JP6842585B2 - 表示装置の作製方法 - Google Patents

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幸市 武島
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Description

本発明の一態様は、酸化物半導体を用いた半導体装置、該半導体装置を用いた表示装置、
およびその作製方法に関する。
なお、本発明の一態様は、上記の技術分野に限定されない。本明細書等で開示する発明の
一態様の技術分野は、物、方法、または、製造方法に関するものである。または、本発明
の一態様は、プロセス、マシン、マニュファクチャ、または、組成物(コンポジション・
オブ・マター)に関するものである。そのため、より具体的に本明細書で開示する本発明
の一態様の技術分野としては、半導体装置、表示装置、液晶表示装置、発光装置、照明装
置、蓄電装置、記憶装置、それらの駆動方法、または、それらの製造方法、を一例として
挙げることができる。
なお、本明細書等において半導体装置とは、半導体特性を利用することで機能しうる装置
全般を指す。トランジスタ、半導体回路は半導体装置の一態様である。また、記憶装置、
表示装置、電子機器は、半導体装置を有する場合がある。
絶縁表面を有する基板上に形成された半導体膜を用いてトランジスタを構成する技術が注
目されている。当該トランジスタは集積回路(IC)や画像表示装置(表示装置)のよう
な電子デバイスに広く応用されている。トランジスタに適用可能な半導体薄膜としてシリ
コン系半導体材料が広く知られているが、その他の材料として酸化物半導体が注目されて
いる。
例えば、トランジスタの活性層として、インジウム(In)、ガリウム(Ga)、および
亜鉛(Zn)を含む非晶質酸化物半導体を用いたトランジスタが特許文献1に開示されて
いる。
また、表示装置においては、薄型軽量化に加えて、可撓性や耐衝撃性の向上が望まれてい
る。例えば、特許文献2には、フィルム基板上に、スイッチング素子であるトランジスタ
や有機EL素子を備えたフレキシブルなアクティブマトリクス型の発光装置が開示されて
いる。
特開2006−165528号公報 特開2003−174153号公報
可撓性を有する表示装置の製造工程では、硬質基板を用いた場合には問題とならないよう
な微細な不良箇所が工程中に拡大することがあり、製品歩留りを低下させることがある。
また、表示装置の完成後に当該不良箇所が曲げや撓みなどによって拡大し、表示品位や信
頼性を低下させることがある。
そのため、可撓性を有する表示装置の作製方法においては、材料の組み合わせや適切な加
工手段を用いることで工程途中の製造物に微細な不良箇所を発生させないことが望まれる
したがって、本発明の一態様は、表示品位が良好な表示装置を提供することを目的の一つ
とする。または、信頼性の高い表示装置を提供することを目的の一つとする。または、新
規な表示装置を提供することを目的の一つとする。または、新規な半導体装置などを提供
することを目的の一つとする。または、上記表示装置の作製方法を提供することを目的の
一つとする。
なお、これらの課題の記載は、他の課題の存在を妨げるものではない。なお、本発明の一
態様は、これらの課題の全てを解決する必要はないものとする。なお、これら以外の課題
は、明細書、図面、請求項などの記載から、自ずと明らかとなるものであり、明細書、図
面、請求項などの記載から、これら以外の課題を抽出することが可能である。
本発明の一態様は、酸化物半導体層を用いたトランジスタを有する可撓性表示装置、およ
びその作製方法に関する。
本発明の一態様は、第1の素子層および第2の素子層を有し、第1の素子層および第2の
素子層の一方は、酸化物半導体層を有する第1のトランジスタおよび表示素子を含む画素
部、ならびに酸化物半導体層を有する第2のトランジスタを含む回路部を有し、第1の素
子層および第2の素子層の他方は、着色層および遮光層を有する表示装置の作製方法であ
って、第1の基板上に第1の有機樹脂層を形成し、第1の有機樹脂層上に第1の絶縁膜を
形成し、第1の絶縁膜上に第1の素子層を形成し、第2の基板上に第2の有機樹脂層を形
成し、第2の有機樹脂層上に第2の絶縁膜を形成し、第2の絶縁膜上に第2の素子層を形
成し、第1の素子層および第2の素子層が密封されるように第1の基板と第2の基板を貼
り合わせ、第1の有機樹脂層と第1の基板との密着性を低下させて第1の基板を分離する
第1の分離工程を行い、第1の有機樹脂層と第1の可撓性基板を第1の接着層を介して接
着し、第2の有機樹脂層と第2の基板との密着性を低下させて第2の基板を分離する第2
の分離工程を行い、第2の有機樹脂層と第2の可撓性基板を第2の接着層を介して接着す
ることを特徴とする表示装置の作製方法である。
なお、本明細書における「第1」、「第2」、などの序数詞は、構成要素の混同を避ける
ために付したものであり、数的に限定するものではないことを付記する。
第1の有機樹脂層および第2の有機樹脂層は、エポキシ樹脂、アクリル樹脂、ポリイミド
樹脂、ポリアミド樹脂、またはポリアミドイミド樹脂から選ばれた材料で形成することが
できる。
前記第1の有機樹脂層と前記第1の基板との密着性の低下、および前記第2の有機樹脂層
と前記第2の基板との密着性を低下は、線状のエキシマレーザ光照射で行うことが好まし
い。
また、上記エキシマレーザ光は、複数の発振器から出力されるレーザ光を合成したレーザ
光であることが好ましい。
また、第2の分離工程は、前記第1の可撓性基板をローラの曲面に接して剥離することで
行うことが好ましい。
第1の絶縁膜および第2の絶縁膜には、酸化シリコン膜、酸化窒化シリコン膜、窒化シリ
コン膜、または窒化酸化シリコン膜が含まれることが好ましい。
酸化物半導体層は、In−M−Zn酸化物(MはAl、Ti、Ga、Y、Zr、La、C
e、Nd、SnまたはHf)を用いることができる。また、酸化物半導体層はc軸に配向
する結晶を有することが好ましい。
表示素子は、有機EL素子を用いることができる。
また、本発明の一態様は、第1の可撓性基板と、第1の接着層と、第1の有機樹脂層と、
第1の絶縁膜と、酸化物半導体層を有する第1のトランジスタおよび表示素子を含む画素
部、ならびに酸化物半導体層を有する第2のトランジスタを含む回路部を有する第1の素
子層と、着色層および遮光層を有する第2の素子層と、第2の絶縁膜と、第2の有機樹脂
層と、第2の接着層と、第2の可撓性基板と、が、上記順序で積層されていることを特徴
とする表示装置である。
第1のトランジスタが有する酸化物半導体層は単層とし、第2のトランジスタが有する酸
化物半導体層は多層としてもよい。
また、第1のトランジスタが有する酸化物半導体層は、酸化物半導体層を有する第2のト
ランジスタのゲート絶縁膜と接する層と同じ組成であることが好ましい。
本発明の一態様を用いることにより、表示品位が良好な表示装置を提供することができる
。または、信頼性の高い表示装置を提供することができる。または、新規な表示装置など
を提供することができる。または、上記表示装置の作製方法を提供することができる。ま
たは、表示装置の歩留りの高い作製方法を提供することができる。
なお、これらの効果の記載は、他の効果の存在を妨げるものではない。なお、本発明の一
態様は、必ずしも、これらの効果の全てを有する必要はない。なお、これら以外の効果は
、明細書、図面、請求項などの記載から、自ずと明らかとなるものであり、明細書、図面
、請求項などの記載から、これら以外の効果を抽出することが可能である。
表示装置を説明する上面図。 表示装置を説明する断面図。 表示装置を説明する断面図。 表示装置の作製方法を説明する断面図。 表示装置の作製方法を説明する断面図。 エキシマレーザを用いた加工装置の一例を説明する図。 剥離装置の一例を示す図。 剥離装置の一例を示す図。 剥離装置の一例を示す図。 剥離装置の一例を示す図。 剥離装置の一例を示す図。 剥離装置の一例を示す図。 剥離装置の一例を示す図。 剥離装置の一例を示す図。 剥離装置の一例を示す図。 剥離装置の一例を示す図。 表示装置を説明するブロック図および回路図。 表示モジュールを説明する図。 トランジスタを説明する断面図。 トランジスタを説明する断面図。 CAAC−OSの断面におけるCs補正高分解能TEM像、およびCAAC−OSの断面模式図。 CAAC−OSの平面におけるCs補正高分解能TEM像。 CAAC−OSおよび単結晶酸化物半導体のXRDによる構造解析を説明する図。 電子機器を説明する図。 トランジスタを説明する断面図。 トランジスタを説明する断面図。 トランジスタを説明する断面図。 トランジスタを説明する断面図。 トランジスタを説明する断面図。 表示装置を説明する断面図。 表示装置を説明する断面図。 トランジスタの作製方法を説明する断面図。 トランジスタの作製方法を説明する断面図。 トランジスタの作製方法を説明する断面図。 トランジスタを説明する断面図。 抵抗率の温度依存性を説明する図。 トランジスタを説明する断面図。 トランジスタを説明する断面図。 トランジスタを説明する断面図。 CAAC−OSの電子回折パターンを示す図。 In−Ga−Zn酸化物の電子照射による結晶部の変化を示す図。 CAAC−OSおよびnc−OSの成膜モデルを説明する模式図。 InGaZnOの結晶、およびペレットを説明する図。 CAAC−OSの成膜モデルを説明する模式図。
実施の形態について、図面を用いて詳細に説明する。但し、本発明は以下の説明に限定さ
れず、本発明の趣旨およびその範囲から逸脱することなくその形態および詳細を様々に変
更し得ることは当業者であれば容易に理解される。したがって、本発明は以下に示す実施
の形態の記載内容に限定して解釈されるものではない。なお、以下に説明する発明の構成
において、同一部分または同様な機能を有する部分には同一の符号を異なる図面間で共通
して用い、その繰り返しの説明は省略することがある。なお、図を構成する同じ要素のハ
ッチングを異なる図面間で適宜省略または変更する場合もある。
例えば、本明細書等において、XとYとが接続されている、と明示的に記載されている場
合は、XとYとが電気的に接続されている場合と、XとYとが機能的に接続されている場
合と、XとYとが直接接続されている場合とが、本明細書等に開示されているものとする
。したがって、所定の接続関係、例えば、図または文章に示された接続関係に限定されず
、図または文章に示された接続関係以外のものも、図または文章に記載されているものと
する。
ここで、X、Yは、対象物(例えば、装置、素子、回路、配線、電極、端子、導電膜、層
、など)であるとする。
XとYとが直接的に接続されている場合の一例としては、XとYとの電気的な接続を可能
とする素子(例えば、スイッチ、トランジスタ、容量素子、インダクタ、抵抗素子、ダイ
オード、表示素子、発光素子、負荷など)が、XとYとの間に接続されていない場合であ
り、XとYとの電気的な接続を可能とする素子(例えば、スイッチ、トランジスタ、容量
素子、インダクタ、抵抗素子、ダイオード、表示素子、発光素子、負荷など)を介さずに
、XとYとが、接続されている場合である。
XとYとが電気的に接続されている場合の一例としては、XとYとの電気的な接続を可能
とする素子(例えば、スイッチ、トランジスタ、容量素子、インダクタ、抵抗素子、ダイ
オード、表示素子、発光素子、負荷など)が、XとYとの間に1個以上接続されることが
可能である。なお、スイッチは、オンオフが制御される機能を有している。つまり、スイ
ッチは、導通状態(オン状態)、または、非導通状態(オフ状態)になり、電流を流すか
流さないかを制御する機能を有している。または、スイッチは、電流を流す経路を選択し
て切り替える機能を有している。なお、XとYとが電気的に接続されている場合は、Xと
Yとが直接的に接続されている場合を含むものとする。
XとYとが機能的に接続されている場合の一例としては、XとYとの機能的な接続を可能
とする回路(例えば、論理回路(インバータ、NAND回路、NOR回路など)、信号変
換回路(DA変換回路、AD変換回路、ガンマ補正回路など)、電位レベル変換回路(電
源回路(昇圧回路、降圧回路など)、信号の電位レベルを変えるレベルシフタ回路など)
、電圧源、電流源、切り替え回路、増幅回路(信号振幅または電流量などを大きく出来る
回路、オペアンプ、差動増幅回路、ソースフォロワ回路、バッファ回路など)、信号生成
回路、記憶回路、制御回路など)が、XとYとの間に1個以上接続されることが可能であ
る。なお、一例として、XとYとの間に別の回路を挟んでいても、Xから出力された信号
がYへ伝達される場合は、XとYとは機能的に接続されているものとする。なお、XとY
とが機能的に接続されている場合は、XとYとが直接的に接続されている場合と、XとY
とが電気的に接続されている場合とを含むものとする。
なお、XとYとが電気的に接続されている、と明示的に記載されている場合は、XとYと
が電気的に接続されている場合(つまり、XとYとの間に別の素子又は別の回路を挟んで
接続されている場合)と、XとYとが機能的に接続されている場合(つまり、XとYとの
間に別の回路を挟んで機能的に接続されている場合)と、XとYとが直接接続されている
場合(つまり、XとYとの間に別の素子又は別の回路を挟まずに接続されている場合)と
が、本明細書等に開示されているものとする。つまり、電気的に接続されている、と明示
的に記載されている場合は、単に、接続されている、とのみ明示的に記載されている場合
と同様な内容が、本明細書等に開示されているものとする。
なお、例えば、トランジスタのソース(又は第1の端子など)が、Z1を介して(又は介
さず)、Xと電気的に接続され、トランジスタのドレイン(又は第2の端子など)が、Z
2を介して(又は介さず)、Yと電気的に接続されている場合や、トランジスタのソース
(又は第1の端子など)が、Z1の一部と直接的に接続され、Z1の別の一部がXと直接
的に接続され、トランジスタのドレイン(又は第2の端子など)が、Z2の一部と直接的
に接続され、Z2の別の一部がYと直接的に接続されている場合では、以下のように表現
することが出来る。
例えば、「XとYとトランジスタのソース(又は第1の端子など)とドレイン(又は第2
の端子など)とは、互いに電気的に接続されており、X、トランジスタのソース(又は第
1の端子など)、トランジスタのドレイン(又は第2の端子など)、Yの順序で電気的に
接続されている。」と表現することができる。または、「トランジスタのソース(又は第
1の端子など)は、Xと電気的に接続され、トランジスタのドレイン(又は第2の端子な
ど)はYと電気的に接続され、X、トランジスタのソース(又は第1の端子など)、トラ
ンジスタのドレイン(又は第2の端子など)、Yは、この順序で電気的に接続されている
」と表現することができる。または、「Xは、トランジスタのソース(又は第1の端子な
ど)とドレイン(又は第2の端子など)とを介して、Yと電気的に接続され、X、トラン
ジスタのソース(又は第1の端子など)、トランジスタのドレイン(又は第2の端子など
)、Yは、この接続順序で設けられている」と表現することができる。これらの例と同様
な表現方法を用いて、回路構成における接続の順序について規定することにより、トラン
ジスタのソース(又は第1の端子など)と、ドレイン(又は第2の端子など)とを、区別
して、技術的範囲を決定することができる。
または、別の表現方法として、例えば、「トランジスタのソース(又は第1の端子など)
は、少なくとも第1の接続経路を介して、Xと電気的に接続され、前記第1の接続経路は
、第2の接続経路を有しておらず、前記第2の接続経路は、トランジスタを介した、トラ
ンジスタのソース(又は第1の端子など)とトランジスタのドレイン(又は第2の端子な
ど)との間の経路であり、前記第1の接続経路は、Z1を介した経路であり、トランジス
タのドレイン(又は第2の端子など)は、少なくとも第3の接続経路を介して、Yと電気
的に接続され、前記第3の接続経路は、前記第2の接続経路を有しておらず、前記第3の
接続経路は、Z2を介した経路である。」と表現することができる。または、「トランジ
スタのソース(又は第1の端子など)は、少なくとも第1の接続経路によって、Z1を介
して、Xと電気的に接続され、前記第1の接続経路は、第2の接続経路を有しておらず、
前記第2の接続経路は、トランジスタを介した接続経路を有し、トランジスタのドレイン
(又は第2の端子など)は、少なくとも第3の接続経路によって、Z2を介して、Yと電
気的に接続され、前記第3の接続経路は、前記第2の接続経路を有していない。」と表現
することができる。または、「トランジスタのソース(又は第1の端子など)は、少なく
とも第1の電気的パスによって、Z1を介して、Xと電気的に接続され、前記第1の電気
的パスは、第2の電気的パスを有しておらず、前記第2の電気的パスは、トランジスタの
ソース(又は第1の端子など)からトランジスタのドレイン(又は第2の端子など)への
電気的パスであり、トランジスタのドレイン(又は第2の端子など)は、少なくとも第3
の電気的パスによって、Z2を介して、Yと電気的に接続され、前記第3の電気的パスは
、第4の電気的パスを有しておらず、前記第4の電気的パスは、トランジスタのドレイン
(又は第2の端子など)からトランジスタのソース(又は第1の端子など)への電気的パ
スである。」と表現することができる。これらの例と同様な表現方法を用いて、回路構成
における接続経路について規定することにより、トランジスタのソース(又は第1の端子
など)と、ドレイン(又は第2の端子など)とを、区別して、技術的範囲を決定すること
ができる。
なお、これらの表現方法は、一例であり、これらの表現方法に限定されない。ここで、X
、Y、Z1、Z2は、対象物(例えば、装置、素子、回路、配線、電極、端子、導電膜、
層、など)であるとする。
なお、回路図上は独立している構成要素同士が電気的に接続しているように図示されてい
る場合であっても、1つの構成要素が、複数の構成要素の機能を併せ持っている場合もあ
る。例えば配線の一部が電極としても機能する場合は、一の導電膜が、配線の機能、及び
電極の機能の両方の構成要素の機能を併せ持っている。したがって、本明細書における電
気的に接続とは、このような、一の導電膜が、複数の構成要素の機能を併せ持っている場
合も、その範疇に含める。
なお、「膜」という言葉と、「層」という言葉とは、場合によっては、または、状況に応
じて、互いに入れ替えることが可能である。例えば、「導電層」という用語を、「導電膜
」という用語に変更することが可能な場合がある。または、例えば、「絶縁膜」という用
語を、「絶縁層」という用語に変更することが可能な場合がある。
(実施の形態1)
本実施の形態では、本発明の一態様の表示装置およびその作製方法について図面を用いて
説明する。
なお、本明細書中における表示装置とは、画像表示デバイス、もしくは光源(照明装置な
ども含む)を指す。また、コネクター、例えばFPC、TCP(Tape Carrie
r Package)が取り付けられたモジュール、TCPの先にプリント配線板が設け
られたモジュール、または表示素子にCOG方式により駆動回路が直接実装されたモジュ
ールも全て表示装置に含むものとする。
本発明の一態様である表示装置は、フレキシブル性を有する。なお、フレキシブル性とは
、曲げ、撓めることが可能であることをいう。また、フレキシブル性は最終製品において
利用される場合のほか、製造工程中に利用される場合もある。後者の場合、最終製品とし
てはフレキシブル性を有さない場合もある。
図1は、本発明の一態様の表示装置300の上面図である。なお、図1では、図の明瞭化
のために一部の要素を拡大、縮小、透過、または省略して図示している。
表示装置300は、第1の可撓性基板301上に設けられた画素部302と、当該画素部
を駆動するための第1の回路部304および第2の回路部305と、画素部302、第1
の回路部304および第2の回路部305を囲むように配置されるシール材312と、第
1の可撓性基板301に対向するように設けられる第2の可撓性基板307と、を有する
。なお、第1の回路部304としては、例えば信号線駆動回路(ソースドライバ)、第2
の回路部305としては、例えば、走査線駆動回路(ゲートドライバ)を有することがで
きる。
第1の可撓性基板301と第2の可撓性基板307は、シール材312によって接着され
ている。また、図1には図示しないが、第1の可撓性基板301と第2の可撓性基板30
7の間には表示素子が設けられる。すなわち、画素部302、第1の回路部304、第2
の回路部305、および表示素子は、第1の可撓性基板301とシール材312と第2の
可撓性基板307によって封止されている。
また、表示装置300は、第1の可撓性基板301上のシール材312によって囲まれて
いる領域とは異なる領域に、画素部302、第1の回路部304および第2の回路部30
5と電気的に接続されるFPC端子部308(FPC:Flexible printe
d circuit)が設けられる。
また、FPC端子部308には、FPC316が接続され、FPC316によって画素部
302、第1の回路部304および第2の回路部305に各種信号等が供給される。また
、画素部302、第1の回路部304、第2の回路部305、およびFPC端子部308
には、信号線310が各々接続されている。FPC316により供給される各種信号等は
、信号線310を介して、画素部302、第1の回路部304および第2の回路部305
に与えられる。
なお、図1では、画素部302を駆動するための回路を二つの領域に配置する構成を例示
したが、当該回路の構成はこれに限られない。例えば、当該回路を一つの領域にまとめて
配置してもよい。また、当該回路を三つ以上に分割して配置してもよい。また、第1の回
路部304および第2の回路部305のいずれか一方のみを第1の可撓性基板301上に
形成し、他方の回路を外付けにしてもよい。
また、画素部302を駆動するための回路は、画素部302に含まれるトランジスタと同
様に第1の可撓性基板301上に形成する構成であってもよいし、COG(Chip O
n Glass)などでICチップを実装する構成であってもよい。また、TCPなどを
接続する構成であってもよい。
なお、表示装置300が有する画素部302、第1の回路部304および第2の回路部3
05は、チャネル形成領域が酸化物半導体層で形成された複数のトランジスタを有してい
る。
酸化物半導体層を用いたトランジスタは移動度が高いためトランジスタの占有面積を小さ
くすることができ、開口率を向上させることができる。また、当該トランジスタを用いて
画素部302と同一基板上に第1の回路部304および第2の回路部305を形成するこ
ともできる。また、当該トランジスタはオフ電流が極めて小さく、画像信号等の保持時間
を長くすることができることから、フレーム周波数を低くすることができ、表示装置の消
費電力を低減させることができる。
また、酸化物半導体層としては、c軸に配向した結晶を有することが好ましい。トランジ
スタのチャネル形成領域に当該結晶を有する酸化物半導体層を用いると、例えば、表示装
置300を曲げる際に当該酸化物半導体層にクラック等が入りにくくなるため、信頼性を
向上させることができる。
したがって、酸化物半導体層を用いたトランジスタを用いることで、例えば非晶質シリコ
ン層や多結晶シリコン層を用いるよりも優れた表示装置を形成することができる。
表示装置300に含まれる表示素子としては、代表的に液晶素子や発光素子を用いること
ができる。
次に、液晶素子を用いた表示装置300aについて説明する。図2は、表示装置300に
液晶素子を用いた場合における、図1に示す一点鎖線A1−A2の断面図である。
表示装置300aは、第1の可撓性基板301と、第1の接着層318aと、第1の有機
樹脂層320aと、第1の絶縁膜321aと、第1の素子層と、第2の素子層と、第2の
絶縁膜321bと、第2の有機樹脂層320bと、第2の接着層318bと、第2の可撓
性基板307が、上記順序で積層されている。
図2において第1の素子層は、トランジスタ350、352と、絶縁膜364、366、
368と、平坦化絶縁膜370と、接続電極360と、導電膜372などを有する。また
、第2の素子層は、導電膜374と、絶縁膜334と、着色層336(カラーフィルタ)
と、遮光層338(ブラックマトリクス)などを有する。なお、第1の素子層および第2
の素子層においては、上記の要素の一部が含まれない場合もある。また、上記以外の要素
が含まれる場合もある。
ここで、第1の素子層と第2の素子層は液晶層376およびシール材312によって密閉
され、液晶素子375を形成する。
第1の可撓性基板301と第2の可撓性基板307としては、例えば、可撓性を有する程
度の厚さのガラスや、ポリエチレンテレフタレート(PET)、ポリエチレンナフタレー
ト(PEN)等のポリエステル樹脂、ポリアクリロニトリル樹脂、ポリイミド樹脂、ポリ
メチルメタクリレート樹脂、ポリカーボネート(PC)樹脂、ポリエーテルスルホン(P
ES)樹脂、ポリアミド樹脂、シクロオレフィン樹脂、ポリスチレン樹脂、ポリアミドイ
ミド樹脂、ポリ塩化ビニル樹脂、ポリエーテルエーテルケトン(PEEK)樹脂等が挙げ
られる。とくに、熱膨張係数の低い材料を用いることが好ましく、例えば、ポリアミドイ
ミド樹脂、ポリイミド樹脂、PET等を好適に用いることができる。また、ガラス繊維に
有機樹脂を含浸した基板や、無機フィラーを有機樹脂に混ぜて熱膨張係数を下げた基板を
使用することもできる。
接着層318a、318bには、例えば、二液混合型の樹脂などの常温で硬化する硬化樹
脂、光硬化性の樹脂、熱硬化性の樹脂などの樹脂を用いることができる。例えば、エポキ
シ樹脂、アクリル樹脂、シリコーン樹脂、フェノール樹脂等が挙げられる。特に、エポキ
シ樹脂等の透湿性が低い材料が好ましい。
第1の有機樹脂層320aおよび第2の有機樹脂層320bとしては、例えば、エポキシ
樹脂、アラミド樹脂、アクリル樹脂、ポリイミド樹脂、ポリアミド樹脂、またはポリアミ
ドイミド樹脂から選ばれた材料で形成することができる。
第1の絶縁膜321aおよび第2の絶縁膜321bとしては、酸化シリコン膜、酸化窒化
シリコン膜、窒化シリコン膜または窒化酸化シリコン膜の単層、またはこれらの積層を用
いることができる。特に、第1の可撓性基板301および第1の接着層318aなどに含
まれる不純物がトランジスタ等に拡散することを防止するため、ブロッキング性の高い窒
素を含む膜を用いることが好ましい。
表示装置300aは、引き回し配線部311と、画素部302と、第1の回路部304と
、FPC端子部308と、を有する。なお、引き回し配線部311は、信号線310を有
する。
また、表示装置300aにおいては、画素部302にトランジスタ350、第1の回路部
304にトランジスタ352がそれぞれ設けられる構成について例示している。
図2において、トランジスタ350とトランジスタ352は、同一のサイズの構成として
いるが、これに限定されない。トランジスタ350とトランジスタ352は、適宜サイズ
(チャネル長およびチャネル幅等)、または数などを変えることができる。また、図2に
おいては、第2の回路部305は図示していないが、接続先または接続方法等を変更する
ことで、第1の回路部304と同様の構成とすることができる。
引き回し配線部311が有する信号線310は、トランジスタ350のソース電極層およ
びドレイン電極層を形成する工程で形成することができる。
FPC端子部308は、接続電極360、異方性導電膜380、およびFPC316を有
する。また、接続電極360は、トランジスタ350のソース電極層およびドレイン電極
層を形成する工程で形成することができる。また、接続電極360は、FPC316が有
する端子と異方性導電膜380を介して、電気的に接続される。
また、画素部のトランジスタ、および駆動回路部に使用するトランジスタに接続する信号
線として、銅元素を含む配線を用いることが好ましい。銅元素を含む配線を用いることで
、配線抵抗に起因する信号遅延等を少なくすることができる。
また、図2において、トランジスタ350およびトランジスタ352上に、絶縁膜364
、366、368、および平坦化絶縁膜370が設けられている。
絶縁膜364、366は、同種の材料の絶縁膜を用いることができ、例えば、酸化シリコ
ン、酸化窒化シリコン等を用いることができる。ここで、絶縁膜364は欠陥量が少なく
、絶縁膜366は、化学量論的組成を満たす酸素よりも多くの酸素を含む酸化物絶縁膜を
用いて形成することが好ましい。なお、絶縁膜364、366を同種材料の単層で形成し
てもよい。絶縁膜368は、酸素、水素、水、アルカリ金属、アルカリ土類金属等のブロ
ッキングできる機能を有する。例えば、窒化絶縁膜などを用いることが好ましい。
また、平坦化絶縁膜370としては、ポリイミド樹脂、アクリル樹脂、ポリイミドアミド
樹脂、ベンゾシクロブテン樹脂、ポリアミド樹脂、エポキシ樹脂等の耐熱性を有する有機
材料を用いることができる。なお、これらの材料で形成される絶縁膜を複数積層させるこ
とで、平坦化絶縁膜370を形成してもよい。また、平坦化絶縁膜370を設けない構成
としてもよい。
また、トランジスタ350が有するソース電極層およびドレイン電極層の一方には、導電
膜372が電気的に接続される。導電膜372は、平坦化絶縁膜370上に形成され画素
電極、すなわち液晶素子の一方の電極として機能する。導電膜372としては、可視光に
おいて透光性のある導電膜を用いると好ましい。該導電膜としては、例えば、インジウム
(In)、亜鉛(Zn)、錫(Sn)の中から選ばれた一種を含む材料を用いるとよい。
液晶素子375は、導電膜372、導電膜374、および液晶層376を有する。導電膜
374は、第2の可撓性基板307側に設けられ、対向電極としての機能を有する。図2
に示す表示装置300aは、導電膜372と導電膜374に印加される電圧によって、液
晶層376の配向状態を変えることによって光の透過、非透過が制御され画像を表示する
ことができる。
なお、図2において図示しないが、導電膜372、374の液晶層376と接する側に、
それぞれ配向膜を設ける構成としてもよい。そのほか、偏光部材、位相差部材、反射防止
部材などの光学部材(光学基板)などは適宜設けてもよい。例えば、偏光基板および位相
差基板による円偏光を用いてもよい。また、光源としてバックライト、サイドライトなど
を用いてもよい。
また、第1の可撓性基板301と第2の可撓性基板307の間には、スペーサ378が設
けられる。スペーサ378は、絶縁膜を選択的にエッチングすることで得られる柱状のス
ペーサであり、液晶層376の膜厚(セルギャップ)を制御するために設けられる。なお
、スペーサ378として、球状のスペーサを用いていても良い。
液晶層376を構成する液晶材料としては、サーモトロピック液晶、低分子液晶、高分子
液晶、高分子分散型液晶、強誘電性液晶、反強誘電性液晶等を用いることができる。これ
らの液晶材料は、条件により、コレステリック相、スメクチック相、キュービック相、カ
イラルネマチック相、等方相等を示す。
また、横電界方式を採用する場合、配向膜を用いないブルー相を示す液晶を用いてもよい
。ブルー相は液晶相の一つであり、コレステリック液晶を昇温していくと、コレステリッ
ク相から等方相へ転移する直前に発現する相である。ブルー相は狭い温度範囲でしか発現
しないため、温度範囲を改善するために数重量%以上のカイラル剤を混合させた液晶組成
物を用いて液晶層に用いる。ブルー相を示す液晶とカイラル剤とを含む液晶組成物は、応
答速度が短く、光学的等方性であるため配向処理が不要であり、視野角依存性が小さい。
また配向膜を設けなくてもよいのでラビング処理も不要となるため、ラビング処理によっ
て引き起こされる静電破壊を防止することができ、作製工程中の液晶表示装置の不良や破
損を軽減することができる。
また、表示素子として液晶素子を用いる場合、TN(Twisted Nematic)
モード、IPS(In−Plane−Switching)モード、FFS(Fring
e Field Switching)モード、ASM(Axially Symmet
ric aligned Micro−cell)モード、OCB(Optical C
ompensated Birefringence)モード、FLC(Ferroel
ectric Liquid Crystal)モード、AFLC(AntiFerro
electric Liquid Crystal)モードなどを用いることができる。
また、ノーマリブラック型の液晶表示装置、例えば垂直配向(VA)モードを採用した透
過型の液晶表示装置としてもよい。垂直配向モードとしては、いくつか挙げられるが、例
えば、MVA(Multi−Domain Vertical Alignment)モ
ード、PVA(Patterned Vertical Alignment)モード、
ASVモードなどを用いることができる。
また、画素部302における表示方式は、プログレッシブ方式やインターレース方式等を
用いることができる。また、カラー表示する際に画素で制御する色要素としては、RGB
(Rは赤、Gは緑、Bは青を表す)の三色に限定されない。例えば、Rの画素とGの画素
とBの画素とW(白)の画素の四画素から構成されてもよい。または、ペンタイル配列の
ように、RGBのうちの2色分で一つの色要素を構成し、色要素よって、異なる2色を選
択して構成してもよい。またはRGBに、イエロー、シアン、マゼンタ等を一色以上追加
してもよい。なお、色要素のドット毎にその表示領域の大きさが異なっていてもよい。た
だし、開示する発明はカラー表示の表示装置に限定されるものではなく、モノクロ表示の
表示装置に適用することもできる。
次に、発光素子を用いた表示装置300bについて説明する。図3は、表示装置300に
発光素子を用いた場合における、図1に示す一点鎖線A1−A2の断面図である。なお、
上述した液晶素子を用いた表示装置300aと重複する説明は省略する。
表示装置300bは、第1の可撓性基板301と、第1の接着層318aと、第1の有機
樹脂層320aと、第1の絶縁膜321aと、第1の素子層410と、第2の素子層41
1と、第2の絶縁膜321bと、第2の有機樹脂層320bと、第2の接着層318bと
、第2の可撓性基板307が、上記順序で積層されている。
図3において第1の素子層410は、トランジスタ350、352と、絶縁膜364、3
66、368と、平坦化絶縁膜370と、発光素子480と、絶縁膜430と、信号線3
10と、接続電極360を有する。また、第2の素子層411は、絶縁膜334と、着色
層336と、遮光層338と、を有する。また、第1の素子層410と第2の素子層41
1は、封止層432およびシール材312によって密閉される。なお、第1の素子層41
0および第2の素子層411においては、上記の要素の一部が含まれない場合もある。ま
た、上記以外の要素が含まれる場合もある。
発光素子480は、導電膜444、EL層446、および導電膜448を有する。表示装
置300bは、発光素子480が有するEL層446が発光することによって、画像を表
示することができる。
平坦化絶縁膜370上の導電膜444上には、絶縁膜430が設けられる。絶縁膜430
は、導電膜444の一部を覆う。導電膜444にEL層が発する光に対して反射率の高い
導電膜を用い、導電膜448にEL層が発する光に対して透光性が高い導電膜を用いるこ
とで、発光素子480をトップエミッション構造とすることができる。また、導電膜44
4に当該光に対して透光性の高い導電膜を用い、導電膜448に当該光に対して反射率の
高い導電膜を用いることで、発光素子480をボトムエミッション構造とすることができ
る。また、導電膜444および導電膜448の両方に当該光に対して透光性が高い導電膜
を用いることでデュアルエミッション構造とすることができる。
また、発光素子480と重なる位置に、着色層336が設けられ、絶縁膜430と重なる
位置、引き回し配線部311、および第1の回路部304に遮光層338が設けられてい
る。着色層336および遮光層338は、第3の絶縁膜334で覆われている。発光素子
480と第3の絶縁膜334の間は封止層432で充填されている。なお、表示装置30
0bにおいては、着色層336を設ける構成について例示したが、これに限定されない。
例えば、EL層446を塗り分けにより形成する場合においては、着色層336を設けな
い構成としてもよい。
表示装置300bにおいて、接着層318a、318bに乾燥剤を含ませてもよい。例え
ば、アルカリ土類金属の酸化物(酸化カルシウムや酸化バリウム等)のように、化学吸着
によって水分を吸着する物質を用いることができる。または、ゼオライトやシリカゲル等
のように、物理吸着によって水分を吸着する物質を用いてもよい。乾燥剤が含まれている
と、水分などの不純物が発光素子480に侵入することを抑制でき、表示装置の信頼性が
向上することができる。
また、封止層432に屈折率の高いフィラー(酸化チタン等)を混合することにより、発
光素子480からの光取り出し効率を向上させることができる。
また、接着層318a、318bには、光を散乱させる散乱部材を有していてもよい。例
えば、接着層318a、318bには、封止層432と屈折率が異なる粒子との混合物を
用いることもできる。該粒子は光の散乱部材として機能する。封止層432と屈折率の異
なる粒子は、屈折率の差が0.1以上あることが好ましく、0.3以上あることがより好
ましい。粒子としては、酸化チタン、酸化バリウム、ゼオライト等を用いることができる
。酸化チタンおよび酸化バリウムの粒子は、光を散乱させる性質が強く好ましい。またゼ
オライトを用いると、封止層432等の有する水を吸着することができ、発光素子の信頼
性を向上させることができる。
第1の可撓性基板301および第2の可撓性基板307には、それぞれ、靱性が高い材料
を用いることが好ましい。これにより、耐衝撃性に優れ、破損しにくい発光装置を実現で
きる。例えば、第1の可撓性基板301および第2の可撓性基板307を有機樹脂基板と
することで、基材にガラス基板を用いる場合に比べて、軽量であり、破損しにくい表示装
置を実現できる。
また、第1の可撓性基板301に、熱放射率が高い材料を用いると表示装置の表面温度が
高くなることを抑制でき、表示装置の破壊や信頼性の低下を抑制できる。例えば、第1の
可撓性基板301を金属基板と熱放射率の高い層(例えば、金属酸化物やセラミック材料
を用いることができる)の積層構造としてもよい。
次に、図3に示す表示装置300bの作製方法について図4および図5を用いて説明する
。なお、図4および図5では、図面の煩雑さを避けるために、図3に示す第1の素子層4
10および第2の素子層411を簡略化して図示している。
まず、第1の基板462上に、第1の有機樹脂層320a、第1の絶縁膜321aおよび
第1の素子層410の順でなる積層を形成する(図4(A)参照)。
また、第2の基板463上に、第2の有機樹脂層320b、第2の絶縁膜321bおよび
第2の素子層411の順でなる積層を形成する(図4(B)参照)。
第1の基板462および第2の基板463としては、少なくとも、後の熱処理に耐えうる
程度の耐熱性を有している必要がある。例えば、ガラス基板、セラミック基板、石英基板
、サファイア基板等を用いることができる。
第1の有機樹脂層320aおよび第2の有機樹脂層320bには、例えば、エポキシ樹脂
、アラミド樹脂、アクリル樹脂、ポリイミド樹脂、ポリアミド樹脂、ポリアミドイミド樹
脂等の有機樹脂膜を用いることができる。中でもポリイミド樹脂を用いると耐熱性が高い
ため好ましい。ポリイミド樹脂を用いる場合、該ポリイミド樹脂の膜厚は、3nm以上2
0μm以下、好ましくは500nm以上2μm以下である。該ポリイミド樹脂は、スピン
コート法、ディップコート法、ドクターブレード法等により形成することができる。
第1の絶縁膜321aおよび第2の絶縁膜321bとしては、酸化シリコン膜、酸化窒化
シリコン膜、窒化シリコン膜、窒化酸化シリコン膜等を用いることができ、スパッタ法や
CVD法等で形成することができる。第1の絶縁膜321aを形成することで、例えば、
第1の基板462や第1の有機樹脂層320aから第1の素子層410への不純物の拡散
を抑えることができる。
第1の素子層410の形成時において、トランジスタ350を含む全ての構成の形成温度
は、室温以上300℃以下であると好ましい。例えば、第1の素子層410が有する無機
材料で形成される絶縁膜または導電膜は、成膜温度が150℃以上300℃以下、好まし
くは200℃以上270℃以下とする。また、第1の素子層410が有する有機樹脂材料
で形成される絶縁膜等は、形成温度が室温以上100℃以下で形成されることが好ましい
。また、トランジスタ350の形成工程において、例えば、作製工程中の加熱工程を省く
こともできる。
また、第1の素子層410が有する絶縁膜430、導電膜444、EL層446、および
導電膜448は、以下の方法で形成することができる。
絶縁膜430としては、例えば、有機樹脂または無機絶縁材料を用いることができる。有
機樹脂としては、例えば、ポリイミド樹脂、ポリアミド樹脂、アクリル樹脂、シロキサン
樹脂、エポキシ樹脂、またはフェノール樹脂等を用いることができる。無機絶縁材料とし
ては、例えば、酸化シリコン、酸化窒化シリコン等を用いることができる。絶縁膜430
の形成方法は、特に限定されず、例えば、リソグラフィ法、スパッタ法、蒸着法、液滴吐
出法(インクジェット法等)、印刷法(スクリーン印刷、オフセット印刷等)等を用いれ
ばよい。リソグラフィ法を用いる場合、感光性の樹脂を用いると絶縁膜430の作製工程
を簡略化することができる。
導電膜444としては、例えば、可視光において反射性の高い金属膜を用いると好ましい
。該金属膜としては、例えば、アルミニウム、銀、またはこれらの合金等を用いることが
できる。また、導電膜444としては、例えば、スパッタ法を用いて形成することができ
る。
EL層446としては、導電膜444と導電膜448から注入される正孔と電子とが再結
合し発光できる発光材料を用いればよい。また、該発光材料の他に、正孔注入層、正孔輸
送層、電子輸送層、電子注入層などの機能層を必要に応じて形成してもよい。また、EL
層446としては、例えば、蒸着法、または塗布法などを用いて形成することができる。
導電膜448としては、例えば、可視光において透光性のある導電膜を用いると好ましい
。該導電膜としては、例えば、インジウム(In)、亜鉛(Zn)、錫(Sn)の中から
選ばれた一種を含む材料を用いるとよい。また、導電膜448としては、例えば、酸化タ
ングステンを含むインジウム酸化物、酸化タングステンを含むインジウム亜鉛酸化物、酸
化チタンを含むインジウム酸化物、酸化チタンを含むインジウム錫酸化物、インジウム錫
酸化物(ITO)、インジウム亜鉛酸化物、シリコンを添加したインジウム錫酸化物など
の透光性を有する導電性材料を用いることができる。本発明の一態様の表示装置では、シ
リコンを添加したインジウム錫酸化物を導電膜448に用いることが好ましい。シリコン
を添加したインジウム錫酸化物を用いると、導電膜448の曲げに対する耐性が向上し、
クラック等が入りにくくなる。また、導電膜448は、例えば、スパッタ法を用いて形成
することができる。
また、第2の素子層411が有する着色層336としては、特定の波長帯域の光を透過す
る有色層であればよく、例えば、赤色の波長帯域の光を透過する赤色(R)のカラーフィ
ルタ、緑色の波長帯域の光を透過する緑色(G)のカラーフィルタ、青色の波長帯域の光
を透過する青色(B)のカラーフィルタなどを用いることができる。そのほか、黄色(Y
)、白色(W)のカラーフィルタを用いてもよい。各カラーフィルタは、様々な材料を用
いて、印刷法、インクジェット法、リソグラフィ技術を用いたエッチング方法などでそれ
ぞれ所望の位置に形成する。
また、第2の素子層411が有する遮光層338としては、特定の波長帯域の光を遮光す
る機能を有していればよく、金属膜または黒色顔料等を含んだ有機絶縁膜などを用いるこ
とができる。
また、第2の素子層411が有する第3の絶縁膜434としては、例えば、アクリル樹脂
等の有機絶縁膜を用いることができる。なお、第3の絶縁膜434は、必ずしも形成する
必要はなく、第3の絶縁膜434を形成しない構造としてもよい。
次に、第1の素子層410と第2の素子層411を封止層432を介して貼り合わせる(
図4(C)参照)。なお、シール材312は図示していない。
封止層432としては、可撓性を有する固体封止材料を用いることができる。例えば、ガ
ラスフリットなどのガラス材料や、二液混合型の樹脂などの常温で硬化する硬化樹脂、光
硬化性の樹脂、熱硬化性の樹脂などの樹脂材料を用いることができる。
次に、図4(C)に示した構成から第1の基板462を剥離する。(図4(D)参照)。
なお、第2の基板463を剥離する工程を先に行ってもよい。
なお、上記剥離工程は、様々な方法を適宜用いることができる。例えば、第1の基板46
2を介して第1の有機樹脂層320aに紫外光468を照射することで、第1の有機樹脂
層320aを脆弱化または第1の有機樹脂層320aと第1の基板462との密着性を低
下させることで、第1の基板462を剥離することができる。また、紫外光468の照射
エネルギー密度を調整することで、第1の基板462と第1の有機樹脂層320aの密着
性が高い領域と、第1の基板462と第1の有機樹脂層320aの密着性が低い領域を作
り分けてから剥離してもよい。なお、紫外光の光源としては、例えば波長308nmの紫
外光を出力するエキシマレーザなどを用いることができる。また、高圧水銀ランプやUV
−LEDなどを用いてもよい。
エキシマレーザは高出力のパルスレーザであり、光学系にてビームを線状に整形すること
ができる。線状ビームのレーザ光の照射位置において基板を移動させることで基板全体ま
たは必要箇所にレーザ光を照射することができる。なお、線状ビームは、用いる基板の一
辺と同等以上の長さとすれば、基板を一方向に移動するのみで基板全体にレーザ光を照射
することができる。
エキシマレーザ装置には、レーザ発振器を一つ搭載した装置の他、二つ以上のレーザ発振
器を搭載する装置を用いることもできる。複数のレーザ発振器を搭載する装置においては
、それぞれのレーザ発振器から同期されて出力されたレーザ光を光学系にて合成する(重
ね合わす)ことで高エネルギー密度のレーザ光を得ることができる。したがって、本実施
の形態の用途においては、第8世代ガラス基板(2160mm×2460mm)以上のサ
イズの処理を行うこともできる。また、複数のレーザ発振器を搭載する装置では、それぞ
れのレーザ発振器から出力されるレーザ光が互いに出力ばらつきを補完するため、1パル
ス毎の強度ばらつきが少なくなり、歩留りの高い処理を行うことができる。なお、複数の
発振器に替えて、複数のエキシマレーザ装置を用いてもよい。
図6にエキシマレーザを用いた加工装置の一例を示す。二つのレーザ発振器を有するエキ
シマレーザ装置600から出力されたレーザ光610a、610bは光学系630にて合
成される。さらに光学系630にて横長に伸張されたレーザ光610cは、ミラー650
を介してレンズ670に入射し、縮小されて線状ビーム610dとなる。このとき、線状
ビーム610dが加工物700が有する加工領域710に基板720を介して照射される
ようにする。
なお、本実施の形態において、加工物700には、図4(C)または図5(A)に示す構
成、加工領域710には、第1の有機樹脂層320aまたは第2の有機樹脂層320b、
基板720には、第1の基板462または第2の基板463が該当する。
そして、図中の矢印方向に加工物700を移動させることで、加工領域710全体に線状
ビーム610dを照射することができる。なお、エキシマレーザとしては、波長308n
mまたはそれよりも波長が長いものを用いることが好ましい。波長308nm以上であれ
ば、基板720にガラス基板を用いた場合においても加工に必要なレーザ光を十分に透過
させることができる。
なお、本実施の形態においては、第1の基板462と第1の有機樹脂層320aの界面で
剥離する方法について例示したが、これに限定されない。例えば、剥離したときに第1の
有機樹脂層320aの一部が第1の基板462に残るように分離してもよい。また、第1
の有機樹脂層320aと第1の素子層410との界面で剥離してもよい。
また、第1の基板462と有機樹脂層320aとの界面に液体を浸透させて第1の基板4
62から第1の有機樹脂層320aを剥離してもよい。または、第1の有機樹脂層320
aと第1の素子層410との界面に液体を浸透させて第1の有機樹脂層320aから第1
の素子層410を剥離してもよい。上記液体としては、例えば、水、極性溶媒等を用いる
ことができる。当該液体を用いることによって、剥離に伴って発生する静電気を抑制する
ことができ、第1の素子層410が有するトランジスタ等の静電破壊を抑えることができ
る。
次に、第1の有機樹脂層320aと第1の可撓性基板301を第1の接着層318aを用
いて接着する(図5(A)参照)。
次に、上記と同様の方法を用いて第2の基板463を剥離し、第2の有機樹脂層320b
と第2の可撓性基板307を第2の接着層318bを用いて接着する(図5(B)参照)
そして、接続電極360に異方性導電膜380を介してFPC316を貼り付ける。必要
があればICチップなどを実装させてもよい。
以上により、図3に示す表示装置300bを作製することができる。
なお、第1の有機樹脂層320aと第1の素子層410との界面で剥離を行った場合は、
図5(C)に示す構成となる。このとき、図2および図3に示す表示装置300a、30
0bにおいては、有機樹脂層320aが存在しない構成となる。
本発明の一態様では、有機樹脂層上に酸化物半導体層を用いたトランジスタ等を含む素子
層を形成し、当該有機樹脂層を脆弱化または当該有機樹脂層と基板との密着力を低下させ
ることにより素子層の剥離工程を行う。多結晶シリコンを用いるトランジスタの場合は、
非晶質シリコンを結晶化するためのレーザ光照射工程を有している。レーザ照射工程にお
いては瞬間的ではあるがシリコンが溶融するほどの高温となる領域が生じる。そのため、
本発明と一態様と同様に有機樹脂層を用いる場合は当該有機樹脂層にも熱が伝わり、脱ガ
スや熱膨張などによりトランジスタと基板との間に形成した無機膜などにクラックやピー
リングが発生することがある。また、当該クラックやピーリングを抑えるためにエネルギ
ー密度を抑えたレーザ照射では、十分な結晶性を有する多結晶シリコンを得られなくなっ
てしまう。
一方、酸化物半導体層を用いたトランジスタの製造工程では、高温の工程が不要であり、
トランジスタ等が完成するまで当該有機樹脂層を脆弱化させることなく、安定な工程を行
うことができ、歩留りおよび信頼性の高いトランジスタを作成することができる。
本実施の形態に示す構成は、他の実施の形態に示す構成と適宜組み合わせて用いることが
できる。
(実施の形態2)
本実施の形態では、本発明の一態様の剥離装置について図7、図8、図9、図10、図1
1、図12、図13、図14を用いて説明する。本発明の一態様は、加工部材の第1の部
材を保持することができる構造体と、加工部材の第2の部材を保持することができるステ
ージと、を有し、第1の部材を巻き取りながら、構造体とステージの間の加工部材を、第
1の部材および第2の部材に分離する、剥離装置である。例えば、第1の部材には図5(
A)に示す第2の基板463以外の積層物、第2の部材には第2の基板463を適用する
ことができる。
本発明の一態様の剥離装置を用いることで、加工部材を歩留まりよく第1の部材および第
2の部材に分離することができる。本発明の一態様の剥離装置は、複雑な構成を有さず、
幅広い大きさの加工部材の剥離に対応できる。
以下では、剥離装置の構成と動作、および剥離装置を用いた剥離方法について例示する。
<構成例1>
図7、図8、図9を用いて、加工部材103から第1の部材103aを剥離することで、
第1の部材103aおよび第2の部材103bを分離する例を示す。
まず、剥離を行う直前の剥離装置の斜視図を図7(A)に示し、正面図を図7(B)に示
し、側面図を図7(D)に示す。
図7(A)、図7(B)、図7(C)、図7(D)に示す剥離装置は、構造体101およ
びステージ105を有する。構造体101は、凸面を有する。ステージ105は、該凸面
に対向する支持面を有する。
図7(A)、図7(B)、図7(C)、図7(D)では、剥離装置の該凸面と該支持面の
間に加工部材103が配置されている。
図7(C)に、図7(A)、(B)、(D)とは、構造体101に対する加工部材103
の配置が異なる場合の上面図を示す。図7(A)では、加工部材103の辺部から剥離を
始める場合を示すが、図7(C)の上面図に示すように、加工部材103の角部から剥離
を始めてもよい。加工部材103の辺部から剥離を始める場合は、短辺から剥離を開始し
、長辺方向に剥離を行うことが好ましい。これにより、構造体の回転速度などの条件の制
御が容易となり、剥離の歩留まりを高めることができる。
加工部材103は、シート状であり、シート状の第1の部材103aおよびシート状の第
2の部材103bからなる。第1の部材103aおよび第2の部材103bは、それぞれ
、単層であっても積層であってもよい。加工部材103は、剥離の起点が形成されている
ことが好ましい。これにより、第1の部材103aおよび第2の部材103bの界面で剥
離をすることが容易となる。
剥離装置が搬送手段を有する場合は、該搬送手段によって、ステージ105上に加工部材
103が配置されてもよい。
図7(D)の二点鎖線で囲った箇所の拡大図に示すように、構造体101の凸面を、加工
部材103に形成された点状または線状(実線、破線、枠状含む)の剥離の起点102と
重ねる。その後、構造体101が回転することで、加工部材103に第1の部材103a
を引き剥がす力がかかり、剥離の起点102の近傍から第1の部材103aが剥がれる。
そして、加工部材103は、第1の部材103aと第2の部材103bに分離される。
構造体101は凸面を有していればよく、例えば、円筒状(円柱状、直円柱状、楕円柱状
、放物柱状、なども含む)、円筒の一部、球状、球の一部等の構造物であればよい。例え
ば、ドラムローラ等のローラを用いることができる。
構造体の材質としては、金属、合金、有機樹脂等が挙げられる。構造体は内部に空間や空
洞を有してもよい。
図10(C)、(D)に、一部の面に凸面を含む構造体151、構造体152をそれぞれ
示す。構造体151、構造体152は、それぞれ円筒の一部状の構造を有する。
構造体が有する凸面の曲率半径は、ステージ105の支持面の曲率半径より小さい。凸面
の曲率半径は、例えば、0.5mm以上1000mm以下とすることができる。例えば、
フィルムを剥離する場合、凸面の曲率半径を0.5mm以上500mm以下としてもよく
、具体例としては、150mm、225mm、または300mm等が挙げられる。このよ
うな凸面を有する構造体としては、例えば、直径300mm、450mm、または600
mmのローラ等が挙げられる。なお、加工部材の厚さや大きさによって、凸面の曲率半径
の好ましい範囲は変化する。したがって、これらに限られず、本発明の一態様において、
構造体は、凸面の曲率半径が、ステージ105の支持面の曲率半径より小さければよい。
加工部材103が、密着性の低い積層構造を含む場合、該密着性の低い界面で剥離してし
まい、剥離の歩留まりが低下する場合がある。例えば、加工部材103が有機EL素子を
含む場合には、EL層を構成する2層の界面や、EL層と電極の界面で剥離され、第1の
部材103aと第2の部材103bとの界面が剥離が困難な場合がある。したがって、第
1の部材103aと第2の部材103bの界面で剥離できるよう、凸面の曲率半径を設定
する。また、構造体101の回転速度等により制御してもよい。
また、凸面の曲率半径が小さすぎると、凸面に巻き取られた第1の部材103aに含まれ
る素子が壊れる場合がある。したがって、凸面の曲率半径は0.5mm以上であることが
好ましい。
また、凸面の曲率半径が大きいと、ガラス、サファイア、石英、シリコン等の可撓性が低
く、剛性が高い基板を凸面で巻き取ることができる。したがって、凸面の曲率半径は、例
えば、300mm以上であることが好ましい。
また、凸面の曲率半径が大きいと、剥離装置が大型化してしまい、設置場所などに制限が
かかる場合がある。したがって、凸面の曲率半径は、例えば、1000mm以下であるこ
とが好ましく、500mm以下であることがより好ましい。
凸面の少なくとも一部は、粘着性を有していてもよい。例えば、凸面の一部または全体に
粘着テープ等を貼ってもよい。また、図10(E)に示すように凸面の少なくとも一部に
、第1の部材103aに対して粘着性を有する部位104を設けてもよい。また、構造体
101が吸着機構を有し、凸面が、第1の部材103aを吸着できてもよい。
構造体101やステージ105は、前後、左右、上下の少なくともいずれか一に移動可能
であってもよい。構造体101の凸面とステージ105の支持面の間の距離が可変である
と、様々な厚みの加工部材の剥離が行えるため好ましい。構成例1では、構造体101が
ステージ105の長手方向に移動可能である例を示す。
ステージ105上に配置された部材等(例えば、加工部材103や、第2の部材103b
)を保持するための保持手段としては、吸引チャック、静電チャック、メカニカルチャッ
ク等のチャックが挙げられる。例えば、ポーラスチャックを用いてもよい。また、吸着テ
ーブル、ヒーターテーブル、スピンナーテーブル等に部材を固定してもよい。
次に、剥離途中の剥離装置の斜視図を図8(A)に示し、正面図を図8(B)に示し、側
面図を図8(C)に示す。また、剥離後の剥離装置の斜視図を図9(A)に示し、正面図
を図9(B)に示し、側面図を図9(C)に示す。
構造体101の中心には回転軸109がある。構造体101の回転する方向を図8(A)
、(C)等に示すが、構造体101は逆方向に回転することができてもよい。また、ガイ
ド107の溝に沿って回転軸109が移動することで、ステージ105の長手方向に構造
体101が移動することができる(図8(C)、図9(C)の左右方向)。
構造体101が回転することで、構造体101の凸面と重なる第1の部材103aは、剥
離の起点の近傍より、加工部材103から剥離され、凸面に巻き取られながら、第2の部
材103bと分離される。構造体101の凸面で第1の部材103aが保持され、ステー
ジ105上には第2の部材103bが保持される。
本発明の一態様の剥離装置において、ステージ105または構造体101の少なくとも一
方が移動することで、ステージ105に対する構造体101の回転中心の位置が移動でき
ればよい。構成例1では、構造体101の回転中心自体が移動する例を示す。具体的には
、ステージ105が静止した(または固定された)状態で、構造体101が、第1の部材
103aを巻き取りながら加工部材103の一の端部側から対向する他の端部側に向かっ
て移動(回転移動)することができる例を示す。
構造体101の凸面の線速度は、ステージ105に対する構造体101の回転中心の移動
速度以上である。
第1の部材103aまたは第2の部材103bに張力を加えながら、第1の部材103a
および第2の部材103bを分離してもよい。
図8(C)に矢印108で示すように、第1の部材103aと第2の部材103bの分離
面に液体を供給することができる液体供給機構を有していてもよい。
剥離時に生じる静電気が、第1の部材103aに含まれる素子等に悪影響を及ぼすこと(
半導体素子が静電気により破壊されるなど)を抑制できる。なお、液体を霧状または蒸気
にして吹き付けてもよい。液体としては、純水や有機溶剤などを用いることができ、中性
、アルカリ性、もしくは酸性の水溶液や、塩が溶けている水溶液などを用いてもよい。
剥離装置が搬送手段を有する場合は、剥離後に、該搬送手段によって、ステージ105上
の第2の部材103bや、構造体101に巻き取られた第1の部材103aをそれぞれ搬
出してもよい。
また、図10(A)、(B)に示すように、さらに構造体101が回転することで、ステ
ージ105上に配置されたシート状の部材111と第1の部材103aを貼り合わせても
よい。
部材111は、単層であってもよいし、積層であってもよい。部材111の第1の部材1
03aと接する面の少なくとも一部の領域は、部材103aに対して密着性を有すること
が好ましい。例えば、接着層が形成されていてもよい。
構造体101が1回転する間に、凸面は第1の部材103aをすべて巻き取ってもよい。
これにより、第1の部材103aがステージ105に触れることや第1の部材103aが
構造体101により加圧されることを抑制できるため好ましい。
また、凸面に巻き取られた第1の部材103aがステージ105に触れることなく、部材
111に貼り合わされることが好ましい。
例えば、構造体101を1/4回転させて、第1の部材103aを凸面がすべて巻き取り
、構造体101を3/4回転させて、構造体101が部材111の端部付近まで移動し、
さらに構造体101を1/4回転させて、部材111上に第1の部材103aを貼り合わ
せてもよい。
または、剥離が終わった後、構造体101に巻き取られた第1の部材103aがステージ
105に触れないよう、構造体101とステージ105の間隔を調整してもよい。
<構成例2>
構成例2では、ステージが移動することで、ステージに対する構造体の回転中心の位置が
移動する例を示す。具体的には、構造体の回転中心の位置は移動せず、ステージが、加工
部材の一の端部側から対向する他の端部側に向かって移動することができる例を示す。
図11、図12、図13を用いて、加工部材153から第1の部材153aを剥離するこ
とで、第1の部材153aおよび第2の部材153bを分離する例を示す。
まず、剥離を行う直前の剥離装置の斜視図を図11(A)に示し、正面図を図11(B)
に示し、側面図を図11(C)に示す。
図11(A)、図11(B)、図11(C)に示す剥離装置は、構造体151、ステージ
155、支持体157、および搬送ローラ158を有する。構造体151は、凸面を有す
る。ステージ155は、該凸面に対向する支持面を有する。支持体157は、構造体15
1を支持する。
図11(A)、図11(B)、図11(C)では、剥離装置の該凸面と該支持面の間に加
工部材153が配置されている。
図11(A)では、加工部材153の辺部から剥離を始める場合を示すが、構成例1と同
様、加工部材153の角部から剥離を始めてもよい。
構造体151、加工部材153、およびステージ155は、構成例1の構造体101、加
工部材103、およびステージ105とそれぞれ同様の構成を適用することができるため
、説明は省略する。加工部材153には、剥離の起点162が形成されている。
支持体157は、構造体151の回転軸159を支持している。支持体157は構造体1
51の高さを調整する機能を有する。これにより、構造体151の凸面とステージ155
の支持面の間の距離を可変にすることができる。
搬送ローラ158は、ステージ155を移動させることができる。ステージ155の移動
手段に特に限定は無く、ベルトコンベアや搬送ロボットを用いてもよい。
剥離装置が搬送手段を有する場合は、該搬送手段によって、ステージ155上に加工部材
153が配置されてもよい。
次に、剥離途中の剥離装置の斜視図を図12(A)に示し、正面図を図12(B)に示し
、側面図を図12(C)に示す。また、剥離後の剥離装置の斜視図を図13(A)に示し
、正面図を図13(B)に示し、側面図を図13(C)に示す。
構造体151の中心には回転軸159がある。構造体151や搬送ローラ158の回転す
る方向を図12(A)、(C)等に示すが、構造体151や搬送ローラ158はそれぞれ
逆方向に回転することができてもよい。搬送ローラ158が回転することで、構造体15
1の回転中心に対するステージ155およびステージ155上の加工部材153の位置が
移動できる(具体的には図12(C)、図13(C)の左右方向に移動する)。
構造体151に保持された第1の部材153aは、加工部材153から剥離され、凸面に
巻き取られながら、第2の部材153bと分離される。ステージ155上には第2の部材
153bが保持される。
構造体151の凸面を、加工部材153に形成された剥離の起点162と重ねる。その後
、構造体151が回転することで、加工部材153に第1の部材153aを引き剥がす力
がかかり、剥離の起点162の近傍から第1の部材153aが剥がれる。加工部材103
から剥離された第1の部材153aは、凸面に巻き取られながら、第2の部材103bと
分離される。構造体151の凸面で第1の部材153aが保持され、ステージ155上に
は第2の部材153bが保持される。
剥離装置が搬送手段を有する場合は、剥離後に、該搬送手段によって、ステージ155上
の第2の部材153bや、構造体151に巻き取られた第1の部材153aをそれぞれ搬
出してもよい。
また、図14(A)、(B)に示すように、さらに構造体151および搬送ローラ158
が回転することで、ステージ156上に配置されたシート状の部材161と第1の部材1
53aを貼り合わせてもよい。なお、加工部材153が配置されていたステージ155上
に、部材161が配置されていてもよい。
<構成例3>
本発明の一態様の剥離装置の別の構成について、図15を参照しながら説明する。図15
は本発明の一態様の剥離装置の構成および動作を説明する図である。
図15(A−1)、図15(B−1)および図15(C−1)は本発明の一態様の剥離装
置の側面を説明する模式図である。また、図15(A−2)、図15(B−2)および図
15(C−2)は上面を説明する模式図である。
また、図15(A−1)および図15(A−2)は、本発明の一態様の剥離装置が加工部
材103から第1の部材103aを分離する工程を開始する状態を説明する図である。
図15(B−1)および図15(B−2)は、本発明の一態様の剥離装置が加工部材10
3から第1の部材103aを分離している状態を説明する図である。
図15(C−1)および図15(C−2)は、本発明の一態様の剥離装置が加工部材10
3から第1の部材103aを分離し終えた状態を説明する図である。
なお、本実施の形態の構成例3で説明する剥離装置は、円筒状の構造体101を有する点
、円筒状の構造体101の内壁に接し且つ構造体101の回転と同期して回転することが
できる回転体101aを有する点が、図7乃至図14を参照しながら説明する剥離装置と
は異なる。ここでは異なる構成について詳細に説明し、同様の構成を用いることができる
部分は、上記の説明を援用する。
構造体101は円筒状を有する。なお、構造体101は部材101bを外周に備えていて
もよい(図15(A−1)および図15(A−2)参照)。
部材101bは、構造体101の表面の物性を改質することができる。例えば、粘着性を
構造体101の表面に付与できる。または、凹凸部分に集中する応力を分散できる弾力性
を構造体101の表面に付与できる。
例えば、ゴム、シリコンゴム、樹脂または天然素材などを部材101bに適用できる。
なお、構造体101に配置した部材101bに継ぎ目が形成される場合は、加工部材10
3が継ぎ目部分に接しないように、加工部材をステージ105と構造体101の間に供給
する。
回転体101aは、円筒状の構造体101の内周に接し、構造体101の外周とステージ
105の間に加工部材103を挟むように配置される。
回転体101aは、中心軸を中心に回転自在に設けられている。例えば、回転体101a
は円柱状のローラまたは外周に歯車を備えていてもよい。
外周に歯車を備える回転体101aを用いる場合は、その歯車とかみ合う歯車を構造体1
01の内周に設ける。この構成によれば、例えば駆動機構を用いて回転体101aを駆動
して、その回転を構造体101に伝達することができる。
第1のステップにおいて、剥離の起点102が形成された加工部材103をステージ10
5と構造体101の間に挿入する(図15(A−1)および図15(A−2)参照)。な
お、加工部材103が短辺と長辺を有する場合、剥離の起点102を角部に設け、回転体
101aの中心軸と直交する方向から角度θ傾けて、角部から挿入するとよい。これによ
り、剥離の起点102から次第に広げながら、第1の部材103aと第2の部材103b
を分離することができる。
第2のステップにおいて、第1の部材103aと第2の部材103bの分離を進行させる
(図15(B−1)および図15(B−2)参照)。
なお、矢印108で示す液体供給機構を用いて、液体を第1の部材103aと第2の部材
103bの分離面に供給する。(図15(B−1)参照)例えば、分離面に液体を浸透さ
せる。または液体を吹き付けてもよい。
浸透させる液体または吹き付ける液体に水、極性溶媒等を用いることができる。液体を浸
透させることにより、剥離に伴い発生する静電気等の影響を抑制することができる。また
、剥離層を溶かしながら剥離してもよい。
第3のステップにおいて、第1の部材103aと第2の部材103bを分離する(図15
(C−1)および図15(C−2)参照)。
<構成例4>
本発明の一態様の剥離装置の別の構成について、図16を参照しながら説明する。図16
は本発明の一態様の剥離装置の構成および動作を説明する図である。
図16(A−1)、図16(B−1)および図16(C−1)は本発明の一態様の剥離装
置の側面を説明する模式図である。また、図16(A−2)、図16(B−2)および図
16(C−2)は上面を説明する模式図である。
また、図16(A−1)および図16(A−2)は、本発明の一態様の剥離装置が加工部
材153から第1の部材153aを分離する工程を開始する状態を説明する図である。
図16(B−1)および図16(B−2)は、本発明の一態様の剥離装置が加工部材15
3から第1の部材153aを分離している状態を説明する図である。
図16(C−1)および図16(C−2)は、本発明の一態様の剥離装置が加工部材15
3から第1の部材153aを分離し終えた状態を説明する図である。
なお、本実施の形態の構成例4で説明する剥離装置は、円筒状の構造体101を円筒状の
構造体151に換えて有する点、円筒状の構造体101の内壁に接し且つ構造体101の
回転と同期して回転することができる回転体101aを有する点が、図11乃至図13を
参照しながら説明する剥離装置とは異なる。
また、構造体101が固定され、ステージ155が移動する点が、図15を参照しながら
説明する剥離装置とは異なる。
なお、本実施の形態は、本明細書で示す他の実施の形態と適宜組み合わせることができる
(実施の形態3)
本実施の形態では、本発明の一態様の表示装置の構成および表示素子について説明を行う
図17(A)に示す表示装置は、表示素子の画素を有する領域(以下、画素部502とい
う)と、画素部502の外側に配置され、画素を駆動するための回路を有する回路部(以
下、駆動回路部504という)と、素子の保護機能を有する回路(以下、保護回路506
という)と、端子部507と、を有する。なお、保護回路506は設けない構成としても
よい。
駆動回路部504の一部または全部は、画素部502と同一基板上に形成されていること
が望ましい。これにより、部品数や端子数を減らすことができる。駆動回路部504の一
部または全部が画素部502と同一基板上に形成されていない場合には、COGやTAB
(Tape Automated Bonding)によって、ICチップを実装しても
よい。
画素部502は、X行(Xは2以上の自然数)Y列(Yは2以上の自然数)に配置された
複数の表示素子を駆動するための回路(以下、画素回路501という)を有し、駆動回路
部504は、画素を選択する信号(走査信号)を出力する回路(以下、ゲートドライバ5
04aという)、画素の表示素子を駆動するための信号(データ信号)を供給するための
回路(以下、ソースドライバ504b)などの駆動回路を有する。
ゲートドライバ504aは、シフトレジスタ等を有する。ゲートドライバ504aは、端
子部507を介して、シフトレジスタを駆動するための信号が入力され、信号を出力する
。例えば、ゲートドライバ504aは、スタートパルス信号、クロック信号等が入力され
、パルス信号を出力する。ゲートドライバ504aは、走査信号が与えられる配線(以下
、走査線GL_1乃至GL_Xという)の電位を制御する機能を有する。なお、ゲートド
ライバ504aを複数設け、複数のゲートドライバ504aにより、走査線GL_1乃至
GL_Xを分割して制御してもよい。または、ゲートドライバ504aは、初期化信号を
供給することができる機能を有する。ただし、これに限定されず、ゲートドライバ504
aは、別の信号を供給することも可能である。
ソースドライバ504bは、シフトレジスタ等を有する。ソースドライバ504bは、端
子部507を介して、シフトレジスタを駆動するための信号の他、データ信号の元となる
信号(画像信号)が入力される。ソースドライバ504bは、画像信号を元に画素回路5
01に書き込むデータ信号を生成する機能を有する。また、ソースドライバ504bは、
スタートパルス、クロック信号等が入力されて得られるパルス信号に従って、データ信号
の出力を制御する機能を有する。また、ソースドライバ504bは、データ信号が与えら
れる配線(以下、データ線DL_1乃至DL_Yという)の電位を制御する機能を有する
。または、ソースドライバ504bは、初期化信号を供給することができる機能を有する
。ただし、これに限定されず、ソースドライバ504bは、別の信号を供給することも可
能である。
ソースドライバ504bは、例えば複数のアナログスイッチなどを用いて構成される。ソ
ースドライバ504bは、複数のアナログスイッチを順次オン状態にすることにより、画
像信号を時分割した信号をデータ信号として出力できる。また、シフトレジスタなどを用
いてソースドライバ504bを構成してもよい。
複数の画素回路501のそれぞれは、走査信号が与えられる複数の走査線GLの一つを介
してパルス信号が入力され、データ信号が与えられる複数のデータ線DLの一つを介して
データ信号が入力される。また、複数の画素回路501のそれぞれは、ゲートドライバ5
04aによりデータ信号のデータの書き込みおよび保持が制御される。例えば、m行n列
目の画素回路501は、走査線GL_m(mはX以下の自然数)を介してゲートドライバ
504aからパルス信号が入力され、走査線GL_mの電位に応じてデータ線DL_n(
nはY以下の自然数)を介してソースドライバ504bからデータ信号が入力される。
図17(A)に示す保護回路506は、例えば、ゲートドライバ504aと画素回路50
1の間の配線である走査線GLに接続される。または、保護回路506は、ソースドライ
バ504bと画素回路501の間の配線であるデータ線DLに接続される。または、保護
回路506は、ゲートドライバ504aと端子部507との間の配線に接続することがで
きる。または、保護回路506は、ソースドライバ504bと端子部507との間の配線
に接続することができる。なお、端子部507は、外部の回路から表示装置に電源および
制御信号、および画像信号を入力するための端子が設けられた部分をいう。
保護回路506は、自身が接続する配線に一定の範囲外の電位が与えられたときに、該配
線と別の配線とを導通状態にする回路である。
図17(A)に示すように、画素部502と駆動回路部504にそれぞれ保護回路506
を設けることにより、ESD(Electro Static Discharge:静
電気放電)などにより発生する過電流に対する表示装置の耐性を高めることができる。た
だし、保護回路506の構成はこれに限定されず、例えば、ゲートドライバ504aに保
護回路506を接続した構成、またはソースドライバ504bに保護回路506を接続し
た構成とすることもできる。あるいは、端子部507に保護回路506を接続した構成と
することもできる。
また、図17(A)においては、ゲートドライバ504aとソースドライバ504bによ
って駆動回路部504を形成している例を示しているが、この構成に限定されない。例え
ば、ゲートドライバ504aのみを形成し、別途用意されたソースドライバ回路(ICチ
ップ等)を実装する構成としても良い。
なお、表示素子、表示素子を有する装置である表示装置、発光素子、および発光素子を有
する装置である発光装置は、様々な形態を用いること、または様々な素子を有することが
出来る。表示素子、表示装置、発光素子または発光装置の一例としては、EL(エレクト
ロルミネッセンス)素子(有機物および無機物を含むEL素子、有機EL素子、無機EL
素子)、LED(白色LED、赤色LED、緑色LED、青色LEDなど)、トランジス
タ(電流に応じて発光するトランジスタ)、電子放出素子、液晶素子、電子インク、電気
泳動素子、グレーティングライトバルブ(GLV)、プラズマディスプレイ(PDP)、
MEMS(マイクロ・エレクトロ・メカニカル・システム)を用いた表示素子、デジタル
マイクロミラーデバイス(DMD)、DMS(デジタル・マイクロ・シャッター)、MI
RASOL(登録商標)、IMOD(インターフェアレンス・モジュレーション)素子、
シャッター方式のMEMS表示素子、光干渉方式のMEMS表示素子、エレクトロウェッ
ティング素子、圧電セラミックディスプレイ、カーボンナノチューブ、など、電気磁気的
作用により、コントラスト、輝度、反射率、透過率などが変化する表示媒体を有するもの
がある。EL素子を用いた表示装置の一例としては、ELディスプレイなどがある。電子
放出素子を用いた表示装置の一例としては、フィールドエミッションディスプレイ(FE
D)またはSED方式平面型ディスプレイ(SED:Surface−conducti
on Electron−emitter Display)などがある。液晶素子を用
いた表示装置の一例としては、液晶ディスプレイ(透過型液晶ディスプレイ、半透過型液
晶ディスプレイ、反射型液晶ディスプレイ、直視型液晶ディスプレイ、投射型液晶ディス
プレイ)などがある。電子インク、電子粉流体、または電気泳動素子を用いた表示装置の
一例としては、電子ペーパーなどがある。なお、半透過型液晶ディスプレイや反射型液晶
ディスプレイを実現する場合には、画素電極の一部、または、全部が、反射電極としての
機能を有するようにすればよい。例えば、画素電極の一部、または、全部が、アルミニウ
ム、銀、などを有するようにすればよい。さらに、その場合、反射電極の下に、SRAM
などの記憶回路を設けることも可能である。これにより、さらに、消費電力を低減するこ
とができる。
図17(A)に示す複数の画素回路501は、例えば、図17(B)に示す構成とするこ
とができる。
図17(B)に示す画素回路501は、液晶素子570と、トランジスタ550と、容量
素子560と、を有する。
液晶素子570の一対の電極の一方の電位は、画素回路501の仕様に応じて適宜設定さ
れる。液晶素子570は、書き込まれるデータにより配向状態が設定される。なお、複数
の画素回路501のそれぞれが有する液晶素子570の一対の電極の一方に共通の電位(
コモン電位)を与えてもよい。また、各行の画素回路501の液晶素子570の一対の電
極の一方に異なる電位を与えてもよい。
例えば、液晶素子570を備える表示装置の駆動方法としては、TNモード、STNモー
ド、VAモード、ASM(Axially Symmetric Aligned Mi
cro−cell)モード、OCB(Optically Compensated B
irefringence)モード、FLC(Ferroelectric Liqui
d Crystal)モード、AFLC(AntiFerroelectric Liq
uid Crystal)モード、MVAモード、PVA(Patterned Ver
tical Alignment)モード、IPSモード、FFSモード、またはTBA
(Transverse Bend Alignment)モードなどを用いてもよい。
また、表示装置の駆動方法としては、上述した駆動方法の他、ECB(Electric
ally Controlled Birefringence)モード、PDLC(P
olymer Dispersed Liquid Crystal)モード、PNLC
(Polymer Network Liquid Crystal)モード、ゲストホ
ストモードなどがある。ただし、これに限定されず、液晶素子およびその駆動方式として
様々なものを用いることができる。
m行n列目の画素回路501において、トランジスタ550のソース電極またはドレイン
電極の一方は、データ線DL_nに電気的に接続され、他方は液晶素子570の一対の電
極の他方に電気的に接続される。また、トランジスタ550のゲート電極は、走査線GL
_mに電気的に接続される。トランジスタ550は、オン状態またはオフ状態になること
により、データ信号のデータの書き込みを制御する機能を有する。
容量素子560の一対の電極の一方は、電位が供給される配線(以下、電位供給線VL)
に電気的に接続され、他方は、液晶素子570の一対の電極の他方に電気的に接続される
。なお、電位供給線VLの電位の値は、画素回路501の仕様に応じて適宜設定される。
容量素子560は、書き込まれたデータを保持する保持容量としての機能を有する。
例えば、図17(B)の画素回路501を有する表示装置では、例えば、図17(A)に
示すゲートドライバ504aにより各行の画素回路501を順次選択し、トランジスタ5
50をオン状態にしてデータ信号のデータを書き込む。
データが書き込まれた画素回路501は、トランジスタ550がオフ状態になることで保
持状態になる。これを行毎に順次行うことにより、画像を表示できる。
また、図17(A)に示す複数の画素回路501は、例えば、図17(C)に示す構成と
することができる。
また、図17(C)に示す画素回路501は、トランジスタ552、554と、容量素子
562と、発光素子572と、を有する。
トランジスタ552のソース電極およびドレイン電極の一方は、データ信号が与えられる
配線(以下、信号線DL_nという)に電気的に接続される。さらに、トランジスタ55
2のゲート電極は、ゲート信号が与えられる配線(以下、走査線GL_mという)に電気
的に接続される。
トランジスタ552は、オン状態またはオフ状態になることにより、データ信号のデータ
の書き込みを制御する機能を有する。
容量素子562の一対の電極の一方は、電位が与えられる配線(以下、電位供給線VL_
aという)に電気的に接続され、他方は、トランジスタ552のソース電極およびドレイ
ン電極の他方に電気的に接続される。
容量素子562は、書き込まれたデータを保持する保持容量としての機能を有する。
トランジスタ554のソース電極およびドレイン電極の一方は、電位供給線VL_aに電
気的に接続される。さらに、トランジスタ554のゲート電極は、トランジスタ552の
ソース電極およびドレイン電極の他方に電気的に接続される。
発光素子572のアノードおよびカソードの一方は、電位供給線VL_bに電気的に接続
され、他方は、トランジスタ554のソース電極およびドレイン電極の他方に電気的に接
続される。
発光素子572としては、例えば有機エレクトロルミネセンス素子(有機EL素子ともい
う)などを用いることができる。ただし、発光素子572としては、これに限定されず、
無機材料からなる無機EL素子を用いても良い。
なお、電位供給線VL_aおよび電位供給線VL_bの一方には、高電源電位VDDが与
えられ、他方には、低電源電位VSSが与えられる。
図17(C)の画素回路501を有する表示装置では、例えば、図17(A)に示すゲー
トドライバ504aにより各行の画素回路501を順次選択し、トランジスタ552をオ
ン状態にしてデータ信号のデータを書き込む。
データが書き込まれた画素回路501は、トランジスタ552がオフ状態になることで保
持状態になる。さらに、書き込まれたデータ信号の電位に応じてトランジスタ554のソ
ース電極とドレイン電極の間に流れる電流量が制御され、発光素子572は、流れる電流
量に応じた輝度で発光する。これを行毎に順次行うことにより、画像を表示できる。
例えば、本明細書等において、トランジスタとして、様々な構造のトランジスタを用いる
ことが出来る。よって、用いるトランジスタの種類に限定はない。トランジスタの一例と
しては、単結晶シリコンを有するトランジスタ、または、非晶質シリコン、多結晶シリコ
ン、微結晶(マイクロクリスタル、ナノクリスタル、セミアモルファスとも言う)シリコ
ンなどに代表される非単結晶半導体膜を有するトランジスタなどを用いることが出来る。
または、それらの半導体を薄膜化した薄膜トランジスタ(TFT)などを用いることが出
来る。TFTを用いる場合、様々なメリットがある。例えば、単結晶シリコンの場合より
も低い温度で製造できるため、製造コストの削減、または製造装置の大型化を図ることが
できる。製造装置を大きくできるため、大型基板上に製造できる。そのため、同時に多く
の個数の表示装置を製造できるため、低コストで製造できる。または、製造温度が低いた
め、耐熱性の弱い基板を用いることができる。そのため、透光性を有する基板上にトラン
ジスタを製造できる。または、透光性を有する基板上のトランジスタを用いて表示素子で
の光の透過を制御することが出来る。または、トランジスタの膜厚が薄いため、トランジ
スタを形成する膜の一部は、光を透過させることが出来る。そのため、開口率が向上させ
ることができる。
なお、多結晶シリコンを製造するときに、触媒(ニッケルなど)を用いることにより、結
晶性をさらに向上させ、電気特性のよいトランジスタを製造することが可能となる。その
結果、ゲートドライバ回路(走査線駆動回路)、ソースドライバ回路(信号線駆動回路)
、および信号処理回路(信号生成回路、ガンマ補正回路、DA変換回路など)を基板上に
一体形成することが出来る。
なお、微結晶シリコンを製造するときに、触媒(ニッケルなど)を用いることにより、結
晶性をさらに向上させ、電気特性のよいトランジスタを製造することが可能となる。この
とき、レーザー照射を行うことなく、熱処理を加えるだけで、結晶性を向上させることも
可能である。その結果、ソースドライバ回路の一部(アナログスイッチなど)およびゲー
トドライバ回路(走査線駆動回路)を基板上に一体形成することが出来る。なお、結晶化
のためにレーザー照射を行わない場合は、シリコンの結晶性のムラを抑えることができる
。そのため、画質の向上した画像を表示することが出来る。ただし、触媒(ニッケルなど
)を用いずに、多結晶シリコンまたは微結晶シリコンを製造することは可能である。
なお、シリコンの結晶性を、多結晶または微結晶などへと向上させることは、パネル全体
で行うことが望ましいが、それに限定されない。パネルの一部の領域のみにおいて、シリ
コンの結晶性を向上させてもよい。選択的に結晶性を向上させることは、レーザー光を選
択的に照射することなどにより可能である。例えば、画素以外の領域である周辺回路領域
にのみ、ゲートドライバ回路およびソースドライバ回路などの領域にのみ、またはソース
ドライバ回路の一部(例えば、アナログスイッチ)の領域にのみ、にレーザー光を照射し
てもよい。その結果、回路を高速に動作させる必要がある領域にのみ、シリコンの結晶化
を向上させることができる。画素領域は、高速に動作させる必要性が低いため、結晶性が
向上されなくても、問題なく画素回路を動作させることが出来る。こうすることによって
、結晶性を向上させる領域が少なくて済むため、製造工程も短くすることが出来る。その
ため、スループットが向上し、製造コストを低減させることが出来る。または、必要とさ
れる製造装置の数も少ない数で製造できるため、製造コストを低減させることが出来る。
なお、トランジスタの一例としては、化合物半導体(例えば、SiGe、GaAsなど)
、または酸化物半導体(例えば、Zn−O、In−Ga−Zn−O、In−Zn−O、I
n−Sn−O、Sn−O、Ti−O、Al−Zn−Sn−O、In−Sn−Zn−Oなど
)などを有するトランジスタを用いることが出来る。または、これらの化合物半導体、ま
たは、これらの酸化物半導体を薄膜化した薄膜トランジスタなどを用いることが出来る。
これらにより、製造温度を低くできるので、例えば、室温でトランジスタを製造すること
が可能となる。その結果、耐熱性の低い基板、例えばプラスチック基板またはフィルム基
板などに直接トランジスタを形成することが出来る。なお、これらの化合物半導体または
酸化物半導体を、トランジスタのチャネル部分に用いるだけでなく、それ以外の用途で用
いることも出来る。例えば、これらの化合物半導体または酸化物半導体を配線、抵抗素子
、画素電極、または透光性を有する電極などとして用いることができる。それらをトラン
ジスタと同時に成膜または形成することが可能なため、コストを低減できる。
なお、トランジスタの一例としては、インクジェット法または印刷法を用いて形成したト
ランジスタなどを用いることが出来る。これらにより、室温で製造、低真空度で製造、ま
たは大型基板上に製造することができる。よって、マスク(レチクル)を用いなくても製
造することが可能となるため、トランジスタのレイアウトを容易に変更することが出来る
。または、レジストを用いらずに製造することが可能なので、材料費が安くなり、工程数
を削減できる。または、必要な部分にのみ膜を付けることが可能なので、全面に成膜した
後でエッチングする、という製法よりも、材料が無駄にならず、低コストにできる。
なお、トランジスタの一例としては、有機半導体やカーボンナノチューブを有するトラン
ジスタ等を用いることができる。これらにより、曲げることが可能な基板上にトランジス
タを形成することが出来る。有機半導体やカーボンナノチューブを有するトランジスタを
用いた装置は、衝撃に強くすることができる。
なお、トランジスタとしては、他にも様々な構造のトランジスタを用いることができる。
例えば、トランジスタとして、MOS型トランジスタ、接合型トランジスタ、バイポーラ
トランジスタなどを用いることが出来る。トランジスタとしてMOS型トランジスタを用
いることにより、トランジスタのサイズを小さくすることが出来る。よって、多数のトラ
ンジスタを搭載することができる。トランジスタとしてバイポーラトランジスタを用いる
ことにより、大きな電流を流すことが出来る。よって、高速に回路を動作させることがで
きる。なお、MOS型トランジスタとバイポーラトランジスタとを1つの基板に混在させ
て形成してもよい。これにより、低消費電力、小型化、高速動作などを実現することが出
来る。
本実施の形態に示す構成は、他の実施の形態に示す構成と適宜組み合わせて用いることが
できる。
(実施の形態4)
本実施の形態では、本発明の一態様の表示装置を用いることができる表示モジュールにつ
いて説明を行う。
図18に示す表示モジュール8000は、上部カバー8001と下部カバー8002との
間に、FPC8003に接続されたタッチパネル8004、FPC8005に接続された
表示パネル8006、バックライト8007、フレーム8009、プリント基板8010
、バッテリー8011を有する。
本発明の一態様の表示装置は、例えば、表示パネル8006に用いることができる。
上部カバー8001および下部カバー8002は、タッチパネル8004および表示パネ
ル8006のサイズに合わせて、形状や寸法を適宜変更することができる。また、上部カ
バー8001および下部カバー8002は、可撓性を有していてもよい。
タッチパネル8004は、抵抗膜方式または静電容量方式のタッチパネルを表示パネル8
006に重畳して用いることができる。また、表示パネル8006の対向基板(封止基板
)に、タッチパネル機能を持たせるようにすることも可能である。また、表示パネル80
06の各画素内に光センサを設け、光学式のタッチパネルとすることも可能である。また
、タッチパネル8004は、可撓性を有していてもよい。
バックライト8007は、光源8008を有する。なお、図18において、バックライト
8007上に光源8008を配置する構成について例示したが、これに限定さない。例え
ば、バックライト8007の端部に光源8008を配置し、さらに光拡散板を用いる構成
としてもよい。なお、有機EL素子等の自発光型の発光素子を用いる場合、または反射型
パネル等の場合においては、バックライト8007を設けない構成としてもよい。また、
バックライト8007は、可撓性を有していてもよい。
フレーム8009は、表示パネル8006の保護機能の他、プリント基板8010の動作
により発生する電磁波を遮断するための電磁シールドとしての機能を有する。またフレー
ム8009は、放熱板としての機能を有していてもよい。また、フレーム8009は、可
撓性を有していてもよい。
プリント基板8010は、電源回路、ビデオ信号およびクロック信号を出力するための信
号処理回路を有する。電源回路に電力を供給する電源としては、外部の商用電源であって
も良いし、別途設けたバッテリー8011による電源であってもよい。バッテリー801
1は、商用電源を用いる場合には、省略可能である。プリント基板8010は、FPCで
あってもよい。
また、表示モジュール8000は、偏光板、位相差板、プリズムシートなどの部材を追加
して設けてもよい。
本実施の形態に示す構成は、他の実施の形態に示す構成と適宜組み合わせて用いることが
できる。
(実施の形態5)
本実施の形態では、本発明の一態様の表示装置に用いることのできるトランジスタおよび
該トランジスタを構成する材料について説明する。本実施の形態で説明するトランジスタ
は、先の実施の形態で説明したトランジスタ350、352、550、552、554な
どに用いることができる。なお、本実施の形態で説明するトランジスタは可撓性基板に転
置する前の構成である。
図19(A)は、本発明の一態様である表示装置に用いることができる一例のトランジス
タの断面図である。当該トランジスタは、基板900上に形成された有機樹脂層910と
、絶縁膜915と、ゲート電極層920と、絶縁膜931および絶縁膜932の順で形成
されたゲート絶縁膜930と、酸化物半導体層940と、当該酸化物半導体層の一部と接
するソース電極層950およびドレイン電極層960を有する。また、必要に応じて、ゲ
ート絶縁膜930、酸化物半導体層940、およびソース電極層950およびドレイン電
極層960上に絶縁膜970、絶縁膜980、絶縁膜990が形成されていてもよい。
また、本発明の一態様のトランジスタは、図19(B)に示すように、絶縁膜980また
は絶縁膜990上にゲート電極層920および酸化物半導体層940と重なるように導電
膜921を備えていてもよい。当該導電膜を第2のゲート電極層(バックゲート)として
用いることで、オン電流の増加や、しきい値電圧の制御を行うことができる。オン電流を
増加させるには、例えば、ゲート電極層920と導電膜921を同電位とし、ダブルゲー
トトランジスタとして駆動させればよい。また、しきい値電圧の制御を行うには、ゲート
電極層920とは異なる定電位を導電膜921に供給すればよい。
また、本発明の一態様のトランジスタは、図25(A)、(B)に示すようなチャネル保
護型のボトムゲート構造であってもよい。ここで、絶縁膜933は、チャネル領域を保護
する機能を有する。したがって、絶縁膜933は、チャネル領域と重なる領域にのみ配置
されていてもよいし、図25(A)、(B)に示すように、それら以外の領域にも、配置
されていてもよい。
また、本発明の一態様のトランジスタは、図26(A)、(B)に示すようなセルフアラ
イン型のトップゲート構造であってもよい。図26(A)の構造において、ソース領域9
51およびドレイン領域961は、ソース電極層950およびドレイン電極層960の接
触による酸素欠陥の生成、およびゲート電極層920をマスクとしてホウ素、リン、アル
ゴンなどの不純物をドーピングすることによって形成することができる。また、図26(
B)の構造において、ソース領域951およびドレイン領域961は、上記ドーピングに
替えて酸化物半導体層940の一部と接するように窒化珪素膜などの水素を含む絶縁膜9
75を形成し、水素を酸化物半導体層940の一部に拡散させることで形成することがで
きる。
また、本発明の一態様のトランジスタは、図27(A)に示すようなセルフアライン型の
トップゲート構造であってもよい。図27(A)の構造において、ソース領域951およ
びドレイン領域961は、ソース電極層950およびドレイン電極層960の接触による
酸素欠陥の生成、およびゲート絶縁膜930をマスクとしてホウ素、リン、アルゴンなど
の不純物をドーピングすることによって形成することができる。図27(A)の構造にお
いて、ソース電極層950、ドレイン電極層960およびゲート電極層920は同一の工
程で形成することができる。
また、本発明の一態様のトランジスタは、図27(B)に示すようなセルフアライン型の
トップゲート構造であってもよい。図27(B)の構造において、ソース領域951およ
びドレイン領域961は、ゲート絶縁膜930をマスクとしてホウ素、リン、アルゴンな
どの不純物をドーピングすることに加え、酸化物半導体層940の一部と接するように窒
化珪素膜などの水素を含む絶縁膜975を形成し、水素を酸化物半導体層940の一部に
拡散させることで形成することができる。当該構成では、より低抵抗のソース領域951
およびドレイン領域961を形成することができる。なお、上記不純物をドーピングしな
い構成、または絶縁膜975を形成しない構成とすることもできる。
なお、酸化物半導体層において酸素欠損を形成する元素を、不純物(不純物元素)として
説明する。不純物元素の代表例としては、ホウ素、炭素、窒素、フッ素、アルミニウム、
シリコン、リン、塩素、希ガス元素等がある。希ガス元素の代表例としては、ヘリウム、
ネオン、アルゴン、クリプトンおよびキセノンがある。
不純物元素の添加により酸素欠損が形成された酸化物半導体に水素を添加すると、酸素欠
損サイトに水素が入り伝導帯近傍にドナー準位が形成される。この結果、酸化物半導体は
、導電性が高くなり、導電体化する。導電体化された酸化物半導体を酸化物導電体という
ことができる。一般に、酸化物半導体は、エネルギーギャップが大きいため、可視光に対
して透光性を有する。一方、酸化物導電体は、伝導帯近傍にドナー準位を有する酸化物半
導体である。したがって、該ドナー準位による吸収の影響は小さく、可視光に対して酸化
物半導体と同程度の透光性を有する。
ここで、酸化物導電体で形成される膜(以下、酸化物導電体層という。)における、抵抗
率の温度依存性について、図36を用いて説明する。
ここでは、酸化物導電体層を有する試料を作製した。酸化物導電体層としては、酸化物半
導体層が窒化シリコン膜に接することで形成された酸化物導電体層(OC_SiN)、
ドーピング装置において酸化物半導体層にアルゴンが添加され、且つ窒化シリコン膜と接
することで形成された酸化物導電体層(OC_Ar dope+SiN)、またはプラ
ズマ処理装置において酸化物半導体層がアルゴンプラズマに曝され、且つ窒化シリコン膜
と接することで形成された酸化物導電体層(OC_Ar plasma+SiN)を作
製した。なお、窒化シリコン膜は、水素を含む。
酸化物導電体層(OC_SiN)を含む試料の作製方法を以下に示す。ガラス基板上に
、厚さ400nmの酸化窒化シリコン膜をプラズマCVD法により形成した後、酸素プラ
ズマに曝し、酸素イオンを酸化窒化シリコン膜に添加することで、加熱により酸素を放出
する酸化窒化シリコン膜を形成した。次に、加熱により酸素を放出する酸化窒化シリコン
膜上に、原子数比がIn:Ga:Zn=5:5:6のスパッタリングターゲットを用いた
スパッタ法により、厚さ100nmのIn−Ga−Zn酸化物膜を形成し、450℃の窒
素雰囲気で加熱処理した後、450℃の窒素および酸素の混合ガス雰囲気で加熱処理した
。次に、プラズマCVD法で、厚さ100nmの窒化シリコン膜を形成した。次に、35
0℃の窒素および酸素の混合ガス雰囲気で加熱処理した。
酸化物導電体層(OC_Ar dope+SiN)を含む試料の作製方法を以下に示す
。ガラス基板上に、厚さ400nmの酸化窒化シリコン膜をプラズマCVD法により形成
した後、酸素プラズマに曝し、酸素イオンを酸化窒化シリコン膜に添加することで、加熱
により酸素を放出する酸化窒化シリコン膜を形成した。次に、加熱により酸素を放出する
酸化窒化シリコン膜上に、原子数比がIn:Ga:Zn=5:5:6のスパッタリングタ
ーゲットを用いたスパッタ法により、厚さ100nmのIn−Ga−Zn酸化物膜を形成
し、450℃の窒素雰囲気で加熱処理した後、450℃の窒素および酸素の混合ガス雰囲
気で加熱処理した。次に、ドーピング装置を用いて、In−Ga−Zn酸化物膜に、加速
電圧を10kVとし、ドーズ量が5×1014/cmのアルゴンを添加して、In−G
a−Zn酸化物膜に酸素欠損を形成した。次に、プラズマCVD法で、厚さ100nmの
窒化シリコン膜を形成した。次に、350℃の窒素および酸素の混合ガス雰囲気で加熱処
理した。
酸化物導電体層(OC_Ar plasma+SiN)を含む試料の作製方法を以下に
示す。ガラス基板上に、厚さ400nmの酸化窒化シリコン膜をプラズマCVD法により
形成した後、酸素プラズマに曝すことで、加熱により酸素を放出する酸化窒化シリコン膜
を形成した。次に、加熱により酸素を放出する酸化窒化シリコン膜上に、原子数比がIn
:Ga:Zn=5:5:6のスパッタリングターゲットを用いたスパッタ法により、厚さ
100nmのIn−Ga−Zn酸化物膜を形成し、450℃の窒素雰囲気で加熱処理した
後、450℃の窒素および酸素の混合ガス雰囲気で加熱処理した。次に、プラズマ処理装
置において、アルゴンプラズマを発生させ、加速させたアルゴンイオンをIn−Ga−Z
n酸化物膜に衝突させることで酸素欠損を形成した。次に、プラズマCVD法で、厚さ1
00nmの窒化シリコン膜を形成した。次に、350℃の窒素および酸素の混合ガス雰囲
気で加熱処理した。
次に、各試料の抵抗率を測定した結果を図36に示す。ここで、抵抗率の測定は4端子の
van−der−Pauw法で行った。図36において、横軸は測定温度を示し、縦軸は
抵抗率を示す。また、酸化物導電体層(OC_SiN)の測定結果を四角印で示し、酸
化物導電体層(OC_Ar dope+SiN)の測定結果を三角印で示し、酸化物導
電体層(OC_Ar plasma+SiN)の測定結果を丸印で示す。
なお、図示しないが、窒化シリコン膜と接しない酸化物半導体層は、抵抗率が高く、抵抗
率の測定が困難であった。このため、酸化物導電体層は、酸化物半導体層より抵抗率が低
いことがわかる。
図36からわかるように、酸化物導電体層(OC_Ar dope+SiN)および酸
化物導電体層(OC_Ar plasma+SiN)が、酸素欠損および水素を含む場
合、抵抗率の変動が小さい。代表的には、80K以上290K以下において、抵抗率の変
動率は、±20%未満である。または、150K以上250K以下において、抵抗率の変
動率は、±10%未満である。即ち、酸化物導電体は、縮退半導体であり、伝導帯端とフ
ェルミ準位とが一致または略一致していると推定される。このため、酸化物導電体層をト
ランジスタのソース領域およびドレイン領域として用いることで、酸化物導電体層とソー
ス電極およびドレイン電極として機能する導電膜との接触がオーミック接触となり、酸化
物導電体層とソース電極およびドレイン電極として機能する導電膜との接触抵抗を低減で
きる。また、酸化物導電体の抵抗率は温度依存性が低いため、酸化物導電体層とソース電
極およびドレイン電極として機能する導電膜との接触抵抗の変動量が少なく、信頼性の高
いトランジスタを作製することが可能である。
また、本発明の一態様のトランジスタは、図28(A)、(B)に示すように、ゲート絶
縁膜935を介して酸化物半導体層940と重なるように導電膜921を備えていてもよ
い。なお、図28(A)、(B)では、図26(A)、(B)に示すトランジスタに導電
膜921を備える例を示したが、図27(A)、(B)に示すトランジスタに導電膜92
1を備えることもできる。
本発明の一態様である表示装置では、上述したように酸化物半導体を活性層に用いる。酸
化物半導体層を用いたトランジスタは非晶質シリコンを用いたトランジスタよりも移動度
が高いため、トランジスタを小さくすることが容易であり、画素を小さくすることができ
る。また、酸化物半導体層を用いたトランジスタは可撓性を有する表示装置に優れた信頼
性を与える。ただし、本発明の一態様は、これに限定されない。場合によっては、または
、状況に応じて、活性層は、酸化物半導体以外の半導体を有していてもよい。
なお、図19(A)、(B)などに示すように、ゲート電極層920の幅は酸化物半導体
層940の幅よりも大きくすることが好ましい。バックライトを有する表示装置では当該
ゲート電極層が遮光層となり、酸化物半導体層940に光が照射されることによる電気特
性の劣化を抑制することができる。また、EL表示装置などでは、トップゲート型のトラ
ンジスタを用いることでゲート電極層を遮光層とすることができる。
以下に、発明の一態様のトランジスタの構成要素について、詳細に説明する。
基板900は、可撓性基板への転置工程を行いやすくするために硬質基板であることが好
ましい。例えば、ガラス基板、セラミック基板、石英基板、サファイア基板、金属基板等
を用いることができる。なお、基板900は実施の形態1に示す第1の基板462に相当
する。
有機樹脂層910には、例えば、エポキシ樹脂、アラミド樹脂、アクリル樹脂、ポリイミ
ド樹脂、ポリアミド樹脂、ポリアミドイミド樹脂等の有機樹脂膜を用いることができる。
なお、有機樹脂層910は実施の形態1に示す有機樹脂層320aに相当する。
絶縁膜915には、例えば、酸化シリコン膜、酸化窒化シリコン膜、窒化シリコン膜、ま
たは窒化酸化シリコン膜の単層、またはこれらの積層を用いることができる。なお、絶縁
膜915は実施の形態1に示す第1の絶縁膜321aに相当する。
ゲート電極層920および導電膜921には、クロム(Cr)、銅(Cu)、アルミニウ
ム(Al)、金(Au)、銀(Ag)、亜鉛(Zn)、モリブデン(Mo)、タンタル(
Ta)、チタン(Ti)、タングステン(W)、マンガン(Mn)、ニッケル(Ni)、
鉄(Fe)、コバルト(Co)から選ばれた金属元素、または上述した金属元素を成分と
する合金か、上述した金属元素を組み合わせた合金等を用いて形成することができる。ま
た、ゲート電極層920は、単層構造でも、二層以上の積層構造としてもよい。
また、ゲート電極層920および導電膜921には、インジウム錫酸化物、酸化タングス
テンを含むインジウム酸化物、酸化タングステンを含むインジウム亜鉛酸化物、酸化チタ
ンを含むインジウム酸化物、酸化チタンを含むインジウム錫酸化物、インジウム亜鉛酸化
物、酸化シリコンを添加したインジウム錫酸化物等の透光性を有する導電性材料を適用す
ることもできる。また、上記透光性を有する導電性材料と、上記金属元素の積層構造とす
ることもできる。
また、ゲート電極層920と絶縁膜932との間に、In−Ga−Zn系酸窒化物半導体
膜、In−Sn系酸窒化物半導体膜、In−Ga系酸窒化物半導体膜、In−Zn系酸窒
化物半導体膜、Sn系酸窒化物半導体膜、In系酸窒化物半導体膜、金属窒化膜(InN
、ZnN等)等を設けてもよい。
ゲート絶縁膜930として機能する絶縁膜931、932としては、プラズマ化学気相堆
積(PECVD:(Plasma Enhanced Chemical Vapor
Deposition))法、スパッタ法等により、酸化シリコン膜、酸化窒化シリコン
膜、窒化酸化シリコン膜、窒化シリコン膜、酸化アルミニウム膜、酸化ハフニウム膜、酸
化イットリウム膜、酸化ジルコニウム膜、酸化ガリウム膜、酸化タンタル膜、酸化マグネ
シウム膜、酸化ランタン膜、酸化セリウム膜および酸化ネオジム膜を一種以上含む絶縁層
を、それぞれ用いることができる。なお、ゲート絶縁膜930は、絶縁膜931、932
の積層構造とせずに、上述の材料から選択された単層の絶縁膜、または3層以上の絶縁膜
を用いてもよい。
なお、トランジスタのチャネル形成領域として機能する酸化物半導体層940と接する絶
縁膜932は、酸化物絶縁膜であることが好ましく、化学量論的組成よりも過剰に酸素を
含有する領域(酸素過剰領域)を有することがより好ましい。別言すると、絶縁膜932
は、酸素を放出することが可能な絶縁膜である。なお、絶縁膜932に酸素過剰領域を設
けるには、例えば、酸素雰囲気下にて絶縁膜932を形成すればよい。または、成膜後の
絶縁膜932に酸素を導入して、酸素過剰領域を形成してもよい。酸素の導入方法として
は、イオン注入法、イオンドーピング法、プラズマイマージョンイオン注入法、プラズマ
処理法等を用いることができる。
また、絶縁膜931、932として、酸化ハフニウムを用いる場合、以下の効果を奏する
。酸化ハフニウムは、酸化シリコンや酸化窒化シリコンと比べて比誘電率が高い。したが
って、等価酸化膜厚に対して物理的な膜厚を大きくできるため、等価酸化膜厚を10nm
以下または5nm以下とした場合でも、トンネル電流によるリーク電流を小さくすること
ができる。すなわち、オフ電流の小さいトランジスタを実現することができる。さらに、
結晶構造を有する酸化ハフニウムは、非晶質構造を有する酸化ハフニウムと比べて高い比
誘電率を備える。したがって、オフ電流の小さいトランジスタとするためには、結晶構造
を有する酸化ハフニウムを用いることが好ましい。結晶構造の例としては、単斜晶系や立
方晶系などが挙げられる。ただし、本発明の一態様は、これらに限定されない。
なお、本実施の形態では、絶縁膜931として窒化シリコン膜を形成し、絶縁膜932と
して酸化シリコン膜を形成する。窒化シリコン膜は、酸化シリコン膜と比較して比誘電率
が高く、酸化シリコン膜と同等の静電容量を得るのに必要な膜厚が大きいため、トランジ
スタのゲート絶縁膜930として、窒化シリコン膜を含むことで絶縁膜を物理的に厚膜化
することができる。よって、トランジスタの絶縁耐圧を向上させて、トランジスタの静電
破壊を抑制することができる。
酸化物半導体層940は、代表的には、In−Ga酸化物、In−Zn酸化物、In−M
−Zn酸化物(Mは、Al、Ti、Ga、Y、Zr、La、Ce、Nd、SnまたはHf
)がある。とくに、酸化物半導体層940としては、In−M−Zn酸化物(Mは、Al
、Ti、Ga、Y、Zr、La、Ce、Nd、SnまたはHf)を用いると好ましい。
酸化物半導体層940がIn−M−Zn酸化物(Mは、Al、Ti、Ga、Y、Zr、L
a、Ce、Nd、SnまたはHf)の場合、In−M−Zn酸化物を成膜するために用い
るスパッタターゲットの金属元素の原子数比は、In≧M、Zn≧Mを満たすことが好ま
しい。このようなスパッタリングターゲットの金属元素の原子数比として、In:M:Z
n=1:1:1、In:M:Zn=5:5:6、In:M:Zn=3:1:2が好ましい
。なお、成膜される酸化物半導体層940の原子数比はそれぞれ、誤差として上記のスパ
ッタリングターゲットに含まれる金属元素の原子数比のプラスマイナス40%の変動を含
む。
なお、酸化物半導体層940がIn−M−Zn酸化物であるとき、ZnおよびOを除いて
のInとMの原子数比率は、好ましくはInが25atomic%以上、Mが75ato
mic%未満、さらに好ましくはInが34atomic%以上、Mが66atomic
%未満とする。
また、酸化物半導体層940は、エネルギーギャップが2eV以上、好ましくは2.5e
V以上、より好ましくは3eV以上である。このように、エネルギーギャップの広い酸化
物半導体を用いることで、トランジスタのオフ電流を低減することができる。
また、酸化物半導体層940の厚さは、3nm以上200nm以下、好ましくは3nm以
上100nm以下、さらに好ましくは3nm以上50nm以下とする。
また、酸化物半導体層940としては、キャリア密度の低い酸化物半導体層を用いる。例
えば、酸化物半導体層940は、キャリア密度が1×1017個/cm以下、好ましく
は1×1015個/cm以下、さらに好ましくは1×1013個/cm以下、より好
ましくは1×1011個/cm以下とする。
なお、これらに限られず、必要とするトランジスタの半導体特性および電気特性(電界効
果移動度、しきい値電圧等)に応じて適切な組成のものを用いればよい。また、必要とす
るトランジスタの半導体特性を得るために、酸化物半導体層940のキャリア密度や不純
物濃度、欠陥密度、金属元素と酸素の原子数比、原子間距離、密度等を適切なものとする
ことが好ましい。
酸化物半導体層において、水素、窒素、炭素、シリコン、および主成分以外の金属元素は
不純物となる。例えば、水素および窒素は、ドナー準位の形成に寄与し、キャリア密度を
増大させてしまう。また、シリコンは、酸化物半導体層中で不純物準位を形成する。当該
不純物準位はトラップとなり、トランジスタの電気特性を劣化させることがある。酸化物
半導体層中や、他の層との界面において不純物濃度を低減させることが好ましい。
なお、酸化物半導体層をチャネルとするトランジスタに安定した電気特性を付与するため
には、酸化物半導体層中の不純物濃度を低減し、酸化物半導体層を真性または実質的に真
性にすることが有効である。ここで、実質的に真性とは、酸化物半導体層のキャリア密度
が、1×1017/cm未満であること、好ましくは1×1015/cm未満である
こと、さらに好ましくは1×1013/cm未満、特に好ましくは8×1011/cm
未満、さらに好ましくは1×1011/cm未満、さらに好ましくは1×1010
cm未満であり、1×10−9/cm以上であることを指す。
酸化物半導体層を真性または実質的に真性とするためには、SIMS(Secondar
y Ion Mass Spectrometry)分析において、例えば、酸化物半導
体層のある深さにおいて、または、酸化物半導体層のある領域において、シリコン濃度を
1×1019atoms/cm未満、好ましくは5×1018atoms/cm未満
、さらに好ましくは1×1018atoms/cm未満とする部分を有することとする
。また、水素濃度は、例えば、酸化物半導体層のある深さにおいて、または、酸化物半導
体層のある領域において、2×1020atoms/cm以下、好ましくは5×10
atoms/cm以下、より好ましくは1×1019atoms/cm以下、さら
に好ましくは5×1018atoms/cm以下とする部分を有することとする。また
、窒素濃度は、例えば、酸化物半導体層のある深さにおいて、または、酸化物半導体層の
ある領域において、5×1019atoms/cm未満、好ましくは5×1018at
oms/cm以下、より好ましくは1×1018atoms/cm以下、さらに好ま
しくは5×1017atoms/cm以下とする部分を有することとする。
また、酸化物半導体層が結晶を含む場合、シリコンや炭素が高濃度で含まれると、酸化物
半導体層の結晶性を低下させることがある。酸化物半導体層の結晶性を低下させないため
には、例えば、酸化物半導体層のある深さにおいて、または、酸化物半導体層のある領域
において、シリコン濃度を1×1019atoms/cm未満、好ましくは5×10
atoms/cm未満、さらに好ましくは1×1018atoms/cm未満とす
る部分を有することとする。また、例えば、酸化物半導体層のある深さにおいて、または
、酸化物半導体層のある領域において、炭素濃度を1×1019atoms/cm未満
、好ましくは5×1018atoms/cm未満、さらに好ましくは1×1018at
oms/cm未満とする部分を有することとする。
具体的に、高純度化された酸化物半導体層をチャネル形成領域に用いたトランジスタのオ
フ電流が低いことは、いろいろな実験により証明できる。例えば、チャネル幅が1×10
μmでチャネル長が10μmの素子であっても、ソース電極とドレイン電極間の電圧(
ドレイン電圧)が1Vから10Vの範囲において、オフ電流が、半導体パラメータアナラ
イザの測定限界以下、すなわち1×10−13A以下という特性を得ることができる。こ
の場合、トランジスタのチャネル幅で規格化したオフ電流は、100zA/μm以下であ
ることが分かる。また、容量素子とトランジスタとを接続して、容量素子に流入または容
量素子から流出する電荷を当該トランジスタで制御する回路を用いて、オフ電流の測定を
行った。当該測定では、上記トランジスタに高純度化された酸化物半導体層をチャネル形
成領域に用い、容量素子の単位時間あたりの電荷量の推移から当該トランジスタのオフ電
流を測定した。その結果、トランジスタのソース電極とドレイン電極間の電圧が3Vの場
合に、数十yA/μmという、さらに低いオフ電流が得られることが分かった。したがっ
て、高純度化された酸化物半導体層をチャネル形成領域に用いたトランジスタは、オフ電
流が、結晶性を有するシリコンを用いたトランジスタに比べて著しく低い。
ソース電極層950およびドレイン電極層960には、酸化物半導体層から酸素を引き抜
く性質を有する導電膜を用いると好ましい。例えば、Al、Cr、Cu、Ta、Ti、M
o、W、Ni、Mn、Nd、Scなどを用いることができる。また、上記材料の合金や上
記材料の導電性窒化物を用いてもよい。また、上記材料、上記材料の合金、および上記材
料の導電性窒化物から選ばれた複数の材料の積層であってもよい。代表的には、特に酸素
と結合しやすいTiや、後のプロセス温度が比較的高くできることなどから、融点の高い
Wを用いることがより好ましい。また、低抵抗のCuまたはCu−X合金(Xは、Mn、
Ni、Cr、Fe、Co、Mo、Ta、またはTi)や上記材料とCuまたはCu−X合
金との積層を用いてもよい。
なお、Cu−X合金(Xは、Mn、Ni、Cr、Fe、Co、Mo、Ta、またはTi)
は、加熱処理により酸化物半導体層と接する領域、または絶縁膜と接する領域に被覆膜が
形成される場合がある。被覆膜は、Xを含む化合物で形成される。Xを含む化合物の一例
としては、Xの酸化物、In−X酸化物、Ga−X酸化物、In−Ga−X酸化物、In
−Ga−Zn−X酸化物等がある。被覆膜が形成されることで、被覆膜がブロッキング膜
となり、Cu−X合金膜中のCuが、酸化物半導体層に入り込むことを抑制することがで
きる。
酸化物半導体層から酸素を引き抜く性質を有する導電膜の作用により、酸化物半導体層中
の酸素が脱離し、酸化物半導体層中に酸素欠損が形成される。膜中に僅かに含まれる水素
と当該酸素欠損が結合することにより当該領域は顕著にn型化する。したがって、n型化
した当該領域はトランジスタのソースまたはドレインとして作用させることができる。
絶縁膜970、980、990は、保護絶縁膜としての機能を有する。例えば、絶縁膜9
70は、酸素を透過することのできる絶縁膜である。なお、絶縁膜970は、後に形成す
る絶縁膜980を形成する際の、酸化物半導体層940へのダメージ緩和膜としても機能
する。
絶縁膜970としては、厚さが5nm以上150nm以下、好ましくは5nm以上50n
m以下の酸化シリコン、酸化窒化シリコン等を用いることができる。なお、本明細書中に
おいて、酸化窒化シリコン膜とは、その組成として、窒素よりも酸素の含有量が多い膜を
指し、窒化酸化シリコン膜とは、その組成として、酸素よりも窒素の含有量が多い膜を指
す。
また、絶縁膜970は、欠陥量が少ないことが好ましく、代表的には、ESR測定により
、シリコンのダングリングボンドに由来するg=2.001に現れる信号のスピン密度が
3×1017spins/cm以下であることが好ましい。これは、絶縁膜970に含
まれる欠陥密度が多いと、該欠陥に酸素が結合してしまい、絶縁膜970における酸素の
透過量が減少してしまうためである。
絶縁膜980は、化学量論的組成を満たす酸素よりも多くの酸素を含む酸化物絶縁膜を用
いて形成する。化学量論的組成を満たす酸素よりも多くの酸素を含む酸化物絶縁膜は、加
熱により酸素の一部が脱離する。化学量論的組成を満たす酸素よりも多くの酸素を含む酸
化物絶縁膜はTDS分析にて、酸素原子に換算しての酸素の脱離量が1.0×1018
toms/cm以上、好ましくは3.0×1020atoms/cm以上である酸化
物絶縁膜である。なお、上記TDS分析時における膜の表面温度としては100℃以上7
00℃以下、または100℃以上500℃以下の範囲が好ましい。
絶縁膜980としては、厚さが30nm以上500nm以下、好ましくは50nm以上4
00nm以下の、酸化シリコン、酸化窒化シリコン等を用いることができる。
また、絶縁膜980は、欠陥量が少ないことが好ましく、代表的には、ESR測定により
、シリコンのダングリングボンドに由来するg=2.001に現れる信号のスピン密度が
1.5×1018spins/cm未満、さらには1×1018spins/cm
下であることが好ましい。なお、絶縁膜980は、絶縁膜970と比較して酸化物半導体
層940から離れているため、絶縁膜970より、欠陥密度が多くともよい。
また、絶縁膜970、980は、同種の材料の絶縁膜を用いることができるため、絶縁膜
970と絶縁膜980との界面の明確な確認が困難な場合がある。したがって、本実施の
形態においては、絶縁膜970と絶縁膜980の界面は、破線で図示している。なお、本
実施の形態においては、絶縁膜970と絶縁膜980の2層構造について説明したが、こ
れに限定されず、例えば、絶縁膜970の単層構造、絶縁膜980の単層構造、または3
層以上の積層構造としてもよい。
絶縁膜990は、酸素、水素、水、アルカリ金属、アルカリ土類金属等のブロッキングで
きる機能を有する。絶縁膜990を設けることで、酸化物半導体層940からの酸素の外
部への拡散と、外部から酸化物半導体層940への水素、水等の入り込みを防ぐことがで
きる。絶縁膜990としては、例えば、窒化物絶縁膜を用いることができる。該窒化物絶
縁膜としては、窒化シリコン、窒化酸化シリコン、窒化アルミニウム、窒化酸化アルミニ
ウム等がある。なお、酸素、水素、水、アルカリ金属、アルカリ土類金属等のブロッキン
グ効果を有する窒化物絶縁膜の代わりに、酸素、水素、水等のブロッキング効果を有する
酸化物絶縁膜を設けてもよい。酸素、水素、水等のブロッキング効果を有する酸化物絶縁
膜としては、酸化アルミニウム、酸化窒化アルミニウム、酸化ガリウム、酸化窒化ガリウ
ム、酸化イットリウム、酸化窒化イットリウム、酸化ハフニウム、酸化窒化ハフニウム等
がある。
また、酸化物半導体層940は、複数の酸化物半導体層が積層された構造でもよい。例え
ば、図20(A)に示すトランジスタのように、酸化物半導体層940を第1の酸化物半
導体層941aと第2の酸化物半導体層941bの積層とすることができる。第1の酸化
物半導体層941aと第2の酸化物半導体層941bに、異なる原子数比の金属酸化物を
用いてもよい。例えば、一方の酸化物半導体層に二種類の金属を含む酸化物、三種類の金
属を含む酸化物、四種類の金属を含む酸化物のうち一つを用い、他方の酸化物半導体層に
一方の酸化物半導体層と異なる二種類の金属を含む酸化物、三種類の金属を含む酸化物、
四種類の金属を含む酸化物を用いてもよい。
また、第1の酸化物半導体層941aと第2の酸化物半導体層941bの構成元素を同一
とし、両者の原子数比を異ならせてもよい。例えば、一方の酸化物半導体層の原子数比を
In:Ga:Zn=1:1:1、5:5:6、または3:1:2とし、他方の酸化物半導
体層の原子数比をIn:Ga:Zn=1:3:2、1:3:4、1:3:6、1:4:5
、1:6:4、または1:9:6である酸化物半導体層で形成することができる。なお、
各酸化物半導体層の原子数比は、誤差として上記の原子数比のプラスマイナス20%の変
動を含む。
このとき、一方の酸化物半導体層と他方の酸化物半導体層のうち、ゲート電極に近い側(
チャネル側)の酸化物半導体層のInとGaの原子数比をIn≧Ga(InはGa以上)
とし、ゲート電極から遠い側(バックチャネル側)の酸化物半導体層のInとGaの原子
数比をIn<Gaとすることで、電界効果移動度の高いトランジスタを作製することがで
きる。一方、チャネル側の酸化物半導体層のInとGaの原子数比をIn<Gaとし、バ
ックチャネル側の酸化物半導体層のInとGaの原子数比をIn≧Ga(InはGa以上
)とすることで、トランジスタの経時変化や信頼性試験によるしきい値電圧の変動量を低
減することができる。
また、トランジスタの半導体膜を第1の酸化物半導体層乃至第3の酸化物半導体層からな
る3層構造としてもよい。このとき、第1の酸化物半導体層乃至第3の酸化物半導体層の
構成元素を同一とし、且つそれぞれの原子数比を異ならせてもよい。半導体膜を3層構造
とするトランジスタの構成について、図20(B)および図29(A)、(B)を用いて
説明する。なお、半導体膜を多層構造とする構成は、本実施の形態に示す他のトランジス
タに適用することもできる。
図20(B)および図29(A)、(B)に示すトランジスタ型では、第3の酸化物半導
体層942a、第2の酸化物半導体層942b、および第1の酸化物半導体層942cが
ゲート絶縁膜側から順に積層されている。
第1の酸化物半導体層942cおよび第3の酸化物半導体層942aを構成する材料は、
InM1xZn(x≧1(xは1以上)、y>1、z>0、M=Ga、Hf等)
で表記できる材料を用いる。また、第2の酸化物半導体層942bを構成する材料は、I
nM2xZn(x≧1(xは1以上)、y≧x(yはx以上)、z>0、M2=G
a、Sn等)で表記できる材料を用いる。
第1の酸化物半導体層942cの伝導帯下端および第3の酸化物半導体層942aの伝導
帯下端に比べて第2の酸化物半導体層942bの伝導帯下端が真空準位から最も深くなる
ような井戸型構造を構成するように、第1、第2、および第3の酸化物半導体層の材料を
適宜選択する。
例えば、第1の酸化物半導体層942cおよび第3の酸化物半導体層942aを原子数比
がIn:Ga:Zn=1:1:1、1:3:2、1:3:4、1:3:6、1:4:5、
1:6:4、または1:9:6である酸化物半導体層で形成し、第2の酸化物半導体層9
42bの原子数比がIn:Ga:Zn=1:1:1、5:5:6、または3:1:2であ
る酸化物半導体層で形成することができる。
第1の酸化物半導体層942c乃至第3の酸化物半導体層942aの構成元素は同一であ
るため、第2の酸化物半導体層942bは、第3の酸化物半導体層942aとの界面にお
ける欠陥準位(トラップ準位)が少ない。詳細には、当該欠陥準位(トラップ準位)は、
ゲート絶縁膜と第3の酸化物半導体層942aとの界面における欠陥準位よりも少ない。
このため、上記のように酸化物半導体層が積層されていることで、トランジスタの経時変
化や信頼性試験によるしきい値電圧の変動量を低減することができる。
また、第1の酸化物半導体層942aの伝導帯下端および第3の酸化物半導体層942c
の伝導帯下端に比べて第2の酸化物半導体層942bの伝導帯下端が真空準位から最も深
くなるような井戸型構造を構成するように、第1、第2、および第3の酸化物半導体層の
材料を適宜選択することで、トランジスタの電界効果移動度を高めることが可能であると
共に、トランジスタの経時変化や信頼性試験によるしきい値電圧の変動量を低減すること
ができる。
また、第1の酸化物半導体層942a乃至第3の酸化物半導体層942cに、結晶性の異
なる酸化物半導体を適用してもよい。なお、少なくともチャネル形成領域となりうる第2
の酸化物半導体層942bは結晶性を有する膜であることが好ましく、表面に対して垂直
方向にc軸配向した膜であることがより好ましい。
なお、図29(A)などに示すトップゲート型トランジスタのチャネル形成領域における
チャネル幅方向の断面は、図35に示すような構成であることが好ましい。当該構成にお
いて、ゲート電極層920は、酸化物半導体層940のチャネル幅方向を電気的に取り囲
み、オン電流が高められる。このようなトランジスタの構造を、surrounded
channel(s−channel)構造とよぶ。
また、図28(A)、(B)に示すような導電膜921を有するような構成において、ゲ
ート電極層920と導電膜921を同電位とする場合には図35(B)に示すように、コ
ンタクトホールを介して両者を接続させてもよい。
本実施の形態に示す構成は、他の実施の形態に示す構成と適宜組み合わせて用いることが
できる。
(実施の形態6)
本実施の形態では、本発明の一態様である表示装置に含まれるトランジスタについて説明
する。
本発明の一態様の表示装置に含まれるトランジスタは各々の構造が一様でなくてもよい。
例えば、表示装置の画素部に含まれるトランジスタと当該画素部を駆動するための駆動回
路部に用いるトランジスタを異なる構成とすることで、それぞれに適した電気特性与える
ことができ、かつ表示装置の信頼性を向上させることができる。
また、駆動回路部に含まれるトランジスタは、ダブルゲート構造とすることによって電界
効果移動度の高いトランジスタとすることもできる。
また、駆動回路部と画素部に含まれるトランジスタのチャネル長が異なってもよい。代表
的には、駆動回路部に含まれるトランジスタ194のチャネル長を2.5μm未満、また
は1.45μm以上2.2μm以下とすることができる。一方、画素部に含まれるトラン
ジスタ190のチャネル長を2.5μm以上、または2.5μm以上20μm以下とする
ことができる。
駆動回路部に含まれるトランジスタのチャネル長を、2.5μm未満、好ましくは1.4
5μm以上2.2μm以下とすることで、画素部に含まれるトランジスタと比較して、電
界効果移動度を高めることが可能であり、オン電流増大させることができる。この結果、
高速動作が可能な駆動回路部を作製することができる。
また、駆動回路部に含まれるトランジスタの電界効果移動度が高いことで、入力端子数を
削減することができる。
図30は図2に示す液晶表示装置の画素部に含まれるトランジスタとして図26(A)に
示すトランジスタを適用し、駆動回路部に含まれるトランジスタとして図29(A)に示
すトランジスタを適用した例である。また、図31は図3に示すEL表示装置に対して画
素部および駆動回路部に異なるトランジスタを適用した例である。また、画素部に含まれ
るトランジスタとしては、図26(B)、図27(A)、(B)に示すトランジスタを適
用することもできる。また、駆動回路部に含まれるトランジスタとしては、図29(A)
、(B)、および図27(A)、(B)の酸化物半導体層を多層構造にしたトランジスタ
を適用することもできる。
画素部に含まれるトランジスタは、バックライトまたはEL素子からの光照射に対して信
頼性の高いトランジスタが望まれる。例えば、原子数比がIn:Ga:Zn=1:1:1
である材料をターゲットに用いたスパッタ法で成膜した酸化物半導体層をチャネル形成領
域に用いることで光照射に対して信頼性の高いトランジスタを形成することができる。
一方、駆動回路部に含まれるトランジスタは電界効果移動度が高いトランジスタが望まれ
る。上述した構成のほかに、例えば、原子数比がIn:Ga:Zn=3:1:2である材
料をターゲットに用いたスパッタ法で成膜した酸化物半導体層をチャネル形成領域に用い
ることで電界効果移動度の高いトランジスタを形成することができる。
本実施の形態では、一方のトランジスタの酸化物半導体層を積層構造とすることで、上記
2種類のトランジスタの工程を簡易に同一基板上に作り分けられる方法を図32および図
33を用いて説明する。なお、図面の左側には画素部に用いるトランジスタとして図26
(A)のトランジスタと同様の構成のトランジスタAのチャネル長方向の断面を例示する
。また、図面の右側には駆動回路部に用いるトランジスタとして図29(A)のトランジ
スタと同様の構成のトランジスタBのチャネル長方向の断面を例示する。なお、トランジ
スタAおよびトランジスタBで共通する符号はどちらか一方のみに付する。また、本実施
の形態で説明するトランジスタの作製方法には、実施の形態1で説明した可撓性基板への
転置するための要素(有機樹脂層など)の作製方法を含む。
基板900には、ガラス基板、セラミック基板、石英基板、サファイア基板などを用いる
ことができる。また、シリコンや炭化シリコンなどの単結晶半導体基板、多結晶半導体基
板、シリコンゲルマニウムなどの化合物半導体基板、SOI(Silicon On I
nsulator)基板などを用いることも可能であり、これらの基板上に半導体素子が
設けられたものを用いてもよい。
有機樹脂層910には、例えば、エポキシ樹脂、アラミド樹脂、アクリル樹脂、ポリイミ
ド樹脂、ポリアミド樹脂、ポリアミドイミド樹脂等の有機樹脂膜を用いることができる。
中でもポリイミド樹脂を用いると耐熱性が高いため好ましい。ポリイミド樹脂を用いる場
合、該ポリイミド樹脂の膜厚は、3nm以上20μm以下、好ましくは500nm以上2
μm以下である。該ポリイミド樹脂は、スピンコート法、ディップコート法、ドクターブ
レード法等により形成することができる。
絶縁膜915としては、酸化シリコン膜、酸化窒化シリコン膜、窒化シリコン膜、窒化酸
化シリコン膜等を用いることができ、スパッタ法やCVD法等で形成することができる。
絶縁層935は、プラズマCVD法またはスパッタ法等により、酸化アルミニウム、酸化
マグネシウム、酸化シリコン、酸化窒化シリコン、酸化ガリウム、酸化ゲルマニウム、酸
化イットリウム、酸化ジルコニウム、酸化ランタン、酸化ネオジム、酸化ハフニウムおよ
び酸化タンタルなどの酸化物絶縁膜、窒化シリコン、窒化酸化シリコン、窒化アルミニウ
ム、窒化酸化アルミニウムなどの窒化物絶縁膜、または上記材料を混合した膜を用いて形
成することができる。また、上記材料の積層であってもよく、少なくとも酸化物半導体層
と接する上層は酸化物半導体層への酸素の供給源となりえる過剰な酸素を含む材料で形成
することが好ましい。
また、絶縁層935にイオン注入法、イオンドーピング法、プラズマイマージョンイオン
インプランテーション法、プラズマ処理法などを用いて酸素を添加してもよい。酸素を添
加することによって、絶縁層935から酸化物半導体層への酸素の供給をさらに容易にす
ることができる。
なお、基板900の表面が絶縁体であり、後に設ける酸化物半導体層への不純物拡散の影
響が無い場合は、絶縁層935を設けない構成とすることができる。また、図28(A)
、(B)に示す例のように、絶縁膜915上に導電膜921を形成し、当該導電膜上に絶
縁層935を形成してもよい。
次に、絶縁層935上に、駆動回路用トランジスタにおける第1の酸化物半導体層942
cとなる第1の酸化物半導体膜940c、第2の酸化物半導体層942bとなる第2の酸
化物半導体膜940bをスパッタリング法、CVD法、MBE法などを用いて成膜する。
次に、リソグラフィ法を用いてレジストマスク801を駆動回路領域に形成する(図32
(A)参照)。そして当該レジストマスクを用いて第1の酸化物半導体膜940cおよび
第2の酸化物半導体膜940bを選択的にエッチングし、第1の酸化物半導体層942c
および第2の酸化物半導体層942bからなる積層を形成する(図32(B)参照)。
次に、上記積層を覆うように第3の酸化物半導体層942aとなる第3の酸化物半導体膜
940aを成膜する。
第1の酸化物半導体膜940c、第2の酸化物半導体膜940b、および第3の酸化物半
導体膜940aには、実施の形態5で説明した材料を用いることができる。本実施の形態
においては、例えば、第1の酸化物半導体膜940cおよび第3の酸化物半導体膜940
aにIn:Ga:Zn=1:1:1[原子数比]のIn−Ga−Zn酸化物、第2の酸化
物半導体膜940bにIn:Ga:Zn=3:1:2[原子数比]のIn−Ga−Zn酸
化物を用いる。なお、第1の酸化物半導体膜940c、第2の酸化物半導体膜940b、
および第3の酸化物半導体膜940aの原子数比はそれぞれ、誤差として上記の原子数比
のプラスマイナス20%の変動を含む。また、成膜法にスパッタ法を用いる場合は、上記
材料をターゲットとして成膜することができる。
また、第1の酸化物半導体膜940c、第2の酸化物半導体膜940b、および第3の酸
化物半導体膜940aとして用いることのできる酸化物半導体は、少なくともインジウム
(In)もしくは亜鉛(Zn)を含むことが好ましい。または、InとZnの双方を含む
ことが好ましい。また、該酸化物半導体を用いたトランジスタの電気特性のばらつきを減
らすため、それらと共に、スタビライザーを含むことが好ましい。
スタビライザーとしては、ガリウム(Ga)、スズ(Sn)、ハフニウム(Hf)、アル
ミニウム(Al)、またはジルコニウム(Zr)等がある。また、他のスタビライザーと
しては、ランタノイドである、ランタン(La)、セリウム(Ce)、プラセオジム(P
r)、ネオジム(Nd)、サマリウム(Sm)、ユウロピウム(Eu)、ガドリニウム(
Gd)、テルビウム(Tb)、ジスプロシウム(Dy)、ホルミウム(Ho)、エルビウ
ム(Er)、ツリウム(Tm)、イッテルビウム(Yb)、ルテチウム(Lu)等がある
例えば、酸化物半導体として、酸化インジウム、酸化スズ、酸化亜鉛、In−Zn酸化物
、Sn−Zn酸化物、Al−Zn酸化物、Zn−Mg酸化物、Sn−Mg酸化物、In−
Mg酸化物、In−Ga酸化物、In−Ga−Zn酸化物、In−Al−Zn酸化物、I
n−Sn−Zn酸化物、Sn−Ga−Zn酸化物、Al−Ga−Zn酸化物、Sn−Al
−Zn酸化物、In−Hf−Zn酸化物、In−La−Zn酸化物、In−Ce−Zn酸
化物、In−Pr−Zn酸化物、In−Nd−Zn酸化物、In−Sm−Zn酸化物、I
n−Eu−Zn酸化物、In−Gd−Zn酸化物、In−Tb−Zn酸化物、In−Dy
−Zn酸化物、In−Ho−Zn酸化物、In−Er−Zn酸化物、In−Tm−Zn酸
化物、In−Yb−Zn酸化物、In−Lu−Zn酸化物、In−Sn−Ga−Zn酸化
物、In−Hf−Ga−Zn酸化物、In−Al−Ga−Zn酸化物、In−Sn−Al
−Zn酸化物、In−Sn−Hf−Zn酸化物、In−Hf−Al−Zn酸化物を用いる
ことができる。
なお、ここで、例えば、In−Ga−Zn酸化物とは、InとGaとZnを主成分として
有する酸化物という意味である。また、InとGaとZn以外の金属元素が入っていても
よい。また、本明細書においては、In−Ga−Zn酸化物で構成した膜をIGZO膜と
も呼ぶ。
また、InMO(ZnO)(m>0、且つ、mは整数でない)で表記される材料を用
いてもよい。なお、Mは、Ga、Y、Zr、La、Ce、またはNdから選ばれた一つの
金属元素または複数の金属元素を示す。また、InSnO(ZnO)(n>0、且
つ、nは整数)で表記される材料を用いてもよい。
ただし、第2の酸化物半導体膜940bは第1の酸化物半導体膜940cおよび第3の酸
化物半導体膜940aよりも電子親和力が大きい材料を選択する。
なお、酸化物半導体膜の成膜には、スパッタ法を用いることが好ましい。スパッタ法とし
ては、RFスパッタ法、DCスパッタ法、ACスパッタ法等を用いることができる。また
、酸化物半導体膜の膜厚の分布、膜組成の分布、または結晶性の分布の均一性を向上させ
るには、RFスパッタ法よりもDCスパッタ法またはACスパッタ法を用いた方が好まし
い。
また、第2の酸化物半導体膜940bは、第1の酸化物半導体膜940cおよび第3の酸
化物半導体膜940aよりもインジウムの含有量を多くするとよい。酸化物半導体では主
として重金属のs軌道がキャリア伝導に寄与しており、Inの含有率を多くすることによ
り、より多くのs軌道が重なるため、InがGaよりも多い組成となる酸化物はInがG
aと同等または少ない組成となる酸化物と比較して移動度が高くなる。そのため、チャネ
ル形成領域にインジウムの含有量が多い酸化物を用いることで、高い移動度のトランジス
タを実現することができる。
第3の酸化物半導体膜940aの形成後に、第1の加熱処理を行ってもよい。第1の加熱
処理は、250℃以上650℃以下、好ましくは300℃以上500℃以下の温度で、不
活性ガス雰囲気、酸化性ガスを10ppm以上含む雰囲気、または減圧状態で行えばよい
。また、第1の加熱処理の雰囲気は、不活性ガス雰囲気で加熱処理した後に、脱離した酸
素を補うために酸化性ガスを10ppm以上含む雰囲気で行ってもよい。第1の加熱処理
によって、第1の酸化物半導体膜940c乃至第3の酸化物半導体膜940aの結晶性を
高め、さらに絶縁層935、および第1の酸化物半導体膜940c乃至第3の酸化物半導
体膜940aから水素や水などの不純物を除去することができる。なお、第1の加熱処理
は、後述する第3の酸化物半導体膜940aのエッチングの後に行ってもよい。
次に、リソグラフィ法を用いてレジストマスク802を画素領域に形成する。またレジス
トマスク803を駆動回路領域における第1の酸化物半導体層942cおよび第2の酸化
物半導体層942bからなる積層上に形成する(図32(C)参照)。
次に、上記レジストマスクを用いて、第3の酸化物半導体膜940aを選択的にエッチン
グし、画素領域に酸化物半導体層943aを形成する。また、駆動回路領域に第1の酸化
物半導体層942c、第2の酸化物半導体層942bおよび第3の酸化物半導体層942
aからなる積層を形成する(図32(D)参照)。
次に、酸化物半導体層943aおよび上記積層上に第1の導電膜を形成する。第1の導電
膜としては、Al、Cr、Cu、Ta、Ti、Mo、W、Ni、Mn、Nd、Sc、およ
び当該金属材料の合金から選ばれた材料の単層、または積層を用いることができる。
次に、第1の導電膜上にレジストマスクを形成し、当該レジストマスクを用いて第1の導
電膜選択的にエッチングすることでソース電極層950およびドレイン電極層960を形
成する(図33(A)参照)。このとき、酸化物半導体層943a、および第1の酸化物
半導体層942c乃至第3の酸化物半導体層942aからなる積層の一部はn型化する。
次に、画素領域および駆動回路領域を覆うようにゲート絶縁膜930を形成する(図33
(B)参照)。ゲート絶縁膜930には、酸化アルミニウム、酸化マグネシウム、酸化シ
リコン、酸化窒化シリコン、窒化酸化シリコン、窒化シリコン、酸化ガリウム、酸化ゲル
マニウム、酸化イットリウム、酸化ジルコニウム、酸化ランタン、酸化ネオジム、酸化ハ
フニウムおよび酸化タンタルなどを用いることができる。なお、ゲート絶縁膜930は、
上記材料の積層であってもよい。ゲート絶縁膜930は、スパッタ法、CVD法、MBE
法などを用いて形成することができる。
次に、ゲート絶縁膜930上にゲート電極層920となる第2の導電膜を形成する。第2
の導電膜としては、Al、Ti、Cr、Co、Ni、Cu、Y、Zr、Mo、Ru、Ag
、Mn、Nd、Sc、TaおよびWの単層、積層または合金を用いることができる。第2
の導電膜は、スパッタ法やCVD法などにより形成することができる。また、第2の導電
膜としては、窒素を含んだ導電膜を用いてもよく、上記導電膜と窒素を含んだ導電膜の積
層を用いてもよい。
次に、第2の導電膜上にレジストマスクを形成し、当該レジストマスクを用いて、第2の
導電膜を選択的にエッチングし、ゲート電極層920を形成する。
次に、酸化物半導体層943a、および第1の酸化物半導体層942c乃至第3の酸化物
半導体層942aからなる積層のソース電極層950、ドレイン電極層960およびゲー
ト電極層920で覆われない領域に不純物810を添加してn型化させ、ソース領域95
1およびドレイン領域961を形成する(図33(C)参照)。
当該不純物の添加方法としては、イオン注入法、イオンドーピング法、プラズマイマージ
ョンイオンインプランテーション法、プラズマ処理法などを用いることができる。なお、
不純物の添加は、ゲート電極層920をマスクとしてゲート絶縁膜930を選択的にエッ
チングした後に行ってもよい。
酸化物半導体層の導電率を高める不純物としては、例えば、リン、砒素、アンチモン、ホ
ウ素、アルミニウム、シリコン、窒素、ヘリウム、ネオン、アルゴン、クリプトン、キセ
ノン、インジウム、フッ素、塩素、チタン、亜鉛、および炭素のいずれかから選択される
一つ以上を用いることができる。
不純物元素として、希ガスが酸化物半導体層に添加されると、酸化物半導体層中の金属元
素および酸素の結合が切断され、酸素欠損が形成される。酸化物半導体膜に含まれる酸素
欠損と酸化物半導体層中に残存または後から添加される水素の相互作用により、酸化物半
導体層は導電率が高くなる。具体的には、酸化物半導体膜に含まれる酸素欠損に水素が入
ることで、キャリアである電子が生成される。この結果、導電率が高くなる。
なお、図33(C)において、酸化物半導体層におけるゲート電極層920、ソース電極
層およびドレイン電極層と重ならない領域、所謂オフセット領域の幅が0.1μm未満と
する場合には、上記不純物のドーピングを行わなくてもよい。当該オフセット領域が0.
1μm未満の場合には、不純物のドーピングの有無におけるトランジスタのオン電流の差
は極めて小さくなる。
次に、ゲート絶縁膜930およびゲート電極層920上に絶縁膜970、絶縁膜980お
よび絶縁膜990を形成する(図33(D)参照)。
また、絶縁膜970および/または絶縁膜980にイオン注入法、イオンドーピング法、
プラズマイマージョンイオンインプランテーション法、プラズマ処理法などを用いて酸素
を添加してもよい。酸素を添加することによって、絶縁膜970および/または絶縁膜9
80から酸化物半導体層943a、および第1の酸化物半導体層942c乃至第3の酸化
物半導体層942aからなる積層への酸素の供給をさらに容易にすることができる。
次に、第2の加熱処理を行ってもよい。第2の加熱処理は、第1の加熱処理と同様の条件
で行うことができる。第2の加熱処理により、絶縁層935、絶縁膜970、絶縁膜98
0から過剰酸素が放出されやすくなり、酸化物半導体層943a、および第1の酸化物半
導体層942c乃至第3の酸化物半導体層942aからなる積層の酸素欠損を低減するこ
とができる。
また、画素部に用いるトランジスタとして図26(B)のトランジスタと同様の構成のト
ランジスタCとし、駆動回路部に用いるトランジスタとして図29(B)のトランジスタ
と同様の構成のトランジスタDとした場合の作製方法を図34に示す。
まず、図33(B)に示す工程までは前述したトランジスタの作製方法と同様の工程を行
い、ゲート電極層920を形成する(図34(A)参照)。
次に、ゲート電極層920をマスクとしてゲート絶縁膜930をエッチングする(図34
(B)参照)。
次に、酸化物半導体層940の一部と接するように窒化珪素膜や窒化アルミニウムなどの
水素を含む絶縁膜975を形成し、酸化物半導体層940の一部に水素を拡散させる(図
34(C)参照)。当該拡散した水素は酸化物半導体層940中の酸素欠損と結合してド
ナーとなるため、低抵抗のソース領域951およびドレイン領域961を形成することが
できる。なお、図34(C)の構造において、前述した不純物を酸化物半導体層にドーピ
ングしてもよい。
次に、絶縁膜975上に絶縁膜970、絶縁膜980および絶縁膜990を形成する(図
34(D)参照)。
以上の工程において、積層構造の酸化物半導体層を有するトランジスタおよび単層構造の
酸化物半導体層を有するトランジスタを同一基板上に簡易に形成することができる。また
、高速動作が可能であり、且つ光照射の劣化が少なく、表示品質に優れた画素部を有する
表示装置を作製することができる。
なお、本実施の形態で説明した金属膜、半導体膜、無機絶縁膜など様々な膜は、代表的に
はスパッタ法やプラズマCVD法により形成することができるが、他の方法、例えば、熱
CVD(Chemical Vapor Deposition)法により形成してもよ
い。熱CVD法の例としては、MOCVD(Metal Organic Chemic
al Vapor Deposition)法やALD(Atomic Layer D
eposition)法などがある。
熱CVD法は、プラズマを使わない成膜方法のため、プラズマダメージにより欠陥が生成
されることが無いという利点を有する。
また、熱CVD法では、原料ガスと酸化剤を同時にチャンバー内に送り、チャンバー内を
大気圧または減圧下とし、基板近傍または基板上で反応させて基板上に堆積させることで
成膜を行ってもよい。
ALD法は、チャンバー内を大気圧または減圧下とし、反応のための原料ガスが順次にチ
ャンバーに導入され、そのガス導入の順序を繰り返すことで成膜を行ってもよい。例えば
、それぞれのスイッチングバルブ(高速バルブとも呼ぶ)を切り替えて2種類以上の原料
ガスを順番にチャンバーに供給し、複数種の原料ガスが混ざらないように第1の原料ガス
と同時またはその後に不活性ガス(アルゴン、或いは窒素など)などを導入し、第2の原
料ガスを導入する。なお、同時に不活性ガスを導入する場合には、不活性ガスはキャリア
ガスとなり、また、第2の原料ガスの導入時にも同時に不活性ガスを導入してもよい。ま
た、不活性ガスを導入する代わりに真空排気によって第1の原料ガスを排出した後、第2
の原料ガスを導入してもよい。第1の原料ガスが基板の表面に吸着して第1の層を成膜し
、後から導入される第2の原料ガスと反応して、第2の層が第1の層上に積層されて薄膜
が形成される。このガス導入順序を制御しつつ所望の厚さになるまで複数回繰り返すこと
で、段差被覆性に優れた薄膜を形成することができる。薄膜の厚さは、ガス導入順序を繰
り返す回数によって調節することができるため、精密な膜厚調節が可能であり、微細なF
ETを作製する場合に適している。
MOCVD法やALD法などの熱CVD法は、これまでに記載した実施形態に開示された
金属膜、半導体膜、無機絶縁膜など様々な膜を形成することができ、例えば、In−Ga
−ZnO(X>0)膜を成膜する場合には、トリメチルインジウム、トリメチルガリウ
ム、およびジメチル亜鉛を用いることができる。なお、トリメチルインジウムの化学式は
、In(CHである。また、トリメチルガリウムの化学式は、Ga(CH
ある。また、ジメチル亜鉛の化学式は、Zn(CHである。また、これらの組み合
わせに限定されず、トリメチルガリウムに代えてトリエチルガリウム(化学式Ga(C
)を用いることもでき、ジメチル亜鉛に代えてジエチル亜鉛(化学式Zn(C
)を用いることもできる。
例えば、ALDを利用する成膜装置により酸化ハフニウム膜を形成する場合には、溶媒と
ハフニウム前駆体化合物を含む液体(ハフニウムアルコキシド溶液、代表的にはテトラキ
スジメチルアミドハフニウム(TDMAH))を気化させた原料ガスと、酸化剤としてオ
ゾン(O)の2種類のガスを用いる。なお、テトラキスジメチルアミドハフニウムの化
学式はHf[N(CHである。また、他の材料液としては、テトラキス(エチ
ルメチルアミド)ハフニウムなどがある。
例えば、ALDを利用する成膜装置により酸化アルミニウム膜を形成する場合には、溶媒
とアルミニウム前駆体化合物を含む液体(トリメチルアルミニウムTMAなど)を気化さ
せた原料ガスと、酸化剤としてHOの2種類のガスを用いる。なお、トリメチルアルミ
ニウムの化学式はAl(CHである。また、他の材料液としては、トリス(ジメチ
ルアミド)アルミニウム、トリイソブチルアルミニウム、アルミニウムトリス(2,2,
6,6−テトラメチル−3,5−ヘプタンジオナート)などがある。
例えば、ALDを利用する成膜装置により酸化シリコン膜を形成する場合には、ヘキサク
ロロジシランを被成膜面に吸着させ、吸着物に含まれる塩素を除去し、酸化性ガス(O
、一酸化二窒素)のラジカルを供給して吸着物と反応させる。
例えば、ALDを利用する成膜装置によりタングステン膜を成膜する場合には、WF
スとBガスを順次繰り返し導入して初期タングステン膜を形成し、その後、WF
ガスとHガスを同時に導入してタングステン膜を形成する。なお、Bガスに代え
てSiHガスを用いてもよい。
例えば、ALDを利用する成膜装置により酸化物半導体膜、例えばIn−Ga−ZnO
(X>0)膜を成膜する場合には、In(CHガスとOガスを順次繰り返し導入
してIn−O層を形成し、その後、Ga(CHガスとOガスを同時に導入してG
aO層を形成し、更にその後Zn(CHとOガスを同時に導入してZnO層を形
成する。なお、これらの層の順番はこの例に限らない。また、これらのガスを混ぜてIn
−Ga−O層やIn−Zn−O層、Ga−Zn−O層などの混合化合物層を形成しても良
い。なお、Oガスに変えてAr等の不活性ガスでバブリングして得られたたHOガス
を用いても良いが、Hを含まないOガスを用いる方が好ましい。また、In(CH
ガスにかえて、In(Cガスを用いても良い。また、Ga(CHガス
にかえて、Ga(Cガスを用いても良い。また、Zn(CHガスを用い
ても良い。
なお、本実施の形態は、本明細書で示す他の実施の形態と適宜組み合わせることができる
(実施の形態7)
本実施の形態では、本発明の一態様であるトランジスタに使用することができる酸化物半
導体膜について説明する。
<酸化物半導体の構造について>
以下では、酸化物半導体の構造について説明する。
なお、本明細書において、「平行」とは、二つの直線が−10°以上10°以下の角度で
配置されている状態をいう。したがって、−5°以上5°以下の場合も含まれる。また、
「略平行」とは、二つの直線が−30°以上30°以下の角度で配置されている状態をい
う。また、「垂直」とは、二つの直線が80°以上100°以下の角度で配置されている
状態をいう。したがって、85°以上95°以下の場合も含まれる。また、「略垂直」と
は、二つの直線が60°以上120°以下の角度で配置されている状態をいう。
また、本明細書において、結晶が三方晶または菱面体晶である場合、六方晶系として表す
酸化物半導体は、単結晶酸化物半導体と、それ以外の非単結晶酸化物半導体とに分けられ
る。非単結晶酸化物半導体としては、CAAC−OS(C Axis Aligned
Crystalline Oxide Semiconductor)、多結晶酸化物半
導体、微結晶酸化物半導体、非晶質酸化物半導体などがある。
また別の観点では、酸化物半導体は、非晶質酸化物半導体と、それ以外の結晶性酸化物半
導体とに分けられる。結晶性酸化物半導体としては、単結晶酸化物半導体、CAAC−O
S、多結晶酸化物半導体、微結晶酸化物半導体などがある。
<CAAC−OS>
まずは、CAAC−OSについて説明する。なお、CAAC−OSを、CANC(C−A
xis Aligned nanocrystals)を有する酸化物半導体と呼ぶこと
もできる。
CAAC−OSは、c軸配向した複数の結晶部(ペレットともいう。)を有する酸化物半
導体の一つである。
透過型電子顕微鏡(TEM:Transmission Electron Micro
scope)によって、CAAC−OSの明視野像と回折パターンとの複合解析像(高分
解能TEM像ともいう。)を観察すると、複数のペレットを確認することができる。一方
、高分解能TEM像ではペレット同士の境界、即ち結晶粒界(グレインバウンダリーとも
いう。)を明確に確認することができない。そのため、CAAC−OSは、結晶粒界に起
因する電子移動度の低下が起こりにくいといえる。
以下では、TEMによって観察したCAAC−OSについて説明する。図21(A)に、
試料面と略平行な方向から観察したCAAC−OSの断面の高分解能TEM像を示す。高
分解能TEM像の観察には、球面収差補正(Spherical Aberration
Corrector)機能を用いた。球面収差補正機能を用いた高分解能TEM像を、
特にCs補正高分解能TEM像と呼ぶ。Cs補正高分解能TEM像の取得は、例えば、日
本電子株式会社製原子分解能分析電子顕微鏡JEM−ARM200Fなどによって行うこ
とができる。
図21(A)の領域(1)を拡大したCs補正高分解能TEM像を図21(B)に示す。
図21(B)より、ペレットにおいて、金属原子が層状に配列していることを確認できる
。金属原子の各層の配列は、CAAC−OSの膜を形成する面(被形成面ともいう。)ま
たは上面の凹凸を反映しており、CAAC−OSの被形成面または上面と平行となる。
図21(B)に示すように、CAAC−OSは特徴的な原子配列を有する。図21(C)
は、特徴的な原子配列を、補助線で示したものである。図21(B)および図21(C)
より、ペレット一つの大きさは1nm以上3nm以下程度であり、ペレットとペレットと
の傾きにより生じる隙間の大きさは0.8nm程度であることがわかる。したがって、ペ
レットを、ナノ結晶(nc:nanocrystal)と呼ぶこともできる。
ここで、Cs補正高分解能TEM像をもとに、基板5120上のCAAC−OSのペレッ
ト5100の配置を模式的に示すと、レンガまたはブロックが積み重なったような構造と
なる(図21(D)参照。)。図21(C)で観察されたペレットとペレットとの間で傾
きが生じている箇所は、図21(D)に示す領域5161に相当する。
また、図22(A)に、試料面と略垂直な方向から観察したCAAC−OSの平面のCs
補正高分解能TEM像を示す。図22(A)の領域(1)、領域(2)および領域(3)
を拡大したCs補正高分解能TEM像を、それぞれ図22(B)、図22(C)および図
22(D)に示す。図22(B)、図22(C)および図22(D)より、ペレットは、
金属原子が三角形状、四角形状または六角形状に配列していることを確認できる。しかし
ながら、異なるペレット間で、金属原子の配列に規則性は見られない。
次に、X線回折(XRD:X−Ray Diffraction)によって解析したCA
AC−OSについて説明する。例えば、InGaZnOの結晶を有するCAAC−OS
に対し、out−of−plane法による構造解析を行うと、図23(A)に示すよう
に回折角(2θ)が31°近傍にピークが現れる場合がある。このピークは、InGaZ
nOの結晶の(009)面に帰属されることから、CAAC−OSの結晶がc軸配向性
を有し、c軸が被形成面または上面に略垂直な方向を向いていることが確認できる。
なお、CAAC−OSのout−of−plane法による構造解析では、2θが31°
近傍のピークの他に、2θが36°近傍にもピークが現れる場合がある。2θが36°近
傍のピークは、CAAC−OS中の一部に、c軸配向性を有さない結晶が含まれることを
示している。より好ましいCAAC−OSは、out−of−plane法による構造解
析では、2θが31°近傍にピークを示し、2θが36°近傍にピークを示さない。
一方、CAAC−OSに対し、c軸に略垂直な方向からX線を入射させるin−plan
e法による構造解析を行うと、2θが56°近傍にピークが現れる。このピークは、In
GaZnOの結晶の(110)面に帰属される。CAAC−OSの場合は、2θを56
°近傍に固定し、試料面の法線ベクトルを軸(φ軸)として試料を回転させながら分析(
φスキャン)を行っても、図23(B)に示すように明瞭なピークは現れない。これに対
し、InGaZnOの単結晶酸化物半導体であれば、2θを56°近傍に固定してφス
キャンした場合、図23(C)に示すように(110)面と等価な結晶面に帰属されるピ
ークが6本観察される。したがって、XRDを用いた構造解析から、CAAC−OSは、
a軸およびb軸の配向が不規則であることが確認できる。
次に、電子回折によって解析したCAAC−OSについて説明する。例えば、InGaZ
nOの結晶を有するCAAC−OSに対し、試料面に平行にプローブ径が300nmの
電子線を入射させると、図40(A)に示すような回折パターン(制限視野透過電子回折
パターンともいう。)が現れる場合がある。この回折パターンには、InGaZnO
結晶の(009)面に起因するスポットが含まれる。したがって、電子回折によっても、
CAAC−OSに含まれるペレットがc軸配向性を有し、c軸が被形成面または上面に略
垂直な方向を向いていることがわかる。一方、同じ試料に対し、試料面に垂直にプローブ
径が300nmの電子線を入射させたときの回折パターンを図40(B)に示す。図40
(B)より、リング状の回折パターンが確認される。したがって、電子回折によっても、
CAAC−OSに含まれるペレットのa軸およびb軸は配向性を有さないことがわかる。
なお、図40(B)における第1リングは、InGaZnOの結晶の(010)面およ
び(100)面などに起因すると考えられる。また、図40(B)における第2リングは
(110)面などに起因すると考えられる。
また、CAAC−OSは、欠陥準位密度の低い酸化物半導体である。酸化物半導体の欠陥
としては、例えば、不純物に起因する欠陥や、酸素欠損などがある。したがって、CAA
C−OSは、不純物濃度の低い酸化物半導体ということもできる。また、CAAC−OS
は、酸素欠損の少ない酸化物半導体ということもできる。
酸化物半導体に含まれる不純物は、キャリアトラップとなる場合や、キャリア発生源とな
る場合がある。また、酸化物半導体中の酸素欠損は、キャリアトラップとなる場合や、水
素を捕獲することによってキャリア発生源となる場合がある。
なお、不純物は、酸化物半導体の主成分以外の元素で、水素、炭素、シリコン、遷移金属
元素などがある。例えば、シリコンなどの、酸化物半導体を構成する金属元素よりも酸素
との結合力の強い元素は、酸化物半導体から酸素を奪うことで酸化物半導体の原子配列を
乱し、結晶性を低下させる要因となる。また、鉄やニッケルなどの重金属、アルゴン、二
酸化炭素などは、原子半径(または分子半径)が大きいため、酸化物半導体の原子配列を
乱し、結晶性を低下させる要因となる。
また、欠陥準位密度の低い(酸素欠損が少ない)酸化物半導体は、キャリア密度を低くす
ることができる。そのような酸化物半導体を、高純度真性または実質的に高純度真性な酸
化物半導体と呼ぶ。CAAC−OSは、不純物濃度が低く、欠陥準位密度が低い。即ち、
高純度真性または実質的に高純度真性な酸化物半導体となりやすい。したがって、CAA
C−OSを用いたトランジスタは、しきい値電圧がマイナスとなる電気特性(ノーマリー
オンともいう。)になることが少ない。また、高純度真性または実質的に高純度真性な酸
化物半導体は、キャリアトラップが少ない。酸化物半導体のキャリアトラップに捕獲され
た電荷は、放出するまでに要する時間が長く、あたかも固定電荷のように振る舞うことが
ある。そのため、不純物濃度が高く、欠陥準位密度が高い酸化物半導体を用いたトランジ
スタは、電気特性が不安定となる場合がある。一方、CAAC−OSを用いたトランジス
タは、電気特性の変動が小さく、信頼性の高いトランジスタとなる。
また、CAAC−OSは欠陥準位密度が低いため、光の照射などによって生成されたキャ
リアが、欠陥準位に捕獲されることが少ない。したがって、CAAC−OSを用いたトラ
ンジスタは、可視光や紫外光の照射による電気特性の変動が小さい。
<微結晶酸化物半導体>
次に、微結晶酸化物半導体について説明する。
微結晶酸化物半導体は、高分解能TEM像において、結晶部を確認することのできる領域
と、明確な結晶部を確認することのできない領域と、を有する。微結晶酸化物半導体に含
まれる結晶部は、1nm以上100nm以下、または1nm以上10nm以下の大きさで
あることが多い。特に、1nm以上10nm以下、または1nm以上3nm以下の微結晶
であるナノ結晶を有する酸化物半導体を、nc−OS(nanocrystalline
Oxide Semiconductor)と呼ぶ。nc−OSは、例えば、高分解能
TEM像では、結晶粒界を明確に確認できない場合がある。なお、ナノ結晶は、CAAC
−OSにおけるペレットと起源を同じくする可能性がある。そのため、以下ではnc−O
Sの結晶部をペレットと呼ぶ場合がある。
nc−OSは、微小な領域(例えば、1nm以上10nm以下の領域、特に1nm以上3
nm以下の領域)において原子配列に周期性を有する。また、nc−OSは、異なるペレ
ット間で結晶方位に規則性が見られない。そのため、膜全体で配向性が見られない。した
がって、nc−OSは、分析方法によっては、非晶質酸化物半導体と区別が付かない場合
がある。例えば、nc−OSに対し、ペレットよりも大きい径のX線を用いるXRD装置
を用いて構造解析を行うと、out−of−plane法による解析では、結晶面を示す
ピークが検出されない。また、nc−OSに対し、ペレットよりも大きいプローブ径(例
えば50nm以上)の電子線を用いる電子回折(制限視野電子回折ともいう。)を行うと
、ハローパターンのような回折パターンが観測される。一方、nc−OSに対し、ペレッ
トの大きさと近いかペレットより小さいプローブ径の電子線を用いるナノビーム電子回折
を行うと、スポットが観測される。また、nc−OSに対しナノビーム電子回折を行うと
、円を描くように(リング状に)輝度の高い領域が観測される場合がある。さらに、リン
グ状の領域内に複数のスポットが観測される場合がある。
このように、ペレット(ナノ結晶)間では結晶方位が規則性を有さないことから、nc−
OSを、RANC(Random Aligned nanocrystals)を有す
る酸化物半導体、またはNANC(Non−Aligned nanocrystals
)を有する酸化物半導体と呼ぶこともできる。
nc−OSは、非晶質酸化物半導体よりも規則性の高い酸化物半導体である。そのため、
nc−OSは、非晶質酸化物半導体よりも欠陥準位密度が低くなる。ただし、nc−OS
は、異なるペレット間で結晶方位に規則性が見られない。そのため、nc−OSは、CA
AC−OSと比べて欠陥準位密度が高くなる。
<非晶質酸化物半導体>
次に、非晶質酸化物半導体について説明する。
非晶質酸化物半導体は、膜中における原子配列が不規則であり、結晶部を有さない酸化物
半導体である。石英のような無定形状態を有する酸化物半導体が一例である。
非晶質酸化物半導体は、高分解能TEM像において結晶部を確認することができない。
非晶質酸化物半導体に対し、XRD装置を用いた構造解析を行うと、out−of−pl
ane法による解析では、結晶面を示すピークが検出されない。また、非晶質酸化物半導
体に対し、電子回折を行うと、ハローパターンが観測される。また、非晶質酸化物半導体
に対し、ナノビーム電子回折を行うと、スポットが観測されず、ハローパターンのみが観
測される。
非晶質構造については、様々な見解が示されている。例えば、原子配列に全く秩序性を有
さない構造を完全な非晶質構造(completely amorphous stru
cture)と呼ぶ場合がある。また、最近接原子間距離または第2近接原子間距離まで
秩序性を有し、かつ長距離秩序性を有さない構造を非晶質構造と呼ぶ場合もある。したが
って、最も厳格な定義によれば、僅かでも原子配列に秩序性を有する酸化物半導体を非晶
質酸化物半導体と呼ぶことはできない。また、少なくとも、長距離秩序性を有する酸化物
半導体を非晶質酸化物半導体と呼ぶことはできない。よって、結晶部を有することから、
例えば、CAAC−OSおよびnc−OSを、非晶質酸化物半導体または完全な非晶質酸
化物半導体と呼ぶことはできない。
<非晶質ライク酸化物半導体>
なお、酸化物半導体は、nc−OSと非晶質酸化物半導体との間の構造を有する場合があ
る。そのような構造を有する酸化物半導体を、特に非晶質ライク酸化物半導体(a−li
ke OS:amorphous−like Oxide Semiconductor
)と呼ぶ。
a−like OSは、高分解能TEM像において鬆(ボイドともいう。)が観察される
場合がある。また、高分解能TEM像において、明確に結晶部を確認することのできる領
域と、結晶部を確認することのできない領域と、を有する。
鬆を有するため、a−like OSは、不安定な構造である。以下では、a−like
OSが、CAAC−OSおよびnc−OSと比べて不安定な構造であることを示すため
、電子照射による構造の変化を示す。
電子照射を行う試料として、a−like OS(試料Aと表記する。)、nc−OS(
試料Bと表記する。)およびCAAC−OS(試料Cと表記する。)を準備する。いずれ
の試料もIn−Ga−Zn酸化物である。
まず、各試料の高分解能断面TEM像を取得する。高分解能断面TEM像により、各試料
は、いずれも結晶部を有することがわかる。
なお、どの部分を一つの結晶部と見なすかの判定は、以下のように行えばよい。例えば、
InGaZnOの結晶の単位格子は、In−O層を3層有し、またGa−Zn−O層を
6層有する、計9層がc軸方向に層状に重なった構造を有することが知られている。これ
らの近接する層同士の間隔は、(009)面の格子面間隔(d値ともいう。)と同程度で
あり、結晶構造解析からその値は0.29nmと求められている。したがって、格子縞の
間隔が0.28nm以上0.30nm以下である箇所を、InGaZnOの結晶部と見
なすことができる。なお、格子縞は、InGaZnOの結晶のa−b面に対応する。
図41は、各試料の結晶部(22箇所から45箇所)の平均の大きさを調査した例である
。ただし、上述した格子縞の長さを結晶部の大きさとしている。図41より、a−lik
e OSは、電子の累積照射量に応じて結晶部が大きくなっていくことがわかる。具体的
には、図41中に(1)で示すように、TEMによる観察初期においては1.2nm程度
の大きさだった結晶部(初期核ともいう。)が、累積照射量が4.2×10/nm
においては2.6nm程度の大きさまで成長していることがわかる。一方、nc−OS
およびCAAC−OSは、電子照射開始時から電子の累積照射量が4.2×10
nmまでの範囲で、結晶部の大きさに変化が見られないことがわかる。具体的には、図
41中の(2)および(3)で示すように、電子の累積照射量によらず、nc−OSおよ
びCAAC−OSの結晶部の大きさは、それぞれ1.4nm程度および2.1nm程度で
あることがわかる。
このように、a−like OSは、電子照射によって結晶部の成長が見られる場合があ
る。一方、nc−OSおよびCAAC−OSは、電子照射による結晶部の成長がほとんど
見られないことがわかる。即ち、a−like OSは、nc−OSおよびCAAC−O
Sと比べて、不安定な構造であることがわかる。
また、鬆を有するため、a−like OSは、nc−OSおよびCAAC−OSと比べ
て密度の低い構造である。具体的には、a−like OSの密度は、同じ組成の単結晶
の密度の78.6%以上92.3%未満となる。また、nc−OSの密度およびCAAC
−OSの密度は、同じ組成の単結晶の密度の92.3%以上100%未満となる。単結晶
の密度の78%未満となる酸化物半導体は、成膜すること自体が困難である。
例えば、In:Ga:Zn=1:1:1[原子数比]を満たす酸化物半導体において、菱
面体晶構造を有する単結晶InGaZnOの密度は6.357g/cmとなる。よっ
て、例えば、In:Ga:Zn=1:1:1[原子数比]を満たす酸化物半導体において
、a−like OSの密度は5.0g/cm以上5.9g/cm未満となる。また
、例えば、In:Ga:Zn=1:1:1[原子数比]を満たす酸化物半導体において、
nc−OSの密度およびCAAC−OSの密度は5.9g/cm以上6.3g/cm
未満となる。
なお、同じ組成の単結晶が存在しない場合がある。その場合、任意の割合で組成の異なる
単結晶を組み合わせることにより、所望の組成における単結晶に相当する密度を見積もる
ことができる。所望の組成の単結晶に相当する密度は、組成の異なる単結晶を組み合わせ
る割合に対して、加重平均を用いて見積もればよい。ただし、密度は、可能な限り少ない
種類の単結晶を組み合わせて見積もることが好ましい。
以上のように、酸化物半導体は、様々な構造をとり、それぞれが様々な特性を有する。な
お、酸化物半導体は、例えば、非晶質酸化物半導体、a−like OS、微結晶酸化物
半導体、CAAC−OSのうち、二種以上を有する積層膜であってもよい。
<成膜モデル>
以下では、CAAC−OSおよびnc−OSの成膜モデルの一例について説明する。
図42(A)は、スパッタリング法によりCAAC−OSが成膜される様子を示した成膜
室内の模式図である。
ターゲット5130は、バッキングプレートに接着されている。バッキングプレートを介
してターゲット5130と向かい合う位置には、複数のマグネットが配置される。該複数
のマグネットによって磁場が生じている。マグネットの磁場を利用して成膜速度を高める
スパッタリング法は、マグネトロンスパッタリング法と呼ばれる。
基板5120は、ターゲット5130と向かい合うように配置しており、その距離d(タ
ーゲット−基板間距離(T−S間距離)ともいう。)は0.01m以上1m以下、好まし
くは0.02m以上0.5m以下とする。成膜室内は、ほとんどが成膜ガス(例えば、酸
素、アルゴン、または酸素を5体積%以上の割合で含む混合ガス)で満たされ、0.01
Pa以上100Pa以下、好ましくは0.1Pa以上10Pa以下に制御される。ここで
、ターゲット5130に一定以上の電圧を印加することで、放電が始まり、プラズマが確
認される。なお、ターゲット5130の近傍には磁場によって、高密度プラズマ領域が形
成される。高密度プラズマ領域では、成膜ガスがイオン化することで、イオン5101が
生じる。イオン5101は、例えば、酸素の陽イオン(O)やアルゴンの陽イオン(A
)などである。
ここで、ターゲット5130は、複数の結晶粒を有する多結晶構造を有し、いずれかの結
晶粒には劈開面が含まれる。図43(A)に、一例として、ターゲット5130に含まれ
るInGaZnOの結晶の構造を示す。なお、図43(A)は、b軸に平行な方向から
InGaZnOの結晶を観察した場合の構造である。図43(A)より、近接する二つ
のGa−Zn−O層において、それぞれの層における酸素原子同士が近距離に配置されて
いることがわかる。そして、酸素原子が負の電荷を有することにより、近接する二つのG
a−Zn−O層の間には斥力が生じる。その結果、InGaZnOの結晶は、近接する
二つのGa−Zn−O層の間に劈開面を有する。
高密度プラズマ領域で生じたイオン5101は、電界によってターゲット5130側に加
速され、やがてターゲット5130と衝突する。このとき、劈開面から平板状またはペレ
ット状のスパッタ粒子であるペレット5100aおよびペレット5100bが剥離し、叩
き出される。なお、ペレット5100aおよびペレット5100bは、イオン5101の
衝突の衝撃によって、構造に歪みが生じる場合がある。
ペレット5100aは、三角形、例えば正三角形の平面を有する平板状またはペレット状
のスパッタ粒子である。また、ペレット5100bは、六角形、例えば正六角形の平面を
有する平板状またはペレット状のスパッタ粒子である。なお、ペレット5100aおよび
ペレット5100bなどの平板状またはペレット状のスパッタ粒子を総称してペレット5
100と呼ぶ。ペレット5100の平面の形状は、三角形、六角形に限定されない、例え
ば、三角形が複数個合わさった形状となる場合がある。例えば、三角形(例えば、正三角
形)が2個合わさった四角形(例えば、ひし形)となる場合もある。
ペレット5100は、成膜ガスの種類などに応じて厚さが決定する。理由は後述するが、
ペレット5100の厚さは、均一にすることが好ましい。また、スパッタ粒子は厚みのな
いペレット状である方が、厚みのあるサイコロ状であるよりも好ましい。例えば、ペレッ
ト5100は、厚さを0.4nm以上1nm以下、好ましくは0.6nm以上0.8nm
以下とする。また、例えば、ペレット5100は、幅を1nm以上3nm以下、好ましく
は1.2nm以上2.5nm以下とする。ペレット5100は、上述の図41中の(1)
で説明した初期核に相当する。例えば、In−Ga−Zn酸化物を有するターゲット51
30にイオン5101を衝突させると、図43(B)に示すように、Ga−Zn−O層、
In−O層およびGa−Zn−O層の3層を有するペレット5100が剥離する。図43
(C)に、剥離したペレット5100をc軸に平行な方向から観察した構造を示す。ペレ
ット5100は、二つのGa−Zn−O層(パン)と、In−O層(具)と、を有するナ
ノサイズのサンドイッチ構造と呼ぶこともできる。
ペレット5100は、プラズマを通過する際に、側面が負または正に帯電する場合がある
。ペレット5100は、例えば、側面に位置する酸素原子が負に帯電する可能性がある。
側面が同じ極性の電荷を有することにより、電荷同士の反発が起こり、平板状またはペレ
ット状の形状を維持することが可能となる。なお、CAAC−OSが、In−Ga−Zn
酸化物である場合、インジウム原子と結合した酸素原子が負に帯電する可能性がある。ま
たは、インジウム原子、ガリウム原子または亜鉛原子と結合した酸素原子が負に帯電する
可能性がある。また、ペレット5100は、プラズマを通過する際に、プラズマ中のイン
ジウム原子、ガリウム原子、亜鉛原子および酸素原子などと結合することで成長する場合
がある。上述の図41中の(2)と(1)の大きさの違いが、プラズマ中での成長分に相
当する。ここで、基板5120が室温程度である場合、基板5120上におけるペレット
5100の成長が起こりにくいためnc−OSとなる(図42(B)参照。)。室温程度
で成膜できることから、基板5120が大面積である場合でもnc−OSの成膜が可能で
ある。なお、ペレット5100をプラズマ中で成長させるためには、スパッタリング法に
おける成膜電力を高くすることが有効である。成膜電力を高くすることで、ペレット51
00の構造を安定にすることができる。
図42(A)および図42(B)に示すように、例えば、ペレット5100は、プラズマ
中を凧のように飛翔し、ひらひらと基板5120上まで舞い上がっていく。ペレット51
00は電荷を帯びているため、ほかのペレット5100が既に堆積している領域が近づく
と、斥力が生じる。ここで、基板5120の上面では、基板5120の上面に平行な向き
の磁場(水平磁場ともいう。)が生じている。また、基板5120およびターゲット51
30間には、電位差が与えられるため、基板5120からターゲット5130に向かう方
向に電流が流れる。したがって、ペレット5100は、基板5120の上面において、磁
場および電流の作用によって、力(ローレンツ力)を受ける。このことは、フレミングの
左手の法則によって理解できる。
ペレット5100は、原子一つと比べると質量が大きい。そのため、基板5120の上面
を移動するためには何らかの力を外部から印加することが重要となる。その力の一つが磁
場および電流の作用で生じる力である可能性がある。なお、ペレット5100に、基板5
120の上面を移動するために十分な力を与えるには、基板5120の上面において、基
板5120の上面に平行な向きの磁場が10G以上、好ましくは20G以上、さらに好ま
しくは30G以上、より好ましくは50G以上となる領域を設けるとよい。または、基板
5120の上面において、基板5120の上面に平行な向きの磁場が、基板5120の上
面に垂直な向きの磁場の1.5倍以上、好ましくは2倍以上、さらに好ましくは3倍以上
、より好ましくは5倍以上となる領域を設けるとよい。
このとき、マグネットと基板5120とが相対的に移動すること、または回転することに
よって、基板5120の上面における水平磁場の向きは変化し続ける。したがって、基板
5120の上面において、ペレット5100は、様々な方向から力を受け、様々な方向へ
移動することができる。
また、図42(A)に示すように基板5120が加熱されている場合、ペレット5100
と基板5120との間で摩擦などによる抵抗が小さい状態となっている。その結果、ペレ
ット5100は、基板5120の上面を滑空するように移動する。ペレット5100の移
動は、平板面を基板5120に向けた状態で起こる。その後、既に堆積しているほかのペ
レット5100の側面まで到達すると、側面同士が結合する。このとき、ペレット510
0の側面にある酸素原子が脱離する。脱離した酸素原子によって、CAAC−OS中の酸
素欠損が埋まる場合があるため、欠陥準位密度の低いCAAC−OSとなる。なお、基板
5120の上面の温度は、例えば、100℃以上500℃未満、150℃以上450℃未
満、または170℃以上400℃未満とすればよい。したがって、基板5120が大面積
である場合でもCAAC−OSの成膜は可能である。
また、ペレット5100は、基板5120上で加熱されることにより、原子が再配列し、
イオン5101の衝突で生じた構造の歪みが緩和される。歪みの緩和されたペレット51
00は、ほとんど単結晶となる。ペレット5100がほとんど単結晶となることにより、
ペレット5100同士が結合した後に加熱されたとしても、ペレット5100自体の伸縮
はほとんど起こり得ない。したがって、ペレット5100間の隙間が広がることで結晶粒
界などの欠陥を形成し、クレバス化することがない。
また、CAAC−OSは、単結晶酸化物半導体が一枚板のようになっているのではなく、
ペレット5100(ナノ結晶)の集合体がレンガまたはブロックが積み重なったような配
列をしている。また、ペレット5100同士の間には結晶粒界を有さない。そのため、成
膜時の加熱、成膜後の加熱または曲げなどで、CAAC−OSに縮みなどの変形が生じた
場合でも、局部応力を緩和する、または歪みを逃がすことが可能である。したがって、可
とう性を有する半導体装置に用いることに適した構造である。なお、nc−OSは、ペレ
ット5100(ナノ結晶)が無秩序に積み重なったような配列となる。
ターゲット5130をイオン5101でスパッタした際に、ペレット5100だけでなく
、酸化亜鉛などが剥離する場合がある。酸化亜鉛はペレット5100よりも軽量であるた
め、先に基板5120の上面に到達する。そして、0.1nm以上10nm以下、0.2
nm以上5nm以下、または0.5nm以上2nm以下の酸化亜鉛層5102を形成する
。図44に断面模式図を示す。
図44(A)に示すように、酸化亜鉛層5102上にはペレット5105aと、ペレット
5105bと、が堆積する。ここで、ペレット5105aとペレット5105bとは、互
いに側面が接するように配置している。また、ペレット5105cは、ペレット5105
b上に堆積した後、ペレット5105b上を滑るように移動する。また、ペレット510
5aの別の側面において、酸化亜鉛とともにターゲットから剥離した複数の粒子5103
が、基板5120からの加熱により結晶化し、領域5105a1を形成する。なお、複数
の粒子5103は、酸素、亜鉛、インジウムおよびガリウムなどを含む可能性がある。
そして、図44(B)に示すように、領域5105a1は、ペレット5105aと一体化
し、ペレット5105a2となる。また、ペレット5105cは、その側面がペレット5
105bの別の側面と接するように配置する。
次に、図44(C)に示すように、さらにペレット5105dがペレット5105a2上
およびペレット5105b上に堆積した後、ペレット5105a2上およびペレット51
05b上を滑るように移動する。また、ペレット5105cの別の側面に向けて、さらに
ペレット5105eが酸化亜鉛層5102上を滑るように移動する。
そして、図44(D)に示すように、ペレット5105dは、その側面がペレット510
5a2の側面と接するように配置する。また、ペレット5105eは、その側面がペレッ
ト5105cの別の側面と接するように配置する。また、ペレット5105dの別の側面
において、酸化亜鉛とともにターゲット5130から剥離した複数の粒子5103が基板
5120からの加熱により結晶化し、領域5105d1を形成する。
以上のように、堆積したペレット同士が接するように配置し、ペレットの側面において成
長が起こることで、基板5120上にCAAC−OSが形成される。したがって、CAA
C−OSは、nc−OSよりも一つ一つのペレットが大きくなる。上述の図41中の(3
)と(2)の大きさの違いが、堆積後の成長分に相当する。
また、ペレット同士の隙間が極めて小さくなることで、一つの大きなペレットが形成され
る場合がある。一つの大きなペレットは、単結晶構造を有する。例えば、ペレットの大き
さが、上面から見て10nm以上200nm以下、15nm以上100nm以下、または
20nm以上50nm以下となる場合がある。このとき、微細なトランジスタに用いる酸
化物半導体において、チャネル形成領域が一つの大きなペレットに収まる場合がある。即
ち、単結晶構造を有する領域をチャネル形成領域として用いることができる。また、ペレ
ットが大きくなることで、単結晶構造を有する領域をトランジスタのチャネル形成領域、
ソース領域およびドレイン領域として用いることができる場合がある。
このように、トランジスタのチャネル形成領域などが、単結晶構造を有する領域に形成さ
れることによって、トランジスタの周波数特性を高くすることができる場合がある。
以上のようなモデルにより、ペレット5100が基板5120上に堆積していくと考えら
れる。被形成面が結晶構造を有さない場合においても、CAAC−OSの成膜が可能であ
ることから、エピタキシャル成長とは異なる成長機構であることがわかる。また、CAA
C−OSは、レーザ結晶化が不要であり、大面積のガラス基板などであっても均一な成膜
が可能である。例えば、基板5120の上面(被形成面)の構造が非晶質構造(例えば非
晶質酸化シリコン)であっても、CAAC−OSを成膜することは可能である。
また、CAAC−OSは、被形成面である基板5120の上面に凹凸がある場合でも、そ
の形状に沿ってペレット5100が配列することがわかる。例えば、基板5120の上面
が原子レベルで平坦な場合、ペレット5100はa−b面と平行な平面である平板面を下
に向けて並置する。ペレット5100の厚さが均一である場合、厚さが均一で平坦、かつ
高い結晶性を有する層が形成される。そして、当該層がn段(nは自然数。)積み重なる
ことで、CAAC−OSを得ることができる。
一方、基板5120の上面が凹凸を有する場合でも、CAAC−OSは、ペレット510
0が凹凸に沿って並置した層がn段(nは自然数。)積み重なった構造となる。基板51
20が凹凸を有するため、CAAC−OSは、ペレット5100間に隙間が生じやすい場
合がある。ただし、この場合でも、ペレット5100間で分子間力が働き、凹凸があって
もペレット間の隙間はなるべく小さくなるように配列する。したがって、凹凸があっても
高い結晶性を有するCAAC−OSとすることができる。
このようなモデルによってCAAC−OSが成膜されるため、スパッタ粒子が厚みのない
ペレット状である方が好ましい。なお、スパッタ粒子が厚みのあるサイコロ状である場合
、基板5120上に向ける面が一定とならず、厚さや結晶の配向を均一にできない場合が
ある。
以上に示した成膜モデルにより、非晶質構造を有する被形成面上であっても、高い結晶性
を有するCAAC−OSを得ることができる。
本実施の形態に示す構成は、他の実施の形態に示す構成と適宜組み合わせて用いることが
できる。
(実施の形態8)
本実施の形態では、本発明の一態様が適用された電子機器について、図24を用いて説明
する。
本発明の一態様の表示装置を適用することで、信頼性の高いフレキシブルな電子機器を作
製することができる。
電子機器としては、例えば、テレビジョン装置、コンピュータ用などのモニタ、デジタル
カメラ、デジタルビデオカメラ、デジタルフォトフレーム、携帯型電話機、携帯型ゲーム
機、携帯型情報端末、音響再生装置、大型ゲーム機などが挙げられる。
また、本発明の一態様の表示装置は可撓性を有するため、家屋やビルの内壁もしくは外壁
、または、自動車の内装もしくは外装の曲面に沿って組み込むことも可能である。
図24(A)は、携帯型電話機の一例を示している。携帯型電話機7100は、筐体71
01に組み込まれた表示部7102の他、操作ボタン7103、外部接続ポート7104
、スピーカ7105、マイク7106、カメラ7107などを備えている。なお、携帯型
電話機7100は、本発明の一態様の発光装置を表示部7102に用いることにより作製
される。本発明の一態様により、湾曲した表示部を備え、且つ信頼性の高い携帯型電話機
を提供できる。
図24(A)に示す携帯型電話機7100は、表示部7102を指などで触れることで、
情報を入力することができる。また、電話を掛ける、或いは文字を入力するなどのあらゆ
る操作は、表示部7102を指などで触れることにより行うことができる。例えば、表示
部7102に表示されたアイコン7108に触れることで、アプリケーションを起動する
ことができる。
また操作ボタン7103の操作により、電源のON、OFFや、表示部7102に表示さ
れる画像の種類を切り替えることができる。例えば、メール作成画面から、メインメニュ
ー画面に切り替えることができる。
図24(B)は、腕時計型の携帯型情報端末の一例を示している。携帯型情報端末720
0は、筐体7201、表示部7202、バンド7203、バックル7204、操作ボタン
7205、入出力端子7206などを備える。
携帯型情報端末7200は、移動電話、電子メール、文章閲覧および作成、音楽再生、イ
ンターネット通信、コンピュータゲームなどの種々のアプリケーションを実行することが
できる。
表示部7202はその表示面が湾曲して設けられ、湾曲した表示面に沿って表示を行うこ
とができる。また、表示部7202はタッチセンサを備え、指やスタイラスなどで画面に
触れることで操作することができる。例えば、表示部7202に表示されたアイコン72
07に触れることで、アプリケーションを起動することができる。
操作ボタン7205は、時刻設定のほか、電源のオン、オフ動作、無線通信のオン、オフ
動作、マナーモードの実行および解除、省電力モードの実行および解除など、様々な機能
を持たせることができる。例えば、携帯型情報端末7200に組み込まれたオペレーショ
ンシステムにより、操作ボタン7205の機能を自由に設定することもできる。
また、携帯型情報端末7200は、通信規格された近距離無線通信を実行することが可能
である。例えば無線通信可能なヘッドセットと相互通信することによって、ハンズフリー
で通話することもできる。
また、携帯型情報端末7200は入出力端子7206を備え、他の情報端末とコネクター
を介して直接データのやりとりを行うことができる。また入出力端子7206を介して充
電を行うこともできる。なお、充電動作は入出力端子7206を介さずに無線給電により
行ってもよい。
携帯型情報端末7200の表示部7202に、本発明の一態様の表示装置を適用すること
ができる。
図24(C)には、携帯型の表示装置の一例を示している。表示装置7300は、筐体7
301、表示部7302、操作ボタン7303、引き出し部材7304、制御部7305
を備える。
表示装置7300は、筒状の筐体7301内にロール状に巻かれたフレキシブルな表示部
7102を備える。
また、表示装置7300は制御部7305によって映像信号を受信可能で、受信した映像
を表示部7302に表示することができる。また、制御部7305にはバッテリーを備え
る。また、制御部7305にコネクターを接続する端子部を備え、映像信号や電力を有線
により外部から直接供給する構成としてもよい。
また、操作ボタン7303によって、電源のON、OFF動作や表示する映像の切り替え
等を行うことができる。
図24(D)には、表示部7302を引き出し部材7304により引き出した状態の表示
装置7300を示す。この状態で表示部7302に映像を表示することができる。また、
筐体7301の表面に配置された操作ボタン7303によって、片手で容易に操作するこ
とができる。また、図24(C)のように操作ボタン7303を筐体7301の中央でな
く片側に寄せて配置することで、片手で容易に操作することができる。
なお、表示部7302を引き出した際に表示部7302の表示面が平面状となるように固
定するため、表示部7302の側部に補強のためのフレームを設けていてもよい。
なお、この構成以外に、筐体にスピーカを設け、映像信号と共に受信した音声信号によっ
て音声を出力する構成としてもよい。
表示部7302には、本発明の一態様の発光装置が組み込まれている。本発明の一態様に
より、軽量で、且つ信頼性の高い発光装置を提供できる。
本実施の形態は、他の実施の形態に記載した構成と適宜組み合わせて実施することが可能
である。
(実施の形態9)
ここでは、先の実施の形態に示すトランジスタの変形例について、図37乃至図39を用
いて説明する。図37に示すトランジスタは、基板821上の絶縁膜824上に形成され
た酸化物半導体層828と、酸化物半導体層828に接する絶縁膜837と、絶縁膜83
7と接し且つ酸化物半導体層828と重畳する導電膜840と、を有する。なお、絶縁膜
837は、ゲート絶縁膜としての機能を有する。また、導電膜840は、ゲート電極層と
しての機能を有する。
また、酸化物半導体層828に接する絶縁膜846、および絶縁膜846に接する絶縁膜
847が、トランジスタに設けられている。また、絶縁膜846および絶縁膜847の開
口部において、酸化物半導体層828と接する導電膜856、857が、トランジスタに
設けられている。なお、導電膜856、857は、ソース電極層およびドレイン電極層と
しての機能を有する。また、絶縁膜847および導電膜856、857と接する絶縁膜8
62が設けられている。
なお、本実施の形態に示すトランジスタの構成、並び該構成に接する導電膜および絶縁膜
は、先の実施の形態に示すトランジスタの構成、並びに該構成に接する導電膜および絶縁
膜を適宜用いることができる。
図37(A)に示すトランジスタにおいて、酸化物半導体層828は、導電膜840と重
なる領域に形成される領域828aと、領域828aを挟み、且つ不純物元素を含む領域
828b、828cとを有する。また、導電膜856、857は、領域828b、828
cと接する。領域828aはチャネル領域として機能する。領域828b、828cは、
領域828aと比較して、抵抗率が低く、低抵抗領域ということができる。また、領域8
28b、828cは、ソース領域およびドレイン領域として機能する。
または、図37(B)に示すトランジスタのように、酸化物半導体層828において、導
電膜856、857と接する領域828d、828eに、不純物元素が添加されていなく
ともよい。この場合、導電膜856、857と接する領域828d、828eと領域82
8aとの間に、不純物元素を有する領域828b、828cを有する。なお、領域828
d、828eは、導電膜856、857に電圧が印加されると導電性を有するため、ソー
ス領域およびドレイン領域としての機能を有する。
なお、図37(B)に示すトランジスタは、導電膜856、857を形成した後、導電膜
840および導電膜856、857をマスクとして、不純物元素を酸化物半導体層に添加
することで、形成できる。
導電膜840において、導電膜840の端部がテーパ形状であってもよい。即ち、絶縁膜
837および導電膜840が接する面と、導電膜840の側面となす角度θ1が、90°
未満、または10°以上85°以下、または15°以上85°以下、または30°以上8
5°以下、または45°以上85°以下、または60°以上85°以下であってもよい。
角度θ1を、90°未満、または10°以上85°以下、または15°以上85°以下、
または30°以上85°以下、または45°以上85°以下、または60°以上85°以
下とすることで、絶縁膜837および導電膜840の側面における絶縁膜846の被覆性
を高めることが可能である。
次に、領域828b、828cの変形例について説明する。なお、図37(C)乃至図3
7(F)は、図37(A)に示す酸化物半導体層828の近傍の拡大図である。ここでは
、チャネル長Lは、一対の不純物元素を含む領域の間隔である。
図37(C)に示すように、チャネル長方向の断面形状において、領域828aおよび領
域828b、828cの境界が、絶縁膜837を介して、導電膜840の端部と、一致ま
たは略一致している。即ち、上面形状において、領域828aおよび領域828b、82
8cの境界が、導電膜840の端部と、一致または概略一致している。
または、図37(D)に示すように、チャネル長方向の断面形状において、領域828a
が、導電膜840の端部と重ならない領域を有する。該領域はオフセット領域としての機
能を有する。チャネル長方向におけるオフセット領域の長さをLoffと示す。なお、オ
フセット領域が複数ある場合は、一つのオフセット領域の長さをLoffという。Lof
は、チャネル長Lに含まれる。また、Loffは、チャネル長Lの20%未満、または
10%未満、または5%未満、または2%未満である。
または、図37(E)に示すように、チャネル長方向の断面形状において、領域828b
、828cが、絶縁膜837を介して、導電膜840と重なる領域を有する。該領域はオ
ーバーラップ領域としての機能を有する。チャネル長方向におけるオーバーラップ領域の
長さをLovと示す。Lovは、チャネル長Lの20%未満、または10%未満、または
5%未満、または2%未満である。
または、図37(F)に示すように、チャネル長方向の断面形状において、領域828a
と領域828bの間に領域828fを有し、領域828aと領域828cの間に領域82
8gを有する。領域828f、828gは、領域828b、828cより不純物元素の濃
度が低く、抵抗率が高い。ここでは、領域828f、828gは、絶縁膜837と重なる
が、絶縁膜837および導電膜840と重なってもよい。
なお、図37(C)乃至図37(F)においては、図37(A)に示すトランジスタの説
明をしたが、図37(B)に示すトランジスタにおいても、図37(C)乃至図37(F
)の構造を適宜適用することができる。
図38(A)に示すトランジスタは、絶縁膜837の端部が、導電膜840の端部より外
側に位置する。即ち、絶縁膜837が、導電膜840から迫り出した形状を有する。領域
828aから絶縁膜846を遠ざけることが可能であるため、絶縁膜846に含まれる窒
素、水素等が、チャネル領域として機能する領域828aに入り込むのを抑制することが
できる。
図38(B)に示すトランジスタは、絶縁膜837および導電膜840がテーパ形状であ
り、且つそれぞれのテーパ部の角度が異なる。即ち、絶縁膜837および導電膜840が
接する面と、導電膜840の側面のなす角度θ1と、酸化物半導体層828および絶縁膜
837が接する面と、絶縁膜837の側面のなす角度θ2との角度が異なる。角度θ2は
、90°未満、または30°以上85°以下、または45°以上70°以下であってもよ
い。例えば、角度θ2が角度θ1より小さいと、絶縁膜846の被覆性が高まる。また、
角度θ2が角度θ1より大きいと、領域828aから絶縁膜846を遠ざけることが可能
であるため、絶縁膜846に含まれる窒素、水素等が、チャネル領域として機能する領域
828aに入り込むのを抑制することができる。
次に、領域828b、828cの変形例について、図38(C)乃至図38(F)を用い
て説明する。なお、図38(C)乃至図38(F)は、図38(A)に示す酸化物半導体
層828の近傍の拡大図である。
図38(C)に示すように、チャネル長方向の断面形状において、領域828aおよび領
域828b、828cの境界が、導電膜840の端部と、絶縁膜837を介して、一致ま
たは該略一致している。即ち、上面形状において、領域828aおよび領域828b、8
28cの境界が、導電膜840の端部と、一致若しくは略一致している。
または、図38(D)に示すように、チャネル長方向の断面形状において、領域828a
が、導電膜840と重ならない領域を有する。該領域はオフセット領域としての機能を有
する。即ち、上面形状において、領域828b、828cの端部が、絶縁膜837の端部
と、一致または略一致しており、導電膜840の端部と重ならない。
または、図38(E)に示すように、チャネル長方向の断面形状において、領域828b
、828cが、絶縁膜837を介して、導電膜840と重なる領域を有する。該領域をオ
ーバーラップ領域という。即ち、上面形状において、領域828b、828cの端部が、
導電膜840と重なる。
または、図38(F)に示すように、チャネル長方向の断面形状において、領域828a
と領域828bの間に領域828fを有し、領域828aと領域828cの間に領域82
8gを有する。領域828f、828gは、領域828b、828cより不純物元素の濃
度が低く、抵抗率が高い。ここでは、領域828f、828gは、絶縁膜837と重なる
が、絶縁膜837および導電膜840と重なってもよい。
なお、図38(C)乃至図38(F)においては、図38(A)に示すトランジスタの説
明をしたが、図38(B)に示すトランジスタにおいても、図38(C)乃至図38(F
)の構造を適宜適用することが可能である。
図39(A)に示すトランジスタは、導電膜840が積層構造であり、絶縁膜837と接
する導電膜840a、および導電膜840aに接する導電膜840bを有する。また、導
電膜840aの端部は、導電膜840bの端部より外側に位置する。即ち、導電膜840
aが、導電膜840bから迫り出した形状を有する。
次に、領域828b、828cの変形例について説明する。なお、図39(B)乃至図3
9(E)は、図39(A)に示す酸化物半導体層828の近傍の拡大図である。
図39(B)に示すように、チャネル長方向の断面形状において、領域828aおよび領
域828b、828cの境界が、導電膜840に含まれる導電膜840aの端部と、絶縁
膜837を介して、一致または略一致している。即ち、上面形状において、領域828a
および領域828b、828cの境界が、導電膜840の端部と、一致または略一致して
いる。
または、図39(C)に示すように、チャネル長方向の断面形状において、領域828a
が、導電膜840と重ならない領域を有する。該領域はオフセット領域としての機能を有
する。また、上面形状において、領域828b、828cの端部が、絶縁膜837の端部
と、一致または略一致しており、導電膜840の端部と重ならない構成としてもよい。
または、図39(D)に示すように、チャネル長方向の断面形状において、領域828b
、828cが、導電膜840、ここでは導電膜840aと重なる領域を有する。該領域を
オーバーラップ領域という。即ち、上面形状において、領域828b、828cの端部が
、導電膜840aと重なる。
または、図39(E)に示すように、チャネル長方向の断面形状において、領域828a
と領域828bの間に領域828fを有し、領域828aと領域828cの間に領域82
8gを有する。不純物元素は、導電膜840aを通過して領域828f、828gに添加
されるため、領域828f、828gは、領域828b、828cより不純物元素の濃度
が低く、抵抗率が高い。なお、ここでは、領域828f、828gは、導電膜840aと
重なるが、導電膜840aおよび導電膜840bと重なってもよい。
なお、絶縁膜837の端部が、導電膜840aの端部より外側に位置してもよい。
または、絶縁膜837の側面は湾曲してしてもよい。
または、絶縁膜837がテーパ形状であってもよい。即ち、酸化物半導体層828および
絶縁膜837が接する面と、絶縁膜837の側面のなす角度が90°未満、好ましくは3
0°以上90°未満であってもよい。
図39に示すように、酸化物半導体層828が、領域828b、828cより、不純物元
素の濃度が低く、抵抗率が高い領域828f、828gを有することで、ドレイン領域の
電界緩和が可能である。そのため、ドレイン領域の電界に起因したトランジスタのしきい
値電圧の変動などの劣化を低減することが可能である。
本実施の形態は、他の実施の形態に記載した構成と適宜組み合わせて実施することが可能
である。
101 構造体
101a 回転体
101b 部材
102 起点
103 加工部材
103a 部材
103b 部材
104 部位
105 ステージ
107 ガイド
108 矢印
109 回転軸
111 部材
151 構造体
152 構造体
153 加工部材
153a 部材
153b 部材
155 ステージ
156 ステージ
157 支持体
158 搬送ローラ
159 回転軸
161 部材
162 起点
190 トランジスタ
194 トランジスタ
300 表示装置
300a 表示装置
300b 表示装置
301 可撓性基板
302 画素部
304 回路部
305 回路部
307 可撓性基板
308 FPC端子部
310 信号線
311 配線部
312 シール材
316 FPC
318a 接着層
318b 接着層
320a 有機樹脂層
320b 有機樹脂層
321a 絶縁膜
321b 絶縁膜
334 絶縁膜
336 着色層
338 遮光層
350 トランジスタ
352 トランジスタ
360 接続電極
364 絶縁膜
366 絶縁膜
368 絶縁膜
370 平坦化絶縁膜
372 導電膜
374 導電膜
375 液晶素子
376 液晶層
378 スペーサ
380 異方性導電膜
410 素子層
411 素子層
430 絶縁膜
432 封止層
434 絶縁膜
444 導電膜
446 EL層
448 導電膜
462 基板
463 基板
468 紫外光
480 発光素子
501 画素回路
502 画素部
504 駆動回路部
504a ゲートドライバ
504b ソースドライバ
506 保護回路
507 端子部
550 トランジスタ
552 トランジスタ
554 トランジスタ
560 容量素子
562 容量素子
570 液晶素子
572 発光素子
600 エキシマレーザ装置
610a レーザ光
610b レーザ光
610c レーザ光
610d 線状ビーム
630 光学系
650 ミラー
670 レンズ
700 加工物
710 加工領域
720 基板
801 レジストマスク
802 レジストマスク
803 レジストマスク
810 不純物
821 基板
824 絶縁膜
828 酸化物半導体層
828a 領域
828b 領域
828c 領域
828d 領域
828e 領域
828f 領域
828g 領域
837 絶縁膜
840 導電膜
840a 導電膜
840b 導電膜
846 絶縁膜
847 絶縁膜
856 導電膜
857 導電膜
862 絶縁膜
900 基板
910 有機樹脂層
915 絶縁膜
920 ゲート電極層
921 導電膜
930 ゲート絶縁膜
931 絶縁膜
932 絶縁膜
933 絶縁膜
935 絶縁層
940 酸化物半導体層
940a 酸化物半導体膜
940b 酸化物半導体膜
940c 酸化物半導体膜
941a 酸化物半導体層
941b 酸化物半導体層
942a 酸化物半導体層
942b 酸化物半導体層
942c 酸化物半導体層
943a 酸化物半導体層
950 ソース電極層
951 ソース領域
960 ドレイン電極層
961 ドレイン領域
970 絶縁膜
975 絶縁膜
980 絶縁膜
990 絶縁膜
7100 携帯型電話機
7101 筐体
7102 表示部
7103 操作ボタン
7104 外部接続ポート
7105 スピーカ
7106 マイク
7107 カメラ
7108 アイコン
7200 携帯型情報端末
7201 筐体
7202 表示部
7203 バンド
7204 バックル
7205 操作ボタン
7206 入出力端子
7207 アイコン
7300 表示装置
7301 筐体
7302 表示部
7303 操作ボタン
7304 部材
7305 制御部
5100 ペレット
5100a ペレット
5100b ペレット
5101 イオン
5102 酸化亜鉛層
5103 粒子
5105a ペレット
5105a1 領域
5105a2 ペレット
5105b ペレット
5105c ペレット
5105d ペレット
5105d1 領域
5105e ペレット
5120 基板
5130 ターゲット
5161 領域
8000 表示モジュール
8001 上部カバー
8002 下部カバー
8003 FPC
8004 タッチパネル
8005 FPC
8006 表示パネル
8007 バックライト
8008 光源
8009 フレーム
8010 プリント基板
8011 バッテリー

Claims (15)

  1. 基板に積層物を設ける工程と、
    前記基板を介して前記積層物にビームを照射する工程と、
    前記積層物と前記基板とを分離する工程と、
    前記分離する工程の後に、前記積層物の前記基板が分離された面に第1の可撓性基板を接着する工程と、を有し、
    前記積層物を設ける工程において、前記積層物は、前記基板側から順に、有機樹脂層と、トランジスタ及び発光素子を有する素子層と、第2の可撓性基板と、を有し、
    前記積層物を設ける工程において、前記有機樹脂層は前記基板と接し、
    前記照射する工程において、前記有機樹脂層が脆弱化または前記有機樹脂層と前記基板との密着力が低下するように、前記ビームを照射して前記積層物を加工し、
    前記接着する工程において、前記第1の可撓性基板は、接着層を用いて前記有機樹脂層に接着される、ことを特徴とする表示装置の作製方法。
  2. 基板に積層物を設ける工程と、
    前記基板を介して前記積層物にビームを照射する工程と、
    前記積層物と前記基板とを分離する工程と、
    前記分離する工程の後に、前記積層物の前記基板が分離された面に第1の可撓性基板を接着する工程と、を有し、
    前記積層物を設ける工程において、前記積層物は、前記基板側から順に、有機樹脂層と、トランジスタ及び発光素子を有する素子層と、第2の可撓性基板と、を有し、
    前記積層物を設ける工程において、前記有機樹脂層は前記基板と接し、
    前記照射する工程において、前記有機樹脂層が脆弱化または前記有機樹脂層と前記基板との密着力が低下するように、前記ビームを前記積層物の加工領域に照射して前記積層物を加工し、
    前記接着する工程において、前記第1の可撓性基板は、接着層を用いて前記有機樹脂層に接着される、ことを特徴とする表示装置の作製方法。
  3. 基板に積層物を設ける工程と、
    前記基板を介して前記積層物にビームを照射する工程と、
    前記積層物と前記基板とを分離する工程と、
    前記分離する工程の後に、前記積層物の前記基板が分離された面に第1の可撓性基板を接着する工程と、を有し、
    前記積層物を設ける工程において、前記積層物は、前記基板側から順に、有機樹脂層と、トランジスタ及び発光素子を有する素子層と、第2の可撓性基板と、を有し、
    前記積層物を設ける工程において、前記有機樹脂層は前記基板と接し、
    前記照射する工程において、前記有機樹脂層が脆弱化または前記有機樹脂層と前記基板との密着力が低下するように、前記ビームを前記有機樹脂層に照射して前記積層物を加工し、
    前記接着する工程において、前記第1の可撓性基板は、接着層を用いて前記有機樹脂層に接着される、ことを特徴とする表示装置の作製方法。
  4. 基板に積層物を設ける工程と、
    前記基板を介して前記積層物にビームを照射する工程と、
    前記積層物と前記基板とを分離する工程と、
    前記分離する工程の後に、前記積層物の前記基板が分離された面に第1の可撓性基板を接着する工程と、を有し、
    前記積層物を設ける工程において、前記積層物は、前記基板側から順に、有機樹脂層と、トランジスタ及び発光素子を有する素子層と、前記素子層を覆う封止層と、第2の可撓性基板と、を有し、
    前記積層物を設ける工程において、前記有機樹脂層は前記基板と接し、
    前記照射する工程において、前記有機樹脂層が脆弱化または前記有機樹脂層と前記基板との密着力が低下するように、前記ビームを照射して前記積層物を加工し、
    前記接着する工程において、前記第1の可撓性基板は、接着層を用いて前記有機樹脂層に接着される、ことを特徴とする表示装置の作製方法。
  5. 基板に積層物を設ける工程と、
    前記基板を介して前記積層物にビームを照射する工程と、
    前記積層物と前記基板とを分離する工程と、
    前記分離する工程の後に、前記積層物の前記基板が分離された面に第1の可撓性基板を接着する工程と、を有し、
    前記積層物を設ける工程において、前記積層物は、前記基板側から順に、有機樹脂層と、トランジスタ及び発光素子を有する素子層と、前記素子層を覆う封止層と、第2の可撓性基板と、を有し、
    前記積層物を設ける工程において、前記有機樹脂層は前記基板と接し、
    前記照射する工程において、前記有機樹脂層が脆弱化または前記有機樹脂層と前記基板との密着力が低下するように、前記ビームを前記積層物の加工領域に照射して前記積層物を加工し、
    前記接着する工程において、前記第1の可撓性基板は、接着層を用いて前記有機樹脂層に接着される、ことを特徴とする表示装置の作製方法。
  6. 基板に積層物を設ける工程と、
    前記基板を介して前記積層物にビームを照射する工程と、
    前記積層物と前記基板とを分離する工程と、
    前記分離する工程の後に、前記積層物の前記基板が分離された面に第1の可撓性基板を接着する工程と、を有し、
    前記積層物を設ける工程において、前記積層物は、前記基板側から順に、有機樹脂層と、トランジスタ及び発光素子を有する素子層と、前記素子層を覆う封止層と、第2の可撓性基板と、を有し、
    前記積層物を設ける工程において、前記有機樹脂層は前記基板と接し、
    前記照射する工程において、前記有機樹脂層が脆弱化または前記有機樹脂層と前記基板との密着力が低下するように、前記ビームを前記有機樹脂層に照射して前記積層物を加工し、
    前記接着する工程において、前記第1の可撓性基板は、接着層を用いて前記有機樹脂層に接着される、ことを特徴とする表示装置の作製方法。
  7. 前記照射する工程において、前記ビームの波長は、308nm以上であることを特徴とする請求項1乃至請求項6いずれか一の表示装置の作製方法。
  8. 前記照射する工程において、前記ビームは、紫外光であることを特徴とする請求項1乃至請求項7いずれか一の表示装置の作製方法。
  9. 前記照射する工程において、前記ビームは、パルスレーザであることを特徴とする請求項1乃至請求項8いずれか一の表示装置の作製方法。
  10. 前記照射する工程において、前記ビームは、線状ビームであることを特徴とする請求項1乃至請求項9いずれか一の表示装置の作製方法。
  11. 前記照射する工程において、前記基板及び前記積層物を移動させながら前記照射を行うことを特徴とする請求項1乃至請求項10いずれか一の表示装置の作製方法。
  12. 前記積層物を設ける工程において、前記有機樹脂層は、エポキシ樹脂、アクリル樹脂、ポリイミド樹脂、ポリアミド樹脂、またはポリアミドイミド樹脂を有することを特徴とする請求項1乃至請求項11いずれか一の表示装置の作製方法。
  13. 前記積層物を設ける工程において、前記有機樹脂層はポリイミド樹脂を有し、前記有機樹脂層の膜厚は3nm以上20μm以下であることを特徴とする請求項1乃至請求項11いずれか一の表示装置の作製方法。
  14. 前記積層物を設ける工程において、前記基板は、ガラス基板であることを特徴とする請求項1乃至請求項13いずれか一の表示装置の作製方法。
  15. 前記積層物を設ける工程において、前記トランジスタは、多結晶シリコンを半導体膜として有することを特徴とする請求項1乃至請求項14いずれか一の表示装置の作製方法。
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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2010153813A (ja) * 2008-11-18 2010-07-08 Semiconductor Energy Lab Co Ltd 発光装置及びその作製方法、並びに、携帯電話機
CN103337222B (zh) * 2013-07-01 2015-07-08 京东方科技集团股份有限公司 柔性显示装置
US9269914B2 (en) * 2013-08-01 2016-02-23 Semiconductor Energy Laboratory Co., Ltd. Light-emitting device, electronic device, and lighting device
US9882014B2 (en) 2013-11-29 2018-01-30 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and method for manufacturing the same
KR20180021926A (ko) * 2013-12-02 2018-03-05 가부시키가이샤 한도오따이 에네루기 켄큐쇼 표시 장치 및 그 제조방법
DE112014005486B4 (de) * 2013-12-02 2024-08-22 Semiconductor Energy Laboratory Co., Ltd. Anzeigevorrichtung
JP2016027597A (ja) * 2013-12-06 2016-02-18 株式会社半導体エネルギー研究所 半導体装置
TWI666770B (zh) 2013-12-19 2019-07-21 日商半導體能源研究所股份有限公司 半導體裝置
JP6488124B2 (ja) 2013-12-27 2019-03-20 株式会社半導体エネルギー研究所 半導体装置
US9397149B2 (en) * 2013-12-27 2016-07-19 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device
JP6294670B2 (ja) * 2014-01-07 2018-03-14 株式会社ジャパンディスプレイ 表示装置及び表示装置の製造方法
US9676175B2 (en) 2014-06-20 2017-06-13 Semiconductor Energy Laboratory Co., Ltd. Peeling apparatus
CN111477657B (zh) 2014-10-28 2024-03-05 株式会社半导体能源研究所 功能面板、功能面板的制造方法、模块、数据处理装置
CN105988609B (zh) 2015-01-28 2019-06-04 中强光电股份有限公司 触控式投影幕及其制造方法
TWI553536B (zh) * 2015-03-13 2016-10-11 中強光電股份有限公司 觸控式投影幕及觸控式投影系統
WO2017006821A1 (ja) * 2015-07-03 2017-01-12 大日本印刷株式会社 蒸着マスクの製造方法、蒸着マスク準備体、有機半導体素子の製造方法、有機elディスプレイの製造方法、及び蒸着マスク
US10608203B2 (en) * 2015-07-23 2020-03-31 Sharp Kabushiki Kaisha Silicon oxide sealing layer for electroluminescent device
CN108738377B (zh) * 2015-07-30 2020-11-10 株式会社半导体能源研究所 发光装置的制造方法、发光装置、模块及电子设备
KR102639302B1 (ko) * 2015-10-15 2024-02-21 삼성디스플레이 주식회사 표시 패널 및 표시 패널의 제조 방법
KR102391478B1 (ko) * 2015-11-17 2022-04-28 삼성디스플레이 주식회사 화소, 화소를 포함하는 디스플레이 패널 및 디스플레이 패널의 제작 방법
KR102402837B1 (ko) * 2015-12-07 2022-05-27 엘지전자 주식회사 디스플레이 장치
KR102419688B1 (ko) * 2015-12-11 2022-07-13 삼성디스플레이 주식회사 표시 장치 및 그의 제조 방법
KR102474203B1 (ko) * 2015-12-22 2022-12-06 삼성디스플레이 주식회사 디스플레이 장치 제조방법 및 이에 따라 제조된 디스플레이 장치
WO2017115225A2 (en) 2015-12-28 2017-07-06 Semiconductor Energy Laboratory Co., Ltd. Flexible device, display device, and manufacturing methods thereof
CN105633281B (zh) * 2016-01-06 2018-07-17 京东方科技集团股份有限公司 一种柔性显示面板及其封装方法、显示装置
CN105655389B (zh) * 2016-01-15 2018-05-11 京东方科技集团股份有限公司 有源层、薄膜晶体管、阵列基板、显示装置及制备方法
US10263114B2 (en) * 2016-03-04 2019-04-16 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device, method for manufacturing the same, or display device including the same
US10586817B2 (en) 2016-03-24 2020-03-10 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device, manufacturing method thereof, and separation apparatus
JP6863803B2 (ja) 2016-04-07 2021-04-21 株式会社半導体エネルギー研究所 表示装置
KR102340066B1 (ko) * 2016-04-07 2021-12-15 가부시키가이샤 한도오따이 에네루기 켄큐쇼 박리 방법 및 플렉시블 디바이스의 제작 방법
WO2017178919A1 (ja) 2016-04-12 2017-10-19 株式会社半導体エネルギー研究所 剥離方法及びフレキシブルデバイスの作製方法
US10003023B2 (en) * 2016-04-15 2018-06-19 Semiconductor Energy Laboratory Co., Ltd. Display device and electronic device
JP2017207744A (ja) 2016-05-11 2017-11-24 株式会社半導体エネルギー研究所 表示装置、モジュール、及び電子機器
US10804407B2 (en) 2016-05-12 2020-10-13 Semiconductor Energy Laboratory Co., Ltd. Laser processing apparatus and stack processing apparatus
US10522574B2 (en) 2016-05-16 2019-12-31 Semiconductor Energy Laboratory Co., Ltd. Manufacturing method of display device and manufacturing method of electronic device
CN109156065B (zh) * 2016-05-18 2020-12-11 株式会社日本有机雷特显示器 有机el显示面板及其制造方法
KR102378976B1 (ko) 2016-05-18 2022-03-24 가부시키가이샤 한도오따이 에네루기 켄큐쇼 박리 방법, 표시 장치, 모듈, 및 전자 기기
TWI727041B (zh) * 2016-05-20 2021-05-11 日商半導體能源研究所股份有限公司 顯示裝置
JP6670683B2 (ja) * 2016-06-07 2020-03-25 株式会社Screenラミナテック キャリア基板と樹脂層からなるワークの分離方法および分離装置
KR102570314B1 (ko) * 2016-06-08 2023-08-24 삼성디스플레이 주식회사 표시 장치 및 이의 제조 방법
KR102527763B1 (ko) * 2016-07-06 2023-05-02 삼성디스플레이 주식회사 롤러블 디스플레이 장치 및 롤러블 장치
KR102554183B1 (ko) 2016-07-29 2023-07-10 가부시키가이샤 한도오따이 에네루기 켄큐쇼 박리 방법, 표시 장치, 표시 모듈, 및 전자 기기
TWI753868B (zh) 2016-08-05 2022-02-01 日商半導體能源研究所股份有限公司 剝離方法、顯示裝置、顯示模組及電子裝置
TW201808628A (zh) 2016-08-09 2018-03-16 Semiconductor Energy Lab 半導體裝置的製造方法
TWI730017B (zh) 2016-08-09 2021-06-11 日商半導體能源研究所股份有限公司 顯示裝置的製造方法、顯示裝置、顯示模組及電子裝置
US10923350B2 (en) 2016-08-31 2021-02-16 Semiconductor Energy Laboratory Co., Ltd. Manufacturing method of semiconductor device
WO2018042284A1 (en) 2016-08-31 2018-03-08 Semiconductor Energy Laboratory Co., Ltd. Method for manufacturing semiconductor device
JP6900160B2 (ja) * 2016-08-31 2021-07-07 エルジー ディスプレイ カンパニー リミテッド フレキシブル表示装置
KR102207053B1 (ko) * 2016-09-16 2021-01-25 도판 인사츠 가부시키가이샤 표시 장치 및 표시 장치 기판
CN109416598B (zh) * 2016-09-16 2021-10-01 凸版印刷株式会社 显示装置及显示装置基板
WO2018051212A1 (en) * 2016-09-16 2018-03-22 Semiconductor Energy Laboratory Co., Ltd. Display panel, display device, input/output device, data processing device, and method for manufacturing the display panel
TWI715631B (zh) * 2016-09-20 2021-01-11 日商凸版印刷股份有限公司 顯示裝置及顯示裝置基板
US10369664B2 (en) 2016-09-23 2019-08-06 Semiconductor Energy Laboratory Co., Ltd. Manufacturing method of semiconductor device
US20180090720A1 (en) * 2016-09-27 2018-03-29 Universal Display Corporation Flexible OLED Display Module
KR20230107411A (ko) * 2016-10-07 2023-07-14 가부시키가이샤 한도오따이 에네루기 켄큐쇼 유리 기판의 세정 방법, 반도체 장치의 제작 방법,및 유리 기판
TWI744383B (zh) * 2016-10-19 2021-11-01 日商索尼股份有限公司 液晶顯示裝置及投射型顯示裝置
CN109922919A (zh) * 2016-11-03 2019-06-21 株式会社半导体能源研究所 激光加工装置、叠层体加工装置及激光加工方法
WO2018083568A1 (en) * 2016-11-03 2018-05-11 Semiconductor Energy Laboratory Co., Ltd. Method for manufacturing semiconductor device
KR102601500B1 (ko) * 2016-11-11 2023-11-15 삼성디스플레이 주식회사 표시장치 및 이를 포함하는 전자장치
WO2018096425A1 (ja) 2016-11-23 2018-05-31 株式会社半導体エネルギー研究所 表示装置、表示モジュール、及び電子機器
WO2018122665A1 (en) * 2016-12-27 2018-07-05 Semiconductor Energy Laboratory Co., Ltd. Display panel, display device, input/output device, and data processing device
KR20180083253A (ko) 2017-01-12 2018-07-20 가부시키가이샤 한도오따이 에네루기 켄큐쇼 반도체 장치의 제작 방법
DE102017000703A1 (de) 2017-01-26 2018-07-26 Bally Wulff Games & Entertainment Gmbh Rotierende symboltragende Anzeigemittel für Spielautomaten und Verfahren zur Steuerung der Anzeige
JP6995333B2 (ja) * 2017-02-04 2022-01-14 パイクリスタル株式会社 アクティブマトリクス基板およびアクティブマトリクス基板の製造方法
US10374160B2 (en) * 2017-02-24 2019-08-06 Sharp Kabushiki Kaisha Production method for OLED panel, and production apparatus for OLED panel
KR20180100013A (ko) 2017-02-28 2018-09-06 삼성디스플레이 주식회사 표시 장치 및 표시 장치의 제조 방법
TWI778959B (zh) 2017-03-03 2022-10-01 日商半導體能源硏究所股份有限公司 半導體裝置及半導體裝置的製造方法
JP2018180254A (ja) * 2017-04-12 2018-11-15 株式会社ジャパンディスプレイ 表示装置
JP6904769B2 (ja) * 2017-04-20 2021-07-21 株式会社半導体エネルギー研究所 表示装置
KR102480458B1 (ko) 2017-06-05 2022-12-22 삼성디스플레이 주식회사 표시 장치
CN107403732B (zh) * 2017-06-21 2019-10-25 武汉华星光电半导体显示技术有限公司 改善氧化物半导体薄膜晶体管阈值电压的方法
CN107170374A (zh) * 2017-06-29 2017-09-15 武汉天马微电子有限公司 柔性显示面板及柔性显示装置
CN111108541B (zh) * 2017-09-27 2021-10-15 夏普株式会社 可弯曲性显示装置以及可弯曲性显示装置的制造方法
WO2019064532A1 (ja) * 2017-09-29 2019-04-04 シャープ株式会社 表示素子の製造方法
GB201717566D0 (en) * 2017-10-25 2017-12-06 Bodle Tech Ltd Display apparatus
US10581027B2 (en) 2017-10-26 2020-03-03 Sakai Display Products Corporation Method and apparatus for producing flexible OLED device
TWI662347B (zh) * 2017-12-14 2019-06-11 友達光電股份有限公司 畫素結構
CN107831612B (zh) * 2017-12-15 2020-01-07 京东方科技集团股份有限公司 显示面板、显示装置以及显示方法
KR20200101964A (ko) 2018-01-05 2020-08-28 가부시키가이샤 한도오따이 에네루기 켄큐쇼 반도체 장치 및 반도체 장치의 제작 방법
JP7170671B2 (ja) * 2018-01-24 2022-11-14 株式会社半導体エネルギー研究所 半導体装置
US11183674B2 (en) * 2018-02-27 2021-11-23 Sakai Display Products Corporation Method for manufacturing flexible OLED device and support substrate
WO2019166906A1 (ja) 2018-02-28 2019-09-06 株式会社半導体エネルギー研究所 半導体装置、および半導体装置の作製方法
CN115616803A (zh) * 2018-03-14 2023-01-17 群创光电股份有限公司 电子装置
US10991919B2 (en) 2018-05-09 2021-04-27 Sakai Display Products Corporation Method and apparatus for manufacturing flexible light emitting device
CN112042273A (zh) * 2018-05-09 2020-12-04 堺显示器制品株式会社 柔性发光器件的制造方法以及制造装置
CN112042271A (zh) * 2018-05-09 2020-12-04 堺显示器制品株式会社 柔性发光器件的制造方法以及制造装置
CN108511635B (zh) * 2018-06-07 2020-03-06 京东方科技集团股份有限公司 一种柔性显示基板的制备方法
US10971527B2 (en) * 2018-09-11 2021-04-06 Sharp Kabushiki Kaisha Thin-film transistor substrate including data line with lower layer data line and upper layer data line, and liquid crystal display device and organic electroluminescent display device including same
KR102573780B1 (ko) * 2018-09-28 2023-08-31 엘지디스플레이 주식회사 표시 장치
JP7132076B2 (ja) * 2018-10-11 2022-09-06 株式会社半導体エネルギー研究所 Ct装置
KR102178626B1 (ko) * 2018-10-30 2020-11-16 에이피시스템 주식회사 적층구조물 박리 방법, 유기발광소자 수리 방법 및 적층구조물 박리장치
TWI722331B (zh) * 2018-11-12 2021-03-21 友達光電股份有限公司 半導體疊層結構及其製造方法
JP2020087961A (ja) * 2018-11-15 2020-06-04 株式会社アルバック 積層構造体及び積層構造体の製造方法
KR102680693B1 (ko) * 2018-12-18 2024-07-01 엘지디스플레이 주식회사 디스플레이 장치
KR102708746B1 (ko) 2018-12-19 2024-09-20 엘지디스플레이 주식회사 박막 트랜지스터 및 이를 포함하는 표시장치
JP2020150027A (ja) * 2019-03-11 2020-09-17 キオクシア株式会社 基板の分離方法、半導体記憶装置の製造方法、および基板分離装置
WO2020189873A1 (ko) * 2019-03-18 2020-09-24 주식회사 모두테크 반도체 패키지 제조공정을 위한 접착 테이프 및 그 제조방법
CN110065267B (zh) 2019-04-26 2021-03-26 京东方科技集团股份有限公司 可形变材料、形变结构、Micro-LED显示装置、应变传感器
CN110098329B (zh) * 2019-05-06 2021-01-29 上海交通大学 有机薄膜晶体管及其制备方法
JP7553179B2 (ja) 2019-06-24 2024-09-18 日本製鉄株式会社 塊鉱石の前処理方法及び高炉の操業方法
WO2021006185A1 (ja) * 2019-07-05 2021-01-14 昭和電工マテリアルズ株式会社 電子部品用キャリアフィルム及びキャリアフィルムの製造方法
KR102166162B1 (ko) * 2019-08-21 2020-10-15 씨제이첨단소재 주식회사 방열성능과 절연기능을 가진 층을 포함하는 무선 전력 전송장치
EP3785897B1 (en) 2019-08-29 2021-12-29 SHPP Global Technologies B.V. Transparent, flexible, impact resistant, multilayer film comprising polycarbonate copolymers
CN112447924B (zh) * 2019-08-30 2024-03-08 上海和辉光电股份有限公司 显示面板、制备方法及包括其的显示装置
CN114555595B (zh) 2019-08-30 2023-12-26 Tsd生命科学有限公司 咪唑并吡啶衍生物及将其作为有效成分的药学组合物
JP7096805B2 (ja) * 2019-11-12 2022-07-06 キヤノン株式会社 印刷装置とその制御方法、及びプログラム
JP7398934B2 (ja) 2019-11-22 2023-12-15 エルジー・ケム・リミテッド 表示装置用支持基板、有機el表示装置、および有機el表示装置の製造方法
TWI715447B (zh) * 2020-02-21 2021-01-01 友達光電股份有限公司 背板的製造方法
KR20210129788A (ko) * 2020-04-20 2021-10-29 삼성디스플레이 주식회사 표시 장치 및 이의 제조 방법
CN111687591B (zh) * 2020-05-20 2021-12-31 西安理工大学 一种具有减摩和提高油膜承载力的表面织构及其制作方法
CN111768700B (zh) 2020-06-22 2021-10-08 武汉华星光电半导体显示技术有限公司 显示面板及显示装置
TWI757904B (zh) * 2020-10-06 2022-03-11 友達光電股份有限公司 電子裝置
CN112198693B (zh) * 2020-10-23 2021-07-23 Tcl华星光电技术有限公司 显示面板和母板
CN115206994A (zh) 2021-04-09 2022-10-18 株式会社日本显示器 显示装置
CN113770512B (zh) * 2021-08-02 2022-05-17 北京工业大学 一种柔性氮化镓光电探测器激光快速制备方法
CN115881788A (zh) * 2021-09-26 2023-03-31 群创光电股份有限公司 电子装置及其制造方法
TWI846215B (zh) * 2022-12-16 2024-06-21 財團法人工業技術研究院 顯示面板

Family Cites Families (302)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS60198861A (ja) 1984-03-23 1985-10-08 Fujitsu Ltd 薄膜トランジスタ
JPH0244256B2 (ja) 1987-01-28 1990-10-03 Kagaku Gijutsucho Mukizaishitsu Kenkyushocho Ingazn2o5deshimesarerurotsuhoshokeinosojokozoojusurukagobutsuoyobisonoseizoho
JPH0244258B2 (ja) 1987-02-24 1990-10-03 Kagaku Gijutsucho Mukizaishitsu Kenkyushocho Ingazn3o6deshimesarerurotsuhoshokeinosojokozoojusurukagobutsuoyobisonoseizoho
JPH0244260B2 (ja) 1987-02-24 1990-10-03 Kagaku Gijutsucho Mukizaishitsu Kenkyushocho Ingazn5o8deshimesarerurotsuhoshokeinosojokozoojusurukagobutsuoyobisonoseizoho
JPS63210023A (ja) 1987-02-24 1988-08-31 Natl Inst For Res In Inorg Mater InGaZn↓4O↓7で示される六方晶系の層状構造を有する化合物およびその製造法
JPH0244262B2 (ja) 1987-02-27 1990-10-03 Kagaku Gijutsucho Mukizaishitsu Kenkyushocho Ingazn6o9deshimesarerurotsuhoshokeinosojokozoojusurukagobutsuoyobisonoseizoho
JPH0244263B2 (ja) 1987-04-22 1990-10-03 Kagaku Gijutsucho Mukizaishitsu Kenkyushocho Ingazn7o10deshimesarerurotsuhoshokeinosojokozoojusurukagobutsuoyobisonoseizoho
JPH05251705A (ja) 1992-03-04 1993-09-28 Fuji Xerox Co Ltd 薄膜トランジスタ
US5577360A (en) 1993-01-15 1996-11-26 Gibbs; Alden T. Slate mounting system
JPH07202427A (ja) 1993-12-29 1995-08-04 Nec Corp 有機樹脂多層配線層の製造方法
CA2138218C (en) 1993-12-16 2000-10-10 Shinji Tanaka Process for delaminating organic resin from board and process for manufacturing organic resin multi-layer wiring board
JP3479375B2 (ja) 1995-03-27 2003-12-15 科学技術振興事業団 亜酸化銅等の金属酸化物半導体による薄膜トランジスタとpn接合を形成した金属酸化物半導体装置およびそれらの製造方法
WO1997006554A2 (en) 1995-08-03 1997-02-20 Philips Electronics N.V. Semiconductor device provided with transparent switching element
TW439003B (en) 1995-11-17 2001-06-07 Semiconductor Energy Lab Display device
TW309633B (ja) 1995-12-14 1997-07-01 Handotai Energy Kenkyusho Kk
JP3625598B2 (ja) 1995-12-30 2005-03-02 三星電子株式会社 液晶表示装置の製造方法
JPH09273615A (ja) 1996-04-01 1997-10-21 Naotake Mori 差動型摩擦駆動源装置
EP0818882A3 (en) 1996-07-10 1999-12-15 Matsushita Electric Industrial Co., Ltd. Energy trapping piezoelectric device and producing method thereof
JP4619462B2 (ja) * 1996-08-27 2011-01-26 セイコーエプソン株式会社 薄膜素子の転写方法
TW360901B (en) 1996-08-27 1999-06-11 Seiko Epson Corp Method of peeling thin-film device, method of transferring thin-film device, thin-film device thereby, thin-film IC circuit device, and liquid crystal display device
JP4619461B2 (ja) * 1996-08-27 2011-01-26 セイコーエプソン株式会社 薄膜デバイスの転写方法、及びデバイスの製造方法
JP3809681B2 (ja) * 1996-08-27 2006-08-16 セイコーエプソン株式会社 剥離方法
CN100521160C (zh) 1996-08-27 2009-07-29 精工爱普生株式会社 转移方法和有源矩阵基板的制造方法
DE69737086T2 (de) 1996-08-27 2007-05-16 Seiko Epson Corp. Trennverfahren, verfahren zur übertragung eines dünnfilmbauelements, und unter verwendung des übertragungsverfahrens hergestelltes flüssigkristall-anzeigebauelement
JP3809710B2 (ja) 1997-07-03 2006-08-16 セイコーエプソン株式会社 薄膜素子の転写方法
JP3809712B2 (ja) 1996-08-27 2006-08-16 セイコーエプソン株式会社 薄膜デバイスの転写方法
USRE38466E1 (en) 1996-11-12 2004-03-16 Seiko Epson Corporation Manufacturing method of active matrix substrate, active matrix substrate and liquid crystal display device
US6127199A (en) 1996-11-12 2000-10-03 Seiko Epson Corporation Manufacturing method of active matrix substrate, active matrix substrate and liquid crystal display device
JPH1126733A (ja) 1997-07-03 1999-01-29 Seiko Epson Corp 薄膜デバイスの転写方法、薄膜デバイス、薄膜集積回路装置,アクティブマトリクス基板、液晶表示装置および電子機器
JPH11243209A (ja) * 1998-02-25 1999-09-07 Seiko Epson Corp 薄膜デバイスの転写方法、薄膜デバイス、薄膜集積回路装置、アクティブマトリクス基板、液晶表示装置および電子機器
JPH11329231A (ja) 1998-05-08 1999-11-30 Sony Corp フィルム貼付装置
JP4170454B2 (ja) 1998-07-24 2008-10-22 Hoya株式会社 透明導電性酸化物薄膜を有する物品及びその製造方法
EP0984492A3 (en) * 1998-08-31 2000-05-17 Sel Semiconductor Energy Laboratory Co., Ltd. Semiconductor device comprising organic resin and process for producing semiconductor device
JP2000150861A (ja) 1998-11-16 2000-05-30 Tdk Corp 酸化物薄膜
JP3276930B2 (ja) 1998-11-17 2002-04-22 科学技術振興事業団 トランジスタ及び半導体装置
JP2000196243A (ja) 1998-12-28 2000-07-14 Fujitsu Ltd フレキシブル多層回路基板の製造方法
TW460731B (en) 1999-09-03 2001-10-21 Ind Tech Res Inst Electrode structure and production method of wide viewing angle LCD
TW468283B (en) 1999-10-12 2001-12-11 Semiconductor Energy Lab EL display device and a method of manufacturing the same
TW494447B (en) 2000-02-01 2002-07-11 Semiconductor Energy Lab Semiconductor device and manufacturing method thereof
JP2001351932A (ja) 2000-06-06 2001-12-21 Nec Corp レーザ加工用樹脂構造およびその加工方法
JP4869471B2 (ja) 2000-07-17 2012-02-08 株式会社半導体エネルギー研究所 半導体装置の作製方法
JP2002041220A (ja) * 2000-07-31 2002-02-08 Seiko Instruments Inc 情報処理装置
JP4583568B2 (ja) * 2000-09-19 2010-11-17 株式会社半導体エネルギー研究所 発光装置の作製方法
US6956324B2 (en) 2000-08-04 2005-10-18 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and manufacturing method therefor
US6825820B2 (en) 2000-08-10 2004-11-30 Semiconductor Energy Laboratory Co., Ltd. Display device and electronic device
JP4089858B2 (ja) 2000-09-01 2008-05-28 国立大学法人東北大学 半導体デバイス
KR20020038482A (ko) 2000-11-15 2002-05-23 모리시타 요이찌 박막 트랜지스터 어레이, 그 제조방법 및 그것을 이용한표시패널
US6955956B2 (en) 2000-12-26 2005-10-18 Semiconductor Energy Laboratory Co., Ltd. Method of manufacturing a semiconductor device
JP4837170B2 (ja) 2001-01-12 2011-12-14 株式会社Ihi レーザアニール方法及び装置
JP2002217391A (ja) * 2001-01-23 2002-08-02 Seiko Epson Corp 積層体の製造方法及び半導体装置
JP3997731B2 (ja) 2001-03-19 2007-10-24 富士ゼロックス株式会社 基材上に結晶性半導体薄膜を形成する方法
JP2002289859A (ja) 2001-03-23 2002-10-04 Minolta Co Ltd 薄膜トランジスタ
US6855584B2 (en) 2001-03-29 2005-02-15 Semiconductor Energy Laboratory Co., Ltd. Method of manufacturing a semiconductor device
JP4230160B2 (ja) * 2001-03-29 2009-02-25 株式会社半導体エネルギー研究所 半導体装置の作製方法
JP4408011B2 (ja) * 2001-06-15 2010-02-03 株式会社半導体エネルギー研究所 レーザ照射装置およびレーザ照射方法、並びに半導体装置の作製方法
TW558861B (en) 2001-06-15 2003-10-21 Semiconductor Energy Lab Laser irradiation stage, laser irradiation optical system, laser irradiation apparatus, laser irradiation method, and method of manufacturing semiconductor device
US7211828B2 (en) 2001-06-20 2007-05-01 Semiconductor Energy Laboratory Co., Ltd. Light emitting device and electronic apparatus
JP2003086356A (ja) * 2001-09-06 2003-03-20 Semiconductor Energy Lab Co Ltd 発光装置及び電子機器
TW548860B (en) 2001-06-20 2003-08-21 Semiconductor Energy Lab Light emitting device and method of manufacturing the same
CN100539046C (zh) * 2001-07-16 2009-09-09 株式会社半导体能源研究所 半导体器件及剥离方法以及半导体器件的制造方法
TW564471B (en) 2001-07-16 2003-12-01 Semiconductor Energy Lab Semiconductor device and peeling off method and method of manufacturing semiconductor device
JP4027740B2 (ja) 2001-07-16 2007-12-26 株式会社半導体エネルギー研究所 半導体装置の作製方法
KR100975802B1 (ko) * 2001-07-16 2010-08-16 가부시키가이샤 한도오따이 에네루기 켄큐쇼 발광 장치 및 발광 장치를 형성하는 방법
JP2003109773A (ja) 2001-07-27 2003-04-11 Semiconductor Energy Lab Co Ltd 発光装置、半導体装置およびそれらの作製方法
JP5078205B2 (ja) 2001-08-10 2012-11-21 株式会社半導体エネルギー研究所 レーザ照射装置
TW554398B (en) 2001-08-10 2003-09-21 Semiconductor Energy Lab Method of peeling off and method of manufacturing semiconductor device
TW558743B (en) 2001-08-22 2003-10-21 Semiconductor Energy Lab Peeling method and method of manufacturing semiconductor device
JP4090716B2 (ja) 2001-09-10 2008-05-28 雅司 川崎 薄膜トランジスタおよびマトリクス表示装置
JP3925839B2 (ja) 2001-09-10 2007-06-06 シャープ株式会社 半導体記憶装置およびその試験方法
JP5127103B2 (ja) 2001-09-10 2013-01-23 株式会社半導体エネルギー研究所 発光装置及び電子機器
JP4397571B2 (ja) 2001-09-25 2010-01-13 株式会社半導体エネルギー研究所 レーザ照射方法およびレーザ照射装置、並びに半導体装置の作製方法
US6800008B2 (en) 2001-10-09 2004-10-05 Matsushita Electric Industrial Co., Ltd. Method and apparatus for removing film and method for manufacturing display panel
JP4145114B2 (ja) 2001-10-09 2008-09-03 松下電器産業株式会社 フィルム剥離方法、フィルム剥離装置および表示装置パネルの製造方法
JP2003128490A (ja) 2001-10-23 2003-05-08 Sony Corp 薄膜剥離装置
JP4164562B2 (ja) 2002-09-11 2008-10-15 独立行政法人科学技術振興機構 ホモロガス薄膜を活性層として用いる透明薄膜電界効果型トランジスタ
US7061014B2 (en) 2001-11-05 2006-06-13 Japan Science And Technology Agency Natural-superlattice homologous single crystal thin film, method for preparation thereof, and device using said single crystal thin film
TWI264121B (en) 2001-11-30 2006-10-11 Semiconductor Energy Lab A display device, a method of manufacturing a semiconductor device, and a method of manufacturing a display device
JP2003168820A (ja) 2001-12-03 2003-06-13 Sony Corp 剥離方法、レーザー光の照射方法及びこれらを用いた素子の製造方法
US7050835B2 (en) 2001-12-12 2006-05-23 Universal Display Corporation Intelligent multi-media display communication system
CN1639991B (zh) 2001-12-12 2010-06-09 通用显示有限公司 智能多媒体显示通信系统
JP4083486B2 (ja) 2002-02-21 2008-04-30 独立行政法人科学技術振興機構 LnCuO(S,Se,Te)単結晶薄膜の製造方法
CN1445821A (zh) 2002-03-15 2003-10-01 三洋电机株式会社 ZnO膜和ZnO半导体层的形成方法、半导体元件及其制造方法
DE10212639A1 (de) 2002-03-21 2003-10-16 Siemens Ag Vorrichtung und Verfahren zur Laserstrukturierung von Funktionspolymeren und Verwendungen
JP2003280548A (ja) * 2002-03-25 2003-10-02 Toshiba Corp フレキシブル表示パネル
JP3933591B2 (ja) 2002-03-26 2007-06-20 淳二 城戸 有機エレクトロルミネッセント素子
JP4411575B2 (ja) 2002-04-25 2010-02-10 セイコーエプソン株式会社 電子装置の製造装置
US7339187B2 (en) 2002-05-21 2008-03-04 State Of Oregon Acting By And Through The Oregon State Board Of Higher Education On Behalf Of Oregon State University Transistor structures
JP2004022625A (ja) 2002-06-13 2004-01-22 Murata Mfg Co Ltd 半導体デバイス及び該半導体デバイスの製造方法
US7105868B2 (en) 2002-06-24 2006-09-12 Cermet, Inc. High-electron mobility transistor with zinc oxide
JP3918708B2 (ja) 2002-10-08 2007-05-23 セイコーエプソン株式会社 回路基板及びその製造方法、転写チップ、転写元基板、電気光学装置、電子機器
US7067843B2 (en) 2002-10-11 2006-06-27 E. I. Du Pont De Nemours And Company Transparent oxide semiconductor thin film transistors
US7436050B2 (en) * 2003-01-22 2008-10-14 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device having a flexible printed circuit
JP4151421B2 (ja) 2003-01-23 2008-09-17 セイコーエプソン株式会社 デバイスの製造方法
JP4166105B2 (ja) 2003-03-06 2008-10-15 シャープ株式会社 半導体装置およびその製造方法
JP2004273732A (ja) 2003-03-07 2004-09-30 Sharp Corp アクティブマトリクス基板およびその製造方法
JP2004317908A (ja) * 2003-04-18 2004-11-11 Sony Corp 携帯式情報表示装置
JP2004349541A (ja) 2003-05-23 2004-12-09 Seiko Epson Corp 剥離方法、薄膜装置の製造方法、電気光学装置、電子機器
JP4108633B2 (ja) 2003-06-20 2008-06-25 シャープ株式会社 薄膜トランジスタおよびその製造方法ならびに電子デバイス
JP4934942B2 (ja) 2003-07-23 2012-05-23 ソニー株式会社 剥離方法
US7262463B2 (en) 2003-07-25 2007-08-28 Hewlett-Packard Development Company, L.P. Transistor including a deposited channel region having a doped portion
JP2005183615A (ja) * 2003-12-18 2005-07-07 Ricoh Co Ltd 薄膜デバイス装置の製造方法及び薄膜デバイス装置
EP1547719A3 (en) 2003-12-26 2009-01-28 Semiconductor Energy Laboratory Co., Ltd. Laser irradiation apparatus, laser irradiation method, and method for manufacturing crystalline semiconductor film
JP2005210103A (ja) 2003-12-26 2005-08-04 Semiconductor Energy Lab Co Ltd レーザ照射装置、レーザ照射方法及び結晶質半導体膜の作製方法
JP4620046B2 (ja) 2004-03-12 2011-01-26 独立行政法人科学技術振興機構 薄膜トランジスタ及びその製造方法
US7297977B2 (en) 2004-03-12 2007-11-20 Hewlett-Packard Development Company, L.P. Semiconductor device
US7145174B2 (en) 2004-03-12 2006-12-05 Hewlett-Packard Development Company, Lp. Semiconductor device
US7282782B2 (en) 2004-03-12 2007-10-16 Hewlett-Packard Development Company, L.P. Combined binary oxide semiconductor device
JP2005276996A (ja) * 2004-03-24 2005-10-06 Hitachi Ltd 平面表示装置の製造方法
US7202141B2 (en) 2004-03-29 2007-04-10 J.P. Sercel Associates, Inc. Method of separating layers of material
JP2005294493A (ja) * 2004-03-31 2005-10-20 Toshiba Corp レーザプロセスおよびレーザアニール装置
JP2005309179A (ja) 2004-04-23 2005-11-04 Seiko Epson Corp 電気光学装置、電気光学装置の製造方法および電子機器
US7547866B2 (en) 2004-04-28 2009-06-16 Semiconductor Energy Laboratory Co., Ltd. Laser irradiation method and method for manufacturing semiconductor device including an autofocusing mechanism using the same
WO2005116775A1 (ja) 2004-05-31 2005-12-08 Fuji Photo Film Co., Ltd. パターン形成方法及びカラーフィルタの製造方法、並びにカラーフィルタ及び液晶表示装置
CN101789378B (zh) 2004-06-02 2012-07-04 株式会社半导体能源研究所 用于制造半导体器件的方法
US7211825B2 (en) 2004-06-14 2007-05-01 Yi-Chi Shih Indium oxide-based thin film transistors and circuits
US7744770B2 (en) 2004-06-23 2010-06-29 Sony Corporation Device transfer method
US7591863B2 (en) 2004-07-16 2009-09-22 Semiconductor Energy Laboratory Co., Ltd. Laminating system, IC sheet, roll of IC sheet, and method for manufacturing IC chip
WO2006011665A1 (en) 2004-07-30 2006-02-02 Semiconductor Energy Laboratory Co., Ltd. Laminating system, ic sheet, scroll of ic sheet, and method for manufacturing ic chip
JP2006100760A (ja) 2004-09-02 2006-04-13 Casio Comput Co Ltd 薄膜トランジスタおよびその製造方法
US7285501B2 (en) 2004-09-17 2007-10-23 Hewlett-Packard Development Company, L.P. Method of forming a solution processed device
CN100565794C (zh) 2004-09-24 2009-12-02 株式会社半导体能源研究所 半导体器件及其制造方法
JP5116232B2 (ja) 2004-10-29 2013-01-09 株式会社半導体エネルギー研究所 レーザ照射装置およびレーザ照射方法
US20070063226A1 (en) 2004-10-29 2007-03-22 Semiconductor Energy Laboratory Co., Ltd. Laser irradiation apparatus and laser irradiation method
US7298084B2 (en) 2004-11-02 2007-11-20 3M Innovative Properties Company Methods and displays utilizing integrated zinc oxide row and column drivers in conjunction with organic light emitting diodes
US7863611B2 (en) 2004-11-10 2011-01-04 Canon Kabushiki Kaisha Integrated circuits utilizing amorphous oxides
WO2006051995A1 (en) 2004-11-10 2006-05-18 Canon Kabushiki Kaisha Field effect transistor employing an amorphous oxide
AU2005302963B2 (en) 2004-11-10 2009-07-02 Cannon Kabushiki Kaisha Light-emitting device
CA2708335A1 (en) 2004-11-10 2006-05-18 Canon Kabushiki Kaisha Amorphous oxide and field effect transistor
US7829444B2 (en) 2004-11-10 2010-11-09 Canon Kabushiki Kaisha Field effect transistor manufacturing method
JP5126729B2 (ja) 2004-11-10 2013-01-23 キヤノン株式会社 画像表示装置
US7791072B2 (en) 2004-11-10 2010-09-07 Canon Kabushiki Kaisha Display
US7453065B2 (en) 2004-11-10 2008-11-18 Canon Kabushiki Kaisha Sensor and image pickup device
US7579224B2 (en) 2005-01-21 2009-08-25 Semiconductor Energy Laboratory Co., Ltd. Method for manufacturing a thin film semiconductor device
US7608531B2 (en) 2005-01-28 2009-10-27 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device, electronic device, and method of manufacturing semiconductor device
TWI562380B (en) 2005-01-28 2016-12-11 Semiconductor Energy Lab Co Ltd Semiconductor device, electronic device, and method of manufacturing semiconductor device
US7858451B2 (en) 2005-02-03 2010-12-28 Semiconductor Energy Laboratory Co., Ltd. Electronic device, semiconductor device and manufacturing method thereof
US7948171B2 (en) 2005-02-18 2011-05-24 Semiconductor Energy Laboratory Co., Ltd. Light emitting device
US20060197092A1 (en) 2005-03-03 2006-09-07 Randy Hoffman System and method for forming conductive material on a substrate
US8681077B2 (en) 2005-03-18 2014-03-25 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device, and display device, driving method and electronic apparatus thereof
WO2006105077A2 (en) 2005-03-28 2006-10-05 Massachusetts Institute Of Technology Low voltage thin film transistor with high-k dielectric material
US7645478B2 (en) 2005-03-31 2010-01-12 3M Innovative Properties Company Methods of making displays
JP4650066B2 (ja) 2005-04-01 2011-03-16 セイコーエプソン株式会社 転写用基板、可撓性配線基板の製造方法および電子機器の製造方法
US8300031B2 (en) 2005-04-20 2012-10-30 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device comprising transistor having gate and drain connected through a current-voltage conversion element
JP2006344849A (ja) 2005-06-10 2006-12-21 Casio Comput Co Ltd 薄膜トランジスタ
US7402506B2 (en) 2005-06-16 2008-07-22 Eastman Kodak Company Methods of making thin film transistors comprising zinc-oxide-based semiconductor materials and transistors made thereby
US7691666B2 (en) 2005-06-16 2010-04-06 Eastman Kodak Company Methods of making thin film transistors comprising zinc-oxide-based semiconductor materials and transistors made thereby
US7507618B2 (en) 2005-06-27 2009-03-24 3M Innovative Properties Company Method for making electronic devices using metal oxide nanoparticles
KR100711890B1 (ko) 2005-07-28 2007-04-25 삼성에스디아이 주식회사 유기 발광표시장치 및 그의 제조방법
JP2007030435A (ja) * 2005-07-29 2007-02-08 Optrex Corp フィルムの貼付方法およびその装置
JP2007059128A (ja) 2005-08-23 2007-03-08 Canon Inc 有機el表示装置およびその製造方法
EP1760776B1 (en) 2005-08-31 2019-12-25 Semiconductor Energy Laboratory Co., Ltd. Manufacturing method for semiconductor device with flexible substrate
JP5116225B2 (ja) 2005-09-06 2013-01-09 キヤノン株式会社 酸化物半導体デバイスの製造方法
JP4850457B2 (ja) 2005-09-06 2012-01-11 キヤノン株式会社 薄膜トランジスタ及び薄膜ダイオード
JP2007073705A (ja) 2005-09-06 2007-03-22 Canon Inc 酸化物半導体チャネル薄膜トランジスタおよびその製造方法
JP4280736B2 (ja) 2005-09-06 2009-06-17 キヤノン株式会社 半導体素子
JP2007110064A (ja) 2005-09-14 2007-04-26 Ishikawajima Harima Heavy Ind Co Ltd レーザアニール方法及び装置
EP3614442A3 (en) 2005-09-29 2020-03-25 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device having oxide semiconductor layer and manufactoring method thereof
KR101299604B1 (ko) 2005-10-18 2013-08-26 가부시키가이샤 한도오따이 에네루기 켄큐쇼 반도체 장치 및 그 제조 방법
JP5037808B2 (ja) 2005-10-20 2012-10-03 キヤノン株式会社 アモルファス酸化物を用いた電界効果型トランジスタ、及び該トランジスタを用いた表示装置
KR101117948B1 (ko) 2005-11-15 2012-02-15 가부시키가이샤 한도오따이 에네루기 켄큐쇼 액정 디스플레이 장치 제조 방법
KR101319468B1 (ko) 2005-12-02 2013-10-30 가부시키가이샤 한도오따이 에네루기 켄큐쇼 반도체장치의 제조방법
JP4877916B2 (ja) 2005-12-28 2012-02-15 共同印刷株式会社 表示装置用素子基板とその製造方法及び液晶表示装置
TWI292281B (en) 2005-12-29 2008-01-01 Ind Tech Res Inst Pixel structure of active organic light emitting diode and method of fabricating the same
US7867636B2 (en) 2006-01-11 2011-01-11 Murata Manufacturing Co., Ltd. Transparent conductive film and method for manufacturing the same
JP4977478B2 (ja) 2006-01-21 2012-07-18 三星電子株式会社 ZnOフィルム及びこれを用いたTFTの製造方法
US7576394B2 (en) 2006-02-02 2009-08-18 Kochi Industrial Promotion Center Thin film transistor including low resistance conductive thin films and manufacturing method thereof
US7977169B2 (en) 2006-02-15 2011-07-12 Kochi Industrial Promotion Center Semiconductor device including active layer made of zinc oxide with controlled orientations and manufacturing method thereof
US8222116B2 (en) 2006-03-03 2012-07-17 Semiconductor Energy Laboratory Co., Ltd. Method for manufacturing semiconductor device
JP5222479B2 (ja) 2006-03-03 2013-06-26 株式会社半導体エネルギー研究所 半導体装置の作製方法
JP5288581B2 (ja) * 2006-03-03 2013-09-11 株式会社半導体エネルギー研究所 半導体装置の作製方法
JP5276792B2 (ja) * 2006-03-03 2013-08-28 株式会社半導体エネルギー研究所 半導体装置の作製方法
US8173519B2 (en) 2006-03-03 2012-05-08 Semiconductor Energy Laboratory Co., Ltd. Method for manufacturing semiconductor device
JP4698460B2 (ja) 2006-03-27 2011-06-08 オムロンレーザーフロント株式会社 レーザアニーリング装置
KR20070101595A (ko) 2006-04-11 2007-10-17 삼성전자주식회사 ZnO TFT
US20070252928A1 (en) 2006-04-28 2007-11-01 Toppan Printing Co., Ltd. Structure, transmission type liquid crystal display, reflection type display and manufacturing method thereof
US8900970B2 (en) * 2006-04-28 2014-12-02 Semiconductor Energy Laboratory Co., Ltd. Method for manufacturing a semiconductor device using a flexible substrate
JP5028033B2 (ja) 2006-06-13 2012-09-19 キヤノン株式会社 酸化物半導体膜のドライエッチング方法
JP5264016B2 (ja) * 2006-06-30 2013-08-14 株式会社半導体エネルギー研究所 半導体装置の作製方法
TWI424499B (zh) 2006-06-30 2014-01-21 Semiconductor Energy Lab 製造半導體裝置的方法
JP4977411B2 (ja) * 2006-07-06 2012-07-18 株式会社ディスコ レーザー加工装置
EP2052413A2 (en) 2006-08-08 2009-04-29 Koninklijke Philips Electronics N.V. Integrated device
JP4609797B2 (ja) 2006-08-09 2011-01-12 Nec液晶テクノロジー株式会社 薄膜デバイス及びその製造方法
JP4999400B2 (ja) 2006-08-09 2012-08-15 キヤノン株式会社 酸化物半導体膜のドライエッチング方法
JP2008072087A (ja) * 2006-08-16 2008-03-27 Kyoto Univ 半導体装置および半導体装置の製造方法、ならびに表示装置
JP5110830B2 (ja) 2006-08-31 2012-12-26 株式会社半導体エネルギー研究所 半導体装置の作製方法
JP5227552B2 (ja) 2006-08-31 2013-07-03 株式会社半導体エネルギー研究所 薄膜トランジスタ及びその作製方法、並びに半導体装置
TWI479660B (zh) 2006-08-31 2015-04-01 Semiconductor Energy Lab 薄膜電晶體,其製造方法,及半導體裝置
JP4332545B2 (ja) 2006-09-15 2009-09-16 キヤノン株式会社 電界効果型トランジスタ及びその製造方法
WO2008035421A1 (fr) 2006-09-21 2008-03-27 Fujitsu Limited Panneau d'affichage à cristaux liquides et procédé de production de ce panneau
JP5164357B2 (ja) 2006-09-27 2013-03-21 キヤノン株式会社 半導体装置及び半導体装置の製造方法
JP4274219B2 (ja) 2006-09-27 2009-06-03 セイコーエプソン株式会社 電子デバイス、有機エレクトロルミネッセンス装置、有機薄膜半導体装置
JP4402144B2 (ja) * 2006-09-29 2010-01-20 株式会社半導体エネルギー研究所 半導体装置の作製方法
TWI433306B (zh) 2006-09-29 2014-04-01 Semiconductor Energy Lab 半導體裝置的製造方法
US7622371B2 (en) 2006-10-10 2009-11-24 Hewlett-Packard Development Company, L.P. Fused nanocrystal thin film semiconductor and method
US20100196683A1 (en) 2006-10-27 2010-08-05 Konnklijke Philips Electronics N.V. Electronic device having a plastic substrate
CN101548584A (zh) 2006-10-27 2009-09-30 皇家飞利浦电子股份有限公司 用于控制设备操作的方法和电路
US7772021B2 (en) 2006-11-29 2010-08-10 Samsung Electronics Co., Ltd. Flat panel displays comprising a thin-film transistor having a semiconductive oxide in its channel and methods of fabricating the same for use in flat panel displays
JP2008140684A (ja) 2006-12-04 2008-06-19 Toppan Printing Co Ltd カラーelディスプレイおよびその製造方法
JP2008145173A (ja) * 2006-12-07 2008-06-26 Seiko Epson Corp 表示装置
KR101303578B1 (ko) 2007-01-05 2013-09-09 삼성전자주식회사 박막 식각 방법
JP4776556B2 (ja) 2007-01-26 2011-09-21 株式会社アルバック 有機el素子、有機el素子の製造方法
US8207063B2 (en) 2007-01-26 2012-06-26 Eastman Kodak Company Process for atomic layer deposition
EP1970951A3 (en) 2007-03-13 2009-05-06 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and manufacturing method thereof
KR100851215B1 (ko) 2007-03-14 2008-08-07 삼성에스디아이 주식회사 박막 트랜지스터 및 이를 이용한 유기 전계 발광표시장치
US7795613B2 (en) 2007-04-17 2010-09-14 Toppan Printing Co., Ltd. Structure with transistor
KR101325053B1 (ko) 2007-04-18 2013-11-05 삼성디스플레이 주식회사 박막 트랜지스터 기판 및 이의 제조 방법
KR20080094300A (ko) 2007-04-19 2008-10-23 삼성전자주식회사 박막 트랜지스터 및 그 제조 방법과 박막 트랜지스터를포함하는 평판 디스플레이
KR101334181B1 (ko) 2007-04-20 2013-11-28 삼성전자주식회사 선택적으로 결정화된 채널층을 갖는 박막 트랜지스터 및 그제조 방법
WO2008133345A1 (en) 2007-04-25 2008-11-06 Canon Kabushiki Kaisha Oxynitride semiconductor
JP5150138B2 (ja) 2007-05-23 2013-02-20 株式会社ジャパンディスプレイイースト 表示装置の製造方法
JP2008294379A (ja) 2007-05-28 2008-12-04 Sanyo Electric Co Ltd 窒化物系半導体素子の製造方法
KR101345376B1 (ko) 2007-05-29 2013-12-24 삼성전자주식회사 ZnO 계 박막 트랜지스터 및 그 제조방법
KR101563237B1 (ko) 2007-06-01 2015-10-26 가부시키가이샤 한도오따이 에네루기 켄큐쇼 제조장치 및 발광장치 제작방법
JP5408848B2 (ja) * 2007-07-11 2014-02-05 株式会社ジャパンディスプレイ 半導体装置の製造方法
JP2009043962A (ja) 2007-08-09 2009-02-26 Sony Corp 半導体装置の製造方法
US7968388B2 (en) 2007-08-31 2011-06-28 Seiko Epson Corporation Thin-film device, method for manufacturing thin-film device, and display
WO2009031482A1 (en) 2007-09-07 2009-03-12 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and method for manufacturing the same
US7687810B2 (en) * 2007-10-22 2010-03-30 Philips Lumileds Lighting Company, Llc Robust LED structure for substrate lift-off
US8163628B2 (en) 2007-11-01 2012-04-24 Semiconductor Energy Laboratory Co., Ltd. Method for manufacturing semiconductor substrate
JP5215158B2 (ja) * 2007-12-17 2013-06-19 富士フイルム株式会社 無機結晶性配向膜及びその製造方法、半導体デバイス
JP2009186916A (ja) 2008-02-08 2009-08-20 Asahi Glass Co Ltd 表示装置用パネルの製造方法
CN102089858B (zh) * 2008-02-20 2013-03-13 夏普株式会社 柔性半导体基板的制造方法
JP2009231674A (ja) 2008-03-25 2009-10-08 Victor Co Of Japan Ltd 有機薄膜トランジスタ、有機薄膜トランジスタの製造方法、及び有機薄膜トランジスタを備えた表示装置
JP2009252796A (ja) 2008-04-01 2009-10-29 Semiconductor Energy Lab Co Ltd 半導体装置及びその作製方法
KR101458901B1 (ko) * 2008-04-29 2014-11-10 삼성디스플레이 주식회사 가요성 표시 장치의 제조 방법
JP5368013B2 (ja) * 2008-06-24 2013-12-18 共同印刷株式会社 フレキシブル有機elディスプレイの製造方法
JP2010034217A (ja) 2008-07-28 2010-02-12 Hitachi Ltd 有機薄膜トランジスタの製造方法
JP5214360B2 (ja) * 2008-07-29 2013-06-19 シャープ株式会社 色変換方式有機elディスプレイ
JP5216716B2 (ja) 2008-08-20 2013-06-19 株式会社半導体エネルギー研究所 発光装置及びその作製方法
WO2010030013A1 (ja) * 2008-09-12 2010-03-18 旭化成イーマテリアルズ株式会社 樹脂凸版印刷版の製造方法、樹脂凸版印刷版、及び樹脂凸版印刷版の製造装置
JP4623179B2 (ja) 2008-09-18 2011-02-02 ソニー株式会社 薄膜トランジスタおよびその製造方法
JP2010072529A (ja) 2008-09-22 2010-04-02 Hitachi Displays Ltd 液晶表示装置及びその製造方法
JP5451280B2 (ja) 2008-10-09 2014-03-26 キヤノン株式会社 ウルツ鉱型結晶成長用基板およびその製造方法ならびに半導体装置
EP2178133B1 (en) 2008-10-16 2019-09-18 Semiconductor Energy Laboratory Co., Ltd. Flexible Light-Emitting Device, Electronic Device, and Method for Manufacturing Flexible-Light Emitting Device
JP2010105012A (ja) 2008-10-29 2010-05-13 Sharp Corp レーザ加工装置
JP2010129403A (ja) 2008-11-28 2010-06-10 Sony Corp 透明電極基板の製造方法および透明電極基板、並びに光電変換装置の製造方法および光電変換装置
KR101010023B1 (ko) 2008-12-15 2011-01-21 포항공과대학교 산학협력단 레이저 빔을 이용한 플렉서블 소자의 제조 방법
WO2010070759A1 (ja) 2008-12-18 2010-06-24 株式会社島津製作所 光マトリックスデバイスの製造方法
TWI654689B (zh) * 2008-12-26 2019-03-21 日商半導體能源研究所股份有限公司 半導體裝置及其製造方法
JP2010160906A (ja) 2009-01-06 2010-07-22 Seiko Epson Corp 有機エレクトロルミネッセンス装置、有機エレクトロルミネッセンス装置の製造方法、および電子機器
CN102224613A (zh) * 2009-01-07 2011-10-19 夏普株式会社 有机电致发光显示装置及其制造方法
JP5326098B2 (ja) 2009-02-05 2013-10-30 シャープ株式会社 基板表面の封止装置と有機elパネルの製造方法
JP2010202729A (ja) * 2009-03-02 2010-09-16 Hitachi Chemical Dupont Microsystems Ltd フレキシブルデバイス基板用ポリイミド前駆体樹脂組成物及びそれを用いたフレキシブルデバイスの製造方法、フレキシブルデバイス
JP4623685B2 (ja) 2009-03-26 2011-02-02 次世代モバイル用表示材料技術研究組合 表示装置の製造方法
CN104597651B (zh) 2009-05-02 2017-12-05 株式会社半导体能源研究所 显示设备
CN103871330B (zh) 2009-05-02 2017-09-12 株式会社半导体能源研究所 电子书
CN101937157A (zh) * 2009-07-01 2011-01-05 元太科技工业股份有限公司 可挠式显示装置的制造方法
US9136286B2 (en) * 2009-08-07 2015-09-15 Semiconductor Energy Laboratory Co., Ltd. Display panel and electronic book
KR20120068772A (ko) 2009-09-16 2012-06-27 가부시키가이샤 한도오따이 에네루기 켄큐쇼 발광 장치 및 이의 제조 방법
WO2011043194A1 (en) 2009-10-09 2011-04-14 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and method for manufacturing the same
KR101065318B1 (ko) * 2009-12-03 2011-09-16 삼성모바일디스플레이주식회사 플렉서블 디스플레이 장치의 제조 방법
US8986497B2 (en) 2009-12-07 2015-03-24 Ipg Photonics Corporation Laser lift off systems and methods
US9669613B2 (en) 2010-12-07 2017-06-06 Ipg Photonics Corporation Laser lift off systems and methods that overlap irradiation zones to provide multiple pulses of laser irradiation per location at an interface between layers to be separated
KR101108161B1 (ko) 2009-12-24 2012-01-31 삼성모바일디스플레이주식회사 유기 발광 표시 장치 및 그 제조방법
TWI589042B (zh) 2010-01-20 2017-06-21 半導體能源研究所股份有限公司 發光裝置,撓性發光裝置,電子裝置,照明設備,以及發光裝置和撓性發光裝置的製造方法
JP5403754B2 (ja) * 2010-01-21 2014-01-29 スタンレー電気株式会社 半導体発光装置の製造方法
KR101819197B1 (ko) 2010-02-05 2018-02-28 가부시키가이샤 한도오따이 에네루기 켄큐쇼 반도체 장치, 및 반도체 장치의 제조 방법
KR101097344B1 (ko) 2010-03-09 2011-12-23 삼성모바일디스플레이주식회사 플렉서블 디스플레이 장치의 제조 방법
JP5645185B2 (ja) 2010-03-19 2014-12-24 国立大学法人山形大学 多方向駆動装置
US8014427B1 (en) 2010-05-11 2011-09-06 Ultratech, Inc. Line imaging systems and methods for laser annealing
US20120280229A1 (en) 2010-05-14 2012-11-08 Takeshi Suzuki Flexible semiconductor device, method for manufacturing the same and image display device
JP2011248072A (ja) * 2010-05-26 2011-12-08 Hitachi Displays Ltd 画像表示装置の製造方法
JP5742119B2 (ja) 2010-06-15 2015-07-01 株式会社Ihi 磁性半導体用基板、磁性半導体用基板の製造方法及び磁性半導体用基板の製造装置
JP2012015150A (ja) 2010-06-29 2012-01-19 Ushio Inc レーザリフトオフ方法及びレーザリフトオフ装置
JP5689258B2 (ja) 2010-07-22 2015-03-25 共同印刷株式会社 フレキシブルtft基板の製造方法
KR101793047B1 (ko) 2010-08-03 2017-11-03 삼성디스플레이 주식회사 플렉서블 디스플레이 및 이의 제조 방법
US8852048B2 (en) 2010-08-19 2014-10-07 Ben Shelef Planetary harmonic differential transmission
JP5472035B2 (ja) 2010-10-22 2014-04-16 セイコーエプソン株式会社 有機el装置および電子機器
KR20120048240A (ko) 2010-11-05 2012-05-15 삼성모바일디스플레이주식회사 연속측면고상화(Sequential Lateral Solidification:SLS)를 이용한 결정화 장치, 결정화 방법 및 유기 발광 디스플레이 장치의 제조 방법
KR101896638B1 (ko) 2010-11-22 2018-09-07 덴카 주식회사 평판의 첩합 지그 및 평판 적층체의 제조방법
JP2012138547A (ja) * 2010-12-28 2012-07-19 Fujifilm Corp フレキシブル電子デバイスの製造方法および樹脂層付積層基板、ならびにフレキシブル電子デバイス製造部材
JP2012159695A (ja) 2011-02-01 2012-08-23 Technology Research Association For Advanced Display Materials 光学素子及び光学素子の製造方法
WO2012108142A1 (ja) * 2011-02-07 2012-08-16 シャープ株式会社 有機el表示装置及びその製造方法
WO2012115016A1 (en) * 2011-02-25 2012-08-30 Semiconductor Energy Laboratory Co., Ltd. Light-emitting device and electronic device using light-emitting device
TWI432838B (zh) * 2011-02-25 2014-04-01 Innolux Corp 顯示器及其製造方法
JP5355618B2 (ja) 2011-03-10 2013-11-27 三星ディスプレイ株式會社 可撓性表示装置及びこの製造方法
JP5007849B1 (ja) 2011-03-25 2012-08-22 住友電気工業株式会社 レドックスフロー電池、及びその運転方法
TW201242135A (en) * 2011-04-06 2012-10-16 Univ Yuan Ze Flexible substrate of organic electroluminescent display and preparation method of flexible high contrast, true color organic electroluminescent display
WO2012141117A1 (ja) 2011-04-15 2012-10-18 シャープ株式会社 液晶モジュールおよび表示装置
KR102040242B1 (ko) 2011-05-12 2019-11-05 가부시키가이샤 한도오따이 에네루기 켄큐쇼 발광 장치 및 발광 장치를 이용한 전자 기기
JP5148730B2 (ja) 2011-05-18 2013-02-20 昭和オプトロニクス株式会社 ファイバ転送レーザ光学系
KR101852190B1 (ko) * 2011-06-28 2018-04-25 엘지디스플레이 주식회사 플렉서블 표시장치의 제조방법
JP2013013204A (ja) 2011-06-28 2013-01-17 Toshiba Corp 無線電力伝送システム、送電装置及び受電装置
JP2013038229A (ja) 2011-08-08 2013-02-21 Seiko Epson Corp 電気装置の製造方法、半導体基板の製造方法、電気装置用形成基板、及び電子機器
WO2013035298A1 (ja) * 2011-09-08 2013-03-14 シャープ株式会社 表示装置及びその製造方法
JP5887790B2 (ja) * 2011-09-21 2016-03-16 ソニー株式会社 表示装置および電子機器
JP2013077521A (ja) 2011-09-30 2013-04-25 Dainippon Printing Co Ltd 電磁波剥離性フレキシブルデバイス用基板およびそれを用いた電子素子の製造方法
JPWO2013054792A1 (ja) 2011-10-12 2015-03-30 旭硝子株式会社 密着性樹脂層付き電子デバイスの製造方法
JP5907722B2 (ja) 2011-12-23 2016-04-26 株式会社半導体エネルギー研究所 発光装置の作製方法
KR101391774B1 (ko) 2012-03-13 2014-05-07 엘지디스플레이 주식회사 박막 트랜지스터 기판 및 이를 이용한 유기전계발광표시장치의 제조방법
JP2015111603A (ja) * 2012-03-22 2015-06-18 シャープ株式会社 半導体装置の製造方法、半導体装置、及び表示装置
KR101872963B1 (ko) * 2012-04-17 2018-06-29 엘지디스플레이 주식회사 유기발광 디스플레이 장치의 제조방법
KR102079188B1 (ko) 2012-05-09 2020-02-19 가부시키가이샤 한도오따이 에네루기 켄큐쇼 발광 장치 및 전자 기기
JP5594323B2 (ja) 2012-06-14 2014-09-24 日本電気株式会社 アンダーフィル樹脂組成物およびこれを用いた半導体装置
US9871228B2 (en) 2012-11-30 2018-01-16 Lg Display Co., Ltd. Organic light emitting device comprising flexible substrate and method for preparing thereof
WO2014129519A1 (en) 2013-02-20 2014-08-28 Semiconductor Energy Laboratory Co., Ltd. Peeling method, semiconductor device, and peeling apparatus
KR101775198B1 (ko) 2013-04-09 2017-09-06 주식회사 엘지화학 적층체 및 이를 이용하여 제조된 기판을 포함하는 소자
KR102104608B1 (ko) 2013-05-16 2020-04-27 삼성디스플레이 주식회사 유기 발광 표시 장치, 이를 포함하는 전자 기기, 및 유기 발광 표시 장치의 제조 방법
JP5764616B2 (ja) 2013-06-10 2015-08-19 株式会社半導体エネルギー研究所 半導体装置の作製方法
JP5964807B2 (ja) 2013-08-30 2016-08-03 エルジー ディスプレイ カンパニー リミテッド フレキシブル有機電界発光装置及びその製造方法
US20150151514A1 (en) 2013-11-29 2015-06-04 Samsung Electronics Co., Ltd. Laminated Structure, Method of Preparing Same, and Method of Fabricating Electronic Device Using Laminated Structure
KR20180021926A (ko) 2013-12-02 2018-03-05 가부시키가이샤 한도오따이 에네루기 켄큐쇼 표시 장치 및 그 제조방법

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US10355067B2 (en) 2019-07-16
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CN106663391A (zh) 2017-05-10
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KR102516162B1 (ko) 2023-03-29
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JP2016184166A (ja) 2016-10-20
CN110047760A (zh) 2019-07-23
US20200273936A1 (en) 2020-08-27
WO2015083029A1 (en) 2015-06-11
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US20160247868A1 (en) 2016-08-25
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KR102321189B1 (ko) 2021-11-02
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KR102411905B1 (ko) 2022-06-22
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