JPWO2008149484A1 - 不揮発性記憶素子およびその製造方法、並びにその不揮発性記憶素子を用いた不揮発性半導体装置 - Google Patents
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Abstract
Description
この抵抗変化型の不揮発性記憶素子は、基本的には図32に示したように、抵抗変化層504を下部電極503と上部電極505でサンドイッチしたような非常に単純な構造で構成される。そして、この上下の電極間に所定の電気的パルスを与えるだけで、抵抗が高抵抗もしくは低抵抗状態に変化する。そして、これらの異なる抵抗状態と数値を対応させ情報の記録を行うのである。抵抗変化型の不揮発性記憶素子はこのような構造上及び動作上の単純さから、さらなる微細化や低コスト化が可能であると期待されている。さらに、高抵抗と低抵抗の状態変化が100ns以下オーダーで起こる場合もある事から、高速動作という観点からも注目を集めており、種々の提案が成されている。
例えば、特許文献1に開示されているように、上部電極と下部電極に電圧を印加する事で抵抗変化層504内に金属イオンを出し入れして高抵抗と低抵抗状態を作り出し、情報を記録するタイプの抵抗変化型の不揮発性記憶素子がある。また、特許文献2に開示されているような、抵抗変化層の結晶状態を電気パルスで変化させて抵抗状態を変化させるようなタイプの抵抗変化型メモリも知られている(相変化型メモリ)。
さらに、上記に加えて、抵抗変化層504に金属酸化物を使った抵抗変化型の不揮発性記憶素子に関する提案も多くなされている。
このような金属酸化物を使った抵抗変化型の不揮発性記憶素子は、抵抗変化層に用いる材料で大きく2種類に分類される。一つは、特許文献3等に開示されているペロブスカイト材料(Pr(1−x)CaXMnO3(PCMO)、LaSrMnO3(LSMO)、GdBaCoxOy(GBCO)を抵抗変化層として用いた抵抗変化型の不揮発性記憶素子である。
もう一つは、2元系の遷移金属酸化物を用いた抵抗変化型の不揮発性記憶素子である。2元系の遷移金属酸化物は、上述のペロブスカイト材料と比較しても非常に組成及び構造が単純であるため、製造時の組成制御および成膜が比較的容易である。その上、半導体製造プロセスとの整合性も比較的良好であるという利点もあり、最近、特に精力的に研究がなされている。例えば、特許文献4や非特許文献1では、可変抵抗材料としてNiO、V2O5、ZnO、Nb2O5、TiO2、WO3、CoOが開示されている。また、特許文献5では、Ni、Ti、Hf、Nb、Zn、W、Co等のサブオキサイド(化学量論的組成からずれた酸化物)を可変抵抗材料として使った抵抗変化型の不揮発性記憶素子が開示されている。さらに、特許文献6や非特許文献2には、TiNの表面を酸化してナノメートルオーダーのTiO2結晶膜を形成したような構造を抵抗変化層に使う例も開示されている。
なお、本明細書では、定常的な抵抗状態の変化を得る事のできる電気的パルスの大きさ(電圧値)や幅(時間)とは異なる電気的パルスを加えて、製造直後の抵抗変化型の不揮発性記憶素子の状態を変化させる工程の事をフォーミング工程と定義する。例えば、2Vの大きさで100nsの幅を持つ電気的パルスで抵抗状態が変化する潜在的能力を有する不揮発性記憶素子を動作させるために、製造直後にこれとは異なる電気的パルス(例えば3Vで1μsの電気的パルスを10回加える等)を加える必要がある場合、フォーミング工程が必要であると表現する。
一方で、特許文献6や非特許文献2に開示されている、TiNの表面を酸化して微結晶性のTiO2を形成したような構造(TiO2/TiN構造)を有する抵抗変化型メモリでは、フォーミング工程が不要とされている。しかしながら、このメモリでは、TiO2がナノメートルオーダーの微小な結晶(以下、ナノ結晶)の集合体を成しており、この結晶のサイズによって抵抗変化の状態が変化するとされている。一般にナノ結晶のサイズや結晶構造は、製造方法(上記分では酸化によって形成)に非常に敏感で、製造時のばらつきが大きくなる可能性がある。すなわち、ナノ結晶を抵抗変化層に使うと、抵抗変化の状態にばらつきが生じやすく、望ましくない。
上記目的を達成するために、本発明の不揮発性記憶素子は、第1電極と、第2電極と、前記第1電極と前記第2電極との間に介在し、両電極間に与えられる極性の異なる電気的信号に基づいて可逆的に抵抗値が変化する抵抗変化層と、を備え、前記抵抗変化層は、その厚み方向において、TaOx(但し、0<x<2.5)で表される組成を有する第1の酸素不足型のタンタル酸化物を含む第1の領域と、TaOy(但し、x<y<2.5)で表される組成を有する第2の酸素不足型のタンタル酸化物を含む第2の領域と、を有している。
前記抵抗変化層は、前記第1の領域としてのTaOx(但し、0<x<2.5)で表される組成を有する第1の酸素不足型のタンタル酸化物層と、前記第2の領域としてのTaOy(但し、x<y<2.5)で表される組成を有する第2の酸素不足型のタンタル酸化物層との少なくとも2層が積層された積層構造を有していてもよい。
また、本発明の不揮発性半導体装置は、半導体基板と、前記半導体基板の上に互いに平行に形成された複数の第1の電極配線と、前記複数の第1の電極配線の上方に前記半導体基板の主面に平行な面内において互いに平行に且つ前記複数の第1の電極配線に立体交差するように形成された複数の第2の電極配線と、前記複数の第1の電極配線と前記複数の第2の電極配線との立体交差点に対応して設けられた不揮発性記憶素子とを具備するメモリアレイを備え、前記不揮発性記憶素子のそれぞれは、前記第1の電極配線と接続される第1電極と、前記第2の電極配線と接続される第2電極と、前記第1電極と前記第2電極との間に介在し、両電極間の電圧に基づいて可逆的に抵抗値が変化する抵抗変化層とを備え、前記抵抗変化層は、その厚み方向において、TaOx(但し、0<x<2.5)で表される組成を有する第1の酸素不足型のタンタル酸化物を含む第1の領域と、TaOy(但し、x<y<2.5)で表される組成を有する第2の酸素不足型のタンタル酸化物を含む第2の領域と、を有している。
前記不揮発性記憶素子のそれぞれは、前記第1電極と前記第2電極との間に電流抑制素子を具備しており、当該電流抑制素子は、前記抵抗変化層と電気的に接続されていてもよい。
本発明の上記目的、他の目的、特徴、及び利点は、添付図面参照の下、以下の好適な実施態様の詳細な説明から明らかにされる。
101 基板
102 酸化物層
103 第1電極層
104 第1のタンタル酸化物層
105 第2のタンタル酸化物層
106 抵抗変化層
107 第2電極層
108 フォトレジスト
109 素子領域
110 第3のタンタル酸化物層
200 不揮発性半導体装置
201 メモリ本体部
202 メモリアレイ
203 行選択回路/ドライバ
204 列選択回路/ドライバ
205 書き込み回路
206 センスアンプ
207 データ入出力回路
208 アドレス入力回路
209 制御回路
210 不揮発性記憶素子
211 上部配線
212 下部配線
213 上部電極
214 抵抗変化層
215 内部電極
216 電流抑制素子
217 下部電極
218 オーミック抵抗層
219 第2の抵抗変化層
300 不揮発性半導体装置
301 メモリ本体部
302 メモリアレイ
303 行選択回路/ドライバ
304 列選択回路
305 書き込み回路
306 センスアンプ
307 データ入出力回路
308 セルプレート電源
309 アドレス入力回路
310 制御回路
313 不揮発性記憶素子
314 上部電極
315 抵抗変化層
316 下部電極
400 不揮発性半導体装置
401 半導体基板
402 CPU
403 入出力回路
404 論理回路
405 アナログ回路
406 BIST回路
407 SRAM
408 救済アドレス格納レジスタ
409 不揮発性記憶素子
410 書き込み回路
411 読み出し回路
412 ラッチ回路
BL0,BL1,… ビット線
M11,M12,… メモリセル
T11,T12,… トランジスタ
WL0,WL1,… ワード線
500 不揮発性記憶素子
501 基板
502 酸化物層
503 下部電極
504 抵抗変化層
505 上部電極
[不揮発性記憶素子の構成]
図1は、本発明の第1の実施の形態に係る不揮発性記憶素子の一構成例を示した断面図である。
次に、図2(a)〜図2(c)を参照しながら、本実施の形態の不揮発性記憶素子100の製造方法について説明する。
まず、実施例1乃至3の抵抗変化層106の初期抵抗を測定し、その結果について検討する。ここでは、各実施例における第1電極層103と第2電極層107との間に、閾値電圧(例えば、1V程度)よりも低い50mVの微弱な電圧を印加し、流れる電流を測定して各実施例の抵抗変化層106の初期の抵抗値を求めた。その結果を表1に示す。
実施例1乃至3の具体的な動作を説明する前に、本実施の形態で作製した抵抗変化型の不揮発性記憶素子の動作例、すなわち情報の書き込み/読み出しをする場合の動作例を、図面を参照して説明する。
次に、本実施の形態において実際に作製した実施例1乃至3に対して電気的パルスを印加して、抵抗変化を起こさせたときの特性について説明する。
しかしながら、実施例1の抵抗変化特性を示す図5(a)を見ると、−2.0V及び3.0Vの2種類の電気的パルスを加えても、抵抗変化が起こっていない事が分かる。実施例1は、酸素プラズマ暴露時間が0分、すなわち、第1のタンタル酸化物層104を堆積直後に第2電極層107を堆積して作製しており、第2のタンタル酸化物層105が存在しないか、したとしても非常に薄い状態であると考えられる。これらの結果から、フォーミング工程なしに、抵抗変化を生じさせるには、第2のタンタル酸化物層105の存在が必要であると考えられる。
[抵抗変化層の解析]
本実施の形態における抵抗変化層106の構造を解析するため、単結晶シリコン基板上に厚さ200nmの酸化物層が形成された基板上に、実施例1乃至3と全く同じ条件で、タンタル酸化物を堆積して、酸素プラズマの照射処理まで行ったサンプルをそれぞれ用意した。これらのサンプルを、それぞれA,B、Cと表記する。それぞれのサンプルの酸素プラズマ暴露時間と、後述の分析結果をまとめた結果を表2に示す。なお、サンプルA乃至Cの上には、第2電極層107に相当するPtは堆積されていないため、抵抗変化層が露出された状態となっている。
また、表2からは、酸素プラズマ暴露時間が0分のサンプルAでも、約1nm程度の第2のタンタル酸化物層が形成されている事が分かる。タンタル酸化物を堆積した、スパッタリング装置内は、背圧が7×10−4Paの高真空の状態に保たれており、装置内でこの酸化層が形成されたとは考えにくい。従って、この層の大部分は、スパッタリング終了後にスパッタリング装置から取り出して、X線反射率測定までの間に形成されたのではないかと考えられる(実際にはスパッタ装置から取り出して数日後に測定を実施した)。つまり、スパッタリング装置から取り出さずに、第2電極を形成した場合は、第2のタンタル酸化物層は存在しないか、存在しても、1nm以下のわずかであろうと考えられる。
同様の推論から、サンプルB及びCでもタンタル酸化物を堆積したスパッタリング装置から取り出した後(X線反射率測定を行うまでの間に)外気に晒され、若干の第2のタンタル酸化物層の膜厚が増加した可能性がある。しかしながら、一般に、酸化の進行は最初は早く徐々に遅くなる傾向がある事が知られている。従って、スパッタリング装置内で酸素プラズマに暴露して酸素の含有率の高い第2のタンタル酸化物を形成した場合は、スパッタリング装置外で増加した第2のタンタル酸化物層の割合は小さいと推察される。
工業調査会(1992年) 宇佐美晶、兼房慎ニ、前川隆雄、友景肇、井上森男)、108Ωcm未満の抵抗値を有する材料を導電体と定義する。もし、本実施の形態の第2のタンタル酸化物層が絶縁体であって抵抗率が108Ωcmである場合、直径3μm(本実施の形態での素子領域109の直径)の円形で1nmの膜厚(第2のタンタル酸化物層のおよその膜厚)を有しているとすれば、抵抗値は1.4×108Ω程度となるはずである(「抵抗値=抵抗率×膜厚/面積」で計算)。さらに、第2のタンタル酸化物層の膜厚が0.1nmとしても、抵抗値は1.4×107Ωとなる。一方で、実施例2及び3では抵抗値は、表1を参照して、高々103〜104Ω程度であり、絶縁体を仮定した場合に比べて、少なくとも3〜4桁程度は低くなっている。この計算の結果からも本実施の形態で形成した第2のタンタル酸化物層は、絶縁体ではなく、導電性の酸化物層である事が分かる。
実施例2及び3とサンプルB及びCとでは、全く同一の条件でスパッタリングし、酸素プラズマ照射処理を行っているので、実施例2及び3においても、サンプルB及びCと同様に、第1のタンタル酸化物層104と第2電極層107との間には第2のタンタル酸化物層105が存在していると考えられる。したがって、実施例2では、サンプルBと同様に膜厚が1.1nmの第2のタンタル酸化物層105が形成されており、実施例3では、サンプルCと同様に膜厚が1.2nmの第2のタンタル酸化物層105が形成されているといえる。
第2のタンタル酸化物層の果している役割についてであるが、抵抗変化現象のメカニズム自体が明らかになっていない現状では、明確には分からない。但し、第2のタンタル酸化物層の存在が確認されたことで、以下のような推論が成立する。すなわち、本実施の形態の抵抗変化型の不揮発性素子の抵抗変化が、電極とタンタル酸化物層の界面の酸素原子の移動によって起こっていると考えれば、第2のタンタル酸化物層は界面近傍に電圧を有効に印加する役割を果している可能性が考えられる。つまり、抵抗変化現象は、第2電極層107とタンタル酸化物層106の界面付近に電界によって酸素原子が集まったり、拡散したりして発現していると考える。具体的には、第2電極層107に正の電圧を印加すれば負に帯電している酸素原子が第2電極層107側に集まり、高抵抗層を形成して、高抵抗化する。逆に負の電圧を印加すれば、酸素原子がタンタル酸化物層内に拡散して抵抗が下がる。ここでもし、界面(正確にはタンタル酸化物層106側の界面)に高抵抗層である第2のタンタル酸化物層105が存在すれば、この部分に大きな電圧がかかって、酸素が高抵抗層105に注入され、ますます酸素含有率が高くなって、絶縁物として知られている化学量論的組成を有するTa2O5に近づく。その結果、素子自体の抵抗が上昇し、高抵抗化状態となる。しかし、界面に高抵抗層である第2のタンタル酸化物層105が存在しなければ、電圧は、タンタル酸化物層106に均等にかかり、界面近傍に絶縁物に近い高抵抗層は形成されにくい。その結果、抵抗変化現象は起こりにくくなる。しかし、第2のタンタル酸化物層105が存在しない場合でも、定常的に動作させる電圧よりも高い電圧を加えたり(本実施の形態では−2Vや3Vよりも大きな電圧)、数多くの電気的パルスを加える、いわゆる、フォーミング工程によって、第2のタンタル酸化物層105に類似した層を一旦作ってやれば、その後は安定した抵抗変化が起こると考えられる。
さらに、上記のようなメカニズムによれば、第2のタンタル酸化物層は第1のタンタル酸化物層と第2電極との間に設けられなければならないわけではなく、次の変形例のように設けられていてもよい。
次に、第1のタンタル酸化物層104の膜厚が抵抗変化現象に与える影響を調べるため、上記の実施例1及び2とは異なる膜厚の第1のタンタル酸化物層を有する不揮発性記憶素子(実施例4)を作製し、この抵抗変化特性を調べた。実施例4は、実施例2と比べると、第1のタンタル酸化物層104の膜厚だけが異なっており、実施例2における第1のタンタル酸化物層104の膜厚が30nmであったのに対して、実施例4におけるその膜厚は90nmとした。実施例4を作製する際の酸素プラズマ暴露時間は、実施例2の場合と同様に0.5分とした。したがって、実施例4においても、第2のタンタル酸化物層105の膜厚は1から2nm程度であると考えられる。
次に、本実施の形態の不揮発性記憶素子100において電極間に印加する電気的パルスの幅と抵抗変化層106の抵抗変化特性との関係について説明する。
次に、電極間に同極性の電気的パルスを連続して印加した場合における本実施の形態の不揮発性記憶素子100の抵抗値のインプリント性について説明する。
図12は、実施例2に対して、正負のパルスを交互に連続して印加し、抵抗変化現象の耐久性を調べた結果を示している。図12には、パルスの印加回数が10000回までの測定結果が示されている。この図を見ると分かるように、パルスを10000回印加しても、高抵抗状態の抵抗値及び低抵抗状態の抵抗値には変化は見られず、それぞれ、1000Ωと60Ωとでほぼ一定した値となっている。なお、図12は、10000回のパルスを加えた後に、抵抗変化現象が見られなくなったということを意味しているのではなく、この後も素子は安定して抵抗変化を示した。
次に、本実施の形態に係る不揮発性記憶素子100のリテンション特性について説明する。
(第2の実施の形態)
第1の実施の形態では、第1のタンタル酸化物層をスパッタリング装置内で堆積したあと、連続して酸素プラズマによる酸化処理を行い、第2のタンタル酸化物層を形成した。しかし、この方法では使用した装置の都合上、厚い第2のタンタル酸化物層を形成する事はできなかった。そこで、本実施の形態では、膜厚の厚い第2のタンタル酸化物層を形成した場合の不揮発性記憶素子の動作について述べる。
不揮発性記憶素子の製造方法は、基本的に第1の実施の形態と同一である。但し、酸化工程の都合上、タンタル酸化物の堆積条件や、形成した不揮発性記憶素子のサイズは第1の実施の形態とは異なっている。以下、図2を参照しながら不揮発性素子の製造工程について説明する。
ここで、第1のタンタル酸化物層104は、以下に述べる条件で堆積を行った。すなわち、スパッタリング装置内に基板を設置した後、スパッタリング装置内を8×10−6Pa程度まで真空引きする。そして、タンタルをターゲットとして、パワーを1.6kW、アルゴンガスを34sccm、酸素ガスを21sccm流して、スパッタリング装置内の圧力を0.17Paに保ち、20秒間スパッタリングを行う。これにより、抵抗率が6mΩcmで酸素含有率が約61at%(TaO1.6)の第1のタンタル酸化物層が30nm堆積できる。
次に、図2(b)のように、その第1のタンタル酸化物層104の最表面を酸化してその表面を改質する。ここで、表3に示すように、酸化処理の方法を変化させる事により、実施例5乃至7を作製した。
その後、第2のタンタル酸化物層105上に、第2電極層107としての厚さ150nmのPt薄膜をスパッタリング法により形成する。なお、第2のタンタル酸化物層105が大気中で酸化されるのをさけるため、第2電極層107は、第2のタンタル酸化物層105を堆積後速やかに行った。最後に、フォトレジスト工程によって、フォトレジストによるパターン108を形成し、ドライエッチングによって、素子領域109を形成する。ここで素子領域の109は、一辺が0.5μmの四角の形状とした。
[実施例5乃至7の抵抗変化特性]
次に、本実施の形態において実際に作製した実施例5乃至7に対して電気的パルスを印加して、抵抗変化を起こさせた時の特性について説明する。
これもフォーミング工程なしで、安定して抵抗変化が起こっている事が分かる。すなわち、初期約600Ωであった抵抗が負電圧−1.2Vを加える事で、300Ω程度に低下し、正電圧1.5Vを加える事で5000Ω程度に増加している。そしてその後は、負電圧−1.2Vと正電圧1.5Vの電気的パルスを交互に加える事で抵抗値は約200Ωと約5000Ωの間を往復し、良好に抵抗変化が起こっている。
しかしながら、図14(c)に示した、第1のタンタル酸化物層を酸化していない実施例7は上記とはかなり異なる結果が得られている。すなわち、実施例7は、作製した直後の状態では、実施例5および6よりも高い電圧である、負電圧−1.5Vと正電圧2Vを印加しても全く抵抗変化を示さなかった。そこで、印加電圧を正電圧2.5Vから0.1V刻みで増加させてゆくと(図14(c)の横軸のパルス数で26回目から32回の範囲)、3.2Vの時に抵抗値が約40Ωから約60000Ωに急激に増加しているのが分かる。その後は、負電圧−1.5Vと正電圧2.0Vの電圧の電気的パルスを印加する事で抵抗変化が生じている。ここで、印加電圧を2.5Vから3.2Vへと増加させた工程が、従来技術で開示されているフォーミング工程に相当すると考えられる。すなわちこの工程で第1のタンタル酸化膜層104の表面付近に第2のタンタル酸化物層105に相当する高抵抗層が形成されているのではないかと考えられる。
本実施の形態における抵抗変化層106の構造を解析するため、単結晶シリコン基板上に厚さ200nmの酸化物層が形成された基板上に、実施例5及び6と全く同じ条件で、タンタル酸化物を堆積して、酸化処理まで行ったサンプルを用意した。これらのサンプルを、それぞれD、Eと表記する。それぞれのサンプルのX線反射率測定の結果を表4に示す。なお、サンプルD及びEは、サンプルA乃至Cと同様に、第2のタンタル酸化物層が露出された状態とした。
[不揮発性記憶素子の断面観察]
上述のように、本実施の形態で形成した不揮発性記憶素子の第2のタンタル酸化物層の膜厚は上述のように7〜8nm程度の値である。この程度の膜厚があれば、透過型電子顕微鏡による不揮発性素子の断面観察によって、第2のタンタル酸化物層の存在が容易に観察できる。そこで、実施例5の酸素プラズマ酸化により第2のタンタル酸化物層を形成した不揮発性記憶素子の断面観察を実際に行った。その結果を図15(a)に示す。図15(b)は、図15(a)の写真のスケッチである。
これらの図を見ると明らかなように、Ptから成る第1電極(第1電極層)、第1のタンタル酸化物層、第2のタンタル酸化物層、Ptから成る第2電極(第2電極層)が明確に確認できる。さらに第1のタンタル酸化物層の膜厚は若干のばらつきはあるが約28nm、第2のタンタル酸化物層の膜厚は約8nm程度となっている事も分かる。これらの値は、同一の酸化条件で作製したサンプルDのX線反射率測定の結果とほぼ一致している(表4より、第1のタンタル酸化物層の膜厚26.6nm、第2のタンタル酸化物層の膜厚8.1nm)。以上の事から、本実施の形態の方法で作製した不揮発性記憶素子には、実際に第2のタンタル酸化物層が存在している事が明らかとなった。また、X線反射率測定による分析結果の妥当性の証明ともなっている。また、サンプルA〜Eのデータを総合すると、第2のタンタル酸化物層の厚みは、実質的に1nm以上8nm以下(正確には1.1nm以上8.1nm以下)が好ましいことが実証された。
(第3の実施の形態)
上述した第1の実施の形態に係る不揮発性記憶素子100の場合、第1のタンタル酸化物層104の酸素含有率は58at%(TaO1.4)であった。また第2の実施の形態に係る不揮発性記憶素子100の第1のタンタル酸化物層104の酸素含有率もこれに近く、61at%(TaO1.6)であった。これに対し、第3の実施の形態に係る不揮発性記憶素子は、もう少し大きく酸素含有率を変化させた第1のタンタル酸化物層を備えている。第3の実施の形態のその他の構成については、第1及び第2の実施の形態の場合と同様であるので、図示は省略する。以下、図1を参照しながら、第1のタンタル酸化物層の酸素含有率を変化させて作製した本実施の形態における各実施例の製造方法及びその抵抗変化特性等について説明する。
まず、本実施の形態におけるタンタル酸化物の作製条件及び酸素含有率の解析結果について述べる。タンタルの酸化物は、第1の実施の形態で説明した方法と同様の方法で作製した。但し、タンタル酸化物の酸素含有率は、スパッタリング時の酸素流量比を調整することで制御する。具体的なスパッタリング時の工程に従って説明すると、まず、スパッタリング装置内に基板を設置し、スパッタリング装置内を7×10−4Pa程度まで真空引きする。そして、タンタルをターゲットとして、パワーを250W、アルゴンガスと酸素ガスとをあわせた全ガス圧力を3.3Pa、基板の設定温度を30℃にし、スパッタリングを行う。ここでは、酸素ガスの流量比を0.8%から6.7%まで変化させている。まずは、組成を調べる事が目的であるため、基板としては、Si上にSiO2を200nm堆積したものを用い、タンタル酸化物層の膜厚は約100nmになるようにスパッタリング時間を調整した。また、第1の実施の形態で説明したような、酸素プラズマへの暴露は行っていない。このようにして作製したタンタル酸化物層の組成をラザフォード後方散乱法(RBS法)、及びオージェ電子分光法(AES法)によって解析した結果を図16に示す。この図から、酸素分圧比を0.8%から6.7%に変化させた場合、タンタル酸化物層中の酸素含有率は約40at%(TaO0.66)から約70at%(TaO2.3)へと変化していることが分かる。すなわち、タンタル酸化物層中の酸素含有率を酸素流量比によって制御可能であることが分かる。
なお、組成測定用に用意した試料は、基板上に堆積後、測定までの間に大気中の酸素によって酸化され、表面に高酸素含有率層が形成されていると考えられる。しかしながら、RBS及びAESの測定を行う前に、表面をエッチングして測定を行ったので、この表面の高酸素含有率層が、酸素含有率の測定に与える影響は無視しうる。
次に、酸素含有率を変化させたタンタル酸化物層を、第1のタンタル酸化物層104として用いて抵抗変化層106を形成し、本実施の形態の不揮発性記憶素子100を構成した場合の抵抗変化特性について説明する。不揮発性記憶素子100の作製は、第1の実施の形態で説明した方法と同様の方法を用いた。すなわち、単結晶シリコン基板101上に、厚さ200nmの酸化物層102を熱酸化法により形成し、第1電極層103としての厚さ100nmのPt薄膜を、スパッタリング法により酸化物層102上に形成する。その後、第1電極層103上に、タンタルをターゲットとして、パワーを250W、アルゴンガスと酸素ガスとをあわせた全ガス圧力を3.3Pa、基板の設定温度を30℃としてスパッタリングを行い、第1のタンタル酸化物層104を形成する。本実施の形態で検討した範囲では、酸素ガスの流量比を、0.8%から6.7%まで変化させて各実施例を作製した。
以上のように作製した不揮発性記憶素子の抵抗変化現象を測定した。その結果、図16のα点(酸素流量比約1.7%、酸素含有率約45at%)からβ点(酸素流量比約5%、酸素含有率約65at%)のタンタル酸化膜を使った不揮発性記憶素子では、高抵抗値が低抵抗値の5倍以上と良好であった。
図17(a)と(b)は、それぞれ、α点およびβ点の酸素含有率を有する試料についてのパルス印加回数に対する抵抗変化特性を測定した結果である。図17(b)および図17(c)によれば、α点およびβ点の酸素含有率においては、共に、高抵抗値が低抵抗値の5倍以上と良好であることが判る。従って、酸素含有率が45〜65at%の組成範囲、即ち抵抗変化層をTaOxと表記した場合におけるxの範囲が0.8≦x≦1.9の範囲がより適切な抵抗変化層の範囲である(酸素含有率=45at%がx=0.8に、酸素含有率=65at%がx=1.9にそれぞれ対応)。なお、RBS法による組成分析では、酸素含有量の分析値は±5at%程度の精度である。従って、前記xの組成範囲もこの精度に起因する測定誤差を含んでおり、実際には、酸素含有率が40〜70at%の組成範囲までこの適切な組成範囲である可能性がある。この組成範囲以外でも抵抗変化現象は確認され又は推認されるが、この組成範囲内に比べると抵抗率が小さくなり又は大きくなることから高抵抗値が低抵抗値の5倍未満になると考えられ、記憶素子として動作の安定性にやや欠けると考えられる。
上述した第1乃至第3の実施の形態に係る不揮発性記憶素子は、種々の形態の不揮発性半導体装置へ適用することが可能である。第4の実施の形態に係る半導体装置は、第1乃至3の実施の形態に係る不揮発性記憶素子を備える不揮発性半導体装置であって、ワード線とビット線との交点(立体交差点)にアクティブ層を介在させた、いわゆるクロスポイント型のものである。
図19は、本発明の第4の実施の形態に係る不揮発性半導体装置の構成を示すブロック図である。また、図20は、図19におけるA部の構成(4ビット分の構成)を示す斜視図である。
0で示されている。
図21は、本発明の第4の実施の形態に係る不揮発性半導体装置が備える不揮発性記憶素子の構成を示す断面図である。なお、図21では、図20のB部における構成が示されている。
本実施の形態に係る不揮発性半導体装置が備える不揮発性記憶素子の構成は、図21に示したものに限られるわけではなく、以下に示すような構成であってもよい。
図19および図20に示した本実施の形態に係る不揮発性半導体装置におけるメモリアレイを、3次元に積み重ねることによって、多層化構造の不揮発性半導体装置を実現することができる。
次に、情報を書き込む場合の書き込みサイクルおよび情報を読み出す場合の読み出しサイクルにおける第4の実施の形態に係る不揮発性半導体装置の動作例について、図24に示すタイミングチャートを参照しながら説明する。
上述した第1乃至第3の実施の形態に係る不揮発性記憶素子は、種々の形態の不揮発性半導体装置へ適用することが可能である。第5の実施の形態に係る不揮発性半導体装置は、第1乃至3の実施の形態に係る不揮発性記憶素子を備える不揮発性半導体装置であって、1トランジスタ/1不揮発性記憶部とした、いわゆる1T1R型のものである。
図25は、本発明の第5の実施の形態に係る不揮発性半導体装置の構成を示すブロック図である。また、図26は、図25におけるC部の構成(2ビット分の構成)を示す断面図である。
次に、情報を書き込む場合の書き込みサイクルおよび情報を読み出す場合の読み出しサイクルにおける第5の実施の形態に係る不揮発性半導体装置の動作例について、図27に示すタイミングチャートを参照しながら説明する。
第6の実施の形態に係る不揮発性半導体装置は、プログラム機能を有する第1乃至第3の実施の形態に係る不揮発性記憶素子を備える不揮発性半導体装置であって、所定の演算を実行する論理回路を備えるものである。
図28は、本発明の第6の実施の形態に係る不揮発性半導体装置の構成を示すブロック図である。
次に、上述したように構成される本実施の形態に係る不揮発性半導体装置の動作例について説明する。
次に、上述したように構成される本実施の形態に係る不揮発性半導体装置の製造方法について説明する。
第6の実施の形態に係る不揮発性半導体装置が、第4の実施の形態に係る不揮発性半導体装置を備えるような構成、すなわち、第4の実施の形態に係るクロスポイント型の不揮発性半導体装置と第6の実施の形態に係るCPUなどを有するLSIとを一つの半導体基板上に集積するような構成を実現することができる。
上記説明から、当業者にとっては、本発明の多くの改良や他の実施形態が明らかである。従って、上記説明は、例示としてのみ解釈されるべきであり、本発明を実行する最良の態様を当業者に教示する目的で提供されたものである。本発明の精神を逸脱することなく、その構造及び/又は機能の詳細を実質的に変更できる。
[不揮発性記憶素子の構成]
図1は、本発明の第1の実施の形態に係る不揮発性記憶素子の一構成例を示した断面図である。
次に、図2(a)〜図2(c)を参照しながら、本実施の形態の不揮発性記憶素子100の製造方法について説明する。
まず、実施例1乃至3の抵抗変化層106の初期抵抗を測定し、その結果について検討する。ここでは、各実施例における第1電極層103と第2電極層107との間に、閾値電圧(例えば、1V程度)よりも低い50mVの微弱な電圧を印加し、流れる電流を測定して各実施例の抵抗変化層106の初期の抵抗値を求めた。その結果を表1に示す。
実施例1乃至3の具体的な動作を説明する前に、本実施の形態で作製した抵抗変化型の不揮発性記憶素子の動作例、すなわち情報の書き込み/読み出しをする場合の動作例を、図面を参照して説明する。
次に、本実施の形態において実際に作製した実施例1乃至3に対して電気的パルスを印加して、抵抗変化を起こさせたときの特性について説明する。
本実施の形態における抵抗変化層106の構造を解析するため、単結晶シリコン基板上に厚さ200nmの酸化物層が形成された基板上に、実施例1乃至3と全く同じ条件で、タンタル酸化物を堆積して、酸素プラズマの照射処理まで行ったサンプルをそれぞれ用意した。これらのサンプルを、それぞれA,B、Cと表記する。それぞれのサンプルの酸素プラズマ暴露時間と、後述の分析結果をまとめた結果を表2に示す。なお、サンプルA乃至Cの上には、第2電極層107に相当するPtは堆積されていないため、抵抗変化層が露出された状態となっている。
実施例2及び3とサンプルB及びCとでは、全く同一の条件でスパッタリングし、酸素プラズマ照射処理を行っているので、実施例2及び3においても、サンプルB及びCと同様に、第1のタンタル酸化物層104と第2電極層107との間には第2のタンタル酸化物層105が存在していると考えられる。したがって、実施例2では、サンプルBと同様に膜厚が1.1nmの第2のタンタル酸化物層105が形成されており、実施例3では、サンプルCと同様に膜厚が1.2nmの第2のタンタル酸化物層105が形成されているといえる。
第2のタンタル酸化物層の果している役割についてであるが、抵抗変化現象のメカニズム自体が明らかになっていない現状では、明確には分からない。但し、第2のタンタル酸化物層の存在が確認されたことで、以下のような推論が成立する。すなわち、本実施の形態の抵抗変化型の不揮発性素子の抵抗変化が、電極とタンタル酸化物層の界面の酸素原子の移動によって起こっていると考えれば、第2のタンタル酸化物層は界面近傍に電圧を有効に印加する役割を果している可能性が考えられる。つまり、抵抗変化現象は、第2電極層107とタンタル酸化物層106の界面付近に電界によって酸素原子が集まったり、拡散したりして発現していると考える。具体的には、第2電極層107に正の電圧を印加すれば負に帯電している酸素原子が第2電極層107側に集まり、高抵抗層を形成して、高抵抗化する。逆に負の電圧を印加すれば、酸素原子がタンタル酸化物層内に拡散して抵抗が下がる。ここでもし、界面(正確にはタンタル酸化物層106側の界面)に高抵抗層である第2のタンタル酸化物層105が存在すれば、この部分に大きな電圧がかかって、酸素が高抵抗層105に注入され、ますます酸素含有率が高くなって、絶縁物として知られている化学量論的組成を有するTa2O5に近づく。その結果、素子自体の抵抗が上昇し、高抵抗化状態となる。しかし、界面に高抵抗層である第2のタンタル酸化物層105が存在しなければ、電圧は、タンタル酸化物層106に均等にかかり、界面近傍に絶縁物に近い高抵抗層は形成されにくい。その結果、抵抗変化現象は起こりにくくなる。しかし、第2のタンタル酸化物層105が存在しない場合でも、定常的に動作させる電圧よりも高い電圧を加えたり(本実施の形態では−2Vや3Vよりも大きな電圧)、数多くの電気的パルスを加える、いわゆる、フォーミング工程によって、第2のタンタル酸化物層105に類似した層を一旦作ってやれば、その後は安定した抵抗変化が起こると考えられる。
次に、第1のタンタル酸化物層104の膜厚が抵抗変化現象に与える影響を調べるため、上記の実施例1及び2とは異なる膜厚の第1のタンタル酸化物層を有する不揮発性記憶素子(実施例4)を作製し、この抵抗変化特性を調べた。実施例4は、実施例2と比べると、第1のタンタル酸化物層104の膜厚だけが異なっており、実施例2における第1のタンタル酸化物層104の膜厚が30nmであったのに対して、実施例4におけるその膜厚は90nmとした。実施例4を作製する際の酸素プラズマ暴露時間は、実施例2の場合と同様に0.5分とした。したがって、実施例4においても、第2のタンタル酸化物層105の膜厚は1から2nm程度であると考えられる。
次に、本実施の形態の不揮発性記憶素子100において電極間に印加する電気的パルスの幅と抵抗変化層106の抵抗変化特性との関係について説明する。
次に、電極間に同極性の電気的パルスを連続して印加した場合における本実施の形態の不揮発性記憶素子100の抵抗値のインプリント性について説明する。
図12は、実施例2に対して、正負のパルスを交互に連続して印加し、抵抗変化現象の耐久性を調べた結果を示している。図12には、パルスの印加回数が10000回までの測定結果が示されている。この図を見ると分かるように、パルスを10000回印加しても、高抵抗状態の抵抗値及び低抵抗状態の抵抗値には変化は見られず、それぞれ、1000Ωと60Ωとでほぼ一定した値となっている。なお、図12は、10000回のパルスを加えた後に、抵抗変化現象が見られなくなったということを意味しているのではなく、この後も素子は安定して抵抗変化を示した。
次に、本実施の形態に係る不揮発性記憶素子100のリテンション特性について説明する。
(第2の実施の形態)
第1の実施の形態では、第1のタンタル酸化物層をスパッタリング装置内で堆積したあと、連続して酸素プラズマによる酸化処理を行い、第2のタンタル酸化物層を形成した。しかし、この方法では使用した装置の都合上、厚い第2のタンタル酸化物層を形成する事はできなかった。そこで、本実施の形態では、膜厚の厚い第2のタンタル酸化物層を形成した場合の不揮発性記憶素子の動作について述べる。
不揮発性記憶素子の製造方法は、基本的に第1の実施の形態と同一である。但し、酸化工程の都合上、タンタル酸化物の堆積条件や、形成した不揮発性記憶素子のサイズは第1の実施の形態とは異なっている。以下、図2を参照しながら不揮発性素子の製造工程について説明する。
[実施例5乃至7の抵抗変化特性]
次に、本実施の形態において実際に作製した実施例5乃至7に対して電気的パルスを印加して、抵抗変化を起こさせた時の特性について説明する。
これもフォーミング工程なしで、安定して抵抗変化が起こっている事が分かる。すなわち、初期約600Ωであった抵抗が負電圧−1.2Vを加える事で、300Ω程度に低下し、正電圧1.5Vを加える事で5000Ω程度に増加している。そしてその後は、負電圧−1.2Vと正電圧1.5Vの電気的パルスを交互に加える事で抵抗値は約200Ωと約5000Ωの間を往復し、良好に抵抗変化が起こっている。
本実施の形態における抵抗変化層106の構造を解析するため、単結晶シリコン基板上に厚さ200nmの酸化物層が形成された基板上に、実施例5及び6と全く同じ条件で、タンタル酸化物を堆積して、酸化処理まで行ったサンプルを用意した。これらのサンプルを、それぞれD、Eと表記する。それぞれのサンプルのX線反射率測定の結果を表4に示す。なお、サンプルD及びEは、サンプルA乃至Cと同様に、第2のタンタル酸化物層が露出された状態とした。
[不揮発性記憶素子の断面観察]
上述のように、本実施の形態で形成した不揮発性記憶素子の第2のタンタル酸化物層の膜厚は上述のように7〜8nm程度の値である。この程度の膜厚があれば、透過型電子顕微鏡による不揮発性素子の断面観察によって、第2のタンタル酸化物層の存在が容易に観察できる。そこで、実施例5の酸素プラズマ酸化により第2のタンタル酸化物層を形成した不揮発性記憶素子の断面観察を実際に行った。その結果を図15(a)に示す。図15(b)は、図15(a)の写真のスケッチである。
(第3の実施の形態)
上述した第1の実施の形態に係る不揮発性記憶素子100の場合、第1のタンタル酸化物層104の酸素含有率は58at%(TaO1.4)であった。また第2の実施の形態に係る不揮発性記憶素子100の第1のタンタル酸化物層104の酸素含有率もこれに近く、61at%(TaO1.6)であった。これに対し、第3の実施の形態に係る不揮発性記憶素子は、もう少し大きく酸素含有率を変化させた第1のタンタル酸化物層を備えている。第3の実施の形態のその他の構成については、第1及び第2の実施の形態の場合と同様であるので、図示は省略する。以下、図1を参照しながら、第1のタンタル酸化物層の酸素含有率を変化させて作製した本実施の形態における各実施例の製造方法及びその抵抗変化特性等について説明する。
まず、本実施の形態におけるタンタル酸化物の作製条件及び酸素含有率の解析結果について述べる。タンタルの酸化物は、第1の実施の形態で説明した方法と同様の方法で作製した。但し、タンタル酸化物の酸素含有率は、スパッタリング時の酸素流量比を調整することで制御する。具体的なスパッタリング時の工程に従って説明すると、まず、スパッタリング装置内に基板を設置し、スパッタリング装置内を7×10-4Pa程度まで真空引きする。そして、タンタルをターゲットとして、パワーを250W、アルゴンガスと酸素ガスとをあわせた全ガス圧力を3.3Pa、基板の設定温度を30℃にし、スパッタリングを行う。ここでは、酸素ガスの流量比を0.8%から6.7%まで変化させている。まずは、組成を調べる事が目的であるため、基板としては、Si上にSiO2を200nm堆積したものを用い、タンタル酸化物層の膜厚は約100nmになるようにスパッタリング時間を調整した。また、第1の実施の形態で説明したような、酸素プラズマへの暴露は行っていない。このようにして作製したタンタル酸化物層の組成をラザフォード後方散乱法(RBS法)、及びオージェ電子分光法(AES法)によって解析した結果を図16に示す。この図から、酸素分圧比を0.8%から6.7%に変化させた場合、タンタル酸化物層中の酸素含有率は約40at%(TaO0.66)から約70at%(TaO2.3)へと変化していることが分かる。すなわち、タンタル酸化物層中の酸素含有率を酸素流量比によって制御可能であることが分かる。
次に、酸素含有率を変化させたタンタル酸化物層を、第1のタンタル酸化物層104として用いて抵抗変化層106を形成し、本実施の形態の不揮発性記憶素子100を構成した場合の抵抗変化特性について説明する。不揮発性記憶素子100の作製は、第1の実施の形態で説明した方法と同様の方法を用いた。すなわち、単結晶シリコン基板101上に、厚さ200nmの酸化物層102を熱酸化法により形成し、第1電極層103としての厚さ100nmのPt薄膜を、スパッタリング法により酸化物層102上に形成する。その後、第1電極層103上に、タンタルをターゲットとして、パワーを250W、アルゴンガスと酸素ガスとをあわせた全ガス圧力を3.3Pa、基板の設定温度を30℃としてスパッタリングを行い、第1のタンタル酸化物層104を形成する。本実施の形態で検討した範囲では、酸素ガスの流量比を、0.8%から6.7%まで変化させて各実施例を作製した。
上述した第1乃至第3の実施の形態に係る不揮発性記憶素子は、種々の形態の不揮発性半導体装置へ適用することが可能である。第4の実施の形態に係る半導体装置は、第1乃至3の実施の形態に係る不揮発性記憶素子を備える不揮発性半導体装置であって、ワード線とビット線との交点(立体交差点)にアクティブ層を介在させた、いわゆるクロスポイント型のものである。
図19は、本発明の第4の実施の形態に係る不揮発性半導体装置の構成を示すブロック図である。また、図20は、図19におけるA部の構成(4ビット分の構成)を示す斜視図である。
0で示されている。
図21は、本発明の第4の実施の形態に係る不揮発性半導体装置が備える不揮発性記憶素子の構成を示す断面図である。なお、図21では、図20のB部における構成が示されている。
本実施の形態に係る不揮発性半導体装置が備える不揮発性記憶素子の構成は、図21に示したものに限られるわけではなく、以下に示すような構成であってもよい。
図19および図20に示した本実施の形態に係る不揮発性半導体装置におけるメモリアレイを、3次元に積み重ねることによって、多層化構造の不揮発性半導体装置を実現することができる。
次に、情報を書き込む場合の書き込みサイクルおよび情報を読み出す場合の読み出しサイクルにおける第4の実施の形態に係る不揮発性半導体装置の動作例について、図24に示すタイミングチャートを参照しながら説明する。
上述した第1乃至第3の実施の形態に係る不揮発性記憶素子は、種々の形態の不揮発性半導体装置へ適用することが可能である。第5の実施の形態に係る不揮発性半導体装置は、第1乃至3の実施の形態に係る不揮発性記憶素子を備える不揮発性半導体装置であって、1トランジスタ/1不揮発性記憶部とした、いわゆる1T1R型のものである。
図25は、本発明の第5の実施の形態に係る不揮発性半導体装置の構成を示すブロック図である。また、図26は、図25におけるC部の構成(2ビット分の構成)を示す断面図である。
次に、情報を書き込む場合の書き込みサイクルおよび情報を読み出す場合の読み出しサイクルにおける第5の実施の形態に係る不揮発性半導体装置の動作例について、図27に示すタイミングチャートを参照しながら説明する。
第6の実施の形態に係る不揮発性半導体装置は、プログラム機能を有する第1乃至第3の実施の形態に係る不揮発性記憶素子を備える不揮発性半導体装置であって、所定の演算を実行する論理回路を備えるものである。
図28は、本発明の第6の実施の形態に係る不揮発性半導体装置の構成を示すブロック図である。
次に、上述したように構成される本実施の形態に係る不揮発性半導体装置の動作例について説明する。
次に、上述したように構成される本実施の形態に係る不揮発性半導体装置の製造方法について説明する。
第6の実施の形態に係る不揮発性半導体装置が、第4の実施の形態に係る不揮発性半導体装置を備えるような構成、すなわち、第4の実施の形態に係るクロスポイント型の不揮発性半導体装置と第6の実施の形態に係るCPUなどを有するLSIとを一つの半導体基板上に集積するような構成を実現することができる。
101 基板
102 酸化物層
103 第1電極層
104 第1のタンタル酸化物層
105 第2のタンタル酸化物層
106 抵抗変化層
107 第2電極層
108 フォトレジスト
109 素子領域
110 第3のタンタル酸化物層
200 不揮発性半導体装置
201 メモリ本体部
202 メモリアレイ
203 行選択回路/ドライバ
204 列選択回路/ドライバ
205 書き込み回路
206 センスアンプ
207 データ入出力回路
208 アドレス入力回路
209 制御回路
210 不揮発性記憶素子
211 上部配線
212 下部配線
213 上部電極
214 抵抗変化層
215 内部電極
216 電流抑制素子
217 下部電極
218 オーミック抵抗層
219 第2の抵抗変化層
300 不揮発性半導体装置
301 メモリ本体部
302 メモリアレイ
303 行選択回路/ドライバ
304 列選択回路
305 書き込み回路
306 センスアンプ
307 データ入出力回路
308 セルプレート電源
309 アドレス入力回路
310 制御回路
313 不揮発性記憶素子
314 上部電極
315 抵抗変化層
316 下部電極
400 不揮発性半導体装置
401 半導体基板
402 CPU
403 入出力回路
404 論理回路
405 アナログ回路
406 BIST回路
407 SRAM
408 救済アドレス格納レジスタ
409 不揮発性記憶素子
410 書き込み回路
411 読み出し回路
412 ラッチ回路
BL0,BL1,… ビット線
M11,M12,… メモリセル
T11,T12,… トランジスタ
WL0,WL1,… ワード線
500 不揮発性記憶素子
501 基板
502 酸化物層
503 下部電極
504 抵抗変化層
505 上部電極
Claims (23)
- 第1電極と、第2電極と、前記第1電極と前記第2電極との間に介在し、両電極間に与えられる極性の異なる電気的信号に基づいて可逆的に抵抗値が変化する抵抗変化層と、を備え、
前記抵抗変化層は、その厚み方向において、TaOx(但し、0<x<2.5)で表される組成を有する第1の酸素不足型のタンタル酸化物を含む第1の領域と、TaOy(但し、x<y<2.5)で表される組成を有する第2の酸素不足型のタンタル酸化物を含む第2の領域と、を有している、不揮発性記憶素子。 - 前記抵抗変化層は、前記第1の領域としてのTaOx(但し、0<x<2.5)で表される組成を有する第1の酸素不足型のタンタル酸化物層と、前記第2の領域としてのTaOy(但し、x<y<2.5)で表される組成を有する第2の酸素不足型のタンタル酸化物層との少なくとも2層が積層された積層構造を有している、請求項1に記載の不揮発性記憶素子。
- 前記第2の酸素不足型のタンタル酸化物層が前記第1電極もしくは前記第2電極に接している、請求項2に記載の不揮発性記憶素子。
- 前記第2の酸素不足型のタンタル酸化物層が接している電極に前記第2の酸素不足型のタンタル酸化物層が接していない電極よりも高い電位を有する電気的パルスを印加した後の第1電極と第2電極間の抵抗値をRHとし、前記第2の酸素不足型のタンタル酸化物層が接している電極に前記第2の酸素不足型のタンタル酸化物層が接していない電極よりも低い電位を有する電気的パルスを印加した後の第1電極と第2電極間の抵抗値をRLとした時、RH>RLとなる、請求項3に記載の不揮発性記憶素子。
- 前記TaOxは、0.8≦x≦1.9を満足する、請求項1乃至4のいずれかに記載の不揮発性記憶素子。
- 前記TaOyは、2.1≦y<2.5を満足する、請求項1乃至4のいずれかに記載の不揮発性記憶素子。
- 前記第2の酸素不足型のタンタル酸化物層の厚みは、前記第1の酸素不足型のタンタル酸化物層の厚みよりも小さい、請求項2または3に記載の不揮発性記憶素子。
- 前記第2の酸素不足型のタンタル酸化物層の厚みが1nm以上8nm以下である、請求項1乃至4のいずれかに記載の不揮発性記憶素子。
- 半導体基板と、前記半導体基板の上に互いに平行に形成された複数の第1の電極配線と、前記複数の第1の電極配線の上方に前記半導体基板の主面に平行な面内において互いに平行に且つ前記複数の第1の電極配線に立体交差するように形成された複数の第2の電極配線と、前記複数の第1の電極配線と前記複数の第2の電極配線との立体交差点に対応して設けられた不揮発性記憶素子とを具備するメモリアレイを備え、
前記第1の電極配線を第1電極とし、前記第2の電極配線を第2電極とした場合、前記不揮発性記憶素子のそれぞれは、前記第1電極と前記第2電極との間に介在し、両電極間の電圧に基づいて可逆的に抵抗値が変化する抵抗変化層とを備え、
前記抵抗変化層は、その厚み方向において、TaOx(但し、0<x<2.5)で表される組成を有する第1の酸素不足型のタンタル酸化物を含む第1の領域と、TaOy(但し、x<y<2.5)で表される組成を有する第2の酸素不足型のタンタル酸化物を含む第2の領域と、を有している、不揮発性半導体装置。 - 半導体基板と、前記半導体基板の上に互いに平行に形成された複数の第1の電極配線と、前記複数の第1の電極配線の上方に前記半導体基板の主面に平行な面内において互いに平行に且つ前記複数の第1の電極配線に立体交差するように形成された複数の第2の電極配線と、前記複数の第1の電極配線と前記複数の第2の電極配線との立体交差点に対応して設けられた不揮発性記憶素子とを具備するメモリアレイを備え、
前記不揮発性記憶素子のそれぞれは、前記第1の電極配線と接続される第1電極と、前記第2の電極配線と接続される第2電極と、前記第1電極と前記第2電極との間に介在し、両電極間の電圧に基づいて可逆的に抵抗値が変化する抵抗変化層とを備え、
前記抵抗変化層は、その厚み方向において、TaOx(但し、0<x<2.5)で表される組成を有する第1の酸素不足型のタンタル酸化物を含む第1の領域と、TaOy(但し、x<y<2.5)で表される組成を有する第2の酸素不足型のタンタル酸化物を含む第2の領域と、を有している、不揮発性半導体装置。 - 前記不揮発性記憶素子のそれぞれは、前記第1電極と前記第2電極との間に電流抑制素子を具備しており、
当該電流抑制素子は、前記抵抗変化層と電気的に接続されている、請求項9または10に記載の不揮発性半導体装置。 - 前記メモリアレイが複数積層されてなる多層化メモリアレイを備える、請求項9または10に記載の不揮発性半導体装置。
- 半導体基板と、前記半導体基板上に形成された、互いに交差するように配列された複数のワード線および複数のビット線、前記複数のワード線および複数のビット線の交点に対応してそれぞれ設けられた複数のトランジスタ、並びに前記複数のトランジスタに対応して設けられた複数の不揮発性記憶素子とを備え、
前記不揮発性記憶素子のそれぞれは、第1電極と、第2電極と、前記第1電極と前記第2電極との間に介在され、対応して設けられている前記トランジスタを介して前記第1電極および前記第2電極間に与えられる電気的信号に基づいて可逆的に抵抗値が変化する抵抗変化層を備え、
前記抵抗変化層は、その厚み方向において、TaOx(但し、0<x<2.5)で表される組成を有する第1の酸素不足型のタンタル酸化物を含む第1の領域と、TaOy(但し、x<y<2.5)で表される組成を有する第2の酸素不足型のタンタル酸化物を含む第2の領域と、を有している、不揮発性半導体装置。 - 半導体基板と、前記半導体基板上に形成された、所定の演算を実行する論理回路およびプログラム機能を有する不揮発性記憶素子とを備え、
前記不揮発性記憶素子は、第1電極と、第2電極と、前記第1電極と前記第2電極との間に介在され、両電極間の電圧に基づいて可逆的に抵抗値が変化する抵抗変化層とを備え、
前記抵抗変化層は、その厚み方向において、TaOx(但し、0<x<2.5)で表される組成を有する第1の酸素不足型のタンタル酸化物を含む第1の領域と、TaOy(但し、x<y<2.5)で表される組成を有する第2の酸素不足型のタンタル酸化物を含む第2の領域と、を有している、不揮発性半導体装置。 - 請求項9、10または13に記載の不揮発性半導体装置を更に備える、請求項14に記載の不揮発性半導体装置。
- 第1電極と、第2電極と、前記第1電極と前記第2電極との間に介在し、両電極間に与えられる極性の異なる電気的信号に基づいて可逆的に抵抗値が変化する抵抗変化層と、を備える不揮発性記憶素子の製造方法であって、
前記抵抗変化層を製造する工程は、(A)前記抵抗変化層の厚み方向における一部を構成し、TaOx(但し、0<x<2.5)で表される組成を有する第1の酸素不足型のタンタル酸化物を含む第1の領域を形成する工程と、(B)前記抵抗変化層の厚み方向において前記第1の領域に隣り合い、TaOy(但し、x<y<2.5)で表される組成を有する第2の酸素不足型のタンタル酸化物を含む第2の領域を形成する工程と、を含む、不揮発性記憶素子の製造方法。 - 前記工程Aは前記第1の酸素不足型のタンタル酸化物を含む第1層を形成する工程であり、前記工程Bは前記第1層の表面を酸化することによって前記第1の領域及び前記第2の領域を形成する工程である、請求項16に記載の不揮発性記憶素子の製造方法。
- 前記工程Aは前記第1の酸素不足型のタンタル酸化物を含む前記第1の領域としての第1層を形成する工程であり、前記工程Bは前記第1層の上に前記第2の酸素不足型のタンタル酸化物を含む前記第2の領域としての第2層を堆積する工程である、請求項16に記載の不揮発性記憶素子の製造方法。
- 前記第1層を、スパッタリング法または化学気相堆積法によって形成する、請求項17または18に記載の不揮発性記憶素子の製造方法。
- 前記第2層を、スパッタリング法または化学気相堆積法によって形成する、請求項19に記載の不揮発性記憶素子の製造方法。
- 前記TaOxは、0.8≦x≦1.9を満足する、請求項16に記載の不揮発性記憶素子の製造方法。
- 前記TaOyは、2.1≦y<2.5を満足する、請求項16に記載の不揮発性記憶素子の製造方法。
- 前記第2層の厚みが1nm以上8nm以下である、請求項18に記載の不揮発性記憶素子の製造方法。
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JP5400797B2 (ja) * | 2008-12-04 | 2014-01-29 | パナソニック株式会社 | 不揮発性記憶素子 |
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US8350245B2 (en) | 2008-12-10 | 2013-01-08 | Panasonic Corporation | Variable resistance element and nonvolatile semiconductor memory device using the same |
JP5401970B2 (ja) * | 2008-12-17 | 2014-01-29 | 日本電気株式会社 | 不揮発性記憶装置 |
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WO2010086916A1 (ja) * | 2009-01-29 | 2010-08-05 | パナソニック株式会社 | 抵抗変化素子およびその製造方法 |
CN102292814B (zh) * | 2009-02-02 | 2013-10-23 | 松下电器产业株式会社 | 非易失性存储元件、非易失性存储装置、非易失性半导体装置和非易失性存储元件的制造方法 |
WO2010090002A1 (ja) * | 2009-02-04 | 2010-08-12 | パナソニック株式会社 | 不揮発性記憶素子 |
KR101519363B1 (ko) | 2009-02-16 | 2015-05-13 | 삼성전자 주식회사 | 저항체를 이용한 멀티 레벨 비휘발성 메모리 장치 |
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WO2010116754A1 (ja) * | 2009-04-10 | 2010-10-14 | パナソニック株式会社 | 不揮発性記憶素子の駆動方法 |
JP2010251352A (ja) * | 2009-04-10 | 2010-11-04 | Panasonic Corp | 不揮発性記憶素子及びその製造方法 |
WO2010119671A1 (ja) * | 2009-04-15 | 2010-10-21 | パナソニック株式会社 | 抵抗変化型不揮発性記憶装置 |
WO2010131477A1 (ja) * | 2009-05-14 | 2010-11-18 | パナソニック株式会社 | 不揮発性記憶装置及び不揮発性記憶装置へのデータ書込み方法 |
WO2010143396A1 (ja) * | 2009-06-08 | 2010-12-16 | パナソニック株式会社 | 抵抗変化型不揮発性記憶素子のフォーミング方法および抵抗変化型不揮発性記憶装置 |
US8325508B2 (en) | 2009-06-08 | 2012-12-04 | Panasonic Corporation | Writing method for variable resistance nonvolatile memory element, and variable resistance nonvolatile memory device |
JP4971522B2 (ja) * | 2009-06-18 | 2012-07-11 | パナソニック株式会社 | 不揮発性記憶装置及びその製造方法 |
JP4688979B2 (ja) * | 2009-07-13 | 2011-05-25 | パナソニック株式会社 | 抵抗変化型素子および抵抗変化型記憶装置 |
US8675387B2 (en) | 2009-07-28 | 2014-03-18 | Panasonic Corporation | Variable resistance nonvolatile memory device and programming method for same |
CN102484113B (zh) * | 2009-08-28 | 2014-11-26 | 松下电器产业株式会社 | 半导体存储装置及其制造方法 |
JP2011054766A (ja) * | 2009-09-02 | 2011-03-17 | Semiconductor Technology Academic Research Center | 抵抗変化型メモリとその製造方法 |
WO2011030559A1 (ja) * | 2009-09-14 | 2011-03-17 | パナソニック株式会社 | 不揮発性記憶装置及びその製造方法 |
US8274065B2 (en) * | 2009-10-19 | 2012-09-25 | Macronix International Co., Ltd. | Memory and method of fabricating the same |
US20120044749A1 (en) * | 2009-11-02 | 2012-02-23 | Shunsaku Muraoka | Variable resistance nonvolatile storage device and method of forming memory cell |
JP5468087B2 (ja) * | 2009-11-30 | 2014-04-09 | パナソニック株式会社 | 不揮発性記憶素子及び不揮発性記憶装置 |
JP5036909B2 (ja) * | 2009-12-18 | 2012-09-26 | パナソニック株式会社 | 抵抗変化型素子及びその製造方法 |
US8563962B2 (en) | 2009-12-28 | 2013-10-22 | Panasonic Corporation | Memory device and method of manufacturing the same |
US8450182B2 (en) * | 2010-01-25 | 2013-05-28 | Panasonic Corporation | Method of manufacturing non-volatile semiconductor memory element and method of manufacturing non-volatile semiconductor memory device |
CN102301425B (zh) | 2010-02-02 | 2013-10-30 | 松下电器产业株式会社 | 电阻变化元件的驱动方法、初始处理方法、以及非易失性存储装置 |
JP2011165883A (ja) * | 2010-02-09 | 2011-08-25 | Toshiba Corp | 半導体記憶装置およびその製造方法 |
JP5079927B2 (ja) | 2010-02-23 | 2012-11-21 | パナソニック株式会社 | 不揮発性メモリ装置の製造方法、不揮発性メモリ素子、および不揮発性メモリ装置 |
JP5121864B2 (ja) * | 2010-03-02 | 2013-01-16 | 株式会社東芝 | 不揮発性半導体記憶装置 |
US8481990B2 (en) | 2010-03-08 | 2013-07-09 | Panasonic Corporation | Nonvolatile memory element |
KR20110101983A (ko) * | 2010-03-10 | 2011-09-16 | 삼성전자주식회사 | 바이폴라 메모리셀 및 이를 포함하는 메모리소자 |
JP5001464B2 (ja) * | 2010-03-19 | 2012-08-15 | パナソニック株式会社 | 不揮発性記憶素子、その製造方法、その設計支援方法および不揮発性記憶装置 |
WO2011118185A1 (ja) * | 2010-03-25 | 2011-09-29 | パナソニック株式会社 | 不揮発性記憶素子の駆動方法および不揮発性記憶装置 |
US8848421B2 (en) | 2010-03-30 | 2014-09-30 | Panasonic Corporation | Forming method of performing forming on variable resistance nonvolatile memory element, and variable resistance nonvolatile memory device |
EP2561545B1 (en) * | 2010-04-19 | 2017-10-25 | Hewlett-Packard Enterprise Development LP | Nanoscale switching devices with partially oxidized electrodes |
JP5154711B2 (ja) | 2010-04-21 | 2013-02-27 | パナソニック株式会社 | 不揮発性記憶装置及びその製造方法 |
CN102270738A (zh) * | 2010-06-03 | 2011-12-07 | 北京大学 | 包含电阻器的存储单元的制造方法 |
WO2011155210A1 (ja) * | 2010-06-10 | 2011-12-15 | パナソニック株式会社 | 不揮発性記憶素子およびそれを備えた不揮発性記憶装置 |
CN102473707A (zh) | 2010-07-01 | 2012-05-23 | 松下电器产业株式会社 | 非易失性存储单元、非易失性存储单元阵列、以及其制造方法 |
US8785238B2 (en) | 2010-07-01 | 2014-07-22 | Panasonic Corporation | Nonvolatile memory element and method for manufacturing same |
CN101894911A (zh) * | 2010-07-13 | 2010-11-24 | 复旦大学 | 高数据保持能力的电阻型存储器的制备方法 |
US8884261B2 (en) | 2010-08-23 | 2014-11-11 | Crossbar, Inc. | Device switching using layered device structure |
WO2012008160A1 (ja) * | 2010-07-14 | 2012-01-19 | パナソニック株式会社 | 不揮発性記憶装置及びその製造方法 |
US9012294B2 (en) | 2010-07-27 | 2015-04-21 | Panasonic Intellectual Property Management Co., Ltd. | Manufacturing method of non-volatile memory device |
KR20120021539A (ko) * | 2010-08-06 | 2012-03-09 | 삼성전자주식회사 | 비휘발성 메모리요소 및 이를 포함하는 메모리소자 |
JP5000788B2 (ja) * | 2010-08-17 | 2012-08-15 | パナソニック株式会社 | 不揮発性記憶装置およびその製造方法 |
KR101744758B1 (ko) * | 2010-08-31 | 2017-06-09 | 삼성전자 주식회사 | 비휘발성 메모리요소 및 이를 포함하는 메모리소자 |
WO2012042866A1 (ja) * | 2010-09-28 | 2012-04-05 | パナソニック株式会社 | 抵抗変化型不揮発性記憶素子のフォーミング方法 |
US20130082230A1 (en) * | 2010-10-01 | 2013-04-04 | Koji Katayama | Method of manufacturing nonvolatile memory element, and nonvolatile memory element |
JP5680927B2 (ja) * | 2010-10-01 | 2015-03-04 | シャープ株式会社 | 可変抵抗素子、及び、不揮発性半導体記憶装置 |
US9184381B2 (en) | 2010-10-08 | 2015-11-10 | Panasonic Intellectual Property Management Co., Ltd. | Nonvolatile storage element and method for manufacturing same |
JP5000026B2 (ja) | 2010-10-29 | 2012-08-15 | パナソニック株式会社 | 不揮発性記憶装置 |
US8377718B2 (en) * | 2010-11-10 | 2013-02-19 | Micron Technology, Inc. | Methods of forming a crystalline Pr1-xCaxMnO3 (PCMO) material and methods of forming semiconductor device structures comprising crystalline PCMO |
US8574957B2 (en) | 2010-11-12 | 2013-11-05 | Panasonic Corporation | Method for manufacturing nonvolatile semiconductor memory element |
CN102714210B (zh) | 2010-11-19 | 2015-08-12 | 松下电器产业株式会社 | 非易失性存储元件以及非易失性存储元件的制造方法 |
US8889478B2 (en) | 2010-11-19 | 2014-11-18 | Panasonic Corporation | Method for manufacturing nonvolatile semiconductor memory element, and nonvolatile semiconductor memory element |
CN103229299B (zh) | 2010-11-24 | 2015-11-25 | 松下电器产业株式会社 | 非易失性存储元件、其制造方法、非易失性存储装置和非易失性存储元件的设计支援方法 |
WO2012073503A1 (ja) * | 2010-12-03 | 2012-06-07 | パナソニック株式会社 | 不揮発性記憶素子ならびに不揮発性記憶装置及びそれらの製造方法 |
US8692222B2 (en) | 2010-12-27 | 2014-04-08 | Panasonic Corporation | Nonvolatile memory element and method of manufacturing the nonvolatile memory element |
US8437177B2 (en) | 2011-01-20 | 2013-05-07 | Panasonic Corporation | Nonvolatile latch circuit and nonvolatile flip-flop circuit |
WO2012105214A1 (ja) * | 2011-01-31 | 2012-08-09 | パナソニック株式会社 | 抵抗変化型素子の製造方法 |
JP5075294B2 (ja) | 2011-02-07 | 2012-11-21 | パナソニック株式会社 | 不揮発性ラッチ回路、不揮発性フリップフロップ回路および不揮発性信号処理装置 |
US20130140515A1 (en) * | 2011-02-23 | 2013-06-06 | Yoshio Kawashima | Nonvolatile memory element and method of manufacturing the same |
JP5438707B2 (ja) * | 2011-03-04 | 2014-03-12 | シャープ株式会社 | 可変抵抗素子及びその製造方法、並びに、当該可変抵抗素子を備えた不揮発性半導体記憶装置 |
US8927331B2 (en) | 2011-03-10 | 2015-01-06 | Panasonic Corporation | Method of manufacturing nonvolatile memory device |
US9153319B2 (en) | 2011-03-14 | 2015-10-06 | Panasonic Intellectual Property Management Co., Ltd. | Method for driving nonvolatile memory element, and nonvolatile memory device having a variable resistance element |
US8847196B2 (en) * | 2011-05-17 | 2014-09-30 | Micron Technology, Inc. | Resistive memory cell |
KR20140007493A (ko) * | 2011-06-08 | 2014-01-17 | 가부시키가이샤 아루박 | 저항 변화 소자의 제조 방법 및 그 제조 장치 |
CN103597597B (zh) * | 2011-06-10 | 2016-09-14 | 株式会社爱发科 | 可变电阻元件及其制造方法 |
KR20120139082A (ko) | 2011-06-16 | 2012-12-27 | 삼성전자주식회사 | 멀티비트 메모리요소, 이를 포함하는 메모리소자 및 이들의 제조방법 |
US9252189B2 (en) | 2011-06-27 | 2016-02-02 | Panasonic Intellectual Property Management Co., Ltd. | Nonvolatile semiconductor memory element, nonvolatile semiconductor memory device, and method for manufacturing nonvolatile semiconductor memory device |
US8619471B2 (en) * | 2011-07-27 | 2013-12-31 | Micron Technology, Inc. | Apparatuses and methods including memory array data line selection |
US8866121B2 (en) | 2011-07-29 | 2014-10-21 | Sandisk 3D Llc | Current-limiting layer and a current-reducing layer in a memory device |
US8867259B2 (en) | 2011-08-11 | 2014-10-21 | Panasonic Corporation | Method of programming variable resistance nonvolatile memory element |
US8659001B2 (en) | 2011-09-01 | 2014-02-25 | Sandisk 3D Llc | Defect gradient to boost nonvolatile memory performance |
WO2013038647A1 (ja) | 2011-09-16 | 2013-03-21 | パナソニック株式会社 | 不揮発性記憶素子、不揮発性記憶装置、不揮発性記憶素子の製造方法、及び不揮発性記憶装置の製造方法 |
WO2013046603A1 (ja) * | 2011-09-27 | 2013-04-04 | パナソニック株式会社 | 不揮発性記憶素子、不揮発性記憶装置及びそれらの製造方法 |
US20130286714A1 (en) * | 2011-09-28 | 2013-10-31 | Panasonic Corporation | Data write method for writing data to nonvolatile memory element, and nonvolatile memory device |
JP5352032B2 (ja) | 2011-10-06 | 2013-11-27 | パナソニック株式会社 | 不揮発性記憶素子および不揮発性記憶装置 |
WO2013054506A1 (ja) | 2011-10-11 | 2013-04-18 | パナソニック株式会社 | 半導体記憶素子の製造方法 |
WO2013054515A1 (ja) * | 2011-10-12 | 2013-04-18 | パナソニック株式会社 | 不揮発性半導体記憶装置およびその製造方法 |
JP5874905B2 (ja) * | 2011-10-18 | 2016-03-02 | 国立研究開発法人物質・材料研究機構 | アルミナ抵抗変化型メモリ素子の製造方法 |
CN102368535B (zh) * | 2011-11-10 | 2013-11-27 | 复旦大学 | 一种可擦写式双层薄膜结构阻变存储单元及其制备方法 |
KR20130052371A (ko) * | 2011-11-11 | 2013-05-22 | 삼성전자주식회사 | 비휘발성 메모리요소 및 이를 포함하는 메모리소자 |
JP5340508B1 (ja) | 2011-11-17 | 2013-11-13 | パナソニック株式会社 | 抵抗変化型不揮発性記憶装置及びその製造方法 |
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US8637413B2 (en) | 2011-12-02 | 2014-01-28 | Sandisk 3D Llc | Nonvolatile resistive memory element with a passivated switching layer |
JP5250726B1 (ja) | 2011-12-02 | 2013-07-31 | パナソニック株式会社 | 抵抗変化型不揮発性記憶素子の書き込み方法および抵抗変化型不揮発性記憶装置 |
JP5427982B2 (ja) | 2011-12-19 | 2014-02-26 | パナソニック株式会社 | 不揮発性記憶装置及びその製造方法 |
JP5871313B2 (ja) * | 2012-01-18 | 2016-03-01 | 国立大学法人大阪大学 | 不揮発性メモリセル、これを備える不揮発性メモリ装置および遷移金属酸化物の選定方法。 |
US8698119B2 (en) | 2012-01-19 | 2014-04-15 | Sandisk 3D Llc | Nonvolatile memory device using a tunnel oxide as a current limiter element |
JP5873981B2 (ja) * | 2012-01-19 | 2016-03-01 | パナソニックIpマネジメント株式会社 | 抵抗変化型不揮発性記憶装置の製造方法及び抵抗変化型不揮発性記憶装置 |
WO2013111548A1 (ja) | 2012-01-23 | 2013-08-01 | パナソニック株式会社 | 不揮発性記憶素子及びその製造方法 |
WO2013111545A1 (ja) | 2012-01-25 | 2013-08-01 | パナソニック株式会社 | 抵抗変化型不揮発性記憶素子とその製造方法 |
JP5450911B2 (ja) * | 2012-02-17 | 2014-03-26 | パナソニック株式会社 | 不揮発性記憶素子のデータ読み出し方法及び不揮発性記憶装置 |
US8686386B2 (en) * | 2012-02-17 | 2014-04-01 | Sandisk 3D Llc | Nonvolatile memory device using a varistor as a current limiter element |
US9082971B2 (en) | 2012-02-20 | 2015-07-14 | Panasonic Intellectual Property Management Co., Ltd. | Nonvolatile memory device and method for manufacturing the same |
US8878152B2 (en) * | 2012-02-29 | 2014-11-04 | Intermolecular, Inc. | Nonvolatile resistive memory element with an integrated oxygen isolation structure |
JP2013201276A (ja) | 2012-03-23 | 2013-10-03 | Toshiba Corp | 抵抗変化素子及び不揮発性記憶装置 |
JP5400253B1 (ja) | 2012-03-23 | 2014-01-29 | パナソニック株式会社 | 抵抗変化型不揮発性記憶素子の書き込み方法および抵抗変化型不揮発性記憶装置 |
JP5597320B2 (ja) | 2012-03-29 | 2014-10-01 | パナソニック株式会社 | 不揮発性記憶装置の製造方法 |
US9685608B2 (en) * | 2012-04-13 | 2017-06-20 | Crossbar, Inc. | Reduced diffusion in metal electrode for two-terminal memory |
WO2013157261A1 (ja) * | 2012-04-20 | 2013-10-24 | パナソニック株式会社 | 不揮発性記憶素子の駆動方法および不揮発性記憶装置 |
KR20150006825A (ko) | 2012-04-26 | 2015-01-19 | 휴렛-팩커드 디벨롭먼트 컴퍼니, 엘.피. | 맞춤식 비선형 전기 장치 |
WO2014025434A2 (en) * | 2012-05-15 | 2014-02-13 | The Regents Of The University Of Michigan | Complementary resistive switching in single resistive memory devices |
US9741765B1 (en) | 2012-08-14 | 2017-08-22 | Crossbar, Inc. | Monolithically integrated resistive memory using integrated-circuit foundry compatible processes |
CN102779941B (zh) * | 2012-08-22 | 2015-02-18 | 中国科学院上海微系统与信息技术研究所 | 低功耗相变存储单元及其制备方法 |
KR101607820B1 (ko) * | 2012-09-05 | 2016-03-30 | 가부시키가이샤 아루박 | 저항 변화 소자 및 그 제조 방법 |
KR20140035558A (ko) * | 2012-09-14 | 2014-03-24 | 삼성전자주식회사 | 가변 저항 메모리 장치 및 그 동작 방법 |
JP5571833B2 (ja) | 2012-09-14 | 2014-08-13 | パナソニック株式会社 | 不揮発性記憶素子及び不揮発性記憶素子の製造方法 |
US20140077149A1 (en) * | 2012-09-14 | 2014-03-20 | Industrial Technology Research Institute | Resistance memory cell, resistance memory array and method of forming the same |
JP5636081B2 (ja) | 2012-09-26 | 2014-12-03 | パナソニック株式会社 | 不揮発性記憶装置およびその製造方法 |
JP5572749B2 (ja) | 2012-09-26 | 2014-08-13 | パナソニック株式会社 | 不揮発性記憶素子及びその製造方法 |
US9047945B2 (en) | 2012-10-15 | 2015-06-02 | Marvell World Trade Ltd. | Systems and methods for reading resistive random access memory (RRAM) cells |
US9042159B2 (en) * | 2012-10-15 | 2015-05-26 | Marvell World Trade Ltd. | Configuring resistive random access memory (RRAM) array for write operations |
US8885388B2 (en) | 2012-10-24 | 2014-11-11 | Marvell World Trade Ltd. | Apparatus and method for reforming resistive memory cells |
WO2014070852A1 (en) | 2012-10-31 | 2014-05-08 | Marvell World Trade Ltd. | Sram cells suitable for fin field-effect transistor (finfet) process |
CN105190760B (zh) | 2012-11-12 | 2018-04-24 | 马维尔国际贸易有限公司 | 在存储器系统中并行地使用具有nmos通过门和pmos通过门两者的sram单元 |
US9172038B2 (en) | 2012-11-14 | 2015-10-27 | Panasonic Intellectual Property Management Co., Ltd. | Nonvolatile memory element and method of manufacturing the same |
JP2014103326A (ja) | 2012-11-21 | 2014-06-05 | Panasonic Corp | 不揮発性記憶素子およびその製造方法 |
JP5583738B2 (ja) * | 2012-11-22 | 2014-09-03 | 株式会社半導体理工学研究センター | 抵抗変化型メモリ |
US20140175367A1 (en) * | 2012-12-20 | 2014-06-26 | Intermolecular Inc. | Materials for Thin Resisive Switching Layers of Re-RAM Cells |
CN103066206B (zh) * | 2012-12-25 | 2016-03-23 | 清华大学 | 一种阻变式存储单元及其形成方法 |
JP2014127566A (ja) * | 2012-12-26 | 2014-07-07 | Panasonic Corp | 不揮発性記憶装置の製造方法および不揮発性記憶装置 |
FR3001571B1 (fr) * | 2013-01-30 | 2016-11-25 | Commissariat Energie Atomique | Procede de programmation d'un dispositif memoire a commutation bipolaire |
JP5650855B2 (ja) | 2013-02-08 | 2015-01-07 | パナソニックIpマネジメント株式会社 | 不揮発性記憶素子の製造方法、不揮発性記憶素子及び不揮発性記憶装置 |
US20140241031A1 (en) | 2013-02-28 | 2014-08-28 | Sandisk 3D Llc | Dielectric-based memory cells having multi-level one-time programmable and bi-level rewriteable operating modes and methods of forming the same |
JP6201151B2 (ja) | 2013-03-18 | 2017-09-27 | パナソニックIpマネジメント株式会社 | 不揮発性記憶装置及びその製造方法 |
JP2014211937A (ja) | 2013-04-03 | 2014-11-13 | パナソニック株式会社 | 抵抗変化型不揮発性記憶素子の書き込み方法および抵抗変化型不揮発性記憶装置 |
KR101977271B1 (ko) * | 2013-04-05 | 2019-05-10 | 에스케이하이닉스 주식회사 | 반도체 장치의 제조 방법 |
JP6251885B2 (ja) | 2013-04-26 | 2017-12-27 | パナソニックIpマネジメント株式会社 | 抵抗変化型不揮発性記憶装置およびその書き込み方法 |
US9478584B2 (en) | 2013-12-16 | 2016-10-25 | Panasonic Intellectual Property Management Co., Ltd. | Nonvolatile memory device and method for manufacturing the same |
US10290801B2 (en) | 2014-02-07 | 2019-05-14 | Crossbar, Inc. | Scalable silicon based resistive memory device |
US9054308B1 (en) * | 2014-03-04 | 2015-06-09 | Sandisk 3D Llc | Plasma reduction method for modifying metal oxide stoichiometry in ReRAM |
JP6391009B2 (ja) | 2014-03-17 | 2018-09-19 | パナソニックIpマネジメント株式会社 | 抵抗変化型不揮発性記憶素子の製造方法 |
US9847481B2 (en) * | 2015-10-27 | 2017-12-19 | Taiwan Semiconductor Manufacturing Co., Ltd. | Metal landing on top electrode of RRAM |
US9653682B1 (en) * | 2016-02-05 | 2017-05-16 | Taiwan Semiconductor Manufacturing Company Ltd. | Resistive random access memory structure |
US9923139B2 (en) * | 2016-03-11 | 2018-03-20 | Micron Technology, Inc. | Conductive hard mask for memory device formation |
WO2018057022A1 (en) * | 2016-09-25 | 2018-03-29 | Intel Corporation | Barriers for metal filament memory devices |
US11018189B2 (en) * | 2017-04-11 | 2021-05-25 | Sony Semiconductor Solutions Corporation | Storage apparatus |
US10163781B1 (en) * | 2017-05-31 | 2018-12-25 | Taiwan Semiconductor Manufacturing Co., Ltd. | Semiconductor devices and methods of forming the same |
KR102492033B1 (ko) * | 2018-03-26 | 2023-01-26 | 에스케이하이닉스 주식회사 | 메모리 장치 및 이를 포함하는 메모리 시스템 |
US10839886B2 (en) * | 2018-06-11 | 2020-11-17 | Western Digital Technologies, Inc. | Method and apparatus for adaptive data retention management in non-volatile memory |
JP7308026B2 (ja) | 2018-12-26 | 2023-07-13 | ヌヴォトンテクノロジージャパン株式会社 | 抵抗変化型不揮発性記憶素子及びそれを用いた抵抗変化型不揮発性記憶装置 |
CN114093908A (zh) | 2020-08-24 | 2022-02-25 | 联华电子股份有限公司 | 混合式随机存取存储器的系统架构、结构以及其制作方法 |
Family Cites Families (20)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH07263647A (ja) | 1994-02-04 | 1995-10-13 | Canon Inc | 電子回路装置 |
IL143649A0 (en) * | 1999-02-17 | 2002-04-21 | Ibm | Microelectronic device for storing information and method thereof |
US6473332B1 (en) | 2001-04-04 | 2002-10-29 | The University Of Houston System | Electrically variable multi-state resistance computing |
US6965137B2 (en) | 2002-08-02 | 2005-11-15 | Unity Semiconductor Corporation | Multi-layer conductive memory device |
US6927120B2 (en) | 2003-05-21 | 2005-08-09 | Sharp Laboratories Of America, Inc. | Method for forming an asymmetric crystalline structure memory cell |
KR100773537B1 (ko) | 2003-06-03 | 2007-11-07 | 삼성전자주식회사 | 한 개의 스위칭 소자와 한 개의 저항체를 포함하는비휘발성 메모리 장치 및 그 제조 방법 |
KR101051704B1 (ko) | 2004-04-28 | 2011-07-25 | 삼성전자주식회사 | 저항 구배를 지닌 다층막을 이용한 메모리 소자 |
JP4830275B2 (ja) | 2004-07-22 | 2011-12-07 | ソニー株式会社 | 記憶素子 |
JP4848633B2 (ja) * | 2004-12-14 | 2011-12-28 | ソニー株式会社 | 記憶素子及び記憶装置 |
KR100693409B1 (ko) | 2005-01-14 | 2007-03-12 | 광주과학기술원 | 산화막의 저항변화를 이용한 비휘발성 기억소자 및 그제조방법 |
JP2006203098A (ja) | 2005-01-24 | 2006-08-03 | Sharp Corp | 不揮発性半導体記憶装置 |
JP5049483B2 (ja) * | 2005-04-22 | 2012-10-17 | パナソニック株式会社 | 電気素子,メモリ装置,および半導体集積回路 |
KR100960208B1 (ko) * | 2005-07-29 | 2010-05-27 | 후지쯔 가부시끼가이샤 | 저항 기억 소자 및 불휘발성 반도체 기억 장치 |
US7834338B2 (en) * | 2005-11-23 | 2010-11-16 | Sandisk 3D Llc | Memory cell comprising nickel-cobalt oxide switching element |
JP3989506B2 (ja) | 2005-12-27 | 2007-10-10 | シャープ株式会社 | 可変抵抗素子とその製造方法ならびにそれを備えた半導体記憶装置 |
JPWO2007138646A1 (ja) | 2006-05-25 | 2009-10-01 | 株式会社日立製作所 | 不揮発性メモリ素子およびその製造方法ならびに不揮発性メモリ素子を用いた半導体装置 |
JP5010891B2 (ja) * | 2006-10-16 | 2012-08-29 | 富士通株式会社 | 抵抗変化型素子 |
CN101636840B (zh) * | 2006-11-17 | 2011-05-25 | 松下电器产业株式会社 | 非易失性存储元件、非易失性存储器件、非易失性半导体器件以及非易失性存储元件的制造方法 |
CN101711431B (zh) * | 2007-05-09 | 2015-11-25 | 分子间公司 | 阻变型非易失性存储元件 |
US7863087B1 (en) * | 2007-05-09 | 2011-01-04 | Intermolecular, Inc | Methods for forming resistive-switching metal oxides for nonvolatile memory elements |
-
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