JP3501491B2 - スイッチングレギュレータ回路において高効率を広い電流範囲にわたって維持するための制御回路および方法 - Google Patents
スイッチングレギュレータ回路において高効率を広い電流範囲にわたって維持するための制御回路および方法Info
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Description
ータ回路に関する。特に、本発明は、スイッチングレギ
ュレータ回路において高効率を広い電流範囲にわたって
維持するための制御回路および方法に関する。
されない変動入力電圧源から、所定の一定出力電圧を負
荷に供給することである。一般に、2つの異なるタイプ
のレギュレータがある:シリーズレギュレータとスイッ
チングレギュレータである。
続した直列要素(例えば、パワートランジスタ)を用
い、負荷に印加される電圧を制御するするために直列要
素の電圧降下を制御する。これとは対照的に、スイッチ
ングレギュレータは、負荷に直列または並列に接続され
たスイッチ(例えば、パワートランジスタ)を用いる。
レギュレータは、負荷への電力の流れを制御するために
スイッチのターンオンおよびターンオフを制御する。ス
イッチングレギュレータは、誘導エネルギー貯蔵素子を
用いて、スイッチングされた電流パルスを安定負荷電流
に変換する。このため、シリーズレギュレータにおいて
は、電力は、安定電流として直列要素を伝送されるのに
対して、スイッチングレギュレータにおいては、電力
は、断続する電流パルスの形でスイッチを伝送される。
イッチングレギュレータは、通常、スイッチをターンオ
ンおよびターンオフするための制御回路を有する。負荷
への電力の流れを制御するスイッチのデューティーサイ
クルは、種々の方法に応じて変化し得る。例えば、デュ
ーティーサイクルは、(1)パルスストリーム周波数を
固定し、各パルスのオンまたはオフ時間を変化させるこ
と、または(2)各パルスのオンまたはオフ時間を固定
し、パルスストリーム周波数を変化させることによって
変化させることが可能である。
ずれの方法を用いたとしても、スイッチングレギュレー
タは、一般に、シリーズレギュレータよりもより効率的
である。シリーズレギュレータでは、直列要素は、一般
に、直列要素が電流を連続して導電する線形領域におい
て動作する。この結果、直列トランジスタにおいて電力
が連続して散逸する。これとは対照的に、スイッチング
レギュレータでは、スイッチがオフとなるときには電力
がスイッチによって散逸せず、低インピーダンス状態で
オンとなるときには少量の電力がスイッチによって散逸
する。この動作の相違により、一般に、スイッチングレ
ギュレータでは、より少ない量の平均電力が散逸するこ
とになる。
力−出力電圧差が大きいときほどより明確にあらわれ
る。例えば、同等の機能を果たすのに、スイッチングレ
ギュレータが、75%を上回る効率で行うことができる
のに対して、シリーズレギュレータは、25%未満の効
率でしか行うことができないこともまれなことではな
い。
ギュレータよりもより優れた効率を有するため、通常、
ポータブルおよびラップトップコンピュータおよび手持
ち器具などの電池駆動システムで使用される。このよう
なシステムでは、スイッチングレギュレータが定格出力
電流付近を供給する場合(例えば、ポータブルまたはラ
ップトップコンピュータにおいてディスクドライブまた
はハードドライブがオンの場合)、回路全体の効率は高
くなり得る。しかし、効率は、一般に、出力電流の関数
であり、通常、低出力電流で減少する。この効率低下
は、一般に、スイッチングレギュレータの動作に伴う損
失に原因がある。これらの損失には、とりわけ、レギュ
レータの制御回路における静止電流の損失、スイッチの
損失、スイッチ駆動電流の損失およびインダクタ/トラ
ンスフォーマの巻線およびコアの損失が含まれる。
効率が低下することは、電池寿命を最大にすることが所
望される電池駆動システムにおいては深刻な問題となり
得る。
を鑑みて成されたものであり、高効率のスイッチングレ
ギュレータを提供すること、およびスイッチングレギュ
レータ回路において、高効率を、低い出力電流を含む広
い電流範囲にわたって維持するための制御回路および方
法を提供することを目的とする。
ると、スイッチング電圧レギュレータを制御する回路で
あって、該レギュレータは、(1)入力電圧を受け取る
ことができるように接続され、一対の同期してスイッチ
ングされるスイッチングトランジスタを含むスイッチ
と、(2)出力コンデンサを含む負荷に、制御された電
圧で電流を供給する出力とを含み、該回路は、該出力を
モニタして第1帰還信号を発生する第1回路と、第1状
態の回路動作中に第1制御信号を発生する第2回路であ
って、該第1制御信号が、該第1帰還信号に応答して、
該スイッチングトランジスタのデューティーサイクルを
変化させて、該出力を該制御された電圧で維持する、第
2回路と、第2状態の回路動作中に第2制御信号を発生
して、該出力コンデンサが実質的に該制御された電圧で
該出力を維持する第1期間に、該スイッチングトランジ
スタを両方とも同時にオフにする、第3回路と、を含む
回路が提供される。
2制御信号が、前記第1帰還信号に応答して発生され
る。
が、第1しきい値レベルに降下した前記第1帰還信号の
大きさに応答して、前記第2動作状態から前記第1動作
状態に変化する。
記回路が、前記第1しきい値レベルよりも大きい第2し
きい値レベルを越えた前記第1帰還信号の大きさに応答
して、前記第1動作状態から前記第2動作状態に変化す
る。
記第1帰還信号が電圧帰還信号であり、前記第3回路が
ヒステリシスを有する電圧比較器を有する。
記スイッチング電圧レギュレータで消費される電流が、
前記第2動作状態で低減される。
記第2回路が、前記第1制御信号を発生するワンショッ
ト回路を含み、該第1制御信号が、スイッチサイクルの
第2期間中に発生される。
記第2期間が所定の期間である。
記第2回路が、前記負荷に供給される前記電流をモニタ
して、電流帰還信号を発生する第4回路を含む。
記スイッチが、インダクタに接続されるように設計さ
れ、前記第4回路が該インダクタの電流をモニタして、
前記電流帰還信号を発生する。
記第4回路が、前記電流帰還信号と基準電流値とを比較
し、該電流帰還信号が該基準電流値よりも大きいときに
は、前記ワンショット回路をトリガする。
記第4回路が、前記ワンショット回路をトリガする電流
比較器を含み、該電流比較器が、前記電流帰還信号を受
け取ることができるように接続された第1入力と、前記
基準電流値を提供する電流源に接続された第2入力とを
含む。
記電流源が、前記第1帰還信号と一定電圧との間の電圧
差に実質的に比例した電流を供給する、相互コンダクタ
ンス増幅器と、該相互コンダクタンス増幅器と並列に接
続された一定の電流源と、を含む。
記第2期間が前記入力電圧に依存する。
記スイッチがインダクタに接続され、前記第2期間が前
記入力電圧の低下に応答して減少し、それによって、該
インダクタを介したリップル電流の振動周波数が可聴周
波数からユーザノイズを実質的に発生しない周波数に増
加する。
記第2期間が前記負荷の電圧に依存する。
記スイッチがインダクタに接続され、前記第2期間が前
記負荷の電圧降下に応答して増加し、それによって、前
記第1制御信号が発生される間に、該インダクタを介し
た電流の降下の合計が増加する。
記第2動作状態で前記ワンショット回路が実質的にオフ
に維持され、それによって、前記回路が前記第1動作状
態から該第2動作状態に変化するにつれて、前記スイッ
チングレギュレータ回路の効率が増加する。
記電流比較器が前記第2動作状態で実質的にオフに維持
され、それによって、前記回路が前記第1動作状態から
該第2動作状態に変化するにつれて、前記スイッチング
レギュレータ回路の効率が増加する。
記第3回路が、ユーザ駆動スイッチを含み、前記第2制
御信号が、該ユーザ駆動スイッチの駆動に応答して発生
される。
記第2回路が、前記第1動作状態で、前記帰還信号と一
定電圧との間の電圧差に実質的に比例した電流を供給す
る、相互コンダクタンス増幅器を含み、前記ユーザ駆動
スイッチの駆動が、ヒステリシスを前記相互コンダクタ
ンス増幅器に導入する。
記第2回路が、前記第1制御信号を発生するワンショッ
ト回路を含み、該第1制御信号が、スイッチサイクルの
第2期間中に発生される。
記第2期間が所定の期間である。
記第2回路が、前記負荷に供給される前記電流をモニタ
して、電流帰還信号を発生する第4回路を含む。
記第4回路が、前記電流帰還信号と基準電流値とを比較
し、該電流帰還信号が該基準電流値よりも大きいときに
は、前記ワンショット回路をトリガする。
記第2期間が前記入力電圧に依存する。
記スイッチがインダクタに接続され、前記第2期間が前
記入力電圧の低下に応答して減少し、それによって、該
インダクタを介したリップル電流の振動周波数が可聴周
波数からユーザノイズを実質的に発生しない周波数に増
加する。
記第2期間が前記負荷の電圧に依存する。
記スイッチがインダクタに接続され、前記第2期間が前
記負荷の電圧降下に応答して増加し、それによって、前
記第1制御信号が発生される間に、該インダクタを介し
た電流の降下の合計が増加する。
記第2動作状態で前記ワンショット回路が実質的にオフ
に維持され、それによって、前記回路が前記第1動作状
態から該第2動作状態に変化するにつれて、前記スイッ
チング回路の効率が増加する。
記回路が、入力電圧とアースとの間に直列に接続された
第1および第2スイッチングトランジスタを有するスイ
ッチング電圧レギュレータを制御するように設計され、
該第1および第2スイッチングトランジスタが出力端末
で共通に接続され、前記入力電圧が、前記負荷の電圧よ
りも高く、それによって、該スイッチング電圧レギュレ
ータは降圧型電圧レギュレータとなる。本発明のさらに
他の実施態様によると、前記回路がスイッチング電圧レ
ギュレータを制御するように設計され、前記入力電圧が
前記負荷の電圧よりも低く、それによって、該スイッチ
ング電圧レギュレータはステップアップ電圧レギュレー
タとなる。
記回路が、スイッチング電圧レギュレータを制御するよ
うに設計され、前記入力電圧が、前記負荷の電圧とは反
対の極性を有し、それによって、該スイッチング電圧レ
ギュレータは極性反転電圧レギュレータとなる。
電圧レギュレータを制御する回路であって、該レギュレ
ータは、(1)入力電圧を受け取ることができるように
接続され、スイッチングトランジスタおよびスイッチン
グダイオードを含むスイッチと、(2)出力コンデンサ
を含む負荷に、制御された電圧で電流を供給する出力と
を含み、該回路は、該出力をモニタして第1帰還信号を
発生する第1回路と、第1状態の回路動作中に第1制御
信号を発生する第2回路であって、該第1制御信号が、
該第1帰還信号に応答して、該スイッチングトランジス
タのデューティーサイクルを変化させて、該出力を該制
御された電圧で維持する、第2回路と、第2状態の回路
動作中に第2制御信号を発生して、該出力コンデンサが
実質的に該制御された電圧で該出力を維持する第1期間
に、該スイッチングトランジスタを実質的にオフにし、
該第2制御信号が該第1帰還信号に応答する、第3回路
と、を含む回路が提供される。
2制御信号が、前記第1帰還信号に応答して発生され
る。
が、第1しきい値レベルに降下した前記第1帰還信号の
大きさに応答して、前記第2動作状態から前記第1動作
状態に変化する。
記回路が、前記第1しきい値レベルよりも大きい第2し
きい値レベルを越えた前記第1帰還信号の大きさに応答
して、前記第1動作状態から前記第2動作状態に変化す
る。
記第1帰還信号が電圧帰還信号であり、前記第3回路が
ヒステリシスを有する電圧比較器を有する。
記スイッチング電圧レギュレータで消費される電流が、
前記第3動作状態で低減される。
記第2回路が、前記第1制御信号を発生するワンショッ
ト回路を含み、該第1制御信号が、スイッチサイクルの
第2期間中に発生される。
記第2期間が所定の期間である。
記第2回路が、前記負荷に供給される前記電流をモニタ
して、電流帰還信号を発生する第4回路を含む。
記スイッチが、インダクタに接続されるように設計さ
れ、前記第4回路が該インダクタの電流をモニタして、
前記電流帰還信号を発生する。
記第4回路が、前記電流帰還信号と基準電流値とを比較
し、該電流帰還信号が該基準電流値よりも大きいときに
は、前記ワンショット回路をトリガする。
記第4回路が、前記ワンショット回路をトリガする電流
比較器を含み、該電流比較器が、前記電流帰還信号を受
け取ることができるように接続された第1入力と、前記
基準電流値を提供する電流源に接続された第2入力とを
含む。
記電流源が、前記帰還信号と一定電圧との間の電圧差に
実質的に比例した電流を供給する、相互コンダクタンス
増幅器と、該相互コンダクタンス増幅器と並列に接続さ
れた一定の電流源と、を含む。
記第2期間が前記入力電圧に依存する。
記スイッチがインダクタに接続され、前記第2期間が前
記入力電圧の低下に応答して減少し、それによって、該
インダクタを介したリップル電流の振動周波数が可聴周
波数からユーザノイズを実質的に発生しない周波数に増
加する。
記第2期間が前記負荷の電圧に依存する。
記スイッチがインダクタに接続され、前記第2期間が前
記負荷の電圧降下に応答して増加し、それによって、前
記第1制御信号が発生される間に、該インダクタを介し
た電流の降下の合計が増加する。
記第2動作状態で前記ワンショット回路が実質的にオフ
に維持され、それによって、前記回路が前記第1動作状
態から該第2動作状態に変化するにつれて、前記スイッ
チングレギュレータ回路の効率が増加する。
記電流比較器が前記第2動作状態で実質的にオフに維持
され、それによって、前記回路が前記第1動作状態から
該第2動作状態に変化するにつれて、前記スイッチング
レギュレータ回路の効率が増加する。
記回路が、入力電圧とアースとの間に直列に接続された
スイッチングトランジスタとスイッチングダイオードを
有するスイッチング電圧レギュレータを制御するように
設計され、該スイッチングトランジスタおよびスイッチ
ングダイオードが出力端末で共通に接続され、前記入力
電圧が、前記負荷の電圧よりも高く、それによって、該
スイッチング電圧レギュレータは降圧型電圧レギュレー
タとなる。本発明のさらに他の実施態様によると、前記
回路がスイッチング電圧レギュレータを制御するように
設計され、前記入力電圧が前記負荷の電圧よりも低く、
それによって、該スイッチング電圧レギュレータはステ
ップアップ電圧レギュレータとなる。
記回路が、スイッチング電圧レギュレータを制御するよ
うに設計され、前記入力電圧が、前記負荷の電圧とは反
対の極性を有し、それによって、該スイッチング電圧レ
ギュレータは極性反転電圧レギュレータとなる。
れた電圧で出力コンデンサを含む負荷に電流を供給する
ように設計された、スイッチおよび出力を有するスイッ
チング電圧レギュレータを制御する回路であって、該ス
イッチは、入力電圧と出力電圧との間に接続され、1つ
またはそれ以上のスイッチングトランジスタを含み、該
回路は、該出力をモニタして第1帰還信号を発生する第
1回路と、第1状態の回路動作中に第1制御信号を発生
する第2回路であって、該第1制御信号が、該第1帰還
信号に応答して、該1つまたはそれ以上のスイッチング
トランジスタのデューティーサイクルを変化させて、該
出力を該制御された電圧で維持し、該第2回路が、スイ
ッチサイクルの第1期間に該第1制御信号を発生するワ
ンショット回路を含み、該第1制御信号が、該入力電圧
および該出力電圧の少なくとも1つに依存している、第
2回路と、を含む回路が提供される。
1期間が前記入力電圧に依存する。本発明の他の実施態
様によると、前記スイッチがインダクタに接続され、前
記第1期間が前記入力電圧の低下に応答して減少し、そ
れによって、該インダクタを介したリップル電流の振動
周波数が可聴周波数からユーザノイズを実質的に発生し
ない周波数に増加する。
記第1期間が前記出力電圧に依存する。
記スイッチがインダクタに接続され、前記第1期間が前
記出力電圧の降下に応答して増加し、それによって、前
記第1制御信号が発生される間に、該インダクタを介し
た電流の降下の合計が増加する。
記ワンショット回路が、コンデンサと、該コンデンサの
放電レートを制御する可変電流源とを有し、該放電レー
トが、前記入力電圧および出力電圧の少なくとも1つに
依存して、前記第1期間を制御する。
記第1期間が前記入力電圧に依存する。
記スイッチがインダクタに接続され、前記第1期間が前
記入力電圧の低下に応答して減少し、それによって、該
インダクタを介したリップル電流の振動周波数が可聴周
波数からユーザノイズを実質的に発生しない周波数に増
加する。
記第1期間が前記出力電圧に依存する。
記スイッチがインダクタに接続され、前記第1期間が前
記出力電圧の降下に応答して増加し、それによって、前
記第1制御信号が発生される間に、該インダクタを介し
た電流の降下の合計が増加する。
チング電圧レギュレータを制御する回路であって、該レ
ギュレータは、(1)入力電圧を受け取ることができる
ように接続され、一対の同期してスイッチングされるス
イッチングトランジスタを含むスイッチと、(2)出力
コンデンサを含む負荷に、制御された電圧で電流を供給
する出力とを含み、該回路は、該出力の電圧を示す電圧
帰還信号を発生する第1手段と、第1状態の回路動作中
に第1制御信号を発生する第2手段であって、該第1制
御信号が、該電圧帰還信号に応答して、該スイッチング
トランジスタのデューティーサイクルを変化させて、該
出力を該制御された電圧で維持する、第2手段と、第2
状態の回路動作中に第2制御信号を発生して、該出力コ
ンデンサが実質的に該制御された電圧で該出力を維持す
る第1期間に、該スイッチングトランジスタを両方とも
同時にオフにする、第3手段と、を含む回路が提供され
る。
3手段がヒステリシスを有する電圧比較器を含む。
手段が、前記第1制御信号を発生するワンショット回路
を含み、該第1制御信号が、スイッチサイクルの第2期
間中に発生される。
記第2手段が、前記負荷に供給される前記電流をモニタ
して、電流帰還信号を発生する第4手段を含む。
記第4手段が、前記電流帰還信号と基準電流値とを比較
し、該電流帰還信号が該基準電流値よりも大きいときに
は、前記ワンショット回路をトリガする。
記第4手段が、前記ワンショット回路をトリガする電流
比較器を含み、該電流比較器が、前記電流帰還信号を受
け取ることができるように接続された第1入力と、前記
基準電流値を提供する電流源に接続された第2入力とを
含む。
記電流源が、前記帰還信号と一定電圧との間の電圧差に
実質的に比例した電流を供給する、相互コンダクタンス
増幅器と、該相互コンダクタンス増幅器と並列に接続さ
れた一定の電流源と、を含む。
チング電圧レギュレータを制御する回路であって、該レ
ギュレータは、(1)入力電圧を受け取ることができる
ように接続され、スイッチングトランジスタおよびスイ
ッチングダイオードを含むスイッチと、(2)出力コン
デンサを含む負荷に、制御された電圧で電流を供給する
出力とを含み、該回路は、該出力の電圧を示す電圧帰還
信号を発生する第1手段と、第1状態の回路動作中に第
1制御信号を発生する第2手段であって、該第1制御信
号が、該電圧帰還信号に応答して、該スイッチングトラ
ンジスタのデューティーサイクルを変化させて、該出力
を該制御された電圧で維持する、第2手段と、第2状態
の回路動作中に第2制御信号を発生して、該出力コンデ
ンサが実質的に該制御された電圧で該出力を維持する第
1期間に、該スイッチングトランジスタを実質的にオフ
にし、該第2制御信号が該電圧帰還信号に応答する、第
3手段と、を含む回路が提供される。
3手段がヒステリシスを有する電圧比較器を含む。
手段が、前記第1制御信号を発生するワンショット回路
を含み、該第1制御信号が、スイッチサイクルの第2期
間中に発生される。
記第2手段が、前記負荷に供給される前記電流をモニタ
して、電流帰還信号を発生する第4手段を含む。
記第4手段が、前記電流帰還信号と基準電流値とを比較
し、該電流帰還信号が該基準電流値よりも大きいときに
は、前記ワンショット回路をトリガする。
記第4手段が、前記ワンショット回路をトリガする電流
比較器を含み、該電流比較器が、前記電流帰還信号を受
け取ることができるように接続された第1入力と、前記
基準電流値を提供する電流源に接続された第2入力とを
含む。
記電流源が、前記帰還信号と一定電圧との間の電圧差に
実質的に比例した電流を供給する、相互コンダクタンス
増幅器と、該相互コンダクタンス増幅器と並列に接続さ
れた一定の電流源と、を含む。
チング電圧レギュレータを制御する方法であって、該レ
ギュレータは、(1)入力電圧を受け取ることができる
ように接続され、一対の同期してスイッチングされるス
イッチングトランジスタを含むスイッチと、(2)出力
コンデンサを含む負荷に、制御された電圧で電流を供給
する出力とを含み、該方法は、(a)該出力をモニタし
て第1帰還信号を発生する工程と、(b)第1状態の回
路動作中に該第1帰還信号に応答して、該スイッチング
トランジスタのデューティーサイクルを変化させて、該
出力を該制御された電圧で維持する工程と、(c)該第
1状態の回路動作後の第1期間に、該スイッチングトラ
ンジスタを両方とも同時にオフにし、第2状態の回路動
作中に放電することによって、該出力コンデンサが該出
力を実質的に該制御された電圧で維持できるようにする
工程と、(d)該第2状態の回路動作後に、該スイッチ
ングトランジスタの少なくとも1つをターンオンして、
該出力コンデンサを再充電する工程と、を包含する方法
が提供される。
イッチング電圧レギュレータが、前記スイッチングトラ
ンジスタの前記デューティーサイクルを変化させるワン
ショット回路を含み、前記工程(c)が、前記第2動作
状態で該ワンショット回路を実質的にオフに維持する工
程を包含する。
ッチング電圧レギュレータが、前記ワンショット回路を
トリガする電流比較器を含み、前記工程(c)が、前記
第2動作状態で該電流比較器を実質的にオフに維持する
工程を包含する。
チング電圧レギュレータを制御する方法であって、該レ
ギュレータは、(1)入力電圧を受け取ることができる
ように接続され、スイッチングトランジスタおよびスイ
ッチングダイオードを含むスイッチと、(2)出力コン
デンサを含む負荷に、制御された電圧で電流を供給する
出力とを含み、該方法は、(a)該出力をモニタして第
1帰還信号を発生する工程と、(b)第1状態の回路動
作中に該第1帰還信号に応答して、該スイッチングトラ
ンジスタのデューティーサイクルを変化させて、該出力
を該制御された電圧で維持する工程と、(c)該第1状
態の回路動作後の第1期間に、該第1期間信号に応答し
て該スイッチングトランジスタをオフにし、第2状態の
回路動作中に放電することによって、該出力コンデンサ
が該出力を実質的に該制御された電圧で維持できるよう
にする工程と、(d)該第2状態の回路動作後に、該ス
イッチングトランジスタをターンオンして、該出力コン
デンサを再充電する工程と、を包含する方法が提供され
る。
イッチング電圧レギュレータが、前記スイッチングトラ
ンジスタの前記デューティーサイクルを変化させるワン
ショット回路を含み、前記工程(c)が、前記第2動作
状態で該ワンショット回路を実質的にオフに維持する工
程を包含する。
ッチング電圧レギュレータが、前記ワンショット回路を
トリガする電流比較器を含み、前記工程(c)が、前記
第2動作状態で該電流比較器を実質的にオフに維持する
工程を包含する。
チング電圧レギュレータを制御する回路であって、該レ
ギュレータは、(1)入力電圧を受け取ることができる
ように接続され、一対の同期してスイッチングされるス
イッチングトランジスタを含むスイッチと、(2)出力
インダクタを含む負荷に、制御された電圧で電流を供給
する出力とを含み、該回路は、該出力をモニタして第1
帰還信号を発生する第1回路と、第1状態の回路動作中
に第1制御信号を発生する第2回路であって、該第1制
御信号が、該第1帰還信号に応答して、該スイッチング
トランジスタのデューティーサイクルを変化させて、該
出力を該制御された電圧で維持する、第2回路と、前記
負荷へ流れる電流をモニタし、第2状態の回路動作中に
第2制御信号を発生して、該モニタされた電流の大きさ
が電流しきい値未満であるときには、該スイッチングト
ランジスタの1つをオフに維持する、第3回路と、を含
む回路が提供される。
3回路が、前記インダクタを介した電流をモニタし、該
インダクタ電流が前記しきい値未満であるときには、該
第2制御信号を発生する。
回路が、前記インダクタを介した電流の極性反転を防止
する。
記第1帰還信号が電圧帰還信号であり、前記第3回路
が、前記モニタされた電流と前記電流しきい値とを比較
する電流比較器を含む。
記スイッチング電圧レギュレータで消費される電流が、
前記第2動作状態中に減少する。
記第2回路が、前記第1制御信号を発生するワンショッ
ト回路を含み、該第1制御信号が、スイッチサイクルの
第2期間中に発生される。
記第2期間が所定の期間である。
チング電圧レギュレータを制御する方法であって、該レ
ギュレータは、(1)入力電圧を受け取ることができる
ように接続され、一対の同期してスイッチングされるス
イッチングトランジスタを含むスイッチと、(2)イン
ダクタをを含む負荷に、制御された電圧で電流を供給す
る出力とを含み、該方法は、(a)該出力をモニタして
第1帰還信号を発生する工程と、(b)第1状態の回路
動作中に該第1帰還信号に応答して該スイッチングトラ
ンジスタのデューティーサイクルを変化させて、該出力
を該制御された電圧で維持する工程であって、該負荷へ
流れる該電流は極性を有する、工程と、(c)該第1状
態の回路動作後の第1期間に、該スイッチングトランジ
スタの1つをオフに維持して、該負荷へ流れる該電流の
極性が反転するのを防止する工程と、を包含する方法が
提供される。
程(c)が、前記負荷へ流れる前記電流をモニタして、
前記電流が電流しきい値未満になるときを検出する工程
(d)を含む。
(d)が、前記インダクタを介した電流をモニタするこ
とを含む。
記スイッチング電圧レギュレータによって消費される電
流が、前記第2動作状態で減少する。
が、出力コンデンサの電荷によって、実質的に制御され
た電圧(例えば、低出力電流)に維持され得る動作条件
下で、1つまたはそれ以上のスイッチングトランジスタ
をターンオフするための制御信号が発生される。このよ
うな制御信号が発生されている期間、負荷は、入力電源
からの電力を消費しなので、レギュレータ効率は増加す
る。所望されるなら、スイッチングトランジスタに加え
てスイッチングレギュレータの他の構成要素もまた、さ
らに電力を保存するために、意図的にオフに保持され得
る。本発明のこのさらなる特徴により、レギュレータ回
路全体の効率がさらに増加し得る。
れ以上のパワートランジスタを用いるスイッチを含む、
スイッチングレギュレータ回路の種々のタイプのスイッ
チを制御するために使用され得る。さらに、本発明の回
路および方法は、電圧降圧型、電圧ステップアップおよ
び極性反転構成を含む、種々のタイプのスイッチングレ
ギュレータ構成のスイッチを制御するために使用され得
る。
ッチングレギュレータの入力および出力電圧に応答し
て、スイッチング電圧のオフ時間を変化させることがで
きる。本発明のこの特徴により、低入力電圧条件下で、
スイッチングレギュレータからの可聴ノイズの放出が減
少する。さらに、ある特定のレギュレータ構成におい
て、出力電圧の短絡によって生じる電流暴走の可能性が
減少する。
を用いる典型的な従来のスイッチングレギュレータ回路
の概略ブロック図である。
を駆動するための制御DC出力電圧VOUT(例えば、5
V)を端子12に供給するために使用される。負荷14
は、例えば、ポータブルまたはラップトップコンピュー
タまたは他の電池駆動システムであり得る。回路10
は、端子14に接続された制御されていない電源電圧V
IN(例えば、12Vの電池)によって動作する。回路1
0は、プッシュプルスイッチ15、駆動回路20、出力
回路30および制御回路35を有している。
スとの間で直列にスタックされた2つの同期スイッチン
グパワーMOSFET16(P−チャネル)および17
(N−チャネル)を含むプッシュプルスイッチ15を駆
動するために使用される。駆動回路20に接続されたプ
ッシュプルスイッチ15は、通常、「ハーフブリッジ」
構成と呼ばれる。MOSFET16および17は、イン
ダクタ32(L1)および出力コンデンサ34
(COUT)を含む出力回路30に交互に電流を供給する
ために使用される。出力回路30は、制御された電圧V
OUTが負荷12に供給されるように、交流電流を平滑に
する。交流電流を供給するために、MOSFET16お
よび17は、それぞれ、P−チャネルドライバ26およ
びN−チャネルドライバ27によって駆動され、P−チ
ャネルドライバ26およびN−チャネルドライバ27
は、交互に制御回路35によって制御される。
(例えば、2から10マイクロセカンド)供給するワン
ショット回路25を有する。この一定期間に、MOSF
ET16はオフに、MOSFET17はオンに、それぞ
れドライバ26および27によって保持される。あるい
は、ワンショット回路25は、オンパルスを供給し、こ
の期間にMOSFET16はオンに、MOSFET17
はオフに保持される。従って、ワンショット回路25
は、MOSFET16および17を交互にオンおよびオ
フして、出力回路30に交流電流を供給する。ワンショ
ット回路35のデューティーサイクルは、電流増幅器3
9によって制御される。
2(36A/36B)を通じて出力電圧VOUTをモニタし
て、出力電圧VOUTに比例した帰還電圧VFBを供給す
る。制御回路35はまた、インダクタL1を通じて電流
ILをモニタして、インダクタ電流ILに比例した帰還電
流IFBを供給する。回路10は、帰還電圧VFBが基準回
路37によって供給される基準電圧VREFと実質的に等
しくなるように制御されるように、インダクタ電流IL
を制御することによって動作する。帰還電圧VFBが制御
されると、出力電圧VOUTは、R2に対する(R1+R2)
の比だけ高い電圧に制御される。
圧VFBと基準電圧VREFとを比較するために使用され
る。回路10は、以下のように出力電圧VOUTを制御す
る。スイッチ15が「オン」である各サイクルにおい
て、P−MOSFET16は、ターンオンし、インダク
タL1中の電流ILは、VIN−VOUTに応じたレートで直
線的に増加する。ILが相互コンダクタンス増幅器38
の出力38Aによって設定されるしきい値レベルまで直
線的に増加すると、電流比較器39は、ワンショットオ
フパルスをトリップおよびトリガし、スイッチ15の
「オフ」サイクルを開始する。「オフ」サイクル中、ワ
ンショット回路25は、P−MOSFET16をオフに
保持し、N−MOSFET17をオンにする。これによ
り、インダクタL1中の電流ILがVOUTに応じたレート
で直線的に減少する。従って、スイッチ15の周期的な
ターンオフのデューティーサイクルは、電流ILが制御
出力電圧VOUTを端子12において発生するように制御
される。
6Bの電圧降下は減少する。このことは、相互コンダク
タンス増幅器38の入力38Bに小さな誤差電圧が生じ
ることを意味し、この誤差電圧は出力38Aを増加させ
得るため、電流比較器39に対してより高いしきい値を
設定することになる。その結果、インダクタL1の電流
ILは、負荷電流を支持するのに必要なレベルまで増加
する。
(tOFF)は一定であるので、スイッチングレギュレー
タ回路10は、インダクタL1において(一定の出力電
圧VOUTに対して)一定のリップル電流を有するが、V
INと共に変化する周波数を有する。リップル振動周波数
は、以下の式で表される: fRIP =(1/tOFF)[1−(VOUT/VIN)] 図1の回路の欠点の1つは、リップル振動周波数fRIP
が、低入力電圧VINで可聴レベルまで低下し得ることで
ある。こうした低下は、例えば、スイッチングレギュレ
ータ回路に電力を供給する電池がほぼ放電してしまった
場合に発生し得る。次に、インダクタL1は、レギュレ
ータ回路を備えた装置を使用するユーザにわかるぐらい
のノイズを発生し得る。
OUTが短絡して接地される場合に、インダクタ電流ILが
うまく制御されないことである。インダクタ電流と電圧
との基本的な関係は、式di/dt=V/Lによって表
される。この式は、インダクタL1中の電流ILがオフ
時間に減衰するレートが、VOUTとN−MOSFET1
7のドレイン−ソース電圧VDSとの合計である、インダ
クタL1の電圧に依存することを意味している。短絡の
間、VDSは非常に低く、VOUTはゼロに近づき、結果と
して、tOFF中のインダクタL1の電流ILの減衰はほと
んどない。しかし、各オフサイクル後、P−MOSFE
T16は、電流比較器39が、ワンショット一定オフ時
間制御回路25を再びトリップするまで、ターンオンす
る。P−MOSFET16がオンである最小時間の間で
さえ、インダクタL1の電流ILは、tO FF中に減少し得
る量よりも多く増加し得る。これにより、短絡電流が破
壊レベルに達する暴走状態となる。
ダクタL1中の一定のリップル電流から生じる。tOFF
中、インダクタL1の電流ILは、レギュレータの出力
電流に関係なく、同じ量だけ常に直線的に減少する。低
出力電流では、これにより、インダクタL1の電流の極
性が反転し、負荷から電力を引き出す。次のオンサイク
ルで、この電流は、再度、正にランプし、平均インダク
タ電流は負荷電流と同等になる。スイッチ15のMOS
FETゲートの充電および放電によるスイッチング損失
と共に、この一定のリップル電流に関連する損失は、低
出力電流において効率を大幅に低下させ得る。このよう
な現象は、特に、インダクタL1の電流が反転し、電力
が負荷から引き出されて、N−MOSFET17を介し
て接地される場合に生じる。
MOSFET16およびN−MOSFET17のゲート
駆動である。一般に、一方のパワーMOSFETがター
ンオンする前に、他のパワーMOSFETがターンオフ
するように、ドライバ26および27には遅延が導入さ
れている。2つのMOSFETの導通期間のデッドタイ
ムが(例えば、素子、回路処理または温度変化により)
十分でないと、電流は、入力電源VINから直接アースま
で通過してしまう。この「貫通」効果は、効率を大幅に
低下させ、場合によっては、パワーMOSFETをオー
バヒートおよび破壊し得る。
ングMOSFETを含むスイッチを駆動するための、本
発明の高効率制御回路の第1実施態様を導入したスイッ
チングレギュレータ回路の概略ブロック図である。
1に示されるのと同様のプッシュプルスイッチ15、駆
動回路20および出力回路30を有している。さらに回
路50は、本発明の高効率制御回路70を有している。
のワンショット回路25、電流比較器39および増幅器
38を有している。しかし、制御回路70はまた、これ
らの構成要素に加えて、低平均電流レベルで高効率動作
を提供するための定電流源I172およびヒステリシス
比較器74を有している。
流源I172および比較器74は、出力コンデンサCOUT
によって、出力電圧VOUTが、制御された電圧VREGに実
質的に維持され得る条件下で、プッシュプルスイッチ1
5を、MOSFET16および17が同時にオフとなる
動作状態になるようにする。本願では、この動作状態を
「スリープモード」と呼ぶ。プッシュプルスイッチ15
がこのようなスリープモードとなる能力は、図1のレギ
ュレータ回路とは対照的である。図1のレギュレータ回
路では、2つのMOSFET16および17のうちの1
つが、常に、実質的にONとなるからである。本発明の
この特性により、レギュレータ回路の電力消費が減少す
る。なぜなら、プッシュプルスイッチ15は、スリープ
モードにおいては電力を散逸したり、または電力を負荷
RLからアースに引き出したりしないためである。
イッチ15が上記のスリープモードである間に、レギュ
レータ回路は、レギュレータがスリープモードである間
に必要とされない他の回路構成要素をオフし得る。例え
ば、図2に示される本発明の実施態様では、ワンショッ
ト回路25、電流比較器39、電流源I172および増
幅器38はまた、スリープモードでオフされ得る。本発
明のこの特性により、レギュレータ回路は、プッシュプ
ルスイッチ15のみがスリープモードで維持される場合
よりも高い効率で、動作することが可能になる。
力電流の20%より大きい負荷電流レベル)では、制御
回路70は、図1の制御回路35と同様に動作する。図
2において、帰還電流IFBは、再び、電流比較器39の
非反転入力に供給される。好ましくは増幅器38に設け
られるオフセットVOS76は、帰還電圧VFBのレベルを
基準電圧VREFよりわずかに低くシフトさせ、高い電流
条件下で、ヒステリシス比較器74の出力をハイレベル
に維持する。帰還電流IFBが、電流比較器39の反転入
力に供給される電流を上回る場合には、比較器39の出
力は、スイッチ「オフ」サイクルを開始するためにHI
GHになる。
25の出力25AがHIGHとなって、P−MOSFE
T16をオフに、N−MOSFET17をオンにする。
ワンショット回路25によって設定される一定時間後、
出力25AはLOWとなり、P−MOSFET16がオ
ンおよびN−MOSFET17がオフである次の「オ
ン」サイクルを開始する。
ータ回路50は、低出力電流レベルでスリープモードに
なる。ヒステリシス比較器74は、帰還電圧VFBをモニ
タし、帰還電圧VFBが、基準電圧VREFよりも大きい所
定の電圧値を越える場合にはLOWとなる。このような
条件は、制御された電圧VREGよりも大きい所定の電圧
値を越える出力電圧VOUTを示す。このようなオーバ電
圧条件は、増幅器38と並列に接続された定電流源I1
72を提供することによって、低平均出力電流で意図的
に誘導される。オーバ電圧条件下では、MOSFET1
6および17は、ANDゲート66およびNANDゲー
ト68によってオフに維持される。
還電流しきい値を設定する。これにより、各オンサイク
ルにおいてインダクタL1で必要とされる最小電流が比
較器39をトリップするように設定される。本発明によ
ると、電流比較器39は、ある電流レベルで意図的にオ
ンに保持される。この電流レベルとは、電流比較器39
がオンにならなければトリップするレベルである。従っ
て、制御された電圧VRE Gで出力電圧VOUTを維持するの
に必要な電流よりも大きな電流がインダクタL1に供給
される。その結果、出力電圧VOUTは、制御された電圧
VREGを越えて増加し始め、基準電圧VREFよりも大きい
所定の電圧値で、帰還電圧VFBがヒステリシス比較器7
4をトリップする。比較器74がトリップすると、その
出力はLOWになり、MOSFET16および17の両
方をオフにして、レギュレータ回路をスリープモードに
する。
時にオフである上記の動作状態(すなわち、「スリープ
モード」)では、出力負荷14は、出力コンデンサC
OUTによって実質的に支持される。ヒステリシス比較器
74は、帰還電圧VFBをモニタし、出力電圧VOUTが比
較器74のヒステリシス量だけ減少するように低下する
とき、駆動回路20は、新しいONサイクルが開始し
て、電流を負荷14に供給するように、スリープモード
(MOSFET16および17が両方ともオフされる状
態)から出る。負荷電流がLOWで維持されるならば、
出力コンデンサCOUTは、制御された電圧VREGよりも大
きい電圧レベルに再充電され、わずか数サイクル後、帰
還電圧VFBは、再び比較器74をトリップする。
MOSFET16および17が実質的に制御された電圧
レベルで出力電圧を維持する必要がなく、代わりに出力
コンデンサCOUTが出力電圧を維持することができる場
合には、MOSFET16および17を両方ともターン
オフする。出力電圧が、このようなモードで、制御され
た電圧レベル未満に低下する場合、制御回路70は、ス
イッチ15を一時的にターンオンし、出力コンデンサC
OUTを、制御された電圧よりも大きい電圧レベルに再充
電する。従って、出力電圧VOUTは、R2に対する(R1
+R2)の比で乗算されたヒステリシス電圧を用いて比
較器74によって分割された高いしきい値と低いしきい
値との間で振動する。レギュレータが「ウェイクアッ
プ」して出力コンデンサCOUTを再充電するレートは、
負荷電流に自動的に適応され、低い出力電流でも高い効
率が維持される。
流が十分に低く、出力コンデンサCOUTが、実質的に制
御された電圧で出力電圧を維持することが可能な期間に
わたって、MOSFET16および17をオフに維持す
る。通常、そのようなオフ時間の期間、すなわち、スイ
ッチングレギュレータが制御された電圧を供給するが、
MOSFET16および17がオフに維持される期間
は、100マイクロセカンド未満から数秒(それぞれ、
100キロヘルツのスイッチング周波数で数スイッチン
グサイクルから100000スイッチングサイクル以上
に対応する)にわたる。通常、このようなオフ時間によ
り、高効率(例えば90%より高い効率)が、100:
1よりも大きい出力電流範囲にわたって得られる。この
ような期間には、スイッチングトランジスタに加えて他
の構成要素もまたオフに維持され得るため、通常、より
高い効率が得られる。
50の制御回路70は、MOSFET16および17を
含む同期してスイッチングされるスイッチを駆動するた
めに使用される。本願で使用されるように、「同期して
スイッチングされるスイッチ」という用語は、交互に駆
動されて、制御された電圧で電流を負荷に供給する2つ
のスイッチングトランジスタを含むスイッチのことをい
う。図3は、降圧型構成のスイッチングトランジスタお
よびスイッチングダイオードを含むスイッチを駆動する
ための、本発明の高効率制御回路の第2実施態様を示
す。
ュレータ回路100は、P−MOSFET116および
ダイオード118を含むスイッチ115を有している。
スイッチ115は、P−ドライバ126を有するドライ
バ120によって駆動される。スイッチ115のターン
オンおよびターンオフは、制御回路125によって制御
される。制御回路125は、(図2の制御回路70とは
対照的に)1つのMOSFETのみを駆動するのに使用
されるため、(NANDゲート68の出力から引き出さ
れる)出力端子125Aを1個だけ有する。
示されるのと同様の電流比較器39、増幅器38、ヒス
テリシス比較器74およびワンショット回路25を有す
る。図2を参照しながら上述したように、低平均出力電
流レベルでは、制御された電圧レベルVREG(出力が長
期にわたって出力コンデンサCOUTによって実質的に支
持される)を越えて出力電圧VOUTが増加するように、
インダクタL1に供給される電流を意図的にオーバ駆動
するために定電流源I172は使用される。この間、P
−MOSFET116は、回路効率を増加させるために
スリープモードでオフに維持される。
70および125は、それぞれ、低平均出力電流レベル
で高効率動作を提供する。このような動作は、出力電流
レベルに自動的に適応する。例えば、高い出力電流レベ
ルの第1の動作状態では、スイッチは連続してオン状態
とオフ状態との間を交互に切り替わり、制御された電圧
レベルVREGで出力電圧VOUTを維持する。低出力電流レ
ベルの第2動作状態(本願発明でなければ回路効率は低
い状態)では、出力電圧VOUTは、スイッチを連続して
ターンオンおよびオフせずに、出力コンデンサCOUTに
よって実質的に制御された電圧レベルVREGに維持され
得る。従って、制御回路は、このような条件を自動的に
確認し、レギュレータ回路を、最小数の回路構成要素が
オンになることが要求される「スリープ」モードにす
る。
回路はまた、本発明の制御回路の「ユーザ駆動」実施態
様を導入し得る。この実施態様では、ユーザ入力が、レ
ギュレータ回路を「スリープ」モードにしたり「スリー
プ」モードから解除したりするように制御する。図4
は、降圧型構成の一対の同期駆動MOSFETを含むス
イッチを駆動するための本発明の高効率制御回路の「ユ
ーザ駆動」実施態様を導入した、スイッチングレギュレ
ータ回路の概略ブロック図である。
0は、図2の回路50と同様に、プッシュプルスイッチ
15、ドライバ20および出力回路30を有する。レギ
ュレータ回路150の制御回路170は、図2の回路5
0と同様に、ワンショット回路25、電流比較器39お
よび増幅器38を有する。図2とは対照的に、(スイッ
チ176および178を含む)スイッチ175は、他の
タイプの制御回路(図示されていない)から伝送される
制御信号であるユーザインプット175Aによって、レ
ギュレータ回路150をスリープモードに手動で切り替
えるために使用される。スイッチ175を閉じると、ス
イッチ176および178は両方とも閉じる。
続されている抵抗器67によってHIGHに保持され
る)ANDゲート66の入力66Aを接地することによ
って、スリープモードでN−ドライバ27をターンオフ
するのに使用される。スイッチ178は、制御回路17
0が、出力電圧VOUTを、スリープモードにおいて制御
された電圧レベルVREGに実質的に維持するように、正
の帰還つまりヒステリシスを増幅器38にほどこしてい
る。(基準回路37と相互コンダクタンス増幅器38の
非反転入力との間に接続された抵抗器RHYSは、増幅器
38の出力を増幅器38の非反転入力に帰還させるのを
助けるために使用される。)スイッチ178により、増
幅器38は、(P−MOSFET16を介した)インダ
クタL1への電流の供給をオーバドライブして、制御さ
れた電圧レベルVRE Gよりも大きい所定のレベルに出力
電圧VOUTを意図的に駆動する。このような電圧レベル
に駆動された後、増幅器38のヒステリシスは、帰還電
圧VFBが少なくともヒステリシス電圧だけ降下するま
で、P−ドライバ26をオフに維持する。この時点で、
電流増幅器39の出力39AはHIGHになり、ワンシ
ョット回路25をトリガし、P−MOSFET16はタ
ーンオンされて、制御された電圧レベルVREGよりも大
きい所定の電圧レベルに出力コンデンサCOUTが再充電
される。
プモードで周期的にウェイクアップし、P−MOSFE
T16をターンオンして、出力コンデンサCOUTを再充
電する。このようなウェイクアップ期間には、N−MO
SFET15はオフに維持されるが、必ずしもそうであ
る必要はないことは当業者に自明である。例えば、制御
回路170が、出力コンデンサCOUTを再充電している
間、このような再充電は、スイッチングトランジスタを
交互にオフに切り替えて、デューティーサイクルを変化
させ、それによって出力コンデンサCOUTを再充電する
ことによっても成し遂げられる。
る場合、レギュレータ回路150は、図2のレギュレー
タ回路50のように、低電流レベルで効率を増加させる
ように動作する。しかし、図2のレギュレータ回路50
とは対照的に、レギュレータ回路150は、出力電流レ
ベルに自動的に適応しない。例えば、回路150は、平
均出力電流が増加してもスリープモードから解除されな
い。スリープモードからの解除は、ユーザによって行わ
れる。
発明の制御回路の実施態様には、ワンショット回路25
が含まれる。本発明の他の特徴によると、ワンショット
回路の代わりに、パワースイッチのデューティーサイク
ルを制御する他のタイプの回路を用いてもよい。例え
ば、ワンショット回路25の代わりに、制御信号に応答
してパルス幅が変調された信号を供給するパルス幅変調
回路を用いることができる。もちろん、他のタイプの回
路を用いてもよい。
間信号を供給するワンショット回路25の代わりに、出
力電圧VOUTおよび入力電圧VINに応じて、可変オフ時
間制御信号を供給するワンショット回路を用いてもよ
い。本発明のこの特徴により、低入力電圧におけるイン
ダクタL1からの可聴ノイズの発生および放出を減少さ
せることが可能である。上記のように、このようなノイ
ズは、インダクタ電流の振動に関連している。さらに、
本発明のこの特徴はまた、出力が短絡している場合に
は、短絡電流を制御するために使用される。
導入した、例示的なスイッチングレギュレータ回路の概
略ブロック図である。
プッシュプルスイッチ15、駆動回路20、電流帰還回
路210、電圧帰還回路220、帰還制御回路230お
よび可変オフ時間回路240を有している。帰還制御回
路230は、入力232および234を介して出力電流
および出力電圧をそれぞれモニタし、端子236にトリ
ガ信号を供給して、スイッチ15のオフサイクルを開始
する。可変オフ時間回路240は、以下のように、オフ
時間を制御するために使用される。
御回路230によってトリガされるワンショットジェネ
レータ245を有している。ワンショットジェネレータ
245は、電圧がワンショットジェネレータ245でモ
ニタされる制御コンデンサ(CCON)246に接続され
たもう1つの端子245Aを有している。本発明による
と、オフ時間制御回路250は、コンデンサCCONの放
電、すなわちコンデンサの電圧を制御するので、ジェネ
レータ245のオフ時間が制御される。オフ時間制御回
路250は、入力および出力電圧(VINおよびVOUT)
をモニタし、それらの値に応じてオフ時間を調整する。
て、上記のインダクタL1振動周波数fRIPが可聴範囲
に入ると、振動周波数fRIPが可聴範囲から脱出して増
加するように、オフ時間は減少する。さらに、短絡によ
り出力電圧VOUTが低下して、インダクタL1の電圧が
低くなりすぎてオフサイクル中のインダクタ電流が十分
に減衰しない場合、電流暴走状態を避けるように、オフ
時間は増加する。
放電は、制御電流ICONの大きさを調整することによっ
て制御される。例えば、低入力電圧では、制御電流I
CONは、制御コンデンサCCONの電圧が急速に低下するよ
うに、オフ時間制御回路250によって増加される。制
御コンデンサ電圧が所定値未満に低下すると、スイッチ
15のオンサイクルが開始される。さらに、低出力電圧
では、制御電流ICONは、制御コンデンサCCONの電圧が
ゆっくりと減衰してオフ時間を長引かせるように、オフ
時間制御回路250によって減少される。
回路200として、コンデンサを放電させてオフ時間を
制御する特定回路を用いているが、入力および出力電圧
に応答してこれと同一の機能を果たす他の回路を用いて
もよいことは明らかである。例えば、所望されるなら、
オフ時間を制御するために、演算増幅器を用いてもよ
い。
に適応する可変オフ時間制御信号を供給するワンショッ
ト回路について記載した。本発明のこの特徴は、低入力
電圧レベルで、レギュレータ回路からの可聴ノイズの発
生および放出を減少させ(すなわち、低入力電圧でのt
OFFを減少させ)、出力が短絡した場合に短絡電流を制
限する(すなわち、低出力電圧でtOFFを増加させる)
ために使用される。
施態様の詳細な概略図である。
および出力電圧VOUTを端子252および254でそれ
ぞれ受け取り、出力ICONを端子256に供給する。上
記のように、出力ICONは、端子256に接続された制
御コンデンサCCONの放電を制御する。制御回路250
は、出力ICONの大きさを制御するので、これにより、
制御コンデンサCCONの放電時間が制御される。制御回
路250は、(電流ICN2を供給するための)電流源2
60、(電流ICN1を供給するための)電流源270、
電流補償回路280および電流ミラー出力回路295を
有している。制御回路250は、以下のように動作す
る。
98Aがドレイン298Bに接続された)トランジスタ
296およびトランジスタ298を含む電流ミラー回路
である。回路295は、制御された基準電流ICREFを入
力295Aで受け取って、(従来の電流ミラー回路のよ
うに)トランジスタ296および298のアスペクト比
に関連した比例出力電流ICONを供給する。本発明によ
ると、基準電流ICREFは、入力端子252および254
の電圧VINおよびVOUTに応じて、それぞれ、ICN1また
は(ICN1+ICN2)と等しくなる。
には、トランジスタ262は、十分な電流を(トランジ
スタ264および電流源I6から)導電して、トランジ
スタ266をオフに保持する。トランジスタ266がオ
フになると、電流ICN2はゼロになるので、基準電流I
CREFは、電流源270の出力端子270Aに供給される
電流ICN1と等しくなる。
ン274Bに接続された)トランジスタ272および2
74からなる電流ミラー回路によって供給される。本発
明によると、トランジスタ274から流れる基準電流I
CN1REFは、伝送ゲート282が開または閉であるかに応
じて、それぞれ、ICN1Aまたは(ICN1A+ICN1B)と等
しくなる。
て制御され、VOUTがVTH3未満である場合にOPENと
なる。伝送ゲート282がOPEN状態のとき、I
CN1REFは、トランジスタ276のコレクタに流れるI
CN1Aと等しくなる。この電流は、(抵抗器271および
273からなる)出力分圧器でVOUTを分圧することに
よって、出力電圧VFB1を(トランジスタ279のベー
スに)発生することによって得られる。次に、電圧V
FB1のレベルは、トランジスタ279のベース−エミッ
タ電圧によってシフトアップされ、トランジスタ276
のベース−エミッタ電圧によってシフトダウンされ、最
終的に、電圧VFB1は、エミッタ抵抗器278の両端に
生じる。結果として得られるトランジスタ276のコレ
クタ電流は、出力電圧VOUTに比例し、制御コンデンサ
CCONは、インダクタL1の電流の放電レートに比例し
たレートで放電する。
ば、故障時またはスタートアップ状態のとき、tOFFが
延長して、インダクタL1中で電流が直線的に減少する
のに必要な時間をさらに許容する。
は、比較器284の出力は、伝送ゲート282を閉じ
て、さらなる補償電流ICN1Bをトランジスタ274のド
レインに接続し、電流補償回路280を介して電流補償
を行う。補償電流ICN1Bは、電流ITRIMからトランジス
タ286のドレイン電流を差し引いたものに等しい。ト
ランジスタ286および288は、トランジスタ290
の(電圧VREFが電圧VF B1の代わりに用いられること以
外は、トランジスタ276のコレクタ電流と同様にして
得られる)コレクタ電流を反映(mirror)するように動
作する。
力電圧VOUTが実質的に制御されたレベルにあるとき、
所望の制御電流ICONを設定するために、トリミング電
流として作用すること、および2)広範囲な動作温度に
わたって、実質的に一定の制御電流ICONを維持するこ
と。典型的な回路を製造するときに抵抗器278の抵抗
値が変動すると、通常、制御電流ICONが所望のレベル
よりも大きくなるかまたは小さくなる。回路製造中にI
TRIMをトリミングすることによって、所定の制御電流I
CONを供給するために必要とされるように、補償電流I
CN1Bは、トランジスタ276のコレクタ電流ICN1Aに加
算されるかまたは減算されるように調整され得る。さら
に、抵抗器278および292が同じである(すなわ
ち、全く同一に設計および製造される)ならば、抵抗器
278の抵抗が温度によって変化するときに生じる制御
電流ICONの変化は、それに対応する抵抗器292の抵
抗の変化によって実質的にキャンセルされる。
は、比較器284の出力は、伝送ゲート282を開い
て、電流補償を阻止する。これにより、出力電圧VOUT
がゼロに近づくにつれて、制御電流ICONはゼロに近づ
き、出力がショートしている間のインダクタ電流ILを
確実に制御する。
る点まで低下すると、トランジスタ262の電流はもは
や、トランジスタ266をオフに保持しない。VINがさ
らに低下すると、トランジスタ266は、さらなる電流
ICN2を電流ミラー出力回路295に加え、それによっ
て制御電流ICONを増加させ、tOFFを減少させる。ま
た、VINが減少すると、動作周波数が安定し、可能性の
ある可聴ノイズの問題が減少する。電流源I7は、トラ
ンジスタ266が制御電流ICONに加える最大電流を決
定する。
るようにVINが低下すると(例えば、電池がほぼ放電し
てしまったとき)、tOFFは減少して、レギュレータ回
路の振動周波数は増加し、可聴ノイズの発生および放出
は減少する。
プルスイッチ15およびドライバ20を含むレギュレー
タ回路に関して上述したが、本発明の可変オフ時間特徴
は、他のレギュレータにも用いられる。例えば、この特
徴は、図3および図4のレギュレータ回路およびワンシ
ョットジェネレータを用いて制御された電圧を供給する
他の回路にも使用され得る。
構成の一対の同期スイッチングMOSFETを有するス
イッチを駆動するための高効率制御回路の両方を導入し
た、例示的なスイッチングレギュレータ回路の概略ブロ
ック図である。
シュプルスイッチ15、ドライバ20、出力回路30お
よび制御回路350を有している。制御回路350は、
ワンショットジェネレータ245、オフサイクル時間を
制御する可変オフ時間制御回路250、および低平均出
力電流レベルで高効率動作を提供する比較器74を有し
ている。スイッチングレギュレータ300は以下のよう
に動作する。
0%を上回ると、ループは、連続モードで動作する。こ
こで、比較器74は、ワンショットジェネレータ245
の出力245Aを無効にしない。VIN−VOUTが1.5
Vよりも大きい場合の動作は、図1で説明した動作と実
質的に同様である。インダクタ電流は、抵抗器RSENSE
の電圧降下によって検出され、電流比較器39のしきい
値は、レジスタR3の電圧降下によって設定される。組
込みオフセットVOS(例えば、約10mv)は、帰還電
圧VFBを基準電圧VREFよりもわずかに低いレベルにシ
フトし、比較器74の出力をこのモードでHIGHに保
持する。抵抗器RSENSEの両端の電圧が抵抗器R3のしき
い値を上回るときには、比較器39の出力はHIGHに
なり、RSフリップフロップ310のRBAR入力はL
OWになり、RSフリップフロップ310をリセット
し、スイッチオフサイクルを開始する。
HIGHであり、P−MOSFET16はオフになり、
N−MOSFET17はオンになり、ICONにより制御
コンデンサCCONは放電する。オフ時間tOFFは、比較器
312の非反転入力に接続された制御コンデンサCCON
が初期電圧からVTH1に放電するのにかかる時間によっ
て決定される。制御コンデンサCCONが放電して電圧V
TH1に達すると、比較器312の出力はLOWになり、
RSフリップフロップ310をセットし、次のオンサイ
クルを開始する。電圧VTH1は、電圧VTH2よりも大きい
ので、比較器315の出力は連続モードでLOWのまま
維持される。
よび図6を参照しながら上述した可変オフ制御回路25
0によって制御される。従って、回路250は、VINお
よびVOUTにそれぞれ接続された入力252および25
4を含み、これらの電圧をモニタする。
の最小電圧しきい値を設定する。これにより、各オンサ
イクルで比較器39をトリップするのに必要なインダク
タL1の最小電流が設定される。結果として得られる、
出力に流れる平均インダクタ電流が負荷電流よりも大き
い場合には、出力電圧VOUTは増加し始め、これにより
帰還電圧VFBはヒステリシス比較器74をトリップす
る。もちろん、インダクタL1のインダクタンスおよび
オフ時間tOFFは、このようなトリッピングが発生する
ときにはインダクタリップル電流がゼロ未満にならない
ように選択されるのが好ましい。比較器74がトリップ
すると、その出力はLOWになり、RSフリップフロッ
プ310のQ出力を無効にし、即座にスイッチ信号V
SWBをHIGHに切り替える。上記のように、これによ
り、「スリープ」モードの動作が自動的に開始される。
ンサCCONは放電するが、比較器312がトリップする
と、コンデンサCCONは新たなスイッチオンサイクルを
開始しない。上記のように、これは、帰還電圧VFBが比
較器74のヒステリシス量だけ低下するまで、出力74
AのLOW状態は、スイッチ信号VSWBをNANDゲー
ト316を介してHIGHの状態に保持するためであ
る。従って、制御コンデンサCCONは、電圧VTH2未満に
放電し続け、比較器315の出力315AはHIGHと
なる。これにより、P−MOSFET16およびN−M
OSFET17はターンオフされる。さらに、レギュレ
ータ回路がスリープモードであるときには、増幅器38
および比較器39および312などの未使用の回路成分
もまたターンオフされる。上記のように、これにより、
スリープモード中にバイアス電流は実質的に減少し、低
出力電流レベルでの効率がさらに増加する。
ギュレータの大半およびMOSFET16および17
は、ターンオフされ、出力負荷は、出力コンデンサC
OUTによって実質的に支持される。しかし、帰還電圧V
FBが比較器74のヒステリシス量だけ減少するように出
力電圧VOUTが低下すると、すべての回路成分は、再び
ターンオンされ、新たなオンサイクルが開始され、電流
が出力に供給される。負荷電流がLOWのままである場
合、出力コンデンサCOUTは再充電し、帰還電圧V
F Bは、わずか数スイッチサイクル後に再び比較器74を
トリップする。従って、軽い負荷状態では、上記のよう
に、出力電圧VOUTは、高いしきい値と低いしきい値と
の間で振動する。
に、そのゲート・ソース間の電圧はMOSFET334
にも発生し、MOSFET334をターンオンする。こ
れにより、MOSFET334のドレインはHIGHに
なり、N−駆動27を阻止する。LOWからHIGHへ
のVSWBの切替え後、P−MOSFET16のゲートの
電圧は、MOSFET334のドレイン電圧が低下し
て、N−MOSFET17がターンオンされる前に、M
OSFET334が電流源335より少ない電流が流れ
るレベルに増加しなければならない。電流IM1は、駆動
が可能となる前に、MOSFET334のゲートが入力
電圧VINの2V以内に増加するように、意図的に小さい
レベルに設定され、N−MOSFET17がターンオン
するときにP−MOSFETが完全にオフとなるように
している。同様に、MOSFET332および電流源I
M2333は、P−MOSFET16がターンオンすると
きにN−MOSFET17が完全にオフとなるようにし
ている。これにより、ドライバの速度またはMOSFE
Tのサイズにかかわらず、P−MOSFET16とN−
MOSFETが同時に導電するのを防止し、最大可能な
効率を確実にしている。本実施態様のこの特徴は、1992
年6月4日付けで提出された、同時係属中で同一譲受人に
譲渡された米国特許出願(LT−20)第07/893,523号
に詳細に記載されている。本願では、この米国特許出願
を参考のためにそのまま援用している。所望されるな
ら、本発明の制御回路は、本願と同時に提出された、同
時係属中で同一譲受人に譲渡された米国特許出願(LT
−20CIP)第08/035,423号に記載されるような、一
時スイッチ信号を収容する回路を含んでいてもよい。本
願では、この米国特許出願を参考のためにそのまま援用
している。
続されたショットキーダイオードD2は、MOSFET
16および17の導通期間のデッドタイム中にのみ導電
する。ダイオードD2の目的は、N−MOSFET17
のボディーダイオードがターンオンして、不動作中に電
荷を蓄積するのを防止することである。ボディーダイオ
ードがターンオンして、不動作中に電荷が蓄積すると、
場合によっては、効率が(例えば、約1%)減少するた
めである。ダイオードD2は、最大出力電流を導通して
いるときに、約0.5V未満の順方向電圧で選択される
のが好ましい。本発明によると、図7に示される制御回
路は、5Vの同期降圧型スイッチングレギュレータに導
入されると、出力電流が2桁より大きい範囲(例えば、
20mAから2A)で変動するときでも、(約10Vの
入力電圧で)90%を上回る効率を成し遂げることが可
能である。特定の動作条件下(例えば、6Vの入力電
圧)では、95%を上回る効率が、このような電流レベ
ルで維持され得る。このような制御回路は、特に、ノー
トブックおよびパームトップコンピュータ、ポータブル
器具、電池駆動ディジタル装置、移動電話、直流電源シ
ステムおよびGPSシステムで有用である。
の制御回路10の欠点は、tOFF中に電流が大幅に直線
的に減少すると、低出力電流で、インダクタL1の電流
が極性を反転し得ることである。これにより、N−MO
SFET17を介して電力が負荷からアースに引き出さ
れ、同時に、回路効率が減少する。本発明のさらに他の
特徴によると、制御回路は、インダクタ電流が極性を反
転する場合、このような電力が負荷から引き出されるの
を防止するために、N−MOSFETをターンオフする
回路を有し得る。
おける電流の極性反転によって負荷から電力が引き出さ
れるのを防止するための本発明の回路を導入した、例示
的なスイッチングレギュレータ回路の概略ブロック図で
ある。
に示されるのと同様のプッシュプルスイッチ15、駆動
回路20および出力回路30を有している。さらに回路
400は、出力インダクタL1電流の極性反転によって
負荷から電力が引き出されるのを防止するための本発明
の高効率制御回路470を有している。
様のワンショット回路25、電流比較器39および相互
コンダクタンス増幅器38を有している。これらの構成
要素に加えて、制御回路470はさらに、比較器471
およびインダクタ電流の極性反転によって低平均電流レ
ベルで負荷から電力が引き出されるのを防止するゲート
472を有している。制御回路470は以下のように動
作する。
になり、P−MOSFET16をオフにし、N−MOS
FET17をオンにすると、インダクタ電流ILは直線
的に減少し始める。低平均出力電流中で、この電流はゼ
ロに直線的に減少し、最後には、負になる。制御回路4
70は、電流帰還信号IFB2を介して、インダクタ電流
ILをモニタすることによって動作し、このような電流
反転が起こる前にN−MOSFET17をターンオフす
る。これにより、N−MOSFET17が、電力を負荷
からアースに引き出すのが防止される。
ってインダクタ電流ILをモニタする入力471aを有
している。電流帰還信号IFB2が、比較器471の入力
471bに印加される電流I4未満に低下すると、比較
器出力471cはLOWになり、NANDゲート472
によってN−MOSFET17はターンオフされる。N
−MOSFET17がターンオフされると、インダクタ
電流ILの電流反転によってN−MOSFET17を介
して電力が負荷14からアースに引き出されるのが防止
される。
後、帰還電流IFB2が電流I4を上回って比較器出力47
1cがHIGHになると、N−MOSFET17は、再
びターンオンされる。一般に、ワンショット回路25が
P−MOSFET16をターンオンした後、比較器出力
471cは再びHIGHになり、インダクタ電流ILは
再び直線的に増加する。このような直線的な増加によ
り、電流帰還信号IFB2はI4を上回るので、比較器出力
471cはHIGHになる。比較器471cがHIGH
である間、ワンショット回路25は、N−MOSFET
17のターンオン制御のみを行う。従って、制御回路4
70は、N−MOSFET17を意図的にオフに保持す
る回路を有している。このN−MOSFET17がオフ
に保持される期間は、もし、N−MOSFET17がオ
フに保持されなければ、電流反転によって負荷から電力
が引き出される期間である。本発明のこの特徴は、電流
反転が最も起こりやすい低平均出力電流レベルで、回路
効率を増加させ得る。
ンダクタ電流ILをモニタするが、インダクタ電流ILの
電流反転を検出する他の手段を用いてもよいことは、当
業者に自明である。例えば、比較器471は、1つのタ
イプの電流帰還信号だけが制御回路470で使用される
ように、電流帰還信号IFB1をモニタすることも可能で
ある。さらに、インダクタ電流ILの電流反転を示す帰
還信号を発生する他の多数の手段も使用され得る(例え
ば、図7の抵抗器RSENSEを参照)。
レギュレータが電圧降圧型構成で設けられている図1か
ら図8を参照しながら上述した。本発明の制御回路が他
の構成でも使用されることは明白である。例えば、図9
は、電圧昇圧型構成の本発明の高効率制御回路を導入し
たスイッチングレギュレータ回路の概略ブロック図を示
す。
してスイッチングされるスイッチ15’を有し、P−チ
ャネルMOSFET16およびN−チャネルMOSFE
T17は互いに接続され、インダクタL1の一端に接続
されている。インダクタL1の他端は、入力VINに接続
されている。制御回路70は、反転P−ドライバ26’
および反転N−ドライバ27’を含む駆動回路20’を
駆動し、反転P−ドライバ26’および反転N−ドライ
バ27’は、P−チャネルMOSFET16およびN−
チャネルモSFET17をそれぞれ交互に駆動する。
駆動回路は、制御された出力電圧VOUTに入力電圧VIN
が昇圧されるスイッチング構成で使用され得る。図2か
ら図8に示される降圧型構成と同様に、図9の制御回路
は、他のタイプの昇圧型構成でも使用される。例えば、
図5および図6を参照しながら上述したように、図9に
示されるワンショット回路25は、入力電圧VINをモニ
タして、インダクタL1からの可聴ノイズの発生および
放出を低入力電圧で減少させるための入力をさらに有し
ていてもよい。さらに、スイッチングレギュレータ50
0は、図8を参照しながら上述したように、P−MOS
FET16がオフに保持されないとインダクタ電流IL
の極性が反転し得る期間P−MOSFET16をオフに
保持する回路を有していてもよい。
高効率制御回路を導入した、スイッチングレギュレータ
回路の概略ブロック図を示す。
ッチ15’’を有し、P−MOSFET16のドレイン
は、インダクタL1の一端に接続され、ダイオードD6
01を介してVOUTに接続されている。インダクタL1
の他端は接地されている。P−チャネルMOSFET1
6のソースは、正入力電圧VINに接続されている。制御
回路70’は、P−ドライバ26を含む駆動回路2
0’’を駆動し、P−ドライバ26はP−チャネルMO
SFET16を駆動する。
と、以下を除いて実質的に同様に動作する。電圧は、抵
抗器R1、R2および増幅器602によって制御回路7
0’へ帰還される。増幅器602は、VOUTで負極性電
圧を反転させて、正極性電圧を制御回路70’に帰還さ
せる。
の制御回路は、入力電圧VINが、反対極性の制御された
出力電圧VOUTに反転されるスイッチング構成で使用さ
れ得る。図2から図8に示される降圧型構成と同様に、
図10の制御回路は、他のタイプの極性反転構成でも使
用される。例えば、図10に示されるワンショット回路
25は、入力電圧VINをモニタして、インダクタL1か
らの可聴ノイズの発生および放出を低入力電圧で減少さ
せるための入力をさらに有していてもよい。さらに、ワ
ンショット回路25は、図5および図6を参照しながら
上述したように、出力が短絡すると、出力電圧VOUTを
モニタして、短絡電流を制御するための入力を有してい
てもよい。さらに、レギュレータ600が同期して切り
替えられ、D601の代わりにN−MOSFETを有す
るならば、図8を参照しながら上述したように、レギュ
レータは、N−MOSFETをオフに保持する回路を有
していてもよい。このN−MOSFETがオフに保持さ
れる期間は、N−MOSFETがオフにされなければイ
ンダクタILの極性が反転し得る期間である。
して、スイッチングレギュレータをスリープモードにす
るかまたはスリープモードから解除するヒステリシス電
圧比較器を参照しながら上述したが、同一の機能を果た
す他の手段を用いることもできることは当業者に公知で
ある。例えば、所望されるなら、スリープモード制御信
号は、モニタされた出力電流に応答して発生され得る。
さらに、上記のように、スイッチングレギュレータは、
出力電圧が所定のしきい値未満に低下した後ではなく、
スリープモードになって所定期間を経過すると、スリー
プモードから解除され得る。
しながら上述し、ここで、パワースイッチは一対の相補
型MOSFET(すなわち、1つのP−チャネルおよび
1つのN−チャネル)または単一なP−チャネルMOS
FET(図3)のいずれかであるが、本発明は、他のタ
イプのスイッチにも適用できることは明白である。例え
ば、パワースイッチは、一対のN−チャネルMOSFE
T、一対のP−チャネルMOSFETまたはバイポーラ
接合トランジスタを有していてもよい。
スイッチングレギュレータ回路で広範囲の電流にわたっ
て高効率を維持する方法が提供される。
あって、本発明を限定するものではない。従って、本発
明は、上記の実施態様以外の態様でも実施され得ること
は当業者に自明である。また、本発明は、添付の請求の
範囲によってのみ限定される。
レギュレータが提供され、スイッチングレギュレータ回
路において、高効率を、低い出力電流を含む広い電流範
囲にわたって維持するための制御回路および方法が提供
される。
ETを含むスイッチを用いる典型的な従来のスイッチン
グレギュレータ回路の概略ブロック図である。
ETを含むスイッチを駆動するための本発明の高効率制
御回路の第1実施態様を導入した、スイッチングレギュ
レータ回路の概略ブロック図である。
スイッチングダイオードを含むスイッチを駆動するため
の本発明の高効率制御回路の第2実施態様を導入した、
スイッチングレギュレータ回路の概略ブロック図であ
る。
ETを含むスイッチを駆動するための本発明の高効率制
御回路の「ユーザ駆動」の実施態様を導入した、スイッ
チングレギュレータ回路の概略ブロック図である。
ッチングレギュレータ回路の概略ブロック図である。
図である。
ETを含むスイッチを駆動するための本発明の可変オフ
時間特性と高効率制御回路との両方を導入した、例示的
なスイッチングレギュレータ回路の概略ブロック図であ
る。
からの電力に起因する電流の極性反転を防止するための
本発明の回路を導入した、スイッチングレギュレータ回
路の概略ブロック図である。
たスイッチングレギュレータ回路の概略ブロック図であ
る。
入したスイッチングレギュレータ回路の概略ブロック図
である。
Claims (5)
- 【請求項1】 スイッチング電圧レギュレータのための
制御回路であって、 該スイッチング電圧レギュレータは、1対のスイッチン
グトランジスタと、該スイッチング電圧レギュレータの
入力電圧、出力および接地ノードの間を相互接続する誘
導素子とを含み、 該スイッチング電圧レギュレータは、第1の動作状態を
有しており、該第1の動作状態において、該制御回路
は、該一対のスイッチングトランジスタのための一対の
駆動回路にスイッチング制御信号を提供することによ
り、スイッチングサイクルで該一対のスイッチングトラ
ンジスタのオンオフを交互に切り替え、これにより、該
誘導素子を通る電流の連続的な流れを提供し、 さらに、 a)該制御回路は、該誘導素子を流れる電流を示す帰還
信号を受け取り、該帰還信号を基準値と比較することに
より、該誘導素子を流れる該電流の極性が反転しようと
していることを示す状態を検出する比較器回路を含み、 b)該制御回路は、該比較器回路が該誘導素子を流れる
該電流の極性が反転しようとしていることを示す状態を
検出した際に、該スイッチング電圧レギュレータを該第
1の動作状態から第2の動作状態に切り替えるための制
御信号を生成し、該制御信号は、該誘導素子を流れる該
電流の極性が反転しようとしているか否かの関数とし
て、該一対のスイッチングトランジスタのうちの一方の
ための該駆動回路に提供される該スイッチング制御信号
を状態づける回路に供給され、該第2の動作状態におい
て、該制御信号は、該一対のスイッチングトランジスタ
のうちの一方をオフにすることによって、該一対のスイ
ッチングトランジスタのうちの一方の該スイッチングサ
イクルを中断し、該誘導素子を流れる該電流の極性が反
転するのを防ぐ、制御回路。 - 【請求項2】 前記スイッチング電圧レギュレータがス
テップダウンレギュレータであり、前記制御信号が、前
記誘導素子の一端を接地に結合する前記スイッチングト
ランジスタの前記スイッチングサイクルを中断する、請
求項1に記載の制御回路。 - 【請求項3】 前記スイッチング電圧レギュレータがス
テップアップレギュレータまたは反転レギュレータであ
り、前記制御信号が、前記誘導素子の一端を該スイッチ
ング電圧レギュレータの前記出力に結合する前記スイッ
チングトランジスタの前記スイッチングサイクルを中断
する、請求項1に記載の制御回路。 - 【請求項4】 前記スイッチング制御信号はワンショッ
ト回路の出力である、請求項1から3のいずれかに記載
の制御回路。 - 【請求項5】 相互コンダクタンス増幅器および電流比
較器をさらに含み、該相互コンダクタンス増幅器が帰還
電圧VFBと基準電圧VREFとを比較するために使用
され、そして該電流比較器が前記ワンショット回路をト
リップおよびトリガするために使用される、請求項4に
記載の制御回路。
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