KR101041288B1 - 다중 외부 전원을 갖는 비휘발성 반도체 메모리 - Google Patents
다중 외부 전원을 갖는 비휘발성 반도체 메모리 Download PDFInfo
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Abstract
Description
Claims (56)
- 데이터를 저장하는 플래시 메모리;상기 플래시 메모리에 전원을 인가하기 위해 사용되는 제1 전압을 수신하는 제1 전원 입력핀;제2 전압을 수신하는 제2 전원 입력핀; 및상기 제2 전압을 수신하여, 상기 플래시 메모리로 전달되는 적어도 제1 및 제2 내부 전압을 인출하는 전원 관리 회로를 포함하고,상기 전원 관리 회로는,ⅰ) 상기 제2 전압을 상기 제2 전압보다 큰 제1 내부 전압으로 변환하는 제1 차지 펌프 회로, 및ⅱ) 상기 제2 전압을 상기 제1 내부 전압보다 큰 제2 내부 전압으로 변환하는 제2 차지 펌프 회로를 포함하고,상기 제2 전압은 상기 제1 전압보다 큰, 멀티-핀의 패키지화된 메모리 장치.
- 청구항 1에 있어서,상기 플래시 메모리로 전달되는 적어도 하나의 내부 전압은,ⅰ) 상기 플래시 메모리의 셀들의 프로그래밍,ⅱ) 상기 플래시 메모리의 셀들의 소거, 및ⅲ) 상기 플래시 메모리의 셀들로부터의 데이터의 판독중 적어도 선택된 것을 가능하게 하는, 멀티-핀의 패키지화된 메모리 장치.
- 청구항 1에 있어서,상기 제1 내부 전압과 상기 제2 내부 전압은 상기 플래시 메모리에 대해 데이터 액세스 동작을 지원하는, 멀티-핀의 패키지화된 메모리 장치.
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- 청구항 1에 있어서,상기 제1 내부 전압과 상기 제2 내부 전압이 상기 플래시 메모리에 대해 상이한 유형의 데이터 액세스 동작을 지원하기 위해 사용되는, 멀티-핀의 패키지화된 메모리 장치.
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- 청구항 1에 있어서,기판을 더 포함하고,상기 전원 관리 회로 및 상기 플래시 메모리는 상기 기판 위에 위치하고,상기 기판은,ⅰ) 상기 제1 전원 입력핀에 수신된 상기 제1 전압을 상기 플래시 메모리에 전달하는 제1 도전 경로, 및ⅱ) 상기 제2 전원 입력핀에 수신된 상기 제2 전압을 상기 전원 관리 회로에 전달하는 제2 도전 경로를 포함하는, 멀티-핀의 패키지화된 메모리 장치.
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- 청구항 1에 있어서,상기 제1 전압은 Vcc이고, 상기 제2 전압은 Vpp인, 멀티-핀의 패키지화된 메모리 장치.
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- 제1 전압;상기 제1 전압보다 큰 제2 전압; 및메모리 장치를 포함하고,상기 메모리 장치는,ⅰ) 상기 제1 전압에 의해 전원이 인가되는 플래시 메모리; 및ⅱ) 상기 제2 전압을 수신하여 각각의 플래시 메모리에 의해 사용되는 제1 내부 전압과 제2 내부 전압으로 변환하는 전원 관리 회로를 포함하고,상기 전원 관리 회로는,ⅰ) 상기 제2 전압을 상기 제2 전압보다 큰 제1 내부 전압으로 변환하는 제1 차지 펌프, 및ⅱ) 상기 제2 전압을 상기 제1 내부 전압보다 적어도 1V 큰 제2 내부 전압으로 변환하는 제2 차지 펌프를 포함하는, 메모리 시스템.
- 청구항 16에 있어서,상기 플래시 메모리는, 상기 전원 관리 회로에 의해 생성된 제1 내부 전압과 제2 내부 전압을 활용하여 상기 플래시 메모리에 저장된 데이터를 관리하는, 메모리 시스템.
- 청구항 16에 있어서,회로 기판을 더 포함하고,상기 메모리 장치는 상기 회로 기판 위에 위치하고,상기 회로 기판은,ⅰ) 제1 전원에서 상기 메모리 장치의 제1 전원 입력핀으로 상기 제1 전압을 전달하는 제1 도전 경로, 및ⅱ) 제2 전원에서 상기 메모리 장치의 제2 전원 입력핀으로 상기 제2 전압을 전달하는 제2 도전 경로를 포함하는, 메모리 시스템.
- 청구항 18에 있어서, 상기 제1 전원 입력핀은 상기 제1 전압을 상기 메모리 장치의 플래시 메모리에 전달하고,상기 제2 전원 입력핀은 상기 제2 전압을 상기 메모리 장치의 전원 관리 회로에 전달하는, 메모리 시스템.
- 청구항 16에 있어서,상기 전원 관리 회로에 의해 생성된 상기 제1 내부 전압과 상기 제2 내부 전압은,ⅰ) 상기 플래시 메모리의 셀들의 프로그래밍,ⅱ) 상기 플래시 메모리의 셀들의 소거, 및ⅲ) 상기 플래시 메모리의 셀들로부터의 데이터의 판독중 적어도 선택된 것을 가능하게 하는, 메모리 시스템.
- 청구항 17에 있어서,상기 메모리 장치는 메모리 시스템에서 다중 메모리 장치중 하나이고, 각각의 메모리 장치는 상기 제1 전압 및 상기 제2 전압을 수신하도록 구성되고, 상기 각각의 메모리 장치는, ⅰ) 상기 제1 전압에 의해 전원이 인가되는 각각의 플래시 메모리, 및 ⅱ) 상기 제2 전압을 상기 각각의 플래시 메모리에 의해 사용되는 더 높은 내부 전압의 세트로 변환하여 그 내부의 데이터를 관리하는 각각의 전원 관리 회로를 포함하는, 메모리 시스템.
- 청구항 16에 있어서,상기 제1 전압은 Vpp이고, 상기 제2 전압은 Vcc인, 메모리 시스템.
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- 청구항 1에 있어서,상기 제2 전압의 크기가 상기 제1 전압의 크기보다 실질적으로 큰, 멀티-핀의 패키지화된 메모리 장치.
- 청구항 26에 있어서,상기 제2 전압의 크기가 상기 제1 전압의 크기의 적어도 2배인, 멀티-핀의 패키지화된 메모리 장치.
- 청구항 27에 있어서,상기 제1 내부 전압은 크기가 상기 제2 전압의 크기보다 크고,상기 제2 내부 전압은 크기가 상기 제2 전압의 크기보다 큰, 멀티-핀의 패키지화된 메모리 장치.
- 청구항 1에 있어서,상기 제1 전압의 크기는 3.3V보다 작고, 상기 제2 전압의 크기는 5V보다 큰, 멀티-핀의 패키지화된 메모리 장치.
- 청구항 1에 있어서,상기 플래시 메모리에 상기 제1 내부 전압을 전달하는 제1 도전 경로, 및상기 플래시 메모리에 상기 제2 내부 전압을 전달하는 제2 도전 경로를 포함하는, 멀티-핀의 패키지화된 메모리 장치.
- 청구항 1에 있어서,상기 제2 전압을 상기 제1 내부 전압 및 상기 제2 내부 전압으로 변환하는 것은 상기 제1 전압을 상기 제1 내부 전압 및 상기 제2 내부 전압으로 변환하는 것보다 더 높은 전력 변환 효율을 제공하는, 멀티-핀의 패키지화된 메모리 장치.
- 청구항 1에 있어서,상기 전원 관리 회로는 상기 제2 전압을 수신하여 상기 제2 내부 전압을 생성하는 다단 차지 펌프를 포함하며, 상기 다단 차지 펌프는 상기 제1 전압을 상기 제2 내부 전압으로 변환하기 위해 필요한 단계보다 상기 제2 전압을 상기 제2 내부 전압으로 변환하기 위해서 더 적은 단계들을 갖는, 멀티-핀의 패키지화된 메모리 장치.
- 청구항 1에 있어서,상기 제1 전압과 상기 제2 전압은 상이한 전원으로부터 생성되는, 멀티-핀의 패키지화된 메모리 장치.
- 청구항 1에 있어서,상기 플래시 메모리에 저장된 데이터에 액세스를 제공하는 입/출력 로직을 더 포함하고, 상기 입/출력 로직은 상기 제1 전압에 의해 전원이 인가되는, 멀티-핀의 패키지화된 메모리 장치.
- 청구항 1에 있어서,상기 전원 관리 회로가 제1 전압을 수신하여 상기 제1 차지 펌프 회로와 상기 제2 차지 펌프 회로 이외의 상기 전원 관리 회로의 적어도 일부에 전원을 인가하는, 멀티-핀의 패키지화된 메모리 장치.
- 청구항 1에 있어서,상기 제1 내부 전압과 상기 제2 내부 전압을 생성하기 위해 상기 제1 전압의 사용과 상기 제2 전압의 사용의 사이에서 선택하는 스위치 회로를 더 포함하는, 멀티-핀의 패키지화된 메모리 장치.
- 청구항 1에 있어서,상기 제1 전압 또는 상기 제2 전압 중에서 특정하여, 그것으로부터 상기 제1 내부 전압과 상기 제2 내부 전압을 생성하는 구성 레지스터를 더 포함하는, 멀티-핀의 패키지화된 메모리 장치.
- 청구항 16에 있어서,상기 메모리 장치는 상기 메모리 시스템의 다중 메모리 장치중 하나이고, 상기 메모리 시스템은 제1 도전 경로와 제2 도전 경로를 포함하고, 상기 제1 도전 경로는 제1 전압을 상기 다중 메모리 장치의 각각에 전달하고, 상기 제2 도전 경로는 제2 전압을 상기 다중 메모리 장치의 각각에 전달하는, 메모리 시스템.
- 청구항 38에 있어서,입력 전압을 상기 제1 전압과 상기 제2 전압으로 변환하도록 구성된 전원 컨버터를 더 포함하는, 메모리 시스템.
- 청구항 38에 있어서,상기 메모리 시스템은 컴퓨터에 플러그되는 썸(thumb) 드라이브 장치인, 메모리 시스템.
- 청구항 1에 있어서,상기 플래시 메모리는 NAND 플래시 메모리인, 멀티-핀의 패키지화된 메모리 장치.
- 청구항 1에 있어서,상기 플래시 메모리는 NOR 플래시 메모리인, 멀티-핀의 패키지화된 메모리 장치.
- 청구항 1에 있어서,마스터 클럭 신호를 생성하는 발진기;상기 마스터 클럭 신호를 수신하고, 상기 마스터 클럭 신호에 기초하여 상기 제1 차지 펌프 회로의 동작을 제어하기 위한 신호를 생성하도록 구성된 제1 드라이버 회로; 및상기 마스터 클럭 신호를 수신하고, 상기 마스터 클럭 신호에 기초하여 상기 제2 차지 펌프 회로의 동작을 제어하기 위한 신호를 생성하도록 구성된 제2 드라이버 회로를 더 포함하는, 멀티-핀의 패키지화된 메모리 장치.
- 청구항 1에 있어서,제1 기준과 제2 기준을 생성하는 기준 생성기 회로;상기 제1 기준 및 상기 제1 내부 전압을 수신하여, 상기 제1 내부 전압이 조정(regulation) 내에 있는지를 나타내는 출력을 생성하는 제1 조정기 회로; 및상기 제2 기준 및 상기 제2 내부 전압을 수신하여, 상기 제2 내부 전압이 조정 내에 있는지를 나타내는 출력을 생성하는 제2 조정기 회로를 더 포함하는, 멀티-핀의 패키지화된 메모리 장치.
- 청구항 1에 있어서,상기 플래시 메모리는 비트 정보를 저장하는 데이터 셀을 포함하고, 상기 데이터 셀은 기판 컨택트, 게이트 컨택트, 소스 컨택트, 및 드레인 컨택트를 포함하는, 멀티-핀의 패키지화된 메모리 장치.
- 청구항 45에 있어서,상기 플래시 메모리는, 상기 게이트 컨택트에 접지 전위를 인가하고, 상기 드레인 컨택트에 개방 회로를 적용하고, 상기 소스 컨택트에 개방 회로를 적용하고, 상기 기판 컨택트에 제1 내부 전압을 인가함으로써 상기 데이터 셀을 소거하는, 멀티-핀의 패키지화된 메모리 장치.
- 청구항 45에 있어서,상기 플래시 메모리는, 상기 게이트 컨택트에 제2 내부 전압을 인가하고, 상기 드레인 컨택트, 상기 소스 컨택트, 및 상기 기판 컨택트 각각에 접지 전위를 인가함으로써 상기 데이터 셀을 프로그램하는, 멀티-핀의 패키지화된 메모리 장치.
- 청구항 45에 있어서,상기 플래시 메모리는, 제1 내부 전압을 상기 드레인 컨택트에 인가하고, 상기 드레인 컨택트, 상기 소스 컨택트, 및 상기 기판 컨택트 각각에 접지 전위를 인가함으로써 상기 데이터 셀로부터 판독하는, 멀티-핀의 패키지화된 메모리 장치.
- 청구항 45에 있어서,상기 플래시 메모리는, 제2 내부 전압을 상기 드레인 컨택트에 인가하고, 상기 드레인 컨택트, 상기 소스 컨택트, 및 상기 기판 컨택트 각각에 접지 전위를 인가함으로써 상기 데이터 셀로부터 판독하는, 멀티-핀의 패키지화된 메모리 장치.
- 데이터를 저장하는 메모리;상기 메모리에 전원을 인가하기 위해 제1 전압을 수신하는 제1 전원 입력핀;상기 제1 전압보다 큰 제2 전압을 수신하는 제2 전원 입력핀; 및상기 제2 전압을 수신하여, 상기 메모리 내의 데이터로의 액세스를 제어하기 위해 적어도 제1 내부 전압과 제2 내부 전압을 인출하는 전원 관리 회로를 포함하고,상기 전원 관리 회로는,ⅰ) 상기 제2 전압을 상기 제1 내부 전압으로 변환하는 제1 회로, 및ⅱ) 상기 제2 전압을 상기 제2 내부 전압으로 변환하는 제2 회로를 포함하는, 멀티-핀의 패키지화된 메모리 장치.
- 제1 전압을 수신하는 단계;상기 제1 전압을 활용하여 플래시 메모리에 전원을 인가하는 단계;상기 제1 전압보다 큰 제2 전압을 수신하는 단계;상기 제2 전압을, 상기 플래시 메모리와 연관된 메모리 제어 동작들을 가능하게 하는 복수의 내부 전압으로 변환하는 단계;상기 제2 전압보다 큰 상기 복수의 내부 전압 각각을 생성하는 단계; 및상기 복수의 내부 전압을 활용하여 상기 플래시 메모리에 대한 데이터 액세스 동작들을 실행하는 단계를 포함하는 방법.
- 청구항 51에 있어서,상기 생성하는 단계는:상기 플래시 메모리와 동일한 기판에 위치하는 전원 공급 회로를 동작시켜 상기 제2 전압보다 큰 제1 내부 전압을 생성하는 단계;상기 제1 내부 전압을 상기 플래시 메모리에 공급하는 단계;상기 플래시 메모리와 동일한 기판에 위치하는 상기 전원 공급 회로를 동작시켜 상기 제2 전압보다 큰 제2 내부 전압을 생성하는 단계; 및상기 제2 내부 전압을 상기 플래시 메모리에 공급하는 단계를 포함하는 방법.
- 제1 전압;제2 전압; 및메모리 장치를 포함하고, 상기 메모리 장치는:- 상기 제1 전압에 의해 전원이 인가되는 플래시 메모리, 및- 상기 제2 전압을 수신하여 상기 플래시 메모리에 의해 이용되는 복수의 내부 전압으로 변환하는 전원 관리 회로를 포함하고,상기 제2 전압은 상기 제1 전압보다 크고, 상기 복수의 내부 전압은 각각 양적으로 상기 제2 전압보다 크며;상기 전원 관리 회로에 의해 생성된 상기 복수의 내부 전압은:ⅰ) 상기 플래시 메모리의 셀의 프로그래밍,ⅱ) 상기 플래시 메모리의 셀의 소거, 및ⅲ) 상기 플래시 메모리의 셀로부터의 데이터의 판독중 선택된 적어도 하나를 가능하게 하는, 메모리 시스템.
- 청구항 53에 있어서,상기 플래시 메모리는, 상기 전원 관리 회로에 의해 생성되는 상기 복수의 내부 전압을 활용하여 상기 플래시 메모리에 저장된 데이터를 관리하는, 메모리 시스템.
- 청구항 53에 있어서,회로 기판을 더 포함하고,상기 메모리 장치는 상기 회로 기판에 위치하며;상기 회로 기판은:i) 제1 전원으로부터의 상기 제1 전압을 상기 메모리 장치의 제1 전원 입력핀에 전달하는 제1 도전 경로, 및ii) 제2 전원으로부터의 상기 제2 전압을 상기 메모리 장치의 제2 전원 입력핀에 전달하는 제2 도전 경로를 포함하는, 메모리 시스템.
- 청구항 54에 있어서,상기 메모리 장치는 상기 메모리 시스템의 복수의 메모리 장치 중 하나이며, 상기 메모리 장치들 각각은 제1 전압 및 제2 전압을 수신하도록 구성되고, 상기 메모리 장치들 각각은:i) 상기 제1 전압에 의해 전원이 인가되는 각각의 플래시 메모리, 및ii) 상기 제2 전압을, 그 안의 데이터를 관리하는 상기 각각의 플래시 메모리에 의해 이용되는 더 높은 내부 전압들의 세트로 변환하는 각각의 전원 관리 회로를 포함하는, 메모리 시스템.
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