JPS61287176A - 半導体素子の製造方法 - Google Patents

半導体素子の製造方法

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JPS61287176A
JPS61287176A JP61054540A JP5454086A JPS61287176A JP S61287176 A JPS61287176 A JP S61287176A JP 61054540 A JP61054540 A JP 61054540A JP 5454086 A JP5454086 A JP 5454086A JP S61287176 A JPS61287176 A JP S61287176A
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    • C23CCOATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
    • C23C16/00Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes
    • C23C16/44Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the method of coating
    • C23C16/54Apparatus specially adapted for continuous coating
    • CCHEMISTRY; METALLURGY
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    • H01L31/042PV modules or arrays of single PV cells
    • H01L31/0445PV modules or arrays of single PV cells including thin film solar cells, e.g. single thin film a-Si, CIS or CdTe solar cells
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    • YGENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y02TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
    • Y02EREDUCTION OF GREENHOUSE GAS [GHG] EMISSIONS, RELATED TO ENERGY GENERATION, TRANSMISSION OR DISTRIBUTION
    • Y02E10/00Energy generation through renewable energy sources
    • Y02E10/50Photovoltaic [PV] energy

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明は半導体デバイスのアレイが上に形成される基板
、及び該基板を用いた光起電力デバイスに関する。
本発明は、更に光起電カバネルの製造方法に圓する。
本発明は、更に比較的高いアクセプタ濃度を有するP形
シリコン膜を効率的に形成する方法に関し、更に全体的
に又は部分的に非晶質のP形およびN形のシリコン膜を
連続的に堆積および形成することを含むバッチ法又は連
続法において改良されたP−N素子およびP−I −N
素子が形成できるように前記方法から製造された素子に
関する。
本発明は、ダイオード、スイッチ、およびトランジスタ
の如き増幅素子の製造に用いられるが、最も重要な用途
は太陽電池その他のエネルギ変換素子の如き光起電力乃
至光電作用素子の製造にある。
結晶質半導体技術は商業的な水準に達したが、この技術
は今日の巨大な半導体素子製造産業の基礎となった。こ
れは、実質的に欠陥のないゲルマニウム、特にシリコン
の結晶を成長させ、更にこれ等の結晶をその内部のP形
又はN形の伝導領域を有する外因性物質に転じる科学者
の能力に依るものであった。このことは、このような結
晶質の材料に、実質的に純粋な結晶質材料に置換不純物
としてl)E)m程度のドナー(N)又はアクセプタ(
P)となるドープ物質を拡散させて、その導電率を高め
かつそれ等のP形又はN形の導電性を制御することによ
って達成された。P−N接合および光電作用を有する結
晶質半導体デバイスを形成する製造プロセスは、非常に
複雑で、時間を要し、高価な工程を含む。太陽電池およ
び電流制御素子において有用なこれ等の結晶質材料は、
個々のシリコン又はゲルマニウムの単結晶を成長させる
ことにより、又P−N接合が必要な場合は、非常に少い
臨界量のドープ物質をこのような単結晶にドープするこ
とによって、非常に慎重に制御された条件下で形成され
る。
これ等の結晶成長プロセスでは比較的小さな結晶しか形
成されないため、単一の太陽電池パネルの所要領域をカ
バーするのに多くの単結晶を組合せて太陽電池をつくら
ねばならない。
このような方法で1つの太陽電池を製造するのに必要な
エネルギ量、シリコン結晶の寸法限度により生じる制約
、およびこのような結晶質材料の切断および組合せの必
要性は、全てエネルギ変換用の結晶質半導体太陽電池の
大m模な使用に対する実施不能な経済的障壁をもたらす
ことになる。更に、結晶質シリコンは、間接光学端を有
している故、光吸収が少ないため、結晶質の太陽電池は
入射太陽光を吸収するように少くとも50ミクロンの厚
さにしなければならない。仮に、この結晶質材料を比較
的安価な製造プロセスを用いて多結晶シリコンで置換し
ても、前記間接光学端の問題は依然として存在し、従っ
て材料の厚さは減少され得ない。この多結晶材料ではま
た粒界その他の欠点が加わる。一方、非晶質シリコンは
直接光学端を有し、結晶質シリコンと同臘の太陽光を吸
収するため僅か1ミクロンの厚さの材料しか必要としな
い。
従って、必要に応じて比較的大きな面積を覆うことがで
き、付着(堆積)設備の寸法に一辷ってしか制約を受け
ず、結晶質の場合に形成されるものと同等のP−N接合
が形成されるP形およびN形の材料を得るため容易にド
ープできる非晶質半導体膜を容易に付着させるプロセス
を開発するための多大の努力がなされて来た。長い年月
にわたってこのような作業は殆んど成果を挙げなかった
非晶質シリコン又はゲルマニウム(第■族)の膜は、エ
ネルギ・ギャップ中に高密度の局在状態を生じる微小孔
、ダングリング結合その他の欠陥を有することが判った
。非晶質シリコン半導体膜のエネルギ・ギャップ中に高
密度の局在状態がある場合、光伝導率が小さくなり、拡
散距離が短かくなり、その結果この膜を太陽電池の用途
には不適格なものにする。更に、このような膜は、フェ
ルミ単位を伝導帯又は価電子帯に近づけるように移動さ
せるドープその他の変成装置が成功せず、太陽電池およ
び電流制御素子用のショットキー・バリア又はP−N接
合の形成には不適合なものとなる。
非晶質シリコンおよびゲルマニウムに関する前述の諸問
題を最小限に抑える試みとして、スコツトランド・ダン
ディ−市ダンディー大学のカーネギ−物理学研究所のW
、E、スピア(S pear)およびP、G、ル・コン
パ(L e Co1bcr )は、ノックr2年版「ソ
リッド・ステートコミュニケーションズ(Solid 
 5tate  Communications)J第
17巻、1193〜1196頁に記載の論文において発
表された如く、非晶質のシリコン又はゲルマニウムを真
性の結晶質シリコン又はゲルマニウムに更に近似させる
ため非晶質シリコン又はゲルマニウムのエネルギ・ギャ
ップ中の局在状態を減少させ、結晶質材料をP形又はN
形伝導形性の外因性にするための結晶質材料へのドーピ
ングにおける如く、前記非晶質材料に適当な従来のドー
プ物質を置換的にドープするため、「非晶質シリコンへ
の置換形ドーピングJなる研究を行った。
局在状態の減少は非晶質シリコン膜のグロー放電堆積法
によって達成された。この方法では、シラン(S t 
H4)のガスが反応管を通され、反応管において、シラ
ンガスが高周波グロー放電によって分解されて約SOO
〜eoo″K (227〜327℃)の基板温度におい
て基板上に堆積せしめられた。このようにして基板上に
付着された材料は、シリコンおよび水素からなる真性の
非晶質材料であった。
ドープされた非晶質材料を形成するため、N形伝導用に
はホスフィン(PH3>のガスが、あるいはP形伝導用
にはジボラン(82H6)のガスが、シラン・ガスと予
め混合されて、同じ操作条件下でグロー放電反応管内に
送られた。使用されたドープ物質の気体濃度は約5×1
0  乃至10−2体積部の範囲内であった。このよう
に付着された材料は、ドープ物質としてのリン又はホウ
素をおそらくは置換形で含み、外因性のN形又はP形伝
導を呈した。しかし、同堡の添加されたドープ物質に対
するドープ効率は結晶質シリコンの場合よりも遥かに低
かった。高濃度にドープされたN又はP形材料の導電率
は低く、約10−2又は10’ (0cm) −1であ
った。更に、バンド・ギャップは、特にジボランを用い
たP形ドープの場合に、ドープ材料の添加の故に狭くな
った。このような結果は、ジボランが、非晶質シリコン
に効果的にドープされずにバンド・ギャップ中に局在状
態を生じさせたことを示す。
前述の如く、非晶質のシリコンおよびゲルマニウムは通
常四配位結合され、一般に微小孔、ダングリング結合又
は他の欠陥形態を有してエネルギ・ギャップ中に局在状
態を生じる。前記研究者達には知られていなかったが、
現在ではシラン中の水素がグロー放電堆積の闇、最適温
度でシリコンの多くのダングリングボンドと結合し、非
晶質材料を対応する結晶質材料と更に近似させるように
、エネルギ・ギャップ中の局在状態の密度を、実質的に
減少させることが他の研究によって知られている。
しかし、水素のとり込みはシランにおける水素対シリコ
ンの固定比率によって制限されるのみならず、最も重要
なことには、種々のSi :Hの結合形態がこれ等の材
料において有害な結果をもち得る新しい反結合状態をも
たらす。従って、特に、有効なP形ならびにN形ドープ
に関して特に有害なこれ等材料の局在状態の密度を減少
させる上で基本的な制限がある。シランを用いて堆積さ
せた材料の望ましくない状態密度は狭い空乏層中をもた
らし、これが更に、その動作がフリーキャリアのドリフ
トに依存する太陽電池その他の素子の効率を制限する。
シリコンおよび水素のみを用いてこれ等材料をつくる方
法の場合にも、高密度の表面状態が生じ、前述の全ての
パラメータに影響を及ぼすことになる。
シラン・ガスからのシリコンのグロー放電堆積の開発が
行われた後、アルゴンと水素分子の混合物の雰囲気(ス
パッタリング法の場合に必要)で非晶質シリコン膜のス
パッタ堆積の仕事が行なわれ、堆積された非晶質シリコ
ン膜の特性に対するこのような水素分子の影響を決定す
ることが検討された。この研究は、エネルギ・ギャップ
中の局在状態を減少するように結合した変更物質として
水素が作用したことを示した。しかし、エネルギ・ギャ
ップ中の局在状態がスパッタ付着(堆積)法において減
少する程度は前述のシランを用いた付着堆積法により達
成された程度よりも遥かに少かった。スパッタリング法
においても前述のP形およびN形ドープ用ガスを導入し
てP形およびN形にドープした材料を形成した。これ等
の材料はグロー放電法において形成された材料よりも更
に低い効率を有していた。いずれのプロセスでも市販の
P−N又はP−I−N接合素子を形成するに十分に高い
アクセプタ濃度を有する有効なPドープ材料がつくられ
なかった。N形ドーピング効率は望ましい商業レベルに
達せず、P形ドーピングはバンド・ギャップ中を減少さ
せ、バンド・ギャップ中の局在状態の数を増大させたた
め特に望ましくなかった。
結晶質シリコンに更に近似させようとする試みにおいて
、シラン・ガスからの水素によって変成され、結晶質シ
リコンへのドープと同様にドープされた非晶質シリコン
の今までの堆積物は、全ての重要な点において、ドープ
された結晶シリコンの特性よりも劣る特性を有する。特
にP形材料においてドーピング効率およびI11!性は
不十分なものであり、このシリコン膜の光導電および光
起電力特性には望まれるべきことが多く残された。
局在状態の密度が非常に小さな非晶質シリコン膜の形成
における実質的な突破口は、非晶質膜、特に非晶質半導
体材料の関連する望ましい属性を有するシリコンの非晶
質膜を形成した弊米印特許第4,217,374号およ
び同第4.226.898号に開示された発明によって
開かれた。(前者の米国特許は蒸着法を用いる改良され
た非晶質シリコン膜の堆積法を開示し、後者の特許はシ
リコンを含むガスのグロー放電による改良された非晶質
シリコン膜の付着(堆積)法を開示する。)これ等の特
許において開示されたプロセスにより形成された改良さ
れた真性の非晶質シリコン膜では真性材料におけるバン
ド・ギャップ中の状態数が減少されており、非常に大き
なN形ドーピング効率と、大きな光導電性と、増加した
易動度と、長いキャリア拡散長さと、光電池において必
要な暗所における小さな真性導電率を提供する。この非
晶質半導体膜は、太陽電池およびP−N接合素子、ダイ
オード、又はトランジスタ等を含む電流制御素子の如き
更に効率のよい素子の製造に使用可能である。
本発明の一実施例では、望ましくは非晶質膜の付着形成
中に、非晶質半導体材料のエネルギ・ギャップ中の局在
状態を大巾に減小させて多くの点で真性結晶質シリコン
と同等にするように、非晶質半導体材料と合金を作り、
これを変成すると考えられる変成即ち補償材料を含有さ
せる。前記の米国特許第4,226,898号に開示さ
れたシリコン膜の形成プロセスにおいては、−構成元素
としてシリコンを含む化合物がグロー放電分解によって
分解され、グロー放電堆積の間、複数の変成元素、好ま
しくは活性化されたフッ素および水素をとり込ませつつ
、非晶質シリコンを基板上に堆積させる。
優者の特許の特定の実施態様においては、堆積非晶質膜
のシリコンと一つの変成即ち補償元素としてのフッ素と
を供給する四フッ化シリコン(S i F4)のグロー
放電によって約380℃の基板温度においてシリコンが
バッチ・モードで堆積される。
四フッ化シリコンはグロー放電の際プラズマを形成し得
るが、この物質はシリコンのグロー放電堆積のため出発
物質としてはそれ自体それ程有効なものではない。グロ
ー放電のための雰囲気は水素分子(H2)の如き気体を
添加することによってより反応性になるが、これは水素
分子を水素原子又は水素イオン等に変えることによって
グロー放電により反応性を高められる。この反応性の(
高い)水素は、グロー放電において、その分解を更に容
易にしかつこれから基板上に非晶質シリコンを付着させ
るように四フッ化シリコンと反応する。同時に、フッ素
および種々のシリコンの亜フッ化物がグロー放電によっ
て解離され、反応性にされる。反応性水素および反応性
フッ業種は、非晶質シリコンの主マトリックスが堆積さ
れている際、非晶質シリコンの主マトリックスにとり込
まれ、欠陥状態の数が少い新しい真性材料を生成する。
この新しい合金を考察する簡単な方法は、ダングリング
ボンドのキャッピング(capping)の充満および
他の欠陥の除去が生じることである。
このため、このような変成用元素はエネルギ・ギャップ
中の局在状態の密度を実”質的に減少させ前述の有利な
結果を生じさせる。
非晶質シリコン半導体マトリックスにN形およびP形の
導電性を付与することが必要な場合、このマトリックス
の使用は膜のグロー放電堆積の閤変成用元素の気体形態
でのとり込みを推奨する。
N形伝導を得るため推奨された変成元素即ちドープ物質
は、気相のホスフィン(PH3)およびアルシン(A、
H3)の形のリンおよびヒ素である。P形伝導特性を得
るための推奨変成元素すなわちドープ物質は、気相のジ
ボラン(82H6)、A!  (C2H5)3 、Ga
(CH3)3および1n(H3)3の形のホウ素、アル
ミニウム、ガリウムおよびインジウムである。この変成
元素は、約380℃の基板温度で、真性材料の場合につ
いて説明したと同じ堆積条件の下で添加された。
前述の用途において堆積されたシリコン素子を形成する
プロセスは重要な改善をもたらして改良された太陽電池
その他の素子の製造を可能にするが、P形ドープされ付
着されたシリコン材料は必要とされるだけの効果的なP
形伝導特性をもたなかった。[ジャーナル・オブ・ノン
クリスタン・ソリツズ(J oBnal of N o
n −Crystal l 1ne3o1ids)J第
35巻および第36巻、バートエ、1980年1月72
月号の171〜181頁に報告された如く、真性材料及
びn+層に対応して堆積用気体中に500ppg+のP
H3を添加する。堆積気体中にシボラン(82H6)を
添加すると、光吸収に大きな変化が生じる。示唆される
ことは、更に狭いバンド・ギャップを有し、P形の特性
を呈するホウ素を含む新しい合金が合成されたことであ
る。ホウ素に特有の3中心結合が部分的にはこの挙動の
原因になり得る。このことは、従来のN彫物質が形成さ
れる′リン又はヒ素が添加される時に得られる結果と対
照的である。
ショットキー障壁又はMIS素子の如き素子はP形ドー
プされた膜の有無に拘わらず形成可能であるが、一般に
MIS素子で用いられる薄い障壁層の特性は制御が難か
しく、屡々周囲の元素が拡散するのを防止するよう十分
に密閉することができず、その結果素子は屡々不安定に
なるため、製造が難しい。更に、このような構造体では
素子のレベルが高くなるとシート抵抗が高くなる。所要
の効率および安定性を有する光電池はP−N又はP−1
−N接合の使用を必要とするように思われる。この目的
のため、電池の効率を高めるには改良されたP−ドープ
された物質が望ましい。
前掲の後者の米国特許において開示されたフッ素および
水素で補償されたグロー放電堆積によるシリコン膜を形
成する際、シリコンは約380℃の基板温度で付着され
ることが望ましい。この基板温度以上では、水素の補償
効率が徐々に低下し、約450℃より高い温度では、水
素が堆積中のシリコンと容易“に結合しないため、前記
効率は大きく低下する。
前述の如く、気相のP形ドープ物質の導入は、一応P形
物質を生ぜしめるものの、所望の四価の即ち四配位の結
合が生じるのみであるならば、理論上実現されるはずの
P形伝導効率を有する物質を生成しない。シリコン材料
の最も有効な水素補償のために必要な400℃以下のグ
ロー放電時の基板温度においては、−見P形ドープ物質
のあるものは、結晶質の拘束が存在しない故に、四面体
状ではなく三配位されて、このためギャップ中にドープ
ではない付加的状態を生じさせるものと考えられる。ジ
ボランを含む他のプロセスは、その金属部分乃至ホウ素
がその炭化水素又は水素の関連する置換基から容易に完
全に解離せず、又このためこのような形態ではシリコン
の主マトリックスに対する有効なP形ドープ元素を提供
しないため、3中心結合の形成その他の効率の低い結合
をもたらす。更に、このような物質のバンド・ギャップ
中にP形ドーピング効率を低下させると考えられる状態
が付加される。
従って、グロー放電法により堆積されたシリコン材料中
の前記P形ドープ元素のP形ドービンク効率を改善する
ため多くの努力が払われて来た。
真性層又はP−N接合を形成した空乏領域を必要とする
光電池その他の用途のためのシリコンのグロー放電によ
る堆積は、水素およびフッ素の補償の程度およびその結
果得られる物質における状態密度の減少がシリコンの蒸
着又はスパッタにより得られる場合よりも優れているた
め、現在のところ、望ましい付着方法と考えられる。
本発明は、前記諸点に温みなされたものであり、その目
的とすると、ころは、基板上に形成される複数の半導体
デバイス間の直列接続が容易に行なわれ得る基板を提供
することにある。
本発明によれば、前記した目的は、半導体層から形成さ
れる半導体デバイスの電気的に相互接続されたアレイの
製造に用いられる改良基板であって、比較的厚く導電性
で可撓性の支持層を有しており、比較的薄く可撓性で電
気絶縁体層が前記支持層と前記半導体層との間に介在せ
しめられるように構成された基板によって達成される。
本発明の好ましい一興体例では、前記支持層が金属から
なる。
また、本発明の好ましい一興体例では、少なくとも一つ
のmiが前記電気絶縁体と、前記半導体層との間に配置
されるように構成されており、更に好ましくは、半導体
層が前記の少なくとも一つの電極及び電気絶縁体上に堆
積されるように構成されている。
本発明の別の目的は、前記基板を用いた光起電力デバイ
スを提供することにある。
本発明によれば、前記した目的は、 第一の電極と、 該第一の電極の下側に位置しており、該第一の電極に接
触している半導体層と、 該半導体層の部分の下側に位置しており、該半導体層の
部分に接触している第二の電極と、該第二の電極及び前
記半導体層の下側に位置しており、該第二の電極及び該
半導体層に接触している基板とからなり、 該基板が、 前記第二の電極及び前記半導体の下側に位置しており、
前記第二の電極及び前記半導体と接触している比較的薄
く可撓性の電気絶縁体1と、前記電気絶縁体の下側に位
置しており、該電気絶縁体と接触している比較的厚く導
電性の可撓性支持層と からなる光起電力装置によって達成される。
本発明の好ましい一具体例では、前記支持層が金属から
なる。
本発明の一実施例では、化合物を含む気体のグロー放電
によって順々に堆積された異なる導電形の半導体合金材
料層で光起電カバネルを作製する方法であって、減圧状
態の少なくとも二つのグロー放電領域の各々において、
加熱されて昇温されている基体上に前記半導体合金材料
を堆積させること、所定のドープ物質含有化合物を、前
記グロー放電領域のうちの少なくとも一つの領域では気
相中に含ませておくと共に、前記グロー放電領域のうち
の他の領域では存在させないでおく方法であり、且つ異
なる導電形の半導体合金材料層を順々に堆積させるため
の前記複数のグロー放電領域をとおるように前記基体を
ある径路に沿って連続的に移動させること、前記一つの
領域の前記所定のドープ物質含有化合物が前記基体の移
動径路に関して該一つの領域の直前又は直後の前記他の
領域の気相を汚染しないようにこれらの領域の気相を相
互に分離することによって光起電カバネルが作製される
本発明の一実施例では、前記基体として可撓性ウェブが
用いられる。
また、本発明の一実施例では、個々別々の堆積室に前記
領域を設ける。
更に、本発明の一実施例では、更にp、i及びn形の半
導体合金材料の層を前記の個々別々の堆積室の夫々の室
で順々に堆積させる。
尚、本発明の一実施例では、前記半導体合金材料として
シリコンを用いる。
本発明の一実施例では、より効率的にドープされたP形
物質を形成するため、又はより効率的にP形ドープされ
たシリコン材料を有するP−N乃至P−1−N11合素
子を形成するため、グロー放電によるシリコン堆積のバ
ッチ法又は連続法において、P形ドープをより効率的に
行う。
従来技術におけるP形ドープされた物質の形成方法は、
真性材料に対して最適化された堆積条件下でジボランの
如き従来のドープ物質用気体を使用することに限定され
て来た。これ迄は、有効な非晶質シリコンの調製のため
必要とされる温度範囲外にあると考えられて来た約45
0℃以上の基板温度で付着された非晶質(又は多結晶質
)のシリコンのグロー放N堆積法において、P形ドープ
物質の気体状のホウ化物(B2H,の如き)およびP形
ドープ用金属の気体状化合物を使用可能であるとは誰も
考えなかった。
本発崩の一実施例は又、約450℃以上で物質を堆積さ
せることによって、更に効率的にP形ドープされたグロ
ー放電堆積シリコンを形成する方法も含むものである。
このような高い温度で堆積されたシリコン物質では、水
素補償の利点を失うことは、特にP形ドープされた堆I
IIが開通する電極とオーミックなP+界面を形成する
場合、P形ドーピングの効率向上により十分以上に克服
される。前述の如く、このような高温度においては、ホ
ウ素又は金属性のP形ドープ用元素が使用された気体状
化合物の水素および炭化水素構成元素から十分に実質的
に解離されるため、3中心結合その他の望ましくない結
合配置が除かれるものと考えられる。P形ドープに対し
て有効な所望の四面(四面体)結合がこのようにして得
られる。P形ドープ用金属(即ち、ARlGa、In、
ZnおよびTI >の化合物の気体も又約400℃又は
これより低い基板温度を用いるシリコンのグロー放電堆
積の際のP形ドープ物質としては有効でないが、これ等
の元素は本文に説明されたシリコンのグロー放慣用のよ
り高い基板温度(即ち、少くとも約450℃の温度〉を
用いる気体化合物形態の良好なP形ドープ物質である。
約450℃以上の高い基板温度ではシリコン材料の水素
補償の効率は低い結果となり得るが、700℃乃至80
0℃までの範囲内の基板温度ではフッ素が堆積されたシ
リコンと効率的に結合するため、この材料はフッ素によ
って依然として効果的に補償される。
水素又はフッ素補償なしに堆積された非晶質シリコンの
場合、基板温度が約550℃で結晶化過程が重要となる
。水素補償の非晶質シリコンの堆積および(又は)合金
化のため、非晶質状態は実質的に約650℃の基板m 
Ifまで維持される。水素で補償されたホウ素がドープ
された非晶質シリコンの場合は、約700℃の基板温度
まで非晶質状態が維持される。フッ素が添加される場合
、堆積される材料の非晶質状態は更に高い基板温度の場
合までひろがる。このことから、この方法では、700
℃以上の基板温度においてホウ素でドープされたフッ素
補償の行われた非晶質シリコンが生成され得ることが明
らかである。水素およびフッ素によって補償されたシリ
コン膜が実質的に非晶質のま)であるような付着基板温
度により達成されたドーピンη・1ノベルけ7@る一−
ピング用途に対して十分である。更に高いドーピング・
レベルに対しては、非晶質材料がシリコンの微結晶と混
成状態になるか、あるいは実質的に多結晶となるように
、比較的/高い堆積基板温度を使用することができる。
堆積させられた非晶質シリコン中の結晶物質の包含又は
実質的に多結晶のP形ドープされた物質の使用は、P−
N又はP”−1−N+形光起電力素子の効率を損うこと
はない。この効率は、多結晶シリコンにおけるP形ドー
ピング効率は十分に既知であり、又微結晶の光吸収性は
非晶質物質よりも低い放光活性層中での光子吸収性が悪
影響を受けないため、素子の効率が損われることはない
吸収率が高い非晶質物質の場合は、P”−I−N+構造
のP+層が1000Å以下と言う薄さに保持され、この
層が光活性層でないため光子の吸収が最小限度に抑えら
れる。この層厚は更に、有効な光起電力作用を得るため
素子のP 層と真性層間の伝導帯および価電子帯を曲げ
るに十分な正のキャリアを提供する。非晶質シリコンへ
のシリコン微結晶の添加は、P”−1−N+素子の効率
を損わない許りでなく、非晶質のP形物質と比較して結
晶質P形物質のより大きい正孔移動度およびより大きい
光伝導率の故に、P−N形光型素子の効率を補うことが
できる。
又、本発明の一実施例は、従来用いられてなかった非気
体状材料をドープ物質として使用することによってP形
ドーピングの難かしさを除去する方法をも開示する。こ
の方法は、固体金属を蒸発させて、金属蒸気をシリコン
堆積用気体と共に直接グロー放電室に連続的あるいは間
欠的に供給するように、固体金属を高温度迄加熱するこ
とを含む。金属蒸気の形態のP形ドープ用金属は、フッ
素および水素補償が望ましい比較的低い基板温度でのシ
リコンのグロー放電堆積法において有効である。これ等
の気化されたP形ドープ用金属は又、水素保証が必要で
ない比較的高い基板温度でのグロー放電シリコン堆積膜
と共に使用できる。
本発明の一実施例では、P形ドープ物質であるホウ素乃
至金属材料をN形および真性のグロー放電堆積された非
晶質物質と結合された連続ブ0セスで堆積させ、改良さ
れたP−NおよびP−I−N接合の光起電力素子等を製
造することができる。
連続法において、連続する帯状材上に特定の所要のP形
およびN形および(又は)真性のシリコン膜を効率的に
堆積させるに必要な基板温度その他の周囲条件を各々が
有する別個の堆積ステーションを経て帯状基板が連続的
又は段階的に移動される際、前記各物質が帯状基板上に
グロー放電法で堆積させられる。本発明の連続的な製造
法においては各堆積ステーションが1つの層(P、I。
Nのいずれか)の堆積のため専用化されるが、これは堆
積材料がステーションの背景環境を汚染して容易に除去
されないためである。
本発明の特徴は、例えば、非晶質および多結晶のシリコ
ン半導体材料に対して適用されるが、好ましい一例とし
て450乃至700℃の範囲の基板温度でシリコン材料
と共にグロー放電堆積される気体状のホウ素乃至気体状
の蒸気化金属からなるP形ドープ用物質について特に詳
述する。この堆積された膜は前記基板温度範囲全体にわ
たってフッ素によって補償されているが、水素の補償は
基板温度の上昇と共に減少する。蒸気化金属からなるP
形ドープ材料はシリコン材料と共に400℃より低い基
板温度でグロー放電堆積されてもよい。この場合、水素
およびフッ素補償されたP形ドープされた物質を形成す
ることができる。
本発明の一実施例は、太陽電池又はP−N乃至P−1−
N素子を含む電流素子の製造に用いるため、更に効率の
よいP形の非晶質半導体膜の製造を可能にする。更に、
本発明の一実施例では、前述の基板温度で、P形ドープ
用物質となるホウ素又は金属Ail、Ga、In5Zn
もしくはTi)の内の少くとも1つを用いて、グロー放
電環境において種種の素子の有効な大量生産法をもたら
す。
従って、本発明の一実施例では、P形半導体合金を形成
する方法が提供され、この方法は、材料のグロー放電法
の堆積工程において、金属元素がグロー放電堆積される
シリコン材料と共に堆積させられてP形合金を形成する
ようにシリコン堆積用のグロー放電領域中にP形ドープ
物質となる蒸気化金属元素を導入することを特徴とする
部分真空雰囲気内に少くともシリコンを含む化合物のグ
ロー放電によって、少くともシリコンを含む材料を基板
上に付着させる工程を含む。
本発明の一実施例ではP形合金の形成方法が提供される
。この方法は、材料のグロー放電堆積の問、P形ドープ
物質の気体状化合物を、シリコン堆積用グロー放電域に
導入することによって特徴づけられており、部分真空の
雰囲気内で少くともシリコンを含む化合物のグロー放電
によって少くともシリコンを含む材料を少くとも約45
0℃の温度迄加熱された基板上に堆積される工程を含む
尚、この場合、前記P形ドープ物質の気体状化合物は少
くともP形ドープ用元素および非P形ドープ用置換基を
含み、この気体状化合物は少くとも約450℃の前記基
板温度において前記P形ドープ用元素および前記非P形
ドープ用置換基に解離し、P形ドープ用元素は堆積する
シリコン半導体材料と結合してP形合金を生じる。
本発明の一実施例ではシリコンを含む少くとも1つの元
素を有する材料を含む半導体合金が提供される。この材
料は部分真空雰囲気におけるシリコンを含む少くとも1
つの化合物のグロー放電により基板上に堆積させられ、
このグロー放電による堆積の開蓋気化状態の前記金属元
素が該材料にとり込まれてP形合金を提供する少くとも
1つの金属のP形ドープ用元素が用いられている。
本発明の一実質例ではシリコンを含む少くとも1つの元
素を有する材料を含む半導体合金が提供される。この材
料は少くとも約450℃の温度に加熱された基板上にシ
リコンを含む少くとも1つの化合物のグロー放電によっ
て堆積せしめられており、P形ドープ用の気体状化合物
から材料中にとり込まれた少くとも1つのP形ドープ元
素によって特徴づけられている。尚この場合、前記のP
形ドープ用気体状化合物は少くとも前記P形ドープ用元
素および非P形ドープ用置換基を含み、前記の気体状化
合物は、グロー放電堆積の間少くとも約450℃の前記
基板温度においてP形合金が形成されるように前記P形
ドープ用元素および非P形ドープ用置換基に解離する。
本発明の一実施例では、金属電極を含む基板を有するP
−N又はP−1−N接合が提供される。
この場合、材料が反対の伝導タイプ(PおよびN)の少
くとも2つの合金の順次のグロー放電堆積により前記電
極上に堆積されたシリコンを含む少くとも1つの元素か
らなり、グロー放電堆積の間に少くとも1つの蒸気化金
属からなるP形ドープ用元素をとり込ませてなるシリコ
ンのP形合金であるP形のシリコン含有合金によって特
徴づけられる。尚、この場合、N形のシリコン含有合金
は、N形合金になるようにそのグロー放電堆積の間少く
とも1つのN形ドープ用元素をとり込んでいる。
本発明の一実施例では金属電極を含む基板を有するP−
N又はP−1−N形接合が提供される。
この場合、材料が、反対の伝導タイプ(PおよびN)の
少くとも2つの合金の順次のグロー放電堆積によって少
くとも約450℃の温度迄加熱された前記電極上に堆積
されたシリコンを含む少くとも1つの元素を有し、グロ
ー放電堆積の間にP形ドープ用気体状化合物から少くと
も1つのP形ドープ用元素をとり込ませたP形のシリコ
ン含有合金によって特徴づけられる。尚この場合、前記
P形ドープ用気体状化合物は少くとも前記P形ドープ用
元素および非P形ドープ用置換基を含み、この気体状化
合物は、シリコンのP形合金を形成するように、少くと
も約450℃の前記基板温度で前記P形ドープ用元素お
よび非P形ドープ用直換基に解離する。N形シリコン含
有合金は、N形シリコンになるようにそのグロー放電堆
積の間に少くとも1つのN形ドープ用元素をとり込む。
本発明の一実施例では、1つ以上の電極形成領域を有す
る可撓性の帯状材からなる基板のロールを形成し、反対
の伝導タイプ(PおよびN)を有する少くとも2つの薄
い可撓性のシリコン合金を前記の1つ以上の電極形成領
域の少くとも一部上に堆積させるように少くとも1つの
シリコン堆積領域を含む部分的に後記された空間内に前
記基板のロールを略々連続的に繰出し、前記1つ以上の
合金によって光起電力用空乏領域を成形させるようにし
、次いで前記シリコン合金上に前記電極形成領域の各々
に対して別個に薄い可撓性の電極形成層を付着すること
を特徴とする光起電カバネルを製造する方法が提供され
る。
本発明の望ましい実質態様については、本明細書に添付
した図面に関して次に例示的に説明する。
第1図によれば、改良されたP形材料をとり込む素子の
製造における第1の工程(A)は支持層10の形成を含
む。この基板10は、アルミニウム又はステンレス鋼等
からなる可撓性の帯状材で形成される。このように、可
撓性に富んだ帯状材支持111Gは、連続的なプロセス
において、第2図および第3図に関して以下に説明する
種々の堆積ステーションを該帯状材10が通過させられ
る際、金属のff1tfiを形成する各層およびシリコ
ン層を堆積させるために使用可能である。アルミニウム
又はステンレス鋼の支持層10は、少くとも約0.08
11 (3ミル)好ましくは約0.411(15ミル)
の厚さを有し、必要に応じた巾を有する。帯状材10が
簿く可撓性のある帯状材である場合、ロール単位で購入
することが望ましい。
第2の工程(B)は、所望ならば離間され絶縁された電
極形成層が形成されるように、アルミニウム又はステン
レス鋼製の支持層10の表面に絶縁層12を堆積させる
ことを含む。例えば、厚さ約5ミクロンの層12は金f
f1llt化物で作ることができる。
支持層10がアルミニウムからなる場合にはこの層は酸
化アルミニウム(An!2 o3)であることが望まし
く、ステンレス鋼からなる場合には二酸化ケイ素(S 
f 02 )その他の適当なガラスでよい。
この支持ll!110は絶縁層12を予め形成した状態
で購入できる。尚、絶縁層12は、化学的堆積法、蒸着
法、又はアルミニウム基板の場合には陽極酸化法等の従
来周知の製造方法によって支持層10の表面に形成され
得る。2つの層、即ち支持[110および酸化1i11
2が絶縁基板14を形成する。
第3の工程(C)は前記絶縁基板14上に1つ以上の電
極を形成する層16を堆積させて、その上に形成させる
接合素子のためのベース電極基板18を形成する。この
金属の電極層(単数又は複数)1Gは、比較的早い堆積
法である蒸着法により堆積されることが望ましい。電極
層16は、光起電力素子のためには、モリブデン、アル
ミニウム、クロム・、又はステンレス鋼製の反射性のあ
る金属電極であることが望ましい。太陽電池の場合には
、吸収されないで半導体材料を透過した光が電極111
16で反射され、再び半導体材料中にとおされる。半導
体材料がこの時反射された光のエネルギを吸収する故、
素子の効率が増大され得る。従って、反射性電極が望ま
しい。
次に、ベース電極基板18は、前記特許第4.226,
898号に記載された室の如きグロー放電堆積環境、又
は第2図および第3図につ0て以下に論述される如き連
続プロセス装置おかれる。D1〜D5で示される特定例
は、改良されたP形ドープ法および材料を用いて製造で
きる種々のP−1−N又はP−N接合素子の例示に過ぎ
な(1)。各素子はベース電極基板18を用いて形成さ
れる。D1〜D5に示される各素子は、全体の厚さが約
5000乃至30,000人の範囲内である複数のシリ
コン層を有する。この厚さは、構造体内にピンホールそ
の他の物理的欠陥がないこと、および光吸収効率が最大
となることを補償する。更に厚い材料の場合更に光を吸
収できるかもしれないが、厚さが厚くなるにつれて光で
生成された電子正孔対の再結合がより多く生じる故、あ
る厚さにおいてそれ以上の電流が生じなくなる。(D1
〜D5に示された各層の厚さは正確な縮尺になっていな
いことを理解すべきである。) 最初にDlについて述べれば、第一に基板18上に強く
ドープしたN“シリコン層20を堆積させることによっ
てN−I−P素子が形成される。
N+層2Gが堆積されると、真性(+)シリコン層22
がその上に付着させられる。この真性層22の後には、
最後の半導体層として強くドープされた伝導性P のシ
リコン層24が堆積される。このシリコン層20.22
.24はN−1−P素子26の活性層を形D1〜D5に
示される各素子は他の用途もあるが、こ)では光起電力
素子として説明する。光起電力素子として利用される場
合、選択された外側のP  1124は、光の吸収性の
少い高導電率の層である。光の吸収性の小さな高導電率
のN 層20上に吸収率が大きく導電率が小さく光導電
率が大きな真性1it)22がある。電極層16の内面
とP 層24の頂面との間の素子の全厚さは、前述の如
く、少くとも約5000人程度である。N ドープ層2
0の厚さは約50乃至500人の範囲内にあることが望
ましい。非晶質の真性層22の厚さは約5ooo乃至3
0,000人の範囲内にあることが望ましい。頂部のP
+接触層24の厚さも又約50乃至500人の範囲内に
あることが望ましい。正孔の拡散距離が比較的短いため
、P+層は一般に50乃至500(又は150)人程度
の可能な限り簿くする。更に、前記接触層における光の
吸収を避けるため、N+又はP の如何を問わず外側の
層(本例ではP 層24)はできるだけ薄く保たれる。
各層は、前掲の米国特許第4,226,898号に記載
した従来のグロー放電室により、あるいは望ましくは第
2図および第3図に関して以下に記載した連続プロセス
において、ベース電楊基板18上に堆積され得る。いず
れの場合でも、前記グロー放電システムが最初に約20
ミリトルに仮配されて堆積シス、テムから雰囲気中の不
純物をパージ即ち除去する。シリコン材料は、次に化合
物のガス形態で、特に四フッ化シリコン(S t F4
 )の形で堆積室内に送られることが望ましい。グロー
放電プラズマは、好ましくは、約4:1乃至10:1の
望ましい比率の範囲で四フッ化シリコンおよび水素(H
2)ガスの混合物から得る。堆積システムは、約0.3
乃至1.5トル、望ましくは約0.6トルの如り0,6
乃至1.0トルの範囲内の圧力で操作されることがts
 −4+ I  IX 半導体材料は、望ましくは赤外線装置によって、各層の
所要の堆積温度迄加熱されている基板上に自己保持プラ
ズマから堆積される。素子のP形ドープ層は、使用され
たP形ドープ物質の形態に依存して、特定温度で堆積さ
れる。気化されたP形ドープ用金属の蒸気は、十分に補
償されたシリコン材料が望ましい場合、約400℃又は
これ以下の比較的低い温度で堆積され得るが、約100
0℃迄の比較的高い温度で堆積させ得る。基板温度の上
限は一部は使用される金属基板10の種類による。アル
ミニウムの場合には上限温度は約600℃より高くては
ならず、ステンレス鋼の場合は約1000℃より高くす
ることもできる。N−I−P又はP−I−N素子の真性
層を形成するのに必要な十分に補償された非晶質シリコ
ン層が形成されるべき場合には、基板温度は約400℃
より低くなければならず、約300℃であることが望ま
しい。
気化された金属の蒸気を用いて非晶質のP形ドープされ
た水素補償シリコン材料を堆積させるためには、基板温
度は約200℃乃至400℃の範囲内、好ましくは約2
50℃乃至350℃、特に望ましくは約300℃である
本発明の一実施例のP形ドープ物質の気体を几いてシリ
コン半導体材料を堆積させるためには、基板温度は約4
50℃乃至800℃の範囲内、望ましくは約500℃乃
至700℃の範囲内である。
ドープ濃度は、各素子のために各層が堆積される際所要
のP、P+、N又はN 形の伝導特性を生じるよう変更
される。N形又はP形ドープ層の場合は、堆積の際、材
料は5乃至100pp−のドープ物質でドープされる。
N+形又はP+形ドープ層の場合、堆積の際材料は11
00pp乃至1%以上のドープ物質でドープされる。N
形ドープ物質は前記量のホスフィン又はアルシンでよい
。P形ドープ物質は、P+材料に対して望ましくは11
00pp乃至5000ppm又はそれ以上の範囲で各基
板温度で堆積される本発明の一実施例のドープ物質でよ
い。
グロー放電堆積法においては、材料が導入されAC信号
によって生成されるプラズマが含まれる。このプラズマ
は、約1 KH2乃至13.6M HZのAC信号によ
りカソードと基板7ノードの間に保持されることが望ま
しい。
本発明の一実施例のP形ドープ法および物質は、種々の
シリコン非晶質半導体材料層を有する素子において使用
可能であるが、前掲の米国特許第4.226,898号
に開示されフッ素および水素補償グロー放電堆積材料と
共に使用されることが望ましい。この場合、四フフ化シ
リコンおよび水素の混合物は、真性層およびN形層に対
しては、約400℃又はこれ以下で非晶質シリコンの補
償された物質として堆積せしめられる。D2 、D3お
よびD5に示された事例においては、電極1lI116
上に配されたP+層は、フッ素で補償された物質が得ら
れる約450℃以上の比較的高い基板温度で堆積せしめ
られ得る。水素は比較的高い基板温度範囲においてはシ
リコンと共に有効に堆積されず、排気ガスと共に掃気さ
れる故、材料は有効な水素補償が行われない。
真性(i)層の外側にP+層があるDlおよびD4に示
された素子では、約450℃以上の基板堆積温度である
層を堆積させようとすると該層の下に位置する層での水
素補償作用を破壊することになるため、高温で付着され
るP+層は持たず、真性(i) IIは光起電力素子に
おける十分に水素およびフッ素補償された非晶質層であ
り得る。各素子のN形層およびN+形層も又、非晶質で
フッ素および水素補償された形で堆積されていることが
望ましい。従来のN形ドープ物質は、約400℃以下の
比較的低い温度でシリコン材料と共に容易に付着され、
高いドーピング効率をもたらすことになる。このように
、これ等の構造体D1およびD4においては、各層は非
晶質シリコンであり、少くとも約400℃以下の基板温
度において気化されたP+形ドープ用金属蒸気の1つに
よりP+層が最もよく形成される。下に位置する非晶質
層の特性を破壊する温度に達しないと仮定すれば、高い
基板温度を必要とする気相の金属又はホウ素化合物から
なるP形ドープ物質の使用も又有効である。
D2に示された第二の素子26′ はDlに示すP−I
−N形素子と逆の伝導形態を有する。素子26′ にお
いては、p” 528が最初にベース電極基板18上に
堆積されており、この上に真性層30および外側のN+
層32が堆積されている。この素子においては、P+層
は前記好ましい範囲内のどんな基板温度でも堆積され得
る。
D3およびD4に示される素子26″および26“′も
又逆の形態であってそれぞれP−NおよびN−P接合素
子である。素子26“においては、P+形非晶質シリコ
ン1134がベース電極基板18上に堆積され、その上
に非晶質シリコンのP形1i536が堆積され、次に非
晶質シリコンのN形層38が堆積され、最後に非晶質シ
リコンのN 形外側1140が堆積されている。素子2
6″においては、逆の順序でN+形非晶質シリコン11
42が最初に堆積され、これにN形@44およびP形非
晶質シリコン層46が堆積され、最後に外側のP 形非
晶質シリコン層48が堆積されている。
第二のタイプのP−1−N接合素子26  がD5に示
されている。この素子においては、第1のP+形非晶質
I!50が堆積され、その上に真性非晶質シリコン層5
2、非晶質シリコン層54および外側のN+形非晶質シ
リコン1956が堆積されている。
(この構成の逆の形態は図示しないが、これも又使用可
能である。) 所要の順序における種々の半導体層のグロー放電操作に
続いて、別の堆積環境における第五の工程(E)が実施
されることが望ましい。蒸着環境はグロー放電プロセス
よりも速い堆積プロセスであるため、その使用が望まし
い。この工程においては、例えばインジウムaim化物
(ITO)、錫酸カドミウム(C12SnO4)又はド
ープされた酸化1!(Sn02)でよいTCO15B(
透明な導電性酸化物)が素子26に追加されている。
TCO1158の上に電極グリッド60を形成するため
、第六工程(F)をオプションとして実施することがで
きる。このグリッド60は、使用した素子の最終寸法に
従ってTCOII58の表面に配することができる。約
13cj (21n2)程度以下の面積を有する素子2
6においては、TCOで導電性が十分なだめ、効率を高
めるために電極グリッドを設けなくてもよい。もしこの
素子が更に大きな面積を有するか、あるいはTCO[l
の導電率が必要とされる程度であるならば、電極グリッ
ド60がTCO層上に置かれてキャリア経路を短縮し、
素子の導電効率を高め得る。
前述の如く、素子26乃至26″″従来のグロー放電室
内で形成可能であるが、第2図に全体的に示される如く
連続的なプロセスにおいて形成されることが望ましい。
第2図には、本発明方法の基礎となるグロー放電堆積の
原理である堆積面が1つの連続的処理工程の略図が示さ
れている。ベース電極基板18が供給リール62から1
対のローラ64と66の周囲に繰出されて、その間に平
坦な堆積面域68が形成されている。基板18は、リー
ド70により接地されたローラ66と電気的に接触して
いる。平坦域68において、基板18は、カンード極板
72から講整自在に離間されたアノードを形成している
。このカソード72は高周波源74の出力端子と結合さ
れている。アノード域68とカソード72との間の区間
はプラズマ・グロー放電堆積領域76を形成している。
図示はしないが、第2図の各要素は、周囲の環境からグ
ロー放電域76を隔離するため抜気された空間内に密閉
されている。堆積ガスは矢印78で示される如くプラズ
マ領域76内に導入される。ドープ物質は矢印80で示
される如ぎ第2の流れで導入することができる。尚、ド
ープ用物質は付着ガスと組合して導入してもよい。使用
済みのガスは、矢印82で示す如くプラズマ域76およ
びシステムから排除される。
第2図の堆積域は、所要の各層を連続的に形成するため
適正な混合ガスを導入することによってバッチ・モード
により使用することができる。運続ブOセスにおいては
、供給リール62からプラズマ領域を経て巻取りリール
a4に至る基板18の単一バスにおいて1種の材料しか
付着させ得ないが、帯材18の終端部においてリールの
運転を逆転することができ、又各バス毎に所要のドープ
物質を導入することによって、第2のおよび逐次の層が
プラズマ域76を経由する逐次のパスにおいて付着させ
得る。基板18の温度は、1個以上の赤外線加熱ランプ
その他のソース86により制御可能である。
グロー放電堆積は、堆積される物質の厚さが毎秒2乃至
5人の比較的小さい速度で行なわれ得る。
基板18上での半導体材料の堆積厚さが5000人の場
合を想定すると、毎秒5人の堆積速度における5000
人の廐の完成には約1000秒を要することになる。
これは無論実用的ではあるが、第3図に示す如く、堆積
速度を上げるために、多数の堆積ステーションにおいて
基板18に層を付着させることが望ましい。
第3図においては、本発明による好ましい一実施例とし
ての光起電カバネルの製造方法として、第1図の工程C
,D、Eの各プロセスを実施する全体的なシステムのブ
ロック図が示されている。
工程Cは蒸着室88内で実施可能である。酸化された基
板14は供給リール90から室88内に送出され、ここ
で電極層が基板上に付着されてベース電極基板18が形
成され、その後巻取りリール92へ送られる。この堆積
工程は、覗きボート94を介して視覚的にあるいはモニ
ター兼制御器によって観察されてもよい。
電極層は、基板14と同様な帯状材形態のマスク96に
よって所望のグリッド・パターンの形に形成可能である
。マスク96は、帯状材14が室88を経た後巻取りリ
ール100に送られる際、この帯状材と整合位置関係に
なるように繰出しリール98から送出される。
電極層の堆積工程に続いて、ベース電極基板18が連続
的に複数個のグロー放電室102. 102’ および
102“内に送り込まれるが、この各放電室は76の如
きプラズマ域および第2図に示される他のグロー放電用
要素を含んでいる。同−又は殆んど同一の素子を識別す
るため、各図においては同じ番号(同様な符号)を用い
た。全ての室の堆積領域76を相互に隔離された1つの
室内に密閉することも又実際的である。
DlのN−I−P形素子26は、下記の特殊な連続的付
着事例の説明に用いられる。この場合、ベース電極基板
18は繰出しリール62から室102内に送出される。
予め混合された四フッ化シリコンおよび水素の如き堆積
ガスは矢印78で示される如く堆積域76内に導入され
る。ホスフィンの如きドープ物質は、矢印80で示され
る如く堆積域76内に導入される。使用済みのガスは矢
印82で示される如く前記室102から除去される。
所要の堆積速度および堆積されるN 形層20の厚さに
従って、各々がN+形トド−1層20堆積させる1個以
上の室102があり得る。室102の各々は隔離通路1
04によって連結されている。各室102からの使用済
みガス(排気)82は各室を隔離する上で十分なければ
ならないが、不活性のキャリア・ガスを矢印106によ
り示される如く各通路104内に吹込んで通路104の
両側の室からのガスがなくなるように通路を掃気するこ
とができる。
ドープ濃度は、必要に応じて層にグレードを付けるため
連なる室の各々において変化させることができる。
室102′ は、本例においては矢印78′で示される
四フッ化シリコンおよび水素の予め混合された堆積ガス
のみが供給されるが、これは−切のドープ物質を導入す
ることなく真性層22を堆積させるためである。更に、
この層22の堆積速度を増加させるため複数の室102
′を設けることができる。
更に、各室102. 102’・・・・・・が同じ連続
的帯状材に各層毎に多くの堆積域76で堆積するため、
形成されるべき素子、本例の場合はN−1−P素子26
に対する各タイプの層を所要の層厚で堆積させるように
その寸法があられされている。
基板18は、次に矢印78“で示される如く堆積ガスが
供給される室102“内に送り込まれる。P形ドープ物
質は矢印80″で示される如く堆積域内に導入される。
本例の場合には、P 形l124が非晶質N+層および
illに堆積されるため、P形ドープ物質は気化されて
なる金属蒸気である。この場合も、1個以上の室102
“を設けることができ、最後の室102″からのフィル
ム26は巻取りリール84に巻取られる。
電極マスク96と共用可能なマスク10Bは繰出しリー
ル110から繰出され、基板18と整合位置関係に一連
の交102内を通過させられる。マスク10Bは、最後
の室102”の後の巻取りリール112で巻取られる。
次に素子の@26が蒸@ ’l 114内に送り込まれ
て工程EのTCOI!58が堆積せしめられる。膜26
は繰出しリール116から繰出されて室114を経由し
、巻取りリール118に達する。適当なマスク120を
用いて繰出しリール122から巻取りリール124へ供
給することができる。もし電橋グリッド60が必要なら
ば、適当なマスク(図示せず)を用いて同様な蒸着室内
で付着することができる。
P−I−N形素子26′の如き特殊な素子を製造するた
めには、室102. 102’ 、  102“の各々
は1つの特定の層を付着させるよう専用化される。
前述の如く、各室は1つの層(P、I又はN)の付着の
ため専用化されるが、これは他の層の付着物質が室の背
景環境を汚染するためである。P−N素子又はPi−N
素子の各層を最適化するためには、他のタイプの層から
のドープ物質が1つの層の望ましい電気的特性を害する
ため、前記ドープ物質が存在しないことが重要である。
例えば、P形又はN形の層を最初に付着する場合、残在
するP形又はN形ドープ物質による後続の真性層の汚染
のため真性層中に局在状態を生じることになる。このよ
うに、素子の効率は汚染によって低減されることになる
。素子の効率の低下を生じる汚染の問題は、P−N又は
P−I−N形の素子の連続層の形成のため特定の1つの
付着室を用いた場合に遭遇した。室の環境の汚染は容易
に除去できず、その結果、背景環境内に残留する一@け
ト、丁Jlh /A 団JJ i a −A−k −v
 +−猿−17% ffi M@続的なプロセスにおい
て1つ以上の層に対して1個の室を用いることは現在で
は実施不可能である。
【図面の簡単な説明】
第1図は本発明方法に従って製造される好ましい一実施
例の基板を用いた本発明の好ましい具体例の光起電カバ
ネル(光起電力デバイス)の形成工程の一例を示す説明
図、第2図は本発明方法に従って形成される基板に対し
て適用される半導体膜の堆積方法を示す説明図、および
第3図は本発明に従って形成される基板に対して適用さ
れる好ましい一実施例の光起電カバネルの製造方法及び
装置の説明図である。 10・・・・・・支持層、12・・・・・・金III化
物絶縁層、14・・・・・・絶縁基板、16・・・・・
・電橋層、18・・・・・・ベース電極基板、 20.32.3B、 40.42.44.54.56・
・・・・・N形シリコン含有合金、22・・・・・・真
性(i)シリコン層、24.28,34,36.4B、
48.50・・・・・・P形シリコン含有合金、26.
26’ 、 26“、 26− 、26”′・・・・・
・素子、3G−・・・・・真性層、52・・・・・・真
性非晶質シリコン層、58・・・・・・透過伝導酸化膜
(TCO)層、6 G−・・・・・電極グリッド、 62.90,98,110,116,122・・・・・
・繰出しリール、64.66・・・・・・ローラ、68
・・・・・・付着域、70・・・・・・リード、72・
・・・・・カソード電極、74・・・・・・高周波ソー
ス、7ローーーー・・プラズマ・グロー放電付着域、8
4.92.100,112,118.124・・・・・
・巻取りリール、88・・・・・・蒸着至、 96・・・・・・マスク、 102、 102’ 、  102”・・・・・・グロ
ー放電室、104・・・・・・通路、108,120・
・・・・・マスク。

Claims (6)

    【特許請求の範囲】
  1. (1)半導体層から形成される半導体デバイスの電気的
    に相互接続されたアレイの製造に用いられる改良基板で
    あって、比較的厚く導電性で可撓性の支持層を有してお
    り、比較的薄く可撓性で電気絶縁体層が前記支持層と前
    記半導体層との間に介在せしめられるように構成された
    基板。
  2. (2)前記支持層が金属からなる特許請求の範囲第1項
    に記載の基板。
  3. (3)少なくとも一つの電極が前記電気絶縁体と前記半
    導体層との間に配置されるように構成された特許請求の
    範囲第1項に記載の基板。
  4. (4)半導体層が前記少なくとも一つの電極及び電気絶
    縁体上に堆積されるように構成された特許請求の範囲第
    3項に記載の基板。
  5. (5)第一の電極と、 該第一の電極の下側に位置しており、該第一の電極に接
    触している半導体層と、 該半導体層の部分の下側に位置しており該半導体層の部
    分に接触している第二の電極と、 該第二の電極及び前記半導体層の下側に位置しており、
    該第二の電極及び該半導体層に接触している基板とから
    なり、 該基板が、 前記第二の電極及び前記半導体の下側に位置しており、
    前記第二の電極及び前記半導体と接触している比較的薄
    く可撓性の電気絶縁体層と、前記電気絶縁体の下側に位
    置しており、該電気絶縁体と接触している比較的厚く導
    電性の可撓性支持層と からなる光起電力デバイス。
  6. (6)前記支持層が金属からなる特許請求の範囲第5項
    に記載の光起電力デバイス。
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