JP2000340714A - 半導体パッケージ及びその製造方法 - Google Patents
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Abstract
(57)【要約】
【課題】半導体パッケージの厚さを超薄型化し熱放出性
能を向上させる半導体パッケージ及び製造方法を提供す
る。 【解決手段】半導体パッケージは、第1、2面を有し、
第2面に多数の入出力パッドが形成された半導体チップ
と、第1、2面を有する樹脂層と、この第1面には多数
のボールランドが形成され、樹脂層の第2面には多数の
ボンドフィンガーが形成され、ボールランドとボンドフ
ィンガーは導電性ビアホールで連結される回路パターン
と、多数のボンドフィンガーとボールランドとをオープ
ンさせ回路パターンをコーティングするカバーコートと
で構成され、中央の貫通孔には半導体チップが位置する
回路基板と、半導体チップの入出力パッドと回路基板の
ボンドフィンガーとを接続させる電気的接続手段と、半
導体チップ、接続手段及び回路基板の貫通孔を覆う封止
材と、回路基板のボールランドに融着された多数の導電
性ボールとで構成される。
能を向上させる半導体パッケージ及び製造方法を提供す
る。 【解決手段】半導体パッケージは、第1、2面を有し、
第2面に多数の入出力パッドが形成された半導体チップ
と、第1、2面を有する樹脂層と、この第1面には多数
のボールランドが形成され、樹脂層の第2面には多数の
ボンドフィンガーが形成され、ボールランドとボンドフ
ィンガーは導電性ビアホールで連結される回路パターン
と、多数のボンドフィンガーとボールランドとをオープ
ンさせ回路パターンをコーティングするカバーコートと
で構成され、中央の貫通孔には半導体チップが位置する
回路基板と、半導体チップの入出力パッドと回路基板の
ボンドフィンガーとを接続させる電気的接続手段と、半
導体チップ、接続手段及び回路基板の貫通孔を覆う封止
材と、回路基板のボールランドに融着された多数の導電
性ボールとで構成される。
Description
【0001】
【発明の屬する技術分野】本発明は半導体パッケージ及
びその製造方法に関するもので、より詳しくは、厚が薄
く放熱性能が優秀な半導体パッケージ及びその製造方法
に関するものである。
びその製造方法に関するもので、より詳しくは、厚が薄
く放熱性能が優秀な半導体パッケージ及びその製造方法
に関するものである。
【0002】
【従来の技術】近年、半導体パッケージは、ボールグリ
ッドアレイ(ball grid array)半導体パ
ッケージ(以下、BGA半導体パッケージという)、チッ
プスケール(chip scale)半導体パッケージ及
びマイクローボールグリッドアレイ(micro ba
ll grid array)半導体パッケージ等のよ
うに漸次小型化及び薄型化の趨勢にある。また、このよ
うな半導体パッケージに搭載される半導体チップも集積
技術及び製造装備の発達により電力回路の高性能化、動
作周波数の増加及び回路機能の拡大に付随して、半導体
チップの作動中に発生するチップの単位体積当たり熱発
生量も増加する傾向にある。
ッドアレイ(ball grid array)半導体パ
ッケージ(以下、BGA半導体パッケージという)、チッ
プスケール(chip scale)半導体パッケージ及
びマイクローボールグリッドアレイ(micro ba
ll grid array)半導体パッケージ等のよ
うに漸次小型化及び薄型化の趨勢にある。また、このよ
うな半導体パッケージに搭載される半導体チップも集積
技術及び製造装備の発達により電力回路の高性能化、動
作周波数の増加及び回路機能の拡大に付随して、半導体
チップの作動中に発生するチップの単位体積当たり熱発
生量も増加する傾向にある。
【0003】このような従来の一般的な半導体パッケー
ジ中で従来の一般的なBGA半導体パッケージ(10
0')を図17で図示する。多数の電子回路が集積されて
おり、その上面には入出力パッド2'が形成されている
半導体チップ1'が中央に位置されており、前記半導体
チップ1'の下面には接着剤3'が介在されたままで回路
基板10'の上面中央部が接着されている。
ジ中で従来の一般的なBGA半導体パッケージ(10
0')を図17で図示する。多数の電子回路が集積されて
おり、その上面には入出力パッド2'が形成されている
半導体チップ1'が中央に位置されており、前記半導体
チップ1'の下面には接着剤3'が介在されたままで回路
基板10'の上面中央部が接着されている。
【0004】前記回路基板10'は中央の樹脂層15'を
中心層にしてその上部には前記半導体チップ1'を中心
にその外周縁にボンドフィンガー11'を包含する回路
パターン12'が形成されており、下部には多数のボー
ルランド13'を包含する回路パターンが形成されてい
る。勿論、前記回路パターンをなすボンドフィンガー1
1'及びボールランド13'は銅(Cu)等の導電性薄膜系
列であり、前記樹脂層15'上部の回路パターン12'と
下部の回路パターンは導電性ビアホール14'により相
互連結されている。また、前記ボンドフィンガー11'
及びボールランド13'を除外した樹脂層15'の上下面
はカバーコート16'でコッティングされて外部環境か
ら前記回路パターン12'を保護する。
中心層にしてその上部には前記半導体チップ1'を中心
にその外周縁にボンドフィンガー11'を包含する回路
パターン12'が形成されており、下部には多数のボー
ルランド13'を包含する回路パターンが形成されてい
る。勿論、前記回路パターンをなすボンドフィンガー1
1'及びボールランド13'は銅(Cu)等の導電性薄膜系
列であり、前記樹脂層15'上部の回路パターン12'と
下部の回路パターンは導電性ビアホール14'により相
互連結されている。また、前記ボンドフィンガー11'
及びボールランド13'を除外した樹脂層15'の上下面
はカバーコート16'でコッティングされて外部環境か
ら前記回路パターン12'を保護する。
【0005】一方、前記半導体チップ1'の入出力パッ
ド2'は回路基板10'の上面に形成されたボンドフィン
ガー11'に導電性ワイア4'で接続されており、前記半
導体チップ1'及び導電性ワイア4'を外部環境から保護
するために回路基板10'上面は封止材20'で封止され
ている。また、前記印刷回路基板10'の下面に形成さ
れたボールランド13'には導電性ボール40'が融着さ
れたままでマザーボード(図示せず)に実装され、半導体
チップ1'とマザーボード間に所定の電気的信号を媒介
でき得るようになっている。
ド2'は回路基板10'の上面に形成されたボンドフィン
ガー11'に導電性ワイア4'で接続されており、前記半
導体チップ1'及び導電性ワイア4'を外部環境から保護
するために回路基板10'上面は封止材20'で封止され
ている。また、前記印刷回路基板10'の下面に形成さ
れたボールランド13'には導電性ボール40'が融着さ
れたままでマザーボード(図示せず)に実装され、半導体
チップ1'とマザーボード間に所定の電気的信号を媒介
でき得るようになっている。
【0006】このような構成のBGA半導体パッケージ
100'は、半導体チップ1'の電気的信号が入出力パッ
ド2'、導電性ワイア4'、ボンドフィンガー11'、ビ
アホール14'、ボールランド13'及び導電性ボール4
0'を通じてマザーボードと電気信号を交換するように
なる。しかし、このような従来のBGA半導体パッケー
ジは、半導体チップが比較的厚さが厚い回路基板上面に
接着されるので、全体的な半導体パッケージの厚さも併
せて大きくなる。これは前述のように最近の超小型化、
超薄型化の趨勢に滿足には付随できないので、結局いろ
いろな超小型電子機器、例えば、携帶フォン、セリュー
ラフォン、無線呼出器等の使用時に不滿足であるという
問題点がある。
100'は、半導体チップ1'の電気的信号が入出力パッ
ド2'、導電性ワイア4'、ボンドフィンガー11'、ビ
アホール14'、ボールランド13'及び導電性ボール4
0'を通じてマザーボードと電気信号を交換するように
なる。しかし、このような従来のBGA半導体パッケー
ジは、半導体チップが比較的厚さが厚い回路基板上面に
接着されるので、全体的な半導体パッケージの厚さも併
せて大きくなる。これは前述のように最近の超小型化、
超薄型化の趨勢に滿足には付随できないので、結局いろ
いろな超小型電子機器、例えば、携帶フォン、セリュー
ラフォン、無線呼出器等の使用時に不滿足であるという
問題点がある。
【0007】また、前述のように、半導体チップの作動
時の単位体積当たり熱発生量は相対的に増加する趨勢で
ある反面、放熱効率が低くなるので半導体チップの電気
的性能が低下すると共に、場合によっては半導体チップ
の機能の麻痺を招来し、これによって前記半導体チップ
を採用した半導体パッケージまたは電子機器の性能低下
まは技能停止を惹起するという憂いがある。
時の単位体積当たり熱発生量は相対的に増加する趨勢で
ある反面、放熱効率が低くなるので半導体チップの電気
的性能が低下すると共に、場合によっては半導体チップ
の機能の麻痺を招来し、これによって前記半導体チップ
を採用した半導体パッケージまたは電子機器の性能低下
まは技能停止を惹起するという憂いがある。
【0008】一方、半導体チップの作動時、溌生する熱
を外部へ容易易に発散させるための従来の方案として放
熱板搭載半導体パッケージが提案されているが、この場
合、前記放熱板の搭載によりその厚さだけ半導体パッケ
ージの厚さも増大すると共に、製造価格も相伴って上昇
するという問題点がある。
を外部へ容易易に発散させるための従来の方案として放
熱板搭載半導体パッケージが提案されているが、この場
合、前記放熱板の搭載によりその厚さだけ半導体パッケ
ージの厚さも増大すると共に、製造価格も相伴って上昇
するという問題点がある。
【0009】
【発明が解決しようとする課題】したがって、本発明は
上記のような従来の問題点を解決すべく案出したもので
あり、本発明の一番目の目的は、厚さを超薄型に製造で
きる半導体パッケージ及びその製造方法の提供にある。
本発明のほかの目的は、半導体チップの熱を外部に容易
易に放出し得る半導体パッケージ及びその製造方法の提
供にある。
上記のような従来の問題点を解決すべく案出したもので
あり、本発明の一番目の目的は、厚さを超薄型に製造で
きる半導体パッケージ及びその製造方法の提供にある。
本発明のほかの目的は、半導体チップの熱を外部に容易
易に放出し得る半導体パッケージ及びその製造方法の提
供にある。
【0010】
【課題を解決するための手段】前記目的を達成するため
の本発明による半導体パッケージは、第1面と第2面を
有し、前記第2面には多数の入出力パッドが形成された
半導体チップと;第1面と第2面を有する樹脂層と、前
記樹脂層の第1面には多数のボールランドが形成され前
記樹脂層の第2面には多数のボンドフィンガーが形成さ
れ前記ボールランドとボンドフィンガーは導電性ビアホ
ールにより連結される回路パターンと、前記多数のボン
ドフィンガーとボールランドとをオープンさせ回路パタ
ーンをコッティングするカバーコートとで構成され、中
央には貫通孔が形成されており、この貫通孔には前記半
導体チップが位置する回路基板と;前記半導体チップの
入出力パッドと前記回路基板のボンドフィンガーを電気
的に接続させる電気的接続手段と;前記半導体チップ、
接続手段及び回路基板の貫通孔を覆い被せている封止材
と;前記回路基板のボールランドに融着された多数の導
電性ボールを包含してなるのを特徴とする。
の本発明による半導体パッケージは、第1面と第2面を
有し、前記第2面には多数の入出力パッドが形成された
半導体チップと;第1面と第2面を有する樹脂層と、前
記樹脂層の第1面には多数のボールランドが形成され前
記樹脂層の第2面には多数のボンドフィンガーが形成さ
れ前記ボールランドとボンドフィンガーは導電性ビアホ
ールにより連結される回路パターンと、前記多数のボン
ドフィンガーとボールランドとをオープンさせ回路パタ
ーンをコッティングするカバーコートとで構成され、中
央には貫通孔が形成されており、この貫通孔には前記半
導体チップが位置する回路基板と;前記半導体チップの
入出力パッドと前記回路基板のボンドフィンガーを電気
的に接続させる電気的接続手段と;前記半導体チップ、
接続手段及び回路基板の貫通孔を覆い被せている封止材
と;前記回路基板のボールランドに融着された多数の導
電性ボールを包含してなるのを特徴とする。
【0011】前記半導体チップの第2面と、ボンドフィ
ンガーが形成された回路基板の第2面は同一の方向に形
成されており、前記半導体チップの第1面と、ボールラ
ンドが形成された前記回路基板の第1面及び封止材の一
面は同一の平面でなることができる。前記封止材はボン
ドフィンガーが形成された回路基板の第2面全体に形成
することもできる。前記ボールランドはボンドフィンガ
ーが形成された回路基板の第2面に形成することもでき
る。前記回路基板の第2面に形成されたボールランドに
導電性ボールが融着することもできる。前記半導体チッ
プの第1面には回路基板の貫通孔を覆うように閉鎖部材
をさらに接着することもできる。前記閉鎖部材としては
絶縁テープ、紫外線テープまたは銅層が望ましい。
ンガーが形成された回路基板の第2面は同一の方向に形
成されており、前記半導体チップの第1面と、ボールラ
ンドが形成された前記回路基板の第1面及び封止材の一
面は同一の平面でなることができる。前記封止材はボン
ドフィンガーが形成された回路基板の第2面全体に形成
することもできる。前記ボールランドはボンドフィンガ
ーが形成された回路基板の第2面に形成することもでき
る。前記回路基板の第2面に形成されたボールランドに
導電性ボールが融着することもできる。前記半導体チッ
プの第1面には回路基板の貫通孔を覆うように閉鎖部材
をさらに接着することもできる。前記閉鎖部材としては
絶縁テープ、紫外線テープまたは銅層が望ましい。
【0012】また、前記目的を達成するための本発明に
よる半導体パッケージの製造方法は、ほぼ、直四角板状
で第1面と第2面を有し、半導体チップが位置するよう
に多数の貫通孔が一定の長さのサブスロットを境界とし
て行並びに列を成し一つのサブストリップをなし、前記
サブストリップは一定の長さのメインスロットを境界と
して多数が一列に連結されて一つのメインストリップを
なす樹脂層と;前記各サブストリップ内の貫通孔とサブ
スロットとの間の樹脂層の第1面には多数のボールラン
ドが、第2面には多数のボンドフィンガーが形成されて
いる多数の回路パターンと;前記回路パターン中、ボン
ドフィンガー及びボールランドは外側にオープンさせ前
記樹脂層表面にコーティングされたカバーコートを包含
する回路基板を提供する段階と;第1面と第2面を有
し、前記第2面に多数の入出力パッドを有する半導体チ
ップを前記回路基板の各貫通孔内に位置させる段階と;
前記半導体チップの入出力パッドと回路基板のボンドフ
ィンガーとを電気的に接続させる段階と;前記半導体チ
ップ、接続手段、及び回路基板の貫通孔を封止材で封止
する段階と;前記回路基板のボールランドに導電性ボー
ルを融着させる段階と;前記回路基板から各サブスロッ
ト間の領域を除去して個個の半導体パッケージにシンギ
ュレーションする段階とでなるを特徴とする。
よる半導体パッケージの製造方法は、ほぼ、直四角板状
で第1面と第2面を有し、半導体チップが位置するよう
に多数の貫通孔が一定の長さのサブスロットを境界とし
て行並びに列を成し一つのサブストリップをなし、前記
サブストリップは一定の長さのメインスロットを境界と
して多数が一列に連結されて一つのメインストリップを
なす樹脂層と;前記各サブストリップ内の貫通孔とサブ
スロットとの間の樹脂層の第1面には多数のボールラン
ドが、第2面には多数のボンドフィンガーが形成されて
いる多数の回路パターンと;前記回路パターン中、ボン
ドフィンガー及びボールランドは外側にオープンさせ前
記樹脂層表面にコーティングされたカバーコートを包含
する回路基板を提供する段階と;第1面と第2面を有
し、前記第2面に多数の入出力パッドを有する半導体チ
ップを前記回路基板の各貫通孔内に位置させる段階と;
前記半導体チップの入出力パッドと回路基板のボンドフ
ィンガーとを電気的に接続させる段階と;前記半導体チ
ップ、接続手段、及び回路基板の貫通孔を封止材で封止
する段階と;前記回路基板のボールランドに導電性ボー
ルを融着させる段階と;前記回路基板から各サブスロッ
ト間の領域を除去して個個の半導体パッケージにシンギ
ュレーションする段階とでなるを特徴とする。
【0013】前記半導体チップを回路基板の貫通孔内に
位置させる段階前に、多数のボールランドが形成された
前記回路基板の第1面に貫通孔閉鎖部材が付着される段
階がさらに包含できる。前記半導体チップを回路基板の
貫通孔内に位置させる段階前に、前記ボールランドが形
成された回路基板のメインストリップの第1面全体に閉
鎖部材が付着される段階がさらに包含できる。
位置させる段階前に、多数のボールランドが形成された
前記回路基板の第1面に貫通孔閉鎖部材が付着される段
階がさらに包含できる。前記半導体チップを回路基板の
貫通孔内に位置させる段階前に、前記ボールランドが形
成された回路基板のメインストリップの第1面全体に閉
鎖部材が付着される段階がさらに包含できる。
【0014】前記閉鎖部材は、おのおののサブストリッ
プに個々に付着され、前記閉鎖部材の一側がサブストリ
ップとサブストリップとの間のメインスロットに位置す
るようにするのが望ましい。また、前記閉鎖部材は回路
基板の各メインスロットに対応する領域に切断用小孔が
付着形成できる。
プに個々に付着され、前記閉鎖部材の一側がサブストリ
ップとサブストリップとの間のメインスロットに位置す
るようにするのが望ましい。また、前記閉鎖部材は回路
基板の各メインスロットに対応する領域に切断用小孔が
付着形成できる。
【0015】前記回路基板のボールランドに導電性ボー
ルを融着する段階前、または導電性ボールを融着する段
階後、またはシンギュレーション段階後の中、いずれか
一つの段階で前記閉鎖部材を除去することができる。前
記回路基板のボールランドに導電性ボールを融着する段
階前、または導電性ボールを融着する段階後、またはシ
ンギュレーション段階後の中、いずれか一つの段階で前
記回路基板の各メインスロットに回路基板の第2面から
第1面を向かう板状のバーを貫通させて閉鎖部材の一側
が回路基板から分離されるようにして閉鎖部材を除去す
ることもできる。前記閉鎖部材としては絶縁性テープか
または銅層がよい。前記絶縁テープとして紫外線テープ
でもよい。前記封止段階はボンドフィンガーが形成され
た回路基板の第2面全体に形成することもできる、前記
シンギュレーション段階は封止材と回路基板とを共にシ
ンギュレーションするのが望ましい。
ルを融着する段階前、または導電性ボールを融着する段
階後、またはシンギュレーション段階後の中、いずれか
一つの段階で前記閉鎖部材を除去することができる。前
記回路基板のボールランドに導電性ボールを融着する段
階前、または導電性ボールを融着する段階後、またはシ
ンギュレーション段階後の中、いずれか一つの段階で前
記回路基板の各メインスロットに回路基板の第2面から
第1面を向かう板状のバーを貫通させて閉鎖部材の一側
が回路基板から分離されるようにして閉鎖部材を除去す
ることもできる。前記閉鎖部材としては絶縁性テープか
または銅層がよい。前記絶縁テープとして紫外線テープ
でもよい。前記封止段階はボンドフィンガーが形成され
た回路基板の第2面全体に形成することもできる、前記
シンギュレーション段階は封止材と回路基板とを共にシ
ンギュレーションするのが望ましい。
【0016】前記封止段階は回路基板を上型と下型でな
る金型の間に位置させ、前記半導体チップの第2面に対
応する金型にゲートを形成することによって、前記封止
材が前記半導体チップの第2面上部から充填することも
できる。前記回路基板提供段階はボンドフィンガーが形
成された回路基板の第2面にも多数のボールランドが形
成されて提供できる。この時、前記導電性ボール融着段
階は前記ボンドフィンガーが形成された回路基板の第2
面のボールランドにも多数の導電性ボールの融着ができ
る。
る金型の間に位置させ、前記半導体チップの第2面に対
応する金型にゲートを形成することによって、前記封止
材が前記半導体チップの第2面上部から充填することも
できる。前記回路基板提供段階はボンドフィンガーが形
成された回路基板の第2面にも多数のボールランドが形
成されて提供できる。この時、前記導電性ボール融着段
階は前記ボンドフィンガーが形成された回路基板の第2
面のボールランドにも多数の導電性ボールの融着ができ
る。
【0017】このようにして、本発明による半導体パッ
ケージ及びその製造方法によれば、回路基板に一定の面
積の貫通孔が形成され、その貫通孔に半導体チップが位
置することによって、その半導体チップの厚さが前記回
路基板の厚さにより相殺され、結局、半導体パッケージ
の厚さを超薄型に製造及び具備できるようになる。ま
た、半導体チップの一面(第1面)が封止材の外部(下部)
に直接露出されることによって、その半導体チップから
発生する熱が空気中へ直接発散され、半導体チップの熱
的、電気的性能が向上される。
ケージ及びその製造方法によれば、回路基板に一定の面
積の貫通孔が形成され、その貫通孔に半導体チップが位
置することによって、その半導体チップの厚さが前記回
路基板の厚さにより相殺され、結局、半導体パッケージ
の厚さを超薄型に製造及び具備できるようになる。ま
た、半導体チップの一面(第1面)が封止材の外部(下部)
に直接露出されることによって、その半導体チップから
発生する熱が空気中へ直接発散され、半導体チップの熱
的、電気的性能が向上される。
【0018】また、回路基板の一面全体に封止材が封止
されることによって回路基板の曲がる現象を抑制するこ
ともできる。さらに、半導体パッケージの製造工程中に
閉鎖部材を利用することによって、その封止作業が容易
易に、また、回路基板に個々の予め分離された閉鎖部材
を付着するか、または切断用小孔が形成された閉鎖部材
を利用することによって容易易にその閉鎖部材を除去す
ることができる。また、半導体パッケージの製造工程
中、封止工程は半導体チップの第2面から封止材が充填
されるようにすることによって封止が均一に遂行され、
また、ワイアスウィーピング現象を抑制することができ
る。
されることによって回路基板の曲がる現象を抑制するこ
ともできる。さらに、半導体パッケージの製造工程中に
閉鎖部材を利用することによって、その封止作業が容易
易に、また、回路基板に個々の予め分離された閉鎖部材
を付着するか、または切断用小孔が形成された閉鎖部材
を利用することによって容易易にその閉鎖部材を除去す
ることができる。また、半導体パッケージの製造工程
中、封止工程は半導体チップの第2面から封止材が充填
されるようにすることによって封止が均一に遂行され、
また、ワイアスウィーピング現象を抑制することができ
る。
【0019】
【発明の実施の形態】以下、本発明を添付図面を参照し
ながら、詳細に説明することにする。図1乃至図5は本
発明による半導体パッケージを示す断面図である。
ながら、詳細に説明することにする。図1乃至図5は本
発明による半導体パッケージを示す断面図である。
【0020】まず、図1の半導体パッケージ101を参
照すれば、下部と上部に各々、半導体チップの第1面3
0a及び半導体チップの第2面30bを有し、前記上部
の第2面30bには多数の入出力パッド31が形成され
た半導体チップ30が具備されている。前記半導体チッ
プ30は回路基板10に形成された一定の大きさの貫通
孔12内側に位置されている。前記貫通孔12の広さは
前記半導体チップ30の第1面30aまたは第2面30
bの面積より大きく形成されている。
照すれば、下部と上部に各々、半導体チップの第1面3
0a及び半導体チップの第2面30bを有し、前記上部
の第2面30bには多数の入出力パッド31が形成され
た半導体チップ30が具備されている。前記半導体チッ
プ30は回路基板10に形成された一定の大きさの貫通
孔12内側に位置されている。前記貫通孔12の広さは
前記半導体チップ30の第1面30aまたは第2面30
bの面積より大きく形成されている。
【0021】前記回路基板10は前記のように、下部と
上部に各々回路基板の第1面11a及び回路基板の第2
面11bを有する樹脂層17を中心に、前記半導体チッ
プ30が位置する領域に貫通孔12が形成されており、
前記貫通孔12の外側である樹脂層17の前記第1面1
1aにはボールランド18bを包含する多数の導電性回
路パターン18が形成されている。また、前記樹脂層1
7の第2面11bにはボンドフィンガー18a等を包含
する多数の導電性回路パターン18が形成されており、
前記第1面11a及び第2面11bの回路パターン18
は導電性ビアホール20により互いに電気的に連結され
ている。
上部に各々回路基板の第1面11a及び回路基板の第2
面11bを有する樹脂層17を中心に、前記半導体チッ
プ30が位置する領域に貫通孔12が形成されており、
前記貫通孔12の外側である樹脂層17の前記第1面1
1aにはボールランド18bを包含する多数の導電性回
路パターン18が形成されている。また、前記樹脂層1
7の第2面11bにはボンドフィンガー18a等を包含
する多数の導電性回路パターン18が形成されており、
前記第1面11a及び第2面11bの回路パターン18
は導電性ビアホール20により互いに電気的に連結され
ている。
【0022】ここで、前記ボンドフィンガー18aに
は、今後接続手段40との容易なボンディングのために
金(Au)または銀(Ag)が鍍金されており、前記ボール
ランド18bには、今後導電性ボール60との容易易な
ボンディングのために金(Au)、銀(Ag)、ニッケル
(Ni)及びパラジウム(Pd)等が鍍金されている。ま
た、前記樹脂層17としては硬性を有するBT(bis
maleimide triazine)系エポキシ樹
脂が望ましいが、本発明ではこれに限定するのではな
い。
は、今後接続手段40との容易なボンディングのために
金(Au)または銀(Ag)が鍍金されており、前記ボール
ランド18bには、今後導電性ボール60との容易易な
ボンディングのために金(Au)、銀(Ag)、ニッケル
(Ni)及びパラジウム(Pd)等が鍍金されている。ま
た、前記樹脂層17としては硬性を有するBT(bis
maleimide triazine)系エポキシ樹
脂が望ましいが、本発明ではこれに限定するのではな
い。
【0023】前記導電性回路パターン18は外部の物理
的、化学的、電気的及び機械的衝撃等から保護するよう
にカバーコート19がコーティングされているが、前記
回路パターン18中にボンドフィンガー18a及びボー
ルランド18bはカバーコート19により外側にオープ
ンされている。前記半導体チップ30の入出力パッド3
1と前記回路基板10の回路パターン18中、ボンドフ
ィンガー18aとは相互電気的に接続されるように接続
手段40で連結されている。ここで、前記接続手段40
としては金(Au)ワイアやアルミニユウム(Al)ワイア
のような導電性ワイアを利用するか、またはボンドフィ
ンガー18aに延長形成されたリード(lead)を利用
することもできる。
的、化学的、電気的及び機械的衝撃等から保護するよう
にカバーコート19がコーティングされているが、前記
回路パターン18中にボンドフィンガー18a及びボー
ルランド18bはカバーコート19により外側にオープ
ンされている。前記半導体チップ30の入出力パッド3
1と前記回路基板10の回路パターン18中、ボンドフ
ィンガー18aとは相互電気的に接続されるように接続
手段40で連結されている。ここで、前記接続手段40
としては金(Au)ワイアやアルミニユウム(Al)ワイア
のような導電性ワイアを利用するか、またはボンドフィ
ンガー18aに延長形成されたリード(lead)を利用
することもできる。
【0024】一方、前記半導体チップ30、接続手段4
0等は外部の物理的、化学的及び機械的衝撃等から保護
するように封止材50で封止されている。この時、前記
封止材50は図1のように、回路基板10の上面全体に
形成できる。前記のように、回路基板10の上面全体に
封止材50が形成されることによって、回路基板10の
曲がる現象を防止し得る利点がある。また、図2に示し
た半導体パッケージ102のように、半導体チップ3
0、接続手段40及びボンドフィンガー18aが形成さ
れた回路基板10の一部領域だけが封止材50で封止す
ることもできる。
0等は外部の物理的、化学的及び機械的衝撃等から保護
するように封止材50で封止されている。この時、前記
封止材50は図1のように、回路基板10の上面全体に
形成できる。前記のように、回路基板10の上面全体に
封止材50が形成されることによって、回路基板10の
曲がる現象を防止し得る利点がある。また、図2に示し
た半導体パッケージ102のように、半導体チップ3
0、接続手段40及びボンドフィンガー18aが形成さ
れた回路基板10の一部領域だけが封止材50で封止す
ることもできる。
【0025】さらに、前記封止材50は図1、2でのよ
うに、金型を使用するエポキシモルディングコンパウン
ド(Epoxy Molding Compound)の
利用ができ、図3の半導体パッケージ103でのように
ディスペンサー(Dispenser)を使用して封止す
る液相封止材50の利用もできる。この時、回路基板1
0の上面には封止中、液相封止材50が外側へ流れない
ようにするダム25の形成もできる。また、前記図1及
び図2の半導体パッケージ101、102でも同様に液
相封止材50の使用ができるが、ここでは、封止材の材
質を限定するのではない。
うに、金型を使用するエポキシモルディングコンパウン
ド(Epoxy Molding Compound)の
利用ができ、図3の半導体パッケージ103でのように
ディスペンサー(Dispenser)を使用して封止す
る液相封止材50の利用もできる。この時、回路基板1
0の上面には封止中、液相封止材50が外側へ流れない
ようにするダム25の形成もできる。また、前記図1及
び図2の半導体パッケージ101、102でも同様に液
相封止材50の使用ができるが、ここでは、封止材の材
質を限定するのではない。
【0026】前記半導体チップ30の第2面30bと、
ボンドフィンガー18aが形成された回路基板10面(第
2面11b)は同一の方向に形成されており、前記半導
体チップ30の第1面30aとボールランド18bが形
成された回路基板10面(第1面11a)、封止材50の
下面は同一の平面をなすことによって、半導体パッケー
ジが薄型化され、また前記半導体チップ30の第1面3
0aは封止材50の外側へ露出されることによって、半
導体チップ30の熱が外部に容易に放出される。
ボンドフィンガー18aが形成された回路基板10面(第
2面11b)は同一の方向に形成されており、前記半導
体チップ30の第1面30aとボールランド18bが形
成された回路基板10面(第1面11a)、封止材50の
下面は同一の平面をなすことによって、半導体パッケー
ジが薄型化され、また前記半導体チップ30の第1面3
0aは封止材50の外側へ露出されることによって、半
導体チップ30の熱が外部に容易に放出される。
【0027】ここで、図示はしていないが、前記回路基
板10の貫通孔12を包含する半導体チップ30の第1
面30aには絶縁テープまたは銅層が接着できる。前記
絶縁テープが接着された場合は前記半導体チップ30の
第1面30aを外部衝撃から保護するためであり、銅層
が接着された場合はその半導体チップ30の放熱性能を
向上させるためである。継いで、前記回路基板10の回
路パターン18中、即ち、樹脂層17の第1面11aに
形成された多数のボールランド18bには錫(Sn)、鉛
(Pb)またはこれらの合金でなる多数の導電性ボール6
0が融着されることによって、今後マザーボードに実装
が可能となるようになっている。
板10の貫通孔12を包含する半導体チップ30の第1
面30aには絶縁テープまたは銅層が接着できる。前記
絶縁テープが接着された場合は前記半導体チップ30の
第1面30aを外部衝撃から保護するためであり、銅層
が接着された場合はその半導体チップ30の放熱性能を
向上させるためである。継いで、前記回路基板10の回
路パターン18中、即ち、樹脂層17の第1面11aに
形成された多数のボールランド18bには錫(Sn)、鉛
(Pb)またはこれらの合金でなる多数の導電性ボール6
0が融着されることによって、今後マザーボードに実装
が可能となるようになっている。
【0028】一方、図4に図示した半導体パッケージ1
04のように、前記樹脂層17の第2面11bに形成さ
れた回路パターン18にも多数のボールランド18bが
さらに形成することもできる。前記ボールランド18b
はカバーコート19が形成されることなくオープンされ
ており、これは以降多数の半導体パッケージが積層でき
ることを意味する。即ち、図5に図示した半導体パッケ
ージ105のように、前記樹脂層17の第2面11bに
形成されたボールランド18bに多数の導電性ボール6
0がさらに融着することによって、多数の半導体パッケ
ージが積層可能になる。
04のように、前記樹脂層17の第2面11bに形成さ
れた回路パターン18にも多数のボールランド18bが
さらに形成することもできる。前記ボールランド18b
はカバーコート19が形成されることなくオープンされ
ており、これは以降多数の半導体パッケージが積層でき
ることを意味する。即ち、図5に図示した半導体パッケ
ージ105のように、前記樹脂層17の第2面11bに
形成されたボールランド18bに多数の導電性ボール6
0がさらに融着することによって、多数の半導体パッケ
ージが積層可能になる。
【0029】また、図示はしていないが、前記ボールラ
ンド18bが形成された第2面11b全体が封止材で封
止できる。したがって、封止材は前記樹脂層17のボー
ルランド18bにも接着するため、封止材と前記樹脂層
との間の接着力が強化され(インターロッキング力の向
上)、前記樹脂層、特に回路パターンを通じて伝達され
る熱が封止材を通じて伝達することによって、半導体パ
ッケージの全体的な放熱性能も向上される。
ンド18bが形成された第2面11b全体が封止材で封
止できる。したがって、封止材は前記樹脂層17のボー
ルランド18bにも接着するため、封止材と前記樹脂層
との間の接着力が強化され(インターロッキング力の向
上)、前記樹脂層、特に回路パターンを通じて伝達され
る熱が封止材を通じて伝達することによって、半導体パ
ッケージの全体的な放熱性能も向上される。
【0030】図6及び図7は本発明による半導体パッケ
ージの製造に使用された回路基板を図示した平面図及び
底面図で、まず、前記回路基板10の構造を簡単に設明
すれば次のようになる。本発明に利用された回路基板1
0は樹脂層17、回路パターン18、カバーコート19
等でなっている。まず、樹脂層17はほぼ直四角板状
で、第1面11aと第2面11bを有し、半導体チップ
(図示ぜす)が位置するように多数の貫通孔12が一定の
長さのサブスロット13を境界として行並びに列を成し
一つのサブストリップ14をなし、前記サブストリップ
14は一定の長さのメインスロット15を境界として多
数が一列に連結され一つのメインストリップ16をなし
ている。
ージの製造に使用された回路基板を図示した平面図及び
底面図で、まず、前記回路基板10の構造を簡単に設明
すれば次のようになる。本発明に利用された回路基板1
0は樹脂層17、回路パターン18、カバーコート19
等でなっている。まず、樹脂層17はほぼ直四角板状
で、第1面11aと第2面11bを有し、半導体チップ
(図示ぜす)が位置するように多数の貫通孔12が一定の
長さのサブスロット13を境界として行並びに列を成し
一つのサブストリップ14をなし、前記サブストリップ
14は一定の長さのメインスロット15を境界として多
数が一列に連結され一つのメインストリップ16をなし
ている。
【0031】ここで、前記サブスロット13やメインス
ロット15全部は樹脂層17が貫通されて形成したもの
である。また、前記回路パターン18は各サブストリッ
プ14内の貫通孔12とサブスロット13との間の樹脂
層17に形成されており、これは通常の銅薄膜である。
ロット15全部は樹脂層17が貫通されて形成したもの
である。また、前記回路パターン18は各サブストリッ
プ14内の貫通孔12とサブスロット13との間の樹脂
層17に形成されており、これは通常の銅薄膜である。
【0032】一方、前記カバーコート19は前記回路パ
ターン18を外部環境から保護するために前記回路パタ
ーン18及び樹脂層17表面にコッティングされてお
り、前記カバーコートは通常の高分子樹脂である。ここ
で、前記回路パターン18は、次後半導体チップと連結
される多数のボンドフィンガー18aと、次後導電性ボ
ールが融着される多数のボールランド18bとを包含
し、前記ボンドフィンガー18aとボールランド18b
は図示したようにカバーコート19外側へオープンされ
ている。
ターン18を外部環境から保護するために前記回路パタ
ーン18及び樹脂層17表面にコッティングされてお
り、前記カバーコートは通常の高分子樹脂である。ここ
で、前記回路パターン18は、次後半導体チップと連結
される多数のボンドフィンガー18aと、次後導電性ボ
ールが融着される多数のボールランド18bとを包含
し、前記ボンドフィンガー18aとボールランド18b
は図示したようにカバーコート19外側へオープンされ
ている。
【0033】また、前記回路パターン18は図6に図示
したように、樹脂層17の第2面11bにボンドフィン
ガー18a及びボールランド18bのすべて形成でき、
図7に図示したように樹脂層17の第1面11aにボー
ルランド18bが形成することもできる。この時、前記
ボンドフィンガー18aとボールランド18bは導電性
ビアホール(図示せず)により相互連結される。
したように、樹脂層17の第2面11bにボンドフィン
ガー18a及びボールランド18bのすべて形成でき、
図7に図示したように樹脂層17の第1面11aにボー
ルランド18bが形成することもできる。この時、前記
ボンドフィンガー18aとボールランド18bは導電性
ビアホール(図示せず)により相互連結される。
【0034】また、図面では前記ボールランド18bが
2列に形成されているが、これは3列乃至5列に構成す
ることもでき、これは、当業者の選択事項に過ぎなく、
ここでその列の数を限定するのではない。継いで、図8
乃至図13は本発明による半導体パッケージの製造方法
を図示した設明図であり、これを利用してその製造方法
を設明すれば次のようになる。前記半導体パッケージの
製造に使用された回路基板は前記のような構造の回路基
板であり、ここでは一部の構造だけを設明するようにす
る。また、前記サブスロットの図示は設明の便宜上、省
略することにする。
2列に形成されているが、これは3列乃至5列に構成す
ることもでき、これは、当業者の選択事項に過ぎなく、
ここでその列の数を限定するのではない。継いで、図8
乃至図13は本発明による半導体パッケージの製造方法
を図示した設明図であり、これを利用してその製造方法
を設明すれば次のようになる。前記半導体パッケージの
製造に使用された回路基板は前記のような構造の回路基
板であり、ここでは一部の構造だけを設明するようにす
る。また、前記サブスロットの図示は設明の便宜上、省
略することにする。
【0035】まず、図6及び図7で設明した回路基板1
0を提供する(図8)。継いで、前記回路基板10の貫通
孔12内に半導体チップ30を位置させる。この時、前
記半導体チップ30の入出力パッド31が、回路基板1
0のボンドフィンガー18aが形成された面(第2面11
b)と同一の方向をなすようにする。望ましくは、前記
回路基板10の貫通孔12底面を覆うように閉鎖部材7
0をその貫通孔12底面に予め接着した後、半導体チッ
プ30の第1面30aが前記閉鎖部材70に位置するこ
とにする。
0を提供する(図8)。継いで、前記回路基板10の貫通
孔12内に半導体チップ30を位置させる。この時、前
記半導体チップ30の入出力パッド31が、回路基板1
0のボンドフィンガー18aが形成された面(第2面11
b)と同一の方向をなすようにする。望ましくは、前記
回路基板10の貫通孔12底面を覆うように閉鎖部材7
0をその貫通孔12底面に予め接着した後、半導体チッ
プ30の第1面30aが前記閉鎖部材70に位置するこ
とにする。
【0036】前記貫通孔閉鎖部材70としては絶縁テー
プが望ましく、更に望ましくは、熱や紫外線により容易
に剥げ得る紫外線テープを利用することもできる。さら
に、前記閉鎖部材70として放熱性能が優秀な銅層を付
着することもでき、この時には以降の前記閉鎖部材を除
去しない(図9)。
プが望ましく、更に望ましくは、熱や紫外線により容易
に剥げ得る紫外線テープを利用することもできる。さら
に、前記閉鎖部材70として放熱性能が優秀な銅層を付
着することもでき、この時には以降の前記閉鎖部材を除
去しない(図9)。
【0037】一方、前記閉鎖部材70は回路基板(多数
のサブストリップを有するメインストリップ)10全体
に付着ができ、これは以降、図14及び15を参照して
もっと詳細に設明することにする。
のサブストリップを有するメインストリップ)10全体
に付着ができ、これは以降、図14及び15を参照して
もっと詳細に設明することにする。
【0038】前記半導体チップ30の入出力パッド31
と、回路基板10のボンドフィンガー18aが電気的に
接続し得るようにゴールドワイアやアルミニユウムワイ
アのような導電性ワイアまたはボンドフィンガー18a
に延長されたリード等の接続手段40で前記入出力パッ
ド31とボンドフィンガー18aとを電気的に接続する
(図10)。
と、回路基板10のボンドフィンガー18aが電気的に
接続し得るようにゴールドワイアやアルミニユウムワイ
アのような導電性ワイアまたはボンドフィンガー18a
に延長されたリード等の接続手段40で前記入出力パッ
ド31とボンドフィンガー18aとを電気的に接続する
(図10)。
【0039】前記閉鎖部材70上面の半導体チップ3
0、接続手段40、回路基板10の上面全体をエポキシ
モルディングコンパウンドまたは液相封止材のような封
止材50で封止する。この時、前記半導体チップ30、
接続手段40及び回路基板10の一定領域だけを封止材
50で封止することもでき、これは、当業者の選択事項
に過ぎない(図11)。ここで、前記封止工程は以降、図
16でもっと詳細に設明することにする。
0、接続手段40、回路基板10の上面全体をエポキシ
モルディングコンパウンドまたは液相封止材のような封
止材50で封止する。この時、前記半導体チップ30、
接続手段40及び回路基板10の一定領域だけを封止材
50で封止することもでき、これは、当業者の選択事項
に過ぎない(図11)。ここで、前記封止工程は以降、図
16でもっと詳細に設明することにする。
【0040】前記回路基板10の底面に形成されたボー
ルランド18bに多数の導電性ボール60を融着して、
以降マザーボードに実装が可能な形態にする(図12)。
また、前記ボンドフィンガー18aが形成された回路基
板10の上面にもボールランド18bが形成された場合
は、そのボールランド18bにも導電性ボール60を融
着して次後、多数の半導体パッケージが積層可能にす
る。
ルランド18bに多数の導電性ボール60を融着して、
以降マザーボードに実装が可能な形態にする(図12)。
また、前記ボンドフィンガー18aが形成された回路基
板10の上面にもボールランド18bが形成された場合
は、そのボールランド18bにも導電性ボール60を融
着して次後、多数の半導体パッケージが積層可能にす
る。
【0041】前記導電性ボール60を融着する方法とし
ては多様な方法が可能であるが、スクリーンフリンティ
ング(screen printing)方法を利用する
のが望ましい。即ち、前記回路基板10のボールランド
18bに比較的大きい粘性を有するフラックスをドッテ
ィング(dotting)し、前記ドッティングされたフ
ラックス上に導電性ボール60を仮接着した後、前記回
路基板10をファーネス(furnace)に入れて前記
導電性ボール60がボールランド18bに融着されるよ
うにする。
ては多様な方法が可能であるが、スクリーンフリンティ
ング(screen printing)方法を利用する
のが望ましい。即ち、前記回路基板10のボールランド
18bに比較的大きい粘性を有するフラックスをドッテ
ィング(dotting)し、前記ドッティングされたフ
ラックス上に導電性ボール60を仮接着した後、前記回
路基板10をファーネス(furnace)に入れて前記
導電性ボール60がボールランド18bに融着されるよ
うにする。
【0042】最終に、前記ストリップ形態の回路基板1
0を所定のシンギュレーションツール80を利用してお
のおの独立した半導体パッケージに分離する(図13)。
ここで、前記シンギュレーションツールは多数のサブス
ロットとサブスロットとの間の領域を貫通するようにな
り、図面では前記サブスロットが図示していない。
0を所定のシンギュレーションツール80を利用してお
のおの独立した半導体パッケージに分離する(図13)。
ここで、前記シンギュレーションツールは多数のサブス
ロットとサブスロットとの間の領域を貫通するようにな
り、図面では前記サブスロットが図示していない。
【0043】また、前記回路基板10のボールランド1
8bに導電性ボール60を融着して入出力端子を形成す
る段階前、導電性ボール60を融着して入出力端子を形
成する段階後、またはシンギュレーション段階後の中、
いずれかーつの段階で前記閉鎖部材70を除去して、半
導体チップ30の第1面30aが外部に露出させるのが
望ましい。また、前記閉鎖部材を除去することなくその
まま製品化することもできる。これは前記閉鎖部材が銅
層である場合、特に望ましい。また、前記回路基板10
の上面全体に封止材50が封止されている場合は、前記
封止材50及び回路基板10を共にシンギュレーション
することによって図1のような半導体パッケージに製造
される。
8bに導電性ボール60を融着して入出力端子を形成す
る段階前、導電性ボール60を融着して入出力端子を形
成する段階後、またはシンギュレーション段階後の中、
いずれかーつの段階で前記閉鎖部材70を除去して、半
導体チップ30の第1面30aが外部に露出させるのが
望ましい。また、前記閉鎖部材を除去することなくその
まま製品化することもできる。これは前記閉鎖部材が銅
層である場合、特に望ましい。また、前記回路基板10
の上面全体に封止材50が封止されている場合は、前記
封止材50及び回路基板10を共にシンギュレーション
することによって図1のような半導体パッケージに製造
される。
【0044】ー方、図14及び図15は、本発明による
半導体パッケージの製造方法中、閉鎖部材のほかの付着
方法を図示した回路基板の底面図である。まず、図14
に図示したように前記閉鎖部材70はおのおののサブス
トリップ14に個々に付着ができる。この時、前記閉鎖
部材70の一側がサブストリップ14とサブストリップ
との間のメインスロット15に位置するのが望ましい。
これは以降、前記閉鎖部材70を除去する時に、ほぼ板
状のバー(図示せず)が前記メインスロット15を貫通し
て、前記閉鎖部材70の一側を押すことによって前記閉
鎖部材70が容易に除去される。勿論、前記板状のバー
は回路基板10の第2面11bから第1面11aを向か
うように運動する。
半導体パッケージの製造方法中、閉鎖部材のほかの付着
方法を図示した回路基板の底面図である。まず、図14
に図示したように前記閉鎖部材70はおのおののサブス
トリップ14に個々に付着ができる。この時、前記閉鎖
部材70の一側がサブストリップ14とサブストリップ
との間のメインスロット15に位置するのが望ましい。
これは以降、前記閉鎖部材70を除去する時に、ほぼ板
状のバー(図示せず)が前記メインスロット15を貫通し
て、前記閉鎖部材70の一側を押すことによって前記閉
鎖部材70が容易に除去される。勿論、前記板状のバー
は回路基板10の第2面11bから第1面11aを向か
うように運動する。
【0045】また、図15に図示したように、前記閉鎖
部材70は回路基板10の各メインスロット15と対応
する領域に切断用小孔71が形成されたものを使用する
こともできる。この時、前記閉鎖部材70は多数のサブ
ストリップ14に一体に付着される。
部材70は回路基板10の各メインスロット15と対応
する領域に切断用小孔71が形成されたものを使用する
こともできる。この時、前記閉鎖部材70は多数のサブ
ストリップ14に一体に付着される。
【0046】このような閉鎖部材70も又、ほぼ板状の
バー(図示せず)が前記メインスロット15を貫通して、
前記閉鎖部材70の一側を押すことによって前記閉鎖部
材70が容易に除去される。前記閉鎖部材は、例えば、
郵便切手を容易に分離するために、その分離される部分
に小孔等が形成されたものと同一の原理である。図16
は本発明による半導体パッケージの製造方法中、封止方
法を示す断面図である。
バー(図示せず)が前記メインスロット15を貫通して、
前記閉鎖部材70の一側を押すことによって前記閉鎖部
材70が容易に除去される。前記閉鎖部材は、例えば、
郵便切手を容易に分離するために、その分離される部分
に小孔等が形成されたものと同一の原理である。図16
は本発明による半導体パッケージの製造方法中、封止方
法を示す断面図である。
【0047】まず、回路基板10を上型91と下型92
でなる金型の間に位置させる。前記下型92は、図示し
たように回路基板10が安着される面が平坦になってお
り、前記上型91は半導体チップ30の第2面(30a)
に対向する部分に一定空間のキャビティ93が形成され
ている。また、前記上型91には前記半導体チップ30
の第2面(30a)の中央部に対向する部分に一定の口径
を有するゲート94が形成されている。
でなる金型の間に位置させる。前記下型92は、図示し
たように回路基板10が安着される面が平坦になってお
り、前記上型91は半導体チップ30の第2面(30a)
に対向する部分に一定空間のキャビティ93が形成され
ている。また、前記上型91には前記半導体チップ30
の第2面(30a)の中央部に対向する部分に一定の口径
を有するゲート94が形成されている。
【0048】したがって、封止材は前記上型92のゲー
ト94に沿って注入され、結局、前記封止材は半導体チ
ップ30の第2面の中央部からその側面へ移動しながら
封止するようになる。ここで、図面では上型が上部に、
下型が下部に位置しているが、前記上型が下部に、下型
が上部に位置することもできる。
ト94に沿って注入され、結局、前記封止材は半導体チ
ップ30の第2面の中央部からその側面へ移動しながら
封止するようになる。ここで、図面では上型が上部に、
下型が下部に位置しているが、前記上型が下部に、下型
が上部に位置することもできる。
【0049】前記のように上型及び下型の位置が取り換
えられた場合は、勿論封止材が下部から上部に向って流
れるようになる。前記のようにして、従来の回路基板の
一側から封止する方法に比べてボール封止の作業中、ワ
イアスウィーピング(sweeping)現象が最小化さ
れる。即ち、高圧の封止圧力が半導体チップの入出力パ
ッドが形成された表面の中央部に作用した後、多少緩和
された封止圧でワイア部分に封止材が流れるようにな
る。
えられた場合は、勿論封止材が下部から上部に向って流
れるようになる。前記のようにして、従来の回路基板の
一側から封止する方法に比べてボール封止の作業中、ワ
イアスウィーピング(sweeping)現象が最小化さ
れる。即ち、高圧の封止圧力が半導体チップの入出力パ
ッドが形成された表面の中央部に作用した後、多少緩和
された封止圧でワイア部分に封止材が流れるようにな
る。
【0050】
【発明の効果】このようにして、本発明による半導体パ
ッケージ及びその製造方法によれば、回路基板に一定の
面積の貫通孔が形成され、その貫通孔に半導体チップが
位置することによって、その半導体チップの厚さが前記
回路基板の厚さにより相殺され、その結果、半導体パッ
ケージの厚さを超薄型に製造できる効果がある。また、
半導体チップの一面が封止材の外部に直接露出されるこ
とによって、その半導体チップから発生する熱が外部の
空気中へ容易に発散され、半導体チップの熱的、電気的
性能が向上される効果がある。また、回路基板の一面全
対に封止材が封止されることによって、回路基板の曲が
る現象の抑制効果もある。
ッケージ及びその製造方法によれば、回路基板に一定の
面積の貫通孔が形成され、その貫通孔に半導体チップが
位置することによって、その半導体チップの厚さが前記
回路基板の厚さにより相殺され、その結果、半導体パッ
ケージの厚さを超薄型に製造できる効果がある。また、
半導体チップの一面が封止材の外部に直接露出されるこ
とによって、その半導体チップから発生する熱が外部の
空気中へ容易に発散され、半導体チップの熱的、電気的
性能が向上される効果がある。また、回路基板の一面全
対に封止材が封止されることによって、回路基板の曲が
る現象の抑制効果もある。
【0051】さらに、半導体パッケージの製造工程中に
閉鎖部材を利用することによって、その封止作業を容易
に遂行し、また、回路基板に個々の予め分離された閉鎖
部材を付着するか、または切断用小孔が形成された閉鎖
部材を利用して、その閉鎖部材の除去を容易に遂行し得
る効果もある。また、半導体パッケージの製造工程中、
封止工程は半導体チップの第2面から封止材が充填され
るので、封止が均一に遂行され、また、ワイアスウィー
ピング現象を抑制し得る効果がある。
閉鎖部材を利用することによって、その封止作業を容易
に遂行し、また、回路基板に個々の予め分離された閉鎖
部材を付着するか、または切断用小孔が形成された閉鎖
部材を利用して、その閉鎖部材の除去を容易に遂行し得
る効果もある。また、半導体パッケージの製造工程中、
封止工程は半導体チップの第2面から封止材が充填され
るので、封止が均一に遂行され、また、ワイアスウィー
ピング現象を抑制し得る効果がある。
【図1】本発明による半導体パッケージを示す断面図で
ある。
ある。
【図2】本発明による半導体パッケージを示す断面図で
ある。
ある。
【図3】本発明による半導体パッケージを示す断面図で
ある。
ある。
【図4】本発明による半導体パッケージを示す断面図で
ある。
ある。
【図5】本発明による半導体パッケージを示す断面図で
ある。
ある。
【図6】本発明による半導体パッケージの製造に使用さ
れた回路基板を示す平面図
れた回路基板を示す平面図
【図7】本発明による半導体パッケージの製造に使用さ
れた回路基板を示す底面図
れた回路基板を示す底面図
【図8】本発明による半導体パッケージの製造方法を図
示した設明図である。
示した設明図である。
【図9】本発明による半導体パッケージの製造方法を図
示した設明図である。
示した設明図である。
【図10】本発明による半導体パッケージの製造方法を
図示した設明図である。
図示した設明図である。
【図11】本発明による半導体パッケージの製造方法を
図示した設明図である。
図示した設明図である。
【図12】本発明による半導体パッケージの製造方法を
図示した設明図である。
図示した設明図である。
【図13】本発明による半導体パッケージの製造方法を
図示した設明図である。
図示した設明図である。
【図14】本発明による半導体パッケージの製造方法
中、閉鎖部材のほかの付着方法を図示した回路基板の底
面図である。
中、閉鎖部材のほかの付着方法を図示した回路基板の底
面図である。
【図15】本発明による半導体パッケージの製造方法
中、閉鎖部材のほかの付着方法を図示した回路基板の底
面図である。
中、閉鎖部材のほかの付着方法を図示した回路基板の底
面図である。
【図16】本発明による半導体パッケージの製造方法
中、封止方法を示す断面図である。
中、封止方法を示す断面図である。
【図17】従来の半導体パッケージを図示した断面図で
ある。
ある。
10 本発明による回路基板 11a 回路基板の第1面 11b 回路基板の第2面 12 貫通孔 13 スブスロット 14 サブストリップ 15 メインスロット 16 メインストリップ 17 樹脂層 18 回路パターン 18a ボンドフィンガー 18b ボールランド 19 カバーコート 20 導電性ビアホール 25 ダム 30 半導体チップ 30a 半導体チップの第1面 30b 半導体チップの第2面 31入出力パッド 40 接続手段 50 封止材 60 導電性ボール 70閉鎖部材 80シンギュレーションツール 91上型 92下型 93キャビティ 94ゲート 101半導体パッケージ 102半導体パッケージ 103半導体パッケージ 104半導体パッケージ 105 半導体パッケージ
───────────────────────────────────────────────────── フロントページの続き (72)発明者 李 相 昊 大韓民国 ソウル特別市 中浪區 中和洞 284−13 (72)発明者 全 道 成 アメリカ アリゾーナ 85226 チャンド ール スート 900 ノース ルールロー ド 1347
Claims (20)
- 【請求項1】 第1面と第2面を有し、前記第2面には
多数の入出力パッドが形成された半導体チップと;第1
面と第2面を有する樹脂層と、前記樹脂層の第1面には
多数のボールランドが形成され前記樹脂層の第2面には
多数のボンドフィンガーが形成され前記ボールランドと
ボンドフィンガーとは導電性ビアホールにより連結され
る回路パターンと、前記多数のボンドフィンガーとボー
ルランドとをオープンさせ回路パターンをコッティング
するカバーコートとで構成され、中央には貫通孔が形成
されており、前記貫通孔には前記半導体チップが位置す
る回路基板と;前記半導体チップの入出力パッドと前記
回路基板のボンドフィンガーとを電気的に接続させる電
気的接続手段と;前記半導体チップ、接続手段及び回路
基板の貫通孔を覆う封止材と;前記回路基板のボールラ
ンドに融着された多数の導電性ボールとを包含してなる
ことを特徴とする半導体パッケージ。 - 【請求項2】前記半導体チップの第2面と、ボンドフィ
ンガーが形成された回路基板の第2面とは同一の方向に
形成されており、前記半導体チップの第1面と、ボール
ランドが形成された前記回路基板の第1面及び封止材の
一面とは同一の平面であることを特徴とする請求項1記
載の半導体パッケージ。 - 【請求項3】前記封止材はボンドフィンガーが形成され
た回路基板の第2面全体に形成されることを特徴とする
請求項1記載の半導体パッケージ。 - 【請求項4】前記ボールランドはボンドフィンガーが形
成された回路基板の第2面にも形成されることを特徴と
する請求項2又は3記載の半導体パッケージ。 - 【請求項5】前記回路基板の第2面に形成されたボール
ランドには導電性ボールが融着されることを特徴とする
請求項3記載の半導体パッケージ。 - 【請求項6】前記半導体チップの第1面には回路基板の
貫通孔を覆うように閉鎖部材がさらに付着されることを
特徴とする請求項4記載の半導体パッケージ。 - 【請求項7】前記閉鎖部材は絶縁テープまたは銅層であ
ることを特徴とする請求項6記載の半導体パッケージ。 - 【請求項8】ほぼ直四角板状であり、第1面と第2面を
有し、半導体チップが位置するように多数の貫通孔が一
定の長さのサブスロットを境界として行並びに列を成し
て一つのサブストリップをなし、前記サブストリップは
一定の長さのメインスロットを境界として多数が一列に
連結されて一つのメインストリップをなす樹脂層と;前
記各サブストリップ内の貫通孔とサブスロットとの間の
樹脂層の第1面には多数のボールランドが、第2面には
多数のボンドフィンガーが形成されている多数の回路パ
ターンと;前記回路パターン中、ボンドフィンガー及び
ボールランドは外側にオープンさせ前記樹脂層表面にコ
ーティングされたカバーコートを包含する回路基板を提
供する段階と;第1面と第2面を有し、前記第2面に多
数の入出力パッドを有する半導体チップを前記回路基板
の各貫通孔内に位置させる段階と;前記半導体チップの
入出力パッドと回路基板のボンドフィンガーとを電気的
に接続させる段階と;前記半導体チップ、接続手段、及
び回路基板の貫通孔を封止材で封止する段階と;前記回
路基板のボールランドに導電性ボールを融着させる段階
と;前記回路基板から各サブスロット間の領域を除去し
て個々の半導体パッケージにシンギュレーションする段
階とでなることを特徴とする半導体パッケージの製造方
法。 - 【請求項9】前記半導体チップを回路基板の貫通孔内に
位置させる段階前に、多数のボールランドが形成された
前記回路基板の第1面に貫通孔閉鎖部材を付着する段階
をさらに包含することを特徴とする請求項8記載の半導
体パッケージの製造方法。 - 【請求項10】前記半導体チップを回路基板の貫通孔内
に位置させる段階前に、前記回路基板でボールランドが
形成されたメインストリップの第1面全体に閉鎖部材を
付着する段階をさらに包含することを特徴とする請求項
8記載の半導体パッケージの製造方法。 - 【請求項11】前記閉鎖部材は、おのおののサブストリ
ップに個々に付着するが、前記閉鎖部材の一側がサブス
トリップとサブストリップとの間のメインスロットに位
置することを特徴とする請求項10記載の半導体パッケ
ージの製造方法。 - 【請求項12】前記閉鎖部材は回路基板の各メインスロ
ットに対応する領域に切断用小孔を形成して付着するこ
とを特徴とする請求項10記載の半導体パッケージの製
造方法。 - 【請求項13】前記回路基板のボールランドに導電性ボ
ールを融着する段階前、または導電性ボールを融着する
段階後、またはシンギュレーション段階後のうち、いず
れかのーつの段階で前記閉鎖部材を除去することを特徴
とする請求項9乃至11のいずれかーつに記載の半導体
パッケージの製造方法。 - 【請求項14】前記回路基板のボールランドに導電性ボ
ールを融着する段階前、または導電性ボールを融着する
段階後、またはシンギュレーション段階後のうち、いず
れかーつの段階で前記回路基板の各メインスロットに回
路基板の第2面から第1面に向かう板状のバーを貫通さ
せて閉鎖部材の一側が回路基板から分離するようにして
閉鎖部材を除去することを特徴とする請求項11又は1
2記載の半導体パッケージの製造方法。 - 【請求項15】前記閉鎖部材は絶縁性テープ、紫外線テ
ープまたは銅層を利用することを特徴とする請求項9乃
至12のいずれかーつに記載の半導体パッケージの製造
方法。 - 【請求項16】前記封止段階はボンドフィンガーが形成
された回路基板の第2面全体に形成することを特徴とす
る請求項8記載の半導体パッケージの製造方法。 - 【請求項17】前記シンギュレーション段階は封止材と
回路基板とを共にシンギュレーションすることを特徴と
する請求項16記載の半導体パッケージの製造方法。 - 【請求項18】前記封止段階は回路基板を金型の間に位
置させ、前記半導体チップの第2面に対応する金型にゲ
ートを形成することによって、前記封止材が前記半導体
チップの第2面から充填することを特徴とする請求項8
記載の半導体パッケージの製造方法。 - 【請求項19】前記回路基板の提供段階はボンドフィン
ガーが形成された回路基板の第2面にも多数のボールラ
ンドを形成して提供することを特徴とする請求項8記載
の半導体パッケージの製造方法。 - 【請求項20】前記導電性ボールの融着段階は前記ボン
ドフィンガーが形成された回路基板の第2面のボールラ
ンドにも多数の導電性ボールを融着することを特徴とす
る請求項19記載の半導体パッケージの製造方法。
Applications Claiming Priority (6)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019990018244A KR20000074350A (ko) | 1999-05-20 | 1999-05-20 | 반도체패키지 및 그 제조방법 |
KR1999/P37925 | 1999-09-07 | ||
KR1999/P37928 | 1999-09-07 | ||
KR10-1999-0037928A KR100369394B1 (ko) | 1999-09-07 | 1999-09-07 | 반도체패키지용 섭스트레이트 및 이를 이용한 반도체패키지의 제조방법 |
KR1999/P18244 | 1999-09-07 | ||
KR1019990037925A KR100365054B1 (ko) | 1999-09-07 | 1999-09-07 | 반도체패키지용 섭스트레이트 및 이를 이용한 반도체패키지의 제조방법 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2000340714A true JP2000340714A (ja) | 2000-12-08 |
JP3398721B2 JP3398721B2 (ja) | 2003-04-21 |
Family
ID=27349969
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2000122786A Expired - Fee Related JP3398721B2 (ja) | 1999-05-20 | 2000-04-24 | 半導体パッケージ及びその製造方法 |
Country Status (2)
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