JP3230348B2 - 樹脂封止型半導体装置及びその製造方法 - Google Patents

樹脂封止型半導体装置及びその製造方法

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Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、薄型の樹脂封止型半導
体装置及びその製造方法に関する。
【0002】
【従来の技術】樹脂封止型の半導体装置としては、リー
ドフレームを用い半導体チップの電極とリードフレーム
のインナーリード先端とを金属細線(例えばAu細線)
等を介して接続し、樹脂封止して成る半導体装置があ
る。また、ポリイミドフィルムをベースとして、その表
面に銅箔のリードを形成したTAB(tape aut
omated bonding)リードを、半導体チッ
プの電極パッドに直接接続して成る半導体装置も知られ
ている。更に、リードフレームのインナーリード先端に
バンプを形成し、そのバンプと半導体チップの電極とを
接続して成る半導体装置も知られている。
【0003】前記のリードフレームのインナーリード先
端にバンプを形成した型式の半導体装置に関しては、3
層構造によるリードフレームを用いてなる半導体装置が
挙げられる。図12は、3層構造のリードフレームを用
いてなる樹脂封止型半導体装置の断面構造である。
【0004】同図において、1は半導体チップ、2はリ
ードフレーム、3はそのアウターリード、4はインナー
リードを示す。5は封止樹脂である。リードフレーム2
は、例えば銅あるいは鉄ニッケル合金(42アロイ)等
によるアウターリード用金属層6aと、例えばアルミニ
ウムによる中間層6bと、例えば銅によるインナーリー
ド用金属層6cの3層クラッド材6から成り、エッチン
グによるパターニングによって、金属層6aによるアウ
ターリード3、金属層6cによるインナーリード4及び
インナーリード先端の中間層6cによるバンプ7が夫々
形成される。
【0005】半導体チップ1は、表面に例えばアルミニ
ウムの電極パッド8が形成され、この電極パッド8がイ
ンナーリード先端のバンプ7に超音波ボンディングされ
る。この状態で、半導体チップ1及びインナーリード4
が樹脂5により気密封止される。リードフレーム2によ
りリード加工が施された後、アウターリード3の表裏面
に半田メッキ層9が形成される。
【0006】
【発明が解決しようとする課題】上述した図12の樹脂
封止型半導体装置10においては、インナーリード4の
先端にバンプ7を有する構造のため、複数本のインナー
リード4だけで半導体チップ1を支えることができ、ダ
イパッドのない比較的薄型の構造が可能となる。
【0007】しかし、半導体チップ1及びインナーリー
ド4は封止樹脂5中に埋め込まれており、且つアウター
リード3が一方向に曲げられている為、回路基板上への
実装方向、つまり半田付方向が一方向に固定されてしま
うという欠点があった。
【0008】また、半導体装置10を積層し半田付けし
て組立てることは不可能であった。
【0009】本発明は、上述の点に鑑み、更なる薄型化
が可能で且つ積層組立、表裏双方向の実装を可能にした
樹脂封止型半導体装置及びその製造方法を提供するもの
である。
【0010】
【課題を解決するための手段】本発明に係る樹脂封止型
半導体装置は、インナーリードとこのインナーリードに
接続された端子部とを有するリードフレームの板厚内
に、表面においてインナーリードに接続された半導体チ
ップが配置され、半導体チップ及びインナーリードが埋
め込まれるように樹脂封止され、一方の樹脂封止面とリ
ードフレームの上面とが同一平面となるように形成さ
れ、他方の樹脂封止面とリードフレームの下面と半導体
チップの裏面とが同一平面となるように形成され、端子
部の上面、下面及び側面が露出された構成とする。本発
明に係る樹脂封止型半導体装置の製造方法は、インナー
リードとこのインナーリードに接続された端子部とを有
するリードフレームの板厚内に半導体チップを配置し、
この半導体チップの表面をインナーリードに接続する工
程と、リードフレームの上面と樹脂封止面とが同一平面
となるようにインナーリードと半導体チップとを樹脂に
より封止する工程と、半導体チップの裏面とリードフレ
ームの下面とが同一平面となるように半導体チップと樹
脂とを研削する工程と、リードフレームを端子部を残し
て切断する工程とを有する。
【0011】
【作用】本発明の樹脂封止型半導体装置においては、リ
ードフレームの板厚内に、半導体チップを配置して樹脂
封止し、一方の樹脂封止面とリードフレームの上面とが
同一平面となり、他方の樹脂封止面とリードフレームの
下面と半導体チップの裏面とが同一平面となるように形
成するので、装置全体の厚さがリードフレームの板厚で
規定され、表裏両面が平坦な樹脂封止型半導体装置の薄
型化が可能になる。また、半導体チップの裏面が露出さ
れているので、半導体チップの放熱特性が向上する。更
に、表裏面が平坦であり、端子部の上面、下面及び側面
が露出されているので、取り扱い易く、樹脂封止型半導
体装置の回路基板に対し、表裏いずれの方向での実装が
可能となり、また、複数の樹脂封止型半導体装置を積層
状に実装することが可能となる。本発明の樹脂封止型半
導体装置の製造方法においては、上述の各工程を経るこ
とによって、リードフレームの板厚内に半導体チップが
配置され、リードフレームの板厚で全体の厚さが規定さ
れると共に半導体チップの裏面が露出され且つ端子部の
上面、下面及び側面が露出した上述の樹脂封止型半導体
装置が製造できる。
【0012】
【実施例】以下、図面を参照して本発明の実施例を説明
する。
【0013】図1及び図2は本発明の樹脂封止型半導体
装置の一例を示す断面図及び斜視図である。本例に係る
樹脂封止型半導体装置11は、リードフレーム12の板
厚D1 内に半導体チップ13が配され、且つ板厚D1
よって半導体装置11全体の厚さが規定されるように樹
脂14にて封止されて成る。
【0014】リードフレーム12は、例えば100μm
〜150μm厚の銅材あるいは鉄ニッケル合金(42ア
ロイ)材等によるアウターリード用金属層20aと、例
えば5μm〜20μm厚のアルミニウム材による中間層
20bと、例えば5μm〜30μm厚の銅材によるイン
ナーリード用金属層20cの3層クラッド材20からな
り、エッチングによるパターニングによって、金属層2
0aによるアウターリード15、金属層20cによるイ
ンナーリード16及びインナーリード先端の中間層20
bによるバンプ17が夫々形成される。
【0015】インナーリード16はアウターリード15
の板厚D1 内に存するように内方に折曲され、その先端
のバンプ17と、半導体チップ13の表面に形成された
例えばアルミニウムによる電極パット18とが例えば超
音波エネルギーにより接合される。
【0016】半導体チップ13の裏面は樹脂14の封止
後にアウターリード15の上面と面一となるように研削
され、封止樹脂14の面と面一となって露出する。これ
によって、半導体チップ13の厚さt1 はアウターリー
ド15の板厚D1より薄く形成されることになる。
【0017】一方、アウターリード15はその封止樹脂
14の端面にほぼ沿って切断されて、所謂端子部として
形成される。従って、ここでのアウターリード15は、
従来呼ばれている封止樹脂から外方に導出されたもので
はなく、図2に示すように、実質的に封止樹脂14内に
埋め込まれた状態にあるので、従来の概念でいえばイン
ナーリードの一部を構成しているといえる。以後、この
アウターリード15を端子部と称する。
【0018】そして、上記端子部15は、上面、下面及
び側面が樹脂封止面より露出し、その露出した上面15
a、下面15b及び側面15cにわたって例えば3μm
〜10μm厚の半田メッキ層19がコーティングされ
る。この半田メッキ層19により端子部15は封止樹脂
14の面から僅かに突出することになる。
【0019】図3〜図5は上記実施例に係る樹脂封止型
半導体装置11の製造工程の一例を示す。
【0020】先ず、図3Aに示すように、リードフレー
ム12となるクラッド材、即ちアウターリード用の銅材
20aと中間層用のアルミニウム材20bとインナーリ
ード用の銅材20cからなる3層構造のクラッド材20
を用意する。
【0021】次に、図3Bに示すように、クラッド材2
0の上下両面に夫々アウターリードを含むリードフレー
ム形状に対応するパターンのフォトレジスト層22及び
インナーリードの形状に対応するパターンのフォトレジ
スト層23を形成する。
【0022】次に、このフォトレジスト層23をマスク
に銅材20a及び20cを選択エッチングし、図3Cに
示すように、中間層であるアルミニウム材20bを挟ん
でアウターリード15A(その他、ダイバー、外枠等を
含む)とこれに接続された形のインナーリード16とを
形成する。このとき、中間層のアルミニウム材13bは
エッチングストッパーとなる。
【0023】次に、図4Dに示すように、インナーリー
ド16の先端に対応するアルミニウム材20b上にバン
プのパターンに対応するフォトレジスト層24を形成し
た後、図4Eに示すように、アルミニウム材20bを選
択的に除去し、インナーリード16の先端上にアルミニ
ウム材によるバンプ17を形成する。
【0024】次に、図4Fに示すように、インナーリー
ド16をアウターリード15Aの板厚内に存するように
内方に折曲する。これによって、実施例で用いるリード
フレーム12が形成される。
【0025】次に、図4Gに示すように、このリードフ
レーム12のインナーリード16上に半導体チップ13
を配し、インナーリード16先端のバンプ17と、半導
体チップ13に形成されたアルミニウムの電極パッド1
8とを超音波ボンディングにより接合する。
【0026】次に、図5Hに示すように、半導体チップ
13及びインナーリード16を埋め込むように樹脂14
にて封止する。この状態で半導体チップ13及び封止樹
脂14はアウターリード15Aの面より突出している。
【0027】次に、図5Iに示すように、研削手段25
を介して突出している封止樹脂14及び半導体チップ1
3の裏面をアウターリード15Aの面と面一となる位置
まで研削する。半導体チップ13としてはその機能を満
足できる限界まで研削することができる。
【0028】次いで、リードフレーム12のリード加工
を行う。即ち封止樹脂14の流れ止めに供するダイバ
ー、外枠(フレーム)の切断及びアウターリード15A
の封止樹脂14の断面に沿う位置での切断を行う。その
後、アウターリードの残った部分、即ち端子部15の露
出された上面、下面及び側面にバレルメッキ、化学メッ
キ、蒸着等により半田層19を形成して、図5Jに示す
目的とする超薄型、小型の樹脂封止型半導体装置11を
得る。
【0029】ここで、リード加工では、例えばリードフ
レーム12のダイバー及びアウターリード15A間の通
称、樹脂バリと称する部分を切断又は削り取り、樹脂1
4の端面に沿ってアウターリード15Aを切断すること
ができる。
【0030】或はリードフレーム12のダイバーを切断
して後、樹脂バリの部分を残した状態でアウタリード1
5Aを樹脂14の端面に沿って切断することができる。
このときには端子部が長く形成できるので、後の半田付
けが良好となる。
【0031】尚、アウターリード15Aの切断に際して
は、図6に示すように、樹脂14の端面より僅かに(例
えばd0 が0.1mm程度)外方に突出するようにして
切断される。
【0032】上述の実施例に係る樹脂封止型半導体装置
11によれば、半導体チップ13がリードフレーム12
の板厚即ち端子部15の板厚D1 内に埋め込まれ、半導
体装置11全体の厚さがリードフレーム12の板厚に規
定された構成であるので、超薄型で且つ小型の樹脂封止
型半導体装置が得られる。また、端子部15から一体に
導出された端子部15よりも薄い接続リード部16と、
半導体チップ13とを接続するようになすので、薄型の
樹脂封止型半導体装置が得られる。
【0033】この樹脂封止型半導体装置11では、端子
部15の上面15a、下面15b及び側面15cが樹脂
封止面より露出しているので、図7及び図8に示すよう
に、絶縁基板27の面に配線パターン28が形成された
回路基板29に対して、半導体装置11を表裏両方向に
自由に実装することができる。半田付けに際しては、端
子部15の側面15cが露出していることにより、半田
30が側面15cに盛り上がり、半田付け性が向上す
る。
【0034】また、半導体チップ13の裏面13aが外
部に露出した構成となっているので、例えば図7に示す
ように、半導体チップ13の露出した裏面13aが上向
きとなるように実装するときは、半導体チップ13の放
熱特性が上がる。尚、図8に示すように、半導体チップ
13の露出した裏面13aを下向きに実装したときに
も、例えば回路基板29に半導体装置11に対向する開
口31を設けるようになせば、半導体チップ13の放熱
特性が上がる。
【0035】更に、図9に示すように、半導体チップ1
3の露出している裏面13aにヒートシング32を付す
ことができるので、更に放熱特性を良好にすることがで
きる。
【0036】更に、本実施例では、図10に示すよう
に、複数の半導体装置11を積層して互いの端子部15
を直接半田付けし、回路基板29に実装することが可能
となる。この実装法は例えば半導体メモリ等に適用され
る。
【0037】図11は参考例を示す。この樹脂封止型半
導体装置34は、半導体チップ13を端子部15の板厚
内にあって封止樹脂14内に完全に埋置されるように配
して構成される。本参考例においても、上例と同様に超
薄型且つ小型の樹脂封止型半導体装置が得られ、回路基
板29に対しても、表裏両方向に自由に実装可能であ
り、また複数の半導体装置34を積層して実装すること
も可能である。
【0038】
【発明の効果】本発明の樹脂封止型半導体装置によれ
ば、超薄型且つ小型にして、表裏両面が平坦で半導体チ
ップの放熱特性が良好な樹脂封止型半導体装置が得られ
る。そして、取り扱い易く、回路基板に対して半導体装
置を表裏の向きを自由に選択して実装することができ
る。更に、半導体装置を簡単に積層することができ、実
装の自由度を上げることができる。本発明の製造方法に
よれば、上述の樹脂封止型半導体装置を容易且つ高精度
に製造することができる。
【図面の簡単な説明】
【図1】本発明による樹脂封止型半導体装置の一例を示
す断面図である。
【図2】図1の樹脂封止型半導体装置の斜視図である。
【図3】A 本発明による樹脂封止型半導体装置の製法
例を示す製造工程図である。B 本発明による樹脂封止
型半導体装置の製法例を示す製造工程図である。C 本
発明による樹脂封止型半導体装置の製法例を示す製造工
程図である。
【図4】D 本発明による樹脂封止型半導体装置の製法
例を示す製造工程図である。E 本発明による樹脂封止
型半導体装置の製法例を示す製造工程図である。F 本
発明による樹脂封止型半導体装置の製法例を示す製造工
程図である。G 本発明による樹脂封止型半導体装置の
製法例を示す製造工程図である。
【図5】H 本発明による樹脂封止型半導体装置の製法
例を示す製造工程図である。I 本発明による樹脂封止
型半導体装置の製法例を示す製造工程図である。J 本
発明による樹脂封止型半導体装置の製法例を示す製造工
程図である。
【図6】本発明の製造に係る要部の斜視図である。
【図7】本発明に係る樹脂封止型半導体装置の回路基板
への実装例を示す断面図である。
【図8】本発明に係る樹脂封止型半導体装置の回路基板
への他の実装例を示す断面図である。
【図9】本発明に係る樹脂封止型半導体装置の回路基板
への他の実装例を示す断面図である。
【図10】本発明に係る樹脂封止型半導体装置の回路基
板への他の実装例を示す断面図である。
【図11】樹脂封止型半導体装置の参考例を示す断面図
である。
【図12】従来の樹脂封止型半導体装置の断面図であ
る。
【符号の説明】
1,13 半導体チップ 2,12 リードフレーム 3,15A アウターリード 4,16 インナーリード 5,14 封止樹脂 6,20 クラッド材 7,17 バンプ 8,18 電極パッド 9,19 半田メッキ層 10,11 樹脂封止型半導体装置 22,23,24 フォトレジスト層
───────────────────────────────────────────────────── フロントページの続き (56)参考文献 特開 平2−32547(JP,A) 特開 平3−123042(JP,A) (58)調査した分野(Int.Cl.7,DB名) H01L 23/28

Claims (2)

    (57)【特許請求の範囲】
  1. 【請求項1】 インナーリードと該インナーリードに接
    続された端子部とを有するリードフレームの板厚内に、
    表面において前記インナーリードに接続された半導体チ
    ップが配置され、前記半導体チップ及び前記インナーリードが埋め込まれ
    るように樹脂封止され、 一方の樹脂封止面と前記リードフレームの上面とが同一
    平面となるように形成され、他方の樹脂封止面と前記リ
    ードフレームの下面と前記半導体チップの裏面とが同一
    平面となるように形成され、 前記端子部の上面、下面及び側面が露出されて成る こと
    を特徴とする樹脂封止型半導体装置。
  2. 【請求項2】 インナーリードと該インナーリードに接
    続された端子部とを有するリードフレームの板厚内に半
    導体チップを配置し、該半導体チップの表面を前記イン
    ナーリードに接続する工程と、 前記リードフレームの上面と樹脂封止面とが同一平面と
    なるように前記インナーリードと前記半導体チップとを
    樹脂により封止する工程と、 前記半導体チップの裏面と前記リードフレームの下面
    が同一平面となるように前記半導体チップと前記樹脂と
    を研削する工程と、 前記リードフレームを前記端子部を残して切断する工程
    とを有することを特徴とする樹脂封止型半導体装置の製
    造方法。
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Families Citing this family (36)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2708191B2 (ja) 1988-09-20 1998-02-04 株式会社日立製作所 半導体装置
KR0158868B1 (ko) * 1988-09-20 1998-12-01 미다 가쓰시게 반도체장치
JPH08279591A (ja) * 1995-04-07 1996-10-22 Nec Corp 半導体装置とその製造方法
KR0179921B1 (ko) * 1996-05-17 1999-03-20 문정환 적측형 반도체 패키지
JP2933554B2 (ja) * 1996-11-28 1999-08-16 九州日本電気株式会社 半導体装置およびその製造方法
KR100240748B1 (ko) * 1996-12-30 2000-01-15 윤종용 기판을 갖는 반도체 칩 패키지와 그 제조 방법 및 그를 이용한적층 패키지
US6087712A (en) * 1997-12-26 2000-07-11 Samsung Aerospace Industries, Ltd. Lead frame containing leads plated with tin alloy for increased wettability and method for plating the leads
US6451624B1 (en) 1998-06-05 2002-09-17 Micron Technology, Inc. Stackable semiconductor package having conductive layer and insulating layers and method of fabrication
US6020629A (en) * 1998-06-05 2000-02-01 Micron Technology, Inc. Stacked semiconductor package and method of fabrication
KR20000072840A (ko) * 1999-01-23 2000-12-05 차준민 셋팅 퍼머 방법 및 장치
US6636334B2 (en) * 1999-03-26 2003-10-21 Oki Electric Industry Co., Ltd. Semiconductor device having high-density packaging thereof
JP3576030B2 (ja) * 1999-03-26 2004-10-13 沖電気工業株式会社 半導体装置及びその製造方法
US6982478B2 (en) * 1999-03-26 2006-01-03 Oki Electric Industry Co., Ltd. Semiconductor device and method of fabricating the same
USRE40112E1 (en) 1999-05-20 2008-02-26 Amkor Technology, Inc. Semiconductor package and method for fabricating the same
JP3398721B2 (ja) * 1999-05-20 2003-04-21 アムコー テクノロジー コリア インコーポレーティド 半導体パッケージ及びその製造方法
US6720642B1 (en) * 1999-12-16 2004-04-13 Fairchild Semiconductor Corporation Flip chip in leaded molded package and method of manufacture thereof
US7273769B1 (en) * 2000-08-16 2007-09-25 Micron Technology, Inc. Method and apparatus for removing encapsulating material from a packaged microelectronic device
JP2002093831A (ja) * 2000-09-14 2002-03-29 Shinko Electric Ind Co Ltd 半導体装置およびその製造方法
US6627980B2 (en) * 2001-04-12 2003-09-30 Formfactor, Inc. Stacked semiconductor device assembly with microelectronic spring contacts
JP2003060117A (ja) * 2001-08-10 2003-02-28 Texas Instr Japan Ltd 半導体装置の製造方法
US6611052B2 (en) 2001-11-16 2003-08-26 Micron Technology, Inc. Wafer level stackable semiconductor package
US7009296B1 (en) 2004-01-15 2006-03-07 Amkor Technology, Inc. Semiconductor package with substrate coupled to a peripheral side surface of a semiconductor die
US6972372B1 (en) * 2004-05-28 2005-12-06 Macronix International Co., Ltd. Method and apparatus for stacking electrical components using outer lead portions and exposed inner lead portions to provide interconnection
WO2006088270A1 (en) * 2005-02-15 2006-08-24 Unisemicon Co., Ltd. Stacked package and method of fabricating the same
US8057857B2 (en) * 2005-07-06 2011-11-15 Northwestern University Phase separation in patterned structures
US9466545B1 (en) 2007-02-21 2016-10-11 Amkor Technology, Inc. Semiconductor package in package
US7893545B2 (en) * 2007-07-18 2011-02-22 Infineon Technologies Ag Semiconductor device
US8227908B2 (en) * 2008-07-07 2012-07-24 Infineon Technologies Ag Electronic device having contact elements with a specified cross section and manufacturing thereof
JP2010034350A (ja) * 2008-07-30 2010-02-12 Sanyo Electric Co Ltd 半導体装置
JP6030970B2 (ja) * 2013-02-12 2016-11-24 エスアイアイ・セミコンダクタ株式会社 樹脂封止型半導体装置およびその製造方法
KR101706825B1 (ko) * 2014-11-13 2017-02-27 앰코 테크놀로지 코리아 주식회사 반도체 패키지
JP6338547B2 (ja) * 2015-03-31 2018-06-06 オリンパス株式会社 成形回路部品、成形回路部品の製造方法および回路モジュール
JP6851239B2 (ja) 2017-03-29 2021-03-31 エイブリック株式会社 樹脂封止型半導体装置およびその製造方法
JP2019153658A (ja) * 2018-03-02 2019-09-12 富士通株式会社 基板モジュール及び基板モジュールの製造方法
JP7239342B2 (ja) * 2019-02-12 2023-03-14 新光電気工業株式会社 電子装置及び電子装置の製造方法
JP7382170B2 (ja) * 2019-08-02 2023-11-16 ローム株式会社 半導体装置

Family Cites Families (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS61101067A (ja) * 1984-10-24 1986-05-19 Nec Corp メモリモジユ−ル
WO1990000813A1 (en) * 1988-07-08 1990-01-25 Oki Electric Industry Co., Ltd. Semiconductor device
JP2856455B2 (ja) * 1989-10-05 1999-02-10 株式会社東芝 半導体装置
JPH0496357A (ja) * 1990-08-13 1992-03-27 Matsushita Electron Corp 半導体装置およびその実装方法
JP2934357B2 (ja) * 1992-10-20 1999-08-16 富士通株式会社 半導体装置

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