JP2000286374A - 半導体集積回路装置 - Google Patents

半導体集積回路装置

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JP2000286374A
JP2000286374A JP2000073486A JP2000073486A JP2000286374A JP 2000286374 A JP2000286374 A JP 2000286374A JP 2000073486 A JP2000073486 A JP 2000073486A JP 2000073486 A JP2000073486 A JP 2000073486A JP 2000286374 A JP2000286374 A JP 2000286374A
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JP
Japan
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semiconductor chip
lead
semiconductor
integrated circuit
circuit device
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JP2000073486A
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English (en)
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Yujiro Kajiwara
祐二郎 梶原
Kazunari Suzuki
一成 鈴木
Kunihiro Tsubosaki
邦宏 坪崎
Hiromichi Suzuki
博通 鈴木
Yoshinori Miyaki
美典 宮木
Takahiro Naito
孝洋 内藤
Sueo Kawai
末男 河合
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Hitachi Ltd
Hitachi Solutions Technology Ltd
Original Assignee
Hitachi Ltd
Hitachi ULSI Systems Co Ltd
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Abstract

(57)【要約】 【課題】 ＬＳＩパッケージのリフロー・クラック耐性
を向上させる。 【解決手段】 半導体チップ２を搭載するためのチップ
搭載部３と、前記チップ搭載部３に搭載され、主面に複
数のボンディングパッドを有する半導体チップ２と、前
記半導体チップ２を取り囲むように配置されたインナー
リード部、およびこのインナーリード部に繋がり前記イ
ンナーリード部から外方に向かって延在するアウターリ
ード部からなる複数のリードとを備え、前記チップ搭載
部３は、交差する吊りリード４によって構成されてい
る。

Description

【発明の詳細な説明】
【０００１】
【発明の属する技術分野】本発明は、半導体チップを搭
載するリードフレームを用いた半導体集積回路装置に関
し、特に、リードフレームの標準化およびＬＳＩパッケ
ージのリフロー・クラック耐性の向上に適用して有効な
技術に関するものである。
【０００２】
【従来の技術】ＱＦＰ(Quad Flat Package) などの表面
実装型樹脂封止装置（Surface MountDevice) であるＬ
ＳＩパッケージは、リフロー半田工程におけるパッケー
ジ・クラックの発生をいかに抑えるかが重要な課題とな
っている。
【０００３】すなわち、ＬＳＩパッケージが吸湿した場
合、ＬＳＩパッケージ全体を加熱するリフロー半田工程
での高温に起因する内部応力によって樹脂とダイパッド
との界面などに剥離が生じる。パッケージ・クラックと
は、この剥離がダイパッド界面に結露していた水分の膨
張、すなわち水蒸気圧によって拡大して樹脂が割れる現
象である。これにより、耐湿性の劣化、樹脂のふくれに
よる半田付け不良が生じていた。また、このパッケージ
・クラックが半導体チップの上面で発生すると、ワイヤ
の切断などの深刻な不良を引き起こすことになる。
【０００４】従来、樹脂とダイパッドの界面の剥離を防
ぐ対策としては、ダイパッドの一部に貫通孔を設け、こ
の貫通孔を通じて半導体チップの裏面を樹脂と密着させ
る方法（特開平２−８３９６１号公報）や、ダイパッド
の裏面にディンプル加工を施すことによって、樹脂とダ
イパッドの接着力を向上させる方法などが知られてい
る。
【０００５】他方、ピン数が同じでチップサイズが違う
製品、例えば一品種あたりの製品数量が少ないＡＳＩＣ
(Application Specific Integrated Circuit) 製品にお
いても、高密度実装が可能な製品が要求されており、前
述したＱＦＰなどの表面実装型ＬＳＩパッケージに半導
体チップを搭載する傾向にある。そこで従来は、チップ
サイズに対応したリードフレームを作成して製品を製造
していたため、その製造コストの上昇を招いていた。
【０００６】そのため、生産数量が少ない各種チップサ
イズのＡＳＩＣに対応することのできるリードフレーム
として、「日経マイクロデバイセズ、１９８７年１２月
号」Ｐ７６〜Ｐ７８には、ポリイミド樹脂系のテープを
ダイパッドとしてインナーリードに取付け、このテープ
上に半導体チップを搭載するリードフレームが開示され
ている。
【０００７】
【発明が解決しようとする課題】しかしながら、近年の
ＬＳＩパッケージは、樹脂体中に占める半導体チップの
面積割合が増加している。さらに樹脂の肉厚が従来より
も極めて薄くなっているため、前述した対策、すなわ
ち、ダイパッドに貫通孔やディンプルを形成するといっ
た方法ではパッケージ・クラックの発生を有効に防止す
ることが困難になりつつある。
【０００８】また、チップサイズに対応したリードフレ
ームを作らずに、従来のリードフレーム、すなわちダイ
パッドの外形寸法（チップ搭載面の面積）が半導体チッ
プの外形寸法（チップ主面あるいは裏面の面積）よりも
大きいリードフレームを用いることを検討したが、ダイ
パッドに搭載する半導体チップの大きさがかなり制限さ
れることが分かった。
【０００９】すなわち、ダイパッドの外形寸法よりも１
〜２mm以上小さい半導体チップを搭載すると、ワイヤが
垂れてダイパッド端に接触し、ワイヤボンディング不良
を起こすので、比較的小さい半導体チップは使用できな
い。また、インナーリードの先端の位置がダイパッドに
よって制限され、かつワイヤの長さにも制限（ワイヤ長
は、ワイヤボンダの性能や電気的特性などにより決定さ
れ、1.０mm〜5.０mm位が適当とされている）があるた
め、比較的小さいチップを用いることはできない。他
方、ダイパッド上には、その外形寸法までの大きさの半
導体チップしか搭載できないため、大きい方のチップサ
イズも制限が生じる。
【００１０】また、前述したダイパッドとしてポリイミ
ド樹脂系のテープをインナーリードに取付けたものは、
半導体チップの大きさに制限はなくなるが、テープの熱
膨張係数がリードフレームや半導体チップのそれと異な
るため、半田リフロー工程において互いの熱膨張係数の
違いからそれらの界面に剥離が生じ、パッケージ・クラ
ックが発生する。従って、界面剥離やパッケージ・クラ
ックの発生を防ぎ、しかも各種サイズの半導体チップを
搭載することのできるＬＳＩパッケージが必要である。
【００１１】本発明の一つの目的は、ＬＳＩパッケージ
のリフロー・クラック耐性を向上させることのできる技
術を提供することにある。
【００１２】本発明の他の目的は、ＬＳＩの少量多品種
化に対応したリードフレームを用いた半導体集積回路装
置を提供することにある。
【００１３】本発明の前記ならびにその他の目的と新規
な特徴は、本明細書の記述および添付図面から明らかに
なるであろう。
【００１４】
【課題を解決するための手段】本願において開示される
発明のうち、代表的なものの概要を説明すれば、下記の
とおりである。
【００１５】(1).本発明の半導体集積回路装置は、所定
の大きさを有する半導体チップを搭載するためのチップ
搭載部と、前記チップ搭載部に搭載され、主面に複数の
ボンディングパッドを有する半導体チップと、前記半導
体チップを取り囲むように配置されたインナーリード
部、およびこのインナーリード部に繋がり前記インナー
リード部から外方に向かって延在するアウターリード部
からなる複数のリードと、前記半導体チップの複数のボ
ンディングパッドと前記インナーリード部とを接続する
ボンディングワイヤと、前記半導体チップ、前記インナ
ーリード部、および前記ボンディングワイヤを封止する
封止樹脂とからなり、さらに、前記チップ搭載部は、交
差する吊りリードによって構成されているものである。
【００１６】(2).本発明の他の半導体集積回路装置は、
半導体チップ搭載領域を規定するように配置された複数
のインナーリードと、この複数のインナーリードに連続
する複数のアウターリードと、前記半導体チップ搭載領
域を横切る複数の吊りリードと、前記半導体チップ搭載
領域の前記吊りリードに接続される半導体チップと、前
記インナーリードと前記半導体チップとを電気的に接続
する手段と、前記半導体チップ、および前記インナーリ
ードを封止するパッケージ本体とからなるものである。
【００１７】上記した手段によれば、チップ搭載部の外
形寸法をその上に搭載する半導体チップのそれよりも小
さくし、またチップ搭載部の上に搭載する半導体チップ
の外形寸法に応じてリードの先端を所定の長さに切断可
能としたことにより、外形寸法がかなり広い範囲で異な
る各種の半導体チップで共用することができるため、Ｌ
ＳＩパッケージの少量多品種化に対応した半導体集積回
路装置を提供することができる。
【００１８】さらに詳しく説明すると、従来のリードフ
レーム、すなわちチップ搭載部の外形寸法がその上に搭
載する半導体チップの外形寸法よりも大きいリードフレ
ームを用いる場合、前述したようにかなり狭い範囲（チ
ップ搭載部の外縁からチップ端までが１〜２mm）のサイ
ズの半導体チップしか共用できないので、インナーリー
ド先端をカットする必要がない。
【００１９】これに対し、本発明の半導体集積回路装置
に用いられるリードフレームは、チップ搭載部の外形寸
法がその上に搭載される半導体チップのそれよりも小さ
いため、広い範囲（本願で説明するリードフレームでは
５mm〜15mm×５mm〜15mmの半導体チップ）のサイズの半
導体チップに共用できるので、ワイヤ長の制限に合わせ
てインナーリード先端位置を変更する必要がある場合に
も十分対応できる。
【００２０】さらに、ＬＳＩパッケージの少量多品種化
に対応したリードフレームを用いた半導体集積回路装置
を提供できると共に、チップ搭載部の外形寸法がその上
に搭載される半導体チップのそれよりも小さいので、チ
ップ搭載部の上に搭載された半導体チップの裏面が封止
樹脂と接着する。そして、半導体チップ（シリコン）と
樹脂との界面の接着力は、チップ搭載部（金属）と樹脂
との界面の接着力よりも大きいため、チップ搭載部と樹
脂との界面に水分が浸入するのを防止することができ、
ＬＳＩパッケージを半田リフローによって基板に実装す
る際のパッケージ・クラックを抑制することができる。
【００２１】
【発明の実施の形態】図１は、本発明の一実施の形態で
あるＱＦＰの製造に用いるリードフレームの平面図であ
る。
【００２２】リードフレーム１の中央部には、主面に集
積回路およびボンディングパッドが形成された半導体チ
ップ２を搭載するための円形のダイパッド（チップ搭載
部）３が形成されている。このダイパッド３は、四本の
吊りリード４によって支持されている。ダイパッド３の
チップ搭載面の面積は、その上に搭載される半導体チッ
プ２の主面の面積よりも小さく設定されているのが特徴
である。
【００２３】ダイパッド３の周囲には、複数本のリード
５がダイパッド３を囲むように配置されている。吊りリ
ード４の幅広部およびリード５の中途部には、絶縁性の
薄い合成樹脂フィルムからなるテープ６が枠状に形成さ
れて接着されている。このテープ６の外側には、リード
５の支持とモールド時における樹脂の溢出防止とを兼ね
たダムバー７が枠状に各リード５間を連結するように形
成されている。
【００２４】リードフレーム１の最外周部は、単位フレ
ームを複数連結している外枠８および各単位フレーム間
を分離するように形成されている内枠９からなり、外枠
８の一部には、リードフレーム１をモールド金型に位置
決めする際のガイドとなるガイド孔１０が設けられてい
る。
【００２５】リードフレーム１を構成する上記ダイパッ
ド３、吊りリード４、リード５、ダムバー７、外枠８お
よび内枠９は、４２アロイや銅などの導電材料からな
る。リード５の一部を構成し、後に樹脂で封止されるイ
ンナーリード部５ａの先端には、Ａｇのメッキが施され
ている。図示はしないが、リードフレーム１は、これら
の各部により構成される単位フレームを一方向に複数個
連設した構成になっている。
【００２６】次に、上記リードフレーム１の製造方法の
一例を図２〜図１０を用いて説明する。
【００２７】まず、図２に示すように、フープ材をプレ
ス加工して、ダイパッド３、吊りリード４、リード５
（インナーリード部５ａおよびアウターリード部５ｂか
らなる）、ダムバー７、外枠８、内枠９およびガイド孔
１０を一体形成する。一例として、フープ材は板厚0.１
５mm程度の４２アロイからなる。また、ダイパッド３の
直径は３mm程度、吊りリード４の幅は0.３mm程度であ
る。インナーリード部５ａ間のピッチは、加工限界を考
慮して、例えば１３２ピンのリードフレームでは約0.２
２mm、１６８ピンでは0.２５mmである。更にダイパッド
３の中心からインナーリード５ａの先端までの距離は、
最大、１３２ピンで約５mm、１６８ピンで約6.２mmであ
る。
【００２８】上記の各部をプレスで形成する場合は、図
３に示すように、切断箇所の裏面側にバリ１１ができ
る。本実施の形態のリードフレーム１は、ダイパッド３
の面積がその上に搭載される半導体チップ２の面積より
小さいので、ダイパッド３のチップ搭載面にバリ１１が
できると半導体チップ２を接着することができなくな
る。従って、ダイパッド３をプレス加工する時は、チッ
プ搭載面を上に向けて上から打ち抜き、バリ１１がチッ
プ搭載面の裏面側にできるようにする。
【００２９】一方、インナーリード部５ａの先端は、ワ
イヤボンディングの際にバリ１１が下側にあると、ワイ
ヤがボンディングされにくく、ボンディング不良が生じ
ることがある。従って、インナーリード部５ａをプレス
加工する時は、ボンディング面を下に向けて上から打ち
抜き、バリがワイヤボンディング面側にできるようにす
る。
【００３０】次に、図４に示すように、インナーリード
部５ａのワイヤボンディング領域３２にＡｇメッキを施
す。後述するように、本実施の形態のリードフレーム１
は、ダイパッド３上に搭載する半導体チップ２の外形寸
法に応じてリード５の先端を所定の長さに切断して使用
するため、従来のリードフレームに比べてＡｇメッキを
施す領域の面積を大きくしてある。例えば従来の場合
は、ワイヤボンディング誤差、メッキ層形成時の誤差を
考慮して、インナーリード部５ａの先端からの距離が１
mm程度の範囲であればよかったが、本発明では、１mm以
上、第１カット、第２カットを考慮すると1.５〜２mm以
上必要である。
【００３１】次に、リードフレーム１のダウンセット加
工を行う。ダウンセット加工は、図５(a),(b) に示すよ
うに、プレス型１２を使って吊りリード４の中途部（同
図(b) の符号Ｓで示す部分）を下方に折り曲げることに
より、水平方向から見たダイパッド３の高さをリード５
の高さよりも低くする作業である。すなわち、ダイパッ
ド３のチップ搭載面側とインナーリード部５ａのワイヤ
ボンディング面を第１の面、この第１の面に対向する面
を第２の面とすると、ダイパッド３の第１の面が、イン
ナーリード部５ａの第１の面よりも第２の面側に位置す
るように加工する。
【００３２】図６は、ダウンセット加工を施したリード
フレーム１の平面図である。一例として、ダイパッド３
の中心から各吊りリード４のダウンセット位置（Ｓ）ま
での距離は、8.５〜9.０mm程度であり、ダウンセット量
（ダイパッド３の主面からリード５の主面までの高さ）
は、0.２mm程度である。
【００３３】上記のダウンセット加工を施すことによ
り、半導体チップ２を搭載したリードフレーム１をモー
ルド金型に装着してパッケージを成形する際に、半導体
チップ２の上面側とダイパッド３の下面側とで樹脂の肉
厚をほぼ等しくすることができる。
【００３４】次に、ダイパッド３を支持する吊りリード
４の中途部（吊りリード４の幅広になっている部分）お
よびインナーリード部５ａにテープ６を接着する。テー
プ６の接着は、図７に示すように、ヒートステージ１３
上に載置したリードフレーム１の上にテープ６を位置決
めし、上方からツール１４を圧着して行う。一例とし
て、テープ６は外形寸法１8.５mm×１8.５mm程度、幅1.
５mm程度、厚さ0.０５mm程度のポリイミド樹脂からなる
フィルム６ａの片面にアクリル樹脂系の接着剤６ｂを厚
さ0.０２mm程度塗布した構成になっている。
【００３５】図８は、テープ６を接着したリードフレー
ム１の平面図、図９は図８のIX−IX線における断面図、
図１０は図８のＸ−Ｘ線における断面図である。
【００３６】テープ６の接着面積を確保するため、図８
に示すように、吊りリード４の中途部は、他の部分より
幅を広くしてある（吊りリード４の幅広部）。すなわ
ち、この幅広部にテープ６、すなわち絶縁性のフィルム
を接着してダイパッド３を固定することにより、半導体
チップ２を搭載したリードフレーム１をモールド金型に
装着してパッケージを成形する際、溶融樹脂の流動によ
るダイパッド３の変動を防止することができるので、半
導体チップ２の上面側とダイパッド３の下面側とで溶融
樹脂の流速がほぼ等しくなり、貫通ボイドなどの成形不
良の発生を防止することができる。
【００３７】このようにして得られる本実施の形態のリ
ードフレーム１は、ダイパッド３のチップ搭載面の面積
がその上に搭載される半導体チップ２の主面あるいはこ
の主面に対向する裏面の面積よりも小さいので、外形寸
法の異なる各種の半導体チップを搭載することが可能で
ある。また、リード５の先端を切断してリード５を短く
することにより、さらに大面積の半導体チップ２を搭載
することも可能である。
【００３８】図１１(a) は、大面積、すなわち前記図１
中に二点鎖線で示されている半導体チップ２よりも大面
積の半導体チップを搭載するために、リード５の先端を
切断したリードフレーム１ａの平面図であり、図１１
(b) はそのXI−XI線における断面図である。なお、図１
１(a) 中の破線は、切断前のリード５の先端位置を示し
ている。図１２は、リード５の先端をさらに切断したリ
ードフレーム１ｂの平面図であり、このようにすると、
さらに大面積の半導体チップを搭載することができる。
【００３９】このようにして、例えばダイパッド３の直
径が３mm程度である場合は、外形寸法が５mm×５mm程度
から１５mm×１５mm程度の範囲までの各種半導体チップ
を搭載することができる。リード５の切断はプレスによ
り行うが、ワイヤボンディング領域３２に施したＡｇメ
ッキの剥離を防止するため、ワイヤボンディング領域３
２を下に向けて行う。従って、図１１(b) に示すよう
に、インナーリード部５ａの先端は、上側を向くように
成形される。
【００４０】次に、上記リードフレーム１を用いたＱＦ
Ｐの製造方法の一例を図１３〜図３０を用いて説明す
る。
【００４１】まず、図１３に示すように、リードフレー
ム１のダイパッド３上に半導体チップ２を接着するため
の接着剤１５を塗布する。なお、同図にはリード５の先
端を切断していないリードフレーム１を示してあるが、
半導体チップ２よりも大面積の半導体チップを搭載する
場合は、ダイパッド３上に接着剤１５を塗布する工程に
先立って、あらかじめリード５の先端を所定の長さに切
断しておく。すなわち、前記図１１のリードフレーム１
ａあるいは前記図１２のリードフレーム１ｂを形成して
おく。リード先端のカット（切断）は、チップが搭載さ
れる場合に、そのチップ外周部とインナーリード５ａの
先端が接続しない距離以上（例えば0.５mm以上）離れる
位置を考慮して行う。
【００４２】接着剤１５の塗布は、図１４に示すよう
に、ステージ１６上に載置したリードフレーム１のダイ
パッド３上にディスペンサ１７を使って接着剤１５を滴
下することにより行う。接着剤１５は、一例として熱硬
化性のエポキシ樹脂にＡｇ粉末を混入させたものからな
る。なお、図中の符号１８はノズル、１９はシリンジで
ある。ダイパッド３の大きさは、接着剤１５が塗布され
る分だけあればよい。
【００４３】上記リードフレーム１は、ダイパッド３の
面積が小さいので、接着剤１５をダイパッド３の主面の
一点に塗布するだけでよい。そのため、ダイパッドの面
積が大きい従来のリードフレームに比べると、使用する
ノズル１８の構造が簡単で済み、かつ接着剤１５の塗布
も短時間で済み、その塗布量も低減できるという利点が
ある。
【００４４】さらに、図１５に示すように、ダイパッド
３の周囲に吊りリード４よりも幾分幅の広い小パッド
（あるいは接着剤塗布部ともいう）２０を形成し、ダイ
パッド３およびこの小パッド２０のそれぞれの主面上に
接着剤１５を塗布するようにしてもよい。このようにす
ると、充分な接着強度が得られるので、ダイパッド３上
で半導体チップ２が回転ずれを起こしたりする不具合を
防止することができる。また、小パッド２０（接着剤塗
布部）を形成したことにより、実質的に吊りリード４の
剛性が増すので、半導体チップ２を搭載したリードフレ
ーム１をモールド金型に装着してパッケージを成形する
際、溶融樹脂の流動によるダイパッド３の変動を防止す
ることができる。
【００４５】上記小パッド２０は、図１６に示すよう
に、それぞれの吊りリード４の途中、例えばダイパッド
３と中途部Ｓとの間に形成してもよい。この場合も前記
同様の効果を得ることができる。
【００４６】次に、図１７に示すように、接着剤１５を
塗布したダイパッド３上にコレット２１を使って半導体
チップ２を位置決めする。一例として、半導体チップ２
は外形寸法5.３４mm×5.３４mm程度、厚さ0.４mm程度の
シリコン単結晶からなる。
【００４７】図１８は、ダイパッド３を支持する吊りリ
ード４の一部にＶ溝２２を形成したリードフレーム１の
平面図である。このＶ溝２２は、ダイパッド３上に半導
体チップ２を正確に位置決めするための目盛りとして利
用されるもので、図１９にその断面を拡大して示すよう
に、各吊りリード４の主面上に一定の間隔をおいて複数
形成される。
【００４８】そして、ダイパッド３上に半導体チップ２
を位置決めする際は、図２０(a) 〜(c) に示すように、
リードフレーム１の上方からカメラ（図示せず）などを
使ってＶ溝２２の位置を検出し、その情報に基づいて、
各種外形寸法の半導体チップ２を正確な位置に移動させ
る。
【００４９】また、図２１に示すように、各吊りリード
４の途中、すなわちダイパッド３と中途部Ｓとの間に複
数の突起２３を一定の間隔で形成し、これをダイパッド
３上に半導体チップ２を位置決めするための目盛りとし
て利用してもよい。これらのＶ溝２２や突起２３は、ダ
イパッド３上に半導体チップ２を位置決めした後の外観
検査工程で利用することもできる。
【００５０】次に、図２２に示すように、ダイパッド３
上に半導体チップ２を位置決めしたリードフレーム１を
ヒートステージ２４上で加熱して接着剤１５を硬化させ
る。一例として、加熱条件は２００〜２５０℃、３０秒
〜１分程度である。なお、接着剤１５の硬化は、オーブ
ンを使って行うこともできる。図２３は、ダイパッド３
上に半導体チップ２を搭載する工程が完了したリードフ
レーム１の平面図である。
【００５１】次に、図２４〜図２６に示すように、ダイ
パッド３上に搭載された半導体チップ２のボンディング
パッド２５とリード５との間をＡｕのワイヤ２６でボン
ディングし、電気的に接続する。図２５は、インナーリ
ード部５ａと半導体チップ２との接続関係を示す断面
図、図２６は、吊りリード４と半導体チップ２との関係
を示す断面図である。
【００５２】図２４に示すように、本実施の形態のリー
ドフレーム１は、半導体チップ２の各辺に沿ってリード
５の先端をＶ字状に配列してある（半導体チップ２のコ
ーナー部近傍の、すなわち吊りリード４に近い方のリー
ド５を長く、各辺中央部近傍の、すなわち吊りリード４
から遠くに位置するリード５を短くしてある）。これに
より、ワイヤ２６の長さが全てのボンディングパッド２
５とリード５との間でほぼ等しくなるので、ワイヤの長
さを変更する必要がなく、ワイヤボンディング作業が容
易になる。
【００５３】図２７は、本実施の形態で使用するワイヤ
ボンディング装置のヒートステージ２７の主面を示す平
面図である。このヒートステージ２７の主面には、リー
ドフレーム１のダイパッド３と吊りリード４の一部（前
記ダウンセット位置（Ｓ）よりも内側の部分）とが嵌め
込まれる逃げ溝２８が形成されている。
【００５４】ヒートステージ２７の主面に上記のような
逃げ溝２８を形成したことにより、図２８に示すよう
に、ダイパッド３上に大面積の半導体チップ２ｂを搭載
したリードフレーム１（同図(a))でも、小面積の半導体
チップ２を搭載したリードフレーム１（同図(b))でも、
ワイヤボンディングが可能となるので、半導体チップ２
の外形寸法が変わる毎にヒートステージ２７を交換する
手間が不要となる。なお、２８図(a) 中の符号ｔ1 はリ
ードフレーム１の板厚（本実施の形態では0.１５mm程
度）を示し、ｔ2 はダイパッド３のダウンセット量（本
実施の形態では0.２mm程度）を示している。図２８から
も明らかなように、逃げ溝２８の深さはｔ1＋ｔ2 より
も大きいので、ダウンセット（タブ下げ）加工のばらつ
きが吸収され、またリードフレーム１のダイパッド３と
吊りリード４の一部を逃げ溝２８に嵌め込ませた場合、
ワイヤボンディングされるリードやチップの部分は図示
のようにヒートステージ２７に密着し、熱伝導が良くな
ることにより、ボンディング性能が向上する。ワイヤの
長さは、ボンディングパッドからインナーリード部５ａ
のボンディング点までの直線距離で1.０〜5.０mm位であ
る。
【００５５】次に、上記リードフレーム１をモールド金
型に装着し、図２９に示すように、半導体チップ２、ダ
イパッド４、インナーリード部５ａおよびワイヤ２６を
エポキシ樹脂などでモールドすることによりパッケージ
本体２９を成形した後、リードフレーム１の不要箇所、
すなわちパッケージ本体２９の外部に露出したダムバー
７、外枠８および内枠９などをプレスで切断除去し、最
後にパッケージ本体２９の外部に露出したリード５を所
定の形状に成形することにより、ＱＦＰ形の表面実装型
半導体装置３０が完成する。その後、図３０に示すよう
に、この表面実装型半導体装置３０をリフロー半田付け
法により配線基板３４上に実装する。図中、３３はリー
ド５を載置するランドパッド、３６は半田である。
【００５６】本実施の形態のリードフレーム１を用いて
製造された表面実装型半導体装置（ＱＦＰ）３０は、ダ
イパッド３の面積がその上に搭載された半導体チップ２
の面積よりも小さいため、半導体チップ２の周辺部の裏
面が封止樹脂と密着している。
【００５７】これにより、封止樹脂とダイパッド３との
界面の接着力が増大するので、水分が浸入してもリフロ
ー半田工程の高温に起因する水分膨張による上記界面の
剥離を抑制することができ、リフロー・クラック耐性の
向上した表面実装型半導体装置（ＱＦＰ）３０を提供す
ることができる。
【００５８】また、本実施の形態のリードフレーム１
は、外形寸法の異なる各種の半導体チップ２を搭載する
ことができるので、外形寸法の異なる半導体チップ毎に
リードフレームを作成する手間が不要となる。これによ
り、リードフレーム１を標準化することができるので、
その製造コストが低減され、表面実装型半導体装置（Ｑ
ＦＰ）３０を安価に提供することができる。
【００５９】また、本実施の形態のリードフレーム１
は、ダイパッド３の外形寸法を小さくしたことにより、
半導体チップ２をダイパッド３上に搭載する際に用いる
接着剤１５の使用量を少なくすることができるので、こ
の点においても、表面実装型半導体装置（ＱＦＰ）３０
を安価に提供することができる。
【００６０】以上、本発明者によってなされた発明を実
施の形態に基づき具体的に説明したが、本発明は前記実
施の形態に限定されるものではなく、その要旨を逸脱し
ない範囲で種々変更可能であることはいうまでもない。
【００６１】ダイパッドの形状は円形に限らず、チップ
のダイパッドへの接着強度や接着剤の最低塗布領域を確
保していれば、例えば矩形であってもよい。また、図３
１に示すように、半導体チップ２の面積よりも小面積の
ダイパッド３の一部に貫通孔３１を形成し、半導体チッ
プ２と樹脂との接着面積をさらに大きくすることによ
り、リフロー・クラック耐性をさらに向上させることが
できる。
【００６２】また、図３２に示すように、四本の吊りリ
ード４が交差する部分の幅を広く形成し、この部分をダ
イパッド３として利用してもよい。
【００６３】前記実施の形態では、ＱＦＰを製造するた
めのリードフレームに本発明を適用した場合について説
明したが、表面実装型ＬＳＩパッケージの組み立てに用
いるリードフレーム全般に適用することができる。ま
た、ＤＩＰ(Dual In-line Package)のようなピン挿入型
ＬＳＩパッケージの製造に用いるリードフレームに適用
することもできる。
【００６４】
【発明の効果】本願によって開示される発明のうち、代
表的なものによって得られる効果を簡単に説明すれば、
以下の通りである。
【００６５】(1).本発明によれば、リフロー・クラック
耐性の向上したＬＳＩパッケージを提供することができ
る。
【００６６】(2).本発明によれば、ＬＳＩパッケージの
少量多品種化に対応したリードフレームを用いた半導体
集積回路装置を提供することができるので、ＬＳＩパッ
ケージの製造コストを低減することができる。
【図面の簡単な説明】
【図１】本発明の一実施の形態である半導体集積回路装
置に用いられるリードフレームの一例の平面図である。
【図２】本発明のリードフレームのプレス工程を示す平
面図である。
【図３】本発明のリードフレームのプレス工程を示す説
明図である。
【図４】本発明のリードフレームのメッキ工程を示す平
面図である。
【図５】(a),(b) は、本発明のリードフレームのダウン
セット工程を示す説明図である。
【図６】ダウンセット工程が完了したリードフレームの
平面図である。
【図７】本発明のリードフレームのテープ接着工程を示
す説明図である。
【図８】本発明のリードフレームのテープ接着工程を示
す平面図である。
【図９】図８のIX−IX線における断面図である。
【図１０】図８のＸ−Ｘ線における断面図である。
【図１１】(a) はリードフレームのリード切断工程を示
す平面図であり、(b) はそのXI−XI線における断面図で
ある。
【図１２】リードフレームのリード切断工程を示す平面
図である。
【図１３】リードフレームの接着剤塗布工程を示す平面
図である。
【図１４】リードフレームの接着剤塗布工程を示す断面
図である。
【図１５】リードフレームの接着剤塗布工程を示す平面
図である。
【図１６】リードフレームの接着剤塗布工程を示す平面
図である。
【図１７】リードフレームのチップ搭載工程を示す断面
図である。
【図１８】リードフレームのチップ搭載工程を示す平面
図である。
【図１９】リードフレームのチップ搭載工程を示す要部
拡大断面図である。
【図２０】(a) 〜(c) は、リードフレームのチップ搭載
工程を示す要部拡大斜視図である。
【図２１】リードフレームのチップ搭載工程を示す平面
図である。
【図２２】リードフレームのチップ搭載工程を示す断面
図である。
【図２３】リードフレームのチップ搭載工程を示す平面
図である。
【図２４】リードフレームのワイヤボンディング工程を
示す平面図である。
【図２５】リードフレームのワイヤボンディング工程を
示す断面図である。
【図２６】リードフレームのワイヤボンディング工程を
示す断面図である。
【図２７】ワイヤボンディング装置のヒートステージを
示す平面図である。
【図２８】(a),(b) は、ワイヤボンディング装置のヒー
トステージを示す断面図である。
【図２９】本発明のリードフレームを用いたＱＦＰの平
面図である。
【図３０】本発明のリードフレームを用いたＱＦＰの断
面図である。
【図３１】リードフレームの他の実施の形態を示す要部
拡大平面図である。
【図３２】リードフレームの他の実施の形態を示す要部
拡大平面図である。
【符号の説明】
１ リードフレーム １ａ リードフレーム １ｂ リードフレーム ２ 半導体チップ ２ｂ 半導体チップ ３ ダイパッド（チップ搭載部） ４ 吊りリード ５ リード ５ａ インナーリード部 ５ｂ アウターリード部 ６ テープ ６ａ フィルム ６ｂ 接着剤 ７ ダムバー ８ 外枠 ９ 内枠 １０ ガイド孔 １１ バリ １２ プレス型 １３ ヒートステージ １４ ツール １５ 接着剤 １６ ステージ １７ ディスペンサ １８ ノズル １９ シリンジ ２０ 小パッド ２１ コレット ２２ Ｖ溝 ２３ 突起 ２４ ヒートステージ ２５ ボンディングパッド ２６ ワイヤ ２７ ヒートステージ ２８ 逃げ溝 ２９ パッケージ本体 ３０ 表面実装型半導体装置（ＱＦＰ） ３１ 貫通孔 ３２ ワイヤボンディング領域（Ａｇメッキ部） ３３ ランドパッド ３４ 配線基板 ３６ 半田
───────────────────────────────────────────────────── フロントページの続き (72)発明者 鈴木 一成 東京都小平市上水本町５丁目22番１号 株 式会社日立マイコンシステム内 (72)発明者 坪崎 邦宏 東京都小平市上水本町５丁目20番１号 株 式会社日立製作所半導体事業部内 (72)発明者 鈴木 博通 東京都小平市上水本町５丁目20番１号 株 式会社日立製作所半導体事業部内 (72)発明者 宮木 美典 東京都小平市上水本町５丁目20番１号 株 式会社日立製作所半導体事業部内 (72)発明者 内藤 孝洋 東京都小平市上水本町５丁目20番１号 株 式会社日立製作所半導体事業部内 (72)発明者 河合 末男 東京都小平市上水本町５丁目20番１号 株 式会社日立製作所半導体事業部内

Claims (10)

    【特許請求の範囲】
  1. 【請求項１】 所定の大きさを有する半導体チップを搭
    載するためのチップ搭載部と、前記チップ搭載部に搭載
    され、主面に複数のボンディングパッドを有する半導体
    チップと、前記半導体チップを取り囲むように配置され
    たインナーリード部、およびこのインナーリード部に繋
    がり前記インナーリード部から外方に向かって延在する
    アウターリード部からなる複数のリードと、前記半導体
    チップの複数のボンディングパッドと前記インナーリー
    ド部とを接続するボンディングワイヤと、前記半導体チ
    ップ、前記インナーリード部、および前記ボンディング
    ワイヤを封止する封止樹脂とからなり、さらに、前記チ
    ップ搭載部は、交差する吊りリードによって構成されて
    いることを特徴とする半導体集積回路装置。
  2. 【請求項２】 前記吊りリードは複数本からなることを
    特徴とする請求項１に記載の半導体集積回路装置。
  3. 【請求項３】 前記吊りリードは×字形状であることを
    特徴とする請求項１に記載の半導体集積回路装置。
  4. 【請求項４】 前記チップ搭載部の吊りリードの幅は前
    記吊りリードの他の部分よりも幅広となっていることを
    特徴とする請求項１、２または３に記載の半導体集積回
    路装置。
  5. 【請求項５】 前記半導体集積回路装置は表面実装型の
    半導体装置であることを特徴とする請求項１、２、３ま
    たは４に記載の半導体集積回路装置。
  6. 【請求項６】 前記表面実装型の半導体装置はＱＦＰで
    あることを特徴とする請求項１、２、３、４または５に
    記載の半導体集積回路装置。
  7. 【請求項７】 半導体チップ搭載領域を規定するように
    配置された複数のインナーリードと、この複数のインナ
    ーリードに連続する複数のアウターリードと、前記半導
    体チップ搭載領域を横切る複数の吊りリードと、前記半
    導体チップ搭載領域の前記吊りリードに接続される半導
    体チップと、前記インナーリードと前記半導体チップと
    を電気的に接続する手段と、前記半導体チップ、および
    前記インナーリードを封止するパッケージ本体とからな
    ることを特徴とする半導体集積回路装置。
  8. 【請求項８】 前記半導体チップ搭載領域を横切る複数
    の吊りリードは選択的な幅広部分を有していることを特
    徴とする請求項７に記載の半導体集積回路装置。
  9. 【請求項９】 前記幅広部分は前記半導体チップ搭載領
    域を構成することを特徴とする請求項８に記載の半導体
    集積回路装置。
  10. 【請求項１０】 前記半導体集積回路装置は表面実装型
    の半導体装置であることを特徴とする請求項７、８また
    は９に記載の半導体集積回路装置。
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