JPWO2009084269A1 - 半導体装置及び表示装置 - Google Patents
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Abstract
Description
2 単位回路
3 走査方向切替回路
3a 第1の回路
3b 第2の回路
4 リセット信号生成回路
10,20,30,40,41,50,51,52,53,54 回路(半導体装置)
T1 トランジスタ(第1のトランジスタ)
T2 トランジスタ(第2のトランジスタ)
T3 トランジスタ(第3のトランジスタ)
T4 トランジスタ(第4のトランジスタ)
T5 トランジスタ(第5のトランジスタ)
T6 トランジスタ(第6のトランジスタ)
T1′ トランジスタ(第11のトランジスタ)
T2′ トランジスタ(第12のトランジスタ)
151 液晶表示装置(表示装置)
n1,n2,n3 ノード
本実施の形態における回路10の構成について、以下に説明する。図1は回路10の構成を示す回路図であり、図2は回路10における各種信号の波形を示すタイミングチャートである。
本実施の形態における回路20の構成について、以下に説明する。図3は回路20の構成を示す回路図であり、図4は回路20における各種信号の波形を示すタイミングチャートである。なお、説明の便宜上、上記実施の形態1において示した部材と同一の機能を有する部材には、同一の符号を付し、その説明を省略する。また、実施の形態1において定義した用語については、特に断わらない限り本実施の形態においてもその定義に則って用いるものとする。
本実施の形態における回路30の構成について、以下に説明する。図5は、実施の形態2の回路20において貫通電流の経路を示す回路図であり、図6は回路20における各種信号の波形を示すタイミングチャートである。図7は、本実施の形態における回路30の構成を示す回路図である。なお、説明の便宜上、上記実施の形態1及び2において示した部材と同一の機能を有する部材には、同一の符号を付し、その説明を省略する。また、実施の形態1及び2において定義した用語については、特に断わらない限り本実施の形態においてもその定義に則って用いるものとする。
本実施の形態における回路40の構成について、以下に説明する。なお、説明の便宜上、上記実施の形態1〜3において示した部材と同一の機能を有する部材には、同一の符号を付し、その説明を省略する。また、実施の形態1〜3において定義した用語については、特に断わらない限り本実施の形態においてもその定義に則って用いるものとする。
本実施の形態における回路50の構成について、以下に説明する。なお、説明の便宜上、上記実施の形態1〜4において示した部材と同一の機能を有する部材には、同一の符号を付し、その説明を省略する。また、実施の形態1〜4において定義した用語については、特に断わらない限り本実施の形態においてもその定義に則って用いるものとする。
図18は、本実施例におけるシフトレジスタ1の構成を示すブロック図である。図18に示すシフトレジスタ1は、n個(nは2以上の整数)の単位回路2を多段接続して構成され、走査方向(出力信号をシフトする方向)を切り替える機能を有している。この単位回路2は、クロック端子CK,CKB、走査方向切替端子UD,UDB、入力端子INu,INd、及び、出力端子OUTを有している。
図28は、本実施例におけるバッファ11、及びその後段に配置される内部ブロック12の構成を示す回路図である。図28に示すように、バッファ11の出力信号は、内部ブロック12に多段に設けられる各トランジスタT7,T8及びT9のゲート端子に入力される。なお、バッファ11と内部ブロック12との接続点をノードn3とする。
Claims (10)
- 同一導電型の複数のトランジスタにより構成される半導体装置であって、
第1の端子に入力信号が入力され、第2の端子から出力信号が出力される第1のトランジスタと、
第1の端子に制御信号が入力され、第2の端子が前記第1のトランジスタの制御端子に接続される第2のトランジスタとを備え、
前記第2のトランジスタの制御端子と、前記第2のトランジスタの第1の端子とが互いに接続されていることを特徴とする半導体装置。 - 第1の端子が、前記第1のトランジスタの制御端子と前記第2のトランジスタの第2の端子との接続点に接続され、第2の端子が、前記第2のトランジスタの制御端子と前記第2のトランジスタの第1の端子との接続点に接続され、制御端子に前記制御信号の反転信号が入力される第3のトランジスタをさらに備えていることを特徴とする請求の範囲第1項に記載の半導体装置。
- 第1の端子が、前記第1のトランジスタの制御端子と前記第2のトランジスタの第2の端子との接続点に接続され、第2の端子にオフ電圧が与えられ、制御端子に前記制御信号の反転信号が入力される第3のトランジスタをさらに備えていることを特徴とする請求の範囲第1項に記載の半導体装置。
- 同一導電型の複数のトランジスタにより構成される半導体装置であって、
第1の端子に入力信号が入力され、第2の端子から出力信号が出力される第1のトランジスタと、
第1の端子に制御信号が入力され、第2の端子が前記第1のトランジスタの制御端子に接続される第2のトランジスタと、
第1の端子が、前記第1のトランジスタの制御端子と前記第2のトランジスタの第2の端子との接続点に接続され、制御端子にオン電圧が与えられる第4のトランジスタと、
第1の端子が、前記第4のトランジスタの第2の端子に接続され、制御端子に前記制御信号の反転信号が入力される第3のトランジスタとを備え、
前記第2のトランジスタの制御端子と、前記第2のトランジスタの第1の端子と、前記第3のトランジスタの第2の端子とが互いに接続されていることを特徴とする半導体装置。 - 同一導電型の複数のトランジスタにより構成される半導体装置であって、
第1の端子に入力信号が入力され、第2の端子から出力信号が出力される第1のトランジスタと、
第1の端子に制御信号が入力され、第2の端子が前記第1のトランジスタの制御端子に接続される第2のトランジスタと、
第1の端子が、前記第1のトランジスタの制御端子と前記第2のトランジスタの第2の端子との接続点に接続され、制御端子にオン電圧が与えられる第4のトランジスタと、
第1の端子が、前記第4のトランジスタの第2の端子に接続され、第2の端子にオフ電圧が与えられ、制御端子に前記制御信号の反転信号が入力される第3のトランジスタとを備え、
前記第2のトランジスタの制御端子と、前記第2のトランジスタの第1の端子とが互いに接続されていることを特徴とする半導体装置。 - 第1の端子に前記制御信号が入力され、制御端子に前記制御信号の反転信号が入力され、第2の端子が前記第1のトランジスタの第2の端子に接続される第5のトランジスタをさらに備えていることを特徴とする請求の範囲第1項から第5項の何れか1項に記載の半導体装置。
- 第1の端子にオフ電圧が与えられ、制御端子に前記制御信号の反転信号が入力され、第2の端子が前記第1のトランジスタの第2の端子に接続される第5のトランジスタをさらに備えていることを特徴とする請求の範囲第1項から第5項の何れか1項に記載の半導体装置。
- 同一導電型の複数のトランジスタにより構成され、第1の入力信号が入力される第1の回路と、第2の入力信号が入力される第2の回路とを備え、それぞれの回路に入力される制御信号及びその反転信号に基づき、前記第1の入力信号及び第2の入力信号の何れか一方を出力信号として出力する半導体装置であって、
前記第1の回路は、
第1の端子に前記第1の入力信号が入力される第1のトランジスタと、
第1の端子に前記制御信号が入力され、第2の端子が前記第1のトランジスタの制御端子に接続される第2のトランジスタとを備えるとともに、
前記第2のトランジスタの制御端子と、前記第2のトランジスタの第1の端子とが互いに接続され、
前記第2の回路は、
第1の端子に前記第2の入力信号が入力される第11のトランジスタと、
第1の端子に前記反転信号が入力され、第2の端子が前記第11のトランジスタの制御端子に接続される第12のトランジスタとを備えるとともに、
前記第12のトランジスタの制御端子と、前記第12のトランジスタの第1の端子とが互いに接続され、
前記第1のトランジスタの第2の端子と、前記第11のトランジスタの第2の端子との接続点から、前記出力信号が出力されることを特徴とする半導体装置。 - 同一導電型の複数のトランジスタにより構成される半導体装置であって、
第1の端子に入力信号が入力され、第2の端子から出力信号が出力される第1のトランジスタと、
第1の端子に前記入力信号が入力され、第2の端子が前記第1のトランジスタの制御端子に接続される第2のトランジスタと、
第1の端子が、前記第1のトランジスタの制御端子と前記第2のトランジスタの第2の端子との接続点に接続され、第2の端子に前記入力信号が入力され、制御端子に前記入力信号の反転信号が入力される第3のトランジスタと、
第1の端子が、前記第1のトランジスタの第2の端子に接続され、第2の端子にオフ電圧が与えられ、制御端子に前記入力信号の反転信号が入力される第6のトランジスタとを備え、
前記第2のトランジスタの制御端子と、前記第2のトランジスタの第1の端子とが互いに接続されていることを特徴とする半導体装置。 - 請求の範囲第1項から第9項の何れか1項に記載の半導体装置を備えていることを特徴とする表示装置。
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