JP5538890B2 - シフトレジスタ - Google Patents
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Description
前記単位回路は、
一方の導通端子に一方のクロック信号が与えられ、他方の導通端子が出力端子に接続された出力制御トランジスタと、
入力信号がオンレベルである間、前記出力制御トランジスタの制御端子にオン電圧を与えるプリチャージ回路と、
後段の単位回路の出力信号を用いることなく、通常時はオンレベルで、前記入力信号がオンレベルになるとオフレベルに変化するリセット信号を生成するリセット信号生成回路と、
前記リセット信号がオンレベルである間、前記出力制御トランジスタの制御端子にオフ電圧を与えるディスチャージ回路と、
前記リセット信号がオンレベルである間、前記出力端子にオフ電圧を与える出力リセット回路と、
前記出力端子にオン電圧が与えられている間、前記リセット信号をオフレベルに固定するリセット信号固定回路とを備え、
前記リセット信号生成回路は、
抵抗回路と、制御端子に他方のクロック信号が与えられ、前記抵抗回路に直列に接続された第1のトランジスタとを含み、一端にオン電圧が与えられた直列接続回路と、
制御端子に前記入力信号が与えられ、一方の導通端子が前記直列接続回路の他端に接続され、他方の導通端子にオフ電圧が与えられた第2のトランジスタとを含み、
前記直列接続回路と前記第2のトランジスタの接続点から前記リセット信号を出力することを特徴とする。
前記単位回路は、前方の単位回路の出力信号と後方の単位回路の出力信号の中から、前記入力信号を選択する走査方向切替回路をさらに備える。
前記単位回路は、制御端子と一方の導通端子が前記出力制御トランジスタと同様に接続され、他方の導通端子が追加出力端子に接続された追加出力制御トランジスタをさらに備え、
前記出力端子からの出力信号が外部に出力され、前記追加出力端子からの出力信号が後段の単位回路に与えられることを特徴とする。
前記単位回路は、前記リセット信号がオンレベルである間、前記追加出力端子にオフ電圧を与える追加出力リセット回路をさらに備える。
前記単位回路は、全オン制御信号に従い前記出力端子にオン電圧を与える全オン制御回路をさらに備える。
前記抵抗回路の一端にオン電圧が与えられ、
前記第1のトランジスタの一方の導通端子は前記抵抗回路の他端に接続され、
前記第2のトランジスタの一方の導通端子は前記第1のトランジスタの他方の導通端子に接続されていることを特徴とする。
本発明の第1〜第6の局面のいずれかに係るシフトレジスタを含んだ駆動回路とを備えた表示装置である。
11、17〜19、21、31、41、51、61、71、81、91…単位回路
12、14、92、93…リセット信号生成回路
13、15、16…プリチャージ回路
22…走査方向切替回路
32、33…初期化回路
110、120…液晶表示装置
111、121…画素アレイ
112、122…表示制御回路
113、123…走査信号線駆動回路
114、124…データ信号線駆動回路
125…サンプリングスイッチ
図1は、第1の参考例に係るシフトレジスタの構成を示すブロック図である。図1に示すシフトレジスタ10は、n個(nは2以上の整数)の単位回路11を多段接続して構成されている。単位回路11は、クロック端子CK、CKB、入力端子INおよび出力端子OUTを有する。以下、各端子経由で入出力される信号を当該端子と同じ名称で呼ぶ(例えば、クロック端子CK経由で入力される信号をクロック信号CKという)。
図7は、第2の参考例に係るシフトレジスタの構成を示すブロック図である。図7に示すシフトレジスタ20は、走査方向切替端子UD、UDBおよび入力端子INu、INdを有するn個の単位回路21を備えている。シフトレジスタ20は、第1の参考例に係るシフトレジスタ10に、走査方向(出力信号をシフトする方向)を切り替える機能を追加したものである。
図9は、第3の参考例に係るシフトレジスタの構成を示すブロック図である。図9に示すシフトレジスタ30は、初期化端子INITを有するn個の単位回路31を備えている。シフトレジスタ30は、第1の参考例に係るシフトレジスタ10に初期化機能を追加したものである。単位回路31の初期化端子INITには、外部から供給された初期化信号INITが与えられる。
第4の参考例に係るシフトレジスタは、第1の参考例と同じ構成(図1)を有する。本参考例に係るシフトレジスタは、第1の参考例に係るシフトレジスタ10に、出力信号がハイレベルである間、リセット信号をローレベルに固定する機能を追加したものである。
図14は、第5の参考例に係るシフトレジスタの構成を示すブロック図である。図14に示すシフトレジスタ50は、出力端子OUT1、OUT2を有するn個の単位回路51を備えている。シフトレジスタ50は、第1の参考例に係るシフトレジスタ10に、同じ出力信号を複数個出力する機能(出力分離機能)を追加したものである。
図16は、第6の参考例に係るシフトレジスタの構成を示すブロック図である。図16に示すシフトレジスタ60は、全オン制御端子AON、AONBを有するn個の単位回路61を備えている。シフトレジスタ60は、第1の参考例に係るシフトレジスタ10に、すべての出力信号をハイレベルにする機能(全オン機能)を追加したものである。単位回路61の全オン制御端子AON、AONBには、外部から供給された全オン制御信号AON、AONB(AONの否定)が与えられる。
図19は、第7の参考例に係るシフトレジスタの構成を示すブロック図である。図19に示すシフトレジスタ70は、初期化端子INIT、全オン制御端子AONおよび出力端子OUT1、OUT2を有するn個の単位回路71を備えている。シフトレジスタ70は、第1の参考例に係るシフトレジスタ10に、出力分離機能と全オン機能を追加したものである。
図22は、第8の参考例に係るシフトレジスタの構成を示すブロック図である。図22に示すシフトレジスタ80は、クロック端子CKBを有しないn個の単位回路81を備えている。シフトレジスタ80は、2相のクロック信号を用いることなく、単位回路内でリセット信号を生成する。
第9の参考例に係るシフトレジスタは、第1の参考例と同じ構成(図1)を有する。本参考例に係るシフトレジスタは、第1の参考例に係るシフトレジスタ10において、リセット信号生成回路12に含まれるトランジスタT5を抵抗回路に置換したものである。
Claims (7)
- 同一導電型のトランジスタで構成された単位回路を多段接続した構成を有し、オンレベル期間が重複しない2相のクロック信号に基づき動作するシフトレジスタであって、
前記単位回路は、
一方の導通端子に一方のクロック信号が与えられ、他方の導通端子が出力端子に接続された出力制御トランジスタと、
入力信号がオンレベルである間、前記出力制御トランジスタの制御端子にオン電圧を与えるプリチャージ回路と、
後段の単位回路の出力信号を用いることなく、通常時はオンレベルで、前記入力信号がオンレベルになるとオフレベルに変化するリセット信号を生成するリセット信号生成回路と、
前記リセット信号がオンレベルである間、前記出力制御トランジスタの制御端子にオフ電圧を与えるディスチャージ回路と、
前記リセット信号がオンレベルである間、前記出力端子にオフ電圧を与える出力リセット回路と、
前記出力端子にオン電圧が与えられている間、前記リセット信号をオフレベルに固定するリセット信号固定回路とを備え、
前記リセット信号生成回路は、
抵抗回路と、制御端子に他方のクロック信号が与えられ、前記抵抗回路に直列に接続された第1のトランジスタとを含み、一端にオン電圧が与えられた直列接続回路と、
制御端子に前記入力信号が与えられ、一方の導通端子が前記直列接続回路の他端に接続され、他方の導通端子にオフ電圧が与えられた第2のトランジスタとを含み、
前記直列接続回路と前記第2のトランジスタの接続点から前記リセット信号を出力することを特徴とする、シフトレジスタ。 - 前記単位回路は、前方の単位回路の出力信号と後方の単位回路の出力信号の中から、前記入力信号を選択する走査方向切替回路をさらに備えた、請求項1に記載のシフトレジスタ。
- 前記単位回路は、制御端子と一方の導通端子が前記出力制御トランジスタと同様に接続され、他方の導通端子が追加出力端子に接続された追加出力制御トランジスタをさらに備え、
前記出力端子からの出力信号が外部に出力され、前記追加出力端子からの出力信号が後段の単位回路に与えられることを特徴とする、請求項1に記載のシフトレジスタ。 - 前記単位回路は、前記リセット信号がオンレベルである間、前記追加出力端子にオフ電圧を与える追加出力リセット回路をさらに備えた、請求項3に記載のシフトレジスタ。
- 前記単位回路は、全オン制御信号に従い前記出力端子にオン電圧を与える全オン制御回路をさらに備えた、請求項1に記載のシフトレジスタ。
- 前記抵抗回路の一端にオン電圧が与えられ、
前記第1のトランジスタの一方の導通端子は前記抵抗回路の他端に接続され、
前記第2のトランジスタの一方の導通端子は前記第1のトランジスタの他方の導通端子に接続されていることを特徴とする、請求項1に記載のシフトレジスタ。 - 2次元状に配置された複数の画素回路と、
請求項1〜6のいずれかに記載のシフトレジスタを含んだ駆動回路とを備えた、表示装置。
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