JP2010027194A - 駆動回路、表示装置、及び電子機器 - Google Patents
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- G09G2320/04—Maintaining the quality of display appearance
- G09G2320/043—Preventing or counteracting the effects of ageing
Abstract
【解決手段】複数のフリップフロップ回路からなるシフトレジスタを有し、フリップフロップ回路は、トランジスタ11、トランジスタ12、トランジスタ13、トランジスタ14、及びトランジスタ15を有し、非選択期間において、トランジスタ13またはトランジスタ14がオン状態になることにより、ノードAの電位を設定し、ノードAが浮遊状態になることを抑制する。
【選択図】図24
Description
本実施の形態では、本発明の一態様である駆動回路について説明する。
本実施の形態では、上記実施の形態1と異なる構成の駆動回路について説明する。
本実施の形態では、本発明の一態様である駆動回路を用いた表示装置の構成について説明する。
本実施の形態では本発明の一態様である駆動回路を構成するトランジスタに適用可能なトランジスタの構成について説明する。
本実施の形態では、本発明の一態様である表示装置を表示部に用いた電子機器について説明する。
12 トランジスタ
13 トランジスタ
14 トランジスタ
15 トランジスタ
100 端子
101 端子
102 端子
102A 端子
102B 端子
103 端子
103A 端子
103B 端子
103C 端子
103D 端子
104 端子
104A 端子
104B 端子
104C 端子
104D 端子
104E 端子
104F 端子
104G 端子
104H 端子
104I 端子
104J 端子
104K 端子
104L 端子
104M 端子
105 端子
106 トランジスタ
107 トランジスタ
108 容量素子
109 トランジスタ
110 トランジスタ
111 トランジスタ
112 容量素子
113 トランジスタ
114 トランジスタ
115 トランジスタ
116 トランジスタ
117 ノード
118 ノード
119 ノード
120 トランジスタ
121 端子
122 トランジスタ
123 トランジスタ
124 トランジスタ
125 端子
126 トランジスタ
127 トランジスタ
128 トランジスタ
129 トランジスタ
201 制御信号
202 クロック信号
203 クロック信号
204 電位
205 電位
206 電位
207 出力信号
208 制御信号
209 出力信号
500 端子
501 端子
502 端子
502A 端子
502B 端子
503 端子
503A 端子
503B 端子
503C 端子
503D 端子
504 端子
504A 端子
504B 端子
504C 端子
504D 端子
504E 端子
504F 端子
504G 端子
504H 端子
504I 端子
504J 端子
504K 端子
505 端子
506 トランジスタ
507 トランジスタ
508 トランジスタ
509 トランジスタ
510 容量素子
511 トランジスタ
512 トランジスタ
513 トランジスタ
514 トランジスタ
515 ノード
516 ノード
517 トランジスタ
518 端子
519 トランジスタ
520 トランジスタ
521 トランジスタ
522 端子
523 トランジスタ
524 トランジスタ
525 トランジスタ
526 トランジスタ
601 制御信号
602 クロック信号
603 クロック信号
604 電位
605 電位
606 出力信号
607 制御信号
608 出力信号
700 画素部
701 信号線駆動回路
702 走査線駆動回路
703 制御回路
704 クロック信号生成回路
705 信号線
705A 信号線
705B 信号線
706 走査線
706A 走査線
706B 走査線
706C 走査線
706D 走査線
707 クロック信号線
708 クロック信号線
709 画素
710 フリップフロップ回路
710A フリップフロップ回路
710B フリップフロップ回路
710C フリップフロップ回路
710D フリップフロップ回路
750 画素
751 トランジスタ
752 液晶素子
753 容量素子
754 配線
755 配線
756 配線
757 配線
758 電極
801 開始信号
802 クロック信号
803 クロック信号
804 出力信号
805 出力信号
806 出力信号
807 出力信号
900 基板
901 不純物領域
902 半導体層
903 ゲート絶縁膜
904 ゲート電極
905a 電極
905b 電極
906 層間絶縁膜
907 基板
908 ゲート電極
910 ゲート絶縁膜
911 半導体層
912 半導体層
912a 半導体層
912b 半導体層
913a 電極
913b 電極
1000 基板
1001 ゲート電極
1002 ゲート絶縁膜
1003 微結晶半導体層
1004 バッファ層
1005a 半導体層
1005b 半導体層
1006a 電極
1006b 電極
1007 導電膜
1008 微結晶半導体膜
1009 非晶質半導体膜
1010 半導体膜
1011 導電膜
1101 筐体
1102 支持台
1103 表示部
1104 スピーカー部
1105 ビデオ入力端子
1111 本体
1112 表示部
1113 受像部
1114 操作キー
1115 外部接続ポート
1116 シャッターボタン
1121 本体
1122 筐体
1123 表示部
1124 キーボード
1125 外部接続ポート
1126 ポインティングデバイス
1131 本体
1132 表示部
1133 スイッチ
1134 操作キー
1135 赤外線ポート
1141 本体
1142 筐体
1143 表示部A
1144 表示部B
1145 読込部
1146 操作キー
1147 スピーカー部
1151 本体
1152 表示部
1153 アーム部
1161 本体
1162 表示部
1163 筐体
1164 外部接続ポート
1165 リモコン受信部
1166 受像部
1167 バッテリー
1168 音声入力部
1169 操作キー
1170 接眼部
1171 本体
1172 筐体
1173 表示部
1174 音声入力部
1175 音声出力部
1176 操作キー
1177 外部接続ポート
1178 アンテナ
1180 筐体
1181 筐体
1182 表示部
1183 スピーカー
1184 マイクロフォン
1185 操作キー
1186 ポインティングデバイス
1187 カメラ用レンズ
1188 外部接続端子
1189 イヤホン端子
1190 キーボード
1191 外部メモリスロット
1192 カメラ用レンズ
1193 ライト
Claims (13)
- 複数のフリップフロップ回路を含むシフトレジスタを有し、
前記複数のフリップフロップ回路の少なくとも一つは、第1の信号、第2の信号、及び第3の信号が入力され、出力信号を出力するフリップフロップ回路であり、
前記複数のフリップフロップ回路の少なくとも一つは、
ゲート端子、ソース端子、及びドレイン端子を有し、前記ゲート端子に前記第1の信号の電位である第1の電位が与えられ、前記ソース端子及び前記ドレイン端子の一方に前記第1の電位または第2の電位が与えられる第1のトランジスタと、
ゲート端子、ソース端子、及びドレイン端子を有し、前記ゲート端子に前記第2の信号の電位である第3の電位が与えられ、前記ソース端子及び前記ドレイン端子の一方が前記第1のトランジスタの前記ソース端子及び前記ドレイン端子の他方に電気的に接続され、前記ソース端子及び前記ドレイン端子の他方に第4の電位が与えられる第2のトランジスタと、
一方が前記第1のトランジスタの前記ソース端子及び前記ドレイン端子の他方の電位を前記第1の電位または前記第4の電位に設定するか否かを制御し、他方が前記第1のトランジスタの前記ソース端子及び前記ドレイン端子の他方の電位を前記第4の電位に設定するか否かを制御し、前記一方がオン状態のときに前記他方がオフ状態になり、前記他方がオン状態のときに前記一方がオフ状態になる第3のトランジスタ及び第4のトランジスタと、
ゲート端子、ソース端子、及びドレイン端子を有し、前記ゲート端子が前記第1のトランジスタの前記ソース端子及び前記ドレイン端子の他方に電気的に接続され、前記ソース端子及び前記ドレイン端子の一方に前記第3の信号の電位である第5の電位が与えられ、前記ソース端子及び前記ドレイン端子の他方の電位が前記出力信号の電位となり、前記第3のトランジスタまたは前記第4のトランジスタがオン状態のときにオフ状態である第5のトランジスタと、を有する駆動回路。 - 複数のフリップフロップ回路を含むシフトレジスタを有し、
前記フリップフロップ回路は、第1の制御信号、第2の制御信号、第1のクロック信号、及び第2のクロック信号が入力され、出力信号を出力するフリップフロップ回路であり、
前記フリップフロップ回路は、
ゲート端子、ソース端子、及びドレイン端子を有し、前記ゲート端子に前記第1の制御信号の電位である第1の電位が与えられ、前記ソース端子及び前記ドレイン端子の一方に前記第1の電位または第2の電位が与えられる第1のトランジスタと、
ゲート端子、ソース端子、及びドレイン端子を有し、前記ゲート端子に前記第2の制御信号の電位である第3の電位が与えられ、前記ソース端子及び前記ドレイン端子の一方が前記第1のトランジスタの前記ソース端子及び前記ドレイン端子の他方に電気的に接続され、前記ソース端子及び前記ドレイン端子の他方に第4の電位が与えられる第2のトランジスタと、
それぞれゲート端子、ソース端子、及びドレイン端子を有するトランジスタであり、一方のトランジスタの前記ソース端子及び前記ドレイン端子の一方が前記第1のトランジスタの前記ソース端子及び前記ドレイン端子の他方に電気的に接続され、前記一方のトランジスタの前記ソース端子及び前記ドレイン端子の他方に前記第1の電位または前記第4の電位が与えられ、他方のトランジスタの前記ソース端子及び前記ドレイン端子の一方が前記第1のトランジスタの前記ソース端子及び前記ドレイン端子の他方に電気的に接続され、前記他方のトランジスタの前記ソース端子及び前記ドレイン端子の他方に前記第4の電位が与えられ、前記一方のトランジスタがオン状態のときに前記他方のトランジスタがオフ状態になり、前記他方のトランジスタがオン状態のときに前記一方のトランジスタがオフ状態になる第3のトランジスタ及び第4のトランジスタと、
ゲート端子、ソース端子、及びドレイン端子を有し、前記ゲート端子が前記第1のトランジスタの前記ソース端子及び前記ドレイン端子の他方に電気的に接続され、前記ソース端子及び前記ドレイン端子の一方に前記第1のクロック信号の電位である第5の電位が与えられ、前記ソース端子及び前記ドレイン端子の他方の電位が前記出力信号の電位となり、前記第3のトランジスタまたは前記第4のトランジスタがオン状態のときにオフ状態である第5のトランジスタと、
ゲート端子、ソース端子、及びドレイン端子を有し、前記ゲート端子が前記第3のトランジスタ及び前記第4のトランジスタの他方の前記ゲート端子に電気的に接続され、前記ソース端子及び前記ドレイン端子の一方が前記第5のトランジスタの前記ソース端子及び前記ドレイン端子の他方に電気的に接続され、前記ソース端子及び前記ドレイン端子の他方に前記第4の電位が与えられる第6のトランジスタと、
ゲート端子、ソース端子、及びドレイン端子を有し、前記ゲート端子に前記第2のクロック信号の電位である第6の電位が与えられ、前記ソース端子及び前記ドレイン端子の一方が前記第5のトランジスタの前記ソース端子及び前記ドレイン端子の他方に電気的に接続され、前記ソース端子及び前記ドレイン端子の他方に前記第4の電位が与えられる第7のトランジスタと、を有する駆動回路。 - 請求項2において、
前記フリップフロップ回路は、
少なくとも2つの端子を有し、一方の端子に前記第5の電位が与えられ、他方の端子が前記第3のトランジスタ及び前記第4のトランジスタの他方の前記ゲート端子に電気的に接続された第1の容量素子と、
ゲート端子、ソース端子、及びドレイン端子を有し、前記ゲート端子が前記第5のトランジスタの前記ゲート端子に電気的に接続され、前記ソース端子及び前記ドレイン端子の一方が前記第3のトランジスタ及び前記第4のトランジスタの他方の前記ゲート端子に電気的に接続され、前記ソース端子及び前記ドレイン端子の他方に前記第4の電位が与えられる第8のトランジスタと、
少なくとも2つの端子を有し、一方の端子に前記第6の電位が与えられ、他方の端子が前記第3のトランジスタ及び前記第4のトランジスタの一方の前記ゲート端子に電気的に接続された第2の容量素子と、
ゲート端子、ソース端子、及びドレイン端子を有し、前記ゲート端子が前記第1のトランジスタの前記ゲート端子に電気的に接続され、前記ソース端子及び前記ドレイン端子の一方が前記第3のトランジスタ及び前記第4のトランジスタの一方の前記ゲート端子に電気的に接続され、前記ソース端子及び前記ドレイン端子の他方に前記第4の電位が与えられる第9のトランジスタと、を有する駆動回路。 - 請求項2において、
前記フリップフロップ回路は、
少なくとも2つの端子を有し、一方の端子に前記第5の電位が与えられ、他方の端子が前記第3のトランジスタ及び前記第4のトランジスタの他方の前記ゲート端子に電気的に接続された第1の容量素子と、
ゲート端子、ソース端子、及びドレイン端子を有し、前記ゲート端子が前記第5のトランジスタの前記ゲート端子に電気的に接続され、前記ソース端子及び前記ドレイン端子の一方が前記第3のトランジスタ及び前記第4のトランジスタの他方の前記ゲート端子に電気的に接続され、前記ソース端子及び前記ドレイン端子の他方に前記第4の電位が与えられる第8のトランジスタと、を有する駆動回路。 - 請求項3または請求項4において、
前記フリップフロップ回路は、
ゲート端子、ソース端子、及びドレイン端子を有し、前記ゲート端子に前記第1の電位が与えられ、前記ソース端子及び前記ドレイン端子の一方が前記第3のトランジスタ及び前記第4のトランジスタの他方の前記ゲート端子に電気的に接続され、前記ソース端子及び前記ドレイン端子の他方に前記第4の電位が与えられる第10のトランジスタを有する駆動回路。 - 請求項2乃至請求項5のいずれか一項において、
前記フリップフロップ回路は、第2の出力信号を出力する機能を有し、
前記フリップフロップ回路は、
ゲート端子、ソース端子、及びドレイン端子を有し、前記ゲート端子が前記第1のトランジスタの前記ソース端子及び前記ドレイン端子の一方に電気的に接続され、前記ソース端子及び前記ドレイン端子の一方に前記第5の電位が与えられ、前記ソース端子及び前記ドレイン端子の他方の電位が第2の出力信号の電位となる第11のトランジスタと、
ゲート端子、ソース端子、及びドレイン端子を有し、前記ゲート端子が前記第3のトランジスタ及び前記第4のトランジスタの他方の前記ゲート端子に電気的に接続され、前記ソース端子及び前記ドレイン端子の一方が前記第11のトランジスタの前記ソース端子及び前記ドレイン端子の他方に電気的に接続され、前記ソース端子及び前記ドレイン端子の他方に前記第4の電位が与えられる第12のトランジスタと、
ゲート端子、ソース端子、及びドレイン端子を有し、前記ゲート端子が前記第7のトランジスタの前記ゲート端子に電気的に接続され、前記ソース端子及び前記ドレイン端子の一方が前記第11のトランジスタの前記ソース端子及び前記ドレイン端子の他方に電気的に接続され、前記ソース端子及び前記ドレイン端子の他方に前記第4の電位が与えられる第13のトランジスタと、を有する駆動回路。 - 請求項2乃至請求項6のいずれか一項において、
前記第1の制御信号及び前記第2の制御信号は、デジタル信号であり、
前記デジタル信号のハイ状態とロウ状態との電位差の絶対値は、前記フリップフロップ回路内のトランジスタの閾値電圧の絶対値より大きい駆動回路。 - 請求項7において、
前記第4の電位は、前記第1の制御信号若しくは前記第2の制御信号、または前記第1のクロック信号若しくは前記第2のクロック信号のハイ状態またはロウ状態の電位と同等の値である駆動回路。 - 請求項2乃至請求項8のいずれか一項において、
前記第1のクロック信号及び前記第2のクロック信号のハイ状態とロウ状態の電位差の絶対値は、前記フリップフロップ回路内のトランジスタの閾値電圧の絶対値より大きい駆動回路。 - 請求項1乃至請求項9のいずれか一項において、
前記フリップフロップ回路内のトランジスタは、すべて同一の導電型である駆動回路。 - 請求項1乃至請求項10のいずれか一項において、
前記フリップフロップ回路内のトランジスタは、
ゲート電極と、
前記ゲート電極を覆うように設けられたゲート絶縁膜と、
前記ゲート絶縁膜を挟んで前記ゲート電極上に設けられた微結晶半導体層を含む第1の半導体層と、
前記第1の半導体層上に設けられたバッファ層と、
前記バッファ層上に設けられ、不純物元素を含む一対の第2の半導体層と、
前記一対の第2の半導体層の一方の上に設けられたソース電極と、
前記一対の第2の半導体層の他方の上に設けられたドレイン電極と、を有する駆動回路。 - 請求項1乃至請求項11のいずれか一項に記載の駆動回路をいずれかに含む走査線駆動回路及び信号線駆動回路と、
複数の走査線と、
複数の信号線と、
画素部と、を有し、
前記画素部は、
複数の走査線のいずれかを介して前記走査線駆動回路に電気的に接続され、且つ前記複数の信号線のいずれかを介して前記信号線に電気的に接続された画素を複数有する表示装置。 - 請求項12に記載の表示装置を表示部に有する電子機器。
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