JPH11219984A - 半導体装置パッケージおよびその製造方法ならびにそのための回路基板 - Google Patents
半導体装置パッケージおよびその製造方法ならびにそのための回路基板Info
- Publication number
- JPH11219984A JPH11219984A JP10311095A JP31109598A JPH11219984A JP H11219984 A JPH11219984 A JP H11219984A JP 10311095 A JP10311095 A JP 10311095A JP 31109598 A JP31109598 A JP 31109598A JP H11219984 A JPH11219984 A JP H11219984A
- Authority
- JP
- Japan
- Prior art keywords
- semiconductor device
- resin
- circuit board
- connection pad
- device package
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 239000004065 semiconductor Substances 0.000 title claims abstract description 167
- 238000004519 manufacturing process Methods 0.000 title claims abstract description 48
- 229920005989 resin Polymers 0.000 claims abstract description 207
- 239000011347 resin Substances 0.000 claims abstract description 207
- 238000000034 method Methods 0.000 claims abstract description 126
- 229910000679 solder Inorganic materials 0.000 claims abstract description 84
- 229910052751 metal Inorganic materials 0.000 claims description 102
- 239000002184 metal Substances 0.000 claims description 102
- 239000000758 substrate Substances 0.000 claims description 27
- 230000002093 peripheral effect Effects 0.000 claims description 20
- 230000009477 glass transition Effects 0.000 claims description 11
- 239000011159 matrix material Substances 0.000 claims description 11
- 239000000853 adhesive Substances 0.000 claims description 10
- 230000001070 adhesive effect Effects 0.000 claims description 10
- 238000010438 heat treatment Methods 0.000 claims description 10
- 229920001187 thermosetting polymer Polymers 0.000 claims description 9
- 230000008018 melting Effects 0.000 claims description 8
- 238000002844 melting Methods 0.000 claims description 8
- 238000000465 moulding Methods 0.000 claims description 8
- 239000000463 material Substances 0.000 claims description 6
- 230000004907 flux Effects 0.000 claims description 5
- 229920005992 thermoplastic resin Polymers 0.000 claims description 5
- 230000008569 process Effects 0.000 abstract description 15
- 238000005516 engineering process Methods 0.000 abstract description 4
- 238000007789 sealing Methods 0.000 description 13
- 230000002950 deficient Effects 0.000 description 9
- 238000004382 potting Methods 0.000 description 9
- 238000010586 diagram Methods 0.000 description 8
- 239000007788 liquid Substances 0.000 description 8
- 239000007767 bonding agent Substances 0.000 description 7
- 239000004642 Polyimide Substances 0.000 description 6
- 230000000694 effects Effects 0.000 description 6
- 239000010410 layer Substances 0.000 description 6
- 229920001721 polyimide Polymers 0.000 description 6
- 230000008439 repair process Effects 0.000 description 6
- 239000000945 filler Substances 0.000 description 5
- 238000007747 plating Methods 0.000 description 5
- 238000012360 testing method Methods 0.000 description 5
- 229910045601 alloy Inorganic materials 0.000 description 4
- 239000000956 alloy Substances 0.000 description 4
- 229910052710 silicon Inorganic materials 0.000 description 4
- 230000008646 thermal stress Effects 0.000 description 4
- 239000011248 coating agent Substances 0.000 description 3
- 238000000576 coating method Methods 0.000 description 3
- 229910052737 gold Inorganic materials 0.000 description 3
- 239000004593 Epoxy Substances 0.000 description 2
- 239000012298 atmosphere Substances 0.000 description 2
- 230000004888 barrier function Effects 0.000 description 2
- 230000015572 biosynthetic process Effects 0.000 description 2
- 238000001723 curing Methods 0.000 description 2
- 238000009792 diffusion process Methods 0.000 description 2
- 150000002739 metals Chemical class 0.000 description 2
- 239000000203 mixture Substances 0.000 description 2
- 230000003647 oxidation Effects 0.000 description 2
- 238000007254 oxidation reaction Methods 0.000 description 2
- 238000007639 printing Methods 0.000 description 2
- 230000002040 relaxant effect Effects 0.000 description 2
- 238000005476 soldering Methods 0.000 description 2
- JYEUMXHLPRZUAT-UHFFFAOYSA-N 1,2,3-triazine Chemical compound C1=CN=NN=C1 JYEUMXHLPRZUAT-UHFFFAOYSA-N 0.000 description 1
- XQUPVDVFXZDTLT-UHFFFAOYSA-N 1-[4-[[4-(2,5-dioxopyrrol-1-yl)phenyl]methyl]phenyl]pyrrole-2,5-dione Chemical compound O=C1C=CC(=O)N1C(C=C1)=CC=C1CC1=CC=C(N2C(C=CC2=O)=O)C=C1 XQUPVDVFXZDTLT-UHFFFAOYSA-N 0.000 description 1
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 1
- 238000010521 absorption reaction Methods 0.000 description 1
- 239000012790 adhesive layer Substances 0.000 description 1
- 229910052802 copper Inorganic materials 0.000 description 1
- 239000006071 cream Substances 0.000 description 1
- XLJMAIOERFSOGZ-UHFFFAOYSA-M cyanate Chemical compound [O-]C#N XLJMAIOERFSOGZ-UHFFFAOYSA-M 0.000 description 1
- 229920006332 epoxy adhesive Polymers 0.000 description 1
- 230000005496 eutectics Effects 0.000 description 1
- 230000006870 function Effects 0.000 description 1
- 239000011521 glass Substances 0.000 description 1
- 238000013007 heat curing Methods 0.000 description 1
- 230000001771 impaired effect Effects 0.000 description 1
- 238000005304 joining Methods 0.000 description 1
- 229910052759 nickel Inorganic materials 0.000 description 1
- 229920003192 poly(bis maleimide) Polymers 0.000 description 1
- 238000003825 pressing Methods 0.000 description 1
- 239000010703 silicon Substances 0.000 description 1
- 229910052709 silver Inorganic materials 0.000 description 1
- 238000010998 test method Methods 0.000 description 1
- 229920006259 thermoplastic polyimide Polymers 0.000 description 1
- 229910052718 tin Inorganic materials 0.000 description 1
- 238000001771 vacuum deposition Methods 0.000 description 1
- 238000009736 wetting Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/28—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection
- H01L23/31—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape
- H01L23/3107—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape the device being completely enclosed
- H01L23/3121—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape the device being completely enclosed a substrate forming part of the encapsulation
- H01L23/3128—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape the device being completely enclosed a substrate forming part of the encapsulation the substrate having spherical bumps for external connection
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/50—Assembly of semiconductor devices using processes or apparatus not provided for in a single one of the subgroups H01L21/06 - H01L21/326, e.g. sealing of a cap to a base of a container
- H01L21/56—Encapsulations, e.g. encapsulation layers, coatings
- H01L21/563—Encapsulation of active face of flip-chip device, e.g. underfilling or underencapsulation of flip-chip, encapsulation preform on chip or mounting substrate
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/28—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection
- H01L23/31—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape
- H01L23/3107—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape the device being completely enclosed
- H01L23/3121—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape the device being completely enclosed a substrate forming part of the encapsulation
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L24/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
- H01L24/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L24/31—Structure, shape, material or disposition of the layer connectors after the connecting process
- H01L24/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/42—Wire connectors; Manufacturing methods related thereto
- H01L24/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L24/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/73—Means for bonding being of different types provided for in two or more of groups H01L24/10, H01L24/18, H01L24/26, H01L24/34, H01L24/42, H01L24/50, H01L24/63, H01L24/71
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L24/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L25/00—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
- H01L25/03—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes
- H01L25/04—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers
- H01L25/065—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers the devices being of a type provided for in group H01L27/00
- H01L25/0657—Stacked arrangements of devices
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/11—Manufacturing methods
- H01L2224/113—Manufacturing methods by local deposition of the material of the bump connector
- H01L2224/1133—Manufacturing methods by local deposition of the material of the bump connector in solid form
- H01L2224/1134—Stud bumping, i.e. using a wire-bonding apparatus
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/12—Structure, shape, material or disposition of the bump connectors prior to the connecting process
- H01L2224/13—Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
- H01L2224/13001—Core members of the bump connector
- H01L2224/13099—Material
- H01L2224/131—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
- H01L2224/13138—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
- H01L2224/13144—Gold [Au] as principal constituent
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/15—Structure, shape, material or disposition of the bump connectors after the connecting process
- H01L2224/16—Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
- H01L2224/161—Disposition
- H01L2224/16151—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/16221—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/16225—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L2224/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
- H01L2224/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
- H01L2224/29001—Core members of the layer connector
- H01L2224/29099—Material
- H01L2224/291—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
- H01L2224/29101—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of less than 400°C
- H01L2224/29111—Tin [Sn] as principal constituent
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L2224/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
- H01L2224/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
- H01L2224/29001—Core members of the layer connector
- H01L2224/29099—Material
- H01L2224/2919—Material with a principal constituent of the material being a polymer, e.g. polyester, phenolic based polymer, epoxy
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L2224/31—Structure, shape, material or disposition of the layer connectors after the connecting process
- H01L2224/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
- H01L2224/321—Disposition
- H01L2224/32135—Disposition the layer connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip
- H01L2224/32145—Disposition the layer connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being stacked
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L2224/31—Structure, shape, material or disposition of the layer connectors after the connecting process
- H01L2224/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
- H01L2224/321—Disposition
- H01L2224/32151—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/32221—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/32225—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/44—Structure, shape, material or disposition of the wire connectors prior to the connecting process
- H01L2224/45—Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
- H01L2224/45001—Core members of the connector
- H01L2224/4501—Shape
- H01L2224/45012—Cross-sectional shape
- H01L2224/45015—Cross-sectional shape being circular
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/44—Structure, shape, material or disposition of the wire connectors prior to the connecting process
- H01L2224/45—Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
- H01L2224/45001—Core members of the connector
- H01L2224/45099—Material
- H01L2224/451—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
- H01L2224/45138—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
- H01L2224/45144—Gold (Au) as principal constituent
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/4805—Shape
- H01L2224/4809—Loop shape
- H01L2224/48091—Arched
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/481—Disposition
- H01L2224/48151—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/48221—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/48225—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
- H01L2224/48227—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation connecting the wire to a bond pad of the item
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/484—Connecting portions
- H01L2224/48463—Connecting portions the connecting portion on the bonding area of the semiconductor or solid-state body being a ball bond
- H01L2224/48465—Connecting portions the connecting portion on the bonding area of the semiconductor or solid-state body being a ball bond the other connecting portion not on the bonding area being a wedge bond, i.e. ball-to-wedge, regular stitch
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/485—Material
- H01L2224/48505—Material at the bonding interface
- H01L2224/48599—Principal constituent of the connecting portion of the wire connector being Gold (Au)
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/73—Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
- H01L2224/732—Location after the connecting process
- H01L2224/73201—Location after the connecting process on the same surface
- H01L2224/73203—Bump and layer connectors
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/73—Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
- H01L2224/732—Location after the connecting process
- H01L2224/73201—Location after the connecting process on the same surface
- H01L2224/73203—Bump and layer connectors
- H01L2224/73204—Bump and layer connectors the bump connector being embedded into the layer connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/73—Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
- H01L2224/732—Location after the connecting process
- H01L2224/73201—Location after the connecting process on the same surface
- H01L2224/73207—Bump and wire connectors
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/73—Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
- H01L2224/732—Location after the connecting process
- H01L2224/73251—Location after the connecting process on different surfaces
- H01L2224/73253—Bump and layer connectors
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/73—Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
- H01L2224/732—Location after the connecting process
- H01L2224/73251—Location after the connecting process on different surfaces
- H01L2224/73265—Layer and wire connectors
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L2224/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
- H01L2224/831—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector the layer connector being supplied to the parts to be connected in the bonding apparatus
- H01L2224/83102—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector the layer connector being supplied to the parts to be connected in the bonding apparatus using surface energy, e.g. capillary forces
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L2224/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
- H01L2224/8319—Arrangement of the layer connectors prior to mounting
- H01L2224/83191—Arrangement of the layer connectors prior to mounting wherein the layer connectors are disposed only on the semiconductor or solid-state body
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L2224/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
- H01L2224/8319—Arrangement of the layer connectors prior to mounting
- H01L2224/83192—Arrangement of the layer connectors prior to mounting wherein the layer connectors are disposed only on another item or body to be connected to the semiconductor or solid-state body
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L2224/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
- H01L2224/838—Bonding techniques
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L2224/85—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a wire connector
- H01L2224/8538—Bonding interfaces outside the semiconductor or solid-state body
- H01L2224/85399—Material
- H01L2224/854—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
- H01L2224/85438—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
- H01L2224/85444—Gold (Au) as principal constituent
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/91—Methods for connecting semiconductor or solid state bodies including different methods provided for in two or more of groups H01L2224/80 - H01L2224/90
- H01L2224/92—Specific sequence of method steps
- H01L2224/921—Connecting a surface with connectors of different types
- H01L2224/9212—Sequential connecting processes
- H01L2224/92122—Sequential connecting processes the first connecting process involving a bump connector
- H01L2224/92125—Sequential connecting processes the first connecting process involving a bump connector the second connecting process involving a layer connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/91—Methods for connecting semiconductor or solid state bodies including different methods provided for in two or more of groups H01L2224/80 - H01L2224/90
- H01L2224/92—Specific sequence of method steps
- H01L2224/922—Connecting different surfaces of the semiconductor or solid-state body with connectors of different types
- H01L2224/9222—Sequential connecting processes
- H01L2224/92242—Sequential connecting processes the first connecting process involving a layer connector
- H01L2224/92247—Sequential connecting processes the first connecting process involving a layer connector the second connecting process involving a wire connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2225/00—Details relating to assemblies covered by the group H01L25/00 but not provided for in its subgroups
- H01L2225/03—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00
- H01L2225/04—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers
- H01L2225/065—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers the devices being of a type provided for in group H01L27/00
- H01L2225/06503—Stacked arrangements of devices
- H01L2225/0651—Wire or wire-like electrical connections from device to substrate
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2225/00—Details relating to assemblies covered by the group H01L25/00 but not provided for in its subgroups
- H01L2225/03—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00
- H01L2225/04—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers
- H01L2225/065—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers the devices being of a type provided for in group H01L27/00
- H01L2225/06503—Stacked arrangements of devices
- H01L2225/06517—Bump or bump-like direct electrical connections from device to substrate
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2225/00—Details relating to assemblies covered by the group H01L25/00 but not provided for in its subgroups
- H01L2225/03—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00
- H01L2225/04—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers
- H01L2225/065—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers the devices being of a type provided for in group H01L27/00
- H01L2225/06503—Stacked arrangements of devices
- H01L2225/06582—Housing for the assembly, e.g. chip scale package [CSP]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2225/00—Details relating to assemblies covered by the group H01L25/00 but not provided for in its subgroups
- H01L2225/03—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00
- H01L2225/04—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers
- H01L2225/065—All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers the devices being of a type provided for in group H01L27/00
- H01L2225/06503—Stacked arrangements of devices
- H01L2225/06582—Housing for the assembly, e.g. chip scale package [CSP]
- H01L2225/06586—Housing with external bump or bump-like connectors
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/42—Wire connectors; Manufacturing methods related thereto
- H01L24/44—Structure, shape, material or disposition of the wire connectors prior to the connecting process
- H01L24/45—Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/0001—Technical content checked by a classifier
- H01L2924/00013—Fully indexed content
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01006—Carbon [C]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01013—Aluminum [Al]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01014—Silicon [Si]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01018—Argon [Ar]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01024—Chromium [Cr]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01027—Cobalt [Co]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01028—Nickel [Ni]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01029—Copper [Cu]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01047—Silver [Ag]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/0105—Tin [Sn]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01078—Platinum [Pt]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01079—Gold [Au]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/013—Alloys
- H01L2924/0132—Binary Alloys
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/013—Alloys
- H01L2924/0132—Binary Alloys
- H01L2924/01322—Eutectic Alloys, i.e. obtained by a liquid transforming into two solid phases
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/013—Alloys
- H01L2924/014—Solder alloys
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/06—Polymers
- H01L2924/0665—Epoxy resin
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/10—Details of semiconductor or other solid state devices to be connected
- H01L2924/102—Material of the semiconductor or solid state bodies
- H01L2924/1025—Semiconducting materials
- H01L2924/10251—Elemental semiconductors, i.e. Group IV
- H01L2924/10253—Silicon [Si]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/10—Details of semiconductor or other solid state devices to be connected
- H01L2924/11—Device type
- H01L2924/14—Integrated circuits
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/15—Details of package parts other than the semiconductor or other solid state devices to be connected
- H01L2924/151—Die mounting substrate
- H01L2924/1515—Shape
- H01L2924/15151—Shape the die mounting substrate comprising an aperture, e.g. for underfilling, outgassing, window type wire connections
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/15—Details of package parts other than the semiconductor or other solid state devices to be connected
- H01L2924/151—Die mounting substrate
- H01L2924/153—Connection portion
- H01L2924/1531—Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface
- H01L2924/15311—Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface being a ball array, e.g. BGA
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/15—Details of package parts other than the semiconductor or other solid state devices to be connected
- H01L2924/151—Die mounting substrate
- H01L2924/156—Material
- H01L2924/1579—Material with a principal constituent of the material being a polymer, e.g. polyester, phenolic based polymer, epoxy
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/15—Details of package parts other than the semiconductor or other solid state devices to be connected
- H01L2924/181—Encapsulation
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/20—Parameters
- H01L2924/207—Diameter ranges
- H01L2924/20751—Diameter ranges larger or equal to 10 microns less than 20 microns
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/30—Technical effects
- H01L2924/35—Mechanical effects
- H01L2924/351—Thermal stress
Landscapes
- Engineering & Computer Science (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Computer Hardware Design (AREA)
- Physics & Mathematics (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- General Physics & Mathematics (AREA)
- Manufacturing & Machinery (AREA)
- Encapsulation Of And Coatings For Semiconductor Or Solid State Devices (AREA)
- Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)
- Wire Bonding (AREA)
Abstract
能であり、かつ、ワイヤボンディングの際に荷重や超音
波出力によってフリップチップ接続されたチップのはん
だ接続部が損傷することのない、半導体装置パッケージ
およびその製造方法を提供する。 【解決手段】 第1のチップ1と第2のチップ2との裏
面が合わさった状態で、第1のチップ1の電極3と、電
極3に対応する第1の接続パッド6とを接続する際、第
1の接続パッド6より外側で、かつ、第2のチップ2の
電極4と接続するための第2の接続パッド7より内側の
領域に、第1の樹脂9を介在させる。その後、第2のチ
ップ2の電極4と第2の接続パッド7とをワイヤ8で接
続し、全体を第2の樹脂13でモールドする。
Description
半導体チップ(以下、「チップ」という)からなる半導
体装置を基板に搭載してなる半導体装置パッケージおよ
びその製造方法に関するものであり、特に、フリップチ
ップ方式によるCSP(Chip Size Package )に利用さ
れる半導体装置パッケージおよびその製造方法に関する
ものである。
半導体装置パッケージの高密度化、小型化、薄型化が必
要とされる。これらの要望に応えるべく考案された先行
技術として、特開昭63−84128の「混成集積回路
装置」がある。
置の構造を示す断面図である。図15を参照して、この
混成集積回路装置においては、LSIをベアチップのま
ま配線回路基板上に実装する、COX(Chip on X :X
は、有機フィルム、プリント基板、ガラス、シリコンウ
ェハ等の選択された基板の材料を指す)実装が行なわれ
ている。すなわち、厚膜基板21上に、第1のチップ1
が、ハンダ接続部22を介してフリップチップ方式によ
り接続されている。
同士を合わせた状態で接着剤15を介してダイボンディ
ングされ、さらに、厚膜基板21とワイヤ8を介してワ
イヤボンディング方式により接続されている。
ら全体を覆うように、チップコート樹脂20によりチッ
プコートされている。
(Surface Mount Device)40が、図に示すように、リ
ード41を介して実装されている。
に示す従来の実装構造では、チップが厚膜基板21に直
接実装されており、パッケージ化されていない。そのた
め、部品搭載後に一括リフローハンダ付けを行なう従来
のSMT(Surface Mount Technology)の工程のみで
は、厚膜基板上に図15に示す実装構造を構築すること
ができない。
るためには、各工場の既存のアセンブリラインに、ボン
ディング用装置、ダイボンディング用装置、ワイヤボン
ディング用装置、チップコート用装置等の専用ラインを
付加することが必要となる。そのため、大きな設備投資
が必要になるという問題点があった。
がパッケージ化されていないため、搭載したチップが実
装後に不良であることが判明した場合に、不良のチップ
のみを取り替えることが困難であるという問題点もあっ
た。
チップをフリップチップ方式により回路基板と接続した
後に、第2のチップをワイヤボンディングにより回路基
板と接続している。そのため、第2のチップのワイヤボ
ンディングの際に、荷重や超音波出力によって、フリッ
プチップ接続された第1のチップ1のハンダ接続部22
が損傷し、電気的な接続ができなくなるおそれがあると
いう問題点があった。さらに、実装構造全体を覆うよう
にチップコートすると、チップコート樹脂20の広がり
量が多くなるため、チップエッジからモールド外周まで
の長さ24が長くなってしまうという問題もあった。
プのみをフリップチップ実装する構造においては、熱膨
張係数の差による熱応力緩和のため、チップと基板との
間隙に樹脂を注入することが一般的であった。しかしな
がら、注入する樹脂の使用量については何ら検討されて
いなかった。
み、必然的に微細ピッチ化が進むと、当然チップと基板
との間隙は狭くなる。たとえば、積層型CSP(Chip S
ize Package )の場合、チップと配線との間隙が25〜
30μm、チップと基板との間隙が50μm程度といっ
たものが検討されている。したがって、このような狭い
間隙に封止樹脂を充填するためには、当然樹脂の粘度を
低くしなければならない。
るようにチップエッジに大きなフィレット(樹脂の流れ
だし)が形成されてしまうという問題が生じるおそれが
ある。
面を有する半導体装置を回路基板上に搭載する際の上述
の問題点を解決し、従来のSMT工程と同様の工程での
製造が可能な、半導体装置パッケージおよびその製造方
法を提供することにある。
の素子面上に形成された電極を回路基板上に接続する際
のワイヤボンディングによっても、フリップチップ接続
された第1の素子面上の電極と回路基板との接続部が損
傷されることのない、半導体装置パッケージおよびその
製造方法を提供することにある。
的低温で、かつ簡略な工程での製造が可能な、フリップ
チップ方式により接続された半導体装置とワイヤボンデ
ィング方式により接続された半導体装置の両方を備え
た、半導体装置パッケージおよびその製造方法を提供す
ることにある。
置パッケージは、第1および第2の素子面を有する半導
体装置を備え、半導体装置は、第1の素子面の周辺部に
形成された複数の第1の電極と、第2の素子面の周辺部
に形成された複数の第2の電極とを含み、第1および第
2の面を有し、半導体装置を搭載する回路基板をさらに
備え、回路基板は、第1の面上に半導体装置の第1の電
極にそれぞれ対応して配置された、複数の第1の接続パ
ッドと、第1の面上の第1の接続パッド外周に形成され
た、複数の第2の接続パッドと、第1および第2の接続
パッドとそれぞれ電気的に接続された複数の外部入出力
端子とを含み、第1の素子面と回路基板との間隙に設け
られる第1の樹脂と、第1の接続パッドと、対応する第
1の電極とをそれぞれフリップチップ方式で接続する複
数の接着用金属部材と、第2の接続パッドと、対応する
第2の電極とをそれぞれ接続する金属細線と、半導体装
置全体を覆うようにモールドされた第2の樹脂とをさら
に備える。
するため、他のSMD(Surface Mount Device)と同
様、従来のSMT工程で対応が可能となる。
に形成された第1の電極は回路基板上にフリップチップ
方式でベアチップ実装され、第1の素子面と回路基板と
の間には第1の樹脂が介在される。この第1の樹脂の介
在により、第2の素子面上に形成された第2の電極を接
続するためのワイヤボンディング時の荷重や超音波出力
によって、フリップチップ接続された第1の素子面上に
形成された第1の電極と回路基板との接続部が損傷し、
電気的な接続ができなくなることが防止される。
回路基板との熱膨張係数の差が大きい場合に、熱膨張係
数の違いから生じる熱応力を緩和する作用もある。
請求項1記載の半導体装置パッケージの構成において、
半導体装置は、2つの半導体チップの裏面どうしが合わ
さった状態で構成される。
請求項1記載の半導体装置パッケージの構成において、
半導体装置は、1つの半導体チップの両面に素子面が形
成されて構成される。
請求項1〜3のいずれかに記載の半導体装置パッケージ
の構成において、第1の樹脂は、その外周部が、第1の
接続パッドが形成された領域より外側で、かつ、第2の
接続パッドが形成された領域の内側の領域まで広がるよ
うに、第1の素子面と回路基板の間隙に介在する。
請求項1〜3のいずれかに記載の半導体装置パッケージ
の構成において、第1の樹脂は、その外周部が、第1の
接続パッドが形成された領域よりも内側において、第1
の素子面と回路基板の間隙に介在する。
題点に着目し、第1の樹脂の流れだし領域を小さくし、
第1の素子面と回路基板に介在される樹脂を所定の領域
内に限定した点に特徴がある。
請求項1〜5のいずれかに記載の半導体装置パッケージ
の構成において、第1の樹脂は熱可塑性樹脂であり、第
2の樹脂は熱硬化性樹脂である。
熱性を有し、熱膨張率が−10〜100ppm程度の材
料が好ましい。具体的には、たとえば、ポリイミド等を
用いることができる。また、第1の樹脂は、熱可塑性樹
脂に限らず、常温での粘度が高ければ、たとえばエポキ
シ等の熱硬化性樹脂も用いることができる。
エポキシ等を用いることができる。また、第2の樹脂と
して、従来から一般のLSIパッケージに用いられてい
るモールド樹脂を使用することにより、現行のプロセス
と整合性のすぐれたアセンブリ工程を実現できる。
請求項1〜6のいずれかに記載の半導体装置パッケージ
の構成において、接着用金属部材は、Auを主成分とす
る。
請求項1〜6のいずれかに記載の半導体装置パッケージ
の構成において、接着用金属部材は、第1の金属からな
る第1部分と、第2の金属からなる第2部分とを含む。
請求項8記載の半導体装置パッケージの構成において、
第1部分はAuを主成分とする金属からなり、第2部分
はハンダからなる。
は、請求項1〜9のいずれかに記載の半導体装置パッケ
ージの構成において、外部入出力端子は、回路基板の第
2の面上にマトリクス状に配置され、各外部入出力端子
は、第2の面上に設けられる第3の接続パッドと、第3
の接続パッド上に設けられるハンダボールにより形成さ
れる。
は、請求項1〜9のいずれかに記載の半導体装置パッケ
ージの構成において、回路基板はマトリクス状に配置さ
れた接続用の開口を有し、外部入出力端子は、開口を通
して第1および第2の接続パッドに接続されるハンダボ
ールにより形成されている。
製造方法は、第1および第2の素子面を有する半導体装
置が回路基板上に搭載されてなる半導体装置パッケージ
の製造方法であって、第1の素子面の周辺部に形成され
た第1の電極と、回路基板の第1の面上に形成された第
1の接続パッドとを、接着用金属部材を介してフリップ
チップ方式により、かつ、第1の素子面と回路基板との
間隙部分に第1の樹脂を介在して接続するステップと、
第2の素子面の周辺部に形成された第2の電極と、回路
基板の第1の面上において、第1の接続パッドよりも外
側の部分に形成された第2の接続パッドとを、金属細線
を介してワイヤボンディング方式により、接続するステ
ップと、回路基板上に搭載された半導体装置全体を覆う
ように第2の樹脂をモールドするステップと、回路基板
に設けられた複数の第3の接続パッド上に、それぞれ球
状の接着用金属部材を設けるステップとを備える。
製造方法は、請求項12記載の半導体装置パッケージの
製造方法の構成において、第1の素子面と回路基板との
間隙部分に第1の樹脂を介在して接続するステップは、
第1の素子面の中央部に第1の樹脂を塗布するステップ
と、第1の電極と第1の接続パッドとを接続するステッ
プとを含む。
製造方法は、請求項13記載の半導体装置パッケージの
製造方法の構成において、第1の樹脂を塗布するステッ
プは、シート形状を有する第1の樹脂を第1の素子面の
中央部に配置する。
方法としては、たとえば、樹脂の粘度、ガラス転移温度
など、樹脂特性によって影響される樹脂の広がり量を考
慮して決定された所定の量からなる所定の大きさに切り
分けたシートを、第1の素子面上に置くか、もしくは、
仮圧着させるとよい。
製造方法は、請求項12記載の半導体装置パッケージの
製造方法の構成において、第1の素子面と回路基板との
間隙部分に第1の樹脂を介在して接続するステップは、
回路基板の中央部に第1の樹脂を塗布した回路基板を準
備するステップと、第1の電極と第1の接続パッドとを
接続するステップとを含む。
製造方法は、請求項15記載の半導体装置パッケージの
製造方法の構成において、回路基板を準備するステップ
は、シート形状を有する第1の樹脂を回路基板の中央部
に配置する。
製造方法は、請求項12〜16のいずれかに記載の半導
体装置パッケージの製造方法の構成において、第1の素
子面と回路基板との間隙部分に第1の樹脂を介在して接
続するステップにおいて、第1の樹脂の外周部が、第1
の接続パッドが形成された領域より外側で、かつ、第2
の接続パッドが形成された領域の内側の領域まで広がっ
て介在されるように、第1の樹脂の使用量を調整する。
製造方法は、請求項12〜16のいずれかに記載の半導
体装置パッケージの製造方法の構成において、第1の素
子面と回路基板との間隙部分に第1の樹脂を介在して接
続するステップにおいて、第1の樹脂の外周部が、第1
の接続パッドが形成された領域よりも内側に介在される
ように、第1の樹脂の使用量を調整する。
製造方法は、請求項18記載の半導体装置パッケージの
製造方法の構成に加えて、第2の電極と第2の接続パッ
ドとを接続した後であって、第2の樹脂をモールドする
前に、半導体装置を試験して、不良であれば搭載した半
導体装置を回路基板から取り外すステップと、半導体装
置を回路基板から取り外した場合には、半導体装置とは
異なる他の半導体装置の第1の素子面の周辺部に形成さ
れた第1の電極と、回路基板の第1の面上に形成された
第1の接続パッドとを、接着用金属部材を介してフリッ
プチップ方式により、かつ、第1の素子面と回路基板と
の間隙部分に第1の樹脂を介在して接続するステップ
と、半導体装置を回路基板から取り外した場合には、他
の半導体装置の第2の素子面の周辺部に形成された第2
の電極と、回路基板の第1の面上において、第1の接続
パッドよりも外側の部分に形成された第2の接続パッド
とを、金属細線を介してワイヤボンディング方式によ
り、接続するステップとをさらに備える。
製造方法は、請求項12〜19のいずれかに記載の半導
体装置パッケージの製造方法の構成において、接着用金
属部材は、第1の金属からなる第1部分と、第2の金属
からなる第2部分とを含む。
製造方法は、請求項20記載の半導体装置パッケージの
製造方法の構成において、第1の電極と第1の接続パッ
ドとをフリップチップ方式により接続するステップは、
第1の接続パッド上にハンダを供給するステップと、第
1の電極上にAuを主成分とする金属からなるバンプを
形成するステップと、第1の接続パッド上に供給された
ハンダを加熱して溶融させることにより、第1の電極と
第1の接続パッドとを接続するステップとを含む。
製造方法は、請求項21記載の半導体装置パッケージの
製造方法の構成において、第1の接続パッド上にハンダ
を供給するステップは、ハンダをボールボンディング法
により供給する。
製造方法は、請求項21記載の半導体装置パッケージの
製造方法の構成において、第1の接続パッド上にハンダ
を供給するステップは、ハンダをウェッジボンディング
法により供給する。
製造方法は、請求項21〜23のいずれかに記載の半導
体装置パッケージの製造方法の構成に加えて、第1の接
続パッド上に供給されたハンダにフラックスを塗布した
後、リフロー炉に流し、ハンダの形状を半球状に整える
ステップをさらに含む。
第2の素子面を有する半導体装置を搭載して半導体装置
パッケージを製造するための回路基板であって、第1お
よび第2の面を有し、少なくとも一つの貫通孔を有する
基材と、第1の素子面の周辺部に形成された第1の電極
との接続のために形成され、第1の面上に貫通孔を囲む
ように配置される第1の接続パッドと、第2の素子面の
周辺部に形成された第2の電極との接続のために、第1
の面上の第1の接続パッドよりも外側の部分に形成され
た第2の接続パッドと、第1の接続パッドに囲まれる領
域上に塗布された第1の樹脂とを備える。
記載の回路基板の構成において、基材は、200°C以
上のガラス転移温度を有する樹脂から成り、回路基板
は、第3の接続パッドと、第3の接続パッドの各々と、
対応する第1または第2の接続パッドとを接続する金属
配線とをさらに含む。
の実施の形態1の半導体装置パッケージの構造を示す断
面図である。
ジにおいては、回路基板19上に、第1のチップ1と第
2のチップ2とが搭載されている。この第1のチップ1
と第2のチップ2とは、その裏面どうしが接着剤15に
より接着されている。なお、この半導体パッケージにお
いて、第1のチップ1と第2のチップ2との組合せの例
としては、16M FLASHメモリと2M SRAM
とを挙げることができる。
の電極3が形成されている。第2のチップ2の周辺部に
は、複数の第2の電極4が形成されている。
路基板の表面上の第1の接続パッド6とは、金属部材5
を介してフリップチップ方式により接続されている。第
2のチップ上に形成された電極4と、回路基板上の表面
上の第1の接続パッド6より外周に形成された第2の接
続パッド7とは、金属ワイヤ8を介してワイヤボンディ
ング方式により接続されている。第1および第2のチッ
プ1、2は、さらにその全体が覆われるように、第2の
樹脂13によりモールドされている。
続パッド30がマトリクス状に形成され、第3の接続パ
ッド30上には、ハンダボール26が形成されている。
周部が、第1の接続パッド6が形成された領域より外側
で、かつ、第2の接続パッド7が形成された領域の内側
の領域まで広がるように、第1の樹脂9が、第1のチッ
プ1と回路基板19との間隙に介在されている。
が、厚膜基板21上に実装された状態を示す断面図であ
る。図2を参照して、図1に示す半導体装置パッケージ
は、ハンダボール26を介して厚膜基板21と接続され
ている。
ッケージの製造方法について、図面を用いて説明する。
ージに用いられる回路基板の一例を示す図であり、図3
(a)は平面図であり、図3(b)は断面図である。図
3を参照して、この回路基板19においては、その表面
上に、第1のチップの電極との接続のために、複数の第
1の接続パッド6が形成されている。さらに、第1の接
続パッド6の外周には、第2のチップの電極との接続の
ために、第2の接続パッド7が形成されている。
ド7とは、たとえば、第1の接続パッド6aと第2の接
続パッド7aとのように、互いにつながっていてもよ
い。また、第1の接続パッド6と第2の接続パッド7と
の配列は、必ずしも図に示すものに限定されない。
には、第1の樹脂9が塗布されている。また、第1の接
続パッドに囲まれる領域の基板には、少なくとも1つの
貫通孔27が形成されている。この貫通孔27は、第1
の樹脂9が吸湿後のリフローにより膨張することを防止
する働きがある。
を製造する工程の一例を示す図である。
す回路基板19の接続パッド6上に、金属部材5により
金属突起電極を形成する。本実施の形態においては、回
路基板としては、ガラス転移温度が200℃以上のポリ
イミドと金属配線等によって構成される基板を用いる。
ワイヤボンダを用いて、直径約80μm程度の金属突起
電極を形成する。なお、金属突起電極の形成には、めっ
き法などを用いてもよい。
と回路基板19との間隙に第1の樹脂9を介在させる方
法として、第1の樹脂9をシート状にして、予め回路基
板19の中央部に塗布する方法を用いる。
脂シート9として、5.8mm角の鐘淵化学工業株式会
社製の熱可塑性ポリイミドフィルムTP−Tを使用す
る。この樹脂は、ガラス転移温度(Tg)が190℃
で、接続温度(約300℃)付近での引っ張り弾性率
(試験方法:ASTM D882)が0.1〜10MP
aという特性を有している。
なお、第1の樹脂9の塗布方法は、これに限らず、液状
の第1の樹脂9を用いて、ディスペンサなどにより一定
量をポッティングしてもよい。
と回路基板との間隙部分に第1の樹脂を介在させる方法
としては、たとえば、図16に示すように、チップ1の
エッジに液状の封止樹脂9をポッティングし、毛管現象
を利用して、チップ1と回路基板19の間隙に封止樹脂
9を浸透させる方法がある。この方法は、最も簡単では
あるが、回路基板19にポッティング領域10を確保す
る必要がある。回路基板19に形成された第1の接続パ
ッド6と第2の接続パッド7とが離れていれば、ポッテ
ィング領域10を十分に確保することができる。
ップサイズに近づけたパッケージであるCSPでは、チ
ップエッジとパッケージエッジとの距離23が短いた
め、チップ1の電極3がチップ1の周辺部に形成されて
いる場合には、第1の接続パッド6と第2の接続パッド
7が近づいてしまう。したがって、第2の接続パッド7
が、ポッティング領域10と重なってしまう。その結
果、図17に示すように、第2の接続パッド7の上に第
1の樹脂9が被ってしまうという問題が生じる。
するためではなく、気泡の発生しない封止方法として考
案された先行技術として、特開平6−89914に開示
された技術がある。
回路基板1の中央部に熱可塑性樹脂9を塗布し、仮硬化
させる。その後、チップ1の電極3と回路基板19の第
1の接続パッド6とを位置合わせする。さらに、チップ
1の電極3と回路基板19の第1の接続パッド6とが接
触する方向に加圧し、熱可塑性樹脂9を加熱溶融して周
辺へ一様に拡散させる。この方法を利用すれば、ポッテ
ィング領域が十分に確保できなくても、樹脂封止が可能
であるとも考えられる。
封止領域の限定は行なわず、樹脂の塗布量や粘度の制御
は何ら行なっていないため、チップエッジの外周に樹脂
の流れ出しによる大きなフィレット11が形成されるお
それがある。このため、前述の樹脂封止方法と同様に、
CSPのようなベアチップのサイズにより近いパッケー
ジでは、回路基板の大きさがチップ外径とほぼ等しいた
め、フィレットが回路基板のほぼ全周に形成されてしま
う。
続パッド7の上に第1の樹脂9が被ってしまうという問
題が生じる。
9に示すような状態のまま、さらに第2のチップ2が搭
載された回路基板を金型12で押さえ、モールド樹脂1
3を流し込み成形する場合には、上記フィレット11に
より金型12の気密性が維持できず、モールド樹脂13
が外部に流れ出てしまうという問題が生じる。加えて、
第1の樹脂9に熱膨張係数を小さくするためのSiCな
どのフィラー25が含有されている場合には、該フィラ
ー25が固いので、金型12を損傷する可能性も有す
る。
接続パッド6と第2の接続パッド7とが、十分に離れて
いれば、上記の2種類のいずれの樹脂封止方法を利用し
てもよいのであるが、パッケージをより小さくチップサ
イズに近づけたパッケージであるCSPに本発明を適用
する場合には、新たに上述のような課題が発生する。該
課題を解決するため、第1の樹脂の使用量を調整する必
要が生じる。
mm3 以上、1.6mm3 以下とし、たとえば1.2〜
1.4mm3 と制御して、塗布する。
ップ1と第2のチップ2とを接着剤15で裏面同士を接
続した状態で、回路基板19上に搭載する。このとき、
第1の樹脂9は、中央から周辺に広がる。なお、後述の
実施の形態2のように、リペアを考慮して、第1の接続
パッド6を覆わないように、第1の樹脂9の塗布量や樹
脂特性を制御することもできる。
証されたチップ)が保証されていれば、リペアの可能性
が少なくなるので、この例のように第1の樹脂9の介在
領域を、その周辺部が回路基板19に形成された第1の
接続パッド6より外側で、かつ、第2の接続パッド7が
形成された領域より内側の領域まで広がるように制御す
ることが好ましい。本実施の形態では、6.3mm角の
チップ1を使用し、回路基板19との間隙を30μmと
する。
の接続パッド上にAuからなる金属突起電極を形成す
る。
常Al−1%Siであることから、Au−Alの熱圧着
を用いて、金属間の接合が行なわれることになる。その
ため、接続温度を低くすることができる。したがって、
この方法は、回路基板が薄く、熱による反りやうねりを
生じやすい場合に有効である。
プの電極との電気的接続を得るための他の接続方法とし
ては、第1の樹脂9として、熱硬化性で、かつ熱収縮性
を有する樹脂を用いた場合、該樹脂を硬化させることに
より、金属突起電極と電極とを圧接して、電気的接続を
得てもよい。
上に搭載する方法としては、たとえば、第1のチップを
基板上に搭載後、裏面にダイボンド剤(接着剤)を塗布
し、その上に第2のチップを搭載して加熱硬化する方法
がある。他に、予め第1のチップと第2のチップの裏面
どうしをダイボンド剤で接着しておいて、その後回路基
板上に搭載する方法を用いることも可能である。また、
ダイボンド剤としては、液状のもの、シート状のもの等
を用いることができる。さらに、加熱硬化方法として
は、ツール加熱、オーブン加熱等を用いることができ
る。
ップの電極4と、回路基板19の電極に対応する第2の
接続パッド7とを、金属ワイヤ8を介してワイヤボンド
法によって電気的に接続する。なお、電気的接続は、ワ
イヤを用いる他、リードを用いても行なうことができ
る。
の他の例として、図4(b)の段階で第2のチップを搭
載せず、第2のチップをTCP(Tape Carrier Pakage
)とし、OLB(Outer Lead Bonding)技術を用い
て、回路基板との電気接続を行なってもよい。
(c)で形成されたワイヤ接続部を含む搭載面を、熱硬
化性の第2の樹脂13でモールドする。本実施の形態に
おいて、モールドは、金型を被せ、第2の樹脂13を約
180℃で注入し、140〜150℃のオーブンで4〜
5時間で硬化する。なお、モールドは、該方法に限ら
ず、全体に液状の封止樹脂をポッティングする方法を用
いてもよい。
の裏面上ににマトリクス状に形成された第3の接続パッ
ド30上に、ハンダボール26を形成する。外部入出力
端子をこのように回路基板の裏面に形成することによ
り、パッケージの周囲に外部入出力端子を配置するより
も、端子数を増やすことができる。なお、外部入出力端
子は、この構造に限らず、周辺にリードを配置した構造
でもよい。
導体装置パッケージ(CSP)の外径は、8mm角とな
る。
ケージを製造する工程の他の例を示す図である。
1の電極3上に、金属部材5により金属突起電極を形成
する。
0μmのAuワイヤを使用し、ワイヤボンダを用いて、
直径約80μm程度の金属突起電極を形成する。なお、
金属突起電極の形成には、めっき法などを用いてもよ
い。
基板19との間隙に第1の樹脂19を介在させる方法と
して、第1の樹脂9をシート状にして、予め第1のチッ
プ1の中央部に塗布する方法を用いる。このとき、第1
の樹脂シート9としては、熱可塑性を有する4mm角の
樹脂を使用する。樹脂特性として、ガラス転移温度(T
g)が223℃で、接続時温度(約400℃)付近での
引っ張り弾性率が8〜9MPaの樹脂を使用する。
する。なお、樹脂の塗布方法は、これに限らず、液状の
第1の樹脂9を用いて、ディスペンサなどにより一定量
をポッティングしてもよい。
1mm3 以下とし、たとえば0.5〜0.7mm3 と制
御して、塗布する。
ップと第2のチップ2とを接着剤15で裏面同士が接着
された状態で、回路基板19上に搭載する。
に広がるが、第1の接続パッド6を覆わないように、図
5(a)の塗布時に粘度などの樹脂特性を考慮して樹脂
量を制御する。
1を使用し、回路基板19との間隙を30μmとする。
しては、BTレジン(ビスマレイミド トリアジン:シ
アネート樹脂またはその混合樹脂の三菱ガス化学(株)
の商品名)と金属配線からなるフレキシブル基板を用い
る。
ド樹脂硬化のため、回路基板19には約180℃の温度
がかかる。したがって、基板のガラス転移温度は200
℃以上とする。
の第1の配線パッド6の最表面がAuであり、上記の金
属突起電極もAuであることから、Au−Auの熱圧着
を用いて、金属間の接合により、金属部材5を介して電
極3と第1の配線パッド6との電気的接続を得る。他の
接続方法として、第1の樹脂9を熱硬化性でかつ熱収縮
性を有する樹脂とした場合には、該樹脂を硬化させるこ
とにより、金属部材5を介して電極3と第1の配線パッ
ド6とを圧接して、電気的接続を得ることもできる。
ップ2の電極4と、回路基板19の電極4に対応する第
2の接続パッド7とを、金属ワイヤ8を介してワイヤボ
ンド法によって電気的に接続する。
の他の例として、図5(b)の段階で第2のチップを搭
載せず、第2のチップをTCP(Tape Carrier Pakage
)とし、OLB(Outer Lead Bonding)技術を用い
て、回路基板との電気的接続を行なってもよい。
の電気的試験を行ない、不良であればリペアすることが
できる。リペア工程を図6(a)〜(f)に示す。
に示す段階で電気的試験で不良となった積層チップ16
を示す図である。
該不良の積層チップ16を取り除く。このとき、この実
施の形態では、第1の樹脂は、第1の接続パッド6が形
成された領域よりも内側にのみ介在されている。そのた
め、積層チップ16を取り除いても、第1の接続パッド
6が損傷を受けることがない。
(a)に示す工程と同様に、第1のチップ1に対応する
交換用チップの電極上に、金属部材5により金属突起電
極を形成し、中央部に樹脂を塗布する。
(b)および(c)に示す工程と同様に、交換用積層チ
ップ17を回路基板19上に搭載する。
下の図5(d)および(e)に示す工程と同様であるの
で、その説明は省略する。
プ1に形成した金属突起電極5の周辺に存在する第1の
樹脂9の未充填部と、図5(c)で形成されたワイヤ接
続部を含む搭載面を、熱硬化性の第2の樹脂13でモー
ルドする。本実施の形態において、モールドは、金型を
被せ、第2の樹脂13を約180℃で注入し、140〜
150℃のオーブンで4〜5時間硬化する。
に液状の封止樹脂をポッティングする方法を用いてもよ
い。
の裏面上にマトリクス状に形成された第3の接続パッド
30上に、ハンダボール26を形成する。外部入出力端
子をこのように回路基板の裏面に形成することにより、
パッケージの周囲に外部入出力端子を配置するよりも、
端子数を増やすことができる。なお、外部入出力端子
は、この構造に限らず、周辺にリードを配置した構造で
もよい。
導体装置パッケージ(CSP)の外径は、8mm角とな
る。
ケージを製造する工程のさらに他の例を示す図であり、
両面に素子を形成したチップを封止したパッケージの製
造方法を示す図である。
つのチップの表面と裏面に素子面を形成したチップを、
実施の形態1または2の工程に使用される2つのチップ
と置換え、本発明のパッケージの製造方法を用いること
により、該形態の特徴を損なうことなく、パッケージの
高さを低くすることができる。
8の片面の電極3上に、金属部材5により金属突起電極
を形成した。本実施の形態においては、φ20μmのA
uワイヤを使用し、ワイヤボンダを用いて、直径約80
μm程度の金属突起電極を形成する。なお、金属突起電
極の形成は、めっき法などを用いてもよい。
に、チップ18の中央部に樹脂を介在させる方法とし
て、第1の樹脂9をシート状にして、予めチップ18の
中央部に塗布する。
たとえば熱可塑性を有する4mm角の樹脂を使用する。
樹脂特性として、たとえばガラス転移温度(Tg)が2
23℃で、接続時温度(約400℃)付近での引っ張り
弾性率が8〜9MPaの樹脂を使用する。
ば40μmとする。なお、樹脂の塗布方法は、これに限
らず、液状の第1の樹脂9を用い、ディスペンサなどに
より一定量をポッティングしてもよい。本実施の形態で
は、樹脂量を1mm3 以下とし、たとえば0.5〜0.
7mm3 と制御して、塗布する。
8を回路基板19上に搭載した。このとき、上記の第1
の樹脂9は、中央から周辺に広がるが、第1の接続パッ
ド6を覆わないように、図7(a)の塗布時に粘度など
の樹脂特性を考慮して樹脂量を制御する。本実施の形態
では、6.3mm角のチップを使用し、回路基板との間
隙を30μmとする。
リイミドと金属配線とからなるフレキシブル基板を用い
る。
脂硬化のため、回路基板19には約180℃の温度がか
かる。したがって、基板のガラス転移温度は、200℃
以上とする。
の第1の配線パッド6の最表面がAuであり、上記の金
属突起電極もAuであることから、Au−Auの熱圧着
を用いて、金属間の接合により、金属部材5を介して、
電極3と第1の配線パッド6との電気的接続を得る。
化性でかつ熱収縮性を有する樹脂とした場合には、該樹
脂を硬化させることにより、金属部材5を介して電極3
と第1の配線パッド6とを圧接して、電気的接続を得る
こともできる。
8の上面の電極4と、回路基板19の電極4に対応する
第2の接続パッド7とを、金属ワイヤ8を介して、ワイ
ヤボンド法によって電気的に接続する。
気的接続方法の他の例として、図7(b)の段階で予め
チップ18をTCP(Tape Carrier Pakage )とし、金
属突起電極の接合と同時に、OLB(Outer Lead Bondi
ng)技術を用いて、回路基板との電気的接続を行なって
もよい。
試験を行ない、不良であればリペアすることができる。
リペア工程は、実施の形態2で説明した図6(a)〜
(f)とほぼ同様であるので、その説明は繰り返さな
い。
8に形成した金属突起電極5の周辺に存在する第1の樹
脂9の未充填部と、図7(c)で形成されたワイヤ接続
部を含む搭載面を、熱硬化性の第2の樹脂13でモール
ドする。
を被せ、第2の樹脂13をたとえば約180℃で注入
し、140〜150℃のオーブンで4〜5時間で硬化す
る。なお、モールドは、該方法に限らず、全体に液状の
封止樹脂をポッティングする方法を用いてもよい。
の裏面上にマトリクス状に形成された第3の接続パッド
30上に、ハンダボール26を形成する。外部入出力端
子をこのように回路基板の裏面に形成することにより、
パッケージの周囲に外部入出力端子を配置するよりも、
端子数を増やすことができる。なお、外部入出力端子
は、この構造に限らず、周辺にリードを配置した構造で
もよい。
導体パッケージ(CSP)の外径は、8mm角となる。
形態4の半導体装置パッケージの構造を示す断面図であ
る。
ジにおいては、回路基板19に、複数の接続用の開口2
8がマトリクス状に形成されている。そして、この開口
28にハンダボール26が埋込まれている。
26が、回路基板19の表面上に形成された第1および
第2の接続パッド6、7と接続されることにより、外部
入出力端子が形成されている。
施の形態1の半導体装置パッケージと同様であるので、
その説明は省略する。
に用いられる回路基板を示す図であり、図9(a)は平
面図であり、図9(b)は断面図である。
ては、その表面上に、第1のチップの電極との接続のた
めに、複数の第1の接続パッド6が形成されている。さ
らに、第1の接続パッド6の外周には、第2のチップの
電極との接続のために、第2の接続パッド7が形成され
ている。
の接続パッド6の内側に、さらに第3の接続パッド67
が形成されている。この第3の接続パッド67と第1の
接続パッド6とは、たとえば、第3の接続パッド67b
と第1の接続パッド6bとのように、互いにつながって
いてもよい。また、図示しないが、第2の接続パッドも
同様に第3の接続パッドにつながっていてもよく、この
場合、第1の接続パッドの間に配線が通ることになる。
6、7、67が形成された部分に対応する基板の部分に
は、接続用の開口28が形成されている。この開口28
にハンダボールが埋込まれて、図8に示すように外部入
出力端子が形成される。
の接続パッド67を形成したのは、次の理由による、す
なわち、第1および第2の接続パッド6、7に対応する
部分にハンダボール26を形成する際、形成されたハン
ダボールどうしが接近してしまう恐れがある。この場合
に、第1の接続パッド6と第3の接続パッド67とをつ
なげば、ハンダボールを第3の接続パッド67に対応し
た部分にさえ形成すれば、第1の接続パッド6には必ず
しもハンダボールを形成する必要がなくなる。その結
果、各ハンダボール間の距離を広くとることができる。
また、第2の接続パッドと第3の接続パッドとの関係も
同様である。
3の接続パッド67とがつながっている場合にも、いず
れの接続パッドに対応する部分にもハンダボールが形成
されている。しかしながら、第1および第3の接続パッ
ドがつながっている場合には、少なくとも一方の接続パ
ッドに対応する部分にのみハンダボールを形成すればよ
く、必ずしも両方の接続パッドに対応する部分にハンダ
ボールを形成する必要はない。
されたすべての部分に対応するように、基板に開口28
が形成されている。しかしながら、たとえば、第1の接
続パッド6bと第3の接続パッド67bとのように接続
パッドが互いにつながっている場合には、少なくとも一
方の接続パッドが形成された部分に対応する基板の部分
にのみ開口28が形成されていればよい。
に示すものに限定されない。なお、他の構成について
は、図3に示す実施の形態1の回路基板と同様であるの
で、その説明は省略する。
の形態5の半導体装置パッケージの構造を示す断面図で
ある。
ージにおいては、接着用金属部材5が、Auを主成分と
する金属からなる第1部分55と、ハンダからなる第2
部分65という、2つの種類が異なる金属部分から構成
されている。また、第1の接続パッドに囲まれる領域の
基板には、複数の貫通孔27が形成されている。
施の形態1の半導体装置パッケージと同様であるので、
その説明は省略する。
ージに用いられる回路基板を示す図であり、図11
(a)は平面図であり、図11(b)は断面図である。
いては、貫通孔27が複数個形成されている。
施の形態1の回路基板と同様であるので、その説明は省
略する。
ッケージの製造方法について、図面を用いて説明する。
ージを製造する工程の一例を示す断面図である。
に示す半導体装置パッケージの第1のチップ1上の第1
の電極3上に、接着用金属部材の第1部分55として、
金属突起電極を形成する。本実施の形態においては、一
例としてφ20μmのAuワイヤを使用し、ワイヤボン
ダを用いて、直径約80μm程度の金属突起電極を形成
する。なお、金属突起電極の形成には、めっき法などを
用いてもよい。
に示す回路基板19の第1の接続パッド6上に、ボール
ボンディング法によりハンダを供給し、接着用金属部材
の第2部分65としてハンダ突起電極を形成する。本実
施の形態においては、回路基板としては、ガラス転移温
度が200℃以上のポリイミドと金属配線等によって構
成される基板を用いる。また、ハンダの供給には、Sn
97%−Ag3%の組成で、融点221℃、φ40μm
のハンダワイヤを使用し、ワイヤボンダを用いて行な
う。
を放電により加熱してボールを形成し、酸化防止のた
め、Ar−10%H2 還元雰囲気中にて、回路基板19
の第1の接続パッド6にボールを熱圧着後、そのボール
とワイヤを引きちぎり、底部65aの直径が約120〜
140μm程度となるハンダ突起電極65を形成する。
によりハンダ突起電極を形成する方法を説明するための
断面図であり、図12(b)に対応する工程を示す図で
ある。
法では、放電による加熱工程を必要とせず、また、還元
ガスを用いることもなく、ハンダワイヤをウェッジにて
直接第1の接続パッド6上につぶし、超音波によって圧
着後、ワイヤ切断し、底部65aの幅が80μm、厚さ
が20μm程度のハンダ突起電極65を形成する。
ハンダ突起電極65のテイル65bが著しく長く、ボン
ディング時に支障を来す場合には、ハンダ突起電極65
に、ぬれ拡がりを小さくすることができるRMAタイプ
のフラックスを塗布し、回路基板19をピーク温度23
0℃のリフロー炉に流すことにより、図14に示すよう
にハンダ突起電極65の形状をほぼ半球状に整えること
ができる。
3%の組成のものに限らず、他の組成のAgとSnの合
金、あるいは、共晶ハンダなどの他の合金を用いること
もできる。
と回路基板19との間隙に第1の樹脂9を介在させる方
法として、第1の樹脂9をシート状にして、予め回路基
板19の中央部に配置する方法を用いる。また、この実
施の形態では、第1の樹脂シート19として、厚みが3
0μmのエポキシ系の接着シートを使用する。
の融点以上に加熱してハンダ突起電極65を溶融させた
回路基板19上に、第1のチップ1を搭載して、第1の
電極3と第1の接続パッド6とを接続する。その後、第
1のチップ1の裏面にダイボンド剤(接着剤)15を塗
布し、その上に第2のチップ2を搭載して加熱硬化す
る。
に搭載する際に、第1の樹脂9は中央から周辺に広がる
が、溶融したハンダ突起電極65を押し流してしまうこ
とがないように、図12(b)の塗布時に粘度などの樹
脂特性を考慮して塗布量を制御することが好ましい。ま
た、回路基板19が非常に薄く、基板19の温度をハン
ダの融点以上に加熱すると、うねりや反りが大きくなる
場合には、第1のチップ1の方をハンダの融点以上に加
熱し、接着用金属部材の第1部分55がハンダ突起電極
65に接触する際にハンダを溶かし、第1の電極3と第
1の接続パッド6とを接続する。あるいは、回路基板1
9側の加熱温度をハンダの融点以下にしつつ、第1のチ
ップ1側も加熱して、最適な温度条件にて接続を行なう
こともできる。
チップ2の第2の電極4と、その電極4に対応する回路
基板19の第2の接続パッド7とを、金属ワイヤ8を介
してワイヤボンド法によって電気的に接続する。なお、
電気的接続は、このようにワイヤを用いる他、リードを
用いても行なうことができる。
(d)で形成されたワイヤ接続部を含む搭載面を、熱硬
化性の第2の樹脂13でモールドする。本実施の形態に
おいて、モールドは、金型を被せ、第2の樹脂13を約
180℃で注入し、140〜150℃のオーブンにて4
〜5時間で硬化する。なお、モールドは、該方法に限ら
ず、全体に液状の樹脂をポッティングする方法を用いて
もよい。
板19の裏面上にマトリックス状に形成された第3の接
続パッド30上に、ハンダボール26を形成する。外部
入出力端子をこのように回路基板19の裏面に形成する
ことにより、パッケージの周囲に外部入出力端子を配置
するよりも、端子数を増やすことができる。なお、外部
入出力端子は、この構造に限らず、周辺にリードを配置
した構造でもよい。
回路基板にフリップチップ方式にて接続する際の接着用
金属部材としてAuを用い、接合部をAu−Au接合、
あるいはAu−Al接合とした場合よりも、いずれもボ
ンディング温度を400℃未満までさらに低くすること
ができる。
用金属部材にハンダを用いた場合、ハンダとAlは接合
が困難なので、第1のチップ1のAl電極3の上に、た
とえば接着層としてCr層を、さらにその上に拡散防止
層としてCu、Ni層をめっき法や真空蒸着法にて形成
する必要が生ずる場合があるが、この実施の形態におい
ては、その必要がない。したがって、工程の増加を抑制
し、コストアップも生じない。
いて、第1の接続パッド6にハンダを供給し、第1のチ
ップ1の第1の電極3にはボールボンディング法にてA
uを主成分とする金属突起電極を設け、それらをフリッ
プチップ方式にて接続し、Au−ハンダ接合にてボンデ
ィング温度を低くする方法があり、このときのハンダ供
給法としては、印刷法が考えられる。この場合、微細、
狭ピッチパッドに対し安定して精度よく微量のクリーム
ハンダを供給することは困難である。これに対して、こ
の実施の形態においては、ボールボンディング法または
ウェッジボンディング法によりハンダを供給するため、
安定した供給が可能となる。
ソルダ法のように回路基板上にハンダをプリコートする
場合のように、第1のパッド上にのみハンダプリコート
を行なう必要がない。したがって、予め回路基板上の第
2のパッドや配線上にマスクを形成する必要もない。ま
た、ハンダ供給後にマスクを削除する必要もないため、
工程およびコストの増加をもたらさない。
(Surface Mount Device)と同様、従来のSMT工程で
対応が可能となる。また、第2の素子面上の第2の電極
のワイヤボンディング時の荷重や超音波出力によって、
フリップチップ接続された第1の素子面上の第1の電極
の接続部が損傷して、電気的な接続ができなくなること
を防止することができる。また、第1の樹脂を介在させ
ることにより、半導体装置と回路基板との熱膨張係数の
差が大きい場合は、該熱膨張係数の違いから生じる熱応
力緩和の効果もある。特に、チップエッジとパッケージ
エッジの距離が短いパッケージであるCSPに採用する
場合、この発明によれば、第2の素子面上の第2の電極
と接続するための第2の接続パッド上に第1の樹脂が被
ることが防止される。
第2の素子面上の第2の電極と接続するための第2の接
続パッド上に被ることがないので、第2の素子面上の第
2の電極の電気的接続が良好に行なえる。また、第1の
素子面上の第1の電極の接続部と第2の素子面上の第2
の電極のワイヤ接続部との保護を目的とし、搭載面を第
2の樹脂でモールドするために回路基板を金型で押さえ
る場合、該金型の気密性を保つことができるため、第2
の樹脂の外部への流出を防ぐことができるとともに、第
1の樹脂である界面封止樹脂に含まれるフィラーによっ
て、金型を損傷する可能性もなくなる。
続パッド上に接着用金属部材を形成することができる。
たとえば、回路基板の第1の電極パッドの最表層がAu
であり、第1の素子面上の第1の電極の最表層がAl−
1%Siの場合、回路基板上の接着用金属部材として、
請求項7のようにAuを主成分としたものを用い、第1
の素子面上の第1の電極に接続する方法として、熱圧着
法を採用すると仮定する。この場合、AuとAl−1%
Siとの熱圧着となるので、比較的低温で接続できる。
用金属部材を形成すると、AuとAuの接続になり、熱
圧着を行なうには比較的高温にしなくてはならない。そ
のため、先に接続されていたAuからなる接着用金属部
材と第1の素子面上の第1の電極のAl−1%Siの拡
散が進みすぎる。したがって、チップ電極の最表層のバ
リアメタルを形成する工程が必要となる。これに対し
て、回路基板上に接着用金属部材を形成した場合には、
該バリアメタル形成工程を減らすという効果が現れる。
代わりに、1つの半導体装置の表面と裏面に素子が形成
された半導体装置が用いられるため、本願発明の効果を
損なうことなく、パッケージの高さを低くできる。
その外周部が、回路基板に形成された第1の接続パッド
が形成された領域より外側で、かつ、第2の接続パッド
が形成された領域より内側の領域まで広がっている。そ
のため、金型の気密性を阻害する要因はなく、金型の損
傷の可能性もなくなる。たとえば、半導体装置のKGD
が保証されていて、リペアの可能性が少なければ、この
ように第1の接続パッドを第1の樹脂が覆う方式が有効
である。なぜなら、第1の樹脂が注入される面積が多く
なるので、該樹脂に、熱膨張係数を小さくするためのS
iC等のフィラーが含有されている場合は、半導体装置
と回路基板との熱膨張係数の差がより少なくなること
で、熱応力がより緩和できるという効果が現れるからで
ある。
1の素子面と回路基板との間隙に第1の樹脂を介在させ
る際に、回路基板に形成された第1の接続パッドより内
側の領域にのみ介在させることで、第1の樹脂の広がり
を、第1の素子面周辺部の第1の電極まで到達させず
に、第1の素子面の中央部までで抑えている。そのため
に、回路基板の第1の接続パッドが第1の樹脂に覆われ
ることがないので、リペア用チップを搭載しやすい。
部入出力端子が、半導体装置を搭載した回路基板の裏面
にマトリクス状に配置される。そのため、パッケージの
周囲に外部入出力端子を配置するよりも、端子数を増や
すことができ、従来のSMT工程で対応が可能となる。
脂を効果的に介在させる方法である。たとえば、個々の
チップ状にダイシングされる前のウェハの場合は、ウェ
ハの全面に第1の樹脂を塗布し、不要部分を化学的また
は物理的に削除し、個々のチップにダイシングすれば、
請求項11の発明のように第1の素子面上に予め第1の
樹脂を塗布した状態で利用でき、一方、個々に分けられ
た半導体装置を使用する場合、請求項13のように第1
の樹脂を回路基板上に塗布するなど、使い分けが効果的
である。
に、シート形状を有する第1の樹脂を用いることで、樹
脂の塗布量を一定にし、作業効率を向上させる効果があ
る。
モールドしてパッケージ化する前に、電気的試験を行な
う。そのため、第1または第2のチップが不良の場合、
リペアすることで、良品率を上げることができる。
材は第1の金属からなる第1部分と、第2の金属からな
る第2部分とを含んでいる。そのため、金属部材の一方
部分としてハンダ等の融点の低い金属を用いることによ
り、比較的低温にて第1のチップを回路基板にフリップ
チップ方式で接続でき、回路基板や半導体チップへの損
傷を抑えることができる。特に、回路基板にポリイミド
テープなど薄いフレキシブル基板を用いる場合には、加
熱による反りやうねりを抑えることができ、以後の第2
のチップと回路基板とのワイヤボンディング法による接
続から半導体装置全体をモールドするまでの工程を、さ
らに容易にすることができる。
2の接続パッドに掛かることなく、第1の接続パッドに
供給することができるため、スーパージャフィット法や
スーパーソルダ法によってハンダを供給するときのよう
なマスクの形成、削除の工程は必要なく、製造工程が削
減できる。また、印刷法では困難な微細、狭ピッチパッ
ドに対しても安定して精度よく微量のハンダを供給する
ことができる。
つぶして超音波にて圧着するため、請求項22のボール
ボンディング法の場合のような酸化防止のための還元雰
囲気は必要がなく、設備のコストが削減できる。また、
同径のハンダワイヤを用いた場合、ウェッジボンディン
グ方式の方が小さなハンダ突起電極を形成することがで
きるため、狭ピッチパッドに対し、フリップチップ接続
の際の加圧によりハンダが押しつぶされて隣接する金属
突起電極のハンダ等が短絡しないような微量なハンダ量
を制御し、供給することができる。
ダ突起電極のテイルが長くなってしまった場合でも、対
応することができる。
て200℃以上のガラス転移温度を有する樹脂、たとえ
ば、ポリイミドと金属配線等からなるフレキシブル基板
を採用する。そのため、耐熱性を有し、モールドの際の
作業性が向上する。
の構造を示す断面図である。
に実装された状態を示す断面図である。
に用いられる回路基板を示す図である。
の製造方法を示す断面図である。
の製造方法を示す断面図である。
を説明するため断面図である。
の製造方法を示す断面図である。
の構造を示す断面図である。
に用いられる回路基板を示す図である。
ジの構造を示す断面図である。
れる回路基板を示す図である。
る工程の一例を示す断面図である。
方法の一工程の一例を示す断面図である。
方法の一工程の他の例を示す断面図である。
るための断面図である。
する課題を説明するための断面図である。
する課題を説明するための断面図である。
する課題を説明するための断面図である。
する課題を説明するための断面図である。
する課題を説明するための断面図である。
パッケージエッジまでの長さ 24 従来技術を用いた積層型半導体装置のチップエッ
ジからモールド外周までの長さ 25 フィラー 26 ハンダボール 27 貫通孔 28 開口 55 接着用金属部材の第1部分 65 接着用金属部材の第2部分 なお、各図中、同一符号は同一または相当部分を示す。
Claims (26)
- 【請求項1】 半導体装置パッケージであって、 第1および第2の素子面を有する半導体装置を備え、 前記半導体装置は、 前記第1の素子面の周辺部に形成された複数の第1の電
極と、 前記第2の素子面の周辺部に形成された複数の第2の電
極とを含み、 第1および第2の面を有し、前記半導体装置を搭載する
回路基板をさらに備え、 前記回路基板は、 前記第1の面上に前記半導体装置の前記第1の電極にそ
れぞれ対応して配置された、複数の第1の接続パッド
と、 前記第1の面上の前記第1の接続パッド外周に形成され
た、複数の第2の接続パッドと、 前記第1および第2の接続パッドとそれぞれ電気的に接
続された複数の外部入出力端子とを含み、 前記第1の素子面と前記回路基板との間隙に設けられる
第1の樹脂と、 前記第1の接続パッドと、対応する前記第1の電極とを
それぞれフリップチップ方式で接続する複数の接着用金
属部材と、 前記第2の接続パッドと、対応する前記第2の電極とを
それぞれ接続する金属細線と、 前記半導体装置全体を覆うようにモールドされた第2の
樹脂とをさらに備える、半導体装置パッケージ。 - 【請求項2】 前記半導体装置は、2つの半導体チップ
の裏面どうしが合わさった状態で構成された、請求項1
記載の半導体装置パッケージ。 - 【請求項3】 前記半導体装置は、1つの半導体チップ
の両面に素子面が形成されて構成された、請求項1記載
の半導体装置パッケージ。 - 【請求項4】 前記第1の樹脂は、その外周部が、前記
第1の接続パッドが形成された領域より外側で、かつ、
前記第2の接続パッドが形成された領域の内側の領域ま
で広がるように、前記第1の素子面と前記回路基板の間
隙に介在する、請求項1〜3のいずれかに記載の半導体
装置パッケージ。 - 【請求項5】 前記第1の樹脂は、その外周部が、前記
第1の接続パッドが形成された領域よりも内側におい
て、前記第1の素子面と前記回路基板の間隙に介在す
る、請求項1〜3のいずれかに記載の半導体装置パッケ
ージ。 - 【請求項6】 前記第1の樹脂は熱可塑性樹脂であり、
前記第2の樹脂は熱硬化性樹脂である、請求項1〜5の
いずれかに記載の半導体装置パッケージ。 - 【請求項7】 前記接着用金属部材は、Auを主成分と
する、請求項1〜6のいずれかに記載の半導体装置パッ
ケージ。 - 【請求項8】 前記接着用金属部材は、 第1の金属からなる第1部分と、 第2の金属からなる第2部分とを含む、請求項1〜6の
いずれかに記載の半導体装置パッケージ。 - 【請求項9】 前記第1部分はAuを主成分とする金属
からなり、 前記第2部分はハンダからなる、請求項8記載の半導体
装置パッケージ。 - 【請求項10】 前記外部入出力端子は、 前記回路基板の第2の面上にマトリクス状に配置され、 各前記外部入出力端子は、 前記第2の面上に設けられる第3の接続パッドと、 前記第3の接続パッド上に設けられるハンダボールによ
り形成された、請求項1〜9のいずれかに記載の半導体
装置パッケージ。 - 【請求項11】 前記回路基板は、マトリクス状に配置
された接続用の開口を有し、 前記外部入出力端子は、前記開口を通して前記第1およ
び第2の接続パッドに接続されるハンダボールにより形
成された、請求項1〜9のいずれかに記載の半導体装置
パッケージ。 - 【請求項12】 第1および第2の素子面を有する半導
体装置が回路基板上に搭載されてなる半導体装置パッケ
ージの製造方法であって、 前記第1の素子面の周辺部に形成された第1の電極と、
前記回路基板の第1の面上に形成された第1の接続パッ
ドとを、接着用金属部材を介してフリップチップ方式に
より、かつ、前記第1の素子面と前記回路基板との間隙
部分に第1の樹脂を介在して接続するステップと、 前記第2の素子面の周辺部に形成された第2の電極と、
前記回路基板の第1の面上において、前記第1の接続パ
ッドよりも外側の部分に形成された第2の接続パッドと
を、金属細線を介してワイヤボンディング方式により、
接続するステップと、 前記回路基板上に搭載された半導体装置全体を覆うよう
に第2の樹脂をモールドするステップと、 前記回路基板に設けられた複数の第3の接続パッド上
に、それぞれハンダボールを設けるステップとを備え
る、半導体装置パッケージの製造方法。 - 【請求項13】 前記第1の素子面と前記回路基板との
間隙部分に第1の樹脂を介在して接続するステップは、 前記第1の素子面の中央部に前記第1の樹脂を塗布する
ステップと、 前記第1の電極と前記第1の接続パッドとを接続するス
テップとを含む、請求項12記載の半導体装置パッケー
ジの製造方法。 - 【請求項14】 前記第1の樹脂を塗布するステップ
は、 シート形状を有する前記第1の樹脂を前記第1の素子面
の中央部に配置する、請求項13記載の半導体装置パッ
ケージの製造方法。 - 【請求項15】 前記第1の素子面と前記回路基板との
間隙部分に第1の樹脂を介在して接続するステップは、 前記回路基板の中央部に前記第1の樹脂を塗布した前記
回路基板を準備するステップと、 前記第1の電極と前記第1の接続パッドとを接続するス
テップとを含む、請求項12記載の半導体装置パッケー
ジの製造方法。 - 【請求項16】 前記回路基板を準備するステップは、 シート形状を有する前記第1の樹脂を前記回路基板の中
央部に配置する、請求項15記載の半導体装置パッケー
ジの製造方法。 - 【請求項17】 前記第1の素子面と前記回路基板との
間隙部分に第1の樹脂を介在して接続するステップにお
いて、 前記第1の樹脂の外周部が、前記第1の接続パッドが形
成された領域より外側で、かつ、前記第2の接続パッド
が形成された領域の内側の領域まで広がって介在される
ように、前記第1の樹脂の使用量を調整する、請求項1
2〜16のいずれかに記載の半導体装置パッケージの製
造方法。 - 【請求項18】 前記第1の素子面と前記回路基板との
間隙部分に第1の樹脂を介在して接続するステップにお
いて、 前記第1の樹脂の外周部が、前記第1の接続パッドが形
成された領域よりも内側に介在されるように、前記第1
の樹脂の使用量を調整する、請求項12〜16のいずれ
かに記載の半導体装置パッケージの製造方法。 - 【請求項19】 前記第2の電極と前記第2の接続パッ
ドとを接続した後であって、前記第2の樹脂をモールド
する前に、前記半導体装置を試験して、不良であれば搭
載した半導体装置を回路基板から取り外すステップと、 前記半導体装置を回路基板から取り外した場合には、前
記半導体装置とは異なる他の半導体装置の前記第1の素
子面の周辺部に形成された第1の電極と、前記回路基板
の第1の面上に形成された第1の接続パッドとを、接着
用金属部材を介してフリップチップ方式により、かつ、
前記第1の素子面と前記回路基板との間隙部分に第1の
樹脂を介在して接続するステップと、 前記半導体装置を回路基板から取り外した場合には、前
記他の半導体装置の前記第2の素子面の周辺部に形成さ
れた第2の電極と、前記回路基板の第1の面上におい
て、前記第1の接続パッドよりも外側の部分に形成され
た第2の接続パッドとを、金属細線を介してワイヤボン
ディング方式により、接続するステップとをさらに備え
る、請求項18記載の半導体装置パッケージの製造方
法。 - 【請求項20】 前記接着用金属部材は、 第1の金属からなる第1部分と、 第2の金属からなる第2部分とを含む、請求項12〜1
9のいずれかに記載の半導体装置パッケージの製造方
法。 - 【請求項21】 前記第1の電極と前記第1の接続パッ
ドとをフリップチップ方式により接続するステップは、 前記第1の接続パッド上にハンダを供給するステップ
と、 前記第1の電極上にAuを主成分とする金属からなるバ
ンプを形成するステップと、 前記第1の接続パッド上に供給されたハンダを加熱して
溶融させることにより、前記第1の電極と前記第1の接
続パッドとを接続するステップとを含む、請求項20記
載の半導体装置パッケージの製造方法。 - 【請求項22】 前記第1の接続パッド上にハンダを供
給するステップは、ハンダをボールボンディング法によ
り供給する、請求項21記載の半導体装置パッケージの
製造方法。 - 【請求項23】 前記第1の接続パッド上にハンダを供
給するステップは、ハンダをウェッジボンディング法に
より供給する、請求項21記載の半導体装置パッケージ
の製造方法。 - 【請求項24】 前記第1の接続パッド上に供給された
ハンダにフラックスを塗布した後、リフロー炉に流し、
前記ハンダの形状を半球状に整えるステップをさらに含
む、請求項21〜23のいずれかに記載の半導体装置パ
ッケージの製造方法。 - 【請求項25】 第1および第2の素子面を有する半導
体装置を搭載して半導体装置パッケージを製造するため
の回路基板であって、 第1および第2の面を有し、少なくとも一つの貫通孔を
有する基材と、 前記第1の素子面の周辺部に形成された第1の電極との
接続のために形成され、前記第1の面上に前記貫通孔を
囲むように配置される第1の接続パッドと、 前記第2の素子面の周辺部に形成された第2の電極との
接続のために、前記第1の面上の前記第1の接続パッド
よりも外側の部分に形成された第2の接続パッドと、 前記第1の接続パッドに囲まれる領域上に塗布された第
1の樹脂とを備える、回路基板。 - 【請求項26】 前記基材は、 200°C以上のガラス転移温度を有する樹脂から成
り、 前記回路基板は、 第3の接続パッドと、 前記第3の接続パッドの各々と、対応する前記第1また
は第2の接続パッドとを接続する金属配線とをさらに含
む、請求項25記載の回路基板。
Priority Applications (5)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP10311095A JPH11219984A (ja) | 1997-11-06 | 1998-10-30 | 半導体装置パッケージおよびその製造方法ならびにそのための回路基板 |
US09/186,339 US6157080A (en) | 1997-11-06 | 1998-11-05 | Semiconductor device using a chip scale package |
DE69834702T DE69834702T2 (de) | 1997-11-06 | 1998-11-05 | Packung für eine Halbleiteranordnung, Verfahren zu ihrer Herstellung und Leiterplatte dafür |
EP98120996A EP0915505B1 (en) | 1997-11-06 | 1998-11-05 | Semiconductor device package, manufacturing method thereof and circuit board therefor |
TW087118510A TW406382B (en) | 1997-11-06 | 1998-11-06 | Semiconductor device package, manufacturing method thereof and circuit board therefor |
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP30402197 | 1997-11-06 | ||
JP9-304021 | 1997-11-06 | ||
JP10311095A JPH11219984A (ja) | 1997-11-06 | 1998-10-30 | 半導体装置パッケージおよびその製造方法ならびにそのための回路基板 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH11219984A true JPH11219984A (ja) | 1999-08-10 |
Family
ID=26563748
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP10311095A Pending JPH11219984A (ja) | 1997-11-06 | 1998-10-30 | 半導体装置パッケージおよびその製造方法ならびにそのための回路基板 |
Country Status (5)
Country | Link |
---|---|
US (1) | US6157080A (ja) |
EP (1) | EP0915505B1 (ja) |
JP (1) | JPH11219984A (ja) |
DE (1) | DE69834702T2 (ja) |
TW (1) | TW406382B (ja) |
Cited By (25)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2001298039A (ja) * | 2000-04-12 | 2001-10-26 | Matsushita Electric Ind Co Ltd | 半導体装置 |
US6392950B2 (en) | 2000-05-26 | 2002-05-21 | Hitachi, Ltd. | Semiconductor device including multi-chip |
KR100374542B1 (ko) * | 2000-11-02 | 2003-03-04 | 앰코 테크놀로지 코리아 주식회사 | 반도체 패키지 및 그 제조방법 |
JP2003086758A (ja) * | 2001-09-10 | 2003-03-20 | Mitsubishi Electric Corp | 半導体装置の製造方法、製造装置、及び、半導体装置 |
KR100387451B1 (ko) * | 1999-10-14 | 2003-06-18 | 미쓰비시 덴끼 엔지니어링 가부시키가이샤 | 반도체 장치 및 그 제조방법 |
US6621172B2 (en) * | 1999-09-03 | 2003-09-16 | Seiko Epson Corporation | Semiconductor device and method of fabricating the same, circuit board, and electronic equipment |
US6841884B2 (en) | 2002-11-12 | 2005-01-11 | Oki Electric Industry Co., Ltd. | Semiconductor device |
JP2005191229A (ja) * | 2003-12-25 | 2005-07-14 | Shinko Electric Ind Co Ltd | 半導体装置の製造方法 |
US6951774B2 (en) | 2001-04-06 | 2005-10-04 | Renesas Technology Corp. | Semiconductor device and method of manufacturing the same |
US6992396B2 (en) | 2002-12-27 | 2006-01-31 | Matsushita Electric Industrial Co., Ltd. | Semiconductor device and method for fabricating the same |
JP2006504275A (ja) * | 2002-10-29 | 2006-02-02 | インフィネオン テクノロジーズ アクチエンゲゼルシャフト | 熱可塑性物質からなるアンダーフィル材を有する電子部品、およびその製造方法 |
JP2006066551A (ja) * | 2004-08-25 | 2006-03-09 | Renesas Technology Corp | 半導体装置の製造方法 |
KR100708043B1 (ko) * | 2001-08-17 | 2007-04-16 | 앰코 테크놀로지 코리아 주식회사 | 반도체패키지 및 그 제조 방법 |
US7221041B2 (en) * | 2003-07-29 | 2007-05-22 | Advanced Semiconductor Engineering, Inc. | Multi-chips module package and manufacturing method thereof |
JP2007150346A (ja) * | 1999-09-03 | 2007-06-14 | Seiko Epson Corp | 半導体装置及びその製造方法、回路基板並びに電子機器 |
US7239164B2 (en) | 2004-08-04 | 2007-07-03 | Sharp Kabushiki Kaisha | Stack type semiconductor apparatus package and manufacturing method thereof |
JP2007181091A (ja) * | 2005-12-28 | 2007-07-12 | Nippon Dempa Kogyo Co Ltd | 2周波切替型の水晶発振器 |
JP2008069291A (ja) * | 2006-09-15 | 2008-03-27 | Shin Etsu Chem Co Ltd | 半導体封止用液状エポキシ樹脂組成物及び半導体装置 |
JP2008258318A (ja) * | 2007-04-03 | 2008-10-23 | Sanyo Electric Co Ltd | 半導体チップ及びその実装方法、半導体装置 |
JP2009016957A (ja) * | 2007-06-29 | 2009-01-22 | Kyocera Kinseki Corp | 圧電発振器 |
JP2009092545A (ja) * | 2007-10-10 | 2009-04-30 | Panasonic Corp | 角速度および加速度検出用複合センサ |
JP2011066231A (ja) * | 2009-09-17 | 2011-03-31 | Sharp Corp | 太陽電池モジュールおよび太陽電池モジュールの製造方法 |
JP2011082555A (ja) * | 2010-12-20 | 2011-04-21 | Renesas Electronics Corp | 半導体装置 |
JP2014057107A (ja) * | 2013-12-20 | 2014-03-27 | Renesas Electronics Corp | 半導体装置の製造方法および半導体装置 |
JP2015093475A (ja) * | 2013-11-14 | 2015-05-18 | 株式会社デンソー | モールドパッケージおよびその製造方法 |
Families Citing this family (181)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3481444B2 (ja) * | 1998-01-14 | 2003-12-22 | シャープ株式会社 | 半導体装置及びその製造方法 |
US6642136B1 (en) | 2001-09-17 | 2003-11-04 | Megic Corporation | Method of making a low fabrication cost, high performance, high reliability chip scale package |
JP3437107B2 (ja) * | 1999-01-27 | 2003-08-18 | シャープ株式会社 | 樹脂封止型半導体装置 |
WO2000048444A2 (de) * | 1999-02-16 | 2000-08-24 | Wichmann Workx Ag Information Technology | Häusung für ein halbleiterchip |
JP3662461B2 (ja) * | 1999-02-17 | 2005-06-22 | シャープ株式会社 | 半導体装置、およびその製造方法 |
JP3565319B2 (ja) * | 1999-04-14 | 2004-09-15 | シャープ株式会社 | 半導体装置及びその製造方法 |
JP2001223324A (ja) * | 2000-02-10 | 2001-08-17 | Mitsubishi Electric Corp | 半導体装置 |
JP3955712B2 (ja) * | 2000-03-03 | 2007-08-08 | 株式会社ルネサステクノロジ | 半導体装置 |
US6949822B2 (en) * | 2000-03-17 | 2005-09-27 | International Rectifier Corporation | Semiconductor multichip module package with improved thermal performance; reduced size and improved moisture resistance |
JP2001313314A (ja) * | 2000-04-28 | 2001-11-09 | Sony Corp | バンプを用いた半導体装置、その製造方法、および、バンプの形成方法 |
US6603191B2 (en) * | 2000-05-18 | 2003-08-05 | Casio Computer Co., Ltd. | Semiconductor device and method of manufacturing the same |
US7247932B1 (en) | 2000-05-19 | 2007-07-24 | Megica Corporation | Chip package with capacitor |
US6683368B1 (en) | 2000-06-09 | 2004-01-27 | National Semiconductor Corporation | Lead frame design for chip scale package |
WO2002003465A2 (en) * | 2000-06-29 | 2002-01-10 | Advanced Micro Devices, Inc. | Semiconductor package with stacked flip chip and wire bonded upper die |
US7298031B1 (en) * | 2000-08-09 | 2007-11-20 | Micron Technology, Inc. | Multiple substrate microelectronic devices and methods of manufacture |
US6531763B1 (en) * | 2000-08-15 | 2003-03-11 | Micron Technology, Inc. | Interposers having encapsulant fill control features |
US6607937B1 (en) * | 2000-08-23 | 2003-08-19 | Micron Technology, Inc. | Stacked microelectronic dies and methods for stacking microelectronic dies |
FR2813708B1 (fr) * | 2000-09-01 | 2003-08-29 | Orient Semiconductor Elect Ltd | Procede ameliore de montage de pastilles dans des processus de technologie a pastilles a protuberances |
JP3581086B2 (ja) * | 2000-09-07 | 2004-10-27 | 松下電器産業株式会社 | 半導体装置 |
JP2002093831A (ja) * | 2000-09-14 | 2002-03-29 | Shinko Electric Ind Co Ltd | 半導体装置およびその製造方法 |
US6465885B1 (en) * | 2000-10-18 | 2002-10-15 | Jiahn-Chang Wu | Positioning of soldering pads in semiconductor diode package |
US6689640B1 (en) * | 2000-10-26 | 2004-02-10 | National Semiconductor Corporation | Chip scale pin array |
US6885106B1 (en) * | 2001-01-11 | 2005-04-26 | Tessera, Inc. | Stacked microelectronic assemblies and methods of making same |
JP2002208656A (ja) * | 2001-01-11 | 2002-07-26 | Mitsubishi Electric Corp | 半導体装置 |
US6815324B2 (en) | 2001-02-15 | 2004-11-09 | Megic Corporation | Reliable metal bumps on top of I/O pads after removal of test probe marks |
TWI313507B (en) | 2002-10-25 | 2009-08-11 | Megica Corporatio | Method for assembling chips |
US6828663B2 (en) | 2001-03-07 | 2004-12-07 | Teledyne Technologies Incorporated | Method of packaging a device with a lead frame, and an apparatus formed therefrom |
KR100401020B1 (ko) | 2001-03-09 | 2003-10-08 | 앰코 테크놀로지 코리아 주식회사 | 반도체칩의 스택킹 구조 및 이를 이용한 반도체패키지 |
SG100635A1 (en) * | 2001-03-09 | 2003-12-26 | Micron Technology Inc | Die support structure |
GB2374419B (en) * | 2001-03-09 | 2004-12-29 | Zellweger Analytics Ltd | Electrochemical gas sensor |
US6798055B2 (en) | 2001-03-12 | 2004-09-28 | Micron Technology | Die support structure |
US20020127771A1 (en) * | 2001-03-12 | 2002-09-12 | Salman Akram | Multiple die package |
SG95637A1 (en) * | 2001-03-15 | 2003-04-23 | Micron Technology Inc | Semiconductor/printed circuit board assembly, and computer system |
US6441483B1 (en) * | 2001-03-30 | 2002-08-27 | Micron Technology, Inc. | Die stacking scheme |
KR100422343B1 (ko) * | 2001-05-10 | 2004-03-10 | 주식회사 하이닉스반도체 | 적층 패키지 구조 및 제조방법 |
JP4790157B2 (ja) * | 2001-06-07 | 2011-10-12 | ルネサスエレクトロニクス株式会社 | 半導体装置 |
US7215022B2 (en) * | 2001-06-21 | 2007-05-08 | Ati Technologies Inc. | Multi-die module |
JP4126891B2 (ja) * | 2001-08-03 | 2008-07-30 | セイコーエプソン株式会社 | 半導体装置の製造方法 |
US7605479B2 (en) * | 2001-08-22 | 2009-10-20 | Tessera, Inc. | Stacked chip assembly with encapsulant layer |
US6613606B1 (en) * | 2001-09-17 | 2003-09-02 | Magic Corporation | Structure of high performance combo chip and processing method |
US7099293B2 (en) | 2002-05-01 | 2006-08-29 | Stmicroelectronics, Inc. | Buffer-less de-skewing for symbol combination in a CDMA demodulator |
US6946323B1 (en) | 2001-11-02 | 2005-09-20 | Amkor Technology, Inc. | Semiconductor package having one or more die stacked on a prepackaged device and method therefor |
US6916682B2 (en) | 2001-11-08 | 2005-07-12 | Freescale Semiconductor, Inc. | Semiconductor package device for use with multiple integrated circuits in a stacked configuration and method of formation and testing |
TW529141B (en) * | 2002-01-07 | 2003-04-21 | Advanced Semiconductor Eng | Stacking type multi-chip package and its manufacturing process |
US6858932B2 (en) | 2002-02-07 | 2005-02-22 | Freescale Semiconductor, Inc. | Packaged semiconductor device and method of formation |
US6982485B1 (en) | 2002-02-13 | 2006-01-03 | Amkor Technology, Inc. | Stacking structure for semiconductor chips and a semiconductor package using it |
US7154171B1 (en) | 2002-02-22 | 2006-12-26 | Amkor Technology, Inc. | Stacking structure for semiconductor devices using a folded over flexible substrate and method therefor |
US6979904B2 (en) * | 2002-04-19 | 2005-12-27 | Micron Technology, Inc. | Integrated circuit package having reduced interconnects |
DE10240460A1 (de) | 2002-08-29 | 2004-03-11 | Infineon Technologies Ag | Universelles Halbleitergehäuse mit vorvernetzten Kunststoffeinbettmassen und Verfahren zur Herstellung desselben |
US7034387B2 (en) * | 2003-04-04 | 2006-04-25 | Chippac, Inc. | Semiconductor multipackage module including processor and memory package assemblies |
EP1556895A4 (en) * | 2002-10-08 | 2009-12-30 | Chippac Inc | SEMICONDUCTOR STACKED MULTIPLE CAPSULATION MODULE WITH INVERTED SECOND CAPACITY |
KR100618812B1 (ko) * | 2002-11-18 | 2006-09-05 | 삼성전자주식회사 | 향상된 신뢰성을 가지는 적층형 멀티 칩 패키지 |
JP2004193497A (ja) * | 2002-12-13 | 2004-07-08 | Nec Electronics Corp | チップサイズパッケージおよびその製造方法 |
JP4390541B2 (ja) * | 2003-02-03 | 2009-12-24 | Necエレクトロニクス株式会社 | 半導体装置及びその製造方法 |
JP2004260135A (ja) * | 2003-02-06 | 2004-09-16 | Sanyo Electric Co Ltd | 半導体集積装置及びその製造方法 |
US6879047B1 (en) | 2003-02-19 | 2005-04-12 | Amkor Technology, Inc. | Stacking structure for semiconductor devices using a folded over flexible substrate and method therefor |
WO2004077559A1 (en) * | 2003-02-27 | 2004-09-10 | Infineon Technologies Ag | Integrated circuit package and method for producing it |
DE10310617B4 (de) * | 2003-03-10 | 2006-09-21 | Infineon Technologies Ag | Elektronisches Bauteil mit Hohlraum und ein Verfahren zur Herstellung desselben |
TWI220781B (en) * | 2003-04-28 | 2004-09-01 | Advanced Semiconductor Eng | Multi-chip package substrate for flip-chip and wire bonding |
US20040217488A1 (en) * | 2003-05-02 | 2004-11-04 | Luechinger Christoph B. | Ribbon bonding |
JP3718205B2 (ja) * | 2003-07-04 | 2005-11-24 | 松下電器産業株式会社 | チップ積層型半導体装置およびその製造方法 |
CN100413060C (zh) * | 2003-09-04 | 2008-08-20 | 松下电器产业株式会社 | 半导体装置 |
DE10352946B4 (de) | 2003-11-11 | 2007-04-05 | Infineon Technologies Ag | Halbleiterbauteil mit Halbleiterchip und Umverdrahtungslage sowie Verfahren zur Herstellung desselben |
FR2863390B1 (fr) * | 2003-12-08 | 2006-03-24 | Kingpak Tech Inc | Petite carte memoire |
US8970049B2 (en) | 2003-12-17 | 2015-03-03 | Chippac, Inc. | Multiple chip package module having inverted package stacked over die |
JP2005197491A (ja) * | 2004-01-08 | 2005-07-21 | Matsushita Electric Ind Co Ltd | 半導体装置 |
DE102004005586B3 (de) * | 2004-02-04 | 2005-09-29 | Infineon Technologies Ag | Halbleiterbauteil mit einem Halbleiterchipstapel auf einer Umverdrahtungsplatte und Herstellung desselben |
US7126829B1 (en) | 2004-02-09 | 2006-10-24 | Pericom Semiconductor Corp. | Adapter board for stacking Ball-Grid-Array (BGA) chips |
CN1700467A (zh) * | 2004-05-20 | 2005-11-23 | 株式会社东芝 | 半导体器件 |
US20050260789A1 (en) * | 2004-05-21 | 2005-11-24 | Texas Instruments Incorporated | Method and system for applying an adhesive substance on an electronic device |
US8552551B2 (en) * | 2004-05-24 | 2013-10-08 | Chippac, Inc. | Adhesive/spacer island structure for stacking over wire bonded die |
US20050269692A1 (en) | 2004-05-24 | 2005-12-08 | Chippac, Inc | Stacked semiconductor package having adhesive/spacer structure and insulation |
US20050258527A1 (en) * | 2004-05-24 | 2005-11-24 | Chippac, Inc. | Adhesive/spacer island structure for multiple die package |
US7217597B2 (en) | 2004-06-22 | 2007-05-15 | Micron Technology, Inc. | Die stacking scheme |
US7253511B2 (en) | 2004-07-13 | 2007-08-07 | Chippac, Inc. | Semiconductor multipackage module including die and inverted land grid array package stacked over ball grid array package |
US7095096B1 (en) | 2004-08-16 | 2006-08-22 | National Semiconductor Corporation | Microarray lead frame |
US11842972B2 (en) | 2004-09-28 | 2023-12-12 | Rohm Co., Ltd. | Semiconductor device with a semiconductor chip connected in a flip chip manner |
JP2006100385A (ja) | 2004-09-28 | 2006-04-13 | Rohm Co Ltd | 半導体装置 |
CN101053079A (zh) | 2004-11-03 | 2007-10-10 | 德塞拉股份有限公司 | 堆叠式封装的改进 |
TWI250592B (en) * | 2004-11-16 | 2006-03-01 | Siliconware Precision Industries Co Ltd | Multi-chip semiconductor package and fabrication method thereof |
US8294279B2 (en) | 2005-01-25 | 2012-10-23 | Megica Corporation | Chip package with dam bar restricting flow of underfill |
TWI442520B (zh) | 2005-03-31 | 2014-06-21 | Stats Chippac Ltd | 具有晶片尺寸型封裝及第二基底及在上側與下側包含暴露基底表面之半導體組件 |
US7364945B2 (en) | 2005-03-31 | 2008-04-29 | Stats Chippac Ltd. | Method of mounting an integrated circuit package in an encapsulant cavity |
JP2008535273A (ja) | 2005-03-31 | 2008-08-28 | スタッツ・チップパック・リミテッド | 上面および下面に露出した基板表面を有する半導体積層型パッケージアセンブリ |
US7354800B2 (en) | 2005-04-29 | 2008-04-08 | Stats Chippac Ltd. | Method of fabricating a stacked integrated circuit package system |
US7429786B2 (en) | 2005-04-29 | 2008-09-30 | Stats Chippac Ltd. | Semiconductor package including second substrate and having exposed substrate surfaces on upper and lower sides |
US7582960B2 (en) | 2005-05-05 | 2009-09-01 | Stats Chippac Ltd. | Multiple chip package module including die stacked over encapsulated package |
US7846775B1 (en) | 2005-05-23 | 2010-12-07 | National Semiconductor Corporation | Universal lead frame for micro-array packages |
US7394148B2 (en) * | 2005-06-20 | 2008-07-01 | Stats Chippac Ltd. | Module having stacked chip scale semiconductor packages |
US7485969B2 (en) * | 2005-09-01 | 2009-02-03 | Micron Technology, Inc. | Stacked microelectronic devices and methods for manufacturing microelectronic devices |
TWI303873B (en) | 2005-09-23 | 2008-12-01 | Freescale Semiconductor Inc | Method of making stacked die package |
KR20070095504A (ko) * | 2005-10-14 | 2007-10-01 | 인티그런트 테크놀로지즈(주) | 적층형 집적회로 칩 및 패키지. |
US7323968B2 (en) * | 2005-12-09 | 2008-01-29 | Sony Corporation | Cross-phase adapter for powerline communications (PLC) network |
US8058101B2 (en) | 2005-12-23 | 2011-11-15 | Tessera, Inc. | Microelectronic packages and methods therefor |
US20070152314A1 (en) * | 2005-12-30 | 2007-07-05 | Intel Corporation | Low stress stacked die packages |
US7768125B2 (en) * | 2006-01-04 | 2010-08-03 | Stats Chippac Ltd. | Multi-chip package system |
US7456088B2 (en) * | 2006-01-04 | 2008-11-25 | Stats Chippac Ltd. | Integrated circuit package system including stacked die |
US7485502B2 (en) * | 2006-01-31 | 2009-02-03 | Stats Chippac Ltd. | Integrated circuit underfill package system |
US7750482B2 (en) * | 2006-02-09 | 2010-07-06 | Stats Chippac Ltd. | Integrated circuit package system including zero fillet resin |
US8704349B2 (en) | 2006-02-14 | 2014-04-22 | Stats Chippac Ltd. | Integrated circuit package system with exposed interconnects |
US7675180B1 (en) | 2006-02-17 | 2010-03-09 | Amkor Technology, Inc. | Stacked electronic component package having film-on-wire spacer |
US20070200253A1 (en) * | 2006-02-28 | 2007-08-30 | Gogoi Bishnu P | Electronic assembly and method for forming the same |
JP4881044B2 (ja) * | 2006-03-16 | 2012-02-22 | 株式会社東芝 | 積層型半導体装置の製造方法 |
US7462509B2 (en) * | 2006-05-16 | 2008-12-09 | International Business Machines Corporation | Dual-sided chip attached modules |
US7633144B1 (en) | 2006-05-24 | 2009-12-15 | Amkor Technology, Inc. | Semiconductor package |
US7656236B2 (en) | 2007-05-15 | 2010-02-02 | Teledyne Wireless, Llc | Noise canceling technique for frequency synthesizer |
US8030761B2 (en) * | 2007-05-23 | 2011-10-04 | United Test And Assembly Center Ltd. | Mold design and semiconductor package |
JP4121543B1 (ja) * | 2007-06-18 | 2008-07-23 | 新光電気工業株式会社 | 電子装置 |
US8179045B2 (en) | 2008-04-22 | 2012-05-15 | Teledyne Wireless, Llc | Slow wave structure having offset projections comprised of a metal-dielectric composite stack |
CN101615587A (zh) * | 2008-06-27 | 2009-12-30 | 桑迪士克股份有限公司 | 半导体装置中的导线层叠式缝线接合 |
US8923004B2 (en) * | 2008-07-31 | 2014-12-30 | Micron Technology, Inc. | Microelectronic packages with small footprints and associated methods of manufacturing |
WO2010029726A1 (ja) * | 2008-09-11 | 2010-03-18 | 住友ベークライト株式会社 | 半導体装置および半導体装置に用いる樹脂組成物 |
KR20100033012A (ko) | 2008-09-19 | 2010-03-29 | 주식회사 하이닉스반도체 | 반도체 패키지 및 이를 갖는 적층 반도체 패키지 |
JP2010093109A (ja) * | 2008-10-09 | 2010-04-22 | Renesas Technology Corp | 半導体装置、半導体装置の製造方法および半導体モジュールの製造方法 |
US8022539B2 (en) * | 2008-11-17 | 2011-09-20 | Stats Chippac Ltd. | Integrated circuit packaging system with increased connectivity and method of manufacture thereof |
JP2010278318A (ja) * | 2009-05-29 | 2010-12-09 | Renesas Electronics Corp | 半導体装置 |
US20100327419A1 (en) * | 2009-06-26 | 2010-12-30 | Sriram Muthukumar | Stacked-chip packages in package-on-package apparatus, methods of assembling same, and systems containing same |
CN102208396A (zh) * | 2010-03-30 | 2011-10-05 | 日月光半导体制造股份有限公司 | 半导体封装件及其制造方法 |
US8482111B2 (en) | 2010-07-19 | 2013-07-09 | Tessera, Inc. | Stackable molded microelectronic packages |
US9159708B2 (en) | 2010-07-19 | 2015-10-13 | Tessera, Inc. | Stackable molded microelectronic packages with area array unit connectors |
KR101075241B1 (ko) | 2010-11-15 | 2011-11-01 | 테세라, 인코포레이티드 | 유전체 부재에 단자를 구비하는 마이크로전자 패키지 |
JP5707902B2 (ja) * | 2010-12-02 | 2015-04-30 | ソニー株式会社 | 半導体装置及びその製造方法 |
US20120146206A1 (en) | 2010-12-13 | 2012-06-14 | Tessera Research Llc | Pin attachment |
US9721872B1 (en) | 2011-02-18 | 2017-08-01 | Amkor Technology, Inc. | Methods and structures for increasing the allowable die size in TMV packages |
US8618659B2 (en) | 2011-05-03 | 2013-12-31 | Tessera, Inc. | Package-on-package assembly with wire bonds to encapsulation surface |
KR101128063B1 (ko) | 2011-05-03 | 2012-04-23 | 테세라, 인코포레이티드 | 캡슐화 층의 표면에 와이어 본드를 구비하는 패키지 적층형 어셈블리 |
US8836136B2 (en) | 2011-10-17 | 2014-09-16 | Invensas Corporation | Package-on-package assembly with wire bond vias |
US8946757B2 (en) | 2012-02-17 | 2015-02-03 | Invensas Corporation | Heat spreading substrate with embedded interconnects |
US8372741B1 (en) | 2012-02-24 | 2013-02-12 | Invensas Corporation | Method for package-on-package assembly with wire bonds to encapsulation surface |
US9349706B2 (en) | 2012-02-24 | 2016-05-24 | Invensas Corporation | Method for package-on-package assembly with wire bonds to encapsulation surface |
US8835228B2 (en) | 2012-05-22 | 2014-09-16 | Invensas Corporation | Substrate-less stackable package with wire-bond interconnect |
US9391008B2 (en) | 2012-07-31 | 2016-07-12 | Invensas Corporation | Reconstituted wafer-level package DRAM |
US9502390B2 (en) | 2012-08-03 | 2016-11-22 | Invensas Corporation | BVA interposer |
US8969730B2 (en) * | 2012-08-16 | 2015-03-03 | Apple Inc. | Printed circuit solder connections |
US8975738B2 (en) | 2012-11-12 | 2015-03-10 | Invensas Corporation | Structure for microelectronic packaging with terminals on dielectric mass |
US9799592B2 (en) | 2013-11-19 | 2017-10-24 | Amkor Technology, Inc. | Semicondutor device with through-silicon via-less deep wells |
KR101366461B1 (ko) | 2012-11-20 | 2014-02-26 | 앰코 테크놀로지 코리아 주식회사 | 반도체 디바이스 및 그 제조 방법 |
US8878353B2 (en) | 2012-12-20 | 2014-11-04 | Invensas Corporation | Structure for microelectronic packaging with bond elements to encapsulation surface |
US9136254B2 (en) | 2013-02-01 | 2015-09-15 | Invensas Corporation | Microelectronic package having wire bond vias and stiffening layer |
JP2014170686A (ja) | 2013-03-04 | 2014-09-18 | Toshiba Corp | 表示素子の製造方法、表示素子及び表示装置 |
US9202660B2 (en) | 2013-03-13 | 2015-12-01 | Teledyne Wireless, Llc | Asymmetrical slow wave structures to eliminate backward wave oscillations in wideband traveling wave tubes |
TWI591352B (zh) | 2013-06-07 | 2017-07-11 | 金士頓數位股份有限公司 | 測試裝置 |
US8981541B2 (en) * | 2013-07-10 | 2015-03-17 | Freescale Semiconductor, Inc. | Quad flat semiconductor device with additional contacts |
US9023691B2 (en) | 2013-07-15 | 2015-05-05 | Invensas Corporation | Microelectronic assemblies with stack terminals coupled by connectors extending through encapsulation |
US8883563B1 (en) | 2013-07-15 | 2014-11-11 | Invensas Corporation | Fabrication of microelectronic assemblies having stack terminals coupled by connectors extending through encapsulation |
US9034696B2 (en) | 2013-07-15 | 2015-05-19 | Invensas Corporation | Microelectronic assemblies having reinforcing collars on connectors extending through encapsulation |
US9167710B2 (en) | 2013-08-07 | 2015-10-20 | Invensas Corporation | Embedded packaging with preformed vias |
US9685365B2 (en) | 2013-08-08 | 2017-06-20 | Invensas Corporation | Method of forming a wire bond having a free end |
US20150076714A1 (en) | 2013-09-16 | 2015-03-19 | Invensas Corporation | Microelectronic element with bond elements to encapsulation surface |
KR101607981B1 (ko) | 2013-11-04 | 2016-03-31 | 앰코 테크놀로지 코리아 주식회사 | 반도체 패키지용 인터포저 및 이의 제조 방법, 제조된 인터포저를 이용한 반도체 패키지 |
US9082753B2 (en) | 2013-11-12 | 2015-07-14 | Invensas Corporation | Severing bond wire by kinking and twisting |
US9087815B2 (en) | 2013-11-12 | 2015-07-21 | Invensas Corporation | Off substrate kinking of bond wire |
US9379074B2 (en) | 2013-11-22 | 2016-06-28 | Invensas Corporation | Die stacks with one or more bond via arrays of wire bond wires and with one or more arrays of bump interconnects |
US9263394B2 (en) | 2013-11-22 | 2016-02-16 | Invensas Corporation | Multiple bond via arrays of different wire heights on a same substrate |
US9583456B2 (en) | 2013-11-22 | 2017-02-28 | Invensas Corporation | Multiple bond via arrays of different wire heights on a same substrate |
US9583411B2 (en) | 2014-01-17 | 2017-02-28 | Invensas Corporation | Fine pitch BVA using reconstituted wafer with area array accessible for testing |
US9214454B2 (en) | 2014-03-31 | 2015-12-15 | Invensas Corporation | Batch process fabrication of package-on-package microelectronic assemblies |
US10381326B2 (en) | 2014-05-28 | 2019-08-13 | Invensas Corporation | Structure and method for integrated circuits packaging with increased density |
US9646917B2 (en) | 2014-05-29 | 2017-05-09 | Invensas Corporation | Low CTE component with wire bond interconnects |
US9412714B2 (en) | 2014-05-30 | 2016-08-09 | Invensas Corporation | Wire bond support structure and microelectronic package including wire bonds therefrom |
KR102311677B1 (ko) * | 2014-08-13 | 2021-10-12 | 삼성전자주식회사 | 반도체소자 및 그 제조방법 |
US9735084B2 (en) | 2014-12-11 | 2017-08-15 | Invensas Corporation | Bond via array for thermal conductivity |
US9888579B2 (en) | 2015-03-05 | 2018-02-06 | Invensas Corporation | Pressing of wire bond wire tips to provide bent-over tips |
US9502372B1 (en) | 2015-04-30 | 2016-11-22 | Invensas Corporation | Wafer-level packaging using wire bond wires in place of a redistribution layer |
US9761554B2 (en) | 2015-05-07 | 2017-09-12 | Invensas Corporation | Ball bonding metal wire bond wires to metal pads |
US9490222B1 (en) | 2015-10-12 | 2016-11-08 | Invensas Corporation | Wire bond wires for interference shielding |
US10490528B2 (en) | 2015-10-12 | 2019-11-26 | Invensas Corporation | Embedded wire bond wires |
US10332854B2 (en) | 2015-10-23 | 2019-06-25 | Invensas Corporation | Anchoring structure of fine pitch bva |
US10181457B2 (en) | 2015-10-26 | 2019-01-15 | Invensas Corporation | Microelectronic package for wafer-level chip scale packaging with fan-out |
US9911718B2 (en) | 2015-11-17 | 2018-03-06 | Invensas Corporation | ‘RDL-First’ packaged microelectronic device for a package-on-package device |
US9659848B1 (en) | 2015-11-18 | 2017-05-23 | Invensas Corporation | Stiffened wires for offset BVA |
US9984992B2 (en) | 2015-12-30 | 2018-05-29 | Invensas Corporation | Embedded wire bond wires for vertical integration with separate surface mount and wire bond mounting surfaces |
US10834826B2 (en) * | 2016-02-25 | 2020-11-10 | Huawei Technologies Co., Ltd. | Glue dispensing method and circuit board |
US9935075B2 (en) | 2016-07-29 | 2018-04-03 | Invensas Corporation | Wire bonding method and apparatus for electromagnetic interference shielding |
US9960328B2 (en) | 2016-09-06 | 2018-05-01 | Amkor Technology, Inc. | Semiconductor device and manufacturing method thereof |
US20180088628A1 (en) * | 2016-09-28 | 2018-03-29 | Intel Corporation | Leadframe for surface mounted contact fingers |
US10299368B2 (en) | 2016-12-21 | 2019-05-21 | Invensas Corporation | Surface integrated waveguides and circuit structures therefor |
CN107324274B (zh) * | 2017-07-13 | 2024-04-05 | 中国工程物理研究院电子工程研究所 | 用于sip三维集成的封装载体 |
KR20210104364A (ko) | 2020-02-17 | 2021-08-25 | 삼성전자주식회사 | 반도체 패키지 |
CN112786555A (zh) * | 2021-01-12 | 2021-05-11 | 杰群电子科技(东莞)有限公司 | 一种功率模块封装结构及功率模块制造方法 |
CN115565893A (zh) * | 2022-12-06 | 2023-01-03 | 深圳宏芯宇电子股份有限公司 | 封装方法、封装设备及塑封元件 |
Family Cites Families (19)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5987840A (ja) * | 1982-11-10 | 1984-05-21 | Toray Silicone Co Ltd | 半導体装置 |
JPS6384128A (ja) * | 1986-09-29 | 1988-04-14 | Oki Electric Ind Co Ltd | 混成集積回路装置 |
JPS63104343A (ja) * | 1986-10-21 | 1988-05-09 | Mitsubishi Electric Corp | 半導体装置 |
JPH01122459A (ja) * | 1987-11-07 | 1989-05-15 | Alps Electric Co Ltd | 光書込みヘッド |
JPH0428260A (ja) * | 1990-05-23 | 1992-01-30 | Matsushita Electric Ind Co Ltd | 半導体チップの実装方法 |
JPH04154157A (ja) * | 1990-10-18 | 1992-05-27 | Fujitsu Miyagi Electron:Kk | 半導体装置の製造方法 |
JP3225062B2 (ja) * | 1991-08-05 | 2001-11-05 | ローム株式会社 | 熱硬化性樹脂シート及びそれを用いた半導体素子の実装方法 |
US5222014A (en) * | 1992-03-02 | 1993-06-22 | Motorola, Inc. | Three-dimensional multi-chip pad array carrier |
JPH0689914A (ja) * | 1992-09-09 | 1994-03-29 | Kawasaki Steel Corp | 半導体装置の封止方法 |
JPH06177323A (ja) * | 1992-12-02 | 1994-06-24 | Nippon Chemicon Corp | 半導体回路装置 |
JP2716336B2 (ja) * | 1993-03-10 | 1998-02-18 | 日本電気株式会社 | 集積回路装置 |
US5385869A (en) * | 1993-07-22 | 1995-01-31 | Motorola, Inc. | Semiconductor chip bonded to a substrate and method of making |
JP2531382B2 (ja) * | 1994-05-26 | 1996-09-04 | 日本電気株式会社 | ボ―ルグリッドアレイ半導体装置およびその製造方法 |
GB9502178D0 (en) * | 1995-02-03 | 1995-03-22 | Plessey Semiconductors Ltd | MCM-D Assemblies |
JPH09213829A (ja) * | 1995-06-06 | 1997-08-15 | Circuit Components Inc | Bga型i/oフォーマットを使用した高性能デジタルicパッケージ及びバイメタル充填バイア技術による単層セラミックス基板 |
US5697148A (en) * | 1995-08-22 | 1997-12-16 | Motorola, Inc. | Flip underfill injection technique |
US5783867A (en) * | 1995-11-06 | 1998-07-21 | Ford Motor Company | Repairable flip-chip undercoating assembly and method and material for same |
US5889326A (en) * | 1996-02-27 | 1999-03-30 | Nec Corporation | Structure for bonding semiconductor device to substrate |
JP3409957B2 (ja) * | 1996-03-06 | 2003-05-26 | 松下電器産業株式会社 | 半導体ユニット及びその形成方法 |
-
1998
- 1998-10-30 JP JP10311095A patent/JPH11219984A/ja active Pending
- 1998-11-05 US US09/186,339 patent/US6157080A/en not_active Expired - Lifetime
- 1998-11-05 DE DE69834702T patent/DE69834702T2/de not_active Expired - Lifetime
- 1998-11-05 EP EP98120996A patent/EP0915505B1/en not_active Expired - Lifetime
- 1998-11-06 TW TW087118510A patent/TW406382B/zh not_active IP Right Cessation
Cited By (34)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2007150346A (ja) * | 1999-09-03 | 2007-06-14 | Seiko Epson Corp | 半導体装置及びその製造方法、回路基板並びに電子機器 |
US6621172B2 (en) * | 1999-09-03 | 2003-09-16 | Seiko Epson Corporation | Semiconductor device and method of fabricating the same, circuit board, and electronic equipment |
KR100387451B1 (ko) * | 1999-10-14 | 2003-06-18 | 미쓰비시 덴끼 엔지니어링 가부시키가이샤 | 반도체 장치 및 그 제조방법 |
JP2001298039A (ja) * | 2000-04-12 | 2001-10-26 | Matsushita Electric Ind Co Ltd | 半導体装置 |
US8223578B2 (en) | 2000-05-26 | 2012-07-17 | Renesas Electronics Corporation | Semiconductor device including multi-chip |
US6587393B2 (en) | 2000-05-26 | 2003-07-01 | Hitachi, Ltd. | Semiconductor device including multi-chip |
US6411561B2 (en) | 2000-05-26 | 2002-06-25 | Hitachi, Ltd. | Semiconductor device including multi-chip |
US6847575B2 (en) | 2000-05-26 | 2005-01-25 | Renesas Technology Corp. | Semiconductor device including multi-chip |
US8711650B2 (en) | 2000-05-26 | 2014-04-29 | Renesas Electronics Corporation | Semiconductor device including multi-chip |
US6392950B2 (en) | 2000-05-26 | 2002-05-21 | Hitachi, Ltd. | Semiconductor device including multi-chip |
US7554872B2 (en) | 2000-05-26 | 2009-06-30 | Renesas Technology Corp. | Semiconductor device including multi-chip |
KR100374542B1 (ko) * | 2000-11-02 | 2003-03-04 | 앰코 테크놀로지 코리아 주식회사 | 반도체 패키지 및 그 제조방법 |
US6951774B2 (en) | 2001-04-06 | 2005-10-04 | Renesas Technology Corp. | Semiconductor device and method of manufacturing the same |
KR100708043B1 (ko) * | 2001-08-17 | 2007-04-16 | 앰코 테크놀로지 코리아 주식회사 | 반도체패키지 및 그 제조 방법 |
JP2003086758A (ja) * | 2001-09-10 | 2003-03-20 | Mitsubishi Electric Corp | 半導体装置の製造方法、製造装置、及び、半導体装置 |
JP2006504275A (ja) * | 2002-10-29 | 2006-02-02 | インフィネオン テクノロジーズ アクチエンゲゼルシャフト | 熱可塑性物質からなるアンダーフィル材を有する電子部品、およびその製造方法 |
US6841884B2 (en) | 2002-11-12 | 2005-01-11 | Oki Electric Industry Co., Ltd. | Semiconductor device |
US6992396B2 (en) | 2002-12-27 | 2006-01-31 | Matsushita Electric Industrial Co., Ltd. | Semiconductor device and method for fabricating the same |
US7221041B2 (en) * | 2003-07-29 | 2007-05-22 | Advanced Semiconductor Engineering, Inc. | Multi-chips module package and manufacturing method thereof |
JP2005191229A (ja) * | 2003-12-25 | 2005-07-14 | Shinko Electric Ind Co Ltd | 半導体装置の製造方法 |
US7239164B2 (en) | 2004-08-04 | 2007-07-03 | Sharp Kabushiki Kaisha | Stack type semiconductor apparatus package and manufacturing method thereof |
JP4565931B2 (ja) * | 2004-08-25 | 2010-10-20 | ルネサスエレクトロニクス株式会社 | 半導体装置の製造方法 |
JP2006066551A (ja) * | 2004-08-25 | 2006-03-09 | Renesas Technology Corp | 半導体装置の製造方法 |
JP2007181091A (ja) * | 2005-12-28 | 2007-07-12 | Nippon Dempa Kogyo Co Ltd | 2周波切替型の水晶発振器 |
JP2008069291A (ja) * | 2006-09-15 | 2008-03-27 | Shin Etsu Chem Co Ltd | 半導体封止用液状エポキシ樹脂組成物及び半導体装置 |
JP2008258318A (ja) * | 2007-04-03 | 2008-10-23 | Sanyo Electric Co Ltd | 半導体チップ及びその実装方法、半導体装置 |
JP2009016957A (ja) * | 2007-06-29 | 2009-01-22 | Kyocera Kinseki Corp | 圧電発振器 |
JP2009092545A (ja) * | 2007-10-10 | 2009-04-30 | Panasonic Corp | 角速度および加速度検出用複合センサ |
US9069000B2 (en) | 2007-10-10 | 2015-06-30 | Panasonic Intellectual Property Management Co., Ltd. | Composite sensor for detecting angular velocity and acceleration |
US9453851B2 (en) | 2007-10-10 | 2016-09-27 | Panasonic Intellectual Property Management Co., Ltd. | Composite sensor for detecting angular velocity and acceleration |
JP2011066231A (ja) * | 2009-09-17 | 2011-03-31 | Sharp Corp | 太陽電池モジュールおよび太陽電池モジュールの製造方法 |
JP2011082555A (ja) * | 2010-12-20 | 2011-04-21 | Renesas Electronics Corp | 半導体装置 |
JP2015093475A (ja) * | 2013-11-14 | 2015-05-18 | 株式会社デンソー | モールドパッケージおよびその製造方法 |
JP2014057107A (ja) * | 2013-12-20 | 2014-03-27 | Renesas Electronics Corp | 半導体装置の製造方法および半導体装置 |
Also Published As
Publication number | Publication date |
---|---|
EP0915505A1 (en) | 1999-05-12 |
DE69834702D1 (de) | 2006-07-06 |
TW406382B (en) | 2000-09-21 |
EP0915505B1 (en) | 2006-05-31 |
DE69834702T2 (de) | 2007-05-03 |
US6157080A (en) | 2000-12-05 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JPH11219984A (ja) | 半導体装置パッケージおよびその製造方法ならびにそのための回路基板 | |
US6214642B1 (en) | Area array stud bump flip chip device and assembly process | |
US7075183B2 (en) | Electronic device | |
JP3597754B2 (ja) | 半導体装置及びその製造方法 | |
JP5420505B2 (ja) | 半導体装置の製造方法 | |
US8710651B2 (en) | Semiconductor device and method for manufacturing the same | |
US5847456A (en) | Semiconductor device | |
JPH0888245A (ja) | 半導体装置 | |
WO1997020347A1 (en) | Semiconductor device, process for producing the same, and packaged substrate | |
US6589812B2 (en) | Pre-applied adhesion promoter | |
JP2004303861A (ja) | 半導体装置およびその製造方法 | |
JPH09237807A (ja) | 放熱性樹脂封止型半導体装置の製造方法 | |
KR20020044577A (ko) | 개선된 플립-칩 결합 패키지 | |
JP2000208675A (ja) | 半導体装置およびその製造方法 | |
JP3741553B2 (ja) | 半導体装置の接続構造および接続方法ならびにそれを用いた半導体装置パッケージ | |
JP3332555B2 (ja) | 半導体装置およびその製造方法 | |
JPWO2004030075A1 (ja) | 半導体装置の製造方法 | |
JPH0964080A (ja) | 半導体装置及びその製造方法 | |
JP3968321B2 (ja) | 半導体装置およびその製造方法 | |
JPH10261735A (ja) | 半導体装置およびその製造方法 | |
JP2001127102A (ja) | 半導体装置およびその製造方法 | |
KR100209267B1 (ko) | 비.지.에이 패키지의 열방출부 형성방법 | |
JPH11260945A (ja) | 半導体装置の実装構造及び実装方法 | |
JP3063691B2 (ja) | フレキシブルフィルム及びこれを有する半導体装置 | |
JP2002217232A (ja) | 半導体装置の製造方法 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20040127 |
|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20040326 |
|
A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20040420 |
|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20040615 |
|
A911 | Transfer to examiner for re-examination before appeal (zenchi) |
Free format text: JAPANESE INTERMEDIATE CODE: A911 Effective date: 20040630 |
|
A912 | Re-examination (zenchi) completed and case transferred to appeal board |
Free format text: JAPANESE INTERMEDIATE CODE: A912 Effective date: 20040730 |