JP2009517855A - 分子接合による結合のためのプロセスおよび装置 - Google Patents
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Abstract
【選択図】 図6
Description
粒子が無いこと;
炭化水素が無いこと;
金属汚染物質が無いこと;
一般に5ÅRMS未満の低い表面粗さ;
強い親水性、すなわち、貼り付けられるべき表面を終結させるかなりの濃度のSi−OHシラノール結合。
RCAタイプの洗浄、すなわち、粒子の減少に適するSC1(NH4OH,H2O2,H2O)槽と金属汚染物質の減少に適する炭化水素・SC2(HCl,H2O2,H2O)槽との組み合わせ;
有機汚染物質の減少に適するオゾン溶液(O3)を用いた洗浄;
硫酸と過酸化水素水との混合物を含む溶液(または、SPM溶液、硫酸過酸化物混合物)を用いた洗浄。
“Effects of plasma activation on hydrophilic bonding of Si and SiO2”(T. Suni et al., J. Electroch. Soc, Vol. 149. No. 6, p. 348 (2002));
“Time−dependent surface properties and wafer bonding of O2−plasma treated silicon (100) surfaces”(M. Wiegand et al., J. Electroch. Soc. Vol. 147, No. 7, p. 2734 (2000))。
表面状態の上記改質は、貼り付けられるべき上記基板の一方および/または他方の表面に吸着される水の層の厚さの減少である;
表面状態の上記改質が加熱によって完了される;
上記加熱は、基板が互いに密着した状態に置かれる前に且つ少なくとも結合の開始まで適用される;
上記加熱は、1〜90秒の継続時間にわたって、好ましくは30秒にわたって行なわれる;
上記加熱は、貼り付けられるべき基板の一方を支持するプレートからの熱の伝達による熱伝導によって行なわれる;
上記加熱は、貼り付けられるべき基板の一方を照らすランプからの輻射によって行なわれる;
上記ランプは、0.8m〜5mの波長をもって赤外線範囲で放射するランプである;
上記加熱は、30℃〜90℃の温度、好ましくは50℃〜60℃の温度で行なわれる;
上記加熱は、貼り付けられるべき基板の全面にわたって均一に適用される;
上記加熱は、貼り付けられるべき基板の外周領域で局所的に適用される:
接合が中心で開始され、上記外周領域は、貼り付けられるべき基板の全周に及ぶ;
接合が縁部で開始され、上記外周領域は、開始縁部の正反対で約120°の中心角によって制限される円の円弧を描く;
結合前に、プロセスは、貼り付けられるべき表面の一方および/または他方のプラズマ活性化の段階を備える。
表面状態の上記改質が表面の粗面化によって形成される;
表面状態の上記改質ステップは、貼り付けられるべき基板の一方および/または他方の粗い表面層を形成することから構成される;
上記粗い層を形成するため、プロセスは、基板の一方および/または他方を熱酸化することにより基板の一方および/または他方の表面に熱酸化物層を形成する熱酸化作業と、上記酸化物層をエッチングするようになっている熱酸化物層処理のための作業とを備える;
上記熱酸化物層処理が化学処理である;
上記熱酸化物層がSiO2層であり、上記化学処理は、3分を越える継続時間、好ましくは10分間にわたって50℃〜80℃の温度で行なわれるSC1処理である;
上記粗い層を形成するため、プロセスは、基板の一方および/または他方の表面上に酸化物層を堆積させるための作業を備える;
上記堆積は、TEOS酸化物層の堆積、LTO酸化物層の堆積、または、窒化物層の堆積を行なうことから構成される;
−プロセスは、結合前に且つ表面状態の上記改質ステップ後に、貼り付けられるべき表面の一方および/または他方のプラズマ活性化段階を備える。
ウエハの中心および方向を登録するためのアライナ(特に、「切り欠き」として知られる凹部の存在のおかげによる);
結合前の表面処理のための1つ以上のステーション(洗浄、濯ぎ、乾燥等のための作業);
第1の基板を受け、その後、結合の終りに第2の基板を受ける接合支持体。基板同士が接触状態に置かれる前に第2の基板を第1の基板よりも数ミリメートル上側に保つためにスペーサを更に設けることもできる;
結合の開始を確保する自動ピストン;
貼り付けられるべき或いは既に貼り付けられた基板のカセットを受ける1つ以上のローディングポート;
装置の1つの要素から他の要素へのウエハの輸送を確保するロボット。
RCA洗浄とオゾンに基づく処理とを組み合わせる湿潤洗浄による、貼り付けられるべき表面の前処理;
ドナー基板の表面の随意的なプラズマ活性化(O2);
ブラッシングおよびその後の超純水を用いた濯ぎ並びに遠心力を用いた乾燥による結合直前の表面の洗浄;
貼り付けられるべき基板の加熱チャックを用いた均一な加熱。チャック上には、基板が接触状態で配置されず、基板が数ミリメートル離間して互いに対向して配置される(図4参照)。加熱は、加熱デバイスの電力にしたがって、数秒間(1〜90秒、一般的に30秒)にわたって行なわれる;
基板を密着した状態に置き、結合を開始する;
加熱の終了。
RCA洗浄とオゾンに基づく処理とを組み合わせる湿潤洗浄による、貼り付けられるべき表面の前処理;
ドナー基板の表面の随意的なプラズマ活性化(O2);
ブラッシングおよびその後の超純水を用いた濯ぎ並びに遠心力を用いた乾燥による接合直前の表面の洗浄;
接触状態ではなく数ミリメートル離間して互いに対向して配置される基板の上側に位置されたランプLを使用する、開始点の反対側の領域のみにおける、貼り付けられるべき基板の加熱(図5参照)。加熱は、加熱デバイスの電力にしたがって、数秒間(1〜90秒、一般的に30秒)にわたって行なわれる;
接触した状態に置き、接合を開始する(IC ウエハ縁部での局所的な開始);
−ウエハの加熱の終了。
Claims (35)
- 2つの基板を互いに分子接合により結合するためのプロセスであって、当該プロセス中に前記基板の表面が密着した状態に置かれ、前記基板間で結合面の伝播によって結合が起こるプロセスにおいて、
結合前に、前記基板の一方および/または他方の表面状態を改質して前記結合面の伝播速度を調整することから構成されるステップを備えることを特徴とする、プロセス。 - 表面状態の前記改質が、結合されるべき前記基板の一方および/または他方の表面に吸着される水の層の厚さの減少であることを特徴とする、請求項1に記載のプロセス。
- 表面状態の前記改質が加熱によって形成されることを特徴とする、請求項1または2に記載のプロセス。
- 前記加熱が、密着した状態に置く前に且つ少なくとも基板同士の結合の開始まで適用されることを特徴とする、請求項3に記載のプロセス。
- 前記加熱が、1〜90秒の継続時間にわたって、好ましくは30秒にわたって行なわれることを特徴とする、請求項3または4に記載のプロセス。
- 前記加熱が、結合されるべき基板の一方を支持するプレートからの熱の伝達による熱伝導によって行なわれることを特徴とする、請求項3〜5のいずれか一項に記載のプロセス。
- 前記加熱が、貼り付けられるべき基板の一方を照らすランプからの輻射によって行なわれることを特徴とする、請求項3〜5のいずれか一項に記載のプロセス。
- 前記ランプが、0.8m〜5mの波長の赤外線範囲で放射するランプであることを特徴とする、請求項7に記載のプロセス。
- 前記加熱が、30℃〜90℃の温度、好ましくは50℃〜60℃の温度で行なわれることを特徴とする、請求項3〜8のいずれか一項に記載のプロセス。
- 前記加熱が、結合されるべき基板の表面の範囲にわたって均一に加えられることを特徴とする、請求項3〜9のいずれか一項に記載のプロセス。
- 前記加熱が、結合されるべき基板の外周領域で局所的に加えられることを特徴とする、請求項3〜9のいずれか一項に記載のプロセス。
- 接合が中心で開始され、前記外周領域が、結合されるべき基板の全周に及ぶことを特徴とする、請求項11に記載のプロセス。
- 接合が縁部で開始され、前記外周領域が、開始縁部の正反対で約120°の中心角によって制限される円の円弧を描くことを特徴とする、請求項11に記載のプロセス。
- 表面状態の前記改質が表面の粗面化によって形成されることを特徴とする、請求項1に記載のプロセス。
- 表面状態の前記改質の段階が、結合されるべき基板の一方および/または他方の表面に粗い層を形成することから構成されることを特徴とする、請求項14に記載のプロセス。
- 前記粗い層を形成するため、基板の一方および/または他方を熱酸化することにより基板の一方および/または他方の表面に熱酸化物層を形成する作業と、前記酸化物層をエッチングするようになっている熱酸化物層処理のための作業とを備えることを特徴とする、請求項15に記載のプロセス。
- 前記熱酸化物層処理が化学処理であることを特徴とする、請求項16に記載のプロセス。
- 前記熱酸化物層がSiO2層であり、前記化学処理が、3分を越える継続時間、好ましくは10分間にわたって50℃〜80℃の温度で行なわれるSC1処理であることを特徴とする、請求項17に記載のプロセス。
- 前記粗い層を形成するため、基板の一方および/または他方の表面上に酸化物層を堆積させるための作業を備えることを特徴とする、請求項15に記載のプロセス。
- 前記堆積が、TEOS酸化物層の堆積、LTO酸化物層の堆積、または、窒化物層の堆積を行なうことから構成されることを特徴とする、請求項19に記載のプロセス。
- 結合前に、結合されるべき表面の一方および/または他方をプラズマ活性化させるステップを更に備えることを特徴とする、請求項1〜20のいずれか一項に記載のプロセス。
- 前記プラズマ活性化により、約2時間の結合の補強アニーリング後、強力な結合エネルギに達することができることを特徴とする、請求項21に記載のプロセス。
- 前記アニーリングが600℃未満の温度で行なわれることを特徴とする、請求項22に記載のプロセス。
- 前記プラズマ活性が、加熱による表面状態の前記改質前に行なわれることを特徴とする、請求項3〜13のいずれか一項との組み合わせにおける請求項21〜23のいずれか一項に記載のプロセス。
- 前記プラズマ活性化が、粗面化による表面状態の前記改質後に行なわれることを特徴とする、請求項14〜20のいずれか一項との組み合わせにおける請求項21〜23のいずれか一項に記載のプロセス。
- 半導体材料から構成される薄層を備える構造を支持基板上に形成するためのプロセスであって、
支持基板と密着した状態でドナー基板を配置して、前記基板間での結合面の伝播にしたがって前記基板同士の分子接合による結合を生み出すステップと、
前記ドナー基板の一部を前記支持基板へ転写して、前記支持基板上に前記薄層を形成するステップと
を備えるプロセスにおいて、
結合前に、前記ドナー基板および/または前記支持基板の表面状態を改質して前記結合面の伝播速度を調整することから構成されるステップを備えることを特徴とする、プロセス。 - 前記ドナー基板がリサイクルにより生じるリフレッシュ基板であることを特徴とする、請求項26に記載のプロセス。
- 2つの基板同士を当該基板間での結合面の伝播にしたがって分子接合により結合するための装置であって、
結合前に前記基板の一方および/または他方の表面状態を改質して前記結合面の伝播速度を調整する手段を備えることを特徴とする、装置。 - 表面状態を改質する前記手段が、基板が密着した状態に置かれる前に且つ少なくとも前記基板同士の結合の開始まで基板の一方および/または他方の温度を上げて制御するようになっている加熱手段から構成されることを特徴とする、請求項28に記載の装置。
- 貼り付けられるべき基板の一方が配置されるプレートを備え、
前記プレートが加熱ウエハを形成することを特徴とする、請求項29に記載の装置。 - 1つ以上の電気抵抗が前記プレートの塊中に組み込まれることを特徴とする、請求項30に記載の装置。
- 温度が調整される流体を循環させることができる手段が前記プレートの塊中に組み込まれることを特徴とする、請求項30に記載の装置。
- 前記ウエハを照らして該ウエハを加熱するための1つ以上の加熱ランプを備えることを特徴とする、請求項30に記載の装置。
- 前記加熱手段が、基板上に対して直接に放射する1つ以上の加熱ランプによって形成されることを特徴とする、請求項29に記載の装置。
- 前記ランプが、0.8μm〜5μmの波長の赤外範囲で放射するランプであることを特徴とする、請求項34に記載の装置。
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Cited By (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2010539696A (ja) * | 2007-09-12 | 2010-12-16 | エス.オー.アイ.テック、シリコン、オン、インシュレター、テクノロジーズ | 層転写により構造を製造する方法 |
JP2012069927A (ja) * | 2010-08-23 | 2012-04-05 | Semiconductor Energy Lab Co Ltd | Soi基板の作製方法 |
JP2014510418A (ja) * | 2011-04-08 | 2014-04-24 | エーファウ・グループ・エー・タルナー・ゲーエムベーハー | ウェーハを永久的に結合する方法 |
WO2015046235A1 (ja) * | 2013-09-25 | 2015-04-02 | 芝浦メカトロニクス株式会社 | 基板処理装置、貼合基板の剥離方法、および接着剤の除去方法 |
US10083933B2 (en) | 2011-01-25 | 2018-09-25 | Ev Group E. Thallner Gmbh | Method for permanent bonding of wafers |
US10825793B2 (en) | 2011-04-08 | 2020-11-03 | Ev Group E. Thallner Gmbh | Method for permanently bonding wafers |
JP7535058B2 (ja) | 2019-03-29 | 2024-08-15 | ソイテック | 半導体オンインシュレータ基板を製造するためのプロセス |
Families Citing this family (53)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
FR2809534B1 (fr) * | 2000-05-26 | 2005-01-14 | Commissariat Energie Atomique | Dispositif semiconducteur a injection electronique verticale et son procede de fabrication |
US7601271B2 (en) * | 2005-11-28 | 2009-10-13 | S.O.I.Tec Silicon On Insulator Technologies | Process and equipment for bonding by molecular adhesion |
FR2912839B1 (fr) * | 2007-02-16 | 2009-05-15 | Soitec Silicon On Insulator | Amelioration de la qualite de l'interface de collage par nettoyage froid et collage a chaud |
FR2915624A1 (fr) * | 2007-04-26 | 2008-10-31 | Soitec Silicon On Insulator | Procedes de collage et de fabrication d'un substrat du type a couche enterree tres fine. |
EP2091071B1 (en) * | 2008-02-15 | 2012-12-12 | Soitec | Process for bonding two substrates |
JP5391599B2 (ja) * | 2008-07-14 | 2014-01-15 | オムロン株式会社 | 基板接合方法及び電子部品 |
FR2938202B1 (fr) * | 2008-11-07 | 2010-12-31 | Soitec Silicon On Insulator | Traitement de surface pour adhesion moleculaire |
FR2938702B1 (fr) * | 2008-11-19 | 2011-03-04 | Soitec Silicon On Insulator | Preparation de surface d'un substrat saphir pour la realisation d'heterostructures |
FR2943177B1 (fr) | 2009-03-12 | 2011-05-06 | Soitec Silicon On Insulator | Procede de fabrication d'une structure multicouche avec report de couche circuit |
FR2947380B1 (fr) * | 2009-06-26 | 2012-12-14 | Soitec Silicon Insulator Technologies | Procede de collage par adhesion moleculaire. |
SG176276A1 (en) * | 2009-07-17 | 2012-01-30 | Soitec Silicon On Insulator | Method of bonding using a bonding layer based on zinc, silicon and oxygen and corresponding structures |
FR2953641B1 (fr) | 2009-12-08 | 2012-02-10 | S O I Tec Silicon On Insulator Tech | Circuit de transistors homogenes sur seoi avec grille de controle arriere enterree sous la couche isolante |
FR2957193B1 (fr) | 2010-03-03 | 2012-04-20 | Soitec Silicon On Insulator | Cellule a chemin de donnees sur substrat seoi avec grille de controle arriere enterree sous la couche isolante |
FR2953643B1 (fr) | 2009-12-08 | 2012-07-27 | Soitec Silicon On Insulator | Cellule memoire flash sur seoi disposant d'une seconde grille de controle enterree sous la couche isolante |
US8508289B2 (en) | 2009-12-08 | 2013-08-13 | Soitec | Data-path cell on an SeOI substrate with a back control gate beneath the insulating layer |
FR2955195B1 (fr) | 2010-01-14 | 2012-03-09 | Soitec Silicon On Insulator | Dispositif de comparaison de donnees dans une memoire adressable par contenu sur seoi |
FR2955204B1 (fr) | 2010-01-14 | 2012-07-20 | Soitec Silicon On Insulator | Cellule memoire dram disposant d'un injecteur bipolaire vertical |
FR2955203B1 (fr) | 2010-01-14 | 2012-03-23 | Soitec Silicon On Insulator | Cellule memoire dont le canal traverse une couche dielectrique enterree |
FR2955200B1 (fr) | 2010-01-14 | 2012-07-20 | Soitec Silicon On Insulator | Dispositif, et son procede de fabrication, disposant d'un contact entre regions semi-conductrices a travers une couche isolante enterree |
KR101398080B1 (ko) | 2010-02-04 | 2014-05-23 | 소이텍 | 접합 반도체 구조물 및 그 형성방법 |
FR2957186B1 (fr) | 2010-03-08 | 2012-09-28 | Soitec Silicon On Insulator | Cellule memoire de type sram |
FR2957449B1 (fr) | 2010-03-11 | 2022-07-15 | S O I Tec Silicon On Insulator Tech | Micro-amplificateur de lecture pour memoire |
FR2958441B1 (fr) | 2010-04-02 | 2012-07-13 | Soitec Silicon On Insulator | Circuit pseudo-inverseur sur seoi |
EP2378549A1 (en) | 2010-04-06 | 2011-10-19 | S.O.I.Tec Silicon on Insulator Technologies | Method for manufacturing a semiconductor substrate |
EP2381470B1 (en) | 2010-04-22 | 2012-08-22 | Soitec | Semiconductor device comprising a field-effect transistor in a silicon-on-insulator structure |
SG193407A1 (en) * | 2011-04-08 | 2013-10-30 | Ev Group E Thallner Gmbh | Method for permanent bonding of wafers |
CN102543828B (zh) * | 2011-11-02 | 2014-12-10 | 上海华力微电子有限公司 | 一种soi硅片的制备方法 |
FR2990054B1 (fr) | 2012-04-27 | 2014-05-02 | Commissariat Energie Atomique | Procede de collage dans une atmosphere de gaz presentant un coefficient de joule-thomson negatif. |
US9329336B2 (en) | 2012-07-06 | 2016-05-03 | Micron Technology, Inc. | Method of forming a hermetically sealed fiber to chip connection |
EP3035370A1 (de) * | 2012-07-24 | 2016-06-22 | EV Group E. Thallner GmbH | Vorrichtung zum permanenten bonden von wafern |
US9640510B2 (en) * | 2013-07-05 | 2017-05-02 | Ev Group E. Thallner Gmbh | Method for bonding metallic contact areas with solution of a sacrificial layer applied on one of the contact areas |
US9922851B2 (en) | 2014-05-05 | 2018-03-20 | International Business Machines Corporation | Gas-controlled bonding platform for edge defect reduction during wafer bonding |
CN105197880B (zh) * | 2014-06-24 | 2018-03-20 | 中芯国际集成电路制造(上海)有限公司 | 一种带空腔晶片的键合方法 |
WO2016025478A1 (en) | 2014-08-11 | 2016-02-18 | Massachusetts Institute Of Technology | Interconnect structures for assembly of semiconductor structures including at least one integrated circuit structure |
CN104900615A (zh) * | 2015-05-08 | 2015-09-09 | 武汉新芯集成电路制造有限公司 | 一种提高键合力的方法及一种半导体键合结构 |
FR3036845B1 (fr) * | 2015-05-28 | 2017-05-26 | Soitec Silicon On Insulator | Procede de transfert d'une couche d'un substrat monocristallin |
US10658424B2 (en) | 2015-07-23 | 2020-05-19 | Massachusetts Institute Of Technology | Superconducting integrated circuit |
US10134972B2 (en) | 2015-07-23 | 2018-11-20 | Massachusetts Institute Of Technology | Qubit and coupler circuit structures and coupling techniques |
CN105140143B (zh) * | 2015-07-30 | 2019-01-22 | 武汉新芯集成电路制造有限公司 | 一种晶圆键合工艺 |
CN105185720B (zh) * | 2015-08-03 | 2018-05-08 | 武汉新芯集成电路制造有限公司 | 一种增强键合强度的超薄热氧化晶圆键合工艺 |
CN105206536B (zh) * | 2015-08-17 | 2018-03-09 | 武汉新芯集成电路制造有限公司 | 一种增强键合强度的晶圆键合方法及结构 |
US10242968B2 (en) | 2015-11-05 | 2019-03-26 | Massachusetts Institute Of Technology | Interconnect structure and semiconductor structures for assembly of cryogenic electronic packages |
WO2017079417A1 (en) | 2015-11-05 | 2017-05-11 | Massachusetts Institute Of Technology | Interconnect structures for assembly of semiconductor structures including superconducting integrated circuits |
WO2017140348A1 (de) * | 2016-02-16 | 2017-08-24 | Ev Group E. Thallner Gmbh | Verfahren zum bonden von substraten |
US10586909B2 (en) | 2016-10-11 | 2020-03-10 | Massachusetts Institute Of Technology | Cryogenic electronic packages and assemblies |
JP6558355B2 (ja) | 2016-12-19 | 2019-08-14 | 信越半導体株式会社 | Soiウェーハの製造方法 |
JP6854696B2 (ja) * | 2017-05-02 | 2021-04-07 | 東京エレクトロン株式会社 | 接合装置および接合方法 |
FR3103629B1 (fr) * | 2019-11-25 | 2021-10-22 | Soitec Silicon On Insulator | Procédé de collage de deux substrats |
FR3106235B1 (fr) * | 2020-01-09 | 2021-12-10 | Soitec Silicon On Insulator | Procede d’assemblage de deux substrats semi-conducteurs |
CN112259677B (zh) * | 2020-10-19 | 2022-11-01 | 济南晶正电子科技有限公司 | 一种具有图案的薄膜键合体、制备方法及电子器件 |
CN112233974A (zh) * | 2020-10-26 | 2021-01-15 | 广州粤芯半导体技术有限公司 | 防止湿法刻蚀中侧面侵蚀的方法及沟槽栅的形成方法 |
JP7105956B2 (ja) * | 2021-03-12 | 2022-07-25 | 東京エレクトロン株式会社 | 接合装置 |
FR3134650B1 (fr) | 2022-04-19 | 2024-03-01 | Soitec Silicon On Insulator | Procede d’assemblage de deux substrats par adhesion moleculaire, et structure obtenue par un tel procede |
Citations (12)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH02135722A (ja) * | 1988-11-16 | 1990-05-24 | Sony Corp | 半導体基体の張り合わせ方法 |
JPH03196610A (ja) * | 1989-09-25 | 1991-08-28 | Ulrich M Goesele | シリコンウェハの結合法 |
JPH07245250A (ja) * | 1994-03-04 | 1995-09-19 | Mitsubishi Materials Corp | 張り合わせ半導体基板の製造方法 |
JPH08122232A (ja) * | 1994-10-28 | 1996-05-17 | Nec Corp | 乾燥装置 |
JPH10335448A (ja) * | 1997-06-03 | 1998-12-18 | Oki Electric Ind Co Ltd | 誘電体分離基板の製造方法 |
JP2000223679A (ja) * | 1999-01-27 | 2000-08-11 | Sharp Corp | 半導体基板及びその製造方法 |
JP2004266070A (ja) * | 2003-02-28 | 2004-09-24 | Canon Inc | 貼り合わせシステム |
WO2005022610A1 (ja) * | 2003-09-01 | 2005-03-10 | Sumco Corporation | 貼り合わせウェーハの製造方法 |
WO2005027217A1 (ja) * | 2003-09-08 | 2005-03-24 | Sumco Corporation | Soiウェーハおよびその製造方法 |
JP2005109503A (ja) * | 2003-09-30 | 2005-04-21 | Commiss Energ Atom | 接合によって積層構造を形成しているウェハを分離するための方法 |
JP2005158813A (ja) * | 2003-11-20 | 2005-06-16 | Toshiba Ceramics Co Ltd | 接着半導体の製造方法 |
JP2006080314A (ja) * | 2004-09-09 | 2006-03-23 | Canon Inc | 結合基板の製造方法 |
Family Cites Families (28)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4883215A (en) * | 1988-12-19 | 1989-11-28 | Duke University | Method for bubble-free bonding of silicon wafers |
JP2512243B2 (ja) * | 1991-03-29 | 1996-07-03 | 信越半導体株式会社 | 半導体素子形成用基板の製造方法 |
JPH05190406A (ja) * | 1992-01-10 | 1993-07-30 | Nippon Steel Corp | 半導体基板貼付装置 |
US5236118A (en) * | 1992-05-12 | 1993-08-17 | The Regents Of The University Of California | Aligned wafer bonding |
US5503704A (en) * | 1993-01-06 | 1996-04-02 | The Regents Of The University Of California | Nitrogen based low temperature direct bonding |
JP3431951B2 (ja) * | 1993-06-16 | 2003-07-28 | キヤノン株式会社 | 半導体基板貼り合わせ装置 |
JP2929949B2 (ja) * | 1994-08-29 | 1999-08-03 | 信越半導体株式会社 | ウエーハの結合方法 |
US6388290B1 (en) | 1998-06-10 | 2002-05-14 | Agere Systems Guardian Corp. | Single crystal silicon on polycrystalline silicon integrated circuits |
JP3385972B2 (ja) | 1998-07-10 | 2003-03-10 | 信越半導体株式会社 | 貼り合わせウェーハの製造方法および貼り合わせウェーハ |
JP2000076710A (ja) * | 1998-08-26 | 2000-03-14 | Matsushita Electric Ind Co Ltd | 光ディスク用基板の貼り合わせ方法および装置 |
US6423613B1 (en) * | 1998-11-10 | 2002-07-23 | Micron Technology, Inc. | Low temperature silicon wafer bond process with bulk material bond strength |
CN1161770C (zh) * | 1999-03-23 | 2004-08-11 | 大日本油墨化学工业株式会社 | 光盘制造装置 |
US6566233B2 (en) | 1999-12-24 | 2003-05-20 | Shin-Etsu Handotai Co., Ltd. | Method for manufacturing bonded wafer |
US6902987B1 (en) * | 2000-02-16 | 2005-06-07 | Ziptronix, Inc. | Method for low temperature bonding and bonded structure |
FR2835096B1 (fr) * | 2002-01-22 | 2005-02-18 | Procede de fabrication d'un substrat auto-porte en materiau semi-conducteur monocristallin | |
FR2823599B1 (fr) * | 2001-04-13 | 2004-12-17 | Commissariat Energie Atomique | Substrat demomtable a tenue mecanique controlee et procede de realisation |
FR2839147B1 (fr) * | 2002-04-30 | 2004-07-09 | Soitec Silicon On Insulator | Dispositif et procede de controle automatique de l'etat de surface de plaque par mesure de vitesse de collage |
AU2003270613A1 (en) | 2002-09-10 | 2004-04-30 | Axcelis Technologies, Inc. | Method of heating a substrate in a variable temperature process using a fixed temperature chuck |
US20040060899A1 (en) * | 2002-10-01 | 2004-04-01 | Applied Materials, Inc. | Apparatuses and methods for treating a silicon film |
JP2004186226A (ja) | 2002-11-29 | 2004-07-02 | Shin Etsu Handotai Co Ltd | Soiウエーハの製造方法 |
US20040262686A1 (en) | 2003-06-26 | 2004-12-30 | Mohamad Shaheen | Layer transfer technique |
US6911376B2 (en) * | 2003-10-01 | 2005-06-28 | Wafermasters | Selective heating using flash anneal |
FR2868599B1 (fr) | 2004-03-30 | 2006-07-07 | Soitec Silicon On Insulator | Traitement chimique optimise de type sc1 pour le nettoyage de plaquettes en materiau semiconducteur |
US7261793B2 (en) | 2004-08-13 | 2007-08-28 | Hewlett-Packard Development Company, L.P. | System and method for low temperature plasma-enhanced bonding |
FR2884966B1 (fr) | 2005-04-22 | 2007-08-17 | Soitec Silicon On Insulator | Procede de collage de deux tranches realisees dans des materiaux choisis parmi les materiaux semiconducteurs |
US20060292823A1 (en) | 2005-06-28 | 2006-12-28 | Shriram Ramanathan | Method and apparatus for bonding wafers |
US20070090479A1 (en) * | 2005-10-20 | 2007-04-26 | Chien-Hua Chen | Controlling bond fronts in wafer-scale packaging |
US7601271B2 (en) | 2005-11-28 | 2009-10-13 | S.O.I.Tec Silicon On Insulator Technologies | Process and equipment for bonding by molecular adhesion |
-
2006
- 2006-02-17 US US11/357,771 patent/US7601271B2/en active Active
- 2006-11-20 WO PCT/EP2006/068647 patent/WO2007060145A1/en active Application Filing
- 2006-11-20 CN CN2006800443126A patent/CN101317258B/zh active Active
- 2006-11-20 JP JP2008541715A patent/JP5079706B2/ja active Active
- 2006-11-20 KR KR1020087012379A patent/KR101041015B1/ko active IP Right Grant
- 2006-11-20 EP EP06819601.3A patent/EP1964166B1/en active Active
- 2006-11-22 TW TW095143196A patent/TWI358084B/zh active
-
2009
- 2009-06-23 US US12/490,132 patent/US8158013B2/en active Active
- 2009-06-23 US US12/489,800 patent/US8091601B2/en active Active
-
2012
- 2012-07-20 JP JP2012161929A patent/JP5663535B2/ja active Active
Patent Citations (12)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH02135722A (ja) * | 1988-11-16 | 1990-05-24 | Sony Corp | 半導体基体の張り合わせ方法 |
JPH03196610A (ja) * | 1989-09-25 | 1991-08-28 | Ulrich M Goesele | シリコンウェハの結合法 |
JPH07245250A (ja) * | 1994-03-04 | 1995-09-19 | Mitsubishi Materials Corp | 張り合わせ半導体基板の製造方法 |
JPH08122232A (ja) * | 1994-10-28 | 1996-05-17 | Nec Corp | 乾燥装置 |
JPH10335448A (ja) * | 1997-06-03 | 1998-12-18 | Oki Electric Ind Co Ltd | 誘電体分離基板の製造方法 |
JP2000223679A (ja) * | 1999-01-27 | 2000-08-11 | Sharp Corp | 半導体基板及びその製造方法 |
JP2004266070A (ja) * | 2003-02-28 | 2004-09-24 | Canon Inc | 貼り合わせシステム |
WO2005022610A1 (ja) * | 2003-09-01 | 2005-03-10 | Sumco Corporation | 貼り合わせウェーハの製造方法 |
WO2005027217A1 (ja) * | 2003-09-08 | 2005-03-24 | Sumco Corporation | Soiウェーハおよびその製造方法 |
JP2005109503A (ja) * | 2003-09-30 | 2005-04-21 | Commiss Energ Atom | 接合によって積層構造を形成しているウェハを分離するための方法 |
JP2005158813A (ja) * | 2003-11-20 | 2005-06-16 | Toshiba Ceramics Co Ltd | 接着半導体の製造方法 |
JP2006080314A (ja) * | 2004-09-09 | 2006-03-23 | Canon Inc | 結合基板の製造方法 |
Cited By (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2010539696A (ja) * | 2007-09-12 | 2010-12-16 | エス.オー.アイ.テック、シリコン、オン、インシュレター、テクノロジーズ | 層転写により構造を製造する方法 |
JP2012069927A (ja) * | 2010-08-23 | 2012-04-05 | Semiconductor Energy Lab Co Ltd | Soi基板の作製方法 |
US10083933B2 (en) | 2011-01-25 | 2018-09-25 | Ev Group E. Thallner Gmbh | Method for permanent bonding of wafers |
JP2014510418A (ja) * | 2011-04-08 | 2014-04-24 | エーファウ・グループ・エー・タルナー・ゲーエムベーハー | ウェーハを永久的に結合する方法 |
US10825793B2 (en) | 2011-04-08 | 2020-11-03 | Ev Group E. Thallner Gmbh | Method for permanently bonding wafers |
WO2015046235A1 (ja) * | 2013-09-25 | 2015-04-02 | 芝浦メカトロニクス株式会社 | 基板処理装置、貼合基板の剥離方法、および接着剤の除去方法 |
JPWO2015046235A1 (ja) * | 2013-09-25 | 2017-03-09 | 芝浦メカトロニクス株式会社 | 基板処理装置、貼合基板の剥離方法、および接着剤の除去方法 |
JP7535058B2 (ja) | 2019-03-29 | 2024-08-15 | ソイテック | 半導体オンインシュレータ基板を製造するためのプロセス |
Also Published As
Publication number | Publication date |
---|---|
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