KR20040081344A - 박막 트랜지스터 및 그 제조 방법 - Google Patents
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- 239000010409 thin film Substances 0.000 title claims abstract description 248
- 238000000034 method Methods 0.000 title claims description 64
- 238000004519 manufacturing process Methods 0.000 title claims description 58
- 229910052739 hydrogen Inorganic materials 0.000 claims abstract description 154
- 239000001257 hydrogen Substances 0.000 claims abstract description 154
- UFHFLCQGNIYNRP-UHFFFAOYSA-N Hydrogen Chemical compound [H][H] UFHFLCQGNIYNRP-UHFFFAOYSA-N 0.000 claims abstract description 148
- 229910021420 polycrystalline silicon Inorganic materials 0.000 claims abstract description 128
- 239000010408 film Substances 0.000 claims description 206
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 claims description 54
- 229910021424 microcrystalline silicon Inorganic materials 0.000 claims description 31
- 239000000758 substrate Substances 0.000 claims description 31
- 229910052751 metal Inorganic materials 0.000 claims description 28
- 239000002184 metal Substances 0.000 claims description 28
- 238000005260 corrosion Methods 0.000 claims description 27
- 230000007797 corrosion Effects 0.000 claims description 27
- 235000012239 silicon dioxide Nutrition 0.000 claims description 27
- 239000000377 silicon dioxide Substances 0.000 claims description 27
- 238000005530 etching Methods 0.000 claims description 25
- 239000012535 impurity Substances 0.000 claims description 11
- 150000002431 hydrogen Chemical class 0.000 claims description 6
- 238000009792 diffusion process Methods 0.000 abstract description 18
- 238000009413 insulation Methods 0.000 abstract description 8
- 239000010410 layer Substances 0.000 description 100
- 238000005984 hydrogenation reaction Methods 0.000 description 38
- 229910021417 amorphous silicon Inorganic materials 0.000 description 16
- 239000011229 interlayer Substances 0.000 description 16
- WQJQOUPTWCFRMM-UHFFFAOYSA-N tungsten disilicide Chemical compound [Si]#[W]#[Si] WQJQOUPTWCFRMM-UHFFFAOYSA-N 0.000 description 16
- 229910021342 tungsten silicide Inorganic materials 0.000 description 16
- 238000010438 heat treatment Methods 0.000 description 15
- 238000000206 photolithography Methods 0.000 description 15
- 239000007789 gas Substances 0.000 description 13
- 238000002161 passivation Methods 0.000 description 13
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 11
- 229910052710 silicon Inorganic materials 0.000 description 11
- 239000010703 silicon Substances 0.000 description 11
- 229910052581 Si3N4 Inorganic materials 0.000 description 9
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 description 9
- 239000013081 microcrystal Substances 0.000 description 8
- 229910052782 aluminium Inorganic materials 0.000 description 6
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 description 6
- 238000010586 diagram Methods 0.000 description 5
- 238000001312 dry etching Methods 0.000 description 5
- 238000006243 chemical reaction Methods 0.000 description 4
- 239000000203 mixture Substances 0.000 description 4
- 238000005268 plasma chemical vapour deposition Methods 0.000 description 4
- 239000004065 semiconductor Substances 0.000 description 4
- 238000004904 shortening Methods 0.000 description 4
- MWUXSHHQAYIFBG-UHFFFAOYSA-N Nitric oxide Chemical compound O=[N] MWUXSHHQAYIFBG-UHFFFAOYSA-N 0.000 description 3
- 230000015572 biosynthetic process Effects 0.000 description 3
- 238000005229 chemical vapour deposition Methods 0.000 description 3
- 230000000694 effects Effects 0.000 description 3
- 239000011521 glass Substances 0.000 description 3
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 description 2
- XYFCBTPGUUZFHI-UHFFFAOYSA-N Phosphine Chemical compound P XYFCBTPGUUZFHI-UHFFFAOYSA-N 0.000 description 2
- 238000000137 annealing Methods 0.000 description 2
- 229910052802 copper Inorganic materials 0.000 description 2
- 239000010949 copper Substances 0.000 description 2
- 239000013078 crystal Substances 0.000 description 2
- 238000011049 filling Methods 0.000 description 2
- 150000002500 ions Chemical class 0.000 description 2
- 230000001678 irradiating effect Effects 0.000 description 2
- 239000004973 liquid crystal related substance Substances 0.000 description 2
- 239000011159 matrix material Substances 0.000 description 2
- 229910021421 monocrystalline silicon Inorganic materials 0.000 description 2
- 238000000059 patterning Methods 0.000 description 2
- 229920005591 polysilicon Polymers 0.000 description 2
- 239000012495 reaction gas Substances 0.000 description 2
- 238000004544 sputter deposition Methods 0.000 description 2
- 238000003949 trap density measurement Methods 0.000 description 2
- 229910000838 Al alloy Inorganic materials 0.000 description 1
- 229910000881 Cu alloy Inorganic materials 0.000 description 1
- OAICVXFJPJFONN-UHFFFAOYSA-N Phosphorus Chemical compound [P] OAICVXFJPJFONN-UHFFFAOYSA-N 0.000 description 1
- 229910018503 SF6 Inorganic materials 0.000 description 1
- 229910004298 SiO 2 Inorganic materials 0.000 description 1
- BLRPTPMANUNPDV-UHFFFAOYSA-N Silane Chemical compound [SiH4] BLRPTPMANUNPDV-UHFFFAOYSA-N 0.000 description 1
- 239000004020 conductor Substances 0.000 description 1
- 238000002425 crystallisation Methods 0.000 description 1
- 230000008025 crystallization Effects 0.000 description 1
- 238000000151 deposition Methods 0.000 description 1
- PZPGRFITIJYNEJ-UHFFFAOYSA-N disilane Chemical compound [SiH3][SiH3] PZPGRFITIJYNEJ-UHFFFAOYSA-N 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 238000005499 laser crystallization Methods 0.000 description 1
- 239000000463 material Substances 0.000 description 1
- 229910044991 metal oxide Inorganic materials 0.000 description 1
- 150000004706 metal oxides Chemical class 0.000 description 1
- 229910052698 phosphorus Inorganic materials 0.000 description 1
- 239000011574 phosphorus Substances 0.000 description 1
- 229910000073 phosphorus hydride Inorganic materials 0.000 description 1
- 238000000926 separation method Methods 0.000 description 1
- SFZCNBIFKDRMGX-UHFFFAOYSA-N sulfur hexafluoride Chemical compound FS(F)(F)(F)(F)F SFZCNBIFKDRMGX-UHFFFAOYSA-N 0.000 description 1
- 229960000909 sulfur hexafluoride Drugs 0.000 description 1
- TXEYQDLBPFQVAA-UHFFFAOYSA-N tetrafluoromethane Chemical compound FC(F)(F)F TXEYQDLBPFQVAA-UHFFFAOYSA-N 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/66007—Multistep manufacturing processes
- H01L29/66075—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials
- H01L29/66227—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials the devices being controllable only by the electric current supplied or the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched, e.g. three-terminal devices
- H01L29/66409—Unipolar field-effect transistors
- H01L29/66477—Unipolar field-effect transistors with an insulated gate, i.e. MISFET
- H01L29/66742—Thin film unipolar transistors
- H01L29/6675—Amorphous silicon or polysilicon transistors
- H01L29/66757—Lateral single gate single channel transistors with non-inverted structure, i.e. the channel layer is formed before the gate
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
- H01L29/76—Unipolar devices, e.g. field effect transistors
- H01L29/772—Field effect transistors
- H01L29/78—Field effect transistors with field effect produced by an insulated gate
- H01L29/786—Thin film transistors, i.e. transistors with a channel being at least partly a thin film
- H01L29/78651—Silicon transistors
- H01L29/7866—Non-monocrystalline silicon transistors
- H01L29/78672—Polycrystalline or microcrystalline silicon transistor
- H01L29/78675—Polycrystalline or microcrystalline silicon transistor with normal-type structure, e.g. with top gate
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- H—ELECTRICITY
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/40—Electrodes ; Multistep manufacturing processes therefor
- H01L29/43—Electrodes ; Multistep manufacturing processes therefor characterised by the materials of which they are formed
- H01L29/49—Metal-insulator-semiconductor electrodes, e.g. gates of MOSFET
- H01L29/4908—Metal-insulator-semiconductor electrodes, e.g. gates of MOSFET for thin film semiconductor, e.g. gate of TFT
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- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
- Y10S—TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10S438/00—Semiconductor device manufacturing: process
- Y10S438/91—Controlling charging state at semiconductor-insulator interface
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- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
- Y10S—TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10S438/00—Semiconductor device manufacturing: process
- Y10S438/958—Passivation layer
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- Engineering & Computer Science (AREA)
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- Power Engineering (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- Physics & Mathematics (AREA)
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- General Physics & Mathematics (AREA)
- Computer Hardware Design (AREA)
- Chemical & Material Sciences (AREA)
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- Manufacturing & Machinery (AREA)
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Abstract
Description
Claims (16)
- 소스 영역 및 드레인 영역이 형성된 다결정 실리콘 박막과,상기 다결정 실리콘 박막상에 게이트 절연막을 사이에 두고 형성된 게이트 전극을 구비하고,상기 게이트 절연막과 상기 게이트 전극의 사이에 상기 다결정 실리콘 박막과 상기 게이트 절연막의 계면으로 수소를 공급하기 위한 수소 공급층이 형성되는 것을 특징으로 하는 박막 트랜지스터.
- 제 1항에 있어서,상기 수소 공급층의 형상이 상기 게이트 전극의 형상과 개략 동일한 것을 특징으로 하는 박막 트랜지스터.
- 제 1항에 있어서,상기 게이트 절연막이 이산화실리콘막으로 이루어지는 것을 특징으로 하는 박막 트랜지스터.
- 소스 영역 및 드레인 영역이 형성된 다결정 실리콘 박막과, 상기 다결정 실리콘 박막상에 게이트 절연막을 사이에 두고 형성된 게이트 전극을 구비하는박막 트랜지스터 제조 방법에 있어서,절연 기판상에 소망하는 형상으로 아일런드화된 다결정 실리콘 박막을 형성하는 단계와,상기 다결정 실리콘 박막상에 게이트 절연막을 형성한 후, 상기 게이트 절연막상에 마이크로 크리스탈 실리콘 박막 및 금속 박막을 순차적으로 형성하는 단계와,상기 금속 박막상에 소망하는 형상의 내식성 마스크층을 형성한 후, 상기 내식성 마스크층을 이용하여 상기 금속 박막을 에칭하여 소망하는 형상의 상기 게이트 전극을 형성하는 단계와,상기 내식성 마스크층을 이용하여 상기 마이크로 크리스탈 실리콘 박막을 에칭하여 상기 게이트 전극과 개략 동일 형상의 수소 공급층을 형성하는 단계와,상기 게이트 전극의 표면을 포함하는 전체 표면상에 제 1의 절연막을 형성하는 단계와,상기 다결정 실리콘 박막에 소망하는 도전형의 불순물을 선택적으로 도입하여 상기 소스 영역 및 드레인 영역을 형성하는 단계와,300 내지 400℃로 열처리하여 상기 수소 공급층으로부터 상기 다결정 실리콘 박막과 상기 게이트 절연막의 계면으로 수소를 공급하는 단계를 포함하는 것을 특징으로 하는 박막 트랜지스터 제조 방법.
- 제 4항에 있어서,상기 수소를 공급하는 단계를 수소 플라즈마를 포함하는 분위기에서 행하는것을 특징으로 하는 박막 트랜지스터 제조 방법.
- 제 4항에 있어서,상기 수소를 공급하는 공정의 후에, 상기 제 1의 절연막 및 상기 게이트 절연막에 상기 소스 영역 및 상기 드레인 영역을 노출시키는 컨택트 홀을 개구하고, 상기 컨택트 홀 중의 하나의 컨택트 홀을 통하여 상기 소스 영역에 접속하는 소스 전극, 및 상기 컨택트 홀 중의 다른 컨택트 홀을 통하여 상기 드레인 영역에 접속하는 드레인 전극을 형성하고, 상기 소스 전극 및 상기 드레인 전극의 표면을 포함하는 노출된 전체 표면상에 제 2의 절연막을 형성하는 단계를 포함하는 것을 특징으로 하는 박막 트랜지스터 제조 방법.
- 제 4항에 있어서,상기 마이크로 크리스탈 실리콘 박막을 형성하는 공정 이후의 단계가 약 400℃ 이하에서 행하는 것을 특징으로 하는 박막 트랜지스터 제조 방법.
- 제 4항에 있어서,상기 게이트 절연막이 이산화실리콘막으로 이루어지는 것을 특징으로 하는 박막 트랜지스터 제조 방법.
- 소스 영역 및 드레인 영역이 형성된 다결정 실리콘 박막과, 상기 다결정 실리콘 박막상에 게이트 절연막을 사이에 두고 형성된 게이트 전극을 구비하는 박막 트랜지스터 제조 방법에 있어서,절연 기판상에 소망하는 형상으로 아일런드화된 다결정 실리콘 박막을 형성하는 단계와,상기 다결정 실리콘 박막상에 게이트 절연막을 형성한 후, 상기 게이트 절연막상에 마이크로 크리스탈 실리콘 박막 및 금속 박막을 순차적으로 형성하는 단계와,상기 금속 박막상에 소망하는 형상의 내식성 마스크층을 형성한 후, 상기 내식성 마스크층을 이용하여 상기 금속 박막을 에칭하여 소망하는 형상의 상기 게이트 전극을 형성하는 단계와,상기 내식성 마스크층을 이용하여 상기 마이크로 크리스탈 실리콘 박막을 에칭하여 상기 게이트 전극과 개략 동일 형상의 수소 공급층을 형성하는 단계와,상기 게이트 전극을 포함하는 노출된 전체 표면상에 제 1의 절연막을 형성하는 단계와,상기 다결정 실리콘 박막에 소망하는 도전형의 불순물을 선택적으로 도입하여 소스 영역 및 드레인 영역을 형성하는 단계를 포함하며,상기 제 1의 절연막을 형성하는 단계가 300 내지 400℃에서 행해져서 상기 수소 공급층으로부터 상기 다결정 실리콘 박막과 상기 게이트 절연막의 계면으로 수소를 공급하는 것을 특징으로 하는 박막 트랜지스터 제조 방법.
- 제 9항에 있어서,수소를 공급하기 위한 상기 제 1의 절연막을 형성하는 상기 단계에는 수소 플라즈마를 포함하는 분위기에서의 단계를 포함하는 것을 특징으로 하는 박막 트랜지스터 제조 방법.
- 제 9항에 있어서,상기 게이트 절연막이 이산화실리콘막으로 이루어지는 것을 특징으로 하는 박막 트랜지스터 제조 방법.
- 소스 영역 및 드레인 영역이 형성된 다결정 실리콘 박막과, 상기 다결정 실리콘 박막상에 게이트 절연막을 사이에 두고 형성된 게이트 전극을 구비하는 박막 트랜지스터 제조 방법에 있어서,절연 기판상에 소망하는 형상으로 아일런드화된 다결정 실리콘 박막을 형성하는 단계와,상기 다결정 실리콘 박막상에 게이트 절연막을 형성한 후, 상기 게이트 절연막상에 마이크로 크리스탈 실리콘 박막 및 금속 박막을 순차적으로 형성하는 단계와,상기 금속 박막상에 소망하는 형상의 내식성 마스크층을 형성한 후, 상기 내식성 마스크층을 이용하여 상기 금속 박막을 에칭하여 소망하는 형상의 상기 게이트 전극을 형성하는 단계와,상기 내식성 마스크층을 이용하여 상기 마이크로 크리스탈 실리콘 박막을 에칭하여 상기 게이트 전극과 개략 동일 형상의 수소 공급층을 형성하는 단계와,상기 게이트 전극의 표면을 포함하는 노출된 전체 표면상에 제 1의 절연막을 형성하는 단계와,상기 다결정 실리콘 박막에 소망하는 도전형의 불순물을 선택적으로 도입하여 소스 영역 및 드레인 영역을 형성하는 단계와,상기 제 1의 절연막 및 상기 게이트 절연막에 상기 소스 영역 및 상기 드레인 영역을 노출시키는 컨택트 홀을 개구하고, 상기 컨택트 홀 중의 하나의 컨택트 홀을 통하여 상기 소스 영역에 접속하는 소스 전극, 및 상기 컨택트 홀 중의 다른 컨택트 홀을 통하여 상기 드레인 영역에 접속하는 드레인 전극을 형성하고, 상기 소스 전극 및 상기 드레인 전극의 표면을 포함하는 노출된 전체 표면상에 제 2의 절연막을 형성하는 단계를 포함하며,상기 제 2의 절연막을 형성하는 단계는 300 내지 400℃에서 행해져서 상기 수소 공급층으로부터 상기 다결정 실리콘 박막과 상기 게이트 절연막의 계면으로 수소를 공급하는 것을 특징으로 하는 박막 트랜지스터 제조 방법.
- 제 12항에 있어서,상기 제2의 절연막을 형성하는 상기 단계 또는 상기 수소를 공급하기 위한 상기 제 1의 절연막을 형성하는 상기 단계에는 수소 플라즈마를 포함하는 분위기에서의 단계를 포함하는 것을 특징으로 하는 박막 트랜지스터 제조 방법.
- 제 12항에 있어서,상기 게이트 절연막이 이산화실리콘막으로 이루어지는 것을 특징으로 하는 박막 트랜지스터 제조 방법.
- 소스 영역 및 드레인 영역이 형성된 다결정 실리콘 박막과, 상기 다결정 실리콘 박막상에 게이트 절연막을 사이에 두고 형성된 게이트 전극을 구비하는 박막 트랜지스터 제조 방법에 있어서,절연 기판상에 소망하는 형상으로 아일런드화된 다결정 실리콘 박막을 형성하는 단계와,상기 다결정 실리콘 박막상에 게이트 절연막을 형성한 후, 상기 게이트 절연막상에 마이크로 크리스탈 실리콘 박막 및 금속 박막을 순차적으로 형성하는 단계와,상기 금속 박막상에 소망하는 형상의 내식성 마스크층을 형성한 후, 상기 내식성 마스크층을 이용하여 상기 금속 박막을 에칭하여 소망하는 형상의 상기 게이트 전극을 형성하는 단계와,상기 내식성 마스크층을 이용하여 상기 마이크로 크리스탈 실리콘 박막을 에칭하여 상기 게이트 전극과 개략 동일 형상의 수소 공급층을 형성하는 단계와,상기 게이트 전극의 표면을 포함하는 노출된 전체 표면상에 제 1의 절연막을 형성하는 단계와,상기 다결정 실리콘 박막에 소망하는 도전형의 불순물을 선택적으로 도입하여 소스 영역 및 드레인 영역을 형성하는 단계를 포함하고,상기 마이크로 크리스탈 실리콘 박막을 형성하는 단계 이후의 어느 하나의 단계는 300 내지 400℃에서 행해져서, 상기 수소 공급층으로부터 상기 다결정 실리콘 박막과 상기 게이트 절연막의 계면으로 수소를 공급하는 것을 특징으로 하는 박막 트랜지스터 제조 방법.
- 제 15항에 있어서,상기 게이트 절연막이 이산화실리콘막으로 이루어지는 것을 특징으로 하는 박막 트랜지스터 제조 방법.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2003067858A JP4382375B2 (ja) | 2003-03-13 | 2003-03-13 | 薄膜トランジスタの製造方法 |
JPJP-P-2003-00067858 | 2003-03-13 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR20040081344A true KR20040081344A (ko) | 2004-09-21 |
KR100607768B1 KR100607768B1 (ko) | 2006-08-01 |
Family
ID=32959309
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1020040016407A KR100607768B1 (ko) | 2003-03-13 | 2004-03-11 | 박막 트랜지스터 및 그 제조 방법 |
Country Status (6)
Country | Link |
---|---|
US (2) | US20040178429A1 (ko) |
JP (1) | JP4382375B2 (ko) |
KR (1) | KR100607768B1 (ko) |
CN (1) | CN1310339C (ko) |
SG (1) | SG138446A1 (ko) |
TW (1) | TWI285763B (ko) |
Families Citing this family (16)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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JP5344205B2 (ja) | 2006-03-22 | 2013-11-20 | Nltテクノロジー株式会社 | 積層配線、該積層配線を用いた半導体装置及びその製造方法 |
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US10340387B2 (en) | 2017-09-20 | 2019-07-02 | Wuhan China Star Optoelectronics Semiconductor Display Technology Co., Ltd. | Low temperature poly-silicon thin film transistor, manufacturing method thereof, and array substrate |
CN107507869A (zh) * | 2017-09-20 | 2017-12-22 | 武汉华星光电半导体显示技术有限公司 | 低温多晶硅薄膜晶体管及其制备方法和阵列基板 |
CN108987265A (zh) * | 2018-06-26 | 2018-12-11 | 武汉华星光电半导体显示技术有限公司 | 显示器件制造方法及装置 |
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JP2001326357A (ja) | 2000-05-16 | 2001-11-22 | Toshiba Corp | 薄膜トランジスタの製造方法 |
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-
2003
- 2003-03-13 JP JP2003067858A patent/JP4382375B2/ja not_active Expired - Fee Related
-
2004
- 2004-03-01 TW TW093105265A patent/TWI285763B/zh not_active IP Right Cessation
- 2004-03-04 SG SG200401067-4A patent/SG138446A1/en unknown
- 2004-03-08 US US10/793,845 patent/US20040178429A1/en not_active Abandoned
- 2004-03-11 KR KR1020040016407A patent/KR100607768B1/ko active IP Right Grant
- 2004-03-15 CN CNB2004100287474A patent/CN1310339C/zh not_active Expired - Lifetime
-
2009
- 2009-03-05 US US12/379,991 patent/US8183135B2/en not_active Expired - Lifetime
Also Published As
Publication number | Publication date |
---|---|
JP4382375B2 (ja) | 2009-12-09 |
TWI285763B (en) | 2007-08-21 |
CN1310339C (zh) | 2007-04-11 |
CN1531112A (zh) | 2004-09-22 |
SG138446A1 (en) | 2008-01-28 |
US20090209070A1 (en) | 2009-08-20 |
KR100607768B1 (ko) | 2006-08-01 |
JP2004281506A (ja) | 2004-10-07 |
TW200424650A (en) | 2004-11-16 |
US8183135B2 (en) | 2012-05-22 |
US20040178429A1 (en) | 2004-09-16 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A201 | Request for examination | ||
E902 | Notification of reason for refusal | ||
E701 | Decision to grant or registration of patent right | ||
GRNT | Written decision to grant | ||
FPAY | Annual fee payment |
Payment date: 20130705 Year of fee payment: 8 |
|
FPAY | Annual fee payment |
Payment date: 20140716 Year of fee payment: 9 |
|
FPAY | Annual fee payment |
Payment date: 20150626 Year of fee payment: 10 |
|
FPAY | Annual fee payment |
Payment date: 20160704 Year of fee payment: 11 |
|
FPAY | Annual fee payment |
Payment date: 20170628 Year of fee payment: 12 |
|
FPAY | Annual fee payment |
Payment date: 20180702 Year of fee payment: 13 |