JP4571476B2 - 半導体装置の製造方法 - Google Patents
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Description
GaN系化合物半導体を用いた半導体発光素子の一般的な製造工程では、サファイア単結晶基板上にバッファ層を介してGaN系化合物結晶層をエピタキシャル成長させることによって、発光ダイオード構造が形成される。しかし、サファイア基板とGaNとの格子不整合等に起因して、GaN系化合物結晶内に転位と呼ばれる多数の結晶欠陥が生じ、素子特性に悪影響を与える。そこで、横方向選択エピタキシャル成長によって、GaN系化合物結晶の結晶性を向上することが提案されている。
C面(ジャスト面)を主面としたサファイア基板上に下地層としてのGaN薄膜を形成し、その上に横方向選択成長によってGaN系化合物結晶を成長させる場合について考える。この場合、下地層のGaN薄膜の表面は、C面(ジャスト面)となっているのであるが、この表面では、ステップやキンクが少ない。そのため、原料原子は、ステップやキンクに到達できず、図13に図解的に示すようなアイランド成長を引き起こす。これにより、平坦性が損なわれていくのである。
そこで、本件発明者は、前記ストライプパターンに平行な方向にオフセット角を設定した基板と、ストライプパターンに垂直な方向にオフセット角を設定した基板とを用いて、それぞれGaN系化合物結晶の横方向選択成長を行った。
そこで、この発明の目的は、平坦性に優れた窒化ガリウム系化合物半導体層を基板上に形成することができる半導体装置の製造方法を提供することである。
とくに、この発明では、窒化ガリウム系化合物半導体を前記下地膜の表面に縦方向に選択的にエピタキシャル成長させて縦方向選択成長部を形成する縦方向選択エピタキシャル成長工程が行われる。そして、前記縦方向選択成長部を前記基板の主面に沿う横方向へと選択的にエピタキシャル成長させる横方向選択エピタキシャル成長工程が行われる。
窒化ガリウムストライプパターンが形成された基板主面上での縦方向選択エピタキシャル成長では、そのストライプパターンに応じたストライプ形状の窒化ガリウム系化合物半導体層が成長する。その後に、横方向選択エピタキシャル成長を行うと、窒化ガリウム系化合物半導体層のストライプ形状部同士が接合することになる。このとき、ストライプパターンに平行なストライプ平行方向に関してオフセット角が設定されていることによって、ストライプ平行方向に関する平坦性が良好になる。また、ストライプパターンに垂直なストライプ垂直方向に関してもオフセット角が設定されていることになるから、窒化ガリウム系化合物半導体層のストライプ形状部が接合した後、その接合段差がステップフロー成長によって解消される。これにより、ストライプ垂直方向に関しても良好な平坦性を得ることができる。
直線状の窒化ガリウムストライプパターンは、第1結晶軸に沿って形成されるが、このことは、基板の主面に垂直な方向から見た場合にストライプ平行方向が第1結晶軸にほぼ沿うことを意味していて、ストライプ平行方向が第1結晶軸と厳密に平行であることを意味しているわけではない。実際、基板の主面は第1結晶軸に対してオフセット角が設定された表面であるので、第2結晶軸方向から見た場合には、第1結晶軸とストライプ平行方向とは平行ではない。
基板の主面とは、基板の端面でない表面を指す。
主面が所定の結晶面からオフセットされた基板は、たとえば、基板表面を精密に研削することによって作製することができる。
この場合、C面に平行な結晶軸はA軸およびM軸であり、これらは互いに直交する。第1結晶軸がA軸の場合、第2結晶軸はM軸となり、第1結晶軸がM軸の場合、第2結晶軸はA軸となる。いずれの場合にも、基板は、A軸およびM軸の両方に関してそれぞれ0.1度〜0.5度のオフセット角でC面からオフセットされた主面を有することになる。これにより、C面に沿うステップフロー成長が安定に進行する成長条件でエピタキシャル成長を行うことにより、前記基板の主面にほぼ平行な表面を有する窒化ガリウム系化合物半導体層を形成することができる。
請求項3記載の発明は、前記基板がLiNbO3(ニオブ酸リチウム)基板であり、前記所定の結晶面が(100)面であることを特徴とする請求項1記載の半導体装置の製造方法である。
請求項4記載の発明は、前記基板がシリコン基板であり、前記所定の結晶面が(111)面であることを特徴とする請求項1記載の半導体装置の製造方法である。
請求項5記載の発明は、前記ストライプ形成工程は、窒化ガリウム系化合物半導体層の成長を抑制する直線ストライプ状のマスクを前記第1結晶軸に沿って形成することにより、当該マスク開口部に直線ストライプ状に露出する窒化ガリウム露出部を形成する工程を含むことを特徴とする請求項1ないし4のいずれかに記載の半導体装置の製造方法である。
前記窒化ガリウム露出部は、基板の主面に形成された窒化ガリウム系化合物半導体膜の表面の露出部であってもよい。また、基板として窒化ガリウム基板を用いる場合には、前記窒化ガリウム露出部は基板の表面の露出部であってもよい。
直線ストライプ状に凹凸加工された基板の主面にバッファ層が形成され、そのバッファ層上に窒化ガリウム系化合物半導体膜が下地膜として形成され、この窒化ガリウム系化合物半導体膜を核として窒化ガリウム系化合物半導体層のエピタキシャル成長が行われてもよい。
この方法では、窒化ガリウム系化合物半導体膜が直線ストライプ状に加工されるので、この窒化ガリウム系化合物半導体膜からのエピタキシャル成長によって良好な平坦性の窒化ガリウム系化合物半導体層を形成できる。
凹凸加工する場合には、窒化ガリウム系化合物半導体膜の直線ストライプパターンの凸条部にマスクを形成し、凹条部において露出する窒化ガリウム露出部からのエピタキシャル成長によって窒化ガリウム系化合物半導体層を形成することもできる。
請求項8記載の発明は、前記縦方向選択エピタキシャル成長工程が、R面が安定となる条件で窒化ガリウム系化合物半導体を結晶成長させる工程を含む、請求項1ないし7のいずれかに記載の半導体装置の製造方法である。
請求項9記載の発明は、前記縦方向選択エピタキシャル成長工程が、前記窒化ガリウムストライプパターンに沿って延びる尾根形状に前記縦方向選択成長部を成長させる工程を含む、請求項1ないし8のいずれかに記載の半導体装置の製造方法である。
請求項10記載の発明は、前記窒化ガリウム系化合物半導体層のエピタキシャル成長工程は、第1導電型の不純物を添加しながら、前記第1導電型の前記窒化ガリウム系化合物半導体層をエピタキシャル成長させる工程を含み、前記窒化ガリウム系化合物半導体層上に、電子および正孔の再結合により発光を生じる活性層を形成する工程と、前記活性層上に、前記第1導電型とは異なる第2導電型の第2の窒化ガリウム系化合物半導体層を形成する工程とを含むことを特徴とする請求項1ないし9のいずれかに記載の半導体装置の製造方法である。
第1導電型の窒化ガリウム系化合物半導体層の表面の平坦性が良好であるため、その上に形成される活性層および第2導電型の窒化ガリウム系化合物半導体層は良好な結晶性を有することができる。これにより、優れた発光効率を実現できる。
図1(a)〜図1(e)は、この発明の第1の実施形態に係る半導体装置の製造方法を工程順に示した断面図である。サファイア、炭化シリコンまたは窒化アルミニウムの結晶からなる基板1が準備される。この基板1は、その主面1aが、C面に対してオフセット角を設定した表面となっている。この基板1の主面1a上には、バッファ層2が形成される(図1(a)参照)。このバッファ層2は、Inx1Aly1Ga1-x1-y1N(0≦x1≦1、0≦y1≦1、0≦x1+y1≦1)で表されるIII族窒化物系化合物で構成することができ、たとえば、MOCVD法(有機金属化学気相成長法)等のエピタキシャル成長法によって形成することができる。バッファ層2の膜厚は、たとえば、200Å程度とすればよい。
図2(a)は基板1の図解的な平面図であり、図2(b)は基板1のオリエンテーションフラット1b側から見た図解的な正面図であり、図2(c)はオリエンテーションフラット1bに直交する方向から見た基板1の図解的な側面図である。
マスク層3のストライプパターンは、主面1a上にA軸に沿って平行直線状に形成されている。したがって、基板1は、ストライプ平行方向10に関してはC面からオフセット角αだけオフセットされており、ストライプ垂直方向11に関してはC面からオフセット角βだけオフセットされた2方向オフセット面を成している。
オフセット角α,βとGaN系化合物半導体層7の表面ラフネスとの関係は、概ね、次の表1に示す傾向を示す。
この実施形態では、基板1上にバッファ層2および下地GaN膜5を形成した後に、この下地GaN膜5の表面が、ストライプ状の凹凸形状に加工される。より具体的には、たとえば、下地GaN膜5の表面に、フォトリソグラフィ工程によって、等間隔のストライプパターン(この実施形態では平行直線ストライプパターン)に複数本のエッチングマスク12が形成される(図4(a))。そして、このエッチングマスク12をマスクとした用いたエッチングによって、下地GaN膜5の表面に等間隔のストライプパターンに複数本の凹条(凹部、溝部)13が形成される(図4(b))。エッチングマスク12の直下部分の下地GaN膜5は、凸条14となる。こうして下地GaN膜5の表面をストライプ状の凹凸形状に加工できる。
3μm程度とすればよい。
次に、横方向選択エピタキシャル成長を行うと、頂面が平坦なストライプ形状のGaN系化合物半導体層72(横方向選択成長部)が複数本形成された状態(図4(d))を経て、全面にわたって平坦なGaN系化合物半導体層7が得られる(図4(e))。この実施形態の場合にも、結晶成長の核となる下地GaN膜5の表面は、基板1の主面1aと同様に、C面に対して直交する2方向にオフセットされた表面となるから、ステップフロー成長によってGaN系化合物半導体層7を横方向選択エピタキシャル成長させることができる。これにより、アイランド成長を抑制できるので、GaN系化合物半導体層7の表面7aは、良好な平坦性を有することができる。
エッチングマスク12には、レジスト膜を適用してもよいが、GaN系化合物半導体が成長しにくい材料(たとえば、SiO2、SiNx、W、TiN、ZrO2)によってエッチングマスク12を形成してもよい。この場合、図5(a)および図5(b)に示すように、エッチングマスク12を剥離せずに残したままで、GaN系化合物半導体結晶の縦方向選択エピタキシャル成長(図5(a))および横方向選択エピタキシャル成長を順に行ってもよい。この場合には、凹条13からの結晶成長によってGaN系化合物半導体層7が形成されることになる。
さらに、エッチングマスク12を剥離する場合には、凹条13は、バッファ層2に達するように形成したり、基板1に達するように形成したりしてもよい。すなわち、下地GaN膜5を直線ストライプ状にパターニングしてもよい。この場合、たとえば、図6(a)および図6(b)に示すように、凸条14からの縦方向選択エピタキシャル成長(図6(a))および横方向選択エピタキシャル成長を順に行うことによってストライプ形状のGaN系化合物半導体層72を成長させ、さらに、これらを接合させて全面にGaN系化合物半導体層7を形成することができる。
この実施形態では、基板1の表面に対して、エッチングまたはダイシングにより、直線ストライプパターンの凹凸を形成する加工が行われる(図8(a))。すなわち、基板1の表面には、等間隔のストライプパターンに直線状の凹条21(凹部、溝)が複数本形成され、隣接する凹条21間にそれぞれ直線状の凸条22が形成されることになる。こうして複数本の凹条21および複数本の凸条22からなるストライプパターン(この実施形態では平行直線ストライプパターン)が形成される。凹条21の深さは、たとえば、3μm程度とされる。
前記第1および第2の参考例の場合と同様に、下地GaN膜5からの縦方向選択成長を行わず、下地GaN膜5に対して当初から横方向選択エピタキシャル成長によってGaN系化合物半導体層7を形成することも考えられる(第3の参考例)。この場合には、GaN系化合物半導体層7の形成途中の断面構造は、概ね図9に示すとおりとなり、尾根状のGaN系化合物半導体結晶は成長せず、平坦な頂面を有するストライプ状のGaN系化合物半導体層72が当初から成長することになる。
そして、図10(c)に示すように、P型GaN系化合物半導体層26に接合するP側電極31が形成され、N型GaN系化合物半導体層7の露出面7bに接合するN側電極32が形成される。これらの電極31,32間に通電することにより、GaN系化合物半導体層7,26から活性層25に電子および正孔がそれぞれ注入され、これらが活性層25において再結合することによって発光が生じることになる。
GaN系化合物半導体層7の表面7aの平坦性が良好であるため、その上に積層される活性層25との間に良好な界面を形成でき、さらに、活性層25とP型GaN系化合物半導体層26との界面の状態も良好になる。その結果、優れた発光効率の発光素子を実現できる。
また、図12に示すように、活性層25の上に積層されるP型GaN系化合物半導体層26をリッジ形状に形成し、そのリッジ形状部26Aの両側に電流狭窄のための高抵抗層27を形成するとともに、リッジ形状部26Aの頂面にP側電極31を接合させる構成としてもよい。高抵抗層27は、たとえば、SiO2等の絶縁膜で構成すればよい。
以上、この発明の好ましい実施形態について説明したが、この発明は他の形態でも実施することができる。たとえば、前述の実施形態では、基板1上に形成されるストライプパターンは等間隔に形成しているが、必ずしも等間隔である必要はない。たとえば、一部のストライプの間隔を広くすることにより、ストライプ形状のGaN系化合物半導体層72同士の接合部間の間隔を広くとることができ、これにより、接合部に起因する転位の少ない領域を形成できる。したがって、転位の少ない領域を選択して、その上方にP側電極31を配置することにより、発光効率の向上を図ることができる。
また、前述の実施形態では、基板1として、サファイア基板、炭化シリコン基板および窒化アルミニウム基板を例示したが、むろん、GaN基板を用いてもよい。ただし、一般に、GaNのバルク結晶の合成は困難であり、サファイア基板、炭化シリコン基板または窒化アルミニウム基板を用いる方が素子の製造が容易である。
1a 主面
1b オリエンテーションフラット
2 バッファ層
3 マスク層
5 GaN系化合物半導体膜(GaN膜)
7 GaN系化合物半導体層
7a 表面
7b 露出面
71 縦方向選択成長部
71A,71B 傾斜面
71C 稜線部
72 化合物半導体層
10 ストライプ平行方向
11 ストライプ垂直方向
12 エッチングマスク
13 凹条
14 凸条
21 凹条
22 凸条
25 活性層
26 GaN系化合物半導体層
26A リッジ形状部
27 高抵抗層
31 P側電極
32 N側電極
α A軸に対するオフセット角
β M軸に対するオフセット角
Claims (10)
- 所定の結晶面に平行な互いに直交する第1結晶軸および第2結晶軸の両方に対してそれぞれ0.1度〜0.5度の範囲のオフセット角を設定した主面を有する基板の当該主面に前記第1結晶軸に沿う直線状の窒化ガリウムストライプパターンを形成するストライプ形成工程と、
前記基板の主面にバッファ層を形成する工程と、
前記バッファ層上に下地膜としての窒化ガリウム系化合物半導体膜を形成する下地膜形成工程と、
前記窒化ガリウムストライプパターンが形成された前記基板の主面に、前記所定の結晶面に沿う横方向選択エピタキシャル成長によって、窒化ガリウム系化合物半導体層を形成するエピタキシャル成長工程とを含み、
前記エピタキシャル成長工程が、窒化ガリウム系化合物半導体を前記下地膜の表面に縦方向に選択的にエピタキシャル成長させて縦方向選択成長部を形成する縦方向選択エピタキシャル成長工程と、前記縦方向選択成長部を前記基板の主面に沿う横方向へと選択的にエピタキシャル成長させる横方向選択エピタキシャル成長工程とを含むことを特徴とする半導体装置の製造方法。 - 前記基板がサファイア基板、炭化シリコン基板、窒化アルミニウム基板または窒化ガリウム基板であり、前記所定の結晶面がC面であることを特徴とする請求項1記載の半導体装置の製造方法。
- 前記基板がLiNbO3基板であり、前記所定の結晶面が(100)面であることを特徴とする請求項1記載の半導体装置の製造方法。
- 前記基板がシリコン基板であり、前記所定の結晶面が(111)面であることを特徴とする請求項1記載の半導体装置の製造方法。
- 前記ストライプ形成工程は、窒化ガリウム系化合物半導体層の成長を抑制する直線ストライプ状のマスクを前記第1結晶軸に沿って形成することにより、当該マスク開口部に直線ストライプ状に露出する窒化ガリウム露出部を形成する工程を含むことを特徴とする請
求項1ないし4のいずれかに記載の半導体装置の製造方法。 - 前記ストライプ形成工程は、前記基板の主面を前記第1結晶軸に沿う直線ストライプ状に凹凸加工する工程を含むことを特徴とする請求項1ないし5のいずれかに記載の半導体装置の製造方法。
- 前記ストライプ形成工程は、前記窒化ガリウム系化合物半導体膜からなる下地膜を前記第1結晶軸に沿う直線ストライプ状に加工する工程を含むことを特徴とする請求項1ないし6のいずれかに記載の半導体装置の製造方法。
- 前記縦方向選択エピタキシャル成長工程が、R面が安定となる条件で窒化ガリウム系化合物半導体を結晶成長させる工程を含む、請求項1ないし7のいずれかに記載の半導体装置の製造方法。
- 前記縦方向選択エピタキシャル成長工程が、前記窒化ガリウムストライプパターンに沿って延びる尾根形状に前記縦方向選択成長部を成長させる工程を含む、請求項1ないし8のいずれかに記載の半導体装置の製造方法。
- 前記窒化ガリウム系化合物半導体層のエピタキシャル成長工程は、第1導電型の不純物を添加しながら、前記第1導電型の前記窒化ガリウム系化合物半導体層をエピタキシャル成長させる工程を含み、
前記窒化ガリウム系化合物半導体層上に、電子および正孔の再結合により発光を生じる活性層を形成する工程と、
前記活性層上に、前記第1導電型とは異なる第2導電型の第2の窒化ガリウム系化合物半導体層を形成する工程とを含むことを特徴とする請求項1ないし9のいずれかに記載の半導体装置の製造方法。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2004302975A JP4571476B2 (ja) | 2004-10-18 | 2004-10-18 | 半導体装置の製造方法 |
US11/231,822 US20060084245A1 (en) | 2004-10-18 | 2005-09-22 | Semiconductor device, semiconductor device production method, and substrate for the semiconductor device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2004302975A JP4571476B2 (ja) | 2004-10-18 | 2004-10-18 | 半導体装置の製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2006114829A JP2006114829A (ja) | 2006-04-27 |
JP4571476B2 true JP4571476B2 (ja) | 2010-10-27 |
Family
ID=36181312
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2004302975A Expired - Fee Related JP4571476B2 (ja) | 2004-10-18 | 2004-10-18 | 半導体装置の製造方法 |
Country Status (2)
Country | Link |
---|---|
US (1) | US20060084245A1 (ja) |
JP (1) | JP4571476B2 (ja) |
Families Citing this family (46)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP5082278B2 (ja) * | 2005-05-16 | 2012-11-28 | ソニー株式会社 | 発光ダイオードの製造方法、集積型発光ダイオードの製造方法および窒化物系iii−v族化合物半導体の成長方法 |
US9754782B2 (en) * | 2006-04-07 | 2017-09-05 | Sixpoint Materials, Inc. | Group III nitride substrates and their fabrication method |
KR101038069B1 (ko) * | 2006-04-25 | 2011-06-01 | 내셔널 유니버시티 오브 싱가포르 | 에피택셜 측방향 과도성장 질화갈륨 템플릿 상에 성장된 산화아연막의 방법 |
JP4933137B2 (ja) * | 2006-04-28 | 2012-05-16 | 学校法人 名城大学 | 半導体および半導体製造方法 |
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Also Published As
Publication number | Publication date |
---|---|
US20060084245A1 (en) | 2006-04-20 |
JP2006114829A (ja) | 2006-04-27 |
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Legal Events
Date | Code | Title | Description |
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A621 | Written request for application examination |
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|
A977 | Report on retrieval |
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|
A131 | Notification of reasons for refusal |
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A521 | Written amendment |
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|
A131 | Notification of reasons for refusal |
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|
A521 | Written amendment |
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|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
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|
A01 | Written decision to grant a patent or to grant a registration (utility model) |
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|
A61 | First payment of annual fees (during grant procedure) |
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|
FPAY | Renewal fee payment (event date is renewal date of database) |
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|
R150 | Certificate of patent or registration of utility model |
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LAPS | Cancellation because of no payment of annual fees |