DE102006051454A1 - Halbleitervorrichtung - Google Patents
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- 239000004065 semiconductor Substances 0.000 title claims abstract description 111
- 239000010410 layer Substances 0.000 claims abstract description 65
- 229920005989 resin Polymers 0.000 claims abstract description 65
- 239000011347 resin Substances 0.000 claims abstract description 65
- 239000000758 substrate Substances 0.000 claims abstract description 20
- 239000012790 adhesive layer Substances 0.000 claims abstract description 17
- 229920005992 thermoplastic resin Polymers 0.000 claims description 7
- 229910000679 solder Inorganic materials 0.000 description 14
- 238000004806 packaging method and process Methods 0.000 description 9
- 229920001187 thermosetting polymer Polymers 0.000 description 5
- 229910052782 aluminium Inorganic materials 0.000 description 4
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 description 4
- 238000010586 diagram Methods 0.000 description 4
- 238000001746 injection moulding Methods 0.000 description 4
- 239000000463 material Substances 0.000 description 4
- 238000005452 bending Methods 0.000 description 3
- 229910052751 metal Inorganic materials 0.000 description 3
- 239000002184 metal Substances 0.000 description 3
- 238000001721 transfer moulding Methods 0.000 description 3
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 description 2
- 229920000106 Liquid crystal polymer Polymers 0.000 description 2
- 239000004977 Liquid-crystal polymers (LCPs) Substances 0.000 description 2
- PXHVJJICTQNCMI-UHFFFAOYSA-N Nickel Chemical compound [Ni] PXHVJJICTQNCMI-UHFFFAOYSA-N 0.000 description 2
- 239000004734 Polyphenylene sulfide Substances 0.000 description 2
- 239000004020 conductor Substances 0.000 description 2
- 229910052802 copper Inorganic materials 0.000 description 2
- 239000010949 copper Substances 0.000 description 2
- 238000001514 detection method Methods 0.000 description 2
- 238000004519 manufacturing process Methods 0.000 description 2
- 238000000034 method Methods 0.000 description 2
- 229920001707 polybutylene terephthalate Polymers 0.000 description 2
- 229920000069 polyphenylene sulfide Polymers 0.000 description 2
- -1 Polybutylene terephthalate Polymers 0.000 description 1
- 230000001070 adhesive effect Effects 0.000 description 1
- PNEYBMLMFCGWSK-UHFFFAOYSA-N aluminium oxide Inorganic materials [O-2].[O-2].[O-2].[Al+3].[Al+3] PNEYBMLMFCGWSK-UHFFFAOYSA-N 0.000 description 1
- 230000015572 biosynthetic process Effects 0.000 description 1
- 238000005266 casting Methods 0.000 description 1
- PMHQVHHXPFUNSP-UHFFFAOYSA-M copper(1+);methylsulfanylmethane;bromide Chemical compound Br[Cu].CSC PMHQVHHXPFUNSP-UHFFFAOYSA-M 0.000 description 1
- 238000011161 development Methods 0.000 description 1
- 230000018109 developmental process Effects 0.000 description 1
- 238000009429 electrical wiring Methods 0.000 description 1
- 239000003822 epoxy resin Substances 0.000 description 1
- 239000011810 insulating material Substances 0.000 description 1
- 239000007788 liquid Substances 0.000 description 1
- 229910052759 nickel Inorganic materials 0.000 description 1
- NJPPVKZQTLUDBO-UHFFFAOYSA-N novaluron Chemical compound C1=C(Cl)C(OC(F)(F)C(OC(F)(F)F)F)=CC=C1NC(=O)NC(=O)C1=C(F)C=CC=C1F NJPPVKZQTLUDBO-UHFFFAOYSA-N 0.000 description 1
- 229920000647 polyepoxide Polymers 0.000 description 1
- 238000007788 roughening Methods 0.000 description 1
- 238000005476 soldering Methods 0.000 description 1
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Abstract
Einer der Aspekte der vorliegenden Erfindung ist die Bereitstellung einer Halbleitervorrichtung, welche eine Grundplatte (10), ein isolierendes Substrat (12) auf der Grundplatte (10) und eine Verdrahtungsmusterschicht (14) auf dem isolierenden Substrat (12) beinhaltet. Sie beinhaltet ebenfalls zumindest einen Halbleiterchip (20, 30), der auf der Verdrahtungsmusterschicht (14) befestigt ist, wobei der Halbleiterchip (20, 30) eine Oberflächenelektrode (22, 32) aufweist. Ein Hauptanschluß (40, 50) ist über eine leitende Haftschicht (16) auf zumindest einer der Oberflächenelektroden (22, 32) und der Verdrahtungsmusterschicht (14) angeschlossen. Ebenfalls bedeckt eine Harzverpackung (70) das isolierende Substrat (12), die Verdrahtungsmusterschicht (14), den Halbleiterchip (20, 30), die leitende Haftschicht (16) und zumindest einen Abschnitt des Hauptanschlusses (40, 50).
Description
- Die vorliegende Erfindung bezieht sich auf eine Halbleitervorrichtung und insbesondere auf eine Halbleitervorrichtung, die ihre Drahtinduktanz innerhalb eines Harzgehäuses verringern kann.
- Bei einer Leistungshalbleitervorrichtung, wie z.B. einem Leistungsmodul, das durch ein bekanntes Verfahren hergestellt ist, sind Leistungschips, wie z.B. ein Bipolartransistor mit isoliertem Gate (IGBT)-Chip und ein Freilaufdioden(FWD)-Chip mittels einer leitenden Haftschicht, wie z.B. einer Lotschicht, auf ein isolierendes Substrat mit einer Drahtmusterschicht montiert, die in einem Hohlharzgehäuse untergebracht (gehäust) sind.
- Die Leistungschips beinhalten jeweils Oberflächenelektroden (z.B. eine Emitterelektrode des IGBT-Chip und eine Anodenelektrode des FWD), die über einen leitenden Draht und die Drahtmusterschicht mit einem der Hauptanschlüsse elektrisch verbunden sind. Die Leistungschips beinhalten ebenfalls jeweils Gegen elektroden (d.h. eine Kollektorelektrode des IGBT-Chip und eine Kathodenelektrode des FWD-Chip), die über einen leitenden Draht und die Drahtmusterschicht mit dem anderen der Hauptanschlüsse elektrisch verbunden sind. Weiterhin ist eine Steuerelektrode, wie z.B. eine Gateelektrode des IGBT-Chip, über einen leitenden Draht mit einem Steueranschluß elektrisch verbunden. Diese Hauptanschlüsse und der Steueranschluß sind so ausgelegt, daß sie sich außerhalb über das Gehäuse hinaus erstrecken zur elektrischen Verbindung mit einer externen Schaltungsanordnung. Wie oben sind der IGBT-Chip und der FWD-Chip umgekehrt parallel verschaltet zum Aufbau eines Inverterschaltkreises.
- Die Hauptanschlüsse und der Steueranschluß werden durch das Harzgehäuse unterstützt und sind elektrisch mit den Drahtmusterschichten verbunden. Die leitenden Drähte und die Drahtmusterschichten zwischen dem Haupt-/Steueranschluß und den Chipelektroden (Oberflächen-/Gegen-/Steuer-Elektrode) neigen dazu, entsprechend der Konfiguration und dem Aufbau des Hohlharzgehäuses und der Drahtmusterschicht sowie der Anordnung der Leistungschips ziemlich redundant zu sein. Gemäß dem bekannten Leistungsmodul neigen dadurch die Drahtinduktanz des leitenden Drahtes und der Drahtmusterschicht dazu, bedeutender zu sein, wenn der Aufbau derselben komplizierter ist.
- Die größere Induktanz des leitenden Drahtes und der Drahtmusterschicht verursachen das Anliegen eines größeren Spannungsstoßes an dem Leistungschip, wie z.B. dem IGBT-Chip. Dies vergrößert den Energieverlust während des Schaltvorgangs des IGBT-Chips und sobald eine Überspannung an den IGBT-Chip angelegt wird, die die Spannungsfestigkeit des IGBT-Chips übersteigt, kann der IGBT-Chip durch die Überspannung schwer beschädigt werden.
- Wenn der leitende Draht für die elektrische Verbindung zwischen dem Steueranschluß und der Steuerelektrode des IGBT-Chips länger ist, ist der IGBT empfänglicher für elektromagnetische Störungen, die von außen eingestrahlt werden, was einen unsauberen oder fehlerhaften Schaltvorgang des IGBT-Chips verursachen kann.
- Das Leistungsmodul beinhaltet oft eine Mehrzahl von Inverterschaltkreisen, die parallel geschaltet sind, wobei bei jedem der IGBT-Chip umgekehrt parallel zu dem FWD-Chip geschaltet ist, und jeder der leitenden Drähte eine Verdrahtungslänge unterschiedlich zu den anderen aufweisen kann. Dies kann eine Abweichung (Variation) der Anschaltzeit der Inverterschaltkreise verursachen, wodurch ein Ungleichgewicht im Betriebsstrom, der jeden der parallel geschalteten IGBT-Chips durchläuft, verursacht werden kann. Ein übermäßiger Stromfluß durch einen der IGBT-Chips kann eine schwere Beschädigung an diesem Chip verursachen.
- Deshalb ist es wünschenswert, daß die Verdrahtungslänge für jeden der leitenden Drähte und jede der Drahtmusterschichten für einen Inverterschaltkreis minimiert und zu jener der anderen Inverterschaltkreise gleichgesetzt wird.
- Eine japanische Patentanmeldung JPA 9-321216 (hier als "Referenz
1 " bezeichnet) offenbart eine Leistungshalbleitervorrichtung, deren Induktanz verringert werden kann, welche Muttern beinhaltet, die auf eine leitende Basisschicht und eine Zuleitungsanschlußschicht innerhalb eines Harzgehäuses gelötet sind, wie in2 der Referenz1 dargestellt. Diese Muttern haben die Funktion, daß sie als externe Zuleitungsanschlüsse dienen. - Eine weitere japanische Patentanmeldung JPA-9-283681 (hier als "Referenz
2 " bezeichnet) offenbart eine Halbleitervorrichtung mit einer Harzverpackung, die durch eine Spritzpreß-Injektion von wärmehärtendem Harz ausgebildet ist, auf deren Deckfläche externe Zuleitungsanschlüsse vorgesehen sind. Die in2 der Referenz2 gezeigte Halbleitervorrichtung beinhaltet eine externe Anschlußplatte, deren Bodenseite mit der internen Verdrahtungsplatte verbunden ist und deren Oberseite mit einer Mutter verlötet ist, die mit einem externen Schaltkreis verbunden ist. Die Mutter ist so montiert, daß sie eine freiliegende Oberfläche hat, die bündig mit der Deckfläche der Harzverpackung 8 ist. - Obwohl die Muttern durch ein Hohlharzgehäuse und eine Lotschicht auf der Zuleitungsanschlußschicht unterstützt werden, ist gemäß der Referenz
1 das Hohlharzgehäuse mit weichem Gelharz aufgefüllt, so daß die Muttern mit ungenügender mechanischer Festigkeit befestigt sind. Deshalb gibt es den Nachteil, daß das Drehmoment an der Mutter, welches erzeugt wird während der Befestigung der Mutterwelle in der Mutter, leicht die Verbindung der Mutter mit der Zuleitungsanschlußschicht zerstört. - Die Halbleitervorrichtung der Referenz
2 hat ebenfalls das weitere Problem, daß, wenn die Harzverpackung durch Spritzpreß-Injektion des wärmehärtenden Harzes ausgebildet wird, eine wesentliche Zeit für das Aushärten des wärmehärtenden Harzes erforderlich ist. Dies bewirkt, daß das flüssige wärmehärtende Harz in einen kleinen Spalt zwischen der Mutter und der Form gelangt, so daß ein Harzgrat auf der Deckfläche der Mutter ausgebildet wird, welcher einer guten elektrischen Verbindung zwischen der Mutter und dem externen Schaltkreis im Wege stehen kann, wodurch die Herstellungseffizienz der Halbleitervorrichtung verringert wird. - Weiterhin hat die mit der internen Verdrahtungsplatte elektrisch verbundene externe Anschlußplatte eine beachtliche Induktanz, was die Verringerung der Gesamtinduktanz der Halbleitervorrichtung begrenzt.
- Die vorliegende Erfindung soll den oben beschriebenen Nachteilen begegnen und eine zuverlässige Halbleitervorrichtung liefern, welche die Verdrahtungsinduktanz zwischen dem Hauptanschluß und dem Halbleiterchip verringern kann und die mechanische Festigkeit des Hauptanschlusses verbessern kann.
- Die Aufgabe wird gelöst durch eine Halbleitervorrichtung nach Anspruch 1 und Anspruch 6.
- Weiterbildungen der Erfindung sind in den Unteransprüchen beschrieben.
- Gemäß eines der Aspekte der vorliegenden Erfindung beinhaltet eine Halbleitervorrichtung eine Grundplatte, ein isolierendes Substrat auf der Grundplatte und eine Drahtmusterschicht auf dem isolierenden Substrat. Sie beinhaltet ebenfalls zumindest einen Halbleiterchip, der auf der Drahtmusterschicht befestigt ist, wobei der Halbleiterchip eine Oberflächenelektrode aufweist. Ein Hauptanschluß ist über eine leitende Haftschicht zumindest entweder auf der Oberflächenelektrode oder der Drahtmusterschicht angeschlossen. Eine Harzverpackung bedeckt weiterhin das isolierende Substrat, die Drahtmusterschicht, den Halbleiterchip, die leitende Haftschicht und zumindest einen Abschnitt des Hauptanschlusses.
- Weitere Merkmale und Zweckmäßigkeiten der vorliegenden Erfindung werden anhand der nachfolgenden Beschreibung unter Bezug nahme auf die beigefügten Zeichnungen deutlich. Von den Figuren zeigen:
-
1 eine perspektivische Ansicht der ersten Ausführungsform der Halbleitervorrichtung gemäß der vorliegenden Erfindung, -
2 eine perspektivische Innenansicht der Halbleitervorrichtung von1 mit einer weggelassenen Harzverpackung, -
3 eine Querschnittsansicht entlang einer Linie III-III von1 , -
4 eine perspektivische Ansicht eines abgewandelten L-förmigen Hauptanschlusses, -
5 eine perspektivische Ansicht der zweiten Ausführungsform der Halbleitervorrichtung gemäß der vorliegenden Erfindung, -
6 eine perspektivische Innenansicht der Halbleitervorrichtung von5 mit einer weggelassenen Harzverpackung, -
7 eine Querschnittsansicht entlang einer Linie VII-VII von5 , -
8 eine Querschnittsansicht einer unfertigen Halbleitervorrichtung, die zwischen einer oberen und einer unteren Gußform vorgesehen ist, -
9 eine perspektivische Ansicht der dritten Ausführungsform der Halbleitervorrichtung gemäß der vorliegenden Erfindung, -
10 eine perspektivische Innenansicht der Halbleitervorrichtung von9 mit einer weggelassenen Harzverpackung, -
11 eine Draufsicht auf die Halbleitervorrichtung von9 mit einer weggelassenen Harzverpackung, -
12 eine Querschnittsansicht entlang einer Linie XII-XII von9 , -
13 eine perspektivische Ansicht der vierten Ausführungsform der Halbleitervorrichtung gemäß der vorliegenden Erfindung, -
14 eine Draufsicht der Halbleitervorrichtung von13 mit einer weggelassenen Harzverpackung, -
15A einen internen Schaltplan der Halbleitervorrichtung und -
15B und15C beispielhafte externe Verdrahtungsdiagramme für die Verbindungsanschlüsse. - Bezugnehmend auf die beigefügten Zeichnungen werden die Details der Ausführungsformen gemäß der vorliegenden Erfindung hier beschrieben werden. Obwohl bei dieser Beschreibung zweckmäßigerweise lediglich zur Klarheit eine Terminologie verwendet wird, die die Richtungen bezeichnet (beispielsweise "obere" und "untere"), sollte die Beschreibung nicht so ausgelegt werden, daß diese Terminologie den Umfang der vorliegenden Erfindung begrenzt.
- Ausführungsform 1
- Bezugnehmend auf
1 bis4 wird hier eine erste Ausführungsform der Halbleitervorrichtung gemäß der vorliegenden Erfindung beschrieben.1 ist eine perspektivische Ansicht der Halbleitervorrichtung gemäß der ersten Ausführungsform.2 ist eine perspektivische Innenansicht der Halbleitervorrichtung von1 mit einer weggelassenen Harzverpackung.3 ist eine Querschnittsansicht entlang einer Linie III-III von1 . - Die Halbleitervorrichtung
1 von2 gemäß der ersten Ausführungsform beinhaltet allgemein eine Grundplatte10 , ein isolierendes Substrat12 , welches auf der Grundplatte10 befestigt ist, eine Verdrahtungsmusterschicht14 , die auf dem isolierenden Substrat12 ausgebildet ist, und zumindest einen Halbleiterchip, der auf der Verdrahtungsmusterschicht14 befestigt ist. Die Grundplatte10 und die Verdrahtungsmusterschicht14 können aus Metall, wie z.B. Kupfer, hergestellt sein. Das isolierende Substrat12 kann aus isolierendem Material, wie z.B. Aluminiumoxid oder Aluminiumnitrid, oder aus Polymermaterial, wie z.B. Epoxydharz, ausgebildet sein. Eine leitende Haftschicht16 (3 ), wie z.B. eine Lotschicht, kann verwendet werden zum Befestigen des Halbleiterchips auf der Verdrahtungsmusterschicht14 . - Bei den folgenden Ausführungsformen der vorliegenden Erfindung werden hier im folgenden ein Chip eines Bipolartransistors mit isoliertem Gate
20 und ein Freilaufdiodenchip30 (welche einfach als ein "IGBT"-Chip" und ein "FWD-Chip" bezeichnet werden) als Beispiele der Halbleiterchips beschrieben. Die Halbleitervorrichtung1 kann jedoch andere Arten von Halbleiterchips aufweisen und ebenfalls einen einzelnen, drei oder mehr Halbleiterchips. Somit ist die vorliegende Erfindung nicht auf den Typ und/oder die Anzahl der Halbleiterchips begrenzt. - Der IGBT-Chip
20 beinhaltet auf seiner Bodenfläche eine Kollektorelektrode (nicht gezeigt), die nach unten zu der Verdrahtungsmusterschicht14 zeigt, und ebenfalls auf seiner Deckfläche, welche nach oben zeigt, eine Emitterelektrode22 und eine Steuerelektrode24 , wie z.B. eine Gateelektrode und eine Stromerfassungselektrode. Der FWD-Chip30 beinhaltet ebenfalls eine Kathodenelektrode (nicht gezeigt) auf seiner Bodenfläche und eine Anodenelektrode32 auf seiner Deckfläche. Während die Kollektorelektrode und die Kathodenelektrode mit der Verdrahtungsmusterschicht14 über eine Lotschicht16 verbunden sind, sind die Emitterelektrode22 und die Anodenelektrode32 über leitende Drähte34 aus Metall, wie z.B. Aluminium, elektrisch miteinander verbunden. Dadurch sind der IGBT-Chip20 und der FWD-Chip30 umgekehrt parallel zueinander geschaltet und bilden einen Inverterschaltkreis. Es sollte bemerkt werden, daß bei der vorliegenden Beschreibung die Emitterelektrode22 , die Steuerelektrode24 und die Anodenelektrode32 zusammen als "Oberflächenelektroden" bezeichnet werden können und die Kollektorelektrode und die Kathodenelektrode zusammen als "Rückseitenelektroden" bezeichnet werden können. - Die Halbleitervorrichtung
1 der ersten Ausführungsform beinhaltet ebenfalls L-förmige Hauptanschlüsse40 ,50 , die auf der Verdrahtungsmusterschicht14 bzw. der Anodenelektrode32 des FWD-Chips30 über leitende Haftschichten16 , wie z.B. eine Lotschicht, befestigt sind. Die L-förmigen Hauptanschlüsse40 ,50 werden durch Abbiegen von Platten aus leitendem Material, wie z.B. Metall, ausgebildet und beinhalten Verbindungsabschnitte42 ,52 , die der Lotschicht16 gegenüberliegen bzw. plattenförmige Ausdehnungsabschnitte44 ,54 , die sich in einer Richtung erstrecken, die im wesentlichen senkrecht zu der Lotschicht16 ist. - Wie in
2 und3 dargestellt ist, hat die Halbleitervorrichtung1 ebenfalls Steueranschlüsse (Hilfsanschlüsse)60 , die direkt auf den Steuerelektroden (der Gateelektrode und der Stromerfassungselektrode)24 über leitende Haftschichten (nicht gezeigt) befestigt sind. - Die unfertige Halbleitervorrichtung, die so zusammengesetzt ist, jedoch noch nicht vergossen ist (
2 ), wird innerhalb der Gußform angeordnet, welche wiederum durch ein Spritzgußverfahren mit thermoplastischem Harz aufgefüllt wird, so daß eine Harzverpackung70 ausgebildet wird und die in1 gezeigte Halbleitervorrichtung1 erhalten wird. Die Harzverpackung70 wird so ausgebildet, daß sie vollständig die Verbindungsabschnitte42 ,52 der L-förmigen Hauptanschlüsse40 ,50 umschließt und die oberen Enden46 ,56 der Ausdehnungsabschnitte44 ,54 und das obere Ende62 des Steueranschlusses60 frei läßt. Aus Gründen der Klarheit von3 wurde die Schraffur der Harzverpackung70 weggelassen. - Gemäß der so aufgebauten Halbleitervorrichtung
1 kann die Verdrahtungsinduktanz von den Oberflächenelektroden22 ,32 der Halbleiterchips20 ,30 bis zu den Hauptanschlüssen40 ,50 und dem Steueranschluß60 wesentlich verringert werden. Deshalb drückt die Verringerung der Verdrahtungsinduktanz der Halbleitervorrichtung1 den den Halbleiterchips20 ,30 zugeführten Spannungsstoß herab, so daß der Energieverlust verringert wird, der hervorgerufen wird während des Schaltvorgangs, wodurch eine Beschädigung des Halbleiterchip durch den Spannungsstoß verhindert wird. - Wie oben beschrieben, bedeckt die Harzverpackung
70 die gesamten Verbindungsabschnitte42 ,52 und die meisten der Ausdehnungsabschnitte44 ,54 , so daß die Verbindung der L-förmigen Hauptanschlüsse40 ,50 mit der Verdrahtungsmusterschicht14 bzw. der Anodenelektrode32 aufrechterhalten wird ohne unterbrochen zu werden, sogar wenn die freigelegten oberen Enden46 ,56 (1 ) eine mechanische Spannung entgegennehmen. Da das Meiste des Steueranschlusses60 mit Ausnahme der oberen Enden durch die Harzverpackung70 sicher unterstützt wird, kann eine robuste Halbleitervorrichtung1 verwirklicht werden, welche kaum an der Verbindungsfläche zwischen dem Steueranschluß60 und der Steuerelektrode24 beschädigt wird. - Während die L-förmigen Hauptanschlüsse
40 ,50 ausgebildet werden durch Biegen eines flachen ebenen Teils (Platte), können die Ausdehnungsabschnitte44 ,54 Durchgangslöcher48 enthalten oder eine Aufrauhung (Furchen)58 , wie in4A und4B veranschaulicht, zum Vergrößern der Hafteigenschaft mit dem thermoplastischen Harz (der Harzverpackung70 ). - Obwohl das thermoplastische Harz nicht hierauf eingeschränkt ist, kann es beispielsweise Polyphenylen-Sulfid(PPS)-Harz beinhalten, Polybuthylen-terephthalat(PBT)-Harz, ein flüssiges Kristallpolymer (LCP) beinhalten.
- Ausführungsform 2
- Bezugnehmend auf
5 bis8 wird hier eine zweite Ausführungsform der Halbleitervorrichtung gemäß der vorliegenden Er findung beschrieben.5 ist eine perspektivische Ansicht der Halbleitervorrichtung gemäß der zweiten Ausführungsform.6 ist eine perspektivische Innenansicht der Halbleitervorrichtung von5 mit einer weggelassenen Harzverpackung.7 ist eine Querschnittsansicht entlang einer Linie VII-VII von5 . - Da die Halbleitervorrichtung
2 der zweiten Ausführungsform Komponenten (und Material derselben) beinhaltet, die ähnlich zu jenen der Halbleitervorrichtung1 der ersten Ausführungsform sind, die mit ähnlichen Bezugszeichen bezeichnet sind, wird keine doppelte Beschreibung derselben gegeben und es erfolgt eine Konzentration auf Komponenten, die unterschiedlich zu jenen der ersten Ausführungsform sind. - Wie in
6 gezeigt beinhaltet die Halbleitervorrichtung2 der zweiten Ausführungsform die Grundplatte10 , das isolierende Substrat12 auf der Grundplatte10 , die Verdrahtungsmusterschicht14 auf dem isolierenden Substrat12 und zwei Paare der IGBT-Chips20 und der FWD-Chips30 , die auf der Drahtmusterschicht14 mittels der Lotschichten16 (7 ) montiert sind. Ähnlich zu der ersten Ausführungsform ist zum Bilden des Inverterschaltkreises jedes Paar von IGBT-Chips20 und FWD-Chips30 umgekehrt parallel verschaltet, so daß die Halbleitervorrichtung2 zwei Inverterschaltkreise, die in Reihe geschaltet sind, beinhaltet. - Während die leitenden Drähte
34 , wie z.B. Aluminiumdrähte, bei der ersten Ausführungsform verwendet werden für die elektrische Verbindung zwischen der Emitterelektrode22 des IGBT-Chip20 und der Anodenelektrode32 des FWD-Chip30 , wird bei der zweiten Ausführungsform die elektrische Verbindung zwischen ihnen erreicht mittels einer leitenden Zuleitungsplatte (auch als "Direktanschluß" bezeichnet), welche durch geeignetes Biegen einer Platte aus leitendem Material ausgebildet ist. Die leitenden Zuleitungsplatten80 sind ebenfalls über die entsprechenden Verdrahtungsmusterschichten14 mit Hauptanschlüssen90 verbunden. - Jede der Steuerelektroden
24 der IGBT-Chips20 ist ebenfalls über eine weitere leitende Zuleitungsplatte82 mit einer Kopfelektrode66 auf einem Sockelkopf64 elektrisch verbunden. Da jede der Kopfelektroden66 elektrisch mit dem entsprechenden Steueranschluß (Hilfsanschluß)24 verbunden ist, können die Steuerelektroden24 des IGBT-Chip20 zu den Steueranschlüssen60 nach außen geführt werden. Anstelle der leitenden Zuleitungsplatte82 können jedoch die bekannten leitenden Drähte verwendet werden zum Anschließen der Steuerelektroden24 an die Kopfelektroden66 . - Der Hauptanschluß
90 der zweiten Ausführungsform weist weiterhin ein Innengewindeloch94 auf, das sich in einer Richtung erstreckt, die im wesentlichen senkrecht zu der Lotschicht16 ist. Somit ist die Harzverpackung70 durch die Spritzgußmethode so ausgebildet, daß der Hauptanschluß90 sorgfältig innerhalb der Harzverpackung70 eingebettet ist, während das Innengewindeloch94 freiliegt. Der Hauptanschluß90 kann irgendeine Gestaltung haben, so lange er das Innengewindeloch aufweist, und ist bevorzugt eine hexagonale Mutter, wie in6 gezeigt. Der Hauptanschluß90 besteht ebenfalls aus Material von hervorragender Leitfähigkeit, wie z.B. Kupfer und Aluminium, welches zur Erleichterung des Lötens mit Nickel überzogen ist. Da der Hauptanschluß90 ein beachtliches Drehmoment aufnimmt, wenn ein Bolzen in dem Innengewindeloch befestigt wird zum Befestigen einer Schiene (nicht gezeigt) an dem Hauptanschluß90 , weist er jedoch bevorzugt eher eine Gestaltung auf, die dem Drehmoment entgegenwirkt, als eine säulenartige Gestalt. Die Gestalt des Hauptanschlusses90 kann plattenartig oder rechtwinklig mit dem Innengewindeloch94 sein. - Gemäß der zweiten Ausführungsform können die Verdrahtungsinduktanz des Hauptanschlusses
90 und des Steueranschlusses60 , die sich von den Oberflächenelektroden22 ,24 ,33 der Halbleiterchips20 ,30 erstrecken, wesentlich verringert werden. Deshalb drückt die Verringerung der Gesamtinduktanz der Halbleitervorrichtung2 den Spannungsstoß, der den Halbleiterchips20 ,30 zugeführt wird, herab, so daß der Energieverlust verringert wird, der hervorgerufen wird während des Schaltvorgangs, und eine Beschädigung der Halbleiterchips aufgrund des Spannungsstoßes vermieden wird. - Da der Hauptanschluß
90 mit Ausnahme des Innengewindeloches94 durch die Harzverpackung umfaßt und unterstützt wird, können weiterhin die Hauptanschlüsse90 in Verbindung mit der Drahtmusterschicht14 gehalten werden, ohne abgetrennt zu werden, sogar wenn sie die mechanische Spannung rund um das Innengewindeloch94 herum empfangen. Deshalb kann eine robuste Halbleitervorrichtung2 erhalten werden. - Es sollte bemerkt werden, daß, während die Hauptanschlüsse
40 ,50 der ersten Ausführungsform die Ausdehnungsabschnitte44 ,54 aufweisen, die Halbleitervorrichtung2 der zweiten Ausführungsform keinen Ausdehnungsabschnitt aufweist, was die Gesamt-Verdrahtungsinduktanz und die Größe in der Höhe (Größe in einer vertikalen Richtung) der Halbleitervorrichtung2 weiter verringert. - Die Halbleitervorrichtung
2 der zweiten Ausführungsform wird, wie in8 dargestellt, realisiert durch Anordnen der unfer tigen (nicht vollständigen) Halbleitervorrichtung vor dem Gießen zwischen oberen und unteren Gußformen UD, LD und durch Spritzgießen des thermoplastischen Harzes ausgehend von dem Harzeinlaß RI in die Gußform. Wenn die Harzverpackung durch Spritzpressen des wärmehärtenden Harzes ausgebildet wird, dringt, wie bei der vorstehend erwähnten Referenz2 , Harz in den schmalen Spalt zwischen dem Hauptanschluß90 und der oberen Gußform UD (wie durch einen Pfeil in8 angedeutet) zum Ausbilden des Harzgrates. Dadurch kann die fertiggestellte Halbleitervorrichtung2 mit dem Harzgrat auf dem oberen Ende des Hauptanschlusses90 oft ein Problem aufweisen, bei dem eine schlechte elektrische Verbindung zwischen dem Hauptanschluß90 und der Schiene hergestellt wird, wodurch eine niedrige Herstellungseffizienz der Halbleitervorrichtung2 verursacht wird. - Im Gegensatz hierzu ist gemäß der vorliegenden Ausführungsform die Harzverpackung
70 aus dem thermoplastischen Harz ausgebildet, welches rasch in Kontakt zu der Gußform abgekühlt wird (zur Härtung), was die Ausbildung des Harzgrates zwischen dem Hauptanschluß90 und der oberen Gußform UD verhindert. - Ausführungsform 3
- Bezugnehmend auf
9 bis12 wird eine dritte Ausführungsform der Halbleitervorrichtung gemäß der vorliegenden Erfindung hier beschrieben.9 ist eine perspektivische Ansicht der Halbleitervorrichtung gemäß der dritten Ausführungsform.10 und11 sind eine perspektivische Innenansicht bzw. eine Draufsicht der Halbleitervorrichtung von9 mit einer weggelassenen Harzverpackung.12 ist eine Draufsicht einer Querschnittsansicht entlang einer Linie XII-XII in9 . - Da die Halbleitervorrichtung
3 der dritten Ausführungsform Komponenten beinhaltet (und Material derselben), die ähnlich zu jenen der Halbleitervorrichtung1 der ersten Ausführungsform sind, welche mit ähnlichen Bezugszeichen bezeichnet werden, wird keine doppelte Beschreibung derselben gegeben und es erfolgt eine Konzentration auf Komponenten, die unterschiedlich zu jenen der ersten Ausführungsform sind. - Wie in
10 dargestellt, beinhaltet die Halbleitervorrichtung3 der dritten Ausführungsform die Grundplatte10 , das isolierende Substrat12 auf der Grundplatte10 , erste und zweite Verdrahtungsmusterschichten14a ,14b , welche auf dem isolierenden Substrat12 ausgebildet und voneinander beabstandet sind, und den IGBT-Chip20 und den FWD-Chip30 , die auf der Verdrahtungsmusterschicht14a mittels der Lotschicht16 montiert sind (12 ). - Ähnlich zu der zweiten Ausführungsform sind der IGBT-Chip
20 und der FWD-Chip30 über die leitende Zuleitungsplatte (Direktanschluß)80 elektrisch miteinander verbunden. Die elektrische Verbindung zwischen der leitenden Zuleitungsplatte80 und den Oberflächenelektroden22 ,32 wird mittels leitender Haftschichten16 (12 ), wie z.B. der Lotschicht, bewerkstelligt. Ähnlich zu den obigen Ausführungsformen sind ebenfalls der IGBT-Chip20 und der FWD-Chip30 umgekehrt parallel zueinander verschaltet zum Bilden des Inverterschaltkreises. - Ungleich der zweiten Ausführungsform ist die leitende Zuleitungsplatte
80 der dritten Ausführungsform nicht elektrisch mit der Verdrahtungsmusterschicht14 verbunden. Stattdessen ist ein Zwischenchip-Anschluß92 auf der leitenden Zuleitungsplatte80 über die leitende Haftschicht16 , wie z.B. die Lotschicht, befestigt. - Der Hauptanschluß
90 , der ähnlich zu jenem der zweiten Ausführungsform ist, ist auf der ersten Verdrahtungsmusterschicht14a mittels der leitenden Haftschicht (nicht gezeigt) befestigt. Die zweite Verdrahtungsmusterschicht14b ist mit der Steuerelektrode24 des IGBT-Chip20 über den Direktanschluß und die Lotschicht (nicht gezeigt) elektrisch verbunden. Es sollte bemerkt werden, daß der bekannte Aluminiumdraht für die elektrische Verbindung zwischen der zweiten Verdrahtungsmusterschicht14b und der Steuerelektrode24 des IGBT-Chip20 verwendet werden kann. Mittels der leitenden Schicht16 ist auf der zweiten Verdrahtungsmusterschicht14b ebenfalls der Steueranschluß (Hilfsanschluß)96 befestigt. - Von dem Hauptanschluß
90 , dem Zwischenchip-Anschluß92 und dem Steueranschluß96 hat jeder ein Innengewindeloch, das sich in einer Richtung erstreckt, die im wesentlichen senkrecht zu der Lotschicht16 ist, und die Harzverpackung70 ist durch die Spritzgußtechnik ausgebildet, so daß der Hauptanschluß90 , der Zwischenchip-Anschluß92 und der Steueranschluß96 im wesentlichen mit dem freiliegenden Innengewindeloch94 innerhalb der Harzverpackung70 eingebettet sind. Der Hauptanschluß90 , der Zwischenchip-Anschluß92 und der Steueranschluß96 können irgendeine Gestaltung aufweisen, solange jeder von ihnen das Innengewindeloch94 aufweist. Somit können diese Anschlüsse eine plattenartige oder rechteckige Gestaltung aufweisen und es ist wünschenswert, daß sie hexagonale Muttern sind. - Wie in
12 dargestellt, kann die Schiene B auf der Halbleitervorrichtung3 befestigt werden durch Befestigen des BolzensV in den Innengewindelöchern94 dieser Anschlüsse90 ,92 ,94 . - Gemäß der dritten Ausführungsform können die Verdrahtungsinduktanz des Zwischenchip-Anschlusses
92 und des Steueranschlusses96 , die sich von der leitenden Zuleitungsplatte80 und der Steuerelektrode24 erstrecken, minimiert werden. Die Verdrahtungsinduktanz des Hauptanschlusses90 , der sich von der ersten Verdrahtungsmusterschicht14a erstreckt, kann ebenfalls wesentlich verringert werden. Deshalb drückt die Verringerung der Gesamtinduktanz der Halbleitervorrichtung3 den den Halbleiterchips20 ,30 zugeführten Spannungsstoß herab, so daß der Energieverlust verringert wird, der hervorgerufen wird während des Schaltvorgangs, und eine Beschädigung der Halbleiterchips20 ,30 aufgrund des Spannungsstoßes kann vermieden werden. - Da mit Ausnahme der Innengewindelöcher der Hauptanschluß
90 , der Zwischenchip-Anschluß92 und der Steueranschluß96 durch die Harzverpackung70 umschlossen und unterstützt werden, können diese Anschlüsse90 ,92 ,96 in Verbindung auf der Drahtmusterschicht14 gehalten werden, ohne abgetrennt zu werden, sogar wenn sie rund um das Innengwindeloch herum eine mechanische Spannung entgegennehmen. Deshalb kann eine robuste Halbleitervorrichtung3 realisiert werden. - Gemäß der vorliegenden Ausführungsform wird die Harzverpackung
70 durch das thermoplastische Harz ausgebildet. Somit kann eine Halbleitervorrichtung3 erzielt werden, bei der ein Harzgrat und eine Unterbrechung der Verbindung zwischen den Schienen und den Anschlüssen beseitigt werden können. - Ausführungsform 4
- Bezugnehmend auf
13 bis15 wird hier eine vierte Ausführungsform der Halbleitervorrichtung gemäß der vorliegenden Er findung beschrieben.13 und14 sind eine perspektivische Innenansicht und eine Draufsicht der Halbleitervorrichtung von13 mit einer weggelassenen Harzverpackung.15A ist interner Schaltplan der Halbleitervorrichtung und15B und15C sind beispielhafte externe Verdrahtungsdiagramme für die Verbindung der Anschlüsse. - Die Halbleitervorrichtung
4 der vierten Ausführungsform beinhaltet Komponenten, die ähnlich zu jenen der dritten Ausführungsform sind, welche mit ähnlichen Bezugszeichen bezeichnet werden, mit der Ausnahme, daß eine Mehrzahl von Halbleitervorrichtungen in einer einzigen Harzverpackung70 eingeschlossen ist. Deshalb wird eine doppelte Beschreibung für die ähnlichen Komponenten der vierten Ausführungsform vermieden. - Da im Allgemeinen die neuen Leistungshalbleitervorrichtungen dazu neigen, einen höheren Strom zu steuern, der bei einer höheren Spannung fließt, enthalten viele von ihnen eine Mehrzahl der IGBT-Chips und der FWD-Chips, die innerhalb einer einzigen Harzverpackung vergossen sind. Gemäß den typischen Halbleitervorrichtungen sind die Steuerelektroden der IGBT-Chips elektrisch mit einem einzigen Steueranschluß über interne Verdrahtungen innerhalb der Harzverpackung verbunden. Dadurch ist entsprechend der Anordnung der IGBT-Chips innerhalb der Harzverpackung jede der internen Verdrahtungen zwischen der Steuerelektrode und dem einzigen Steueranschluß unterschiedlich zu den anderen. Deshalb kann das gleichzeitige Schalten (die Schaltgleichzeitigkeit) der IGBT-Chips nicht sichergestellt werden, was eine Variation des gesteuerten Stroms verursacht, der durch jeden der IGBT-Chips fließt. Schlimmstenfalls kann der gesteuerte Strom, der im Übermaß durch einen bestimmten IGBT-Chip fließt, eine verhängnisvolle Beschädigung desselben hervorrufen.
- Gemäß der vierten Ausführungsform der vorliegenden Erfindung beinhaltet die Halbleitervorrichtung
4 zwei Reihen und neun Stränge (2 × 9) von Inverterschaltkreisen, von denen jeder einen Hauptanschluß90 , einen Zwischenchip-Anschluß92 und einen Steueranschluß96 aufweist, die unabhängig von den Anschlüssen der anderen Inverterschaltkreise von der Harzverpackung70 hervorragen. Mit anderen Worten, eine der Verdrahtungen zwischen den Steueranschlüssen96 und den Steuerelektroden24 der IGBT-Chips20 hat die gleiche Länge wie die anderen. Wenn die externen Verdrahtungen zwischen einer Steuersignalquelle (nicht gezeigt) und den Steueranschlüssen96 so ausgelegt sind, daß sie gleich den anderen sind, kann deshalb die Schaltgleichzeitigkeit der IGBT-Chips erreicht werden. - Wie in
13 und14 dargestellt, ist einer von den Hauptanschlüssen90 , den Zwischenchip-Anschlüssen92 und den Steueranschlüssen96 bezüglich einer Mittellinie C von13 symmetrisch zu einem anderen angeordnet, was einem Endnutzer die gleiche Auslegung der externen Verdrahtungen erleichtert. - Zwei Reihen und neun Spalten (2 × 9) von Inverterschaltkreisen der
15A können über die externen Verdrahtungen verbunden werden, indem jede Reihe der Inverterschaltkreise in Reihe geschaltet wird, wie in15B dargestellt, so daß drei Sätze der Halbleitervorrichtungen realisiert werden können, welche unabhängig drei Phasen (U-, V-, W-Phase) des Treiberstroms steuern. Wie in15C dargestellt, kann ebenfalls eine einzige Leistungshalbleitervorrichtung zum Steuern eines umfangreicheren Stroms erzielt werden mittels externer Verdrahtungen, die jede Reihe der Inverterschaltkreise in Reihe schalten und drei Spalten derselben parallel schalten. Gemäß der vierten Ausführungsform erstreckt sich jeder von den Hauptanschlüssen90 , den Zwischenchip-Anschlüssen92 und den Steueranschlüssen96 unabhängig von den anderen von der Harzverpackung70 und diese Anschlüsse sind bezüglich der Mittellinie C symmetrisch zu den anderen angeordnet. Dies erhöht die Flexibilität für das Design der externen Verdrahtungen auf Seiten des Endnutzers.
Claims (11)
- Halbleitervorrichtung mit: einer Grundplatte (
10 ); einem isolierenden Substrat (12 ) auf der Grundplatte (10 ); einer Verdrahtungsmusterschicht (14 ) auf dem isolierenden Substrat (12 ); zumindest einem Halbleiterchip (20 ,30 ), der auf der Verdrahtungsmusterschicht (14 ) befestigt ist, wobei der Hableiterchip (20 ,30 ) eine Oberflächenelektrode (22 ,32 ) aufweist; einem Hauptanschluß (40 ,50 ), der über eine leitende Haftschicht (16 ) auf zumindest einer von der Oberflächenelektrode (22 ,32 ) und der Verdrahtungsmusterschicht (14 ) angeschlossen ist; einer Harzverpackung (70 ), die das isolierende Substrat (12 ), die Verdrahtungsmusterschicht (14 ), den Halbleiterchip (20 ,30 ), die leitende Haftschicht (16 ) und zumindest einen Abschnitt des Hauptanschlusses (40 ,50 ) bedeckt. - Halbleitervorrichtung nach Anspruch 1, bei der der Hauptanschluß (
40 ,50 ) einen Verbindungsabschnitt (42 ,52 ) beinhaltet, der der leitenden Haftschicht (16 ) gegenüberliegt, und einen plattenartigen Ausdehnungsabschnitt (44 ,54 ) in einer Richtung senkrecht zu der leitenden Haftschicht (16 ), und bei der die Harzverpackung (70 ) den Verbindungsabschnitt (42 ,52 ) bedeckt, während zumindest ein Abschnitt des Ausdehnungsabschnittes (44 ,54 ) freiliegt. - Halbleitervorrichtung nach Anspruch 1 oder 2, bei der der Hauptanschluß (
40 ,50 ) ein L-förmiges leitendes Teil aufweist. - Halbleitervorrichtung nach einem der Ansprüche 1 bis 3, bei der der Hauptanschluß (
40 ,50 ) ein Innengewindeloch (94 ) aufweist, das von der Harzverpackung (70 ) freigelassen wird. - Halbleitervorrichtung nach einem der Anschlüsse 1 bis 4, bei der der Hauptanschluß (
40 ,50 ) eine leitende Mutter ist. - Halbleitervorrichtung mit: einer Grundplatte (
10 ); einem isolierenden Substrat (12 ) auf der Grundplatte (10 ); einer Verdrahtungsmusterschicht (14a ,14b ) auf dem isolierenden Substrat (12 ); zumindest zwei Halbleiterchips (20 ,30 ), die auf der Verdrahtungsmusterschicht (14a ) befestigt sind, wobei jeder der Halbleiterchips (20 ,30 ) eine Oberflächenelektrode (22 ,32 ) aufweist; einer Zuleitungsplatte (80 ), die auf jeder der Oberflächenelektroden (22 ,32 ) der Halbleiterchips (20 ,30 ) angeschlossen ist; einem Zwischenchip-Anschluß (92 ), der über eine leitende Haftschicht (16 ) auf der Zuleitungsplatte (80 ) angeschlossen ist; einer Harzverpackung (70 ), die das isolierende Substrat (12 ), die Verdrahtungsmusterschicht (14 ), die Halbleiterchips (20 ,30 ), die leitende Haftschicht (16 ) und zumindest einen Abschnitt des Zwischenchip-Anschlusses (92 ) bedeckt. - Halbleitervorrichtung nach Anspruch 6, bei der der Zwischenchip-Anschluß (
92 ) ein Innengewindeloch (94 ) aufweist, das von der Harzverpackung (70 ) freigelassen wird. - Halbleitervorrichtung nach Anspruch 6 oder 7, bei der die Halbleiterchips (
20 ,30 ) ein Paar aus einem Transistorchip (20 ) und einem Diodenchip (30 ) aufweisen, welche umgekehrt parallel geschaltet sind, wobei der Transistorchip (20 ) eine Steuerelektrode (24 ) aufweist; bei der ein Steueranschluß (96 ) auf der Steuerelektrode (24 ) des Transistorchips (20 ) angeschlossen ist, der sich in einer Richtung senkrecht zu der Steuerelektrode (24 ) erstreckt, und bei der die Harzverpackung (70 ) einen Abschnitt des Steueranschlusses (96 ) frei läßt. - Halbleitervorrichtung nach einem der Ansprüche 6 bis 8, die weiterhin eine Mehrzahl von Hauptanschlüssen (
90 ) aufweist, von denen jeder auf der Verdrahtungsmusterschicht (14a ) angeschlossen ist; und bei der die Halbleiterchips (20 ,30 ) eine Mehrzahl von Paaren von Transistorchips (20 ) und Diodenchips (30 ) beinhalten, von denen jedes Paar umgekehrt parallel verschaltet ist, wobei jeder der Transistorchips (20 ) eine Steuerelektrode (24 ) aufweist, und bei der eine Mehrzahl von Steueranschlüssen (96 ) mit den Steuerelektroden (24 ) der Transistorchips (20 ) verbunden ist, die sich in einer Richtung senkrecht zu den Steuerelektroden (24 ) erstrecken, und bei der die Harzverpackung (70 ) einen Abschnitt jedes Steueranschlusses (96 ) frei läßt. - Halbleitervorrichtung nach Anspruch 9, bei der jeder der Hauptanschlüsse (
90 ), der Zwischenchip-Anschlüsse (92 ) und der Steueranschlüsse (96 ) die durch die Harzverpackung (70 ) freigelassenen Abschnitte beinhaltet, und bei der einer von den Hauptanschlüssen (90 ), den Zwischenchip-Anschlüssen (92 ) bzw. den Steueranschlüssen (96 ) bezüglich einer Mittellinie symmetrisch zu einem anderen angeordnet ist. - Halbleitervorrichtung nach einem der Ansprüche 1 bis 10, bei der die Harzverpackung (
70 ) aus thermoplastischem Harz ausgebildet ist.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2006057207A JP2007235004A (ja) | 2006-03-03 | 2006-03-03 | 半導体装置 |
JP2006-057207 | 2006-03-03 |
Publications (2)
Publication Number | Publication Date |
---|---|
DE102006051454A1 true DE102006051454A1 (de) | 2007-09-13 |
DE102006051454B4 DE102006051454B4 (de) | 2012-10-04 |
Family
ID=38336184
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE102006051454A Expired - Fee Related DE102006051454B4 (de) | 2006-03-03 | 2006-10-31 | Halbleitervorrichtung |
Country Status (4)
Country | Link |
---|---|
US (1) | US7589412B2 (de) |
JP (1) | JP2007235004A (de) |
CN (1) | CN101030570B (de) |
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CN101030570B (zh) | 2010-05-12 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
OP8 | Request for examination as to paragraph 44 patent law | ||
R016 | Response to examination communication | ||
R016 | Response to examination communication | ||
R016 | Response to examination communication | ||
R079 | Amendment of ipc main class |
Free format text: PREVIOUS MAIN CLASS: H01L0023482000 Ipc: H01L0023480000 |
|
R018 | Grant decision by examination section/examining division | ||
R079 | Amendment of ipc main class |
Free format text: PREVIOUS MAIN CLASS: H01L0023482000 Ipc: H01L0023480000 Effective date: 20110927 |
|
R020 | Patent grant now final |
Effective date: 20130105 |
|
R119 | Application deemed withdrawn, or ip right lapsed, due to non-payment of renewal fee |