JP2006131925A - Cu合金薄膜およびCu合金スパッタリングターゲット並びにフラットパネルディスプレイ - Google Patents

Cu合金薄膜およびCu合金スパッタリングターゲット並びにフラットパネルディスプレイ Download PDF

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Abstract

【課題】 熱処理が施された場合でも、従来技術では発生しやすかったボイドが抑制され、低電気抵抗率が維持されるCu合金薄膜を提供する。
【解決手段】 FeおよびPを含み残部が実質的にCuであるCu合金薄膜であって、該FeとPの含有量が下記式(1)〜(3)を全て満たすことを特徴とするCu合金薄膜であり、200〜500℃で1〜120分間の熱処理が施された場合に、Fe2PがCuの結晶粒界に析出するCu合金薄膜。 1.4 NFe+ 8 NP < 1.3 …(1) NFe+ 48 NP > 1.0 …(2) 12 NFe+ NP > 0.5 …(3)[式中、NFeはFeの含有量(at%)、NPはPの含有量(at%)である]
【選択図】 図8

Description

本発明は、Cu合金薄膜およびCu合金スパッタリングターゲット並びにフラットパネルディスプレイに関するものであり、特に、熱処理が施された後でも、低い電気抵抗率を維持しつつボイドの抑制されたCu合金薄膜と、該Cu合金薄膜の形成に用いるスパッタリングターゲット、および該Cu合金薄膜を配線膜または電極膜に用いたフラットパネルディスプレイに関するものである。
液晶ディスプレイ、プラズマディスプレイパネル、フィールドエミッションディスプレイ、エレクトロルミネッセンスディスプレイをはじめとするフラットパネルディスプレイの製造では、画面の大型化に伴う信号線の信号遅延を解消すべく、配線に電気抵抗のより小さな材料を用いることが求められている。特に液晶ディスプレイでは、画素を駆動するための薄膜トランジスタ(TFT)のゲート線および信号線(ソース・ドレイン線)といった配線の更なる低電気抵抗化が要求されており、現在では、該配線の材料として、Al−Ndなどの耐熱性を有するAl合金が用いられている。
しかし液晶ディスプレイ、特に液晶TVのディスプレイは40型を越える大型化が進んでおり、これに伴う上記信号遅延の問題を解決すべく、純Al(抵抗率<3.3μΩ・cm:薄膜実験値)よりも更に低い電気抵抗率を示すAgやCuが素材として注目されている。ところがAgには、液晶ディスプレイに適用するにあたり、ガラス基板やSiN絶縁膜との密着性に劣るといった問題や、ウェットエッチによる配線の加工性が十分とはいえないといった問題がある。また、Ag元素の凝集性により絶縁不良が生じるといった問題もある。従って実用化の観点からは、LSIで既に使用されているCuの方がAgよりも液晶ディスプレイに適用しやすく、Cuを配線材料としたディスプレイパネルや液晶表示素子が、既に提案されている(例えば特許文献1、特許文献2等)。
特開2002−202519号公報 特開平10−253976号公報
しかしながら、Cuを配線材料に適用する場合にも解決すべき改善点がいくつかある。一つはボイドと呼ばれる粒界割れ目を抑制することである。液晶ディスプレイにおけるTFT(以下「液晶TFT」ということがある)の配線形成工程には、スパッタリングにより薄膜形成後に、ゲート酸化膜形成や層間絶縁膜形成などの工程で約300℃程度まで加熱する熱処理工程が含まれるが、この熱処理工程における降温時に、ガラス基板と金属配線(Cu配線)との熱膨張率の差に起因して金属配線が引張応力を受ける。そしてこの引張応力により、金属配線の粒界間にボイドと呼ばれる微細な割れ目が発生し、これが配線信頼性(ストレスマイグレーションによる断線に対する耐性[SM耐性]やエレクトロマイグレーションによる断線に対する耐性[EM耐性]等)の低下を引き起こす。
またCuは、Alと異なり、ヤング率や剛性率が結晶方位によって大きく相違するため、多結晶配線の場合には、熱処理後の降温時に、異なる結晶方位間にある粒界に非常に大きな歪みが負荷され、粒界はがれ(ボイドまたはクラック)が生じやすくなる。
Cuを配線材料に適用するにあたり解決すべき別の改善点として、Cuが酸化され易いことによる粒界酸化と、それにともなう粒界はがれ(ボイドあるいはクラック)を抑制することが挙げられる。粒界にはベーカンシーと呼ばれる原子空孔の結晶欠陥が多く存在し、これが酸化を促進させる原因となる。粒界が酸化されてCuOXが形成されると、製造時の洗浄工程で該CuOXが腐食され、結晶粒界にそってボイドまたはクラックが生じ、Cu配線の電気抵抗が増加する。またこうした問題は、電気抵抗を高めるだけでなく、配線が断線するなど信頼性にも大きな悪影響を及ぼす。
本発明はこの様な事情に鑑みてなされたものであって、その目的は、例えばフラットパネルディスプレイの製造工程において高温に曝された場合であっても、純Alよりも低い電気抵抗率を維持すると共に、ボイド発生を抑制することのできるCu合金薄膜と、該Cu合金薄膜を成膜するためのスパッタリングターゲット、更には該Cu合金薄膜を配線膜または電極膜に用いたフラットパネルディスプレイを提供することにある。
本発明に係るCu合金薄膜とは、
(a)FeおよびPを含み残部が実質的にCuであるCu合金薄膜であって、該FeとPの含有量が下記式(1)〜(3)を全て満たすところに特徴を有するもの、
1.4 NFe+ 8 NP < 1.3 …(1)
Fe+ 48 NP > 1.0 …(2)
12 NFe+ NP > 0.5 …(3)
[式中、NFeはFeの含有量(at%)、NPはPの含有量(at%)である]
(b)CoおよびPを含み残部が実質的にCuであるCu合金薄膜であって、
該CoとPの含有量が下記式(4)〜(6)を全て満たすところに特徴を有するもの、
1.3 NCo + 8 NP < 1.3 …(4)
Co + 73 NP > 1.5 …(5)
12 NCo + NP > 0.5 …(6)
[式中、NCoはCoの含有量(at%)、NPはPの含有量(at%)である]
または
(c)MgおよびPを含み残部が実質的にCuであるCu合金薄膜であって、
該MgとPの含有量が下記式(7)〜(9)を全て満たすところに特徴を有するものである。
0.67 NMg + 8 NP < 1.3 …(7)
2 NMg+ 197 NP > 4 …(8)
16 NMg + NP > 0.5 …(9)
[式中、NMgはMgの含有量(at%)、NPはPの含有量(at%)である]
上記Cu合金薄膜は、フラットパネルディスプレイの配線膜または電極膜として最適であり、200〜500℃で1〜120分間の熱処理を施した場合であっても、上記(a)のCu合金薄膜の場合にはFe2P、上記(b)のCu合金薄膜の場合にはCo2P、また上記(c)のCu合金薄膜の場合にはMg32が粒界に析出して、低電気抵抗率を維持すると共にボイドの発生が抑制される。
本発明はこの様なCu合金薄膜の形成に用いるスパッタリングターゲットも含むものであって、前記(a)のCu合金薄膜の形成には、FeおよびPを含み残部が実質的にCuであり、該FeとPの含有量が下記式(10)〜(12)を全て満たすスパッタリングターゲットを用いる。
1.4 NFe+ 1.6 NP´< 1.3 …(10)
Fe+ 9.6 NP´> 1.0 …(11)
12 NFe+ 0.2 NP´> 0.5 …(12)
[式中、NFeはFeの含有量(at%)、NP´はPの含有量(at%)である]
前記(b)のCu合金薄膜の形成には、CoおよびPを含み残部が実質的にCuであり、該CoとPの含有量が下記式(13)〜(15)を全て満たすスパッタリングターゲットを用いる。
1.3 NCo + 1.6 NP´ < 1.3 …(13)
Co + 14.6 NP´ > 1.5 …(14)
12 NCo + 0.2 NP´ > 0.5 …(15)
[式中、NCoはCoの含有量(at%)、NP´はPの含有量(at%)である]
また前記(c)のCu合金薄膜の形成には、MgおよびPを含み残部が実質的にCuであり、該MgとPの含有量が下記式(16)〜(18)を全て満たすスパッタリングターゲットを用いるのがよい。
0.67 NMg + 1.6 NP´ < 1.3 …(16)
2 NMg+ 39.4 NP´ > 4 …(17)
16 NMg + 0.2 NP´ > 0.5 …(18)
[式中、NMgはMgの含有量(at%)、NP´はPの含有量(at%)である]
また本発明は、フラットパネルディスプレイの配線膜または電極膜が、上記Cu合金薄膜であるところに特徴を有するフラットパネルディスプレイも含むものである。
本発明によれば、大型のフラットパネルディスプレイ(液晶ディスプレイ、プラズマディスプレイパネル、フィールドエミッションディスプレイ、エレクトロルミネッセンスディスプレイ等)の配線膜または電極膜を形成すべく、本発明のCu合金薄膜を形成した後に200℃以上の熱処理を施した場合であっても、純Al薄膜より低い電気抵抗率を維持したまま、多数のボイドを生じさせることなく信頼性に優れたCu合金配線膜を形成することができる。
本発明者らは、液晶TFTの製造工程の様に、薄膜が200℃以上の高温に曝される場合であっても、純Al薄膜より低い電気抵抗率を維持すると共に、純Cu薄膜で配線膜を形成する場合に生じていた「ボイド」を著しく抑制することのできるCu合金薄膜と、該Cu合金薄膜の形成に用いるスパッタリングターゲットの成分組成について鋭意研究を行った。
その結果、Cuをベースに、Pと、Fe、CoまたはMgとを同時に含有させれば、低電気抵抗率を維持しつつ、純Cu薄膜の場合よりもボイドを著しく抑制できることを見出し、更に検討を進めたところ、この様な作用効果を確実に発現させるには、Cu合金中のPと、Fe、CoまたはMgとの比率を所定の範囲内に制御するのがよいことを見出し、本発明を完成するに至った。以下、本発明を完成するに至った経緯について詳述する。
まず本発明者らは、Cuをベースに、Cu薄膜中の不純物酸素を捕えて粒界酸化を抑制するのに有用であると思われるPを含んだCu−P合金薄膜を形成し、熱処理後のボイド発生量に及ぼすP量の影響について調べた。
詳細には、スパッタリング装置を用いて、0〜0.5at%のPを含有する膜厚300nmのCu−P合金薄膜または純Cu薄膜を、それぞれガラス基板(コーニング社製♯1737ガラス)上に成膜した後、フォトリソグラフィと混酸(硫酸、硝酸、酢酸の混酸)系エッチングにより線幅10μmの配線パターンを形成し、その後に300℃で30分間の真空熱処理を行った。そして配線パターン表面に観察されるボイドをカウントしてボイド密度を求めた。尚、上記熱処理は、液晶TFTの製造における熱処理温度履歴が、通常、ゲート配線膜の形成工程で最高350℃であり、ソース・ドレイン配線膜の形成工程で最高300℃であることを想定して行なったものである。
この実験結果を、Cu−P合金薄膜における熱処理後のボイド密度とP添加量との関係として図1に示す。図1から、Pを多く添加すればボイド密度が減少し、実用的に許容されるボイド密度:1.0×1010-2以下にするには、Pを0.2at%以上添加すればよいことがわかる。
参考までに、図2にCu−0.1at%P合金薄膜を300℃で真空熱処理した後のSEM像を示す。該写真は、合金薄膜を成膜後にフォトリソグラフィと混酸系エッチングにより線幅10μmの配線パターンを形成した後、300℃で30分間の真空熱処理を行ったものである。図2の写真は、熱処理後の結晶粒界を識別し易いように配線パターン表面を混酸系エッチャントでエッチング処理を行ったものであり、図2中に矢印で示してある黒い部分がボイドである。
一方、Cu−P合金薄膜におけるP添加量が電気抵抗率に及ぼす影響についても調べた。詳細には、スパッタリング装置を用いて、P含有量が0.03at%または0.09at%である膜厚300nmのCu−P合金薄膜を、それぞれガラス基板(コーニング社製♯1737ガラス)上に成膜した後、300℃で30分間保持する真空熱処理を施し、該熱処理後のCu−P合金薄膜の電気抵抗率を測定した。尚、この熱処理も、液晶TFTの製造における熱処理温度履歴を想定したものである。また、Pを全く添加しない純Cu薄膜も成膜し、熱処理を施した後に電気抵抗率を測定した。
これらの実験結果を、Cu−P合金薄膜における電気抵抗率とP添加量との関係として図3に示す。この図3から明らかなように、Pを0.1at%添加した場合には、電気抵抗率が純Cu薄膜の場合と比べて0.8μΩ・cm高まることがわかる。
ところで、純Al薄膜について同様の実験を行ったところ、熱処理後の純Al薄膜の電気抵抗率は3.3μΩ・cmであることから、純Al薄膜よりも電気抵抗率の低いCu−P合金薄膜を得るには、上記図3の結果から、Pの添加量を0.16at%以下(0at%含む)にする必要があることがわかる。
以上のCu−P合金薄膜に関する実験結果より、熱処理により発生するボイドを抑制するには、Pを0.2at%以上添加する必要があるのに対し、純Al薄膜より低い電気抵抗率を達成するにはP添加量を0.16at%以下(0at%含む)にする必要があることから、Cu−P合金薄膜のP添加量を制御したとしても、低電気抵抗率とボイドの抑制を同時に達成することができないことがわかる。
次に本発明者らは、Cuをベースに、金属間化合物の粒界析出による粒界強化に有用であると思われるFeを添加したCu−Fe合金薄膜を形成し、ボイド発生量に及ぼすFe量の影響について調べた。
詳細には、スパッタリング装置を用いて、0〜1.0at%のFeを含有する膜厚300nmのCu−P合金薄膜または純Cu薄膜を、それぞれガラス基板(コーニング社製♯1737ガラス)上に成膜した後、フォトリソグラフィと混酸系エッチングにより線幅10μmの配線パターンを形成し、その後に300℃で30分間の真空熱処理を行った。そして配線パターン表面に観察されるボイドをカウントしてボイド密度を求めた。尚、上記熱処理は、液晶TFTの製造における熱処理温度履歴が、通常、ゲート配線膜の形成工程で最高350℃、ソース・ドレイン配線膜の形成工程で最高300℃であることを想定して行なったものである。
この実験結果を、Cu−Fe合金薄膜における熱処理後のボイド密度とFe添加量との関係として図4に示す。図4から、Feを多く添加すればボイド密度が減少し、実用的に許容されるボイド密度:1.0×1010-2以下とするには、Feを1.0at%以上添加すればよいことがわかる。
参考までに、図5にCu−0.28at%Fe合金薄膜を300℃で真空熱処理した後のSEM像を示す。該写真は、前記図2と同様に、上記合金薄膜を成膜後にフォトリソグラフィと混酸系エッチングにより線幅10μmの配線パターンを形成し、その後300℃で30分間の真空熱処理を行ったものであり、前記図2と同様に、熱処理後の結晶粒界を識別し易いように配線パターン表面を混酸系エッチャントでエッチング処理を行っており、図5中に矢印で示してある黒い部分がボイドである。この図5から、Feが0.28at%と少ない場合には、ボイドが多量に発生していることがわかる。
一方、Cu−Fe合金薄膜におけるFe添加量が電気抵抗率に及ぼす影響についても調べた。詳細には、上記Cu−P合金薄膜の場合と同様に、スパッタリング装置を用いて、Fe量が0.3at%または0.9at%の膜厚300nmのCu−Fe合金薄膜を、それぞれガラス基板(コーニング社製♯1737ガラス)上に成膜した後、300℃で30分間保持する真空熱処理を施し、該熱処理後のCu−Fe合金薄膜の電気抵抗率を測定した。尚、この熱処理も、液晶TFTの製造における熱処理温度履歴を想定したものである。また、Feを全く添加しない純Cu薄膜も成膜し、熱処理を施した後に電気抵抗率を測定した。
これらの実験結果を、Cu−Fe合金薄膜における電気抵抗率とFe添加量との関係として図6に示す。この図6から明らかなように、Feを0.1at%添加した場合には、電気抵抗率が純Cu薄膜の場合と比べて0.14μΩ・cm高まることがわかる。そしてこの図6の結果から、純Al薄膜よりも電気抵抗率の低いCu−Fe合金薄膜を得るには、Fe添加量を0.93at%以下(0at%含む)に抑える必要があることがわかる。
以上のCu−Fe合金薄膜に関する実験結果より、熱処理により発生するボイドを抑制するには、Feを1.0at%以上添加する必要があるのに対し、純Al薄膜より低い電気抵抗率を達成するにはFe添加量を0.93at%以下(0at%含む)にする必要があることから、Cu−Fe合金薄膜の場合も、Fe添加量を制御したとしても、低電気抵抗率とボイドの抑制を同時に達成することができないことがわかる。
次に本発明者らは、FeとPを純Cu薄膜へ同時に添加した場合の効果について調べた。まず本発明者らは、一定量のPを添加し、更にFe添加量を変化させて添加したCu−P−Fe合金薄膜に、様々な温度で真空熱処理を施し、熱処理温度とFe添加量が熱処理後のCu−P−Fe合金薄膜の電気抵抗率に及ぼす影響について調べた。
実験は、スパッタリング装置を用いて、P添加量を0.1at%で固定し、Fe添加量を0〜0.5at%の間で変化させた膜厚300nmのCu−Fe−P合金薄膜を、それぞれガラス基板(コーニング社製♯1737ガラス)上に成膜した後、熱処理温度:200〜500℃でそれぞれ30分間保持する真空熱処理を施した。そして該熱処理後のCu−Fe−P合金薄膜の電気抵抗率を測定した。
その結果を、熱処理温度とFe添加量が電気抵抗率に及ぼす影響として整理したものを図7に示す。この図7から、Fe添加量に依存することなく、200℃以上の熱処理を施すことによって、ほぼ一定の低電気抵抗率が得られる。
ところで、純Al薄膜と純Cu薄膜の電気抵抗率の差は1.3μΩ・cmであることから、純Cu薄膜にFeとPを添加した場合であっても、電気抵抗率の上昇は1.3μΩ・cm未満に抑える必要がある。そこでCu合金薄膜中のFe添加量(at%)をNFe、P添加量(at%)をNPとし、P,Fe添加による電気抵抗率の増加比率を図3、図6それぞれの結果から係数として求めると、下記式(1)が得られる。この下記式(1)を満たすようにCu合金薄膜中のFeおよびPの添加量を制御すれば、純Al薄膜より低い電気抵抗率を達成できる。
1.4 NFe+ 8 NP < 1.3 …(1)
次に、上記Cu−Fe−P合金薄膜の熱処理後に発生するボイドの密度に及ぼすFe添加量およびP添加量の影響について調べた。実験では、上記Cu−Fe−P合金薄膜を成膜後、フォトリソグラフィと混酸系エッチングにより線幅10μmの配線パターンを形成し、それから300℃で30分間の真空熱処理を行った。そして10μm幅の配線パターンに発生したボイドをカウントしてボイド密度を求めた。実用的に許容されるボイド密度:1.0×1010-2以下の場合は○(合格)と判断し、超える場合は×(不合格)と判断した。
その結果を、Cu−Fe−P合金薄膜におけるFe・P添加量と熱処理後のボイド密度との関係として図8に示す。この図8から、Cu−Fe−P合金薄膜におけるFe添加量とP添加量が、下記式(2)および(3)を満たすようにすればボイド発生を抑制できることを確認した。
Fe+ 48 NP > 1.0 …(2)
12 NFe+ NP > 0.5 …(3)
更に図8に図示する通り、低電気抵抗率の確保に必要な前記式(1)を組み合わせ、Cu−Fe−P合金薄膜におけるFe添加量とP添加量が、下記式(1)〜(3)を全て満たすようにすれば、低電気抵抗率とボイドの抑制を併せて実現できることがわかった。
1.4 NFe+ 8 NP < 1.3 …(1)
Fe+ 48 NP > 1.0 …(2)
12 NFe+ NP > 0.5 …(3)
この様に、適正量のFeとPをCuへ同時に添加することで、FeやPを単独で添加する場合には実現し得なかった「純Al薄膜より低い電気抵抗率」と「ボイドの抑制」を同時に成し得ることのできた理由は十分明らかではないが、Cu−Fe−P合金薄膜を200℃以上で熱処理したときに、Cuの結晶粒界に微小なFe2Pが析出し、Cu結晶粒界に金属間化合物が析出することによる粒界強化によって、熱ストレス(引っ張り応力)によるボイド発生が抑制されたためと考えられる。また、Cu粒内でなくCu粒界に析出することで低電気抵抗が維持されていると考えられる。
更に本発明者らは、P化合物を形成する上記Fe以外の元素についても検討を行った結果、CoとMgに同様の効果があること、更にFe、CoおよびMgよりなる群から選択される2種以上を同時に添加した場合にも同様の効果があることを見出した。以下、Co、MgをそれぞれPと共にCuに添加した場合について詳述する。
まず、Co添加量とP添加量を変化させたCu−Co−P合金薄膜を成膜し、この薄膜の電気抵抗率を測定して、前記図8の場合と同様に、Co添加量およびP添加量とCu−Co−P合金薄膜の電気抵抗率の関係を求めた。その結果、Cu−Co−P合金薄膜の場合には、下記式(4)を満たせば純Al薄膜より低い電気抵抗率を確保できることがわかった。
1.3 NCo + 8 NP < 1.3 …(4)
またCo添加量およびP添加量が熱処理後のボイド密度に及ぼす影響について調べた。実験では、Cu−Co−P合金薄膜を成膜後にフォトリソグラフィと混酸系エッチングにより線幅10μmの配線パターンを形成し、それから300℃で30分間の真空熱処理を行った。そして、10μm幅の配線パターンに発生したボイドをカウントしてボイド密度を求めた。実用的に許容されるボイド密度:1.0×1010-2以下を満たす場合は○(合格)、超える場合は×(不合格)と判断した。
その結果を、Cu−Co−P合金薄膜におけるCo・P添加量と熱処理後のボイド密度との関係として図9に示す。この図9から、Cu−Co−P合金薄膜におけるCo添加量とP添加量が、下記式(5)および(6)を満たすようにすればボイド発生を抑制できることを確認した。
Co + 73 NP > 1.5 …(5)
12 NCo + NP > 0.5 …(6)
更に図9に図示する通り、低い電気抵抗率の確保に必要な前記式(4)を組み合わせ、Cu−Co−P合金薄膜におけるCo添加量とP添加量が、下記式(4)〜(6)の全てを満たすようにすれば、低電気抵抗率とボイドの抑制を併せて実現できる。この場合も、熱処理でCo2Pが結晶粒界に析出することによって、低電気抵抗率とボイドの抑制を同時に達成できたものと考えられる。
1.3 NCo + 8 NP < 1.3 …(4)
Co + 73 NP > 1.5 …(5)
12 NCo + NP > 0.5 …(6)
次に本発明者らは、上記FeやCoの代わりにMgを添加したCu−Mg−P合金薄膜について検討を行った。まず、Mg添加量とP添加量を変化させたCu−Mg−P合金薄膜を成膜し、この薄膜の電気抵抗率を測定して、前記図8,9の場合と同様に、Mg添加量およびP添加量とCu−Mg−P合金薄膜の電気抵抗率の関係を求めた。その結果、Cu−Mg−P合金薄膜の場合には、下記式(7)を満たせば純Al薄膜より低い電気抵抗率を確保できることがわかった。
0.67 NMg + 8 NP < 1.3 …(7)
またMg添加量およびP添加量が熱処理後のボイド密度に及ぼす影響について調べた。実験では、Cu−Mg−P合金薄膜を成膜後にフォトリソグラフィと混酸系エッチングにより線幅10μmの配線パターンを形成し、それから300℃で30分間の真空熱処理を行った。そして、10μm幅の配線パターンに発生したボイドをカウントしてボイド密度を求めた。実用的に許容されるボイド密度:1.0×1010-2以下を満たす場合は○(合格)、超える場合は×(不合格)と判断した。
その結果を、Cu−Mg−P合金薄膜におけるMg・P添加量と熱処理後のボイド密度との関係として図10に示す。この図10から、Cu−Mg−P合金薄膜におけるMg添加量とP添加量が、下記式(8)および(9)を満たすようにすればボイド発生を抑制できることを確認した。
2 NMg+ 197 NP > 4 …(8)
16 NMg + NP > 0.5 …(9)
更に図10に図示する通り、低電気抵抗率の確保に必要な前記式(7)を組み合わせ、Cu−Mg−P合金薄膜におけるMg添加量とP添加量が、下記式(7)〜(9)の全てを満たすようにすれば、低電気抵抗率とボイドの抑制を併せて実現できる。この場合も、熱処理でMg32が結晶粒界に析出することによって、低電気抵抗率とボイドの抑制を同時に達成できたものと考えられる。
0.67 NMg + 8 NP < 1.3 …(7)
2 NMg+ 197 NP > 4 …(8)
16 NMg + NP > 0.5 …(9)
尚、本発明のCu合金薄膜の膜厚は特に限定されないが、例えば後述するフラットパネルディスプレイの配線膜に適用する場合には、約100〜400nmのものが形成される。
本発明のCu合金薄膜は、その用途まで限定するものではなく、フラットパネルディスプレイの配線膜や電極膜に適用できるが、特に液晶ディスプレイにおける薄膜トランジスタのゲート配線膜およびソース・ドレイン配線膜に適用した場合に、その効果を存分に発揮するものである。
尚、上記「実質的にCu」とは、上記P、Fe、Co、Mgを除く残部がCuおよび不可避不純物であることを意味し、不可避不純物としてSi、Al、C、O、Nをそれぞれ100ppm以下含みうる。
本発明はこの様なCu合金薄膜の形成に用いるスパッタリングターゲットも含むものである。ところで、Pを含むCu合金薄膜を形成する場合、得られたCu合金薄膜中のP含有量は、用いるスパッタリングターゲットのP含有量の約20%となる。従って本発明では、所望するCu合金薄膜のP含有量の約5倍のPを含むスパッタリングターゲットを使用する必要があることに鑑みて、下記の通りその成分組成を規定した。
即ち、前記FeおよびPを含み残部が実質的にCuであるCu合金薄膜を形成するには、FeおよびPを含み残部が実質的にCuであって、該FeとPの含有量が下記式(10)〜(12)を全て満たし、形成しようとするCu合金薄膜のP含有量の約5倍のPを含むCu合金スパッタリングターゲットを用いる。
1.4 NFe+ 1.6 NP´< 1.3 …(10)
Fe+ 9.6 NP´> 1.0 …(11)
12 NFe+ 0.2 NP´> 0.5 …(12)
[式中、NFeはFeの含有量(at%)、NP´はPの含有量(at%)である]
また、前記CoおよびPを含み残部が実質的にCuであるCu合金薄膜を形成するには、CoおよびPを含み残部が実質的にCuであって、該CoとPの含有量が下記式(13)〜(15)を全て満たし、形成しようとするCu合金薄膜のP含有量の約5倍のPを含むCu合金スパッタリングターゲットを用いる。
1.3 NCo + 1.6 NP´ < 1.3 …(13)
Co + 14.6 NP´ > 1.5 …(14)
12 NCo + 0.2 NP´ > 0.5 …(15)
[式中、NCoはCoの含有量(at%)、NP´はPの含有量(at%)である]
更に、前記MgおよびPを含み残部が実質的にCuであるCu合金薄膜を形成するには、MgおよびPを含み残部が実質的にCuであって、該MgとPの含有量が下記式(16)〜(18)を全て満たし、形成しようとするCu合金薄膜のP含有量の約5倍のPを含むCu合金スパッタリングターゲットを用いる。
0.67 NMg + 1.6 NP´ < 1.3 …(16)
2 NMg+ 39.4 NP´ > 4 …(17)
16 NMg + 0.2 NP´ > 0.5 …(18)
[式中、NMgはMgの含有量(at%)、NP´はPの含有量(at%)である]
以下、実施例を挙げて本発明をより具体的に説明するが、本発明はもとより下記実施例によって制限を受けるものではなく、前・後記の趣旨に適合し得る範囲で適当に変更を加えて実施することも可能であり、それらはいずれも本発明の技術的範囲に含まれる。
真空溶解法によりFe:0.28at%、P:0.25at%を含有し、残部Cuおよび不可避不純物であるCu合金からなるスパッタリングターゲットを製造し、このスパッタリングターゲットを用いてDCマグネトロンスパッタリング法で、厚さ300nmのCu−Fe−P合金薄膜を、直径50.8mm、厚さ0.7mmのガラス(コーニング社製♯1737ガラス)基板上に成膜した。このCu−Fe−P合金薄膜の組成分析をICP発光分析法で分析したところ、Fe含有量が0.28at%で、P含有量が0.05at%であることを確認した。尚、Pは蒸気圧が高いため、成膜の際に80%程度のロスが発生したものと考えられる。
次に、このCu−0.28at%Fe−0.05at%P合金薄膜上に、ポジ型フォトレジスト(厚さ1μm)をパターニングし、混酸系エッチャントでCu−Fe−P合金薄膜のエッチングを行なった後、フォトレジストリムーバーでフォトレジストを剥離した。最小線幅が10μmである配線パターンを観察して、粒界はがれやヒロック(異常突起物)の有無を確認したが、粒界はがれやヒロックは全く見られなかった。また電気抵抗率は、配線パターンの電流−電圧特性から計算して求めた。
そして次に、上記サンプルを真空熱処理炉において、300℃で30分間加熱した後、電気抵抗率を測定したところ2.73μΩ・cmであった。更にSEMで表面を詳細に観察した結果を図11に示すが、上記熱処理後であっても、粒界はがれやヒロックはまったく観察されず、ボイド密度は4.5×109-2と1.0×1010-2以下であった。
真空溶解法によりCo:0.35at%、P:0.25at%を含有し、残部Cuおよび不可避不純物であるCu合金からなるスパッタリングターゲットを製造し、このスパッタリングターゲットを用いてDCマグネトロンスパッタリング法で、厚さ300nmのCu−Co−P合金薄膜を、直径50.8mm、厚さ0.7mmのガラス(コーニング社製♯1737ガラス)基板上に成膜した。このCu−Co−P合金薄膜の成分組成をICP発光分析法で分析したところ、Co含有量が0.35at%で、P含有量が0.05at%であることを確認した。尚、前記実施例1と同様に、Pは蒸気圧が高いため、成膜の際に80%程度のロスが発生したものと考えられる。
次にこのCu−0.35at%Co−0.05at%P合金薄膜上にポジ型フォトレジスト(厚さ1μm)をパターニングし、混酸系エッチャントでCu−Co−P合金薄膜のエッチングを行った後、フォトレジストリムーバーでフォトレジストを剥離した。最小線幅が10μmである配線パターンを観察して、粒界はがれやヒロック(異常突起物)の有無を評価した。また電気抵抗率は、配線パターンの電流−電圧特性から計算して求めた。
次に上記サンプルを真空熱処理炉において、300℃で30分間加熱した後、電気抵抗率を測定したところ2.57μΩ・cmであった。更にSEMで表面を詳細に観察した結果、粒界はがれやヒロックはまったく観察されず、ボイド密度は5.5×109-2と1.0×1010-2以下であった。
真空溶解法によりMg:0.5at%、P:0.25at%を含有し、残部Cuおよび不可避不純物であるCu合金からなるスパッタリングターゲットを製造し、このスパッタリングターゲットを用いてDCマグネトロンスパッタリング法で、厚さ300nmのCu−Mg−P合金薄膜を、直径50.8mm、厚さ0.7mmのガラス(コーニング社製♯1737ガラス)基板上に成膜した。このCu−Mg−P合金薄膜の成分組成をICP発光分析法で分析したところ、Mg含有量が0.5at%で、P含有量が0.05at%であることを確認した。尚、前記実施例1,2と同様に、Pは蒸気圧が高いため、成膜の際に80%程度のロスが発生したものと考えられる。
次に、このCu−0.5at%Mg−0.05at%P合金薄膜上にポジ型フォトレジスト(厚さ1μm)をパターニングし、混酸系エッチャントでCu−Mg−P合金薄膜をエッチングした後、フォトレジストリムーバーでフォトレジストを剥離した。最小線幅が10μmである配線パターンを観察して、粒界はがれやヒロック(異常突起物)の有無を確認した。また電気抵抗率は配線パターンの電流−電圧特性から計算した。
それから真空熱処理炉において、上記サンプルを300℃で30分間加熱した後、電気抵抗率を測定したところ2.77μΩ・cmであった。更にSEMで表面を詳細に観察した結果、粒界はがれやヒロックはまったく観察されず、ボイド密度は5.0×109-2と1.0×1010-2以下であった。
Cu−P合金薄膜における熱処理後のボイド密度とP添加量との関係を示すグラフである。 300℃真空熱処理後のCu−0.1at%P合金薄膜のSEM像である。 Cu−P合金薄膜における電気抵抗率とP添加量との関係を示すグラフである。 Cu−Fe合金薄膜における熱処理後のボイド密度とFe添加量との関係を示すグラフである。 300℃真空熱処理後のCu−0.28at%Fe合金薄膜のSEM像である。 Cu−Fe合金薄膜における電気抵抗率とFe添加量との関係を示すグラフである。 Cu−P合金薄膜、Cu−Fe−P合金薄膜における電気抵抗率と熱処理温度との関係を示すグラフである。 Cu−Fe−P合金薄膜におけるFe・P添加量と熱処理後のボイド密度との関係を示すグラフである。 Cu−Co−P合金薄膜におけるCo・P添加量と熱処理後のボイド密度との関係を示すグラフである。 Cu−Mg−P合金薄膜におけるMg・P添加量と熱処理後のボイド密度との関係を示すグラフである。 300℃真空熱処理後のCu−0.28at%Fe−0.05at%P合金薄膜のSEM像である。

Claims (10)

  1. FeおよびPを含み残部が実質的にCuであるCu合金薄膜であって、
    該FeとPの含有量が下記式(1)〜(3)を全て満たすことを特徴とするCu合金薄膜。
    1.4 NFe+ 8 NP < 1.3 …(1)
    Fe+ 48 NP > 1.0 …(2)
    12 NFe+ NP > 0.5 …(3)
    [式中、NFeはFeの含有量(at%)、NPはPの含有量(at%)である]
  2. CoおよびPを含み残部が実質的にCuであるCu合金薄膜であって、
    該CoとPの含有量が下記式(4)〜(6)を全て満たすことを特徴とするCu合金薄膜。
    1.3 NCo + 8 NP < 1.3 …(4)
    Co + 73 NP > 1.5 …(5)
    12 NCo + NP > 0.5 …(6)
    [式中、NCoはCoの含有量(at%)、NPはPの含有量(at%)である]
  3. MgおよびPを含み残部が実質的にCuであるCu合金薄膜であって、
    該MgとPの含有量が下記式(7)〜(9)を全て満たすことを特徴とするCu合金薄膜。
    0.67 NMg + 8 NP < 1.3 …(7)
    2 NMg+ 197 NP > 4 …(8)
    16 NMg + NP > 0.5 …(9)
    [式中、NMgはMgの含有量(at%)、NPはPの含有量(at%)である]
  4. フラットパネルディスプレイの配線膜または電極膜に用いられる請求項1〜3のいずれかに記載のCu合金薄膜。
  5. 200〜500℃で1〜120分間保持する熱処理の施されたものである請求項1〜4のいずれかに記載の低電気抵抗率かつボイド耐性に優れたCu合金薄膜。
  6. Fe2P、Co2PまたはMg32がCuの結晶粒界に析出している請求項1〜4のいずれかに記載の低電気抵抗率かつボイド耐性に優れたCu合金薄膜。
  7. Cu合金薄膜を形成するために用いるスパッタリングターゲットであって、
    FeおよびPを含み残部が実質的にCuであり、該FeとPの含有量が下記式(10)〜(12)を全て満たすことを特徴とするCu合金スパッタリングターゲット。
    1.4 NFe+ 1.6 NP´< 1.3 …(10)
    Fe+ 9.6 NP´> 1.0 …(11)
    12 NFe+ 0.2 NP´> 0.5 …(12)
    [式中、NFeはFeの含有量(at%)、NP´はPの含有量(at%)である]
  8. Cu合金薄膜を形成するために用いるスパッタリングターゲットであって、
    CoおよびPを含み残部が実質的にCuであり、該CoとPの含有量が下記式(13)〜(15)を全て満たすことを特徴とするCu合金スパッタリングターゲット。
    1.3 NCo + 1.6 NP´ < 1.3 …(13)
    Co + 14.6 NP´ > 1.5 …(14)
    12 NCo + 0.2 NP´ > 0.5 …(15)
    [式中、NCoはCoの含有量(at%)、NP´はPの含有量(at%)である]
  9. Cu合金薄膜を形成するために用いるスパッタリングターゲットであって、
    MgおよびPを含み残部が実質的にCuであり、該MgとPの含有量が下記式(16)〜(18)を全て満たすことを特徴とするCu合金スパッタリングターゲット。
    0.67 NMg + 1.6 NP´ < 1.3 …(16)
    2 NMg+ 39.4 NP´ > 4 …(17)
    16 NMg + 0.2 NP´ > 0.5 …(18)
    [式中、NMgはMgの含有量(at%)、NP´はPの含有量(at%)である]
  10. フラットパネルディスプレイの配線膜または電極膜が、前記請求項1〜6のいずれかに記載のCu合金薄膜であることを特徴とするフラットパネルディスプレイ。

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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2008057031A (ja) * 2006-07-31 2008-03-13 Mitsubishi Materials Corp 熱欠陥発生のない液晶表示装置用配線および電極並びにそれらを形成するためのスパッタリングターゲット
JP2013153093A (ja) * 2012-01-26 2013-08-08 Hitachi Cable Ltd 薄膜トランジスタ、その製造方法および該薄膜トランジスタを用いた表示装置
WO2014132857A1 (ja) * 2013-03-01 2014-09-04 Jx日鉱日石金属株式会社 高純度銅コバルト合金スパッタリングターゲット

Families Citing this family (41)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP4330517B2 (ja) * 2004-11-02 2009-09-16 株式会社神戸製鋼所 Cu合金薄膜およびCu合金スパッタリングターゲット並びにフラットパネルディスプレイ
JP4117001B2 (ja) 2005-02-17 2008-07-09 株式会社神戸製鋼所 薄膜トランジスタ基板、表示デバイス、および表示デバイス用のスパッタリングターゲット
US7411298B2 (en) * 2005-08-17 2008-08-12 Kabushiki Kaisha Kobe Seiko Sho (Kobe Steel, Ltd.) Source/drain electrodes, thin-film transistor substrates, manufacture methods thereof, and display devices
US7683370B2 (en) 2005-08-17 2010-03-23 Kobe Steel, Ltd. Source/drain electrodes, transistor substrates and manufacture methods, thereof, and display devices
US7781767B2 (en) 2006-05-31 2010-08-24 Kobe Steel, Ltd. Thin film transistor substrate and display device
JP2008098611A (ja) * 2006-09-15 2008-04-24 Kobe Steel Ltd 表示装置
JP4280277B2 (ja) * 2006-09-28 2009-06-17 株式会社神戸製鋼所 表示デバイスの製法
KR101043508B1 (ko) 2006-10-13 2011-06-23 가부시키가이샤 고베 세이코쇼 박막 트랜지스터 기판 및 표시 디바이스
JP2008127623A (ja) * 2006-11-20 2008-06-05 Kobelco Kaken:Kk Al基合金スパッタリングターゲットおよびその製造方法
JP4377906B2 (ja) * 2006-11-20 2009-12-02 株式会社コベルコ科研 Al−Ni−La系Al基合金スパッタリングターゲット、およびその製造方法
JP4170367B2 (ja) 2006-11-30 2008-10-22 株式会社神戸製鋼所 表示デバイス用Al合金膜、表示デバイス、及びスパッタリングターゲット
JP4355743B2 (ja) * 2006-12-04 2009-11-04 株式会社神戸製鋼所 Cu合金配線膜とそのCu合金配線膜を用いたフラットパネルディスプレイ用TFT素子、及びそのCu合金配線膜を作製するためのCu合金スパッタリングターゲット
JP4705062B2 (ja) * 2007-03-01 2011-06-22 株式会社神戸製鋼所 配線構造およびその作製方法
JP2009004518A (ja) * 2007-06-20 2009-01-08 Kobe Steel Ltd 薄膜トランジスタ基板、および表示デバイス
JP2009008770A (ja) * 2007-06-26 2009-01-15 Kobe Steel Ltd 積層構造およびその製造方法
US20090001373A1 (en) * 2007-06-26 2009-01-01 Kabushiki Kaisha Kobe Seiko Sho (Kobe Steel Ltd.) Electrode of aluminum-alloy film with low contact resistance, method for production thereof, and display unit
JP2009010052A (ja) * 2007-06-26 2009-01-15 Kobe Steel Ltd 表示装置の製造方法
JP5143649B2 (ja) * 2007-07-24 2013-02-13 株式会社コベルコ科研 Al−Ni−La−Si系Al合金スパッタリングターゲットおよびその製造方法
JP4611417B2 (ja) * 2007-12-26 2011-01-12 株式会社神戸製鋼所 反射電極、表示デバイス、および表示デバイスの製造方法
JP4469913B2 (ja) 2008-01-16 2010-06-02 株式会社神戸製鋼所 薄膜トランジスタ基板および表示デバイス
JP5231282B2 (ja) * 2008-02-22 2013-07-10 株式会社神戸製鋼所 タッチパネルセンサー
JP5432550B2 (ja) * 2008-03-31 2014-03-05 株式会社コベルコ科研 Al基合金スパッタリングターゲットおよびその製造方法
JP5139134B2 (ja) 2008-03-31 2013-02-06 株式会社コベルコ科研 Al−Ni−La−Cu系Al基合金スパッタリングターゲットおよびその製造方法
WO2009123217A1 (ja) * 2008-03-31 2009-10-08 株式会社神戸製鋼所 表示装置、その製造方法およびスパッタリングターゲット
JP5475260B2 (ja) * 2008-04-18 2014-04-16 株式会社神戸製鋼所 配線構造、薄膜トランジスタ基板およびその製造方法、並びに表示装置
KR20100127290A (ko) * 2008-04-23 2010-12-03 가부시키가이샤 고베 세이코쇼 표시 장치용 Al 합금막, 표시 장치 및 스퍼터링 타깃
CN102077323A (zh) * 2008-07-03 2011-05-25 株式会社神户制钢所 配线结构、薄膜晶体管基板及其制造方法、以及显示装置
JP2010065317A (ja) * 2008-08-14 2010-03-25 Kobe Steel Ltd 表示装置およびこれに用いるCu合金膜
JP4567091B1 (ja) 2009-01-16 2010-10-20 株式会社神戸製鋼所 表示装置用Cu合金膜および表示装置
DE102009002894A1 (de) * 2009-05-07 2010-11-18 Federal-Mogul Wiesbaden Gmbh Gleitlagermaterial
CN102473732B (zh) 2009-07-27 2015-09-16 株式会社神户制钢所 布线结构以及具备布线结构的显示装置
JP2011222567A (ja) 2010-04-02 2011-11-04 Kobe Steel Ltd 配線構造、表示装置、および半導体装置
JP2012027159A (ja) 2010-07-21 2012-02-09 Kobe Steel Ltd 表示装置
JP2012180540A (ja) 2011-02-28 2012-09-20 Kobe Steel Ltd 表示装置および半導体装置用Al合金膜
JP5171990B2 (ja) 2011-05-13 2013-03-27 株式会社神戸製鋼所 Cu合金膜および表示装置
JP5524905B2 (ja) 2011-05-17 2014-06-18 株式会社神戸製鋼所 パワー半導体素子用Al合金膜
JP2013084907A (ja) 2011-09-28 2013-05-09 Kobe Steel Ltd 表示装置用配線構造
CN102409147B (zh) * 2011-11-14 2013-12-11 余姚康富特电子材料有限公司 靶材热处理方法
DE102013208497A1 (de) 2013-05-08 2014-11-13 Federal-Mogul Wiesbaden Gmbh Kupferlegierung, Verwendung einer Kupferlegierung, Lager mit einer Kupferlegierung und Verfahren zur Herstellung eines Lagers aus einer Kupferlegierung
CN104118852B (zh) * 2014-08-06 2016-02-03 济南大学 一种过渡金属磷化物Co2P的制备方法
CN112289532B (zh) * 2020-09-23 2023-09-01 贵州凯里经济开发区中昊电子有限公司 以铜合金为材料制备纳米晶薄膜电极的方法及应用

Family Cites Families (36)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS59140339A (ja) * 1983-01-29 1984-08-11 Furukawa Electric Co Ltd:The リ−ドフレ−ム用銅合金
JPH0635633B2 (ja) * 1986-10-29 1994-05-11 株式会社神戸製鋼所 電気および電子部品用銅合金及びその製造方法
JPS63203737A (ja) * 1987-02-17 1988-08-23 Kobe Steel Ltd 耐摩耗性に優れた鋼連続鋳造用管型モ−ルド材料
US4908275A (en) * 1987-03-04 1990-03-13 Nippon Mining Co., Ltd. Film carrier and method of manufacturing same
JPH0673474A (ja) * 1992-08-27 1994-03-15 Kobe Steel Ltd 強度、導電率及び耐マイグレーション性が優れた銅合金
JP2733006B2 (ja) * 1993-07-27 1998-03-30 株式会社神戸製鋼所 半導体用電極及びその製造方法並びに半導体用電極膜形成用スパッタリングターゲット
DE69637333T2 (de) * 1995-06-27 2008-10-02 International Business Machines Corp. Kupferlegierungen für Chipverbindungen und Herstellungsverfahren
JP3365954B2 (ja) * 1997-04-14 2003-01-14 株式会社神戸製鋼所 半導体電極用Al−Ni−Y 合金薄膜および半導体電極用Al−Ni−Y 合金薄膜形成用スパッタリングターゲット
JP4663829B2 (ja) * 1998-03-31 2011-04-06 三菱電機株式会社 薄膜トランジスタおよび該薄膜トランジスタを用いた液晶表示装置
JP4458563B2 (ja) * 1998-03-31 2010-04-28 三菱電機株式会社 薄膜トランジスタの製造方法およびこれを用いた液晶表示装置の製造方法
JP3886303B2 (ja) * 1999-08-25 2007-02-28 株式会社神戸製鋼所 電気・電子部品用銅合金
US20040072009A1 (en) * 1999-12-16 2004-04-15 Segal Vladimir M. Copper sputtering targets and methods of forming copper sputtering targets
KR100396696B1 (ko) * 2000-11-13 2003-09-02 엘지.필립스 엘시디 주식회사 저저항 배선을 갖는 액정 디스플레이 패널
JP4159757B2 (ja) * 2001-03-27 2008-10-01 株式会社神戸製鋼所 強度安定性および耐熱性に優れた銅合金
JP2003064432A (ja) * 2001-08-27 2003-03-05 Kobe Steel Ltd 接続部品の接点構造
JP4783525B2 (ja) * 2001-08-31 2011-09-28 株式会社アルバック 薄膜アルミニウム合金及び薄膜アルミニウム合金形成用スパッタリングターゲット
JP2003105463A (ja) * 2001-10-02 2003-04-09 Kobe Steel Ltd 電気接続部品
JP2003221632A (ja) * 2002-01-28 2003-08-08 Kobe Steel Ltd 耐アーク性に優れた電気接続部品用銅合金板・条及びその製造方法
US7514037B2 (en) * 2002-08-08 2009-04-07 Kobe Steel, Ltd. AG base alloy thin film and sputtering target for forming AG base alloy thin film
JP3940385B2 (ja) * 2002-12-19 2007-07-04 株式会社神戸製鋼所 表示デバイスおよびその製法
JP4223511B2 (ja) * 2003-03-17 2009-02-12 日鉱金属株式会社 銅合金スパッタリングターゲット及びその製造方法並びに半導体素子配線
JP2005303003A (ja) * 2004-04-12 2005-10-27 Kobe Steel Ltd 表示デバイスおよびその製法
JP4541787B2 (ja) * 2004-07-06 2010-09-08 株式会社神戸製鋼所 表示デバイス
JP4330517B2 (ja) * 2004-11-02 2009-09-16 株式会社神戸製鋼所 Cu合金薄膜およびCu合金スパッタリングターゲット並びにフラットパネルディスプレイ
JP4579709B2 (ja) * 2005-02-15 2010-11-10 株式会社神戸製鋼所 Al−Ni−希土類元素合金スパッタリングターゲット
JP4117001B2 (ja) * 2005-02-17 2008-07-09 株式会社神戸製鋼所 薄膜トランジスタ基板、表示デバイス、および表示デバイス用のスパッタリングターゲット
JP4542008B2 (ja) * 2005-06-07 2010-09-08 株式会社神戸製鋼所 表示デバイス
US7683370B2 (en) * 2005-08-17 2010-03-23 Kobe Steel, Ltd. Source/drain electrodes, transistor substrates and manufacture methods, thereof, and display devices
US7411298B2 (en) * 2005-08-17 2008-08-12 Kabushiki Kaisha Kobe Seiko Sho (Kobe Steel, Ltd.) Source/drain electrodes, thin-film transistor substrates, manufacture methods thereof, and display devices
US7781767B2 (en) * 2006-05-31 2010-08-24 Kobe Steel, Ltd. Thin film transistor substrate and display device
JP4280277B2 (ja) * 2006-09-28 2009-06-17 株式会社神戸製鋼所 表示デバイスの製法
JP4377906B2 (ja) * 2006-11-20 2009-12-02 株式会社コベルコ科研 Al−Ni−La系Al基合金スパッタリングターゲット、およびその製造方法
JP2008127623A (ja) * 2006-11-20 2008-06-05 Kobelco Kaken:Kk Al基合金スパッタリングターゲットおよびその製造方法
JP2009004518A (ja) * 2007-06-20 2009-01-08 Kobe Steel Ltd 薄膜トランジスタ基板、および表示デバイス
US20090001373A1 (en) * 2007-06-26 2009-01-01 Kabushiki Kaisha Kobe Seiko Sho (Kobe Steel Ltd.) Electrode of aluminum-alloy film with low contact resistance, method for production thereof, and display unit
JP2009010052A (ja) * 2007-06-26 2009-01-15 Kobe Steel Ltd 表示装置の製造方法

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2008057031A (ja) * 2006-07-31 2008-03-13 Mitsubishi Materials Corp 熱欠陥発生のない液晶表示装置用配線および電極並びにそれらを形成するためのスパッタリングターゲット
JP2013153093A (ja) * 2012-01-26 2013-08-08 Hitachi Cable Ltd 薄膜トランジスタ、その製造方法および該薄膜トランジスタを用いた表示装置
WO2014132857A1 (ja) * 2013-03-01 2014-09-04 Jx日鉱日石金属株式会社 高純度銅コバルト合金スパッタリングターゲット
JP5837202B2 (ja) * 2013-03-01 2015-12-24 Jx日鉱日石金属株式会社 高純度銅コバルト合金スパッタリングターゲット

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