EP2589072A2 - Interposer und verfahren zur herstellung von löchern in einem interposer - Google Patents
Interposer und verfahren zur herstellung von löchern in einem interposerInfo
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- EP2589072A2 EP2589072A2 EP11730223.2A EP11730223A EP2589072A2 EP 2589072 A2 EP2589072 A2 EP 2589072A2 EP 11730223 A EP11730223 A EP 11730223A EP 2589072 A2 EP2589072 A2 EP 2589072A2
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Definitions
- the invention relates to interposer for electrically connecting the terminals of a CPU chip with a
- Circuit board further to methods that are used in a critical manufacturing step of the interposer.
- a CPU chip as a processor core typically has several hundreds of contact points spaced close to each other on its underside over a relatively small area. Because of this close spacing, these contact points can not be mounted directly onto a circuit board, the so-called motherboard. It is therefore a
- the glass fiber mat has a coefficient of expansion of 15 to 17 ⁇ 10 -6
- the silicon-based core processor has one
- Hole diameter is limited to 250 to 450 m.
- the US 2002/0180015 Al shows a module for a variety of chips, the semiconductor devices and a
- the wiring substrate comprises a glass substrate having holes through
- the glass substrate has a wiring and an insulation layer. It is aimed at the
- US 5,216,207 shows multi-layer ceramic circuit boards with conductors of silver. The layers are baked at low temperatures. The boards have a thermal expansion coefficient close to that of silicon.
- US 2009/0321114 A1 shows a substrate unit for electrical testing with a multilayer
- Ceramic substrate Although the materials used have a coefficient of thermal expansion in the vicinity of
- Silicate glass The production process takes place in two
- the invention has for its object to provide an interposer for electrical connection between a CPU chip and a circuit board, which is economical to manufacture, thereby enabling the production of micro holes in the order of 20 m and 200 ⁇ hole diameter and the interposer body similar thermal expansion to that of the CPU chip material.
- Hole diameter the so-called aspect, should be between 1 and 10.
- the center distance of the holes should be between 120 pm and 400 ⁇ ⁇ .
- the hole shape should be at the hole inlet and outlet conical or
- the interposer according to the invention is characterized in that its plate-shaped base substrate is made of glass whose thermal expansion coefficient is in the range between 3.1 x 10 "6 and 3.4 x 10 ⁇ . 6 chip boards based on silicon have a coefficient of expansion between 3.2 x 10 "6 and 3.3 x 10 " 6. Between interposer and CPU chip, therefore, no great mechanical stresses are to be expected due to different thermal expansion behavior
- the number of holes in the interposer will be after the
- a typical number of holes is in the range of 1000 to 3000.
- the hole center distance of the holes is in the range of 50 ⁇ im and 700 ⁇ .
- Interposer an arsenic or antimony content of less than 50 ppm.
- Interposer have a plate thickness that is below 1 mm, but not 30 ⁇ below.
- the number of holes of an interposer is chosen according to the needs and is of the order of 1000 to 3000 holes / cm 2 .
- the invention is intended to interposer with
- the holes are generally slim cylindrically shaped, but can be at the hole entrance and
- Hole exit be equipped with rounded-broken edges.
- Wavelength range of the transparency of the glass so that the laser rays penetrate into the glass and are not already absorbed in the outer layers of the glass.
- Laser radiation of very high radiation intensity is used to cause local, athermal destruction of the glass along filamentous channels.
- filamentous channels are then widened to the desired diameter of the holes, taking one
- Lead hole material, and / or the filamentous channels are widened by the supply of reactive gases.
- the holes provided can also be exactly marked by HF coupling material, which is printed dot-shaped on the base substrate.
- Marked points are heated by RF energy in order to close the holes
- Breakthrough sites can be caused by supplied etching gas
- Fig. 1 is a schematic representation of a production of an interposer in longitudinal section
- Fig. 2 shows a second production. Detailed description
- holes 10 on a plate-shaped glass substrate 1 are marked by focused laser pulses 41 emanating from an arrangement 4 of lasers 40.
- the radiation intensity of these lasers is so strong that local, athermal destruction occurs along a filamentary channel 11 in the glass.
- filamentous channels 11 expanded into holes 12. It is possible to use opposing electrodes 6 and 7, which are supplied with high-voltage energy, which leads to dielectric breakthroughs through the glass substrate along the filamentary channels 11. These breakthroughs expand by electrothermal heating and
- conductor paths 13 are applied to the perforation points 10 on the upper side of the glass plate 1, and the holes 12 are filled with conductive material 14 to complete on the underside of the plate the connections to the contact points of a CPU chip or the like.
- Dielectric strength of the material leads. When high voltage is applied, dielectric breakdowns occur along narrow channels 11. By further supplying high voltage energy, these narrow channels 11 can be widened to the size of the holes 12.
- conduction paths 13 are applied to the holes 12 on the top of the glass substrate, and the Holes are filled with conductive material 14 in order to produce, with turned glass plate 1, the connections for the CPU chip. It should be noted that interposers do not need to be made individually but glass substrate plates for one
- interposers can be processed by cutting the large format glass substrate plates to recover the individual interposers. Formats of glass substrate plates with edge lengths from 0.2 m to 3 m (or smaller) can be processed.
- Round disc formats can be up to 1 m in dimension
- T2 The temperature at the viscosity 10 2 dPas (referred to as T2 (° C), calculated from the Vogel-Fulcher-Tammann equation
- compositions (in% by weight based on oxide) and
- the glasses have the following advantages:
- the glasses are ideally suited for use as a substrate glass in the
- Thermal expansion coefficient is little different, occur less mechanical stress between these bonded layers or plates, and there will be no dislocation or cracks between the layers or plates.
- Interposer which are densely occupied with holes over previous interposers, take smaller substrate sizes, whereby the extent of different strains and shrinkages of the layers or plates involved and thus the risk of discarding and thus the
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Abstract
Interposer zur elektrischen Verbindung zwischen einem CPU-Chip und einer Schaltungsplatte. Ein plattenförmiges Basissubstrat (1) aus Glas weist einen Wärmeausdehnungskoeffizienten im Bereich zwischen 3,1 · 10-6 und 3,4 · 10-6 und Löcher (12) in einer Anzahl auf, die im Bereich zwischen 10 und 10.000 cm-2 liegt. Es gibt Löcher (12) mit Durchmessern, die im Bereich zwischen 20 µm und 200 µm liegen können. Auf der einen Plattenseite verlaufen Leiterbahnen (13), die sich jeweils bis in die Löcher (12) hinein und durch diese hindurch auf die andere Plattenseite erstrecken, um Anschlusspunkte für den Chip zu bilden.
Description
Interposer und Verfahren zur Herstellung von Löchern in einem Interposer
Gebiet der Erfindung
Die Erfindung bezieht sich auf Interposer zur elektrischen Verbindung der Anschlüsse eines CPU-Chips mit einer
Schaltungsplatte, ferner auf Verfahren, die bei einem kritischen Herstellungsschritt der Interposer benutzt werden .
Hintergrund der Erfindung Ein CPU-Chip als Prozessorkern hat typischerweise auf seiner Unterseite auf relativ kleiner Fläche verteilt mehrere Hundert Kontaktpunkte in engem Abstand zueinander. Wegen dieses engen Abstandes können diese Kontaktpunkte nicht direkt auf eine Schaltungsplatte, das sogenannte Motherboard, montiert werden. Es wird deshalb ein
Zwischenteil angewendet, mit welchem die
Kontaktierungsbasis verbreitert werden kann. Als
Zwischenteil wird häufig eine mit Epoximaterial ummantelte Glasfasermatte eingesetzt, die mit einer Anzahl von Löchern versehen ist. Auf der Oberfläche der Glasfasermatte laufen Leiterbahnen, die in die jeweiligen Löcher hineinführen, um diese zu verfüllen, und auf der anderen Seite der
Glasfasermatte bis zu den Anschlusskontakten des
Prozessorkerns führen. Um dies zu bewerkstelligen, wird sowohl um den Prozessorkern als auch zwischen dem
Prozessorkern und der Glasfasermatte eine Hinterfüllung (underfill) aufgebracht, welche die Leitungen schützt und
BESTÄTIGUNGSKOPIE
den Prozessorkern und die Glasfasermatte mechanisch
miteinander verbindet. Der Prozessorkern und die
Glasfasermatte weisen jedoch unterschiedliche
Wärmeausdehnungen auf. So hat die Glasfasermatte einen Ausdehnungskoeffizienten von 15 bis 17 x 10~6, während der Kernprozessor auf Siliziumbasis einen
Wärmeausdehnungsfaktor von 3,2 bis 3,3 x 10"6 aufweist. Bei Auftreten von Erwärmung kommt es deshalb zu differentiellen Ausdehnungen zwischen dem Kernprozessor und der
Glasfasermatte und damit zu mechanischen Spannungen
zwischen diesen beiden Komponenten. Dies kann sich
schädlich auf die Kontaktverbindungen auswirken, vor allem dann, wenn die beiden Komponenten nicht überall flächig miteinander verbunden sind. Dann können die Kontaktstellen leicht brechen.
Die Anwendung der Glasfasermatte ist mit einem weiteren Nachteil behaftet, der mit dem mechanischen Bohren der Löcher in der Glasfasermatte zusammenhängt. Der
Lochdurchmesser ist auf 250 bis 450 m begrenzt.
Eine weitere Möglichkeit des Aufbaus und der Herstellung von Verbindungsstrukturen, die in der Art von Interposern genutzt werden könnten, wird in WO 02/058135 A2 aufgezeigt. Es wird die Wafertechnologie mit Erzeugung von Löchern und Gräben in dielektrischem Material angewendet,
beispielsweise Siliziumdioxid, und Auffüllen der Löcher und Gräben mit Leitungsschichten. Diese Herstellungsweise von Kontaktverbindungen ist jedoch sehr teuer.
Eine ähnliche Technologie wird in DE 103 01 291 B3
vermittelt. Es werden Vertiefungen in Substraten geätzt und durch Leiterbahnen aus Metall aufgefüllt, wobei auch
Kontakte durch Löcher hindurchreichen. Diese Technik ist aufwendig und teuer.
Die US 2002/0180015 AI zeigt ein Modul für eine Vielzahl von Chips, das Halbleiterbausteine und ein
Beschaltungssubstrat zur Aufbringung der
Halbleiterbausteine aufweist. Das Beschaltungssubstrat umfasst ein Glassubstrat mit Löchern, die durch
Sandstrahlbehandlung gebildet wurden. Auf der Oberfläche des Glassubstrat ist eine Beschaltungsschicht gebildet.
Ferner weist das Glassubstrat eine Verdrahtung und eine Isolationsschicht auf. Es wird angestrebt, den
Wärmeausdehnungskoeffizienten des Glassubstrats in der Nähe des Koeffizienten von Silizium zu wählen.
Die US 5,216,207 zeigt keramische Platinen mit mehreren Schichten mit Leitern aus Silber. Die Schichten werden bei niedrigen Temperaturen eingebrannt. Die Platinen haben einen Wärmeausdehungskoeffizienten nahe dem von Silizium.
Die US 2009/0321114 AI zeigt eine Subtstrateinheit zum elektrischen Testen mit einem mehrschichtigen
Keramiksubstrat. Die verwendeten Materialien haben zwar einen Wärmeausdehnungskoeffizienten in der Nähe des
entsprechenden Wertes Ihrer Erfindung, sind aber keine reinen Gläser.
Die US 7,550,321 Bl zeigt ein Substrat mit einem
Wärmeausdehungskoeffizienten, der in Dickenrichtung einen Gradienten aufweist. Der Fachartikel "Femtosecond laser-assisted three- dimensional microfabrication in silica" aus Optics Letters, Vol. 26, No. 5, 1. März 2001, Seiten 277 bis 279 beschreibt direkte dreidimensionale Mikroproduktion in einem
Silikatglas. Der Produktionsprozess erfolgt in zwei
Schritten. Zunächst werden die vorgesehenen Muster mittels fokussierten Femtosekunden-Laserpulsen im Glas
vorgezeichnet. Anschließend werden diese Muster geätzt.
Allgemeine Erfindungsbeschreibung
Der Erfindung liegt die Aufgabe zugrunde, einen Interposer zur elektrischen Verbindung zwischen einem CPU-Chip und einer Schaltungsplatte zu schaffen, der wirtschaftlich herstellbar ist, dabei die Herstellung von Mikrolöchern in der Größenordnung von 20 m und 200 μπι Lochdurchmesser ermöglicht und der Interposerkörper eine Wärmeausdehnung ähnlich zu der des CPU-Chipmaterials aufweist.
Bei dem neuen Interposer sollen folgende Forderungen erfüllt werden können:
Viele kleine Löcher (10 bis 10.000) sollen pro Interposer bei engen Toleranzen der Löcher zueinander untergebracht werden können. Dabei muss auch ein Lochabstand bis herab zu 30 μιη eingehalten werden können. Der Lochdurchmesser soll bis zu einer Größe von 20 m herabreichen können. Das
Verhältnis zwischen Dicke des Interposers und
Lochdurchmesser, der sogenannte Aspekt, soll zwischen 1 und 10 liegen können. Der Mittelpunktabstand der Löcher soll
zwischen 120 pm und 400 μπ\ betragen können. Die Lochform soll am Locheintritt und -austritt konisch oder
kraterförmig, in der Lochlaibungsmitte aber möglichst zylindrisch ausgebildet sein. Die Lochwände sollen glatt (feuerpoliert) sein. Gegebenenfalls soll auch ein Wulst von maximal 5 mm Wulsthöhe um den Lochrand herum entstehen.
Der erfindungsgemäße Interposer zeichnet sich dadurch aus, dass sein plattenförmiges Basissubstrat aus Glas besteht, dessen Wärmeausdehnungskoeffizient im Bereich zwischen 3,1 x 10"6 und 3,4 x 10~6 liegt. Chipplatten auf Siliziumbasis weisen einen Ausdehnungskoeffizienten zwischen 3,2 x 10"6 und 3,3 x 10"6 auf. Zwischen Interposer und CPU-Chip sind deshalb keine großen mechanischen Spannungen zu erwarten, die auf unterschiedlichem Wärmeausdehnungsverhalten
beruhen .
Die Anzahl der Löcher im Interposer wird nach den
jeweiligen Erfordernissen gewählt und kann bis zu 10.000 Löcher pro cm2 liegen. Eine übliche Lochanzahl liegt im Bereich von 1000 bis 3000. Der Lochmittenabstand der Löcher liegt im Bereich von 50 \im und 700 μιη. Um den Anforderungen der Miniaturisierung von Bauteilen Rechnung zu tragen, gibt es Löcher, deren Durchmesser im Bereich zwischen 20 m und 200 m liegt. Um die elektrische Verbindung zwischen dem CPU-Chip und seiner Schaltungsplatte herzustellen,
verlaufen Leiterbahnen auf einer der Plattenseiten des Interposers bis in die Löcher hinein und durch diese hindurch, um Anschlusspunkte für den CPU-Chip zu bilden. Das Glas des Basissubstrats sollte einen Alkaligehalt von weniger als 700 ppm enthalten. Solches Glas weist, wie gefordert, einen niedrigen Wärmeausdehnungskoeffizienten
und infolge des hohen dielektrischen Wertes sehr gute signalisolierende Eigenschaften auf. Ferner wird die Gefahr der Kontamination von Siliziumprozessoren mit Alkalien weitgehend vermieden.
Aus Gründen des Umweltschutzes enthält die
Glaszusammensetzung einen Arsen- oder Antimongehalt von weniger als 50 ppm. Interposer weisen eine Plattendicke auf, die unterhalb von 1 mm liegt, aber 30 μπι nicht unterschreitet. Die Lochanzahl eines Interposers wird nach den Bedürfnissen gewählt und liegt in der Größenordnung von 1000 bis 3000 Löchern/cm2. Mit der Erfindung wird avisiert, Interposer mit
Mikrolöchern unterhalb von 100 μπι am Markt anzubieten. Die Löcher sind demnach eng gepackt, wobei der Mittelabstand der Löcher im Bereich zwischen 150 μπι und 400 μιη liegen kann. Der Lochkantenabstand der Löcher soll aber 30 μιη nicht unterschreiten. Die Löcher müssen nicht alle den gleichen Durchmesser aufweisen, es ist möglich, dass Löcher unterschiedlichen Durchmessers in dem plattenförmigen
Basissubstrat vorhanden sind. Das Verhältnis der
Glasplattendicke zum Lochdurchmesser, der sogenannte
Aspekt, kann in einem breiten Bereich von 0,1 bis 25 gewählt werden, wobei ein Aspektverhältnis von 1 bis 10 bevorzugt wird. Die Löcher sind im Allgemeinen schlank zylindrisch gestaltet, können aber am Locheingang und
Lochausgang mit abgerundet-gebrochenen Kanten ausgestattet sein .
Um Löcher exakt zu positionieren, deren Durchmesser im Bereich zwischen 20 μπι und 200 μιτι liegen können, bedient
man sich fokussierter Laserimpulse in einem
Wellenlängenbereich der Transparenz des Glases, so dass die Laserstrahlen in das Glas eindringen und nicht bereits in den Randschichten des Glases absorbiert werden. Es wird Laserstrahlung sehr hoher Strahlungsintensität benutzt, damit es entlang von filamentartigen Kanälen zu lokaler, athermischer Zerstörung des Glases kommt. Diese
filamentartigen Kanäle werden anschließend auf gewünschten Durchmesser der Löcher aufgeweitet, wobei man sich
dielektrischer Durchbrüche bedienen kann, die zur
elektrothermischen Aufheizung und Verdampfung des
Lochrandmaterials führen, und/oder die filamentartigen Kanäle werden durch Zufuhr reaktiver Gase aufgeweitet. Die vorgesehenen Lochungsstellen können auch durch HF- Ankopplungsmaterial exakt markiert werden, das auf das Basissubstrat punktförmig aufgedruckt wird. Solche
markierten Stellen werden durch HF-Energie aufgeheizt, um im Bereich der vorgesehenen Löcher die
Durchbruchsfestigkeit gegenüber elektrischer Hochspannung zu erniedrigen und schließlich an diesen Stellen zu
dielektrischen Durchbrüchen zu gelangen. Die
Durchbruchsstellen können durch zugeführtes Ätzgas
aufgeweitet werden.
Die Herstellung der Leiterbahnen auf dem plattenförmigen Glassubstrat und durch die Löcher hindurch erfolgt nach bekannten Verfahrensmustern und muss hier nicht weiter beschrieben werden.
Kurze Beschreibung der Zeichnung
Ausführungsbeispiele der Erfindung werden anhand der
Zeichnung beschrieben. Dabei zeigt:
Fig. 1 eine Schematische Darstellung einer Herstellungsart eines Interposers im Längsschnitt und
Fig. 2 eine zweite Herstellungsart. Detaillierte Beschreibung
In einem ersten Verfahrensschritt werden Lochungsstellen 10 auf einem plattenförmigen Glassubstrat 1 durch fokussierte Laserimpulse 41 markiert, die von einer Anordnung 4 von Lasern 40 ausgehen. Die Strahlungsintensität dieser Laser ist so stark, dass es zu lokaler, athermischer Zerstörung entlang eines filamentartigen Kanals 11 im Glas kommt.
In einem zweiten Verfahrensschritt werden die
filamentartigen Kanäle 11 zu Löchern 12 aufgeweitet. Man kann sich dabei gegenüberstehender Elektroden 6 und 7 bedienen, denen Hochspannungsenergie zugeführt wird, was zu dielektrischen Durchbrüchen durch das Glassubstrat entlang der filamentartigen Kanäle 11 führt. Diese Durchbrüche erweitern sich durch elektrothermische Aufheizung und
Verdampfung von Lochmaterial, bis der Vorgang bei Erreichen des gewünschten Lochdurchmessers durch Abschalten der
Energiezufuhr gestoppt wird. Alternativ oder zusätzlich kann man auch die
filamentartigen Kanäle 11 durch reaktive Gase aufweiten,
wie durch Düsen 20, 30 dargestellt, die das Gas auf die Lochungsstellen 10 richten.
Im nächsten Verfahrensschritt werden auf der Oberseite der Glasplatte 1 Leitungsbahnen 13 zu den Lochungsstellen 10 hin aufgebracht, und die Löcher 12 werden durch leitendes Material 14 verfüllt, um auf der Unterseite der Platte die Anschlüsse zu den Kontaktpunkten eines CPU-Chips oder dergleichen zu vervollständigen. (Zur Montage auf dem
Motherboard wird die Glasplatte 1 gewendet.)
Fig. 2 zeigt eine weitere Möglichkeit der Herstellung von Mikrolöchern . Die Lochungsstellen 10 werden durch präzise aufgedrucktes HF-Ankopplungsmaterial markiert. An diesen Stellen 10 wird Hochfrequenzenergie mittels Elektroden 2, 3 eingekoppelt, so dass sich die Ankopplungspunkte selbst und das Glasmaterial zwischen den oberseitigen
Ankopplungspunkten und den unterseitigen Ankopplungspunkten erwärmt, was zu einer Erniedrigung der
Durchschlagsfestigkeit des Materials führt. Bei Anlage von Hochspannung kommt es zu dielektrischen Durchbrüchen entlang von schmalen Kanälen 11. Durch weitere Zufuhr von Hochspannungsenergie können diese schmalen Kanäle 11 auf die Größe der Löcher 12 aufgeweitet werden.
Es ist aber auch möglich, die Aufweitung der schmalen
Kanäle 11 infolge dielektrischer Durchbrüche durch
reaktives Gas vorzunehmen, das durch Düsen 20, 30 zugeführt wird .
Schließlich werden auf der Oberseite des Glassubstrats Leitungsbahnen 13 zu den Löchern 12 aufgebracht, und die
Löcher werden mit Leitungsmaterial 14 verfüllt, um, bei gewendeter Glasplatte 1, die Anschlüsse für den CPU-Chip herzustellen . Es sei bemerkt, dass Interposer nicht einzeln hergestellt werden müssen, sondern Glassubstratplatten für eine
Vielzahl von Interposern verarbeitet werden können, indem die großformatigen Glassubstratplatten zerschnitten werden, um die einzelnen Interposer zu gewinnen. Es können Formate der Glassubstratplatten mit Kantenlängen von 0,2 m auf 3 m (oder kleiner) verarbeitet werden.
Rundscheibenformate können Abmessungen bis zu 1 m
aufweisen . Ausführungsbeispiele
Aus herkömmlichen, von unvermeidlichen Verunreinigungen abgesehen im wesentlichen alkalifreien Rohstoffen wurden bei 1620° Celsius Gläser in Pt/Ir-Tiegeln erschmolzen. Die Schmelze wurde anderthalb Stunden bei dieser Temperatur geläutert, anschließend in induktiv bezeigte Platintiegel umgegossen und zur Homogenisierung 30 Minuten bei 1550° Celsius gerührt. Die Tabelle zeigt fünfzehn Beispiele geeigneter Gläser mit ihren Zusammensetzungen (in Gew.-% auf Oxidbasis) und ihre wichtigsten Eigenschaften. Das Läutermittel Sn02 (Beispiele 1-8, 11, 12, 14, 15) bzw. As203 (Beispiele 9, 10, 13) mit einem Anteil von 0,3 Gew.-% ist nicht aufgeführt. Folgende Eigenschaften sind angegeben:
- der thermische Ausdehnungskoeffizient 2o/3oo (10_6/K)
- die Dichte p (g/cm3)
- die dilatometrische Transformationstemperatur Tg (°C) nach DIN 52324
- die Temperatur bei der Viskosität 104 dPas (bezeichnet als T4 (°C)
- die Temperatur bei der Viskosität 102 dPas (bezeichnet als T2 (°C), berechnet aus der Vogel-Fulcher-Tammann- Gleichung
- eine Säurebeständigkeit „HCl" als Gewichtsverslust
(Abtragswert) von allseitig polierten Glasplättchen der Abmessungen 50mm x 50mm x 2mm nach Behandlung mit 5%iger Salzsäure für 24 Stunden bei 95°C (mg/cm2) .
- eine Beständigkeit „BHF" gegenüber gepufferter
Fluorwasserstoffsäure als Gewichtsverlust
(Abtragswert) von allseitig polierten Glasplättchen der Abmessungen 50mm x 50mm x 2mm nach Behandlung mit 10% NH4F · HF für 20 min. bei 23°C (mg/cm2)
- der Brechwert nd
Beispiele :
Zusammensetzungen (in Gew.-% auf Oxidbasis) und
wesentliche Eigenschaften von erfindungsgemäßen Gläsern
1 2 3 4 5 6
Si02 60, 0 60, 0 59, 9 58, 9 59, 9 61, 0
B203 7,5 7,5 7,5 8,5 7,5 9,5
A1203 21,5 21,5 21,5 21,5 21,5 18, 4
MgO 2,9 2, 9 2,0 2,0 2,9 2,2
CaO 3,8 2,8 3,8 3,8 4,8 4,1
BaO 4,0 5,0 5,0 5, 0 3,1 4,5
ZnO - - - - - -
α20/300 3, 07 3, 00 3,01 3, 08 3, 13 3, 11
(10"6/K)
ρ (g/cmJ) 2,48 2,48 2,48 2,48 2,47 2,45
Tg (°C) 747 748 752 741 743 729
T 4 (°C) 1312 1318 1315 1308 1292 1313
T 2 (°C) 1672 1678 1691 1668 1662 1700 nd 1, 520 1, 518 1, 519 1, 519 1, 521 1, 515
HCl 1, 05 n.b. 0,85 n.b. 1,1 n.b.
(mg/cm2)
BHF 0, 57 0, 58 0, 55 0, 55 0, 56 0,49
(mg/cm2)
7 8 9 10 11 12
Si02 58, 5 62, 8 63, 5 63, 5 59,7 59,0
B203 7,7 8,2 10, 0 10, 0 10, 0 9,0
AI2O3 22, 7 16, 5 15, 4 15, 4 18, 5 17, 2
MgO 2,8 0,5 2,0 1,0 2,0
CaO 2,0 4,2 5, 6 6, 6 8,3 9,0
BaO 5,0 7,5 3,2 3,2 3,2 3,5
ZnO 1,0 - - - - -
O20/300 2,89 3, 19 3, 24 3, 34 3, 44 3,76
(10"6/K)
p (g/cmJ) 2, 50 2,49 2,42 2,43 2,46 2, 50
Tg (°C) 748 725 711 719 714 711
T 4 (°C) 1314 1325 1320 1327 1281 1257
T 2 (°C) 1674 1699 n.b. n.b. 1650 1615 nd 1, 520 1, 513 1, 511 1, 512 1, 520 1, 526
HCl n.b. 0, 30 0,89 n.b. n.b. 0, 72
(mg/cm2)
BHF 0, 62 0,45 0,43 0,40 0, 44 0,49
(mg/cm2)
n.b. = nicht bestimmt
Wie die Ausführungsbeispiele verdeutlichen, besitzen die Gläser folgende vorteile Eigenschaften:
- eine thermische Dehnung 2o/3oo zwischen 2,8 x 10"6/K und 3,8 X 10"6/K, in bevorzugten Ausführungen ^ 3,6 x 10"6/K, in besonders bevorzugten Ausführungen <3,2 x 10"6/K, damit angepasst an das Ausdehnungsverhalten von amorphen und auch zunehmend polykristallinem Silicium.
- mit Tg > 700°C eine hohe Transformationstemperatur, also eine hohe Temperaturbeständigkeit. Dies ist wesentlich für einen möglichst geringen herstellungsbedingten Schrumpf
(„compaction" ) und für die Verwendung der Gläser als
Substrate für Beschichtungen mit amorphen Si-Schichten und deren anschließende Temperung.
- mit p < 2,600 g/cm3 eine geringe Dichte
- eine Temperatur bei der Viskosität 104 dPas
(Verarbeitungstemperatur VA) von maximal 1350°C, und eine Temperatur bei der Viskosität 102 dPas von maximal 1720°C, was hinsichtlich der Heißformgebung sowie Schmezlbarkeit eine geeignete Viskositätskennlinie bedeutet.
- mit nd ^ 1,526 einen geringen Brechwert.
- eine hohe chemische Beständigkeit dokumentiert u.a. durch gute Beständigkeit gegenüber gepufferter Flußsäurelösung.
Die Gläser weisen eine hohe Temperaturwechselbeständigkeit und eine gute Entglasungsstabilität auf. Die Gläser sind als Flachgläser mit den verschiedenen Ziehverfahren, z.B. Micro-sheet-Down-draw-, Up-draw- oder Overflowfusion-
Verfahren und in bevorzugter Ausführung, wenn sie frei von AS2O3 und Sb203 sind, auch mit dem Floatverfahren
herstellbar . Mit diesen Eigenschaften sind die Gläser hervorragend geeignet für die Verwendung als Substratglas bei der
Herstellung von Interposern.
Durch den Einsatz des Basissubstrats aus alkaliarmem Glas und mit einem Wärmeausdehnungskoeffizienten sehr nahe an dem des Chips aus Siliziummaterial werden Schwierigkeiten infolge unterschiedlicher Wärmeausdehnung von Interposer
und CPU-Chip weitgehend vermieden. Wenn benachbarte, miteinander verbundene Materialschichten oder -platten sich nur wenig unterschiedlich erwärmen und der
Wärmeausdehnungskoeffizient wenig unterschiedlich ist, treten weniger mechanische Spannungen zwischen diesen verbundenen Schichten oder Platten auf, und es kommt nicht zu Verwerfungen oder zu Rissen zwischen den Schichten oder Platten.
Interposer, welche dichter mit Löchern gegenüber bisherigen Interposern besetzt sind, nehmen kleinere Substratgrößen ein, wodurch das Ausmaß unterschiedlicher Dehnungen und Schrumpfungen der beteiligten Schichten oder Platten und damit die Gefahr des sich Verwerfens und damit der
Rissbildung zwischen den beteiligten Schichten oder Platten noch weiter verringert wird.
Schließlich sind Kostensenkungen auch deshalb zu erwarten, weil (bei verringerter Interposergröße und Lochgröße) weniger Material an Glas und an Leitungsmaterial zur
Auffüllung der Löcher verwendet werden muss.
Claims
Patentansprüche
Interposer zur elektrischen Verbindung zwischen einem CPU-Chip und einer Schaltungsplatte,
mit folgenden Merkmalen:
ein plattenförmiges Basissubstrat (1) aus Glas mit einer ersten und einer zweiten Plattenseite;
das Basissubstrat (1) weist einen
Wärmeausdehnungskoeffizienten im Bereich zwischen
3,1 · KT6 /°C und 3,4 · 10"6 /°C auf;
das Basissubstrat weist Löcher (12) quer zu den Plattenseiten in einer Anzahl auf, die im Bereich zwischen 10 und 10.000 cm"2 liegt;
es gibt Löcher (12) mit Durchmessern, die im Bereich zwischen 20 pm und 200 pm liegen können;
der Abstand der Löcher (12), gemessen von
Lochmitte zu Lochmitte, liegt im Bereich zwischen 50 pm und 700 pm;
auf der ersten Plattenseite verlaufen
Leiterbahnen (13), die sich jeweils bis in die Löcher (12) hinein und durch diese hindurch (14) auf die zweite Plattenseite erstrecken, um Anschlusspunkte für den CPU-Chip zu bilden.
Interposer nach Anspruch 1,
wobei das Glas des Basissubstrates einen Alkaligehalt weniger als 700 ppm enthält.
Interposer nach Anspruch 1 oder 2,
wobei das Glas des Basissubstrates einen Arsen- oder
Antimongehalt von weniger als 50 ppm enthält.
4. Interposer nach einem der Ansprüche 1 bis 3,
wobei der Wärmeausdehnungskoeffizient bei 3,2 · 10 -6 liegt .
5. Interposer nach einem der Ansprüche 1 bis 4,
wobei die Plattendicke des Substrates (1) im Bereich zwischen 30 μιη und 1000 μτ liegt.
Interposer nach einem der Ansprüche 1 bis 5,
wobei die Lochanzahl im Bereich zwischen 1000 bis
3000 cm"2 liegt.
Interposer nach einem der Ansprüche 1 bis 6,
wobei der Durchmesser der Löcher (12) maximal 100 pm beträgt .
Interposer nach einem der Ansprüche 1 bis 7,
wobei der Mittenabstand der Löcher (12) (12) im Bereich zwischen 150 ym und 400 μπι liegt.
Interposer nach einem der Ansprüche 1 bis 8,
wobei der Lochkantenabstand der Löcher (12) wenigstens
30 pm beträgt.
Interposer nach einem der Ansprüche 1 bis 9,
wobei Löcher (12) unterschiedlichen Durchmessers in dem plattenförmigen Basissubstrat (1) vorhanden sind.
Interposer nach einem der Ansprüche 1 bis
wobei folgende Abmessungsverhältnisse eingehalten
werden :
Lochmittenabstand zu Lochdurchmesser im Bereich von 1 bis 10;
Lochkantenabstand zu Lochdurchmesser im Bereich von 1 bis 9;
Plattendicke des Substrats zu Lochdurchmesser im Bereich von 0,1 bis 25.
12. Interposer nach einem der Ansprüche 1 bis 11,
wobei die Lochkanten zwischen Plattenseite des
Basissubstrats und Lochlaibung abgerundet-gebrochen sind.
13. Verfahren zur Herstellung von Löchern in einem
Interposer nach einem der Ansprüche 1 bis 12,
mit folgenden Schritten:
a) Bereitstellen des zu lochenden Basissubstrates (1) aus Glas;
b) Ausrichten einer Vielfach-Laserstrahlanordnung (4) auf vorbestimmte Lochungsstellen (10) des
Basissubstrates (1);
c) Auslösen von fokussierten Laserimpulsen (41) in
einem Wellenlängenbereich zwischen 1600 und 200 nm, in welchem das Glas wenigstens teilweise transparent ist, und mit einer Strahlungsintensität, die zu lokaler, athermischer Zerstörung des Glases entlang jeweils eines filamentartigen Kanals (11) führt; d) Aufweiten der filamentartigen Kanäle (11) auf
gewünschten Durchmesser der Löcher (12).
14. Verfahren nach Anspruch 13,
wobei die Aufweitung der filamentartigen Kanäle (11)
durch elektrothermische Aufheizung und Verdampfung von Lochmaterial infolge dielektrischer Durchbrüche erfolgt . 15. Verfahren nach Anspruch 13,
wobei die Aufweitung der filamentartigen Kanäle (11) durch reaktive Gase erfolgt.
Verfahren zur Herstellung von Löchern in einem
Interposer nach einem der Ansprüche 1 bis 12,
mit folgenden Schritten:
a) beidseitiges Bedrucken des Basissubstrats (1) aus Glas mit HF-Ankopplungsmaterial , punktförmig an vorgesehenen Lochungsstellen (10);
b) Verbringen des bedruckten Basissubstrates (1) in
einen Bearbeitungsraum, der von plattenförmigen HF- Elektroden (2, 3) flankiert wird;
c) Beaufschlagen des Basissubstrates (1) mit HF- Energie, die vorwiegend das punktförmig aufgebrachte HF-Ankopplungsmaterial erwärmt, bis dort Erweichung des Materials des Basissubstrates stattfindet;
d) Erzeugen hoher Spannung zwischen den Elektroden (2, 3), um schmale Kanäle (11) infolge dielektrischer Durchbrüche, ausgehend von den HF- Ankopplungspunkten, zu erzeugen.
17. Verfahren nach Anspruch 16,
wobei eine Aufweitung der schmalen Kanäle (11) infolge dielektrischer Durchbrüche zu Löchern (12) durch tiefes, reaktives Ionen-Ätzen erfolgt.
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| Publication Number | Publication Date |
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Family Applications (1)
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Families Citing this family (34)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| TWI547454B (zh) * | 2011-05-31 | 2016-09-01 | 康寧公司 | 於玻璃中高速製造微孔洞的方法 |
| EP2754524B1 (de) | 2013-01-15 | 2015-11-25 | Corning Laser Technologies GmbH | Verfahren und Vorrichtung zum laserbasierten Bearbeiten von flächigen Substraten, d.h. Wafer oder Glaselement, unter Verwendung einer Laserstrahlbrennlinie |
| EP2781296B1 (de) | 2013-03-21 | 2020-10-21 | Corning Laser Technologies GmbH | Vorrichtung und verfahren zum ausschneiden von konturen aus flächigen substraten mittels laser |
| JP6162827B2 (ja) | 2013-04-04 | 2017-07-12 | エル・ピー・ケー・エフ・レーザー・ウント・エレクトロニクス・アクチエンゲゼルシヤフト | 基板を分離する方法及び装置 |
| DE102013103370A1 (de) | 2013-04-04 | 2014-10-09 | Lpkf Laser & Electronics Ag | Verfahren zum Einbringen von Durchbrechungen in ein Glassubstrat sowie ein derart hergestelltes Glassubstrat |
| LT2964417T (lt) | 2013-04-04 | 2022-04-11 | Lpkf Laser & Electronics Ag | Būdas kiaurinėms angoms pagrinde įvesti |
| US11556039B2 (en) | 2013-12-17 | 2023-01-17 | Corning Incorporated | Electrochromic coated glass articles and methods for laser processing the same |
| US10293436B2 (en) * | 2013-12-17 | 2019-05-21 | Corning Incorporated | Method for rapid laser drilling of holes in glass and products made therefrom |
| JP2015146401A (ja) * | 2014-02-04 | 2015-08-13 | 大日本印刷株式会社 | ガラスインターポーザー |
| KR102445217B1 (ko) | 2014-07-08 | 2022-09-20 | 코닝 인코포레이티드 | 재료를 레이저 가공하는 방법 및 장치 |
| LT3169477T (lt) | 2014-07-14 | 2020-05-25 | Corning Incorporated | Skaidrių medžiagų apdorojimo sistema ir būdas, naudojant lazerio pluošto židinio linijas, kurių ilgis ir skersmuo yra reguliuojami |
| DE102014113339A1 (de) | 2014-09-16 | 2016-03-17 | Lpkf Laser & Electronics Ag | Verfahren zur Erzeugung von Ausnehmungen in einem Material |
| EP4061101A1 (de) | 2014-09-16 | 2022-09-21 | LPKF Laser & Electronics AG | Verfahren zum einbringen mindestens einer ausnehmung oder einer durchbrechung in ein plattenförmiges werkstück |
| WO2016154284A1 (en) | 2015-03-24 | 2016-09-29 | Corning Incorporated | Laser cutting and processing of display glass compositions |
| US10410883B2 (en) | 2016-06-01 | 2019-09-10 | Corning Incorporated | Articles and methods of forming vias in substrates |
| US10134657B2 (en) | 2016-06-29 | 2018-11-20 | Corning Incorporated | Inorganic wafer having through-holes attached to semiconductor wafer |
| US10794679B2 (en) | 2016-06-29 | 2020-10-06 | Corning Incorporated | Method and system for measuring geometric parameters of through holes |
| WO2018064409A1 (en) | 2016-09-30 | 2018-04-05 | Corning Incorporated | Apparatuses and methods for laser processing transparent workpieces using non-axisymmetric beam spots |
| LT3529214T (lt) | 2016-10-24 | 2021-02-25 | Corning Incorporated | Substrato apdorojimo stotis lakšto formos stiklo substratų lazeriniam mašininiam apdorojimui |
| EP3592500B1 (de) | 2017-03-06 | 2023-10-11 | LPKF Laser & Electronics SE | Verfahren zum einbringen zumindest einer ausnehmung in ein material mittels elektromagnetischer strahlung und anschliessendem ätzprozess |
| WO2018210519A1 (de) | 2017-05-19 | 2018-11-22 | Schott Ag | Bauteil, umfassend glas oder glaskeramik, mit entlang einer vorgegebenen trennlinie angeordneten vorschädigungen, verfahren und vorrichtung zur herstellung des bauteils und dessen verwendung |
| US10580725B2 (en) | 2017-05-25 | 2020-03-03 | Corning Incorporated | Articles having vias with geometry attributes and methods for fabricating the same |
| US11078112B2 (en) | 2017-05-25 | 2021-08-03 | Corning Incorporated | Silica-containing substrates with vias having an axially variable sidewall taper and methods for forming the same |
| US12180108B2 (en) | 2017-12-19 | 2024-12-31 | Corning Incorporated | Methods for etching vias in glass-based articles employing positive charge organic molecules |
| US11554984B2 (en) | 2018-02-22 | 2023-01-17 | Corning Incorporated | Alkali-free borosilicate glasses with low post-HF etch roughness |
| EP3776035B1 (de) | 2018-04-03 | 2022-11-09 | Corning Research & Development Corporation | Wellenleitersubstrate und wellenleitersubstratverbindungsanordnungen mit wellenleitern und ausrichtungsmerkmalen und verfahren zur herstellung davon |
| EP3776036B1 (de) | 2018-04-03 | 2023-04-26 | Corning Research & Development Corporation | Wellenleitersubstrate und wellenleitersubstratanordnungen mit wellenleiterlenkungsschemata und verfahren zur herstellung davon |
| US11609395B2 (en) | 2021-01-11 | 2023-03-21 | Corning Research & Development Corporation | Waveguide substrates and assemblies including the same |
| WO2025010112A1 (en) * | 2023-07-03 | 2025-01-09 | Corning Incorporated | Co-fired glass substrates for high frequency electronic packaging and methods of making |
| KR102833095B1 (ko) | 2024-06-14 | 2025-07-10 | 경북대학교 산학협력단 | 유리 인터포저용 마이크로 홀 가공 장치 및 그 방법 |
| KR102888357B1 (ko) * | 2024-06-14 | 2025-11-18 | 경북대학교 산학협력단 | 유리 인터포저용 마이크로 홀 가공 장치 및 그 방법 |
| KR102833094B1 (ko) | 2024-06-19 | 2025-07-10 | 경북대학교 산학협력단 | 유리 인터포저용 마이크로 홀 가공 장치 및 그 방법 |
| KR102833097B1 (ko) | 2024-06-20 | 2025-07-10 | 경북대학교 산학협력단 | 유리 인터포저용 마이크로 홀 가공 장치 및 그 방법 |
| KR20250178795A (ko) | 2024-06-20 | 2025-12-29 | 경북대학교 산학협력단 | 유리 인터포저용 고집적 마이크로 홀 가공 장치 및 그 방법 |
Family Cites Families (90)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US3483373A (en) | 1966-07-28 | 1969-12-09 | Siemens Ag | Airlock assembly for corpuscular ray devices |
| US3562009A (en) | 1967-02-14 | 1971-02-09 | Western Electric Co | Method of providing electrically conductive substrate through-holes |
| US3783237A (en) | 1972-11-06 | 1974-01-01 | Reynolds Tobacco Co R | Apparatus for electrically perforating sheet material |
| DE2802315C2 (de) | 1978-01-20 | 1987-02-05 | Hauni-Werke Körber & Co KG, 2050 Hamburg | Vorrichtung zum Perforieren von Bahnen aus Umhüllungsmaterial für Zigaretten oder andere stabförmige Rauchartikel und Verwendung der Vorrichtung |
| DE2830326A1 (de) | 1978-07-10 | 1980-01-24 | Schmidt Kufeke K P | Anordnung zum feinstperforieren folienartiger materialbahnen mittels hochspannungsimpulsen |
| FR2475064B1 (fr) | 1980-01-31 | 1987-06-26 | Inoue Japax Res | Procede et dispositif de traitement par etincelage d'une piece conductrice de l'electricite |
| DE3111402A1 (de) | 1980-03-25 | 1982-04-29 | Walter Winston Duley | "verfahren und vorrichtung zur laserstrahl-bearbeitung von werkstuecken" |
| US4662969A (en) | 1985-01-14 | 1987-05-05 | General Motors Corporation | Microwave method of perforating a polymer film |
| US4777338A (en) | 1987-04-08 | 1988-10-11 | Cross James D | Perforation of synthetic plastic films |
| DE3742770A1 (de) | 1987-12-17 | 1989-06-29 | Akzo Gmbh | Mikro-/ultrafiltrationsmembranen mit definierter porengroesse durch bestrahlung mit gepulsten lasern und verfahren zur herstellung |
| US5216207A (en) * | 1991-02-27 | 1993-06-01 | David Sarnoff Research Center, Inc. | Low temperature co-fired multilayer ceramic circuit boards with silver conductors |
| FR2677271A1 (fr) | 1991-06-04 | 1992-12-11 | Commissariat Energie Atomique | Procede de realisation de membranes microporeuses. |
| US5367143A (en) | 1992-12-30 | 1994-11-22 | International Business Machines Corporation | Apparatus and method for multi-beam drilling |
| JP2529811B2 (ja) | 1993-07-28 | 1996-09-04 | 栄電子工業株式会社 | 小径穴加工装置及びそれを使用する小径穴加工方法 |
| JP2607346B2 (ja) | 1994-03-04 | 1997-05-07 | 栄電子工業株式会社 | 基板材料の小径穴加工方法 |
| JP2572201B2 (ja) | 1994-03-04 | 1997-01-16 | 栄電子工業株式会社 | 基板材料の小径穴加工方法及び装置 |
| JP2614697B2 (ja) | 1994-03-29 | 1997-05-28 | 栄電子工業株式会社 | 小径穴加工装置及びそれを使用する小径穴加工方法 |
| WO1997003460A1 (en) | 1995-07-12 | 1997-01-30 | Hoya Corporation | Bare chip mounted board, method of manufacturing the board, and method of forming electrode of bare chip |
| JP2989271B2 (ja) * | 1995-07-12 | 1999-12-13 | ホーヤ株式会社 | ベアチップ搭載ボード、ベアチップ搭載ボードの製造方法及びベアチップの電極形成方法 |
| US5770889A (en) * | 1995-12-29 | 1998-06-23 | Lsi Logic Corporation | Systems having advanced pre-formed planar structures |
| CN1161899A (zh) | 1996-03-13 | 1997-10-15 | 严跃 | 高分子薄膜微孔加工法 |
| JPH09255351A (ja) * | 1996-03-26 | 1997-09-30 | Nippon Sheet Glass Co Ltd | ガラス板の孔あけ方法および装置 |
| JP4004596B2 (ja) | 1997-08-05 | 2007-11-07 | 一成 高木 | プラスチックフィルムの製造方法 |
| US6114240A (en) * | 1997-12-18 | 2000-09-05 | Micron Technology, Inc. | Method for fabricating semiconductor components using focused laser beam |
| US6620731B1 (en) * | 1997-12-18 | 2003-09-16 | Micron Technology, Inc. | Method for fabricating semiconductor components and interconnects with contacts on opposing sides |
| JP3844868B2 (ja) | 1998-01-12 | 2006-11-15 | 株式会社東芝 | レーザ・放電複合加工方法および装置 |
| US7205181B1 (en) * | 1998-03-20 | 2007-04-17 | Mcsp, Llc | Method of forming hermetic wafer scale integrated circuit structure |
| JP4497147B2 (ja) * | 1998-12-16 | 2010-07-07 | セイコーエプソン株式会社 | 半導体チップの製造方法、半導体装置の製造方法、回路基板の製造方法及び電子機器の製造方法 |
| KR100379350B1 (ko) * | 1998-12-16 | 2003-04-08 | 세이코 엡슨 가부시키가이샤 | 반도체 칩, 반도체 장치, 회로 기판 및 전자기기 및 그제조 방법 |
| JP3792445B2 (ja) | 1999-03-30 | 2006-07-05 | 日本特殊陶業株式会社 | コンデンサ付属配線基板 |
| US7247035B2 (en) * | 2000-06-20 | 2007-07-24 | Nanonexus, Inc. | Enhanced stress metal spring contactor |
| EP1224999A4 (de) | 1999-09-28 | 2007-05-02 | Sumitomo Heavy Industries | Laserbohrverfahren und laserbohrvorrichtung |
| JP2001266094A (ja) * | 2000-03-15 | 2001-09-28 | Toshiba Corp | 非接触通信装置及び非接触通信装置の制御方法 |
| JP3796099B2 (ja) * | 2000-05-12 | 2006-07-12 | 新光電気工業株式会社 | 半導体装置用インターポーザー、その製造方法および半導体装置 |
| JP3797068B2 (ja) | 2000-07-10 | 2006-07-12 | セイコーエプソン株式会社 | レーザによる微細加工方法 |
| US6399892B1 (en) | 2000-09-19 | 2002-06-04 | International Business Machines Corporation | CTE compensated chip interposer |
| US6977224B2 (en) | 2000-12-28 | 2005-12-20 | Intel Corporation | Method of electroless introduction of interconnect structures |
| JP4092890B2 (ja) * | 2001-05-31 | 2008-05-28 | 株式会社日立製作所 | マルチチップモジュール |
| JP3860000B2 (ja) * | 2001-09-07 | 2006-12-20 | Necエレクトロニクス株式会社 | 半導体装置およびその製造方法 |
| TWI312166B (en) * | 2001-09-28 | 2009-07-11 | Toppan Printing Co Ltd | Multi-layer circuit board, integrated circuit package, and manufacturing method for multi-layer circuit board |
| JP2003249606A (ja) * | 2002-02-25 | 2003-09-05 | Sony Corp | 半導体装置及びインターポーザー |
| JP3999999B2 (ja) | 2002-04-19 | 2007-10-31 | 新日本製鐵株式会社 | レーザ表面加工装置 |
| JP4138529B2 (ja) * | 2003-02-24 | 2008-08-27 | 浜松ホトニクス株式会社 | 半導体装置、及びそれを用いた放射線検出器 |
| WO2004063109A1 (ja) | 2003-01-10 | 2004-07-29 | Nippon Sheet Glass Company, Limited | レーザ加工用ガラス |
| DE10301291B3 (de) | 2003-01-15 | 2004-08-26 | Infineon Technologies Ag | Verfahren zum Einbringen von eine unterschiedliche Dimensionierung aufweisenden Strukturen in ein Substrat |
| US7327554B2 (en) * | 2003-03-19 | 2008-02-05 | Ngk Spark Plug Co., Ltd. | Assembly of semiconductor device, interposer and substrate |
| JP2004288839A (ja) | 2003-03-20 | 2004-10-14 | Fujikura Ltd | 反応性イオンエッチング装置 |
| JP2004306137A (ja) | 2003-03-27 | 2004-11-04 | Kyocera Corp | 貫通孔の形成方法 |
| US6984583B2 (en) * | 2003-09-16 | 2006-01-10 | Micron Technology, Inc. | Stereolithographic method for forming insulative coatings for via holes in semiconductor devices |
| EP1667225A4 (de) * | 2003-09-24 | 2009-04-01 | Ibiden Co Ltd | Zwischenglied und mehrschichtige leiterplatte |
| EP1681717B1 (de) * | 2003-11-07 | 2017-03-29 | Shinko Electric Industries Co., Ltd. | Elektronische einrichtung |
| JPWO2005074003A1 (ja) * | 2004-01-28 | 2007-09-13 | 国立大学法人京都大学 | レーザ分析装置及び方法 |
| US20060060238A1 (en) | 2004-02-05 | 2006-03-23 | Advent Solar, Inc. | Process and fabrication methods for emitter wrap through back contact solar cells |
| JP2005228834A (ja) | 2004-02-12 | 2005-08-25 | Ibiden Co Ltd | プラズマ発生装置用電極埋設部材 |
| CN100485913C (zh) * | 2004-02-24 | 2009-05-06 | 揖斐电株式会社 | 半导体搭载用基板 |
| ATE543617T1 (de) * | 2004-04-01 | 2012-02-15 | Picodrill Sa | Herstellung und verwendung von mikroperforierten substraten |
| US7109068B2 (en) * | 2004-08-31 | 2006-09-19 | Micron Technology, Inc. | Through-substrate interconnect fabrication methods |
| US7221050B2 (en) * | 2004-09-02 | 2007-05-22 | Intel Corporation | Substrate having a functionally gradient coefficient of thermal expansion |
| CN101646301B (zh) * | 2004-12-15 | 2011-09-07 | 揖斐电株式会社 | 印刷电路板 |
| JP3966329B2 (ja) * | 2005-01-24 | 2007-08-29 | セイコーエプソン株式会社 | インクジェットヘッドの製造方法 |
| JP2006239718A (ja) * | 2005-03-01 | 2006-09-14 | Kyoto Univ | ナノ空孔周期配列体の作製方法及びその装置 |
| US8022532B2 (en) * | 2005-06-06 | 2011-09-20 | Rohm Co., Ltd. | Interposer and semiconductor device |
| TWI379724B (en) * | 2006-02-03 | 2012-12-21 | Gsi Group Corp | Laser-based method and system for removing one or more target link structures |
| JP4394667B2 (ja) | 2006-08-22 | 2010-01-06 | 日本碍子株式会社 | ヒータ付き静電チャックの製造方法 |
| JP2008066481A (ja) * | 2006-09-06 | 2008-03-21 | Shinko Electric Ind Co Ltd | パッケージ、半導体装置、パッケージの製造方法及び半導体装置の製造方法 |
| JP5003082B2 (ja) * | 2006-09-26 | 2012-08-15 | 富士通株式会社 | インターポーザ及びその製造方法 |
| JP5124121B2 (ja) * | 2006-10-02 | 2013-01-23 | 株式会社アルバック | ガラス基板のエッチング方法 |
| WO2008105535A1 (ja) * | 2007-03-01 | 2008-09-04 | Nec Corporation | 半導体装置及びその製造方法 |
| US8440916B2 (en) * | 2007-06-28 | 2013-05-14 | Intel Corporation | Method of forming a substrate core structure using microvia laser drilling and conductive layer pre-patterning and substrate core structure formed according to the method |
| US20100314723A1 (en) | 2007-07-20 | 2010-12-16 | Christian Schmidt | Manufacturing of optical structures by electrothermal focussing |
| US20090033337A1 (en) | 2007-08-03 | 2009-02-05 | Pasco Robert W | Temporary chip attach test carrier utilizing an interposer |
| WO2009022461A1 (ja) * | 2007-08-10 | 2009-02-19 | Sanyo Electric Co., Ltd. | 回路装置及びその製造方法、携帯機器 |
| US7763965B2 (en) * | 2007-09-25 | 2010-07-27 | International Business Machines Corporation | Stress relief structures for silicon interposers |
| JPWO2009041159A1 (ja) * | 2007-09-28 | 2011-01-20 | 三洋電機株式会社 | 素子搭載用基板及びその製造方法、回路装置及びその製造方法、携帯機器 |
| WO2009059786A1 (en) | 2007-11-09 | 2009-05-14 | Picodrill Sa | Electrothermal focussing for the production of micro-structured substrates |
| JP5079475B2 (ja) * | 2007-12-05 | 2012-11-21 | 新光電気工業株式会社 | 電子部品実装用パッケージ |
| WO2009110288A1 (ja) | 2008-03-04 | 2009-09-11 | 日本電気株式会社 | 貫通電極付きキャパシタおよびその製造方法、並びに半導体装置 |
| US7833808B2 (en) | 2008-03-24 | 2010-11-16 | Palo Alto Research Center Incorporated | Methods for forming multiple-layer electrode structures for silicon photovoltaic cells |
| CN201257685Y (zh) | 2008-06-26 | 2009-06-17 | 高田山 | 膏药离子打孔头 |
| US8193456B2 (en) * | 2008-06-30 | 2012-06-05 | Ngk Spark Plug Co., Ltd. | Electrical inspection substrate unit and manufacturing method therefore |
| JPWO2010087483A1 (ja) | 2009-02-02 | 2012-08-02 | 旭硝子株式会社 | 半導体デバイス部材用ガラス基板および半導体デバイス部材用ガラス基板の製造方法 |
| US8039957B2 (en) * | 2009-03-11 | 2011-10-18 | Raytheon Company | System for improving flip chip performance |
| US20100244276A1 (en) * | 2009-03-25 | 2010-09-30 | Lsi Corporation | Three-dimensional electronics package |
| US8624374B2 (en) * | 2010-04-02 | 2014-01-07 | Advanced Semiconductor Engineering, Inc. | Semiconductor device packages with fan-out and with connecting elements for stacking and manufacturing methods thereof |
| US8674513B2 (en) * | 2010-05-13 | 2014-03-18 | Taiwan Semiconductor Manufacturing Company, Ltd. | Interconnect structures for substrate |
| DE102010025968B4 (de) | 2010-07-02 | 2016-06-02 | Schott Ag | Erzeugung von Mikrolöchern |
| DE102010025969A1 (de) * | 2010-07-02 | 2012-01-05 | Schott Ag | Locherzeugung mit Mehrfach-Elektroden |
| DE102010025967B4 (de) | 2010-07-02 | 2015-12-10 | Schott Ag | Verfahren zur Erzeugung einer Vielzahl von Löchern, Vorrichtung hierzu und Glas-Interposer |
| WO2012129708A1 (de) | 2011-03-30 | 2012-10-04 | Selfrag Ag | Elektrodenanordnung für eine elektrodynamische fragmentierungsanlage |
| EP2564999A1 (de) * | 2011-08-31 | 2013-03-06 | Asahi Glass Company, Limited | Verfahren zur Erzeugung eines Lochs oder einer Aussparung hoher Qualität in einem Substrat |
-
2010
- 2010-07-02 DE DE102010025966A patent/DE102010025966B4/de active Active
-
2011
- 2011-07-04 US US13/807,386 patent/US20130210245A1/en not_active Abandoned
- 2011-07-04 JP JP2013517092A patent/JP6208010B2/ja active Active
- 2011-07-04 CN CN201180032797.8A patent/CN102971838B/zh active Active
- 2011-07-04 KR KR1020167001285A patent/KR101726982B1/ko active Active
- 2011-07-04 EP EP11730223.2A patent/EP2589072A2/de not_active Withdrawn
- 2011-07-04 KR KR1020137001035A patent/KR101598260B1/ko active Active
- 2011-07-04 WO PCT/EP2011/003300 patent/WO2012000685A2/de not_active Ceased
-
2016
- 2016-07-04 JP JP2016132647A patent/JP6841607B2/ja active Active
-
2018
- 2018-12-17 JP JP2018235537A patent/JP2019041133A/ja active Pending
-
2019
- 2019-10-11 US US16/600,191 patent/US11744015B2/en active Active
Non-Patent Citations (1)
| Title |
|---|
| See references of WO2012000685A2 * |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2013531380A (ja) | 2013-08-01 |
| CN102971838A (zh) | 2013-03-13 |
| US11744015B2 (en) | 2023-08-29 |
| JP6841607B2 (ja) | 2021-03-10 |
| KR101598260B1 (ko) | 2016-02-26 |
| WO2012000685A3 (de) | 2012-03-08 |
| DE102010025966A1 (de) | 2012-01-05 |
| US20200045817A1 (en) | 2020-02-06 |
| KR20130040224A (ko) | 2013-04-23 |
| WO2012000685A2 (de) | 2012-01-05 |
| JP6208010B2 (ja) | 2017-10-04 |
| JP2019041133A (ja) | 2019-03-14 |
| US20130210245A1 (en) | 2013-08-15 |
| DE102010025966B4 (de) | 2012-03-08 |
| KR20160013259A (ko) | 2016-02-03 |
| JP2016195270A (ja) | 2016-11-17 |
| KR101726982B1 (ko) | 2017-04-13 |
| CN102971838B (zh) | 2015-11-25 |
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