JP4138529B2 - 半導体装置、及びそれを用いた放射線検出器 - Google Patents

半導体装置、及びそれを用いた放射線検出器 Download PDF

Info

Publication number
JP4138529B2
JP4138529B2 JP2003046141A JP2003046141A JP4138529B2 JP 4138529 B2 JP4138529 B2 JP 4138529B2 JP 2003046141 A JP2003046141 A JP 2003046141A JP 2003046141 A JP2003046141 A JP 2003046141A JP 4138529 B2 JP4138529 B2 JP 4138529B2
Authority
JP
Japan
Prior art keywords
hole
glass
wiring board
semiconductor device
radiation
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Fee Related
Application number
JP2003046141A
Other languages
English (en)
Other versions
JP2004265948A (ja
Inventor
勝己 柴山
泰 楠山
雅宏 林
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Hamamatsu Photonics KK
Original Assignee
Hamamatsu Photonics KK
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Hamamatsu Photonics KK filed Critical Hamamatsu Photonics KK
Priority to JP2003046141A priority Critical patent/JP4138529B2/ja
Priority to TW093100397A priority patent/TWI307556B/zh
Priority to TW093100398A priority patent/TWI307557B/zh
Priority to TW093104573A priority patent/TW200428546A/zh
Priority to US10/546,601 priority patent/US7545044B2/en
Priority to KR1020057015706A priority patent/KR100997035B1/ko
Priority to DE602004020452T priority patent/DE602004020452D1/de
Priority to EP04714020A priority patent/EP1598862B1/en
Priority to CNB2004800050039A priority patent/CN100383942C/zh
Priority to PCT/JP2004/002132 priority patent/WO2004075281A1/ja
Publication of JP2004265948A publication Critical patent/JP2004265948A/ja
Priority to IL170456A priority patent/IL170456A/en
Application granted granted Critical
Publication of JP4138529B2 publication Critical patent/JP4138529B2/ja
Anticipated expiration legal-status Critical
Expired - Fee Related legal-status Critical Current

Links

Images

Classifications

    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/0011Working of insulating substrates or insulating layers
    • H05K3/0017Etching of the substrate by chemical or physical means
    • H05K3/002Etching of the substrate by chemical or physical means by liquid chemical etching
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/12Mountings, e.g. non-detachable insulating substrates
    • H01L23/13Mountings, e.g. non-detachable insulating substrates characterised by the shape
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/14Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components sensitive to infrared radiation, light, electromagnetic radiation of shorter wavelength or corpuscular radiation and specially adapted either for the conversion of the energy of such radiation into electrical energy or for the control of electrical energy by such radiation
    • H01L27/144Devices controlled by radiation
    • H01L27/146Imager structures
    • H01L27/14601Structural or functional details thereof
    • H01L27/14634Assemblies, i.e. Hybrid structures
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/14Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components sensitive to infrared radiation, light, electromagnetic radiation of shorter wavelength or corpuscular radiation and specially adapted either for the conversion of the energy of such radiation into electrical energy or for the control of electrical energy by such radiation
    • H01L27/144Devices controlled by radiation
    • H01L27/146Imager structures
    • H01L27/14643Photodiode arrays; MOS imagers
    • H01L27/14658X-ray, gamma-ray or corpuscular radiation imagers
    • H01L27/14661X-ray, gamma-ray or corpuscular radiation imagers of the hybrid type
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/14Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components sensitive to infrared radiation, light, electromagnetic radiation of shorter wavelength or corpuscular radiation and specially adapted either for the conversion of the energy of such radiation into electrical energy or for the control of electrical energy by such radiation
    • H01L27/144Devices controlled by radiation
    • H01L27/146Imager structures
    • H01L27/14643Photodiode arrays; MOS imagers
    • H01L27/14658X-ray, gamma-ray or corpuscular radiation imagers
    • H01L27/14663Indirect radiation imagers, e.g. using luminescent members
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/15Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L2224/16Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
    • H01L2224/161Disposition
    • H01L2224/16151Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/16221Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/16225Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • H01L2224/16235Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation the bump connector connecting to a via metallisation of the item
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/15Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L2224/16Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
    • H01L2224/161Disposition
    • H01L2224/16151Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/16221Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/16225Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • H01L2224/16237Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation the bump connector connecting to a bonding area disposed in a recess of the surface of the item
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/0102Calcium [Ca]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01046Palladium [Pd]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01078Platinum [Pt]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01079Gold [Au]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/049Nitrides composed of metals from groups of the periodic table
    • H01L2924/04944th Group
    • H01L2924/04941TiN
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10Details of semiconductor or other solid state devices to be connected
    • H01L2924/11Device type
    • H01L2924/12Passive devices, e.g. 2 terminal devices
    • H01L2924/1204Optical Diode
    • H01L2924/12044OLED
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/151Die mounting substrate
    • H01L2924/1515Shape
    • H01L2924/15153Shape the die mounting substrate comprising a recess for hosting the device
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/151Die mounting substrate
    • H01L2924/15165Monolayer substrate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/151Die mounting substrate
    • H01L2924/153Connection portion
    • H01L2924/1531Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface
    • H01L2924/15312Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface being a pin array, e.g. PGA
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/30Technical effects
    • H01L2924/301Electrical effects
    • H01L2924/3025Electromagnetic shielding
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K1/00Printed circuits
    • H05K1/02Details
    • H05K1/03Use of materials for the substrate
    • H05K1/0306Inorganic insulating substrates, e.g. ceramic, glass
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K2201/00Indexing scheme relating to printed circuits covered by H05K1/00
    • H05K2201/09Shape and layout
    • H05K2201/09818Shape or layout details not covered by a single group of H05K2201/09009 - H05K2201/09809
    • H05K2201/09827Tapered, e.g. tapered hole, via or groove
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K2203/00Indexing scheme relating to apparatus or processes for manufacturing printed circuits covered by H05K3/00
    • H05K2203/02Details related to mechanical or acoustic processing, e.g. drilling, punching, cutting, using ultrasound
    • H05K2203/0235Laminating followed by cutting or slicing perpendicular to plane of the laminate; Embedding wires in an object and cutting or slicing the object perpendicular to direction of the wires
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/30Assembling printed circuits with electric components, e.g. with resistor
    • H05K3/32Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits
    • H05K3/34Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits by soldering
    • H05K3/341Surface mounted components
    • H05K3/3431Leadless components
    • H05K3/3436Leadless components having an array of bottom contacts, e.g. pad grid array or ball grid array components

Description

【0001】
【発明の属する技術分野】
本発明は、電気信号を導く導電路が設けられた配線基板を有する半導体装置、及びそれを用いた放射線検出器に関するものである。
【0002】
【従来の技術】
CT用センサなどに用いられる放射線検出器として、半導体素子である半導体光検出素子に対して、その光入射面上にシンチレータを設置した構成の検出器がある。このような放射線検出器において、検出対象となるX線、γ線、荷電粒子線などの放射線がシンチレータに入射すると、シンチレータ内で放射線によってシンチレーション光が発生する。そして、半導体光検出素子は、シンチレータから入射したシンチレーション光を検出して、放射線の強度に対応する電気信号を出力する。
【0003】
また、半導体光検出素子から出力される電気信号に対して、その信号処理を行うため、信号処理素子が設けられる。このとき、半導体素子と信号処理素子とを電気的に接続して電気信号を伝達する構成の1つとして、導電路が設けられた配線基板に半導体素子を接続して一体の半導体装置を構成し、この半導体装置の配線基板に信号処理素子を接続する構成が用いられている。配線基板を用いたこのような半導体装置は、放射線検出器以外にも様々な用途に用いられる(例えば、特許文献1、2参照)。
【0004】
【特許文献1】
特許第2555720号公報
【特許文献2】
特開平3−203341号公報
【0005】
【発明が解決しようとする課題】
半導体素子に対して配線基板を接続する構成の半導体装置では、半導体素子のチップをフリップチップボンディングによって配線基板上に実装する際、半導体素子に設けられたバンプ電極を介して、半導体素子と配線基板での対応する導電路とが電気的に接続される。
【0006】
このような構成においては、半導体素子と配線基板とを物理的、電気的に安定に接続することが重要である。しかしながら、上記のようにバンプ電極を用いた接続構成では、大きいバンプ電極が過度につぶれ、あるいは、隣接するバンプ電極同士が接触してしまうなど、バンプ電極の大きさや高さ、配置等により半導体素子と配線基板との接続に問題が生じる場合がある。
【0007】
本発明は、以上の問題点を解決するためになされたものであり、半導体素子と配線基板での対応する導電路とが良好に接続される半導体装置、及びそれを用いた放射線検出器を提供することを目的とする。
【0008】
【課題を解決するための手段】
このような目的を達成するために、本発明による半導体装置は、(1)電気信号を出力する半導体素子と、(2)信号入力面及び信号出力面の間で電気信号を導く導電路が設けられ、信号入力面に半導体素子が接続された配線基板とを備え、(3)配線基板は、コアガラス部及びコアガラス部の周囲に設けられた被覆ガラス部を含むファイバ状のガラス部材を束ねて形成された束状のガラス部材を所望の厚さに切断するとともに、コアガラス部を除去した貫通孔が設けられたガラス基板と、貫通孔に設けられ信号入力面及び信号出力面の間を電気的に導通して導電路として機能する導電性部材とを有して構成され、(4)半導体素子、及び配線基板での対応する導電性部材は、導電性部材と1対1に対応して形成されたバンプ電極を介して電気的に接続されていることを特徴とする。
【0009】
上記した半導体装置においては、半導体光検出素子などの半導体素子を接続する配線基板として、複数本のガラスファイバから一体に形成され、その所定位置に入力面から出力面への貫通孔が設けられたガラス基板を用いている。そして、貫通孔及び導電性部材に対して半導体素子のバンプ電極を1対1対応させて、半導体素子と配線基板での導電路である導電性部材とを接続している。
【0010】
このような構成によれば、半導体素子を配線基板上に実装する際に、導電性部材が設けられた貫通孔の内部にバンプ電極の一部が入り込む。これにより、半導体素子と配線基板での対応する導電路とがバンプ電極を介して良好に接続される半導体装置が実現される。ここで、配線基板における導電路の構成については、導電性部材は、ガラス基板に設けられた貫通孔の内壁に形成されていることが好ましい。
【0011】
また、ガラス基板での貫通孔は、信号入力面における開口面積が、ガラス基板の内部の所定位置における開口面積よりも大きいように形成されていることを特徴とする。このような構成では、バンプ電極が接続される側で貫通孔の開口面積が大きくなるので、貫通孔に設けられた導電性部材に対してバンプ電極を確実に接続することができる。
【0012】
貫通孔の具体的な構成としては、ガラス基板での貫通孔は、信号入力面側の所定範囲が、信号入力面からガラス基板の内部に向かって開口面積が順次小さくなるテーパ形状に形成されていることが好ましい。あるいは、ガラス基板での貫通孔は、信号入力面側の所定範囲が、ガラス基板の内部の所定位置を含む範囲における開口面積よりも大きい所定の開口面積で凹形状に形成されていることが好ましい。
【0013】
また、ガラス基板は、貫通孔として、所定の開口面積の第1貫通孔と、第1貫通孔とは異なる開口面積の第2貫通孔とを少なくとも有することを特徴としても良い。このような構成では、貫通孔に設けられた導電性部材に対して接続されるバンプ電極の大きさや高さ等に応じて、それぞれの貫通孔での開口面積を好適に設定することができる。
【0014】
また、配線基板の信号出力面に接続され、半導体素子からの電気信号を処理する信号処理手段をさらに備える構成としても良い。これにより、半導体素子から出力された電気信号が信号処理手段で処理される構成の半導体装置が得られる。
【0015】
また、本発明による放射線検出器は、上記した半導体装置を含んで構成された放射線検出器であって、(a)半導体素子を含み、入射した放射線を検出して電気信号を出力する放射線検出手段と、(2)放射線検出手段からの電気信号を処理する信号処理手段と、(3)配線基板を含み、放射線検出手段及び信号処理手段がそれぞれ信号入力面及び信号出力面に接続された配線基板部とを備えることを特徴とする。
【0016】
上記した放射線検出器においては、放射線検出手段と信号処理手段とを電気的に接続して電気信号である検出信号を伝達する配線基板部として、放射線検出手段に含まれる半導体素子とともに上記の半導体装置を構成する配線基板を用いている。このような構成によれば、半導体素子と配線基板での対応する導電性部材とが良好に接続されるので、放射線検出手段から信号処理手段への検出信号の伝達、及び信号処理手段における検出信号の処理を確実に行うことが可能な放射線検出器が実現される。
【0017】
このように、上記の半導体装置を放射線検出器に適用する場合、配線基板に用いられるガラス基板は、放射線遮蔽機能を有する所定のガラス材料から形成されていることが好ましい。これにより、放射線検出手段から信号処理手段への放射線の透過を抑制することができる。このようなガラス材料としては、例えば、鉛を含有するガラス材料がある。
【0018】
また、放射線検出手段の構成については、放射線検出手段は、放射線の入射によりシンチレーション光を発生するシンチレータと、シンチレータからのシンチレーション光を検出する半導体光検出素子とを有する構成を用いることができる。あるいは、放射線検出手段としては、入射した放射線を検出する半導体検出素子を有する構成を用いても良い。
【0019】
【発明の実施の形態】
以下、図面とともに本発明による半導体装置、及びそれを用いた放射線検出器の好適な実施形態について詳細に説明する。なお、図面の説明においては同一要素には同一符号を付し、重複する説明を省略する。また、図面の寸法比率は、説明のものと必ずしも一致していない。
【0020】
図1は、本発明による半導体装置、及び放射線検出器の一実施形態の断面構造を示す側面断面図である。また、図2は、図1に示した半導体装置、及び放射線検出器の構成を、各構成要素を分解して示す斜視図である。なお、以下の各図においては、説明の便宜のため、図1及び図2に示すように、放射線が入射する方向に沿った軸をz軸、このz軸に直交する2軸をx軸、y軸とする。ここでは、z軸の負の方向が、配線基板における信号入力面から信号出力面へと向かう導電方向、及び放射線検出器における各構成要素の配列方向となっている。
【0021】
図1に示した放射線検出器は、シンチレータ10と、半導体装置5と、信号処理部3とを備えている。これらは、図2に示すように、所定の配列方向に沿って上流側(図中の上側)から下流側(下側)へとこの順で配置されている。
【0022】
まず、フォトダイオードアレイ15及び配線基板20からなる半導体装置5の構成について説明する。
【0023】
フォトダイオードアレイ(PDアレイ)15は、半導体装置5の上流側部分を構成している。このPDアレイ15は、入射した光を検出し、その強度に対応する電気信号を出力する半導体素子であるフォトダイオード(PD)が複数個配列された半導体光検出素子アレイである。
【0024】
図2においては、PDアレイ15の構成例として、x軸及びy軸を配列軸として4×4=16個のフォトダイオード16が2次元に配列されるように形成されたPDアレイを示している。また、PDアレイ15の下面15bは、各フォトダイオード16からの検出信号を出力するための信号出力面となっている。この信号出力面15bには、検出信号出力用の電極である16個のバンプ電極17が、それぞれフォトダイオード16に対応するように4×4に配列されて設けられている。なお、図示していないが、基板電極(共通電極)用のバンプ電極も、検出信号出力用の電極と同様の形態を取っている。
【0025】
配線基板20は、半導体装置5の下流側部分を構成している。この配線基板20には、信号入力面20aと信号出力面20bとの間で電気信号を導く導電路が設けられており、その信号入力面20aに上記したPDアレイ15が接続されている。
【0026】
具体的には、配線基板20では、コアガラス部と、コアガラス部の周囲に設けられた被覆ガラス部とを含むファイバ状のガラス部材(ガラスファイバ)を束ねて束状のガラス部材とし、それをガラスファイバの軸と交差する所定方向で所望の厚さに切断したガラス基板が用いられている。本実施形態においては、半導体装置5を放射線検出器に適用しているため、配線基板20のガラス材料として、鉛を含有する鉛ガラス材料などの放射線遮蔽機能を有する所定のガラス材料が用いられている。
【0027】
図3(a)及び(b)は、それぞれ配線基板20の構成を示す平面図であり、図3(a)はその上面である信号入力面20aを、また、図3(b)は下面である信号出力面20bをそれぞれ示している。なお、この図には主要部分のみを示しており、PDアレイの基板電極に対応した部分などは図示を省略している。
【0028】
配線基板20を構成するガラス基板では、ガラス基板に含まれている複数のガラスファイバのうち所定のガラスファイバについて、その中心にあるコアガラス部が除去されて信号入力面20aから信号出力面20bへの貫通孔20cが形成されている。また、それぞれの貫通孔20cに対して、入力面20aと出力面20bとの間を電気的に導通して、導電路として機能する導電性部材21が設けられている。本実施形態においてはPDアレイ15の構成に対応して、4×4=16個の貫通孔20c及び導電性部材21が設けられている。これらの貫通孔20c及び導電性部材21は、PDアレイ15におけるバンプ電極17と同一のピッチで形成されている。
【0029】
図4は、配線基板20の貫通孔20c、及び貫通孔20cに設けられる導電性部材21の構成の一例を示す図であり、図4(a)は上面図、図4(b)はI−I矢印断面図を示している。
【0030】
配線基板20には、複数個(例えば4×4=16個)の貫通孔20cが2次元に配列されて形成されている。それぞれの貫通孔20cは、図4(b)に示すように、配線基板20の入力面20a及び出力面20bに対して垂直な軸を中心軸として、円形状の断面形状を有して形成されている。また、本実施形態においては、貫通孔20cの信号入力面20a側の所定範囲が、入力面20aからガラス基板の内部に向かって開口面積が順次小さくなるテーパ形状のテーパ部20dとなっている。また、信号出力面20b側の所定範囲が、出力面20bから内部に向かって開口面積が順次小さくなるテーパ形状のテーパ部20eとなっている。
【0031】
この貫通孔20cに対し、入力面20aと出力面20bとの間を電気的に導通する導電性部材21は、貫通孔20cの内壁に形成された部材として設けられている。具体的には、図4(a)及び(b)に示すように、テーパ部20d、20eを含む貫通孔20cの内部には、その内壁に導通部21cが形成されている。また、入力面20a上でテーパ部20dの外周部には、導通部21cと連続する入力部21aが形成されている。また、出力面20b上でテーパ部20eの外周部には、導通部21cと連続する出力部21bが形成されている。これらの導通部21c、入力部21a、及び出力部21bにより、配線基板20での導電路となる導電性部材21が構成される。
【0032】
配線基板20の入力面20a上には、図3(a)に示すように、導電性部材21の入力部21aが、PDアレイ15の出力面15b上のバンプ電極17に対応する位置に設けられている。ここで、PDアレイ15のバンプ電極17と、配線基板20の貫通孔20c及び導電性部材21とは1対1に対応しており、入力部21aは、バンプ電極17が接続される電極パッドとなっている。
【0033】
バンプ電極17は、配線基板20での対応する導電性部材21に対し、導電性部材21が設けられた貫通孔20cの内部にバンプ電極17の一部が入り込むように接続される。これにより、PDアレイ15での検出信号を出力するフォトダイオード16は、バンプ電極17を介して、配線基板20での検出信号を伝達する導電路である導電性部材21に電気的に接続される。
【0034】
また、配線基板20の出力面20b上には、図3(b)に示すように、導電性部材21の出力部21bに加えて電極パッド22が形成されている。また、電極パッド22は、配線23を介して対応する導電性部材21の出力部21bと電気的に接続されている。また、出力面20b上には、電極パッド24が形成されている。この電極パッド24は、後述するハウジング40との接続に用いられるものである。
【0035】
次に、上述した半導体装置5を含む放射線検出器の構成について説明する。
【0036】
半導体装置5のPDアレイ15の上流側には、シンチレータ10が設置されており、その上面10aが放射線検出器における放射線入射面となっている。シンチレータ10は、入射面10aからX線、γ線、荷電粒子線などの放射線が入射することにより、所定波長のシンチレーション光を発生する。また、シンチレータ10の下面である光出射面10bと、PDアレイ15の上面である光入射面15aとは、シンチレーション光を透過させる光学接着剤11を介して光学的に接続、接着されている。
【0037】
ここで、シンチレータ10及びPDアレイ15により、本放射線検出器における放射線検出部1が構成されている。この放射線検出部1は、入射した放射線を検出し、その強度に対応する電気信号として検出信号を出力する検出手段である。また、配線基板20により、放射線検出部1と信号処理部3とを接続する配線基板部2が構成されている。
【0038】
半導体装置5の配線基板20の下流側には、信号処理部3と、ハウジング(パッケージ)40とが設置されている。本実施形態においては、信号処理部3は、PDアレイ15からの検出信号を処理するための信号処理回路が設けられた信号処理素子30からなる。
【0039】
信号処理素子30の上面上には、バンプ電極31が形成されている。このバンプ電極31は、配線基板20の出力面20b上の電極パッド22に対応する位置に設けられている。これにより、配線基板20での検出信号を伝達する導電路である導電性部材21は、その出力部21b、配線23、電極パッド22、及びバンプ電極31を介して、信号処理素子30に設けられた信号処理回路に電気的に接続されている。
【0040】
なお、図ではPDアレイの信号出力に対応したバンプ電極のみ示しているが、信号処理回路の駆動信号や信号処理回路からの出力信号も同様にバンプ電極を介して配線基板20の出力面20b上にある所定の電極パッドに接続し、配線基板20の出力面20b上にある電極パッド24とハウジング40上のバンプ電極44を介して所定のリード43と電気的に接続される。
【0041】
また、ハウジング40は、シンチレータ10と、PDアレイ15及び配線基板20からなる半導体装置5と、信号処理素子30とを一体に保持する保持部材である。このハウジング40は、その上面上に凹部として設けられ、信号処理素子30を内部に収容する素子収容部41と、素子収容部41の外周に設けられ、バンプ電極44を介して配線基板20の電極パッド24に接続されるとともに、シンチレータ10、半導体装置5、及び信号処理素子30を支持する支持部42とを有する。また、ハウジング40の下面には、電気信号の外部への入出力に用いられるリード43が設けられている。
【0042】
以上の構成において、放射線検出部1のシンチレータ10にX線などの放射線が入射すると、シンチレータ10内で放射線によってシンチレーション光が発生し、光学接着剤11を介して半導体素子であるPDアレイ15のフォトダイオード16へと入射する。フォトダイオード16は、このシンチレーション光を検出して、放射線の強度に対応した電気信号を出力する。
【0043】
PDアレイ15の各フォトダイオード16から出力された電気信号は、対応するバンプ電極17、配線基板20の導電性部材21、及びバンプ電極31を順次に介して、信号処理素子30へと入力される。そして、信号処理素子30の信号処理回路において、信号処理が行われる。
【0044】
本実施形態による半導体装置、及び放射線検出器の効果について説明する。
【0045】
図1〜図4に示した半導体装置5においては、半導体素子アレイであるPDアレイ15を接続する配線基板20として、複数本のガラスファイバから一体に形成されるとともに、その所定位置にコアガラス部を除去した貫通孔20cが設けられたガラス基板を用いている。これにより、導電性部材21を設けるための貫通孔20cが所望の孔径及びピッチで形成されたガラス基板によって配線基板20を構成することができる。例えば、このような構成のガラス基板では、貫通孔20cを微細な孔径及びピッチで形成することができる。また、配線基板20の大面積化、薄型化を容易に行うことができる。
【0046】
また、貫通孔20c、及び貫通孔20cに形成された導電性部材21に対してPDアレイ15のバンプ電極17を1対1対応させて、半導体素子であるPDアレイ15のフォトダイオード16と、配線基板20での導電路である導電性部材21とを接続している。これにより、バンプ電極17と導電性部材21とを良好に接続することができる。
【0047】
また、半導体装置5を適用した放射線検出器においては、放射線検出部1と信号処理部3とを電気的に接続して検出信号を伝達する配線基板部2として、放射線検出部1に含まれるPDアレイ15とともに半導体装置5を構成する配線基板20を用いている。このような構成によれば、PDアレイ15のフォトダイオード16と、配線基板20での導電性部材21とが良好に接続されるので、放射線検出部1から信号処理部3への検出信号の伝達、及び信号処理部3における検出信号の処理を確実に行うことが可能な放射線検出器が実現される。
【0048】
このように、半導体素子及び配線基板からなる半導体装置を放射線検出器に適用する場合、配線基板20に用いられるガラス基板としては、放射線遮蔽機能を有する所定のガラス材料から形成された基板を用いることが好ましい。これにより、配線基板20の上面20a側に位置する放射線検出部1から下面20b側に位置する信号処理部3への放射線の透過を抑制することができる。
【0049】
このようなガラス材料としては、例えば、鉛を含有するガラス材料がある。鉛ガラスを用いる場合、ガラス材料に含有させる鉛の量については、その放射線検出器において要求される放射線遮蔽機能の程度等に応じて適宜設定することが好ましい。また、鉛ガラス以外で放射線遮蔽機能を有するガラス材料を用いても良い。あるいは、放射線の遮蔽が不要な場合や、放射線検出器以外の装置に上記した半導体装置を適用する場合などには、放射線遮蔽機能を有していないガラス材料を用いても良い。
【0050】
図5は、配線基板における貫通孔及び導電性部材の具体的な構成、及びそのバンプ電極との接続の一例について示す図であり、図5(a)は接続前の状態を示し、図5(b)は接続後の状態を示している。
【0051】
本構成例では、図1に関して上述したように、ガラスファイバから形成されたガラス基板の貫通孔20cに導電性部材21を設けた配線基板20と、貫通孔20c及び導電性部材21に1対1に対応するように形成されたバンプ電極17を有するPDアレイ15とを用いて半導体装置5を構成している。
【0052】
このような構成によれば、図5(b)に示すように、PDアレイ15を配線基板20上に実装する際に、導電性部材21が設けられた貫通孔20cの内部にバンプ電極17の一部が入り込む。これによりバンプ電極と導電性部材との接触面積が増大し、PDアレイ15のフォトダイオード16と、配線基板20での対応する導電性部材21とがバンプ電極17を介して電気的にかつ物理的に良好に接続される。配線基板20での導電性部材21としては、図4(a)及び(b)に示したように、貫通孔20cの内壁に形成された部材を用いることが好ましい。
【0053】
ここで、バンプ電極を用いて半導体素子と配線基板とを接続する構成では、バンプ電極の大きさや高さ、配置等により半導体素子と配線基板との接続に問題が生じる場合がある。例えば、図5(a)に示した例では、PDアレイ15の出力面15bに設けられた4個のバンプ電極17を図示しているが、これらのバンプ電極17のうち、内側の2個はやや小さいバンプ電極171、外側の2個はバンプ電極171よりも大きいバンプ電極172となっている。
【0054】
このような構成では、配線基板20上にPDアレイ15を実装したときに、PDアレイ15と配線基板20との隙間が不均一となり、あるいは、大きいバンプ電極が過度につぶれてしまうなどの問題が生じる。また、バンプ電極のピッチが狭い場合には、実装時に隣接するバンプ電極同士が接触してショートしてしまうなどの問題がある。
【0055】
これに対して、上記構成の配線基板20では、図5(b)に示すように、バンプ電極17の大きさや高さ等に応じて、バンプ電極17の一部がそれぞれ対応する導電性部材21が設けられた貫通孔20cの内部に入り込む。これにより、実装時にバンプ電極17が過度につぶれて、対応する電極パッドの周囲に広がること等が防止される。したがって、バンプ電極同士がショートすることなく、バンプ電極17と対応する導電性部材21とを良好に接続することが可能となる。
【0056】
また、図1、及び図5(a)、(b)に示した構成においては、配線基板20に設けられた貫通孔20cのうち、入力面20a側の所定範囲をテーパ部20dとしている。このような構成では、バンプ電極17が接続される入力面20a側で貫通孔20cの開口面積(円形状の内径)が大きくなるので、導電性部材21へのバンプ電極17の接続がテーパ部20dによってガイドされ、貫通孔20cに対してバンプ電極17が入り込みやすくなる。これにより、導電性部材21に対してバンプ電極17を確実に接続することができる。
【0057】
このような配線基板20の貫通孔20cは、一般には、入力面20aにおける開口面積が、ガラス基板の内部の所定位置(例えば中心位置を含み開口面積が一定となっている範囲内の位置)における開口面積よりも大きい形状に形成することが好ましい。このような構成としては、貫通孔の入力面側の所定範囲をテーパ形状とした上記構成以外にも、様々な構成を用いることができる。
【0058】
図6は、配線基板における貫通孔及び導電性部材の具体的な構成、及びそのバンプ電極との接続の他の例について示す図であり、図6(a)は接続前の状態を示し、図6(b)は接続後の状態を示している。
【0059】
本構成例では、配線基板20に設けられた貫通孔20cのうち、入力面20a側の所定範囲を、ガラス基板の内部の所定位置(例えば中心位置)を含む範囲における開口面積(円形状の内径)よりも大きい開口面積(内径)で凹形状に形成された凹部20fとしている。このような構成では、入力面20a側の所定範囲をテーパ部20dとした構成と同様に、バンプ電極17が接続される入力面20a側で貫通孔20cの開口面積が大きくなることにより、導電性部材21に対してバンプ電極17を確実に接続することができる。
【0060】
なお、配線基板20に設けられる貫通孔20cの構成としては、その入力面20a側に開口面積を変えたテーパ部20dや凹部20fなどを設けず、一定の開口面積(円形状の内径)を有する筒状の形状に形成しても良い。
【0061】
図7は、配線基板における貫通孔及び導電性部材の具体的な構成、及びそのバンプ電極との接続の他の例について示す図であり、図7(a)は接続前の状態を示し、図7(b)は接続後の状態を示している。
【0062】
図7(a)に示した例では、PDアレイ15の出力面15bに設けられた4個のバンプ電極17を図示しているが、図5(a)と同様に、これらのバンプ電極17のうち、内側の2個はやや小さいバンプ電極171、外側の2個はバンプ電極171よりも大きいバンプ電極172となっている。
【0063】
これに対して、本構成例では、バンプ電極17に対応する4個の貫通孔20cのうち、バンプ電極171に対応する内側の2個を開口面積がやや小さい貫通孔(第1貫通孔)201c、バンプ電極172に対応する外側の2個を貫通孔201cよりも開口面積が大きい貫通孔(第2貫通孔)202cとしている。
【0064】
これらの構造において、バンプ電極材に金属への濡れ性の高い半田などを用いて、貫通孔の導電性部材が半田に濡れ性の高い金属を最表面に形成すると、特に良好な効果が得られる。
【0065】
このように、配線基板20での貫通孔20cとして、互いに開口面積が異なる貫通孔201c、202cを設ける構成によれば、導電性部材21に対して接続されるバンプ電極17の大きさや高さ等に応じて、それぞれの貫通孔20cでの開口面積を好適に設定することができる。これにより、バンプ電極17を、その大きさや高さ等の差異にかかわらず、対応する導電性部材21に確実に接続することができる。
【0066】
次に、図8〜図11を用いて、図1に示した半導体装置及び放射線検出器での配線基板に用いられるガラス基板、及びその製造方法について説明する。なお、ここでは、貫通孔を有するガラス基板の一般的な構成例及びその製造方法について示している。このため、以下に示すガラス基板は、図1に示した放射線検出器に用いられている配線基板とは異なる形状及び構成となっている。
【0067】
まず、図8(a)に示すように、コアガラス部63と、その周囲に設けられた被覆ガラス部65とを含む母材61を用意する。この母材61は、外径が例えば40〜45mm程度であり、コアガラス部63の外径は例えば28〜31mm程度である。コアガラス部63は酸溶解性ガラスからなり、被覆ガラス部65は鉛ガラス、ソーダ石灰ガラス、コバールガラス、パイレックスガラス等からなる。そして、図8(b)に示すように、上記母材61を線引きして、ファイバ状のガラス部材であるガラスファイバ67を作製する。ガラスファイバ67の外径は、例えば0.4mm程度である。
【0068】
次に、図8(c)に示すように、上記ガラスファイバ67を複数本束ねて所定の型69に整列する。ここでは、ガラスファイバ67の中心軸方向からみて、6角形状を呈した型69を用い、1万本程度のガラスファイバ67を型積みする。これにより、ガラスファイバ67は、図8(d)に示すように、その中心軸方向からみて6角形状となるように整列される。なお、ガラスファイバ67の中心軸方向からみて、3角形状あるいは4角形状を呈した型を用い、ガラスファイバ67を、その中心軸方向からみて3角形状あるいは4角形状となるように整列しても良い。
【0069】
続いて、図8(e)に示すように、整列した状態でガラスファイバ67の束を線引きして、マルチファイバ71を作製する。マルチファイバ71の外径は、例えば0.7mm程度である。
【0070】
次に、図9(a)に示すように、線引きしたマルチファイバ71を所定のガラス管73内に複数本整列して、納める。ガラス管73の内径は、100mm程度である。そして、図9(b)に示すように、ガラス管73内に納められたマルチファイバ71同士を加熱融着する。このとき、ガラス管73の一方の端部にこのガラス管より細いガラス管75を接続し、ロータリーポンプ等で排気して内部の圧力を低下させることによって、ガラス管73とその内部に納められたマルチファイバ71同士が加熱時に大気圧で隙間無く接触して融着できる。
【0071】
加熱温度は、例えば600度程度であり、内部の圧力は、0.5Pa程度である。なお、ガラス管73の他方の端部は封止されている。以上の工程により、ガラス管73内において複数のマルチファイバ71が融着された状態の束状のガラス部材77が形成される。
【0072】
続いて、ガラス管75、及び、封止していた部分を取り除く。その後、図10(a)に示すように、ガラス管73の外周を砥石79等により研磨して、束状のガラス部材77の整形(外径出し)を行う。この束状のガラス部材77の外径出しには、外周研磨機を用いることができる。
【0073】
そして、図10(b)に示すように、束状のガラス部材77を所望の厚みに切断する。このとき、束状のガラス部材77を、その中心軸に直交する軸lに沿ってスライサー81で切断することにより、図1に示した配線基板20のように、貫通孔が上面及び下面に対して垂直な軸を中心軸とする形状となるガラス基板が得られる。
【0074】
あるいは、図10(b)に示すように、中心軸に直交する軸lに対して所定角度θで斜めとなるように、束状のガラス部材77をスライサー81で切断しても良い。さらに、スライサー81によって切断されたガラス部材について、その切断面を研磨する。これらの工程により、図11(a)及び(b)に示すように、板状のガラス部材83が形成される。なお、ここでは、角度θで斜めとなるように切断した場合のガラス部材83を例として示している。
【0075】
続いて、図11(c)に示すように、板状のガラス部材83からコアガラス部63を除去(芯抜き)する。このとき、HNO3あるいはHClを用い、エッチング技術によりコアガラス部63を除去する。これにより、板状のガラス部材83を厚み方向に貫通する貫通孔84が複数形成されることとなり、貫通孔を有するガラス基板が形成される。
【0076】
図1に示した半導体装置5、及びそれを用いた放射線検出器における配線基板20としては、例えば、上記の製造方法によって得られたガラス基板での貫通孔に導電路となる導電性部材を形成したものを用いることができる。すなわち、このような構成のガラス基板において、その基板の形状及び貫通孔の個数、配置等を放射線検出器の構成に応じて設定する。そして、ガラス基板に設けられた貫通孔に導電路となる導電性部材を形成し、さらに、その各面にそれぞれ必要な電極及び配線からなる電気配線パターンを形成することにより、図3に示したような構成を有する配線基板が得られる。
【0077】
次に、図1に示した半導体装置、及び放射線検出器の製造方法について、その具体的な構成例とともに概略的に説明する。
【0078】
まず、上述したように複数のガラスファイバを束ねた束状のガラス部材を切断して形成されるとともに、所定のコアガラス部を除去することによって貫通孔が設けられたガラス基板を用意する。そして、その貫通孔に導電路となる導電性部材を形成し、さらに、入力面及び出力面となる両面にそれぞれ必要な電極及び配線を有する電気配線パターンを形成して、半導体装置5に用いられる配線基板20を作製する。
【0079】
図1に示した構成では、半導体装置5での配線基板について、ガラス基板に設けられた貫通孔20cに対して、導通部21c、入力部21a、及び出力部21bからなる導電性部材21を形成する。さらに、その出力面20b上に電極パッド22、24、及び配線23を形成して、配線基板20とする。
【0080】
ガラス基板に形成する上記した導電性部材及び電気配線パターンとしては、例えば、窒化チタン(TiN)、ニッケル(Ni)、アルミニウム(Al)、クロム(Cr)、銅(Cu)、銀(Ag)、金(Au)、あるいはそれらの合金からなる導電性金属層によって形成することができる。このような金属層は、単一の金属層であっても良く、複合膜あるいは積層膜であっても良い。また、その具体的な形成方法としては、蒸着、CVD、メッキ、スパッタなどの方法によって金属膜を形成でき、ホトリソグラフィーやエッチングプロセスによりガラス基板上に所望のパターニングをすることができる。あるいは、ガラス基板に対して所望パターンのマスクを設けてから前述の方法で金属層を形成しマスクを除去する方法もある。なお、必要があれば、配線基板20にさらにバンプ電極を形成する場合もある。
【0081】
配線基板20を作製した後、バンプ電極31が形成された信号処理素子30のICチップを、配線基板20の出力面20b上に設けられた電極パッド22に対してアライメントして、それらを物理的、電気的に接続する。また、バンプ電極17が形成されたPDアレイ15を、配線基板20の入力面20a上に設けられて電極パッドとして機能する導電性部材21の入力部21aに対してアライメントして、それらを物理的、電気的に接続する。
【0082】
バンプ電極31、17を形成するバンプ材料としては、例えば、ニッケル(Ni)、銅(Cu)、銀(Ag)、金(Au)、半田、導電性フィラーを含む樹脂、あるいはそれらの複合材料を用いたり、層構造にすることができる。また、バンプ電極と、その下の電極パッドとの間に、アンダーバンプメタル(UBM)を介在させても良い。
【0083】
続いて、バンプ電極44が形成されたハウジング40を、配線基板20の出力面20b上に設けられた電極パッド24に対してアライメントして、それらを物理的、電気的に接続する。以上により、ハウジング40に設けられたリード43を介した外部回路との信号の入出力動作が可能となる。さらに、PDアレイ15の光入射面15a上に、光学接着剤11を介してシンチレータ10を実装することにより、図1に示した放射線検出器が得られる。
【0084】
ここで、半導体装置5において半導体光検出素子アレイとして設けられているPDアレイ15については、フォトダイオードが光入射面(表面)15aに形成されている表面入射型のものを用いても良く、あるいは、フォトダイオードが信号出力面(裏面)15bに形成されている裏面入射型のものを用いても良い。また、光検出素子であるフォトダイオードの個数や配列等についても、適宜設定して良い。
【0085】
また、フォトダイオードからの検出信号を出力面15bから出力する構成については、PDアレイの具体的な構成に応じて、例えば、出力面15b上に形成された配線パターンによる構成や、PDアレイ15内に形成された貫通電極による構成などを用いることができる。
【0086】
また、図1に示した放射線検出器では、放射線検出部1の構成として、放射線の入射によりシンチレーション光を発生するシンチレータ10と、シンチレータ10からのシンチレーション光を検出する半導体光検出素子であるフォトダイオード16が設けられたPDアレイ15とを有する構成を用いている。このような構成は、入射されたX線などの放射線をシンチレータ10によって所定波長の光(例えば、可視光)に変換した後にSi−PDアレイなどの半導体光検出素子で検出する間接検出型の構成である。
【0087】
あるいは、放射線検出部として、シンチレータを設けず、入射された放射線を検出する半導体検出素子を有する構成を用いることも可能である。このような構成は、入射されたX線などの放射線をCdTeやCdZnTeなどからなる半導体検出素子で検出する直接検出型の構成である。あるいは、Siにおいても厚さを充分に厚くし全空乏させて用いたり、裏面から入射できるような構造にすることでも実現できる。これらは、例えば、図1の構成において、シンチレータ10を除くとともに、PDアレイ15を半導体検出素子アレイに置き換えた構成に相当する。この場合、半導体検出素子アレイと配線基板とによって、半導体装置が構成される。
【0088】
また、半導体素子及び配線基板からなる上記構成の半導体装置は、放射線検出器以外にも、様々な装置に対して適用可能である。この場合、半導体素子としては、半導体光検出素子や半導体検出素子以外の素子を用いて良い。また、配線基板、及び配線基板の信号入力面に接続された半導体素子に加えて、配線基板の信号出力面に信号処理素子を接続して、半導体素子と、半導体素子からの電気信号を処理する信号処理素子とが配線基板を介して一体とされた半導体装置としても良い。
【0089】
また、配線基板20と信号処理素子30との接続等については、上記実施形態のように、バンプ電極を介した電気的な接続によるダイレクトボンディング方式を用いることが好ましい。このような金属バンプ電極を電気的接続手段として用いることにより、各部を好適に電気的に接続することができる。
【0090】
また、図1に示した放射線検出器では、配線基板20の出力面20bに導電性部材21の出力部21bとは別に、信号処理素子30を接続するための電極パッド22を設けている。この電極パッドについては、導電性部材21の出力部21bをそのまま電極パッドとして用いる構成としても良い。
【0091】
あるいは、このようなバンプ電極を用いた構成以外にも、バンプ電極による接続後にアンダーフィル樹脂を充填する構成や、異方性導電性フィルム(ACF)方式、異方性導電性ペースト(ACP)方式、非導電性ペースト(NCP)方式による構成などを用いても良い。また、それぞれの基板については、必要に応じて、電極パッドを開口させた状態で絶縁性物質からなるパッシベーション膜を形成しても良い。
【0092】
【発明の効果】
本発明による半導体装置、及びそれを用いた放射線検出器は、以上詳細に説明したように、次のような効果を得る。すなわち、半導体素子を接続する配線基板として、複数本のガラスファイバから一体に形成され、その所定位置に入力面から出力面への貫通孔が設けられたガラス基板を用いるとともに、貫通孔及び導電性部材に対して半導体素子のバンプ電極を1対1対応させて、半導体素子と配線基板での導電路である導電性部材とを接続する構成によれば、半導体素子を配線基板上に実装する際に、導電性部材が設けられた貫通孔の内部にバンプ電極の一部が入り込む。これにより、半導体素子と配線基板での対応する導電路とがバンプ電極を介して良好に接続される半導体装置が実現される。
【0093】
また、このような構成の半導体装置を適用した放射線検出器によれば、半導体素子と配線基板での対応する導電性部材とが良好に接続されるので、放射線検出手段から信号処理手段への検出信号の伝達、及び信号処理手段における検出信号の処理を確実に行うことが可能な放射線検出器が実現される。
【図面の簡単な説明】
【図1】半導体装置、及びそれを用いた放射線検出器の一実施形態の断面構造を示す側面断面図である。
【図2】図1に示した放射線検出器の構成を分解して示す斜視図である。
【図3】配線基板の(a)信号入力面、及び(b)信号出力面の構成を示す平面図である。
【図4】配線基板の貫通孔、及び貫通孔に設けられる導電性部材の構成の一例を示す図である。
【図5】配線基板での貫通孔及び導電性部材の構成、及びそのバンプ電極との接続の一例について示す図である。
【図6】配線基板での貫通孔及び導電性部材の構成、及びそのバンプ電極との接続の他の例について示す図である。
【図7】配線基板での貫通孔及び導電性部材の構成、及びそのバンプ電極との接続の他の例について示す図である。
【図8】配線基板の製造方法の一例を示す図である。
【図9】配線基板の製造方法の一例を示す図である。
【図10】配線基板の製造方法の一例を示す図である。
【図11】配線基板の製造方法の一例を示す図である。
【符号の説明】
1…放射線検出部、10…シンチレータ、10a…放射線入射面、10b…光出射面、11…光学接着剤、15…フォトダイオードアレイ(半導体光検出素子アレイ)、15a…光入射面、15b…信号出力面、16…フォトダイオード、17…バンプ電極、
2…配線基板部、20…配線基板、20a…信号入力面、20b…信号出力面、20c…貫通孔、20d、20e…テーパ部、20f…凹部、21…導電性部材(導電路)、21a…入力部、21b…出力部、21c…導通部、22…電極パッド、23…配線、24…電極パッド、
3…信号処理部、30…信号処理素子、31…バンプ電極、40…ハウジング、41…素子収容部、42…支持部、43…リード、44…バンプ電極、5…半導体装置。

Claims (11)

  1. 電気信号を出力する半導体素子と、
    信号入力面及び信号出力面の間で前記電気信号を導く導電路が設けられ、前記信号入力面に前記半導体素子が接続された配線基板とを備え、
    前記配線基板は、コアガラス部及び前記コアガラス部の周囲に設けられた被覆ガラス部を含むファイバ状のガラス部材を束ねて形成された束状のガラス部材を所望の厚さに切断するとともに、前記コアガラス部を除去した貫通孔が設けられたガラス基板と、前記貫通孔に設けられ前記信号入力面及び前記信号出力面の間を電気的に導通して前記導電路として機能する導電性部材とを有して構成され、
    前記半導体素子、及び前記配線基板での対応する前記導電性部材は、前記導電性部材と1対1に対応して形成されたバンプ電極を介して電気的に接続されていることを特徴とする半導体装置。
  2. 前記導電性部材は、前記ガラス基板に設けられた前記貫通孔の内壁に形成されていることを特徴とする請求項1記載の半導体装置。
  3. 前記ガラス基板での前記貫通孔は、前記信号入力面における開口面積が、前記ガラス基板の内部の所定位置における開口面積よりも大きいように形成されていることを特徴とする請求項1または2記載の半導体装置。
  4. 前記ガラス基板での前記貫通孔は、前記信号入力面側の所定範囲が、前記信号入力面から前記ガラス基板の内部に向かって開口面積が順次小さくなるテーパ形状に形成されていることを特徴とする請求項3記載の半導体装置。
  5. 前記ガラス基板での前記貫通孔は、前記信号入力面側の所定範囲が、前記ガラス基板の内部の所定位置を含む範囲における開口面積よりも大きい所定の開口面積で凹形状に形成されていることを特徴とする請求項3記載の半導体装置。
  6. 前記ガラス基板は、前記貫通孔として、所定の開口面積の第1貫通孔と、前記第1貫通孔とは異なる開口面積の第2貫通孔とを少なくとも有することを特徴とする請求項1〜5のいずれか一項記載の半導体装置。
  7. 前記配線基板の前記信号出力面に接続され、前記半導体素子からの前記電気信号を処理する信号処理手段を備えることを特徴とする請求項1〜6のいずれか一項記載の半導体装置。
  8. 請求項7記載の半導体装置を含んで構成された放射線検出器であって、
    前記半導体素子を含み、入射した放射線を検出して前記電気信号を出力する放射線検出手段と、
    前記放射線検出手段からの前記電気信号を処理する前記信号処理手段と、
    前記配線基板を含み、前記放射線検出手段及び前記信号処理手段がそれぞれ前記信号入力面及び前記信号出力面に接続された配線基板部とを備えることを特徴とする放射線検出器。
  9. 前記ガラス基板は、放射線遮蔽機能を有する所定のガラス材料から形成されていることを特徴とする請求項8記載の放射線検出器。
  10. 前記放射線検出手段は、放射線の入射によりシンチレーション光を発生するシンチレータと、前記シンチレータからの前記シンチレーション光を検出する前記半導体素子とを有することを特徴とする請求項8または9記載の放射線検出器。
  11. 前記放射線検出手段は、入射された放射線を検出する前記半導体素子を有することを特徴とする請求項8または9記載の放射線検出器。
JP2003046141A 2003-01-08 2003-02-24 半導体装置、及びそれを用いた放射線検出器 Expired - Fee Related JP4138529B2 (ja)

Priority Applications (11)

Application Number Priority Date Filing Date Title
JP2003046141A JP4138529B2 (ja) 2003-02-24 2003-02-24 半導体装置、及びそれを用いた放射線検出器
TW093100398A TWI307557B (en) 2003-01-08 2004-01-08 Distribution substrate and radiation-ray detector using the same
TW093100397A TWI307556B (en) 2003-01-08 2004-01-08 Distribution substrate and radiating ray detector using the same
US10/546,601 US7545044B2 (en) 2003-02-24 2004-02-24 Semiconductor device and radiation detector employing it
KR1020057015706A KR100997035B1 (ko) 2003-02-24 2004-02-24 반도체 장치 및 이를 이용한 방사선 검출기
DE602004020452T DE602004020452D1 (de) 2003-02-24 2004-02-24 Halbleiterbauelement und strahlungsdetektor damit
TW093104573A TW200428546A (en) 2003-02-24 2004-02-24 Semiconductor device and radiation ray detecting device using the same
EP04714020A EP1598862B1 (en) 2003-02-24 2004-02-24 Semiconductor device and radiation detector employing it
CNB2004800050039A CN100383942C (zh) 2003-02-24 2004-02-24 半导体装置及使用其的放射线检测器
PCT/JP2004/002132 WO2004075281A1 (ja) 2003-02-24 2004-02-24 半導体装置、及びそれを用いた放射線検出器
IL170456A IL170456A (en) 2003-02-24 2005-08-23 Semiconductor device and radiation detector using the same

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2003046141A JP4138529B2 (ja) 2003-02-24 2003-02-24 半導体装置、及びそれを用いた放射線検出器

Publications (2)

Publication Number Publication Date
JP2004265948A JP2004265948A (ja) 2004-09-24
JP4138529B2 true JP4138529B2 (ja) 2008-08-27

Family

ID=32905541

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2003046141A Expired - Fee Related JP4138529B2 (ja) 2003-01-08 2003-02-24 半導体装置、及びそれを用いた放射線検出器

Country Status (9)

Country Link
US (1) US7545044B2 (ja)
EP (1) EP1598862B1 (ja)
JP (1) JP4138529B2 (ja)
KR (1) KR100997035B1 (ja)
CN (1) CN100383942C (ja)
DE (1) DE602004020452D1 (ja)
IL (1) IL170456A (ja)
TW (1) TW200428546A (ja)
WO (1) WO2004075281A1 (ja)

Families Citing this family (27)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6180426B1 (en) 1999-03-01 2001-01-30 Mou-Shiung Lin High performance sub-system design and assembly
TWI313507B (en) 2002-10-25 2009-08-11 Megica Corporatio Method for assembling chips
TW584950B (en) 2001-12-31 2004-04-21 Megic Corp Chip packaging structure and process thereof
US6673698B1 (en) 2002-01-19 2004-01-06 Megic Corporation Thin film semiconductor package utilizing a glass substrate with composite polymer/metal interconnect layers
TW544882B (en) 2001-12-31 2003-08-01 Megic Corp Chip package structure and process thereof
TW503496B (en) 2001-12-31 2002-09-21 Megic Corp Chip packaging structure and manufacturing process of the same
JP4133429B2 (ja) 2003-02-24 2008-08-13 浜松ホトニクス株式会社 半導体装置
JP4364514B2 (ja) * 2003-01-08 2009-11-18 浜松ホトニクス株式会社 配線基板、及びそれを用いた放射線検出器
JP4379295B2 (ja) 2004-10-26 2009-12-09 ソニー株式会社 半導体イメージセンサー・モジュール及びその製造方法
TWI269420B (en) 2005-05-03 2006-12-21 Megica Corp Stacked chip package and process thereof
JP4916241B2 (ja) * 2006-07-28 2012-04-11 パナソニック株式会社 半導体装置及びその製造方法
SG166773A1 (en) * 2007-04-24 2010-12-29 United Test & Assembly Ct Lt Bump on via-packaging and methodologies
JP5032276B2 (ja) * 2007-11-19 2012-09-26 株式会社東芝 放射線検出装置
WO2010058503A1 (ja) * 2008-11-21 2010-05-27 パナソニック株式会社 半導体装置およびその製造方法
US20190157218A1 (en) * 2010-07-02 2019-05-23 Schott Ag Interposer and method for producing holes in an interposer
DE102010025966B4 (de) * 2010-07-02 2012-03-08 Schott Ag Interposer und Verfahren zum Herstellen von Löchern in einem Interposer
FR2970598B1 (fr) * 2011-01-17 2013-08-16 Commissariat Energie Atomique Dispositif imageur a grande gamme dynamique
US20150268739A1 (en) * 2014-03-21 2015-09-24 Dell Products L.P. Projected Information Handling System Input Environment with Object Initiated Responses
JP6528376B2 (ja) * 2014-08-27 2019-06-12 富士通株式会社 撮像装置及びその製造方法
JP6478538B2 (ja) * 2014-09-10 2019-03-06 キヤノン株式会社 放射線撮像装置および放射線撮像システム
US9997554B2 (en) * 2014-12-24 2018-06-12 Stmicroelectronics Pte Ltd Chip scale package camera module with glass interposer having lateral conductive traces between a first and second glass layer and method for making the same
US9871073B1 (en) * 2016-11-22 2018-01-16 General Electric Company Scintillator sealing for solid state X-ray detector
TWI785052B (zh) 2017-06-01 2022-12-01 美商康寧公司 包括穿透孔洞貫孔的組件基板及其製作方法
CN110914993B (zh) 2017-07-25 2023-08-15 索尼半导体解决方案公司 固态摄像装置
CN110959017B (zh) * 2017-08-04 2022-02-18 巴塞尔聚烯烃意大利有限公司 具有高熔体流动速率的丁烯-1聚合物组合物
JP6747487B2 (ja) * 2018-10-26 2020-08-26 大日本印刷株式会社 放射線検出装置
JP7207192B2 (ja) * 2019-06-19 2023-01-18 Tdk株式会社 センサー用パッケージ基板及びこれを備えるセンサーモジュール、並びに、センサー用パッケージ基板の製造方法

Family Cites Families (28)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4153988A (en) * 1977-07-15 1979-05-15 International Business Machines Corporation High performance integrated circuit semiconductor package and method of making
JP2555720B2 (ja) 1988-12-19 1996-11-20 富士通株式会社 半田バンプ部品の実装方法
JPH0351477U (ja) * 1989-09-26 1991-05-20
JPH03203341A (ja) 1989-12-29 1991-09-05 Hoya Corp 微小電極を有する基板およびその製造方法
JP2828116B2 (ja) * 1990-05-30 1998-11-25 オリンパス光学工業株式会社 固体撮像装置
US5699610A (en) * 1994-04-22 1997-12-23 Nec Corporation Process for connecting electronic devices
JPH07333348A (ja) 1994-06-03 1995-12-22 Toshiba Corp 放射線検出器およびこれを用いたx線ct装置
JPH08330469A (ja) 1995-05-30 1996-12-13 Hitachi Ltd 半導体装置用配線基板およびその製造方法
JPH0945805A (ja) * 1995-07-31 1997-02-14 Fujitsu Ltd 配線基板、半導体装置及び半導体装置を配線基板から取り外す方法並びに半導体装置の製造方法
JPH10275984A (ja) * 1997-03-28 1998-10-13 Ibiden Co Ltd 多層プリント配線板
JPH11121648A (ja) * 1997-10-20 1999-04-30 Fuji Xerox Co Ltd 電子部品実装体およびこれを構成する基板
US6114240A (en) * 1997-12-18 2000-09-05 Micron Technology, Inc. Method for fabricating semiconductor components using focused laser beam
US5962922A (en) * 1998-03-18 1999-10-05 Wang; Bily Cavity grid array integrated circuit package
EP1148349A4 (en) * 1998-12-14 2003-07-09 Hamamatsu Photonics Kk OPTICAL ELEMENT AND RADIATION DETECTOR APPLYING THE SAME
JP2001007468A (ja) * 1999-06-24 2001-01-12 Nec Kansai Ltd 配線基板,多層配線基板およびその製造方法
US6625036B1 (en) * 1999-08-31 2003-09-23 Rohm Co., Ltd. Infrared data communication module and method of making the same
JP2001099941A (ja) * 1999-09-30 2001-04-13 Hitachi Metals Ltd 放射線遮蔽板、放射線検出器及び放射線遮蔽板の製造方法
US6396898B1 (en) * 1999-12-24 2002-05-28 Kabushiki Kaisha Toshiba Radiation detector and x-ray CT apparatus
GB2364791B (en) * 2000-07-14 2004-12-29 Evan Arkas Optical channel plates
US6800857B2 (en) * 2000-08-10 2004-10-05 Canon Kabushiki Kaisha Large-area fiber plate, radiation image pickup apparatus utilizing the same and producing method therefor
JP3785032B2 (ja) * 2000-08-22 2006-06-14 日本特殊陶業株式会社 プリント配線基板におけるスルーホール構造及びその製造方法
JP4092890B2 (ja) * 2001-05-31 2008-05-28 株式会社日立製作所 マルチチップモジュール
TWI224382B (en) * 2001-07-12 2004-11-21 Hitachi Ltd Wiring glass substrate and manufacturing method thereof, conductive paste and semiconductor module used for the same, and conductor forming method
US6510195B1 (en) 2001-07-18 2003-01-21 Koninklijke Philips Electronics, N.V. Solid state x-radiation detector modules and mosaics thereof, and an imaging method and apparatus employing the same
JP4237966B2 (ja) * 2002-03-08 2009-03-11 浜松ホトニクス株式会社 検出器
JP4365108B2 (ja) * 2003-01-08 2009-11-18 浜松ホトニクス株式会社 配線基板、及びそれを用いた放射線検出器
JP4364514B2 (ja) * 2003-01-08 2009-11-18 浜松ホトニクス株式会社 配線基板、及びそれを用いた放射線検出器
JP4133429B2 (ja) * 2003-02-24 2008-08-13 浜松ホトニクス株式会社 半導体装置

Also Published As

Publication number Publication date
CN1754254A (zh) 2006-03-29
US7545044B2 (en) 2009-06-09
KR20050105241A (ko) 2005-11-03
IL170456A (en) 2010-05-17
WO2004075281A1 (ja) 2004-09-02
EP1598862A1 (en) 2005-11-23
CN100383942C (zh) 2008-04-23
US20070029670A1 (en) 2007-02-08
DE602004020452D1 (de) 2009-05-20
KR100997035B1 (ko) 2010-11-26
TW200428546A (en) 2004-12-16
EP1598862B1 (en) 2009-04-08
JP2004265948A (ja) 2004-09-24
EP1598862A4 (en) 2006-12-06

Similar Documents

Publication Publication Date Title
JP4138529B2 (ja) 半導体装置、及びそれを用いた放射線検出器
JP4133429B2 (ja) 半導体装置
US7507971B2 (en) Radioactive ray detector
JP4365108B2 (ja) 配線基板、及びそれを用いた放射線検出器
IL170458A (en) A semiconductor device and a radiation detector that uses it
JP4364514B2 (ja) 配線基板、及びそれを用いた放射線検出器
JP4855439B2 (ja) 放射線検出器
JP2008235929A (ja) 半導体装置

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20051202

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20080603

A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20080605

R150 Certificate of patent or registration of utility model

Free format text: JAPANESE INTERMEDIATE CODE: R150

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20110613

Year of fee payment: 3

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20120613

Year of fee payment: 4

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20120613

Year of fee payment: 4

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20130613

Year of fee payment: 5

LAPS Cancellation because of no payment of annual fees