CN109634883A - 主从式系统、指令执行方法与数据存取方法 - Google Patents

主从式系统、指令执行方法与数据存取方法 Download PDF

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Abstract

本发明提供一种主从式系统、指令执行方法与数据存取方法。主从式系统包括主装置以及从装置。主装置提供第一指令以及时脉信号至从装置。从装置根据第一指令与时脉信号，执行对应于第一指令的第一操作。当对应于第一指令的第一操作完成时，从装置根据时脉信号产生回应信号以通知主装置关于对应于第一指令的第一操作的执行结果。

Description

主从式系统、指令执行方法与数据存取方法
技术领域
本发明涉及一种主从式系统、指令执行方法与数据存取方法，尤其涉及一种串列周边接口(Serial Peripheral Interface，SPI)的主从式系统、指令执行方法与数据存取方法。
背景技术
传统图像传感器大多使用I2C(Inter-Integrated Circuit)接口作为系统与传感器之间的沟通桥梁，以并列(parallel)接口传输数据。然而，I2C接口速度慢，并列接口接脚数目多。一般来说，采用串列周边接口(Serial Peripheral Interface，SPI)取代上述两者接口，可以在特定的应用上解决上述速度慢以及接脚数目过多的缺点。利用SPI接口的特性，可以将图像传感器内部的部分数字电路做更有效率或更省芯片面积的设计。
发明内容
本发明提供一种主从式系统、指令执行方法与数据存取方法。通过本发明的主从式装置，可以让从装置直接根据由主装置传送的时脉信号来执行对应的操作，进而省去(或减少)从装置中用于产生时脉信号的电路，并且节省运算码(Operation Code，OP code)的定义。
本发明提出一种主从式系统，所述主从式系统包括具有第一接口的主装置以及具有第二接口的从装置。所述第二接口电性连接至所述第一接口。所述主装置提供第一指令以及时脉信号至所述从装置。所述从装置根据所述第一指令与所述时脉信号，执行对应于所述第一指令的第一操作。当对应于所述第一指令的所述第一操作完成时，所述从装置根据所述时脉信号产生回应信号以通知所述主装置关于对应于所述第一指令的所述第一操作的执行结果。
本发明提出一种指令执行方法，用于主从式系统，所述主从式系统包括具有第一接口的主装置以及具有第二接口的从装置，所述第二接口电性连接至所述第一接口，所述方法包括：通过所述主装置提供第一指令以及时脉信号至所述从装置；通过所述从装置根据所述第一指令与所述时脉信号，执行对应于所述第一指令的第一操作；以及当对应于所述第一指令的所述第一操作完成时，通过所述从装置根据所述时脉信号产生回应信号以通知所述主装置关于对应于所述第一指令的所述第一操作的执行结果。
本发明提出一种主从式系统，所述主从式系统包括具有第一接口的主装置以及具有第二接口的从装置。所述第二接口电性连接至所述第一接口。所述主装置提供第一运算码(operation code，OP code)、第一地址以及时脉信号至所述从装置。所述从装置执行第一存取操作以根据所述第一运算码、所述第一地址以及所述时脉信号存取对应于所述第一地址的第一数据。当所述从装置结束存取对应于所述第一地址的所述第一数据且于所述主装置结束对应于所述第一运算码的操作前所述从装置未再接收到所述时脉信号时，所述从装置结束执行所述第一存取操作。当所述从装置结束存取对应于所述第一地址的所述第一数据且所述从装置持续地接收到所述时脉信号时，所述从装置根据所述时脉信号存取对应于第二地址的第二数据，其中所述第二地址是相邻于所述第一地址。
本发明提出一种数据存取方法，用于主从式系统，所述主从式系统包括具有第一接口的主装置以及具有第二接口的从装置，所述第二接口电性连接至所述第一接口，所述方法包括：通过所述主装置提供第一运算码(operation code，OP code)、第一地址以及时脉信号至所述从装置；通过所述从装置执行第一存取操作以根据所述第一运算码、所述第一地址以及所述时脉信号存取对应于所述第一地址的第一数据；当所述从装置结束存取对应于所述第一地址的所述第一数据且于所述主装置结束对应于所述第一运算码的操作前所述从装置未再接收到所述时脉信号时，通过所述从装置结束执行所述第一存取操作；以及当所述从装置结束存取对应于所述第一地址的所述第一数据且所述从装置持续地接收到所述时脉信号时，通过所述从装置根据所述时脉信号存取对应于第二地址的第二数据，其中所述第二地址是相邻于所述第一地址。
基于上述，本发明的主从式系统、指令执行方法与数据存取方法可以让从装置直接根据由主装置传送的时脉信号来执行对应的操作，进而省去(或减少)从装置中用于产生时脉信号的电路。此外，在本发明的主从式系统、指令执行方法与数据存取方法中，当主装置与从装置彼此之间欲使用多数据爆发式传输模式(burst-mode)来传输多个连续地址的数据时，可以使用与单一数据传输模式(single-shot)相同的运算码(operation code，OPcode)，藉此达到以相同的运算码来支援单一数据传输模式与多数据爆发式传输模式，进而节省OP code的定义及有限状态机(finite state-machine)的状态数。
为让本发明的上述特征和优点能更明显易懂，下文特举实施例，并配合附图作详细说明如下。
附图说明
图1是依照本发明的一实施例所示出的主从式系统的示意图。
图2是依照本发明的一实施例所示出的主装置与从装置数据传输的信号状态的示意图。
图3是依照本发明的一实施例所示出的指令执行方法的流程图。
图4A至图4C是依照本发明的一实施例所示出的写入数据的示意图。
图5A至图5C是依照本发明的一实施例所示出的读取数据的示意图。
图6是依照本发明的一实施例所示出的数据存取方法的流程图。
附图标记说明
1000：主从式系统
10：主装置10
200：从装置
10、20：接口
SS、SCLK、MOSI、MISO：接脚
C1～C15：时脉周期组
cmd1、cmd2：指令
RS1、RS2：回应信号
S301：主装置提供选择信号至从装置以选择从装置的步骤
S303：主装置提供第一指令以及时脉信号至从装置的步骤
S305：从装置根据第一指令与时脉信号，执行对应于第一指令的第一操作的步骤
S307：当对应于第一指令的第一操作完成时，从装置根据时脉信号产生回应信号以通知主装置关于对应第一指令的第一操作的执行结果的步骤
0x10、0x11、0x12、0x13：运算码
addr_0～addr_10：地址
D1～D15：数据
S601：主装置提供选择信号至从装置以选择从装置的步骤
S603：主装置提供第一运算码、第一地址以及时脉信号至从装置的步骤
S605：从装置执行第一存取操作以根据第一运算码、第一地址以及时脉信号存取对应于第一地址的第一数据的步骤
S607：从装置结束存取对应于第一地址的第一数据的步骤
S609：从装置判断是否持续接收到时脉信号的步骤
S611：从装置结束执行第一存取操作的步骤
S613：从装置根据时脉信号存取对应于第二地址的第二数据，其中第二地址是相邻于第一地址的步骤
具体实施方式
现将详细参考本发明的示范性实施例，在附图中说明所述示范性实施例的实例。另外，凡可能之处，在附图及实施方式中使用相同标号的元件/构件代表相同或类似部分。
图1是依照本发明的一实施例所示出的主从式系统的示意图。
请参照图1，主从式系统1000包括主装置100以及从装置200。主装置100以及从装置200例如可以分别包括处理单元(未示出)以及存储单元(未示出)。在主装置100以及从装置200中，存储单元可以耦接至处理单元。其中，主装置100以及从装置200例如是手机、平板电脑、笔记本电脑等电子装置，在此不设限。此外，在其他实施例中，主装置100以及从装置200也可以包括其他更多的元件。特别是，在其他实施例中，主装置100以及从装置200也可以被配置在同一个装置中。需说明的是，虽然图1仅示出一个主装置100连接至一个从装置200，但本发明不限于此。在其他实施例中，一个主装置100可以连接至多个从装置200。
处理单元可以是中央处理单元(Central Processing Unit，CPU)，或是其他可程序化的一般用途或特殊用途的微处理器(Microprocessor)、数字信号处理器(DigitalSignal Processor，DSP)、可程序化控制器、特殊应用集成电路(Application SpecificIntegrated Circuit，ASIC)或其他类似元件或上述元件的组合。
存储单元可以是任何型态的固定或可移动随机存取存储器(random accessmemory，RAM)、只读存储器(read-only memory，ROM)、快闪存储器(flash memory)或类似元件或上述元件的组合。
特别是，在本范例实施例中，主装置100具有接口10(也称为，第一接口)，从装置200具有接口20(也称为，第二接口)。其中，第一接口与第二接口彼此电性连接(也称为，耦接)使得主装置100可以与从装置200进行数据的传输。在本范例实施例中，接口10与接口20分别是串列周边接口(Serial Peripheral Interface，SPI)。其中，一个串列周边接口会具有从选择(Select Slave，SS)接脚、串列时脉(Serial Clock，SCLK)接脚、主输出从输入(Master Output Slave Input，MOSI)接脚以及主输入从输出(Master Input SlaveOutput，MISO)接脚。而当接口10电性连接接口20时，主装置100的SS接脚会电性连接至从装置200的SS接脚，主装置100的SCLK接脚会电性连接至从装置200的SCLK接脚，主装置100的MOSI接脚会电性连接至从装置200的MOSI接脚，且主装置100的MISO接脚会电性连接至从装置200的MISO接脚。
在本范例实施例中，主装置100的存储单元中存储有多个程序码片段，在上述程序码片段被安装后，会由主装置100的处理单元来执行。例如，主装置100的存储单元中包括多个模块，通过这些模块来分别执行主从式系统1000的各个运作，其中各模块是由一或多个程序码片段所组成。然而本发明不限于此，上述的各个运作也可以是使用其他硬件形式的方式来实现。此外，主装置100的处理单元也可以用于控制主装置100与从装置200之间数据的传输。
以下以多个实施例来描述主装置100与从装置200彼此之间的运作方式。
[第一实施例]
图2是依照本发明的一实施例所示出的主装置与从装置数据传输的信号状态的示意图。
请参照图2，在本范例实施例中，假设主装置100要与从装置200进行数据的传输。首先，主装置100会通过SS接脚提供一选择信号至从装置200以选择欲进行数据传输的从装置200。如图1所示，所述选择信号例如是将原本SS接脚中处于高电位的信号调整为低电位的信号，藉此让从装置200得知其已被主装置100所选择。
此外，在本范例实施例中，主装置100会通过SCLK接脚来提供时脉信号给从装置200。也就是说，从装置200可以直接使用主装置100所提供的时脉信号来执行相关的操作，进而省去(或减少)从装置200中用于产生时脉信号的电路(例如，锁相回路(Phase-LockedLoops，PLL)或震荡器(Oscillator))。在此需说明的是，在本实施例中，主装置100与从装置200是以一字节(byte)作为数据传输的基本单位，且时脉信号中的每一个时脉周期(clockcycle)仅传输一比特(bit)。在图2的实施例中，主装置100会通过SCLK接脚来提供时脉信号给从装置200，而时脉信号中可以包括时脉周期组C1～C15以及更多的时脉周期组。特别是，每一个时脉周期组是包括八个时脉周期。也就是说，一个时脉周期组可以用于传输一字节的数据。
在此需说明的是，一般的数字电路中会使用先进先出(First In First Out，FIFO)寄存器来作为数据传输的暂存区。然而在本实施例中，主装置100与从装置200每次沟通都至少会花费8个时脉周期。由于在此期间不会有一个以上的数据被存取，因此从装置200可以不必暂存太多的数据。换句话说，在接收一个字节的数据(在此称为，第一字节数据)时，由于下一个字节的数据(在此称为，第二字节数据)尚未传输至从装置200，故可以省去暂存前述第二字节数据的空间，并且在第一字节数据传输完毕且从FIFO寄存器取出后，再接收前述的第二字节数据并且使用FIFO寄存器来暂存前述的第二字节数据。利用前述的特性，可以节省FIFO寄存器的深度(即，容量)。
在本范例实施例中，主装置100可以在时脉周期组C1的时间内通过MOSI接脚下达(或提供)指令cmd1(也称为，第一指令)至从装置200。之后，从装置200会根据指令cmd1与时脉信号中的时脉周期组C2～C4，执行指令cmd1的操作(也称为，第一操作)。在本范例实施例中，第一操作例如是从装置200根据指令cmd1读取出对应的数据，并且将所读取出的数据通过MISO接脚提供给主装置100。然而需注意的是，本发明并不用于限定前述第一操作的内容。
当第一操作完成时，从装置200会根据主装置100提供的时脉信号中的时脉周期组C5～C6产生回应信号RS1以通知主装置100关于对应于指令cmd1的第一操作的执行结果。例如，在回应信号RS1中，在时脉周期组C5中提供的信号为确认(ack)信号，而在时脉周期组C6中提供的信号为通知主装置100关于指令cmd1执行成功或执行失败的信号。
之后，主装置100例如可以在时脉周期组C7的时候感测到回应信号RS1并且在时脉周期组C8时下达另一个指令cmd2。
例如，主装置100可以在时脉周期组C8～C9的时间内通过MOSI接脚下达(或提供)指令cmd2至从装置200。之后，从装置200会根据指令cmd2与时脉信号中的时脉周期组C9～C10，执行指令cmd2的操作。然而需注意的是，本发明并不用于限定前述指令cmd2的操作为何。
当指令cmd2的操作完成时，从装置200会根据主装置100提供的时脉信号中的时脉周期组C11～C13产生回应信号RS2以通知主装置100关于对应于指令cmd2的操作的执行结果。
需注意的是，在本范例实施例中，主装置100与从装置200会对于多个不同指令，定义每一个指令所需花费的时脉周期的数量。更详细来说，以前述的指令cmd1为例，如图2所示，主装置100与从装置200会预先定义主装置100在提供指令cmd1至从装置200时所需的时脉周期(也称为，第一时脉周期)的数量(例如，8个时脉周期(即，1个时脉周期组))、从装置200在执行对应于指令cmd1的第一操作时所需的时脉周期(也称为，第二时脉周期)的数量(例如，24个时脉周期(即，3个时脉周期组))、从装置200产生回应信号RS1时所需的时脉周期(也称为，第三时脉周期)的数量(例如，16个时脉周期(即，2个时脉周期组))以及主装置100接收到回应信号RS1后所需花费的时脉周期的数量。
再例如，以图2中的指令cmd2为例，如图2所示，主装置100与从装置200会预先定义主装置100在提供指令cmd2至从装置200时所需的时脉周期的数量(例如，16个时脉周期(即，2个时脉周期组))、从装置200在执行对应于指令cmd1的操作时所需的时脉周期的数量(例如，16个时脉周期(即，2个时脉周期组))、从装置200产生回应信号RS2时所需的时脉周期的数量(例如，24个时脉周期(即，3个时脉周期组))以及主装置100接收到回应信号RS2后所需花费的时脉周期的数量。
特别是，通过定义每一个指令所需花费的时脉周期的数量，可以让主装置100得知需提供具有多少数量的时脉周期的时脉信号给从装置200。由于从装置200可以直接根据由主装置100传送的时脉信号来执行对应的操作，从装置200可以省去(或减少)用于产生时脉信号的电路。
图3是依照本发明的一实施例所示出的指令执行方法的流程图。
请参照图3，在步骤S301中，主装置100提供选择信号至从装置200以选择从装置200。在步骤S303中，主装置100提供第一指令以及时脉信号至从装置200。在步骤S305中，从装置200根据第一指令与时脉信号，执行对应于第一指令的第一操作。当对应于第一指令的第一操作完成时，在步骤S307中，从装置200根据时脉信号产生回应信号以通知主装置100关于对应第一指令的第一操作的执行结果。
基于上述，本发明第一实施例的主从式系统与指令执行方法可以让从装置直接根据由主装置传送的时脉信号来执行对应的操作，进而省去(或减少)从装置中用于产生时脉信号的电路。
[第二实施例]
对于数据传输指令(包括存储器或寄存器存取)，传统上不同的指令类型，主装置会先传输不同的运算码(Operation Code，OP code)来沟通，如单一数据传输(single-shot)或多数据爆发式传输(burst-mode)会以不同的OP code来表示。
然而，在本发明的第二实施例中，当主装置100与从装置200彼此之间欲使用多数据爆发式传输模式(burst-mode)来传输多个连续地址的数据时，可以使用与单一数据传输模式(single-shot)相同的运算码(operation code，OP code)，藉此达到以相同的运算码来支援单一数据传输模式与多数据爆发式传输模式，进而节省OP code的定义及有限状态机(finite state-machine)的状态数。
详细来说，图4A至图4C是依照本发明的一实施例所示出的写入数据的示意图。请参照图4A，在本实施例中，假设主装置100要与从装置200进行数据的传输。首先，主装置100会通过SS接脚提供一选择信号至从装置200以选择欲进行数据传输的从装置200。如图4A所示，所述选择信号例如是将原本SS接脚中处于高电位的信号调整为低电位的信号，藉此让从装置200得知其已被主装置100所选择。
此外，在本范例实施例中，主装置100会通过SCLK接脚来提供时脉信号给从装置200。在此需说明的是，类似于第一实施例，在本实施例中，主装置100与从装置200是以一字节(byte)作为数据传输的基本单位，且时脉信号中的每一个时脉周期(clock cycle)仅传输一比特(bit)。在图4A至图4C的实施例中，主装置100会通过SCLK接脚来提供时脉信号给从装置200，而时脉信号中可以包括多个时脉周期组。特别是，每一个时脉周期组是包括八个时脉周期。也就是说，一个时脉周期组可以用于传输一字节的数据。
此外，主装置100还会通过MOSI接脚提供运算码(例如，0x11)(也称为，第一运算码)、地址addr_0(也称为，第一地址)以及一时脉信号至所述从装置200。从装置200会执行写入操作(也称为，第一写入操作)以根据第一运算码、地址addr_0以及主装置100提供的时脉信号将主装置100提供的数据D1(也称为，第一数据)写入至从装置200的地址addr_0中。
特别是，当从装置200结束写入数据D1至地址addr_0后，于主装置100结束对应于第一运算码(即，0x11)的操作前且从装置200在选择信号结束(即，选择信号从低电位被调整回高电位)前未再接收到时脉信号时，如图4A所示，从装置200会结束执行第一写入操作。换句话说，在图4A的实施例中，主装置100是用于写入一笔数据至从装置200中的一地址。
然而，当从装置200结束写入数据D1至地址addr_0中且从装置200在选择信号结束(即，选择信号从低电位被调整回高电位)前持续地接收到时脉信号时，如图4B所示，从装置200可以根据时脉信号再从主装置100取得更多的数据(例如，数据D2～D4，也称为第二数据)，并且将所取得的第二数据依序写入至与地址addr_0相邻的地址。例如，从装置200会将数据D2写入至地址addr_0的下一个地址，将数据D3写入至位于地址addr_0之后的第二个地址，以及将数据D4写入至位于地址addr_0之后的第三个地址。
换句话说，图4B的实施例是对于欲存储在多个连续地址的多笔数据的写入，且图4B中所使用的运算码可以相同于图4A的实施例中对于单笔数据的写入所使用的运算码。而从装置200可以根据于选择信号的有效期间(即，选择信号处于低电位的期间)是否持续接收到时脉信号来判断是否执行多个连续地址的写入。
此外，在另一实施例中，如图4C所示，当主装置100欲写入多笔数据(也称为，第三数据)至从装置200中多个不连续的地址(也称为，第三地址)时，主装置100例如可以通过MOSI接脚提供另一运算码(例如，0x13)(也称为，第二运算码)、多个第三地址(即，地址addr_1、地址addr_2以及地址addr_3)以及前述的时脉信号至从装置200。从装置200会根据前述的第二运算码执行第二写入操作以根据第二运算码、前述的多个第三地址以及前述的时脉信号将第三数据(即，数据D5～D7)分别写入主装置100所指定的第三地址(即，地址addr_1、地址addr_2以及地址addr_3)中。如图4C所示，从装置200会将数据D5写入至地址addr_1、将数据D6写入至地址addr_2以及将数据D7写入至地址addr_3。
此外，图5A至图5C是依照本发明的一实施例所示出的读取数据的示意图。请参照图5A，在本实施例中，假设主装置100要与从装置200进行数据的传输。首先，主装置100会通过SS接脚提供一选择信号至从装置200以选择欲进行数据传输的从装置200。如图5A所示，所述选择信号例如是将原本SS接脚中处于高电位的信号调整为低电位的信号，藉此让从装置200得知其已被主装置100所选择。
此外，在本范例实施例中，主装置100会通过SCLK接脚来提供时脉信号给从装置200。在此需说明的是，类似于第一实施例，在本实施例中，主装置100与从装置200是以一字节(byte)作为数据传输的基本单位，且时脉信号中的每一个时脉周期(clock cycle)仅传输一比特(bit)。在图5A至图5C的实施例中，主装置100会通过SCLK接脚来提供时脉信号给从装置200，而时脉信号中可以包括多个时脉周期组。特别是，每一个时脉周期组是包括八个时脉周期。也就是说，一个时脉周期组可以用于传输一字节的数据。
此外，主装置100还会通过MOSI接脚提供运算码(例如，0x10)(也称为，第一运算码)、地址addr_4(也称为，第一地址)以及时脉信号至从装置200。从装置200会根据第一运算码执行读取操作(也称为，第一读取操作)以根据第一运算码、地址addr_4自从装置200的地址addr_4中读取出数据D8(也称为，第一数据)并通过MISO接脚将数据D8传输给主装置100。
特别是，当从装置200结束从地址addr_4读取数据D8后，于主装置100结束对应于第一运算码(即，0x10)的操作前且从装置200在选择信号结束(即，选择信号从低电位被调整回高电位)前未再接收到时脉信号时，如图5A所示，从装置200会结束执行第一读取操作。换句话说，在图5A的实施例中，主装置100是用于自从装置200中的一地址读取一笔数据。
然而，当从装置200结束从地址addr_4中读取数据D8且从装置200在选择信号结束(即，选择信号从低电位被调整回高电位)前持续地接收到时脉信号时，如图5B所示，从装置200可以根据时脉信号再从从装置200中读取更多的数据(例如，数据D9～D11，也称为第二数据)，并且将所读取出的第二数据传送给主装置100。
换句话说，图5B的实施例是对于存储在多个连续地址的多笔数据进行读取，且图5B中所使用的运算码可以相同于图5A的实施例中对于单笔数据的读取所使用的运算码。而从装置200可以根据是否于选择信号的有效期间(即，选择信号处于低电位的期间)内持续接收到时脉信号来判断是否执行多个连续地址的读取。
此外，在另一实施例中，如图5C所示，当主装置100欲自从装置200中多个不连续的地址(也称为，第三地址)读取多笔数据(也称为，第三数据)时，主装置100例如可以通过MOSI接脚提供另一运算码(例如，0x12)(也称为，第二运算码)、多个第三地址(即，地址addr_5～地址addr_10)以及前述的时脉信号至从装置200。从装置200会根据前述的第二运算码执行第二读取操作以根据第二运算码、前述的多个第三地址以及前述的时脉信号自从装置200的第三地址(即，地址addr_5～地址addr_10)中读取出第三数据(即，数据D12～D15)并将所读取出的第三数据通过MISO接脚传送给主装置100。如图5C所示，从装置200会自地址addr_5读取出数据D12并传送给主装置100、自地址addr_6读取出数据D13并传送给主装置100、自地址addr_7读取出数据D14并传送给主装置100以及自地址addr_8读取出数据D15并传送给主装置100，以此类推。
通过上述，当主装置100与从装置200彼此之间欲使用多数据爆发式传输模式(burst-mode)来读取或写入多个连续地址的数据时，可以使用与单一数据传输模式(single-shot)相同的运算码(operation code，OP code)，藉此达到以相同的运算码来支援单一数据传输模式与多数据爆发式传输模式，进而节省OP code的定义及有限状态机(finite state-machine)的状态数。
图6是依照本发明的一实施例所示出的数据存取方法的流程图。
请参照图6，在步骤S601中，主装置100提供选择信号至从装置200以选择从装置200。在步骤S603中，主装置100提供第一运算码、第一地址以及时脉信号至从装置200。在步骤S605中，从装置100执行第一存取操作以根据第一运算码、第一地址以及时脉信号存取对应于第一地址的第一数据。在步骤S607中，中，从装置200结束存取对应于第一地址的第一数据。在步骤S609中，从装置200判断是否持续接收到时脉信号。当于主装置100结束对应述第一运算码的操作前从装置200未再接收到时脉信号时，在步骤S611中，从装置200会结束执行第一存取操作。当从装置200持续地接收到时脉信号时，在步骤S613中，从装置200会根据时脉信号存取对应于第二地址的第二数据，其中第二地址是相邻于第一地址。
综上所述，本发明的主从式系统、指令执行方法与数据存取方法可以让从装置直接根据由主装置传送的时脉信号来执行对应的操作，进而省去(或减少)从装置中用于产生时脉信号的电路。此外，在本发明的主从式系统、指令执行方法与数据存取方法中，当主装置与从装置彼此之间欲使用多数据爆发式传输模式(burst-mode)来传输多个连续地址的数据时，可以使用与单一数据传输模式(single-shot)相同的运算码(operation code，OPcode)，藉此达到以相同的运算码来支援单一数据传输模式与多数据爆发式传输模式，进而节省OP code的定义及有限状态机(finite state-machine)的状态数。
虽然本发明已以实施例揭示如上，然其并非用以限定本发明，任何所属技术领域中技术人员，在不脱离本发明的精神和范围内，当可作些许的更改与润饰，故本发明的保护范围当视权利要求所界定者为准。

Claims (30)

1.一种主从式系统，包括：
主装置，具有第一接口；以及
从装置，具有第二接口且所述第二接口电性连接至所述第一接口，其中
所述主装置提供第一指令以及时脉信号至所述从装置，
所述从装置根据所述第一指令与所述时脉信号，执行对应于所述第一指令的第一操作，以及
当对应于所述第一指令的所述第一操作完成时，所述从装置根据所述时脉信号产生回应信号以通知所述主装置关于对应于所述第一指令的所述第一操作的执行结果。
2.根据权利要求1所述的主从式系统，其中在所述主装置提供所述第一指令以及所述时脉信号至所述从装置的运作之前，
所述主装置与所述从装置预先定义所述主装置在提供所述第一指令至所述从装置时所需的所述时脉信号中的第一时脉周期的数量、所述从装置在执行对应于所述第一指令的所述第一操作时所需的所述时脉信号中的第二时脉周期的数量以及所述从装置产生所述回应信号时所需的所述时脉信号中的第三时脉周期的数量。
3.根据权利要求1所述的主从式系统，其中在所述主装置提供所述第一指令以及所述时脉信号至所述从装置的运作之前，
所述主装置提供选择信号至所述从装置以选择所述从装置执行对应于所述第一指令的所述第一操作。
4.根据权利要求3所述的主从式系统，其中所述第一接口与所述第二接口是串列周边接口。
5.根据权利要求4所述的主从式系统，其中所述选择信号是通过所述串列周边接口中的从选择接脚提供给所述从装置，所述时脉信号是通过所述串列周边接口中的串列时脉接脚提供给所述从装置，所述第一指令是通过所述串列周边接口中的主输出从输入接脚提供给所述从装置，以及所述回应信号是通过所述串列周边接口中的主输入从输出接脚提供给所述从装置。
6.根据权利要求1所述的主从式系统，其中所述主装置与所述从装置是以一字节作为数据传输的基本单位，且所述时脉信号中的每一个时脉周期仅传输一比特。
7.一种指令执行方法，用于主从式系统，所述主从式系统包括具有第一接口的主装置以及具有第二接口的从装置，所述第二接口电性连接至所述第一接口，所述方法包括：
通过所述主装置提供第一指令以及时脉信号至所述从装置；
通过所述从装置根据所述第一指令与所述时脉信号，执行对应于所述第一指令的第一操作；以及
当对应于所述第一指令的所述第一操作完成时，通过所述从装置根据所述时脉信号产生回应信号以通知所述主装置关于对应于所述第一指令的所述第一操作的执行结果。
8.根据权利要求7所述的指令执行方法，其中在提供所述第一指令以及所述时脉信号至所述从装置的步骤之前，所述方法还包括：
通过所述主装置与所述从装置预先定义所述主装置在提供所述第一指令至所述从装置时所需的所述时脉信号中的第一时脉周期的数量、所述从装置在执行对应于所述第一指令的所述第一操作时所需的所述时脉信号中的第二时脉周期的数量以及所述从装置产生所述回应信号时所需的所述时脉信号中的第三时脉周期的数量。
9.根据权利要求7所述的指令执行方法，其中在提供所述第一指令以及所述时脉信号至所述从装置的步骤之前，所述方法还包括：
通过所述主装置提供选择信号至所述从装置以选择所述从装置执行对应于所述第一指令的所述第一操作。
10.根据权利要求9所述的指令执行方法，其中所述第一接口与所述第二接口是串列周边接口。
11.根据权利要求10所述的指令执行方法，其中所述选择信号是通过所述串列周边接口中的从选择接脚提供给所述从装置，所述时脉信号是通过所述串列周边接口中的串列时脉接脚提供给所述从装置，所述第一指令是通过所述串列周边接口中的主输出从输入接脚提供给所述从装置，以及所述回应信号是通过所述串列周边接口中的主输入从输出接脚提供给所述从装置。
12.根据权利要求7所述的指令执行方法，其中所述主装置与所述从装置是以一字节作为数据传输的基本单位，且所述时脉信号中的每一个时脉周期仅传输一比特。
13.一种主从式系统，包括：
主装置，具有第一接口；以及
从装置，具有第二接口且所述第二接口电性连接至所述第一接口，其中
所述主装置提供第一运算码、第一地址以及时脉信号至所述从装置，
所述从装置执行第一存取操作以根据所述第一运算码、所述第一地址以及所述时脉信号存取对应于所述第一地址的第一数据，
当所述从装置结束存取对应于所述第一地址的所述第一数据且于所述主装置结束对应于所述第一运算码的操作前所述从装置未再接收到所述时脉信号时，所述从装置结束执行所述第一存取操作，以及
当所述从装置结束存取对应于所述第一地址的所述第一数据且所述从装置持续地接收到所述时脉信号时，所述从装置根据所述时脉信号存取对应于第二地址的第二数据，其中所述第二地址是相邻于所述第一地址。
14.根据权利要求13所述的主从式系统，其中
所述主装置提供第二运算码、多个第三地址以及所述时脉信号至所述从装置，
所述从装置执行第二存取操作以根据所述第二运算码、所述多个第三地址以及所述时脉信号存取对应于所述多个第三地址的多个第三数据。
15.根据权利要求13所述的主从式系统，其中所述第一存取操作为第一写入操作，其中在执行所述第一存取操作以根据所述第一运算码、所述第一地址以及所述时脉信号存取对应于所述第一地址的所述第一数据的运作中，
所述从装置执行所述第一写入操作以根据所述第一运算码、所述第一地址以及所述时脉信号将所述第一数据写入至所述从装置的所述第一地址中，
其中在根据所述时脉信号存取对应于所述第二地址的所述第二数据的运作中，所述从装置将所述第二数据写入至所述从装置的所述第二地址中。
16.根据权利要求14所述的主从式系统，其中所述第二存取操作为第二写入操作，其中在执行所述第二存取操作以根据所述第二运算码、所述多个第三地址以及所述时脉信号存取对应于所述多个第三地址的所述多个第三数据的运作中，
所述从装置执行所述第二写入操作以根据所述第二运算码、所述多个第三地址以及所述时脉信号将所述多个第三数据分别写入至所述从装置的所述多个第三地址中。
17.根据权利要求13所述的主从式系统，其中所述第一存取操作为第一读取操作，其中在执行所述第一存取操作以根据所述第一运算码、所述第一地址以及所述时脉信号存取对应于所述第一地址的所述第一数据的运作中，
所述从装置执行所述第一读取操作以根据所述第一运算码、所述第一地址以及所述时脉信号将从所述从装置的所述第一地址中读取出所述第一数据，
其中在根据所述时脉信号存取对应于所述第二地址的所述第二数据的运作中，所述从装置从所述从装置的所述第二地址中读取出所述第二数据。
18.根据权利要求14所述的主从式系统，其中所述第二存取操作为第二读取操作，其中在执行所述第二存取操作以根据所述第二运算码、所述多个第三地址以及所述时脉信号存取对应于所述多个第三地址的所述多个第三数据的运作中，
所述从装置执行所述第二读取操作以根据所述第二运算码、所述多个第三地址以及所述时脉信号分别从所述从装置的所述多个第三地址中读取出所述多个第三数据。
19.根据权利要求13所述的主从式系统，其中在提供所述第一运算码、所述第一地址以及所述时脉信号至所述从装置的运作之前，
所述主装置提供选择信号至所述从装置以选择所述从装置执行所述第一存取操作。
20.根据权利要求19所述的主从式系统，其中所述第一接口与所述第二接口是串列周边接口。
21.根据权利要求20所述的主从式系统，其中所述选择信号是通过所述串列周边接口中的从选择接脚提供给所述从装置，所述时脉信号是通过所述串列周边接口中的串列时脉接脚提供给所述从装置，所述第一运算码与所述第一地址是通过所述串列周边接口中的主输出从输入接脚提供给所述从装置，以及所述第一数据以及所述第二数据是通过所述串列周边接口中的所述主输出从输入提供给所述从装置或通过所述串列周边接口中的主输入从输出接脚提供给所述主装置。
22.一种数据存取方法，用于主从式系统，所述主从式系统包括具有第一接口的主装置以及具有第二接口的从装置，所述第二接口电性连接至所述第一接口，所述方法包括：
通过所述主装置提供第一运算码、第一地址以及时脉信号至所述从装置；
通过所述从装置执行第一存取操作以根据所述第一运算码、所述第一地址以及所述时脉信号存取对应于所述第一地址的第一数据；
当所述从装置结束存取对应于所述第一地址的所述第一数据且于所述主装置结束对应于所述第一运算码的操作前所述从装置未再接收到所述时脉信号时，通过所述从装置结束执行所述第一存取操作；以及
当所述从装置结束存取对应于所述第一地址的所述第一数据且所述从装置持续地接收到所述时脉信号时，通过所述从装置根据所述时脉信号存取对应于第二地址的第二数据，其中所述第二地址是相邻于所述第一地址。
23.根据权利要求22所述的数据存取方法，还包括：
通过所述主装置提供第二运算码、多个第三地址以及所述时脉信号至所述从装置；以及
通过所述从装置执行第二存取操作以根据所述第二运算码、所述多个第三地址以及所述时脉信号存取对应于所述多个第三地址的多个第三数据。
24.根据权利要求22所述的数据存取方法，其中所述第一存取操作为第一写入操作，其中执行所述第一存取操作以根据所述第一运算码、所述第一地址以及所述时脉信号存取对应于所述第一地址的所述第一数据的步骤包括：
通过所述从装置执行所述第一写入操作以根据所述第一运算码、所述第一地址以及所述时脉信号将所述第一数据写入至所述从装置的所述第一地址中，
其中根据所述时脉信号存取对应于所述第二地址的所述第二数据的步骤包括：
通过所述从装置将所述第二数据写入至所述从装置的所述第二地址中。
25.根据权利要求23所述的数据存取方法，其中所述第二存取操作为第二写入操作，其中执行所述第二存取操作以根据所述第二运算码、所述多个第三地址以及所述时脉信号存取对应于所述多个第三地址的所述多个第三数据的步骤包括：
通过所述从装置执行所述第二写入操作以根据所述第二运算码、所述多个第三地址以及所述时脉信号将所述多个第三数据分别写入至所述从装置的所述多个第三地址中。
26.根据权利要求22所述的数据存取方法，其中所述第一存取操作为第一读取操作，其中执行所述第一存取操作以根据所述第一运算码、所述第一地址以及所述时脉信号存取对应于所述第一地址的所述第一数据的步骤包括：
通过所述从装置执行所述第一读取操作以根据所述第一运算码、所述第一地址以及所述时脉信号将从所述从装置的所述第一地址中读取出所述第一数据，
其中根据所述时脉信号存取对应于所述第二地址的所述第二数据的步骤包括：
通过所述从装置从所述从装置的所述第二地址中读取出所述第二数据。
27.根据权利要求23所述的数据存取方法，其中所述第二存取操作为第二读取操作，其中执行所述第二存取操作以根据所述第二运算码、所述多个第三地址以及所述时脉信号存取对应于所述多个第三地址的所述多个第三数据的步骤包括：
通过所述从装置执行所述第二读取操作以根据所述第二运算码、所述多个第三地址以及所述时脉信号分别从所述从装置的所述多个第三地址中读取出所述多个第三数据。
28.根据权利要求22所述的数据存取方法，其中在提供所述第一运算码、所述第一地址以及所述时脉信号至所述从装置的步骤之前，所述方法还包括：
通过所述主装置提供选择信号至所述从装置以选择所述从装置执行所述第一存取操作。
29.根据权利要求28所述的数据存取方法，其中所述第一接口与所述第二接口是串列周边接口。
30.根据权利要求29所述的数据存取方法，其中所述选择信号是通过所述串列周边接口中的从选择接脚提供给所述从装置，所述时脉信号是通过所述串列周边接口中的串列时脉接脚提供给所述从装置，所述第一运算码与所述第一地址是通过所述串列周边接口中的主输出从输入接脚提供给所述从装置，以及所述第一数据以及所述第二数据是通过所述串列周边接口中的所述主输出从输入提供给所述从装置或通过所述串列周边接口中的主输入从输出接脚提供给所述主装置。
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