CN104810272A - 等离子体蚀刻方法 - Google Patents
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Abstract
本发明提供等离子体蚀刻方法,能够大幅改善充电损伤的发生,实现等离子体处理的稳定性和可靠性的提高。在能够真空排气的处理容器(10)内相对地平行配置上部电极(38)和下部电极(12),由第一高频电源(32)通过第一匹配器(34)向下部电极(12)施加第一高频。控制部(68)以使得用于生成等离子体的第一高频具有生成等离子体的第一振幅的第一期间、和具有实质上不生成等离子体的第二振幅的第二期间以规定的周期交替重复的方式控制第一高频电源(32)。
Description
本申请是2008年8月15日提出的申请号为200810135193.6的申请的分案申请。
技术领域
本发明涉及对被处理体实施等离子体处理的技术,特别涉及电容耦合型的等离子体处理装置、等离子体处理方法、和具有执行该等离子体处理方法的控制程序的存储介质。
背景技术
半导体设备、FPD(Flat Panel Display:平板显示器)的制造工艺中的蚀刻、堆积、氧化、溅射等处理中,为了对处理气体以比较低的温度进行良好的反应,多利用等离子体。一直以来,在单片式的等离子体处理装置、特别是等离子体蚀刻装置中,电容耦合型的等离子体处理装置是主流。
一般的电容耦合型等离子体处理装置是,在构成为真空腔室的处理容器内平行地配置上部电极和下部电极,在下部电极上载置被处理基板(半导体晶片、玻璃基板等),在两电极之间施加高频电压。利用通过该高频电压在两电极之间形成的电场对电子进行加速,通过电子与处理气体的碰撞电离而产生等离子体,通过等离子体中的自由基、离子对基板表面实施希望的微细加工,例如蚀刻加工。
然而,近年来,半导体等制造工艺中的设计规则越来越微细化,特别是等离子体蚀刻要求更高的尺寸精度,对于蚀刻中的掩膜、基底的选择比、面内均匀性也要求得更高。因此,要求腔室内的处理区域的低压力化、低离子能量化,从而使用40MHz以上的相比于现有技术频率大幅提高的高频。
但是,由于这样的低压力化和低离子能量化的发展,现今不成为问题的充电损伤的影响变得无法忽视。即,在离子能量高的现有的装置中,等离子体电位即使在面内不规则也不会产生很大问题,但如果更为低压且离子能量变低,则会产生等离子体电位的面内不均匀容易引起栅极氧化膜的充电损伤这样的问题。
另外,在使用40MHz以上的高频率的高频的等离子体工艺中,一般来说,具有晶片中心部的蚀刻速率较高、晶片周边部的蚀刻速率较低的倾向,从而产生问题。
关于该问题,专利文献1中公开了:在由施加在晶片上的高频偏压产生的高频电流的通路中,设置以使晶片的外周附近的电流通路部分朝向相对电极的晶片相对面的方式进行矫正的电流通路矫正机构,或者设置阻抗调整机构,使得从高频偏压看的直至地的阻抗在晶片面内大致均匀。由此,在施加高频偏压时产生的自偏压的晶片面内的均匀性提高,能够抑制宏观损伤。
但是,专利文献1中记载的技术存在以下问题:需要设置电流通路矫正机构、阻抗调整机构,装置结构复杂化;等离子体处理的面内均匀性并不充分等。
另外,在等离子体工艺中,因晶片面内的离子与电子的平衡破坏而导致的局部电场会诱发栅极氧化膜的充电而导致绝缘破坏,这种方式的充电损伤也很麻烦。例如,在等离子体蚀刻中,相对晶片的主面,离子垂直入射而电子从倾斜方向入射,因此容易随机地产生局部的电荷平衡破坏而诱发充电的位置。这样的充电损伤不仅依赖于自偏压的面内不均匀性,也依赖于蚀刻图案的形状等,且产生的位置不确定,不能够由专利文献1中记载的技术有效地消除。
专利文献1:日本特开2001-185542号公报
发明内容
本发明鉴于现有技术的问题点,目的在于提供等离子体处理装置、等离子体处理方法、和具有执行该等离子体处理方法的控制程序的存储介质,其能够有效地防止充电损伤的发生,实现等离子体处理的稳定性和可靠性的提高,并且能够实现等离子体处理的面内均匀性的提高。
为了达到上述目的,本发明的第一观点中的等离子体处理装置包括:能够真空排气的处理容器;在上述处理容器内载置被处理体的第一电极;在上述处理容器内与上述第一电极平行地相对的第二电极;向上述第一电极与上述第二电极之间的处理空间供给希望的处理气体的处理气体供给部;在上述第一电极和上述第二电极的至少一方上施加上述处理气体的等离子体生成用的第一高频的第一高频供电部;和以上述第一高频具有生成等离子体的第一振幅的第一期间、和上述第一高频具有实质上不生成等离子体的第二振幅的第二期间以规定的周期交替重复的方式控制上述第一高频供电部的控制部。
一般来说,等离子体工艺中的充电损伤(绝缘破坏)被从等离子体流入被处理体的或累积的电荷的量左右,当流入电荷量或累积电荷量超过某个阈值时,就会以指数函数产生绝缘膜的劣化乃至破坏。另外,绝缘膜的充电由于入射或流入被处理体的离子和电子的平衡破坏而发生,产生局部电场。在等离子体生成时,充电的电荷量和局部电场的强度与时间成比例地增大,当其超过某阈值时,会导致绝缘膜的损伤(损伤或破坏)。
在上述的装置结构中,即使在第一高频具有生成等离子体用的第一振幅的第一期间(阶段)中,在被处理体的任意位置的流入电荷量或累积电荷量过量,但因为在中断等离子体生成的第二期间(阶段)中,过量的电荷分散,恢复电荷平衡,所以能够有效地防止绝缘膜的损伤。由此,能够大幅改善等离子体工艺的可靠性。
根据本发明的第一观点中的等离子体处理装置的一种优选方式,上述第二振幅也可以为0。由此,能够在第二期间中使电荷平衡恢复的时间尽量地短,从而能够使等离子体处理时间缩短。另外,生成等离子体的第一期间,可以在每一周期为2μsec~100μsec,也可以进而优选为2μsec~50μsec。另外,中断等离子体生成的第二期间可以在每一周期为2μsec以上。
本发明的第二观点中的等离子体处理装置包括:能够真空排气的处理容器;在上述处理容器内载置被处理体的第一电极;在上述处理容器内与上述第一电极平行地相对的第二电极;向上述第一电极与上述第二电极之间的处理空间供给希望的处理气体的处理气体供给部;在上述第一电极和上述第二电极的至少一方上施加第一高频的第一高频供电部;和在上述被处理体的处理中,以在上述处理容器内生成上述处理气体的等离子体的状态和实质上不生成等离子体的状态以规定的周期交替重复的方式控制上述第一高频供电部的控制部。
上述装置结构中,在被处理体的处理中,处理气体的等离子体生成状态和等离子体非生成状态(不生成等离子体的状态)以规定周期交替重复,因此,与从等离子体处理的开始直到结束持续生成等离子体的通常的等离子体处理相比,等离子体连续生成的时间确实变短。因此,从等离子体一次流入被处理体的电荷的量、或电荷在被处理体的表面部累积的量减少,从而难以发生充电损伤,能够实现稳定的等离子体处理,提高等离子体工艺的可靠性。
根据本发明的第二观点中的等离子体处理装置的一种优选方式,上述等离子体生成状态的持续时间可以在每一周期为2μsec~100μsec,也可进而优选为2μsec~50μsec。另外,上述等离子体非生成状态的持续时间可以在每一周期为2μsec以上。
根据本发明的第一和第二观点中的等离子体处理装置的一种优选方式,上述第一高频的频率可以是30~300MHz。另外,上述第一高频供电部可以在上述第一电极上施加上述第一高频。另外,也可以包括向上述第一电极和上述第二电极的至少一方施加用于将上述等离子体中的离子引入上述被处理体的第二高频的第二高频供电部。进一步,上述第二高频供电部可以在上述第一电极上施加上述第二高频。
本发明的第三观点中的等离子体处理方法,使用等离子体处理装置,在处理空间中生成处理气体的等离子体,并对被处理体实施等离子体处理,该等离子体处理装置包括:能够真空排气的处理容器;在上述处理容器内载置上述被处理体的第一电极;在上述处理容器内与上述第一电极平行地相对的第二电极;向上述第一电极与上述第二电极之间的上述处理空间供给希望的上述处理气体的处理气体供给部;和在上述第一电极和上述第二电极的至少一方上施加上述处理气体的等离子体生成用的第一高频的第一高频供电部,该等离子体处理方法的特征在于,上述第一高频具有生成等离子体的第一振幅的第一期间、和上述第一高频具有实质上不生成等离子体的第二振幅的第二期间以规定的周期交替地被重复。
在上述方法中,用于等离子体生成的第一高频以规定周期交替地重复具有生成等离子体的第一振幅的第一期间(阶段)、和具有实质上不生成等离子体的第二振幅的第二期间(阶段),因此,与连续施加具有生成等离子体的振幅的高频的通常的等离子体处理相比,等离子体连续生成的时间缩短。因此,从等离子体一次流入被处理体的电荷的量、或电荷在被处理体的表面部上累积的量减少,从而难以发生充电损伤,能够实现稳定的等离子体处理,提高等离子体工艺的可靠性。
根据本发明的第三观点中的等离子体处理方法的一种优选方式,上述第二振幅也可以为0。由此,在第二期间中给予无等离子体的状态的时间,即恢复电荷平衡的时间,变得尽量的短,从而能够使等离子体处理时间缩短。另外,生成等离子体的第一期间可以在每一周期为2μsec~100μsec,也可以进而优选为2μsec~50μsec。另外,中断等离子体生成的第二期间可以在每一周期为2μsec以上。
本发明的第四观点中的等离子体处理方法,使用等离子体处理装置,在处理空间中生成处理气体的等离子体,并对被处理体实施等离子体处理,该等离子体处理装置包括:能够真空排气的处理容器;在上述处理容器内载置上述被处理体的第一电极;在上述处理容器内与上述第一电极平行地相对的第二电极;向上述第一电极与上述第二电极之间的上述处理空间供给希望的上述处理气体的处理气体供给部;和在上述第一电极和上述第二电极的至少一方上施加第一高频的第一高频供电部,该等离子体处理方法的特征在于,在上述被处理体的处理中,在上述处理容器内生成上述处理气体的等离子体的状态和实质上不生成等离子体的状态以规定的周期交替地被重复。
在上述方法中,在被处理体的处理中,处理气体的等离子体生成状态和等离子体非生成状态(不生成等离子体的状态)以规定周期交替重复,因此,与持续生成等离子体的通常的等离子体处理相比,连续生成等离子体的时间确实变短。因此,从等离子体一次流入被处理体的电荷的量、或电荷在被处理体的表面部累积的量减少,从而难以发生充电损伤,能够实现稳定的等离子体处理,提高等离子体工艺的可靠性。
根据本发明的第四观点中的等离子体处理方法的一种优选方式,上述等离子体生成状态的持续时间可以在每一周期为2μsec~100μsec,也可以进而优选为2μsec~50μsec。另外,上述等离子体非生成状态的持续时间可以在每一周期为2μsec以上。
根据本发明的第三和第四观点中的等离子体处理方法的一种优选方式,上述第一高频的频率可以是30~300MHz。另外,上述第一高频供电部可以向上述第一电极施加上述第一高频。另外,上述等离子体处理装置也可以包括向上述第一电极和上述第二电极的至少一方施加用于将上述等离子体中的离子引入上述被处理体的第二高频的第二高频供电部。进一步,上述第二高频供电部可以对上述第一电极施加上述第二高频。
另外,本发明的第五观点中的存储介质,存储有用于控制等离子体处理装置的在计算机上运行的控制程序,该等离子体处理装置包括:能够真空排气的处理容器;在上述处理容器内载置被处理体的第一电极;在上述处理容器内与上述第一电极平行地相对的第二电极;向上述第一电极与上述第二电极之间的处理空间供给希望的处理气体的处理气体供给部;和在上述第一电极和上述第二电极的至少一方上施加生成上述处理气体的等离子体用的第一高频的第一高频供电部,该存储介质的特征在于,上述控制程序以在执行时进行本发明的第三和第四观点中的等离子体处理方法的方式使计算机控制上述等离子体处理装置。
根据本发明的等离子体处理装置、等离子体处理方法、和具有执行该等离子体处理方法的控制程序的存储介质,通过上述结构和作用,能够有效地防止充电损伤的发生,实现等离子体工艺的稳定性和可靠性的提高,并且能够实现等离子体处理的面内均匀性的提高。
附图说明
图1是表示本发明的一实施方式的等离子体处理装置的结构的纵截面图。
图2是表示脉冲等离子体的时间-高频功率特性的图。
图3是表示图2中的脉冲等离子体的第一高频的波形的图。
图4是表示等离子体生成期间A、等离子体非生成期间B的最佳范围的图。
图5是表示对充电损伤耐性进行试验的元件结构的示意图。
图6是比较并表示现有技术(比较例)与本发明的充电损伤的发生频率的图。
图7是比较并表示现有技术(比较例)与本发明的充电损伤的发生频率的图。
符号说明
10 腔室(处理容器)
12 基座(下部电极)
28 排气装置
32 第一高频电源
34 第一匹配器
36 供电棒
38 喷淋头(上部电极)
62 处理气体供给部
68 控制部
70 第二高频电源
72 第二匹配器
具体实施方式
以下参照附图对本发明的优选实施方式进行说明。
图1表示本发明的一实施方式的等离子体处理装置的结构。该等离子体处理装置构成为RF下部双频施加方式的电容耦合型(平行平板型)等离子体蚀刻装置,具有例如由铝或不锈钢等金属制造的圆筒型腔室(处理容器)10。腔室10被保护接地。
在腔室10内,设置有载置作为被处理体(被处理基板)的例如半导体晶片W的圆板状的下部电极或基座12。该基座12,例如由铝构成,隔着绝缘性的筒状保持部14被支承在从腔室10的底部向垂直上方延伸的筒状支承部16上。筒状保持部14的上面配置有环状包围基座12的上面的例如由石英、硅构成的聚焦环18。
腔室10的侧壁与筒状支承部16之间形成有排气通路20,该排气通路20的入口或中间安装有环状的挡板22,并且在底部设置有排气口24。该排气口24通过排气管26与排气装置28连接。排气装置28具有真空泵,能够使腔室10内的处理空间减压到规定的真空度。腔室10的侧壁上安装有开关半导体晶片W的搬入搬出口的闸阀30。
等离子体生成用的第一高频电源32通过第一匹配器34和供电棒36与基座12电连接。该第一高频电源32在下部电极即基座12上施加规定的频率例如100MHz的第一高频。另外,腔室10的顶部设置有后述的喷淋头38,作为接地电位的上部电极。从而,来自第一高频电源32的第一高频被电容性地施加在基座12与喷淋头38之间。
另外,引入离子用的第二高频电源70通过第二匹配器72和供电棒36与基座12电连接。该第二高频电源70在基座12上施加规定的频率例如3.2MHz的第二高频。
基座12的上面设置有用于以静电吸附力保持半导体晶片W的静电卡盘40。该静电卡盘40在一对绝缘膜40b、40c之间夹持由导电膜构成的电极40a,直流电源42通过开关43与电极40a电连接。通过来自直流电源42的直流电压,能够用库仑力使半导体晶片W被吸附保持在卡盘上。
在基座12的内部,设置有例如在圆周方向延伸的致冷剂室44。由冷却单元46通过配管48、50向该致冷剂室44循环供给规定温度的致冷剂例如冷却水。利用致冷剂的温度,能够控制静电卡盘40上的半导体晶片W的处理温度。进一步,来自传热气体供给部52的传热气体例如He气,通过气体供给线54被供给至静电卡盘40的上面与半导体晶片W的背面之间。
顶部的喷淋头38包括具有多个气体通气孔56a的下面的电极板56,和能够装卸地支承该电极板56的电极支承体58。在电极支承体58的内部设置有缓冲室60,来自处理气体供给部62的气体供给配管64与该缓冲室60的气体导入口60a连接。
在腔室10的周围,配置有以环状或同心状延伸的磁铁66。在腔室10内,在喷淋头38与基座12之间的空间中,利用第一高频电源32形成铅直方向的RF电场。通过第一高频的放电,能够在基座12的表面附近生成高密度的等离子体。
控制部68控制该等离子体蚀刻装置内的各部,例如排气装置28、第一高频电源32、第一匹配器34、静电卡盘用的开关43、冷却单元46、传热气体供给部52、处理气体供给部62、第二高频电源70和第二匹配器72等的动作,与主计算机(未图示)等连接。
在该等离子体蚀刻装置中,为了进行蚀刻,首先使闸阀30为打开状态,将作为加工对象的半导体晶片W搬入腔室10内,并载置在静电卡盘40上。然后,通过处理气体供给部62将蚀刻气体(一般为混合气体)按规定的流量和流量比导入腔室10内,通过排气装置28使腔室10内的压力为设定值。进一步,通过第一高频电源32以规定的功率向基座12供给第一高频,同时从第二高频电源70也以规定的功率向基座12供给第二高频。另外,通过直流电源42向静电卡盘40的电极40a施加直流电压,将半导体晶片W固定在静电卡盘40上。由喷淋头38喷出的蚀刻气体在两电极12、38之间通过第一高频的放电而等离子体化,通过由该等离子体生成的自由基、离子对半导体晶片W的主面进行蚀刻。
该等离子体蚀刻装置中,从第一高频电源32对基座(下部电极)12施加比现有技术高的频域(30MHz以上)的第一高频,由此,能够使等离子体在优选的离解状态下高密度化,即使在更低压的条件下也能够形成高密度等离子体。
如果使等离子体密度提高,会发生低离子能量化,即半导体晶片W上的鞘电位变小(低偏压化),因为这样的低偏压化与现有相比更进一步,所以充电损伤(绝缘破坏)的影响变得无法忽视。充电损伤在从等离子体流入半导体晶片W(栅电极)的电荷量超过一定的阈值时发生。该流入电荷量与晶片W面内的鞘电位的相对差异相关联。
现有的使用较低的频率的等离子体蚀刻装置中,鞘电位较大,为数百伏特,所以即使等离子体中的电位(等离子体电位)发生面内不均匀,鞘电位的变化在晶片面内也相对较小,流入半导体晶片W的栅电极的电荷量不会超过阈值。
但是,如本实施方式所示的高密度等离子体中,鞘电位较小,为数十伏特左右,所以在等离子体电位发生面内不均匀时,鞘电位的变化相对较大,容易导致大量的电子向栅电极流入,容易产生依赖于基板表面连续暴露在等离子体中的时间的长度的充电损伤。
另外,在等离子体工艺中,与等离子体电位的面内不均匀性或电路图案的形状相关联,会由局部的离子和电子的平衡破坏而导致在基板上的绝缘膜(例如栅极氧化膜)上发生充电。发生了充电的绝缘膜上会产生与累积电荷的量成比例的电位梯度或电场。如果这种充电状态累积增大并超过一定阈值,则在该位置绝缘膜会被损伤或破坏。
本实施方式中,为了使向栅电极的流入电荷量不超过阈值,或使由于充电而累积在绝缘膜上的电荷的量不超过阈值,使等离子体生成状态和等离子体非生成状态(不生成等离子体的状态)以规定周期交替重复。即,将连续的等离子体生成的时间设为流入电荷量或充电电荷量不会超过阈值的程度的较短时间,之后成为不生成等离子体的状态,并使它们断续地重复。即使在等离子体生成状态的期间中,在晶片W上的任意的位置发生过量的电荷流入或充电,在等离子体非生成状态的期间中,也能够使多余的电荷或累积电荷向周围分散而使中和性恢复,因此,能够阻止流入电荷或累积电荷的累积增大,有效防止绝缘膜的损伤。从而能够大幅改善等离子体工艺的可靠性。
在等离子体蚀刻中,为了使等离子体生成状态和等离子体非生成状态交替重复,在本实施方式中,控制部68对第一高频电源32和第一匹配器34进行控制,使得第一高频具有生成等离子体的第一振幅或峰值(即有效的功率)的第一期间、和第一高频具有不生成等离子体的第二振幅或峰值(即不具有有效的功率)的第二期间以规定的周期交替重复。另外,本发明中,第二振幅包括0(即不施加第一高频)。
具体来说,对从第一高频电源32输出的第一高频的功率进行调制,并施加在基座12上。作为功率调制的典型的例子,能够举出图2所示的脉冲状的调制。
在图2中,等离子体生成状态为期间A,等离子体非生成状态为期间B。在等离子体生成期间A中,以电力换算为500W的第一振幅将第一高频施加在高频电极12上,在等离子体非生成期间B中,使第一高频为电力换算为0W的电力(第二振幅)。即,使第一高频的电力在ON、OFF之间反复,在腔室10内生成所谓的脉冲等离子体。该情况下的第一高频的波形如图3所示。
另外,等离子体非生成状态的第二振幅也可以不为0W。只要是实质上不生成等离子体的功率值,则并不限定于此。而且,使等离子体生成时的第一振幅是电力换算为500W的振幅,但并不限于此。虽然也会受到工艺条件的影响,但能够设定在电力换算为100W~2000W的范围内。
虽然规定第一振幅、第二振幅是很重要的,但以使向栅电极的流入电荷量或栅极氧化膜上的累积电荷量不超过阈值的方式规定等离子体生成期间A和等离子体非生成期间B的持续时间更为重要。图4用图形表示了在脉冲施加图2所示的第一高频(第一振幅的电力换算为500W,第二振幅的电力换算为0W)的情况下,等离子体生成期间A、等离子体非生成期间B的优选的范围。
根据图4,等离子体生成期间A是2μsec以上100μsec以下即可,等离子体非生成期间B是2μsec以上即可。另外,图4的等离子体生成期间A优选为2μsec以上50μsec以下。如果等离子体生成期间A比100μsec更长,则流入电荷量或累积电荷量超过阈值,产生充电损伤。此外,如果等离子体生成期间A比2μsec更短,即使生成了等离子体也不能够成为稳定的状态,等离子体处理的效率降低。另一方面,如果等离子体非生成期间B比2μsec更短,则等离子体无法完全消退,会成为仅连续进行等离子体生成期间A的情况,即与长时间连续生成等离子体的通常的等离子体处理相同的状况,容易产生充电损伤。另外,即使延长等离子体非生成期间B,对蚀刻结果也不会造成影响。
脉冲状地施加第一高频的脉冲等离子体,因为等离子体生成期间A和等离子体非生成期间B以规定周期交替重复,所以与维持等离子体生成状态而连续进行蚀刻的情况相比,从蚀刻处理的开始到结束的总蚀刻时间变长。为了提高蚀刻效率或生产量,需要增大脉冲等离子体的占空比(等离子体生成期间A/(等离子体生成期间A+等离子体非生成期间B))。由此,尽管如上所述,等离子体非生成期间B的上限依据蚀刻结果并没有特别规定,但为了提高蚀刻效率,优选其较短。
图2中等离子体生成期间A最大为100μsec,等离子体非生成期间B最小为2μsec,所以蚀刻效率最好的最大占空比约为98%。另一方面,考虑到蚀刻效率,最小占空比优选为50%左右,即等离子体生成期间A与等离子体非生成期间B为相同的时间。
而且,设定为最大占空比98%,换言之,与从处理的开始到结束维持等离子体生成状态而连续进行蚀刻的情况相比,蚀刻时间仅相差2%。如此,能够以与通常的等离子体处理相比大致不变的蚀刻效率(生产量)可靠地防止充电损伤。
另外,考虑功率调制的频率,即脉冲等离子体的频率,其优选为5~250kHz。关于这一点,根据图4的例子,因为等离子体生成期间A与等离子体非生成期间B的最小时间为2μsec,所以最短周期为4μsec,因此规定为250kHz。另外,因为等离子体生成期间A与等离子体非生成期间B的最大时间为100μsec,所以最长周期为200μsec,因此规定为5kHz。
接下来,对使用测试晶片,试验脉冲等离子体的充电损伤耐性的结果进行说明。试验中使用了图5所示的结构的元件。即,在Si基板(Si-sub)74上,形成SiO2膜76,其包括厚度为4nm的栅极氧化膜相当部分76a和厚度为500nm的元件分离区域76b,再在其上形成多晶硅膜78,在晶片上以矩阵的单元状形成多个这样的元件。元件分离区域76b的面积C设定为栅极氧化膜相当部分76a的面积D的1万倍或10万倍,比通常的元件大,使之成为与通常的应力试验(stress test)相同的容易发生充电损伤的结构。
作为晶片,使用300mm晶片。等离子体处理使用图1所示的装置进行,按以下条件将晶片暴露在等离子体中:腔室内压强:20mTorr;处理气体:O2气体;流量:200sccm;第一高频的频率:100MHz;高频电力:500W;处理时间:10秒。另外,不使用(施加)从第二高频电源70输出的第二高频。测定此时各元件的漏电流,设定漏电流在1×10-9A/μm2以上的情况为发生绝缘破坏的情况,设定比该值小的情况作为无绝缘破坏的情况。
该试验结果表示于图6、图7。图6为晶片的元件分离区域76b的面积C为栅极氧化膜相当部分76a的面积D的10万倍的情况,图7为1万倍的情况。图6(a)、图7(a)是通常的连续等离子体的情况,图6(b)、图7(b)是为脉冲等离子体,等离子体生成期间A为40μsec,占空比为20%,调制频率(脉冲频率)为5kHz的情况,图6(c)、图7(c)是同样为脉冲等离子体,等离子体生成期间A为5μsec,占空比为50%,调制频率为100kHz的情况。白色表示没有发生绝缘破坏的部分,黑色表示发生了绝缘破坏的部分。
如图6所示,面积比(C/D)为10万倍的情况下,使用通常的连续等离子体时,多数的元件上都发生绝缘破坏,没有绝缘破坏的元件仅有11%,但是使用脉冲等离子体时,等离子体生成期间A为40μsec时合格率为99%,等离子体生成期间A为5μsec时合格率为96%,充电损伤急剧减少。另外,如图7所示,面积比(C/D)为1万倍的情况下,使用通常的连续等离子体时,没有绝缘破坏的元件合格率为87%,与此相对,使用脉冲等离子体时,等离子体生成期间A为40μsec、5μsec的任一情况下,合格率都为100%,晶片面内的所有位置都没有发生充电损伤。
根据实施方式,即使占空比为50%,直到天线比(Antenna Ratio)为100k都可以获得大致100%的合格率。
在上述实施方式中,对能够防止充电损伤的发生的效果进行了说明,然而,通过使等离子体生成状态和等离子体非生成状态以规定周期交替重复,还具有能够使等离子体处理速度(蚀刻速率)的均匀性提高的效果。
在使用40MHz以上的高频率的高频、并且一直维持等离子体生成状态而进行蚀刻的现有的等离子体蚀刻装置中,一般来说具有晶片中心部的蚀刻速率较高而晶片周边部的蚀刻速率较低的倾向,从而产生问题。即,由从第一高频电源32输出的第一高频的电力产生的等离子体的密度分布,在晶片中心部较高,在晶片周边部较低。
但是,通过使等离子体生成状态和等离子体非生成状态以规定周期交替重复,能够抑制晶片中心部的蚀刻速率的上升,其结果,能够使晶片面内的蚀刻速率均匀。
此处,对在进行使用脉冲等离子体的蚀刻(脉冲蚀刻)、和维持等离子体生成状态的连续的现有的蚀刻(现有蚀刻)时,晶片各处的蚀刻速度的比较测定结果进行说明。
作为晶片,使用300mm晶片,对晶片表面的有机膜进行蚀刻。详细而言,使用图1所示的装置进行等离子体处理,在以下条件下进行等离子体蚀刻:腔室内压强:10mTorr;处理气体:N2/O2/CO;流量:120/60/100sccm;第一高频的频率:100MHz;第二高频的频率:3.2MHz;第二高频的电力:200W;处理时间:30秒。在脉冲蚀刻中,第一高频的等离子体生成期间A在此处适当地设为500μsec,等离子体生成期间A中的第一高频的高频电力的值为1500W,等离子体非生成期间B中的第一高频的高频电力的值0W,占空比为50%,调制频率(脉冲等离子体)适当地设为1kHz。另一方面,现有蚀刻中,第一高频的高频电力的值设为1500W。
其结果为,在现有蚀刻中面内均匀性为13.8%,而脉冲蚀刻中面内均匀性为9.5%,大幅提高。如此,由实验证明了,通过使等离子体生成状态和等离子体非生成状态以规定周期交替重复,能够使晶片面内的蚀刻速率变得均匀。另外,该比较测定中的等离子体生成期间A(500μsec)和调制频率的频率(1kHz),与上述说明的最适于防止充电损伤的等离子体生成期间A(2μsec以上100μsec以下,优选为2μsec以上50μsec以下)和调制频率的频率(5kHz~250kHz)不同。但是,很容易想到,如果是最适于防止充电损伤的等离子体生成期间A和调制频率,则也能够达到蚀刻速率的面内均匀性的提高。
另外,在上述实施方式中,对脉冲等离子体进行了说明,但是即使不是脉冲等离子体,只要等离子体生成状态和实质上的等离子体非生成状态以规定周期交替重复,就可以是本发明的一个方式。
另外,上述实施方式的等离子体处理装置是在基座12上施加主要用于生成等离子体的第一高频和主要用于引入离子的第二高频的RF下部双频施加型。但是,作为其他实施方式,也可是向下部电极施加一个用于生成等离子体的高频的类型的装置,省略图示。另外,也可以是向上部电极施加用于生成等离子体的高频的类型的装置,省略图示。在该情况下,也可以将用于引入离子的高频施加在下部电极上。另外,用于生成等离子体的高频的频率范围优选为30MHz~300MHz。
进一步,本发明也能够应用于等离子体CVD、等离子体氧化、等离子体氮化、溅射等其他等离子体处理装置。另外,本发明中的被处理体并不限于半导体晶片,也能够是用于平板显示器的各种基板、光掩模、CD基板、印刷基板等。
Claims (6)
1.一种等离子体蚀刻方法,其使用等离子体蚀刻装置,在处理空间中生成处理气体的等离子体对半导体基板实施蚀刻处理,该等离子体蚀刻装置包括:能够真空排气的处理容器;在所述处理容器内载置所述半导体基板的第一电极;在所述处理容器内与所述第一电极平行地相对并接地的第二电极;向所述第一电极与所述第二电极之间的所述处理空间供给包含O2气体的所述处理气体的处理气体供给部;和向所述第一电极施加具有100MHz以上的频率的第一高频的第一高频供电部,该等离子体蚀刻方法的特征在于,包括:
通过周期地重复第一期间和第二期间,对在栅极氧化膜上具有多晶硅膜的半导体基板进行蚀刻的步骤,
在所述第一期间中,来自所述第一高频供电部的高频电力以从所述处理气体生成等离子体的第一振幅被施加于所述第一电极,在所述第二期间中,所述高频电力以不生成等离子体的第二振幅被施加于所述第一电极,
所述第一期间的长度为2μsec~50μsec,所述第二期间的长度为2μsec以上,所述周期的长度为4μsec~200μsec。
2.一种等离子体蚀刻方法,其使用等离子体蚀刻装置,在处理空间中生成处理气体的等离子体对半导体基板实施蚀刻处理,该等离子体蚀刻装置包括:能够真空排气的处理容器;在所述处理容器内载置所述半导体基板的第一电极;在所述处理容器内与所述第一电极平行地相对并接地的第二电极;向所述第一电极与所述第二电极之间的所述处理空间供给包含O2气体的所述处理气体的处理气体供给部;向所述第一电极施加具有100MHz以上的频率的第一高频的第一高频供电部;和向所述第一电极施加具有适于离子引入的频率的第二高频的第二高频供电部,该等离子体蚀刻方法的特征在于,包括:
通过周期地重复第一期间和第二期间,对在栅极氧化膜上具有多晶硅膜的半导体基板进行蚀刻的步骤,
在所述第一期间中,来自所述第一高频供电部的高频电力以从所述处理气体生成等离子体的第一振幅被施加于所述第一电极,在所述第二期间中,所述高频电力以不生成等离子体的第二振幅被施加于所述第一电极,
所述第一期间的长度为2μsec~50μsec,所述第二期间的长度为2μsec以上,所述周期的长度为4μsec~200μsec。
3.一种等离子体蚀刻方法,其使用等离子体蚀刻装置,在处理空间中生成处理气体的等离子体对半导体基板实施蚀刻处理,该等离子体蚀刻装置包括:能够真空排气的处理容器;在所述处理容器内载置所述半导体基板的第一电极;在所述处理容器内与所述第一电极平行地相对并接地的第二电极;向所述第一电极与所述第二电极之间的所述处理空间供给包含O2气体的所述处理气体的处理气体供给部;和向所述第一电极施加具有30MHz以上的频率的第一高频的第一高频供电部,该等离子体蚀刻方法的特征在于,包括:
通过周期地重复第一期间和第二期间,对在栅极氧化膜上具有多晶硅膜的半导体基板进行蚀刻的步骤,
在所述第一期间中,在所述处理容器内从所述处理气体持续地生成等离子体,在所述第二期间中,不生成等离子体,
所述第一期间的长度为2μsec~50μsec,所述第二期间的长度为2μsec以上,所述周期的长度为4μsec~200μsec。
4.一种等离子体蚀刻方法,其使用等离子体蚀刻装置,在处理空间中生成处理气体的等离子体对半导体基板实施蚀刻处理,该等离子体蚀刻装置包括:能够真空排气的处理容器;在所述处理容器内载置所述半导体基板的第一电极;在所述处理容器内与所述第一电极平行地相对并接地的第二电极;向所述第一电极与所述第二电极之间的所述处理空间供给包含O2气体的所述处理气体的处理气体供给部;向所述第一电极施加具有100MHz以上的频率的第一高频的第一高频供电部;和向所述第一电极施加具有适于离子引入的频率的第二高频的第二高频供电部,该等离子体蚀刻方法的特征在于,包括:
通过周期地重复第一期间和第二期间,对在栅极氧化膜上具有多晶硅膜的半导体基板进行蚀刻的步骤,
在所述第一期间中,在所述处理容器内从所述处理气体持续地生成等离子体,在所述第二期间中,不生成等离子体,
所述第一期间的长度为2μsec~50μsec,所述第二期间的长度为2μsec以上,所述周期的长度为4μsec~200μsec。
5.一种等离子体蚀刻方法,其使用等离子体蚀刻装置,在处理空间中生成处理气体的等离子体对半导体基板实施蚀刻处理,该等离子体蚀刻装置包括:能够真空排气的处理容器;在所述处理容器内载置所述半导体基板的第一电极,该半导体基板具有作为被蚀刻膜的有机膜;在所述处理容器内与所述第一电极平行地相对并接地的第二电极;向所述第一电极与所述第二电极之间的所述处理空间供给包含N2气体、O2气体和CO气体的所述处理气体的处理气体供给部;向所述第一电极施加具有100MHz以上的频率的第一高频的第一高频供电部;和向所述第一电极施加具有适于离子引入的频率的第二高频的第二高频供电部,该等离子体蚀刻方法的特征在于:
第一期间和第二期间以4μsec~200μsec的周期交替地重复,
在该第一期间中被施加于所述第一电极的所述第一高频具有生成等离子体的第一振幅,并且该第一期间在每个周期为2μsec~50μsec,
在该第二期间中被施加于所述第一电极的所述第一高频具有实质上不生成等离子体的第二振幅,并且该第二期间在每个周期为2μsec以上。
6.一种等离子体蚀刻方法,其使用等离子体蚀刻装置,在处理空间中生成处理气体的等离子体对半导体基板实施蚀刻处理,该等离子体蚀刻装置包括:能够真空排气的处理容器;在所述处理容器内载置所述半导体基板的第一电极,该半导体基板具有作为被蚀刻膜的有机膜;在所述处理容器内与所述第一电极平行地相对并接地的第二电极;向所述第一电极与所述第二电极之间的所述处理空间供给包含N2气体、O2气体和CO气体的所述处理气体的处理气体供给部;向所述第一电极施加具有100MHz以上的频率的第一高频的第一高频供电部;和向所述第一电极施加具有适于离子引入的频率的第二高频的第二高频供电部,该等离子体蚀刻方法的特征在于:
在所述半导体基板的等离子体蚀刻期间,第一期间和第二期间以4μsec~200μsec的周期交替地重复,
在该第一期间中在所述处理容器内持续地生成所述处理气体的等离子体,该第一期间在每个周期为2μsec~50μsec,
在该第二期间中实质上不生成等离子体,该第二期间在每个周期为2μsec以上。
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