KR100622322B1 - 드라이버 회로, 수신기 회로, 및 신호 전송 버스 시스템 - Google Patents
드라이버 회로, 수신기 회로, 및 신호 전송 버스 시스템 Download PDFInfo
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Abstract
Description
본 발명의 드라이버 회로는, 신호 전송 라인 쌍의 중간점에서 발생할 수 있는 반사를 흡수하도록, 제 1 신호 전송 라인과 제 2 신호 전송 라인간에 접속되는 잡음 제거 저항을 포함하는데, 잡음 제거 저항은 직렬 연결의 2개 저항으로 구성될 수 있고 상기 2개 저항은 제 2 전원에 접속됨으로써, 상보 신호가 부재일 때 신호 전송 라인의 전위를 안정화하며 외부 전자기 간섭에 대한 면역성을 추가로 제공한다.
Claims (74)
- 제 1 전원으로부터 제 1 전위의 전력을 수신하며 제 2 전원으로부터 제 2 전위의 전력을 수신하고, 제 1 레벨과 제 2 레벨을 갖는 입력 신호를 수신하며, 상기 입력 신호에 응답하여, 상호 병렬이며 동일한 길이의 제 1 신호 전송 라인과 제 2 신호 전송 라인을 갖는 신호 전송 라인 쌍에 상보 신호를 공급하는 드라이버 회로로서,상기 입력 신호가 상기 제 1 레벨일 때, 상기 제 1 전원과 제 1 신호 전송 라인간의 제 1 전류 경로, 및 상기 제 2 전원과 제 2 신호 전송 라인간의 제 2 전류 경로를 형성하며,상기 입력 신호가 상기 제 2 레벨일 때, 상기 제 1 전류 경로 및 상기 제 2 전류 경로를 개방하고 상기 제 1 전원과 상기 제 2 전원간의 제 3 전류 경로를 형성하여 상기 신호 전송 라인 쌍을 바이패스하는 것을 특징으로 하는 드라이버 회로.
- 제 1 항에 있어서,상기 제 1 전원과 상기 제 1 신호 전송 라인간에 결합되며, 상기 입력 신호가 상기 제 1 레벨일 때 턴온되고 상기 입력 신호가 상기 제 2 레벨일 때 턴오프되고, 이에 따라 상기 제 1 전류 경로를 개폐하는 제 1 트랜지스터;상기 제 2 전원과 상기 제 2 신호 전송 라인간에 결합되며, 상기 입력 신호가 상기 제 1 레벨일 때 턴온되고 상기 입력 신호가 상기 제 2 레벨일 때 턴오프되고, 이에 따라 상기 제 2 전류 경로를 개폐하는 제 2 트랜지스터; 및상기 제 1 전원과 상기 제 2 전원간에 결합되며, 상기 입력 신호가 상기 제 2 레벨일 때 턴온되고 상기 입력 신호가 상기 제 1 레벨일 때 턴오프되고, 이에 따라 상기 제 3 전류 경로를 개폐하는 제 3 트랜지스터를 포함하는 것을 특징으로 하는 드라이버 회로.
- 제 2 항에 있어서,상기 제 1 신호 전송 라인 및 상기 제 2 신호 전송 라인은 종단 저항을 통하여 상호접속되며, 상기 제 3 트랜지스터는, 상기 제 1 트랜지스터의 온 저항 (on-resistance), 상기 제 2 트랜지스터의 온 저항, 상기 제 1 신호 전송 라인의 직류 저항, 상기 제 2 신호 전송 라인의 직류 저항, 및 상기 종단 저항의 저항값의 합과 실질적으로 동일한 온 저항을 갖는 것을 특징으로 하는 드라이버 회로.
- 제 2 항에 있어서,상기 제 1 트랜지스터는 상기 제 1 신호 전송 라인에 접속된 제 1 단자를 갖고 상기 제 2 트랜지스터는 상기 제 2 신호 전송 라인에 접속된 제 2 단자를 갖고, 상기 신호 전송 라인 쌍의 반사 잡음을 흡수하도록 상기 제 1 단자와 상기 제 2 단자간에 접속된 잡음 제거 저항을 더 포함하는 것을 특징으로 하는 드라이버 회로.
- 제 4 항에 있어서,상기 제 1 신호 전송 라인 및 상기 제 2 신호 전송 라인은 특성 임피던스를 갖고, 상기 잡음 제거 저항은 실질적으로 상기 특성 임피던스의 열배인 저항을 갖는 것을 특징으로 하는 드라이버 회로.
- 제 4 항에 있어서,상기 제 1 트랜지스터와 상기 제 1 전원간에 접속된 제 1 직렬 저항; 및상기 제 2 트랜지스터와 상기 제 2 전원간에 접속된 제 2 직렬 저항을 더 포함하고,상기 잡음 제거 저항은 상기 제 2 전원에 접속된 노드, 상기 신호 전송 라인과 상기 노드간에 접속된 제 1 잡음 제거 저항, 및 상기 노드와 상기 제 2 전원간에 접속된 제 2 잡음 제거 저항을 포함하며,제 1 직렬 저항, 제 2 직렬 저항, 제 1 잡음 제거 저항, 및 제 2 잡음 제거 저항은 실질적으로 동일한 저항값을 갖는 것을 특징으로 하는 드라이버 회로.
- 제 1 전원으로부터 제 1 전위의 전력을 수신하고, 제 2 전원으로부터 제 2 전위의 전력을 수신하며, 제 1 레벨과 제 2 레벨을 갖는 입력 신호를 수신하는 드라이버 회로; 및상호 병렬이며 동일한 길이를 갖고 특성 임피던스를 갖는, 제 1 신호 전송 라인 및 제 2 신호 전송 라인을 갖는 신호 전송 라인 쌍을 포함하는 신호 전송 버스 시스템으로서,상기 드라이버 회로는 상기 신호 전송 라인 쌍의 한 끝부에 접속되고,상기 드라이버 회로는,상기 입력 신호가 상기 제 1 레벨일 때, 상기 제 1 전원과 상기 제 1 신호 전송 라인간의 제 1 전류 경로, 및 상기 제 2 전원과 상기 제 2 신호 전송 라인간의 제 2 전류 경로를 형성하고, 이에 따라 상보 신호를 상기 신호 전송 라인 쌍에 인가하며,상기 입력 신호가 상기 제 2 레벨일 때, 상기 제 1 전류 경로 및 상기 제 2 전류 경로를 개방하며 상기 제 1 전원과 상기 제 2 전원간의 제 3 전류 경로를 형성하여 신호 전송 라인 쌍을 바이패스하고,상기 신호 전송 버스 시스템은,상기 신호 전송 라인 쌍의 다른 하나의 끝부에서 상기 제 1 신호 전송 라인과 제 2 신호 전송 라인을 상호접속하며, 상기 제 1 신호 전송 라인과 제 2 신호 전송 라인의 특성 임피던스와 정합하는 저항값을 갖는 종단 저항;상기 신호 전송 라인 쌍의 중간점에 배치되어, 드라이버 회로에 의해 공급되는 상보 신호의 일부를 상기 신호 전송 라인 쌍으로부터 전환하며, 상기 상보 신호의 전환된 부분은 상기 상보 신호가 상기 신호 전송 라인 쌍에서 실질적으로 교란되지 않고 진행될 정도로 작은 한 개 이상의 분기부;각 상기 분기부에 대하여, 상기 분기부에 결합되며 상기 분기부에 의해 전환되는 상보 신호의 일부를 감지하는 수신기 회로; 및상기 신호 전송 라인 쌍, 상기 종단 저항, 상기 드라이버 회로, 상기 분기부, 및 상기 수신기 회로를 지지하는 회로 기판을 더 포함하는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 7 항에 있어서,상기 수신기 회로는,상기 상보 신호의 전환된 일부를 수신하는 차동 입력 단자를 갖는 차동 증폭기; 및상기 차동 입력 단자간에 접속된 종단 트랜지스터를 포함하는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 8 항에 있어서,상기 종단 트랜지스터는 60 GHz 이상의 컷오프 주파수, 및 저항을 갖고,상기 차동 증폭기는, 상기 종단 트랜지스터의 저항과 결합하여 100㎰ 이하의 시정수를 발생시키는 입력 커패시턴스를 갖는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 7 항에 있어서,상기 드라이버 회로를 상기 제 1 전원에 접속하는 상기 제 1 전력 라인, 및 상기 드라이버 회로를 상기 제 2 전원에 접속하는 상기 제 2 전력 라인을 포함하는 전력 라인 쌍을 더 포함하며,제 1 전력 라인과 제 2 전력 라인은 동일한 길이로 상호 병렬인 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 10 항에 있어서,상기 제 1 전력 라인과 상기 제 2 전력 라인간에 접속된 바이패스 커패시터를 더 포함하는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 7 항에 있어서,상기 제 1 전원과 상기 제 2 전원중 적어도 한 개와 상기 드라이버 회로간에 접속되어 상기 드라이버 회로에 의한 전류 소모를 감소시키는 한 개 이상의 직렬 저항을 더 포함하는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 7 항에 있어서,상기 드라이버 회로와 상기 제 1 전원간에 접속된 제 1 직렬 저항; 및상기 드라이버 회로와 상기 제 2 전원간에 접속된 제 2 직렬 저항을 더 포함하고,상기 종단 저항은 상기 제 2 전원에 접속된 노드, 상기 제 1 신호 전송 라인과 상기 노드간에 접속된 제 1 종단 저항, 및 상기 노드와 상기 제 2 신호 전송 라인간에 접속된 제 2 종단 저항을 포함하며,상기 제 1 직렬 저항, 상기 제 2 직렬 저항, 상기 제 1 종단 저항, 및 상기 제 2 종단 저항은 실질적으로 동일한 저항값을 갖는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 7 항에 있어서,상기 분기부는,상기 수신기 회로와 상기 제 1 신호 전송 라인간에 접속된 제 1 분기 저항; 및상기 수신기 회로와 상기 제 2 신호 전송 라인간에 접속된 제 2 분기 저항을 포함하는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 14 항에 있어서,상기 제 1 분기 저항 및 상기 제 2 분기 저항은 400Ω이상의 저항값을 갖는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 14 항에 있어서,상기 분기부는 분기 전송 라인 쌍을 더 포함하되, 상기 분기 전송 라인 쌍은,상기 제 1 분기 저항을 상기 수신기 회로에 접속하는 제 1 분기 전송 라인; 및상기 제 2 분기 저항을 상기 수신기 회로에 접속하는 제 2 분기 전송 라인을 구비하며,상기 제 1 분기 전송 라인과 상기 제 2 분기 전송 라인은 동일한 길이이며 상호 병렬인 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 16 항에 있어서,동일한 회로 기판을 공유하는 복수의 개별 유닛을 포함하고,상기 개별 유닛 각각은 고유의 상기 신호 전송 라인 쌍, 고유의 상기 종단 저항, 고유의 상기 드라이버 회로, 고유의 상기 분기부, 및 고유의 상기 수신기 회로를 구비하며,상기 회로 기판은,상기 개별 유닛들중 한 개의 신호 전송 라인 쌍에서 상기 제 1 신호 전송 라인을 상기 제 2 신호 전송 라인으로부터 분리하는 제 1 절연층;상기 개별 유닛들중 또다른 한 개의 분기 전송 라인 쌍에서 상기 제 1 분기 전송 라인을 상기 제 2 분기 전송 라인으로부터 분리하는 제 2 절연층; 및상기 제 1 절연층 및 상기 제 2 절연층보다 각각 2배 이상 두껍고, 상기 개별 유닛들중 한 개의 신호 전송 라인 쌍을 상기 개별 유닛들중 상기 또다른 한 개의 분기 전송 라인 쌍으로부터 분리하는 제 3 절연층을 구비하며,제 3 절연층과 직교하는 방향에서 볼 때 상기 개별 유닛들중 상기 한 개의 신호 전송 라인 쌍은 상기 개별 유닛들중 또 다른 한 개의 상기 분기 전송 라인 쌍을 가로지르는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 7 항에 있어서,상기 수신기 회로는 상기 신호 전송 라인 쌍에 직접 접속되며 100 Ω이상의 입력 임피던스를 갖고 0.05 ㎊ 이하의 입력 커패시턴스를 갖는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 7 항에 있어서,상기 상보 신호는 에너지를 가지며, 상기 에너지의 9/10 이상은 상기 분기부에 의해 전환되지 않고 상기 신호 전송 라인 쌍에 남겨지는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 7 항에 있어서,상기 회로 기판은 상기 제 1 신호 전송 라인을 상기 제 2 신호 라인으로부터 분리하는 절연층을 구비하는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 7 항에 있어서,상기 회로 기판은 절연층을 구비하며, 상기 제 1 신호 전송 라인과 상기 제 2 신호 전송 라인은 상기 절연층상에 나란히 배치되는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 7 항에 있어서,동일한 회로 기판을 공유하는 복수의 개별 유닛을 포함하고,상기 개별 유닛 각각은 고유의 상기 신호 전송 라인 쌍, 고유의 상기 종단 저항, 고유의 상기 드라이버 회로, 고유의 상기 분기부, 및 고유의 상기 수신기 회로를 구비하는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 1 전원으로부터 제 1 전위의 전력을 수신하고, 제 2 전원으로부터 제 2 전위의 전력을 수신하며, 제 1 레벨과 제 2 레벨을 갖는 입력 신호를 수신하는 드라이버 회로;상호 병렬이며 동일한 길이를 갖고 특성 임피던스를 갖는 제 1 신호 전송 라인 및 제 2 신호 전송 라인을 갖는 신호 전송 라인 쌍; 및상기 드라이버 회로와 상기 신호 전송 라인 쌍간에 배치되며, 상기 드라이버 회로를 상기 신호 전송 라인 쌍의 중간점에 접속하는 분기부를 포함하는 신호 전송 버스 시스템으로서,상기 드라이버 회로는,상기 입력 신호가 상기 제 1 레벨일 때, 상기 제 1 전원과 상기 제 1 신호 전송 라인간의 제 1 전류 경로, 및 상기 제 2 전원과 상기 제 2 신호 전송 라인간의 제 2 전류 경로를 형성하고, 이에 따라 상보 신호를 상기 신호 전송 라인 쌍에 인가하며,상기 입력 신호가 상기 제 2 레벨일 때, 상기 제 1 전류 경로 및 상기 제 2 전류 경로를 개방하며 상기 제 1 전원과 상기 제 2 전원간의 제 3 전류 경로를 형성하여 신호 전송 라인 쌍을 바이패스하고,상기 신호 전송 버스 시스템은,상기 신호 전송 라인 쌍의 한 끝부에서 상기 제 1 신호 전송 라인과 제 2 전송 신호 라인을 상호접속하며, 상기 제 1 신호 전송 라인과 제 2 신호 전송 라인의 특성 임피던스와 정합하는 저항값을 갖는 종단 저항;상기 신호 전송 라인 쌍의 또다른 끝부에 접속되며, 상기 상보 신호를 감지하는 수신기 회로; 및상기 신호 전송 라인 쌍, 상기 종단 저항, 상기 드라이버 회로, 상기 분기부, 및 상기 수신기 회로를 지지하는 회로 기판을 더 포함하는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 23 항에 있어서,상기 드라이버 회로를 상기 제 1 전원에 접속하는 상기 제 1 전력 라인, 및 상기 드라이버 회로를 상기 제 2 전원에 접속하는 상기 제 2 전력 라인을 포함하는 전력 라인 쌍을 더 포함하며,제 1 전력 라인과 제 2 전력 라인은 동일한 길이이며 상호 병렬인 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 24 항에 있어서,상기 제 1 전력 라인과 상기 제 2 전력 라인간에 접속된 바이패스 커패시터를 더 포함하는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 23 항에 있어서,상기 제 1 전원과 상기 제 2 전원중 적어도 한 개와 상기 드라이버 회로간에 접속되어 상기 드라이버 회로에 의한 전류 소모를 감소시키는 한 개 이상의 직렬 저항을 더 포함하는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 23 항에 있어서,상기 드라이버 회로와 상기 제 1 전원간에 접속된 제 1 직렬 저항; 및상기 드라이버 회로와 상기 제 2 전원간에 접속된 제 2 직렬 저항을 더 포함하고,상기 종단 저항은 상기 제 2 전원에 접속된 노드, 상기 제 1 신호 전송 라인과 상기 노드간에 접속된 제 1 종단 저항, 및 상기 노드와 상기 제 2 신호 전송 라인간에 접속된 제 2 종단 저항을 포함하며,상기 제 1 직렬 저항, 상기 제 2 직렬 저항, 상기 제 1 종단 저항, 및 상기 제 2 종단 저항은 실질적으로 동일한 저항값을 갖는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 23 항에 있어서,상기 수신기 회로는, 상기 제 1 신호 전송 라인과 상기 제 2 신호 전송 라인을 상호접속하며 상기 제 1 신호 전송 라인과 상기 제 2 신호 전송 라인의 특성 임피던스와 정합하는 저항값을 갖는 입력 종단 저항을 포함하는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 23 항에 있어서,상기 신호 전송 라인 쌍에 접속되는 복수의 개별 유닛을 포함하고,상기 개별 유닛 각각은 고유의 상기 드라이버 회로 및 고유의 상기 분기부를 구비하고, 각각의 상기 분기부는 상기 드라이버 회로와 상기 신호 전송 라인 쌍간에 배치된 버스 트랜시버 회로를 구비하며,상기 버스 트랜시버 회로는,상기 드라이버 회로를 상기 제 1 신호 전송 라인에 접속하는 제 1 분기 트랜지스터; 및상기 드라이버 회로를 상기 제 2 신호 전송 라인에 접속하는 제 2 분기 트랜지스터를 포함하며,상기 제 1 분기 트랜지스터 및 상기 제 2 분기 트랜지스터는 한 번에 상기 개별 유닛들중 최대 하나의 유닛에서 턴온되는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 29 항에 있어서,각각의 상기 분기부는 분기 전송 라인 쌍을 더 포함하되, 상기 분기 전송 라인 쌍은,상기 제 1 분기 트랜지스터를 상기 드라이버 회로에 접속하는 제 1 분기 전송 라인; 및상기 제 2 분기 트랜지스터를 상기 드라이버 회로에 접속하는 제 2 분기 전송 라인을 구비하며,상기 제 1 분기 전송 라인과 상기 제 2 분기 전송 라인은 동일한 길이이며 상호 병렬인 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 30 항에 있어서,상기 제 1 분기 전송 라인 및 상기 제 2 분기 전송 라인은 실질적으로 상기 제 1 신호 전송 라인과 상기 제 2 신호 전송 라인의 특성 임피던스의 1/2와 동일한 특성 임피던스를 갖는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 30 항에 있어서,동일한 회로 기판을 공유하는 복수의 개별 수퍼 유닛 (super unit) 을 포함하고,상기 개별 수퍼 유닛 각각은 고유의 상기 신호 전송 라인 쌍, 고유의 상기 종단 저항, 고유의 상기 복수의 개별 유닛, 고유의 상기 수신기 회로를 구비하며,상기 회로 기판은,상기 개별 수퍼 유닛들중 한 개의 신호 전송 라인 쌍에서 상기 제 1 신호 전송 라인을 상기 제 2 신호 전송 라인으로부터 분리하는 제 1 절연층;상기 개별 수퍼 유닛들중 또다른 한 개의 분기 전송 라인 쌍에서 상기 제 1 분기 전송 라인을 상기 제 2 분기 전송 라인으로부터 분리하는 제 2 절연층; 및상기 제 1 절연층 및 상기 제 2 절연층보다 각각 2배 이상 두껍고, 상기 개별 수퍼 유닛들중 한 개의 신호 전송 라인 쌍을 상기 분기부의 상기 한 개의 분기 전송 라인 쌍으로부터 분리하는 제 3 절연층을 구비하며,제 3 절연층과 직교하는 방향에서 볼 때 상기 개별 수퍼 유닛들중 상기 한 개의 신호 전송 라인 쌍은 상기 분기부들중 상기 한 개의 분기 전송 라인 쌍을 가로지르는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 23 항에 있어서,상기 회로 기판은 상기 제 1 신호 전송 라인을 상기 제 2 신호 전송 라인으로부터 분리하는 절연층을 구비하는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 23 항에 있어서,상기 회로 기판은 절연층을 구비하며, 상기 제 1 신호 전송 라인 및 상기 제 2 전송 라인은 상기 절연층상에 나란히 배치되는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 23 항에 있어서,동일한 회로 기판을 공유하는 복수의 개별 유닛을 포함하고,상기 개별 유닛 각각은 고유의 상기 신호 전송 라인 쌍, 고유의 상기 종단 저항, 고유의 상기 드라이버 회로, 고유의 상기 분기부, 및 고유의 상기 수신기 회로를 구비하는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 1 신호 전송 라인과 제 2 신호 전송 라인을 구비하되 상기 제 1 신호 전송 라인과 상기 제 2 신호 전송 라인이 상호 병렬이며 동일한 길이이고 특성 임피던스를 갖는 신호 전송 라인 쌍;상기 신호 전송 라인 쌍의 한 끝부에서 상기 제 1 신호 전송 라인과 상기 제 2 신호 전송 라인을 상호접속하며, 상기 제 1 신호 전송 라인과 상기 제 2 신호 전송 라인의 특성 임피던스와 정합하는 저항값을 갖는 종단 저항;상기 신호 전송 라인 쌍의 또다른 끝부에 접속되며, 제 1 상보 신호를 상기 신호 전송 라인 쌍에 인가하는 제 1 드라이버 회로, 및 상기 신호 전송 라인 쌍으로부터 수신되는 제 2 상보 신호를 감지하는 제 1 수신기 회로를 포함하는 제 1 집적 회로 칩;상기 제 1 상보 신호가 상기 신호 전송 라인 쌍에서 실질적으로 교란되지 않고 진행될 수 있게 하면서, 상기 제 2 상보 신호를 상기 신호 전송 라인 쌍에 인가하는 제 2 드라이버 회로, 상기 신호 전송 라인 쌍의 상기 제 1 상보 신호를 감지하는 제 2 수신기 회로를 포함하는 한 개 이상의 제 2 집적 회로 칩;상기 제 2 집적 회로 칩 각각에 대하여, 상기 제 2 집적 회로 칩을 상기 신호 전송 라인 쌍의 중간점에 접속하는 분기부; 및상기 신호 전송 라인 쌍, 상기 종단 저항, 상기 제 1 집적 회로 칩, 상기 제 2 집적 회로 칩, 및 상기 분기부를 지지하는 회로 기판을 포함하며,상기 제 1 드라이버 회로 및 상기 제 2 드라이버 회로중 적어도 한 개는, 제 1 전원으로부터 제 1 전위의 전력을 수신하며 제 2 전원으로부터 제 2 전위의 전력을 수신하고 제 1 레벨과 제 2 레벨을 갖는 입력 신호를 수신하며,상기 입력 신호가 상기 제 1 레벨일 때, 상기 제 1 드라이버 회로 및 상기 제 2 드라이버 회로중 한 개는, 상기 제 1 전원과 상기 제 1 신호 전송 라인간의 제 1 전류 경로, 및 상기 제 2 전원과 상기 제 2 신호 전송 라인간의 제 2 전류 경로를 형성하고, 이에 따라 상기 제 1 상보 신호 및 상기 제 2 상보 신호중 대응하는 한 개를 상기 신호 전송 라인 쌍에 인가하며,상기 입력 신호가 제 2 레벨일 때, 상기 제 1 드라이버 회로 및 상기 제 2 드라이버 회로중 한 개는, 상기 제 1 전류 경로 및 제 2 전류 경로를 개방하고 상기 제 1 전원과 상기 제 2 전원간의 제 3 전류 경로를 형성하여 상기 신호 전송 라인 쌍을 바이패스하는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 36 항에 있어서,상기 제 2 수신기 회로는,상기 제 1 상보 신호를 수신하는 차동 입력 단자를 갖는 차동 증폭기; 및상기 차동 입력 단자간에 접속된 종단 트랜지스터를 포함하는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 37 항에 있어서,상기 종단 트랜지스터는 60 GHz 이상의 컷오프 주파수, 및 저항을 갖고,상기 차동 증폭기는, 상기 종단 트랜지스터의 저항과 결합하여 100 ㎰ 이하의 시정수를 발생시키는 입력 커패시턴스를 갖는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 36 항에 있어서,상기 제 1 드라이버 회로와 상기 제 2 드라이버 회로중 상기 한 개를 상기 제 1 전원에 접속하는 상기 제 1 전력 라인, 및 상기 제 1 드라이버 회로와 상기 제 2 드라이버 회로중 상기 한 개를 상기 제 2 전원에 접속하는 상기 제 2 전력 라인을 포함하는 전력 라인 쌍을 더 포함하며,제 1 전력 라인과 제 2 전력 라인은 동일한 길이로 상호 병렬인 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 39 항에 있어서,상기 제 1 전력 라인과 상기 제 2 전력 라인간에 접속된 바이패스 커패시터를 더 포함하는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 36 항에 있어서,상기 제 1 드라이버 회로와 상기 제 2 드라이버 회로중 상기 한 개 및 상기 제 1 전원과 상기 제 2 전원중 적어도 한 개간에 접속되어 상기 제 1 드라이버 회로와 상기 제 2 드라이버 회로중 상기 한 개에 의한 전류 소모를 감소시키는 한 개 이상의 직렬 저항을 더 포함하는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 36 항에 있어서,상기 제 1 드라이버 회로와 상기 제 2 드라이버 회로중 상기 한 개와, 상기 제 1 전원간에 접속된 제 1 직렬 저항; 및상기 제 1 드라이버 회로와 상기 제 2 드라이버 회로중 상기 한 개와, 상기 제 2 전원간에 접속된 제 2 직렬 저항을 더 포함하고,상기 종단 저항은, 상기 제 2 전원에 접속된 노드, 상기 제 1 신호 전송 라인과 상기 노드간에 접속된 제 1 종단 저항, 및 상기 노드와 상기 제 2 신호 전송 라인간에 접속된 제 2 종단 저항을 포함하며,상기 제 1 직렬 저항, 상기 제 2 직렬 저항, 상기 제 1 종단 저항, 및 상기 제 2 종단 저항은 실질적으로 동일한 저항값을 갖는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 36 항에 있어서,상기 제 1 집적 회로 칩은 집적 종단 저항 및 트랜지스터를 더 포함하고,상기 집적 종단 저항 및 트랜지스터는 상기 제 1 신호 전송 라인과 상기 제 2 신호 전송 라인간에 직렬로 접속되며,상기 집적 회로 저항은 상기 제 1 신호 전송 라인과 상기 제 2 신호 전송라인의 특성 임피던스와 정합하는 저항값을 갖고,상기 트랜지스터는 상기 제 1 수신기 회로가 상기 제 2 상보 신호를 감지할 때 턴온되고 상기 제 1 드라이버 회로가 상기 제 1 상보 신호를 상기 신호 전송 라인 쌍에 인가할 때 턴오프되는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 36 항에 있어서,상기 분기부는 버스 트랜시버 회로를 포함하되, 상기 버스 트랜시버 회로는,상기 제 1 신호 전송 라인과 상기 제 2 집적 회로 칩간에 접속된 제 1 분기 저항;상기 제 2 신호 전송 라인과 상기 제 2 집적 회로 칩간에 접속된 제 2 분기 저항;상기 제 1 분기 저항과 병렬로 접속된 제 1 분기 트랜지스터; 및상기 제 2 분기 저항과 병렬로 접속된 제 2 분기 트랜지스터를 구비하고,상기 제 1 분기 트랜지스터와 상기 제 2 분기 트랜지스터는 상기 제 2 드라이버 회로가 상기 제 2 상보 신호를 상기 신호 전송 라인 쌍에 인가할 수 있도록 턴온되고, 그 외의 경우에는 턴오프되는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 44 항에 있어서,상기 제 1 분기 저항 및 상기 제 2 분기 저항은 400Ω이상의 저항값을 각각 갖는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 44 항에 있어서,상기 분기부는 분기 전송 라인 쌍을 더 포함하고, 상기 분기 전송 라인 쌍은,상기 제 2 집적 회로 칩을 상기 제 1 분기 트랜지스터와 상기 제 1 분기 저항에 접속하는 제 1 분기 전송 라인; 및상기 제 2 집적 회로 칩을 상기 제 2 분기 트랜지스터와 상기 제 2 분기 저항에 접속하는 제 2 분기 전송 라인을 구비하고,상기 제 1 분기 전송 라인과 상기 제 2 분기 전송 라인은 상호 병렬이며 동일한 길이인 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 46 항에 있어서,동일한 회로 기판을 공유하는 복수의 개별 유닛을 포함하고,상기 개별 유닛 각각은 고유의 상기 신호 전송 라인 쌍, 고유의 상기 종단 저항, 고유의 상기 제 1 집적 회로 칩, 고유의 상기 분기부, 및 고유의 상기 제 2 집적 회로 칩을 구비하며,상기 회로 기판은,상기 개별 유닛들중 한 개의 신호 전송 라인 쌍에서 상기 제 1 신호 전송 라인을 상기 제 2 신호 전송 라인으로부터 분리하는 제 1 절연층;상기 개별 유닛들중 또다른 한 개의 분기 전송 라인 쌍에서 상기 제 1 분기 전송 라인을 상기 제 2 분기 전송 라인으로부터 분리하는 제 2 절연층; 및상기 제 1 절연층 및 상기 제 2 절연층보다 각각 2배 이상 두껍고, 상기 개별 유닛들중 상기 한 개의 신호 전송 라인 쌍을 상기 개별 유닛들중 상기 또다른 한 개의 분기 전송 라인 쌍으로부터 분리하는 제 3 절연층을 구비하며,제 3 절연층과 직교하는 방향에서 볼 때 상기 개별 유닛들중 상기 한 개의 신호 전송 라인 쌍은 상기 개별 유닛들중 상기 또 다른 한 개의 상기 분기 전송 라인 쌍을 가로지르는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 36 항에 있어서,상기 상보 신호는 에너지를 가지며, 상기 에너지의 9/10 이상은 상기 분기부에 의해 전환되지 않고 상기 신호 전송 라인 쌍에 남겨지는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 36 항에 있어서,상기 회로 기판은 상기 제 1 신호 전송 라인을 상기 제 2 신호 전송 라인으로부터 분리하는 절연층을 구비하는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 36 항에 있어서,상기 회로 기판은 절연층을 구비하며, 상기 제 1 신호 전송 라인과 상기 제 2 신호 전송 라인은 상기 절연층상에 나란히 배치되는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 36 항에 있어서,동일한 회로 기판을 공유하는 복수의 개별 유닛을 포함하고, 상기 개별 유닛 각각은 고유의 상기 신호 전송 라인 쌍, 고유의 상기 종단 저항, 고유의 상기 제 1 집적 회로 칩, 고유의 상기 분기부, 및 고유의 상기 제 2 집적 회로 칩을 구비하는 것을 특징으로 하는 신호 전송 버스 시스템.
- 상보 신호가 신호 전송 라인 쌍에서 실질적으로 교란되지 않고 진행되도록 하면서 상기 신호 전송 라인 쌍에서 전송되는 상기 상보 신호를 감지하되, 상기 신호 전송 라인 쌍은 서로 병렬이며 동일한 길이를 갖는 제 1 신호 전송 라인과 제 2 신호 전송 라인을 구비하고, 분기 저항 쌍을 통하여 상기 신호 전송 라인 쌍에 접속되는 수신기 회로로서,상기 분기 저항 쌍을 통하여 상기 신호 전송 라인 쌍에 접속되는 한 쌍의 차동 입력 단자를 구비하며, 상기 상보 신호를 감지하고, 상기 상보 신호의 존재 유무를 나타내는 출력 신호를 발생하는 차동 증폭기; 및상기 차동 입력 단자들간에 접속된 종단 트랜지스터를 포함하는 것을 특징으로 하는 수신기 회로.
- 제 52 항에 있어서,상기 수신기 회로는 전원으로부터 전력을 수신하고,상기 종단 트랜지스터는 상기 차동 입력 단자중 한 개에 접속된 소스 전극, 상기 차동 입력 단자들중 또다른 한 개에 접속된 드레인 전극, 및 상기 전원에 접속된 게이트 전극을 구비하는 전계효과 트랜지스터인 것을 특징으로 하는 수신기 회로.
- 상호 병렬이며 동일한 길이를 갖고 특성 임피던스를 갖는 제 1 신호 전송 라인 및 제 2 신호 전송 라인을 갖는 신호 전송 라인 쌍;상기 신호 전송 라인 쌍의 한 끝부에서 상기 제 1 신호 전송 라인과 제 2 신호 전송 라인을 상호접속하며, 상기 제 1 신호 전송 라인과 제 2 신호 전송 라인의 특성 임피던스와 정합하는 저항값을 갖는 종단 저항;상기 신호 전송 라인 쌍의 또다른 끝부에 접속되며, 상기 상보 신호를 상기 신호 전송 라인 쌍에 인가하는 드라이버 회로;상기 신호 전송 라인 쌍의 중간점에 배치되며 상기 드라이버 회로에 의해 공급되는 상보 신호의 일부를 상기 신호 전송 라인 쌍으로부터 전환하되, 상기 상보 신호의 전환된 부분은 상기 상보 신호가 상기 신호 전송 라인 쌍에서 실질적으로 교란되지 않고 진행될 정도로 작은, 한 개 이상의 분기부;각각의 상기 분기부에 대하여, 상기 분기부에 결합되며 상기 분기부에 의해 전환되는 상보 신호의 일부를 감지하는 수신기 회로; 및상기 신호 전송 라인 쌍, 상기 종단 저항, 상기 드라이버 회로, 상기 분기부, 및 상기 수신기 회로를 지지하는 회로 기판을 포함하고,한 개 이상의 상기 수신기 회로는,상기 분기부를 통하여 상기 신호 전송 라인 쌍에 접속되는 한 쌍의 차동 입력 단자를 구비하며, 상기 분기부에 의해 전환되는 상기 상보 신호의 일부를 감지하고, 상기 상보 신호의 존재 유무를 나타내는 출력 신호를 발생하는 차동 증폭기; 및상기 차동 입력 단자간에 접속된 종단 트랜지스터를 포함하는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 54 항에 있어서,한 개 이상의 상기 수신기 회로에서, 상기 종단 트랜지스터는 60 GHz 이상의 컷오프 주파수, 및 저항을 갖고, 상기 차동 증폭기는 상기 종단 트랜지스터의 저항과 결합하여 100 ㎰ 이하의 시정수를 발생시키는 입력 커패시턴스를 갖는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 54 항에 있어서,상기 분기부는,상기 수신기 회로와 상기 제 1 신호 전송 라인간에 접속된 제 1 분기 저항; 및상기 수신기 회로와 상기 제 2 신호 전송 라인간에 접속된 제 2 분기 저항을 포함하는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 56 항에 있어서,상기 제 1 분기 저항 및 제 2 분기 저항은 400 Ω이상의 저항값을 갖는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 56 항에 있어서,상기 분기부는 분기 전송 라인 쌍을 더 포함하되, 상기 분기 전송 라인 쌍은,상기 제 1 분기 저항을 상기 수신기 회로에 접속하는 제 1 분기 전송 라인; 및상기 제 2 분기 저항을 상기 수신기 회로에 접속하는 제 2 분기 전송 라인을 구비하며,상기 제 1 분기 전송 라인과 상기 제 2 분기 전송 라인은 동일한 길이이며 상호 병렬인 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 58 항에 있어서,동일한 회로 기판을 공유하는 복수의 개별 유닛을 포함하고,상기 개별 유닛 각각은 고유의 상기 신호 전송 라인 쌍, 고유의 상기 종단 저항, 고유의 상기 드라이버 회로, 고유의 상기 분기부, 및 고유의 상기 수신기 회로를 구비하며,상기 회로 기판은,상기 개별 유닛들중 한 개의 신호 전송 라인 쌍에서 상기 제 1 신호 전송 라인을 상기 제 2 신호 전송 라인으로부터 분리하는 제 1 절연층;상기 개별 유닛들중 또다른 한 개의 분기 전송 라인 쌍에서 상기 제 1 분기 전송 라인을 상기 제 2 분기 전송 라인으로부터 분리하는 제 2 절연층; 및상기 제 1 절연층 및 상기 제 2 절연층보다 각각 2배 이상 두껍고, 상기 개별 유닛들중 상기 한 개의 신호 전송 라인 쌍을 상기 개별 유닛들중 상기 또다른 한 개의 분기 전송 라인 쌍으로부터 분리하는 제 3 절연층을 구비하며,제 3 절연층과 직교하는 방향에서 볼 때 상기 개별 유닛들중 상기 한 개의 신호 전송 라인 쌍은 상기 개별 유닛들중 상기 또다른 한 개의 분기 전송 라인 쌍을 가로지르는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 54 항에 있어서,상기 상보 신호는 에너지를 가지며, 상기 에너지의 9/10 이상은 상기 분기부에 의해 전환되지 않고 상기 신호 전송 라인 쌍에 남겨지는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 54 항에 있어서,상기 회로 기판은 상기 제 1 신호 전송 라인을 상기 제 2 신호 전송 라인으로부터 분리하는 절연층을 구비하는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 54 항에 있어서,상기 회로 기판은 절연층을 구비하고, 상기 제 1 신호 전송 라인 및 제 2 신호 전송 라인은 상기 절연층상에 나란히 배치되는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 54 항에 있어서,동일한 회로 기판을 공유하는 복수의 개별 유닛을 포함하고,상기 개별 유닛 각각은 고유의 상기 신호 전송 라인 쌍, 고유의 상기 종단 저항, 고유의 상기 드라이버 회로, 고유의 상기 분기부, 및 고유의 상기 수신기 회로를 구비하는 것을 특징으로 하는 신호 전송 버스 시스템.
- 상호 병렬이며 동일한 길이를 갖고 특성 임피던스를 갖는 제 1 신호 전송 라인 및 제 2 신호 전송 라인을 갖는 신호 전송 라인 쌍;상기 신호 전송 라인 쌍의 한 끝부에서 상기 제 1 신호 전송 라인과 제 2 신호 전송 라인을 상호접속하며, 상기 제 1 신호 전송 라인과 제 2 신호 전송 라인의 특성 임피던스와 정합하는 저항값을 갖는 종단 저항;제 1 상보 신호를 상기 신호 전송 라인 쌍에 인가하는 제 1 드라이버 회로, 및 상기 신호 전송 라인 쌍으로부터 수신되는 제 2 상보 신호를 감지하는 제 1 수신기 회로를 포함하고, 상기 신호 전송 라인 쌍의 또다른 끝부에 접속되는 제 1 집적 회로 칩;상기 제 1 상보 신호가 상기 신호 전송 라인 쌍에서 실질적으로 교란되지 않고 진행될 수 있게 하면서, 상기 제 2 상보 신호를 상기 신호 전송 라인 쌍에 인가하는 제 2 드라이버 회로, 및 상기 신호 전송 라인 쌍의 상기 제 1 상보 신호를 감지하는 제 2 수신기 회로를 포함하는 한 개 이상의 제 2 집적 회로 칩;상기 제 2 집적 회로 칩 각각에 대하여, 상기 제 2 집적 회로 칩을 상기 신호 전송 라인 쌍의 중간점에 접속하는 분기부; 및상기 신호 전송 라인 쌍, 상기 종단 저항, 상기 제 1 집적 회로 칩, 상기 제 2 집적 회로 칩, 및 상기 분기부를 지지하는 회로 기판을 포함하며,상기 제 2 수신기 회로는,상기 분기부를 통하여 상기 신호 전송 라인 쌍에 접속되는 한 쌍의 차동 입력 단자를 구비하며, 상기 제 1 상보 신호를 감지하고, 상기 제 1 상보 신호의 존재 유무를 나타내는 출력 신호를 발생하는 차동 증폭기; 및상기 차동 입력 단자들간에 접속된 종단 트랜지스터를 포함하는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 64 항에 있어서,상기 제 1 집적 회로 칩은 집적 종단 저항 및 트랜지스터를 더 포함하고, 상기 집적 종단 저항과 트랜지스터는 상기 제 1 신호 전송 라인과 상기 제 2 신호 전송 라인간에 직렬로 접속되며, 상기 집적 종단 저항은 상기 제 1 신호 전송 라인과 상기 제 2 신호 전송 라인의 특성 임피던스와 정합하는 저항값을 갖고,상기 트랜지스터는, 상기 제 1 수신기 회로가 상기 제 2 상보 신호를 감지할 때 턴온되며, 상기 제 1 드라이버 회로가 상기 제 1 상보 신호를 상기 신호 전송 라인 쌍에 인가할 때 턴오프되는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 64 항에 있어서,상기 제 2 수신기 회로에서, 상기 종단 트랜지스터는 60 GHz 이상의 컷오프 주파수, 및 저항을 갖고,상기 차동 증폭기는, 상기 종단 트랜지스터의 저항과 결합하여 100㎰ 이하의 시정수를 발생시키는 입력 커패시턴스를 갖는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 64 항에 있어서,상기 분기부는 버스 트랜시버 회로를 포함하고, 상기 버스 트랜시버 회로는,상기 제 1 신호 전송 라인과 상기 제 2 집적 회로 칩간에 접속된 제 1 분기 저항;상기 제 2 신호 전송 라인과 상기 제 2 집적 회로 칩간에 접속된 제 2 분기 저항;상기 제 1 분기 저항과 병렬로 접속된 제 1 분기 트랜지스터; 및상기 제 2 분기 저항과 병렬로 접속된 제 2 분기 트랜지스터를 구비하고,상기 제 1 분기 트랜지스터와 상기 제 2 분기 트랜지스터는 상기 제 2 드라이버 회로가 상기 제 2 상보 신호를 상기 신호 전송 라인 쌍에 인가할 수 있도록 턴온되고, 그 외의 시간에 턴오프되는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 67 항에 있어서,상기 제 1 분기 저항 및 상기 제 2 분기 저항은 400Ω이상의 저항값을 각각 갖는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 67 항에 있어서,상기 분기부는 분기 전송 라인 쌍을 더 포함하고, 상기 분기 전송 라인 쌍은,상기 제 2 집적 회로 칩을 상기 제 1 분기 트랜지스터에 접속하는 제 1 분기 전송 라인; 및상기 제 2 집적 회로 칩을 상기 제 2 분기 트랜지스터와 상기 제 2 분기 저항에 접속하는 제 2 분기 전송 라인을 구비하며,상기 제 1 분기 전송 라인과 상기 제 2 분기 전송 라인은 동일한 길이이며 상호 병렬인 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 69 항에 있어서,동일한 회로 기판을 공유하는 복수의 개별 유닛을 포함하고,상기 개별 유닛 각각은 고유의 상기 신호 전송 라인 쌍, 고유의 상기 종단 저항, 고유의 상기 제 1 집적 회로 칩, 고유의 상기 분기부, 및 고유의 상기 제 2 집적 회로 칩을 구비하고,상기 회로 기판은,상기 개별 유닛들중 한 개의 신호 전송 라인 쌍에서 상기 제 1 신호 전송 라인을 상기 제 2 신호 전송 라인으로부터 분리하는 제 1 절연층;상기 개별 유닛들중 또다른 한 개의 분기부의 분기 전송 라인 쌍에서 상기 제 1 분기 전송 라인을 상기 제 2 분기 전송 라인으로부터 분리하는 제 2 절연층; 및상기 제 1 절연층 및 상기 제 2 절연층보다 각각 2배 이상 두껍고, 상기 개별 유닛들중 상기 한 개의 신호 전송 라인 쌍을 상기 개별 유닛들중 상기 또다른 한 개의 분기 전송 라인 쌍으로부터 분리하는 제 3 절연층을 구비하며,제 3 절연층과 직교하는 방향에서 볼 때 상기 개별 유닛들중 상기 한 개의 신호 전송 라인 쌍은 상기 개별 유닛들중 상기 또다른 한 개의 분기 전송 라인 쌍을 가로지르는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 64 항에 있어서,상기 상보 신호는 에너지를 가지며, 상기 에너지의 9/10 이상은 상기 분기부에 의해 전환되지 않고 상기 신호 전송 라인 쌍에 남겨지는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 64 항에 있어서,상기 회로 기판은 상기 제 1 신호 전송 라인을 상기 제 2 신호 전송 라인으로부터 분리하는 절연층을 구비하는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 64 항에 있어서,상기 회로 기판은 절연층을 구비하며, 상기 제 1 신호 전송 라인과 상기 제 2 신호 전송 라인은 상기 절연층상에 나란히 배치되는 것을 특징으로 하는 신호 전송 버스 시스템.
- 제 64 항에 있어서,동일한 회로 기판을 공유하는 복수의 개별 유닛을 포함하고,상기 개별 유닛 각각은 고유의 상기 신호 전송 라인 쌍, 고유의 상기 종단 저항, 고유의 상기 제 1 집적 회로 칩, 고유의 상기 분기부, 및 고유의 상기 제 2 집적 회로 칩을 구비하는 것을 특징으로 하는 신호 전송 버스 시스템.
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