JPH07169926A - 疑似基板構造体及びその製造方法 - Google Patents
疑似基板構造体及びその製造方法Info
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Abstract
る。 【構成】絶縁体上のシリコンは、充分に緩衝されたSi
Ge18バッファ層の成長のために基板として使用され
る。新しい応力軽減機構が働き、SiGe層中で一連の
転位が発生することなくSiGe層は緩衝する。これ
は、表面的なシリコンの厚みのSOI基板上にSiGe
を付着することによって達成される。まず初めに、シリ
コン層中に引張りひずみを作り出すことによって、Si
Ge層中の引張りひずみは、薄いシリコン層14の引張
りひずみと等しくなる。その薄いシリコン層中に形成さ
れる応力は、アニール中に塑性変形により緩衝される。
転位が生じ、薄いシリコン層中にてすべるので、一連の
転位は、それより上のSiGe物質中には生じない。ヘ
テロ構造のための引張りひずみシリコン層20は、Si
Ge物質上に形成される。
Description
するものである。さらに詳しく述べると、ヘテロ構造に
基づく引張りひずみのあるシリコン(以下、引張りひず
みシリコンという)の製造のための、引張りひずみシリ
コン層が成長する疑似構造(pseudo struc
ture)に関する発明である。
いて、高移動度構造を得るために、引張りシリコン疑似
構造を用いる技術は高いレベルとなっている。従来、こ
れを具現する方法は、緩衝SiGeバッファ上における
引張りひずみシリコン層を成長させるためのものだっ
た。この構造においては、SiGe層へのドーピング
は、引張りひずみシリコン・チャネルに変調ドーピング
をきたす。何年にもわたるバッファ層に関する絶え間な
い改善の結果、チャネル電子の移動度は、4.2゜kに
おいて150,000cm2/Vs以上に増加した。し
かし、これらの厚いバッファ層の成長に対していくつか
の不利な点がある。第一に、一般的に1ミクロンないし
数ミクロンの厚さなので、それらをシリコン技術に統合
するのは容易なことではない。第二に、これらの厚いバ
ッファにおける欠陥密度は依然として高く、約104/
cm2ないし107/cm2で、これは、実際の超大規模
集積回路にとって非常に高い値である。第三に、引張り
ひずみシリコン、引張りひずみのないシリコンやSiG
eでできているデバイス回路は統合するのが難しいの
で、その構造は、SiGeの選択成長を妨げる。引張り
ひずみシリコン・チャネルは高い移動度のホール・チャネ
ルとして使用できないし、相補形MOSの適用例は、効
率的に利用できないので、これは必要であろう。最後
に、高い残留欠陥密度は、最も高い移動度を得ることを
妨げる。電界効果トランジスタ以外にも、単一層タイプ
の格子や共鳴トンネル・ダイオードにおける折畳み(f
olding)ゾーンのような他の構造に対して、緩衝
されたバッファ層において利益をもたらす。
するために、従来は、一様な傾斜つきの、または階段状
になっているSiGe層を準安定臨界厚み(それを越え
ると、応力を軽減する転位が生じるような厚み)を越え
る厚さまで、成長させ、SiGe層において関連する一
連の(threading)転位を伴う適合しない(m
isfit)転位を形成させていた。さまざまなバッフ
ァ構造は、その構造における適合しない転位部分の伸長
のため、そして、それによって一連の転位密度を下げる
ために使用されている。
ロ構造の製造のために引張りひずみシリコン層を作成す
ることである。
るとても緩衝されていて欠陥のないシリコンと異なる格
子定数を持つ半導体の層を有する疑似基板を供給するこ
とである。
の作成方法を提供することである。
ウム層中に転位注入することをせずに、圧倒的に緩衝さ
れたシリコン・ゲルマニウム層を作成することである。
ニウム中に転位注入することをせずに、シリコン層上に
シリコン・ゲルマニウム層を作成する方法を提供するこ
とである。
板構造体は、半導体ベース層、そのベース層上の非晶質
物の層、非晶質物の層上のシリコン層、そして、そのシ
リコン層上に仮像のように成長したシリコン層とは異な
る格子定数を持つ半導体を含む。そして、その構造体
は、シリコンとは異なる格子定数を持つ表面を有する層
状構造を形成するために一緒にアニールされる。該構造
体は、シリコンとは異なる格子定数を持つ絶縁体上にあ
るシリコン層を含む半導体のベースを含んでいてよい。
該絶縁体は二酸化ケイ素であってよい。該成長した半導
体はシリコンとゲルマニウムを含んでいてよい。ヘテロ
構造の組み立てのため、シリコンの引張りひずみ層は、
その成長した半導体の層上に形成される。
体ベース層上の非晶質物の層、および該非晶質物の層上
のシリコン層を供給することにより半導体構造を製造
し、該シリコン層上にシリコン層とは異なる格子定数を
持つ半導体を仮像のように(pseudomorphi
cally)成長させ、シリコンより大きい格子定数を
持つ表面を有し、層状構造を形成するためにすべての層
を一緒にアニールすることを含む。その非晶質物とは二
酸化ケイ素である。その成長した半導体はシリコンとゲ
ルマニウムを含んでいる。引張りひずみ半導体層は、上
記半導体層の表面上に成長してもよい。その引張りひず
み半導体層は、シリコンでもよい。
SiGeバッファ層の成長のために基板として使用され
る。新しい応力軽減機構が働き、SiGe層中で一連の
転位が発生することなくSiGe層は緩衝する。これ
は、表面的なシリコンの厚みのSOI基板上にSiGe
を付着することによって達成される。まず初めに、シリ
コン層中に引張りひずみを作り出すことによって、Si
Ge層中の引張りひずみは、薄いシリコン層の引張りひ
ずみと等しくなる。その薄いシリコン層中に形成される
応力は、アニール中に塑性変形により緩衝される。転位
が生じ、薄いシリコン層中にてすべるので、一連の転位
は、それより上のSiGe物質中には生じない。ヘテロ
構造のための引張りひずみシリコン層は、SiGe物質
上に形成される。
方体の(言いかえれば緩衝された)SiGe層が供給され
るので、緩衝が生じるためにSiGe層中で転位を生じ
させる必要がない。もし、自由空間において薄い(50
nmの)シリコン薄膜が同じ厚さのSiGe物質上に置
かれれば、2つの層における同じ大きさの、そして逆方
向の引張り(Siにおける引張りとSiGeにおける圧
縮)が生じるので、SiとSiGeの2層における引張
りは等しくなる。SiGe層の厚みが増すと、SiGe
層からSi層へ次式に示すようにより大きな歪みが伝達
される。
n),G=剪断弾性係数,n=ポアソン比,e=すべり,h=層
の厚みである。SiGe層がシリコン層よりかなり厚い
2重膜を作ることにより、SiGe物質中に転位注入す
ることなしにかなり緩衝されたSiGeが供給される。
常に難しい。実際的には機械的な抵抗力がないので、そ
の作成された2層は応力の存在のためねじ曲がってしま
う。これらの問題を解決するために、図1を参照する。
シリコン基板10の上に、二酸化ケイ素のような絶縁層
12を形成する。しかし、この層は、他の酸化物、窒化
物、炭化物から形成され得る。サファイアでも可能であ
る。層12の厚さのとりうる値は、かなり広い幅にわた
る。薄いシリコン層はその上に形成される。シリコン/
支持構造体界面においてすべりを生じさせ、また、その
構造体に機械的な力を与える物質によって、シリコン層
14は支えられる。このようにして、シリコンの疑似薄
膜構造体ができる。支持構造体として酸化物層を用いる
と、正しい特徴を生じるばかりでなく、SOI構造(絶
縁体の上にシリコンがある)のすべての利点が、その後
に作成される構造に存在することになる。
(0<x<1)はシリコン層14の上に形成される。
14を含むSOI(シリコン・オン・インシュレータ)
(基本的には、サファイア層の上にシリコン層を持つシ
リコン・オン・サファイアのウェーハ)ウェーハが、初
期材料として使用される。SIMOXやBESOIなど
のいくつかの技術のうちの1つによって、このウェーハ
は作成される。シリコン層14はとても薄く、約50n
mの厚さとすることができるし、アプリケーションに応
じて、その厚みは、2nmから500nmの間とするこ
とができる。そのような薄膜の製造方法は次の通りであ
る。即ち、極めて薄いSOI構造の製造、またはSOI
ウェーハの層14の酸化の後でその酸化でできるトップ
のSiO2をエッチングする方法である。しかしなが
ら、このSi層に求められる厚さは、使用されるGeの
割合に左右される。層16のGeが15%ならばSi層
は50nmでよい。しかし、層16のGeが30%な
ら、シリコン層14の厚さは約20nmになる。
の上において、SiGeは、このような液相成長または
超高真空化学気相付着または、固体をソースとする分子
線エピタキシのような他の低温プロセスによりエピタキ
シャル成長する。これは、少なくとも2つの方法により
成すことができる。第一の技術を用いると、低温(50
0℃)で成長し、準安定の臨界厚み未満の厚さにまで達
する。そのサンプルは、約700℃を越える温度でアニ
ールされる。シリコン層14と絶縁層12との界面にお
けるすべり(又は層12におけるフロー)により、Si
Ge層16の緩衝が生じる。いずれにしても、そのよう
なすべりやフローが生じるためには、アニールは十分高
い温度で成されなければならない。もっと緩衝させるた
めには、SiGeを付着し、次いで再びアニールしても
よい。
約700℃を越える成長温度に置いて、任意の厚さ(通
常は約300nmまたは、シリコン層14の10倍の厚
さ)にまで成長させることができ,これによってかなり
緩衝されたバッファ層を提供することができる。
に対して高温アニール処理を施すことができる。高温ア
ニール処理が施されると、層16から層14へゲルマニ
ウムが拡散し、2つの層がマージして、実質的に均一な
組成を持つが、図1の層16よりゲルマニウム含有率は
少ないSiGe層18が出来上がる。例えば、Si層1
4が10nmの厚みで、Geを30%含むSi層16が
20nmの厚みならば、高温アニール処理(1150℃〜
1200℃、またはより低温で且つそれに応じてより長
時間で)すると、その結果できる引張りが緩衝されたS
iGe層18は、20%のゲルマニウムを含み約30n
mの厚みとなる。
子線エピタキシのようなより低温のエピタキシにより、
引張りひずみシリコン層20の成長のための疑似絶縁構
造として機能する。層20は、上述のヘテロ構造のよう
なデバイスが実際に形成される層である。
ない仮像の(pseudomorphic)SiGe層
がSOI材料上に形成される。引張りひずみシリコン層
は、SiGe層上に成長させることができる。緩衝され
たSiGe構造体は、高温アニール処理に耐え得る。仮
像の緩衝されたSiGe構造体は、超大規模集積回路に
適合することができる。
説明したが、本発明の範囲および主旨から離れることな
く形式や細部において変化が生じ得るということは、当
業者によって理解され得ることである。特に、他の半導
体は、SiやSiGeの代用となり得るし、他の物質は
SiO2の代用となり得る。
のない仮像の(pseudomorphic)SiGe
層がSOI材料上に形成される。
概略図。
ン層,16:Si1-xGex層,18:SiGe,20:引張り
ひずみシリコン層
Claims (26)
- 【請求項1】第一の支持層と、 上記支持層上に位置し、上記支持層との間で、界面を画
定する第一の結晶層と、 上記第一の結晶層上に位置し、上記第一の結晶層とは異
なる格子定数を持つ第二の半導体層とを含み、 上記支持層のフロー及び、上記界面でのすべりのうち少
なくとも一方の結果、上記第一の結晶層と上記第二の半
導体層において上記支持層が応力の軽減を可能とするこ
とを特徴とする疑似基板構造体。 - 【請求項2】上記第二の半導体層における応力軽減の結
果、上記第一の結晶層に応力がもたらされることを特徴
とする請求項1記載の疑似基板構造体。 - 【請求項3】上記第一の結晶層は、上記第二の半導体層
とは異なる半導体から成ることを特徴とする請求項1記
載の疑似基板構造体。 - 【請求項4】上記支持層を支持するための別の層を含む
ことを特徴とする請求項1記載の疑似基板構造体。 - 【請求項5】半導体ベース層と、 上記ベース層上にある第二の物質の層と、 上記第二の層上にあるシリコン層と、 上記シリコン層上に仮像的に成長した上記シリコン層と
は異なる格子定数の半導体とを含み、 上記すべての層は一緒にアニールされて、シリコンとは
異なる格子定数の表面を有する層状構造が形成されてい
ることを特徴とする疑似基板構造体。 - 【請求項6】半導体ベース層と、 上記半導体ベース層上にある物質の第二の層と、 上記第二の層上にあるシリコン層と、 上記シリコン層とは異なる格子定数を持ち、シリコンと
は異なる格子定数の表面を有する層状構造を形成するべ
く上記シリコン層上で高温で成長させられる半導体を有
する疑似基板構造体。 - 【請求項7】シリコンとは異なる格子定数を持つ絶縁体
上のシリコン層を含む半導体ベースと、 上記シリコン層上に仮像的に成長したシリコンとは異な
る格子定数を持つ半導体を有し、 上記すべての層は一緒にアニールされて、シリコンとは
異なる格子定数の表面を有する層状構造が形成されてい
ることを特徴とする疑似基板構造体。 - 【請求項8】シリコンとは格子定数の異なる絶縁体上に
あるシリコン層を含む半導体ベースと、シリコンとは格
子定数の異なる半導体であって、上記シリコン層上で高
温で成長して、シリコンとは異なる格子定数の表面を有
する層状構造を形成する半導体を含む疑似基板構造体。 - 【請求項9】上記成長した半導体は、SiGeより成る
ことを特徴とする 請求項5ないし8いずれか1つに記
載の疑似基板構造体。 - 【請求項10】上記物質は、酸化物、窒化物、炭化物か
ら成るグループから選択されることを特徴とする請求項
5ないし6いずれか1つに記載の疑似基板構造体。 - 【請求項11】上記絶縁体がサファイアであることを特
徴とする請求項7ないし8いずれか1つに記載の疑似基
板構造体。 - 【請求項12】さらに、上記表面上に引張りひずみ半導
体層を含むことを特徴とする請求項5ないし8いずれか
1つに記載の疑似基板構造体。 - 【請求項13】上記引張りひずみ半導体がシリコンを含
むことを特徴とする請求項12に記載の疑似基板構造
体。 - 【請求項14】第一の支持層との間で界面を画定する第
一の結晶層を上記第一の支持層上に持つ第一の構造体を
提供し、 上記第一の結晶層とは異なる格子定数を持つ第二の半導
体層を上記第一の結晶層上に提供し、 上記支持層のフロー及び、上記界面でのすべりのうち少
なくとも一方の結果、上記第一の結晶層と上記第二の半
導体層において応力の軽減を可能とするステップを含む
ことを特徴とする半導体構造の製造方法。 - 【請求項15】上記第二の半導体層における応力軽減の
結果、上記第一の結晶層に応力がもたらされることを特
徴とする請求項14に記載の製造方法。 - 【請求項16】上記第一の結晶層は、上記第二の半導体
層とは異なる半導体から成ることを特徴とする請求項1
4に記載の製造方法。 - 【請求項17】上記第一の構造は、上記第一の支持層を
支持するための別の層を含むことを特徴とする請求項1
4に記載の製造方法。 - 【請求項18】半導体ベース層を供給し、 上記半導体ベース層上に物質の第二の層を形成し、 上記第二の層上にシリコン層を形成し、 上記シリコン層上の仮像的な上記シリコン層と異なる格
子定数を持つ半導体を成長させ、 上記すべての層を一緒にアニールし、シリコンと異なる
格子定数の表面を有する層状構造を形成するステップを
含むことを特徴とする半導体構造の製造方法。 - 【請求項19】半導体ベース層を供給し、 上記半導体ベース層上に物質の第二の層を形成し、 上記シリコン層上で高温で、上記シリコン層と異なる格
子定数を持つ半導体を成長させ、シリコンとは異なる格
子定数の表面を有する層状構造を形成するステップを含
むことを特徴とする半導体構造の製造方法。 - 【請求項20】シリコンとは異なる格子定数の絶縁体上
にシリコン層を含む半導体ベースを供給し、 上記シリコン層上の仮像的な上記シリコン層と異なる格
子定数を持つ半導体を成長させ、 上記すべての層を一緒にアニールし、シリコンと異なる
格子定数の表面を有する層状構造を形成するステップを
含むことを特徴とする半導体構造の製造方法。 - 【請求項21】シリコンとは異なる格子定数の絶縁体上
にシリコン層を含む半導体ベースを供給し、 上記シリコン層上で高温で、上記シリコン層と異なる格
子定数を持つ半導体を形成し、 シリコンと異なる格子
定数の表面を有する層状構造を形成するステップを含む
ことを特徴とする半導体構造の製造方法。 - 【請求項22】上記の成長した半導体がSiGeを含む
ことを特徴とする請求項18ないし21いずれか1つに
記載の製造方法。 - 【請求項23】上記非晶質物が、酸化物、窒化物、炭化
物から成るグループから選択されることを特徴とする請
求項18ないし19いずれか1つに記載の製造方法。 - 【請求項24】上記絶縁体がサファイアであることを特
徴とする請求項20ないし21いずれか1つに記載の製
造方法。 - 【請求項25】上記表面上に引張りひずみ半導体を成長
させるステップを含むことを特徴とする請求項18ない
し21いずれか1つに記載の製造方法。 - 【請求項26】上記引張りひずみ半導体はシリコンであ
ることを特徴とする請求項25に記載の製造方法。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US145986 | 1993-10-29 | ||
US08/145,986 US5461243A (en) | 1993-10-29 | 1993-10-29 | Substrate for tensilely strained semiconductor |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH07169926A true JPH07169926A (ja) | 1995-07-04 |
JP2694120B2 JP2694120B2 (ja) | 1997-12-24 |
Family
ID=22515433
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP6246426A Expired - Fee Related JP2694120B2 (ja) | 1993-10-29 | 1994-10-12 | 疑似基板構造体 |
Country Status (3)
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---|---|
US (2) | US5461243A (ja) |
EP (1) | EP0651439A2 (ja) |
JP (1) | JP2694120B2 (ja) |
Cited By (15)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6690043B1 (en) | 1999-11-26 | 2004-02-10 | Kabushiki Kaisha Toshiba | Semiconductor device and method of manufacturing the same |
US6723541B2 (en) | 2001-07-12 | 2004-04-20 | Hitachi, Ltd. | Method of producing semiconductor device and semiconductor substrate |
JP2004363199A (ja) * | 2003-06-02 | 2004-12-24 | Sumitomo Mitsubishi Silicon Corp | 半導体基板の製造方法 |
JP2005532687A (ja) * | 2002-07-09 | 2005-10-27 | エス.オー.アイ.テック、シリコン、オン、インシュレター、テクノロジーズ | バッファ層を備えるウエハからの薄層の転移 |
JP2005536876A (ja) * | 2002-08-23 | 2005-12-02 | アンバーウェーブ システムズ コーポレイション | 減少した転位パイルアップを有する半導体ヘテロ構造および関連した方法 |
JP2006503442A (ja) * | 2002-10-18 | 2006-01-26 | アドバンスト・マイクロ・ディバイシズ・インコーポレイテッド | 埋め込み酸化物層の圧縮材料に導入される伸張性のストレインシリコンを備えた半導体デバイス |
JP2006203223A (ja) * | 1998-12-24 | 2006-08-03 | Toshiba Corp | 半導体装置の製造方法 |
JP2006270000A (ja) * | 2005-03-25 | 2006-10-05 | Sumco Corp | 歪Si−SOI基板の製造方法および該方法により製造された歪Si−SOI基板 |
JP2006269999A (ja) * | 2005-03-25 | 2006-10-05 | Sumco Corp | 歪Si−SOI基板の製造方法および該方法により製造された歪Si−SOI基板 |
JP2007180285A (ja) * | 2005-12-28 | 2007-07-12 | Siltronic Ag | Sgoi基板の製造方法 |
JP2007533119A (ja) * | 2003-11-19 | 2007-11-15 | インターナショナル・ビジネス・マシーンズ・コーポレーション | Si:C−OIおよびSGOI上のシリコン・デバイスならびに製造方法 |
US7449379B2 (en) | 2003-08-05 | 2008-11-11 | Fujitsu Limited | Semiconductor device and method for fabricating the same |
JP2010199609A (ja) * | 2010-04-28 | 2010-09-09 | Sumco Corp | 歪シリコンsoi基板の製造方法 |
US7977221B2 (en) | 2007-10-05 | 2011-07-12 | Sumco Corporation | Method for producing strained Si-SOI substrate and strained Si-SOI substrate produced by the same |
US8110486B2 (en) | 2006-01-18 | 2012-02-07 | Sumco Corporation | Method of manufacturing semiconductor wafer by forming a strain relaxation SiGe layer on an insulating layer of SOI wafer |
Families Citing this family (209)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6664115B2 (en) * | 1992-10-23 | 2003-12-16 | Symetrix Corporation | Metal insulator structure with polarization-compatible buffer layer |
WO1996015550A1 (en) * | 1994-11-10 | 1996-05-23 | Lawrence Semiconductor Research Laboratory, Inc. | Silicon-germanium-carbon compositions and processes thereof |
JP2778553B2 (ja) * | 1995-09-29 | 1998-07-23 | 日本電気株式会社 | 半導体装置およびその製造方法 |
US6429120B1 (en) | 2000-01-18 | 2002-08-06 | Micron Technology, Inc. | Methods and apparatus for making integrated-circuit wiring from copper, silver, gold, and other metals |
US5847419A (en) * | 1996-09-17 | 1998-12-08 | Kabushiki Kaisha Toshiba | Si-SiGe semiconductor device and method of fabricating the same |
EP0838858B1 (de) * | 1996-09-27 | 2002-05-15 | Infineon Technologies AG | Integrierte CMOS-Schaltungsanordnung und Verfahren zu deren Herstellung |
US5891769A (en) * | 1997-04-07 | 1999-04-06 | Motorola, Inc. | Method for forming a semiconductor device having a heteroepitaxial layer |
US5976941A (en) * | 1997-06-06 | 1999-11-02 | The Whitaker Corporation | Ultrahigh vacuum deposition of silicon (Si-Ge) on HMIC substrates |
ATE283549T1 (de) | 1997-06-24 | 2004-12-15 | Massachusetts Inst Technology | Kontrolle der verspannungsdichte durch verwendung von gradientenschichten und durch planarisierung |
FR2765394B1 (fr) * | 1997-06-25 | 1999-09-24 | France Telecom | Procede d'obtention d'un transistor a grille en silicium-germanium |
US5869359A (en) * | 1997-08-20 | 1999-02-09 | Prabhakar; Venkatraman | Process for forming silicon on insulator devices having elevated source and drain regions |
US6130471A (en) * | 1997-08-29 | 2000-10-10 | The Whitaker Corporation | Ballasting of high power silicon-germanium heterojunction biploar transistors |
US6040225A (en) * | 1997-08-29 | 2000-03-21 | The Whitaker Corporation | Method of fabricating polysilicon based resistors in Si-Ge heterojunction devices |
US6641867B1 (en) * | 1998-03-31 | 2003-11-04 | Texas Instruments Incorporated | Methods for chemical vapor deposition of tungsten on silicon or dielectric |
EP1008187B1 (en) * | 1998-04-09 | 2009-09-23 | Nxp B.V. | Semiconductor device having a rectifying junction and method of manufacturing same |
US7227176B2 (en) | 1998-04-10 | 2007-06-05 | Massachusetts Institute Of Technology | Etch stop layer system |
JP3403076B2 (ja) | 1998-06-30 | 2003-05-06 | 株式会社東芝 | 半導体装置及びその製造方法 |
DE19848298B4 (de) * | 1998-10-12 | 2008-08-07 | IHP GmbH - Innovations for High Performance Microelectronics/Institut für innovative Mikroelektronik | Hochtemperaturstabile Halbleitersubstratscheibe großen Durchmessers und Verfahren zu ihrer Herstellung |
US6329063B2 (en) * | 1998-12-11 | 2001-12-11 | Nova Crystals, Inc. | Method for producing high quality heteroepitaxial growth using stress engineering and innovative substrates |
US6369438B1 (en) | 1998-12-24 | 2002-04-09 | Kabushiki Kaisha Toshiba | Semiconductor device and method for manufacturing the same |
US6607948B1 (en) | 1998-12-24 | 2003-08-19 | Kabushiki Kaisha Toshiba | Method of manufacturing a substrate using an SiGe layer |
JP4521542B2 (ja) * | 1999-03-30 | 2010-08-11 | ルネサスエレクトロニクス株式会社 | 半導体装置および半導体基板 |
US20040023874A1 (en) * | 2002-03-15 | 2004-02-05 | Burgess Catherine E. | Therapeutic polypeptides, nucleic acids encoding same, and methods of use |
TW502458B (en) | 1999-06-09 | 2002-09-11 | Toshiba Corp | Bonding type semiconductor substrate, semiconductor light emission element and manufacturing method thereof |
CN1322597C (zh) * | 1999-08-23 | 2007-06-20 | 日本板硝子株式会社 | 发光闸流晶体管及自扫描型发光装置 |
US6326667B1 (en) | 1999-09-09 | 2001-12-04 | Kabushiki Kaisha Toshiba | Semiconductor devices and methods for producing semiconductor devices |
US6633066B1 (en) * | 2000-01-07 | 2003-10-14 | Samsung Electronics Co., Ltd. | CMOS integrated circuit devices and substrates having unstrained silicon active layers |
US7262130B1 (en) | 2000-01-18 | 2007-08-28 | Micron Technology, Inc. | Methods for making integrated-circuit wiring from copper, silver, gold, and other metals |
US6420262B1 (en) | 2000-01-18 | 2002-07-16 | Micron Technology, Inc. | Structures and methods to enhance copper metallization |
US6376370B1 (en) | 2000-01-18 | 2002-04-23 | Micron Technology, Inc. | Process for providing seed layers for using aluminum, copper, gold and silver metallurgy process for providing seed layers for using aluminum, copper, gold and silver metallurgy |
US6602613B1 (en) | 2000-01-20 | 2003-08-05 | Amberwave Systems Corporation | Heterointegration of materials using deposition and bonding |
WO2001054202A1 (en) * | 2000-01-20 | 2001-07-26 | Amberwave Systems Corporation | Strained-silicon metal oxide semiconductor field effect transistors |
US6750130B1 (en) | 2000-01-20 | 2004-06-15 | Amberwave Systems Corporation | Heterointegration of materials using deposition and bonding |
WO2001054175A1 (en) | 2000-01-20 | 2001-07-26 | Amberwave Systems Corporation | Low threading dislocation density relaxed mismatched epilayers without high temperature growth |
DE10025264A1 (de) * | 2000-05-22 | 2001-11-29 | Max Planck Gesellschaft | Feldeffekt-Transistor auf der Basis von eingebetteten Clusterstrukturen und Verfahren zu seiner Herstellung |
US6437375B1 (en) * | 2000-06-05 | 2002-08-20 | Micron Technology, Inc. | PD-SOI substrate with suppressed floating body effect and method for its fabrication |
JP2002043566A (ja) * | 2000-07-27 | 2002-02-08 | Matsushita Electric Ind Co Ltd | 半導体装置及びその製造方法 |
US6645829B2 (en) | 2000-08-04 | 2003-11-11 | Amberwave Systems Corporation | Silicon wafer with embedded optoelectronic material for monolithic OEIC |
JP2004519090A (ja) * | 2000-08-07 | 2004-06-24 | アンバーウェーブ システムズ コーポレイション | 歪み表面チャネル及び歪み埋め込みチャネルmosfet素子のゲート技術 |
US6573126B2 (en) * | 2000-08-16 | 2003-06-03 | Massachusetts Institute Of Technology | Process for producing semiconductor article using graded epitaxial growth |
JP3998408B2 (ja) | 2000-09-29 | 2007-10-24 | 株式会社東芝 | 半導体装置及びその製造方法 |
JP2002164520A (ja) * | 2000-11-27 | 2002-06-07 | Shin Etsu Handotai Co Ltd | 半導体ウェーハの製造方法 |
US6649480B2 (en) | 2000-12-04 | 2003-11-18 | Amberwave Systems Corporation | Method of fabricating CMOS inverter and integrated circuits utilizing strained silicon surface channel MOSFETs |
US20020100942A1 (en) * | 2000-12-04 | 2002-08-01 | Fitzgerald Eugene A. | CMOS inverter and integrated circuits utilizing strained silicon surface channel MOSFETs |
JP4511092B2 (ja) * | 2000-12-11 | 2010-07-28 | セイコーエプソン株式会社 | 半導体素子の製造方法 |
US6383924B1 (en) | 2000-12-13 | 2002-05-07 | Micron Technology, Inc. | Method of forming buried conductor patterns by surface transformation of empty spaces in solid state materials |
KR100385857B1 (ko) * | 2000-12-27 | 2003-06-02 | 한국전자통신연구원 | SiGe MODFET 소자 제조방법 |
US6495402B1 (en) | 2001-02-06 | 2002-12-17 | Advanced Micro Devices, Inc. | Semiconductor-on-insulator (SOI) device having source/drain silicon-germanium regions and method of manufacture |
US6380590B1 (en) | 2001-02-22 | 2002-04-30 | Advanced Micro Devices, Inc. | SOI chip having multiple threshold voltage MOSFETs by using multiple channel materials and method of fabricating same |
US6410371B1 (en) | 2001-02-26 | 2002-06-25 | Advanced Micro Devices, Inc. | Method of fabrication of semiconductor-on-insulator (SOI) wafer having a Si/SiGe/Si active layer |
US6723661B2 (en) | 2001-03-02 | 2004-04-20 | Amberwave Systems Corporation | Relaxed silicon germanium platform for high speed CMOS electronics and high speed analog circuits |
US6703688B1 (en) | 2001-03-02 | 2004-03-09 | Amberwave Systems Corporation | Relaxed silicon germanium platform for high speed CMOS electronics and high speed analog circuits |
US6830976B2 (en) * | 2001-03-02 | 2004-12-14 | Amberwave Systems Corproation | Relaxed silicon germanium platform for high speed CMOS electronics and high speed analog circuits |
US6724008B2 (en) | 2001-03-02 | 2004-04-20 | Amberwave Systems Corporation | Relaxed silicon germanium platform for high speed CMOS electronics and high speed analog circuits |
US6900103B2 (en) | 2001-03-02 | 2005-05-31 | Amberwave Systems Corporation | Relaxed silicon germanium platform for high speed CMOS electronics and high speed analog circuits |
US6593641B1 (en) | 2001-03-02 | 2003-07-15 | Amberwave Systems Corporation | Relaxed silicon germanium platform for high speed CMOS electronics and high speed analog circuits |
WO2002082514A1 (en) | 2001-04-04 | 2002-10-17 | Massachusetts Institute Of Technology | A method for semiconductor device fabrication |
JP2002305293A (ja) * | 2001-04-06 | 2002-10-18 | Canon Inc | 半導体部材の製造方法及び半導体装置の製造方法 |
US20020168802A1 (en) * | 2001-05-14 | 2002-11-14 | Hsu Sheng Teng | SiGe/SOI CMOS and method of making the same |
US20020167048A1 (en) * | 2001-05-14 | 2002-11-14 | Tweet Douglas J. | Enhanced mobility NMOS and PMOS transistors using strained Si/SiGe layers on silicon-on-insulator substrates |
US7142577B2 (en) | 2001-05-16 | 2006-11-28 | Micron Technology, Inc. | Method of forming mirrors by surface transformation of empty spaces in solid state materials and structures thereon |
US6855436B2 (en) * | 2003-05-30 | 2005-02-15 | International Business Machines Corporation | Formation of silicon-germanium-on-insulator (SGOI) by an integral high temperature SIMOX-Ge interdiffusion anneal |
US6898362B2 (en) * | 2002-01-17 | 2005-05-24 | Micron Technology Inc. | Three-dimensional photonic crystal waveguide structure and method |
US6593625B2 (en) * | 2001-06-12 | 2003-07-15 | International Business Machines Corporation | Relaxed SiGe layers on Si or silicon-on-insulator substrates by ion implantation and thermal annealing |
US6855649B2 (en) * | 2001-06-12 | 2005-02-15 | International Business Machines Corporation | Relaxed SiGe layers on Si or silicon-on-insulator substrates by ion implantation and thermal annealing |
US6900094B2 (en) * | 2001-06-14 | 2005-05-31 | Amberwave Systems Corporation | Method of selective removal of SiGe alloys |
US7301180B2 (en) * | 2001-06-18 | 2007-11-27 | Massachusetts Institute Of Technology | Structure and method for a high-speed semiconductor device having a Ge channel layer |
US6916727B2 (en) * | 2001-06-21 | 2005-07-12 | Massachusetts Institute Of Technology | Enhancement of P-type metal-oxide-semiconductor field effect transistors |
WO2003015142A2 (en) | 2001-08-06 | 2003-02-20 | Massachusetts Institute Of Technology | Formation of planar strained layers |
US7138649B2 (en) * | 2001-08-09 | 2006-11-21 | Amberwave Systems Corporation | Dual-channel CMOS transistors with differentially strained channels |
US6974735B2 (en) * | 2001-08-09 | 2005-12-13 | Amberwave Systems Corporation | Dual layer Semiconductor Devices |
EP1428262A2 (en) | 2001-09-21 | 2004-06-16 | Amberwave Systems Corporation | Semiconductor structures employing strained material layers with defined impurity gradients and methods for fabricating same |
AU2002341803A1 (en) | 2001-09-24 | 2003-04-07 | Amberwave Systems Corporation | Rf circuits including transistors having strained material layers |
KR100442105B1 (ko) * | 2001-12-03 | 2004-07-27 | 삼성전자주식회사 | 소이형 기판 형성 방법 |
JP3759026B2 (ja) * | 2001-12-06 | 2006-03-22 | セイコーエプソン株式会社 | 半導体装置およびその検査方法ならびに電子機器 |
JP3970011B2 (ja) * | 2001-12-11 | 2007-09-05 | シャープ株式会社 | 半導体装置及びその製造方法 |
US6600170B1 (en) | 2001-12-17 | 2003-07-29 | Advanced Micro Devices, Inc. | CMOS with strained silicon channel NMOS and silicon germanium channel PMOS |
US6642536B1 (en) | 2001-12-17 | 2003-11-04 | Advanced Micro Devices, Inc. | Hybrid silicon on insulator/bulk strained silicon technology |
US6515335B1 (en) * | 2002-01-04 | 2003-02-04 | International Business Machines Corporation | Method for fabrication of relaxed SiGe buffer layers on silicon-on-insulators and structures containing the same |
AU2003202499A1 (en) * | 2002-01-09 | 2003-07-30 | Matsushita Electric Industrial Co., Ltd. | Semiconductor device and its production method |
US6805962B2 (en) * | 2002-01-23 | 2004-10-19 | International Business Machines Corporation | Method of creating high-quality relaxed SiGe-on-insulator for strained Si CMOS applications |
US6649492B2 (en) | 2002-02-11 | 2003-11-18 | International Business Machines Corporation | Strained Si based layer made by UHV-CVD, and devices therein |
JP2003249641A (ja) * | 2002-02-22 | 2003-09-05 | Sharp Corp | 半導体基板、その製造方法及び半導体装置 |
WO2003079415A2 (en) | 2002-03-14 | 2003-09-25 | Amberwave Systems Corporation | Methods for fabricating strained layers on semiconductor substrates |
KR100754561B1 (ko) * | 2002-04-26 | 2007-09-05 | 인터내셔널 비지네스 머신즈 코포레이션 | 컷오프 주파수가 향상된 실리콘 게르마늄 트랜지스터 |
CA2484668C (en) | 2002-05-08 | 2010-07-13 | Endress + Hauser Flowtec Ag | Vibratory transducer |
US6689671B1 (en) | 2002-05-22 | 2004-02-10 | Advanced Micro Devices, Inc. | Low temperature solid-phase epitaxy fabrication process for MOS devices built on strained semiconductor substrate |
GB0212616D0 (en) * | 2002-05-31 | 2002-07-10 | Univ Warwick | Formation of lattice-tuning semiconductor substrates |
US20030227057A1 (en) | 2002-06-07 | 2003-12-11 | Lochtefeld Anthony J. | Strained-semiconductor-on-insulator device structures |
US6995430B2 (en) | 2002-06-07 | 2006-02-07 | Amberwave Systems Corporation | Strained-semiconductor-on-insulator device structures |
US7615829B2 (en) | 2002-06-07 | 2009-11-10 | Amberwave Systems Corporation | Elevated source and drain elements for strained-channel heterojuntion field-effect transistors |
US7335545B2 (en) | 2002-06-07 | 2008-02-26 | Amberwave Systems Corporation | Control of strain in device layers by prevention of relaxation |
JP2004014856A (ja) * | 2002-06-07 | 2004-01-15 | Sharp Corp | 半導体基板の製造方法及び半導体装置の製造方法 |
WO2003105204A2 (en) * | 2002-06-07 | 2003-12-18 | Amberwave Systems Corporation | Semiconductor devices having strained dual channel layers |
US7074623B2 (en) | 2002-06-07 | 2006-07-11 | Amberwave Systems Corporation | Methods of forming strained-semiconductor-on-insulator finFET device structures |
US7307273B2 (en) | 2002-06-07 | 2007-12-11 | Amberwave Systems Corporation | Control of strain in device layers by selective relaxation |
US6946371B2 (en) | 2002-06-10 | 2005-09-20 | Amberwave Systems Corporation | Methods of fabricating semiconductor structures having epitaxially grown source and drain elements |
WO2004001857A1 (en) * | 2002-06-19 | 2003-12-31 | Massachusetts Institute Of Technology | Ge photodetectors |
US6982474B2 (en) | 2002-06-25 | 2006-01-03 | Amberwave Systems Corporation | Reacted conductive gate electrodes |
KR20040014716A (ko) * | 2002-08-10 | 2004-02-18 | 한국전자통신연구원 | 활성 영역 하부에 산화층을 가지는 반도체 소자를제조하는 방법 |
US6878610B1 (en) * | 2002-08-27 | 2005-04-12 | Taiwan Semiconductor Manufacturing Company, Ltd. | Relaxed silicon germanium substrate with low defect density |
US20040137698A1 (en) * | 2002-08-29 | 2004-07-15 | Gianni Taraschi | Fabrication system and method for monocrystaline semiconductor on a substrate |
US7594967B2 (en) | 2002-08-30 | 2009-09-29 | Amberwave Systems Corporation | Reduction of dislocation pile-up formation during relaxed lattice-mismatched epitaxy |
FR2844634B1 (fr) * | 2002-09-18 | 2005-05-27 | Soitec Silicon On Insulator | Formation d'une couche utile relaxee a partir d'une plaquette sans couche tampon |
US6902991B2 (en) * | 2002-10-24 | 2005-06-07 | Advanced Micro Devices, Inc. | Semiconductor device having a thick strained silicon layer and method of its formation |
US6946373B2 (en) * | 2002-11-20 | 2005-09-20 | International Business Machines Corporation | Relaxed, low-defect SGOI for strained Si CMOS applications |
US6787423B1 (en) | 2002-12-09 | 2004-09-07 | Advanced Micro Devices, Inc. | Strained-silicon semiconductor device |
US6812116B2 (en) * | 2002-12-13 | 2004-11-02 | Taiwan Semiconductor Manufacturing Company, Ltd. | Method of fabricating a wafer with strained channel layers for increased electron and hole mobility for improving device performance |
US6774015B1 (en) | 2002-12-19 | 2004-08-10 | International Business Machines Corporation | Strained silicon-on-insulator (SSOI) and method to form the same |
US6878611B2 (en) * | 2003-01-02 | 2005-04-12 | International Business Machines Corporation | Patterned strained silicon for high performance circuits |
US6770504B2 (en) * | 2003-01-06 | 2004-08-03 | Honeywell International Inc. | Methods and structure for improving wafer bow control |
EP1437764A1 (en) * | 2003-01-10 | 2004-07-14 | S.O.I. Tec Silicon on Insulator Technologies S.A. | A compliant substrate for a heteroepitaxy, a heteroepitaxial structure and a method for fabricating a compliant substrate |
WO2004068556A2 (en) | 2003-01-27 | 2004-08-12 | Amberwave Systems Corporation | Semiconductor structures with structural homogeneity |
US7348260B2 (en) * | 2003-02-28 | 2008-03-25 | S.O.I.Tec Silicon On Insulator Technologies | Method for forming a relaxed or pseudo-relaxed useful layer on a substrate |
US20040192067A1 (en) * | 2003-02-28 | 2004-09-30 | Bruno Ghyselen | Method for forming a relaxed or pseudo-relaxed useful layer on a substrate |
US7018909B2 (en) * | 2003-02-28 | 2006-03-28 | S.O.I.Tec Silicon On Insulator Technologies S.A. | Forming structures that include a relaxed or pseudo-relaxed layer on a substrate |
US6911379B2 (en) * | 2003-03-05 | 2005-06-28 | Taiwan Semiconductor Manufacturing Company, Ltd. | Method of forming strained silicon on insulator substrate |
US7198974B2 (en) * | 2003-03-05 | 2007-04-03 | Micron Technology, Inc. | Micro-mechanically strained semiconductor film |
KR100728173B1 (ko) | 2003-03-07 | 2007-06-13 | 앰버웨이브 시스템즈 코포레이션 | 쉘로우 트렌치 분리법 |
DE10310740A1 (de) * | 2003-03-10 | 2004-09-30 | Forschungszentrum Jülich GmbH | Verfahren zur Herstellung einer spannungsrelaxierten Schichtstruktur auf einem nicht gitterangepassten Substrat, sowie Verwendung eines solchen Schichtsystems in elektronischen und/oder optoelektronischen Bauelementen |
US6949451B2 (en) * | 2003-03-10 | 2005-09-27 | Taiwan Semiconductor Manufacturing Company, Ltd. | SOI chip with recess-resistant buried insulator and method of manufacturing the same |
US6902962B2 (en) * | 2003-04-04 | 2005-06-07 | Taiwan Semiconductor Manufacturing Company, Ltd. | Silicon-on-insulator chip with multiple crystal orientations |
US20040209437A1 (en) * | 2003-04-16 | 2004-10-21 | Taiwan Semiconductor Manufacturing Co. | Method of forming a shallow trench isolation region in strained silicon layer and in an underlying on silicon - germanium layer |
US7220656B2 (en) * | 2003-04-29 | 2007-05-22 | Micron Technology, Inc. | Strained semiconductor by wafer bonding with misorientation |
US7041575B2 (en) * | 2003-04-29 | 2006-05-09 | Micron Technology, Inc. | Localized strained semiconductor on insulator |
US7115480B2 (en) | 2003-05-07 | 2006-10-03 | Micron Technology, Inc. | Micromechanical strained semiconductor by wafer bonding |
US6987037B2 (en) * | 2003-05-07 | 2006-01-17 | Micron Technology, Inc. | Strained Si/SiGe structures by ion implantation |
US6864149B2 (en) * | 2003-05-09 | 2005-03-08 | Taiwan Semiconductor Manufacturing Company | SOI chip with mesa isolation and recess resistant regions |
US7008854B2 (en) | 2003-05-21 | 2006-03-07 | Micron Technology, Inc. | Silicon oxycarbide substrates for bonded silicon on insulator |
US7273788B2 (en) | 2003-05-21 | 2007-09-25 | Micron Technology, Inc. | Ultra-thin semiconductors bonded on glass substrates |
US7501329B2 (en) | 2003-05-21 | 2009-03-10 | Micron Technology, Inc. | Wafer gettering using relaxed silicon germanium epitaxial proximity layers |
US7662701B2 (en) | 2003-05-21 | 2010-02-16 | Micron Technology, Inc. | Gettering of silicon on insulator using relaxed silicon germanium epitaxial proximity layers |
US7049660B2 (en) * | 2003-05-30 | 2006-05-23 | International Business Machines Corporation | High-quality SGOI by oxidation near the alloy melting temperature |
US7026249B2 (en) * | 2003-05-30 | 2006-04-11 | International Business Machines Corporation | SiGe lattice engineering using a combination of oxidation, thinning and epitaxial regrowth |
EP1484794A1 (en) * | 2003-06-06 | 2004-12-08 | S.O.I. Tec Silicon on Insulator Technologies S.A. | A method for fabricating a carrier substrate |
US7261777B2 (en) * | 2003-06-06 | 2007-08-28 | S.O.I.Tec Silicon On Insulator Technologies | Method for fabricating an epitaxial substrate |
US7169226B2 (en) * | 2003-07-01 | 2007-01-30 | International Business Machines Corporation | Defect reduction by oxidation of silicon |
US6921982B2 (en) * | 2003-07-21 | 2005-07-26 | International Business Machines Corporation | FET channel having a strained lattice structure along multiple surfaces |
US6929984B2 (en) * | 2003-07-21 | 2005-08-16 | Micron Technology Inc. | Gettering using voids formed by surface transformation |
FR2858460B1 (fr) * | 2003-07-30 | 2005-10-14 | Soitec Silicon On Insulator | Structure semiconducteur-sur-isolant contrainte ayant une tenue des contraintes aux hautes temperatures |
US7220665B2 (en) | 2003-08-05 | 2007-05-22 | Micron Technology, Inc. | H2 plasma treatment |
US7153753B2 (en) * | 2003-08-05 | 2006-12-26 | Micron Technology, Inc. | Strained Si/SiGe/SOI islands and processes of making same |
US6989058B2 (en) * | 2003-09-03 | 2006-01-24 | International Business Machines Corporation | Use of thin SOI to inhibit relaxation of SiGe layers |
US7170126B2 (en) * | 2003-09-16 | 2007-01-30 | International Business Machines Corporation | Structure of vertical strained silicon devices |
US7029980B2 (en) * | 2003-09-25 | 2006-04-18 | Freescale Semiconductor Inc. | Method of manufacturing SOI template layer |
US6902965B2 (en) * | 2003-10-31 | 2005-06-07 | Taiwan Semiconductor Manufacturing Company, Ltd. | Strained silicon structure |
US20050116360A1 (en) * | 2003-12-01 | 2005-06-02 | Chien-Chao Huang | Complementary field-effect transistors and methods of manufacture |
US6992025B2 (en) * | 2004-01-12 | 2006-01-31 | Sharp Laboratories Of America, Inc. | Strained silicon on insulator from film transfer and relaxation by hydrogen implantation |
US7105393B2 (en) * | 2004-01-30 | 2006-09-12 | Taiwan Semiconductor Manufacturing Co., Ltd. | Strained silicon layer fabrication with reduced dislocation defect density |
US7064396B2 (en) * | 2004-03-01 | 2006-06-20 | Freescale Semiconductor, Inc. | Integrated circuit with multiple spacer insulating region widths |
US7202145B2 (en) * | 2004-06-03 | 2007-04-10 | Taiwan Semiconductor Manufacturing Company | Strained Si formed by anneal |
US7172933B2 (en) * | 2004-06-10 | 2007-02-06 | Taiwan Semiconductor Manufacturing Company, Ltd. | Recessed polysilicon gate structure for a strained silicon MOSFET device |
US7102201B2 (en) * | 2004-07-15 | 2006-09-05 | International Business Machines Corporation | Strained semiconductor device structures |
US7241647B2 (en) * | 2004-08-17 | 2007-07-10 | Freescale Semiconductor, Inc. | Graded semiconductor layer |
US7238567B2 (en) * | 2004-08-23 | 2007-07-03 | Texas Instruments Incorporated | System and method for integrating low schottky barrier metal source/drain |
US7078722B2 (en) * | 2004-09-20 | 2006-07-18 | International Business Machines Corporation | NFET and PFET devices and methods of fabricating same |
KR100593747B1 (ko) * | 2004-10-11 | 2006-06-28 | 삼성전자주식회사 | 실리콘게르마늄층을 구비하는 반도체 구조물 및 그 제조방법 |
US20090130826A1 (en) * | 2004-10-11 | 2009-05-21 | Samsung Electronics Co., Ltd. | Method of Forming a Semiconductor Device Having a Strained Silicon Layer on a Silicon-Germanium Layer |
EP1650794B1 (en) * | 2004-10-19 | 2008-01-16 | S.O.I. Tec Silicon on Insulator Technologies S.A. | A method for fabricating a wafer structure with a strained silicon layer and an intermediate product of this method |
US20060113603A1 (en) * | 2004-12-01 | 2006-06-01 | Amberwave Systems Corporation | Hybrid semiconductor-on-insulator structures and related methods |
US7393733B2 (en) | 2004-12-01 | 2008-07-01 | Amberwave Systems Corporation | Methods of forming hybrid fin field-effect transistor structures |
US7229901B2 (en) * | 2004-12-16 | 2007-06-12 | Wisconsin Alumni Research Foundation | Fabrication of strained heterojunction structures |
FR2880988B1 (fr) * | 2005-01-19 | 2007-03-30 | Soitec Silicon On Insulator | TRAITEMENT D'UNE COUCHE EN SI1-yGEy PRELEVEE |
US7282402B2 (en) * | 2005-03-30 | 2007-10-16 | Freescale Semiconductor, Inc. | Method of making a dual strained channel semiconductor device |
US9153645B2 (en) | 2005-05-17 | 2015-10-06 | Taiwan Semiconductor Manufacturing Company, Ltd. | Lattice-mismatched semiconductor structures with reduced dislocation defect densities and related methods for device fabrication |
US8324660B2 (en) | 2005-05-17 | 2012-12-04 | Taiwan Semiconductor Manufacturing Company, Ltd. | Lattice-mismatched semiconductor structures with reduced dislocation defect densities and related methods for device fabrication |
WO2007005862A1 (en) * | 2005-06-30 | 2007-01-11 | Mears Technologies, Inc. | Semiconductor device having a semiconductor-on-insulator (soi) configuration and including a superlattice on a thin semiconductor layer and associated methods |
KR100676827B1 (ko) | 2005-09-02 | 2007-02-01 | 박재근 | 스트레인드 실리콘층을 포함하는 반도체 웨이퍼, 그의제조방법 및 그를 이용한 반도체 소자 |
US7341883B2 (en) * | 2005-09-27 | 2008-03-11 | The United States Of America As Represented By The Administrator Of The National Aeronautics And Space Administration | Silicon germanium semiconductive alloy and method of fabricating same |
US7772635B2 (en) * | 2005-10-27 | 2010-08-10 | Micron Technology, Inc. | Non-volatile memory device with tensile strained silicon layer |
FR2892733B1 (fr) * | 2005-10-28 | 2008-02-01 | Soitec Silicon On Insulator | Relaxation de couches |
US7544584B2 (en) | 2006-02-16 | 2009-06-09 | Micron Technology, Inc. | Localized compressive strained semiconductor |
US7777250B2 (en) | 2006-03-24 | 2010-08-17 | Taiwan Semiconductor Manufacturing Company, Ltd. | Lattice-mismatched semiconductor structures and related methods for device fabrication |
US7777290B2 (en) * | 2006-06-13 | 2010-08-17 | Wisconsin Alumni Research Foundation | PIN diodes for photodetection and high-speed, high-resolution image sensing |
US7485544B2 (en) * | 2006-08-02 | 2009-02-03 | Micron Technology, Inc. | Strained semiconductor, devices and systems and methods of formation |
US8962447B2 (en) * | 2006-08-03 | 2015-02-24 | Micron Technology, Inc. | Bonded strained semiconductor with a desired surface orientation and conductance direction |
US7968960B2 (en) | 2006-08-18 | 2011-06-28 | Micron Technology, Inc. | Methods of forming strained semiconductor channels |
WO2008030574A1 (en) | 2006-09-07 | 2008-03-13 | Amberwave Systems Corporation | Defect reduction using aspect ratio trapping |
US7960218B2 (en) * | 2006-09-08 | 2011-06-14 | Wisconsin Alumni Research Foundation | Method for fabricating high-speed thin-film transistors |
US7875958B2 (en) | 2006-09-27 | 2011-01-25 | Taiwan Semiconductor Manufacturing Company, Ltd. | Quantum tunneling devices and circuits with lattice-mismatched semiconductor structures |
US20080187018A1 (en) | 2006-10-19 | 2008-08-07 | Amberwave Systems Corporation | Distributed feedback lasers formed via aspect ratio trapping |
US8237151B2 (en) | 2009-01-09 | 2012-08-07 | Taiwan Semiconductor Manufacturing Company, Ltd. | Diode-based devices and methods for making the same |
WO2008124154A2 (en) | 2007-04-09 | 2008-10-16 | Amberwave Systems Corporation | Photovoltaics on silicon |
US8304805B2 (en) | 2009-01-09 | 2012-11-06 | Taiwan Semiconductor Manufacturing Company, Ltd. | Semiconductor diodes fabricated by aspect ratio trapping with coalesced films |
US7825328B2 (en) | 2007-04-09 | 2010-11-02 | Taiwan Semiconductor Manufacturing Company, Ltd. | Nitride-based multi-junction solar cell modules and methods for making the same |
US8329541B2 (en) | 2007-06-15 | 2012-12-11 | Taiwan Semiconductor Manufacturing Company, Ltd. | InP-based transistor fabrication |
US7795605B2 (en) * | 2007-06-29 | 2010-09-14 | International Business Machines Corporation | Phase change material based temperature sensor |
TWI355046B (en) * | 2007-07-10 | 2011-12-21 | Nanya Technology Corp | Two bit memory structure and method of making the |
DE102007034701B4 (de) | 2007-07-16 | 2017-09-14 | Institut Für Mikroelektronik Stuttgart | Halbleitersubstrat und Verfahren zum Herstellen eines Halbleiterbauelements |
WO2009035746A2 (en) | 2007-09-07 | 2009-03-19 | Amberwave Systems Corporation | Multi-junction solar cells |
US8257491B2 (en) * | 2007-10-18 | 2012-09-04 | The United States Of America, As Represented By The Administrator Of The National Aeronautics And Space Administration | Rhombohedral cubic semiconductor materials on trigonal substrate with single crystal properties and devices based on such materials |
FR2931293B1 (fr) | 2008-05-15 | 2010-09-03 | Soitec Silicon On Insulator | Procede de fabrication d'une heterostructure support d'epitaxie et heterostructure correspondante |
US8183667B2 (en) | 2008-06-03 | 2012-05-22 | Taiwan Semiconductor Manufacturing Co., Ltd. | Epitaxial growth of crystalline material |
US8274097B2 (en) | 2008-07-01 | 2012-09-25 | Taiwan Semiconductor Manufacturing Company, Ltd. | Reduction of edge effects from aspect ratio trapping |
US8981427B2 (en) | 2008-07-15 | 2015-03-17 | Taiwan Semiconductor Manufacturing Company, Ltd. | Polishing of small composite semiconductor materials |
EP2151856A1 (en) | 2008-08-06 | 2010-02-10 | S.O.I. TEC Silicon | Relaxation of strained layers |
TWI457984B (zh) | 2008-08-06 | 2014-10-21 | Soitec Silicon On Insulator | 應變層的鬆弛方法 |
EP2151861A1 (en) | 2008-08-06 | 2010-02-10 | S.O.I. TEC Silicon | Passivation of etched semiconductor structures |
EP2151852B1 (en) | 2008-08-06 | 2020-01-15 | Soitec | Relaxation and transfer of strained layers |
EP2159836B1 (en) | 2008-08-25 | 2017-05-31 | Soitec | Stiffening layers for the relaxation of strained layers |
US8034697B2 (en) | 2008-09-19 | 2011-10-11 | Taiwan Semiconductor Manufacturing Company, Ltd. | Formation of devices by epitaxial layer overgrowth |
US20100072515A1 (en) | 2008-09-19 | 2010-03-25 | Amberwave Systems Corporation | Fabrication and structures of crystalline material |
US8253211B2 (en) | 2008-09-24 | 2012-08-28 | Taiwan Semiconductor Manufacturing Company, Ltd. | Semiconductor sensor structures with reduced dislocation defect densities |
US8629446B2 (en) | 2009-04-02 | 2014-01-14 | Taiwan Semiconductor Manufacturing Company, Ltd. | Devices formed from a non-polar plane of a crystalline material and method of making the same |
TWI562195B (en) | 2010-04-27 | 2016-12-11 | Pilegrowth Tech S R L | Dislocation and stress management by mask-less processes using substrate patterning and methods for device fabrication |
US9614026B2 (en) | 2013-03-13 | 2017-04-04 | The United States Of America As Represented By The Administrator Of The National Aeronautics And Space Administration | High mobility transport layer structures for rhombohedral Si/Ge/SiGe devices |
CN103646853B (zh) * | 2013-12-24 | 2016-05-18 | 中国科学院上海微系统与信息技术研究所 | 一种绝缘体上含锗薄膜结构的制备方法 |
US9343303B2 (en) | 2014-03-20 | 2016-05-17 | Samsung Electronics Co., Ltd. | Methods of forming low-defect strain-relaxed layers on lattice-mismatched substrates and related semiconductor structures and devices |
US10510871B1 (en) * | 2018-08-16 | 2019-12-17 | Taiwan Semiconductor Manufacturing Company, Ltd. | Semiconductor device and method |
Family Cites Families (10)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4357183A (en) * | 1980-08-13 | 1982-11-02 | Massachusetts Institute Of Technology | Heteroepitaxy of germanium silicon on silicon utilizing alloying control |
US4861393A (en) * | 1983-10-28 | 1989-08-29 | American Telephone And Telegraph Company, At&T Bell Laboratories | Semiconductor heterostructures having Gex Si1-x layers on Si utilizing molecular beam epitaxy |
US4529455A (en) * | 1983-10-28 | 1985-07-16 | At&T Bell Laboratories | Method for epitaxially growing Gex Si1-x layers on Si utilizing molecular beam epitaxy |
US4806996A (en) * | 1986-04-10 | 1989-02-21 | American Telephone And Telegraph Company, At&T Bell Laboratories | Dislocation-free epitaxial layer on a lattice-mismatched porous or otherwise submicron patterned single crystal substrate |
JPS63285923A (ja) * | 1987-05-19 | 1988-11-22 | Komatsu Denshi Kinzoku Kk | シリコン−ゲルマニウム合金の製造方法 |
US4994867A (en) * | 1988-07-22 | 1991-02-19 | Xerox Corporation | Intermediate buffer films with low plastic deformation threshold for lattice mismatched heteroepitaxy |
US4891329A (en) * | 1988-11-29 | 1990-01-02 | University Of North Carolina | Method of forming a nonsilicon semiconductor on insulator structure |
US5013681A (en) * | 1989-09-29 | 1991-05-07 | The United States Of America As Represented By The Secretary Of The Navy | Method of producing a thin silicon-on-insulator layer |
US5218213A (en) * | 1991-02-22 | 1993-06-08 | Harris Corporation | SOI wafer with sige |
DE4113143C2 (de) * | 1991-04-23 | 1994-08-04 | Forschungszentrum Juelich Gmbh | Verfahren zur Herstellung eines Schichtsystems und Schichtsystem |
-
1993
- 1993-10-29 US US08/145,986 patent/US5461243A/en not_active Expired - Lifetime
-
1994
- 1994-10-12 JP JP6246426A patent/JP2694120B2/ja not_active Expired - Fee Related
- 1994-10-12 EP EP94116091A patent/EP0651439A2/en active Pending
-
1996
- 1996-12-19 US US08/770,065 patent/US5759898A/en not_active Expired - Lifetime
Cited By (19)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2006203223A (ja) * | 1998-12-24 | 2006-08-03 | Toshiba Corp | 半導体装置の製造方法 |
JP4585464B2 (ja) * | 1998-12-24 | 2010-11-24 | 株式会社東芝 | 半導体装置の製造方法 |
US6690043B1 (en) | 1999-11-26 | 2004-02-10 | Kabushiki Kaisha Toshiba | Semiconductor device and method of manufacturing the same |
US7033913B2 (en) | 1999-11-26 | 2006-04-25 | Kabushiki Kaisha Toshiba | Semiconductor device and method of manufacturing the same |
US6723541B2 (en) | 2001-07-12 | 2004-04-20 | Hitachi, Ltd. | Method of producing semiconductor device and semiconductor substrate |
JP2005532687A (ja) * | 2002-07-09 | 2005-10-27 | エス.オー.アイ.テック、シリコン、オン、インシュレター、テクノロジーズ | バッファ層を備えるウエハからの薄層の転移 |
JP4904478B2 (ja) * | 2002-07-09 | 2012-03-28 | ソワテク | バッファ層を備えるウエハからの薄層の転移 |
JP2005536876A (ja) * | 2002-08-23 | 2005-12-02 | アンバーウェーブ システムズ コーポレイション | 減少した転位パイルアップを有する半導体ヘテロ構造および関連した方法 |
JP2006503442A (ja) * | 2002-10-18 | 2006-01-26 | アドバンスト・マイクロ・ディバイシズ・インコーポレイテッド | 埋め込み酸化物層の圧縮材料に導入される伸張性のストレインシリコンを備えた半導体デバイス |
JP2004363199A (ja) * | 2003-06-02 | 2004-12-24 | Sumitomo Mitsubishi Silicon Corp | 半導体基板の製造方法 |
US7449379B2 (en) | 2003-08-05 | 2008-11-11 | Fujitsu Limited | Semiconductor device and method for fabricating the same |
JP2007533119A (ja) * | 2003-11-19 | 2007-11-15 | インターナショナル・ビジネス・マシーンズ・コーポレーション | Si:C−OIおよびSGOI上のシリコン・デバイスならびに製造方法 |
US9040373B2 (en) | 2003-11-19 | 2015-05-26 | International Business Machines Corporation | Silicon device on SI:C-OI and SGOI and method of manufacture |
JP2006269999A (ja) * | 2005-03-25 | 2006-10-05 | Sumco Corp | 歪Si−SOI基板の製造方法および該方法により製造された歪Si−SOI基板 |
JP2006270000A (ja) * | 2005-03-25 | 2006-10-05 | Sumco Corp | 歪Si−SOI基板の製造方法および該方法により製造された歪Si−SOI基板 |
JP2007180285A (ja) * | 2005-12-28 | 2007-07-12 | Siltronic Ag | Sgoi基板の製造方法 |
US8110486B2 (en) | 2006-01-18 | 2012-02-07 | Sumco Corporation | Method of manufacturing semiconductor wafer by forming a strain relaxation SiGe layer on an insulating layer of SOI wafer |
US7977221B2 (en) | 2007-10-05 | 2011-07-12 | Sumco Corporation | Method for producing strained Si-SOI substrate and strained Si-SOI substrate produced by the same |
JP2010199609A (ja) * | 2010-04-28 | 2010-09-09 | Sumco Corp | 歪シリコンsoi基板の製造方法 |
Also Published As
Publication number | Publication date |
---|---|
US5759898A (en) | 1998-06-02 |
US5461243A (en) | 1995-10-24 |
JP2694120B2 (ja) | 1997-12-24 |
EP0651439A2 (en) | 1995-05-03 |
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