JP3989756B2 - 表示装置およびその走査回路検査方法 - Google Patents
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Description
【０００１】
【発明の属する技術分野】
本発明は、走査回路が正常に動作しているか否かを判定することができる表示装置およびその走査回路検査方法に関するものである。
【０００２】
【従来の技術】
従来、表示装置としての、ドライバモノシリック型の液晶表示装置は、一般に、ビデオデータをシフトレジスタで制御したアナログスイッチを介してサンプリングする。
【０００３】
例えば、図１１（ａ）に示すように、液晶表示装置は、画素部の各画素において画素容量ＣLC・補助容量ＣSが接続され、行状に配された複数のゲートラインと列状に配された複数のデータラインとの交差部にＴＦＴ（Thin Film Transistor）を備えている。ゲートラインはゲートドライバに、データラインはソースドライバに接続されている。
【０００４】
また、ＴＦＴと液晶層を介して対向するように、対向電極が配されている。対向電極には対向電圧ＶCOMが印加され、液晶を駆動する。
【０００５】
ゲートドライバは、ゲートパルスを順次出力し、各ゲートラインを順次走査して一水平期間ごとに１行分の画素を選択する。
【０００６】
また、ソースドライバは、シフトレジスタを用いて一水平期間内で各データラインを順次走査し、ビデオデータをサンプリングして選択された１行分の画素に点順次で書き込む。これにより、画像の表示が可能となる。
【０００７】
ここで、ソースドライバは、図１１（ｂ）に示すように、シフトレジスタとアナログスイッチとを備えている。
【０００８】
このような通常の表示と同様に、ドライバの不良を検査するときには、ソースドライバに入力されたビデオデータＶvideo1・Ｖvideo2をシフトレジスタで制御した図示しないアナログスイッチを介してサンプリングする。
【０００９】
即ち、ドライバの不良の検査は、通常の表示のときと同様に、上記ドライバを動作させ画素にデータを書き込んだ後、再びドライバを動作させ各々の画素に保持した電荷を、アナログスイッチを介して読み出す。これにより、画素欠陥とあわせてドライバの不良を検査・判定している。
【００１０】
しかしながら、この検査法では、プロジェクション用など小型高精細の表示装置のように、画素容量が小さく、読み出す電荷が微少となるにつれ、Ｓ／Ｎ比の低下、検査の精度低下を招来する。また、Ｓ／Ｎ比改善のため測定回数を増加したとしても、検査が長時間化するなどの問題があった。
【００１１】
また、ドライバの動作不良を、画素欠陥のあらわれ方の特徴から判断するため、データ処理に時間を要し、検査効率低下の原因になっていた。
【００１２】
そこで、図１０・１２に示すように、ドライバの走査回路を２個備え、パッドを用いてドライバ回路（走査回路）の検査を行う構成の表示装置が提案されている。
【００１３】
このように、ドライバ回路を２個備えることにより、冗長性を有し、例えば２つあるうちの一方のドライバ回路に故障があったとしても、他方のライバ回路が正常に動作していれば、表示装置全体としては、何ら問題ない。
【００１４】
また、図１２に示すように、ゲートドライバ１０１・ソースドライバ１０２内またはその周辺部にパッド１０３…を設け、このパッド１０３…に上記ドライバにおける走査回路の最終段の出力を引き出しておき、ここに検査用のプローブを当てて信号を検出することにより、検査の精度向上、および検査効率向上を図っていた。
【００１５】
あるいは、特願平６−１９４４２１号公報に記載されているように、複数の被検査回路部に対し、複数の機能検査に必要な検査回路部を内蔵する。また、その検査回路部は、検査機能に対応する情報を格納しておく手段と、被検査回路の構成情報を検査回路部に伝達する手段とを有する。これにより、検査回路部の構成および検査手段を簡単化することができ、ＢＩＳＴ（Built−In Self Test）を効率的に行うことができる。
【００１６】
【発明が解決しようとする課題】
しかしながら、上記図１２に示す構成では、検査専用のパッド１０３を複数個設ける必要がある。また、図１０に示すように、ゲートドライバ回路を２個備えることで、必要な検査専用のパッドの数も多くなる。
【００１７】
このような場合、特に、小型高精細パネル、モバイル機器、あるいはプロジェクション用などの小型高精細の表示装置などでは、ドライバ部の面積に厳しい制約にもかかわらず、大きな面積のパッドを形成しなければならないこととなる。また、配線の引き回しの制約や、後述するＥＳＤに対する保護の観点から、プローブカードの針を、外部からの駆動信号入力端子接続パッドとは配列が大きく異なるパッドに対応させる必要がある。
【００１８】
さらに、大面積のパッドが直接論理回路に接続されているため、このパッド１０３…がアンテナとしてはたらき、ＥＳＤ（Electrostatic Discharge：静電放電）による損傷が生じやすい。
【００１９】
また、上記公報の構成では、機能検査のための複雑な検査回路を形成する必要がある。ドライバモノシリック型の液晶表示装置などでは、表示画面部の微細加工レベルと面積とに基づき必要とされる加工精度、およびドライバの回路構成を考えると、このような検査回路用を内蔵することは実用的ではなく、より効果的な検査法が必要である。
【００２０】
本発明は、上記従来の問題点に鑑みなされたものであり、その目的は、面積の増加や回路の複雑化を伴うことなく、確実かつ高速に走査回路の良否判定を行うことができる表示装置およびその走査回路検査方法を提供することにある。
【００２１】
【課題を解決するための手段】
本発明の表示装置は、上記の課題を解決するために、マトリクス状に配置される画素を線順次に選択して走査するためのゲートドライバと、上記選択されたラインの画素にデータ信号を供給するためのソースドライバとを備え、上記ゲートドライバおよび上記ソースドライバのうちの少なくとも一方のドライバが基板上にモノリシックに形成された表示装置において、上記両ドライバのうち、モノリシックに形成された上記ドライバの走査回路には、クロック信号と、一定の幅を有し、シフトデータとして上記クロック信号に同期して、モノリシックに形成された上記ドライバの走査回路でシフトされるスタートパルスとが一定の周期で入力され、上記スタートパルスと、該スタートパルスに対応するシフトデータのシフト方向最終段の出力であって、予め設定された時間遅延してなされた出力とが、第１の論理回路に入力され、該第１の論理回路からの第１の出力により走査回路の検査を行うことを特徴としている。
【００２２】
上記の構成によれば、スタートパルスと、シフトデータのシフト方向最終段の出力であって、予め設定された時間遅延してなされた出力とを用いて、走査回路の検査を行っている。
【００２３】
これにより、ある一定の幅を有するパルスを検査に用いる検査信号とし、論理計算するため、途中で他のパルスなどがあったとしても、それを誤って検査信号として認識することはない。
【００２４】
従って、確実に走査回路の良否判定、即ち、走査回路が正常に動作しているか否かの判定を行うことができる。
【００２５】
また、ドライバが基板上にモノリシックに形成されていることより、ドライバ（駆動回路）の走査回路を、スイッチング素子と同一プロセスで形成することができる。これにより、例えば、駆動回路ＬＳＩを後から別途設ける必要がなくなり、製造コストの削減および実装工程の簡略化を図ることができる。
【００２６】
上記の表示装置は、モノリシックに形成されたドライバはシフト方向を双方向に切り替える切替手段を備え、上記ドライバの走査回路には、クロック信号とスタートパルスとが入力され、各々のシフト方向における各第１の出力は第２の論理回路に入力され、該第２の論理回路からの第２の出力により走査回路の検査を行うことが好ましい。
【００２７】
上記の構成によれば、双方向における走査回路の良否判定を確実に行うことができる。
【００２８】
本発明の表示装置は、上記の課題を解決するために、マトリクス状に配置される画素を線順次に選択して走査するためのゲートドライバと、上記選択されたラインの画素にデータ信号を供給するためのソースドライバとが基板上にモノリシックに形成された表示装置において、シフト方向を双方向に切り替える切替手段を備える上記両ドライバの各走査回路には、クロック信号と、一定の幅を有し、シフトデータとして上記クロック信号に同期して上記走査回路でシフトされるスタートパルスとが一定の周期で入力され、上記ゲートドライバの走査回路へのスタートパルスと、該ゲートドライバの走査回路へのスタートパルスに対応するシフトデータのシフト方向最終段の出力であって、予め設定された時間遅延してなされた出力とが、上記シフト方向ごとにそれぞれ第１論理回路に入力され、上記各々のシフト方向における各第１論理回路からの各第１出力は共に第２論理回路に入力される一方、上記ソースドライバの走査回路へのスタートパルスと、該ソースドライバの走査回路へのスタートパルスに対応するシフトデータのシフト方向最終段の出力であって、予め設定された時間遅延してなされた出力とが、上記シフト方向ごとにそれぞれ第３論理回路に入力され、上記各々のシフト方向における各第３論理回路からの各第３出力は共に第４論理回路に入力され、上記第２出力と上記第４出力とは、第５論理回路に入力され、該第５論理回路の第５出力により上記両走査回路の検査を行うことを特徴としている。
【００２９】
上記の構成によれば、ある一定の幅を有するパルスを検査に用いる検査信号とし、論理計算するため、途中で他のパルスなどがあったとしても、それを誤って検査信号として認識することはない。
【００３０】
従って、確実に走査回路の良否判定、即ち、走査回路が正常に動作しているか否かの判定を行うことができる。
【００３１】
これにより、例えば小型高精細パネル、モバイル機器、あるいはプロジェクション用などの小型高精細の表示装置などにおいても、面積の増加や回路の複雑化を伴うことなく、確実に走査回路の良否判定を行うことができる。
【００３２】
上記の表示装置は、第５出力が接続された検査用端子を備えていることが好ましい。
【００３３】
上記の構成によれば、一部あるいは全ての走査回路の最終段の出力を簡単な構成の論理回路を通して、１本の信号として１個の検査用端子（例えば、パッド）に出力することができる。従って、例えば検査用端子にプローブ針を当てることにより、容易に、走査回路の良否判定を行うことができる。
【００３４】
本発明の表示装置は、上記の課題を解決するために、マトリクス状に配置される画素を線順次に選択して走査するためのゲートドライバと、上記選択されたラインの画素にデータ信号を供給するためのソースドライバとが基板上にモノリシックに形成された表示装置において、上記両ドライバのうち少なくとも一方は、シフト方向を双方向に切り替える切替手段と、いずれかのシフト方向の最終段の出力とスタートパルスとを選択するアナログスイッチとを備え、上記両ドライバの各走査回路には、シフト方向ごとに、クロック信号と、一定の幅を有し、シフトデータとして上記クロック信号に同期して上記走査回路でシフトされるスタートパルスとが一定の周期で入力され、上記両走査回路の最終段からの出力は、共に論理回路に入力され、該論理回路の出力により上記両走査回路の検査を行うことを特徴としている。
【００３５】
上記の構成によれば、ある一定の幅を有するパルスを検査に用いる検査信号とし、論理計算するため、途中で他のパルスなどがあったとしても、それを誤って検査信号として認識することはない。
【００３６】
従って、簡単な構成で、確実に双方向における走査回路の良否判定、即ち、走査回路が正常に動作しているか否かの判定を行うことができる。
【００３７】
上記の表示装置は、走査回路の検査において、上記スタートパルスが入力されてから予め設定された時間後の、上記検査に用いるための上記走査回路および上記論理回路からの出力のうち最終の出力を検出することにより、上記走査回路が正常に動作しているか否かを判定することが好ましい。
【００３８】
即ち、スタートパルスが入力されてから予め設定された時間後の最終の出力が、その前後の時間における該最終の出力とは異なる所定の値となる場合に、走査回路は正常に動作していると判定することが好ましい。
【００３９】
具体的には、第１の論理回路は、ＮＡＮＤゲートとインバータとから、第２の論理回路はＮＯＲゲートからなり、かつ、スタートパルスのシフト方向最終段の出力が０または１のとき、スタートパルスが入力されてから予め設定された時間後の第２の出力が１または０であり、その前後の時間における第２の出力が０または１である場合に、走査回路は正常に動作していると判定される。
【００４０】
あるいは、第１論理回路および第３論理回路は、ＮＡＮＤゲートとインバータとから、第２論理回路および第４論理回路はＮＯＲゲートから、第５論理回路はExclusive ORからなり、各スタートパルスが入力されてから予め設定された時間後の、各スタートパルスに対応する第１出力および第３出力が１であり、第２出力および第４出力が０であるとき、その前後の時間における第１出力および第３出力が０であり、第２出力および第４出力が１である場合に、両走査回路は正常に動作していると判定される。
【００４１】
上記の構成によれば、論理回路に簡単な判定機能をもたせることができ、予め設定されたタイミングである出力が出るか否かにより、走査回路が正常に動作しているか否かを判定することができる。
【００４２】
従って、走査回路の良否を高速、かつ、精度良く判定することができる。
【００４３】
上記の表示装置は、シフト方向最終段の出力を、所定の段数だけさらにシフトさせることにより、予め設定された時間遅延させる遅延手段を備えていることが好ましい。
【００４４】
上記の構成によれば、簡単な構成で、スタートパルスと、シフトデータのシフト方向最終段の出力であって、予め設定された時間遅延してなされた出力とを用いて、走査回路の検査を行うことができる。
【００４５】
上記の表示装置は、遅延手段は、シフトレジスタであることが好ましい。
【００４６】
上記の構成によれば、簡単な構成で、走査回路が双方向にシフト可能とすることができる。
【００４７】
上記の表示装置は、論理回路がExclusive ORからなり、スタートパルスが入力されてから予め設定された時間後の出力が１であり、その前後の時間における出力が０である場合に、両走査回路は正常に動作していると判定されることが好ましい。
【００４８】
上記の構成によれば、予め設定されたタイミングである出力が出るか否かにより、走査回路が正常に動作しているか否かを判定することができる。
【００４９】
従って、走査回路の良否を高速、かつ、精度良く判定することができる。
【００５０】
上記の表示装置は、入力される表示モード切替信号によって切替可能な複数の表示モードを有し、表示モード切替信号がある特定の組み合わせで入力されたときには、論理回路の出力を両走査回路の動作に影響しない信号配線における信号端子に出力し、かつ、信号配線に入力される本来の信号を該信号配線から切り離すことにより、予め設定されたタイミングにおける出力を用いて両走査回路が正常に動作しているか否かを判定することが好ましい。
【００５１】
上記の構成によれば、表示モード切替信号の組み合わせにより、走査回路の良否判定を行うモードとすることができる。また、あるタイミングでの出力に応じて、走査回路の良否判定を行うことができる。
【００５２】
従って、簡単な構成で、走査回路の良否判定、即ち、走査回路が正常に動作しているか否かの判定を行うことができる。
【００５３】
上記の表示装置は、表示モード切替信号が入力される第１ＮＯＲゲートと、表示モード切替信号が全て０であるときにのみ、第１ＮＯＲゲートからの出力が入力される第２ＮＯＲゲートとを備え、第１ＮＯＲゲートからの出力およびその反転出力により駆動されるアナログスイッチにより、第１ＮＯＲゲートからの出力が０のとき第２ＮＯＲゲートへの入力がすべてプルアップされ、かつ、表示モード切替信号が第１ＮＯＲゲートから第２ＮＯＲゲートに入力された後は、その後表示モード切替信号が異なる組み合わせに変化しても、第２ＮＯＲゲートがアナログスイッチにより切り離されていることにより、第２ＮＯＲゲートの入力状態が容量に一定期間保持されることが好ましい。
【００５４】
上記の構成によれば、検査用端子を新たに設ける必要が無く、走査回路の動作の検査を行うことができる。
【００５５】
従って、特に、小型高精細パネル、モバイル機器、あるいはプロジェクション用などの小型高精細の液晶表示装置など、新たな端子を設けるスペースが小さな場合にも、走査回路の良否の判定を高速かつ確実に行うことができる。
【００５６】
本発明の表示装置は、上記の課題を解決するために、マトリクス状に配置される画素を線順次に選択して走査するためのゲートドライバと、上記選択されたラインの画素にデータ信号を供給するためのソースドライバとを備え、上記ゲートドライバおよび上記ソースドライバのうちの少なくとも一方のドライバが基板上にモノリシックに形成された表示装置において、モノリシックに形成された上記ドライバは上記シフト方向を双方向に切り替える切替手段を備え、上記両ドライバのうち、モノリシックに形成された上記ドライバの走査回路には、上記双方向それぞれに対応して、クロック信号と、一定の幅を有し、シフトデータとして上記クロック信号に同期して、モノリシックに形成された上記ドライバの走査回路でシフトされるスタートパルスとが一定の周期で入力され、上記スタートパルスが第１方向にシフトされ、第１方向最終段まで転送された後、上記切替手段は、シフト方向を第１方向から第２方向に切り替え、さらに、上記第１方向最終段まで転送された上記シフトデータは、一時ラッチ回路に保持され、あるいは、上記第２方向へシフトするデータとして上記走査回路に直接入力されて、上記クロック信号に同期して上記第２方向にシフトされ、上記第２方向最終段（即ち、第１方向の入力側）まで転送されたシフトデータを用いて上記走査回路の検査を行うことを特徴としている。
【００５７】
上記の構成によれば、空間的にシフトデータの入力側に判定のもととなる信号が戻ってくる。このため、走査回路の良否判定、即ち、走査回路が双方向において正常に動作しているか否かの判定を行うことができ、かつ、検査のための余分な端子や長い信号のとり回し配線をなくすことにより、配線の複雑化を回避することができる。
【００５８】
上記の表示装置は、第２方向最終段まで転送されたシフトデータと、モノリシックに形成されたドライバの走査回路に、シフトデータとなったスタートパルスの次に入力されたスタートパルスとを、比較または判定論理回路へ入力することにより、走査回路が正常に動作しているか否かを判定することが好ましい。
【００５９】
上記の構成によれば、ある一定の幅を有するパルスを検査に用いる検査信号とし、論理計算するため、途中で他のパルスなどがあったとしても、それを誤って検査信号として認識することはない。
【００６０】
従って、走査回路の良否判定、即ち、走査回路が双方向において正常に動作しているか否かの判定を確実に行うことができる。
【００６１】
上記の表示装置は、第２方向最終段まで転送されたシフトデータにおいて、該シフトデータとなったスタートパルスが入力されてから予め設定された時間後に、所定の値が出力されるか否かにより、走査回路が正常に動作しているか否かを判定することが好ましい。
【００６２】
上記の構成によれば、例えば、出力が１であるはずのタイミングで０が検出されたり、あるいは、出力が０であるはずのタイミングで１が検出されたりすることにより、走査回路が正常に動作していないことを確認することができる。
【００６３】
また、ドライバを、基板上における画素アレイ領域の周辺部の僅かな領域に作り込むことができる。従って、ＴＡＢ実装方式や、ＣＯＧ実装方式により駆動回路ＬＳＩを接続する場合と比較すると、基板の小額縁化を図ることができ、これにより、表示装置の小型化を図ることができる。
【００６４】
上記の表示装置は、走査回路が、金属触媒により結晶成長を促進した多結晶シリコンまたはポリシリコンからなることが好ましい。
【００６５】
上記の構成によれば、６００℃以下の低いプロセス温度で、基板上に走査回路を形成することができる。
【００６６】
上記の表示装置は、液晶、電気泳動、または有機エレクトロルミネッセンス（有機ＥＬ（ＯＬＥＤ）を用いて画素の表示を行うことが好ましい。
【００６７】
上記の構成によれば、例えば、液晶表示装置や、エレクトロルミネッセンス表示装置などとすることができる。
【００６８】
上記の表示装置は、スタートパルスとシフトデータのシフト方向最終段の出力との位相差を検出する位相差検出手段を備えていることが好ましい。
【００６９】
上記の構成によれば、スタートパルスと、シフトデータのシフト方向最終段の出力であって、予め設定された時間遅延してなされた出力とを用いて、走査回路の検査を精度良く行うことができる。
【００７０】
上記の表示装置は、切替手段が、クロックトインバータであり、クロックトインバータへの入力値に基づいて、シフト方向が切り替えられることが好ましい。
【００７１】
上記の構成によれば、双方向における走査回路の良否を判定することができる。
【００７２】
上記の表示装置は、走査回路の出力がマルチプレクサにより分割されることが好ましい。
【００７３】
上記の構成によれば、シフトレジスタの段数に対する走査信号出力数を増やすことができ、スペースの縮小を図ることができる。また、パルス出力の重なりを任意に設定することができる。
【００７４】
本発明の走査回路検査方法は、上記の課題を解決するために、クロック信号と、一定の幅を有し、シフトデータとして上記クロック信号に同期してシフトされるスタートパルスとを、一定の周期でドライバの走査回路に入力し、スタートパルスと、該スタートパルスに対応するシフトデータのシフト方向最終段の出力とを用いて論理計算し、その結果に基づいて上記走査回路が正常に動作しているか否かを判定することを特徴としている。
【００７５】
上記の構成によれば、スタートパルスと、シフトデータのシフト方向最終段の出力であって、予め設定された時間遅延してなされた出力とを用いて、走査回路の検査を行っている。
【００７６】
これにより、ある一定の幅を有するパルスを検査に用いる検査信号とし、論理計算するため、途中で他のパルスなどがあったとしても、それを誤って検査信号として認識することはない。
【００７７】
従って、確実に走査回路の良否判定、即ち、走査回路が正常に動作しているか否かの判定を行うことができる。
【００７８】
上記の走査回路検査方法は、シフトデータのシフト方向が双方向に切替可能な場合、スタートパルスと、該スタートパルスに対応するシフトデータのシフト方向最終段の出力とを用いて、各シフト方向において論理計算し、各シフト方向に対応した計算結果を用いてさらに論理計算することにより、走査回路が正常に動作しているか否かを判定することが好ましい。
【００７９】
上記の構成によれば、双方向における走査回路の良否判定を確実に行うことができる。
【００８０】
上記の走査回路検査方法は、２つの走査回路の各々において、論理計算をした後、それらの計算結果を用いて、さらに論理計算することにより、両走査回路が正常に動作しているか否かを判定することが好ましい。
【００８１】
上記の構成によれば、例えば小型高精細パネル、モバイル機器、あるいはプロジェクション用などの小型高精細の表示装置などにおいても、面積の増加や回路の複雑化を伴うことなく、確実に走査回路の良否判定を行うことができる。
【００８２】
本発明の走査回路検査方法は、上記の課題を解決するために、クロック信号と、一定の幅を有し、シフトデータとして上記クロック信号に同期してシフトされるスタートパルスとを、一定の周期でドライバの走査回路に入力し、シフトデータを第１方向にシフトし、該第１方向における最終段まで転送した後、一時ラッチ回路に保持し、シフト方向を上記第１方向とは反対方向の第２方向に切り替え、上記第１方向における最終段まで転送されたシフトデータをさらに、上記第２方向にシフトし、該第２方向における最終段の出力と、次のスタートパルスとを用いて上記走査回路が正常に動作しているか否かを判定することを特徴としている。
【００８３】
上記の構成によれば、双方向における走査回路の良否判定を確実に行うことができる。
【００８４】
【発明の実施の形態】
〔実施の形態１〕
本発明の表示装置に関する実施の一形態について図１ないし図６、および図９に基づいて説明すれば以下の通りである。
【００８５】
本実施の形態における液晶表示装置（表示装置）は、アクティブマトリクス基板と対向基板とが、液晶層を挟んで、対向配置されている。また、液晶表示装置は、画素がマトリクス状に配され、画素アレイ部を構成している。
【００８６】
アクティブマトリクス基板は、図９に示すように、ガラス基板（絶縁性基板）９０、薄膜トランジスタ（以下、ＴＦＴ：Thin Film Transistorと称する）９９、画素電極９２、ゲート線、データ線、層間絶縁膜９４、および補助容量配線（以下、ＣＳ配線と称する）９３を有している。
【００８７】
なお、ＴＦＴ９９は、ゲート線のゲート電極９１、データ線のデータ電極、チャネル層、ゲート絶縁膜９５、ＣＧ−Ｓｉ膜９８、金属配線１００などにより構成されている。
【００８８】
さらに、ガラス基板９０上には、図１に示すように、ゲート線に接続されたゲート走査回路（走査回路）を有するゲートドライバ（ドライバ）１と、データ線に接続されたソース走査回路（走査回路）を有するソースドライバ（ドライバ）２とが、モノリシックに形成されている。ゲート走査回路およびソース走査回路は、それぞれシフトレジスタからなる。
【００８９】
また、対向基板上には対向電極が配されており、画素電極９２と共に液晶を駆動する。
【００９０】
ここで、液晶の駆動原理について説明する。
【００９１】
液晶表示装置は、画面を表示するために、表示データを、ゲート線に沿って順次走査する。
【００９２】
例えば、あるゲート線を水平走査する場合、そのゲート線にＴＦＴ９９をＯＮ状態にするゲート電圧が印加される。このとき、その他のゲート線はＴＦＴ９９をＯＦＦ状態にするゲート電圧が印加されている。こうして、ゲート線の水平走査のときには、そのゲート線のみのＴＦＴ９９がＯＮ状態となり、データ線に印加されている信号電圧がソース電極からドレイン電極を経て、ゲート線の画素電極９２に加わる。
【００９３】
このとき、画素電極９２に与えられた電荷が電荷蓄積容量に蓄積される。こうして画素電極９２に印加された画素電圧と、対向電極に印加された対向電圧との電位差によって、各々の画素電極９２上の液晶は駆動される。
【００９４】
表示画面全体を一回走査する１フレーム期間中、即ち、次のゲート電圧が印加されるまでは、そのときの画素電圧が電荷蓄積容量によって保持され、液晶は駆動されている。なお、１フレーム期間とは、液晶パネルにおいて、１表示画面を上から下まで１回垂直走査することをいう。
【００９５】
このようにして、ゲート線から順次走査し、このときすべてのデータ線にそれぞれの画素の駆動状態に合わせた信号電圧を印加していけば、必要な画素をすべて表示することができる。
【００９６】
以下、ゲートドライバ１およびソースドライバ２の構成、および、それらのドライバ１・２を構成する、ゲート走査回路およびソース走査回路が正常に動作しているか否かの検査について図１を用いて説明する。ここで、ゲートドライバ１およびソースドライバ２は、それぞれ双方向の走査が可能である。
【００９７】
ゲートドライバ１へは、入力パッド（駆動信号入力端子）５を介して、ソースドライバ２へは、入力パッド（駆動信号入力端子）４を介してそれぞれ外部から信号が入力される。
【００９８】
ゲートドライバ１には、クロックＧ−ＣＫ（ＣＫ）およびスタートパルスＧ−ＳＰが入力される。ゲートドライバ１におけるシフトレジスタ（走査回路）では、クロックＧ−ＣＫに同期して、まず、スタートパルスＧ−ＳＰ（ＳＰ）がシフトデータとして１段目からｍ段目（最終段）までシフトされる。ここで、シフトデータのシフト方向最終段、即ち、ここではｍ段目から（最終）の出力は、図４に示すように、予め設定された時間遅延してなされる。
【００９９】
そして、そのｍ段目からの出力は、ＮＡＮＤゲート１３とインバータ１４とからなる第１論理回路（第１の論理回路）に入力される。
【０１００】
さらに、走査方向切替信号により、シフト方向が（第１方向から第２方向に）切り替えられ、ゲートドライバ１におけるシフトレジスタでは、クロックＧ−ＣＫに同期して、スタートパルスＧ−ＳＰがシフトデータとしてｍ段目から１段目（最終段）までシフトされる。ここで、シフトデータのシフト方向最終段、即ち、ここでは１段目からの出力は、予め設定された時間遅延してなされる。
【０１０１】
そして、その１段目からの出力は、ＮＡＮＤゲート１１とインバータ１２とからなる第１論理回路に入力される。
【０１０２】
また、インバータ１２からの出力（第１出力）およびインバータ１４からの出力（第１出力、第１の出力）は、ＮＯＲゲート１５からなる第２論理回路（第２の論理回路）に入力される。
【０１０３】
一方、ソースドライバ２には、クロックＳ−ＣＫ（ＣＫ）およびスタートパルスＳ−ＳＰ（スタートパルス）が入力される。ソースドライバ２におけるシフトレジスタでは、クロックＳ−ＣＫに同期して、まず、スタートパルスＳ−ＳＰ（ＳＰ）がシフトデータとして１段目からｎ段目（最終段）までシフトされる。ここで、シフトデータのシフト方向最終段、即ち、ここではｎ段目からの出力は、図４に示すように、予め設定された時間遅延してなされる。
【０１０４】
そして、そのｎ段目からの出力は、ＮＡＮＤゲート２３とインバータ２４とからなる第３論理回路（第１の論理回路）に入力される。
【０１０５】
さらに、シフトレジスタにより、シフト方向が切り替えられ、ソースドライバ２におけるシフトレジスタでは、クロックＳ−ＣＫに同期して、スタートパルスＳ−ＳＰがシフトデータとしてｎ段目から１段目（最終段）までシフトされる。ここで、シフトデータのシフト方向最終段、即ち、ここでは１段目からの出力は、予め設定された時間遅延してなされる。
【０１０６】
そして、その１段目からの出力は、ＮＡＮＤゲート２１とインバータ２２とからなる第３論理回路に入力される。
【０１０７】
また、インバータ２２からの出力（第３出力）およびインバータ２４からの出力（第３出力、第１の出力）は、ＮＯＲゲート２５からなる第４論理回路（第２の論理回路）に入力される。
【０１０８】
その後、ＮＯＲゲート１５からの出力（第２出力）およびＮＯＲゲート２５からの出力（第４出力）は、ＥＸ−ＯＲ（Exclusive OR：排他的論理和）３０からなる第５論理回路に入力される。ＥＸ−ＯＲ３０の出力（第５出力、検査出力信号）は、検査用パッド（検査用端子）３に入力され、外部に取り出される。
【０１０９】
即ち、ゲートドライバ１およびソースドライバ２のいずれも双方向走査に対応している場合、ゲートドライバ１からのＮＯＲゲート出力とソースドライバ２からのＮＯＲゲート出力とをＥＸ−ＯＲ３０に入力し、このＥＸ−ＯＲ３０の出力を、通常の入力パッド４・５と並設された検査用パッド３に接続しておく。
【０１１０】
そして、走査回路が正常に動作しているか否かという良否の判定は、この検査用パッド３にプローブ針を当てて観測し、予め設定したタイミングでの検査用パッド３からの出力（最終の出力）と、その前後の時間における出力との同異により、例えば、予め設定したタイミングで１が出力され、それ以外のタイミングでは０が出力されていることを確かめることにより、することができる。
【０１１１】
なお、走査回路の良否の判定は、これに限定されるものではなく、例えば、ＮＯＲゲート１５・２５の出力を直接プローブ針を当てて観測して行ってもかまわない。
【０１１２】
また、直接ＮＡＮＤゲート１１またはＮＡＮＤゲート１３、ＮＡＮＤゲート２１またはＮＡＮＤゲート２３、あるいは、インバータ１２またはインバータ１４、インバータ２２またはインバータ２４の出力を観測することによって、走査回路の良否の判定を行ってもかまわない。この場合、双方向走査に対応していないドライバにも適用することができる。
【０１１３】
上記論理回路における組み合わせは、同様の論理が最終的に実現できるものであれば上述したものに限定されるものではない。また、正論理に限定されるものではなく、負論理の信号に対しても同様の機能を持たせることもできる。
【０１１４】
ここで、ドライバ１・２における双方向走査は、図２に示す構成のシフトレジスタによって行う。ここで、Ｒは、シフト方向が図中左から右向き、Ｌは、シフト方向が図中右から左向き、φは制御信号であることを示す。
【０１１５】
入力されたスタートパルスＳＰは、クロックＣＫの１／２の周期でシフトし、出力するシフトデータのパルス幅はクロックの１周期分となる。通常は、隣接するパルスが重ならないように、隣接出力間でＮＡＮＤゲートを通す、あるいは、分周回路を通すなどの手段により、出力するシフトデータのパルス幅をクロックＣＫの１／２周期となるように設定している。
【０１１６】
シフトデータのシフト方向最終段の出力を、予め設定された時間遅延させるための遅延回路は、図２に示すシフトレジスタと同様のシフトレジスタで形成でき、必要な遅延時間に対応する段数を形成しておけばよい。
【０１１７】
なお、双方向走査を実現するための手段は、上記シフトレジスタに限定されるものではなく、図３（ａ）（ｂ）に示すフリップフロップを用い、その入力と出力とをアナログスイッチによりつなぎかえてもよい。
【０１１８】
また、ドライバ１・２は、双方向走査できるものに特に限定されるものではなく、一方向のみの走査を行うものでもかまわない。
【０１１９】
以下に、アクティブマトリクス基板の製造工程の一例について説明する。
【０１２０】
まず、絶縁性の例えばガラス基板９０上の全面に、ａ−Ｓｉ層を堆積した後、Ｓｉ表面を親水性にするために、薄い酸化膜を形成し、その上に酢酸Ｎｉ水溶液をスピンコートする。
【０１２１】
次に、６００℃で約１２時間固相成長を行い、その上にＳｉＯ2膜を堆積し、デバイスの活性領域を形成する部分以外の酸化膜を除去する。
【０１２２】
その後、酸化膜をマスクに、上記ａ−Ｓｉ層の一部の領域に高濃度のＰ+イオンを注入し（１５ｋｅＶ、５×１０15ｃｍ-2）、６００℃で１２時間熱処理を行う。その後、ＳｉＯ2膜を除去し、再度Ｓｉ上全面にＳｉＯ2膜を堆積し、９５０℃で約２時間塩酸を含む酸化雰囲気で約３０分酸化処理を行う。そして、デバイスの活性領域となる部分を残し、不要なＳｉ膜を除去する。
【０１２３】
これにより、ＴＦＴおよびドライバ１・２の走査回路が、金属触媒により結晶成長を促進した多結晶シリコンである連続粒界結晶シリコンを含むこととなる。
【０１２４】
以降は、通常の良く知られたポリシリコンＴＦＴ形成プロセスと同様のプロセスにより、順次、ゲート絶縁膜９５、ゲート電極、Ｎ+（Ｐ+イオン）およびＰ+（Ｂ+イオン）注入、ＳｉＯ2およびＢＰＳＧからなる平坦化膜９７、コンタクトホール９７ａ、金属（ＡｌＳｉ）配線１００、ＳｉＮｘ膜９６、およびＳｉＯ2からなる層間絶縁膜９４、遮光膜、ビアホール９４ａ、ＩＴＯやＩＺＯからなり透明電極である画素電極９２を順次形成する。これにより、走査回路および表示部のＴＦＴ９９を形成する。
【０１２５】
なお、平坦化膜９７におけるＢＰＳＧは、アクリル樹脂やポリイミドなどの樹脂であってもかまわない。
【０１２６】
このように、金属触媒により結晶化を促進して得られた連続粒界結晶シリコン（ＣＧ−Ｓｉ：Continuous Grain Silicon）からなるＴＦＴ９９は、従来の高温ポリシリコンＴＦＴの移動度が約１００ｃｍ2／Ｖ・ｓｅｃであったのに対し、約２〜２．５倍の移動度を有する。
【０１２７】
なお、ＴＦＴおよびドライバ１・２の走査回路は、ＣＧ−Ｓｉに限定されるものではなく、ｐ−Ｓｉ（ポリシリコン）からなるものであっても、走査回路の良否判定については、上記と同様の効果が得られる。
【０１２８】
また、ドライバ１・２における双方向走査の走査方向（シフト方向）切り替えは、図２あるいは図３に示すように、クロックトインバータのＬ・Ｒへの信号、あるいは、アナログスイッチの設定を切り替えてもかまわない。入力と最終段出力との切り替えは、図５に示すように、アナログスイッチ５１・５２を用いて行ってもかまわない。
【０１２９】
アナログスイッチ５１・５２は、電子回路部からの走査方向切替信号に基づいてアナログスイッチ５１…、あるいは、アナログスイッチ５２…のいずれかが選択され、ＯＮになる。
【０１３０】
アナログスイッチ５１…がＯＮのとき、ゲートドライバ１ではスタートパルスＧ−ＳＰがシフトデータとして１段目からｍ段目（最終段）までシフトされる。また、ソースドライバ２ではスタートパルスＳ−ＳＰがシフトデータとして１段目からｎ段目（最終段）までシフトされる。
【０１３１】
そして、ゲートドライバ１におけるｍ段目からの出力と、ソースドライバ２におけるｎ段目からの出力とが、ＥＸ−ＯＲ（論理回路）５０に入力され、論理計算される。
【０１３２】
そして、スタートパルスＳ−ＳＰまたはスタートパルスＧ−ＳＰが入力されてから予め設定された時間後のＥＸ−ＯＲ５０からの出力（出力）が１であり、その前後の時間における出力が０である場合に、ゲート走査回路およびソース走査回路は正常に動作していると判定される。
【０１３３】
一方、アナログスイッチ５２…がＯＮのときも、アナログスイッチ５１…がＯＮのときと同様に（ただし、走査方向はアナログスイッチ５１…がＯＮのときと反対方向）論理計算され、走査回路の良否が判定される。
【０１３４】
また、図６に示すように、図１に示すＮＡＮＤゲート２１およびインバータ２２と並列にＥＸ−ＯＲ６１を、ＮＡＮＤゲート２３およびインバータ２４と並列にＥＸ−ＯＲ６２を接続し、さらに、インバータ２２からの出力とＥＸ−ＯＲ６１からの出力とをＮＯＲゲート６３に、インバータ２４からの出力とＥＸ−ＯＲ６２からの出力とをＮＯＲゲート６４に入力し、ＮＯＲゲート６３からの出力とＮＯＲゲート６４からの出力とをＥＸ−ＯＲ６５に入力することにより、走査回路の良否判定を行ってもかまわない。
【０１３５】
これにより、ゲート走査回路およびソース走査回路のうちのいずれかが正常に動作せず、所定の値（例えば「１」）が出力されるべきタイミング以外で該所定値（この場合「１」）が出力されることを検出することができる。
【０１３６】
なお、本実施の形態は、表示装置として液晶表示装置を用いて説明したが、特に限定されるものではなく、他の電気泳動、あるいは有機ＥＬ（エレクトロルミネッセンス）などの発光ダイオードを用いた表示装置でも同様の効果が得られる。
【０１３７】
また、上記走査回路の出力は、マルチプレクサにより分割されていてもかまわない。これにより、スペースの縮小およびシフトレジスタの段数の低減を図ることができる。また、より広い範囲で、走査回路の検査を行うことができる。
【０１３８】
さらに、走査回路において、入力されたスタートパルスとそれに対応するシフトデータのシフト方向最終段の出力との位相差を検出する位相差検出手段を備えていてもかまわない。
【０１３９】
これにより、スタートパルスと、シフトデータのシフト方向最終段の出力であって、予め設定された時間遅延してなされた出力とを用いて、走査回路の検査を精度良く行うことができる。
【０１４０】
〔実施の形態２〕
本発明の他の実施の形態について図７に基づいて説明すれば、以下の通りである。なお、本実施の形態において、実施の形態１における構成要素と同等の機能を有する構成要素については、同一の符号を付記してその説明を省略する。
【０１４１】
本実施の形態に係る液晶表示装置は、図７に示すように、実施の形態１において図１に示した構成と同様、シフト方向が双方向に切り替え可能なゲートドライバ１・ソースドライバ２、および入力パッド４・５を備えている。
【０１４２】
ゲートドライバ１・ソースドライバ２からは、そのシフト方向に対応してその最終段から出力されるが、入力される走査方向切替信号に応じて、双方向のうちどちらかのシフト方向に対応する出力が、アナログスイッチによって選択される。
【０１４３】
選択された出力は、そのまま、あるいは遅延してＥＸ−ＯＲ７６に入力される。
【０１４４】
また、本実施の形態においては、３種類の表示モード切替信号（ＭＯＤＥ１信号、ＭＯＤＥ２信号、ＭＯＤＥ３信号（図７中ＭＯＤＥ１、ＭＯＤＥ２、ＭＯＤＥ３））に基づいて、３種類の画像表示フォーマット（表示モード）を切り替えて用いる。ここでは、３種類の表示モード切替信号がすべて０の組み合わせで入力パッド７５…に入力されたときに、表示モード切替回路の配線の途中から分岐して、３入力のＮＯＲゲート（第２ＮＯＲゲート）７２に入力されて、テストモードに切り替えられる。３種類の表示モード切替信号の組み合わせの一例を以下の表１に示す。
【０１４５】
【表１】
【０１４６】
ここで、ＭＯＤＥ１信号、ＭＯＤＥ２信号、ＭＯＤＥ３信号は表示切替用のＤＣレベルである。また、表１中に「×」とあるのは、この部分のみ例えばブランキング時にパルス信号が出ることをさす。このとき、例えば画面の上下領域（非表示領域）の走査出力が全てＯＮ（Ｈ）の状態になり、これにより、画素には黒の表示データが書き込まれる。
【０１４７】
即ち、テストモードの場合、３種類の表示モード切替信号は、ＮＯＲゲート７１（第１ＮＯＲゲート）の出力により駆動されるアナログスイッチを介して、ＮＯＲゲート７２に入力される。
【０１４８】
そして、ＮＯＲゲート７２の出力により、走査回路の動作に影響しない特定の信号線、ここでは、プリチャージ制御線からＰＣＧ（プリチャージ制御信号）が切り離され、そのかわりにＥＸ−ＯＲ７６の出力が、プリチャージ制御線の入力端子７４にアナログスイッチを介して接続される。
【０１４９】
ここで、ＮＯＲゲート７２の各入力には、メモリ用の小さいキャパシタ（非補助容量）７３が接続されている。このため、テストモードが設定された後、いずれかの入力パッド７５に１が入力され、ＮＯＲゲート７２が３種類の表示モード切替信号からアナログスイッチで切り離されても、キャパシタ７３の容量により、テストモードに設定された状態が維持される。その後、十分な時間が経過した後、テストモードは自動的に通常の動作モード（ＭＯＤＥ１〜３）に復帰する。
【０１５０】
上記ＥＸ−ＯＲ７６の出力は、テストモードに設定された場合のみ入力端子７４に自動的に出力される。入力端子７４にプローブ針を当てて信号を観察することにより、ＥＸ−ＯＲ７６の出力が、予め設定されたタイミング１であり、それ以外では０であるか否かを検出することにより、走査回路の良否判定を行うことができる。即ち、出力が１であるはずのタイミングで０が検出されたり、あるいは、出力が０であるはずのタイミングで１が検出されたりすることにより、走査回路が正常に動作していないことが確認できる。
【０１５１】
これにより、検査用端子を新たに設ける必要が無く、走査回路の動作の検査を行うことができる。
【０１５２】
従って、特に、小型高精細パネル、モバイル機器、あるいはプロジェクション用などの小型高精細の液晶表示装置など、新たな端子を設けるスペースが小さな場合にも、走査回路の良否の判定を高速かつ確実に行うことができる。
【０１５３】
なお、上述した表示モード切替信号の組み合わせは、単なる一例であり、本実施の形態に記載の組み合わせに限定されるものではない。
【０１５４】
〔実施の形態３〕
本発明のさらに他の実施の形態について図８に基づいて説明すれば、以下の通りである。なお、本実施の形態において、実施の形態１における構成要素と同等の機能を有する構成要素については、同一の符号を付記してその説明を省略する。
【０１５５】
本実施の形態に係る液晶表示装置は、図８に示すように、実施の形態１において図１に示した構成と同様、シフト方向が双方向に切り替え可能なゲートドライバ１・ソースドライバ２、検査用パッド３および入力パッド４・５を備えている。
【０１５６】
ゲートドライバ１に、クロックＧ−ＣＫおよびスタートパルスＧ−ＳＰが入力され、シフト方向が第１方向にセットされると、ゲートドライバ１におけるシフトレジスタでは、クロックＧ−ＣＫに同期して、まず、スタートパルスＧ−ＳＰがシフトデータとして１段目からｍ段目（第１方向における最終段）までシフトされる。なお、このときスイッチ８４がＯＮ、スイッチ８５がＯＦＦとなっている。また、例えば、検査をしない設定で、逆方向走査のときは、スイッチ８４をＯＦＦ、スイッチ８５をＯＮに設定する。
【０１５７】
そのｍ段目からの出力はラッチ回路に保持されることにより一時ラッチされる。そして、シフト方向が第１方向とは反対方向の第２方向に切り替えられる、即ちラッチされていた出力を入力とし、順次クロックＧ−ＣＫに同期して、シフトデータとしてｍ段目から１段目（最終段、第２方向における最終段）までシフトされる。
【０１５８】
そして、最終段、即ち、１段目まで転送されたシフトデータは、ラッチ回路により一時ラッチされ、次のスタートパルスＧ−ＳＰとともにＮＡＮＤゲート８１に入力され、論理計算される。
【０１５９】
一方、ソースドライバ２においても、ゲートドライバ１と同様に、ｎ段目まで転送されたシフトデータが一時ラッチされた後、再び入力されて、１段目まで転送される。そして、１段目まで転送されたシフトデータは、一時ラッチされ、次のスタートパルスＳ−ＳＰとともにＮＡＮＤゲート８２に入力され、論理計算される。
【０１６０】
そして、ＮＡＮＤゲート８１からの出力とＮＡＮＤゲート８２からの出力とは、ＥＸ−ＯＲ８０に入力され論理計算される。
【０１６１】
ＥＸ−ＯＲ８０の出力が予め設定されたタイミングで１であり、それ以外では０であるか否かを検出することにより、走査回路の良否判定を行うことができる。即ち、出力が１であるはずのタイミングで０が検出されたり、あるいは、出力が０であるはずのタイミングで１が検出されたりすることにより、走査回路が正常に動作していないことが確認できる。
【０１６２】
なお、ｍ段目およびｎ段目におけるシフトデータの一時ラッチは、水平および垂直のブランキングに対応させてタイミングを調節するもので、ブランキング時間がない場合は、行っても行わなくてもかまわない。
【０１６３】
また、ＮＡＮＤゲート８１・８２を用いることなく、シフトデータとスタートパルスとの比較を行うことにより、走査回路の良否判定を行ってもかまわない。
【０１６４】
【発明の効果】
本発明の表示装置は、以上のように、ゲートドライバおよびソースドライバのうち、モノリシックに形成されたドライバの走査回路には、クロック信号と、一定の幅を有し、シフトデータとしてクロック信号に同期して、モノリシックに形成されたドライバの走査回路でシフトされるスタートパルスとが一定の周期で入力され、スタートパルスと、該スタートパルスに対応するシフトデータのシフト方向最終段の出力であって、予め設定された時間遅延してなされた出力とが、第１の論理回路に入力され、該第１の論理回路からの第１の出力により走査回路の検査を行う構成である。
【０１６５】
これにより、ある一定の幅を有するパルスを検査に用いる検査信号とし、論理計算するため、途中で他のパルスなどがあったとしても、それを誤って検査信号として認識することはない。
【０１６６】
従って、確実に走査回路の良否判定、即ち、走査回路が正常に動作しているか否かの判定を行うことができる。
【０１６７】
また、ドライバが基板上にモノリシックに形成されていることより、ドライバ（駆動回路）の走査回路を、スイッチング素子と同一プロセスで形成することができる。これにより、例えば、駆動回路ＬＳＩを後から別途設ける必要がなくなり、製造コストの削減および実装工程の簡略化を図ることができるといった効果を奏する。
【０１６８】
本発明の表示装置は、モノリシックに形成されたドライバはシフト方向を双方向に切り替える切替手段を備え、ドライバの走査回路には、クロック信号とスタートパルスとが入力され、各々のシフト方向における各第１の出力は第２の論理回路に入力され、該第２の論理回路からの第２の出力により走査回路の検査を行う構成である。
【０１６９】
これにより、上記の構成によれば、双方向における走査回路の良否判定を確実に行うことができるといった効果を奏する。
【０１７０】
本発明の表示装置は、シフト方向を双方向に切り替える切替手段を備えるゲートドライバおよびソースドライバの各走査回路には、クロック信号と、一定の幅を有し、シフトデータとしてクロック信号に同期して走査回路でシフトされるスタートパルスとが一定の周期で入力され、ゲートドライバの走査回路へのスタートパルスと、該ゲートドライバの走査回路へのスタートパルスに対応するシフトデータのシフト方向最終段の出力であって、予め設定された時間遅延してなされた出力とが、シフト方向ごとにそれぞれ第１論理回路に入力され、各々のシフト方向における各第１論理回路からの各第１出力は共に第２論理回路に入力される一方、ソースドライバの走査回路へのスタートパルスと、該ソースドライバの走査回路へのスタートパルスに対応するシフトデータのシフト方向最終段の出力であって、予め設定された時間遅延してなされた出力とが、上記シフト方向ごとにそれぞれ第３論理回路に入力され、各々のシフト方向における各第３論理回路からの各第３出力は共に第４論理回路に入力され、第２出力と第４出力とは、第５論理回路に入力され、該第５論理回路の第５出力により両走査回路の検査を行う構成である。
【０１７１】
これにより、ある一定の幅を有するパルスを検査に用いる検査信号とし、論理計算するため、途中で他のパルスなどがあったとしても、それを誤って検査信号として認識することはない。
【０１７２】
従って、確実に走査回路の良否判定、即ち、走査回路が正常に動作しているか否かの判定を行うことができる。
【０１７３】
この結果、例えば小型高精細パネル、モバイル機器、あるいはプロジェクション用などの小型高精細の表示装置などにおいても、面積の増加や回路の複雑化を伴うことなく、確実に走査回路の良否判定を行うことができるといった効果を奏する。
【０１７４】
本発明の表示装置は、第５出力が接続された検査用端子を備えている構成である。
【０１７５】
これにより、一部あるいは全ての走査回路の最終段の出力を簡単な構成の論理回路を通して、１本の信号として１個の検査用端子（例えば、パッド）に出力することができる。従って、例えば検査用端子にプローブ針を当てることにより、容易に、走査回路の良否判定を行うことができるといった効果を奏する。
【０１７６】
本発明の表示装置は、ゲートドライバおよびソースドライバのうち少なくとも一方は、シフト方向を双方向に切り替える切替手段と、いずれかのシフト方向の最終段の出力とスタートパルスとを選択するアナログスイッチとを備え、両ドライバの各走査回路には、シフト方向ごとに、クロック信号と、一定の幅を有し、シフトデータとしてクロック信号に同期して走査回路でシフトされるスタートパルスとが一定の周期で入力され、両走査回路の最終段からの出力は、共に論理回路に入力され、該論理回路の出力により両走査回路の検査を行う構成である。
【０１７７】
これにより、ある一定の幅を有するパルスを検査に用いる検査信号とし、論理計算するため、途中で他のパルスなどがあったとしても、それを誤って検査信号として認識することはない。
【０１７８】
従って、簡単な構成で、確実に双方向における走査回路の良否判定、即ち、走査回路が正常に動作しているか否かの判定を行うことができるといった効果を奏する。
【０１７９】
本発明の表示装置は、走査回路の検査において、スタートパルスが入力されてから予め設定された時間後の、検査に用いるための走査回路および論理回路からの出力のうち最終の出力を検出することにより、走査回路が正常に動作しているか否かを判定する構成である。
【０１８０】
即ち、スタートパルスが入力されてから予め設定された時間後の最終の出力が、その前後の時間における該最終の出力とは異なる所定の値となる場合に、走査回路は正常に動作していると判定する構成である。
【０１８１】
具体的には、第１の論理回路は、ＮＡＮＤゲートとインバータとから、第２の論理回路はＮＯＲゲートからなり、かつ、スタートパルスのシフト方向最終段の出力が０または１のとき、スタートパルスが入力されてから予め設定された時間後の第２の出力が１または０であり、その前後の時間における第２の出力が０または１である場合に、走査回路は正常に動作していると判定される構成である。
【０１８２】
あるいは、第１論理回路および第３論理回路は、ＮＡＮＤゲートとインバータとから、第２論理回路および第４論理回路はＮＯＲゲートから、第５論理回路はExclusive ORからなり、各スタートパルスが入力されてから予め設定された時間後の、各スタートパルスに対応する第１出力および第３出力が１であり、第２出力および第４出力が０であるとき、その前後の時間における第１出力および第３出力が０であり、第２出力および第４出力が１である場合に、両走査回路は正常に動作していると判定される構成である。
【０１８３】
これにより、論理回路に簡単な判定機能をもたせることができ、予め設定されたタイミングである出力が出るか否かにより、走査回路が正常に動作しているか否かを判定することができる。
【０１８４】
従って、走査回路の良否を高速、かつ、精度良く判定することができるといった効果を奏する。
【０１８５】
本発明の表示装置は、シフト方向最終段の出力を、所定の段数だけさらにシフトさせることにより、予め設定された時間遅延させる遅延手段を備えている構成である。
【０１８６】
これにより、簡単な構成で、スタートパルスと、シフトデータのシフト方向最終段の出力であって、予め設定された時間遅延してなされた出力とを用いて、走査回路の検査を行うことができるといった効果を奏する。
【０１８７】
本発明の表示装置は、遅延手段は、シフトレジスタである構成である。
【０１８８】
これにより、簡単な構成で、走査回路が双方向にシフト可能とすることができるといった効果を奏する。
【０１８９】
本発明の表示装置は、論理回路がExclusive ORからなり、スタートパルスが入力されてから予め設定された時間後の出力が１であり、その前後の時間における出力が０である場合に、両走査回路は正常に動作していると判定される構成である。
【０１９０】
これにより、予め設定されたタイミングである出力が出るか否かにより、走査回路が正常に動作しているか否かを判定することができる。
【０１９１】
従って、走査回路の良否を高速、かつ、精度良く判定することができるといった効果を奏する。
【０１９２】
本発明の表示装置は、入力される表示モード切替信号によって切替可能な複数の表示モードを有し、表示モード切替信号がある特定の組み合わせで入力されたときには、論理回路の出力を両走査回路の動作に影響しない信号配線における信号端子に出力し、かつ、信号配線に入力される本来の信号を該信号配線から切り離すことにより、予め設定されたタイミングにおける出力を用いて両走査回路が正常に動作しているか否かを判定する構成である。
【０１９３】
これにより、表示モード切替信号の組み合わせにより、走査回路の良否判定を行うモードとすることができる。また、あるタイミングでの出力に応じて、走査回路の良否判定を行うことができる。
【０１９４】
従って、簡単な構成で、走査回路の良否判定、即ち、走査回路が正常に動作しているか否かの判定を行うことができるといった効果を奏する。
【０１９５】
本発明の表示装置は、表示モード切替信号が入力される第１ＮＯＲゲートと、表示モード切替信号が全て０であるときにのみ、第１ＮＯＲゲートからの出力が入力される第２ＮＯＲゲートとを備え、第１ＮＯＲゲートからの出力およびその反転出力により駆動されるアナログスイッチにより、第１ＮＯＲゲートからの出力が０のとき第２ＮＯＲゲートへの入力がすべてプルアップされ、かつ、表示モード切替信号が第１ＮＯＲゲートから第２ＮＯＲゲートに入力された後は、その後表示モード切替信号が異なる組み合わせに変化しても、第２ＮＯＲゲートがアナログスイッチにより切り離されていることにより、第２ＮＯＲゲートの入力状態が容量に一定期間保持される構成である。
【０１９６】
これにより、検査用端子を新たに設ける必要が無く、走査回路の動作の検査を行うことができる。
【０１９７】
従って、特に、小型高精細パネル、モバイル機器、あるいはプロジェクション用などの小型高精細の液晶表示装置など、新たな端子を設けるスペースが小さな場合にも、走査回路の良否の判定を高速かつ確実に行うことができるといった効果を奏する。
【０１９８】
本発明の表示装置は、モノリシックに形成されたドライバはシフト方向を双方向に切り替える切替手段を備え、ゲートドライバおよびソースドライバのうち、モノリシックに形成されたドライバの走査回路には、双方向それぞれに対応して、クロック信号と、一定の幅を有し、シフトデータとしてクロック信号に同期して、モノリシックに形成されたドライバの走査回路でシフトされるスタートパルスとが一定の周期で入力され、スタートパルスが第１方向にシフトされ、第１方向最終段まで転送された後、切替手段は、シフト方向を第１方向から第２方向に切り替え、さらに、第１方向最終段まで転送されたシフトデータは、一時ラッチ回路に保持され、あるいは、第２方向へシフトするデータとして走査回路に直接入力されて、クロック信号に同期して第２方向にシフトされ、第２方向最終段（即ち、第１方向の入力側）まで転送されたシフトデータを用いて走査回路の検査を行う構成である。
【０１９９】
これにより、空間的にシフトデータの入力側に判定のもととなる信号が戻ってくる。このため、走査回路の良否判定、即ち、走査回路が双方向において正常に動作しているか否かの判定を行うことができ、かつ、検査のための余分な端子や長い信号のとり回し配線をなくすことにより、配線の複雑化を回避することができるといった効果を奏する。
【０２００】
本発明の表示装置は、第２方向最終段まで転送されたシフトデータと、モノリシックに形成されたドライバの走査回路に、シフトデータとなったスタートパルスの次に入力されたスタートパルスとを、比較または判定論理回路へ入力することにより、走査回路が正常に動作しているか否かを判定する構成である。
【０２０１】
これにより、ある一定の幅を有するパルスを検査に用いる検査信号とし、論理計算するため、途中で他のパルスなどがあったとしても、それを誤って検査信号として認識することはない。
【０２０２】
従って、走査回路の良否判定、即ち、走査回路が双方向において正常に動作しているか否かの判定を確実に行うことができるといった効果を奏する。
【０２０３】
本発明の表示装置は、第２方向最終段まで転送されたシフトデータにおいて、該シフトデータとなったスタートパルスが入力されてから予め設定された時間後に、所定の値が出力されるか否かにより、走査回路が正常に動作しているか否かを判定することが好ましい。
【０２０４】
これにより、例えば、出力が１であるはずのタイミングで０が検出されたり、あるいは、出力が０であるはずのタイミングで１が検出されたりすることにより、走査回路が正常に動作していないことを確認することができる。
【０２０５】
また、ドライバを、基板上における画素アレイ領域の周辺部の僅かな領域に作り込むことができる。従って、ＴＡＢ実装方式や、ＣＯＧ実装方式により駆動回路ＬＳＩを接続する場合と比較すると、基板の小額縁化を図ることができ、これにより、表示装置の小型化を図ることができるといった効果を奏する。
【０２０６】
本発明の表示装置は、走査回路が、金属触媒により結晶成長を促進した多結晶シリコンまたはポリシリコンからなる構成である。
【０２０７】
これにより、６００℃以下の低いプロセス温度で、基板上に走査回路を形成することができるといった効果を奏する。
【０２０８】
本発明の表示装置は、液晶、電気泳動、または有機エレクトロルミネッセンスを用いて画素の表示を行う構成である。
【０２０９】
これにより、例えば、液晶表示装置や、エレクトロルミネッセンス表示装置などとすることができるといった効果を奏する。
【０２１０】
本発明の表示装置は、スタートパルスとシフトデータのシフト方向最終段の出力との位相差を検出する位相差検出手段を備えていることが好ましい。
【０２１１】
上記の構成によれば、スタートパルスと、シフトデータのシフト方向最終段の出力であって、予め設定された時間遅延してなされた出力とを用いて、位相差を出力する位相差検出手段により、走査回路の良否判定ができるといった効果を奏する。
【０２１２】
本発明の表示装置は、切替手段が、クロックトインバータであり、クロックトインバータへの入力値に基づいて、シフト方向が切り替えられる構成である。
【０２１３】
これにより、一部のクロックトインバータをＯＦＦとすることでシフト方向が切り替えられ、双方向における走査回路の良否を判定することができるといった効果を奏する。
【０２１４】
本発明の表示装置は、走査回路の出力がマルチプレクサにより分割される構成である。
【０２１５】
これにより、シフトレジスタの段数に対する走査信号出力数を増やすことができ、スペースの縮小を図ることができる。また、パルス出力の重なりを任意に設定することができるといった効果を奏する。
【０２１６】
本発明の走査回路検査方法は、クロック信号と、一定の幅を有し、シフトデータとして上記クロック信号に同期してシフトされるスタートパルスとを、一定の周期でドライバの走査回路に入力し、スタートパルスと、該スタートパルスに対応するシフトデータのシフト方向最終段の出力とを用いて論理計算し、その結果に基づいて上記走査回路が正常に動作しているか否かを判定する構成である。
【０２１７】
これにより、ある一定の幅を有するパルスを検査に用いる検査信号とし、論理計算するため、途中で他のパルスなどがあったとしても、それを誤って検査信号として認識することはない。
【０２１８】
従って、確実に走査回路の良否判定、即ち、走査回路が正常に動作しているか否かの判定を行うことができるといった効果を奏する。
【０２１９】
本発明の走査回路検査方法は、シフトデータのシフト方向が双方向に切替可能な場合、スタートパルスと、該スタートパルスに対応するシフトデータのシフト方向最終段の出力とを用いて、各シフト方向において論理計算し、各シフト方向に対応した計算結果を用いてさらに論理計算することにより、走査回路が正常に動作しているか否かを判定する構成である。
【０２２０】
これにより、双方向における走査回路の良否判定を確実に行うことができるといった効果を奏する。
【０２２１】
本発明の走査回路検査方法は、２つの走査回路の各々において、論理計算をした後、それらの計算結果を用いて、さらに論理計算することにより、両走査回路が正常に動作しているか否かを判定する構成である。
【０２２２】
これにより、例えば小型高精細パネル、モバイル機器、あるいはプロジェクション用などの小型高精細の表示装置などにおいても、面積の増加や回路の複雑化を伴うことなく、確実に走査回路の良否判定を行うことができるといった効果を奏する。
【０２２３】
本発明の走査回路検査方法は、クロック信号と、一定の幅を有し、シフトデータとして上記クロック信号に同期してシフトされるスタートパルスとを、一定の周期でドライバの走査回路に入力し、シフトデータを第１方向にシフトし、該第１方向における最終段まで転送した後、一時ラッチ回路に保持し、シフト方向を上記第１方向とは反対方向の第２方向に切り替え、上記第１方向における最終段まで転送されたシフトデータをさらに、上記第２方向にシフトし、該第２方向における最終段の出力と、次のスタートパルスとを用いて上記走査回路が正常に動作しているか否かを判定する構成である。
【０２２４】
これにより、双方向における走査回路の良否判定を確実に行うことができるといった効果を奏する。
【図面の簡単な説明】
【図１】本発明の実施の一形態に係る液晶表示装置の概略構成を示す回路図である。
【図２】シフトレジスタの構成を示す回路図である。
【図３】（ａ）は、フリップフロップの構成を示す回路図であり、（ｂ）は、（ａ）に示すＡの構成を示す回路図である。
【図４】スタートパルスのシフト方向における駆動動作を示すタイミングチャートである。
【図５】シフト方向の切り替えに、アナログスイッチを用いる場合の構成を示す回路図である
【図６】図１に示すソースドライバに、ＮＯＲゲートおよびＥＸ−ＯＲをさらに接続した場合の回路図である。
【図７】本発明の実施の他の一形態に係る液晶表示装置の概略構成を示す回路図である。
【図８】本発明の実施のさらに他の一形態に係る液晶表示装置の概略構成を示す回路図である。
【図９】液晶表示装置の概略の構成を示す断面図である。
【図１０】従来の液晶表示装置の概略構成を示す回路図である。
【図１１】（ａ）は、従来の他の液晶表示装置の概略構成を示す回路図であり、（ｂ）は、（ａ）に示すシフトレジスタの構成を示す回路図である。である。
【図１２】従来のさらに他の液晶表示装置の概略構成を示す回路図である。
【符号の説明】
１ ゲートドライバ（ドライバ）
２ ソースドライバ（ドライバ）
３ 検査用パッド（検査用端子）
１１ ＮＡＮＤゲート（第１論理回路）
１２ インバータ（第１論理回路）
１３ ＮＡＮＤゲート（第１論理回路、第１の論理回路）
１４ インバータ（第１論理回路、第１の論理回路）
１５ ＮＯＲゲート（第２論理回路、第２の論理回路）
２１ ＮＡＮＤゲート（第３論理回路）
２２ インバータ（第３論理回路）
２３ ＮＡＮＤゲート（第３論理回路、第１の論理回路）
２４ インバータ（第３論理回路、第１の論理回路）
２５ ＮＯＲゲート（第４論理回路、第２の論理回路）
３０ ＥＸ−ＯＲ（第５論理回路）
５０ ＥＸ−ＯＲ（論理回路）
７１ ＮＯＲゲート（第１ＮＯＲゲート）
７２ ＮＯＲゲート（第２ＮＯＲゲート）
７６ ＥＸ−ＯＲ
８１ ＮＡＮＤゲート
８２ ＮＡＮＤゲート
【発明の属する技術分野】
本発明は、走査回路が正常に動作しているか否かを判定することができる表示装置およびその走査回路検査方法に関するものである。
【０００２】
【従来の技術】
従来、表示装置としての、ドライバモノシリック型の液晶表示装置は、一般に、ビデオデータをシフトレジスタで制御したアナログスイッチを介してサンプリングする。
【０００３】
例えば、図１１（ａ）に示すように、液晶表示装置は、画素部の各画素において画素容量ＣLC・補助容量ＣSが接続され、行状に配された複数のゲートラインと列状に配された複数のデータラインとの交差部にＴＦＴ（Thin Film Transistor）を備えている。ゲートラインはゲートドライバに、データラインはソースドライバに接続されている。
【０００４】
また、ＴＦＴと液晶層を介して対向するように、対向電極が配されている。対向電極には対向電圧ＶCOMが印加され、液晶を駆動する。
【０００５】
ゲートドライバは、ゲートパルスを順次出力し、各ゲートラインを順次走査して一水平期間ごとに１行分の画素を選択する。
【０００６】
また、ソースドライバは、シフトレジスタを用いて一水平期間内で各データラインを順次走査し、ビデオデータをサンプリングして選択された１行分の画素に点順次で書き込む。これにより、画像の表示が可能となる。
【０００７】
ここで、ソースドライバは、図１１（ｂ）に示すように、シフトレジスタとアナログスイッチとを備えている。
【０００８】
このような通常の表示と同様に、ドライバの不良を検査するときには、ソースドライバに入力されたビデオデータＶvideo1・Ｖvideo2をシフトレジスタで制御した図示しないアナログスイッチを介してサンプリングする。
【０００９】
即ち、ドライバの不良の検査は、通常の表示のときと同様に、上記ドライバを動作させ画素にデータを書き込んだ後、再びドライバを動作させ各々の画素に保持した電荷を、アナログスイッチを介して読み出す。これにより、画素欠陥とあわせてドライバの不良を検査・判定している。
【００１０】
しかしながら、この検査法では、プロジェクション用など小型高精細の表示装置のように、画素容量が小さく、読み出す電荷が微少となるにつれ、Ｓ／Ｎ比の低下、検査の精度低下を招来する。また、Ｓ／Ｎ比改善のため測定回数を増加したとしても、検査が長時間化するなどの問題があった。
【００１１】
また、ドライバの動作不良を、画素欠陥のあらわれ方の特徴から判断するため、データ処理に時間を要し、検査効率低下の原因になっていた。
【００１２】
そこで、図１０・１２に示すように、ドライバの走査回路を２個備え、パッドを用いてドライバ回路（走査回路）の検査を行う構成の表示装置が提案されている。
【００１３】
このように、ドライバ回路を２個備えることにより、冗長性を有し、例えば２つあるうちの一方のドライバ回路に故障があったとしても、他方のライバ回路が正常に動作していれば、表示装置全体としては、何ら問題ない。
【００１４】
また、図１２に示すように、ゲートドライバ１０１・ソースドライバ１０２内またはその周辺部にパッド１０３…を設け、このパッド１０３…に上記ドライバにおける走査回路の最終段の出力を引き出しておき、ここに検査用のプローブを当てて信号を検出することにより、検査の精度向上、および検査効率向上を図っていた。
【００１５】
あるいは、特願平６−１９４４２１号公報に記載されているように、複数の被検査回路部に対し、複数の機能検査に必要な検査回路部を内蔵する。また、その検査回路部は、検査機能に対応する情報を格納しておく手段と、被検査回路の構成情報を検査回路部に伝達する手段とを有する。これにより、検査回路部の構成および検査手段を簡単化することができ、ＢＩＳＴ（Built−In Self Test）を効率的に行うことができる。
【００１６】
【発明が解決しようとする課題】
しかしながら、上記図１２に示す構成では、検査専用のパッド１０３を複数個設ける必要がある。また、図１０に示すように、ゲートドライバ回路を２個備えることで、必要な検査専用のパッドの数も多くなる。
【００１７】
このような場合、特に、小型高精細パネル、モバイル機器、あるいはプロジェクション用などの小型高精細の表示装置などでは、ドライバ部の面積に厳しい制約にもかかわらず、大きな面積のパッドを形成しなければならないこととなる。また、配線の引き回しの制約や、後述するＥＳＤに対する保護の観点から、プローブカードの針を、外部からの駆動信号入力端子接続パッドとは配列が大きく異なるパッドに対応させる必要がある。
【００１８】
さらに、大面積のパッドが直接論理回路に接続されているため、このパッド１０３…がアンテナとしてはたらき、ＥＳＤ（Electrostatic Discharge：静電放電）による損傷が生じやすい。
【００１９】
また、上記公報の構成では、機能検査のための複雑な検査回路を形成する必要がある。ドライバモノシリック型の液晶表示装置などでは、表示画面部の微細加工レベルと面積とに基づき必要とされる加工精度、およびドライバの回路構成を考えると、このような検査回路用を内蔵することは実用的ではなく、より効果的な検査法が必要である。
【００２０】
本発明は、上記従来の問題点に鑑みなされたものであり、その目的は、面積の増加や回路の複雑化を伴うことなく、確実かつ高速に走査回路の良否判定を行うことができる表示装置およびその走査回路検査方法を提供することにある。
【００２１】
【課題を解決するための手段】
本発明の表示装置は、上記の課題を解決するために、マトリクス状に配置される画素を線順次に選択して走査するためのゲートドライバと、上記選択されたラインの画素にデータ信号を供給するためのソースドライバとを備え、上記ゲートドライバおよび上記ソースドライバのうちの少なくとも一方のドライバが基板上にモノリシックに形成された表示装置において、上記両ドライバのうち、モノリシックに形成された上記ドライバの走査回路には、クロック信号と、一定の幅を有し、シフトデータとして上記クロック信号に同期して、モノリシックに形成された上記ドライバの走査回路でシフトされるスタートパルスとが一定の周期で入力され、上記スタートパルスと、該スタートパルスに対応するシフトデータのシフト方向最終段の出力であって、予め設定された時間遅延してなされた出力とが、第１の論理回路に入力され、該第１の論理回路からの第１の出力により走査回路の検査を行うことを特徴としている。
【００２２】
上記の構成によれば、スタートパルスと、シフトデータのシフト方向最終段の出力であって、予め設定された時間遅延してなされた出力とを用いて、走査回路の検査を行っている。
【００２３】
これにより、ある一定の幅を有するパルスを検査に用いる検査信号とし、論理計算するため、途中で他のパルスなどがあったとしても、それを誤って検査信号として認識することはない。
【００２４】
従って、確実に走査回路の良否判定、即ち、走査回路が正常に動作しているか否かの判定を行うことができる。
【００２５】
また、ドライバが基板上にモノリシックに形成されていることより、ドライバ（駆動回路）の走査回路を、スイッチング素子と同一プロセスで形成することができる。これにより、例えば、駆動回路ＬＳＩを後から別途設ける必要がなくなり、製造コストの削減および実装工程の簡略化を図ることができる。
【００２６】
上記の表示装置は、モノリシックに形成されたドライバはシフト方向を双方向に切り替える切替手段を備え、上記ドライバの走査回路には、クロック信号とスタートパルスとが入力され、各々のシフト方向における各第１の出力は第２の論理回路に入力され、該第２の論理回路からの第２の出力により走査回路の検査を行うことが好ましい。
【００２７】
上記の構成によれば、双方向における走査回路の良否判定を確実に行うことができる。
【００２８】
本発明の表示装置は、上記の課題を解決するために、マトリクス状に配置される画素を線順次に選択して走査するためのゲートドライバと、上記選択されたラインの画素にデータ信号を供給するためのソースドライバとが基板上にモノリシックに形成された表示装置において、シフト方向を双方向に切り替える切替手段を備える上記両ドライバの各走査回路には、クロック信号と、一定の幅を有し、シフトデータとして上記クロック信号に同期して上記走査回路でシフトされるスタートパルスとが一定の周期で入力され、上記ゲートドライバの走査回路へのスタートパルスと、該ゲートドライバの走査回路へのスタートパルスに対応するシフトデータのシフト方向最終段の出力であって、予め設定された時間遅延してなされた出力とが、上記シフト方向ごとにそれぞれ第１論理回路に入力され、上記各々のシフト方向における各第１論理回路からの各第１出力は共に第２論理回路に入力される一方、上記ソースドライバの走査回路へのスタートパルスと、該ソースドライバの走査回路へのスタートパルスに対応するシフトデータのシフト方向最終段の出力であって、予め設定された時間遅延してなされた出力とが、上記シフト方向ごとにそれぞれ第３論理回路に入力され、上記各々のシフト方向における各第３論理回路からの各第３出力は共に第４論理回路に入力され、上記第２出力と上記第４出力とは、第５論理回路に入力され、該第５論理回路の第５出力により上記両走査回路の検査を行うことを特徴としている。
【００２９】
上記の構成によれば、ある一定の幅を有するパルスを検査に用いる検査信号とし、論理計算するため、途中で他のパルスなどがあったとしても、それを誤って検査信号として認識することはない。
【００３０】
従って、確実に走査回路の良否判定、即ち、走査回路が正常に動作しているか否かの判定を行うことができる。
【００３１】
これにより、例えば小型高精細パネル、モバイル機器、あるいはプロジェクション用などの小型高精細の表示装置などにおいても、面積の増加や回路の複雑化を伴うことなく、確実に走査回路の良否判定を行うことができる。
【００３２】
上記の表示装置は、第５出力が接続された検査用端子を備えていることが好ましい。
【００３３】
上記の構成によれば、一部あるいは全ての走査回路の最終段の出力を簡単な構成の論理回路を通して、１本の信号として１個の検査用端子（例えば、パッド）に出力することができる。従って、例えば検査用端子にプローブ針を当てることにより、容易に、走査回路の良否判定を行うことができる。
【００３４】
本発明の表示装置は、上記の課題を解決するために、マトリクス状に配置される画素を線順次に選択して走査するためのゲートドライバと、上記選択されたラインの画素にデータ信号を供給するためのソースドライバとが基板上にモノリシックに形成された表示装置において、上記両ドライバのうち少なくとも一方は、シフト方向を双方向に切り替える切替手段と、いずれかのシフト方向の最終段の出力とスタートパルスとを選択するアナログスイッチとを備え、上記両ドライバの各走査回路には、シフト方向ごとに、クロック信号と、一定の幅を有し、シフトデータとして上記クロック信号に同期して上記走査回路でシフトされるスタートパルスとが一定の周期で入力され、上記両走査回路の最終段からの出力は、共に論理回路に入力され、該論理回路の出力により上記両走査回路の検査を行うことを特徴としている。
【００３５】
上記の構成によれば、ある一定の幅を有するパルスを検査に用いる検査信号とし、論理計算するため、途中で他のパルスなどがあったとしても、それを誤って検査信号として認識することはない。
【００３６】
従って、簡単な構成で、確実に双方向における走査回路の良否判定、即ち、走査回路が正常に動作しているか否かの判定を行うことができる。
【００３７】
上記の表示装置は、走査回路の検査において、上記スタートパルスが入力されてから予め設定された時間後の、上記検査に用いるための上記走査回路および上記論理回路からの出力のうち最終の出力を検出することにより、上記走査回路が正常に動作しているか否かを判定することが好ましい。
【００３８】
即ち、スタートパルスが入力されてから予め設定された時間後の最終の出力が、その前後の時間における該最終の出力とは異なる所定の値となる場合に、走査回路は正常に動作していると判定することが好ましい。
【００３９】
具体的には、第１の論理回路は、ＮＡＮＤゲートとインバータとから、第２の論理回路はＮＯＲゲートからなり、かつ、スタートパルスのシフト方向最終段の出力が０または１のとき、スタートパルスが入力されてから予め設定された時間後の第２の出力が１または０であり、その前後の時間における第２の出力が０または１である場合に、走査回路は正常に動作していると判定される。
【００４０】
あるいは、第１論理回路および第３論理回路は、ＮＡＮＤゲートとインバータとから、第２論理回路および第４論理回路はＮＯＲゲートから、第５論理回路はExclusive ORからなり、各スタートパルスが入力されてから予め設定された時間後の、各スタートパルスに対応する第１出力および第３出力が１であり、第２出力および第４出力が０であるとき、その前後の時間における第１出力および第３出力が０であり、第２出力および第４出力が１である場合に、両走査回路は正常に動作していると判定される。
【００４１】
上記の構成によれば、論理回路に簡単な判定機能をもたせることができ、予め設定されたタイミングである出力が出るか否かにより、走査回路が正常に動作しているか否かを判定することができる。
【００４２】
従って、走査回路の良否を高速、かつ、精度良く判定することができる。
【００４３】
上記の表示装置は、シフト方向最終段の出力を、所定の段数だけさらにシフトさせることにより、予め設定された時間遅延させる遅延手段を備えていることが好ましい。
【００４４】
上記の構成によれば、簡単な構成で、スタートパルスと、シフトデータのシフト方向最終段の出力であって、予め設定された時間遅延してなされた出力とを用いて、走査回路の検査を行うことができる。
【００４５】
上記の表示装置は、遅延手段は、シフトレジスタであることが好ましい。
【００４６】
上記の構成によれば、簡単な構成で、走査回路が双方向にシフト可能とすることができる。
【００４７】
上記の表示装置は、論理回路がExclusive ORからなり、スタートパルスが入力されてから予め設定された時間後の出力が１であり、その前後の時間における出力が０である場合に、両走査回路は正常に動作していると判定されることが好ましい。
【００４８】
上記の構成によれば、予め設定されたタイミングである出力が出るか否かにより、走査回路が正常に動作しているか否かを判定することができる。
【００４９】
従って、走査回路の良否を高速、かつ、精度良く判定することができる。
【００５０】
上記の表示装置は、入力される表示モード切替信号によって切替可能な複数の表示モードを有し、表示モード切替信号がある特定の組み合わせで入力されたときには、論理回路の出力を両走査回路の動作に影響しない信号配線における信号端子に出力し、かつ、信号配線に入力される本来の信号を該信号配線から切り離すことにより、予め設定されたタイミングにおける出力を用いて両走査回路が正常に動作しているか否かを判定することが好ましい。
【００５１】
上記の構成によれば、表示モード切替信号の組み合わせにより、走査回路の良否判定を行うモードとすることができる。また、あるタイミングでの出力に応じて、走査回路の良否判定を行うことができる。
【００５２】
従って、簡単な構成で、走査回路の良否判定、即ち、走査回路が正常に動作しているか否かの判定を行うことができる。
【００５３】
上記の表示装置は、表示モード切替信号が入力される第１ＮＯＲゲートと、表示モード切替信号が全て０であるときにのみ、第１ＮＯＲゲートからの出力が入力される第２ＮＯＲゲートとを備え、第１ＮＯＲゲートからの出力およびその反転出力により駆動されるアナログスイッチにより、第１ＮＯＲゲートからの出力が０のとき第２ＮＯＲゲートへの入力がすべてプルアップされ、かつ、表示モード切替信号が第１ＮＯＲゲートから第２ＮＯＲゲートに入力された後は、その後表示モード切替信号が異なる組み合わせに変化しても、第２ＮＯＲゲートがアナログスイッチにより切り離されていることにより、第２ＮＯＲゲートの入力状態が容量に一定期間保持されることが好ましい。
【００５４】
上記の構成によれば、検査用端子を新たに設ける必要が無く、走査回路の動作の検査を行うことができる。
【００５５】
従って、特に、小型高精細パネル、モバイル機器、あるいはプロジェクション用などの小型高精細の液晶表示装置など、新たな端子を設けるスペースが小さな場合にも、走査回路の良否の判定を高速かつ確実に行うことができる。
【００５６】
本発明の表示装置は、上記の課題を解決するために、マトリクス状に配置される画素を線順次に選択して走査するためのゲートドライバと、上記選択されたラインの画素にデータ信号を供給するためのソースドライバとを備え、上記ゲートドライバおよび上記ソースドライバのうちの少なくとも一方のドライバが基板上にモノリシックに形成された表示装置において、モノリシックに形成された上記ドライバは上記シフト方向を双方向に切り替える切替手段を備え、上記両ドライバのうち、モノリシックに形成された上記ドライバの走査回路には、上記双方向それぞれに対応して、クロック信号と、一定の幅を有し、シフトデータとして上記クロック信号に同期して、モノリシックに形成された上記ドライバの走査回路でシフトされるスタートパルスとが一定の周期で入力され、上記スタートパルスが第１方向にシフトされ、第１方向最終段まで転送された後、上記切替手段は、シフト方向を第１方向から第２方向に切り替え、さらに、上記第１方向最終段まで転送された上記シフトデータは、一時ラッチ回路に保持され、あるいは、上記第２方向へシフトするデータとして上記走査回路に直接入力されて、上記クロック信号に同期して上記第２方向にシフトされ、上記第２方向最終段（即ち、第１方向の入力側）まで転送されたシフトデータを用いて上記走査回路の検査を行うことを特徴としている。
【００５７】
上記の構成によれば、空間的にシフトデータの入力側に判定のもととなる信号が戻ってくる。このため、走査回路の良否判定、即ち、走査回路が双方向において正常に動作しているか否かの判定を行うことができ、かつ、検査のための余分な端子や長い信号のとり回し配線をなくすことにより、配線の複雑化を回避することができる。
【００５８】
上記の表示装置は、第２方向最終段まで転送されたシフトデータと、モノリシックに形成されたドライバの走査回路に、シフトデータとなったスタートパルスの次に入力されたスタートパルスとを、比較または判定論理回路へ入力することにより、走査回路が正常に動作しているか否かを判定することが好ましい。
【００５９】
上記の構成によれば、ある一定の幅を有するパルスを検査に用いる検査信号とし、論理計算するため、途中で他のパルスなどがあったとしても、それを誤って検査信号として認識することはない。
【００６０】
従って、走査回路の良否判定、即ち、走査回路が双方向において正常に動作しているか否かの判定を確実に行うことができる。
【００６１】
上記の表示装置は、第２方向最終段まで転送されたシフトデータにおいて、該シフトデータとなったスタートパルスが入力されてから予め設定された時間後に、所定の値が出力されるか否かにより、走査回路が正常に動作しているか否かを判定することが好ましい。
【００６２】
上記の構成によれば、例えば、出力が１であるはずのタイミングで０が検出されたり、あるいは、出力が０であるはずのタイミングで１が検出されたりすることにより、走査回路が正常に動作していないことを確認することができる。
【００６３】
また、ドライバを、基板上における画素アレイ領域の周辺部の僅かな領域に作り込むことができる。従って、ＴＡＢ実装方式や、ＣＯＧ実装方式により駆動回路ＬＳＩを接続する場合と比較すると、基板の小額縁化を図ることができ、これにより、表示装置の小型化を図ることができる。
【００６４】
上記の表示装置は、走査回路が、金属触媒により結晶成長を促進した多結晶シリコンまたはポリシリコンからなることが好ましい。
【００６５】
上記の構成によれば、６００℃以下の低いプロセス温度で、基板上に走査回路を形成することができる。
【００６６】
上記の表示装置は、液晶、電気泳動、または有機エレクトロルミネッセンス（有機ＥＬ（ＯＬＥＤ）を用いて画素の表示を行うことが好ましい。
【００６７】
上記の構成によれば、例えば、液晶表示装置や、エレクトロルミネッセンス表示装置などとすることができる。
【００６８】
上記の表示装置は、スタートパルスとシフトデータのシフト方向最終段の出力との位相差を検出する位相差検出手段を備えていることが好ましい。
【００６９】
上記の構成によれば、スタートパルスと、シフトデータのシフト方向最終段の出力であって、予め設定された時間遅延してなされた出力とを用いて、走査回路の検査を精度良く行うことができる。
【００７０】
上記の表示装置は、切替手段が、クロックトインバータであり、クロックトインバータへの入力値に基づいて、シフト方向が切り替えられることが好ましい。
【００７１】
上記の構成によれば、双方向における走査回路の良否を判定することができる。
【００７２】
上記の表示装置は、走査回路の出力がマルチプレクサにより分割されることが好ましい。
【００７３】
上記の構成によれば、シフトレジスタの段数に対する走査信号出力数を増やすことができ、スペースの縮小を図ることができる。また、パルス出力の重なりを任意に設定することができる。
【００７４】
本発明の走査回路検査方法は、上記の課題を解決するために、クロック信号と、一定の幅を有し、シフトデータとして上記クロック信号に同期してシフトされるスタートパルスとを、一定の周期でドライバの走査回路に入力し、スタートパルスと、該スタートパルスに対応するシフトデータのシフト方向最終段の出力とを用いて論理計算し、その結果に基づいて上記走査回路が正常に動作しているか否かを判定することを特徴としている。
【００７５】
上記の構成によれば、スタートパルスと、シフトデータのシフト方向最終段の出力であって、予め設定された時間遅延してなされた出力とを用いて、走査回路の検査を行っている。
【００７６】
これにより、ある一定の幅を有するパルスを検査に用いる検査信号とし、論理計算するため、途中で他のパルスなどがあったとしても、それを誤って検査信号として認識することはない。
【００７７】
従って、確実に走査回路の良否判定、即ち、走査回路が正常に動作しているか否かの判定を行うことができる。
【００７８】
上記の走査回路検査方法は、シフトデータのシフト方向が双方向に切替可能な場合、スタートパルスと、該スタートパルスに対応するシフトデータのシフト方向最終段の出力とを用いて、各シフト方向において論理計算し、各シフト方向に対応した計算結果を用いてさらに論理計算することにより、走査回路が正常に動作しているか否かを判定することが好ましい。
【００７９】
上記の構成によれば、双方向における走査回路の良否判定を確実に行うことができる。
【００８０】
上記の走査回路検査方法は、２つの走査回路の各々において、論理計算をした後、それらの計算結果を用いて、さらに論理計算することにより、両走査回路が正常に動作しているか否かを判定することが好ましい。
【００８１】
上記の構成によれば、例えば小型高精細パネル、モバイル機器、あるいはプロジェクション用などの小型高精細の表示装置などにおいても、面積の増加や回路の複雑化を伴うことなく、確実に走査回路の良否判定を行うことができる。
【００８２】
本発明の走査回路検査方法は、上記の課題を解決するために、クロック信号と、一定の幅を有し、シフトデータとして上記クロック信号に同期してシフトされるスタートパルスとを、一定の周期でドライバの走査回路に入力し、シフトデータを第１方向にシフトし、該第１方向における最終段まで転送した後、一時ラッチ回路に保持し、シフト方向を上記第１方向とは反対方向の第２方向に切り替え、上記第１方向における最終段まで転送されたシフトデータをさらに、上記第２方向にシフトし、該第２方向における最終段の出力と、次のスタートパルスとを用いて上記走査回路が正常に動作しているか否かを判定することを特徴としている。
【００８３】
上記の構成によれば、双方向における走査回路の良否判定を確実に行うことができる。
【００８４】
【発明の実施の形態】
〔実施の形態１〕
本発明の表示装置に関する実施の一形態について図１ないし図６、および図９に基づいて説明すれば以下の通りである。
【００８５】
本実施の形態における液晶表示装置（表示装置）は、アクティブマトリクス基板と対向基板とが、液晶層を挟んで、対向配置されている。また、液晶表示装置は、画素がマトリクス状に配され、画素アレイ部を構成している。
【００８６】
アクティブマトリクス基板は、図９に示すように、ガラス基板（絶縁性基板）９０、薄膜トランジスタ（以下、ＴＦＴ：Thin Film Transistorと称する）９９、画素電極９２、ゲート線、データ線、層間絶縁膜９４、および補助容量配線（以下、ＣＳ配線と称する）９３を有している。
【００８７】
なお、ＴＦＴ９９は、ゲート線のゲート電極９１、データ線のデータ電極、チャネル層、ゲート絶縁膜９５、ＣＧ−Ｓｉ膜９８、金属配線１００などにより構成されている。
【００８８】
さらに、ガラス基板９０上には、図１に示すように、ゲート線に接続されたゲート走査回路（走査回路）を有するゲートドライバ（ドライバ）１と、データ線に接続されたソース走査回路（走査回路）を有するソースドライバ（ドライバ）２とが、モノリシックに形成されている。ゲート走査回路およびソース走査回路は、それぞれシフトレジスタからなる。
【００８９】
また、対向基板上には対向電極が配されており、画素電極９２と共に液晶を駆動する。
【００９０】
ここで、液晶の駆動原理について説明する。
【００９１】
液晶表示装置は、画面を表示するために、表示データを、ゲート線に沿って順次走査する。
【００９２】
例えば、あるゲート線を水平走査する場合、そのゲート線にＴＦＴ９９をＯＮ状態にするゲート電圧が印加される。このとき、その他のゲート線はＴＦＴ９９をＯＦＦ状態にするゲート電圧が印加されている。こうして、ゲート線の水平走査のときには、そのゲート線のみのＴＦＴ９９がＯＮ状態となり、データ線に印加されている信号電圧がソース電極からドレイン電極を経て、ゲート線の画素電極９２に加わる。
【００９３】
このとき、画素電極９２に与えられた電荷が電荷蓄積容量に蓄積される。こうして画素電極９２に印加された画素電圧と、対向電極に印加された対向電圧との電位差によって、各々の画素電極９２上の液晶は駆動される。
【００９４】
表示画面全体を一回走査する１フレーム期間中、即ち、次のゲート電圧が印加されるまでは、そのときの画素電圧が電荷蓄積容量によって保持され、液晶は駆動されている。なお、１フレーム期間とは、液晶パネルにおいて、１表示画面を上から下まで１回垂直走査することをいう。
【００９５】
このようにして、ゲート線から順次走査し、このときすべてのデータ線にそれぞれの画素の駆動状態に合わせた信号電圧を印加していけば、必要な画素をすべて表示することができる。
【００９６】
以下、ゲートドライバ１およびソースドライバ２の構成、および、それらのドライバ１・２を構成する、ゲート走査回路およびソース走査回路が正常に動作しているか否かの検査について図１を用いて説明する。ここで、ゲートドライバ１およびソースドライバ２は、それぞれ双方向の走査が可能である。
【００９７】
ゲートドライバ１へは、入力パッド（駆動信号入力端子）５を介して、ソースドライバ２へは、入力パッド（駆動信号入力端子）４を介してそれぞれ外部から信号が入力される。
【００９８】
ゲートドライバ１には、クロックＧ−ＣＫ（ＣＫ）およびスタートパルスＧ−ＳＰが入力される。ゲートドライバ１におけるシフトレジスタ（走査回路）では、クロックＧ−ＣＫに同期して、まず、スタートパルスＧ−ＳＰ（ＳＰ）がシフトデータとして１段目からｍ段目（最終段）までシフトされる。ここで、シフトデータのシフト方向最終段、即ち、ここではｍ段目から（最終）の出力は、図４に示すように、予め設定された時間遅延してなされる。
【００９９】
そして、そのｍ段目からの出力は、ＮＡＮＤゲート１３とインバータ１４とからなる第１論理回路（第１の論理回路）に入力される。
【０１００】
さらに、走査方向切替信号により、シフト方向が（第１方向から第２方向に）切り替えられ、ゲートドライバ１におけるシフトレジスタでは、クロックＧ−ＣＫに同期して、スタートパルスＧ−ＳＰがシフトデータとしてｍ段目から１段目（最終段）までシフトされる。ここで、シフトデータのシフト方向最終段、即ち、ここでは１段目からの出力は、予め設定された時間遅延してなされる。
【０１０１】
そして、その１段目からの出力は、ＮＡＮＤゲート１１とインバータ１２とからなる第１論理回路に入力される。
【０１０２】
また、インバータ１２からの出力（第１出力）およびインバータ１４からの出力（第１出力、第１の出力）は、ＮＯＲゲート１５からなる第２論理回路（第２の論理回路）に入力される。
【０１０３】
一方、ソースドライバ２には、クロックＳ−ＣＫ（ＣＫ）およびスタートパルスＳ−ＳＰ（スタートパルス）が入力される。ソースドライバ２におけるシフトレジスタでは、クロックＳ−ＣＫに同期して、まず、スタートパルスＳ−ＳＰ（ＳＰ）がシフトデータとして１段目からｎ段目（最終段）までシフトされる。ここで、シフトデータのシフト方向最終段、即ち、ここではｎ段目からの出力は、図４に示すように、予め設定された時間遅延してなされる。
【０１０４】
そして、そのｎ段目からの出力は、ＮＡＮＤゲート２３とインバータ２４とからなる第３論理回路（第１の論理回路）に入力される。
【０１０５】
さらに、シフトレジスタにより、シフト方向が切り替えられ、ソースドライバ２におけるシフトレジスタでは、クロックＳ−ＣＫに同期して、スタートパルスＳ−ＳＰがシフトデータとしてｎ段目から１段目（最終段）までシフトされる。ここで、シフトデータのシフト方向最終段、即ち、ここでは１段目からの出力は、予め設定された時間遅延してなされる。
【０１０６】
そして、その１段目からの出力は、ＮＡＮＤゲート２１とインバータ２２とからなる第３論理回路に入力される。
【０１０７】
また、インバータ２２からの出力（第３出力）およびインバータ２４からの出力（第３出力、第１の出力）は、ＮＯＲゲート２５からなる第４論理回路（第２の論理回路）に入力される。
【０１０８】
その後、ＮＯＲゲート１５からの出力（第２出力）およびＮＯＲゲート２５からの出力（第４出力）は、ＥＸ−ＯＲ（Exclusive OR：排他的論理和）３０からなる第５論理回路に入力される。ＥＸ−ＯＲ３０の出力（第５出力、検査出力信号）は、検査用パッド（検査用端子）３に入力され、外部に取り出される。
【０１０９】
即ち、ゲートドライバ１およびソースドライバ２のいずれも双方向走査に対応している場合、ゲートドライバ１からのＮＯＲゲート出力とソースドライバ２からのＮＯＲゲート出力とをＥＸ−ＯＲ３０に入力し、このＥＸ−ＯＲ３０の出力を、通常の入力パッド４・５と並設された検査用パッド３に接続しておく。
【０１１０】
そして、走査回路が正常に動作しているか否かという良否の判定は、この検査用パッド３にプローブ針を当てて観測し、予め設定したタイミングでの検査用パッド３からの出力（最終の出力）と、その前後の時間における出力との同異により、例えば、予め設定したタイミングで１が出力され、それ以外のタイミングでは０が出力されていることを確かめることにより、することができる。
【０１１１】
なお、走査回路の良否の判定は、これに限定されるものではなく、例えば、ＮＯＲゲート１５・２５の出力を直接プローブ針を当てて観測して行ってもかまわない。
【０１１２】
また、直接ＮＡＮＤゲート１１またはＮＡＮＤゲート１３、ＮＡＮＤゲート２１またはＮＡＮＤゲート２３、あるいは、インバータ１２またはインバータ１４、インバータ２２またはインバータ２４の出力を観測することによって、走査回路の良否の判定を行ってもかまわない。この場合、双方向走査に対応していないドライバにも適用することができる。
【０１１３】
上記論理回路における組み合わせは、同様の論理が最終的に実現できるものであれば上述したものに限定されるものではない。また、正論理に限定されるものではなく、負論理の信号に対しても同様の機能を持たせることもできる。
【０１１４】
ここで、ドライバ１・２における双方向走査は、図２に示す構成のシフトレジスタによって行う。ここで、Ｒは、シフト方向が図中左から右向き、Ｌは、シフト方向が図中右から左向き、φは制御信号であることを示す。
【０１１５】
入力されたスタートパルスＳＰは、クロックＣＫの１／２の周期でシフトし、出力するシフトデータのパルス幅はクロックの１周期分となる。通常は、隣接するパルスが重ならないように、隣接出力間でＮＡＮＤゲートを通す、あるいは、分周回路を通すなどの手段により、出力するシフトデータのパルス幅をクロックＣＫの１／２周期となるように設定している。
【０１１６】
シフトデータのシフト方向最終段の出力を、予め設定された時間遅延させるための遅延回路は、図２に示すシフトレジスタと同様のシフトレジスタで形成でき、必要な遅延時間に対応する段数を形成しておけばよい。
【０１１７】
なお、双方向走査を実現するための手段は、上記シフトレジスタに限定されるものではなく、図３（ａ）（ｂ）に示すフリップフロップを用い、その入力と出力とをアナログスイッチによりつなぎかえてもよい。
【０１１８】
また、ドライバ１・２は、双方向走査できるものに特に限定されるものではなく、一方向のみの走査を行うものでもかまわない。
【０１１９】
以下に、アクティブマトリクス基板の製造工程の一例について説明する。
【０１２０】
まず、絶縁性の例えばガラス基板９０上の全面に、ａ−Ｓｉ層を堆積した後、Ｓｉ表面を親水性にするために、薄い酸化膜を形成し、その上に酢酸Ｎｉ水溶液をスピンコートする。
【０１２１】
次に、６００℃で約１２時間固相成長を行い、その上にＳｉＯ2膜を堆積し、デバイスの活性領域を形成する部分以外の酸化膜を除去する。
【０１２２】
その後、酸化膜をマスクに、上記ａ−Ｓｉ層の一部の領域に高濃度のＰ+イオンを注入し（１５ｋｅＶ、５×１０15ｃｍ-2）、６００℃で１２時間熱処理を行う。その後、ＳｉＯ2膜を除去し、再度Ｓｉ上全面にＳｉＯ2膜を堆積し、９５０℃で約２時間塩酸を含む酸化雰囲気で約３０分酸化処理を行う。そして、デバイスの活性領域となる部分を残し、不要なＳｉ膜を除去する。
【０１２３】
これにより、ＴＦＴおよびドライバ１・２の走査回路が、金属触媒により結晶成長を促進した多結晶シリコンである連続粒界結晶シリコンを含むこととなる。
【０１２４】
以降は、通常の良く知られたポリシリコンＴＦＴ形成プロセスと同様のプロセスにより、順次、ゲート絶縁膜９５、ゲート電極、Ｎ+（Ｐ+イオン）およびＰ+（Ｂ+イオン）注入、ＳｉＯ2およびＢＰＳＧからなる平坦化膜９７、コンタクトホール９７ａ、金属（ＡｌＳｉ）配線１００、ＳｉＮｘ膜９６、およびＳｉＯ2からなる層間絶縁膜９４、遮光膜、ビアホール９４ａ、ＩＴＯやＩＺＯからなり透明電極である画素電極９２を順次形成する。これにより、走査回路および表示部のＴＦＴ９９を形成する。
【０１２５】
なお、平坦化膜９７におけるＢＰＳＧは、アクリル樹脂やポリイミドなどの樹脂であってもかまわない。
【０１２６】
このように、金属触媒により結晶化を促進して得られた連続粒界結晶シリコン（ＣＧ−Ｓｉ：Continuous Grain Silicon）からなるＴＦＴ９９は、従来の高温ポリシリコンＴＦＴの移動度が約１００ｃｍ2／Ｖ・ｓｅｃであったのに対し、約２〜２．５倍の移動度を有する。
【０１２７】
なお、ＴＦＴおよびドライバ１・２の走査回路は、ＣＧ−Ｓｉに限定されるものではなく、ｐ−Ｓｉ（ポリシリコン）からなるものであっても、走査回路の良否判定については、上記と同様の効果が得られる。
【０１２８】
また、ドライバ１・２における双方向走査の走査方向（シフト方向）切り替えは、図２あるいは図３に示すように、クロックトインバータのＬ・Ｒへの信号、あるいは、アナログスイッチの設定を切り替えてもかまわない。入力と最終段出力との切り替えは、図５に示すように、アナログスイッチ５１・５２を用いて行ってもかまわない。
【０１２９】
アナログスイッチ５１・５２は、電子回路部からの走査方向切替信号に基づいてアナログスイッチ５１…、あるいは、アナログスイッチ５２…のいずれかが選択され、ＯＮになる。
【０１３０】
アナログスイッチ５１…がＯＮのとき、ゲートドライバ１ではスタートパルスＧ−ＳＰがシフトデータとして１段目からｍ段目（最終段）までシフトされる。また、ソースドライバ２ではスタートパルスＳ−ＳＰがシフトデータとして１段目からｎ段目（最終段）までシフトされる。
【０１３１】
そして、ゲートドライバ１におけるｍ段目からの出力と、ソースドライバ２におけるｎ段目からの出力とが、ＥＸ−ＯＲ（論理回路）５０に入力され、論理計算される。
【０１３２】
そして、スタートパルスＳ−ＳＰまたはスタートパルスＧ−ＳＰが入力されてから予め設定された時間後のＥＸ−ＯＲ５０からの出力（出力）が１であり、その前後の時間における出力が０である場合に、ゲート走査回路およびソース走査回路は正常に動作していると判定される。
【０１３３】
一方、アナログスイッチ５２…がＯＮのときも、アナログスイッチ５１…がＯＮのときと同様に（ただし、走査方向はアナログスイッチ５１…がＯＮのときと反対方向）論理計算され、走査回路の良否が判定される。
【０１３４】
また、図６に示すように、図１に示すＮＡＮＤゲート２１およびインバータ２２と並列にＥＸ−ＯＲ６１を、ＮＡＮＤゲート２３およびインバータ２４と並列にＥＸ−ＯＲ６２を接続し、さらに、インバータ２２からの出力とＥＸ−ＯＲ６１からの出力とをＮＯＲゲート６３に、インバータ２４からの出力とＥＸ−ＯＲ６２からの出力とをＮＯＲゲート６４に入力し、ＮＯＲゲート６３からの出力とＮＯＲゲート６４からの出力とをＥＸ−ＯＲ６５に入力することにより、走査回路の良否判定を行ってもかまわない。
【０１３５】
これにより、ゲート走査回路およびソース走査回路のうちのいずれかが正常に動作せず、所定の値（例えば「１」）が出力されるべきタイミング以外で該所定値（この場合「１」）が出力されることを検出することができる。
【０１３６】
なお、本実施の形態は、表示装置として液晶表示装置を用いて説明したが、特に限定されるものではなく、他の電気泳動、あるいは有機ＥＬ（エレクトロルミネッセンス）などの発光ダイオードを用いた表示装置でも同様の効果が得られる。
【０１３７】
また、上記走査回路の出力は、マルチプレクサにより分割されていてもかまわない。これにより、スペースの縮小およびシフトレジスタの段数の低減を図ることができる。また、より広い範囲で、走査回路の検査を行うことができる。
【０１３８】
さらに、走査回路において、入力されたスタートパルスとそれに対応するシフトデータのシフト方向最終段の出力との位相差を検出する位相差検出手段を備えていてもかまわない。
【０１３９】
これにより、スタートパルスと、シフトデータのシフト方向最終段の出力であって、予め設定された時間遅延してなされた出力とを用いて、走査回路の検査を精度良く行うことができる。
【０１４０】
〔実施の形態２〕
本発明の他の実施の形態について図７に基づいて説明すれば、以下の通りである。なお、本実施の形態において、実施の形態１における構成要素と同等の機能を有する構成要素については、同一の符号を付記してその説明を省略する。
【０１４１】
本実施の形態に係る液晶表示装置は、図７に示すように、実施の形態１において図１に示した構成と同様、シフト方向が双方向に切り替え可能なゲートドライバ１・ソースドライバ２、および入力パッド４・５を備えている。
【０１４２】
ゲートドライバ１・ソースドライバ２からは、そのシフト方向に対応してその最終段から出力されるが、入力される走査方向切替信号に応じて、双方向のうちどちらかのシフト方向に対応する出力が、アナログスイッチによって選択される。
【０１４３】
選択された出力は、そのまま、あるいは遅延してＥＸ−ＯＲ７６に入力される。
【０１４４】
また、本実施の形態においては、３種類の表示モード切替信号（ＭＯＤＥ１信号、ＭＯＤＥ２信号、ＭＯＤＥ３信号（図７中ＭＯＤＥ１、ＭＯＤＥ２、ＭＯＤＥ３））に基づいて、３種類の画像表示フォーマット（表示モード）を切り替えて用いる。ここでは、３種類の表示モード切替信号がすべて０の組み合わせで入力パッド７５…に入力されたときに、表示モード切替回路の配線の途中から分岐して、３入力のＮＯＲゲート（第２ＮＯＲゲート）７２に入力されて、テストモードに切り替えられる。３種類の表示モード切替信号の組み合わせの一例を以下の表１に示す。
【０１４５】
【表１】
ここで、ＭＯＤＥ１信号、ＭＯＤＥ２信号、ＭＯＤＥ３信号は表示切替用のＤＣレベルである。また、表１中に「×」とあるのは、この部分のみ例えばブランキング時にパルス信号が出ることをさす。このとき、例えば画面の上下領域（非表示領域）の走査出力が全てＯＮ（Ｈ）の状態になり、これにより、画素には黒の表示データが書き込まれる。
【０１４７】
即ち、テストモードの場合、３種類の表示モード切替信号は、ＮＯＲゲート７１（第１ＮＯＲゲート）の出力により駆動されるアナログスイッチを介して、ＮＯＲゲート７２に入力される。
【０１４８】
そして、ＮＯＲゲート７２の出力により、走査回路の動作に影響しない特定の信号線、ここでは、プリチャージ制御線からＰＣＧ（プリチャージ制御信号）が切り離され、そのかわりにＥＸ−ＯＲ７６の出力が、プリチャージ制御線の入力端子７４にアナログスイッチを介して接続される。
【０１４９】
ここで、ＮＯＲゲート７２の各入力には、メモリ用の小さいキャパシタ（非補助容量）７３が接続されている。このため、テストモードが設定された後、いずれかの入力パッド７５に１が入力され、ＮＯＲゲート７２が３種類の表示モード切替信号からアナログスイッチで切り離されても、キャパシタ７３の容量により、テストモードに設定された状態が維持される。その後、十分な時間が経過した後、テストモードは自動的に通常の動作モード（ＭＯＤＥ１〜３）に復帰する。
【０１５０】
上記ＥＸ−ＯＲ７６の出力は、テストモードに設定された場合のみ入力端子７４に自動的に出力される。入力端子７４にプローブ針を当てて信号を観察することにより、ＥＸ−ＯＲ７６の出力が、予め設定されたタイミング１であり、それ以外では０であるか否かを検出することにより、走査回路の良否判定を行うことができる。即ち、出力が１であるはずのタイミングで０が検出されたり、あるいは、出力が０であるはずのタイミングで１が検出されたりすることにより、走査回路が正常に動作していないことが確認できる。
【０１５１】
これにより、検査用端子を新たに設ける必要が無く、走査回路の動作の検査を行うことができる。
【０１５２】
従って、特に、小型高精細パネル、モバイル機器、あるいはプロジェクション用などの小型高精細の液晶表示装置など、新たな端子を設けるスペースが小さな場合にも、走査回路の良否の判定を高速かつ確実に行うことができる。
【０１５３】
なお、上述した表示モード切替信号の組み合わせは、単なる一例であり、本実施の形態に記載の組み合わせに限定されるものではない。
【０１５４】
〔実施の形態３〕
本発明のさらに他の実施の形態について図８に基づいて説明すれば、以下の通りである。なお、本実施の形態において、実施の形態１における構成要素と同等の機能を有する構成要素については、同一の符号を付記してその説明を省略する。
【０１５５】
本実施の形態に係る液晶表示装置は、図８に示すように、実施の形態１において図１に示した構成と同様、シフト方向が双方向に切り替え可能なゲートドライバ１・ソースドライバ２、検査用パッド３および入力パッド４・５を備えている。
【０１５６】
ゲートドライバ１に、クロックＧ−ＣＫおよびスタートパルスＧ−ＳＰが入力され、シフト方向が第１方向にセットされると、ゲートドライバ１におけるシフトレジスタでは、クロックＧ−ＣＫに同期して、まず、スタートパルスＧ−ＳＰがシフトデータとして１段目からｍ段目（第１方向における最終段）までシフトされる。なお、このときスイッチ８４がＯＮ、スイッチ８５がＯＦＦとなっている。また、例えば、検査をしない設定で、逆方向走査のときは、スイッチ８４をＯＦＦ、スイッチ８５をＯＮに設定する。
【０１５７】
そのｍ段目からの出力はラッチ回路に保持されることにより一時ラッチされる。そして、シフト方向が第１方向とは反対方向の第２方向に切り替えられる、即ちラッチされていた出力を入力とし、順次クロックＧ−ＣＫに同期して、シフトデータとしてｍ段目から１段目（最終段、第２方向における最終段）までシフトされる。
【０１５８】
そして、最終段、即ち、１段目まで転送されたシフトデータは、ラッチ回路により一時ラッチされ、次のスタートパルスＧ−ＳＰとともにＮＡＮＤゲート８１に入力され、論理計算される。
【０１５９】
一方、ソースドライバ２においても、ゲートドライバ１と同様に、ｎ段目まで転送されたシフトデータが一時ラッチされた後、再び入力されて、１段目まで転送される。そして、１段目まで転送されたシフトデータは、一時ラッチされ、次のスタートパルスＳ−ＳＰとともにＮＡＮＤゲート８２に入力され、論理計算される。
【０１６０】
そして、ＮＡＮＤゲート８１からの出力とＮＡＮＤゲート８２からの出力とは、ＥＸ−ＯＲ８０に入力され論理計算される。
【０１６１】
ＥＸ−ＯＲ８０の出力が予め設定されたタイミングで１であり、それ以外では０であるか否かを検出することにより、走査回路の良否判定を行うことができる。即ち、出力が１であるはずのタイミングで０が検出されたり、あるいは、出力が０であるはずのタイミングで１が検出されたりすることにより、走査回路が正常に動作していないことが確認できる。
【０１６２】
なお、ｍ段目およびｎ段目におけるシフトデータの一時ラッチは、水平および垂直のブランキングに対応させてタイミングを調節するもので、ブランキング時間がない場合は、行っても行わなくてもかまわない。
【０１６３】
また、ＮＡＮＤゲート８１・８２を用いることなく、シフトデータとスタートパルスとの比較を行うことにより、走査回路の良否判定を行ってもかまわない。
【０１６４】
【発明の効果】
本発明の表示装置は、以上のように、ゲートドライバおよびソースドライバのうち、モノリシックに形成されたドライバの走査回路には、クロック信号と、一定の幅を有し、シフトデータとしてクロック信号に同期して、モノリシックに形成されたドライバの走査回路でシフトされるスタートパルスとが一定の周期で入力され、スタートパルスと、該スタートパルスに対応するシフトデータのシフト方向最終段の出力であって、予め設定された時間遅延してなされた出力とが、第１の論理回路に入力され、該第１の論理回路からの第１の出力により走査回路の検査を行う構成である。
【０１６５】
これにより、ある一定の幅を有するパルスを検査に用いる検査信号とし、論理計算するため、途中で他のパルスなどがあったとしても、それを誤って検査信号として認識することはない。
【０１６６】
従って、確実に走査回路の良否判定、即ち、走査回路が正常に動作しているか否かの判定を行うことができる。
【０１６７】
また、ドライバが基板上にモノリシックに形成されていることより、ドライバ（駆動回路）の走査回路を、スイッチング素子と同一プロセスで形成することができる。これにより、例えば、駆動回路ＬＳＩを後から別途設ける必要がなくなり、製造コストの削減および実装工程の簡略化を図ることができるといった効果を奏する。
【０１６８】
本発明の表示装置は、モノリシックに形成されたドライバはシフト方向を双方向に切り替える切替手段を備え、ドライバの走査回路には、クロック信号とスタートパルスとが入力され、各々のシフト方向における各第１の出力は第２の論理回路に入力され、該第２の論理回路からの第２の出力により走査回路の検査を行う構成である。
【０１６９】
これにより、上記の構成によれば、双方向における走査回路の良否判定を確実に行うことができるといった効果を奏する。
【０１７０】
本発明の表示装置は、シフト方向を双方向に切り替える切替手段を備えるゲートドライバおよびソースドライバの各走査回路には、クロック信号と、一定の幅を有し、シフトデータとしてクロック信号に同期して走査回路でシフトされるスタートパルスとが一定の周期で入力され、ゲートドライバの走査回路へのスタートパルスと、該ゲートドライバの走査回路へのスタートパルスに対応するシフトデータのシフト方向最終段の出力であって、予め設定された時間遅延してなされた出力とが、シフト方向ごとにそれぞれ第１論理回路に入力され、各々のシフト方向における各第１論理回路からの各第１出力は共に第２論理回路に入力される一方、ソースドライバの走査回路へのスタートパルスと、該ソースドライバの走査回路へのスタートパルスに対応するシフトデータのシフト方向最終段の出力であって、予め設定された時間遅延してなされた出力とが、上記シフト方向ごとにそれぞれ第３論理回路に入力され、各々のシフト方向における各第３論理回路からの各第３出力は共に第４論理回路に入力され、第２出力と第４出力とは、第５論理回路に入力され、該第５論理回路の第５出力により両走査回路の検査を行う構成である。
【０１７１】
これにより、ある一定の幅を有するパルスを検査に用いる検査信号とし、論理計算するため、途中で他のパルスなどがあったとしても、それを誤って検査信号として認識することはない。
【０１７２】
従って、確実に走査回路の良否判定、即ち、走査回路が正常に動作しているか否かの判定を行うことができる。
【０１７３】
この結果、例えば小型高精細パネル、モバイル機器、あるいはプロジェクション用などの小型高精細の表示装置などにおいても、面積の増加や回路の複雑化を伴うことなく、確実に走査回路の良否判定を行うことができるといった効果を奏する。
【０１７４】
本発明の表示装置は、第５出力が接続された検査用端子を備えている構成である。
【０１７５】
これにより、一部あるいは全ての走査回路の最終段の出力を簡単な構成の論理回路を通して、１本の信号として１個の検査用端子（例えば、パッド）に出力することができる。従って、例えば検査用端子にプローブ針を当てることにより、容易に、走査回路の良否判定を行うことができるといった効果を奏する。
【０１７６】
本発明の表示装置は、ゲートドライバおよびソースドライバのうち少なくとも一方は、シフト方向を双方向に切り替える切替手段と、いずれかのシフト方向の最終段の出力とスタートパルスとを選択するアナログスイッチとを備え、両ドライバの各走査回路には、シフト方向ごとに、クロック信号と、一定の幅を有し、シフトデータとしてクロック信号に同期して走査回路でシフトされるスタートパルスとが一定の周期で入力され、両走査回路の最終段からの出力は、共に論理回路に入力され、該論理回路の出力により両走査回路の検査を行う構成である。
【０１７７】
これにより、ある一定の幅を有するパルスを検査に用いる検査信号とし、論理計算するため、途中で他のパルスなどがあったとしても、それを誤って検査信号として認識することはない。
【０１７８】
従って、簡単な構成で、確実に双方向における走査回路の良否判定、即ち、走査回路が正常に動作しているか否かの判定を行うことができるといった効果を奏する。
【０１７９】
本発明の表示装置は、走査回路の検査において、スタートパルスが入力されてから予め設定された時間後の、検査に用いるための走査回路および論理回路からの出力のうち最終の出力を検出することにより、走査回路が正常に動作しているか否かを判定する構成である。
【０１８０】
即ち、スタートパルスが入力されてから予め設定された時間後の最終の出力が、その前後の時間における該最終の出力とは異なる所定の値となる場合に、走査回路は正常に動作していると判定する構成である。
【０１８１】
具体的には、第１の論理回路は、ＮＡＮＤゲートとインバータとから、第２の論理回路はＮＯＲゲートからなり、かつ、スタートパルスのシフト方向最終段の出力が０または１のとき、スタートパルスが入力されてから予め設定された時間後の第２の出力が１または０であり、その前後の時間における第２の出力が０または１である場合に、走査回路は正常に動作していると判定される構成である。
【０１８２】
あるいは、第１論理回路および第３論理回路は、ＮＡＮＤゲートとインバータとから、第２論理回路および第４論理回路はＮＯＲゲートから、第５論理回路はExclusive ORからなり、各スタートパルスが入力されてから予め設定された時間後の、各スタートパルスに対応する第１出力および第３出力が１であり、第２出力および第４出力が０であるとき、その前後の時間における第１出力および第３出力が０であり、第２出力および第４出力が１である場合に、両走査回路は正常に動作していると判定される構成である。
【０１８３】
これにより、論理回路に簡単な判定機能をもたせることができ、予め設定されたタイミングである出力が出るか否かにより、走査回路が正常に動作しているか否かを判定することができる。
【０１８４】
従って、走査回路の良否を高速、かつ、精度良く判定することができるといった効果を奏する。
【０１８５】
本発明の表示装置は、シフト方向最終段の出力を、所定の段数だけさらにシフトさせることにより、予め設定された時間遅延させる遅延手段を備えている構成である。
【０１８６】
これにより、簡単な構成で、スタートパルスと、シフトデータのシフト方向最終段の出力であって、予め設定された時間遅延してなされた出力とを用いて、走査回路の検査を行うことができるといった効果を奏する。
【０１８７】
本発明の表示装置は、遅延手段は、シフトレジスタである構成である。
【０１８８】
これにより、簡単な構成で、走査回路が双方向にシフト可能とすることができるといった効果を奏する。
【０１８９】
本発明の表示装置は、論理回路がExclusive ORからなり、スタートパルスが入力されてから予め設定された時間後の出力が１であり、その前後の時間における出力が０である場合に、両走査回路は正常に動作していると判定される構成である。
【０１９０】
これにより、予め設定されたタイミングである出力が出るか否かにより、走査回路が正常に動作しているか否かを判定することができる。
【０１９１】
従って、走査回路の良否を高速、かつ、精度良く判定することができるといった効果を奏する。
【０１９２】
本発明の表示装置は、入力される表示モード切替信号によって切替可能な複数の表示モードを有し、表示モード切替信号がある特定の組み合わせで入力されたときには、論理回路の出力を両走査回路の動作に影響しない信号配線における信号端子に出力し、かつ、信号配線に入力される本来の信号を該信号配線から切り離すことにより、予め設定されたタイミングにおける出力を用いて両走査回路が正常に動作しているか否かを判定する構成である。
【０１９３】
これにより、表示モード切替信号の組み合わせにより、走査回路の良否判定を行うモードとすることができる。また、あるタイミングでの出力に応じて、走査回路の良否判定を行うことができる。
【０１９４】
従って、簡単な構成で、走査回路の良否判定、即ち、走査回路が正常に動作しているか否かの判定を行うことができるといった効果を奏する。
【０１９５】
本発明の表示装置は、表示モード切替信号が入力される第１ＮＯＲゲートと、表示モード切替信号が全て０であるときにのみ、第１ＮＯＲゲートからの出力が入力される第２ＮＯＲゲートとを備え、第１ＮＯＲゲートからの出力およびその反転出力により駆動されるアナログスイッチにより、第１ＮＯＲゲートからの出力が０のとき第２ＮＯＲゲートへの入力がすべてプルアップされ、かつ、表示モード切替信号が第１ＮＯＲゲートから第２ＮＯＲゲートに入力された後は、その後表示モード切替信号が異なる組み合わせに変化しても、第２ＮＯＲゲートがアナログスイッチにより切り離されていることにより、第２ＮＯＲゲートの入力状態が容量に一定期間保持される構成である。
【０１９６】
これにより、検査用端子を新たに設ける必要が無く、走査回路の動作の検査を行うことができる。
【０１９７】
従って、特に、小型高精細パネル、モバイル機器、あるいはプロジェクション用などの小型高精細の液晶表示装置など、新たな端子を設けるスペースが小さな場合にも、走査回路の良否の判定を高速かつ確実に行うことができるといった効果を奏する。
【０１９８】
本発明の表示装置は、モノリシックに形成されたドライバはシフト方向を双方向に切り替える切替手段を備え、ゲートドライバおよびソースドライバのうち、モノリシックに形成されたドライバの走査回路には、双方向それぞれに対応して、クロック信号と、一定の幅を有し、シフトデータとしてクロック信号に同期して、モノリシックに形成されたドライバの走査回路でシフトされるスタートパルスとが一定の周期で入力され、スタートパルスが第１方向にシフトされ、第１方向最終段まで転送された後、切替手段は、シフト方向を第１方向から第２方向に切り替え、さらに、第１方向最終段まで転送されたシフトデータは、一時ラッチ回路に保持され、あるいは、第２方向へシフトするデータとして走査回路に直接入力されて、クロック信号に同期して第２方向にシフトされ、第２方向最終段（即ち、第１方向の入力側）まで転送されたシフトデータを用いて走査回路の検査を行う構成である。
【０１９９】
これにより、空間的にシフトデータの入力側に判定のもととなる信号が戻ってくる。このため、走査回路の良否判定、即ち、走査回路が双方向において正常に動作しているか否かの判定を行うことができ、かつ、検査のための余分な端子や長い信号のとり回し配線をなくすことにより、配線の複雑化を回避することができるといった効果を奏する。
【０２００】
本発明の表示装置は、第２方向最終段まで転送されたシフトデータと、モノリシックに形成されたドライバの走査回路に、シフトデータとなったスタートパルスの次に入力されたスタートパルスとを、比較または判定論理回路へ入力することにより、走査回路が正常に動作しているか否かを判定する構成である。
【０２０１】
これにより、ある一定の幅を有するパルスを検査に用いる検査信号とし、論理計算するため、途中で他のパルスなどがあったとしても、それを誤って検査信号として認識することはない。
【０２０２】
従って、走査回路の良否判定、即ち、走査回路が双方向において正常に動作しているか否かの判定を確実に行うことができるといった効果を奏する。
【０２０３】
本発明の表示装置は、第２方向最終段まで転送されたシフトデータにおいて、該シフトデータとなったスタートパルスが入力されてから予め設定された時間後に、所定の値が出力されるか否かにより、走査回路が正常に動作しているか否かを判定することが好ましい。
【０２０４】
これにより、例えば、出力が１であるはずのタイミングで０が検出されたり、あるいは、出力が０であるはずのタイミングで１が検出されたりすることにより、走査回路が正常に動作していないことを確認することができる。
【０２０５】
また、ドライバを、基板上における画素アレイ領域の周辺部の僅かな領域に作り込むことができる。従って、ＴＡＢ実装方式や、ＣＯＧ実装方式により駆動回路ＬＳＩを接続する場合と比較すると、基板の小額縁化を図ることができ、これにより、表示装置の小型化を図ることができるといった効果を奏する。
【０２０６】
本発明の表示装置は、走査回路が、金属触媒により結晶成長を促進した多結晶シリコンまたはポリシリコンからなる構成である。
【０２０７】
これにより、６００℃以下の低いプロセス温度で、基板上に走査回路を形成することができるといった効果を奏する。
【０２０８】
本発明の表示装置は、液晶、電気泳動、または有機エレクトロルミネッセンスを用いて画素の表示を行う構成である。
【０２０９】
これにより、例えば、液晶表示装置や、エレクトロルミネッセンス表示装置などとすることができるといった効果を奏する。
【０２１０】
本発明の表示装置は、スタートパルスとシフトデータのシフト方向最終段の出力との位相差を検出する位相差検出手段を備えていることが好ましい。
【０２１１】
上記の構成によれば、スタートパルスと、シフトデータのシフト方向最終段の出力であって、予め設定された時間遅延してなされた出力とを用いて、位相差を出力する位相差検出手段により、走査回路の良否判定ができるといった効果を奏する。
【０２１２】
本発明の表示装置は、切替手段が、クロックトインバータであり、クロックトインバータへの入力値に基づいて、シフト方向が切り替えられる構成である。
【０２１３】
これにより、一部のクロックトインバータをＯＦＦとすることでシフト方向が切り替えられ、双方向における走査回路の良否を判定することができるといった効果を奏する。
【０２１４】
本発明の表示装置は、走査回路の出力がマルチプレクサにより分割される構成である。
【０２１５】
これにより、シフトレジスタの段数に対する走査信号出力数を増やすことができ、スペースの縮小を図ることができる。また、パルス出力の重なりを任意に設定することができるといった効果を奏する。
【０２１６】
本発明の走査回路検査方法は、クロック信号と、一定の幅を有し、シフトデータとして上記クロック信号に同期してシフトされるスタートパルスとを、一定の周期でドライバの走査回路に入力し、スタートパルスと、該スタートパルスに対応するシフトデータのシフト方向最終段の出力とを用いて論理計算し、その結果に基づいて上記走査回路が正常に動作しているか否かを判定する構成である。
【０２１７】
これにより、ある一定の幅を有するパルスを検査に用いる検査信号とし、論理計算するため、途中で他のパルスなどがあったとしても、それを誤って検査信号として認識することはない。
【０２１８】
従って、確実に走査回路の良否判定、即ち、走査回路が正常に動作しているか否かの判定を行うことができるといった効果を奏する。
【０２１９】
本発明の走査回路検査方法は、シフトデータのシフト方向が双方向に切替可能な場合、スタートパルスと、該スタートパルスに対応するシフトデータのシフト方向最終段の出力とを用いて、各シフト方向において論理計算し、各シフト方向に対応した計算結果を用いてさらに論理計算することにより、走査回路が正常に動作しているか否かを判定する構成である。
【０２２０】
これにより、双方向における走査回路の良否判定を確実に行うことができるといった効果を奏する。
【０２２１】
本発明の走査回路検査方法は、２つの走査回路の各々において、論理計算をした後、それらの計算結果を用いて、さらに論理計算することにより、両走査回路が正常に動作しているか否かを判定する構成である。
【０２２２】
これにより、例えば小型高精細パネル、モバイル機器、あるいはプロジェクション用などの小型高精細の表示装置などにおいても、面積の増加や回路の複雑化を伴うことなく、確実に走査回路の良否判定を行うことができるといった効果を奏する。
【０２２３】
本発明の走査回路検査方法は、クロック信号と、一定の幅を有し、シフトデータとして上記クロック信号に同期してシフトされるスタートパルスとを、一定の周期でドライバの走査回路に入力し、シフトデータを第１方向にシフトし、該第１方向における最終段まで転送した後、一時ラッチ回路に保持し、シフト方向を上記第１方向とは反対方向の第２方向に切り替え、上記第１方向における最終段まで転送されたシフトデータをさらに、上記第２方向にシフトし、該第２方向における最終段の出力と、次のスタートパルスとを用いて上記走査回路が正常に動作しているか否かを判定する構成である。
【０２２４】
これにより、双方向における走査回路の良否判定を確実に行うことができるといった効果を奏する。
【図面の簡単な説明】
【図１】本発明の実施の一形態に係る液晶表示装置の概略構成を示す回路図である。
【図２】シフトレジスタの構成を示す回路図である。
【図３】（ａ）は、フリップフロップの構成を示す回路図であり、（ｂ）は、（ａ）に示すＡの構成を示す回路図である。
【図４】スタートパルスのシフト方向における駆動動作を示すタイミングチャートである。
【図５】シフト方向の切り替えに、アナログスイッチを用いる場合の構成を示す回路図である
【図６】図１に示すソースドライバに、ＮＯＲゲートおよびＥＸ−ＯＲをさらに接続した場合の回路図である。
【図７】本発明の実施の他の一形態に係る液晶表示装置の概略構成を示す回路図である。
【図８】本発明の実施のさらに他の一形態に係る液晶表示装置の概略構成を示す回路図である。
【図９】液晶表示装置の概略の構成を示す断面図である。
【図１０】従来の液晶表示装置の概略構成を示す回路図である。
【図１１】（ａ）は、従来の他の液晶表示装置の概略構成を示す回路図であり、（ｂ）は、（ａ）に示すシフトレジスタの構成を示す回路図である。である。
【図１２】従来のさらに他の液晶表示装置の概略構成を示す回路図である。
【符号の説明】
１ ゲートドライバ（ドライバ）
２ ソースドライバ（ドライバ）
３ 検査用パッド（検査用端子）
１１ ＮＡＮＤゲート（第１論理回路）
１２ インバータ（第１論理回路）
１３ ＮＡＮＤゲート（第１論理回路、第１の論理回路）
１４ インバータ（第１論理回路、第１の論理回路）
１５ ＮＯＲゲート（第２論理回路、第２の論理回路）
２１ ＮＡＮＤゲート（第３論理回路）
２２ インバータ（第３論理回路）
２３ ＮＡＮＤゲート（第３論理回路、第１の論理回路）
２４ インバータ（第３論理回路、第１の論理回路）
２５ ＮＯＲゲート（第４論理回路、第２の論理回路）
３０ ＥＸ−ＯＲ（第５論理回路）
５０ ＥＸ−ＯＲ（論理回路）
７１ ＮＯＲゲート（第１ＮＯＲゲート）
７２ ＮＯＲゲート（第２ＮＯＲゲート）
７６ ＥＸ−ＯＲ
８１ ＮＡＮＤゲート
８２ ＮＡＮＤゲート
Claims (22)
- マトリクス状に配置される画素を線順次に選択して走査するためのゲートドライバと、上記選択されたラインの画素にデータ信号を供給するためのソースドライバとを備え、上記ゲートドライバおよび上記ソースドライバのうちの少なくとも一方のドライバが基板上にモノリシックに形成された表示装置において、
モノリシックに形成された上記ドライバは上記シフト方向を双方向に切り替える切替手段を備え、
上記両ドライバのうち、モノリシックに形成された上記ドライバの走査回路には、上記双方向それぞれに対応して、クロック信号と、一定の幅を有し、シフトデータとして上記クロック信号に同期して、モノリシックに形成された上記ドライバの走査回路でシフトされるスタートパルスとが一定の周期で入力され、
上記シフト方向ごとにそれぞれ、上記スタートパルスと、該スタートパルスに対応するシフトデータのシフト方向最終段の出力であって、遅延回路で所定時間遅延された出力とが、ＮＡＮＤゲートとインバータとからなる第１の論理回路に入力され、上記各々のシフト方向における各第１論理回路からの各第１出力は共にＮＯＲゲートからなる第２の論理回路に入力され、該第２の論理回路からの第２の出力により走査回路の検査を行うことを特徴とする表示装置。 - マトリクス状に配置される画素を線順次に選択して走査するためのゲートドライバと、上記選択されたラインの画素にデータ信号を供給するためのソースドライバとが基板上にモノリシックに形成された表示装置において、
シフト方向を双方向に切り替える切替手段を備える上記両ドライバの各走査回路には、クロック信号と、一定の幅を有し、シフトデータとして上記クロック信号に同期して上記走査回路でシフトされるスタートパルスとが一定の周期で入力され、
上記ゲートドライバの走査回路へのスタートパルスと、該ゲートドライバの走査回路へのスタートパルスに対応するシフトデータのシフト方向最終段の出力であって、遅延回路で所定時間遅延された出力とが、上記シフト方向ごとにそれぞれ、ＮＡＮＤゲートとインバータとからなる第１論理回路に入力され、
上記各々のシフト方向における各第１論理回路からの各第１出力は共にＮＯＲゲートからなる第２論理回路に入力される一方、
上記ソースドライバの走査回路へのスタートパルスと、該ソースドライバの走査回路へのスタートパルスに対応するシフトデータのシフト方向最終段の出力であって、遅延回路で所定時間遅延された出力とが、上記シフト方向ごとにそれぞれ、ＮＡＮＤゲートとインバータとからなる第３論理回路に入力され、
上記各々のシフト方向における各第３論理回路からの各第３出力は共にＮＯＲゲートからなる第４論理回路に入力され、
上記第２出力と上記第４出力とは、Exclusive OR からなる第５論理回路に入力され、該第５論理回路の第５出力により上記両走査回路の検査を行うことを特徴とする表示装置。 - 上記第５出力が接続された検査用端子を備えていることを特徴とする請求項２に記載の表示装置。
- マトリクス状に配置される画素を線順次に選択して走査するためのゲートドライバと、上記選択されたラインの画素にデータ信号を供給するためのソースドライバとが基板上にモノリシックに形成された表示装置において、
両ドライバのうち少なくとも一方は、シフト方向を双方向に切り替える切替手段と、該切替手段による走査方向切替信号に基づいて、いずれかのシフト方向の最終段の出力とスタートパルスとを選択するアナログスイッチとを備え、
上記両ドライバの各走査回路には、シフト方向ごとに、クロック信号と、一定の幅を有し、シフトデータとして上記クロック信号に同期して上記走査回路でシフトされるスタートパルスとが一定の周期で入力され、
上記両走査回路の最終段からの出力は、Exclusive OR からなる論理回路に入力され、該論理回路の出力により上記両走査回路の検査を行うことを特徴とする表示装置。 - 上記走査回路の検査は、上記スタートパルスが入力され遅延回路で所定時間遅延後の、上記検査に用いるための上記走査回路および上記論理回路からの出力のうち最終の出力を検出することにより、上記走査回路が正常に動作しているか否かを判定することを特徴とする請求項１ないし４のいずれか１項に記載の表示装置。
- 上記スタートパルスが入力され遅延回路で所定時間遅延後の上記最終の出力が、その前後の時間における該最終の出力とは異なる所定の値となる場合に、上記走査回路は正常に動作していると判定することを特徴とする請求項５に記載の表示装置。
- 上記第１の論理回路は、ＮＡＮＤゲートとインバータとから、上記第２の論理回路はＮＯＲゲートからなり、かつ、上記スタートパルスのシフト方向最終段の出力が０または１のとき、
上記スタートパルスが入力され遅延回路で所定時間遅延後の上記第２の出力が１または０であり、その前後の時間における上記第２の出力が０または１である場合に、上記走査回路は正常に動作していると判定されることを特徴とする請求項１に記載の表示装置。 - 上記第１論理回路および上記第３論理回路は、ＮＡＮＤゲートとインバータとから、上記第２論理回路および上記第４論理回路はＮＯＲゲートから、上記第５論理回路はExclusive ORからなり、
上記各スタートパルスが入力され遅延回路で所定時間遅延後の、上記各スタートパルスに対応する上記第１出力および第３出力が１であり、上記第２出力および第４出力が０であるとき、その前後の時間における上記第１出力および第３出力が０であり、上記第２出力および第４出力が１である場合に、上記両走査回路は正常に動作していると判定されることを特徴とする請求項２または３に記載の表示装置。 - 上記遅延回路は、上記シフト方向最終段の出力を、所定の段数だけさらにシフトさせることにより、上記所定時間遅延させることを特徴とする請求項１ないし８のいずれか１項に記載の表示装置。
- 上記遅延回路は、シフトレジスタであることを特徴とする請求項９に記載の表示装置。
- 上記 Exclusive OR からなる上記論理回路は、上記スタートパルスが入力され遅延回路で所定時間遅延後の上記出力が１であり、その前後の時間における上記出力が０である場合に、上記両走査回路は正常に動作していると判定されることを特徴とする請求項４に記載の表示装置。
- 入力される表示モード切替信号によって切替可能な複数の表示モードを有し、
上記表示モード切替信号がある特定の組み合わせで入力されたときには、上記論理回路の出力を上記両走査回路の動作に影響しない信号配線における信号端子に出力し、かつ、上記信号配線に入力される本来の信号を該信号配線から切り離すことにより、予め設定されたタイミングにおける上記出力を用いて上記両走査回路が正常に動作しているか否かを判定することを特徴とする請求項４に記載の表示装置。 - 上記表示モード切替信号が入力される第１ＮＯＲゲートと、上記表示モード切替信号が全て０であるときにのみ、上記第１ＮＯＲゲートからの出力が入力される第２ＮＯＲゲートとを備え、
上記第１ＮＯＲゲートからの出力およびその反転出力により駆動されるアナログスイッチにより、上記第１ＮＯＲゲートからの出力が０のとき上記第２ＮＯＲゲートへの入力がすべてプルアップされ、かつ、上記表示モード切替信号が上記第１ＮＯＲゲートから上記第２ＮＯＲゲートに入力された後は、その後上記表示モード切替信号が異なる組み合わせに変化しても、上記第２ＮＯＲゲートがアナログスイッチにより切り離されていることにより、上記第２ＮＯＲゲートの入力状態が容量に一定期間保持されることを特徴とする請求項１２に記載の表示装置。 - マトリクス状に配置される画素を線順次に選択して走査するためのゲートドライバと、上記選択されたラインの画素にデータ信号を供給するためのソースドライバとを備え、上記ゲートドライバおよび上記ソースドライバのうちの少なくとも一方のドライバが基板上にモノリシックに形成された表示装置において、
モノリシックに形成された上記ドライバは上記シフト方向を双方向に切り替える切替手段を備え、
上記両ドライバのうち、モノリシックに形成された上記ドライバの走査回路には、上記双方向それぞれに対応して、クロック信号と、一定の幅を有し、シフトデータとして上記クロック信号に同期して、モノリシックに形成された上記ドライバの走査回路でシフトされるスタートパルスとが一定の周期で入力され、
上記スタートパルスが第１方向にシフトされ、第１方向最終段まで転送された後、上記切替手段は、シフト方向を第１方向から第２方向に切り替え、
さらに、上記第１方向最終段まで転送された上記シフトデータは、一時ラッチ回路に保持され、あるいは、上記第２方向へシフトするデータとして上記走査回路に直接入力されて、上記クロック信号に同期して上記第２方向にシフトされ、
上記第２方向最終段まで転送されたシフトデータを用いて上記走査回路の検査を行うことを特徴とする表示装置。 - 上記第２方向最終段まで転送されたシフトデータと、モノリシックに形成された上記ドライバの走査回路に、上記シフトデータとなったスタートパルスの次に入力されたスタートパルスとを、比較または判定論理回路へ入力することにより、走査回路が正常に動作しているか否かを判定することを特徴とする請求項１４に記載の表示装置。
- 上記第２方向最終段まで転送されたシフトデータにおいて、該シフトデータとなったスタートパルスが入力され所定時間後に、所定の値が出力されるか否かにより、上記走査回路が正常に動作しているか否かを判定することを特徴とする請求項１４に記載の表示装置。
- 上記走査回路は、金属触媒により結晶成長を促進した多結晶シリコンまたはポリシリコンからなることを特徴とする請求項１ないし１６のいずれか１項に記載の表示装置。
- 液晶、電気泳動、または有機エレクトロルミネッセンスを用いて画素の表示を行うことを特徴とする請求項１ないし１７のいずれか１項に記載の表示装置。
- 上記切替手段は、クロックトインバータであり、
該クロックトインバータへの入力値に基づいて、上記シフト方向が切り替えられることを特徴とする請求項１，２，４，１４のいずれか１項に記載の表示装置。 - シフト方向を双方向に切替可能とし、
上記双方向それぞれに対応して、クロック信号と、一定の幅を有し、シフトデータとして上記クロック信号に同期してシフトされるスタートパルスとを、一定の周期でドライバの走査回路に入力し、
上記スタートパルスと、該スタートパルスに対応するシフトデータのシフト方向最終段の出力とを用いて、各シフト方向において、ＮＡＮＤゲートとインバータとによる論理計算し、各シフト方向に対応した計算結果を用いてさらにＮＯＲゲートによる論理計算することにより、その結果に基づいて上記走査回路が正常に動作しているか否かを判定することを特徴とする走査回路検査方法。 - ２つの走査回路の各々において、上記論理計算をした後、それらの計算結果を用いて、さらにExclusive OR による論理計算することにより、上記両走査回路が正常に動作しているか否かを判定することを特徴とする請求項２０に記載の走査回路検査方法。
- クロック信号と、一定の幅を有し、シフトデータとして上記クロック信号に同期してシフトされるスタートパルスとを、一定の周期でドライバの走査回路に入力し、
シフトデータを第１方向にシフトし、該第１方向における最終段まで転送した後、一時ラッチ回路に保持し、シフト方向を上記第１方向とは反対方向の第２方向に切り替え、上記第１方向における最終段まで転送されたシフトデータをさらに、上記第２方向にシフトし、
該第２方向における最終段の出力と、次のスタートパルスとを用いて上記走査回路が正常に動作しているか否かを判定することを特徴とする走査回路検査方法。
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