CN1146036C - 半导体图象传感器及其制造方法 - Google Patents

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Abstract

一种图象传感器(10),具有图象敏感元件,该元件包括N型导电区(26)和P型嵌入层(37)。这两个区构成两个深度不同的P-N结,提高了不同光频下电荷载流子收集的效率。导电区(26)是通过有角度的注入形成的,这样可以保证导电区(26)的一部分可以用作MOS晶体管(32)的源。

Description

半导体图象传感器及其制造方法
技术领域
本发明一般涉及半导体器件,特别涉及一种半导体图象传感器。
背景技术
过去,采用了各种方法在具有互补金属氧化物半导体(CMOS)器件的衬底上形成半导体传感器。一般情况下,传感器的光接收部分形成为大面积晶体管的栅,常称之为光栅,或形成为金属氧化物半导体(MOS)晶体管的源-漏结。采用光栅晶体管时,需要光通过晶体管的硅栅行进,以将光转化为电能。因此,采用光栅的情况减小了灵敏度。另外,耗尽区一般较浅(小于一个微米),所以减小了红光吸收诱发的载流子收集效率。并且常规光栅对表面复合产生的噪声敏感。
采用源-漏结的情况一般有一个对于晶体管操作最佳的结,并且还有一个会造成红光诱发的载流子无效收集的浅结。采用源-漏结情况的另一缺点是结一般形成于重掺杂(大于1016原子/cm3)区中,限制了结耗尽区的宽度,进而减小了红光吸收诱发的载流子收集效率。另外,在这种重掺杂区中形成结会产生很大的电容,进而会减少可以从光敏元件传递到其它电子元件的电荷量。
传统的CMOS图象传感器常在图象敏感元件上方形成硅化物层,所以进一步减小了灵敏度。
发明内容
因此,希望形成一种图象传感器,不用光栅可具有较高效率,没有浅结深度可提高效率,可减小由于表面复合造成的噪声,不用覆盖于光敏区上的硅化物可进一步提高效率,具有宽耗尽区可增大所有波长光的载流子转换,没有减少从图象敏感元件传递到其它电子元件的电荷的大电容。
根据本发明的一种形成图象传感器的方法,其特征在于:提供第一导电类型的半导体衬底;在衬底上形成加强层,加强层具有第一导电类型和第一掺杂浓度;在加强层的第一区上形成第一阱,第一阱具有第一导电类型和大于第一掺杂浓度的第二掺杂浓度,其中第一阱的第一深度深入到加强层;在加强层的第二区上形成第二导电类型的导电区,其中导电区的第一部分构成MOS晶体管的一部分;及通过形成处于导电区中的嵌入层的第一部分和以远离MOS晶体管的方向从导电区横向延伸的嵌入层的第二部分,在加强层的第二区中形成第一导电类型的嵌入层,其中嵌入层的第一部分和第二部分是相接的。
在本发明的实施例中,其中形成导电区包括以从衬底的法线算起的第一角并朝向MOS晶体管注入第一掺杂剂,其中第一角至少从衬底的法线算起为15度。
在上述发明的实施例中,其中以第一角注入第一掺杂剂包括基本垂直于衬底注入第一浓度的掺杂剂,及以第一角注入第二浓度的第一掺杂剂。
在上述发明的实施例中,其中形成导电区和形成第一导电类型的嵌入层的步骤包括以第一角注入导电区的第一掺杂剂,以及以偏离衬底法线并远离MOS晶体管的第二角注入嵌入层的掺杂剂。
根据本发明的一种形成图象传感器的方法,其特征在于:利用至少为15度的第一角并朝向MOS晶体管进行掺杂剂注入,以形成图象传感器的导电区;及至少部分地在导电区内形成嵌入层,该嵌入层包括从导电区延伸的一部分,该部分与在导电区内的嵌入层的一部分相接。
在上述发明的实施例中,还包括形成覆盖嵌入层的介质层,并在图象传感器的一部分上形成硅化物层,其中覆盖嵌入层的区没有硅化物层。
在上述发明的实施例中,还包括形成覆盖嵌入层的介质层,其中介质层的介电常数介于覆盖该介质层的任何材料的介电常数和其上形成有嵌入层的底层衬底的介电常数之间。
根据本发明的一种图象传感器,其特征在于:具有第一掺杂浓度的第一导电类型半导体衬底;具有低于第一掺杂浓度的第二掺杂浓度的第一导电类型的加强层,加强层位于衬底上;加强层上的第一MOS晶体管;加强层上的嵌入光电二极管,其中嵌入光电二极管的一部分构成第一MOS晶体管的源。
在上述发明的实施例中,还包括覆盖在嵌入光电二极管上的介质层,其中介质层的介电常数介于覆盖该介质层的任何材料的介电常数和衬底的介电常数之间。
附图说明
图1是展示根据本发明图象传感器实施例的放大剖面图;
图2是根据本发明处于制造阶段的图1实施例的放大剖面图;
图3-7是根据本发明处于随后的制造阶段的图1实施例的放大剖面图;
图8是根据本发明另一实施例的图象传感器的放大剖面图。
具体实施方式
图1是半导体传感器10的放大剖面图。传感器10包括由半导体衬底11和形成于其上的加强层12构成的底层P型衬底。传感器10具有形成于底层衬底的第一区13中的第一阱或P阱16。阱16的掺杂浓度一般高于底层衬底的层12的第二区14的掺杂浓度。层12的区13和14由层12下示出的括弧标识出。层12的这第二区构成底层衬底内的第二阱。阱16的表面掺杂浓度一般至少为1×1016原子/cm3。阱16的第一深度或深度24一般小于层12的深度,一般约为2-4微米,以便于在衬底11上形成其它CMOS器件。
传感器10的图象获取元件或光敏元件包括形成于第二阱或第二区14中的N型导电区26。导电区26与底层衬底的P型材料一起构成第一P-N结。这第一P-N结处于导电区26的第二深度或深度29,以便于容易地探测红光,该深度一般是从底层衬底表面算起小于约0.7微米,最好是约小于0.5微米。P型嵌入层37形成于区26内,从区26向外延伸到底层衬底的层12中,以形成与底层衬底的电连接。该电连接将加于图象传感器的该元件的电位保持住。因此,所得的光电二极管常被称为嵌入光电二极管。第二P-N结沿层37和区26的交界区形成。一般层37与其它P沟道MOS晶体管(未示出)的轻掺杂漏和源区同时形成于衬底11上。第二P-N结的深度小于第一P-N结的深度。该深度选择成使对蓝光的收集或探测最佳。传递晶体管或第一MOS晶体32邻近导电区26形成,以便区26的一部分构成晶体管32的源。第二或复位MOS晶体管31形成于阱16内。耦合区41使晶体管31的源电耦合到晶体管32。
通过使用具有暴露区14表面一些部分的开口的掩模,形成导电区26,该区延伸到晶体管32的栅22的一部分,并包括该部分。然后,以偏离衬底11法线向着栅22的角度注入掺杂剂,以确保区26在栅22下延伸,由此省去形成区26和晶体管32的源时的掩蔽和其它处理操作。
图2是制造图1所示传感器10的实施例某一阶段的放大剖面图。传感器10包括具有形成于其上的轻掺杂P型加强层12的重掺杂P型衬底11。一般情况下,衬底11的第一或P型掺杂浓度至少为1×1016原子/cm3,最好是1×1018原子/cm3,层12的P型掺杂浓度不大于约1×1015原子/cm3。此外,层12包括其中形成第一阱或P阱16的第一区13,和其中将形成传感器10的光敏元件的第二阱或第二区14。在覆盖较重掺杂的衬底11的轻掺杂第二区14中形成光敏元件,加强了光敏元件的载流子收集。
通过使用暴露层12第一区13的表面的掩模17,形成P型阱16。在暴露表面内形成掺杂剂,以构成阱16,形成阱16后去掉掩模17。
图3是处于随后制造阶段的图1和图2所示传感器10的放大剖面图。图1、图2和图3中相同的元件用相同的数字表示。在传感器10的表面上形成栅氧化物18。然后形成沟道掺杂区19,以便于形成MOS晶体管31和32的沟道。栅23和22形成于氧化物18上,以便于分别形成晶体管31和32。
此后,施加掩模21,暴露其中将形成导电区26的第二区14。掩模21的开口暴露第二区14中栅氧化层18的一部分表面,该暴露的部分从栅22的边缘延伸到第二区14,还暴露一部分栅22。以向着栅22的角28注入掺杂剂,如箭头27所示。角28偏离垂直于传感器10表面的线。角28一般为从传感器10表面的法线算起大于15度,最好是至少25度。采用这个角度的注入可以确保区26稍微在栅22下延伸,以便于利用一部分区26作为晶体管32的源,由此连接晶体管32的沟道与导电区26。形成区26后去掉掩模21。
可选择的是,可以采用两种不同的注入技术形成区26。例如,靠近传感器10表面的法线,可以采用120-190keV的高能量注入,以形成深入到层12中的区26。此后,可以以基本上等于角28的角,采用例如90-130keV进行低能量注入,低能量注入可以确保一部分区26在栅22下延伸。
图4表示的是形成传感器10的随后步骤。图1、2、3和4中相同的元件用相同的元件数字表示。施加掩模34,掩模34具有暴露形成晶体管32的漏及晶体管31的源和漏区域的开口。然后,利用栅22和23的边缘作掩模,在层12中形成源-漏掺杂区33,使源和漏区与栅22和23自对准,此后去掉掩模34。
图5是形成传感器10的随后步骤的放大剖面图。图1、2、3、4和5中相同的元件用相同的元件数字表示。施加掩模36,掩模36具有暴露栅22的边缘、导电区26的表面、及区56并如箭头所示延伸穿过区26的开口。在暴露的表面中形成P型掺杂区,从而在区26的暴露部分内形成P型嵌入层37,该区从区26向外延伸到区56中,远离晶体管32。层37的深度和掺杂浓度选择成便于将所有光诱生电荷从区26传递到晶体管32的漏。一般情况下,层37的深度为约0.2-0.3微米,表面掺杂浓度大于约5×1017原子/cm3。形成层37后去掉掩模36。
图6示出了形成传感器10的随后步骤。图1、2、3、4、5和6中相同的元件用相同的元件数字表示。在传感器10的表面上施加介质材料,并构图,在栅22和23的侧壁上形成间隔层39,并形成叠于传感器10的光敏元件上的介质覆盖层38。覆盖层38一般延伸到栅22,构成随后操作的掩模。形成间隔层39和覆盖层38所用的材料选择为具有介于底层衬底和叠于覆盖层38上的任何材料的介电常之间的介电常数。覆盖层38的介电常数选择成使底层半导体材料和设置于覆盖层38之上的任何其它介质材料间的反射最小。例如,覆盖层38的材料可以是厚为30-70纳米的氮化硅,以使兰和红波谱之间的光的反射最小。另外,也可以适当地选用130-200纳米的厚度。相信如氧化铝及氮化铝等其它材料也是形成覆盖层38和间隔层39的合适材料。
然后,用间隔层39和覆盖层38作掩模,在层12中形成N型掺杂区,由此形成电连接漏42和源43的耦合区41。
图7示出了形成传感器10的随后步骤。图1-7中相同的元件用相同的元件数字表示。采用低电阻材料,以降低耦合区41及栅22和23的接触电阻。一般情况下,在传感器10上地毡式淀积钛,然后退火,形成带有暴露的底层硅材料的硅化钛。因此,层38可以防止形成叠于由区26和层37构成的光电二极管之上的硅化物。去掉未形成硅化钛的其余钛,只在栅22和23上留下低电阻的接触材料44和耦合区41。这种形成技术是所属领域的技术人员所熟知的,一般情况下,在传感器10和构成其合适部分的接触上形成层间介质(未示出)。
图8示出了形成传感器10的嵌入层37的另一实施例。在形成了如参照图3讨论的导电区26后,通过以与图3所示角28相对的角进行注入,形成层37。该实施例中,以从传感器10表面的法线算起的角48,偏离栅22注入掺杂剂,如箭头47所示。一般情况下,角48介于10-25度之间,以保证层37的一部分从区26向外远离晶体管32延伸。用层37的这一部分形成与加强层12的接触。因为采用这些处理工艺,该替换的实施例可以减少处理操作的数量、
现在,应理解,这里提供了一种新颖的图像传感器及其制造方法。形成叠于较重掺杂区上的轻掺杂区中形成图象传感器,可以加强载流子收集。形成深导电区和较浅嵌入层,构成了两个P-N结,其中一个P-N结及有关的耗尽区较深,以便于获取红光,第二P-N结及有关的耗尽区较浅,以便于获取蓝光。这种结构还可以减少表面复合,并使电荷传递最大化。利用有角度的注入形成导电区,可以保证导电区可用作电荷传递晶体管的源,由此减少制造操作步骤。采用具有介于底层衬底和覆盖材料的介电常数间的介电常数的介质材料,可以使反射最小化,提高传感器的效率。保证光敏元件上没有覆盖硅化物材料也可以提高传感器的效率。

Claims (9)

1.一种形成图象传感器的方法,其特征在于:
提供第一导电类型的半导体衬底(11);
在衬底上形成加强层(12),加强层具有第一导电类型和第一掺杂浓度;
在加强层的第一区上形成第一阱(16),第一阱具有第一导电类型和大于第一掺杂浓度的第二掺杂浓度,其中第一阱的第一深度(24)深入到加强层;
在加强层(12)的第二区上形成第二导电类型的导电区(26),其中导电区的第一部分构成MOS晶体管(32)的一部分;及
通过形成处于导电区中的嵌入层的第一部分和以远离MOS晶体管(32)的方向从导电区(26)横向延伸的嵌入层的第二部分,在加强层(12)的第二区中形成第一导电类型的嵌入层(37),其中嵌入层的第一部分和第二部分是相接的。
2.如权利要求1所述的方法,其中形成导电区(26)包括以从衬底的法线算起的第一角(28)并朝向MOS晶体管注入第一掺杂剂,  其中第一角(28)从衬底的法线算起至少为15度。
3.如权利要求2所述的方法,其中以第一角(28)注入第一掺杂剂包括基本垂直于衬底注入第一浓度的掺杂剂,及以第一角(28)注入第二浓度的第一掺杂剂。
4.如权利要求2所述的方法,其中形成导电区和形成第一导电类型的嵌入层的步骤包括以第一角(28)注入导电区的第一掺杂剂,以及以偏离衬底法线并远离MOS晶体管的第二角(48)注入嵌入层的掺杂剂。
5.一种形成图象传感器的方法,其特征在于:
利用至少为15度的第一角(28)并朝向MOS晶体管进行掺杂剂注入,以形成图象传感器的导电区;及
至少部分地在导电区内形成嵌入层(37),该嵌入层包括从导电区延伸的一部分,该部分与在导电区内的嵌入层的一部分相接。
6.如权利要求5所述的方法,还包括形成覆盖嵌入层的介质层(38),并在图象传感器的一部分上形成硅化物层,其中覆盖嵌入层的区没有硅化物层。
7.如权利要求5所述的方法,还包括形成覆盖嵌入层的介质层(38),其中介质层(38)的介电常数介于覆盖该介质层的任何材料的介电常数和其上形成有嵌入层的底层衬底的介电常数之间。
8.一种图象传感器,其特征在于:
具有第一掺杂浓度的第一导电类型半导体衬底(11);
具有低于第一掺杂浓度的第二掺杂浓度的第一导电类型的加强层(12),加强层位于衬底上;
加强层(12)上的第一MOS晶体管(32);
加强层上的嵌入光电二极管,其中嵌入光电二极管的一部分构成第一MOS晶体管(32)的源。
9.如权利要求8所述的图象传感器,还包括覆盖在嵌入光电二极管上的介质层(38),其中介质层的介电常数介于覆盖该介质层的任何材料的介电常数和衬底的介电常数之间。
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