JPH11214665A - Cmosイメージセンサ - Google Patents
CmosイメージセンサInfo
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- JPH11214665A JPH11214665A JP10323486A JP32348698A JPH11214665A JP H11214665 A JPH11214665 A JP H11214665A JP 10323486 A JP10323486 A JP 10323486A JP 32348698 A JP32348698 A JP 32348698A JP H11214665 A JPH11214665 A JP H11214665A
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Abstract
MOSプロセスを示すPMOSおよびNMOSインプラ
ントを含む表面を有する第1伝導型の基板を含む。該イ
メージセンサは、第1伝導型と反対の第2伝導型のイン
プラントで表面に構成される第1深さの光検出器を含
む。該イメージセンサは、光検出器付近の表面にゲート
を含む。ここにおいて光検出器は、サブミクロンCMO
Sプロセスで使用されているインプラントより深くかつ
低濃度にドープされた第2伝導型のインプラントによっ
て構成される。センサは、ゲート方向に角度をつけられ
たインプラントによって構成される光検出器を含む。さ
らにセンサの好ましい実施態様は、光検出器より表面に
近い、第1伝導型で構成される第1深さより浅い第2深
さのピンニング層を使用する。
Description
ージセンサ、より詳細にはCMOSベースのイメージセ
ンサに関するものである。
(CMOS)素子で半導体イメージセンサを構成するた
めにさまざまな方法が使用されていた。概して、センサ
の光受信部品は、しばしばフォトゲートと呼ばれる大面
積トランジスタのゲート、または金属酸化膜半導体(M
OS)トランジスタのソース‐ドレイン接合のいずれか
として構成される。フォトゲートトランジスタの使用に
おいて、光が電気エネルギーに変換するために、光はト
ランジスタのシリコンゲートを通過する必要がある。そ
れゆえに、フォトゲートの使用によって感度が下がる。
さらに、概して空乏領域は浅く(1ミクロン未満)、赤
色光吸収により誘導されるキャリヤーの収集効率はそれ
によって下がる。その上、従来のフォトゲートの使用
は、表面再結合によって生じるノイズに影響されやす
い。
にトランジスタを操作するために最大限に活用される接
合を含み、そのため赤色光によって誘導されるキャリヤ
ーを効率的に収集する浅い接合も含む。ソース‐ドレイ
ン接合の使用に関するその他の欠点は、一般に接合は高
濃度にドープされた領域(1cm3当たり1016個より
多くの原子)において形成され、該領域は、接合空乏領
域の幅を制限し、さらに赤色光によって誘導されるキャ
リヤーの収集効率がそれによって下がることである。さ
らに当該高濃度にドープされている領域における接合の
形成によって、電荷量を減らす大きなキャパシタンスに
なり、該電荷量は、人工のイメージ残像を作り出す光検
知要素から伝導されることが可能である。さらに、当該
高濃度にドープされた領域には、概して大きな暗ノイズ
を生じる大きな暗電流が生じる。低濃度にドープされた
フォトダイオードとして使用されるかもしれない、サブ
ミクロンCMOSプロセスにおけるほかのインプラント
はかなり浅い。十分に深いそれらは、かなり高濃度にド
ープされている。
ートを使用しないことによってより高い収率が得られ、
接合深さが浅くないことによって収率が高くなり、表面
再結合から生じるノイズを最小限にし、より低濃度にド
ープされたプロフィールを有し、そのようなイメージセ
ンサを保有することが好ましい。
欠点を解決し、好ましい実施の形態において活動的なイ
メージセンサを提供する。
ミクロンCMOSプロセスを示すPMOSおよびNMO
Sインプラントを含む表面を有する第1伝導型の基板を
含む。該イメージセンサは、第1伝導型と反対の第2伝
導型のインプラントで表面に構成される第1深さの光検
出器を含む。該イメージセンサは、光検出器付近の表面
にゲートを含む。ここにおいて光検出器は、サブミクロ
ンCMOSプロセスで使用されているインプラントより
深くかつ低濃度にドープされた第2伝導型のインプラン
トによって構成される。センサは、ゲート方向に角度を
つけられたインプラントによって構成される光検出器を
含む。さらにセンサは、光検出器より表面に近い、第1
伝導型で構成される第1深さより浅い第2深さのピンニ
ング層を含むことができる。
0の拡大横断面図を説明する。センサ10は基礎を成す
P型基板11を含み、該P型基板11は、従来のCMO
Sインプラントではないフォトダイオードを作成するた
めに従来のCMOSプロセスを用いて、N型インプラン
トを付加することによって形成される。これらのN型イ
ンプラントは、一般的にCMOSプロセスで使用される
インプラントより深くかつ低濃度にドープされている。
一般的にサブミクロンCMOSプロセスにおける浅いイ
ンプラント(1/2−1/4ミクロン)は、1cm3当
たり不純物分子が1018個より大きいオーダーの不純物
濃度でドープされている。また、サブミクロンCMOS
プロセスにおける浅いインプラントは、1cm3当たり
ドーパント不純物が1015個より小さなオーダーでかな
り低濃度にドープされている。サブミクロンCMOSプ
ロセスにおける深いインプラント(1ミクロンより大き
なインプラント)は、一般的に1cm3当たりドーパン
ト不純物が1017個のオーダーでドープされている。一
般的にサブミクロンCMOSプロセスによって用いられ
るインプラントより深くかつ低濃度にドープされている
少なくとも1つのインプラント(好ましい実施の形態は
N型インプラントについて教える)が本発明によって生
じることが予想される。1cm3当たりドーパント不純
物が1015から1016個のオーダーのドーピング濃度を
有するインプラントを、少なくとも1ミクロンの深さで
本発明は使用することが想像される。変更CMOSプロ
セスにおいて、光検出器を作成するためにCMOS環境
におけるこれらのタイプのインプラントを本発明は使用
することが想像される。
出要素は、基板11において形成されるN型伝導領域2
6を含む。伝導領域26は、基板11のP型物質と共に
P−N接合を形成する。該P−N接合は、光スペクトル
の緑および赤の波長における光電子を効率的に集めるた
めに、伝導領域26の深さ29に位置し、CMOS素子
製造で一般的に使用されるインプラントより大きな深み
にある。実際の深さは、使用される具体的なCMOS技
術に依存する。さらに、N型伝導領域は、CMOS製造
プロセスによって一般的に使用されるインプラントより
低濃度にドープされ、インプラントの損害を完全に防ぐ
ことによって弱い暗電流にする。
ング層37は、領域26内において形成され、領域26
から基板11へ外に向かって広がり、そこで電気的接続
を形成する。より低濃度にドープされたN型領域によっ
てピンニング層の作成は容易になる。P型ピンニング層
37が好ましい実施の形態において使用されているが、
フォトダイオードを形成するN型領域26はピンニング
層なしで使用されることが可能であることは当業者によ
って理解されるであろう。表面電位をイメージセンサの
基板電位にするピンニング層によって、形成される電気
的接続がある。したがって、結果的に生じるフォトダイ
オードは、しばしばピン止めされたフォトダイオードと
呼ばれる。ピンニング層37によって生じる第2P−N
接合は、層37と領域26の交わる部分に沿って形成さ
れる。一般的に層37は、基板11上においてその他の
P−チャンネルMOSトランジスタ(示されていない)
の低濃度にドープされたドレインおよびソースの形成と
同時に形成される。第2P−N接合の深さは、第1P−
N接合29の深さより浅い。この深さは、青色波長にお
ける光の吸収または検出を最も効果的にする。ピンニン
グ層37は浅く、かなり高濃度にドープされているの
で、インプラント以外の方法で形成されることも可能で
ある。
OSトランジスタ32は、伝導領域26付近に形成さ
れ、領域26の一部はトランジスタ32のソースを形成
することになる。第2またはリセットMOSトランジス
タ31は、基板11に形成される。トランジスタ31
は、カップリング領域41によってトランジスタ32に
電気的に結合されるソースを有する。
しにする穴を有するマスクを利用することによって形成
される。該基板11は、トランジスタ32またはゲート
22の部分を含み、それらまで広がっている。次に、ゲ
ート22の下に広がる領域26を確保するためにゲート
22に対してある角度をなしてドーパントは注入され、
それによって、領域26およびトランジスタ32のソー
スの形成において、マスキングおよびその他の処理操作
を省く。伝導領域26はインプラントによって形成さ
れ、サブミクロンCMOSプロセスの短く低い熱の連続
により得られる好ましいドーピングレベルと十分な深さ
を有する領域を形成することが予想される。
ための方法が提供されていることは高く評価されるべき
である。深い伝導領域とより浅いピンニング層を形成す
ることによって、2つのP−N接合を形成し、ここにお
いて1つのP−N接合は空乏領域と結合していて、赤と
緑色波長における光の捕獲を容易にするために深く、別
のP−N接合は空乏領域と結合していて、青色波長の光
の捕獲を容易にするために浅い。この構造も表面再結合
と同様にバルク暗電流を最小にし、電荷の移動を最大に
する。伝導領域を形成するために角度をつけられたイン
プラントを用いることによって、伝導領域が電荷トラン
スファートランジスタのソースとして使用可能であるこ
とを保証し、それによって製造工程を最少にする。
態様の拡大横断面の一部を説明する。
Claims (1)
- 【請求項1】 サブミクロンCMOSプロセスを示すP
MOSおよびNMOSインプラントを含む表面を有する
第1伝導型の基板と、 第1伝導型と反対の第2伝導型のインプラントで表面に
構成される第1深さの光検出器と、 光検出器付近の表面にゲートとを含み、 ここにおいて、該光検出器は、サブミクロンCMOSプ
ロセスにおいて使用されるインプラントより深くかつ低
濃度にドープされている第2伝導型のインプラントによ
って構成されるCMOSイメージセンサ。
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