KR900002110A - 액티브 매트릭스 패널의 제조 방법 - Google Patents
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제 1도(a)~(d)는 본 발명의 제 1 및 제 3의 실시예를 설명하기 위한 공정의 흐름을 도시한 도면.
제 2도(a)는 제 1도(d)에 도시한 패널의 평면도.
제 2도(b)는 제 2도(a)의 부분 확대도.
제 3도(a)~(d)는 본 발명의 제 2및 제 6의 실시예를 설명하기 위한 공정의 흐름을 도시한 도면.
제 9도(a)~(d)는 본 발명의 제 7도의 실시예를 설명하기 위한 공정의 흐름을 도시한 도면.
Claims (11)
- 액티브 매트릭스형의 액정 패널에 있어서, 기판위에 차례로 퇴적한 투명도전막과 금속막의 2층막을 가공하는 것에 의해 적어도 화소전극과 박막 트랜지스터의 게이트전극을 동시에 패턴 형성하고, 상기 박막 트랜지스터의 소오스 및 드레인전극을 형성하는 가공시와 동시에 상기 화소전극상의 금속막을 제거하는 액티브 매트릭스 패널의 제조방법.
- 액티브 매트릭스형의 액정패널에 있어서, 기판위에 차례로 퇴적한 투명도전막과 금속막의 2층막을 가공하는 것에 의해 적어도 화소전극과 박막 트랜지스터의 게이트전극을 동시에 패턴형성하고, 상기 박막 트랜지스터의 소오스 및 드레인전극을 형성하는 가공시와 동시에 상기 박막 트랜지스터의 소오스 배선의 아래층쪽에 퇴적된 불순물이 함유된 비정질 실리콘막이 불필요한 부분과 상기 화소전극상의 금속막을 제거하는 액티브 매트릭스 패널의 제조방법.
- 액티브 매트릭스형의 액정패널에 있어서, 기판위에 차례로 퇴적한 투명도전막과 금속막의 2층막을 가공하는 것에 의해 적어도 화소전극과 박막 트랜지스터의 게이트전극을 동시에 패턴형성하고, 상기 박막 트랜지스터의 소오스 및 드레인전극을 형성하는 가공시와 동시에, 상기 박막 트랜지스터의 소오스 배선의 아래층측에 퇴적된 불순물이 함유된 비정질 실리콘막이 불필요한 부분, 상기 불순물이 함유된 비정질 실리콘막의 아래층측에서 게이트절연막의 위층측에 퇴적된 비정질 실리콘막이 불필요한 부분 및 상기 화소전극상의 금속막을 제거하는 액티브 매트릭스 패널의 제조방법.
- 특허청구의 범위 제 1항, 제 2항 또는 제 3항에 있어서, 상기 화소전극은 그 중앙부가 투명도전막으로 형성되고, 그 주변부가 투명도전막과 금속막의 2층막으로 형성되어 있는 액티브 매트릭스 패널의 제조방법.
- 특허청구의 범위 제 3항에 있어서, 상기 불순물이 함유된 비정질 실리콘막과 상기 비정질실리콘막사이에 실리콘을 주성분으로하고 적어도 산소를 함유하는 화합물로 되는 보호막을 개재시킨 액티브 매트릭스 패닐의 제조방법.
- 특허청구의 범위 제 4항에 있어서, 상기 불순물이 함유된 비정질 실리콘막과 상기 비정질실리콘막사이에 실리콘을 주성분으로하고 적어도 산소를 함유하는 화합물로 되는 보호막을 개재시킨 액티브 매트릭스 패널의 제조방법.
- 특허청구의 범위 제 1항, 제 2항 또는 제 3항에 있어서, 상기 화소전극과 게이트전극을 동시에 형성하는 가공 및 상기 소오스, 드레인전극을 형성하는 가공이 포토마스크를 사용한 포토리도그래피에 의한 가공인 액티브 매트릭스패널의 제조방법.
- 적어도 박막 트랜지스터 부분과 화소전극부분을 포함하는 액티브 매트릭스 패널의 제조방법에 있어서, 유리기판위에 투명도전막을 퇴적하고, 투명도전막위에 하부도전막을 퇴적하고, 투명도전막과 하부도전막의 2층막을 가공하는 것에 의해 상기 박막 트랜지스터 부분의 게이트전극 및 상기 화소전극부분을 형성하는 제 1의 단계, 절연막, 절연막에 이어 반도체막, 반도체막에 이어 보호막을 퇴적하고, 상기 보호막을 상기 박막 트랜지스터부분의 게이트전극의 폭보다 좁게 가공하는 것에 의해 상기 보호막을 형성하는 제 2의 단계, 상기 반도체막을 상기 게이트전극의 폭보다 채널길이 방향으로 넓게하고, 채널폭 방향으로 짧게 가공하는 제 3의 단계 및 불순물이 함유된 반도체막을 퇴적하고, 불순물이 함유된 반도체막에 이어 제 1의 상부도전막을 퇴적하고, 제 1의 상부도전막에 이어 제 2의 상부도전막을 퇴적하고, 불순물이 함유된 반도체막, 제 1및 제 2의 상부도전막의 3층막을 가공하는 것에 의해, 상기 박막 트랜지스터부분의 드레인 및 소오스전극을 형성함과 동시에, 상기 드레인 및 소오스전극의 어느 한쪽의 전극과 상기 화소전극의 접촉부분이외의 화소전극상의 영역에서 상기 3층막을 제거하고, 그후 계속해서 상기 하부도전막을 제거하는 제 4의 단계를 포함하는 액티브 매트릭스 패널의 제조방법.
- 적어도 박막 트랜지스터 부분과 화소전극부분을 포함하는 액티브 매트릭스 패널의 제조방법에 있어서, 유리기판위에 투명도전막을 퇴적하고, 투명도전막위에 하부도전막을 퇴적하고, 투명도전막과 하부도전막의 2층막을 가공하는 것에 의해 상기 박막 트랜지스터부분의 게이트전극 및 상기 화소전극부분을 형성하는 제 1의 단계, 절연막, 절연막에 이어 반도체막을, 반도체막에 이어 보호막을 퇴적하고, 상기 보호막을 상기 박막 트랜지스터부분의 게이트전극의 폭보다 좁게 가공하는 것에 의해 상기 보호막을 형성하는 제 2의 단계, 상기 반도체막과 상기 절연막을 상기 화소전극부분보다 좁은 영역에서 제거하는 제 3의 단계 및 불순물이 함유된 반도체막을 퇴적하고, 불순물이 함유된 반도체막에 이어 상부도전막을 퇴적하고, 불순물이 함유된 반도체막과 상부도전막의 2층막을 가공하는 것에 의해 상기 박막 트랜지스터부분의 드레인 및 소오스전극을 형성함과 동시에 상기 드레인 및 소오스전극의 어느 한쪽의 전극과 상기 화소전극의 접촉부분 이외의 화소전극상의 영역에서 상기 2층막을 제거하고, 그후 계속해서 상기 반도체막을 가공하고, 또 상기 화소전극부분위의 상기 하부도전막을 제거하는 제 4의 단계를 포함하는 액티브 매트릭스 패널의 제조방법.
- 적어도 박막 트랜지스터부분과 화소전극부분을 포함하는 액티브 매트릭스 패널의 제조방법에 있어서, 유리기판위에 투명도전막을 퇴적하고, 투명도전막위에 하부도전막을 퇴적하고, 투명도전막과 하부도전막의 2층막을 가공하는 것에 의해 상기 박막 트랜지스터부분의 게이트전극 및 상기 화소전극부분을 형성하는 제 1의 단계, 절연막, 절연막에 이어 반도체막을 반도체막에 이어 SiXOYNZ를 함유하는 보호막을 퇴적하고, 상기 보호막을 상기 박막 트랜지스터부분에 게이트전극의 폭보다 좁게 가공하는 것에 의해 상기 보호막을 형성하는 제 2의 단계, 상기 화소전극부분보다 좁은 영역에서 상기 절연막을 제거하고, 불순물이 함유된 반도체막을 퇴적하고 불순물이 함유된 반도체막을 박막 트랜지스터부분의 소오스 및 드레인전극보다 작게 또한 상기 보호막의 중앙부분을 제거하도록 가공하고, 또 계속해서 상기 반도체막을 가공하는 제 3의 단계, 제 1의 상부도전막을 퇴적하고, 제 1의 상부도전막을 퇴적하고, 제 1의 상부도전막에 이어 제 2의 상부도전막을 퇴적하고, 제 1 및 제 2의 상부도전막의 2층막을 가공하는 것에 의해 상기 드레인 및 소오스전극을 형성함과 동시에 상기 드레인 및 소오스전극의 어느 한쪽의 전극과 상기 화소전극의 접촉부분이외의 화소전극상이 영역에서 상기 2층막을 제거하고, 그후 계속해서 상기 하부도전막을 제거하는 제 4의 단계를 포함하는 액티브 매트릭스 패널의 제조방법.
- 적어도 박막 트랜지스터부분과 화소전극부분을 포함하는 액티브 매트릭스 패널의 제조방법에 있어서, 유리기판위에 투명도전막을 퇴적하고, 투명도전막위에 하부도전막을 퇴적하고, 상기 박막 트랜지스터부분의 게이트전극 및 상기 화소전극부분을 형성하는 제 1의 단계, 게이트절연막, 게이트절연막에 이어 a-si의 반도체막을, 반도체막에 이어 보호막을 퇴적하고, 상기 보호막을 형성하는 제 2의 단계, 상기 반도체막과 상기 절연막을 상기 화소전극부분에서 제거하는 제 3의 단계 및 불순물이 함유된 반도체막을 퇴적하고, 불순물이 함유된 반도체막에 이어 상부도전막을 퇴적하고, 상기 박막 트랜지스터부분의 드레인 및 소오스전극을 형성함과 동시에, 화소전극상에서 상기 불순물이 함유된 반도체막 및 상부도전막을 제거하고, 계속해서 상기 반도체막을 가공하고, 또 상기 화소전극부분상의 상기 하부도전막을 제거하는 제 4의 단계를 포함하는 액티브 매트릭스 패널의 제조방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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