KR870007520A - 여유회로부를 갖춘 반도체 메모리장치 - Google Patents

여유회로부를 갖춘 반도체 메모리장치 Download PDF

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Abstract

내용 없음

Description

여유회로부를 갖춘 반도체 메모리장치
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제3도는 본 발명에 따른 반도체 메모리장치의 기본구조예를 나타내는 블록도.
제4도에 도시한 회로에 있는 부분.
제6도는 본 발명에 따른 반도체 메모리장치의 또다른 실시예를 나타내는 회로도.
* 도면의 주요부분에 대한 부호의 설명
1 : 정규메모리 셀어레이, 2 : 정규디코더 및 구동기, 3 : 어드레스 버퍼 및 디코더, 4 : 비교 및 스위칭회로, 5 : PROM, 6 : 여유디코더 및 구동기, 7 : 여유메모리 셀어레이

Claims (5)

  1. 반도체 메모리장치에 있어서, 이상의 상위 어드레스비트가 입력되는 1이상의 상위 어드레스비트 입력단자 ; 1이상의 하위 어드레스 비트가 입력되는 1이상의 하위어드레스 비트입력단자 ; 다수의 워드선 및 비트선이 제공되며, 다수의 메모리셀이 상기 워드선 및 비트선의 각 교차점에 배치되는 정규메모리 셀어레이 ; 다수의 워드선 및 비트선이 제공되며, 다수의 메모리셀이 상기 워드선 및 비트선의 각 교차점에 배치되며, 상기 정규메모리 셀어레이의 용량보다 적은 여유메모리 셀어레이 ; 상기 상위어드레스 비트 및 하위어드레스비트에 따라 상기 정규메모리 셀어레이에 속하는 워드선 혹은 비트선을 선택하기 위한 제1선택수단 ; 상기하위 어드레스 비트에 따라 상기 여유메모리 셀어레이에 속하는 워드선 혹은 비트선을 선택하기 위한 제2선택수단 ; 상기 정규메모리 셀어레이에 존재하는 결합이 있는 메모리 셀에 대응하는 어드레스데이타에 포함된 1이상의 상위 어드레스비트를 프로그램하기 위한 여유어드레스 프로그래밍수단 ; 및 상기 각 입력상위 어드레스비트가 상기 각 프로그램된 상위어드레스 비트와 일치할 때, 상기 정규메모리 셀어레이에 속하는 상기 워드선 혹은 비트선의 선택이 금지되고, 상기 여유메모리 셀어레이에 속하는 소정의 워드선 혹은 비트선이 상기 정규메모리 셀어레이에 속하는 상기 워드선 혹은 비트선 대신에 선택되도록 상기 각 입력 상위어드레스 비트를 상기 각 프로그램된 상위어드레스 비트와 비교하고, 상기 제1 및 제2선택수단을 제어하기 위한 제어수단으로 구성되는 것을 특징으로 하는 반도체 메모리장치.
  2. 제1항에 있어서, 상기 제1선택수단은 상기 입력상위어드레스비트를 더코딩하기 위한 제1프리스테이지(prestage)디코더, 상기 입력 하위어드레스비트를 디코딩하기 위한 제2프리스테이지 디코더 및 상기 제1 및 제2프리스테이지 디코더 수단으로부터 출력을 입력하여 디코딩하기 위한 포스트스테이지(poststage)디코더수단으로 구성되며, 상기 제2선택수단은 상기 제2프리스테이지 디코더수단으로부터 출력을 입력하여 상기 여유메모리 셀어레이에 속하는 소정의 워드선 혹은 비트선을 선택하기 위한 회로로 구성되는 것을 특징으로 하는 반도체 메모리장치.
  3. 제2항에 있어서 상기 제어수단은 상기 각 입력상위 어드레스비트를 상기 각 프로그램된 상위어드레스 비트와 비교하여, 상기 각 입력상위 어드레스비트가 각 상기 프로그램된 상위어드레스 비트와 일치할 때 상기 포스트스테이지 디코더수단의 디코딩동작을 금지하여 상기 제2선택수단이 능동상태로 들어가도록 하기 위한 제어신호를 출력하는 것을 특징으로 하는 반도체 메모리장치.
  4. 제1항에 있어서, 상기 제1선택수단은 상기 입력상위 어드레스비트 및 하위어드레스 비트를 디코딩하기 위한 상기 정규메모리 셀어레이용 디코더수단을 포함하며, 상기 제2선택수단은 상기 입력하위어드레스 비트를 디코딩하기 위한 상기 여유메모리 셀어레이용 디코더수단을 포함하는 것을 특징으로 하는 반도체 메모리 장치.
  5. 제4항에 있어서, 상기 제어수단은 상기 각 입력상위 어드레스비트와 비교하여, 상기 각 입력 상기 각입력 상위어드레스비트가 상기 각 프로그램된 상위 어드레스 비트와 일치할 때, 상기 정규메모리 셀어레이용 상기 디코더수단의 디코딩동작을 금지하여 상기 여유메모리 셀어레이용 상기 디코더수단을 능동상태로 들어가도록 하기 위한 제어신호를 출력하는 것을 특징으로 하는 반도체 메모리장치.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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