JP2503565B2 - 半導体装置の製造方法 - Google Patents
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Description
【発明の詳細な説明】 [産業上の利用分野] 本発明は、半導体装置の応力緩衝保護膜として梯子型
シリコーンポリマーからなる膜を用いた半導体装置の製
造方法に関する。
シリコーンポリマーからなる膜を用いた半導体装置の製
造方法に関する。
[従来の技術および発明が解決しようとする課題] 従来から、EPROMなどの半導体装置に設けられている
応力緩衝保護膜としては、たとえば「機能材料,7,9−15
(1983)」や「デンキカガク(Denki kagaku),51,No.
7,554−558(1983)」などに開示されているようにポリ
イミド系の材料が使用されている。
応力緩衝保護膜としては、たとえば「機能材料,7,9−15
(1983)」や「デンキカガク(Denki kagaku),51,No.
7,554−558(1983)」などに開示されているようにポリ
イミド系の材料が使用されている。
ポリイミド系の材料は膜形成が簡便であり、耐熱性に
優れた保護膜を与えうるが、第2図に示すように半導体
装置の製造工程におけるボンディングパッドなどの配線
パターンを形成する工程が煩雑になるという問題があ
る。
優れた保護膜を与えうるが、第2図に示すように半導体
装置の製造工程におけるボンディングパッドなどの配線
パターンを形成する工程が煩雑になるという問題があ
る。
第2図(g)〜(o)は半導体装置の製造工程におい
て、従来の方法によって応力緩衝保護膜を設け、アルミ
ニウム配線にワイヤボンドするためのパッドを開ける工
程を示す断面図であり、図中、(1)はシリコン基板、
(2)はアルミニウム配線、(3)はガラスコート膜、
(4)はレジスト、(55)は応力緩衝保護膜である。
て、従来の方法によって応力緩衝保護膜を設け、アルミ
ニウム配線にワイヤボンドするためのパッドを開ける工
程を示す断面図であり、図中、(1)はシリコン基板、
(2)はアルミニウム配線、(3)はガラスコート膜、
(4)はレジスト、(55)は応力緩衝保護膜である。
従来の方法では、まず第2図(g)に示すようにアル
ミニウム配線(2)が設けられ、その上にガラスコート
膜(3)が形成されたシリコン基板(1)に、ガラスコ
ート膜(3)に孔を開けるためのレジスト(4)が塗布
される。つぎに(h)〜(j)に示すようにレジスト
(4)をパターイングし、四フッ化炭素と酸素の混合ガ
スのプラズマを用いたドライ処理によりガラスコート膜
(3)をエッチングしてガラスコート膜(3)に孔を開
け、さらにレジスト(4)を酸素プラズマを用いたドラ
イ処理をして除去する。
ミニウム配線(2)が設けられ、その上にガラスコート
膜(3)が形成されたシリコン基板(1)に、ガラスコ
ート膜(3)に孔を開けるためのレジスト(4)が塗布
される。つぎに(h)〜(j)に示すようにレジスト
(4)をパターイングし、四フッ化炭素と酸素の混合ガ
スのプラズマを用いたドライ処理によりガラスコート膜
(3)をエッチングしてガラスコート膜(3)に孔を開
け、さらにレジスト(4)を酸素プラズマを用いたドラ
イ処理をして除去する。
つぎに(k)に示すようにポリイミド系材料からなる
応力緩衝保護膜(55)を形成し、さらに(l)〜(m)
に示すようにパッド孔を開けるためにもう一度レジスト
(4)を塗布し、パターニングする。つぎに(n)〜
(m)に示すように応力緩衝保護膜(55)をアルカリ溶
液で処理してエッチングし、レジスト(4)をアセト
ン、n−酢酸ブチルなどの溶剤を用いたウェット処理を
行ない除去することによってパッドが形成される。
応力緩衝保護膜(55)を形成し、さらに(l)〜(m)
に示すようにパッド孔を開けるためにもう一度レジスト
(4)を塗布し、パターニングする。つぎに(n)〜
(m)に示すように応力緩衝保護膜(55)をアルカリ溶
液で処理してエッチングし、レジスト(4)をアセト
ン、n−酢酸ブチルなどの溶剤を用いたウェット処理を
行ない除去することによってパッドが形成される。
このようにガラスコート膜(3)をエッチングしたの
ち、応力緩衝保護膜(55)を形成してエッチングする必
要があるため、レジストのパターニングが2回必要であ
った。後述する第1図の(e)〜(f)に示すように応
力緩衝保護膜(5)をマスクとしてガラスコート膜
(3)をエッチングすることができればレジストのパタ
ーニングが1回ですむのであるが、前述のごとく従来の
応力緩衝保護膜(55)はポリイミド系材料からなるもの
が多く、ガラスコート膜(3)のエッチングに用いられ
る四フッ化炭素と酸素の混合ガスのプラズマに対して表
面が変質し、また応力緩衝保護膜(55)をパターン形成
するために用いたレジスト除去に作業性の良好な酸素プ
ラズマ処理は適用できないという問題がある。なぜな
ら、ポリイミド系材料は酸素プラズマ処理で灰化される
からである。また、シリコーン系材料であっても、酸素
プラズマ処理により、クラックが発生するため、レジス
ト除去は溶剤を用いる必要があるなどの作業性などの劣
るウェット処理である必要がある。
ち、応力緩衝保護膜(55)を形成してエッチングする必
要があるため、レジストのパターニングが2回必要であ
った。後述する第1図の(e)〜(f)に示すように応
力緩衝保護膜(5)をマスクとしてガラスコート膜
(3)をエッチングすることができればレジストのパタ
ーニングが1回ですむのであるが、前述のごとく従来の
応力緩衝保護膜(55)はポリイミド系材料からなるもの
が多く、ガラスコート膜(3)のエッチングに用いられ
る四フッ化炭素と酸素の混合ガスのプラズマに対して表
面が変質し、また応力緩衝保護膜(55)をパターン形成
するために用いたレジスト除去に作業性の良好な酸素プ
ラズマ処理は適用できないという問題がある。なぜな
ら、ポリイミド系材料は酸素プラズマ処理で灰化される
からである。また、シリコーン系材料であっても、酸素
プラズマ処理により、クラックが発生するため、レジス
ト除去は溶剤を用いる必要があるなどの作業性などの劣
るウェット処理である必要がある。
本発明は上記のような問題を解消するためになされた
もので、パッド孔形成工程上のレジストのパターニング
が1度ですみ、レジスト除去およびガラスコート膜のエ
ッチングがドライ処理で行なえるとう従来の方法に比べ
て工程が大幅に簡略化された半導体装置の製造方法をう
ることを目的とする。
もので、パッド孔形成工程上のレジストのパターニング
が1度ですみ、レジスト除去およびガラスコート膜のエ
ッチングがドライ処理で行なえるとう従来の方法に比べ
て工程が大幅に簡略化された半導体装置の製造方法をう
ることを目的とする。
[課題を解決するための手段] 本発明は、アルミニウム配線された基板上にガラスコ
ート膜、さらに応力緩衝保護膜が設けられ、アルミニウ
ム配線にワイヤボンドするためのパッドを設けた半導体
装置を製造する際に、アルミニウム配線された基板上に
ガラスコート膜を設け、ついで応力緩衝保護膜として梯
子型シリコーンポリマーからなる膜を形成し、不活性ガ
スのプラズマ処理またはイオン注入による表面改質処理
を行ない、さらにレジスト膜の形成、パターニングを行
なったのち、応力緩衝保護膜のドライエッチングを行な
い、酸素プラズマでレジスト膜の除去を行なったのちガ
ラスコート膜を四フッ化炭素プラズマでドライエッチン
グを行なうことを特徴とする半導体装置の製造方法に関
する。
ート膜、さらに応力緩衝保護膜が設けられ、アルミニウ
ム配線にワイヤボンドするためのパッドを設けた半導体
装置を製造する際に、アルミニウム配線された基板上に
ガラスコート膜を設け、ついで応力緩衝保護膜として梯
子型シリコーンポリマーからなる膜を形成し、不活性ガ
スのプラズマ処理またはイオン注入による表面改質処理
を行ない、さらにレジスト膜の形成、パターニングを行
なったのち、応力緩衝保護膜のドライエッチングを行な
い、酸素プラズマでレジスト膜の除去を行なったのちガ
ラスコート膜を四フッ化炭素プラズマでドライエッチン
グを行なうことを特徴とする半導体装置の製造方法に関
する。
[作用および実施例] 本発明において応力緩衝保護膜として用いられる梯子
型シリコーンポリマーからなる膜としては、たとえば
「機能材料,7,14−15(1983)」や「デンキカガク(Den
ki kagaku),51,No.7,555−556(1983)」に開示されて
いるような一般式(I): (式中、R1はフェニル基または好ましい炭素数は1〜5
の低級アルキル基、R2は水素原子、メチル基またはエチ
ル基、nは2〜1000、好ましくは50〜500の整数を示
す)で表わされる梯子型シリコーンポリマーなどからな
る保護膜があげられる。また、応力緩衝保護膜の厚さは
2〜10μmが好ましい。
型シリコーンポリマーからなる膜としては、たとえば
「機能材料,7,14−15(1983)」や「デンキカガク(Den
ki kagaku),51,No.7,555−556(1983)」に開示されて
いるような一般式(I): (式中、R1はフェニル基または好ましい炭素数は1〜5
の低級アルキル基、R2は水素原子、メチル基またはエチ
ル基、nは2〜1000、好ましくは50〜500の整数を示
す)で表わされる梯子型シリコーンポリマーなどからな
る保護膜があげられる。また、応力緩衝保護膜の厚さは
2〜10μmが好ましい。
前記のごときポリマーからなる応力緩衝保護膜は、通
常の四フッ化炭素プラズマによるガラスコート膜のエッ
チングのマスクとして充分な耐四フッ化炭素プラズマ性
を有し、また不活性ガスのプラズマで処理またはイオン
注入による表面改質処理により応力緩衝保護膜の表面が
SiO2化し、酸素プラズマに曝されてもクラックなどを生
じない膜になる。したがってガラスコート膜を四フッ化
炭素プラズマでエッチングするときのレジストになりう
る。
常の四フッ化炭素プラズマによるガラスコート膜のエッ
チングのマスクとして充分な耐四フッ化炭素プラズマ性
を有し、また不活性ガスのプラズマで処理またはイオン
注入による表面改質処理により応力緩衝保護膜の表面が
SiO2化し、酸素プラズマに曝されてもクラックなどを生
じない膜になる。したがってガラスコート膜を四フッ化
炭素プラズマでエッチングするときのレジストになりう
る。
以下、前記応力緩衝保護膜を用いる本発明の方法の一
実施例を、第1図(a)〜(f)に基づいて説明する。
第1図において(1)はシリコン基板、(2)はアルミ
ニウム配線、(3)はガラスコート膜、(4)はレジス
ト、(5)は応力緩衝保護膜である。
実施例を、第1図(a)〜(f)に基づいて説明する。
第1図において(1)はシリコン基板、(2)はアルミ
ニウム配線、(3)はガラスコート膜、(4)はレジス
ト、(5)は応力緩衝保護膜である。
まず、第1図(a)に示すようにアルミニウム配線
(2)が設けられ、その上にガラスコート膜(3)が形
成されたシリコン基板(1)上に、応力緩衝保護膜
(5)となる前記のごときポリマーをトルエン、アニソ
ール、テトライドロフランなどの有機溶剤に溶解して濃
度5〜30%(重量%、以下同様)程度の溶液としたもの
を、乾燥後の厚さが2〜10μmになるように回転塗布法
などにより塗布したのち、チッ素雰囲気中150〜300℃で
1〜2時間ベークして応力緩衝保護膜(5)を形成す
る。なお、シリコン基板(1)、アルミニウム配線
(2)およびガラスコート膜(3)はいずれも従来と同
様のものである。
(2)が設けられ、その上にガラスコート膜(3)が形
成されたシリコン基板(1)上に、応力緩衝保護膜
(5)となる前記のごときポリマーをトルエン、アニソ
ール、テトライドロフランなどの有機溶剤に溶解して濃
度5〜30%(重量%、以下同様)程度の溶液としたもの
を、乾燥後の厚さが2〜10μmになるように回転塗布法
などにより塗布したのち、チッ素雰囲気中150〜300℃で
1〜2時間ベークして応力緩衝保護膜(5)を形成す
る。なお、シリコン基板(1)、アルミニウム配線
(2)およびガラスコート膜(3)はいずれも従来と同
様のものである。
つぎにチッ素、アルゴン、ネオンなどの不活性ガスの
プラズマ処理またはそれらのイオン注入により応力緩衝
保護膜(5)の表面改質を行なう。前記プラズマの発生
方法は、RF、マイクロ波、ECRなどいずれの方法であっ
てもよく、またプラズマ処理の条件は、たとえばRF、N2
プラズマのばあいガス流量20〜100cc/min、圧力0.5〜1T
orr、電300W〜1kW、処理時間15〜60分で行なうのが好ま
しく、またチッ素、アルゴン、ネオンなどな不活性ガス
のイオン注入の条件は、たとえばチッ素のばあい注入量
1〜5×1017N+/cm2、注入エネルギー50〜100keVで行な
うのが好ましい。
プラズマ処理またはそれらのイオン注入により応力緩衝
保護膜(5)の表面改質を行なう。前記プラズマの発生
方法は、RF、マイクロ波、ECRなどいずれの方法であっ
てもよく、またプラズマ処理の条件は、たとえばRF、N2
プラズマのばあいガス流量20〜100cc/min、圧力0.5〜1T
orr、電300W〜1kW、処理時間15〜60分で行なうのが好ま
しく、またチッ素、アルゴン、ネオンなどな不活性ガス
のイオン注入の条件は、たとえばチッ素のばあい注入量
1〜5×1017N+/cm2、注入エネルギー50〜100keVで行な
うのが好ましい。
ここで本明細書にいう表面改質とは、応力緩衝保護膜
を、その表面から好ましくは0.1〜0.5μmの深さまでを
SiO2化することをいう。
を、その表面から好ましくは0.1〜0.5μmの深さまでを
SiO2化することをいう。
つぎに(b)〜(c)に示すように応力緩衝保護膜
(5)をエッチングするための従来から用いられるポジ
型の厚さ2〜3μmのレジスト(4)を形成し、所定の
マスクを用いて露光し、レジスト(4)をパターニング
する。
(5)をエッチングするための従来から用いられるポジ
型の厚さ2〜3μmのレジスト(4)を形成し、所定の
マスクを用いて露光し、レジスト(4)をパターニング
する。
つぎに(d)〜(e)に示すように応力緩衝保護膜
(5)をCHF3などのプラズマでドライ処理してエッチン
グしたのち、レジスト(4)を酸素プラズマで、好まし
くは圧力1Torr、RF電力400Wで処理して灰化除去する。
(5)をCHF3などのプラズマでドライ処理してエッチン
グしたのち、レジスト(4)を酸素プラズマで、好まし
くは圧力1Torr、RF電力400Wで処理して灰化除去する。
つぎに(f)に示すようにエッチングされた応力緩衝
保護膜(5)をマスクとしてガラスコート膜(3)を四
フッ化炭化プラズマで、好ましくはO25%のCF4/O2、圧
力1Torr、RF電力400〜500Wでエッチングすることによ
り、半導体装置に応力緩衝保護膜を設け、ボンディング
パットなどの配線パターンを形成することができる。
保護膜(5)をマスクとしてガラスコート膜(3)を四
フッ化炭化プラズマで、好ましくはO25%のCF4/O2、圧
力1Torr、RF電力400〜500Wでエッチングすることによ
り、半導体装置に応力緩衝保護膜を設け、ボンディング
パットなどの配線パターンを形成することができる。
(f)に示されるガラスコート膜をエッチングすると
き、応力緩衝保護膜は表面のSiO2化されている部分はエ
ッチングされるが、SiO2の部分の下はシリコーン系材料
であるため、マスクの役目を果たす。
き、応力緩衝保護膜は表面のSiO2化されている部分はエ
ッチングされるが、SiO2の部分の下はシリコーン系材料
であるため、マスクの役目を果たす。
これまでに説明したように、従来の方法では、第2図
により説明したように、ガラスコート膜(3)の開孔と
応力緩衝保護膜(55)の開孔とを別々に行なうことが多
く、それぞれにレジストのパターニングが必要であっ
た。これに対し、本発明の方法ではパターニングされた
応力緩衝保護膜(5)をマスクとして(f)に示すよう
に四フッ化炭素プラズマでガラスコート膜(3)をエッ
チングするのでレジストのパターニングが一度ですみ、
またレジスト除去をドライ処理で行なうことができ、工
程が大幅に簡略化される。
により説明したように、ガラスコート膜(3)の開孔と
応力緩衝保護膜(55)の開孔とを別々に行なうことが多
く、それぞれにレジストのパターニングが必要であっ
た。これに対し、本発明の方法ではパターニングされた
応力緩衝保護膜(5)をマスクとして(f)に示すよう
に四フッ化炭素プラズマでガラスコート膜(3)をエッ
チングするのでレジストのパターニングが一度ですみ、
またレジスト除去をドライ処理で行なうことができ、工
程が大幅に簡略化される。
つぎに本発明の製造方法を実施例に基づき、さらに具
体的に説明するが、本発明はかかる実施例のみに限定さ
れるものではない。
体的に説明するが、本発明はかかる実施例のみに限定さ
れるものではない。
実施例1 第1図(a)に示すような厚さ1μmのアルミニウム
配線が設けられ、その上に厚さ1μmのガラスコート膜
が形成されたシリコン基板上に、平均分子量100000の
式: で示されるシリコーンポリマーをアニソールに溶解して
濃度20%の溶液としたものを、乾燥後の厚さが5μmに
なるように回転塗布法により塗布したのち、250℃で1
時間ベークして応力緩衝保持膜を形成した。えられた保
護膜の面のオージェ電子分光法で調べたスペクトル(以
下、AESという)を第3図に示す。第3図から、Siのピ
ーク(6)、Cのピーク(7)、Oのピークがみられる
ことがわかる。
配線が設けられ、その上に厚さ1μmのガラスコート膜
が形成されたシリコン基板上に、平均分子量100000の
式: で示されるシリコーンポリマーをアニソールに溶解して
濃度20%の溶液としたものを、乾燥後の厚さが5μmに
なるように回転塗布法により塗布したのち、250℃で1
時間ベークして応力緩衝保持膜を形成した。えられた保
護膜の面のオージェ電子分光法で調べたスペクトル(以
下、AESという)を第3図に示す。第3図から、Siのピ
ーク(6)、Cのピーク(7)、Oのピークがみられる
ことがわかる。
つぎに応力緩衝保護膜の表面をチッ素ガス圧力0.8Tor
r、RF電力300Wの条件で60分間プラズマに曝し、チッ素
ガスプラズマ処理による表面改質処理を行なった。その
表面のAESを第4図に示す。第4図ではCのピーク
(7)が極めて小さくなり、Nのピーク(9)が少しみ
られる。このことから応力緩衝保護膜の表面の有機成分
が除去され、SiO2化されたことがわかる。なお、表面に
Nが少し取り込まれることがあるが、ガラスコート膜を
エッチングする際、同時に除去されるので問題はない。
r、RF電力300Wの条件で60分間プラズマに曝し、チッ素
ガスプラズマ処理による表面改質処理を行なった。その
表面のAESを第4図に示す。第4図ではCのピーク
(7)が極めて小さくなり、Nのピーク(9)が少しみ
られる。このことから応力緩衝保護膜の表面の有機成分
が除去され、SiO2化されたことがわかる。なお、表面に
Nが少し取り込まれることがあるが、ガラスコート膜を
エッチングする際、同時に除去されるので問題はない。
つぎに第1図(b)〜(c)に示すようにポジ型レジ
スト、たとえば東京応化工業(株)製OFPR−800を用い
て厚さ2μmのレジストを形成し、所定のマスクを用い
て露光し、パターニングした。
スト、たとえば東京応化工業(株)製OFPR−800を用い
て厚さ2μmのレジストを形成し、所定のマスクを用い
て露光し、パターニングした。
つぎに(d)〜(e)に示すように応力緩衝保護膜
(5)をCHF3圧力1Torr、RF電力400Wのプラズマでエッ
チングしたのち、レジスト(4)を酵素プラズマにより
圧力1Torr、RF電力400Wで処理して灰化除去した。
(5)をCHF3圧力1Torr、RF電力400Wのプラズマでエッ
チングしたのち、レジスト(4)を酵素プラズマにより
圧力1Torr、RF電力400Wで処理して灰化除去した。
つぎに(f)に示すようにエッチングされた応力緩衝
保護膜(5)をマスクとして四フッ化炭素プラズマで圧
力1Torr、RF電力400W(O25%)の条件で処理してガラス
コート膜をエッチングすることにより、半導体装置に応
力緩衝保護膜を設け、アルミニウム配線にワイヤボンド
するためのパッドを設けた。パッドが設けられた応力緩
衝保護膜を観察したところ、クラックはまったく認めら
れなかった。
保護膜(5)をマスクとして四フッ化炭素プラズマで圧
力1Torr、RF電力400W(O25%)の条件で処理してガラス
コート膜をエッチングすることにより、半導体装置に応
力緩衝保護膜を設け、アルミニウム配線にワイヤボンド
するためのパッドを設けた。パッドが設けられた応力緩
衝保護膜を観察したところ、クラックはまったく認めら
れなかった。
なお、参考として第5図に本発明に用いるチッ素プラ
ズマ処理した応力緩衝保護膜を、Arで2分間スパッタリ
ングした表面のAESを示す。Si、C、Oのピークが第3
図のピークに近く、これよりチッ素プラズマ処理によっ
て表面のみ(0.15μm以下)がSiO2化することがわか
る。
ズマ処理した応力緩衝保護膜を、Arで2分間スパッタリ
ングした表面のAESを示す。Si、C、Oのピークが第3
図のピークに近く、これよりチッ素プラズマ処理によっ
て表面のみ(0.15μm以下)がSiO2化することがわか
る。
実施例1ではチッ素によるプラズマ処理を行なった
が、Ar、Neなどの不活性ガスのプラズマ、またはそれら
のイオン注入による処理であっても、またさらにそれら
のプラズマ発生方法は、RF、マイクロ波、ECR、いずれ
のばあいであっても上記実施例と同様の効果を奏する。
が、Ar、Neなどの不活性ガスのプラズマ、またはそれら
のイオン注入による処理であっても、またさらにそれら
のプラズマ発生方法は、RF、マイクロ波、ECR、いずれ
のばあいであっても上記実施例と同様の効果を奏する。
[発明の効果] 以上のように本発明の製造方法によれば応力緩衝保護
膜の材料を従来のポリイミド系材料に替えて梯子型シリ
コーンポリマーとし、さらに不活性ガスのプラズマ処理
またはイオン注入により応力緩衝保護膜の表面改質処理
を行なったので、ボンディングパッドなどを形成する工
程を簡略化できるという効果を奏する。
膜の材料を従来のポリイミド系材料に替えて梯子型シリ
コーンポリマーとし、さらに不活性ガスのプラズマ処理
またはイオン注入により応力緩衝保護膜の表面改質処理
を行なったので、ボンディングパッドなどを形成する工
程を簡略化できるという効果を奏する。
第1図は本発明の一実施例によるボンディングパッド形
成工程を示す半導体装置の断面図、第2図は従来のボン
ディングパッド形成工程を示す半導体装置の断面図、第
3図は応力緩衝保護膜表面のオージェ電子分光スペクト
ルを示すグラフ、第4図はチッ素プラズマ処理を行なっ
た応力緩衝保護膜表面のオージェ電子分光スペクトルを
示すグラフ、第5図はチッ素プラズマ処理を行なった応
力緩衝保護膜を2分間スパッタリングした表面のオージ
ェ電子分光スペクトルを示すグラフである。 (図面の符号) (1):シリコン基板 (2):アルミニウム配線 (3):ガラスコート膜 (4):レジスト (5):応力緩衝保護膜 (6):Siのピーク (7):Cのピーク (8):Oのピーク (9):Nのピーク
成工程を示す半導体装置の断面図、第2図は従来のボン
ディングパッド形成工程を示す半導体装置の断面図、第
3図は応力緩衝保護膜表面のオージェ電子分光スペクト
ルを示すグラフ、第4図はチッ素プラズマ処理を行なっ
た応力緩衝保護膜表面のオージェ電子分光スペクトルを
示すグラフ、第5図はチッ素プラズマ処理を行なった応
力緩衝保護膜を2分間スパッタリングした表面のオージ
ェ電子分光スペクトルを示すグラフである。 (図面の符号) (1):シリコン基板 (2):アルミニウム配線 (3):ガラスコート膜 (4):レジスト (5):応力緩衝保護膜 (6):Siのピーク (7):Cのピーク (8):Oのピーク (9):Nのピーク
───────────────────────────────────────────────────── フロントページの続き (72)発明者 岡橋 和郎 兵庫県尼崎市塚口本町8丁目1番1号 三菱電機株式会社生産技術研究所内 (56)参考文献 特開 昭62−290139(JP,A) 特開 昭56−125855(JP,A) 特開 昭62−1236(JP,A)
Claims (1)
- 【請求項1】アルミニウム配線された基板上にガラスコ
ート膜、さらに応力緩衝保護膜が設けられ、アルミニウ
ム配線にワイヤボンドするためのパッドを設けた半導体
装置を製造する際に、アルミニウム配線された基板上に
ガラスコート膜を設け、ついで応力緩衝保護膜として梯
子型シリコーンポリマーからなる膜を形成し、不活性ガ
スのプラズマ処理またはイオン注入による表面改質処理
を行ない、さらにレジスト膜の形成、パターニングを行
なったのち、応力緩衝保護膜のドライエッチングを行な
い、酸素プラズマでレジスト膜の除去を行なったのちガ
ラスコート膜を四フッ化炭素プラズマでドライエッチン
グを行なうことを特徴とする半導体装置の製造方法。
Priority Applications (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63011217A JP2503565B2 (ja) | 1988-01-21 | 1988-01-21 | 半導体装置の製造方法 |
| US07/298,950 US5023204A (en) | 1988-01-21 | 1989-01-19 | Method of manufacturing semiconductor device using silicone protective layer |
| KR1019890000609A KR920004517B1 (ko) | 1988-01-21 | 1989-01-20 | 실리콘계 보호막을 사용한 반도체 장치의 제조방법 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63011217A JP2503565B2 (ja) | 1988-01-21 | 1988-01-21 | 半導体装置の製造方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH01185924A JPH01185924A (ja) | 1989-07-25 |
| JP2503565B2 true JP2503565B2 (ja) | 1996-06-05 |
Family
ID=11771799
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63011217A Expired - Fee Related JP2503565B2 (ja) | 1988-01-21 | 1988-01-21 | 半導体装置の製造方法 |
Country Status (3)
| Country | Link |
|---|---|
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| US5157061A (en) * | 1988-04-05 | 1992-10-20 | Mitsubishi Denki Kabushiki Kaisha | Epoxy resin containing an epoxy resin-modified silicone oil flexibilizer |
| US5166771A (en) * | 1990-01-12 | 1992-11-24 | Paradigm Technology, Inc. | Self-aligning contact and interconnect structure |
| US5483104A (en) * | 1990-01-12 | 1996-01-09 | Paradigm Technology, Inc. | Self-aligning contact and interconnect structure |
| JPH04233732A (ja) * | 1990-08-16 | 1992-08-21 | Motorola Inc | 半導体の製造工程で使用するスピン・オン誘電体 |
| JPH04261049A (ja) * | 1991-01-31 | 1992-09-17 | Mitsubishi Electric Corp | 半導体装置およびその製造方法 |
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| US5086017A (en) * | 1991-03-21 | 1992-02-04 | Industrial Technology Research Institute | Self aligned silicide process for gate/runner without extra masking |
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| KR950009740B1 (ko) * | 1991-11-12 | 1995-08-26 | 금성일렉트론주식회사 | 메모리 캐패시터 제조방법 및 그 구조 |
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| US5600151A (en) * | 1995-02-13 | 1997-02-04 | Mitsubishi Denki Kabushiki Kaisha | Semiconductor device comprising a semiconductor substrate, an element formed thereon, and a stress-buffering film made of a silicone ladder resin |
| US5474956A (en) * | 1995-03-14 | 1995-12-12 | Hughes Aircraft Company | Method of fabricating metallized substrates using an organic etch block layer |
| JPH10330188A (ja) * | 1997-05-29 | 1998-12-15 | Kobe Steel Ltd | ダイヤモンドの微細加工方法 |
| DE69811296D1 (de) * | 1997-07-11 | 2003-03-20 | Bosch Gmbh Robert | Erhöhte Haftung der Unterseitenbeschichtung von Flip-Chips |
| KR100238991B1 (ko) * | 1997-09-11 | 2000-04-01 | 백전호 | 공기가 주입된 에어모자를 이용한 다용도 안전모자와 헬멧 |
| JP2001223269A (ja) * | 2000-02-10 | 2001-08-17 | Nec Corp | 半導体装置およびその製造方法 |
| KR100725364B1 (ko) * | 2005-09-06 | 2007-06-07 | 삼성전자주식회사 | 반도체 칩 패키지 및 그 제조 방법 |
| JP4357570B2 (ja) * | 2008-01-31 | 2009-11-04 | 株式会社東芝 | 磁気記録媒体の製造方法 |
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|---|---|---|---|---|
| JPS52127174A (en) * | 1976-04-19 | 1977-10-25 | Matsushita Electric Ind Co Ltd | Minute patern formation method |
| JPS56135928A (en) * | 1980-03-27 | 1981-10-23 | Fujitsu Ltd | Forming method for pattern of silicone resin |
| JPS60249326A (ja) * | 1984-05-25 | 1985-12-10 | Hitachi Ltd | パタ−ン形成方法 |
| JPS62247522A (ja) * | 1986-04-18 | 1987-10-28 | Fujitsu Ltd | 半導体装置の製造方法 |
| JPS62290139A (ja) * | 1986-06-09 | 1987-12-17 | Fujitsu Ltd | 耐熱樹脂組成物 |
| JPS6314432A (ja) * | 1986-07-07 | 1988-01-21 | Nippon Telegr & Teleph Corp <Ntt> | パタン形成方法 |
| JPS63107122A (ja) * | 1986-10-24 | 1988-05-12 | Fujitsu Ltd | 凹凸基板の平坦化方法 |
| JPS63120774A (ja) * | 1986-11-07 | 1988-05-25 | Mitsubishi Electric Corp | 高純度SiO2薄膜形成法 |
| JP2503565B2 (ja) * | 1988-01-21 | 1996-06-05 | 三菱電機株式会社 | 半導体装置の製造方法 |
| JPH01307227A (ja) * | 1988-06-06 | 1989-12-12 | Showa Denko Kk | 微細加工方法 |
| JPH029153A (ja) * | 1988-06-28 | 1990-01-12 | Fujitsu Ltd | 半導体基板の平坦化処理法 |
-
1988
- 1988-01-21 JP JP63011217A patent/JP2503565B2/ja not_active Expired - Fee Related
-
1989
- 1989-01-19 US US07/298,950 patent/US5023204A/en not_active Expired - Lifetime
- 1989-01-20 KR KR1019890000609A patent/KR920004517B1/ko not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| KR920004517B1 (ko) | 1992-06-08 |
| US5023204A (en) | 1991-06-11 |
| KR890012378A (ko) | 1989-08-26 |
| JPH01185924A (ja) | 1989-07-25 |
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