JPH0682641B2 - 半導体集積回路装置の製造方法 - Google Patents
半導体集積回路装置の製造方法Info
- Publication number
- JPH0682641B2 JPH0682641B2 JP60235731A JP23573185A JPH0682641B2 JP H0682641 B2 JPH0682641 B2 JP H0682641B2 JP 60235731 A JP60235731 A JP 60235731A JP 23573185 A JP23573185 A JP 23573185A JP H0682641 B2 JPH0682641 B2 JP H0682641B2
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- JP
- Japan
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- silicon
- semiconductor integrated
- circuit device
- polycrystalline silicon
- refractory metal
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Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、半導体集積回路装置の製造方法に関し、特
に、高融点金属シリサイド層を形成する方法に関する。
に、高融点金属シリサイド層を形成する方法に関する。
従来、シリコン半導体集積回路装置の、たとえば拡散層
領域のシリサイド化は、拡散層上の絶縁物を反応性ガス
を用いたドライエッチング法で除去した後、高融点金属
を被着し熱処理法等によりシリサイド層を形成してき
た。
領域のシリサイド化は、拡散層上の絶縁物を反応性ガス
を用いたドライエッチング法で除去した後、高融点金属
を被着し熱処理法等によりシリサイド層を形成してき
た。
上述した従来の高融点金属シリサイド層の形成方法は、
高融点金属被着前に反応性ガスによるドライエッチング
法で、シリサイド化される領域にダメージが与えられる
為にシリコン表面にシリサイド化しにくい層が形成さ
れ、均一なシリサイド層が出来ないという問題があっ
た。
高融点金属被着前に反応性ガスによるドライエッチング
法で、シリサイド化される領域にダメージが与えられる
為にシリコン表面にシリサイド化しにくい層が形成さ
れ、均一なシリサイド層が出来ないという問題があっ
た。
本発明の目的は、シリコン基板及び多結晶シリコン上に
均一なシリサイド層を形成する半導体集積回路装置の製
造方法を提供することにある。
均一なシリサイド層を形成する半導体集積回路装置の製
造方法を提供することにある。
〔問題点を解決するための手段〕 本発明の半導体集積回路装置の製造方法は、シリコン上
あるいは、多結晶シリコン上に高融点金属を被着し、熱
処理法等によりシリサイド層を形成する場合、高融点金
属被着する際Arプラズマ中で前記のシリコン基板あるい
は、多結晶シリコン表面をエッチングした後高融点金属
を被着することにより構成される。
あるいは、多結晶シリコン上に高融点金属を被着し、熱
処理法等によりシリサイド層を形成する場合、高融点金
属被着する際Arプラズマ中で前記のシリコン基板あるい
は、多結晶シリコン表面をエッチングした後高融点金属
を被着することにより構成される。
次に、本発明の実施例について図面を参照して説明す
る。第1図(a)〜(d)は本発明の一実施例を説明す
るために工程順に示した半導体素子の断面図である。
る。第1図(a)〜(d)は本発明の一実施例を説明す
るために工程順に示した半導体素子の断面図である。
まず、第1図(a)に示すように、シリコン半導体基板
10上にはゲート酸化膜11が形成され、ゲート酸化膜上に
はゲート多結晶シリコン12が形成されゲート多結晶シリ
コン電極を含む表面には気相成長絶縁膜13を被着する。
10上にはゲート酸化膜11が形成され、ゲート酸化膜上に
はゲート多結晶シリコン12が形成されゲート多結晶シリ
コン電極を含む表面には気相成長絶縁膜13を被着する。
次に、第1図(b)に示すように、反応性ガスを用いる
異方性ドライエッチングで気相成長絶縁膜13をエッチン
グし、ゲート電極である多結晶シリコン12の側面に側壁
13aを形成する。この際、反応性ガスを用いたエッチン
グによりソース・ドレインの拡散層上及びゲート電極12
の多結晶シリコン上にはダメージ層14及び14aが形成さ
れる。
異方性ドライエッチングで気相成長絶縁膜13をエッチン
グし、ゲート電極である多結晶シリコン12の側面に側壁
13aを形成する。この際、反応性ガスを用いたエッチン
グによりソース・ドレインの拡散層上及びゲート電極12
の多結晶シリコン上にはダメージ層14及び14aが形成さ
れる。
次に、Ar雰囲気中でエッチングを行ないダメージ層14及
び14aを除去し、ひき続きTi膜16等の高融点金属を被着
し、第1図(c)の状態とする。
び14aを除去し、ひき続きTi膜16等の高融点金属を被着
し、第1図(c)の状態とする。
次に、第1図(d)に示すように、不活性ガス雰囲気中
でシリサイド化を行ない、未反応Tiを除去して基板シリ
コン上及び多結晶シリコン上にシリサイド層17を形成す
る。
でシリサイド化を行ない、未反応Tiを除去して基板シリ
コン上及び多結晶シリコン上にシリサイド層17を形成す
る。
以上説明したように、本発明はシリサイド化法により、
シリコン基板及び多結晶シリコン上にシリサイド層を形
成する場合、基板シリコン上及び多結晶シリコン上に、
高融点金属を被着する直前に、Arプラズマ中で基板シリ
コン及び多結晶シリコン表面をエッチングし、前のエッ
チング時に生じたダメージ層を除去することにより均一
なシリサイド層を形成できる効果がある。
シリコン基板及び多結晶シリコン上にシリサイド層を形
成する場合、基板シリコン上及び多結晶シリコン上に、
高融点金属を被着する直前に、Arプラズマ中で基板シリ
コン及び多結晶シリコン表面をエッチングし、前のエッ
チング時に生じたダメージ層を除去することにより均一
なシリサイド層を形成できる効果がある。
第1図(a)〜(d)は、本発明の一実施例を説明する
ために工程順に示した半導体素子の断面図である。 10……シリコン半導体基板、11……ゲート酸化膜、12…
…ゲート多結晶シリコン電極、13……気相成長酸化膜、
14,14a……ダメージ層、15……Arプラズマ、16……Ti
膜、17……チタンシリサイド(TiSi2)層。
ために工程順に示した半導体素子の断面図である。 10……シリコン半導体基板、11……ゲート酸化膜、12…
…ゲート多結晶シリコン電極、13……気相成長酸化膜、
14,14a……ダメージ層、15……Arプラズマ、16……Ti
膜、17……チタンシリサイド(TiSi2)層。
Claims (1)
- 【請求項1】基板シリコンと多結晶シリコン上に高融点
金属を被着し熱処理法等により前記基板シリコン上ある
いは、多結晶シリコン上に前記高融点金属のシリサイド
層を形成する工程を有する半導体集積回路装置の製造方
法において、前記高融点金属を被着するに先立ちArプラ
ズマ中で前記基板シリコンと多結晶シリコン表面をエッ
チングすることを特徴とする半導体集積回路装置の製造
方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60235731A JPH0682641B2 (ja) | 1985-10-21 | 1985-10-21 | 半導体集積回路装置の製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60235731A JPH0682641B2 (ja) | 1985-10-21 | 1985-10-21 | 半導体集積回路装置の製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS6294937A JPS6294937A (ja) | 1987-05-01 |
JPH0682641B2 true JPH0682641B2 (ja) | 1994-10-19 |
Family
ID=16990393
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP60235731A Expired - Lifetime JPH0682641B2 (ja) | 1985-10-21 | 1985-10-21 | 半導体集積回路装置の製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0682641B2 (ja) |
Families Citing this family (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5407837A (en) * | 1992-08-31 | 1995-04-18 | Texas Instruments Incorporated | Method of making a thin film transistor |
JP3093620B2 (ja) * | 1995-10-19 | 2000-10-03 | 日本電気株式会社 | 半導体装置の製造方法 |
JP4101901B2 (ja) | 1997-04-25 | 2008-06-18 | シャープ株式会社 | 半導体装置の製造方法 |
Family Cites Families (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5768033A (en) * | 1980-10-16 | 1982-04-26 | Toshiba Corp | Manufacture of semiconductor device |
JPS57124477A (en) * | 1981-01-26 | 1982-08-03 | Toshiba Corp | Manufacture of semiconductor device |
JPS5818965A (ja) * | 1981-07-28 | 1983-02-03 | Toshiba Corp | 半導体装置の製造方法 |
JPS5799775A (en) * | 1980-12-12 | 1982-06-21 | Toshiba Corp | Manufacture of semiconductor device |
US4545116A (en) * | 1983-05-06 | 1985-10-08 | Texas Instruments Incorporated | Method of forming a titanium disilicide |
JPS6197839A (ja) * | 1984-10-18 | 1986-05-16 | Fujitsu Ltd | 半導体装置の製造方法 |
-
1985
- 1985-10-21 JP JP60235731A patent/JPH0682641B2/ja not_active Expired - Lifetime
Also Published As
Publication number | Publication date |
---|---|
JPS6294937A (ja) | 1987-05-01 |
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