JP2020533805A - 回路基板およびその製造方法 - Google Patents
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Abstract
Description
110:第1配線パターン
210:第2配線パターン
120:第1保護層
140:第2保護層
130:リードパターン
150:ダミーパターン
160:素子
170:連結部
Claims (16)
- 素子実装領域が定義されたベース基板と、
前記ベース基板の一面上に形成された第1配線パターンと、
前記ベース基板上に、前記素子実装領域の少なくとも一部を埋めるように形成されたダミーパターンと、
前記第1配線パターンと前記ダミーパターンを覆う第1保護層と、
前記第1保護層上に、前記素子実装領域に延びるリードパターンと、を含む、回路基板。 - 前記リードパターンは、前記素子実装領域内に素子が実装される接合部を含み、前記ダミーパターンは、前記接合部から外側方向に第1間隔だけ拡張された領域内に形成される、請求項1に記載の回路基板。
- 前記第1間隔は、0.1μm〜100μmである、請求項2に記載の回路基板。
- 前記ダミーパターンは、前記素子実装領域内の前記ベース基板の一面を露出させる露出穴と、
前記露出穴を囲む外郭部と、を含む、請求項1に記載の回路基板。 - 前記第1保護層を貫いて前記第1配線パターンを露出させる貫通穴と、
前記貫通穴を埋め、前記リードパターンと前記第1配線パターンを電気的に接続する連結配線とをさらに含む、請求項1に記載の回路基板。 - 前記第1保護層上に、前記リードパターンを覆うように形成される第2保護層をさらに含む、請求項1に記載の回路基板。
- 前記ダミーパターンは、前記第1配線パターンと連結されない、請求項1に記載の回路基板。
- 前記ベース基板の他面上に形成された第2配線パターンと、
前記ベース基板を貫いて前記第1配線パターンと前記第2配線パターンを電気的に接続するビアとをさらに含む、請求項1に記載の回路基板。 - 前記回路基板は、n層(nは2以上の自然数)で積層される、請求項1に記載の回路基板。
- 素子実装領域が定義されたベース基板を提供し、
前記ベース基板の一面上に第1配線パターンと、前記素子実装領域内にダミーパターンをそれぞれ形成し、
前記第1配線パターンとダミーパターンを覆うように第1保護層を形成し、
前記第1保護層上に前記素子実装領域から延びるリードパターンを形成することを含む、回路基板の製造方法。 - 前記リードパターンを形成することは、
前記第1保護層を貫いて前記第1配線パターンを露出させる貫通穴を形成し、
前記貫通穴を埋めるように連結配線を形成し、
前記連結配線の表面をメッキすることを含む、請求項10に記載の回路基板の製造方法。 - 前記連結配線と前記リードパターンを同時に形成することを含む、請求項11に記載の回路基板の製造方法。
- 前記第1保護層上に、前記リードパターンを覆うように第2保護層を形成することをさらに含む、請求項12に記載の回路基板の製造方法。
- 前記ベース基板を貫くビアホールを形成し、
前記ビアホールを埋めるビアを形成し、
前記ビアを介して前記第1配線パターンと電気的に接続される第2配線パターンを形成することをさらに含む、請求項10に記載の回路基板の製造方法。 - 前記第2保護層上に追加的なリードパターンと、前記追加的なリードパターンを覆う追加的な保護層を形成してn層(nは2以上の自然数)回路基板を形成することをさらに含む、請求項10に記載の回路基板の製造方法。
- 前記第1配線パターンまたは前記リードパターンと接続されるまた他の回路基板を接合してn層回路基板を形成することをさらに含む、請求項10に記載の回路基板の製造方法。
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