JP2000032745A - 電圧モ―ドフィ―ドバックバ―ストモ―ド回路 - Google Patents
電圧モ―ドフィ―ドバックバ―ストモ―ド回路Info
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Abstract
圧モードフィードバック切り換え調整回路を提供する。 【解決手段】 負荷電流が低い場合、切り換え調整器
は、固定最小非ゼロデューティサイクル発振器を用いて
パルス幅変調発振器を無効にし、切り換え発振器におけ
る電源スイッチに最小ONサイクルを提供する。これ
は、パルス幅変調器によって発生される、必要とされる
デューティサイクルをより低くする。パルス幅変調器
が、ゼロデューティサイクルを必要とする程低く駆動さ
れる場合、パルス幅変調器のデューティサイクルを受け
取っているデジタル論理は、切り換え調整器に対して、
バーストモードに入り、停止することを命令する。この
原理は、非変調切り換え調整器、または、少しの改変
で、同期切り換え調整器のいずれかに用いられ得る。加
えて、その原理は、ステップダウン構成およびステップ
アップ構成の双方に用いられ得る。
Description
る。特に、本発明は、切り換えモード調整器に関する。
公知の切り換え調整器は、典型的には電圧調整器として
用いられるが、それは、重負荷において、相当する線形
調整回路よりも高効率を示すためである。典型的な切り
換え調整器は、反復的に、電源切り換えを完全にオンに
し、次いで完全にオフにすることにより動作し、それに
より、インダクタを用いて最終的な電圧に平均されるパ
ルス幅変調信号を発生する。電源トランジスタドライブ
の切り換え特質に起因して、典型的な切り換えモード回
路の効率性は、負荷が減少するのに伴い低下する。それ
は、負荷にかかわらず、ドライブ回路において固定量の
電力が空費されるからである。軽負荷における、このよ
うな効率低下を回避するために用いられる方法の1つ
は、出力で流れる電流を感知し、軽負荷の場合に切り換
え周期を削除する。本明細書中、これは、Burst
ModeTMと称される。言い換えると、バーストモード
は、切り換え調整器における切り換え損失を低減するた
めにサイクルスキップの技術を用いて、且つ低出力電流
レベルにおいて動作効率を増加する、動作のモードであ
る。
流フィードバック調整器における実行が比較的容易であ
る。それは、調整器には出力電流信号が利用可能であ
り、それにより、いつ負荷が軽度であるかを調整器が決
定することが可能になるためである。典型的な電圧フィ
ードバック切り換え調整器には、この負荷電流信号は利
用可能でなく、バーストモードに入る決定を別の方法に
よって行わなければならない。
ク切り換え調整器が自動的にバーストモードに出入りす
ることを可能にする、回路および方法を提供することが
好ましい。
調整回路の同期トポロジーおよび非同期トポロジーの双
方について、電圧モードフィードバック切り換え調整器
が自動的にバーストモードに出入りすることを可能にす
る、技術を提供することが好ましい。
整器は、入力および出力を有し、バーストモードに自動
的に出入りし得る非同期電圧モード切り換え調整器であ
って、デューティサイクルを有するスイッチ回路と、P
WM発振器と、固定最小非ゼロデューティサイクル発振
器と、入力と、出力とを含む、パルス幅変調器(PM
W)回路であって、該PMW回路の出力が該スイッチ回
路に接続され、該デューティサイクルが該PMW回路に
よって設定され、該切り換え調整器が、該PMW回路に
よって提供される信号に基づいてバーストモードに出入
りする、パルス幅変調回路と、該切り換え調整器の出力
と該PWM発振器の入力との間に接続され、該切り換え
調整器の該出力における電圧から得られるフィードバッ
ク信号を該PWM回路に提供する、フィードバック回路
とを含み、それにより上記目的が達成される。
前記切り換え調整器の入力に接続される第1の端部と、
第2の端部とを有する、切り換え素子と、該切り換え素
子の該第2の端部と、該切り換え調整器の前記出力との
間に接続された、インダクタと、該切り換え素子の該第
2の端部とアースとの間に接続された、ダイオードと、
該切り換え調整器の該出力と、アースとの間に接続され
た、出力キャパシタと、を含んでもよい。
前記フィードバック回路に接続された第1の入力と、第
2の入力と、出力とを含み、前記固定最小非ゼロデュー
ティサイクル発振器が、入力と出力とを含み、該PWM
発振器がさらに、該PWM発振器の該第2の入力に接続
された第1の出力と、該固定最小非ゼロデューティサイ
クル発振器の入力に接続された第2の出力と、第3の出
力とを有する、マスタクロックと、該PWM発振器の前
記出力に接続された第1の入力と、該固定最小非ゼロデ
ューティサイクル発振器の出力に接続された第2の入力
と、該マスタクロックの該第3の出力に接続された第3
の入力と、前記スイッチング回路に接続された出力とを
有する、論理回路とを含んでもよい。
PWM発振器の前記出力に接続されたD入力と、前記第
3のクロック出力に接続されたクロック入力と、Q出力
とを有する、バーストフリップフロップと、該PWM発
振器の該出力に接続された第1の入力と、前記固定最小
非ゼロデューティサイクル発振器の前記出力に接続され
た第2の入力と、出力とを有する、ORゲートと、該O
Rゲートの該出力に接続された第1の入力と、該バース
トフリップフロップの該Q出力に接続された第2の入力
と、前記スイッチ回路の前記デューティサイクルを設定
するために該スイッチ回路に接続された出力とを有す
る、ANDゲートとを含んでもよい。
路が、基準電圧に接続された正の端子と、前記切り換え
調整器の前記出力に接続された負の端子と、前記PWM
回路の前記入力に接続された出力端子とを有する、フィ
ードバック増幅器を含んでもよい。
器は、入力と出力とを有する同期電圧モード切り換え調
整器であって、自動的にバーストモードに出入りするこ
とが可能な切り換え調整器が、第1のデューティサイク
ルと第2のデューティサイクルとを有するスイッチ回路
であって、該第2のデューティサイクルは該第1のデュ
ーティサイクルと実質的に位相ずれしているスイッチ回
路と、パルス幅変調器(PWM)回路であって、PWM
発振器と、固定最小非ゼロデューティサイクル発振器
と、入力と、出力とを有し、該PWM回路の前記出力は
該スイッチ回路に接続され、該第1のデューティサイク
ルは該PWM回路によって設定され、該第2のデューテ
ィサイクルは該PWM回路によって部分的に設定され、
該切り換え調整器は、該PWM回路によって提供される
信号に基づいてバーストモードに出入りする、PWM回
路と、該切り換え調整器の該出力と該PWM回路の該入
力との間に接続され、該切り換え調整器の該出力におけ
る電圧から引き出されるフィードバック信号を該PWM
回路に提供するフィードバック回路とを備え、それによ
り上記目的が達成される。
イッチ回路が、第1の端部と第2の端部とを有する第1
の切り換え素子であって、該第1の端部は前記切り換え
調整器の前記入力に接続され、該第1の切り換え素子が
前記PWM回路によって供給される前記第1のデューテ
ィサイクルに応答して開閉するように、該PWM回路に
接続される第1の切り換え素子と、該第1の切り換え素
子の該第2の端部と該切り換え調整器の前記出力との間
に接続されるインダクタと、該PWM回路の前記出力と
該第1の切り換え素子の該第2の端部との間に接続され
る第2の切り換え素子であって、前記第2のデューティ
サイクルに応答して部分的に開閉する第2の切り換え素
子と、該切り換え調整器の該出力とアースとの間に接続
される出力キャパシタとを備えてもよい。
2の切り換え素子が、負の端子と正の端子と出力端子と
を有する比較器であって、該正の端子は前記第1の切り
換え素子の前記第2の端部に接続され、該負の端子はア
ースに接続される、比較器と、該比較器の該出力端子に
接続される入力と、出力とを有する立ち上がりエッジ検
出器と、R入力とS入力とQ出力とを有するRSラッチ
フリップフロップであって、該S入力は該立ち上がりエ
ッジ検出器の該出力に接続され、該R入力は前記PWM
回路の前記出力に接続される、RSラッチフリップフロ
ップと、第1の入力と第2の入力と出力とを有するNO
Rゲートであって、該第1の入力は該PWM回路の該出
力に接続され、該第2の入力は該RSラッチフリップフ
ロップの該Q出力に接続され、そして該NORゲートの
該出力は該第2の切り換え素子に接続され、これにより
該NORゲートは該第2の切り換え素子のために前記デ
ューティサイクルを提供する、NORゲートとを備えて
もよい。
2の切り換え素子が、該第2の切り換え素子の前記第2
の端部とアースとの間に接続される抵抗素子と、負の端
子と正の端子と出力端子とを有する比較器であって、該
正の端子は前記第1の切り換え素子の前記第1の端部に
接続され、該負の端子はアースに接続される、比較器
と、該比較器の該出力端子に接続される入力と、出力と
を有する立ち上がりエッジ検出器と、R入力とS入力と
Q出力とを有するRSラッチフリップフロップであっ
て、該S入力は該立ち上がりエッジ検出器の該出力に接
続され、該R入力は前記PWM回路の前記出力に接続さ
れる、RSラッチフリップフロップと、第1の入力と第
2の入力と出力とを有するNORゲートであって、該第
1の入力は該PWM回路の該出力に接続され、該第2の
入力は該RSラッチフリップフロップの該Q出力に接続
され、そして該NORゲートの該出力は該第2の切り換
え素子に接続され、これにより該NORゲートの該出力
は該第2の切り換え素子を開閉する、NORゲートとを
備えてもよい。
2の切り換え素子が、該第2の切り換え素子の前記第2
の端部とアースとの間に接続される抵抗素子と、負の端
子と正の端子と出力端子とを有する比較器であって、該
正の端子は該第2の切り換え素子の該第2の端部に接続
され、該負の端子はアースに接続される、比較器と、該
比較器の該出力端子に接続される入力と、出力とを有す
る立ち上がりエッジ検出器と、R入力とS入力とQ出力
とを有するRSラッチフリップフロップであって、該S
入力は該立ち上がりエッジ検出器の該出力に接続され、
該R入力は前記PWM回路の前記出力に接続される、R
Sラッチフリップフロップと、第1の入力と第2の入力
と出力とを有するNORゲートであって、該第1の入力
は該PWM回路の該出力に接続され、該第2の入力は該
RSラッチフリップフロップの該Q出力に接続され、そ
して該NORゲートの該出力は該第2の切り換え素子に
接続され、これにより該NORゲートの該出力は該第2
の切り換え素子を開閉する、NORゲートとを備えても
よい。
WM発振器が、前記フィードバック回路に接続される第
1の入力と、第2の入力と、出力とを備え、前記固定最
小非ゼロデューティサイクル発振器は入力と出力とを備
え、そして、前記PWM回路は、入力と出力とを有する
固定最小非ゼロデューティサイクル発振器と、該PWM
発振器の該第2の入力に接続される第1の出力と、該固
定最小非ゼロデューティサイクル発振器の該入力に接続
される第2の出力と、前記バーストフリップフロップの
前記クロック入力に接続される第3の出力とを有するマ
スタークロックと、該PWM発振器の該出力に接続され
る第1の入力と、該固定最小非ゼロデューティサイクル
発振器の該出力に接続される第2の入力と、前記マスタ
ークロックの該第3の出力に接続される第3の入力と、
前記スイッチ回路に接続される出力とを有する論理回路
とをさらに備えてもよい。
理回路が、前記PWM発振器の前記出力に接続されるD
入力と、クロック入力と、Q出力とを有するバーストフ
リップフロップと、該PWM発振器の前記第2の入力に
接続される第1の出力と、前記固定最小非ゼロデューテ
ィサイクル発振器の前記入力に接続される第2の出力
と、前記バーストフリップフロップの前記クロック入力
に接続される第3の出力とを有するマスタークロック
と、該PWM発振器の該出力に接続される第1の入力
と、該固定最小非ゼロデューティサイクル発振器の前記
出力に接続される第2の入力と、出力とを有するORゲ
ートと、該ORゲートの該出力に接続される第1の入力
と、該バーストフリップフロックの該Q出力に接続され
る第2の入力と、前記スイッチ回路に接続される出力と
を有するANDゲートとを備えてもよい。
ィードバック回路が、基準電圧に接続される正の端子
と、前記切り換え調整器の前記出力に接続される負の端
子と、前記PWM回路に接続される出力端子とを有する
フィードバック増幅器を備えてもよい。
ード切り換え調整器は、入力と出力とを有する非同期ス
テップアップ電圧モード切り換え調整器であって、自動
的にバーストモードに出入りすることが可能な切り換え
調整器は、デューティサイクルを有するスイッチ回路
と、パルス幅変調器(PWM)回路であって、PWM発
振器と、固定最小非ゼロデューティサイクル発振器と、
入力と、出力とを有し、該PWM回路の該出力は該スイ
ッチ回路に接続され、該デューティサイクルは該PWM
回路によって設定され、該切り換え調整器は、該PWM
回路によって提供される信号に基づいてバーストモード
に出入りする、PWM回路と、該切り換え調整器の該出
力と該PWM回路の該入力との間に接続され、該切り換
え調整器の該出力において電圧に対応するフィードバッ
ク信号を該PWM回路に提供するフィードバック回路と
を備え、それにより上記目的が達成される。
調整器は、前記スイッチ回路が、該第1の端部と第2の
端部とを有するインダクタであって、該第1の端部は前
記切り換え調整器の前記入力に接続される、インダクタ
と、該インダクタの該第2の端部とアースとの間に接続
される切り換え素子と、該インダクタの該第2の端部と
該切り換え調整器の前記出力との間に接続されるダイオ
ードと、該切り換え調整器の該出力とアースとの間に接
続される出力キャパシタとを備えてもよい。
調整器は、前記PWM発振器が、前記フィードバック回
路に接続される第1の入力と、第2の入力と、出力とを
備え、前記固定最小非ゼロデューティサイクル発振器は
入力と出力とを備え、そして、前記PWM回路は、該P
WM発振器の該第2の入力に接続される第1の出力と、
該固定最小非ゼロデューティサイクル発振器の該入力に
接続される第2の出力と、第3の出力とを有するマスタ
ークロックと、該PWM発振器の該出力に接続される第
1の入力と、該固定最小非ゼロデューティサイクル発振
器の該出力に接続される第2の入力と、前記マスターク
ロックの前記第3の出力に接続される第3の入力と、前
記スイッチ回路に接続される出力とを有する論理回路と
を備えてもよい。
調整器は、前記論理回路が、前記PWM発振器の前記出
力に接続されるD入力と、前記第3のクロック出力に接
続されるクロック入力と、Q出力とを有するバーストフ
リップフロップと、該PWM発振器の該出力に接続され
る第1の入力と、前記該固定最小非ゼロデューティサイ
クル発振器の前記出力に接続される第2の入力と、出力
とを有するORゲートと、ANDゲートであって、該O
Rゲートの該出力に接続される第1の入力と、該バース
トフリップフロップの該Q出力に接続される第2の入力
と、該ANDゲートが前記スイッチ回路のための前記第
1のデューティサイクルを設定するように該スイッチ回
路に接続される出力とを有するANDゲートとを備えて
もよい。
調整器は、前記フィードバック回路が、基準電圧に接続
される正の端子と、前記切り換え調整器の前記出力に接
続される負の端子と、前記PWM回路の入力に接続され
る出力端子とを有するフィードバック増幅器を備えても
よい。
び出力を有し、バーストモードに自動的に出入りし得る
同期セットアップ電圧モード切り換え調整器であって、
該切り換え調整器の該入力に接続された第1の端部と、
第2の端部とを有する、インダクタと、第1のデューテ
ィサイクルを有し、該インダクタの該第2の端部とアー
スとの間に接続された、第1の電源スイッチと、該イン
ダクタの該第2の端部に接続された第1の端部と、該切
り換え調整器の該出力に接続された第2の端部とを有
し、第2のデューティサイクルを有する、第2の電源ス
イッチと、該切り換え調整器の該出力に接続された正の
端子と、該インダクタの該第2の端部に接続された負の
端子と、出力とを有する、比較器と、該比較器の該出力
端子に接続された入力と、出力とを有する、立ち上がり
エッジ検出器と、前記PWM回路の前記出力に接続され
たR入力と、該立ち上がりエッジ検出器の該出力に接続
されたS入力と、Q入力とを有する、ラッチフリップフ
ロップと、該ラッチフリップフロップの該Q入力に接続
された第1の入力と、第2の入力と、該第2の電源スイ
ッチに第2のデューティサイクルを提供するために該第
2の電源スイッチに接続された出力とを有する、NOR
ゲートと、該切り換え調整器の該出力とアースとの間に
接続されたキャパシタと、基準電圧に接続された正の端
子と、該切り換え調整器の該出力に接続された負の端子
と、出力端子とを有する、フィードバック増幅器と、該
フィードバック増幅器の該出力端子に接続された第1の
入力と、第2の入力と、出力とを有する、PWM発振器
と、入力と、出力とを有する、固定最小非ゼロデューテ
ィサイクル発振器と、該PWM発振器の該出力に接続さ
れたD入力と、クロック入力と、Q出力とを有する、バ
ーストフリップフロップと、該PWM発振器の該第2の
入力に接続された第1の出力と、該固定最小非ゼロデュ
ーティサイクル発振器の該入力に接続された第2の出力
と、該バーストフリップフロップの該クロック入力に接
続された第3の出力とを有する、マスタクロックと、該
PWM発振器の該出力に接続された第1の入力と、該固
定最小非ゼロデューティサイクル発振器の該出力に接続
された第2の入力と、出力とを有する、ORゲートと、
該ORゲートの該出力に接続された第1の入力と、該バ
ーストフリップフロップの該Q出力に接続された第2の
入力と、該ラッチフリップフロップの該R入力と該NO
Rゲートの該第2の入力に接続され、且つ前記スイッチ
回路の前記デューティサイクルを設定するために該第1
の電源スイッチに接続された出力とを有する、ANDゲ
ートとを含み、それにより上記目的が達成される。
ィードバック切り換え調整回路を提供することにある。
回路は、同期または非同期形態で動作し得、且つ軽微な
改変によって、セットアップまたはセットダウン構成に
おいて動作し得る。回路は、設定し得るデューティサイ
クルを有するスイッチ回路、パルス幅変調器および固定
最小非ゼロデューティサイクル発振器を有し、スイッチ
回路のデューティサイクルを設定し、且つスイッチ回路
がバーストモードに入るべきかどうかを決定するバース
トモード回路、および、スイッチ回路から信号を受け取
り、バーストモード回路に信号のフィードバックを提供
する、フィードバック回路を提供する。回路は、セット
であり得るデューティサイクルを有するスイッチ回路、
パルス幅変調器および固定最小非ゼロデューティサイク
ル発振器を有するバーストモード、スイッチ回路のデュ
ーティサイクルの設定およびスイッチ回路がバーストモ
ードに含まれるかどうかを決定を実装するバーストモー
ド、ならびにスイッチ回路から信号を受け取り、フィー
ドバック信号をバーストモード回路に提供するフィード
バック回路を提供する。
は、添付の図面に関連して、以下の詳細な説明を考慮す
ることにより明らかになる。図面中、同一の参照符号は
同一の部分を表す。
電圧に比例する出力電圧を生成し、比例度は電源スイッ
チにおけるパルス幅信号のデューティサイクルにより設
定される。電圧フィードバック切り換え調整器は、出力
電圧を感知し、出力電圧の変化により必要とされる切り
換え調整器のデューティサイクルを設定することにより
動作する。切り換え調整器の出力電圧は、負荷により必
要とされる電流に反比例する。当業者には公知であるよ
うに、負荷により、より大きな電流が必要とされると
き、負荷の電流に対する要件を満たすために、デューテ
ィスイッチがオン位置のままにされる時間が延長され
る。
電流を直接感知することなく出力電圧レベルを感知する
ことにより低出力電流レベルでバーストモードに入るこ
とを可能にする。本発明は、僅かな改変をするだけで非
同期および同期変換器の両方に適用され得る。
ク切り換え調整器は、自動バーストモードを組み込むよ
うに適合され得る。自動バーストモードは、軽負荷電流
で切り換え調整器の効率を向上させる。さらに、切り換
え調整器のデューティサイクルを決定し且つバーストモ
ード内の回路に送信する感知機構は、負荷電流経路に追
加のコンポーネントを加えることなく動作する。
原理によって設計された切り換え調整器は好適には、出
力負荷の近似値を獲得する固定最小非ゼロ信号発振器を
組み込むことにより、負荷電流が所定のあるレベルより
も低くなったときに、切り換え調整器がバーストモード
に入るようになっている。この信号は、後述するように
デューティサイクルを制御するパルス幅変調器(PW
M)信号と直列状態で動作する。PWM信号は、切り換
え調整器の分野で公知であるように、出力電圧に反比例
する。
電源スイッチと、上記ノードからアースまでのダイオー
ドとを含む。インダクタが、上記ノードから出力へ接続
され、キャパシタは典型的には出力ノードかアースへ接
続されている。フィードバック増幅器は、出力ノードに
おける電圧を感知し、パルス幅変調器(PWM)回路に
対して、電源スイッチに従って駆動信号のデューティサ
イクルを調整するように指示する。スイッチ制御ライン
の論理HIGH状態はスイッチをオンにし、論理LOW
状態はスイッチをオフにする。
に電源スイッチが電流を導電し、その他の期間はダイオ
ードが電流を導電する。電源スイッチが導電している
間、インダクタ内の電流は、線形に増加し、電源スイッ
チが導電を停止する直前に正のピークに達する。ダイオ
ードが導電している間、インダクタ内の電流は、線形に
減少し、ダイオードが導電を停止する直前に最小値に達
する。それにより、当該分野で公知であるように、イン
ダクタ内のピークトゥピークリプル電流の平均値が負荷
電流と等しくなる。負荷電流が降下すると、回路は、負
荷電流がインダクタ内のピークトゥピークリプル電流の
半分未満にまで降下する点に達する。これが起こると、
インダクタ内を流れる電流は、サイクルの一部期間中反
転する。
ード(ダイオード、スイッチおよびインダクタが合う位
置)における電圧がアースよりも高くなり、ダイオード
を介する導電は停止する。そのため、回路は不連続導電
状態になり、従って、ダイオードが導電する時間が短縮
される。ダイオードの導電する時間の短縮は、出力電圧
を増加させ得る。なぜなら、出力電圧は電源スイッチお
よびダイオードの導電する時間により設定されるからで
ある。出力電圧を一定に保持するために、フィードバッ
ク増幅器が、ダイオードの導電する時間の短縮に比例し
て電源スイッチのONの時間を短縮させるようにPWM
回路に命じる。
り換え調整器において、PWM発振器は好適には、スイ
ッチ用のデューティサイクルを生成する。ここで、スイ
ッチは好適にはMOSFETトランジスタから形成され
得るが、任意の適切な切り換え半導体でも動作し、その
結果、デューティサイクルは出力電圧に反比例する。例
えば、負荷により要求される出力電流が低いとき、出力
電圧は調整されたレベルより高く上昇し、フィードバッ
ク機構はデューティサイクルを下げる。しかし、デュー
ティサイクルは所定のレベル未満には下がらない。なぜ
なら、固定最小非ゼロデューティ信号発振器が、デュー
ティサイクルが所定のレベル未満まで下がることを防止
するからである。そのため、デューティサイクルは人工
的に高いレベルに保持される。
求よりも多い電流を供給されていることを連絡し、さら
にデューティサイクルを低下するよう試みる。負荷に対
するこの電流の過剰供給は、固定最小非ゼロデューティ
信号発振器によって生成される信号から生じる。このプ
ロセスは、フィードバック機構が最終的にパルス幅変調
発振器にゼロ信号が要求されることを指示するまで、す
なわち、フィードバック増幅器がスイッチにオフ状態で
デューティサイクルを開始するように命令するまで、続
く。オフ、すなわちゼロ信号が、デューティサイクルの
開始時にPWM発振器によって生成される場合、デジタ
ル論理は、切り換え調整器をバーストモードに送信する
ように合図される。バーストモードは、最小非ゼロデュ
ーティサイクルおよびノーマルデューティサイクルを不
可にし、切り換え調整器は、シャットオフする。このオ
フ状態は、フィートバック機構がデューティサイクルの
開始時にPWM発振器からオン状態を要求するほど十分
に出力電圧が降下するまで続く。次に、PWM発振器
は、デューティサイクルの始めにオンにされる。その
後、デジタル論理は、PWM発振器がもはやゼロ出力を
要求していないことを通知され、切り換え調整器は再起
動される。この動作は、総合的には、バーストモード期
間中の電力を節約することになる。なぜならば、切り換
え調整器が、出力電流がPWM回路にデューティサイク
ルを再開するように要求するまでシャットダウンするこ
とができるからである。
電圧モード切り換え調整器と同様の方法でバーストモー
ドに入るように改変され得る。同期の場合は、ダイオー
ドが、第1電源スイッチからずれた位相で駆動される第
2電源スイッチと置き換えられるという点で非同期の場
合と異なる。
点は、低電力消費である。一般に、第2電源スイッチで
の電力散逸は、ダイオードでの電力散逸より実質的に低
い。スイッチは(好ましくはMOSFETトランジスタ
によって形成され得る)、そのON抵抗とそこを流れる
電流との積に比例して電圧降下するからである。この値
は、導電時のダイオードでの一般的な700ミリボルト
の電圧降下よりも一般に低い。
と異なり、同期の場合における第2電源スイッチは、い
ずれかの方向に導電し、インダクタ電流が逆転するとき
も導電を停止しない。したがって、負荷電流が低下する
とき、2つのスイッチ間の導電時間率は一定を維持し、
出力電圧は一定を維持し、そしてPWM回路はバースト
モードに決して入らない。したがって、同期切り換え調
整器は、バーストモードに入るためのおよびバーストモ
ードから出るためのさらなる構成要素が必要である。
するためには、さらなるループに、インダクタ電流が逆
転されたことを感知し、そして第2電源スイッチをオフ
することが必要とされる。これにより、ループは非同期
の場合にダイオードのように動作する。これは、第2電
源スイッチと直列の抵抗素子での電圧降下を検出するこ
とによってなされる。比較器は、この電圧降下の測定に
適している。上述のようにスイッチの導電時の電圧降下
が測定可能なので、抵抗素子はスイッチ自身であること
が好ましい。抵抗素子での電圧の符号が、インダクタ電
流が逆転したことを示す場合、第2電源スイッチはシャ
ットオフされる。
ンス(parasitic capacitance)
を有する回路には、望ましくないリンギングが生じる。
本発明により構成された切り換え調整器においては、一
旦第2電源スイッチがシャットオフすると、リンギング
が生じることがある。このリンギングは、抵抗素子での
符号に影響を及ぼすことがあり、第2電源スイッチに望
ましくないやり方でオンオフの切り換えを繰り返し起こ
させる。以下に説明されるように、さらなる回路を追加
し、回路のリンギングによって起こる第2電源スイッチ
のサイクルを避けることが好ましい。
いて周知であるように、非同期電圧モード切り換え調整
器システム100は一般に、入力とノード104との間
の第1電源スイッチ102、ノード104とアースとの
間に接続されたダイオード106、ノード104と出力
ノード114との間に接続されたインダクタ108、お
よび出力ノード114とアースとの間に接続されたキャ
パシタ110から構成される。フィードバック増幅器1
12は、出力ノード114で電圧を感知し、この電圧を
基準電圧と比較し、そして好ましくは、負荷電流が要求
するときにPWM回路120に第1電源スイッチ102
に対する駆動信号のデューティサイクルを調整するよう
に指示する。PWM発振器122は、マスタークロック
124によってデューティサイクルを開始するようにト
リガされる。スイッチ制御線のHIGH論理状態は、第
1電源スイッチ102をオンにし、LOW論理状態はオ
フにする(PWM発振器122と第1電力スイッチ10
2との接続点における点線を参照のこと)。
2は、オン状態のとき、電流を導電し、ダイオード10
6は、実質的に残りの時間、電流を導電する。負荷電流
が低下すると、回路は、負荷電流がインダクタ108に
おけるピークツーピークリプル電流の半分未満に低下す
る点に到達する。これが発生すると、インダクタ108
中を流れる電流は、デューティサイクルの途中で逆転す
る。インダクタ電流が逆方向にするとすぐに、ノード1
04の電圧はグランドを上回って上昇し、ダイオード1
06の導電は停止する。出力ノード114の出力電圧
は、ダイオード106の導電時間に対する第1電源スイ
ッチ102の導電時間の比によって設定される入力電圧
と比例するので、回路が不連続導電状態に入ると、ダイ
オード106は、次のサイクルが始まる前に導電を停止
し、ダイオード106が導電する時間は減少する。従っ
て、出力電圧を一定に保つためには、フィードバック増
幅器112は、パルス幅変調回路120に、それに応じ
て第1電源スイッチ102のオン時間を減少させるよう
に命令する。
ように、電圧モード非同期切り換え調整器200は、本
発明の原理を用いて、自動的にバーストモードに入り得
る。非同期の場合、回路は、バーストモードに入るため
に、上記の変化するデューティサイクルを指標として用
い得る。図2は、本発明の原理に従ってこれを成し遂げ
るための回路を示す。
停止するように命令されない限り、少なくとも所定の最
小値のデューティーサイクルを発生する。負荷電流が低
下し、フィードバック増幅器112が所定値よりも低い
デューティサイクルを要求する場合、PWM回路220
は、固定最小非ゼロデューティサイクル発振器226に
よって設定される最小値で応答する。第1電源スイッチ
102によって供給されている過剰な電流によって、出
力ノード114の電圧は上昇し、フィードバック増幅器
112は、第1電源スイッチ102からのさらに短いオ
ン時間を要求する。フィードバック増幅器112は、ゼ
ロデューティサイクルを要求し、出力電圧を下げるま
で、さらに低いデューティサイクルを要求するように迅
速に調整する。PWM回路220はこの状態を認識す
る。なぜなら、論理回路222の一部として提供される
バーストフリップフロップFF1 228の入力は、P
WM発振器122の出力に接続され、それによって、各
マスタークロックサイクルの開始時にPWM発振器12
2の出力を受けるからである。マスタークロック124
は、すべての内部構成要素に対してタイミングサイクル
を開始する。フィードバック増幅器112が非ゼロデュ
ーティサイクルを要求する場合、PWM発振器226の
出力は、サイクルの開始時に論理HIGHとなる。サイ
クルが開始したときPWM発振器226の出力が論理L
OWである場合、回路は、フィードバック増幅器112
がゼロデューティサイクルに命令していると想定し、バ
ーストフリップフロップFF1 228におけるLOW
値を保持する。次に、バーストフリップフロップFF1
228の出力は、論理LOWをANDゲート232に
送信することによって、第1電源スイッチ102への駆
動を使用不能にする。ANDゲート232は、固定最小
非ゼロデューティサイクル発振器226から第1電源ス
イッチ102への信号経路を阻止し、切り換え調整器2
00をバーストモードに入れる。
は、バーストフリップフロップFF1228からのこの
信号が、さらなる効率の向上を実現するためにバースト
モードにおいて使用されない、調整回路200の使用さ
れない部分のパワーを落とすために用いられ得る。バー
ストフリップフロップFF1 228からのこの信号
を、バーストモード中の出力電流限定回路のパワーを落
とすために用いることは、この原理の1つの適切な実施
態様である。なぜなら、バーストモードでは、一般に、
過剰電流の状態がないからである。
出力ノード114における出力電圧は、フィードバック
増幅器112が再び出力パルスを要求し始める点まで低
下する。パルス幅変調回路220は、マスタークロック
サイクルの開始時に、PWM発振器122からの信号の
存在に留意することによってこの状態を検出する。この
信号は、バーストフリップフロップFF1 228にお
いて論理HIGHとして記憶され、第1電源スイッチ1
02への駆動を再開し、第1電源スイッチ102は、信
号を受信してパルスを発生し始める。負荷電流が低いま
まであると、出力ノード114の電圧は、フィードバッ
ク増幅器112がゼロパルス幅を要求する点まで急速に
増加し、バーストサイクルは繰り返される。
に示すように、同期切り換え調整回路300は、非同期
の場合とは異なる。なぜなら、図1および図2に示すダ
イオード106の代わりに、第2電源スイッチ304が
用いられ、第1電源スイッチ102から位相外(out
−of−phase)駆動されるからである。
ケンスを介して、第1の電源スイッチ102がオフされ
るのと実質的に同時にオンされる。まず、第1の電源ス
イッチ102がオンされると、RSラッチフリップフロ
ップ(FF2)232のR入力は高である。しかし比較
器308および立ち上がりエッジ検出器303の構成の
ために、FF2 302のS入力は低である。つまり、
比較器308が、第1の電源スイッチ102がオンであ
る場合に発生するノード104とアースとの間の正電圧
を記録する限り、比較器308は一定の高信号を立ち上
がりエッジ検出器303に送信する。次に、立ち上がり
エッジ検出器303は低信号をFF2302のS入力に
送信する。(図11の立ち上がりエッジ検出器の状態表
を参照。この表は、立ち上がりエッジ検出器303への
連続する高入力が、低信号を出力することを示してい
る。立ち上がりエッジ検出器303の構造を図10に示
す。立ち上がりエッジ検出器は、その出力において短い
正パルスでの入力における正の遷移に応答する回路であ
る。この構造は、3つのインバータ312からの僅かな
伝搬遅延のために、立ち上がりエッジ検出器が正の遷移
上にのみ高出力を送信することを示している。当業者に
公知のように、この3つのインバータからの伝搬遅延の
ために、ANDゲート314は一時的に両方の入力を正
の遷移上に高の状態で有するので、ANDゲート314
の端部において一時的に高出力となる。従って、インバ
ータのいずれかが低信号を生成するか、またはVinへ
の接続が低信号を生成するので、他の全ての条件下の出
力は、図11の状態表に示すように、論理低である。立
ち上がりエッジ検出器303のタイミングの微調整は、
キャパシタを適切な位置に配置することによって達成さ
れ得る。)従ってFF2302のQ出力は、高R入力お
よび低S入力を有するので(図4のFF2についての状
態表を参照)、低である。第1の電源スイッチ102が
オフされると、FF2 302のR入力は低になり、N
ORゲート306の入力の1つは低になる。低になるF
F2 302のR入力はFF2 302のQ出力に影響
しない。FF2 302のQ出力は前の状態を保持する
ので、低のままである(図4の状態表の第2の状態を参
照)。従って、NORゲート306の入力は両方とも低
であり、NORゲート306の出力は高になり、第2の
電源スイッチ304をオンする。
なり、第2の電源スイッチ304はいずれかの方向に導
電し得、インダクタ電流が逆転する場合に導電し続け得
る。負荷電流が落下すると、第1の電源スイッチ102
と第2の電源スイッチとの間の導電時間比は一定のまま
であり、出力電圧は一定のままであり、PWM回路22
0は修正されない状態であり、バーストモードに入らな
い。
ドに入れるために、インダクタ電流が逆転した場合に、
追加的なループが感知し、従って、第2の電源スイッチ
304をオフする必要があり、それにより、非同期の場
合に、第2の電源スイッチ304をダイオード106の
ように振る舞わさせる。所定の環境下で、バーストモー
ドは、オフである両方のスイッチに対応する図4および
図5の状態表における第3の状態によって示され得る。
この状態の間にフィードバックメカニズム112がPW
M発振器122によって発生されたデューティサイクル
の開始時にゼロ出力を要求する場合に、この状態はバー
ストモードに対応し、効果的に第1の電源スイッチ10
2を使用不能にする。
象を介して発生し得る。第1の電源スイッチ102がオ
フ位置に入るか、または「開放」される。従って、イン
ダクタ内の電流は一時的に変化し得ず、結果的に、ノー
ド104における電圧は負に遷移し始める。しかしその
電圧は、第2の電源スイッチ304によってアースより
も僅かに低い電圧に維持される。(オン位置にある場合
に、第2の電源スイッチ304は実質的にノード104
をアースに結合する)第2の電源スイッチ304は、上
述のように、開放するまたはオフにする第1の電源スイ
ッチ102と実質的に同時にオンになる。
インダクタ108に格納された電流を実質的に散逸させ
た後に、比較器308によって測定された第2の電源ス
イッチ304が正に転換するのに引き続いて、電圧がノ
ード104から抵抗素子610(図6参照)を渡って落
下する。比較器308は、抵抗素子610およびスイッ
チ304を渡って電圧降下(図6の切り換え調整器60
0に図示)か、もしくは抵抗素子710のみを渡って電
圧降下(図7の切り換え調整器700に図示)のいずれ
かを測定し得る。この抵抗素子は好適には第2の電源ス
イッチ304自体(図3)であり得る。なぜなら、第2
の電源スイッチ304を渡る比較的小さな電圧降下によ
って所定の電流が散逸され、結果的に、第2の電源スイ
ッチ304が抵抗素子として機能するからである。後者
では、比較器308は、直接第2の電源スイッチ304
を渡る電圧降下を測定する。
形態の第2の電源スイッチ304において正になる場
合、インダクタ電流は逆転したものとみなされる。比較
器308が高信号を立ち上がりエッジ検出器303に送
信するので、第2の電源スイッチ304を渡る正の電圧
は、結果的に、第2の電源スイッチ304をシャットオ
フする。
ッジで、立ち上がりエッジ検出器303は、高信号をR
SラッチフリップフロップFF2 302のS入力に送
信する。これによって、S入力は、図11の状態表の第
4状態に示すように高くなり、RSラッチフリップフロ
ップFF2 302のQ出力を立ち上げる。RSラッチ
フリップフロップFF2 302のQ出力におけるこの
高信号は、NORゲート306の入力の1つに高信号を
送信し、図5の状態表の第3状態に示すように、NOR
ゲート306の出力を低下させる。回路がバーストモー
ドになく、またバーストモードに入らない場合、第1の
電源スイッチ102は、好ましくは、第2の電源スイッ
チ304が開くのと実質的に同時に閉じる。なぜなら、
デューティサイクルが、パルス幅変調回路220によっ
て要求されるからである。
すると、ノード104は素早く高インピーダンスになり
得、当該分野で公知のように、インダクタがノード10
4の寄生キャパシタンスでLC回路を形成すると振動す
る。ノード104がアースを下回るときに第2の電源ス
イッチ304がサイクルオンおよびオフするのを防止す
るために、第2の電源スイッチ304に対する第1のタ
ーンオフ事象が、RSラッチフリップフロップFF2
302を設定するために用いられる。この第1のターン
オフ事象では、RSラッチフリップフロップFF2 3
02は、所望されないサイクリング中に第2の電源スイ
ッチ304をオフに保持する。なぜなら、RSラッチフ
リップフロップFF2 302は、立ち上がりエッジ検
出器303からのさらなる論理LOW出力または論理H
IGH出力によって影響されないためである(図4の状
態表を参照のこと。この表は、Rが低いままである限
り、一旦Sが少なくとも1回高くなると、QはさらにS
が変化しても影響されないことを示す。)第1の電源ス
イッチ102がオンになると、RSラッチフリップフロ
ップFF2 302出力Qは、しばらくの間、規定され
なくなり得る。これは、比較器308が高信号の立ち上
がりエッジを立ち上がりエッジ検出器303に送信し、
立ち上がりエッジ検出器303が、短い高信号をFF2
302のS入力に送信するためである。(図4の状態
表の状態4を参照のこと)。しかし、この規定されない
状態は、回路の動作には影響しない。なぜなら、NOR
ゲート306がRSラッチフリップフロップ302のQ
出力を無効にするためである。
相違は、図1および図2におけるダイオード106の動
作と比較した図3における第2の電源スイッチ304の
動作である。しかし、第1の電源スイッチ102は、非
同期回路においてバーストモードに出入りするのと同様
に、同期回路においてバーストモードに出入りする。従
って、負荷電流が十分に低下すると、PWM回路220
によって、第1の電源スイッチ102は、非同期回路に
ついて上述したように閉じる。
に示す非同期回路と同様にバーストモードにスイッチイ
ンおよびアウトし、それによって、同期スイッチ回路の
効率的な利点を高電流で維持しながら、低負荷電流での
効率を向上させる。
バックスタイルまたはステップダウン調整器であった。
ステップダウン調整器は、非調整入力電圧の平均値未満
の出力交流電圧のレベルを下げるために使用される。ブ
ーストスタイルまたはステップアップ調整器は、出力交
流電圧のレベルを非調整入力電圧のレベルを上回って上
昇させるために用いられ得る。
ステップアップ切り換え調整器800を示す。ステップ
アップ切り換え調整器800と、図3、図6、および図
7に示す切り換え調整器300との主な相違は、インダ
クタおよびスイッチの位置である。
では、第1の電源スイッチ802は、図1および図2に
おいてダイオード106が配置されていた位置を占有す
る。インダクタ808は、図1から図3および図6から
図7における第1の電源スイッチ102の位置を占有す
る。第2の電源スイッチ816は、図1から図3および
図6から図7におけるインダクタ108の位置を占有す
る。好ましくは、ステップアップ切り換え調整器800
の出力信号と、図1から図3および図6から図7のステ
ップダウン切り換え調整器の出力信号との主な相違は、
ステップアップ切り換え調整器800における信号の大
きさが、減少するのではなく増加することである。
非同期ステップアップ切り換え調整器を示す。同期動作
に必要な回路は、除去され、入力ノード904と出力ノ
ード114との間に接続されたダイオード906に置き
換えられている。第1の電源スイッチ902は、図8の
第1の電源スイッチ802と実質的に同じ目的で役立
つ。
入りが可能な電圧モード切り換え調整回路が提供される
のが理解される。切り換え調整器は、ステップダウン構
成およびステップアップ構成の両方に対して設計され得
る。当業者は、本発明が、限定ではなく例示の目的で提
示した上記の実施態様以外によっても実施され得、本発
明は、以下の請求の範囲によってのみ限定されることが
理解される。
ードフィードバック切り換え調整器が自動的にバースト
モードに出入りすることを可能にする、回路および方法
が提供される。本発明によると電圧モードフィードバッ
ク切り換え調整回路の同期トポロジーおよび非同期トポ
ロジーの双方について、電圧モードフィードバック切り
換え調整器が自動的にバーストモードに出入りすること
が可能になる。
ク切り換え調整器のブロック図である。
ックバーストモード回路のブロック図である。
ンフィードバックバーストモード回路のブロック図であ
る。
フリップフロップの可能な状態を示す、状態表である。
NORゲートの可能性な状態を示す、状態表である。
フィードバックバーストモード回路のブロック図であ
る。
フィードバックバーストモード回路のブロック図であ
る。
フィードバックバーストモード回路のブロック図であ
る。
ドフィードバックバーストモード回路のブロック図であ
る。
を示すブロック図である。
表である。
Claims (19)
- 【請求項1】 入力および出力を有し、バーストモード
に自動的に出入りできる非同期電圧モード切り換え調整
器であって、 デューティサイクルを有するスイッチ回路と、 PWM発振器と、固定最小非ゼロデューティサイクル発
振器と、入力と、出力とを含む、パルス幅変調器(PM
W)回路であって、該PMW回路の出力が該スイッチ回
路に接続され、該デューティサイクルが該PMW回路に
よって設定され、該切り換え調整器が、該PMW回路に
よって提供される信号に基づいてバーストモードに出入
りする、パルス幅変調回路と、 該切り換え調整器の出力と該PWM発振器の入力との間
に接続され、該切り換え調整器の該出力における電圧か
ら得られるフィードバック信号を該PWM回路に提供す
る、フィードバック回路と、 を含む、非同期電圧モード切り換え調整器。 - 【請求項2】 前記スイッチ回路が、 前記切り換え調整器の入力に接続される第1の端部と、
第2の端部とを有する、切り換え素子と、 該切り換え素子の該第2の端部と、該切り換え調整器の
前記出力との間に接続された、インダクタと、 該切り換え素子の該第2の端部とアースとの間に接続さ
れた、ダイオードと、 該切り換え調整器の該出力と、アースとの間に接続され
た、出力キャパシタと、 を含む、請求項1に記載の切り換え調整器。 - 【請求項3】 前記PWM発振器が、前記フィードバッ
ク回路に接続された第1の入力と、第2の入力と、出力
とを含み、前記固定最小非ゼロデューティサイクル発振
器が、入力と出力とを含み、該PWM発振器がさらに、 該PWM発振器の該第2の入力に接続された第1の出力
と、該固定最小非ゼロデューティサイクル発振器の入力
に接続された第2の出力と、第3の出力とを有する、マ
スタクロックと、 該PWM発振器の前記出力に接続された第1の入力と、
該固定最小非ゼロデューティサイクル発振器の出力に接
続された第2の入力と、該マスタクロックの該第3の出
力に接続された第3の入力と、前記スイッチング回路に
接続された出力とを有する、論理回路と、 を含む、請求項1に記載の切り換え調整器。 - 【請求項4】 前記論理回路が、 前記PWM発振器の前記出力に接続されたD入力と、前
記第3のクロック出力に接続されたクロック入力と、Q
出力とを有する、バーストフリップフロップと、 該PWM発振器の該出力に接続された第1の入力と、前
記固定最小非ゼロデューティサイクル発振器の前記出力
に接続された第2の入力と、出力とを有する、ORゲー
トと、 該ORゲートの該出力に接続された第1の入力と、該バ
ーストフリップフロップの該Q出力に接続された第2の
入力と、前記スイッチ回路の前記デューティサイクルを
設定するために該スイッチ回路に接続された出力とを有
する、ANDゲートと、 を含む、請求項3に記載の切り換え調整器。 - 【請求項5】 前記フィードバック回路が、基準電圧に
接続された正の端子と、前記切り換え調整器の前記出力
に接続された負の端子と、前記PWM回路の前記入力に
接続された出力端子とを有する、フィードバック増幅器
を含む、請求項1に記載の切り換え調整器。 - 【請求項6】 入力と出力とを有する同期電圧モード切
り換え調整器であって、自動的にバーストモードに出入
りすることが可能な該切り換え調整器が、 第1のデューティサイクルと第2のデューティサイクル
とを有するスイッチ回路であって、該第2のデューティ
サイクルは該第1のデューティサイクルと実質的に位相
ずれしているスイッチ回路と、 パルス幅変調器(PWM)回路であって、PWM発振器
と、固定最小非ゼロデューティサイクル発振器と、入力
と、出力とを有し、該PWM回路の前記出力は該スイッ
チ回路に接続され、該第1のデューティサイクルは該P
WM回路によって設定され、該第2のデューティサイク
ルは該PWM回路によって部分的に設定され、該切り換
え調整器は、該PWM回路によって提供される信号に基
づいてバーストモードに出入りする、PWM回路と、 該切り換え調整器の前記出力と該PWM回路の入力との
間に接続され、該切り換え調整器の該出力における電圧
から引き出されるフィードバック信号を該PWM回路に
提供するフィードバック回路と、 を備えた同期電圧モード切り換え調整器。 - 【請求項7】 前記スイッチ回路は、 第1の端部と第2の端部とを有する第1の切り換え素子
であって、該第1の端部は前記切り換え調整器の前記入
力に接続され、該第1の切り換え素子が前記PWM回路
によって供給される前記第1のデューティサイクルに応
答して開閉するように、該PWM回路に接続される第1
の切り換え素子と、 該第1の切り換え素子の該第2の端部と該切り換え調整
器の前記出力との間に接続されるインダクタと、 該PWM回路の前記出力と該第1の切り換え素子の該第
2の端部との間に接続される第2の切り換え素子であっ
て、前記第2のデューティサイクルに応答して部分的に
開閉する第2の切り換え素子と、 該切り換え調整器の該出力とアースとの間に接続される
出力キャパシタと、 を備えている、請求項6に記載の切り換え調整器。 - 【請求項8】 前記第2の切り換え素子は、 負の端子と正の端子と出力端子とを有する比較器であっ
て、該正の端子は前記第1の切り換え素子の前記第2の
端部に接続され、該負の端子はアースに接続される、比
較器と、 該比較器の該出力端子に接続される入力と、出力とを有
する立ち上がりエッジ検出器と、 R入力とS入力とQ出力とを有するRSラッチフリップ
フロップであって、該S入力は該立ち上がりエッジ検出
器の該出力に接続され、該R入力は前記PWM回路の前
記出力に接続される、RSラッチフリップフロップと、 第1の入力と第2の入力と出力とを有するNORゲート
であって、該第1の入力は該PWM回路の該出力に接続
され、該第2の入力は該RSラッチフリップフロップの
該Q出力に接続され、そして該NORゲートの該出力は
該第2の切り換え素子に接続され、これにより該NOR
ゲートは該第2の切り換え素子のために前記デューティ
サイクルを提供する、NORゲートと、 を備えている、請求項7に記載の切り換え調整器。 - 【請求項9】 前記第2の切り換え素子は、 該第2の切り換え素子の前記第2の端部とアースとの間
に接続される抵抗素子と、 負の端子と正の端子と出力端子とを有する比較器であっ
て、該正の端子は前記第1の切り換え素子の前記第1の
端部に接続され、該負の端子はアースに接続される、比
較器と、 該比較器の該出力端子に接続される入力と、出力とを有
する立ち上がりエッジ検出器と、 R入力とS入力とQ出力とを有するRSラッチフリップ
フロップであって、該S入力は該立ち上がりエッジ検出
器の該出力に接続され、該R入力は前記PWM回路の前
記出力に接続される、RSラッチフリップフロップと、 第1の入力と第2の入力と出力とを有するNORゲート
であって、該第1の入力は該PWM回路の該出力に接続
され、該第2の入力は該RSラッチフリップフロップの
該Q出力に接続され、そして該NORゲートの該出力は
該第2の切り換え素子に接続され、これにより該NOR
ゲートの該出力は該第2の切り換え素子を開閉する、N
ORゲートと、 を備えている、請求項7に記載の切り換え調整器。 - 【請求項10】 前記第2の切り換え素子は、 該第2の切り換え素子の前記第2の端部とアースとの間
に接続される抵抗素子と、 負の端子と正の端子と出力端子とを有する比較器であっ
て、該正の端子は該第2の切り換え素子の該第2の端部
に接続され、該負の端子はアースに接続される、比較器
と、 該比較器の該出力端子に接続される入力と、出力とを有
する立ち上がりエッジ検出器と、 R入力とS入力とQ出力とを有するRSラッチフリップ
フロップであって、該S入力は該立ち上がりエッジ検出
器の該出力に接続され、該R入力は前記PWM回路の前
記出力に接続される、RSラッチフリップフロップと、 第1の入力と第2の入力と出力とを有するNORゲート
であって、該第1の入力は該PWM回路の該出力に接続
され、該第2の入力は該RSラッチフリップフロップの
該Q出力に接続され、そして該NORゲートの出力は該
第2の切り換え素子に接続され、これにより該NORゲ
ートの該出力は該第2の切り換え素子を開閉する、NO
Rゲートと、 を備えている、請求項7に記載の切り換え調整器。 - 【請求項11】 前記PWM発振器は、前記フィードバ
ック回路に接続される第1の入力と、第2の入力と、出
力とを備え、前記固定最小非ゼロデューティサイクル発
振器は入力と出力とを備え、そして、前記PWM回路
は、 入力と出力とを有する固定最小非ゼロデューティサイク
ル発振器と、 該PWM発振器の該第2の入力に接続される第1の出力
と、該固定最小非ゼロデューティサイクル発振器の該入
力に接続される第2の出力と、前記バーストフリップフ
ロップの前記クロック入力に接続される第3の出力とを
有するマスタークロックと、 該PWM発振器の該出力に接続される第1の入力と、該
固定最小非ゼロデューティサイクル発振器の該出力に接
続される第2の入力と、該マスタークロックの第3の出
力に接続される第3の入力と、前記スイッチ回路に接続
される出力とを有する論理回路と、 をさらに備えている、請求項6に記載の切り換え調整
器。 - 【請求項12】 前記論理回路は、 前記PWM発振器の前記出力に接続されるD入力と、ク
ロック入力と、Q出力とを有するバーストフリップフロ
ップと、 該PWM発振器の前記第2の入力に接続される第1の出
力と、前記固定最小非ゼロデューティサイクル発振器の
前記入力に接続される第2の出力と、該バーストフリッ
プフロップの該クロック入力に接続される第3の出力と
を有するマスタークロックと、 該PWM発振器の該出力に接続される第1の入力と、該
固定最小非ゼロデューティサイクル発振器の該出力に接
続される第2の入力と、出力とを有するORゲートと、 該ORゲートの該出力に接続される第1の入力と、該バ
ーストフリップフロックの該Q出力に接続される第2の
入力と、前記スイッチ回路に接続される出力とを有する
ANDゲートと、 を備えている、請求項11に記載の切り換え調整器。 - 【請求項13】 前記フィードバック回路は、基準電圧
に接続される正の端子と、前記切り換え調整器の前記出
力に接続される負の端子と、前記PWM回路に接続され
る出力端子とを有するフィードバック増幅器を備えてい
る、請求項6に記載の切り換え調整器。 - 【請求項14】 入力と出力とを有する非同期ステップ
アップ電圧モード切り換え調整器であって、自動的にバ
ーストモードに出入りすることが可能な該切り換え調整
器は、 デューティサイクルを有するスイッチ回路と、 パルス幅変調器(PWM)回路であって、PWM発振器
と、固定最小非ゼロデューティサイクル発振器と、入力
と、出力とを有し、該PWM回路の該出力は該スイッチ
回路に接続され、該デューティサイクルは該PWM回路
によって設定され、該切り換え調整器は、該PWM回路
によって提供される信号に基づいてバーストモードに出
入りする、PWM回路と、 該切り換え調整器の出力と該PWM回路の該入力との間
に接続され、該切り換え調整器の該出力において電圧に
対応するフィードバック信号を該PWM回路に提供する
フィードバック回路と、 を備えた非同期ステップアップ電圧モード切り換え調整
器。 - 【請求項15】 前記スイッチ回路が、 第1の端部と第2の端部とを有するインダクタであっ
て、該第1の端部は前記切り換え調整器の前記入力に接
続される、インダクタと、 該インダクタの該第2の端部とアースとの間に接続され
る切り換え素子と、 該インダクタの該第2の端部と該切り換え調整器の前記
出力との間に接続されるダイオードと、 該切り換え調整器の該出力とアースとの間に接続される
出力キャパシタと、 を備えている、請求項14に記載の切り換え調整器。 - 【請求項16】 前記PWM発振器は、前記フィードバ
ック回路に接続される第1の入力と、第2の入力と、出
力とを備え、前記固定最小非ゼロデューティサイクル発
振器は入力と出力とを備え、そして、前記PWM回路
は、 該PWM発振器の該第2の入力に接続される第1の出力
と、該固定最小非ゼロデューティサイクル発振器の該入
力に接続される第2の出力と、第3の出力とを有するマ
スタークロックと、 該PWM発振器の該出力に接続される第1の入力と、該
固定最小非ゼロデューティサイクル発振器の該出力に接
続される第2の入力と、前記マスタークロックの前記第
3の出力に接続される第3の入力と、前記スイッチ回路
に接続される出力とを有する論理回路と、 を備えている、請求項14に記載の切り換え調整器。 - 【請求項17】 前記論理回路は、 前記PWM発振器の前記出力に接続されるD入力と、前
記第3のクロック出力に接続されるクロック入力と、Q
出力とを有するバーストフリップフロップと、 該PWM発振器の該出力に接続される第1の入力と、前
記該固定最小非ゼロデューティサイクル発振器の前記出
力に接続される第2の入力と、出力とを有するORゲー
トと、 ANDゲートであって、該ORゲートの該出力に接続さ
れる第1の入力と、該バーストフリップフロップの該Q
出力に接続される第2の入力と、該ANDゲートが前記
スイッチ回路のための前記第1のデューティサイクルを
設定するように該スイッチ回路に接続される出力とを有
するANDゲートと、 を備えている、請求項16に記載の切り換え調整器。 - 【請求項18】 前記フィードバック回路は、基準電圧
に接続される正の端子と、前記切り換え調整器の前記出
力に接続される負の端子と、前記PWM回路の入力に接
続される出力端子とを有するフィードバック増幅器を備
えている、請求項14に記載の切り換え調整器。 - 【請求項19】 入力および出力を有し、バーストモー
ドに自動的に出入りできる同期セットアップ電圧モード
切り換え調整器であって、 該切り換え調整器の該入力に接続された第1の端部と、
第2の端部とを有する、インダクタと、 第1のデューティサイクルを有し、該インダクタの該第
2の端部とアースとの間に接続された、第1の電源スイ
ッチと、 該インダクタの該第2の端部に接続された第1の端部
と、該切り換え調整器の該出力に接続された第2の端部
とを有し、第2のデューティサイクルを有する、第2の
電源スイッチと、 該切り換え調整器の該出力に接続された正の端子と、該
インダクタの該第2の端部に接続された負の端子と、出
力とを有する、比較器と、 該比較器の該出力端子に接続された入力と、出力とを有
する、立ち上がりエッジ検出器と、 前記PWM回路の前記出力に接続されたR入力と、該立
ち上がりエッジ検出器の出力に接続されたS入力と、Q
入力とを有する、ラッチフリップフロップと、 該ラッチフリップフロップの該Q入力に接続された第1
の入力と、第2の入力と、該第2の電源スイッチに第2
のデューティサイクルを提供するために該第2の電源ス
イッチに接続された出力とを有する、NORゲートと、 該切り換え調整器の該出力とアースとの間に接続された
キャパシタと、 基準電圧に接続された正の端子と、該切り換え調整器の
出力に接続された負の端子と、出力端子とを有する、フ
ィードバック増幅器と、 該フィードバック増幅器の該出力端子に接続された第1
の入力と、第2の入力と、出力とを有する、PWM発振
器と、 入力と、出力とを有する、固定最小非ゼロデューティサ
イクル発振器と、 該PWM発振器の該出力に接続されたD入力と、クロッ
ク入力と、Q出力とを有する、バーストフリップフロッ
プと、 該PWM発振器の該第2の入力に接続された第1の出力
と、該固定最小非ゼロデューティサイクル発振器の該入
力に接続された第2の出力と、該バーストフリップフロ
ップの該クロック入力に接続された第3の出力とを有す
る、マスタクロックと、 該PWM発振器の該出力に接続された第1の入力と、該
固定最小非ゼロデューティサイクル発振器の該出力に接
続された第2の入力と、出力とを有する、ORゲート
と、 該ORゲートの該出力に接続された第1の入力と、該バ
ーストフリップフロップの該Q出力に接続された第2の
入力と、該ラッチフリップフロップの該R入力と該NO
Rゲートの該第2の入力に接続され、且つ前記スイッチ
回路の前記デューティサイクルを設定するために該第1
の電源スイッチに接続された出力とを有する、ANDゲ
ートと、 を含む、同期セットアップ電圧モード切り換え調整器。
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