CN101714860A - 振荡电路及影像显示装置 - Google Patents
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Abstract
本发明提供一种振荡电路。该振荡电路将规定的振荡信号供给至具有分频器、相位比较器及生成器的生成电路。时钟信号生成部生成具有与上述相位比较器中的比较结果对应的周期的时钟信号。时钟信号屏蔽部将上述时钟信号生成部生成的上述时钟信号的一部分屏蔽而生成上述规定的振荡信号,将该规定的振荡信号向上述分频器供给。上述时钟信号屏蔽部对上述时钟信号的一部分进行屏蔽,以使得上述生成器生成的上述采样信号的周期,与在生成上述影像信号时使用的时钟的周期即规定周期相同。
Description
技术领域
本发明涉及一种振荡电路及影像显示装置。
背景技术
对于影像信号,与进行影像显示等的设备的规格对应而实施各种处理。例如,在显示模拟影像的情况下,利用与输入的影像信号的时钟具有相同周期的采样时钟,对影像信号进行采样处理。图7是显示影像的电路的结构图。如图7所示,对来自生成并输出导航影像等各种影像的图像输出电路部102的影像信号进行显示的TFT(ThinFilm Transistor)液晶显示装置105,基于来自显示定时电路部103的采样时钟,对影像信号进行采样并进行描绘处理。显示定时电路部103基于由振荡电路部106起振的信号,生成与来自图像输出电路部102的水平同步信号同步的采样时钟。
图8及图9是表示输入的影像信号的时钟和采样时钟之间的关系的时序图。如图8所示,在所输入的影像信号的时钟和采样时钟一致的情况下,在TFT液晶显示装置105中,对影像信号正确地进行采样,正常地显示影像。另一方面,如图9所示,在输入的影像信号的时钟和采样时钟不一致的情况下,在TFT液晶显示装置105中,没有对影像信号正确地进行采样,无法正常地显示影像。在此情况下,所显示的文字产生污点或轮廓模糊。
在专利文献1中,公开了一种对PLL(Phase-Locked Loop:相位同步环)电路的分频器的分频比进行变更的图像显示装置。另外,在专利文献2中,公开了一种时钟生成电路,其可以通过部分地屏蔽采样时钟而以简单的结构进行频率变换。
专利文献1:特开平10-173518号公报
专利文献2:特开2006-270438号公报
发明内容
处理影像信号的电子设备,为了抑制开发成本等,大多沿用通常所流通的(市售的)IC芯片而处理影像信息。即,大多将通常所流通IC芯片作为显示定时电路部使用。此时,存在输入的影像信号的时钟和由通常所流通的IC芯片生成的采样时钟不一致的情况。在这种情况下,可以使用专利文献1的技术,通过对生成采样时钟的电路的分频器的分频比进行变更,从而使影像信号的时钟和采样时钟一致,但变更分频器的分频比时需要很多费用。另外,可以使用专利文献2的技术,通过不变更分频器的分频比而部分地屏蔽采样时钟,使水平同步信号的1个周期中的采样时钟的数量与影像信号的时钟数量一致,但在此情况下,会因影像信号的时钟的周期和采样时钟的周期之间的微小的不一致,导致文字产生污点或轮廓模糊。
本发明就是鉴于上述问题而提出的,其课题在于提供一种振荡电路及影像显示装置,其不对分频器的分频比进行变更,防止文字的污点或轮廓模糊。
详细地说,一种振荡电路,其向生成电路供给规定的振荡信号,该生成电路具有:分频器,其具有固定的分频比,将规定的振荡信号以该分频比进行分频,并输出分频信号;相位比较器,其对影像信号中包含的同步信号的相位和从该分频器输出的上述分频信号相位之间的相位差进行比较;以及生成器,其生成具有与该相位比较器中的比较结果对应的周期的采样信号,该振荡电路的特征在于,具有:时钟信号生成部,其生成具有与上述相位比较器中的比较结果对应的周期的时钟信号;以及时钟信号屏蔽部,其对上述时钟信号生成部生成的上述时钟信号的一部分进行屏蔽而生成上述规定的振荡信号,并将该规定的振荡信号向上述分频器供给,上述时钟信号屏蔽部对上述时钟信号的一部分进行屏蔽,以使得上述生成器生成的上述采样信号的周期,与在生成上述影像信号时使用的时钟的周期即规定周期相同。
上述振荡电路可以与生成电路连接,对从该生成电路输出的采样信号的周期进行调整。该生成电路如上述所示,具有分频器、相位比较器和生成器,生成器生成具有与相位比较器中的比较结果对应的周期的采样信号。生成电路中的分频器具有固定的分频比,如果输入某个振荡信号,则将该振荡信号以该分频比进行分频,并向相位比较器发送。输入至分频器的振荡信号,在本发明中称为规定的振荡信号。在生成电路的相位比较器中,将从外部输入的同步信号的相位与来自分频器的相位进行比较。同步信号是用于与影像信号取得同步的信号,可以例示例如水平同步信号或垂直同步信号。上述振荡电路可以对由上述生成电路的生成器所生成的采样信号的周期进行调整。另外,由于该振荡电路与生成电路连接,对从该生成电路输出的采样信号的周期进行调整,所以还可以作为对生成电路的动作进行控制的电路。
上述振荡电路具有的时钟信号生成部,生成具有与生成电路的相位比较器中的比较结果对应的周期的时钟信号,例如,可以应用能够与生成电路的相位比较器输出的电压对应而调整时钟的周期的电压控制振荡器。
在这里,振荡电路具有的时钟信号屏蔽部,将时钟信号生成部生成的时钟信号向生成电路的分频器发送,但构成为可以对时钟信号的一部分进行屏蔽。所谓对时钟信号的一部分进行屏蔽,是指对于时钟信号生成部生成的连续存在多个时钟的时钟信号中,使得其一部分的时钟无法被分频器识别,例如在时钟信号的一部分中叠加不同的信号而使时钟消失。
但是,由于在生成电路的生成器中,生成具有与相位比较器的比较结果对应的周期的采样信号,所以在要将该信号调整为规定周期的情况下,重要的是对向相位比较器发送的信号进行调整。在这里,所谓规定频率,是指在生成影像信号时使用的时钟的周期,例如是由生成影像信号的电路的像素数的规格等确定的周期。上述振荡电路仅对至相位比较器的时钟信号的一部分进行屏蔽,以使得从生成器输出的采样信号的周期与该规定周期一致。通过对向相位比较器发送的时钟信号的一部分进行屏蔽,由于如果从生成器输出的采样信号的周期较慢,则相位比较器认为是错误并改变生成器的输出,所以其结果,从生成器输出的采样信号的周期变早。由此,上述振荡电路不需要变更在生成电路中使用的分频器的分频比,就可以将在生成电路中生成的采样时钟调整为期望的周期。根据本发明,通过追加上述小规模电路,可以有效地利用现有的生成电路,同时,消除影像信号的时钟的周期和采样时钟的周期之间的不一致。
另外,上述时钟信号屏蔽部构成为,可以对上述时钟信号的规定数量的时钟进行屏蔽,该规定数量基于上述规定周期和上述分频器的分频比而决定。由于由生成器生成的采样时钟,根据分频器的分频比和时钟信号屏蔽部屏蔽的时钟的数量而确定,所以在要使采样时钟的周期成为规定周期的情况下,可以根据规定周期和分频比之间的关系决定应屏蔽的时钟数量。由此,可以将由生成电路生成的采样时钟调整至期望的周期。
另外,也可以是上述生成器将与上述采样信号同步的同步信号向上述时钟信号屏蔽部输出,上述时钟信号屏蔽部基于从上述生成器输出的上述同步信号,对上述时钟信号的一部分进行屏蔽。根据如上述所示构成的振荡电路,可以稳定地生成与同步信号同步的采样时钟。上述时钟信号屏蔽部,可以在被输入了从上述生成器输出的上述同步信号之后,立刻开始对上述时钟信号的屏蔽,也可以在接收到从上述生成器输出的上述同步信号并经过一定时间后,开始对上述时钟信号的屏蔽。
另外,上述时钟信号屏蔽部也可以在从上述生成器开始生成上述采样信号并经过一定时间后,开始对上述时钟信号的屏蔽。根据如上述所示构成的振荡电路,由于在经过一定时间之前不开始屏蔽处理,所以可以迅速地使生成电路的动作稳定。上述振荡电路也可以具有如下述构成的开关,其在上述生成器开始生成上述采样信号的后的一定期间内,将上述时钟信号生成部生成的时钟信号从上述时钟信号屏蔽部旁路绕过,直接向上述分频器供给,或者,也可以具有如下述构成的开关,其在上述生成器开始生成上述采样信号后的一定期间内,对从上述生成器输出的上述同步信号进行截止。
另外,本发明是一种影像显示装置,其接收影像信号并显示影像,其特征在于,具有:影像显示电路,其利用采样信号对上述影像信号进行采样而显示影像;生成电路,其生成向上述影像显示电路供给的上述采样信号;以及振荡电路,其向上述生成电路供给规定的振荡信号,上述生成电路具有:分频器,其具有固定的分频比,将上述规定的振荡信号以该分频比进行分频并输出分频信号;相位比较器,其对上述影像信号中含有的同步信号的相位和从该分频器输出的上述分频信号的相位之间的相位差进行比较;以及生成器,其生成具有与该相位比较器中的比较结果对应的周期的上述采样信号,上述振荡电路具有:时钟信号生成部,其生成具有与上述相位比较器中的比较结果对应的周期的时钟信号;以及时钟信号屏蔽部,其将上述时钟信号生成部生成的上述时钟信号的一部分进行屏蔽而生成上述规定的振荡信号,并将该规定的振荡信号向上述分频器供给,上述时钟信号屏蔽部对上述时钟信号的一部分进行屏蔽,以使得上述生成器生成的上述采样信号的周期,与生成上述影像信号时使用的时钟的周期即规定周期相同。
发明的效果
本发明可以提供一种振荡电路及影像显示装置,其不变更分频器的分频比,可以防止文字产生污点或轮廓模糊。
附图说明
图1是影像显示装置的结构图。
图2是时钟信号屏蔽部的结构图。
图3是时序图。
图4是变形例所涉及的时序图。
图5是变形例所涉及的影像显示装置的结构图。
图6是变形例所涉及的影像显示装置的结构图。
图7是现有例子所涉及的影像显示装置的结构图。
图8是在时钟一致时的时序图。
图9是在时钟不一致时的时序图。
具体实施方式
下面,例示说明用于实施本发明的最佳方式。以下所示的实施方式仅为例示,本发明并不限定于此。
图1是应用了本发明的影像显示装置1的结构图。影像显示装置1如图1所示,由图像输出电路部2、显示定时电路部3(生成电路的一个例子)、振荡电路部4及TFT(Thin Film Transistor)液晶显示装置5(影像显示电路的一个例子)构成。图像输出电路部2生成并输出导航画面或对各种AV(Audio/Visual)设备进行操作的操作画面等影像信号。图像输出电路部2是通过执行计算机程序而生成影像信号的电路部。图像输出电路部2为了抑制各种信号的衰减,分别独立地输出将水平同步信号和垂直同步信号合并后的复合同步信号、和影像信号。另外,在本实施方式中,以下以在复合同步信号中特别使用水平同步信号的情况下的动作为中心进行说明,但本发明也可以应用于使用垂直同步信号的情况。从图像输出电路部2输出的影像信号向TFT液晶显示装置5发送。另外,从图像输出电路部2输出的水平同步信号向显示定时电路部3发送。
另外,从图像输出电路部2输出的影像信号是水平512像素的信号,水平同步信号的周期及生成影像信号时的时钟的周期(规定周期的一个例子)也以其为基准。从图像输出电路部2输出的影像信号,由于是由红、绿、蓝这三个原色信号构成一个像素的影像信号,所以在扫描该影像信号的一条水平线时,实际上需要512×3=1536个时钟的采样信号。但是,为了便于说明,在以下的说明中,将对由三个原色信号构成的一个像素进行采样时所需的时钟作为1个时钟进行说明。即,以为了对水平512像素的影像信号的一条水平线进行扫描,需要512个时钟的采样信号的情况进行说明。
显示定时电路部3是通常所流通的(市售的)影像信号处理用的半导体装置,如图1所示,具有相位比较器31、定时生成器32(生成器的一个例子)及分频器33。显示定时电路部3具有以对水平508像素的影像信号进行处理作为前提的规格,因此,分频器33的分频比设定为1/508。分频器33将输入的振荡信号以规定的分频比(1/508)进行分频,输出分频信号。即,每输入508个时钟的振荡信号,就输出1个时钟的分频信号。相位比较器31对输入的2个信号的相位进行比较,输出与相位差对应的电压信号。向该相位比较器31中,输入来自图像输出电路部2的水平同步信号和来自分频器33的分频信号。另外,相位比较器31的输出向定时生成器32及后述的振荡电路部4的环路滤波器(loop filter)41发送。即,相位比较器31对来自图像输出电路部2的水平同步信号的相位和来自分频器33的分频信号的相位进行比较,将与相位差对应的电压信号向定时生成器32及环路滤波器41发送。定时生成器32与从相位比较器31输出的信号的电压对应而生成并输出各种信号。即,定时生成器32例如图1所示,生成采样时钟并向TFT液晶显示装置5输出,生成水平同步信号并向时钟屏蔽部43输出,该采样时钟用于由TFT液晶显示装置5对来自图像输出电路部2的影像信号进行采样,该水平同步信号用于调整后述的振荡电路部4的时钟屏蔽部43对时钟信号进行屏蔽的定时。
振荡电路部4如图1所示,由环路滤波器41、VCO(VoltageControlled Oscillator)42(时钟信号生成部的一个例子)及时钟屏蔽部43(时钟信号屏蔽部的一个例子)构成。环路滤波器41是将从相位比较器31输出的信号中的高频成分去除的低通滤波器。由环路滤波器41去除了高频成分的信号向VCO 42输出。VCO 42是生成具有与输入的电压对应的频率的时钟信号的电路,换句话说,是可以根据输入的电压调整时钟信号的振荡频率的电压控制振荡器。VCO 42生成具有与从环路滤波器41输出的信号的电压对应的频率的时钟信号,向时钟屏蔽部43输出。时钟屏蔽部43,是可以将从VCO 42输出的时钟信号,与从定时生成器32输出的水平同步信号对应而进行屏蔽的电路。图2示出时钟屏蔽部43的结构。时钟屏蔽部43如图2所示,设置有4级移位寄存器,以可以将来自VCO 42的时钟信号屏蔽4个时钟(规定数量的一个例子)。另外,由于在本实施方式中处理的影像信号是彩色信号,所以实际上设置有12级移位寄存器,以可以对来自VCO 42的时钟信号屏蔽12个时钟。在图2中,示出了设置有12级移位寄存器的时钟屏蔽部43。另外,时钟屏蔽部43具有:MASK,其对时钟信号进行屏蔽;RESET端子,其输入重置信号;DCLK端子,其输入来自VCO 42的时钟信号;HSYNC端子,其输入来自定时生成器32的水平同步信号;以及DCLK__OUT端子,其输出屏蔽后的时钟信号。另外,时钟屏蔽部43具有XTHRU端子,其用于将输入的时钟信号不进行屏蔽地输出,但其通常不使用。在向RESET端子输入重置信号后,如果从VCO 42向DCLK端子输入4个时钟,则对于所有级的移位寄存器,AND条件成立,第5个时钟以后的来自VCO 42的时钟信号通过时钟屏蔽部43,从DCLK__OUT端子输出。图3示出时钟屏蔽部43对时钟信号进行屏蔽的动作的时序图。时钟屏蔽部43如图3所示,如果接收到来自定时生成器32的水平同步信号,则对来自VCO 42的时钟信号屏蔽4个时钟,将第5个时钟以后的时钟信号(规定的振荡信号的一个例子)向分频器33输出。另外,由于在本实施方式中处理的影像信号是彩色信号,所以实际上对来自VCO 42的时钟信号屏蔽12个时钟,将第13个时钟以后的时钟信号向分频器输出。图3是将来自VCO 42的时钟信号屏蔽12个时钟时的时序图。
TFT液晶显示装置5是使用了薄膜晶体管的液晶显示器装置,基于从显示定时电路部3发送的采样时钟及其他各种定时信号,对来自图像输出电路部2的影像信号进行采样,在液晶面板上进行描绘处理。即,向TFT液晶显示装置5中,输入从定时生成器32输出的采样时钟、和从图像输出电路部2输出的影像信号。并且,TFT液晶显示装置5基于输入的采样时钟和影像信号显示影像。
在如上述所示构成的影像显示装置1中,如果供给电源并从图像输出电路部2输出影像信号及水平同步信号,则与显示定时电路部3的分频器33的分频比为1/508无关地,生成具有与水平512像素的影像信号对应的周期的采样时钟。下面,针对本实施方式的影像显示装置1的动作进行说明。在下述的说明中,将与水平508像素的影像信号对应的水平同步信号的1个周期设为T0,将与水平512像素的影像信号对应的水平同步信号的1个周期设为T1。
在本实施方式的影像显示装置1中使用的显示定时电路部3,如上述所示,是通常所流通的影像信号处理用的半导体装置,以对水平508像素的影像信号进行处理作为前提而设计。即,分频器33的分频比固定为1/508。相位比较器31设置为,如果从图像输出电路部2输入与水平508像素的影像信号对应的水平同步信号(1clk/T0),从分频器33输入在周期T0中包含1个时钟的分频信号(1clk/T0),则输出规定电压V0,定时生成器32设置为,基于该规定电压V0,生成与水平508像素的影像信号对应的水平同步信号(1clk/T0)及具有与水平508像素的影像信号对应的周期的采样时钟(508clk/T0)。
最开始,振荡电路部4的VCO 42在周期T0生成包含508个时钟的时钟信号(508clk/T0),并向时钟屏蔽部43输出。时钟屏蔽部43与来自定时生成器32的水平同步信号(1clk/T0)同步地,将来自VCO 42的时钟信号屏蔽4个时钟,输出在周期T0中含有504个时钟的时钟信号(504clk/T0)。由此,在周期T0中,分频器33中仅输入504个时钟的振荡信号,在比周期T0长的周期T1中,分频器33中输入508个时钟的振荡信号。因此,分频器33将在周期T1中包含1个时钟的分频信号(1clk/T1)输出至相位比较器31。即,向相位比较器31中,从图像输出电路部2输入与水平512像素的影像信号对应的水平同步信号(1clk/T1),另外,从分频器33输入在周期T1中包含1个时钟的分频信号(1clk/T1)。在此情况下,相位比较器31将比规定电压V0高的电压V1向环路滤波器41、定时生成器32输出。这样,VCO 42与经由环路滤波器41输入的电压V1对应,生成在周期T1中包含512个时钟的时钟信号(512clk/T1),向时钟屏蔽部43输出。另一方面,定时生成器32基于输入的电压V1,生成在周期T1中包含512个时钟的采样时钟(512clk/T1),即具有与水平512像素的影像信号对应的周期的采样时钟,向TFT液晶显示装置5输出。另外,定时生成器32基于输入的电压V1,生成在周期T1中包含1个时钟的水平同步信号(1clk/T1),即,具有与水平512像素的影像信号对应的周期的水平同步信号,向时钟屏蔽部43输出。
然后,时钟屏蔽部43与来自定时生成器32的水平同步信号(1clk/T1)同步地,将来自VCO 42的时钟信号(512clk/T1)屏蔽4个时钟,输出在周期T1中含有508个时钟的时钟信号(508clk/T1)。由此,在周期T1,分频器33中输入508个时钟的振荡信号。因此,分频器33将周期T1中含有1个时钟的分频信号(1clk/T1)向相位比较器31输出。相位比较器对从图像输出电路部2输入的水平同步信号(1clk/T1)和从分频器33输入的分频信号(1clk/T1)进行比较,将电压V1向环路滤波器41、定时生成器32输出。定时生成器32基于输入的电压V1,生成具有与水平512像素的影像信号对应的周期的采样时钟,向TFT液晶显示装置5输出。
如上述所示,通过在影像显示装置1中组装振荡电路部4,从而与是否使用以处理水平508像素的影像信号为前提而设计的显示定时电路部3无关,可以稳定地生成具有与水平512像素的影像信号对应的周期的采样时钟。
另外,本实施方式的显示定时电路部3和振荡电路部4构成环形电路。在上述的说明中,第一次循环中,适当地调整采样时钟的频率,在第二次循环中,使采样时钟的频率稳定,但实际上,通过重复多次循环,而逐渐变换采样时钟的频率从而使其稳定。
根据本实施方式,通过追加上述振荡电路部4这样的小规模的电路,可以有效地利用上述显示定时电路部3这样的现有的电路,同时消除影像信号的时钟的周期和采样时钟的周期之间的不一致。另外,在将上述振荡电路部4与显示定时电路部3连接的情况下,为了使得在两个电路之间收发的信号的电平或偏压一致,也可以设置能够任意设定信号电平或偏压的接口电路等。由此,可以广泛地应用振荡电路部4。
另外,在上述实施方式中,时钟屏蔽部43接收到来自定时生成器32的水平同步信号后,立即对来自VCO 42的时钟信号进行屏蔽。但是,也可以使时钟屏蔽部43从接收到来自定时生成器32的水平同步信号并经过一段时间后,对时钟信号进行屏蔽。图4是表示在此情况下的时序图的图。如图4所示,通过在接收到水平同步信号并经过过一段时间后,对时钟信号进行屏蔽,可以调整生成采样时钟的定时,例如可以对在TFT液晶显示装置5中显示的影像的显示位置或影像处理电路中的信号处理的延迟时间等进行调整。
另外,上述实施方式在影像显示装置1接通电源后立刻进行时钟的屏蔽,但也可以从接通电源并经过一定时间后,开始时钟的屏蔽。图5及图6是表示在此情况下的电路结构的图。例如图5所示,在从影像显示装置1接通电源至经过一定时间为止的期间,将时钟屏蔽部43旁路绕过,从VCO 42直接向分频器33发送时钟信号。然后,如果在经过一定时间后进行动作的计时型的开关44进行切换,则解除时钟屏蔽部43的旁路绕过。由此,由于在经过一定时间之前不开始屏蔽处理,所以可以使显示定时电路部3的动作迅速稳定。另外,如图6所示,在从影像显示装置1接通电源至经过一定时间为止的期间,对从定时生成器32向时钟屏蔽部32发送的水平同步信号进行截止。然后,如果在经过一定时间后进行动作的计时型的开关44接通,则向时钟屏蔽部43发送从定时生成器32输出的水平同步信号。由此,由于在经过一定时间之前不开始屏蔽处理,所以可以使显示定时电路部3的动作迅速稳定。
Claims (9)
1.一种振荡电路,其向生成电路供给规定的振荡信号,该生成电路具有:分频器,其具有固定的分频比,将规定的振荡信号以该分频比进行分频,并输出分频信号;相位比较器,其对影像信号中包含的同步信号的相位和从该分频器输出的上述分频信号相位之间的相位差进行比较;以及生成器,其生成具有与该相位比较器中的比较结果对应的周期的采样信号,
该振荡电路的特征在于,具有:
时钟信号生成部,其生成具有与上述相位比较器中的比较结果对应的周期的时钟信号;以及
时钟信号屏蔽部,其对上述时钟信号生成部生成的上述时钟信号的一部分进行屏蔽而生成上述规定的振荡信号,并将该规定的振荡信号向上述分频器供给,
上述时钟信号屏蔽部对上述时钟信号的一部分进行屏蔽,以使得上述生成器生成的上述采样信号的周期,与在生成上述影像信号时使用的时钟的周期即规定周期相同。
2.根据权利要求1所述的振荡电路,其特征在于,
上述时钟信号屏蔽部对上述时钟信号的规定数量的时钟进行屏蔽,该规定数量基于上述规定周期和上述分频器的分频比而决定。
3.根据权利要求1或2所述的振荡电路,其特征在于,
上述生成器将与上述采样信号同步的同步信号向上述时钟信号屏蔽部输出,
上述时钟信号屏蔽部基于从上述生成器输出的上述同步信号,对上述时钟信号的一部分进行屏蔽。
4.根据权利要求3所述的振荡电路,其特征在于,
上述时钟信号屏蔽部在被输入从上述生成器输出的上述同步信号后,立刻开始对上述时钟信号的屏蔽。
5.根据权利要求3所述的振荡电路,其特征在于,
上述时钟信号屏蔽部在接收到上述生成器输出的上述同步信号并经过一定时间后,开始对上述时钟信号的屏蔽。
6.根据权利要求1至5中任意一项所述的振荡电路,其特征在于,
上述时钟信号屏蔽部在上述生成器开始生成上述采样信号并经过一定时间后,开始对上述时钟信号的屏蔽。
7.根据权利要求6所述的振荡电路,其特征在于,
该振荡电路还具有开关,该开关构成为,在上述生成器开始生成上述采样信号后的一定时间内,将上述时钟信号生成部生成的时钟信号从上述时钟信号屏蔽部旁路绕过而直接向上述分频器供给。
8.根据权利要求6所述的振荡电路,其特征在于,
该振荡电路还具有开关,该开关构成为,在上述生成器开始生成上述采样信号后的一定时间内,对从上述生成器输出的上述同步信号进行截止。
9.一种影像显示装置,其接收影像信号并显示影像,
其特征在于,具有:
影像显示电路,其利用采样信号对上述影像信号进行采样而显示影像;
生成电路,其生成向上述影像显示电路供给的上述采样信号;以及
振荡电路,其向上述生成电路供给规定的振荡信号,
上述生成电路具有:分频器,其具有固定的分频比,将上述规定的振荡信号以该分频比进行分频并输出分频信号;相位比较器,其对上述影像信号中含有的同步信号的相位和从该分频器输出的上述分频信号的相位之间的相位差进行比较;以及生成器,其生成具有与该相位比较器中的比较结果对应的周期的上述采样信号,
上述振荡电路具有:时钟信号生成部,其生成具有与上述相位比较器中的比较结果对应的周期的时钟信号;以及时钟信号屏蔽部,其将上述时钟信号生成部生成的上述时钟信号的一部分进行屏蔽而生成上述规定的振荡信号,并将该规定的振荡信号向上述分频器供给,
上述时钟信号屏蔽部对上述时钟信号的一部分进行屏蔽,以使得上述生成器生成的上述采样信号的周期,与生成上述影像信号时使用的时钟的周期即规定周期相同。
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KR100438786B1 (ko) * | 2002-04-23 | 2004-07-05 | 삼성전자주식회사 | 저전력 고효율의 액정표시장치 구동 전압 발생 회로 및 그방법 |
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Cited By (2)
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