CN101295481A - 栅极驱动电路和具有该栅极驱动电路的液晶显示器 - Google Patents

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Abstract

本发明公开了一种栅极驱动电路和一种具有该栅极驱动电路的液晶显示器。该栅极驱动电路具有第一级，第一级包括：上拉驱动单元，从第二级接收第一进位信号并且分别在预先时间段期间、栅极活跃时间段期间、第一栅极不活跃时间段期间和第二栅极不活跃时间段期间向第一节点输出具有第一电压、第二电压、第三电压和第四电压的控制信号；上拉单元，接收控制信号并且在栅极活跃时间段期间向第二节点输出栅极导通信号；进位输出单元，接收控制信号并且在栅极活跃时间段期间向第三级输出第二进位信号；下拉单元，接收来自第二级的栅极导通信号并且在第二栅极不活跃时间段期间向第一节点输出具有第四电压电平的控制信号。

Description

栅极驱动电路和具有该栅极驱动电路的液晶显示器
技术领域
本发明涉及一种栅极驱动电路和一种具有该栅极驱动电路的液晶显示器，更具体地讲，本发明涉及一种减小了尺寸的栅极驱动电路和一种具有该栅极驱动电路的液晶显示器。
背景技术
通常，液晶显示器包括液晶面板，液晶面板具有共电极显示面板、薄膜晶体管基底及设置在共电极显示面板和薄膜晶体管基底之间的液晶层。共电极显示面板具有形成在其上的共电极和滤色器，薄膜晶体管基底具有设置在其上的开关元件和像素电极。
液晶面板还包括栅极线、数据线及连接到栅极线和数据线的像素。另外，薄膜晶体管和顺序向栅极线输出栅极信号的栅极驱动电路设置在液晶面板上。
栅极驱动电路通常包括具有彼此级联的级的移位寄存器。更具体地讲，当前级向对应的栅极线提供栅极信号，并且控制前面的级和后面的级。
每一级包括开关元件和电容器。开关元件向栅极线输出栅极信号，并且占用栅极驱动电路的尺寸的大约20％。在液晶面板中，栅极驱动电路相对于其它组件占据大的空间，这使得难以减小液晶显示器的尺寸，从而难以增大生产余量和/或提高栅极驱动电路和具有该栅极驱动电路的液晶面板的生产效率。
发明内容
在本发明的示例性实施例中，栅极驱动电路具有减小的尺寸。
本发明的另一示例性实施例提供了一种具有减小了尺寸的栅极驱动电路的液晶显示器。
本发明的示例性实施例不限于这里描述的实施例，本发明的其它示例性实施例对本领域技术人员来说将是清楚的。
根据本发明示例性实施例的栅极驱动电路包括多个级。所述多个级中的至少第一级包括：第一节点；第二节点；上拉驱动单元，接收来自第二级的第一进位信号或者接收起始信号，并且将控制信号输出到第一节点。所述控制信号在预先时间段期间具有第一电压电平，在预先时间段之后并且接近预先时间段的栅极活跃时间段期间具有高于第一电压电平的第二电压电平，在栅极活跃时间段之后并且接近栅极活跃时间段的第一栅极不活跃时间段期间具有低于第二电压电平的第三电压电平，在第一栅极不活跃时间段之后并且接近第一栅极不活跃时间段的第二栅极不活跃时间段期间具有低于第三电压电平的第四电压电平。
所述多个级中的至少第一级还包括：上拉单元，接收控制信号和时钟信号并且在栅极活跃时间段期间向第二节点输出栅极导通信号；进位输出单元，接收控制信号和时钟信号，并且在栅极活跃时间段期间向第三级输出第二进位信号；下拉单元，接收来自第二级的栅极导通信号，并且在第二栅极不活跃时间段期间向第一节点输出处于第四电压电平的控制信号。
上拉单元包括第一开关元件，第一开关元件响应控制信号向第二节点输出被时钟信号上拉的栅极导通信号。
下拉单元包括将第一节点的电压电平下拉第二开关元件，并且下拉单元不包括将第二节点的电压电平下拉的第三开关元件；第二开关元件的宽长比在第一开关元件的宽长比的大约1/20至大约1/10的范围内。
在可选示例性实施例中，下拉单元包括：第二开关元件，从第二级接收栅极导通信号并且下拉第一节点的电压电平；第三开关元件，从第二级接收栅极导通信号并且下拉第二节点的电压电平。第三开关元件的宽长比等于或小于第一开关元件的宽长比的大约1/2。
栅极驱动电路还可包括第一移位寄存器和第二移位寄存器，第一移位寄存器和第二移位寄存器中的每个具有分别与第一栅极线、第二栅极线、第三栅极线和第四栅极线对应的第一级、第二级、第三级和第四级。第一移位寄存器和第二移位寄存器中的每个的第一级、第二级、第三级和第四级分别向第一栅极线、第二栅极线、第三栅极线和第四栅极线顺序提供第一栅极导通信号、第二栅极导通信号、第三栅极导通信号和第四栅极导通信号。第一移位寄存器和第二移位寄存器中的每个的第一级接收从第一移位寄存器和第二移位寄存器中的每个的第四级输出的第四栅极导通信号，并且向第一栅极线输出第一栅极截止信号。
另外，第一移位寄存器和第二移位寄存器中的每个的第一栅极导通信号包括预充电时间段和主充电时间段，第一移位寄存器和第二移位寄存器中的每个的第二栅极导通信号的施加时间比第一移位寄存器和第二移位寄存器中的每个的第一栅极导通信号的施加时间延迟预充电时间段。
第一移位寄存器基本上沿着垂直方向布置，并且设置在其上设置有第一栅极线、第二栅极线、第三栅极线和第四栅极线的区域的第一侧；第二移位寄存器基本上沿着垂直方向布置，并且设置在其上设置有第一栅极线、第二栅极线、第三栅极线和第四栅极线的区域的相对第二侧。
第一移位寄存器和第二移位寄存器被同时导通，第一移位寄存器和第二移位寄存器还可均包括第一哑级、第二哑级和第三哑级。
在可选示例性实施例中，第一移位寄存器和第二移位寄存器被顺序导通。
在又一可选示例性实施例中，栅极驱动电路可以包括：第一移位寄存器，具有与第一栅极线对应的第一级和与第三栅极线对应的第三级；第二移位寄存器，具有与第二栅极线对应的第二级和与第四栅极线对应的第四级。第一级、第二级、第三级和第四级分别向第一栅极线、第二栅极线、第三栅极线和第四栅极线顺序提供第一栅极导通信号、第二栅极导通信号、第三栅极导通信号和第四栅极导通信号。第一级接收从第四级输出的第四栅极导通信号并且将第一栅极截止信号输出到第一栅极线。第一移位寄存器基本上沿着垂直方向布置，并且设置在其上设置有第一栅极线、第二栅极线、第三栅极线和第四栅极线的区域的第一侧；第二移位寄存器基本上沿着垂直方向布置，并且设置在其上设置有第一栅极线、第二栅极线、第三栅极线和第四栅极线的区域的相对第二侧。第一移位寄存器和第二移位寄存器被顺序导通。
根据本发明的另一示例性实施例，液晶显示器包括液晶面板。液晶面板包括第一至第n栅极线(其中，n是自然数)和第一至第m数据线(其中，m是自然数)；栅极驱动电路，包括与第一至第n栅极线对应的第一至第n级以及不与第一至第n栅极线对应的第n+1至第n+3级；数据驱动电路，将数据电压提供到第一至第m数据线。在液晶显示器中，第一至第n+3级顺序提供第一至第n+3栅极导通信号，栅极驱动电路的第i级(其中，1≤i≤n)接收从栅极驱动电路的第i+3级输出的栅极导通信号并且向液晶面板的第一栅极线提供栅极截止信号。
根据本发明的又一可选示例性实施例，液晶显示器包括液晶面板。液晶面板包括：第一栅极线、第二栅极线、第三栅极线和第四栅极线；第一数据线、第二数据线、第三数据线和第四数据线；像素，设置在第一栅极线、第二栅极线、第三栅极线和第四栅极线中的对应的栅极线与第一数据线、第二数据线、第三数据线和第四数据线中的对应的数据线的交叉处。
液晶显示器还包括：栅极驱动电路，具有设置在第一栅极线、第二栅极线、第三栅极线和第四栅极线中的每条的第一侧的第一移位寄存器以及设置在第一栅极线、第二栅极线、第三栅极线和第四栅极线中的每条的相对第二侧的第二移位寄存器；数据驱动电路，将数据电压提供到第一数据线、第二数据线、第三数据线和第四数据线。第一移位寄存器和第二移位寄存器均具有分别与第一栅极线、第二栅极线、第三栅极线和第四栅极线对应的第一级、第二级、第三级和第四级。
在液晶显示器中，第一移位寄存器和第二移位寄存器中的每个的第一级、第二级、第三级和第四级分别向第一栅极线、第二栅极线、第三栅极线和第四栅极线顺序提供第一栅极导通信号、第二栅极导通信号、第三栅极导通信号和第四栅极导通信号，第一移位寄存器和第二移位寄存器中的每个的第一级接收从第一移位寄存器和第二移位寄存器中的每个的第四级输出的第四栅极导通信号，并且向第一栅极线输出第一栅极截止信号。
第一移位寄存器和第二移位寄存器被同时导通，或者在可选示例性实施例中，第一移位寄存器和第二移位寄存器可以被顺序导通。
根据本发明的又一可选示例性实施例，液晶显示器包括：液晶面板，液晶面板包括第一至第n栅极线(其中，n是自然数)和第一至第m数据线(其中，m是自然数)；栅极驱动电路，具有多个级；数据驱动电路，将数据电压提供到第一至第m数据线。多个级中的至少第一级包括：第一节点和第二节点；上拉驱动单元，接收第二级的第一进位信号或者起始信号，并且向第一节点输出控制信号。控制信号在预先时间段期间具有第一电压电平，在预先时间段之后并且接近预先时间段的栅极活跃时间段期间具有高于第一电压电平的第二电压电平，在栅极活跃时间段之后并且接近栅极活跃时间段的第一栅极不活跃时间段期间具有低于第二电压电平的第三电压电平，在第一栅极不活跃时间段之后并且接近第一栅极不活跃时间段的第二栅极不活跃时间段期间，具有低于第三电压电平的第四电压电平。多个级中的至少第一级还包括：上拉单元，接收控制信号和时钟信号并且在栅极活跃时间段期间向第二节点输出栅极导通信号；进位输出单元，接收控制信号和时钟信号，并且在栅极活跃时间段期间向第三级输出第二进位信号；下拉单元，接收来自第二级的栅极导通信号，并且在第二栅极不活跃时间段期间向第一节点输出处于第四电压电平的控制信号。
上拉单元包括第一开关元件，第一开关元件响应控制信号向第二节点输出被时钟信号上拉的栅极导通信号。
下拉单元包括将第一节点的电压电平下拉的第二开关元件，并且不包括将第二节点的电压电平下拉的第三开关元件；第二开关元件的宽长比在第一开关元件的宽长比的大约1/20至大约1/10的范围内。
在可选的示例性实施例中，下拉单元包括：第二开关元件，从第二级接收栅极导通信号并且下拉第一节点的电压电平；第三开关元件，从第二级接收栅极导通信号并且下拉第二节点的电压电平。第三开关元件的宽长比等于或小于第一开关元件的宽长比的大约1/2。
附图说明
通过参照附图对本发明示例性实施例进行的更详细的描述，本发明的以上和其它方面、特征及优点将变得更容易清楚，在附图中：
图1是根据本发明示例性实施例的液晶显示器的框图；
图2和图3是根据本发明示例性实施例的栅极驱动电路的移位寄存器的框图；
图4是图2中的根据本发明示例性实施例的移位寄存器的级的内部电路结构的示意性电路图；
图5是示出了图4中的根据本发明示例性实施例的移位寄存器的级的操作的信号波形时序图；
图6是根据本发明可选示例性实施例的移位寄存器的级的内部电路结构的示意性电路图；
图7和图8是根据本发明可选示例性实施例的栅极驱动电路的移位寄存器的框图。
具体实施方式
现在，在下文中将参照附图来更充分地描述本发明，附图中示出了本发明的示例性实施例。然而，本发明可以以许多不同的形式实施，而不应该被理解为限于这里提出的实施例。相反，提供这些实施例使得本公开将是彻底和完全的，并且将把本发明的范围充分传达给本领域技术人员。相同的标号始终表示相同的元件。
应该理解，当元件被称作“在另一元件上”时，该元件可以直接在另一元件上，或者可以在这两个元件之间存在中间元件。相反，当元件被称作“直接在另一元件上”时，不存在中间元件。如这里使用的，术语“和/或”包括相关列出项中的一个或多个的任意组合和所有组合。
应该理解，尽管这里可以使用术语“第一”、“第二”、“第三”等来描述不同的元件、组件、区域、层和/或部分，但是这些元件、组件、区域、层和/或部分不应该受这些术语限制。这些术语仅用来将一个元件、组件、区域、层或部分与其它元件、组件、区域、层或部分区分开。因此，在不脱离本发明教导的情况下，下面讨论的第一元件、组件、区域、层或部分可以被定义为第二元件、组件、区域、层或部分。
这里使用的技术术语仅是出于描述具体实施例的目的，并不意图成为本发明的限制。如这里使用的，除非上下文另外清楚地指出，否则单数形式也意图包括复数形式。还应该理解，当在本说明书中使用术语“包括”或“包含”时，说明存在所述特征、区域、整体、步骤、操作、元件和/或组件，但是不排除存在或添加一个或多个其它特征、区域、整体、步骤、操作、元件、组件和/或它们的组。
此外，这里可以使用相对术语例如，“下面”或“底部”和“上面”或“顶部”来描述如图中所示的一个元件与其它元件的关系。应该理解，相对术语意图包括除了图中描述的方位之外的装置的不同方位。例如，如果一幅图中的装置被翻转，则被描述为“在其它元件下侧”的元件随后将被定位为“在所述其它元件上侧”。因此，根据图中的具体方位，示例性术语“下面”可以包括“上面”和“下面”两个方位。类似地，如果一幅图中的装置被翻转，则被描述为“在其它元件下面”或“在其它元件下方”的元件随后将被定位为“在所述其它元件上面”。因此，示例性术语“在......下面”或“在......下方”可以包括上下两个方位。
除非另外定义，否则这里使用的所有术语(包括技术术语和科学术语)具有与本发明所属领域的普通技术人员所通常理解的意思相同的意思。还应该理解，术语(例如，通用字典中定义的术语)应该被解释为具有与它们在相关领域和本公开的环境中的意思一致的意思，并且除非这里明确定义，否则将不被解释为理想的或过度正式的意思。
这里，参照作为本发明理想实施例的示意性图示的剖视图来描述本发明的示例性实施例。这样，将预料到例如由制造技术和/或公差引起的图示的形状的变化。因此，本发明的实施例不应该被理解为限于这里示出的区域的具体形状，而是包括例如由制造引起的形状的偏差。例如，被示出或被描述为平坦的区域通常可具有粗糙和/或非线性的特征。此外，示出的锐角可以被倒圆。因此，图中示出的区域在本质上是示意性的，并且它们的形状不意图示出区域的精确形状，并且不意图限制本发明的范围。
现在，将参照附图来更详细地描述本发明，在附图中示出了本发明的示例性实施例。
图1是根据本发明示例性实施例的液晶显示器的框图。
如图1中所示，根据本发明示例性实施例的液晶显示器包括液晶面板300、连接到液晶面板300的第一移位寄存器400L和第二移位寄存器400R、数据驱动器500、连接到数据驱动器500的灰度电压发生器800、控制例如上述组件(但不限于上述组件)的时序控制器600及电压发生器700。
如图1中所示，液晶面板300包括多条显示信号线G1至Gn、D1至Dm(m、n为自然数)以及连接到多条显示信号线G1至Gn、D1至Dm并且基本按照矩阵图案布置的多个单位像素PX。
多条显示信号线G1至Gn、D1至Dm包括传输栅极信号的多条栅极线G1至Gn和传输数据信号的多条数据线D1至Dm。多条栅极线G1至Gn中的单条栅极线基本上沿着第一行方向延伸并且基本上彼此平行，多条数据线D1至Dm中的单条数据线基本上沿着第二列方向延伸并且基本上彼此平行。
多个单位像素PX中的每个单位像素PX包括连接到对应的栅极线和对应的数据线的开关元件(未示出)、连接到开关元件的液晶电容器(未示出)及存储电容器(未示出)。在可选示例性实施例中，可以省略存储电容器。
为了显示彩色图像，每个单位像素PX可以显示原色中的一种颜色例如，红色、绿色和蓝色中的一种颜色。在这种情况下，在与各个单位像素PX的像素电极对应的区域内设置红色滤色器、绿色滤色器和蓝色滤色器(未示出)。在示例性实施例中，滤色器设置在第二显示面板(未示出)上的对应区域，但是例如在可选示例性实施例中，滤色器可以设置在第一显示面板(未示出)的单位像素PX的像素电极的上方或下方，但不限于此。
在液晶面板300的第一显示面板(未示出)和第二显示面板(未示出)中的至少一个的外表面上安装使光偏振的偏振器(未示出)。
灰度电压发生器800接收电源电压AVDD并且产生第一灰度电压组和第二灰度电压组，第一灰度电压组和第二灰度电压组中的每个均与单位像素PX的期望透射率有关。例如，第一灰度电压组相对于共电压Vcom可以具有正值，第二灰度电压组相对于共电压Vcom可以具有负值，但不限于此。另外，在根据本发明示例性实施例的液晶显示器的反转驱动(inversion driving)期间，可以通过数据驱动器500对液晶面板交替地施加正值灰度电压和负值灰度电压。
如图1中所示，第一移位寄存器400L和第二移位寄存器400R沿着第一方向(例如，基本水平的纵向方向)设置在液晶面板300的相对的侧，并且连接到多条栅极线G1至Gn。第一移位寄存器400L和第二移位寄存器400R通过多条栅极线G1至Gn向开关元件(未示出)提供栅极信号。
数据驱动器500连接到液晶面板300的多条数据线D1至Dm，根据由灰度电压发生器800提供的第一灰度电压组和第二灰度电压组产生多个灰度电压，从多个灰度电压中选择产生的灰度电压，并将选择的产生的灰度电压提供到单位像素PX作为数据信号。通常，数据驱动器500包括多个集成电路，但不限于此。
时序控制器600产生控制第一移位寄存器400L、第二移位寄存器400R、数据驱动器500和电压发生器700的操作的控制信号，并且将控制信号提供到上述组件。
例如，电压发生器700产生多个驱动电压例如第一时钟信号CKV1(图2)、第二时钟信号CKV2(图2)和共电压Vcom，但不限于此。
现在，将参照图1来进一步详细地描述液晶显示器的操作。
时序控制器600从外部图形控制器(未示出)分别接收红色输入图像信号R、绿色输入图像信号G和蓝色输入图像信号B以及分别用于显示红色输入图像信号R、绿色输入图像信号G和蓝色输入图像信号B的输入控制信号。例如，下面的信号可以用作输入控制信号，但不限于此，这些信号为垂直同步信号Vsync、水平同步信号Hsync、主时钟信号MCLK和数据使能信号DE。时序控制器600产生例如栅极控制信号CONT1和数据控制信号CONT2，并且根据液晶面板300的操作条件和输入控制信号分别处理红色输入图像信号R、绿色输入图像信号G和蓝色输入图像信号B，以产生图像数据信号DAT。时序控制器600向第一移位寄存器400L和第二移位寄存器400R传输栅极控制信号CONT1，向数据驱动器500传输数据控制信号CONT2和图像数据信号DAT，向电压发生器700传输电压选择信号SEL。
栅极控制信号CONT1包括：第一起始信号STV1(图2)和第二起始信号STV2(图2)，开始栅极导通信号Von(未示出)的输出；输出使能信号OE(未示出)，限定栅极导通信号Von的宽度。
数据控制信号CONT2包括：水平同步起始信号STH(未示出)，开始向数据驱动器500输入图像数据信号DAT；数据加载信号TP(未示出)，使数据信号(未示出)被传输到多条数据线D1至Dm中的数据线；数据时钟信号HCLK(未示出)；反转信号RVS(未示出)，将数据电压的极性反转。在示例性实施例中，数据电压的极性相对于共电压Vcom被反转。
数据驱动器500响应来自时序控制器600的数据控制信号CONT2接收与给定行的单位像素PX对应的图像数据信号DAT，从多个灰度电压中选择与该图像数据信号DAT对应的合适的灰度电压，从而将该图像数据信号DAT转换为对应的数据电压。
第一移位寄存器400L和第二移位寄存器400R响应栅极控制信号CONT1向多条栅极线G1至Gn提供栅极导通信号Von，以导通连接到多条栅极线G1至Gn中的对应的单条栅极线的对应的开关元件(未示出)。
当向多条栅极线G1至Gn中的对应的栅极线提供栅极导通信号Von并且连接到对应的栅极线的对应的开关元件处于导通状态时，例如，在一个水平时间段(1H)，数据驱动器500向多条数据线D1至Dm中的对应的数据线提供数据电压。通过处于导通状态的开关元件将提供到多条数据线D1至Dm中的对应的数据线的数据电压施加到对应的单位像素PX。
液晶面板300的液晶层(未示出)中的液晶分子的取向根据单位像素PX的像素电极和共电极(未示出)之间产生的电场的变化而变化，这引起穿过液晶层的光的偏振发生变化。光的偏振的变化引起穿过偏振器(未示出)的光的透射率发生变化，从而显示一行期望的图像。
按照类似的方式，对多条栅极线G1至Gn中的每条栅极线顺序施加栅极导通信号Von，使得在一帧期间对每行单位像素PX施加数据电压，从而显示一帧期望的图像。当显示完一帧时，开始显示随后的帧。在示例性实施例中，控制对数据驱动器500施加的反转信号RVS(未示出)的状态，使得对每个单位像素PX施加的数据电压的极性与在前一帧中对每个单位像素PX施加的数据电压的极性相反(帧反转)。在可选示例性实施例中，在同一帧中，对一条数据线施加的数据电压的极性可以根据反转信号RVS被反转(行反转)，或者对像素行施加的数据电压的极性可以彼此不同(点反转)。
现在，将参照图2至图5来进一步详细地描述根据本发明示例性实施例的栅极驱动电路中使用的第一移位寄存器400L和第二移位寄存器400R。
图2和图3是根据本发明示例性实施例的栅极驱动电路中的移位寄存器的框图，图4是图2中的根据本发明示例性实施例的移位寄存器的级的示意性电路图，图5是示出了图4中的根据本发明示例性实施例的移位寄存器的级的操作的信号波形时序图。
返回参照图1和图2，第一移位寄存器400L连接到多条栅极线G1至Gn中的每条栅极线的第一端，第二移位寄存器400R连接到多条栅极线G1至Gn中的每条栅极线的第二相对端。在根据本发明示例性实施例的操作中，第一移位寄存器400L和第二移位寄存器400R被同时导通，从而从第一移位寄存器400L和第二移位寄存器400R输出的栅极信号Gout1、Gout2、...、Gout(j)被同时提供给多条栅极线G1至Gn中的对应的栅极线。
参照图2，第一移位寄存器400L包括顺序输出栅极信号Gout1、Gout2、...、Gout(j)的多个左边的级STL1、STL2、...、STL(j)，第二移位寄存器400R包括也顺序输出栅极信号Gout1、Gout2、...、Gout(j)的多个右边的级STR1、STR2、...、STR(j)。
多个左边的级STL1、STL2、...、STL(j)中的奇数的左边的级STL1、STL3和STL5彼此级联，多个左边的级STL1、STL2、...、STL(j)中的偶数的左边的级STL2、STL4和STL6彼此级联。类似地，多个右边的级STR1、STR2、...、STR(j)中的奇数的右边的级STR1、STR3和STR5彼此级联，多个右边的级STR1、STR2、...、STR(j)中的偶数的右边的级STR2、STR4和STR6彼此级联。
在本发明的示例性实施例中，第一移位寄存器400L和第二移位寄存器400R具有基本相同的结构。因此，下面将仅进一步详细地描述第一移位寄存器400L，将省略关于第二移位寄存器400R的重复的描述。
参照图2，多个左边的级STL1、STL2、...、STL(j)中的每个级包括第一时钟端CK1、第二时钟端CK2、设置端S、复位端R、电源电压端GV、帧复位端FR、栅极输出端OUT1和进位输出端(carry output terminal)OUT2。
如图2中所示，在对奇数的左边的级STL1施加第一起始信号STV1的同时，向奇数的左边的级STL1、STL3和STL5提供第一时钟信号CKV1、第一反相时钟信号CKVB1和栅极截止信号Voff。在向偶数的左边的级STL2提供第二起始信号STV2的同时，向偶数的左边的级STL2、STL4和STL6提供第二时钟信号CKV2、第二反相时钟信号CKVB2和栅极截止信号Voff。
第一反相时钟信号CKVB1的相位相对于第一时钟信号CKV1的相位被反相，第二反相时钟信号CKVB2的相位相对于第二时钟信号CKV2的相位被反相。另外，第二时钟信号CKV2比第一时钟信号CKV1延迟第一时钟信号CKV1的一个周期(T)的四分之一(T/4)，第二反相时钟信号CKVB2比第一反相时钟信号CKVB1延迟第一反相时钟信号CKVB1的一个周期(T)的四分之一(T/4)，如图5中所示。
代替前面的级的进位信号，第一起始信号STV1输入到第一个左边的级STL1的设置端S，第二起始信号STV2输入到第二个左边的级STL2的设置端S，如图2中所示。第二起始信号STV2比第一起始信号STV1延迟一个周期(T)的四分之一(T/4)，如图5中所示。
类似地，代替用于最后一级STL(j)的栅极信号，第一起始信号STV1输入到最后的级STL(j)的复位端R，如图2中所示。
仍然参照图2，在左边的第三个左边的级STL3中，例如，分别向第三个左边的级STL3的设置端S和复位端R输入前面的级(例如，第一个左边的级STL1)的进位信号和后面的级(例如，第六个左边的级STL6)的栅极信号Gout6，并且分别对第三个左边的级STL3的第一时钟端CK1和第二时钟端CK2输入第一反相时钟信号CKVB1和第一时钟信号CKV1。另外，向第三个左边的级STL3的电源电压端GV输入栅极截止信号Voff，向第三个左边的级STL3的帧复位端FR输入初始信号INT。最后，栅极输出端OUT1输出栅极信号Gout3，进位输出端OUT2输出提供到第五个左边的级STL5的设置端S的进位信号。
向多个左边的级STL1、STL2、...、STL(j)中的每个左边的级的帧复位端FR提供最后一个左边的级STL(j)的进位信号作为初始信号INT。
出于解释的目的，图3中示出了具有七个级(例如，j＝7)的移位寄存器的框图，但是本发明的可选示例性实施例不限于此。
参照图1和图3，左边的级STL1、STL2、STL3和STL4分别向栅极线G1、G2、G3和G4提供栅极信号Gout1、Gout2、Gout3和Gout4。左边的哑级(dummy left stage)STL5、STL6和STL7分别输出提供到左边的级STL2、STL3和STL4的栅极信号Gout5、Gout6和Gout7。
另外，左边的级STL4的栅极信号Gout4输入到左边的级STL1的复位端R、左边的级STL6的栅极信号Gout6输入到左边的级STL3的复位端R。左边的级STL5的栅极信号Gout5输入到左边的级STL2的复位端R，左边的级STL7的栅极信号Gout7输入到左边的级STL4的复位端R。因此，偶数的左边的级STL4和STL6的栅极信号分别输入到奇数的左边的级STL1和STL3的复位端R，奇数的左边的级STL5和STL7的栅极信号分别输入到偶数的左边的级STL2和STL4的复位端R。因此，在本发明的示例性实施例中，可以调节每个级的复位时间。
现在，将参照图4来进一步详细地描述第一移位寄存器400L和第二移位寄存器400R中的每一级的内部电路。
如上所述，第一移位寄存器400L和第二移位寄存器400R具有基本上相同的结构。因此，将仅进一步详细地描述第一移位寄存器400L，下面将省略对第二移位寄存器400R的重复描述。
参照图4，每个级(例如，级STL(j))包括上拉(pull-up)驱动单元211、下拉(pull-down)单元212、上拉单元213、进位输出单元214、波纹防止单元215、开关单元216、保持(holding)单元217和复位单元218。
上拉驱动单元211包括开关元件T4、第一电容器C1和第二电容器C2。开关元件T4的栅极和源极均连接到设置端S，开关元件T4的漏极连接到第一节点N1。第一电容器C1连接在第一节点N1和第二节点N2之间，第二电容器C2连接在第一节点N1和进位输出端OUT2之间。
下拉单元212包括开关元件T9，开关元件T9具有连接到复位端R的栅极、连接到电源电压端GV的源极和连接到第一节点N1的漏极。
上拉单元213包括开关元件T1，开关元件T1具有连接到第一节点N1的栅极、连接到第一时钟端CK1的源极和连接到栅极输出端OUT1并连接至第二节点N2的漏极。在操作中，上拉单元21 3向栅极输出端OUT1输出被通过第一时钟端CK1提供的第一时钟信号CKV1上拉到栅极导通信号Von的栅极信号Gout(j)。
在本发明的示例性实施例中，开关元件T9的宽长比(aspect ratio)可以在开关元件T1的宽长比的大约1/20至大约1/10的范围内。
进位输出单元214包括开关元件T15，开关元件T15具有连接到第一节点N1的栅极、连接到第一时钟端CK1的源极和连接到进位输出端OUT2的漏极。在操作中，进位输出单元214向进位输出端OUT2输出被通过第一时钟端CK1提供的时钟信号CKV1上拉的进位信号Cout(j)。
波纹防止单元215包括串联连接在设置端S和电源电压端GV之间的开关元件T11、T10和T5。更具体地讲，开关元件T11具有连接到第二时钟端CK2的栅极、连接到设置端S的源极和连接到第一节点N1的漏极。开关元件T10具有连接到第一时钟端CK1的栅极、连接到第二节点N2的源极和连接到第一节点N1的漏极。开关元件T5具有连接到第二时钟端CK2的栅极、连接到电源电压端GV的源极和连接到第二节点N2的漏极。
开关元件T10响应第一时钟信号CKV1将来自第二节点N2的信号提供到第一节点N1，以防止从栅极输出端OUT1输出的栅极信号Gout(j)的波纹。开关元件T11响应通过第二时钟端CK2提供的第一反相时钟信号CKVB1向第一节点N1提供来自不同级的进位信号(例如，前面的级的进位信号Cout(j-2))，以进一步防止从栅极输出端OUT1输出的栅极信号Gout(j)的波纹。另外，开关元件T5响应通过第二时钟端CK2提供的第一反相时钟信号CKVB1向第二节点N2提供栅极截止信号Voff，以防止从栅极输出端OUT1输出的栅极信号Gout(j)的波纹。
开关单元216包括开关元件T12、T7、T13和T8、第三电容器C3和第四电容器C4，并且将保持单元217的开关元件T3导通或截止。
更具体地讲，开关元件T12具有连接到第一时钟端CK1的栅极和源极以及连接到第三节点N3的漏极。开关元件T7具有连接到第三节点N3的栅极、连接到第一时钟端CK1的源极和连接到第四节点N4的漏极。第三电容器C3连接在第一时钟端CK1和第三节点N3之间，第四电容器C4连接在第三节点N3和第四节点N4之间。开关元件T13和T8具有均连接到第二节点N2的栅极、均连接到电源电压端GV的源极和分别连接到第三节点N3和第四节点N4的漏极。
当开关元件T12和T7响应第一时钟信号CKV1导通时，第一时钟信号CKV1提供到第三节点N3和第四节点N4，从栅极输出端OUT1输出高电平栅极信号Gout(j)，例如，栅极导通信号Von。接着，开关元件T13和T8导通，第三节点N3和第四节点N4的电压电平降低为低电平，例如，降低为栅极截止信号Voff。因此，保持单元217的开关元件T3被保持在截止状态。
接着，当从栅极输出端OUT1输出低电平栅极信号Gout(j)例如栅极截止信号Voff时，开关元件T13和T8均被截止。随后，响应时钟信号CKV1，开关元件T12和T7被导通，高电平的第一时钟信号CKV1被提供到第四节点N4，开关元件T3向栅极输出端OUT1输出栅极截止信号Voff作为栅极信号Gout(j)。因此，从栅极输出端OUT1输出栅极截止信号Voff。
保持单元217经过第四节点N4连接到开关单元216，并且包括开关元件T3，开关元件T3具有连接到第四节点N4的栅极、连接到电源电压端GV的源极和连接到栅极输出端OUT1(例如，节点N2)的漏极。
复位单元218经过第一节点N1连接到上拉驱动单元211，并且包括开关元件T6，开关元件T6具有连接到帧复位端FR的栅极、连接到电源电压端GV的源极和连接到第一节点N1的漏极。开关元件T6响应前面的级的前面的进位信号Cout(j-2)将通过设置端输入的噪声放电至栅极截止信号Voff。因此，栅极截止信号Voff被输出到第一节点N1，开关元件T1和T15被截止，以将栅极输出端OUT1和进位输出端OUT2复位。
现在，将参照图4和图5来进一步详细地描述第一移位寄存器400L和第二移位寄存器400R中的每一级的内部电路的操作。
如图5中所示，提供到第一栅极线G1的栅极信号Gout1包括预充电时间段P1和主充电时间段M1，提供到第二栅极线G2的栅极信号Gout2比栅极信号Gout1延迟预充电时间段P1。
参照图4和图5，当在时间t1上拉驱动单元211的开关元件T4响应第一起始信号STV1(图2和图3)或者不同级的进位信号(例如，Cout(j-2)，图4)而被导通时，第一电容器C1和第二电容器C2被充电。因此，第一节点N1在保持2H的预先时间段“a”期间具有第一电压电平，直到时间t2。
在时间t2，上拉驱动单元211的开关元件T4被截止，从而第一节点N1被浮置，处于高电平的第一时钟信号CKV1被提供到第一时钟端CK1，上拉单元213的开关元件T1和进位输出单元214的开关元件T15导通。因此，提供到第一时钟端CK1的时钟信号CKV1分别从栅极输出端OUT1和进位输出端OUT2输出作为栅极信号Gout(j)和进位信号Cout(j)。此时，开关元件T1导通，第一节点N1在保持2H的栅极活跃时间段(gate active period)“b”期间具有比第一电压电平高的第二电压电平。
在时间t3，开关元件T1仍然处于导通状态，提供到第一时钟端CK1的时钟信号CKV1从栅极输出端OUT1输出作为栅极信号Gout(j)。此时，第一节点N1在保持1H的第一栅极不活跃时间段(gate inactive period)“c”期间具有低于第二电压电平的第三电压电平。第一栅极不活跃时间段“c”是后面级的栅极信号Gout(j+3)输入到下拉单元212的开关元件T9的栅极之前的时间段。
在时间t4，开关元件T9响应施加到开关元件T9的栅极的后面级的栅极信号Gout(j+3)而被导通，第一节点N1在第二栅极不活跃时间段“d”期间具有低于第三电压电平的第四电压电平，例如，第四电压电平基本上等于栅极截止信号Voff的电平。此时，通过导通的开关元件T9，存储在第一电容器C1和第二电容器C2中的电荷被放电至栅极截止信号Voff。
如上所述，根据本发明的示例性实施例，将后面级的栅极信号Gout(j+3)提供到第j级(例如，STL(j))的复位端R，从而在开关元件T1向第二节点输出栅极截止信号的第一栅极不活跃时间段期间，级STL(j)的第一节点具有恒定的电压电平。因此，开关元件T9作为单个的开关元件，通过去除任何附加的开关元件(否则这些开关元件将占据栅极驱动电路的另外的面积)来有效地减少液晶面板中栅极驱动电路的面积。
图6是根据本发明可选示例性实施例的移位寄存器的级的内部电路结构的示意性电路图。
参照图6，每个级(例如，级STL(j))包括上拉驱动单元211、下拉单元212、补充下拉单元312、上拉单元213、进位输出单元214、波纹防止单元215、开关单元216、保持单元217和复位单元218。
除了补充下拉单元312之外，在下文中参照图6进一步详细描述的根据本发明可选示例性实施例的级STL(j)与如上参照图4描述的示例性实施例的级STL(j)基本相同。因此，相同或相似的组件在图4和图6中具有相同的标号，下面将省略对相同或相似组件的任何重复描述。
补充下拉单元312包括开关元件T2，开关元件T2具有连接到复位端R以从后面的级STL(j+3)接收栅极信号Gout(j+3)的栅极、连接到电源电压端GV的源极和连接到栅极输出端OUT1(例如，节点N2)的漏极。
开关元件T2的宽长比可以小于或者等于上拉单元213的开关元件T1的宽长比的大约1/2。
现在，将参照图5和图6来进一步详细地描述根据可选示例性实施例的具有补充下拉单元312的级STL(j)的操作。
参照图5和图6，当在时间t1，上拉驱动单元211的开关元件T4响应第一起始信号STV1(图2和图3)或者前面的级的进位信号(例如，Cout(j-2)，图6)而被导通时，第一电容器C1和第二电容器C2被充电。因此，第一节点N1在保持2H的预先时间段“a”(例如，直到时间t2)期间具有第一电压电平。
在时间t2，上拉驱动单元211的开关元件T4被截止，从而第一节点N1被浮置，处于高电平的第一时钟信号CKV1被提供到第一时钟端CK1，上拉单元213的开关元件T1和进位输出单元214的开关元件T15导通。因此，提供到第一时钟端CK1的时钟信号CKV1分别从栅极输出端OUT1和进位输出端OUT2输出作为栅极信号Gout(j)和进位信号Cout(j)。此时，开关元件T1被导通，在保持2H的栅极活跃时间段“b”期间，第一节点N1具有高于第一电压电平的第二电压电平。
在时间t3，开关元件T1仍然处于导通状态，提供到第一时钟端CK1的时钟信号CKV1从栅极输出端OUT1输出作为栅极信号Gout(j)。此时，第一节点N1在保持1H的第一栅极不活跃时间段“ c”期间具有低于第二电压电平的第三电压电平。第一栅极不活跃时间段“c ”是后面级的栅极信号Gout(j+3)输入到下拉单元212的开关元件T9的栅极和补充下拉单元312的开关元件T2的栅极之前的时间段。
在时间t4，下拉单元212的开关元件T9响应后面级的栅极信号Gout(j+3)而被导通，从而第一节点N1在第二栅极不活跃时间段“d”期间具有低于第三电压电平的第四电压电平(例如，等于栅极截止信号Voff的电平的电平)。另外，在时间t4，补充下拉单元312的开关元件T2响应后面级的栅极信号Gout(j+3)而被导通，从而在第二栅极不活跃时间段“d”期间，第二节点N2具有低于第三电压电平的第四电压电平(例如，等于栅极截止信号Voff的电平的电压电平)。因此，通过下拉单元212的开关元件T9和补充下拉单元312的开关元件T2，存储在第一电容器C1和第二电容器C2中的电荷被放电至栅极截止信号Voff。
如上所述，根据本发明的可选示例性实施例，通过减小开关元件T2的尺寸以使其具有小于或者等于开关元件T1的宽长比的大约1/2的宽长比，来有效地减小液晶面板中栅极驱动电路的面积。因此有效地提高栅极驱动电路的产率，结果基本上提高了具有该栅极驱动电路的液晶显示器的生产效率并降低了其生产成本。
图7和图8是根据本发明可选示例性实施例的栅极驱动电路的移位寄存器的框图。
参照图1和图7，第一移位寄存器400L连接到多条栅极线G1至Gn中的每条栅极线的第一端，第二移位寄存器400R连接到多条栅极线G1至Gn中的每条栅极线的第二相对端。第一移位寄存器400L和第二移位寄存器400R被交替地导通。例如，从第一移位寄存器400L输出提供到第一栅极线G1的栅极信号Gout1，接着从第二移位寄存器400R输出提供到第二栅极线G2的栅极信号Gout2。
如图5中所示，提供到第一栅极线G1的栅极信号Gout1包括预充电时间段P1和主充电时间段M1，提供到第二栅极线G2的栅极信号Gout2比栅极信号Gout1延迟预充电时间段P1。
第一移位寄存器400L包括顺序输出奇数栅极信号的多个左边的级STL1、STL2、...、STL(j)，第二移位寄存器400R包括顺序输出偶数栅极信号的多个右边的级STR1、STR2、...、STR(j)。具有多个左边的级STL1、STL2、...、STL(j)的对应的左边的级和具有多个右边的级STR1、STR2、...、STR(j)的对应的右边的级分别彼此级联。
参照图7，多个奇数的左边的级STL1、STL3、STL5和STL7及多个偶数的右边的级STR2、STR4、STR6和STR8均具有第一时钟端CK1、第二时钟端CK2、设置端S、复位端R、电源电压端GV、帧复位端FR、栅极输出端OUT1和进位输出端OUT2。
相反，多个偶数的左边的级STL2、STL4、STL6和STL8及多个奇数的右边的级STR1、STR3、STR5和STR7均具有电源电压端GV、复位端R和栅极输出端OUT1。
如图7中所示，在将第一起始信号STV1施加到奇数的左边的级STL1的同时，将第一时钟信号CKV1、第一反相时钟信号CKVB1和栅极截止信号Voff提供到多个奇数的左边的级STL1、STL3、STL5和STL7中的每个级。在将第二起始信号STV2提供到偶数的右边的级STR2的同时，将第二时钟信号CKV2、第二反相时钟信号CKVB2和栅极截止信号Voff提供到多个偶数的右边的级STR2、STR4、STR6和STR8中的每个级。
第一反相时钟信号CKVB1的相位相对于第一时钟信号CKV1的相位被反相，第二反相时钟信号CKVB2的相位相对于第二时钟信号CKV2的相位被反相。另外，第二时钟信号CKV2比第一时钟信号CKV1延迟第一时钟信号CKV1的一个周期(T)的四分之一(T/4)，并且第二反相时钟信号CKVB2比第一反相时钟信号CKVB1延迟第一反相时钟信号CKVB1的一个周期(T)的四分之一(T/4)。
代替前面级的进位信号，第一起始信号STV1被输入到第一个左边的级STL1的设置端S，第二起始信号STV2被输入到第二个右边的级STR2的设置端S。第二起始信号STV2比第一起始信号STV1延迟一个周期(T)的四分之一(T/4)。
将第一起始信号STV1输入到最后一个左边的级STL(j)和最后一个右边的级STR(j)的复位端R。
在多个奇数的左边的级STL1、STL3、STL5和STL7中的每个级(例如，第三个左边的级STL3)中，例如，分别将前面的左边的级STL1的进位信号和后面的右边的级STR6的栅极信号Gout6输入到第三个左边的级STL3的设置端S和复位端R，并且将第一反相时钟信号CKVB1和第一时钟信号CKV1分别输入到第三个左边的级STL3的第一时钟端CK1和第二时钟端CK2。另外，将栅极截止信号Voff输入到第三个左边的级STL3的电源电压端GV，将初始信号INT输入到第三个左边的级STL3的帧复位端FR。栅极输出端OUT1输出栅极信号Gout3，进位输出端OUT2输出进位信号Cout3。
后面的右边的级STR6的栅极信号Gout6同时被输入到第三个左边的级STL3的复位端R和第三个右边的级STR3的复位端R。
最后，最后一级STL(j)的进位信号Cout(j)提供到多个级STL1、STL2、...、STL(j)中的每一奇数级作为初始信号INT。
出于解释的目的，图8中示出了具有九个级(例如，j＝9)的移位寄存器的框图，但是本发明的可选示例性实施例不限于此。
参照图1和图8，在左边的哑级STL7、STL8、STL9和右边的哑级STR7、STR8、STR9向左边的第四个级STL4和右边的第四个级STR4、左边的第五个级STL5和右边的第五个级STR5、左边的第六个级STL6和右边的第六个级STR6分别提供栅极信号Gout7至Gout9时，奇数的左边的级STL1、STL3和STL5、偶数的右边的级STR2、STR4和STR6向六条栅极线G1至G6提供栅极信号Gout1至Gout6。
右边的级STR4的栅极信号Gout4输入到左边的级STL1的复位端R和右边的级STR1的复位端R。右边的级STR6的栅极信号Gout6输入到左边的级STL3的复位端R和右边的级STR3的复位端R。
左边的级STL5的栅极信号Gout5输入到右边的级STR2的复位端R和左边的级STL2的复位端R。左边的级STL7的栅极信号Gout7输入到右边的级STR4的复位端R和左边的级STL4的复位端R。因此，在可选示例性实施例中，可以通过改变连接到对应的复位端R的级来调节每个级的复位时间。
参照图7和图8，第一移位寄存器400L的多个奇数的左边的级和第二移位寄存器400R的多个偶数的右边的级的结构与上面参照图1至图6更详细描述的结构基本相同。因此，多个奇数的左边的级和多个偶数的右边的级可以包括与如图4和图6中所示的电路相同的电路，因此这里将省略对相同电路的任何重复描述。
与前面的上述本发明的可选示例性实施例相同或相似的优点和/或益处由参照图7和图8描述的示例性实施例产生。
如上面更详细的描述，在根据本发明示例性实施例的栅极驱动电路和包括该栅极驱动电路的液晶显示器中，可以减小在栅极驱动电路中的晶体管的宽长比，从而有效地减小栅极驱动电路的尺寸，并且提供了改进的生产余量，在生产效率方面有所提高并且降低了栅极驱动电路和具有该栅极驱动电路的液晶面板的生产成本。
本发明不应该被理解为限于这里提出的示例性实施例。相反，提供这些示例性实施例，使得本公开将是彻底和完全的，并且将把本发明的构思充分传达给本领域技术人员。
尽管已经参照本发明的示例性实施例具体示出和描述了本发明，但是本领域普通技术人员应该理解，在不脱离由权利要求限定的本发明的精神或范围的情况下，可以对此进行形式和细节上的各种改变。

Claims (23)

1、一种栅极驱动电路，所述栅极驱动电路包括多个级，其中，所述多个级中的至少第一级包括：
第一节点和第二节点；
上拉驱动单元，接收来自多个级中的第二级的第一进位信号或者接收起始信号，并且将控制信号输出到第一节点，所述控制信号：
在预先时间段期间具有第一电压电平，
在预先时间段之后并且接近预先时间段的栅极活跃时间段期间，具有高于第一电压电平的第二电压电平，
在栅极活跃时间段之后并且接近栅极活跃时间段的第一栅极不活跃时间段期间，具有低于第二电压电平的第三电压电平，
在第一栅极不活跃时间段之后并且接近第一栅极不活跃时间段的第二栅极不活跃时间段期间，具有低于第三电压电平的第四电压电平；
上拉单元，接收控制信号和时钟信号并且在栅极活跃时间段期间向第二节点输出栅极导通信号；
进位输出单元，接收控制信号和时钟信号，并且在栅极活跃时间段期间向第三级输出第二进位信号；
下拉单元，接收来自第二级的栅极导通信号，并且在第二栅极不活跃时间段期间向第一节点输出具有第四电压电平的控制信号。
2、根据权利要求1所述的栅极驱动电路，其中，上拉单元包括第一开关元件，第一开关元件响应控制信号向第二节点输出被时钟信号上拉的栅极导通信号。
3、根据权利要求2所述的栅极驱动电路，其中，下拉单元包括将第一节点的电压电平下拉的第二开关元件，并且下拉单元不包括将第二节点的电压电平下拉的第三开关元件。
4、根据权利要求3所述的栅极驱动电路，其中，第二开关元件的宽长比在第一开关元件的宽长比的大约1/20至大约1/10的范围内。
5、根据权利要求2所述的栅极驱动电路，其中，下拉单元包括：
第二开关元件，从第二级接收栅极导通信号并且下拉第一节点的电压电平；
第三开关元件，从第二级接收栅极导通信号并且下拉第二节点的电压电平。
6、根据权利要求5所述的栅极驱动电路，其中，第三开关元件的宽长比等于或小于第一开关元件的宽长比的大约1/2。
7、根据权利要求1所述的栅极驱动电路，包括：
第一移位寄存器和第二移位寄存器，第一移位寄存器和第二移位寄存器中的每个包括分别与第一栅极线、第二栅极线、第三栅极线和第四栅极线对应的第一级、第二级、第三级和第四级，
其中，第一移位寄存器和第二移位寄存器中的每个的第一级、第二级、第三级和第四级分别向第一栅极线、第二栅极线、第三栅极线和第四栅极线顺序提供第一栅极导通信号、第二栅极导通信号、第三栅极导通信号和第四栅极导通信号，
第一移位寄存器和第二移位寄存器中的每个的第一级接收从第一移位寄存器和第二移位寄存器中的每个的第四级输出的第四栅极导通信号，并且向第一栅极线输出第一栅极截止信号。
8、根据权利要求7所述的栅极驱动电路，其中，
第一移位寄存器和第二移位寄存器中的每个的第一栅极导通信号包括预充电时间段和主充电时间段，
第一移位寄存器和第二移位寄存器中的每个的第二栅极导通信号的施加时间比第一移位寄存器和第二移位寄存器中的每个的第一栅极导通信号的施加时间延迟预充电时间段。
9、根据权利要求7所述的栅极驱动电路，其中，
第一移位寄存器基本上沿着垂直方向布置，并且设置在其上设置有第一栅极线、第二栅极线、第三栅极线和第四栅极线的区域的第一侧，
第二移位寄存器基本上沿着垂直方向布置，并且设置在其上设置有第一栅极线、第二栅极线、第三栅极线和第四栅极线的区域的相对第二侧。
10、根据权利要求9所述的栅极驱动电路，其中，第一移位寄存器和第二移位寄存器被同时导通。
11、根据权利要求10所述的栅极驱动电路，其中，第一移位寄存器和第二移位寄存器均还包括第一哑级、第二哑级和第三哑级。
12、根据权利要求9所述的栅极驱动电路，其中，第一移位寄存器和第二移位寄存器被顺序导通。
13、根据权利要求1所述的栅极驱动电路，包括：
第一移位寄存器，具有与第一栅极线对应的第一级和与第三栅极线对应的第三级；
第二移位寄存器，具有与第二栅极线对应的第二级和与第四栅极线对应的第四级，
其中，第一级、第二级、第三级和第四级分别向第一栅极线、第二栅极线、第三栅极线和第四栅极线顺序提供第一栅极导通信号、第二栅极导通信号、第三栅极导通信号和第四栅极导通信号，
第一级接收从第四级输出的第四栅极导通信号并且将第一栅极截止信号输出到第一栅极线，
其中，第一移位寄存器基本上沿着垂直方向布置，并且设置在其上设置有第一栅极线、第二栅极线、第三栅极线和第四栅极线的区域的第一侧，
第二移位寄存器基本上沿着垂直方向布置，并且设置在其上设置有第一栅极线、第二栅极线、第三栅极线和第四栅极线的区域的相对第二侧，
第一移位寄存器和第二移位寄存器被顺序导通。
14、一种液晶显示器，包括：
液晶面板，包括第一至第n栅极线和第一至第m数据线，其中，n是自然数，m是自然数；
栅极驱动电路，包括分别与第一至第n栅极线对应的第一至第n级以及不与第一至第n栅极线对应的第n+1至第n+3级；
数据驱动电路，将数据电压提供到第一至第m数据线，
其中，第一至第n+3级顺序提供第一至第n+3栅极导通信号，
栅极驱动电路的第i级接收从栅极驱动电路的第i+3级输出的栅极导通信号并且向液晶面板的第一栅极线提供栅极截止信号，其中，1≤i≤n。
15、一种液晶显示器，包括：
液晶面板，包括：
第一栅极线、第二栅极线、第三栅极线和第四栅极线；
第一数据线、第二数据线、第三数据线和第四数据线；
像素，设置在第一栅极线、第二栅极线、第三栅极线和第四栅极线中的对应的栅极线与第一数据线、第二数据线、第三数据线和第四数据线中的对应的数据线的交叉处；
栅极驱动电路，包括设置在第一栅极线、第二栅极线、第三栅极线和第四栅极线中的每条的第一侧的第一移位寄存器以及设置在第一栅极线、第二栅极线、第三栅极线和第四栅极线中的每条的相对第二侧的第二移位寄存器，第一移位寄存器和第二移位寄存器均具有分别与第一栅极线、第二栅极线、第三栅极线和第四栅极线对应的第一级、第二级、第三级和第四级；
数据驱动电路，将数据电压提供到第一数据线、第二数据线、第三数据线和第四数据线，
其中，第一移位寄存器和第二移位寄存器中的每个的第一级、第二级、第三级和第四级分别向第一栅极线、第二栅极线、第三栅极线和第四栅极线顺序提供第一栅极导通信号、第二栅极导通信号、第三栅极导通信号和第四栅极导通信号，
第一移位寄存器和第二移位寄存器中的每个的第一级接收从第一移位寄存器和第二移位寄存器中的每个的第四级输出的第四栅极导通信号，并且向第一栅极线输出第一栅极截止信号。
16、根据权利要求15所述的液晶显示器，其中，第一移位寄存器和第二移位寄存器被同时导通。
17、根据权利要求15所述的液晶显示器，其中，第一移位寄存器和第二移位寄存器被顺序导通。
18、一种液晶显示器，包括：
液晶面板，包括第一至第n栅极线和第一至第m数据线，其中，n是自然数，m是自然数；
栅极驱动电路，包括多个级；
数据驱动电路，将数据电压提供到第一至第m数据线，
其中，多个级中的至少第一级包括：
第一节点和第二节点；
上拉驱动单元，接收来自第二级的第一进位信号或者接收起始信号，并且向第一节点输出控制信号，其中，控制信号：
在预先时间段期间具有第一电压电平，
在预先时间段之后并且接近预先时间段的栅极活跃时间段期间，具有高于第一电压电平的第二电压电平，
在栅极活跃时间段之后并且接近栅极活跃时间段的第一栅极不活跃时间段期间，具有低于第二电压电平的第三电压电平，
在第一栅极不活跃时间段之后并且接近第一栅极不活跃时间段的第二栅极不活跃时间段期间，具有低于第三电压电平的第四电压电平；
上拉单元，接收控制信号和时钟信号并且在栅极活跃时间段期间向第二节点输出栅极导通信号；
进位输出单元，接收控制信号和时钟信号，并且在栅极活跃时间段期间向第三级输出第二进位信号；
下拉单元，接收来自第二级的栅极导通信号，并且在第二栅极不活跃时间段期间向第一节点输出具有第四电压电平的控制信号。
19、根据权利要求18所述的液晶显示器，其中，上拉单元包括第一开关元件，第一开关元件响应控制信号向第二节点输出被时钟信号上拉的栅极导通信号。
20、根据权利要求19所述的液晶显示器，其中，下拉单元包括将第一节点的电压电平下拉的第二开关元件，并且下拉单元不包括将第二节点的电压下拉的第三开关元件。
21、根据权利要求20所述的液晶显示器，其中，第二开关元件的宽长比在第一开关元件的宽长比的大约1/20至大约1/10的范围内。
22、根据权利要求19所述的液晶显示器，其中，下拉单元包括：
第二开关元件，从第二级接收栅极导通信号并且下拉第一节点的电压电平；
第三开关元件，从第二级接收栅极导通信号并且下拉第二节点的电压电平。
23、根据权利要求22所述的液晶显示器，其中，第三开关元件的宽长比等于或小于第一开关元件的宽长比的大约1/2。
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