CN104809978B - 移位寄存器单元、驱动方法、栅极驱动电路及显示装置 - Google Patents

移位寄存器单元、驱动方法、栅极驱动电路及显示装置 Download PDF

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Abstract

本发明提供一种移位寄存器单元、驱动方法、栅极驱动电路及显示装置，属于显示技术领域。移位寄存器单元包括：第一输出模块、第二输出模块、输入模块和控制模块，第一输出模块分别与第一信号端、第一节点和输出端连接；第二输出模块分别与输出端、第二节点和第二信号端连接；控制模块分别与第一节点、第二节点、第一信号端、第二信号端、第一时钟信号端和第二时钟信号端连接；输入模块分别与输入端、第二节点、第二时钟信号端连接。本发明通过第一输出模块、第二输出模块、输入模块和控制模块来控制输出端输出的电位高低，解决了相关技术中移位寄存器单元的电路结构通常较为复杂的问题；达到了电路结构简单且输出脉宽可调节的效果。

Description

移位寄存器单元、驱动方法、栅极驱动电路及显示装置
技术领域
本发明涉及显示技术领域，特别涉及一种移位寄存器单元、驱动方法、栅极驱动电路及显示装置。
背景技术
在显示技术领域，为了不断改善显示画面，提高用户体验，高清、窄边框显示成了研究的热门。但随着像素数目的提高，移位寄存器(栅极开关电路)在一帧时间内所需扫描的行数增加，这就要求移位寄存器单元的版图面积要更小，电路结构需要更简单。
相关技术中有一种移位寄存器单元，它通常通过多个晶体管和电容器来控制电路输出信号的电位的高低。
发明人在实现本发明的过程中，发现上述方式至少存在如下缺陷：现有技术中的移位寄存器单元的电路结构通常较为复杂，控制过程较为繁琐，无法调节输出脉宽。
发明内容
为了解决相关技术中移位寄存器单元的电路结构通常较为复杂，控制过程较为繁琐，无法调节输出脉宽的问题，本发明提供了一种移位寄存器单元、驱动方法、栅极驱动电路及显示装置。所述技术方案如下：
根据本发明的第一方面，提供一种移位寄存器单元，所述移位寄存器单元包括：第一输出模块、第二输出模块、输入模块和控制模块，
所述第一输出模块分别与第一信号端、第一节点和输出端连接，用于在所述第一节点的控制下，向所述输出端输出来自所述第一信号端的第一控制信号；
所述第二输出模块分别与所述输出端、第二节点和第二信号端连接，用于在所述第二节点的控制下，向所述输出端输出来自所述第二信号端的第二控制信号；
所述控制模块分别与所述第一节点、所述第二节点、所述第一信号端、所述第二信号端、第一时钟信号端和第二时钟信号端连接，用于在来自所述第一信号端的所述第一控制信号、所述第二信号端的所述第二控制信号、所述第一时钟信号端的第一时钟信号和所述第二时钟信号端的第二时钟信号的控制下，控制所述第一节点和所述第二节点的电位；
所述输入模块分别与输入端、所述第二节点、所述第二时钟信号端连接，用于在来自所述第二时钟信号端的所述第二时钟信号的控制下向所述第二节点输出来自所述输入端的输入信号。
可选的，所述第一输出模块包括：第一晶体管和第一电容器，
所述第一晶体管的第一极与所述第一信号端连接，所述第一晶体管的第二极与所述输出端连接，所述第一晶体管的第三极与第一节点连接；
所述第一电容器的第一极与所述第一晶体管的第一极连接，所述第一电容器的第二极与所述第一晶体管的第三极连接。
可选的，所述第二输出模块包括：第二晶体管和第三电容器，
所述第二晶体管的第一极与所述第二信号端连接，所述第二晶体管的第二极与所述输出端连接，所述第二晶体管的第三极与所述第二节点连接；
所述第三电容器的第一极与所述第二晶体管的第二极连接，所述第三电容器的第二极与所述第二晶体管的第三极连接。
可选的，所述控制模块包括：上拉控制子模块和复位子模块；
所述上拉控制子模块分别与所述第一时钟信号端、所述第二时钟信号端、所述第二信号端、所述第一节点和第三节点连接，用于在来自所述第二信号端的第二控制信号、来自所述第三节点的复位控制信号、来自所述第一时钟信号端的所述第一时钟信号和所述第二时钟信号端的所述第二时钟信号的控制下控制所述第一节点的电位；
所述复位子模块分别与所述第一节点、所述第二节点、所述第三节点、所述第一信号端和所述第二时钟信号端连接，用于在所述第一控制信号和所述第二时钟信号的控制下控制所述第一节点的电位、所述第二节点的电位和所述第三节点的电位，所述第一控制信号来自所述第一信号端，所述第二时钟信号来自所述第二时钟信号端。
可选的，所述上拉控制子模块包括：第二电容器、第七晶体管、第八晶体管和第九晶体管，
所述第七晶体管的第一极与第四节点连接，所述第七晶体管的第二极与所述第一节点连接，所述第七晶体管的第三极与所述第一时钟信号端连接；
所述第八晶体管的第二极与所述第四节点连接，所述第八晶体管的第一极与所述第一时钟信号端连接，所述第八晶体管的第三极与所述第三节点连接；
所述第九晶体管的第二极与所述第三节点连接，所述第九晶体管的第一极与所述第二信号端连接，所述第九晶体管的第三极与所述第二时钟信号端连接；
所述第二电容器的第一极与所述第三节点连接，所述第二电容器的第二极与所述第四节点连接。
可选的，所述复位子模块包括：第四晶体管、第五晶体管和第六晶体管，
所述第四晶体管的第二极与所述第一节点连接，所述第四晶体管的第一极与所述第一信号端连接，所述第四晶体管的第三极与所述第二节点连接；
所述第五晶体管的第一极与所述第二节点连接，所述第五晶体管的第二极与所述第六晶体管的第三极连接，所述第五晶体管的第三极与所述第二时钟信号端连接；
所述第六晶体管的第二极与所述第三节点连接，所述第六晶体管的第一极与所述第一信号端连接。
可选的，所述输入模块包括：第三晶体管，
所述第三晶体管的第二极与所述第二节点连接，所述第三晶体管的第一极与所述输入端连接，所述第三晶体管的第三极与所述第二时钟信号端连接。
可选的，所述晶体管均为P型晶体管。
根据本发明的第二方面，提供一种移位寄存器单元驱动方法，用于驱动第一方面所述的移位寄存器单元，所述移位寄存器单元包括：第一输出模块、第二输出模块、输入模块和控制模块，所述方法包括：
第一阶段：输入端输入的输入信号为第一电位，第二时钟信号端输入的第二时钟信号为第二电位，所述输入模块在所述第二时钟信号端输入的所述第二时钟信号的控制下，向第二节点输入所述输入信号；
第二阶段：第一时钟信号端输入的第一时钟信号为第二电位，所述第二时钟信号端输入的所述第二时钟信号为第一电位，控制所述控制模块向第一节点输入来自所述第一时钟信号端的所述第一时钟信号，在所述第一节点的控制下，所述第一输出模块向输出端输入来自第一信号端的第一控制信号；
第三阶段：所述第二节点保持第一电位，所述第二输出模块、所述输入模块和所述控制模块重复执行所述第一阶段和所述第二阶段的过程；
第四阶段：所述第二时钟信号端输入所述第二时钟信号，所述输入模块在来自所述第二时钟信号端的所述第二时钟信号的控制下向所述第二节点输出来自所述输入端的所述输入信号，所述输入信号处于第二电位，在所述第二节点的控制下，所述第二输出模块向所述输出端输入来自第二信号端的第二控制信号，所述控制模块向所述第一节点输入来自所述第一信号端的所述第一控制信号。
可选的，所述第一输出模块包括：第一晶体管和第一电容器，
所述第二阶段中，所述控制模块向所述第一节点输入来自所述第一时钟信号端的所述第一时钟信号，所述第一时钟信号处于第二电位，所述第一晶体管开启，所述第一电容器充电，所述第一晶体管向所述输出端输入来自所述第一信号端的所述第一控制信号；
所述第四阶段中，所述控制模块向所述第一节点输入来自所述第一信号端的所述第一控制信号，所述第一晶体管关断。
可选的，所述第二输出模块包括：第二晶体管和第三电容器，
所述第一阶段中，所述输入模块向所述第二节点输出来自所述输入端的所述输入信号，所述输入信号处于第一电位，所述第二晶体管关断，所述第三电容器充电；
所述第四阶段中，所述输入模块向所述第二节点输出来自所述输入端的所述输入信号，所述输入信号处于第二电位，所述第二晶体管开启，所述第二晶体管向所述输出端输出来自所述第二信号端的所述第二控制信号。
可选的，所述控制模块包括：上拉控制子模块和复位子模块，
所述第二阶段中，所述第一时钟信号端输入所述第一时钟信号，所述第一时钟信号处于第二电位，所述第二时钟信号端输入所述第二时钟信号，所述第二时钟信号处于第一电位，所述上拉控制子模块将所述第一节点复位到第二电位；
所述第四阶段中，所述输入端输入的输入信号处于第二电位，所述复位子模块向第三节点输入来自所述第一信号端的所述第一控制信号。
可选的，所述上拉控制子模块包括：第二电容器、第七晶体管、第八晶体管和第九晶体管，
所述第一阶段中，所述第二时钟信号端输入所述第二时钟信号，所述第二时钟信号处于第二电位，所述第九晶体管开启，所述第二信号端向所述第三节点输入所述第二控制信号；
所述第二阶段中，所述第一时钟信号端输入所述第一时钟信号，所述第一时钟信号处于第二电位，所述第二时钟信号端输入所述第二时钟信号，所述第二时钟信号处于第一电位，所述第九晶体管关断，所述第七晶体管开启，所述第八晶体管开启，所述第一时钟信号端向第四节点输入所述第一时钟信号，所述第四节点将所述第一节点复位到第二电位，所述第一时钟信号端输入的所述第一时钟信号跳变为第一电位后，所述第七晶体管关断。
可选的，所述复位子模块包括：第四晶体管、第五晶体管和第六晶体管，
所述第四阶段中，所述第二时钟信号端输入所述第二时钟信号，所述第二时钟信号处于第二电位，所述输入模块向所述第二节点输入来自所述输入端的所述输入信号，所述输入信号处于第二电位，所述第四晶体管开启，所述第五晶体管开启，所述第六晶体管开启，所述第一信号端向所述第一节点和所述第三节点输入所述第一控制信号。
可选的，所述输入模块包括：第三晶体管，
所述第一阶段中，所述输入端输出所述输入信号，所述输入信号处于第一电位，所述第二时钟信号端输入所述第二时钟信号，所述第二时钟信号处于第二电位，控制所述第三晶体管开启，所述第三晶体管向所述第二节点输入来自所述输入端的所述输入信号；
所述第三阶段中，在所述输入端的所述输入信号跳变为第二电位前，所述第三晶体管在来自所述第二时钟信号端的所述第二时钟信号的控制下关断，所述第二时钟信号处于第一电位；
所述第四阶段中，所述第二时钟信号端输入所述第二时钟信号，所述第二时钟信号处于第二电位，所述第三晶体管在来自所述第二时钟信号端的位于第二电位的所述第二时钟信号的控制下向所述第二节点输出来自所述输入端的第二电位，所述第二时钟信号端输入的所述第二时钟信号跳变为第一电位时，所述第三晶体管关断。
可选的，所述晶体管均为P型晶体管。
可选的，所述第一电位相对于所述第二电位为高电位。
根据本发明的第三方面，提供一种栅极驱动电路，包括至少两个级联的如第一方面所述的移位寄存器单元。
根据本发明的第四方面，提供一种显示装置，所述显示装置包括第三方面所述的栅极驱动电路。
本发明实施例提供的技术方案可以包括以下有益效果：
通过第一输出模块、第二输出模块、输入模块和控制模块来控制输出端输出的电位高低，解决了相关技术中移位寄存器单元的电路结构通常较为复杂，控制过程较为繁琐的问题；达到了电路结构简单且输出脉宽可调节的效果。
应当理解的是，以上的一般描述和后文的细节描述仅是示例性和解释性的，并不能限制本发明。
附图说明
此处的附图被并入说明书中并构成本说明书的一部分，示出了符合本发明的实施例，并与说明书一起用于解释本发明的原理。
图1是根据一示例性实施例示出的一种移位寄存器单元的结构示意图；
图2是根据一示例性实施例示出的另一种移位寄存器单元的结构示意图；
图3是根据一示例性实施例示出的另一种移位寄存器单元的结构示意图；
图4是根据一示例性实施例示出的一种移位寄存器单元驱动方法的流程图；
图5是图4所示实施例提供的移位寄存器单元驱动方法中第一阶段的等效电路图；
图6是图4所示实施例提供的移位寄存器单元驱动方法中第二阶段的等效电路图；
图7是图4所示实施例提供的移位寄存器单元驱动方法中第三阶段的等效电路图；
图8是图4所示实施例提供的移位寄存器单元驱动方法中第四阶段的等效电路图；
图9是图4所示实施例提供的移位寄存器单元驱动方法中第五阶段的等效电路图；
图10是本发明各个实施例中的第一时钟信号端、第二时钟信号端、输入端、输出端、第一节点、第二节点、第三节点和第四节点的电位变化示意图。
通过上述附图，已示出本发明明确的实施例，后文中将有更详细的描述。这些附图和文字描述并不是为了通过任何方式限制本发明构思的范围，而是通过参考特定实施例为本领域技术人员说明本发明的概念。
具体实施方式
这里将详细地对示例性实施例进行说明，其示例表示在附图中。下面的描述涉及附图时，除非另有表示，不同附图中的相同数字表示相同或相似的要素。以下示例性实施例中所描述的实施方式并不代表与本发明相一致的所有实施方式。相反，它们仅是与如所附权利要求书中所详述的、本发明的一些方面相一致的装置和方法的例子。
本发明所有实施例中采用的晶体管均可以为薄膜晶体管或场效应管或其他特性相同的器件，根据在电路中的作用本发明的实施例所采用的晶体管主要为开关晶体管。由于这里采用的开关晶体管的源极、漏极是对称的，所以其源极、漏极是可以互换的。在本发明实施例中，将其中源极称为第一级，漏极称为第二级，栅极称为第三极。按附图中的形态规定晶体管的中间端为栅极、信号输入端为源极、信号输出端为漏极。此外本发明实施例所采用的开关晶体管通常为P型开关晶体管，P型开关晶体管在栅极为低电平时导通，在栅极为高电平时截止。此外，本发明各个实施例中的多个信号都对应有第一电位和第二电位。第一电位和第二电位仅代表该信号的电位有2个状态量。不代表全文中第一电位或第二电位具有特定的数值。第一控制信号可以为高电位信号，第二控制信号可以为低电位信号。
图1是根据一示例性实施例示出的一种移位寄存器单元的结构示意图。该移位寄存器单元可以包括：第一输出模块110、第二输出模块120、控制模块130和输入模块140。
第一输出模块110分别与第一信号端VGH、第一节点B和输出端Out_EM连接，用于在第一节点B的控制下，向输出端Out_EM输出来自第一信号端VGH的第一控制信号。
第二输出模块120分别与输出端Out_EM、第二节点A和第二信号端VGL连接，用于在第二节点A的控制下，向输出端Out_EM输出来自第二信号端VGL的第二控制信号。
控制模块130分别与第一节点B、第二节点A、第一信号端VGH、第二信号端VGL、第一时钟信号端CKB和第二时钟信号端CK连接，用于在来自第一信号端VGH的第一控制信号，第二信号端VGL的第二控制信号，第一时钟信号端CKB的第一时钟信号和第二时钟信号端CK的第二时钟信号的控制下控制第一节点B和第二节点A的电位。
输入模块140分别与输入端STV、第二节点A、第二时钟信号端CK连接，用于在来自第二时钟信号端CK的第二时钟信号的控制下向第二节点A输出来自输入端STV的输入信号。
综上所述，本发明实施例提供的移位寄存器单元，通过第一输出模块、第二输出模块、输入模块和控制模块来控制输出端输出的电位高低，解决了相关技术中移位寄存器单元的电路结构通常较为复杂，控制过程较为繁琐的问题；达到了电路结构简单且输出脉宽可调节的效果。
进一步的，请参考图2，其为本发明实施例提供的另一种移位寄存器单元的结构示意图，该移位寄存器单元在图1所示的移位寄存器单元的基础上增加了更优选的部件，从而使得本发明实施例提供的移位寄存器单元具有更好的性能。
可选的，控制模块130包括：上拉控制子模块131和复位子模块132。
上拉控制子模块131分别与第一时钟信号端CKB、第二时钟信号端CK、第二信号端VGL、第一节点B和第三节点E连接，用于在来自第二信号端VGL的第二控制信号、来自第三节点E的复位控制信号、来自第一时钟信号端CKB的第一时钟信号和第二时钟信号端CK的第二时钟信号的控制下控制第一节点B的电位。
复位子模块132分别与第三节点E、第一信号端VGH、第二时钟信号端CK、第二节点A和第一节点B连接，用于在第一控制信号和第二时钟信号的控制下控制第一节点B的电位、第二节点A的电位和第三节点E的电位，第一控制信号来自第一信号端VGH，第二时钟信号来自第二时钟信号端CK。
如图3所示，其为本发明实施例提供的另一种移位寄存器单元的结构示意图。
可选的，上拉控制子模块131包括：第二电容器C2、第七晶体管M7、第八晶体管M8和第九晶体管M9。
第七晶体管M7的第一极与第四节点C连接，第七晶体管M7的第二极与第一节点B连接，第七晶体管M7的第三极与第一时钟信号端CKB连接。
第八晶体管M8的第二极与第四节点C连接，第八晶体管M8的第一极与第一时钟信号端CKB连接，第八晶体管M8的第三极与第三节点E连接。
第九晶体管M9的第二极与第三节点E连接，第九晶体管M9的第一极与第二信号端VGL连接，第九晶体管M9的第三极与第二时钟信号端CK连接。
第二电容器C2的第一极与第三节点E连接，第二电容器C2的第二极与第四节点C连接。
可选的，复位子模块132包括：第四晶体管M4、第五晶体管M5和第六晶体管M6。
第四晶体管M4的第二极与第一节点B连接，第四晶体管M4的第一极与第一信号端VGH连接，第四晶体管M4的第三极与第二节点A连接。
第五晶体管M5的第一极与第二节点A连接，第五晶体管M5的第二极与第六晶体管M6的第三极连接，第五晶体管M5的第三极与第二时钟信号端CK连接。
第六晶体管M6的第二极与第三节点E连接，第六晶体管M6的第一极与第一信号端VGH连接。
可选的，第一输出模块110包括：第一晶体管M1和第一电容器C1，
第一晶体管M1的第一极与第一信号端VGH连接，第一晶体管M1的第二极与输出端OUT_EM连接，第一晶体管M1的第三极与第一节点B连接。
第一电容器C1的第一极与第一晶体管M1的第一极连接，第一电容器C1的第二极与第一晶体管M1的第三极连接。
可选的，第二输出模块120包括：第二晶体管M2和第三电容器C3，
第二晶体管M2的第一极与第二信号端VGL连接，第二晶体管M2的第二极与输出端OUT_EM连接，第二晶体管M2的第三极与第二节点A连接。
第三电容器C3的第一极与第二晶体管M2的第二极连接，第三电容器C3的第二极与第二晶体管M2的第三极连接。
可选的，输入模块140包括：第三晶体管M3。
第三晶体管M3的第二极与第二节点连接，第三晶体管M3的第一极与输入端STV连接，第三晶体管M3的第三极与第二时钟信号端CK连接。
需要补充说明的是，本发明实施例提供的移位寄存器单元，通过九个晶体管和三个电容器即完成了对输出端电位高低的控制，简化了移位寄存器单元结构，达到了减小移位寄存器版图面积的效果，有利于高分辨率显示装置的制造。
综上所述，本发明实施例提供的移位寄存器单元，通过第一输出模块、第二输出模块、输入模块和控制模块来控制输出端输出的电位高低，解决了相关技术中移位寄存器单元的电路结构通常较为复杂，控制过程较为繁琐的问题；达到了电路结构简单且输出脉宽可调节的效果。
图4是根据一示例性实施例示出的一种移位寄存器单元驱动方法的流程图。移位寄存器单元的结构可以如图1所示，包括：第一输出模块110、第二输出模块120、控制模块130和输入模块140，该移位寄存器单元驱动方法包括：
步骤401，第一阶段：输入端STV输入的输入信号为第一电位，第二时钟信号端CK输入的第二时钟信号为第二电位。输入模块140在第二时钟信号端CK输入的第二时钟信号的控制下，向第二节点A输入输入信号。第一阶段的等效电路图可以如图5所示，其中各标号含义与图3中一致。第一阶段为预备阶段。
步骤402，第二阶段：第一时钟信号端CKB输入第一时钟信号为第二电位，第二时钟信号端CK输入的第二时钟信号为第一电位，控制控制模块130向第一节点B输入来自第一时钟信号端的第一时钟信号，在第一节点B的控制下，第一输出模块110向输出端OUT_EM输出来自第一信号端VGH的第一控制信号。第二阶段的等效电路图可以如图6所示，其中各标号含义与图3中一致。第二阶段为上拉阶段。
步骤403，第三阶段：第二节点A保持第一电位，第二输出模块120、输入模块140和控制模块130重复执行第一阶段和第二阶段的过程。第三阶段的等效电路图可以如图7所示，其中各标号含义与图3中一致。第三阶段为高电位维持阶段。
步骤404，第四阶段：第二时钟信号端CK输入第二时钟信号，输入模块140在来自第二时钟信号端CK的第二时钟信号的控制下向第二节点A输出来自输入端STV的第二电位，在第二节点A的控制下，第二输出模块120向输出端OUT_EM输出来自第二信号端VGL的第二控制信号。第四阶段的等效电路图可以如图8所示，其中各标号含义与图3中一致。第四阶段为下拉阶段。
步骤405，第五阶段：输入端STV保持第二电位，周期性重复第四阶段，使第一节点B保持第一电位，第二节点A保持第二电位，输出端OUT_EM保持第二电位。第五步骤的等效电路图可以如图9所示，其中各标号含义与图3中一致。第五阶段为低电位维持阶段。
即本发明实施例提供的移位寄存器单元驱动方法，可以通过控制输入端STV在第一电位的维持时间来控制输出端OUT_EM输出的电位高低。
可选的，如图2所示，控制模块130包括：上拉控制子模块131和复位子模块132。
此时，步骤402可以包括：第二阶段中，第一时钟信号端CKB输入第一时钟信号，第一时钟信号处于第二电位，第二时钟信号端CK输入第二时钟信号，第二时钟信号处于第一电位，上拉控制子模块131将第一节点B复位到第二电位。第二阶段的等效电路图可以如图6所示。
步骤404可以包括：第四阶段中，第二时钟信号端CK输入第二时钟信号，输入端STV输入第二电位，复位子模块132向第三节点E输入来自第一信号端VGH的第一控制信号。第四阶段的等效电路图可以如图8所示。
可选的，如图3所示，上拉控制子模块131包括：第二电容器C2、第七晶体管M7、第八晶体管M8和第九晶体管M9。
此时，步骤401可以包括：第一阶段中，第二时钟信号端CK输入第二时钟信号，第二时钟信号处于第二电位，第九晶体管M9开启，第二信号端VGL向第三节点E输入第二控制信号。第一阶段的等效电路图可以如图5所示。
步骤402可以包括：第二阶段中，第一时钟信号端CKB输入第一时钟信号，第一时钟信号处于第二电位，第二时钟信号端CK输入第二时钟信号，第二时钟信号处于第一电位，第九晶体管M9关断，第七晶体管M7开启，第八晶体管M8开启，第一时钟信号端CKB向第四节点C输入第一时钟信号为第二电位，第四节点C向第一节点B输入第二电位，由于在第一阶段第八晶体管M8开启，第四节点C被第一时钟信号端CKB拉至第一电位，所以第二电容器C2的两端的第三节点E到第四节点C存储一个负电位，当第一时钟信号端CKB跳变到第二电位时，第一时钟信号端CKB的第二电位被传递到第四节点C，第三节点E会被第二电容器C2举到一个更低的电位，第八晶体管M8可以很好的开启。第一时钟信号端CKB跳变为输入第一电位后，第七晶体管M7关断，第一时钟信号端CKB输入的第一电位不会输入至第一节点A。第二阶段的等效电路图可以如图6所示。
可选的，复位子模块132包括：第四晶体管M4、第五晶体管M5和第六晶体管M6。
第四阶段中，第二时钟信号端CK输入第二时钟信号，第二时钟信号处于第二电位，输入模块140向第二节点A输入来自输入端STV的输入信号为第二电位，第四晶体管M4开启，第五晶体管M5开启，第六晶体管M6开启，第一信号端VGH向第一节点B和第三节点E输入第一控制信号。第四阶段的等效电路图可以如图8所示。
可选的，第一输出模块110包括：第一晶体管M1和第一电容器C1。
步骤402可以包括：第二阶段控制模块130向第一节点B输入第一时钟信号，第一时钟信号处于第二电位，第一晶体管M1开启，第一电容器C1充电，第一晶体管M1向输出端OUT_EM输出来自第一信号端VGH的第一控制信号。
步骤404可以包括：第四阶段中，控制模块130向第一节点B输入第一电位，第一晶体管M1关断。四阶段的等效电路图可以如图8所示。
可选的，第二输出模块120包括：第二晶体管M2和第三电容器C3。
此时，步骤401可以包括：第一阶段中，输入模块140向第二节点A输出来自输入端STV的输入信号，输入信号处于第一电位，第二晶体管M2关断，第三电容器C3充电。第一阶段的等效电路图可以如图5所示。
步骤404可以包括：第四阶段中，输入模块140向第二节点A输出来自输入端STV的输入信号，输入信号处于第二电位，第二晶体管M2开启，第二晶体管M2向输出端OUT_EM输出来自第二信号端VGL的第二控制信号。四阶段的等效电路图可以如图8所示。
可选的，输入模块140包括：第三晶体管M3。
此时，步骤401可以包括：第一阶段中，输入端STV输出输入信号，输入信号处于第一电位，第二时钟信号端CK输入第二时钟信号，第二时钟信号处于第二电位，控制第三晶体管M3开启，第三晶体管M3向第二节点A输入来自输入端STV的输入信号。第一阶段的等效电路图可以如图5所示
步骤403可以包括：第三阶段中，在输入端STV的输入信号跳变为第二电位前，第三晶体管M3在来自第二时钟信号端CK的第二时钟信号的控制下关断，第二时钟信号处于第一电位。第三阶段的等效电路图可以如图7所示。
步骤404可以包括：第四阶段中，第二时钟信号端CK输入第二时钟信号，第二时钟信号处于第二电位，第三晶体管M3在来自第二时钟信号端CK的第二时钟信号为第二电位的控制下向第二节点A输出来自输入端STV的输入信号为第二电位，第二时钟信号端CK输入的第二时钟信号跳变为输出第一电位时，第三晶体管M3关断。四阶段的等效电路图可以如图8所示。
此外，本发明各个实施例中涉及的第一时钟信号端CKB、第二时钟信号端CK、输入端STV、输出端OUT_EM、第一节点B、第二节点A、第三节点E和第四节点C在第一阶段t1、第二阶段t2、第三阶段t3、第四阶段t4和第五阶段t5的电位变化可以参照图10，在图10中，横轴代表时间，纵轴代表电位。
需要补充说明的是，本发明实施例提供的移位寄存器单元，通过九个晶体管和三个电容器即完成了对输出端电位高低的控制，简化了移位寄存器单元结构，达到了减小移位寄存器版图面积的效果，有利于高分辨率显示装置的制造。
综上所述，本发明实施例提供的移位寄存器单元驱动方法，通过第一输出模块、第二输出模块、输入模块和控制模块来控制输出端输出的电位高低，解决了相关技术中移位寄存器单元的电路结构通常较为复杂，控制过程较为繁琐的问题；达到了电路结构简单且输出脉宽可调节的效果。
本发明提供一种栅极驱动电路，包括至少两个级联的如图1、图2或图3所示的移位寄存器单元。
另外，本发明还提供一种显示装置，显示装置包括该栅极驱动电路。所述显示装置可以为：液晶面板、电子纸、OLED面板、手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。
以上所述仅为本发明的较佳实施例，并不用以限制本发明，凡在本发明的精神和原则之内，所作的任何修改、等同替换、改进等，均应包含在本发明的保护范围之内。

Claims (19)

1.一种移位寄存器单元，其特征在于，所述移位寄存器单元包括：第一输出模块、第二输出模块、输入模块和控制模块，
所述第一输出模块分别与第一信号端、第一节点和输出端连接，用于在所述第一节点的控制下，向所述输出端输出来自所述第一信号端的第一控制信号；
所述第二输出模块分别与所述输出端、第二节点和第二信号端连接，用于在所述第二节点的控制下，向所述输出端输出来自所述第二信号端的第二控制信号；
所述控制模块分别与所述第一节点、所述第二节点、所述第一信号端、所述第二信号端、第一时钟信号端和第二时钟信号端连接，用于在来自所述第一信号端的所述第一控制信号、所述第二信号端的所述第二控制信号、所述第一时钟信号端的第一时钟信号和所述第二时钟信号端的第二时钟信号的控制下，控制所述第一节点和所述第二节点的电位；
所述输入模块分别与输入端、所述第二节点、所述第二时钟信号端连接，用于在来自所述第二时钟信号端的所述第二时钟信号的控制下向所述第二节点输出来自所述输入端的输入信号。
2.根据权利要求1所述的移位寄存器单元，其特征在于，所述第一输出模块包括：第一晶体管和第一电容器，
所述第一晶体管的第一极与所述第一信号端连接，所述第一晶体管的第二极与所述输出端连接，所述第一晶体管的第三极与第一节点连接；
所述第一电容器的第一极与所述第一晶体管的第一极连接，所述第一电容器的第二极与所述第一晶体管的第三极连接。
3.根据权利要求1所述的移位寄存器单元，其特征在于，所述第二输出模块包括：第二晶体管和第三电容器，
所述第二晶体管的第一极与所述第二信号端连接，所述第二晶体管的第二极与所述输出端连接，所述第二晶体管的第三极与所述第二节点连接；
所述第三电容器的第一极与所述第二晶体管的第二极连接，所述第三电容器的第二极与所述第二晶体管的第三极连接。
4.根据权利要求1所述的移位寄存器单元，其特征在于，所述控制模块包括：上拉控制子模块和复位子模块；
所述上拉控制子模块分别与所述第一时钟信号端、所述第二时钟信号端、所述第二信号端、所述第一节点和第三节点连接，用于在来自所述第二信号端的第二控制信号、来自所述第三节点的复位控制信号、来自所述第一时钟信号端的所述第一时钟信号和所述第二时钟信号端的所述第二时钟信号的控制下控制所述第一节点的电位；
所述复位子模块分别与所述第一节点、所述第二节点、所述第三节点、所述第一信号端和所述第二时钟信号端连接，用于在所述第一控制信号和所述第二时钟信号的控制下控制所述第一节点的电位、所述第二节点的电位和所述第三节点的电位，所述第一控制信号来自所述第一信号端，所述第二时钟信号来自所述第二时钟信号端。
5.根据权利要求4所述的移位寄存器单元，其特征在于，所述上拉控制子模块包括：第二电容器、第七晶体管、第八晶体管和第九晶体管，
所述第七晶体管的第一极与第四节点连接，所述第七晶体管的第二极与所述第一节点连接，所述第七晶体管的第三极与所述第一时钟信号端连接；
所述第八晶体管的第二极与所述第四节点连接，所述第八晶体管的第一极与所述第一时钟信号端连接，所述第八晶体管的第三极与所述第三节点连接；
所述第九晶体管的第二极与所述第三节点连接，所述第九晶体管的第一极与所述第二信号端连接，所述第九晶体管的第三极与所述第二时钟信号端连接；
所述第二电容器的第一极与所述第三节点连接，所述第二电容器的第二极与所述第四节点连接。
6.根据权利要求4所述的移位寄存器单元，其特征在于，所述复位子模块包括：第四晶体管、第五晶体管和第六晶体管，
所述第四晶体管的第二极与所述第一节点连接，所述第四晶体管的第一极与所述第一信号端连接，所述第四晶体管的第三极与所述第二节点连接；
所述第五晶体管的第一极与所述第二节点连接，所述第五晶体管的第二极与所述第六晶体管的第三极连接，所述第五晶体管的第三极与所述第二时钟信号端连接；
所述第六晶体管的第二极与所述第三节点连接，所述第六晶体管的第一极与所述第一信号端连接。
7.根据权利要求1所述的移位寄存器单元，其特征在于，所述输入模块包括：第三晶体管，
所述第三晶体管的第二极与所述第二节点连接，所述第三晶体管的第一极与所述输入端连接，所述第三晶体管的第三极与所述第二时钟信号端连接。
8.根据权利要求2、3、5、6、7中任一项所述的移位寄存器单元，其特征在于，
所述晶体管均为P型晶体管。
9.一种移位寄存器单元驱动方法，用于驱动权利要求1至8任一所述的移位寄存器单元，其特征在于，所述移位寄存器单元包括：第一输出模块、第二输出模块、输入模块和控制模块，所述方法包括：
第一阶段：输入端输入的输入信号为第一电位，第二时钟信号端输入的第二时钟信号为第二电位，所述输入模块在所述第二时钟信号端输入的所述第二时钟信号的控制下，向第二节点输入所述输入信号；
第二阶段：第一时钟信号端输入的第一时钟信号为第二电位，所述第二时钟信号端输入的所述第二时钟信号为第一电位，控制所述控制模块向第一节点输入来自所述第一时钟信号端的所述第一时钟信号，在所述第一节点的控制下，所述第一输出模块向输出端输入来自第一信号端的第一控制信号；
第三阶段：所述第二节点保持第一电位，所述第二输出模块、所述输入模块和所述控制模块重复执行所述第一阶段和所述第二阶段的过程；
第四阶段：所述第二时钟信号端输入所述第二时钟信号，所述输入模块在来自所述第二时钟信号端的所述第二时钟信号的控制下向所述第二节点输出来自所述输入端的所述输入信号，所述输入信号处于第二电位，在所述第二节点的控制下，所述第二输出模块向所述输出端输入来自第二信号端的第二控制信号，所述控制模块向所述第一节点输入来自所述第一信号端的所述第一控制信号。
10.根据权利要求9所述的方法，其特征在于，所述第一输出模块包括：第一晶体管和第一电容器，
所述第二阶段中，所述控制模块向所述第一节点输入来自所述第一时钟信号端的所述第一时钟信号，所述第一时钟信号处于第二电位，所述第一晶体管开启，所述第一电容器充电，所述第一晶体管向所述输出端输入来自所述第一信号端的所述第一控制信号；
所述第四阶段中，所述控制模块向所述第一节点输入来自所述第一信号端的所述第一控制信号，所述第一晶体管关断。
11.根据权利要求9所述的方法，其特征在于，所述第二输出模块包括：第二晶体管和第三电容器，
所述第一阶段中，所述输入模块向所述第二节点输出来自所述输入端的所述输入信号，所述输入信号处于第一电位，所述第二晶体管关断，所述第三电容器充电；
所述第四阶段中，所述输入模块向所述第二节点输出来自所述输入端的所述输入信号，所述输入信号处于第二电位，所述第二晶体管开启，所述第二晶体管向所述输出端输出来自所述第二信号端的所述第二控制信号。
12.根据权利要求9所述的方法，其特征在于，所述控制模块包括：上拉控制子模块和复位子模块，
所述第二阶段中，所述第一时钟信号端输入所述第一时钟信号，所述第一时钟信号处于第二电位，所述第二时钟信号端输入所述第二时钟信号，所述第二时钟信号处于第一电位，所述上拉控制子模块将所述第一节点复位到第二电位；
所述第四阶段中，所述输入端输入的输入信号处于第二电位，所述复位子模块向第三节点输入来自所述第一信号端的所述第一控制信号。
13.根据权利要求12所述的方法，其特征在于，所述上拉控制子模块包括：第二电容器、第七晶体管、第八晶体管和第九晶体管，
所述第一阶段中，所述第二时钟信号端输入所述第二时钟信号，所述第二时钟信号处于第二电位，所述第九晶体管开启，所述第二信号端向所述第三节点输入所述第二控制信号；
所述第二阶段中，所述第一时钟信号端输入所述第一时钟信号，所述第一时钟信号处于第二电位，所述第二时钟信号端输入所述第二时钟信号，所述第二时钟信号处于第一电位，所述第九晶体管关断，所述第七晶体管开启，所述第八晶体管开启，所述第一时钟信号端向第四节点输入所述第一时钟信号，所述第四节点将所述第一节点复位到第二电位，所述第一时钟信号端输入的所述第一时钟信号跳变为第一电位后，所述第七晶体管关断。
14.根据权利要求12所述的方法，其特征在于，所述复位子模块包括：第四晶体管、第五晶体管和第六晶体管，
所述第四阶段中，所述第二时钟信号端输入所述第二时钟信号，所述第二时钟信号处于第二电位，所述输入模块向所述第二节点输入来自所述输入端的所述输入信号，所述输入信号处于第二电位，所述第四晶体管开启，所述第五晶体管开启，所述第六晶体管开启，所述第一信号端向所述第一节点和所述第三节点输入所述第一控制信号。
15.根据权利要求9所述的方法，其特征在于，所述输入模块包括：第三晶体管，
所述第一阶段中，所述输入端输出所述输入信号，所述输入信号处于第一电位，所述第二时钟信号端输入所述第二时钟信号，所述第二时钟信号处于第二电位，控制所述第三晶体管开启，所述第三晶体管向所述第二节点输入来自所述输入端的所述输入信号；
所述第三阶段中，在所述输入端的所述输入信号跳变为第二电位前，所述第三晶体管在来自所述第二时钟信号端的所述第二时钟信号的控制下关断，所述第二时钟信号处于第一电位；
所述第四阶段中，所述第二时钟信号端输入所述第二时钟信号，所述第二时钟信号处于第二电位，所述第三晶体管在来自所述第二时钟信号端的位于第二电位的所述第二时钟信号的控制下向所述第二节点输出来自所述输入端的第二电位，所述第二时钟信号端输入的所述第二时钟信号跳变为第一电位时，所述第三晶体管关断。
16.根据权利要求10、11、13、14、15中任一项所述的方法，其特征在于，
所述晶体管均为P型晶体管。
17.根据权利要求9至15任一所述的方法，其特征在于，
所述第一电位相对于所述第二电位为高电位。
18.一种栅极驱动电路，其特征在于，包括至少两个级联的如权利要求1至8任一所述的移位寄存器单元。
19.一种显示装置，其特征在于，所述显示装置包括权利要求18所述的栅极驱动电路。
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