TWI449118B - 半導體裝置的製造設備 - Google Patents
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- 239000004065 semiconductor Substances 0.000 title claims description 18
- 238000004519 manufacturing process Methods 0.000 title description 20
- 235000012431 wafers Nutrition 0.000 claims description 146
- 238000005304 joining Methods 0.000 claims description 7
- 230000003287 optical effect Effects 0.000 claims description 6
- 239000000919 ceramic Substances 0.000 claims description 3
- 239000002184 metal Substances 0.000 claims description 3
- 239000013078 crystal Substances 0.000 claims description 2
- 238000006073 displacement reaction Methods 0.000 claims description 2
- 238000004140 cleaning Methods 0.000 description 12
- 238000000034 method Methods 0.000 description 12
- 230000008569 process Effects 0.000 description 8
- 239000000758 substrate Substances 0.000 description 6
- 238000010586 diagram Methods 0.000 description 2
- 230000010354 integration Effects 0.000 description 2
- 238000001179 sorption measurement Methods 0.000 description 2
- 238000003860 storage Methods 0.000 description 2
- 230000009471 action Effects 0.000 description 1
- 230000008859 change Effects 0.000 description 1
- 238000011109 contamination Methods 0.000 description 1
- 230000007547 defect Effects 0.000 description 1
- 230000004927 fusion Effects 0.000 description 1
- 239000012212 insulator Substances 0.000 description 1
- 230000003993 interaction Effects 0.000 description 1
- 239000000463 material Substances 0.000 description 1
- 239000002245 particle Substances 0.000 description 1
- 238000000206 photolithography Methods 0.000 description 1
- 238000002360 preparation method Methods 0.000 description 1
- 230000002250 progressing effect Effects 0.000 description 1
- 230000000644 propagated effect Effects 0.000 description 1
- 238000000926 separation method Methods 0.000 description 1
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-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L25/00—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
- H01L25/50—Multistep manufacturing processes of assemblies consisting of devices, each device being of a type provided for in group H01L27/00 or H01L29/00
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- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/67—Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
- H01L21/67005—Apparatus not specifically provided for elsewhere
- H01L21/67011—Apparatus for manufacture or treatment
- H01L21/67092—Apparatus for mechanical treatment
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- B—PERFORMING OPERATIONS; TRANSPORTING
- B32—LAYERED PRODUCTS
- B32B—LAYERED PRODUCTS, i.e. PRODUCTS BUILT-UP OF STRATA OF FLAT OR NON-FLAT, e.g. CELLULAR OR HONEYCOMB, FORM
- B32B38/00—Ancillary operations in connection with laminating processes
- B32B38/18—Handling of layers or the laminate
- B32B38/1858—Handling of layers or the laminate using vacuum
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- F—MECHANICAL ENGINEERING; LIGHTING; HEATING; WEAPONS; BLASTING
- F16—ENGINEERING ELEMENTS AND UNITS; GENERAL MEASURES FOR PRODUCING AND MAINTAINING EFFECTIVE FUNCTIONING OF MACHINES OR INSTALLATIONS; THERMAL INSULATION IN GENERAL
- F16K—VALVES; TAPS; COCKS; ACTUATING-FLOATS; DEVICES FOR VENTING OR AERATING
- F16K51/00—Other details not peculiar to particular types of valves or cut-off apparatus
- F16K51/02—Other details not peculiar to particular types of valves or cut-off apparatus specially adapted for high-vacuum installations
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- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/67—Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
- H01L21/67005—Apparatus not specifically provided for elsewhere
- H01L21/67011—Apparatus for manufacture or treatment
- H01L21/67126—Apparatus for sealing, encapsulating, glassing, decapsulating or the like
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/67—Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
- H01L21/67005—Apparatus not specifically provided for elsewhere
- H01L21/67011—Apparatus for manufacture or treatment
- H01L21/67155—Apparatus for manufacturing or treating in a plurality of work-stations
- H01L21/67201—Apparatus for manufacturing or treating in a plurality of work-stations characterized by the construction of the load-lock chamber
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/67—Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
- H01L21/68—Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere for positioning, orientation or alignment
- H01L21/681—Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere for positioning, orientation or alignment using optical controlling means
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/67—Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
- H01L21/683—Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere for supporting or gripping
- H01L21/6835—Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere for supporting or gripping using temporarily an auxiliary support
- H01L21/6836—Wafer tapes, e.g. grinding or dicing support tapes
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- B—PERFORMING OPERATIONS; TRANSPORTING
- B32—LAYERED PRODUCTS
- B32B—LAYERED PRODUCTS, i.e. PRODUCTS BUILT-UP OF STRATA OF FLAT OR NON-FLAT, e.g. CELLULAR OR HONEYCOMB, FORM
- B32B2309/00—Parameters for the laminating or treatment process; Apparatus details
- B32B2309/60—In a particular environment
- B32B2309/64—Sterile
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- B—PERFORMING OPERATIONS; TRANSPORTING
- B32—LAYERED PRODUCTS
- B32B—LAYERED PRODUCTS, i.e. PRODUCTS BUILT-UP OF STRATA OF FLAT OR NON-FLAT, e.g. CELLULAR OR HONEYCOMB, FORM
- B32B2309/00—Parameters for the laminating or treatment process; Apparatus details
- B32B2309/60—In a particular environment
- B32B2309/65—Dust free, e.g. clean room
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- B—PERFORMING OPERATIONS; TRANSPORTING
- B32—LAYERED PRODUCTS
- B32B—LAYERED PRODUCTS, i.e. PRODUCTS BUILT-UP OF STRATA OF FLAT OR NON-FLAT, e.g. CELLULAR OR HONEYCOMB, FORM
- B32B2309/00—Parameters for the laminating or treatment process; Apparatus details
- B32B2309/60—In a particular environment
- B32B2309/68—Vacuum
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/0001—Technical content checked by a classifier
- H01L2924/0002—Not covered by any one of groups H01L24/00, H01L24/00 and H01L2224/00
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- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
- Y10T—TECHNICAL SUBJECTS COVERED BY FORMER US CLASSIFICATION
- Y10T156/00—Adhesive bonding and miscellaneous chemical manufacture
- Y10T156/10—Methods of surface bonding and/or assembly therefor
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- Engineering & Computer Science (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Physics & Mathematics (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
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- Manufacturing & Machinery (AREA)
- Computer Hardware Design (AREA)
- Power Engineering (AREA)
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Description
本發明關於一種製造半導體裝置之設備,其中設備包含用於晶圓分子接合之接合模組。
三維電路技術在現代半導體技術中愈來愈重要(例如可見於Burns等人之論文,標題為「A Wafer Scale 3-D Circuit Integration Technology,IEEE TRANSACTIONS ON ELECTRON DEVICES,VOL. 53,NO. 10 OCTOBER 2005,第2507-2516頁」)。在此技術中,電路結構形成在基材上(如絕緣層覆矽(silicon-on-insulator,SOI)),並將基材結合以整合為具有高密度垂直連接之三維電路。三維電路整合技術之基石為精準的晶圓間對準(wafer-wafer alignment)、低溫晶圓間接合(分子接合或氧化物熔融接合)、以及具有高密度垂直交互連接之電路結構之電性連接。與傳統之凸塊接合技術相較之下,晶圓級三維技術可提供更高密度之垂直交互連接,並減低系統之功耗。
晶圓之分子接合要求晶圓之接合表面要夠平滑,且沒有粒子或其他污染,並且彼此需夠接近以可開始接觸,通常起始點需小於數奈米。在此情況中,兩表面間之吸引力高到可導致「接合波」由起始點開始傳播,亦導致分子吸附(因將被接合之晶圓之二表面之原子或分子間的電交互作用的吸引力(凡得瓦力)所產生之接合)。此處「接合波」一詞所指為由起始點所傳播之接合或分子吸附的波前,並對應至由開始點散佈至二晶圓之近接觸之整個表面(接合界面)的吸引力(凡得瓦力)。
然而,分子接合技術需面對如邊緣空乏(edge voids)、晶圓對準以及晶圓變瑕疵等接合界面瑕疵之嚴重問題。上述之問題可能在其與接收之基材組合時出現在轉移層(transfer layer)。
此變形並非導因於基本改變(移動、轉動或其組合),其可能肇因於基材在組合時不準確(未對準)。這些變形起因於出現在組合於最終基材上時產生在層中之非均質形變。實際上,此類變形可能導致微元件形成在層中或層上之位置的變化,而此變化之量級可能為數百奈米或甚至微米。由於這些變形並非均質,因而不可能在接下來執行之光微影步驟中將這些局部未對準錯誤改正。因此可能產生功能不良之半導體裝置。
綜上所述,儘管現在的科技進展迅速,但仍需要一種可以提供三維積體電路所使用,具有足夠精確度之晶圓分子接合的半導體裝置製造設備,特別是可提供對準、減少層變形、抑制接合界面瑕疵,並且有高產能之設備。
本發明欲滿足上述需求,其提供如申請專利範圍第1項之一種半導體製造設備,此設備包含接合模組,其包含一真空室以提供晶圓在低於大氣壓力之壓力下之接合;以及承載模組,其連接至接合模組且經組態以將晶圓運送至接合模組並連接至一第一真空泵,其經組態以使承載模組中之壓力減低至低於大氣壓力。
依本發明,晶圓分子接合在抽真空之真空室中進行。因接合在(部分)真空下進行,而可觀察到如邊緣空乏等界面瑕疵被大幅的抑制而不會影響到接合強度。另外,晶圓由承載模組被運送到接合模組的真空室中,與習知技術之真空接合模組相較之下可大幅增加產能。由於承載模組將欲接合之晶圓在接近已抽真空之接合模組之真空室的低壓之真空壓力下提供給接合模組,因此可避免在兩個接合步驟(接合步驟及將至少一晶圓由承載模組運送至接合模組之步驟)間將晶圓由真空壓力切換至大氣壓力下,反之亦然。
承載模組被第一泵抽真空到(例如)約1毫巴至低於大氣壓(低於1bar)之間,特別是抽至1毫巴至10或100毫巴之範圍。接合模組之真空室被第二泵抽真空至(例如)0.01毫巴至10毫巴或100毫巴之壓力範圍,特別是0.1毫巴至5毫巴之間。亦應注意為避免晶圓因晶圓半導體材料之熱膨脹而產生形變,真空室之溫度維持於室溫。第一及(或)第二泵可透過用以控制所需之各別的真空度的控制閘門分別連接至承載模組及接合模組之真空室。第一及第二泵例如可用多級旋轉翼式泵。
應注意接合模組包含所有真空下之對準晶圓接合製程所需之構件,且被與周遭環境氣密隔絕。承載模組可經組態以同時接收並傳送晶圓給接合模組,或可經組態以接收複數個晶圓,其可被儲存於承載模組所提供之多晶圓儲存系統中。在前述之情形中,承載模組之尺寸可被最小化,以使在晶圓傳送中,開啟分隔接合模組與承載模組之閘時不會使接合模組之真空室的真空被破壞得太嚴重。如此可提高產能。
特別是,承載模組可包含第一閘,其可開啟及關閉以接收晶圓;亦可包含一第二閘,其可開啟及關閉以由承載模組傳送晶圓至接合模組。在承載模組由開啟之第一閘接收晶圓並將第一閘再次關閉後,第一泵可開始將承載模組抽真空。
依本發明一實施例之設備,可有至少一附加承載模組連接至接合模組,並經組態以接收一或多個已在接合模組中經接合之晶圓(晶圓堆疊),其可進一步提高產能。
接合模組可包含至少一第一可動接合夾具,其與第一接合夾具不同,且經組態以握持與第一晶圓不同之第二晶圓。可在接合模組中提供一機械構件,其經組態以由承載模組夾持晶圓並將晶圓置於接合夾具。夾持可由機械構件、靜電構件或真空(若夾持之真空遠低於接合模組之真空室之真空度)來達成。
兩個可動接合夾具面對面放置以支撐並夾持由接合模組之真空室提供之晶圓。夾具可位移並旋轉以使其可將兩晶圓定位並對準於彼此之前。每個接合夾具應盡可能具有最佳之平面性,因夾具之曲度為產生變形瑕疵之因素之一。因本發明一實施例,夾具由金屬或陶瓷製成,其不會輕易產生形變且可維持晶圓之平面性。夾具之曲度(最大正中面(median plane)偏差)較佳應小於一微米或甚至小於0.1微米。
第一及第二接合夾具可經組態(或定向)以在對垂直平面而言小於10°內之垂直位置分別握持或夾持第一及第二晶圓,更特定而言,此角度最大為約1°。每個晶圓具有兩個主表面。依一實施例,晶圓之主表面經定向於(幾乎)垂直於接合模組所配置之水平平面。特別是具有一小於10°之角度,更特定為最大為約1°之角度。在此定向下,可避免因晶圓本身之重量而產生之形變(導致變形瑕疵),而亦能可靠地處理直徑大於300mm之大型晶圓。特別是,第一及第二接合夾具經定位於對垂直平面而言小於10°內之垂直位置。
此設備亦可包括控制單元,其控制設備之不同模組之操作,亦可控制機械構件將晶圓由一模組運送至另一模組。
若在應用上有需要,可在接合模組中提供光學定位置系統,其可操作以辨視晶圓上之對準標記之正確位置,且兩夾具接著以位移及旋轉之方式移動以將晶圓依辨識出之對準標記對準。
實際之分子接合製程可由上述控制單元依不同之替代方案來控制,如美國專利公開號US20100122762所揭露。該一第一方案,夾持被鬆開以由夾具釋放其晶圓,局部地施加額外之力以使得圓形成近距離(以作用之分子力來說)接觸並開始接合波傳播。此額外之力應被最小化(例如小於5牛頓或甚至1牛頓)以避免造成晶元的形變。如此,本發明之設備可更包含控制單元,其經組態以控制第一及第二接合夾具,以使其向彼此靠近而將第一及第二晶圓置於一預定距離,並以適當之局部施力構件開始局部施加一力於第一及第二晶圓其中至少一者上,而使其彼此局部接近至可開始接合。在此及後文中應理解此接合由作用於晶圓之主表面之分子力所啟動,其因彼此靠近而被接合。
依一第二方案,先造成此近距離接觸,然後漸漸地鬆開對晶圓的夾持。可在使兩晶圓相互靠近時在至少一晶圓上局部地造成輕微的形變以產生近距離(以作用之分子力來說)接觸。形變可以局部地減少維持晶圓在夾具上之夾持力來造成。當近距離接觸發生後,可開始漸漸鬆開對晶圓的夾持以控制接合波之傳播速度。在一第三方案中,並非漸漸鬆開對晶圓的夾持,而不對接合波做控制。後者之方案較易實施。
承上述,本發明之設備更可包含控制單元,其經組態以控制第一及第二接合夾具以使其向彼此移動,接著局部地減少由第一及(或)第二接合夾具所施加以分別握持第一及第二晶圓之夾持力,而使第一及第二晶圓局部地靠近彼此以開始接合。
控制單元可經組態以在第一或第二晶圓局部地靠近彼此而可開始接合時控制漸漸地或非漸漸地釋放第一及(或)第二晶圓。
本發明更提供一種製造系統(見後文之詳細描述),其包含以上之例中之設備,並更包含承載介面模組,其經組態以將晶圓置入製造系統;電漿模組,其經組態以對置入製造系統之晶圓之表面進行電漿處理;清洗模組,其經組態以清洗晶圓之表面;以及可動機械構件,其經組態以將該晶圓由承載介面模組、電漿模組、清洗模組以及承載模組中之一者移至上述模組之另一者。
可提供一或多個電漿模組以啟動晶圓之一個或兩個主表面。清洗模組清洗及(或)刷洗欲在接合模組中彼此接合之晶圓表面。機械構件經組態以處理晶圓並將其由承載介面模組運送至任何模組,或由一模組至另一模組。機械構件特別在一機械移動區中移動,以使晶圓可由一處移至另一處。系統亦包括控制單元以控制各別模組之動作及機械構件對晶圓之運送。
上述需求亦可由此處所提供之將半導體晶圓接合之方法解決,此方法包含以下步驟將接合模組之真空室抽真空;將至少一第一晶圓運送至承載模組,其連接至接合模組;在將至少一第一晶圓運送至承載模組中後,將承載模組抽真空;將至少一第一晶圓由已抽真空之承載模組運送至已抽真空之接合模組之真空室;選擇性地在至少一第一晶圓之運送後調整真空室之真空度;將第一晶圓以及第二晶圓分別置於第一及一二接合夾具;以及藉由移動第一及(或)第二接合夾具以將第一及第二晶圓移向彼此,以使第一晶圓之一主表面以及第二晶圓之一主表面彼此局部靠近至可開始進行接合。
特別是,第一及第二晶元可分別置於第一及第二接合夾具上,其置於對垂直平面而言小於10°內之垂直位置,並在彼此靠近至可開始進行接合之垂直位置移動。
本發明更提供接合模組,其包含至少一第一可動接合夾具,其經組態以握持第一晶圓;以及第二可動接合夾具,其與第一可動接合夾具不同且經組態以握持與第一晶圓不同之第二晶圓。
其中第一及第二接合夾具經組態以分別在對垂直平面而言小於10°內之垂直位置握持第一及第二晶圓。接合夾具可經組態以藉由機械構件、靜電構件或真空握持第一及第二晶圓。
此接合模組之第一及第二接合夾具垂直地置於對垂直平面而言小於10°內之垂直位置。
另外,接合模組可包含真空室,而真空室中可提供第一及第二接合夾具。此接合模組可與上述半導體裝置製造設備之承載模組結合。
最後,本發明提供一種接合夾具,其經組態以握持欲與另一半導體晶圓接合之半導體晶圓,以使半導體晶元被握持在對垂直平面而言小於10°內之垂直位置,更特定而言,其角度小於10°,再更特定而言,其角度最大約為1°。
特別是,與晶圓之主表面接觸的夾具之主表面可被垂直定向在對垂直平面而言小於10°。接合夾具可以機械構件、靜電構件或真空握持晶圓。
本發明之其他特徵及優點將參照圖式說明如下。在此說明中會參照所附圖式,其用以繪示本發明之較佳實施例。應了解這些實施例並不能代表本發明之整體範疇。
如第1圖所示,本發明之設備之一例包含接合模組1以及承載模組2。晶圓之接合在接合模組1中之真空室中進行。接合模組1中之真空室的真空由真空泵構件3達成,其由控制閥4連接至接合模組之真空室。類似地真空亦可用於承載模組2中,其由另一真空泵構件5所提供。真空泵構件5經由控制閥6連接至承載模組2。在另一實施例中,單一真空泵分別由不同之控制閥連接至承載模組及接合模組。另外,承載模組2包含當晶圓由承載模組2運送至接合模組1時會開啟之第一閘7,以及當晶圓被機械構件運送至承載模組2時會開啟之第二閘8。
承載模組2可經組態為單晶圓傳送模組,其每次提供一單一晶圓至接合模組1,亦可包括晶圓儲存系統以透過第二閘8接收多個晶圓並將其儲存,然後將這些多個晶圓一次提供給接合模組1。
依本發明,在一或多個晶圓被載入承載模組2後且第二閘8關閉後(第一閘在載入的過程中皆維持關閉),承載模組2被抽真空至預定壓力。抽真空可由泵5以2.5至1000m3
/h之速率進行,特別是大於500m3
/h。承載模組2被抽真空至(例如)約1毫巴至數百毫巴或低於大氣壓力。接合模組1之真空室(例如)被抽真空至0.01毫巴至10毫巴或100毫巴之範圍間,特別是0.1毫巴至5毫巴之間。
在抽真空後,一或多個晶圓在第一閘7開啟後被運送至接合模組1之真空室,其已被第一真空泵構件3抽真空。由於由承載模組2至接合模組1之一或多個晶圓運送中,後者並不暴露於大氣壓力下,僅需(亦可能不需要)在晶圓運送完成且第一閘7關閉後相對於真空室之壓力做微調。如此產能可大幅增加。
需注意,當在第1圖中之接合模組1之(例如)左側提供另一承載模組並將其連接至接合模組1以接收已接合之晶圓時,產能可進一步增加。在此情況下,亦可在運送來自接合模組1之已接合之晶圓前,將此另一承載模組抽真空。另外,承載模組1可用來由接合模組1輸出已接合之晶圓至外界環境。
在第2圖中繪示本發明之一接合模組1之例。接合模組包含真空室,且其連接至第1圖中所述之真空泵。另外,接合模組包含光學系統9,其可決定在接合模組1中欲被接合之晶圓的表面上之對準標記的正確位置。
光學系統9僅在兩晶圓需完美的微米級對準時才需要。此種情況發生在接合之兩晶圓有微元件時。組件由微元件而定,其由在需精確定位之各層上或各層中執行之技術步驟產生。因此,微元件可為主動或被動元件、單純的接觸點或連接(interconnection)。在製程僅將具有微元件之晶圓接合至不含電路之支撐晶圓上時,可不需對準步驟及光學系統9。
另外,接合模組1提供第一接合夾具10以及第二接合夾具11,其分別夾持第一晶圓12以及第二晶圓13。接合夾具10以及11可由金屬或陶瓷製成以維持晶圓12及13之平面性。而第2圖中接合夾具11及12繪示為水平夾持晶圓12及13,而接合夾具11及12可較佳地排置而垂直地握持晶圓12及13。在此情況中,可避免因晶圓本身之重量而產生之形變。
第3圖繪示製造系統20之一例,其包含第1圖中所繪示之設備。特別是,製造系統20包含接合模組1(例如)第2圖中所繪示之接合模組1,以及二承載模組2及2'。製造系統20包括至少一承載介面模組21以將晶圓置入製造系統20。機械構件22經組態以處理並將晶圓由承載介面模組21運送至任何製造系統20之模組,或由一模組運送至另一模組。機械構件特別在一機械移動區中移動(以虛線標示),以使晶圓可由一處移至另一處。
另外,製造系統20亦包括電漿機台23,其可啟動置於製造系統20內之晶圓之一個或兩個主表面。若晶圓處理需要被接合之二晶圓的主表面皆被啟動,可加入第二電漿機台以減少表面準備之時間。此外,相同的電漿機台23可用以處理每個將被接合之晶圓的表面。第一清洗機台24用以清洗欲接合之第一晶圓之接合主表面,而第二清洗機台25用以清洗欲接合之第二晶圓之接合主表面。
製造系統20更包含控制單元(第3圖未示)以控制機械構件22在製造系統20中對晶圓之運送。例如,控制單元可控制機械構件22以:由承載介面21撿選第一晶圓並將其送至電漿機台23;由承載介面21撿選第二晶圓並將其送至清洗機台25;由電漿模組23撿選第一晶圓並將其送至清洗機台24;由清洗模組25撿選第二晶圓並將其送至承載模組2';由清洗模組24撿選第一晶圓並將其送至承載模組2;以及在第一及第二晶圓被處理後由承載模組2撿選已接合之第一及第二晶圓並將其送至承載介面21。
所有上述討論之實施例皆不欲用於限制,而是做為展示本發明之特徵及優點之範例。特別應注意的是,即使本發明以使用半導體產業之晶圓為例說明,但其亦可應用至特性(如本質、尺寸或形狀)與傳統半導體產業中所用之晶圓的特性不同之晶圓或基材。亦應了解上述之全部或一部之特徵可以各種不同方式組合。
1...接合模組
2...承載模組
3、5...真空泵構件
4、6...控制閥
7...第一閘
8...第二閘
9...光學系統
10...第一接合夾具
11...第二接合夾具
12...第一晶圓
13...第二晶圓
20...製造系統
21...承載介面模組
22...機械構件
23...電漿機台
24...第一清洗機台
25...第二清洗機台
第1圖繪示本發明一種製造半導體裝置之設備之範例,其包含接合模組及連接至接合模組之承載模組。
第2圖繪示本發明接合模組之範例。
第3圖繪示包含第1圖中繪示之設備之半導體裝置製造系統。
1...接合模組
2...承載模組
3、5...真空泵構件
4、6...控制閥
7...第一閘
8...第二閘
Claims (7)
- 一種用於接合半導體晶圓之接合模組,其包含:一真空泵;一真空室,其與該真空泵連接;一光學系統,其經組態以決定在該接合模組中欲被接合之該些半導體晶圓之表面上的對準標記之位置;以及進一步包含經組態以握持一第一晶圓之至少一第一可動接合夾具,一第二可動接合夾具,其與該第一可動接合夾具不同且經組態以握持與該第一晶圓不同之一第二晶圓,及一控制單元,其經組態以控制該第一及第二接合夾具以使其向彼此移動,而使該第一及該第二晶圓位於距離彼此一預定距離處,並將該第一及第二晶圓在該預定距離處放下,以開始在該第一及第二晶圓其中之一上施加一力,而使其彼此局部靠近至可開始進行接合。
- 如申請專利範圍第1項之接合模組,其中該第一及第二接合夾具經組態以在對一垂直平面而言小於10°內之垂直位置分別握持該第一及該第二晶圓。
- 如申請專利範圍第1項之接合模組,其中該第一接合夾具及(或)該第二接合夾具之曲度(bow)小於1微米或小於0.1微米。
- 如申請專利範圍第1項之接合模組,其中該第一接合夾 具及(或)該第二接合夾具以金屬或陶瓷製成。
- 如申請專利範圍第1項之接合模組,其中該控制單元更經組態以局部地減少由第一及第二接合夾具分別施加於該第一及第二晶圓上以將其握持之夾持力,以在該預定距離處放下該第一及第二晶圓,以使該第一及第二晶圓彼此局部靠近至可開始進行接合。
- 如申請專利範圍第5項之接合模組,其中該控制單元經組態以在該第一及該第二晶圓彼此局部靠近至可開始進行接合後,控制將該第一及(或)第二晶圓漸漸釋放或非漸漸釋放。
- 如申請專利範圍第5或6項之接合模組,其中該控制單元經組態以計算該第一及該第二接合夾具之位移,而將該第一及該第二晶圓對準。
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
FR1002618A FR2961630B1 (fr) | 2010-06-22 | 2010-06-22 | Appareil de fabrication de dispositifs semi-conducteurs |
Publications (2)
Publication Number | Publication Date |
---|---|
TW201225203A TW201225203A (en) | 2012-06-16 |
TWI449118B true TWI449118B (zh) | 2014-08-11 |
Family
ID=42699871
Family Applications (2)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
TW100145647A TWI449118B (zh) | 2010-06-22 | 2011-06-17 | 半導體裝置的製造設備 |
TW100121311A TWI443769B (zh) | 2010-06-22 | 2011-06-17 | 半導體裝置的製造設備 |
Family Applications After (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
TW100121311A TWI443769B (zh) | 2010-06-22 | 2011-06-17 | 半導體裝置的製造設備 |
Country Status (8)
Country | Link |
---|---|
US (4) | US20110308721A1 (zh) |
EP (2) | EP2432007A3 (zh) |
JP (2) | JP5943408B2 (zh) |
KR (2) | KR101234001B1 (zh) |
CN (3) | CN102299048A (zh) |
FR (1) | FR2961630B1 (zh) |
SG (1) | SG177106A1 (zh) |
TW (2) | TWI449118B (zh) |
Families Citing this family (14)
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FR2964193A1 (fr) | 2010-08-24 | 2012-03-02 | Soitec Silicon On Insulator | Procede de mesure d'une energie d'adhesion, et substrats associes |
-
2010
- 2010-06-22 FR FR1002618A patent/FR2961630B1/fr not_active Expired - Fee Related
- 2010-09-22 US US12/888,251 patent/US20110308721A1/en not_active Abandoned
-
2011
- 2011-06-17 TW TW100145647A patent/TWI449118B/zh not_active IP Right Cessation
- 2011-06-17 TW TW100121311A patent/TWI443769B/zh not_active IP Right Cessation
- 2011-06-20 EP EP11009599.9A patent/EP2432007A3/en not_active Withdrawn
- 2011-06-20 JP JP2011136614A patent/JP5943408B2/ja not_active Expired - Fee Related
- 2011-06-20 EP EP20110005013 patent/EP2400526A3/en not_active Withdrawn
- 2011-06-21 SG SG2011045515A patent/SG177106A1/en unknown
- 2011-06-21 KR KR20110060332A patent/KR101234001B1/ko not_active IP Right Cessation
- 2011-06-21 CN CN2011102122527A patent/CN102299048A/zh active Pending
- 2011-06-21 CN CN201610052078.7A patent/CN105428285A/zh active Pending
- 2011-06-21 CN CN201110414307.2A patent/CN102437073B/zh not_active Expired - Fee Related
- 2011-11-29 US US13/306,719 patent/US20120067524A1/en not_active Abandoned
- 2011-12-26 JP JP2011283992A patent/JP5776538B2/ja not_active Expired - Fee Related
-
2012
- 2012-01-05 KR KR1020120001471A patent/KR101363351B1/ko not_active IP Right Cessation
- 2012-09-21 US US13/624,470 patent/US9138980B2/en active Active
-
2015
- 2015-05-27 US US14/722,794 patent/US20150279830A1/en not_active Abandoned
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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Also Published As
Publication number | Publication date |
---|---|
EP2432007A3 (en) | 2017-03-22 |
KR101363351B1 (ko) | 2014-02-14 |
JP2012039089A (ja) | 2012-02-23 |
EP2400526A3 (en) | 2013-01-16 |
US9138980B2 (en) | 2015-09-22 |
TWI443769B (zh) | 2014-07-01 |
US20120067524A1 (en) | 2012-03-22 |
US20110308721A1 (en) | 2011-12-22 |
KR20110139149A (ko) | 2011-12-28 |
KR20120016299A (ko) | 2012-02-23 |
CN102437073A (zh) | 2012-05-02 |
SG177106A1 (en) | 2012-01-30 |
KR101234001B1 (ko) | 2013-02-18 |
CN102437073B (zh) | 2015-07-22 |
EP2432007A2 (en) | 2012-03-21 |
TW201203438A (en) | 2012-01-16 |
US20130032272A1 (en) | 2013-02-07 |
JP5776538B2 (ja) | 2015-09-09 |
US20150279830A1 (en) | 2015-10-01 |
FR2961630B1 (fr) | 2013-03-29 |
EP2400526A2 (en) | 2011-12-28 |
CN102299048A (zh) | 2011-12-28 |
FR2961630A1 (fr) | 2011-12-23 |
CN105428285A (zh) | 2016-03-23 |
JP2012099839A (ja) | 2012-05-24 |
JP5943408B2 (ja) | 2016-07-05 |
TW201225203A (en) | 2012-06-16 |
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