JPS6348685A - メモリ−カ−ド装置 - Google Patents

メモリ−カ−ド装置

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JPS6348685A JP61192558A JP19255886A JPS6348685A JP S6348685 A JPS6348685 A JP S6348685A JP 61192558 A JP61192558 A JP 61192558A JP 19255886 A JP19255886 A JP 19255886A JP S6348685 A JPS6348685 A JP S6348685A
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 産業上の利用分野 本発明は、データあるいは文章等の情報を記憶する半導
体メモリーを有するメモリーカード装置に関するもので
ある。
従来の技術 従来、半導体メモリーを具備するメモリーカードは、制
御回路に接続されたコネクタにメモリーカードを差し込
むことによりその半導体メモリーと制御回路とを電気的
に接続して前記半導体メモリーに対する情報の書込みま
たは情報の読み出しを行っている。そして、メモリーカ
ードとコネクタとの接続はきわめて多数の端子を介在さ
せて行っているものである。また、電源の接続もこれら
の端子の一部のものを用いて行っているものである。
発明が解決しようとする間居点 このようにメモリーカードをコネクタに挿入して多数の
端子を介在させて電気的接続をする場合に、情報の授受
を正しく行うためには、これらの端子が電気的に確実に
接続されていることが必要なものである。
しかしながら、コネクタに対するメモリーカードの挿入
は手で行うために、各端子が確実に接続状態になる深さ
まで充分に挿入されなかったり、傾いた状態で挿入され
たりして各端子全体の接続が不確かになるおそれがある
。このような状態で半導体メモリーに対する情報の授受
を行った場合には、正確に情報が伝達されず、その内容
が変化したり破壊されたりするおそれもある。
また、各端子の接続が不確かである場合には、電源供給
の確実性もなくなる。例えば、データ及び文章の読み書
きのできる半導体メモリーとしてＣ−Ｍ　ＯＳのスタツ
テイクＲＡＭを用いた場合に、確実に電源供給がされて
いない時には半導体メモリー内のデータ破壊が生じたり
する。
間悪点を解決するための手段 随時書き換え可能な半導体メモリーを有するカード本体
を設け、このカード本体の一辺に電源ライン端子と信号
ライン端子と検出端子とよりなる端子部を形成し、前記
電源ライン端子と前記信号ライン端子とよりも前記カー
ド本体の内方に前記検出端子を配置するとともに前記カ
ード本体が挿入されるコネクタの検出信号受端子に制御
回路を接続する。
作用 コネクタにカード本体が挿入及び離脱する時に、電源ラ
イン端子と信号ライン端子とのコネクタに対する接続と
検出端子のコネクタに対する接続とに時間差を持たせる
ことによって、カード本体が正しくコネクタに接続され
たかどうかを検出することができ、また、カード本体の
端子部の両側に検出端子を配置しているため、カード本
体を傾けた姿勢で挿入した場合には挿入された状態の検
出信号が発生せず、不確かな状態での情報書込または読
み出しを防止することができるものである。
実施例 本発明の一実施例を図面に基づいて説明する。
まず、薄い矩形状のカード本体１が形成され、このカー
ド本体１には半導体メモリー２が設けられている。前記
カード本体１の一方の辺３には端子部４が形成されてい
る。この端子部４の両側には対になった電源ライン端子
５のそれぞれが配置され、これらの電源ライン端子５の
間には直線状に並んだ信号ライン端子６が配列され、こ
れらの信号ライン端子６の画体側には対になった検出端
子７が配列されている。そして、前記カード本体１の一
方の前記辺３に前記電源ライン端子５の端部が一致して
おり、その辺３から内方に間隔ａを取ったところに信号
ライン端子６の端部が配置され、前記辺３から同じく内
方に間３３　ｂを取ったところに検出端子７の端部が配
置されている。また、間隔ａ、ｂの寸法関係は、ａ　（
ｂとなるように設定されている。さらに、前記電源ライ
ン端子５及び前記信号ライン端子６は前記半導体メモリ
ー２と電気的に配線されており、前記検出電極７は互い
に短絡されている。
次に、前記カード本体１が挿入されるコネクタ８が設け
られ、このコネクタ８には直線状に−列に並んだ端子部
９が設けられている。前記コネクタ８には前記カード本
体ｌの電源ライン端子５と信号ライン端子６と前記検出
端子７とに対応させてｆｔｂＷライン受端子１０と二つ
の検出受端子１１゜１２及び信号ライン受端子１３とが
形成されている。
また、電子機器１４は、スイッチ回路１５と遅延回路１
６とゲート回路１７と制御回路としてのメモリーカード
制御装置１８とを具備し、このメモリーカード制御装置
１８と前記コネクタ８との間には前記スイッチ回路１５
が接続され、このスイッチ回路１５には前記検出受端子
１１に接続されるとともに抵抗Ｒを介して供給電源■に
接続された前記遅延回路１６が接続されている。また、
前記遅延回路１６の入力側と出力側とはゲート回路１７
の入力端に接続され、このゲート回路１７の出力側は前
記メモリーカード制御装置１８に接続されている。
このような構成において、第２図のタイムチャートを参
照して動作の説明をする。まず、第１図に示すようにカ
ード本体１の辺３に位置する電ニスライン端子Ｓに対し
て信号ライン端子６は間隔ａを有し、また検出端子７は
間隔すを有している。
但し１、前述のように間隔ａ　＜　ｂである。しかして
、カード本体１がコネクタ８に挿入される場合について
見ると、他の端子に比較して、端子部４の両側にある電
源ライン端子５とコネクタ８の電源ライン受端子１０と
が早く接続される。次に、カード本体１の信号ライン端
子６とコネクタ８の信号ライン受端子１３とが接続され
、最後に検出端子７とコネクタ８の検出受端子１１及び
検出受端子１２とが接続される。このような順に各々の
端子が接続される。また、抜きさる時はこの逆に検出端
子７と検出受端子１１および検出受端子１２とが先ず離
脱し、最後にカード本体１の電源ライン端子５とコネク
タ８の電源ライン受端子１０とが離脱する。このように
接続または離脱する時に端子の接続及び離脱に時間差が
生じるが、常に電源ライン端子５が接続されている状態
で他の端子の電気的な断続がなされる。
また、電源ライン端子５はカード本体１の両側に配置さ
れているので、両側の端子が共にコネクタ８に接続しな
ければ半導体メモリー２には電源供給はされない。例え
ば、カード本体１を斜めに挿入した時などは正しい姿勢
にセットされるまで電源供給がされない。従って、不完
全な挿入状態のまま使用されることが防止される。
さらに、カード本体１がコネクタ８に挿入されると、検
出信号ＤＥＴ２の電位はハイレベルからローレベルにな
り、カード本体１がコネクタ８から離脱すると電位はロ
ーレベルからハイレベルになる。その信号は遅延回路１
６にも伝達される。
また、遅延回路１６からの遅延信号ＤＥＴ３によりスイ
ッチ回路１５が閉じるので、信号ラインは必ずカード本
体１が正しくコネクタ８に差し込まれＣから閉じるもの
である。さらに、検出信号ＤＥＴ２と検出信号ＤＥＴ３
との論理積によって得られた信号である検出信号ＤＥＴ
１がメモリーカード制御装置１８に伝達されるので、メ
モリーカード制御装置１８の動作タイミングも必ずカー
ド本体１が正しくコネクタ８に差し込まれてから動作す
るように制御されているものである。すなわち、メモリ
ーカード制御装置１８はカード本体１が挿入されること
により発生する検出信号ＤＥＴ２とその遅延した信号で
ある遅延信号ｔ）ＥＴ３との論理積の信号である検出信
号ＤＥＴＩを監視することで、カード本体１がコネクタ
８に確実に接続されたと判断しデータ等の書き込みを行
なう。
反対にカード本体１が離脱する時には検出信号ＤＥＴＩ
を確認しており、検出端子７が検出受端子１１．１２か
ら離れた時にカード本体１を抜き出しつつあることを検
出信号ＤＥＴ２の変化に基づく検出信号ＤＥＴｉの変化
で検出する。この時、検出信号ＤＥＴ１の発生時より信
号ライン端子６が４３号ライン受端子１３から、Ｉ　Ｉ
ＩＪ２するまでは、ｂ−ａの寸法骨だけカード本体１か
移動する時間幅があるので、この間にフローテングして
いるデータは混乱のないように処理することが可能なも
のである。但し、第２図において、カード本体１がコネ
クタ８から抜かれることで検出信号ＤＥＴ　１がローレ
ベルになって、スイッチ回路１５により信号が切り離さ
れる時間Ｔ１とデータ等の書き込みの処理時間Ｔ２につ
いてはＴｌ＞Ｔ２である条件とする。
発明の効果 本発明は、上述のように随時書き換え可能な半導体メモ
リーを有するカード本体を設け、このカード本体の一辺
にｆｔ１ｆライン端子と信号ライン端子と検出端子とよ
りなる端子部を形成し、前記電源ライン端子と前記信号
ライン端子とよりも前記カード本体の内方に前記検出端
子を配置するとともに前記カード本体が挿入されるコネ
クタの検出信号受端子に制御回路を接続したので、コネ
クタにカード本体が挿入及び離脱する時に、電源ライン
端子と信号ライン端子とのコネクタに対する接続と検出
端子のコネクタに対する接続とに時間差を持たせること
によって、カード本体が正しくコネクタに接続されたか
どうかを検出することができ、また、検出端子を対にし
てそれらをカード本体の両側に配置したことにより、カ
ード本体を傾けた姿勢で挿入した場合には挿入された状
態の検出信号が発生せず、不確かな状態での情報書込ま
たは読み出しを防止することができ、さらに、制御回路
と前記半導体メモリーとを接続する信号ラインにスイッ
チ回路を設け、前記コネクタの検出受端子に遅延回路を
介して前記スイッチ回路を接続した゛ことにより、信号
ラインのオン・オフを検出端子からの検出信号よりも遅
らせて行うことにより情報処理に混乱が発生することを
防止することができる等の効果を有するものである。
【図面の簡単な説明】
図面は本発明の一実施例を示すもので、第１図はカード
本体と電子機器との接続状態を示すブロック図、第２図
はタイムチャートである。 １・・・カード本体、２・・・半導体メモリー、３・・
・辺、４・・・端子部、５・・・電源ライン端子、６・
・・信号ライン端子、７・・・検出端子、８・・・コネ
クタ、１１，１２・・・検出受端子、１５・・・スイッ
チ回路、１６・・・遅延回路、１８・・・メモリーカー
ド制御装置（制御装置） 出　願　人　　　東京電気株式会社 ｙ３Ｚ図 イ８邑ライン

Claims (1)

  1. 【特許請求の範囲】 １、随時書き換え可能な半導体メモリーを有するカード
    本体を設け、このカード本体の一辺に電源ライン端子と
    信号ライン端子と検出端子とよりなる端子部を形成し、
    前記電源ライン端子と前記信号ライン端子とよりも前記
    カード本体の内方に前記検出端子を配置するとともに前
    記カード本体が挿入されるコネクタの検出信号受端子に
    制御回路を接続したことを特徴とするメモリーカード装
    置。 ２、検出端子を対にしてそれらをカード本体の両側に配
    置したことを特徴とする特許請求の範囲第１項記載のメ
    モリーカード装置。 ３、随時書き換え可能な半導体メモリーを有するカード
    本体を設け、このカード本体の一辺に電源ライン端子と
    信号ライン端子と検出端子とよりなる端子部を形成し、
    前記電源ライン端子と前記信号ライン端子とよりも前記
    カード本体の内方に前記検出端子を配置するとともに前
    記カード本体が挿入されるコネクタの検出信号受端子に
    制御回路を接続し、この制御回路と前記半導体メモリー
    とを接続する信号ラインにスイッチ回路を設け、前記コ
    ネクタの検出受端子に遅延回路を介して前記スイッチ回
    路を接続したことを特徴とするメモリーカード装置。
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