JPH11355668A - 固体撮像素子およびその駆動方法、並びにカメラシステム - Google Patents
固体撮像素子およびその駆動方法、並びにカメラシステムInfo
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Abstract
数が多いと、画素サイズの縮小化の妨げとなる。 【解決手段】 行列状に配置された単位画素10n,m
を、フォトダイオード11と、このフォトダイオード1
1に蓄積された電荷を転送する転送スイッチ12と、こ
の転送スイッチ12によって転送された電荷を蓄積する
フローティングディフュージョン13と、このフローテ
ィングディフュージョン13をリセットするリセットス
イッチ14と、フローティングディフュージョン13の
電位に応じた信号を垂直信号線23に出力する増幅トラ
ンジスタ15とによって構成し、リセットスイッチ14
のドレインに垂直選択パルスφVnを与えることによっ
てそのリセット電位をコントロールすることにより、行
単位で画素の選択を行うようにする。
Description
びその駆動方法、並びにカメラシステムに関し、特に行
列状に配置された単位画素ごとに増幅機能を持つCMO
Sイメージセンサなどの増幅型固体撮像素子およびその
駆動方法、並びに撮像デバイスとして増幅型固体撮像素
子を用いたカメラシステムに関する。
メージセンサには、種々の画素構造のものが存在する。
その一例として、画素内部にフローティングディフュー
ジョン(Floating Diffusion;FD)を持った画素構造
が知られている。この画素構造では、フローティングデ
ィフュージョンで信号が増幅されるため、感度を大きく
とれる利点がある。この種の画素構造の従来例を図18
に示す。
素100の各々は、フォトゲート101、転送スイッチ
102、フローティングディフュージョン103、リセ
ットトランジスタ104、増幅トランジスタ105およ
び垂直選択トランジスタ106を有している。そして、
垂直選択トランジスタ106が垂直選択線111を介し
て与えられる垂直選択パルスに応答して単位画素100
を行単位で選択することにより、増幅トランジスタ10
5で増幅された信号を垂直信号線112に出力する構成
となっている。
の縮小化を図るためには、単位画素100を構成する素
子数を少なくする必要がある。しかしながら、上述した
従来例に係るCMOSイメージセンサの画素構造では、
フローティングディフュージョン103の電位を行単位
で選択して垂直信号線112に出力するのに、リセット
トランジスタ104、増幅トランジスタ105および垂
直選択トランジスタ106の3個のトランジスタを各画
素ごとに用いた構成となっているため、素子数が多く、
画素サイズを縮小化するのに限界があった。
であり、その目的とするところは、増幅機能を持つ単位
画素の構成素子数を削減し、画素サイズの縮小化を可能
とした固体撮像素子およびその駆動方法、並びにカメラ
システムを提供することにある。
子は、光電変換素子と、この光電変換素子に蓄積された
電荷を転送する転送スイッチと、この転送スイッチによ
って転送された電荷を蓄積する電荷蓄積部と、この電荷
蓄積部をリセットするリセットスイッチと、電荷蓄積部
の電位に応じた信号を垂直信号線に出力する増幅素子と
を具備し、行列状に配置された単位画素と、上記リセッ
トスイッチに与えるリセット電位をコントロールするこ
とによって行単位で画素の選択を行う垂直走査回路と、
垂直信号線に出力された信号を列単位で順次選択する水
平走査回路と、この水平走査回路によって選択された信
号を水平信号線を経由して出力する出力回路とを備えた
構成となっている。
素におけるリセットスイッチに与えるリセット電位を、
画素の非選択時に例えば0Vとすることにより、電荷蓄
積部の電位は“L”レベルとなる。そして、リセットス
イッチに与えるリセット電位を例えば画素電源電圧にす
ることによって画素の選択が行われ、次いでリセットパ
ルスが発生することによって電荷蓄積部の電位が画素電
源電圧にリセットされる。すなわち、リセット電位をコ
ントロールすることによって電荷蓄積部の電位がコント
ロールされる。その後、光電変換素子に蓄積された信号
電荷が転送スイッチによって電荷蓄積部に転送され、こ
の転送に伴って変化する電荷蓄積部の電位が増幅素子に
よって垂直信号線に読み出される。
行列状に配置された単位画素が、光電変換素子と、この
光電変換素子に蓄積された電荷を転送する転送スイッチ
と、この転送スイッチによって転送された電荷を蓄積す
る電荷蓄積部と、この電荷蓄積部をリセットするリセッ
トスイッチと、電荷蓄積部の電位に応じた信号を垂直信
号線に出力する増幅素子とを具備してなる固体撮像素子
において、リセットスイッチに与えるリセット電位をコ
ントロールすることによって行単位で画素の選択を行う
ようにする。
おいて、電荷蓄積部をリセットするリセットスイッチに
与えるリセット電位をコントロールすることで、電荷蓄
積部の電位がコントロールされる。これにより、垂直
(行)選択のための素子が存在しなくても画素が行単位
で選択される。すなわち、リセットスイッチが画素を行
単位で選択する作用をもなす。したがって、単位画素内
から垂直選択のための素子を削減できる。
て図面を参照しつつ詳細に説明する。
OSイメージセンサを示す概略構成図である。図1にお
いて、単位画素10が2次元配置されて画素部を構成し
ており、ここでは簡略化のために、n行m列の単位画素
10n,mおよびn+1行m列の単位画素10n+1,
mの2画素のみを示す。単位画素10の画素構造は全て
の画素について同じであり、以下、n行m列の単位画素
10n,mの画素構造を例にとって説明するものとす
る。
る例えばフォトダイオード11、転送スイッチ12、電
荷蓄積部であるフローティングディフュージョン(F
D)13、リセットスイッチ14および増幅トランジス
タ15を有する構成となっている。なお、光電変換素子
としては、フォトダイオード11に代えてフォトゲート
や埋め込みフォトダイオードなどを用いることも可能で
ある。
Nchエンハンスメント型トランジスタが、リセットス
イッチ14としてNchデプレッション型トランジスタ
が、増幅トランジスタ15としてNchエンハンスメン
ト型トランジスタがそれぞれ用いられる。ただし、これ
らトランジスタの全てもしくは一部をPchトランジス
タで置き換えた回路構成とすることも可能である。
ダイオード11はPN接合ダイオードであり、入射光を
その光量に応じた電荷量の信号電荷に光電変換し、これ
を蓄積する。転送スイッチ12は、フォトダイオード1
1とフローティングディフュージョン13の間に接続さ
れ、フォトダイオード11に蓄積された信号電荷をフロ
ーティングディフュージョン13へ転送する。フローテ
ィングディフュージョン13は、転送された信号電荷を
信号電圧に変換し、増幅トランジスタ15のゲートに与
える。
ディフュージョン13と垂直選択線21の間に接続さ
れ、フローティングディフュージョン13の電位を画素
電源の電位にリセットする機能を持つ。増幅トランジス
タ15は、電源ライン22と垂直信号線23の間に接続
され、フローティングディフュージョン13の電位を増
幅して垂直信号線23に出力する。なお、本例では、画
素電源として例えば3.3Vの電源を用いるが、これに
限定されるものではない。
および垂直信号線23のポテンシャル分布を示す。同図
において、PDはフォトダイオード11を、TSは転送
スイッチ12を、FDはフローティングディフュージョ
ン13を、RSはリセットスイッチ14を、ATは増幅
トランジスタ15をそれぞれ表している。そして、フロ
ーティングディフュージョン13および増幅トランジス
タ15のポテンシャルについては、選択時のポテンシャ
ル動作範囲を実線で、非選択時も含めたポテンシャル動
作範囲を破線でそれぞれ示している。
位で選択するために設けられたものであり、例えばシフ
トレジスタによって構成されている。この垂直走査回路
24からは、垂直選択パルスφV(…,φVn,φVn
+1,…)、転送パルスφT(…,φTn,φTn+
1,…)およびリセットパルスφR(…,φRn,φR
n+1,…)が出力される。
n,φVn+1,…)は垂直選択線21を介してリセッ
トスイッチ14のドレインに、転送パルスφT(…,φ
Tn,φTn+1,…)は転送線25を介して転送スイ
ッチ12のゲートに、リセットパルスφR(…,φR
n,φRn+1,…)はリセット線26を介してリセッ
トスイッチ14のゲートにそれぞれ印加される。
力回路27が各列ごとに接続されている。この垂直信号
線出力回路27としては、例えば電圧モード型の出力回
路が用いられる。垂直信号線出力回路27には、水平走
査回路28から水平選択パルスφH(…,φHm,…)
が与えられる。この水平走査回路28は、単位画素10
を列単位で選択するために設けられたものであり、例え
ばシフトレジスタによって構成されている。
信号線29に接続されている。この水平信号線29に
は、単位画素10から垂直信号線23を介して垂直信号
線出力回路27に読み出された1行分の信号が、水平走
査回路28の水平走査によって垂直信号線出力回路27
から順次出力される。水平信号線29の端部には水平信
号線出力回路30の入力端が接続されている。
OSイメージセンサにおける画素動作について、nライ
ン(n行)の画素の選択時を例にとって図3のタイミン
グチャートを用いて図4および図5のポテンシャル図を
参照しつつ説明する。
状態である。この非選択状態においては、垂直選択パル
スφVnは“L”レベル(0V)にあり、またリセット
スイッチ(RS)14がオフ状態にあるため、フローテ
ィングディフュージョン(FD)13の電位は0Vとな
る。
が“L”レベルから“H”レベル(3.3V)に遷移
し、同時に、リセットパルスφRnが発生すると、これ
に応答してリセットスイッチ14がオン状態となり、0
Vであったnライン目のフローティングディフュージョ
ン13の電位を3.3Vにリセットする。この結果、増
幅トランジスタ(AT)15がターンオンするため、n
ライン目の画素が選択状態となる(t1<t<t2)。
消滅すると、このリセットされた状態のフローティング
ディフュージョン13の読み出しが行われる。これによ
り、画素ごとに異なっているオフセットレベル(以下、
これをノイズレベルと呼ぶ)が、増幅トランジスタ15
によって垂直信号線23に読み出され、かつ垂直信号線
出力回路27に出力される(t2<t<t3)。この読
み出されたノイズレベルは、垂直信号線出力回路27内
に保持(サンプルホールド)される。
すると、転送スイッチ(TS)12は、そのゲートに転
送パルスφTnが印加されることによってゲート下のポ
テンシャルが深くなることにより、フォトダイオード
(PD)11に蓄積された信号電荷をフローティングデ
ィフュージョン13に転送する(t3<t<t4)。こ
の信号電荷の転送により、フローティングディフュージ
ョン13の電位がその電荷量に応じて変化する。
すると、フローティングディフュージョン13の信号電
荷に応じた電位が、増幅トランジスタ15によって垂直
信号線23に読み出され、かつ垂直信号線出力回路27
に出力される(t4<t<t5)。この読み出された信
号レベルは、垂直信号線出力回路27内に保持(サンプ
ルホールド)される。
号線出力回路27に画素10から読み出された信号は、
水平走査回路28による水平走査によって順次水平信号
線29を介して水平信号線出力回路30に出力される。
このとき、これら出力回路27,30においては、単位
画素10の信号レベルからノイズレベルを減算すること
により、単位画素10の特性のばらつきに起因する固定
パターンノイズを抑圧する動作が行われるとともに、垂
直信号線出力回路27の特性のばらつきに起因する固定
パターンノイズを抑圧する動作が行われる。
スφVnが“H”レベルから“L”レベルに遷移し、こ
れによりnライン目の画素が非選択状態となり、同時に
次のn+1ライン目の画素が選択状態となり、このn+
1ライン目について上述した動作が繰り返される。
する。垂直選択パルスφVを“L”レベル(0V)とす
ることにより、画素10を非選択状態にできる。なぜな
ら、リセットスイッチ14としてデプレッション型トラ
ンジスタを用いているため、垂直選択パルスφVが0V
の場合、フローティングディフュージョン13は常に0
Vになっており、そのため増幅トランジスタ15は常に
カットオフ状態となるからである。
イオード11、転送スイッチ12、フローティングディ
フュージョン13、リセットスイッチ14および増幅ト
ランジスタ15で構成し、リセットスイッチ14を通し
てフローティングディフュージョン13の電位をコント
ロールするようにしたことにより、従来の画素構造のよ
うに、垂直選択スイッチを設けなくても垂直選択の機能
を持たせることができるため、トランジスタを1個削減
することができる。
して、垂直選択パルスφVを“L”レベルで駆動した場
合、t3<t<t4の期間以外の長い期間、転送スイッ
チ12のゲートを負電位にすることができる。このよう
にした場合、フォトダイオード11に隣接している転送
スイッチのシリコン界面に長い期間正孔を注入すること
ができるため、暗電流を抑圧することができる。これ
は、特にフォトダイオード11として埋め込み型センサ
構造を採用した場合に効果が大きい。
め、全ラインの画素の信号を独立に読み出す全画素独立
読み出し動作モードで説明を行ったが、これに限定され
るものではなく、第1フィールドでは奇数(偶数)ライ
ンの信号を読み出し、第2フィールドでは偶数(奇数)
ラインの信号を読み出すフレーム読み出し動作モード
や、隣り合う2ラインの信号を同時に読み出して電圧加
算するとともに、フィールドごとに加算する2ラインの
組合せを変えるフィールド読み出し動作モードでも勿論
可能である。
いて説明する。フォトダイオード11での信号電荷の蓄
積時には、図4(a)から明らかなように、フローティ
ングディフュージョン13が0Vとなる。そのため、蓄
積時には転送スイッチ12の表面ポテンシャルは0V以
下である必要がある。しかしながら、このままでは、フ
ォトダイオード11でオーバーフローした電荷を掃き捨
てるためのパスが存在しないことになる。
ば電源に接続された拡散層、例えば増幅トランジスタ1
5のドレインなどをフォトダイオード11に隣接してレ
イアウトし、両者間の素子分離を不完全とすることによ
ってオーバーフローパスを形成し、当該パスを経由して
フォトダイオード11で過剰電荷を掃き捨てる(オーバ
ーフローさせる)構成を採るようにする。これにより、
単位画素10の面積を増加させることなく、オーバーフ
ローパスを形成することができる。
るような種々の構造が考えられる。すなわち、図6にお
いて、素子分離領域の幅(距離)を縮めることによって
オーバーフローパスを形成する構造(a)、チャネルス
トップのP領域の濃度を下げることによってオーバーフ
ローパスを形成する構造(b)、チャネルストップのP
領域の下にN- 領域を積極的に形成してこれをオーバー
フローパスとする構造(c)などである。
み型センサ構造を用いた場合において、オーバーフロー
パスの横方向の距離を制御良く形成するために、センサ
用N + (SN用N+ )領域を画素電源側にも形成し、す
かしを入れてソース/ドレイン用N+ 領域を形成する構
造(d)、さらに(d)の構造において、オーバーフロ
ーパス用にN- 領域を形成する構造(e)などがある。
(Local Oxidation of Silicon)酸化膜を図示してある
が、これは必ずしも必要ではない。ただし、この場合、
オーバーフローパスの横方向の距離を制御良く形成する
ために、(d)の構造の例のように、フォトダイオード
11側のN+ とオーバーフローパルスに隣接する画素電
源側のN+ は、同一マスクでイオン注入することが好ま
しい。
ように、オーバーフローパスをバーチャルゲートで形成
することにより、オーバーフロー部のシリコン界面が空
乏化しない。したがって、従来例のような、シリコン界
面が空乏化する転送ゲートを利用したオーバーフロー構
造に比べて、暗電流の発生が少なくなる。特に、フォト
ダイオード11として埋め込み型センサ構造を用いた場
合、シリコン界面が空乏化する部分を完全に無くすこと
ができるため、その効果は大である。
示す概略構成図である。第1実施形態では、画素からの
信号を電圧モードで出力する構成を採っているのに対
し、本変形例では、画素からの信号を電流モードで出力
する構成を採っている。したがって、単位画素の画素構
造は、第1実施形態の場合と全く同じであり、信号の出
力系の構成のみが異なっている。
は、垂直信号線23の端部と水平信号線29の間に水平
選択スイッチ31を接続するとともに、水平信号線29
の端部には抵抗32で帰還したオペアンプ33を配置し
た構成となっている。すなわち、画素からの信号を電流
モードで出力させるために、垂直信号線23および水平
信号線29を抵抗32で帰還したオペアンプ33で一定
電位(Vbias)に固定し、かつ例えば電源回路34
を内蔵し、画素に与える電源電圧を下げることによって
単位画素10n,m内の増幅トランジスタ15を線形動
作させるようにしている。
し、画素に与える電源電圧を下げる構成を採ったが、こ
れに限定されるものではなく、例えば単位画素10n,
m内の増幅トランジスタ15のしきい値電圧Vthを下
げることによっても、当該増幅トランジスタ15を線形
動作させることが可能である。
び垂直信号線23のポテンシャル分布を示す。同図にお
いて、PDはフォトダイオード11を、TSは転送スイ
ッチ12を、FDはフローティングディフュージョン1
3を、RSはリセットスイッチ14を、ATは増幅トラ
ンジスタ15をそれぞれ表している。そして、フローテ
ィングディフュージョン13および増幅トランジスタ1
5のポテンシャルについては、選択時のポテンシャル動
作範囲を実線で、非選択時も含めたポテンシャル動作範
囲を破線でそれぞれ示している。
センサの動作を説明するためのタイミングチャートであ
る。単位画素10n,mの動作の本質的な部分は、第1
実施形態の場合と同じであり、ここでは重複するのでそ
の説明を省略し、異なる部分についてのみ説明する。
期間中に行う。また、ノイズレベルの読み出しは行わ
ず、信号レベルの読み出しのみ行う。電流モードでは、
電圧モードのように、信号出力系においてサンプルホー
ルド動作を行うことができないため、信号レベルの画素
の特性に起因する固定パターンノイズについては、外部
の信号処理系においてフレームメモリを用いてその抑圧
を行うようにすることになる。
インの画素の信号を独立に読み出す全画素独立読み出し
動作モードの場合を示しているが、これに限定されるも
のではなく、第1フィールドでは奇数(偶数)ラインの
信号を読み出し、第2フィールドでは偶数(奇数)ライ
ンの信号を読み出すフレーム読み出し動作モードや、隣
り合う2ラインの信号を同時に読み出して電流加算を行
うとともに、フィールドごとに加算する2ラインの組合
せを変えるフィールド読み出し動作モードの場合も勿論
可能である。
MOSイメージセンサを示す概略構成図である。図10
において、単位画素40が2次元配置されて画素部を構
成しており、ここでは簡略化のために、n行m列の単位
画素40n,mおよびn+1行m列の単位画素40n+
1,mの2画素のみを示す。単位画素40の画素構造は
全ての画素について同じであり、以下、n行m列の単位
画素40n,mの画素構造を例にとって説明するものと
する。
るフォトダイオード41、転送スイッチ42、電荷蓄積
部であるフローティングディフュージョン(FD)4
3、リセットスイッチ44、増幅トランジスタ45およ
び転送選択スイッチ46を有する構成となっている。な
お、光電変換素子としては、フォトダイオード41に代
えてフォトゲートなどを用いることも可能である。
Nchエンハンスメント型トランジスタが、リセットス
イッチ44としてNchデプレッション型トランジスタ
が、増幅トランジスタ45としてNchエンハンスメン
ト型トランジスタが、転送選択スイッチ45としてNc
hエンハンスメント型トランジスタがそれぞれ用いられ
る。ただし、これらトランジスタの全てもしくは一部を
Pchトランジスタで置き換えた回路構成とすることも
可能である。
ダイオード41は、例えば埋め込みセンサ構造のPN接
合ダイオードであり、入射光をその光量に応じた電荷量
の信号電荷に光電変換し、これを蓄積する。転送スイッ
チ42は、フォトダイオード41とフローティングディ
フュージョン43の間に接続され、フォトダイオード4
1に蓄積された信号電荷をフローティングディフュージ
ョン43へ転送する。フローティングディフュージョン
43は、転送された信号電荷を信号電圧に変換し、増幅
トランジスタ45のゲートに与える。
ディフュージョン43と垂直選択線51の間に接続さ
れ、フローティングディフュージョン43の電位を画素
電源の電位にリセットする機能を持つ。増幅トランジス
タ45は、電源ライン52と垂直信号線53の間に接続
され、フローティングディフュージョン43の電位を増
幅して垂直信号線53に出力する。
えば3.3Vの電圧が与えられる。ただし、電源電圧は
3.3Vに限定されるものではない。転送選択スイッチ
46は、転送線55と転送スイッチ42のゲートの間に
接続され、転送スイッチ42の転送制御を行う。
0および垂直信号線53のポテンシャル分布を示す。同
図において、PDはフォトダイオード41を、TSは転
送スイッチ42を、FDはフローティングディフュージ
ョン43を、RSはリセットスイッチ44を、ATは増
幅トランジスタ45を、SSは転送選択スイッチ46を
それぞれ表している。フローティングディフュージョン
43および増幅トランジスタ45のポテンシャルについ
ては、選択時のポテンシャル動作範囲を実線で、非選択
時も含めたポテンシャル動作範囲を破線でそれぞれ示し
ている。
ォトダイオード41として埋め込みセンサ構造のフォト
ダイオードが用いられている。すなわち、PN接合ダイ
オードの基板表面側に、P+ の正孔蓄積層47を有する
センサ構造となっている。また、単位画素40のオーバ
ーフローパスに関しては、第1実施形態の場合と同様
に、図6(a)〜(e)の画素構造が採られているもの
とする。
位で選択するために設けられたものであり、例えばシフ
トレジスタによって構成されている。この垂直走査回路
56からは、垂直選択パルスφV(…,φVn,φVn
+1,…)が出力される。そして、垂直選択パルスφV
(…,φVn,φVn+1,…)は垂直選択線51を介
してリセットスイッチ14のドレインに印加される。
位で選択するために設けられたものであり、例えばシフ
トレジスタによって構成されている。この水平走査回路
57からは、リセットパルスφR(…,φRm,…)、
転送パルスφT(…,φTm,…)および水平選択パル
スφH(…,φHm,…)がそれぞれ出力される。そし
て、転送パルスφT(…,φTm,…)は転送線55を
介して転送選択スイッチ46のドレインに、リセットパ
ルスφR(…,φRm,…)はリセット線58を介して
リセットスイッチ44のゲートにそれぞれ印加される。
間には、水平選択スイッチ60が接続されている。水平
選択トランジスタ60としては、例えばNchトランジ
スタが用いられる。この水平選択トランジスタ60のゲ
ートには、水平走査回路57から出力される水平選択パ
ルスφH(…,φHm,…)が与えられる。水平信号線
59の端部には、抵抗61で帰還したオペアンプ62が
配置されている。
メージセンサでは、画素からの信号を電流モードで出力
する形態を採っている。すなわち、垂直信号線53およ
び水平信号線59を抵抗61で帰還したオペアンプ62
で一定電位(Vbias)に固定し、かつ電源回路54
を内蔵し、画素に与える電源電圧を下げることによって
単位画素40n,m内の増幅トランジスタ45を線形動
作させるようにしている。
蔵し、画素に与える電源電圧を下げることによって増幅
トランジスタ45を線形動作させる構成としたが、これ
に限られるものではなく、第1実施形態の変形例の場合
と同様に、例えば単位画素40n,m内の増幅トランジ
スタ45のしきい値電圧Vthを下げることによって
も、当該増幅トランジスタ45を線形動作させることが
可能である。
OSイメージセンサにおける画素動作について、nライ
ンの画素の選択時を例にとって図12のタイミングチャ
ートを用いて図13および図14のポテンシャル図を参
照しつつ説明する。
状態である。この非選択状態においては、垂直選択パル
スφVnは“L”レベル(0V)にあり、またリセット
スイッチ(RS)44がオフ状態にあるため、フローテ
ィングディフュージョン(FD)43の電位は0Vとな
る。
が“L”レベルから“H”レベル(3.3V)に遷移す
る。すると、リセットトランジスタ44としてデプレッ
ション型トランジスタを用いているため、増幅トランジ
スタ(AT)45のゲート電位が上昇する(t1<t<
t2)。
シャルの設定や、垂直信号線53の電位により、増幅ト
ランジスタ45がオンする場合もある。本例では、カッ
トオフしているものとする。ただし、この時点では、水
平選択スイッチ60がオフしており、水平信号線59に
何ら影響を与えることはないため、増幅トランジスタ4
5の状態はどうであっても構わない。
発生すると、これに応答してリセットスイッチ44がオ
ン状態となって、0Vであったnライン目のm列のフロ
ーティングディフュージョン43の電位を3.3Vにリ
セットする。この結果、増幅トランジスタ(AT)15
がターンオンするため、nライン目のm列の単位画素4
0n,mが選択状態となる(t2<t<t3)。
消滅すると、このリセットされた状態のフローティング
ディフュージョン43の読み出しが行われる。これによ
り、画素ごとに異なっているオフセットレベル(以下、
これをノイズレベルと呼ぶ)が、垂直信号線53へ読み
出される(t3<t<t4)。この読み出されたノイズ
レベルは、時刻t2で発生した水平選択パルスφHmに
応答してオン状態にある水平選択スイッチ60によって
水平信号線59へ出力される。
すると、転送スイッチ(TS)42は、そのゲートに転
送パルスφTmが印加されることによってゲート下のポ
テンシャルが深くなることにより、フォトダイオード
(PD)41に蓄積された信号電荷をフローティングデ
ィフュージョン43に転送する(t4<t<t5)。こ
の信号電荷の転送により、フローティングディフュージ
ョン43の電位がその電荷量に応じて変化する。
すると、フローティングディフュージョン43の信号電
荷に応じた電位が、増幅トランジスタ45によって垂直
信号線53へ読み出される(t5<t<t6)。この読
み出された信号レベルは、水平選択スイッチ60によっ
て水平信号線59へ出力される。
スφVnが“H”レベルから“L”レベルに遷移し、こ
れによりnライン目の画素が非選択状態となり、同時に
次のn+1ライン目の画素が選択状態となり、このn+
1ライン目について上述した動作が繰り返される。
イズレベル出力→信号レベル出力という順序で(信号レ
ベル出力→ノイズレベル出力の順序であっても良い)、
ノイズレベル、信号レベルを順次得る動作のことを画素
点順次リセット動作というものとする。
うな利点がある。 ノイズ出力と信号出力が水平選択スイッチ60を含む
同一経路をとるため、原理的に、経路間のばらつきに起
因する固定パターンノイズが発生しない。 ノイズレベル、信号レベルが順次出力されるため、外
部の信号処理系において、フレームメモリやラインメモ
リを用いることなく、相関二重サンプリング回路(CD
S回路)などの差分回路により、ノイズレベルと信号レ
ベルの差分をとることが可能となり、システムが簡略化
できる。
行うためには、高速動作が要求される。そのため、動作
速度的に有利な電流モードで画素からの信号を出力させ
る。ただし、電流モード出力の形態に限られるものでは
なく、速度的要求を満足するならば、第1実施形態に係
るCMOSイメージセンサのような電圧モード出力の形
態を採ることも可能である。
び図16のポテンシャル図から明らかなように、列方向
に転送パルスφTmおよびリセットパルスφRmを共有
していても、特に問題はないことがわかる。
ラインの画素の信号を独立に読み出す全画素独立読み出
し動作モードで説明を行ったが、これに限定されるもの
ではなく、第1フィールドでは奇数(偶数)ラインの信
号を読み出し、第2フィールドでは偶数(奇数)ライン
の信号を読み出すフレーム読み出し動作モードや、隣り
合う2ラインの信号を同時に読み出して電流加算を行う
とともに、フィールドごとに加算する2ラインの組合せ
を変えるフィールド読み出し動作モードでも勿論可能で
ある。
メージセンサにおいて、隣接したφTm−1とリセット
パルスφRmを兼用することも可能である。これによ
り、配線の削減が可能となる。
送スイッチ42のゲートにつながるノードに積極的に容
量をもたせることにより、t7<tにおいて、垂直選択
パルスφVnが“H”レベルから“L”レベルに遷移し
たとき、転送スイッチ42のゲート電位を負電位とする
ことができる。これにより、フォトダイオード41に隣
接している転送スイッチ42のシリコン界面に長い期間
正孔を注入することができるため、暗電流を抑圧するこ
とができる。
s)、増幅トランジスタ45のポテンシャルおよび電源
電圧全体をシフト(本例の場合、例えば1.5Vシフ
ト)させることにより、電源回路54を削減することが
できる。
ンジスタ45のソースフォロアの抵抗負荷としての役割
を水平選択スイッチ60に移して電流出力を行う構成を
採ることも可能である。すなわち、次のようにして電流
出力動作を行う。
で動作するようにしてあるものとする。また、抵抗で帰
還したオペアンプを使用するなどして、水平信号線59
の電位を一定電位にあるようにする。すると、増幅トラ
ンジスタ45と水平選択スイッチ60で抵抗を負荷とし
たソースフォロアを形成し、水平信号線59にはフロー
ティングディフュージョン43の電位に応じた電流が流
れ、オペアンプの出力端にはフローティングディフュー
ジョン43の電位に応じた電圧が現れる。
テムの一例を示す概略構成図である。図17において、
被写体(図示せず)からの入射光(像光)は、レンズ7
1等を含む光学系によって撮像素子72の撮像面上に結
像される。撮像素子72としては、先述した第1実施形
態若しくはその変形例、又は第2実施形態に係るCMO
Sイメージセンサが用いられる。
等を含む駆動回路73から出力される各種のタイミング
に基づいてその駆動が行われる。撮像素子72から出力
される撮像信号は、信号処理回路74において種々の信
号処理が施された後、映像信号として出力される。
行列状に配置された単位画素を、光電変換素子、転送ス
イッチ、電荷蓄積部、リセットスイッチおよび増幅素子
によって構成し、リセットスイッチに与えるリセット電
位をコントロールすることによって行単位で画素の選択
を行うようにしたことにより、垂直選択のための素子を
削減できるため、画素サイズを縮小することができる。
る。
のポテンシャル図である。
ャートである。
シャル図(その1)である。
シャル図(その2)である。
面構造図である。
図である。
直信号線のポテンシャル図である。
ミングチャートである。
る。
線のポテンシャル図である。
チャートである。
ンシャル図(その1)である。
ンシャル図(その2)である。
テンシャル図(その1)である。
テンシャル図(その2)である。
示す概略構成図である。
ある。
ド、12,42…転送スイッチ、13,43…フローテ
ィングディフュージョン、14,44…リセットスイッ
チ、15,45…増幅トランジスタ、21,51…垂直
選択線、23,53…垂直信号線、24,56…垂直走
査回路、27…垂直信号線出力回路、28,57…水平
走査回路、29,59…水平信号線、30…水平信号線
出力回路、31,60…水平選択スイッチ、33,62
…オペアンプ、34,54…電源回路、46…転送選択
スイッチ
Claims (15)
- 【請求項1】 光電変換素子と、前記光電変換素子に蓄
積された電荷を転送する転送スイッチと、前記転送スイ
ッチによって転送された電荷を蓄積する電荷蓄積部と、
前記電荷蓄積部をリセットするリセットスイッチと、前
記電荷蓄積部の電位に応じた信号を垂直信号線に出力す
る増幅素子とを具備し、行列状に配置された単位画素
と、 前記リセットスイッチに与えるリセット電位をコントロ
ールすることによって行単位で画素の選択を行う垂直走
査回路と、 前記垂直信号線に出力された信号を列単位で順次選択す
る水平走査回路と、 前記水平走査回路によって選択された信号を水平信号線
を経由して出力する出力回路とを備えたことを特徴とす
る固体撮像素子。 - 【請求項2】 前記垂直走査回路は、垂直走査時に順次
出力する垂直選択パルスを前記リセットスイッチに対し
てそのリセット電位として与えることを特徴とする請求
項1記載の固体撮像素子。 - 【請求項3】 前記電荷蓄積部は、フローティングディ
フュージョンであることを特徴とする請求項1記載の固
体撮像素子。 - 【請求項4】 前記リセットスイッチは、デプレッショ
ン型トランジスタからなることを特徴とする請求項1記
載の固体撮像素子。 - 【請求項5】 前記出力回路は、前記垂直信号線に読み
出された信号を電圧モードで出力することを特徴とする
請求項1記載の固体撮像素子。 - 【請求項6】 前記出力回路は、前記垂直信号線に読み
出された信号を電流モードで出力することを特徴とする
請求項1記載の固体撮像素子。 - 【請求項7】 前記単位画素は、前記光電変換素子と画
素電源電圧が与えられる領域の間に、前記光電変換素子
の過剰電荷を排出するオーバーフローパスを形成してな
ることを特徴とする請求項1記載の固体撮像素子。 - 【請求項8】 前記転送スイッチの制御電極に負電位を
印加することを特徴とする請求項1記載の固体撮像素
子。 - 【請求項9】 前記単位画素は、前記転送スイッチの転
送動作を選択する転送選択スイッチを有することを特徴
とする請求項1記載の固体撮像素子。 - 【請求項10】 前記転送選択スイッチは、前記垂直選
択パルスを制御入力とすることを特徴とする請求項9記
載の固体撮像素子。 - 【請求項11】 前記出力回路は、前記垂直信号線に読
み出された信号を電流モードで出力することを特徴とす
る請求項9記載の固体撮像素子。 - 【請求項12】 行列状に配置された単位画素が、光電
変換素子と、前記光電変換素子に蓄積された電荷を転送
する転送スイッチと、前記転送スイッチによって転送さ
れた電荷を蓄積する電荷蓄積部と、前記電荷蓄積部をリ
セットするリセットスイッチと、前記電荷蓄積部の電位
に応じた信号を垂直信号線に出力する増幅素子とを具備
してなる固体撮像素子において、 前記リセットスイッチに与えるリセット電位をコントロ
ールすることによって行単位で画素の選択を行うことを
特徴とする固体撮像素子の駆動方法。 - 【請求項13】 前記垂直信号線に読み出された信号を
電圧モードで出力することを特徴とする請求項12記載
の固体撮像素子の駆動方法。 - 【請求項14】 前記垂直信号線に読み出された信号を
電流モードで出力することを特徴とする請求項12記載
の固体撮像素子の駆動方法。 - 【請求項15】 光電変換素子と、前記光電変換素子に
蓄積された電荷を転送する転送スイッチと、前記転送ス
イッチによって転送された電荷を蓄積する電荷蓄積部
と、前記電荷蓄積部をリセットするリセットスイッチ
と、前記電荷蓄積部の電位に応じた信号を垂直信号線に
出力する増幅素子とを具備し、行列状に配置された単位
画素と、 前記リセットスイッチに与えるリセット電位をコントロ
ールすることによって行単位で画素の選択を行う垂直走
査回路と、 前記垂直信号線に出力された信号を列単位で順次選択す
る水平走査回路と、 前記水平走査回路によって選択された信号を水平信号線
を経由して出力する出力回路とを備えた固体撮像素子を
撮像デバイスとして用いたことを特徴とするカメラシス
テム。
Priority Applications (20)
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DE69942941T DE69942941D1 (de) | 1998-06-08 | 1999-06-07 | Festkörper-Bildaufnahmeelement |
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EP99110878A EP0964570B1 (en) | 1998-06-08 | 1999-06-07 | Solid-state imaging element |
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US10/944,977 US8031248B2 (en) | 1998-06-08 | 2004-09-20 | Solid state imaging element having horizontal scanning circuit for providing reset signals |
US10/945,503 US7944491B2 (en) | 1998-06-08 | 2004-09-20 | Solid-state image-pickup device including unit pixels having a 3-transistor design and wherein a vertical selection pulse provides a reset potential |
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US13/067,112 US8743257B2 (en) | 1998-06-08 | 2011-05-10 | Solid-state imaging element having image signal overflow path |
US13/565,383 US8922689B2 (en) | 1998-06-08 | 2012-08-02 | Solid-state imaging element having image signal overflow path |
US14/218,485 US9179081B2 (en) | 1998-06-08 | 2014-03-18 | Solid-state imaging element having image signal overflow path |
US14/630,320 US9313430B2 (en) | 1998-06-08 | 2015-02-24 | Solid-state imaging element having image signal overflow path |
US14/732,293 US9253422B2 (en) | 1998-06-08 | 2015-06-05 | Solid-state imaging element having image signal overflow path |
US14/994,935 US9445020B2 (en) | 1998-06-08 | 2016-01-13 | Solid-state imaging element having image signal overflow path |
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