JPH1031202A - トグリングバックプレーンを有するディスプレイマトリックスの選択ラインドライバ - Google Patents

トグリングバックプレーンを有するディスプレイマトリックスの選択ラインドライバ

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JPH1031202A
JPH1031202A JP9090901A JP9090197A JPH1031202A JP H1031202 A JPH1031202 A JP H1031202A JP 9090901 A JP9090901 A JP 9090901A JP 9090197 A JP9090197 A JP 9090197A JP H1031202 A JPH1031202 A JP H1031202A
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Abstract

(57)【要約】 【課題】 本発明は、ディスプレイ装置のちらつきを減
らすために、液晶材料の分極を防ぐ選択ラインドライバ
を提供することを目的とする。 【解決手段】 トグリングバックプレーン電圧を有する
液晶ディスプレイのアレーの所与の行が選択解除された
場合、画素容量の中の容量性の電流を防ぐため、行選択
ライン電圧もまたトグリングする。行選択ラインドライ
バは、プッシュプル形式で連結された一対のトランジス
タを含む。一対のトランジスタは、シフトレジスタの縦
続段の対応する段において発生した制御信号に応ずる。
一対のトランジスタは、行が選択解除されたときに行選
択ラインの中に発生するトグリング電圧が、シフトレジ
スタの動作に影響を与えることを防ぐバッファ段を形成
する。

Description

【発明の詳細な説明】
【０００１】
【発明の属する技術分野】本発明は、概して液晶ディス
プレイ（ＬＣＤ）といった、ディスプレイ装置のための
駆動回路及び特に行選択ライン信号をディスプレイ装置
の行選択ラインに適用する方式に関する。
【０００２】
【従来の技術】ＬＣＤのディスプレイのようなディスプ
レイ装置は、マトリックス、或いはたとえば、水平方向
には行、また垂直方向には列で配置されるアレーからな
る。表示されるビデオ情報は、画素セルの夫々の列に個
々に関連するデータラインに対する輝度（グレースケー
ル）信号として適用される。所与のデータライン駆動回
路は、対応するデータラインの中に駆動信号を発生させ
る。Plus外による、「System for Applying Brightness
Signals To A Display Device And ComparatorTherefo
re （輝度信号をディスプレイ装置に対して適用する方
式及びそれによる比較器）」なる名称の米国特許第５，
１７０，１５５号は、ＬＣＤのデータラインあるいは列
ドライバの例を示す。画素セルの行は、連続して走査さ
れるか、或いは画素セルの行に関連した行ライン導体で
発生した行選択信号によって選択される。
【０００３】作動中のマトリックス型ディスプレイで
は、それぞれの画素セルは、画素セルに輝度信号を適用
するスイッチ装置を含む。一般的に、スイッチ装置は、
データラインドライバからデータラインを通して輝度信
号を受ける薄膜トランジスタ（ＴＦＴ）である。この装
置を以下画素ＴＦＴと称する。画素ＴＦＴは、行選択ラ
イン導体に接続し、画素セルの行に関連する行選択信号
に応ずるゲート電極を有する。
【０００４】液晶ディスプレイは、二つの電極の間に挟
まれた液晶材料からなる。少なくとも一つの、そして一
般的には両方の電極は、光を通し、液晶材料に隣接した
電極の表面は、個々の画素セルを形作るパターンに配置
された、透明な電導電極のパターンを支える。一般的
に、画素セルの一つの電極は、アレーの全ての画素セル
に共通の電圧にある。その電極を、アレーのバックプレ
ーン（ｂａｃｋｐｌａｎｅ）或いはコモンプレーン（ｃ
ｏｍｍｏｎ ｐｌａｎｅ）と称する。バックプレーンか
ら遠くにある画素セルの他の電極は、画素ＴＦＴスイッ
チの主電流電導電極に接続し、これを画素電極と称す
る。ＴＦＴは、画素電極において、輝度信号の電圧レベ
ルとほぼ同じ電圧レベルを発生させる。画素電極とバッ
クプレーンの間の電圧レベルの差を、以下画素セル電圧
と称する。
【０００５】画素セル内の液晶材料の分極を防ぐため、
画素セル電圧の極性は、画素セル電圧の平均値或いは直
流成分がゼロであるように、周期的に交番せねばならな
い。画素セル内の液晶材料の分極を防ぐための一つの既
知の技術は、トグリングコモンプレーン電圧技術或いは
トグリングバックプレーン電圧技術と呼ばれる。トグリ
ングバックプレーン電圧技術では、所与の行が選択され
た場合、バックプレーン電圧は、第１或いは第２の電圧
レベルのうちの一つになる。ところが、同じ行が選択さ
れた場合、連続して起こる画像フレームの画像情報を更
新する際に、バックプレーン電圧は第１或いは第２の電
圧レベルのうちの他方の一つになる。グレースケールの
中間範囲の画素セル輝度を発生させる、輝度信号の電圧
レベルを、ここに中間範囲の電圧レベルと称する。トグ
リングバックプレーン電圧技術では、中間範囲の電圧レ
ベルは、バックプレーン電圧のレベルとは無関係に同じ
である。
【０００６】第１或いは第２の電圧レベルのうちの一つ
は、データラインドライバで発生した輝度信号の最大レ
ベルよりもより正、或いはより大きい。第１或いは第２
の電圧レベルのうちの他方の一つは、輝度信号の最小レ
ベルよりもより負、或いはより小さい。バックプレーン
電圧の第１及び第２のレベルは、輝度信号の中間範囲の
レベルについて対称である。従って、バックプレーン電
圧が第１のレベルの場合、選択された行の画素セルの画
素セル電圧は、バックプレーン電圧が第２のレベルの場
合に発生する電圧と反対の極性である。結果は、所与の
画像フレームの間は、画素セル電圧の極性は、続けて起
こる画像フレームの間の極性と反対であるということで
ある。これはフレーム極性反転と呼ばれる。このように
して、液晶材料の分極は回避される。
【０００７】不利なことに、フレーム周波数でのトグリ
ングバックプレーン電圧は、目が感知しやすい周波数に
おいてちらつき（フリッカ）を発生しうる。目の感知度
を減少するために、バックプレーン電圧は、行選択変化
のより高い周波数でトグリングしうる。バックプレーン
に適用される電圧は、すぐに続く行が選択されると、第
１のレベルから第２のレベルへ、そしてその逆に変化す
る。この動作のモードは、画素電圧の極性が行ごとを基
準に変化するため、ライン極性反転と呼ばれる。フレー
ム極性反転の場合のように、各フレームで液晶材料の分
極を回避するため、画素セル電圧の極性は極性反転され
る。
【０００８】
【発明が解決しようとする課題】選択スキャナと呼ばれ
る、本発明による特徴を実施するシフトレジスタは、対
応する行選択ライン導体において、行極性反転の動作の
方式に適した行選択信号を発生する。同じ電圧レベル
は、行が選択される際のバックプレーン電圧のレベルと
は無関係に、選択される行の行選択導体において発生す
る。この特徴は、空間的な均一性とちらつきを考慮した
結果による。画素セル電圧は、画素ＴＦＴの電導性に依
存する。
【０００９】ちらつきを減らし、交互に選択される行の
画素輝度の差を減らすため、バックプレーン電圧が第１
のレベル及び第２のレベルの両方の場合に行が選択され
た際に、画素ＴＦＴにおいて同じ電導性を保つことは望
ましい。同じ電導性を保つことは、輝度信号が中間範囲
の電圧レベルであるときに、特に重要である。これは、
輝度信号が中間範囲の電圧レベルであるときに、目が輝
度の変化に対して非常に敏感なためである。画素ＴＦＴ
の電導性は、選択された行の行ライン導体における電
圧、及び輝度信号の電圧レベルによって決定される。中
間範囲の電圧レベル及び行ライン導体における電圧は、
バックプレーン電圧レベルとは無関係に同じであるた
め、画素ＴＦＴは、有利に、同じ電導性を保つ。
【００１０】選択スキャナはまた、対応する行選択ライ
ン導体において、行極性反転の動作のモードに適した行
選択解除信号を発生する。これは、選択解除された行の
行選択ライン導体において、行選択解除間隔の間に、ト
グリングバックプレーン電圧と同じ量だけ、そして同じ
時に変化する第２のトグリング電圧を発生させることに
よって達成される。この特徴は、一時的な均一性とちら
つきを考慮した結果による。バックプレーン電圧のトグ
リングと調和して、行選択信号の電圧をトグリングする
ことは、行選択解除間隔の間、バックプレーン電圧と行
選択ライン導体の電圧との間の一定の差を保つ。従っ
て、画素セル容量を含む、電流路中の変位電流或いは容
量性電流は、減少または消去される。少しの変位電流
も、ちらつき或いは画像焼付といった望ましくない結果
を生む、画素セル電圧の変化を発生しうる。
【００１１】ＬＤＣディスプレイマトリックスの選択ラ
インスキャナは、トグリングバックプレーンが同じ基板
に乗せて作られており、同時に液晶ディスプレイセルが
ディスプレイマトリックスの中に作られていることが望
ましい。
【００１２】
【課題を解決するための手段】本発明の一面を具体化
し、アレーの複数の行及び複数の列に配置された画素に
対して輝度信号を適用するためのディスプレイ装置は、
所与の行が選択された場合に、所与の行の画素の画素電
極に、輝度信号を発生するための複数の列ドライバを含
む。トグリングする第１の信号源は準備されている。第
１の信号は、交互に、輝度信号の所定のレベルに対して
第１及び第２のレベルを有する、画素の共通の電極で発
生する。複数の段が行選択スキャナを作る。所与の行に
関連づけられた所与の一つの段は、所与の行選択間隔の
間に、所与の行を選択するための、対応する行ラインに
行ライン選択信号を発生するための第１のトランジスタ
を含む。行ラインに連結する第２のトランジスタは、第
１の信号に従って、行ラインに関連した容量の中に電圧
を発生させる。容量は、行選択解除間隔の間に、容量電
圧に従って第１の信号に関してレベルシフトされた行ラ
インにおいて、トグリング行ライン選択解除信号を発生
させるため、容量性に第１信号と行ラインを連結する。
【００１３】
【発明の実施の形態】図１では、液晶アレー１６のデー
タライン１７を駆動する従来のデータラインドライバ２
００は、例えばPlus外による特許において説明されてい
るラインドライバと多くの点で類似しうる。夫々のデー
タラインドライバ２００は、トランジスタＭＮ６を通じ
て対応するデータライン１７に連結する。アレー１６
は、例えば水平に５６０行、垂直に９６０列に整列され
る、液晶セル１６ａといった多数の画素セルからなる。
液晶アレー１６は、、液晶セル１６ａの垂直の列の夫々
に対して１つの、９６０列のデータライン１７、そして
液晶セル１６ａの垂直の列の夫々に対して１つの５６０
列の行選択ライン１１８を含む。
【００１４】本発明の一面を実施する選択ラインスキャ
ナ６０は、対応する選択ライン１１８（ｎ）上に、アレ
ー１６の所与の行ｎを選択するため、行選択信号ＯＵＴ
（ｎ）ａを発生させる。所与のデータライン１７におい
て発生した輝度電圧ＶＣＯＬＵＭＮは、行ｎのライン選
択期間の間、行の上の画素セル１６ａに対して適用され
る。
【００１５】夫々の画素セル１６ａの電極１６ｄにおい
て発生した電圧ＶＢＰは、アレー１６の全ての画素セル
に共通である。共通の電圧ＶＢＰが発生する電極１６ｄ
を、アレー１６のバックプレーンＢＰの電極と称する。
所与の画素セル１６ａでは、バックプレーンＢＰから離
れている画素セル１６ａの第２の電極１６ｅは、対応す
る画素ＴＦＴスイッチ１６ｃに連結する。この電極を、
画素電極と称する。対応する行ｎが選択されると、画素
ＴＦＴ１６ｃは、画素電極１６ｅにおいて、対応する輝
度電圧ＶＣＯＬＵＭＮの電圧レベルとほぼ同じである、
電圧Ｖ１６ｅを発生する。
【００１６】図２の（ａ）及び（ｂ）は、夫々、バック
プレーン電極１６ｄ及び画素電極１６ｅにおいて発生し
た、すぐに選択された行ｎ−１、及びｎの、図１の１対
の画素セル１６ａの各画素セルの電圧の波形の例を示
す。図１、図２の（ａ）及び図２の（ｂ）において、類
似する符号及び数字は、類似する項目或いは機能を示
す。
【００１７】図１のマトリックス１６のバックプレーン
ＢＰに適用された図２の（ａ）或いは（ｂ）のバックプ
レーン電圧ＶＢＰは、行選択が変化するときにトグリン
グする。バックプレーン電圧ＶＢＰがトグリングする間
の、移行間隔の間、図１のトランジスタＭＮ６の夫々
は、ターンオフされている。図１の行選択信号ＯＵＴ
（ｎ−１）ａが、選択された行ｎ−１の行選択ライン１
１８（ｎ−１）上に発生するとき、図２の（ａ）の、従
来のバックプレーンドライバ６１で発生したバックプレ
ーン電圧ＶＢＰは、ライン時間Ｔ（ｎ−１）の間は、＋
６Ｖである。図１の行選択信号ＯＵＴ（ｎ）ａが、すぐ
に続く選択された行ｎの行選択ライン１１８（ｎ）上に
発生するとき、図２の（ｂ）の、バックプレーン電圧Ｖ
ＢＰは、ライン時間Ｔ（ｎ）の間は、−２Ｖである。
【００１８】図２の（ａ）或いは（ｂ）の電圧Ｖ１６ｅ
は、画素１６ａの行が選択された場合、電圧ＶＣＯＬＵ
ＭＮとほぼ等しい。電圧ＶＣＯＬＵＭＮは、一般的に最
大＋４Ｖと最小０Ｖの間の、夫々の行について同じであ
る電圧の範囲を有する。同じ電圧の範囲を使用すること
は、データラインドライバ２００の設計を容易にする。
【００１９】図２の（ａ）のバックプレーン電圧ＶＢＰ
の＋６Ｖのレベルは、輝度電圧ＶＣＯＬＵＭＮの最大レ
ベルの＋４Ｖよりも更に正である。バックプレーン電圧
ＶＢＰの−２Ｖのレベルは、輝度電圧ＶＣＯＬＵＭＮの
最小レベルの０Ｖよりも更に正でない、あるいは更に負
である。選択された行の画素セル１６ａの画素セル電圧
ＶＰＩＸＥＬは、画素電極電圧Ｖ１６ｅとバックプレー
ン電圧ＶＢＰの間の差に等しい。バックプレーン電圧Ｖ
ＢＰが＋６Ｖの場合、選択された行の画素セルの画素セ
ル電圧ＶＰＩＸＥＬは負であり、バックプレーン電圧Ｖ
ＢＰが−２Ｖの場合に発生した電圧と逆の極性である。
示された例では、画素セル電圧ＶＰＩＸＥＬの特性は、
図２の（ａ）のライン時間Ｔ（ｎ−１）の間、選択され
た行ｎ−１における負の極性から、図２の（ｂ）の、ラ
イン時間Ｔ（ｎ）の間、すぐに続く選択された行ｎにお
ける正の極性へと変化する。このように、電圧ＶＰＩＸ
ＥＬの極性は、行ごとを基準に交番に変化する。
【００２０】光透過性或いは輝度の所与の変化につい
て、選択された行ｎ−１及びｎでは、輝度電圧ＶＣＯＬ
ＵＭＮの変化の方向は反対である。図２の（ａ）の、ラ
イン時間Ｔ（ｎ−１）の間、輝度電圧ＶＣＯＬＵＭＮ
が、中間範囲の電圧レベルＭＲＧよりも大きい電圧レベ
ルである場合、それは、例えば中間範囲の電圧レベルＭ
ＲＧの時よりも高い画素の光透過性或いは輝度を発生す
る。それに対して、図２の（ｂ）の、ライン時間Ｔ
（ｎ）の間、輝度電圧ＶＣＯＬＵＭＮは、中間範囲の電
圧レベルＭＲＧよりも大きい電圧レベルであるとき、そ
れは、中間範囲の電圧レベルＭＲＧの時よりも低い画素
の光透過性或いは輝度を発生する。電圧レベルＭＲＧ
は、輝度のグレースケールの中間の輝度レベルを示す。
従って、例えば、行ｎ−１及びｎの画素で同じ光透過性
を得るためには、電圧ＶＣＯＬＵＭＮと電圧レベルＭＲ
Ｇの差は、同じ大きさで反対の極性でなくてはならな
い。
【００２１】図２の（ａ）及び（ｂ）は、破線によって
最大の光透過性或いは輝度を与える、そして点線によっ
て最小の光透過性或いは輝度を与える画素電極１６ｅに
おける電圧Ｖ１６ｅの電圧レベルを示す。バックプレー
ン電圧ＶＢＰは、行ごとを基準にトグリングするため、
画素セル電圧ＶＰＩＸＥＬの極性もまた行ごとを基準に
変化する。
【００２２】所与の行が選択された場合、所与の画像フ
レームの画像情報を更新する際に、バックプレーン電圧
ＶＢＰは＋６Ｖ或いは−２Ｖの電圧レベルのうちの一つ
になる。これに反し、同じ行が選択された場合、すぐに
起こる画像フレームの画像情報を更新する際に、バック
プレーン電圧ＶＢＰは＋６Ｖ或いは−２Ｖの電圧レベル
のうちの他の一つになる。結果は、所与の画像フレーム
間は、画素セル電圧ＶＰＩＸＥＬの極性は、続けて起こ
る画像フレームの間に起こる極性と反対であるというこ
とである。このようにして、上述のごとく液晶材料の分
極は回避される。電圧ＶＰＩＸＥＬの極性を行ごとを基
準に変化させることは、ちらつき（フリッカ）を減少さ
せる。
【００２３】図４は、本発明の特徴を実施する、図１の
選択ラインスキャナ６０の、図３のシフトレジスタ１０
０の、模範的な段Ｎを示す。段Ｎの夫々のトランジスタ
は、Ｎ−ＭＯＳ ＴＦＴである。閾電圧ドリフトを引き
起こしうる圧力を減少させるため、夫々のトランジスタ
が電導性である時間は、不導性である時間と比較して短
い。図３のシフトレジスタ１００は、図１の液晶ディス
プレイマトリックス１６の行選択ライン１１８を駆動す
るためのタイミングを与える。図１、図２の（ａ）及び
（ｂ）、図３及び図４において、類似する符号及び数字
は、類似する項目或いは機能を示す。
【００２４】図３のシフトレジスタ１００において、段
Ｎ−１、Ｎ、Ｎ＋１及びＮ＋２は、縦続の形状で互いに
連結する。所与の段の出力信号は、回路の中ですぐに続
く段の入力と連結する。例えば、レジスタ１００の回路
の先の段Ｎ−１の出力信号ＯＵＴ（ｎ−１）のパルス
は、図４の段Ｎの入力端子７２と連結する。実例とし
て、４つの段Ｎ−１、Ｎ、Ｎ＋１及びＮ＋２のみが、図
３に示されている。しかしながら、レジスタ１００の回
路の合計の段数Ｎは、行選択ラインの数、この例では５
６０と同じである。シフトレジスタ１００を、「ｗａｌ
ｋｉｎｇ ｏｎｅ」シフトレジスタと称することもでき
る。これは、ビデオ画像フレーム時間の間、レジスタ１
００を通して、真（ＴＲＵＥ）の状態或いは高（ＨＩＧ
Ｈ）レベルが伝達されるからである。
【００２５】図５の（ａ）乃至（ｉ）は、図３及び図４
の回路を説明するのに役立つ波形を示す。図１、図２の
（ａ）及び（ｂ）、図３、図４及び図５の（ａ）乃至
（ｉ）において、類似する符号及び数字は、類似する項
目或いは機能を示す。図３のクロック発生器１０１は、
夫々図５の（ｂ）及び（ｃ）に示される波形を持つ２相
クロック信号（クロック信号Ｃ１およびＣ２）を発生す
る。図３の（ａ）の出力信号ＯＵＴ（ｎ−１）のパルス
は、図５の（ｃ）のクロック信号Ｃ２のパルスの間、図
４の段Ｎの入力端子７２で発生する。図５の（ａ）の高
レベルの出力信号ＯＵＴ（ｎ−１）のパルスは、図４の
トランジスタ７８を通して、制御信号Ｐ１を発生させる
ため、端子７８ａに連結される。制御信号Ｐ１は、第１
の出力トランジスタ７６のゲート電極に連結される。
【００２６】制御信号Ｐ１が、図４のトランジスタ７６
のゲート電極で発生するとき、トランジスタ７６のドレ
イン電極は、クロック信号Ｃ１の負の低レベルである。
出力トランジスタ７６のゲートで発生した信号Ｐ１は、
電導のため、出力トランジスタ７６を調節する。電導性
のトランジスタ７６は、ゲートと電導性のトランジスタ
７６のソース電極との間に連結されているコンデンサ７
０に、高レベルの信号Ｐ１を一時的に蓄えるための電流
路を作る。クロック信号Ｃ１はまた、トランジスタ７６
の電極間寄生容量ＣＰを通して、端子７８ａに連結す
る。従って、高レベルの信号Ｐ１はまた、容量ＣＰにも
蓄えられる。図５の（ａ）の出力信号ＯＵＴ（ｎ−１）
が低レベルに達し、図４のトランジスタ７８がターンオ
フされた後でさえ、高レベルはコンデンサ７０及び容量
ＣＰに蓄えられる。
【００２７】図５の（ｂ）のクロック信号Ｃ１は、クロ
ック信号Ｃ２のパルスが止んだ後或いは低レベルに達し
た後すぐに、トランジスタ７６のドレイン電極で高レベ
ルで発生する。図５の（ｂ）のクロック信号Ｃ１は、電
導性のトランジスタ７６を通じて出力端子７３に連結す
る。従って、高レベルを達すると、コンデンサ７０及び
ＣＰを通じて、端子７８ａにおける電圧をブートストラ
ップし、それによりトランジスタ７６に対して余分の駆
動を与える。そのような動作は、ブートストラップ動作
と呼ばれる。従って、図５の（ｆ）の出力信号ＯＵＴ
（ｎ）は、信号Ｃ１の高レベルから電圧降下なしに、図
４のレジスタＮの出力端子７３において発生する。
【００２８】信号Ｐ１はまた、本発明による特徴を実施
するバッファ出力トランジスタ８１のゲート電極にも連
結する。トランジスタ８１の電流ドレインは、クロック
信号Ｃ１に連結する。トランジスタ８１は、トランジス
タ７６と同じ時点にターンオンされたり、ターンオフさ
れたりする。段Ｎのトランジスタ８１が、ターンオンさ
れたときはいつでも、図１のマトリックス１６の選択ラ
イン１１８（ｎ）上に、行選択信号ＯＵＴ（ｎ）ａのパ
ルスを発生する。
【００２９】本発明の特徴によれば、トランジスタ７８
がターンオフされた後にコンデンサ７０に蓄えられてい
る信号Ｐ１は、トランジスタ８１のゲートに連結する。
それにより、有利に、ブートストラップ動作はクロック
信号Ｃ１が発生したときには、トランジスタ７６と８１
の両方で実行される。ブートストラップ動作は、電圧降
下なしに、行選択信号ＯＵＴ（ｎ）ａにクロック信号Ｃ
１の高レベルを達成させる。トランジスタ７６は、選択
ライン１１８（ｎ）の比較的大きい容量の負荷を駆動す
る必要がないため、信号ＯＵＴ（ｎ）の伝達時間は速く
有利である。
【００３０】中間範囲で画素セル輝度を発生する輝度電
圧ＶＣＯＬＵＭＮの電圧レベルＭＧＲは、行が選択され
た時点では、バックプレーン電圧ＶＢＰの電圧レベルに
依存しない。従って、行ｎが選択されたときには、図４
の行選択信号ＯＵＴ（ｎ）の電圧レベルと、図２の
（ａ）及び（ｂ）の中間範囲の電圧レベルＭＧＲの輝度
電圧ＶＣＯＬＵＭＮとの差は、図２の（ａ）のバックプ
レーン電圧ＶＢＰが＋６Ｖの場合と図２の（ｂ）のバッ
クプレーン電圧ＶＢＰが−２Ｖの場合の両方において同
じである。従って、有利に、輝度電圧ＶＣＯＬＵＭＮが
中間範囲の電圧レベルＭＧＲであるとき、図１の画素Ｔ
ＦＴ１６ｃの電導性は、バックプレーン電圧が＋６Ｖ及
び−２Ｖの場合の両方において同じである。
【００３１】バックプレーン電圧ＶＢＰが＋６Ｖ及び−
２Ｖの場合の両方において、所与の行が選択されたとき
にＴＦＴスイッチ１６ｃで同じ電導性を保つことは望ま
しい。これは、電導性の少しの差も、ちらつき及び／又
は画像静止を引き起こしうる画素セル電圧ＶＰＩＸＥＬ
のゼロ以外の平均値を発生させうるためである。同じ電
導性を保つことは、目がグレースケールの中間範囲での
輝度の変化に敏感であるため、輝度電圧ＶＣＯＬＵＭＮ
が図２の（ａ）或いは（ｂ）の中間範囲の電圧レベルＭ
ＧＲである場合に、特に重要である。
【００３２】図４の段Ｎの信号ＯＵＴ（ｎ）は、図３の
連続する段Ｎ＋１の入力端子に適用される。段Ｎ＋１
は、レジスタ１００の信号路の下流に配置され、クロッ
ク信号Ｃ１の代わりに補足的なクロック信号Ｃ２を使用
すること以外は、対応するレジスタをターンオンするた
めに、段Ｎと同様に動作する。このように、図５の
（ｃ）のクロック信号Ｃ２の間に生ずる、図５の（ｇ）
の出力信号ＯＵＴ（ｎ＋１）は、図５の（ｂ）のクロッ
ク信号Ｃ１の高から低へのレベルの転換にすぐに続く、
低から高へのレベルの転換を有する。図５の（ｇ）の信
号ＯＵＴ（ｎ＋１）の低から高へのレベルの転換は、図
５の（ｃ）のクロック信号Ｃ２が低から高へのレベルの
転換を起こすと同時に生ずる。このように、図１の選択
ラインスキャナ６０は、シフトレジスタとして動作す
る。
【００３３】図５の（ｂ）のクロック信号Ｃ１が作動し
ない低レベルに達したとき、図４のトランジスタ７６及
び８１は、コンデンサ７０及びＣＰが放電するまで、点
いたままである。トランジスタ７５は、端子７８ａと−
１２Ｖの一定の負の供給電圧Ｖ１の間に連結される。ト
ランジスタ７７は、端子７３との負の供給電圧Ｖ１の間
に連結される。
【００３４】段Ｎ＋１の信号ＯＵＴ（ｎ＋１）は、トラ
ンジスタ７５及び７７のゲート電極に戻って連結され
る。信号ＯＵＴ（ｎ＋１）はまた、本発明の特徴を実施
し、夫々トグリング電圧Ｖ２及び行ｎの選択ライン１１
８（ｎ）に連結するソース及びドレイン電極を有するプ
ルダウントランジスタ７９のゲート電極に連結する。こ
のように、信号ＯＵＴ（ｎ＋１）のパルスが生じると、
トランジスタ７５、７７及び７９は、ターンオンされ
る。トランジスタ７５及び７７がターンオンされると
き、それらはコンデンサ７０及び寄生コンデンサＣＰを
放電する。これは、−１２Ｖの負の供給電圧Ｖ１が、ク
ロック信号Ｃ１が作動しない低レベルと同じためであ
る。それにより、トランジスタ７６及び８１はターンオ
フされる。信号ＯＵＴ（ｎ＋１）はフレーム当たり１回
起こり、それは実質的にクロック信号Ｃ１或いはＣ２よ
りも頻繁でないため、トランジスタにおいて閾電圧の変
化を起こしうるトランジスタ７９、７５及び７７の圧力
は、有利に、小さい。
【００３５】容量ＣＳＥＢＰは、行ｎの選択ライン１１
８（ｎ）とバックプレーンＢＰとの間に結合される。容
量ＣＳＥＢＰは、行ｎの選択ライン１１８（ｎ）とバッ
クプレーンＢＰとの間の結合容量を増加するために用い
られる。本発明の面によれば、トランジスタ７９がター
ンオンされたとき、それは容量ＣＳＥＢＰを充電し、容
量ＣＳＥＢＰを横切って行選択解除電圧ＶＤＳＥＬを発
生させる。電圧ＶＤＳＥＬは、トグリング電圧Ｖ２とト
グリング電圧ＶＢＰとの差に等しい。電圧ＶＢＰのどち
らの電圧レベルであるかとは無関係に、電圧ＶＤＳＥＬ
は、−１０Ｖの一定の値を有する。
【００３６】行ｎの全ての選択解除間隔の間、信号ＯＵ
Ｔ（ｎ＋１）のパルスの立下り縁に続き、トランジスタ
７９は不導性であり、選択ライン１１８（ｎ）に関し
て、高いインピーダンスを作る。このように、−１０Ｖ
の電圧ＶＤＳＥＬは、容量ＣＳＥＢＰの中に保たれる。
バックプレーンＢＰは、容量ＣＳＥＢＰを通して容量的
に選択ライン１１８（ｎ）に結合されるため、選択解除
間隔のあいだ、選択ライン１１８（ｎ）の信号ＯＵＴ
（ｎ）の電圧レベルはバックプレーン電圧ＶＢＰをたど
る。選択ライン１１８（ｎ）のトラッキングは、有利
に、図１の画素容量ＣＰＩＸＥＬ及び容量ＣＳＰを含む
電流路で発生しうる変位電流を起こさない。これは、ト
グリング電圧ＶＢＰの転換の間は図１のトランジスタＭ
Ｎ６はターンオフされており、従ってデータ列はデータ
スキャナから連結を解除されるためである。従って、画
素電圧ＶＰＩＸＥＬは、行ｎの選択解除間隔の間は，電
圧ＶＢＰがトグリングしても変化しない。図５の（ｈ）
及び（ｉ）は、夫々図３の信号ＯＵＴ（ｎ）ａ及びＯＵ
Ｔ（ｎ＋１）ａの波形を示す。
【００３７】トランジスタ７６の図４の出力端子７３
は、選択ライン１１８（ｎ）から絶縁されている。従っ
て、選択ライン１１８（ｎ）のトグリング電圧は、端子
７３の電圧に影響を与えない。よって図３の段Ｎ＋１に
連結する端子７３の電圧は選択解除間隔の間は一定であ
り、トグリング信号ＯＵＴ（ｎ）ａに影響されない。当
然段Ｎ＋１の夫々のクロック信号Ｃ１及びＣ２は、図４
の選択ライン１１８（ｎ）のトグリング電圧に依存せ
ず、単純な二レベル信号であり得る。このように、段Ｎ
といった夫々の段の設計は、有利に簡単化される。
【００３８】図５の（ｅ）のリセットパルス信号ＲＥＳ
ＥＴは、夫々トグリング電圧Ｖ２及びトランジスタ８１
のソース電極に連結するソース及びドレイン電極を有す
る任意のプルダウントランジスタ８０のゲート電極に連
結する。図５の（ｅ）のパルス信号ＲＥＳＥＴは、行ご
とを基準に行選択が生じるたびに起こる狭いパルスであ
る。トランジスタ８０は、選択ライン１１８（ｎ）ａで
高いインピーダンスが発生する場合に、行ｎの選択解除
間隔の間に、ノイズ障害が電圧ＶＤＳＥＬの大きさに影
響を与えることを防ぐために使用されうる。
【００３９】行ｎの選択解除間隔の間に、図４のクロッ
ク信号Ｃ１は、容量ＣＰを通じ、コンデンサ７０の充電
を引き起こす傾向を有しうる。従って、クロック信号Ｃ
２は、容量ＣＰよりも２０％大きい容量７１を通じて端
子７８ａに連結する。有利に、容量結合されたクロック
信号Ｃ２は、行ｎの選択解除間隔の間に、コンデンサ７
０のいかなる電荷の発生をも防ぐ。
【図面の簡単な説明】
【図１】本発明の面を実施する、行選択ドライバを含む
液晶ディスプレイ装置を示すブロック図である。
【図２】図１の装置を説明するための波形を示す図であ
る。
【図３】複数の縦続段を含むシフトレジスタを含む図１
の行選択ドライバを示すブロック図である。
【図４】本発明の面を実施する、図３のシフトレジスタ
に使用されるシフトレジスタ段を示す系統図である。
【図５】出力信号の相対的なタイミングと、図４に示さ
れる段を使用する図３のシフトレジスタの夫々のコード
で生ずる夫々のクロック信号を示す図である。
【符号の説明】
１６ 液晶アレー １６ａ 液晶セル １６ｃ 画素ＴＦＴスイッチ １６ｄ 電極 １６ｅ 画素電極 １７ データライン ６０ 選択ラインスキャナ ６１ 従来のバックプレーンドライバ ７０ コンデンサ ７１ 容量 ７２ 入力端子 ７３ 出力端子 ７５ トランジスタ ７６ トランジスタ ７７ トランジスタ ７８ トランジスタ ７８ａ 端子 ７９ トランジスタ ８０ トランジスタ ８１ トランジスタ １００ シフトレジスタ ２００ データラインドライバ １１８ 行選択ライン Ｃ１ クロック信号 Ｃ２ クロック信号 ＣＰ 容量 Ｐ１ 制御信号 ＭＮ２ トランジスタ

Claims (14)

    【特許請求の範囲】
  1. 【請求項１】 所与の行が選択されたときに、該所与の
    行の画素の画素電極に輝度信号を発生させるための、複
    数の列ドライバと、 該画素の共通の電極に発生され、所与の輝度信号の所定
    のレベルに関して、第１及び第２のレベルを交番に有す
    る、トグリングする第１の信号源と、 段の所与の１つは該所与の行に関連づけられ、行選択ス
    キャナを形成する複数の段と、 所与の行選択間隔の間に、該所与の行を選択するため
    に、対応する行ラインに行ライン選択信号を発生させる
    ための第１のトランジスタと、 行選択解除間隔の間に、該第１の信号に従って、該行ラ
    インに関連づけられた容量に電圧を発生させるために、
    該行ラインに連結され、該容量は、該容量電圧に従って
    該第１の信号に関してレベルシフトされた該行ライン
    に、トグリング行ライン選択解除信号を発生させるため
    に、該第１の信号と該行ラインとを容量的に結合する第
    ２のトランジスタとを含む、アレーの複数の行及び複数
    の列に配置された画素に、輝度信号を適用するためのデ
    ィスプレイ装置。
  2. 【請求項２】 該行ライン選択解除信号と該第１の信号
    との差が、該第１の信号の夫々のレベルで一定に保たれ
    る請求項１記載のディスプレイ装置。
  3. 【請求項３】 該第２のトランジスタは、該第１の信号
    が該第１及び第２のレベルである場合、夫々第３及び第
    ４のレベルで行ライン選択解除信号を発させる請求項１
    記載のディスプレイドライバ。
  4. 【請求項４】 該第１及び第２のトランジスタは、該行
    ラインに関してプッシュプル形式で動作する請求項１記
    載のディスプレイドライバ。
  5. 【請求項５】 行ライン選択信号は、該第１の信号が該
    第１及び第２のレベルに夫々ある場合、該輝度信号の該
    所定のレベルに関して同じレベルである請求項１記載の
    装置。
  6. 【請求項６】 複数の縦続段からなり、該縦続段の所与
    の１つは、 該所与の段の制御信号を発生させるために、該縦続段の
    第２の段の出力の出力パルス信号に応答する入力部と、 該縦続段の第３の段の入力部に連結された、該所与の段
    の出力パルス信号を発生させるための該制御信号に応答
    し、該出力パルス信号は、シフトレジスタ動作用に供給
    されるため、該第２の段の該出力パルスに関して時間シ
    フトされる、第１のトランジスタと、 行選択間隔の間に、所与の行ラインに、該第２の段の該
    出力信号に関して時間シフトされた行ライン選択信号を
    発生させるため、そして行選択解除間隔の間に、所与の
    行ラインに、行ライン選択解除信号はバッファリングさ
    れ、該第３の段の該入力部からは連結を解除される、ト
    グリング行ライン選択解除信号を発生させるための切り
    替え回路網とからなるディスプレイ装置のアレー用の行
    選択ラインスキャナ。
  7. 【請求項７】 該切り替え回路網は、該行ラインに連結
    され、該行ライン選択信号を発生させるための第２のト
    ランジスタと、該行ライン及びトグリングする第２の信
    号源に連結され、該行ライン選択解除信号を発生させる
    ための第２のトランジスタとからなる請求項６記載の行
    選択スキャナ。
  8. 【請求項８】 該第２及び第３のトランジスタは、プッ
    シュプル形式に結合されている請求項７記載の行選択ス
    キャナ。
  9. 【請求項９】 該制御信号は、該第１及び第２の夫々の
    トランジスタを電導へと調節するための、該第１及び第
    ２のトランジスタの夫々の制御端子に結合される容量に
    蓄えられる請求項７記載の行選択スキャナ。
  10. 【請求項１０】 該行選択解除間隔の間に、該所与の段
    の下流の段の出力信号に応答し、、該第１及び第２のト
    ランジスタをディスエーブルするための第４のトランジ
    スタからさらになる請求項７記載の行選択スキャナ。
  11. 【請求項１１】 該画素の共通の電極で発生したトグリ
    ングする第２の信号源は、交番に第１及び第２のレベル
    を有し、切り替え回路網は、該行選択解除間隔の第１の
    部分の間に、該第２の信号に従って該行ラインに関連づ
    けられた容量に電圧を発生させるための、該行ラインに
    結合された第２のトランジスタを含み、該容量は、該行
    選択解除間隔の第２の部分の間に、該容量電圧に従って
    該第２の信号に関してレベルシフトされた該行ライン
    に、該トグリングする行ライン選択解除信号を発生させ
    るため、該第２の信号と該行ラインとを容量的に結合す
    ることからさらになる請求項６記載の行選択スキャナ。
  12. 【請求項１２】 該容量電圧は、該第２の信号がトグリ
    ングするたびの後に、該２のトランジスタの動作によっ
    て補充される請求項１１記載の行選択スキャナ。
  13. 【請求項１３】 該容量電圧は、夫々の行選択解除間隔
    毎に１回、該第２のトランジスタの動作によって補充さ
    れる請求項１１記載の行選択スキャナ。
  14. 【請求項１４】 複数の位相シフトされたクロック信号
    源と、 複数の縦続段とからなり、該縦続段の所与の一つは、 該縦続段の第２の段の出力に発生した制御信号を発生す
    るために出力パルス信号に応答する入力部と、 第３の段の入力部分に結合され、該所与の段の出力パル
    ス信号を発生するための該制御信号に応答する第１のト
    ランジスタであり、該所与の段の該出力パルス信号が該
    第２の段の該出力パルスに関して時間シフトされるよう
    に、クロック信号が該第１のトランジスタの主電流電導
    端子に発生されるときに、該制御信号は、該第１のトラ
    ンジスタが該所与の段の該出力パルス信号を発生するよ
    うに調節する第１のトランジスタと、 対応する行ラインに行ライン選択信号を発生するための
    該制御信号に応答し、該行ライン選択信号は、該第２の
    段の該出力信号に関して時間シフトされるように、クロ
    ック信号が該第２のトランジスタの主電流電導端子に発
    生するときに、該制御信号は、該第２のトランジスタが
    該行ライン選択信号を発生するように調節する第２のト
    ランジスタと、 該行ラインに、第１の行選択解除間隔の間、第１のレベ
    ルの行選択解除信号を、そして第２の行選択解除間隔の
    間は、第２のレベルの行選択解除信号を発生させるため
    該行ラインに連結された第２のトランジスタからなるマ
    トリックス型ディスプレイの行選択スキャナのためのシ
    フトレジスタ。
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