CN103400558B - 移位寄存器单元及其驱动方法、栅极驱动电路及显示装置 - Google Patents

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Abstract

本发明涉及显示技术领域，特别涉及一种移位寄存器单元及其驱动方法、栅极驱动电路及显示装置。本发明实施例中所提供的移位寄存器单元，通过设置与上拉结点连接的稳压电容，利用稳压电容稳定上拉结点处的电位，从而使移位寄存器单元输出的信号更加稳定；同时本发明利用很少数量的晶体管以及电容组成移位寄存单元，从而使栅极驱动电路的布线面积大大减小，为实现更窄边框的液晶显示装置的设计提供了技术支持，同时，由于简化了栅极驱动电路的结构，从而简化了栅极驱动电路的制备工艺，压缩了制备成本。进一步的，本发明所提供的移位寄存单元还通过两次下拉过程，快速有效的将输出信号下拉至低电位，增强了栅极驱动电路的下拉能力。

Description

移位寄存器单元及其驱动方法、栅极驱动电路及显示装置
技术领域
本发明涉及显示技术领域，特别涉及一种移位寄存器单元、应用该移位寄存器单元的栅极驱动电路、驱动该移位寄存器单元的驱动方法及应用该栅极驱动电路的显示装置。
背景技术
薄膜晶体管液晶显示器（Thin Film Transistor Liquid CrystalDisplay，TFT-LCD）由于具有画面稳定、图像逼真、消除辐射、节省空间以及节省能耗等优点，被广泛应用于电视、手机、显示器等电子产品中，已占据了平面显示领域的主导地位。
液晶显示面板是由水平和垂直两个方向的像素矩阵构成的，其进行显示时，通过栅极驱动电路输出栅极扫描信号，逐行扫描各像素。液晶显示面板的驱动主要包括栅极驱动器和数据驱动器，数据驱动器将输入的显示数据及时钟信号定时顺序锁存，转换成模拟信号后输入到液晶显示面板的数据线，栅极驱动器将输入时钟信号经过移位寄存器转换，切换成开启/关断电压，顺次施加到液晶显示面板的扫描栅线上对像素进行选通，即栅极驱动器中的移位寄存器用于产生扫描栅线中的扫描信号。
随着平板显示技术的发展，窄边框产品得到了越来越多的关注，然而，现有技术中的移位寄存器通常使用数量较多的晶体管以及其他电气元件，不但结构复杂，而且会占据很大的布线面积，不利于窄边框设计，同时，加大了移位寄存器的制备工艺难度，增加了制备成本。并且，由于经常受到布线空间的限制，晶体管的体积通常不能过大，这样可能由于下拉晶体管尺寸过小，存在不能快速有效的将输出信号下拉至低电位的问题。同时，现有技术中的移位寄存器单元中由于对于上拉晶体管的控制信号都是直接输入到上拉晶体管中，这样可能会影响对上拉晶体管的开关控制，导致移位寄存器单元的输出信号不稳定。
发明内容
（一）要解决的技术问题
本发明要解决的技术问题是，针对现有技术的不足，提供一种输出信号更稳定的移位寄存器单元、应用该移位寄存器单元的栅极驱动电路、驱动该移位寄存器单元的驱动方法及应用该栅极驱动电路的显示装置，使用很少数量的晶体管，从而使栅极驱动电路的布线面积大大减小，进而为实现更窄边框的液晶显示装置的设计提供技术支持，进一步的，增强整个移位寄存器单元的下拉能力，从而提升液晶显示装置的响应速度。
（二）技术方案
本发明技术方案如下：
一种移位寄存器单元包括：
上拉模块，分别与第一时钟信号输入端、信号输出端以及上拉结点连接，用于根据所述上拉结点处的电位向信号输出端输出所述第一时钟信号输入端输入的信号，所述上拉结点为所述上拉模块与上拉驱动模块的连接点；
下拉模块，分别与所述信号输出端、第一信号端以及第二时钟信号输入端连接，用于根据所述第二时钟信号输入端输出的信号下拉所述信号输出端的电位至第一信号端；
上拉驱动模块，分别与信号输入端以及所述上拉结点连接，用于根据所述信号输入端输入的信号驱动所述上拉模块；
复位模块，分别与第二信号端、复位信号端以及上拉结点连接，用于根据所述复位信号端输入的信号将所述上拉结点的信号复位；
稳压模块，与所述上拉结点连接，用于稳定所述上拉结点处的电位。
优选的，所述复位信号端与第二时钟信号输入端连接。
优选的，所述第二信号端以及第一信号端均为低电平；所述第二信号端的电位比第一信号端的电位低。
优选的，所述上拉驱动模块包括上拉驱动晶体管，所述复位模块包括复位晶体管，所述上拉模块包括上拉晶体管以及自举电容，所述下拉模块包括下拉晶体管，所述稳压模块包括稳压电容；
所述上拉驱动晶体管的栅极以及源极与信号输入端连接，漏极分别与复位晶体管的源极、稳压电容的第一端、自举电容的第一端、以及上拉晶体管的栅极连接；
所述复位晶体管的栅极与复位信号端连接、漏极分别与稳压电容第二端以及第二信号端连接；
所述上拉晶体管的源极与第一时钟信号输入端连接，漏极分别与信号输出端、自举电容的第二端以及下拉晶体管的源极连接；
所述下拉晶体管的栅极与第二时钟信号输入端连接，漏极与第一信号端连接。
优选的，所有晶体管均为N沟道型晶体管或者所有晶体管均为P沟道型晶体管。
本发明还提供了一种驱动上述移位寄存器单元的驱动方法：
一种移位寄存器单元的驱动方法，包括：
充电阶段，信号输入端输入上一级输出信号或起始信号，上拉驱动晶体管以及上拉晶体管导通，复位信号端输入的信号关断复位晶体管，上一级输出信号或起始信号对稳压电容以及自举电容充电；
输出阶段，信号输入端信号输入结束，上拉驱动晶体管关断，第二时钟信号输入端输入的信号关断下拉晶体管；上拉晶体管继续导通，自举电容通过第一时钟信号输入端输入的信号将上拉结点电位升高，稳压电容对上拉结点电位进行保持，上拉晶体管将第一时钟信号输入端的信号输出至信号输出端；
复位阶段，复位信号端输入的信号控制复位晶体管以及下拉晶体管导通，复位晶体管将上拉结点电位下拉，上拉晶体管关断，下拉晶体管将信号输出端电位下拉。
优选的，所述复位信号输入端与第二时钟信号输入端连接。
本发明还提供了一种包括上述任意一种移位寄存器单元的栅极驱动电路：
一种栅极驱动电路，包括上述任意一种移位寄存器单元；除最后一级移位寄存器单元外，其余每一级移位寄存器单元的信号输出端均连接下一级移位寄存器单元的信号输入端，第一级移位寄存器单元的信号输入端接入起始信号。
本发明还提供了一种包括上述栅极驱动电路的显示装置。
（三）有益效果
本发明实施例中所提供的移位寄存器单元，通过设置与上拉结点连接的稳压电容，利用稳压电容稳定上拉结点处的电位，从而使移位寄存器单元输出的信号更加稳定；同时本发明利用很少数量的晶体管以及电容组成移位寄存单元，从而使栅极驱动电路的布线面积大大减小，为实现更窄边框的液晶显示装置的设计提供了技术支持，同时，由于简化了栅极驱动电路的结构，从而简化了栅极驱动电路的制备工艺，压缩了制备成本。进一步的，本发明所提供的移位寄存单元还通过两次下拉过程，快速有效的将输出信号下拉至低电位，增强了栅极驱动电路的下拉能力。
附图说明
图1是本发明实施例一中移位寄存器单元的模块连接示意图；
图2是本发明实施例一中移位寄存器单元的一种实现电路图；
图3是本发明实施例一中移位寄存器单元的另一种实现电路图；
图4是本发明实施例一中栅极驱动电路的结构示意图；
图5是图2中移位寄存器单元的驱动时序及信号波形示意图；
图6是本发明实施例二中移位寄存器单元的模块连接示意图；
图7是本发明实施例二中移位寄存器单元的一种实现电路图；
图8是本发明实施例二中移位寄存器单元的另一种实现电路图；
图9是本发明实施例二中栅极驱动电路的结构示意图；
图10是图7中移位寄存器单元的驱动时序及信号波形示意图。
具体实施方式
下面结合附图和实施例，对本发明的具体实施方式做进一步描述。以下实施例仅用于说明本发明，但不用来限制本发明的范围。
实施例一
如图1中所示，本实施例中所提供的一种移位寄存器单元主要包括：上拉模块，分别与第一时钟信号输入端、信号输出端以及上拉结点P连接，用于根据上拉结点P处的电位向信号输出端输出第一时钟信号输入端输入的信号；下拉模块，分别与信号输出端、第一信号端以及第二时钟信号输入端连接，用于根据第二时钟信号输入端输出的信号下拉信号输出端的电位；上拉驱动模块，分别与信号输入端以及上拉结点P连接，用于根据信号输入端输入的信号驱动上拉模块；复位模块，分别与第二信号端、复位信号端以及上拉结点P连接，用于根据复位信号端输入的信号将上拉结点P的信号复位；稳压模块，与上拉结点P连接，用于稳定上拉结点P处的电位。该移位寄存器单元通过设置与上拉结点P连接的稳压电容，利用稳压电容稳定上拉结点P处的电位，从而使移位寄存器单元输出的信号更加稳定。
图2中所示电路为本实施例中所提供的移位寄存器单元的一种具体实现方式，图4为由图2中移位寄存器单元组成的栅极驱动电路；本实施例中的移位寄存器单元包括上拉驱动晶体管T1、复位晶体管T2、上拉晶体管T3、下拉晶体管T4、自举电容C1以及稳压电容C2，还包括信号输入端、信号输出端、第一时钟信号输入端、第二时钟信号输入端、复位信号端、第二信号端VGL1以及第一信号端VGL；栅极驱动电路中，除第一级移位寄存器单元外，其余每一级移位寄存器单元的信号输入端均连接下一级移位寄存器单元的信号输出端，除最后一级移位寄存器单元外，其余每一级移位寄存器单元的信号输出端均连接下一级移位寄存器单元的信号输入端，第一级移位寄存器单元的信号输入端接入起始信号STV；其中，上拉驱动晶体管T1的栅极以及源极与信号输入端连接，漏极分别与复位晶体管T2的源极、稳压电容C2的第一端、自举电容C1的第一端、以及上拉晶体管T3的栅极连接，在有起始信号STV或者上级输出信号输入时，上拉驱动晶体管T1导通，为稳压电容C2以及自举电容C1充电；复位晶体管T2的栅极与复位信号端连接、漏极分别与稳压电容C2第二端以及第二信号端VGL1连接，在信号输出端的信号输出完成后，在复位信号的控制下导通，将移位寄存器单元复位；上拉晶体管T3的源极与第一时钟信号输入端连接，漏极分别与信号输出端、自举电容C1的第二端以及下拉晶体管T4的源极连接，用于为信号输出端提供输出信号；下拉晶体管T4的栅极与第二时钟信号输入端连接，漏极与第一信号端VGL连接，用于将信号输出端的输出信号下拉；稳压电容C2用于在信号输入端信号输入完成后，稳定上拉结点P（即上拉晶体管T3的栅极连接点）的电位，从而使输出信号更加稳定；自举电容C1用于升高上拉结点的电位，使上拉结点的电位高于第一时钟信号输入端的电位，从而使第一时钟信号可以完全输出；第二信号端VGL1以及第一信号端VGL均为低电平，本实施例中，为了更彻底的将上拉晶体管T3关断，减少上拉晶体管T3的漏电流，第二信号端VGL1的电位比第一信号端VGL的电位更低。
本实施例中移位寄存器单元以及栅极驱动电路的另外优势就是采用单一沟道类型的晶体管即全为N沟道型晶体管，从而进一步降低了制备工艺的复杂程度和生产成本；当然，本领域所属技术人员很容易得出本发明所提供的移位寄存器单元可以轻易改成全为P沟道型晶体管，具体如图3中所示，并不局限于本实施例中的所提供的实现方式，在此不再赘述。
本实施例中还提供了一种驱动上述移位寄存器单元的驱动方法，参考图5中的驱动时序图，其中所有晶体管均为N沟道型晶体管，时钟信号CK1作为复位信号端输出的信号，时钟信号CK作为第一时钟信号输入端输出的信号；时钟信号CK1的脉宽是时钟信号CK和起始信号STV脉宽的两倍，相邻的时钟信号相位差为90度，这样包含上述移位寄存器单元的栅极驱动电路共需要4个时钟信号CK1～CK4，加上时钟信号CK和时钟信号CKB，该栅极驱动电路一共需要6个时钟信号。该移位寄存器单元的驱动方法主要包括以下阶段：
充电阶段t1，信号输入端输出上一级输出信号G(n-1)或起始信号STV，上拉结点P电位升高，上拉驱动晶体管T1以及上拉晶体管T3导通，复位信号端输出低电平信号关断复位晶体管T2，第二时钟信号输入端输出高电平信号，下拉晶体管T4导通，上一级输出信号G(n-1)或起始信号STV对稳压电容C2以及自举电容C1充电，信号输出端Gn输出低电平信号；
输出阶段t2，信号输入端信号输入结束，上拉驱动晶体管T1关断，第二时钟信号输入端输出低电平信号，下拉晶体管T4关断；第一时钟信号输入端输出高电平信号，自举电容C1将上拉结点P电位继续升高，稳压电容C2对上拉结点电位进行保持，上拉晶体管T3将第一时钟信号输入端的高电平信号完全输出至信号输出端Gn；
复位阶段t3，复位信号端输出高电平信号，复位晶体管T2以及下拉晶体管T4导通，第二信号端VGL1将上拉结点P电位下拉，上拉晶体管T3关断，第二时钟信号输入端输出高电平信号，下拉晶体管T4导通，将信号输出端Gn电位下拉至第一信号端VGL的电位。
由于第二信号端VGL1的电位比第一信号端VGL的电位更低，这样在将输出信号下拉时，上拉结点的电压P被拉低至第二信号端VGL1电位，信号输出端电压被拉低至第一信号端VGL电位，由于VGL1<VGL，这样上拉晶体管T3的栅源电压VGS<0，关断的更彻底，漏电流更小。
本发明还提供了一种包括上述栅极驱动电路的显示装置；由于使用的栅极驱动电路具有更小的布线面积，因此该显示装置的边框可以做的更窄。
实施例二
如图6中所示，本实施例中所提供的一种移位寄存器单元主要包括：上拉模块，分别与第一时钟信号输入端、信号输出端以及上拉结点P连接，用于根据上拉结点P处的电位向信号输出端输出第一时钟信号输入端输入的信号；下拉模块，分别与信号输出端、第一信号端以及第二时钟信号输入端连接，用于根据第二时钟信号输入端输出的信号下拉信号输出端的电位；上拉驱动模块，分别与信号输入端以及上拉结点P连接，用于根据信号输入端输入的信号驱动上拉模块；复位模块，分别与第二信号端、第二时钟信号输入端以及上拉结点P连接，用于根据第二时钟信号输入端输入的信号将上拉结点P的信号复位；稳压模块，与上拉结点P连接，用于稳定上拉结点P处的电位。该移位寄存器单元通过设置与上拉结点P连接的稳压电容，利用稳压电容稳定上拉结点P处的电位，从而使移位寄存器单元输出的信号更加稳定。
图7中所示电路为本实施例中所提供的移位寄存器单元的一种具体实现方式，图9为由图7中移位寄存器单元组成的栅极驱动电路；本实施例中的移位寄存器单元包括上拉驱动晶体管T1、复位晶体管T2、上拉晶体管T3、下拉晶体管T4、自举电容C1以及稳压电容C2，还包括信号输出端、信号输出端、第一时钟信号输入端、第二时钟信号输入端第二信号端VGL1以及第一信号端VGL；栅极驱动电路中，除第一级移位寄存器单元外，其余每一级移位寄存器单元的信号输入端均连接下一级移位寄存器单元的信号输出端，除最后一级移位寄存器单元外，其余每一级移位寄存器单元的信号输出端均连接下一级移位寄存器单元的信号输入端，第一级移位寄存器单元的信号输入端接入起始信号STV；其中，上拉驱动晶体管T1的栅极以及源极与信号输入端连接，漏极分别与复位晶体管T2的源极、稳压电容C2的第一端、自举电容C1的第一端、以及上拉晶体管T3的栅极连接，在有起始信号STV或者上级输出信号输入时，上拉驱动晶体管T1导通，为稳压电容C2以及自举电容C1充电；复位晶体管T2的栅极与第二时钟信号输入端连接、漏极分别与稳压电容C2第二端以及第二信号端VGL1连接，在信号输出端的信号输出完成后，在第二时钟信号的控制下导通，将移位寄存器单元复位；上拉晶体管T3的源极与第一时钟信号输入端连接，漏极分别与信号输出端、自举电容C1的第二端以及下拉晶体管T4的源极连接，用于为信号输出端提供输出信号；下拉晶体管T4的栅极与第二时钟信号输入端连接，漏极与第一信号端VGL连接，用于将信号输出端的输出信号下拉；稳压电容C2用于在信号输入端信号输入完成后，稳定上拉结点（即上拉晶体管T3的栅极连接点）的电位，从而使输出信号更加稳定；自举电容C1用于升高上拉结点的电位，使上拉结点的电位高于第一时钟信号输入端的电位，从而使第一时钟信号可以完全输出；第二信号端VGL1以及第一信号端VGL均为低电平，本实施例中，为了更彻底的将上拉晶体管T3关断，减少上拉晶体管T3的漏电流，第二信号端VGL1的电位比第一信号端VGL的电位更低。
本实施例中移位寄存器单元以及栅极驱动电路的另外优势就是采用单一沟道类型的晶体管即全为N沟道型晶体管，从而进一步降低了制备工艺的复杂程度和生产成本；当然，本领域所属技术人员很容易得出本发明所提供的移位寄存器单元可以轻易改成全为P沟道型晶体管，具体如图8中所示，并不局限于本实施例中的所提供的实现方式，在此不再赘述。
本实施例中还提供了一种驱动上述移位寄存器单元的驱动方法，参考图10中的驱动时序图，其中所有晶体管均为N沟道型晶体管，时钟信号CK1作为复位信号端输出的信号，时钟信号CK3作为第一时钟信号输入端输出的信号；时钟信号CK1、时钟信号CK3的脉宽和起始信号STV的脉宽相同。包含上述移位寄存器单元的栅极驱动电路中同级的起始信号STV过去3个时刻时钟信号CK1才打开，相邻的时钟信号相位差为90度，这样整个栅极驱动电路共需要4个时钟信号CK1～CK4。该移位寄存器单元的驱动方法主要包括以下阶段：
充电阶段t1，信号输入端输出上一级输出信号G(n-1)或起始信号STV，上拉结点P电位升高，上拉驱动晶体管T1以及上拉晶体管T3导通，第二时钟信号输入端输出低电平信号关断复位晶体管T2以及下拉晶体管T4，上一级输出信号G(n-1)或起始信号STV对稳压电容C2以及自举电容C1充电，信号输出端Gn输出低电平信号；
输出阶段t2，信号输入端信号输入结束，上拉驱动晶体管T1关断，第二时钟信号输入端输出低电平信号，下拉晶体管T4关断；第一时钟信号输入端输出高电平信号，自举电容C1将上拉结点P电位升高，稳压电容C2对上拉结点电位进行保持，上拉晶体管T3将第一时钟信号输入端的高电平信号完全输出至信号输出端Gn；
复位阶段，包括第一阶段和第二阶段：
第一阶段t3：第一时钟信号输入端输出低电平信号，此时，复位晶体管T2以及下拉晶体管T4仍然关断，上拉晶体管T3此时仍然导通，第一时钟信号输入端输出的低电平信号将上拉结点P电位下拉，虽然上拉结点P的电位下降，但这个电位仍然可以导通上拉晶体管T3使第一时钟信号输入端的低电平信号完全输出；
第二阶段t4：复位信号端输出高电平信号，复位晶体管T2以及下拉晶体管T4导通，将上拉结点P电位再次下拉，下拉至第二信号端VGL1的电位，使上拉晶体管T3关断，将信号输出端电位下拉至第一信号端VGL电位，下拉晶体管T4的打开再次确保将信号输出端的电位拉低至第一信号端VGL的电位。
由于第二信号端VGL1的电位比第一信号端VGL的电位更低，这样在将输出信号下拉时，上拉结点P的电压被拉低至第二信号端VGL1电位，输出点电压被拉低至第一信号端VGL电位，由于VGL1<VGL，这样上拉晶体管T3的栅源电压VGS<0，关断的更彻底，漏电流更小。
在实施例一中使用了6组时钟信号，在本实施例中仅使用了4组时钟信号；在实施例一中，上拉晶体管T3仅仅起到上拉作用，而在实施例二中，上拉晶体管T3在上拉后马上对输出信号进行下拉，而且还在下一时刻通过下拉晶体管T4对输出信号进行第二次下拉，这样整个栅极驱动电路的下拉能力得到了大大增强。
本发明还提供了一种包括上述栅极驱动电路的显示装置；由于使用的栅极驱动电路具有更小的布线面积，因此该显示装置的边框可以做的更窄；并且，由于整个栅极驱动电路的下拉能力得到了增强，因此提升了液晶显示装置的响应速度。
以上实施方式仅用于说明本发明，而并非对本发明的限制，有关技术领域的普通技术人员，在不脱离本发明的精神和范围的情况下，还可以做出各种变化和变型，因此所有等同的技术方案也属于本发明的保护范畴。

Claims (9)

1.一种移位寄存器单元，其特征在于，包括：
上拉模块，分别与第一时钟信号输入端、信号输出端以及上拉结点连接，用于根据所述上拉结点处的电位向信号输出端输出所述第一时钟信号输入端输入的信号，所述上拉结点为所述上拉模块与上拉驱动模块的连接点；
下拉模块，分别与所述信号输出端、第一信号端以及第二时钟信号输入端连接，用于根据所述第二时钟信号输入端输出的信号下拉所述信号输出端的电位至第一信号端；
上拉驱动模块，分别与信号输入端以及所述上拉结点连接，用于根据所述信号输入端输入的信号驱动所述上拉模块；
复位模块，分别与第二信号端、复位信号端以及上拉结点连接，用于根据所述复位信号端输入的信号将所述上拉结点的信号复位；
稳压模块，与所述上拉结点连接，用于稳定所述上拉结点处的电位，所述稳压模块包括稳压电容。
2.根据权利要求1所述的移位寄存器单元，其特征在于，所述复位信号端与第二时钟信号输入端连接。
3.根据权利要求1所述的移位寄存器单元，其特征在于，所述第一信号端以及第二信号端均为低电平；所述第二信号端的电位比第一信号端的电位低。
4.根据权利要求1-3任意一项所述的移位寄存器单元，其特征在于，所述上拉驱动模块包括上拉驱动晶体管，所述复位模块包括复位晶体管，所述上拉模块包括上拉晶体管以及自举电容，所述下拉模块包括下拉晶体管；
所述上拉驱动晶体管的栅极以及源极与信号输入端连接，所述上拉驱动晶体管的漏极分别与复位晶体管的源极、稳压电容的第一端、自举电容的第一端、以及上拉晶体管的栅极连接；
所述复位晶体管的栅极与复位信号端连接、所述复位晶体管的漏极分别与稳压电容第二端以及第二信号端连接；
所述上拉晶体管的源极与第一时钟信号输入端连接，所述上拉晶体管的漏极分别与信号输出端、自举电容的第二端以及下拉晶体管的源极连接；
所述下拉晶体管的栅极与第二时钟信号输入端连接，所述下拉晶体管的漏极与第一信号端连接。
5.根据权利要求4所述的移位寄存器单元，其特征在于，所有晶体管均为N沟道型晶体管或者所有晶体管均为P沟道型晶体管。
6.一种驱动根据权利要求1所述移位寄存器单元的方法，其特征在于，包括：
充电阶段，信号输入端输入上一级输出信号或起始信号，上拉驱动晶体管以及上拉晶体管导通，复位信号端输入的信号关断复位晶体管，上一级输出信号或起始信号对稳压电容以及自举电容充电；
输出阶段，信号输入端信号输入结束，上拉驱动晶体管关断，第二时钟信号输入端输入的信号关断下拉晶体管；上拉晶体管继续导通，自举电容通过第一时钟信号输入端输入的信号将上拉结点电位升高，稳压电容对上拉结点电位进行保持，上拉晶体管将第一时钟信号输入端的信号输出至信号输出端；
复位阶段，复位信号端输入的信号控制复位晶体管以及下拉晶体管导通，复位晶体管将上拉结点电位下拉，上拉晶体管关断，下拉晶体管将信号输出端电位下拉。
7.根据权利要求6移位寄存器单元驱动方法，其特征在于，所述复位信号输入端与第二时钟信号输入端连接。
8.一种栅极驱动电路，其特征在于，包括多个根据权利要求1-5任意一项所述的移位寄存器单元；除最后一级移位寄存器单元外，其余每一级移位寄存器单元的信号输出端均连接下一级移位寄存器单元的信号输入端，第一级移位寄存器单元的信号输入端接入起始信号。
9.一种显示装置，其特征在于，包括权利要求8所述的栅极驱动电路。
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