JPH027180B2 - - Google Patents

Info

Publication number
JPH027180B2
JPH027180B2 JP59118423A JP11842384A JPH027180B2 JP H027180 B2 JPH027180 B2 JP H027180B2 JP 59118423 A JP59118423 A JP 59118423A JP 11842384 A JP11842384 A JP 11842384A JP H027180 B2 JPH027180 B2 JP H027180B2
Authority
JP
Japan
Prior art keywords
semiconductor element
wiring pattern
resin
metal
wiring
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Lifetime
Application number
JP59118423A
Other languages
English (en)
Other versions
JPS60262430A (ja
Inventor
Kenzo Hatada
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electric Industrial Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electric Industrial Co Ltd
Priority to JP11842384A priority Critical patent/JPS60262430A/ja
Publication of JPS60262430A publication Critical patent/JPS60262430A/ja
Publication of JPH027180B2 publication Critical patent/JPH027180B2/ja
Granted legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/50Assembly of semiconductor devices using processes or apparatus not provided for in a single one of the subgroups H01L21/06 - H01L21/326, e.g. sealing of a cap to a base of a container
    • H01L21/56Encapsulations, e.g. encapsulation layers, coatings
    • H01L21/563Encapsulation of active face of flip-chip device, e.g. underfilling or underencapsulation of flip-chip, encapsulation preform on chip or mounting substrate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/26Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L24/28Structure, shape, material or disposition of the layer connectors prior to the connecting process
    • H01L24/29Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L24/83Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • H01L2224/13001Core members of the bump connector
    • H01L2224/13099Material
    • H01L2224/131Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/13138Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/13144Gold [Au] as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/15Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L2224/16Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
    • H01L2224/161Disposition
    • H01L2224/16151Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/16221Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/16225Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/31Structure, shape, material or disposition of the layer connectors after the connecting process
    • H01L2224/32Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
    • H01L2224/321Disposition
    • H01L2224/32151Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/32221Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/32225Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/73Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
    • H01L2224/732Location after the connecting process
    • H01L2224/73201Location after the connecting process on the same surface
    • H01L2224/73203Bump and layer connectors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/73Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
    • H01L2224/732Location after the connecting process
    • H01L2224/73201Location after the connecting process on the same surface
    • H01L2224/73203Bump and layer connectors
    • H01L2224/73204Bump and layer connectors the bump connector being embedded into the layer connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/81Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
    • H01L2224/8119Arrangement of the bump connectors prior to mounting
    • H01L2224/81191Arrangement of the bump connectors prior to mounting wherein the bump connectors are disposed only on the semiconductor or solid-state body
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/81Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
    • H01L2224/8138Bonding interfaces outside the semiconductor or solid-state body
    • H01L2224/81399Material
    • H01L2224/814Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • H01L2224/81438Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/81447Copper [Cu] as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/83Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
    • H01L2224/8319Arrangement of the layer connectors prior to mounting
    • H01L2224/83192Arrangement of the layer connectors prior to mounting wherein the layer connectors are disposed only on another item or body to be connected to the semiconductor or solid-state body
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01024Chromium [Cr]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01029Copper [Cu]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01078Platinum [Pt]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01079Gold [Au]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/151Die mounting substrate
    • H01L2924/156Material
    • H01L2924/15786Material with a principal constituent of the material being a non metallic, non metalloid inorganic material
    • H01L2924/15788Glasses, e.g. amorphous oxides, nitrides or fluorides

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Manufacturing & Machinery (AREA)
  • Encapsulation Of And Coatings For Semiconductor Or Solid State Devices (AREA)
  • Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)
  • Electric Connection Of Electric Components To Printed Circuits (AREA)
  • Wire Bonding (AREA)

Description

【発明の詳細な説明】 産業上の利用分野 本発明は、半導体素子の電極パツドと外部回路
とを簡便に接続する方法に関するものである。
従来例の構成とその問題点 近年、半導体素子を多数個用いるデバイス、機
器の開発が促進されてきている。例えば、メモリ
ーカード、液晶やELデイスプレイパネル等があ
り、これらは、いずれも多数個のIC、LSIを一定
の面積を有する基板に、高密度にしかも薄型に搭
載しなければならない。IC、LSIの実装手段とし
て、フイルムキヤリヤ方式や、フリツプチツプ方
式が公知であるが、次の様な問題がある。
前記フイルムキヤリヤ方式もフリツプチツプ方
式のいずれも半導体素子の電極パツド上に金属突
起を形成するが、フリツプチツプ方式において
は、配線基板上の配線パターンと半導体素子の金
属突起とを位置合せし、加熱せしめて、半田づけ
固定するものである。したがつてフリツプチツプ
方式の場合は、電気的接続と、配線基板上への半
導体素子の固定とを半田づけ固定した位置で行な
うもので、外部からの熱や機械的歪により、配線
基板が膨張したりそつたりした場合には、半田づ
け位置が強固に固定されているので、その変化に
充分に対応できなくなり、接続部や半導体素子自
体の破損をまねいていた。
またフイルムキヤリヤ方式においては、半導体
素子上の金属突起とフイルムリードとを接続し、
フイルムリードを配線基板の配線パターンと接続
するため、前述した配線基板のそりや膨張等の変
化に充分に対応できるものの、フイルムリードを
必要とするため、実装コストが高価になつたり、
フイルムリード部分が半導体素子からはみ出た状
態で回路基板に固定されるために、実装面積が大
きくなるという欠点がある。
ところで、本発明者は、半導体素子の電極と回
路基板の配線パターンの接続において、電気的接
続を行なわせる部分と、前記半導体素子を回路基
板上に機械的に固定する部分とを分離させるとい
うことに着目することにより、前述した回路基板
の膨張そりによる接続不要や、コスト高を一掃で
きるということを見い出した。
発明の目的 本発明はこのような従来の問題に鑑み、回路基
板の膨張やそりに対応し接続不良の発生しない、
安価な接続方法を提供することを目的とする。
発明の構成 本発明は、半導体素子の電極パツド上に金属突
起を形成し、これと前記金属突起と相対する配線
パターンを有する配線基板との間に光硬化もしく
は熱硬化型の樹脂を介在せしめ、前記半導体素子
の金属突起を配線基板の配線パターンに圧接し、
前記樹脂を硬化さす事により、前記半導体素子の
金属突起と配線基板と配線パターンとを接続する
構成である。
実施例の説明 第1の実施例を第1図で説明する。半導体素子
1の電極パツド2に、Cr−Cu、Ti−Pd等の多層
金属膜を被着せしめて、電解メツキ法により金属
突起3を形成する。金属突起3は、Au、Ag、Cu
半田等の材料で3〜30μmの厚さに構成される。
一方、回路基板4は、ガラス、セラミツク、樹
脂もしくは金属酸化物を表面に被覆した金属等5
の平面に、少なくとも半導体素子1の金属突起3
と対応した位置に配線パターン6を形成してあ
る。配線パターン6は、Cu、Al、Au、ito等を
母体にし、酸化しやすい材質例えばCuであれば、
Auメツキ、Snメツキ、半田メツキ等の処理を施
してある。前記回路基板4面上かもしくは半導体
素子の金属突起を形成した面上に樹脂7を塗布載
置する(第1図a)。樹脂7は、液状もしくはシ
ート状であつて、光もしくは熱によつて硬化する
ものである。
次いで、半導体素子上の金属突起3と回路基板
4上の配線パターン6とを位置合せし、両者を圧
接8せしめる。この圧接8により、樹脂7は、押
し拡げられ、前記金属突起3と配線パターン6と
は、電気的接続を得る。この状態で、樹脂7に対
し、光もしくは熱を加えれば、樹脂7は硬化樹脂
7′となり、樹脂7′により、半導体素子1と回路
基板4とは、金属突起3と配線パターン6との電
気的導通を継続したまま固定されることになる。
この状態を第1図bに示す。すなわち、半導体
素子1の金属突起3と配線基板上の配線パターン
6との電気的接続は圧接で行なわれ、半導体素子
1と配線基板4との固定は硬化した樹脂7′によ
つてなされるものである。
次に他の実施例を第2図で説明する。この構成
においては、半導体素子1上の金属突起3と配線
基板4の配線パターン6との間に低融点金属9を
形成したもので、低融点金属9は、In・Ga系の
合金もしくはPd・Sn系の合金からなり、前記半
導体素子の使用温度領域で、その粘性が温度によ
り変化しかつ柔らかい材料の組成で構成されるも
のである。すなわち半導体素子および回路基板を
含めて温度上昇や機械的応力が作用しても、低融
点金属9により充分に吸収でき、半導体素子上の
金属突起3と配線パターン6との電気的接続を継
続できるものである。また、樹脂7を半導体素子
周縁まではみ出させ、硬化させれば、電極パツド
の保護としての効果も得られ、信頼性の高い半導
体装置を得ることができる。
さらに、本発明は、半導体素子の電極パツド上
に金属突起を形成しているために、配線基板の配
線パターンに圧接しても、半導体素子の金属突起
以外の部分例えば半導体素子の端部が配線パター
ンに接触してしまい、電気的短絡を発生させるこ
とがないものである。
発明の効果 (1) 本発明は、半導体素子の金属突起と配線基板
の配線パターンとの電気的接続は圧接、半導体
素子と回路基板との固定は樹脂で行なわれるた
めに、温度による回路基板の膨張による歪、機
械的歪等が半導体素子自体に直接作用しないの
で、半導体素子を損傷したり、電気的接続不良
を発生させることがない。
(2) 半導体素子の金属突起と配線基板の配線パタ
ーンとは単に圧接しているのみであるから、配
線パターンの材質を特定の材料に選択したり、
多層構成にする必要がない。すなわち、合金を
作りにくい配線パターン材料や処理をしにくい
配線パターン例えばTi、ito等の材料とでも、
電気的接続を容易に得ることができる。
(3) 本発明は、圧接し、樹脂を光もしくは熱によ
つて硬化せしめるものであるから、例えば光で
前記樹脂を硬化せしめれば、回路基板および半
導体素子には全く熱が加わらないし、熱硬化す
る場合でもせいぜい150℃以下であつて、従来
の如く半田づけやAu・Sn合金のように300℃
以上の温度を加える必要がない。これにより、
構成材料の熱歪を小さくすることができ、信頼
度の高い接続を得ることができる。
(4) また、本発明は、従来の如く、半田づけや合
金による接続を行なわないため、接続時に発生
する余剰の半田や、合金等による電極パツド間
や配線パターン間の電気的短絡を発生させるこ
とがない。
(5) 更にまた、本発明は、圧接し、樹脂を硬化さ
せるのみであるから実装のコストも低減できる
ものである。
【図面の簡単な説明】
第1図a,bは本発明の一実施例の半導体装置
の製造工程を示す断面図、第2図は同他の実施例
にかかる装置を示す断面図である。 1……半導体素子、2……電極パツド、3……
金属突起、4……配線基板、6……配線パター
ン、7……樹脂、9……低融点金属。

Claims (1)

  1. 【特許請求の範囲】 1 電極パツド上に金属突起を有する半導体素子
    と前記電極パツドと相対する配線パターンを有す
    る配線基板との間に光または熱硬化性樹脂を介在
    させ、前記半導体素子上の金属突起と配線基板上
    の配線パターンとを位置合せしかつ加圧せしめた
    後、前記樹脂を光もしくは熱によつて硬化せしめ
    たことを特徴とする半導体装置の製造方法。 2 樹脂が半導体素子周縁を覆つたことを特徴と
    する特許請求の範囲第1項に記載の半導体装置の
    製造方法。 3 半導体素子の金属突起と配線基板上の配線パ
    ターンとの間のみに金属層を介在させたことを特
    徴とする特許請求の範囲第1項に記載の半導体装
    置の製造方法。
JP11842384A 1984-06-08 1984-06-08 半導体装置の製造方法 Granted JPS60262430A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP11842384A JPS60262430A (ja) 1984-06-08 1984-06-08 半導体装置の製造方法

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP11842384A JPS60262430A (ja) 1984-06-08 1984-06-08 半導体装置の製造方法

Publications (2)

Publication Number Publication Date
JPS60262430A JPS60262430A (ja) 1985-12-25
JPH027180B2 true JPH027180B2 (ja) 1990-02-15

Family

ID=14736271

Family Applications (1)

Application Number Title Priority Date Filing Date
JP11842384A Granted JPS60262430A (ja) 1984-06-08 1984-06-08 半導体装置の製造方法

Country Status (1)

Country Link
JP (1) JPS60262430A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP0715348A2 (en) 1994-11-29 1996-06-05 Kabushiki Kaisha Toshiba Method of manufacturing semiconductor devices

Families Citing this family (51)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0638436B2 (ja) * 1985-02-22 1994-05-18 カシオ計算機株式会社 半導体ペレツトと基板の接合方法
JPS62169433A (ja) * 1986-01-22 1987-07-25 Fuji Xerox Co Ltd 半導体装置の製造方法
JPS6313337A (ja) * 1986-07-04 1988-01-20 Fuji Electric Co Ltd 半導体素子の実装方法
JPS6329973A (ja) * 1986-07-23 1988-02-08 Nec Corp 電子写真複写装置
JPS6343337A (ja) * 1986-08-09 1988-02-24 Toshiba Corp 半導体装置
JPS63127541A (ja) * 1986-11-17 1988-05-31 Matsushita Electric Ind Co Ltd チップの接合方法
JPS63150930A (ja) * 1986-12-15 1988-06-23 Shin Etsu Polymer Co Ltd 半導体装置
JPS63151031A (ja) * 1986-12-16 1988-06-23 Matsushita Electric Ind Co Ltd 半導体装置の接続方法
JPH0671024B2 (ja) * 1987-03-25 1994-09-07 三菱電機株式会社 半導体素子の実装方法
JPS63293840A (ja) * 1987-05-26 1988-11-30 Matsushita Electric Ind Co Ltd 実装体
JPH084101B2 (ja) * 1987-06-25 1996-01-17 松下電器産業株式会社 半導体装置の製造方法
JPH01160028A (ja) * 1987-12-17 1989-06-22 Matsushita Electric Ind Co Ltd 電極の接続方法
JPH01160029A (ja) * 1987-12-17 1989-06-22 Matsushita Electric Ind Co Ltd 半導体装置
JP2574369B2 (ja) * 1988-03-07 1997-01-22 松下電器産業株式会社 半導体チップの実装体およびその実装方法
JPH0793490B2 (ja) * 1988-09-09 1995-10-09 三井金属鉱業株式会社 実装基板の製造方法
JPH02263481A (ja) * 1989-04-04 1990-10-26 Matsushita Electric Ind Co Ltd 半導体装置およびそれを用いたイメージセンサ
JPH0738436B2 (ja) * 1989-04-04 1995-04-26 松下電器産業株式会社 半導体実装方法
JPH0642502B2 (ja) * 1988-10-19 1994-06-01 松下電器産業株式会社 半導体装置の製造方法および装置
JPH02110948A (ja) * 1988-10-19 1990-04-24 Matsushita Electric Ind Co Ltd 半導体装置及びその実装方法
JPH02110950A (ja) * 1988-10-19 1990-04-24 Matsushita Electric Ind Co Ltd 半導体装置
JPH02114933U (ja) * 1989-02-28 1990-09-14
US5081520A (en) * 1989-05-16 1992-01-14 Minolta Camera Kabushiki Kaisha Chip mounting substrate having an integral molded projection and conductive pattern
JP2600403B2 (ja) * 1989-12-01 1997-04-16 松下電器産業株式会社 半導体装置
DE19529490A1 (de) * 1995-08-10 1997-02-13 Fraunhofer Ges Forschung Chipkontaktierungsverfahren, damit hergestellte elektronische Schaltung und Trägersubstrat zur Kontaktierung von Chips
JPH09213753A (ja) * 1995-11-30 1997-08-15 Ricoh Co Ltd 半導体装置とプリント基板との接続構造体
JP2812316B2 (ja) * 1996-11-18 1998-10-22 富士ゼロックス株式会社 半導体装置の製造方法
EP0954208A4 (en) * 1996-12-27 2002-09-11 Matsushita Electric Ind Co Ltd METHOD AND DEVICE FOR FIXING AN ELECTRONIC COMPONENT ON A CIRCUIT BOARD
US7618713B2 (en) 1997-03-31 2009-11-17 Hitachi Chemical Company, Ltd. Circuit-connecting material and circuit terminal connected structure and connecting method
AU6520798A (en) 1997-03-31 1998-10-22 Hitachi Chemical Company, Ltd. Circuit connecting material, and structure and method of connecting circuit terminal
JP2001093938A (ja) 1999-09-20 2001-04-06 Nec Kansai Ltd 半導体装置及びその製造方法
DE10120029A1 (de) * 2001-02-13 2002-08-29 Pac Tech Gmbh Presskontaktierung von Mikrochips
JP3871634B2 (ja) 2002-10-04 2007-01-24 シャープ株式会社 Cof半導体装置の製造方法
JP4008388B2 (ja) * 2003-06-30 2007-11-14 シャープ株式会社 半導体キャリア用フィルムおよびそれを用いた半導体装置、液晶モジュール
JP4024773B2 (ja) 2004-03-30 2007-12-19 シャープ株式会社 配線基板、半導体装置およびその製造方法並びに半導体モジュール装置
JP3833669B2 (ja) 2004-04-08 2006-10-18 シャープ株式会社 半導体装置および半導体装置の製造方法
JP4691417B2 (ja) 2005-08-22 2011-06-01 日立化成デュポンマイクロシステムズ株式会社 回路接続構造体及びその製造方法及び回路接続構造体用の半導体基板
JP4892209B2 (ja) 2005-08-22 2012-03-07 日立化成デュポンマイクロシステムズ株式会社 半導体装置の製造方法
KR100985084B1 (ko) 2005-10-06 2010-10-04 후지쯔 세미컨덕터 가부시키가이샤 반도체 장치의 제조 방법
DE102006028692B4 (de) * 2006-05-19 2021-09-02 OSRAM Opto Semiconductors Gesellschaft mit beschränkter Haftung Elektrisch leitende Verbindung mit isolierendem Verbindungsmedium
JP5186741B2 (ja) 2006-08-18 2013-04-24 富士通セミコンダクター株式会社 回路基板及び半導体装置
US8613623B2 (en) 2008-09-30 2013-12-24 Sony Chemical & Information Device Corporation Acrylic insulating adhesive
JP5719997B2 (ja) * 2011-09-16 2015-05-20 パナソニックIpマネジメント株式会社 電子部品の実装方法及び実装システム
EP3300108B1 (en) 2013-03-28 2019-07-24 Toshiba Hokuto Electronics Corporation Light emitting device and method for manufacturing the same
WO2014157455A1 (ja) 2013-03-28 2014-10-02 東芝ホクト電子株式会社 発光装置、その製造方法、および発光装置使用装置
JP6523179B2 (ja) 2013-12-02 2019-05-29 東芝ホクト電子株式会社 発光ユニット、発光装置及び発光ユニットの製造方法
JP6560123B2 (ja) 2013-12-02 2019-08-14 東芝ホクト電子株式会社 発光装置およびその製造方法
JP6431485B2 (ja) 2013-12-02 2018-11-28 東芝ホクト電子株式会社 発光装置
JPWO2015146115A1 (ja) 2014-03-25 2017-04-13 東芝ホクト電子株式会社 発光装置
JP6913460B2 (ja) 2014-09-26 2021-08-04 東芝ホクト電子株式会社 発光モジュール
CN106030839B (zh) 2014-09-26 2018-09-28 东芝北斗电子株式会社 发光模块
JP6374434B2 (ja) 2016-04-21 2018-08-15 山栄化学株式会社 熱硬化性樹脂組成物及び電子部品搭載基板

Citations (11)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS51100679A (ja) * 1975-03-03 1976-09-06 Suwa Seikosha Kk
JPS51119732A (en) * 1975-04-15 1976-10-20 Seiko Epson Corp Adhesive with anisotropy in the direction of conducting path
JPS5357481A (en) * 1976-11-04 1978-05-24 Canon Inc Connecting process
JPS56103876A (en) * 1980-01-22 1981-08-19 Fujikura Kasei Kk Method of connecting transparent conductor
JPS56122193A (en) * 1980-01-31 1981-09-25 Rogers Corp Electrically connected unit and method therefor
JPS56167340A (en) * 1980-05-27 1981-12-23 Toshiba Corp Junction of semicondctor pellet with substrate
JPS57130437A (en) * 1981-02-06 1982-08-12 Citizen Watch Co Ltd Sealing method of ic
JPS5873126A (ja) * 1981-10-27 1983-05-02 Seiko Keiyo Kogyo Kk 半導体装置の実装方法
JPS58103143A (ja) * 1981-12-16 1983-06-20 Sharp Corp 電子部品の封止方法
JPS58107641A (ja) * 1981-12-21 1983-06-27 Seiko Keiyo Kogyo Kk 半導体装置の封止方法
JPS59178758A (ja) * 1983-03-29 1984-10-11 Sharp Corp 半導体チツプの基板実装方法

Patent Citations (11)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS51100679A (ja) * 1975-03-03 1976-09-06 Suwa Seikosha Kk
JPS51119732A (en) * 1975-04-15 1976-10-20 Seiko Epson Corp Adhesive with anisotropy in the direction of conducting path
JPS5357481A (en) * 1976-11-04 1978-05-24 Canon Inc Connecting process
JPS56103876A (en) * 1980-01-22 1981-08-19 Fujikura Kasei Kk Method of connecting transparent conductor
JPS56122193A (en) * 1980-01-31 1981-09-25 Rogers Corp Electrically connected unit and method therefor
JPS56167340A (en) * 1980-05-27 1981-12-23 Toshiba Corp Junction of semicondctor pellet with substrate
JPS57130437A (en) * 1981-02-06 1982-08-12 Citizen Watch Co Ltd Sealing method of ic
JPS5873126A (ja) * 1981-10-27 1983-05-02 Seiko Keiyo Kogyo Kk 半導体装置の実装方法
JPS58103143A (ja) * 1981-12-16 1983-06-20 Sharp Corp 電子部品の封止方法
JPS58107641A (ja) * 1981-12-21 1983-06-27 Seiko Keiyo Kogyo Kk 半導体装置の封止方法
JPS59178758A (ja) * 1983-03-29 1984-10-11 Sharp Corp 半導体チツプの基板実装方法

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP0715348A2 (en) 1994-11-29 1996-06-05 Kabushiki Kaisha Toshiba Method of manufacturing semiconductor devices

Also Published As

Publication number Publication date
JPS60262430A (ja) 1985-12-25

Similar Documents

Publication Publication Date Title
JPH027180B2 (ja)
JP2833326B2 (ja) 電子部品実装接続体およびその製造方法
US6537854B1 (en) Method for bonding IC chips having multi-layered bumps with corrugated surfaces and devices formed
US6524892B1 (en) Method of fabricating multilayer flexible wiring boards
US5089750A (en) Lead connection structure
JP3269390B2 (ja) 半導体装置
JP2755696B2 (ja) 半導体装置及びその製造方法
JP2932840B2 (ja) 半導体素子のボンディング方法
JPH0357617B2 (ja)
US4959590A (en) Lead connection structure
JP2000058597A (ja) 電子部品実装方法
JP3054944B2 (ja) 表示装置の製造方法
JP2002050717A (ja) 半導体装置およびその製造方法
JPS6290938A (ja) 半導体装置
JP2002083841A (ja) 実装構造及びその製造方法
JPH0521520A (ja) Ic実装方法
JPH02280349A (ja) バンプの形成方法およびバンプの接続方法
JPS6150394A (ja) 実装体
JP3792227B2 (ja) 半導体装置およびその製造方法
JPH0526747Y2 (ja)
JP2523641B2 (ja) 半導体装置
JPH08102464A (ja) 突起電極構造とその形成方法及び突起電極を用いた接続構造とその接続方法
JPS61198738A (ja) 半導体装置の製造方法
JP2998507B2 (ja) 半導体装置の製造方法
JP2002299387A (ja) 半導体装置用テープキャリアおよびその製造方法

Legal Events

Date Code Title Description
EXPY Cancellation because of completion of term