JP4067651B2 - 半導体装置の作製方法 - Google Patents
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- 238000000034 method Methods 0.000 title claims description 79
- 239000004065 semiconductor Substances 0.000 title claims description 70
- 238000004519 manufacturing process Methods 0.000 title claims description 30
- 239000010408 film Substances 0.000 claims description 345
- 239000013078 crystal Substances 0.000 claims description 116
- 239000010409 thin film Substances 0.000 claims description 70
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 claims description 65
- 229910052814 silicon oxide Inorganic materials 0.000 claims description 52
- 229910052710 silicon Inorganic materials 0.000 claims description 46
- 239000010703 silicon Substances 0.000 claims description 46
- 229910052751 metal Inorganic materials 0.000 claims description 35
- 239000002184 metal Substances 0.000 claims description 33
- 238000002425 crystallisation Methods 0.000 claims description 32
- 230000008025 crystallization Effects 0.000 claims description 32
- 238000010438 heat treatment Methods 0.000 claims description 31
- 229910052759 nickel Inorganic materials 0.000 claims description 21
- 239000012298 atmosphere Substances 0.000 claims description 17
- 239000010453 quartz Substances 0.000 claims description 13
- 230000006870 function Effects 0.000 claims description 12
- 229910052736 halogen Inorganic materials 0.000 claims description 11
- 150000002367 halogens Chemical class 0.000 claims description 11
- 238000004544 sputter deposition Methods 0.000 claims description 9
- 230000001678 irradiating effect Effects 0.000 claims description 8
- 238000000059 patterning Methods 0.000 claims description 8
- 238000005247 gettering Methods 0.000 claims description 7
- 229910052739 hydrogen Inorganic materials 0.000 claims description 7
- 239000001257 hydrogen Substances 0.000 claims description 6
- UFHFLCQGNIYNRP-UHFFFAOYSA-N Hydrogen Chemical compound [H][H] UFHFLCQGNIYNRP-UHFFFAOYSA-N 0.000 claims description 5
- 229910052697 platinum Inorganic materials 0.000 claims description 3
- 229910052802 copper Inorganic materials 0.000 claims description 2
- 229910052737 gold Inorganic materials 0.000 claims description 2
- 229910052741 iridium Inorganic materials 0.000 claims description 2
- 229910052742 iron Inorganic materials 0.000 claims description 2
- 239000012299 nitrogen atmosphere Substances 0.000 claims description 2
- 229910052762 osmium Inorganic materials 0.000 claims description 2
- 229910052763 palladium Inorganic materials 0.000 claims description 2
- 229910052703 rhodium Inorganic materials 0.000 claims description 2
- 229910052707 ruthenium Inorganic materials 0.000 claims description 2
- 239000010410 layer Substances 0.000 description 73
- 239000000758 substrate Substances 0.000 description 61
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 46
- 239000012535 impurity Substances 0.000 description 44
- 229910021417 amorphous silicon Inorganic materials 0.000 description 41
- PXHVJJICTQNCMI-UHFFFAOYSA-N Nickel Chemical compound [Ni] PXHVJJICTQNCMI-UHFFFAOYSA-N 0.000 description 40
- 239000010407 anodic oxide Substances 0.000 description 34
- 229910021419 crystalline silicon Inorganic materials 0.000 description 30
- 230000008569 process Effects 0.000 description 25
- 150000002500 ions Chemical class 0.000 description 22
- 229910052782 aluminium Inorganic materials 0.000 description 21
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 description 21
- 239000011159 matrix material Substances 0.000 description 19
- 239000011229 interlayer Substances 0.000 description 17
- 238000007254 oxidation reaction Methods 0.000 description 17
- 230000003647 oxidation Effects 0.000 description 16
- 230000015572 biosynthetic process Effects 0.000 description 15
- 239000011521 glass Substances 0.000 description 15
- 238000005468 ion implantation Methods 0.000 description 14
- 238000005204 segregation Methods 0.000 description 13
- 229910052581 Si3N4 Inorganic materials 0.000 description 12
- 238000010586 diagram Methods 0.000 description 12
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 description 12
- 239000000243 solution Substances 0.000 description 11
- 239000003990 capacitor Substances 0.000 description 10
- 230000000694 effects Effects 0.000 description 10
- 235000012431 wafers Nutrition 0.000 description 10
- LYCAIKOWRPUZTN-UHFFFAOYSA-N Ethylene glycol Chemical compound OCCO LYCAIKOWRPUZTN-UHFFFAOYSA-N 0.000 description 9
- 239000008151 electrolyte solution Substances 0.000 description 9
- 239000004973 liquid crystal related substance Substances 0.000 description 9
- 238000002230 thermal chemical vapour deposition Methods 0.000 description 9
- 229910052760 oxygen Inorganic materials 0.000 description 8
- 125000004429 atom Chemical group 0.000 description 7
- 230000002093 peripheral effect Effects 0.000 description 7
- 238000005268 plasma chemical vapour deposition Methods 0.000 description 7
- MUBZPKHOEPUJKR-UHFFFAOYSA-N Oxalic acid Chemical compound OC(=O)C(O)=O MUBZPKHOEPUJKR-UHFFFAOYSA-N 0.000 description 6
- 230000007547 defect Effects 0.000 description 6
- 238000005516 engineering process Methods 0.000 description 6
- QGZKDVFQNNGYKY-UHFFFAOYSA-N ammonia Natural products N QGZKDVFQNNGYKY-UHFFFAOYSA-N 0.000 description 5
- QVGXLLKOCUKJST-UHFFFAOYSA-N atomic oxygen Chemical compound [O] QVGXLLKOCUKJST-UHFFFAOYSA-N 0.000 description 5
- 238000002513 implantation Methods 0.000 description 5
- 239000001301 oxygen Substances 0.000 description 5
- 230000002829 reductive effect Effects 0.000 description 5
- VEXZGXHMUGYJMC-UHFFFAOYSA-N Hydrochloric acid Chemical compound Cl VEXZGXHMUGYJMC-UHFFFAOYSA-N 0.000 description 4
- RTAQQCXQSZGOHL-UHFFFAOYSA-N Titanium Chemical compound [Ti] RTAQQCXQSZGOHL-UHFFFAOYSA-N 0.000 description 4
- 238000000576 coating method Methods 0.000 description 4
- 238000000605 extraction Methods 0.000 description 4
- 229910021420 polycrystalline silicon Inorganic materials 0.000 description 4
- 229910021332 silicide Inorganic materials 0.000 description 4
- FVBUAEGBCNSCDD-UHFFFAOYSA-N silicide(4-) Chemical compound [Si-4] FVBUAEGBCNSCDD-UHFFFAOYSA-N 0.000 description 4
- 239000010936 titanium Substances 0.000 description 4
- 229910052719 titanium Inorganic materials 0.000 description 4
- QTBSBXVTEAMEQO-UHFFFAOYSA-N Acetic acid Chemical compound CC(O)=O QTBSBXVTEAMEQO-UHFFFAOYSA-N 0.000 description 3
- ZOXJGFHDIHLPTG-UHFFFAOYSA-N Boron Chemical compound [B] ZOXJGFHDIHLPTG-UHFFFAOYSA-N 0.000 description 3
- FEWJPZIEWOKRBE-UHFFFAOYSA-N Tartaric acid Natural products [H+].[H+].[O-]C(=O)C(O)C(O)C([O-])=O FEWJPZIEWOKRBE-UHFFFAOYSA-N 0.000 description 3
- 229910052796 boron Inorganic materials 0.000 description 3
- 239000011248 coating agent Substances 0.000 description 3
- IXCSERBJSXMMFS-UHFFFAOYSA-N hydrogen chloride Substances Cl.Cl IXCSERBJSXMMFS-UHFFFAOYSA-N 0.000 description 3
- 229910000041 hydrogen chloride Inorganic materials 0.000 description 3
- 239000000463 material Substances 0.000 description 3
- 230000003472 neutralizing effect Effects 0.000 description 3
- RUFLMLWJRZAWLJ-UHFFFAOYSA-N nickel silicide Chemical compound [Ni]=[Si]=[Ni] RUFLMLWJRZAWLJ-UHFFFAOYSA-N 0.000 description 3
- 229910021334 nickel silicide Inorganic materials 0.000 description 3
- 229910052698 phosphorus Inorganic materials 0.000 description 3
- BASFCYQUMIYNBI-UHFFFAOYSA-N platinum Substances [Pt] BASFCYQUMIYNBI-UHFFFAOYSA-N 0.000 description 3
- 229920005591 polysilicon Polymers 0.000 description 3
- 239000000047 product Substances 0.000 description 3
- 238000004151 rapid thermal annealing Methods 0.000 description 3
- 239000012266 salt solution Substances 0.000 description 3
- 229910052715 tantalum Inorganic materials 0.000 description 3
- GUVRBAGPIYLISA-UHFFFAOYSA-N tantalum atom Chemical compound [Ta] GUVRBAGPIYLISA-UHFFFAOYSA-N 0.000 description 3
- 235000002906 tartaric acid Nutrition 0.000 description 3
- 239000011975 tartaric acid Substances 0.000 description 3
- ZOKXTWBITQBERF-UHFFFAOYSA-N Molybdenum Chemical compound [Mo] ZOKXTWBITQBERF-UHFFFAOYSA-N 0.000 description 2
- NBIIXXVUZAFLBC-UHFFFAOYSA-N Phosphoric acid Chemical compound OP(O)(O)=O NBIIXXVUZAFLBC-UHFFFAOYSA-N 0.000 description 2
- OAICVXFJPJFONN-UHFFFAOYSA-N Phosphorus Chemical compound [P] OAICVXFJPJFONN-UHFFFAOYSA-N 0.000 description 2
- 239000002253 acid Substances 0.000 description 2
- 229910021529 ammonia Inorganic materials 0.000 description 2
- 238000000137 annealing Methods 0.000 description 2
- 238000002048 anodisation reaction Methods 0.000 description 2
- 239000007864 aqueous solution Substances 0.000 description 2
- 238000004630 atomic force microscopy Methods 0.000 description 2
- 230000008901 benefit Effects 0.000 description 2
- 229910052799 carbon Inorganic materials 0.000 description 2
- 238000005229 chemical vapour deposition Methods 0.000 description 2
- 238000011109 contamination Methods 0.000 description 2
- 238000009792 diffusion process Methods 0.000 description 2
- 239000000428 dust Substances 0.000 description 2
- 239000007789 gas Substances 0.000 description 2
- 238000005259 measurement Methods 0.000 description 2
- 229910052750 molybdenum Inorganic materials 0.000 description 2
- 239000011733 molybdenum Substances 0.000 description 2
- AIYYMMQIMJOTBM-UHFFFAOYSA-L nickel(ii) acetate Chemical compound [Ni+2].CC([O-])=O.CC([O-])=O AIYYMMQIMJOTBM-UHFFFAOYSA-L 0.000 description 2
- 235000006408 oxalic acid Nutrition 0.000 description 2
- 239000011574 phosphorus Substances 0.000 description 2
- 238000005240 physical vapour deposition Methods 0.000 description 2
- 238000005498 polishing Methods 0.000 description 2
- 238000012545 processing Methods 0.000 description 2
- 230000001737 promoting effect Effects 0.000 description 2
- 230000001681 protective effect Effects 0.000 description 2
- 229910052706 scandium Inorganic materials 0.000 description 2
- SIXSYDAISGFNSX-UHFFFAOYSA-N scandium atom Chemical compound [Sc] SIXSYDAISGFNSX-UHFFFAOYSA-N 0.000 description 2
- 238000004528 spin coating Methods 0.000 description 2
- 238000003860 storage Methods 0.000 description 2
- 239000000126 substance Substances 0.000 description 2
- 229910021341 titanium silicide Inorganic materials 0.000 description 2
- 230000007704 transition Effects 0.000 description 2
- XLYOFNOQVPJJNP-UHFFFAOYSA-N water Substances O XLYOFNOQVPJJNP-UHFFFAOYSA-N 0.000 description 2
- VHUUQVKOLVNVRT-UHFFFAOYSA-N Ammonium hydroxide Chemical compound [NH4+].[OH-] VHUUQVKOLVNVRT-UHFFFAOYSA-N 0.000 description 1
- OKTJSMMVPCPJKN-UHFFFAOYSA-N Carbon Chemical compound [C] OKTJSMMVPCPJKN-UHFFFAOYSA-N 0.000 description 1
- GRYLNZFGIOXLOG-UHFFFAOYSA-N Nitric acid Chemical compound O[N+]([O-])=O GRYLNZFGIOXLOG-UHFFFAOYSA-N 0.000 description 1
- 230000002159 abnormal effect Effects 0.000 description 1
- 230000009471 action Effects 0.000 description 1
- 230000002411 adverse Effects 0.000 description 1
- 229910000147 aluminium phosphate Inorganic materials 0.000 description 1
- 238000004458 analytical method Methods 0.000 description 1
- 238000007743 anodising Methods 0.000 description 1
- 230000004888 barrier function Effects 0.000 description 1
- 230000008859 change Effects 0.000 description 1
- 230000003749 cleanliness Effects 0.000 description 1
- 238000002485 combustion reaction Methods 0.000 description 1
- 238000001816 cooling Methods 0.000 description 1
- 230000007423 decrease Effects 0.000 description 1
- 238000006356 dehydrogenation reaction Methods 0.000 description 1
- 238000013461 design Methods 0.000 description 1
- 230000006866 deterioration Effects 0.000 description 1
- PZPGRFITIJYNEJ-UHFFFAOYSA-N disilane Chemical compound [SiH3][SiH3] PZPGRFITIJYNEJ-UHFFFAOYSA-N 0.000 description 1
- 238000001312 dry etching Methods 0.000 description 1
- 230000005684 electric field Effects 0.000 description 1
- 238000005566 electron beam evaporation Methods 0.000 description 1
- 238000005530 etching Methods 0.000 description 1
- 230000005669 field effect Effects 0.000 description 1
- 150000002431 hydrogen Chemical class 0.000 description 1
- 238000005984 hydrogenation reaction Methods 0.000 description 1
- 230000001771 impaired effect Effects 0.000 description 1
- 230000010354 integration Effects 0.000 description 1
- 238000005304 joining Methods 0.000 description 1
- 238000005224 laser annealing Methods 0.000 description 1
- 230000014759 maintenance of location Effects 0.000 description 1
- 239000000155 melt Substances 0.000 description 1
- 150000002739 metals Chemical class 0.000 description 1
- 238000002156 mixing Methods 0.000 description 1
- 150000002816 nickel compounds Chemical class 0.000 description 1
- KBJMLQFLOWQJNF-UHFFFAOYSA-N nickel(ii) nitrate Chemical compound [Ni+2].[O-][N+]([O-])=O.[O-][N+]([O-])=O KBJMLQFLOWQJNF-UHFFFAOYSA-N 0.000 description 1
- 229910017604 nitric acid Inorganic materials 0.000 description 1
- 229910052757 nitrogen Inorganic materials 0.000 description 1
- 230000006911 nucleation Effects 0.000 description 1
- 238000010899 nucleation Methods 0.000 description 1
- 230000003287 optical effect Effects 0.000 description 1
- 238000002294 plasma sputter deposition Methods 0.000 description 1
- 239000002244 precipitate Substances 0.000 description 1
- 230000008707 rearrangement Effects 0.000 description 1
- 239000012925 reference material Substances 0.000 description 1
- 238000011160 research Methods 0.000 description 1
- 239000011347 resin Substances 0.000 description 1
- 229920005989 resin Polymers 0.000 description 1
- 230000000717 retained effect Effects 0.000 description 1
- 238000007788 roughening Methods 0.000 description 1
- 230000003068 static effect Effects 0.000 description 1
- 230000003746 surface roughness Effects 0.000 description 1
- 230000001131 transforming effect Effects 0.000 description 1
- VEDJZFSRVVQBIL-UHFFFAOYSA-N trisilane Chemical compound [SiH3][SiH2][SiH3] VEDJZFSRVVQBIL-UHFFFAOYSA-N 0.000 description 1
- WFKWXMTUELFFGS-UHFFFAOYSA-N tungsten Chemical compound [W] WFKWXMTUELFFGS-UHFFFAOYSA-N 0.000 description 1
- 229910052721 tungsten Inorganic materials 0.000 description 1
- 239000010937 tungsten Substances 0.000 description 1
- 239000012808 vapor phase Substances 0.000 description 1
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- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
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- H01L21/02104—Forming layers
- H01L21/02365—Forming inorganic semiconducting materials on a substrate
- H01L21/02656—Special treatments
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- H01L21/02667—Crystallisation or recrystallisation of non-monocrystalline semiconductor materials, e.g. regrowth
- H01L21/02669—Crystallisation or recrystallisation of non-monocrystalline semiconductor materials, e.g. regrowth using crystallisation inhibiting elements
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- H01L21/02365—Forming inorganic semiconducting materials on a substrate
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- H01L21/02667—Crystallisation or recrystallisation of non-monocrystalline semiconductor materials, e.g. regrowth
- H01L21/02672—Crystallisation or recrystallisation of non-monocrystalline semiconductor materials, e.g. regrowth using crystallisation enhancing elements
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Description
【発明が属する技術分野】
本明細書で開示する発明は、絶縁表面を有する基体上に形成された、実質的に単結晶と見なせる領域(以下、モノドメイン領域と呼ぶ)を有する半導体薄膜およびその半導体薄膜を活性層とする半導体装置に関する。特に、結晶性珪素膜で活性層を構成した薄膜トランジスタに関する。
【0002】
【従来の技術】
近年、絶縁表面を有する基体上に形成された薄膜珪素半導体膜(厚さ数百〜数千Å程度)を用いて薄膜トランジスタ(TFT)を構成する技術が注目されている。薄膜トランジスタはICや液晶表示装置のような電子デバイスに広く応用されてきている。
【0003】
薄膜トランジスタの心臓部ともいうべき重要な部分はチャネル形成領域およびチャネル形成領域とソース/ドレイン領域とを接合するジャンクション部分である。即ち、活性層が最も薄膜トランジスタの性能に影響を与えると言える。
【0004】
薄膜トランジスタの活性層を構成する半導体薄膜としては、プラズマCVD法や減圧熱CVD法により形成される非晶質珪素膜(アモルファスシリコン膜)が一般に利用されている。
【0005】
現状においては、非晶質珪素膜を用いた薄膜トランジスタが実用化されているが、より高速動作を求められる場合には、結晶性を有した珪素薄膜(結晶性珪素膜と呼ぶ)を利用した薄膜トランジスタが必要とされる。
【0006】
例えば、アクティブマトリクス型の液晶表示装置やパッシブ型の液晶表示装置の周辺回路には、画素領域に配置された画素TFTを駆動するための駆動回路や映像信号を取り扱ったり制御する回路、各種情報を記憶する記憶回路等が必要とされる。
【0007】
さらに、これらの回路の中で、映像信号を取り扱ったり制御する回路や各種情報を記憶する記憶回路には、公知の単結晶ウエハーを用いた集積回路に匹敵する性能が求められる。従って、基板上に形成される薄膜半導体を用いてこれら回路を集積化しようとする場合、単結晶に匹敵する結晶性を有した結晶性珪素膜を基板上に形成する必要がある。
【0008】
基体上に結晶性珪素膜を形成する方法としては、本出願人による特開平6-232059号公報、特開平6-244103号公報に記載された技術が公知である。この公報に記載されている技術は、珪素の結晶化を助長する金属元素を利用することにより、550℃、4時間程度の加熱処理によって結晶性の優れた結晶性珪素膜を形成するものである。
【0009】
しかし、上記技術を薄膜トランジスタの活性層に活用したとしても各種演算回路やメモリー回路等を構成するための薄膜トランジスタとしては役不足の感がある。これは、その結晶性がいまだ不足しており、必要とする特性が得られないからである。
【0010】
特に、単結晶に匹敵する結晶性を有した結晶性珪素膜には実質的に結晶粒界が存在しないことが必要条件となる。なぜならば、結晶粒界は結晶間を往来する電子の進行を妨害するエネルギー障壁となるからである。
【0011】
ここで本発明者らは上記技術を用いた場合の結晶成長の過程を第1〜第4のステップに分類して捉え、以下に示すようなモデルで考えた。説明は図3を用いて行うこととする。
【0012】
図3(A)において301は基体表面にバッファ層として成膜された酸化珪素膜である。その上には非晶質珪素膜303が成膜されている。この時、酸化珪素膜上の凹または凸部302(図は凸部のみを記載する)は酸化珪素膜の表面ラフネスやゴミにより形成されたものである。
【0013】
そして、非晶質珪素膜303の表面に結晶化を助長する金属元素を含む溶液を滴下し、スピンコート法による塗布を行う。すると、図3(A)に示す様に非晶質珪素膜303の表面にニッケル層304を保持した状態を得る。
【0014】
この状態で500〜700℃の温度範囲における加熱処理を施して非晶質珪素膜303の結晶化を行う。ただし、ガラス基板を用いる場合は耐熱性を考慮して650℃以下とするのが望ましい。
【0015】
すると、まず図3(B)中の矢印が示す様に金属元素が非晶質珪素膜303中を等方的に内部拡散して酸化珪素膜301との界面に到達する。これが、第1のステップである。
【0016】
すると、金属元素は酸化珪素膜301と非晶質珪素膜303との界面をマイグレーションして凹または凸部302へと偏析する。これが第2のステップである。これは、金属元素がエネルギー的に安定なサイトを求めるからであり、この場合、凹または凸部302が偏析サイトとなったわけである。(図3(C))
【0017】
この時、偏析サイトとなった凹または凸部302は金属元素が高濃度に存在するためここに結晶核が発生する。本発明者らの研究では金属元素がニッケルの場合、その濃度が1×1020atoms/cm3 以上となると結晶核となりうる。
【0018】
そして、この結晶核を起点として結晶成長が始まるのであるが、まず最初に珪素膜面に対して概略垂直な方向に結晶化が進行する。これが第3のステップである。(図3(D))
【0019】
この珪素膜面に対して概略垂直な方向に結晶化が進行した領域(以下、縦成長領域と呼ぶ)305は高濃度に濃縮された金属元素を押し上げつつ結晶化が進行するため、凹または凸部302の上方に位置する非晶質珪素膜303の表面にも高濃度の金属元素が濃縮される。その結果、縦成長領域305は他の領域と比較して金属元素の濃度が高い領域となる。
【0020】
次に、非晶質珪素膜303が縦成長領域305と接した界面306を起点に基体と概略平行な方向(図3(E)において矢印で示す方向)に結晶成長が始まる。これが第4のステップである。この結晶307は結晶幅が非晶質珪素膜303の膜厚にほぼ等しい柱状または針状の結晶である。(図3(E))
【0021】
この結晶307は基体と概略平行な方向に進むため、やがて向かい合う別の結晶とぶつかり合って成長が止まる。すると、図3(F)に示す様にぶつかり合った境界が結晶粒界308となる。また、こうして形成される結晶領域(以下、横成長領域と呼ぶ)309は比較的結晶性の揃った領域となる。
【0022】
この様に、従来の結晶化形態では偏析サイトが不規則に、かつ、無数に形成されてしまうため、結晶核の密度が高く、個々の結晶粒が互いの成長を阻害し合ってしまう。従って、結晶粒径は小さいものとならざるを得ない。
【0023】
即ち、例えば薄膜トランジスタの活性層を上記技術により形成した結晶性珪素膜上に形成しても、必ずその内部に結晶粒界を含んでしまい、単結晶に匹敵する結晶性を実現することは不可能なのが現状である。
【0024】
結晶核の発生密度を少なくすればその分結晶粒径を確保することができるが、結晶核は金属元素の偏析サイトがどこに存在するかでその位置が決まるものであり、従来技術のままでは偏析サイトとなる様なサイト(例えば、図3(A)に示すような凹または凸部302)が不規則に形成されるが故にその位置を制御することは不可能である。
【0025】
【発明が解決しようとする課題】
本明細書で開示する発明は、表面に絶縁膜を有する基体上に単結晶に匹敵する結晶性を有するモノドメイン領域を形成することを課題とする。そして、そのモノドメイン領域でもって活性層を構成した半導体装置を得ることを課題とする。
【0026】
【課題を解決するための手段】
本明細書で開示する発明の構成は、
表面に絶縁膜を有する基体上に形成された半導体薄膜であって、
前記半導体薄膜はレーザー光または該レーザー光と同等のエネルギーを持つ強光の照射により結晶性を改善された実質的に単結晶と見なせるモノドメイン領域を有し、
前記モノドメイン領域は前記基体と概略平行な柱状または針状結晶が複数集合して形成されており、
前記半導体薄膜の下面に接する前記絶縁膜には意図的に形成された凹または凸パターンが設けられていることを特徴とする。
【0027】
また、他の発明の構成となる半導体装置は、前記モノドメイン領域のみを活性層として利用するものである。このモノドメイン領域の内部には実質的に結晶粒界が存在しないという特徴がある。
【0028】
また、他の発明の構成は、
絶縁表面を有する基体上にスパッタ法により酸化珪素膜を成膜する工程と、
前記酸化珪素膜を所望の形状にパターニングして意図的に凹または凸パターンを設ける工程と、
前記酸化珪素膜上に減圧熱CVD法により非晶質珪素膜を成膜する工程と、
前記非晶質珪素膜に対して結晶化を助長する金属元素を保持せしめる工程と、
加熱処理により前記非晶質珪素膜を結晶性珪素膜に変成せしめる工程と、
前記結晶性珪素膜に対してレーザー光または該レーザー光と同等のエネルギーを持つ強光を照射する工程と、
を少なくとも有し、
前記レーザー光または該レーザー光と同等のエネルギーを持つ強光を照射する工程により前記結晶性珪素膜をモノドメイン領域に変成せしめることを特徴とする。また、これらの工程を経て形成されるモノドメイン領域で活性層を構成することを特徴とする。
【0029】
本発明者らは本発明により得られる結晶領域を実質的に単結晶と見なせる領域即ち、モノドメイン領域と定義している。モノドメイン領域の定義は、その領域内に実質的に結晶粒界が存在せず、転移や積層欠陥等に起因する結晶欠陥が殆ど存在しないことである。
【0030】
なお、実質的に結晶粒界が存在しないとは、結晶粒界が存在したとしても電気的に不活性であることを意味している。その様な電気的に不活性な結晶粒界として、{111}双晶粒界、{111}積層欠陥、{221}双晶粒界、{221}Twist 双晶粒界などが報告されている(R.Simokawa and Y.Hayashi:Jpn.J.Appl.Phys. 27 (1987) pp.751〜758 )。
【0031】
本発明者らは、モノドメイン領域に含まれる結晶粒界がこれらの電気的に不活性な結晶粒界となっている可能性が高いと推測している。即ち、見た目には結晶粒界として存在しても、電気的にはキャリアの移動を阻害する様なことのない不活性な領域であると考えられる。
【0032】
本発明者らはまず結晶粒界を減らすために結晶粒径を大きくする手段を検討した。その結果、従来制御することが出来なかった結晶核を制御する手段を発明するに至った。
【0033】
その手段とは、まず非晶質珪素膜の下面に接する絶縁膜の表面状態を極めて滑らかなものとすることである。そのため、本発明では人工石英ターゲットを用いたスパッタ法により成膜した酸化珪素膜をバッファ層として非晶質珪素膜の下に設ける(参考資料として人工石英ターゲットの成分表を図14に示す)。こうして成膜された酸化珪素膜は非常に緻密、かつ、平滑であり、従来のような偏析サイトとなる凹または凸部が殆どないものとなる。
【0034】
次に、この酸化珪素膜にパターニングを施して意図的に凹または凸パターンを形成することである。即ち、意図的に結晶化を助長する金属元素の偏析サイトを形成することで、結晶核の発生位置を制御することが可能となる。
【0035】
従って、素子設計の段階で所望の位置に所望の大きさの結晶を形成することを設計できるという大きな利点を有することになる。このことは工業上、非常に有益である。
【0036】
また、非晶質珪素膜の成膜方法として減圧熱CVD法を用いることも本発明の特徴の一つである。減圧熱CVD法により成膜した非晶質珪素膜はプラズマCVD法により成膜した非晶質珪素膜に比べて水素含有量が少なく、膜質が緻密であるため自然核発生が少ないという特徴を有している。
【0037】
自然核発生が多いと結晶核を制御するという目的にとって大きな障害となるため、自然核発生が少ないことは極めて都合が良い。
【0038】
次に、以上の様にして形成された結晶粒径の大きな結晶を単結晶化(正確にはモノドメイン領域化)する手段を検討した。その結果、レーザー光またはそれと同等のエネルギーを持つ強光を結晶に対して照射することによりモノドメイン領域を形成できることが判明した。
【0039】
以上のような本発明の構成について、以下に記載する実施例でもって詳細な説明を行うこととする。
【0040】
【実施例】
〔実施例1〕
本実施例では、本発明において最も重要な概念であるモノドメイン領域の形成過程を説明する。図1(A)〜図1(F)は絶縁表面を有する基体上に形成された珪素膜の断面図である。
【0041】
図1(A)において101はガラス基板である。他にも、石英基板やシリコン基板などを用いても良い。102はスパッタ法により成膜された酸化珪素膜である。この時、スパッタに用いるターゲットは人工石英ターゲットを用いる。
【0042】
人工石英ターゲットを用いて成膜した酸化珪素膜102は表面が極めて平坦であり、滑らかな状態となる。例えば、その表面凹凸の高さは30Å以内、表面凹凸の幅は100Å以上であり、AFM(Atomic Force Microscopy )による観察を行っても凹凸として認識するには困難なレベルとなる。
【0043】
酸化珪素膜102を成膜したらパターニングを施して凹または凸パターン103を意図的に形成する。本実施例では、正方形の微細な島状パターンを形成し、意図的に凸部となるようにパターニングした場合についてのみを記載するが、凹部となるように形成しても同様の効果が得られる。この凹または凸パターン103は後に成膜する非晶質珪素膜の膜厚の半分程度の高さでよい。
【0044】
所望の形状にパターニングを施したら非晶質珪素膜104をプラズマCVD法、スパッタ法または減圧熱CVD法により100 〜750 Å(好ましくは150 〜450 Å)の厚さに成膜する。減圧熱CVD法による場合、成膜ガスとしてはジシラン(Si2 H6 )やトリシラン(Si3 H8 )等を用いれば良い。
【0045】
非晶質珪素膜104の膜厚を上記膜厚としておくことで後のレーザー光照射による単結晶化工程が効果的に行われるだけでなく、結晶化により得られる結晶性珪素膜を半導体装置の活性層とした場合に、オフ電流の低い半導体装置を作製することができる。
【0046】
なお、減圧熱CVD法により成膜した非晶質珪素膜は後の結晶化の際に自然核発生率が小さい。自然核発生率とは、非晶質珪素膜がニッケル等の結晶化を助長する金属元素の影響を受けずに熱エネルギーにより核発生する割合である。
【0047】
この事は個々の結晶が相互干渉する(ぶつかり合って成長が止まる)割合が減るため、後の結晶化工程において個々の結晶粒径を大きくする上で望ましい。
【0048】
また、非晶質珪素膜104を成膜する際にはバッファ層である酸化珪素膜102の表面の清浄度に注意が必要である。従来例で述べたようにゴミなどがあると、そこが結晶化を助長する金属元素の偏析サイトとなって核発生の起点となってしまう。
【0049】
非晶質珪素膜104を成膜したら、酸素雰囲気中においてUV光を照射し、非晶質珪素膜104の表面にごく薄い酸化膜(図示せず)を形成する。この酸化膜は、後に金属元素を導入する際の溶液塗布工程で溶液の濡れ性を改善するためのものである。
【0050】
次に、所定の濃度で結晶化を助長する金属元素を含有した溶液を非晶質珪素膜104の表面に滴下して図示しない水膜を形成する。この金属元素としては、Fe、Co、Ni、Ru、Rh、Pd、Os、Ir、Pt、Cu、Auから選ばれた一種または複数種類のものを用いることができるが、発明者らの研究によるとNi(ニッケル)が最も顕著な効果を現した。
【0051】
なお、後の加熱工程における不純物の残留を考慮すると、上記溶液としては硝酸ニッケル塩溶液を用いるのが好ましい。酢酸ニッケル塩溶液を用いることも出来るが、酢酸ニッケル塩溶液は炭素を含んでおり、これが後の加熱工程において炭化して膜中に残留することが懸念されるからである。
【0052】
図1(A)の状態において、スピナーを用いてスピンコートを行い、非晶質珪素膜104上において、図示しない酸化膜を介してニッケル層105が接して保持された状態とする。
【0053】
この時、凹または凸パターン103の上方の非晶質珪素膜104はその凹または凸パターン103の形状に沿って凹または凸部106が形成されている。そのため、スピンコートの際に凹または凸部106の周辺は表面張力により局部的にニッケルが高濃度に存在する領域となりやすく、後の結晶化の際に第4のステップによる結晶化(基体に対して概略平行な方向への結晶化)が容易に進むという効果もある。
【0054】
なお、本実施例では非晶質珪素膜104上に上記溶液塗布工程を行ったが、非晶質珪素膜104の成膜前にバッファ層である酸化珪素膜102上に行っても同様の効果が得られる。また、酸化珪素膜102と非晶質珪素膜104の両表面に対して溶液塗布を行っても構わない。
【0055】
図1(A)の状態を得たら、不活性雰囲気中において450℃、1時間程度の水素出しを行った後、500〜700℃、代表的には550〜600℃の温度で4〜8時間の加熱処理を加えて非晶質珪素膜104の結晶化を行う。ただし、ガラス基板上に形成する場合はガラスの耐熱性を考慮して650℃以下とするのが望ましい。この結晶化は以下ようにして進行する。
【0056】
まず第1のステップとして、ニッケルは加熱されることにより活性化して非晶質珪素膜104の内部を矢印が示す様に等方的に拡散する。(図1(B))
【0057】
次に、第2のステップとして、ニッケルは酸化珪素膜102と非晶質珪素膜104との界面においてマイグレーションして凹または凸パターン103へと偏析する。即ち、凹または凸パターン103が意図的に形成された偏析サイトとして機能することになる。(図1(C))
【0058】
次に、偏析サイトとなった凹または凸パターン103のニッケル濃度が約1×1020atoms/cm3 以上となると、そこに結晶核が発生し、珪素膜面に対して概略垂直な方向に結晶化が進行する。この第3のステップで形成される縦成長領域107は高濃度にニッケルを含む領域となる。(図1(D))
【0059】
そして、第4のステップとして、上記縦成長領域107を起点として珪素膜面に対して概略平行な方向の結晶成長が進行する。こうして形成される横成長領域108は柱状または針状結晶が比較的方向を揃えた状態で複数集合して形成されており、縦成長領域107よりも結晶性の面では優れている。
【0060】
この時、偏析サイトを意図的に制御して形成してあるため、他の結晶粒の影響を受けずに結晶粒径を拡大成長させることが可能である。即ち、偏析サイトの形成位置を適当に設計すれば、所望の位置に所望の大きさの結晶を形成することが可能となる。
【0061】
ただし、結晶粒径をどこまで大きくできるかは加熱処理の温度と時間とで決まるので、製造コスト等との兼ね合いで適宜決定すれば良い。また、後の単結晶化工程においても結晶成長が進行しうることを考慮しなければならない。
【0062】
以上の様にして、図1(F)に示すような結晶性珪素膜109が得られる。ここで、留意すべきなのは本発明が根本的に公知のグラフォエピタキシー技術とは異なる点である。
【0063】
グラフォエピタキシー技術は下地膜の表面形状に規則性を持たせ、非晶質珪素膜を結晶化する際、そこの最も安定な面が出る性質を利用して結晶性珪素膜の配向性を揃えるものである。
【0064】
本発明は、下地膜の表面形状を変えることでその表面エネルギーを変化させ、結晶化を助長する金属元素が偏析しやすい領域とすることに特徴がある。従って、表面形状を変える理由が結晶核の形成にある点でグラフォエピタキシー技術とは異なる技術である。
【0065】
ここで、結晶性珪素膜109を上面から見た図を図2(A)に示す。図2(A)において、201は第3のステップで形成された縦成長領域(図1(D)において107で示される領域)である。本実施例では、正方形の微細な島状パターンを形成しているため、図のような形状となる。
【0066】
また、202で示されるのは第4のステップで形成された横成長領域(図1(F)において109で示される領域)である。この横成長領域202は中央の縦成長領域201を核として成長するものであり、本実施例では縦成長領域201を点として捉えることができるため、図2(A)に示すような概略六角形の形状となる。
【0067】
この理由として本発明者らは次のように考える。珪素膜の結晶形態に関して、一般的に(111)面で囲まれた核を結晶成長させると結晶粒の形状が六角形となることが知られている。
【0068】
また、本実施例では結晶化を助長する金属元素としてニッケルを用いているが、結晶化の際にニッケルシリサイドが柱状または針状結晶の先端部や側面部に形成されていることが本発明者らによって示されている。
【0069】
このニッケルシリサイドの安定面は(111)面であることが知られており、それを考慮すると結晶核となる縦成長領域301を囲む面はニッケルシリサイドの安定面である(111)面が支配的であると考えられる。
【0070】
従って、第4のステップで結晶核となる縦成長領域201を点として捉えると、そこを起点として結晶成長した横成長領域202が概略六角形となるのは自明の理であると言える。
【0071】
以上にようにして形成された横成長領域202は図2(A)に示す様にA〜Fの6つの部分に分割される。この時、A〜Fはそれぞれが一つの結晶粒であるかのように見える。これは、A〜Fが互いにぶつかり合う領域にスリップ等の欠陥が発生し、結晶粒界となるからである。
【0072】
このA〜Fの領域内の一部分を拡大した簡略図を図2(B)に示す。図2(B)に示す様に、微視的に見るとA〜Fの領域内は柱状または針状の結晶が複数集合して形成されており、これが密集しているため巨視的には図2(A)の様に一つの結晶粒のように見えるのである。
【0073】
この柱状または針状の結晶は各々その内部に結晶粒界を含まない実質的に単結晶と見なせるモノドメインである。
【0074】
また、個々の結晶はその内部からニッケル等の不純物元素を排除しつつ成長するため、結晶表面には金属シリサイドが形成されており、図2(B)の203で示される様な結晶粒界には金属元素、即ちニッケルが偏析している。
【0075】
従って、図2(B)の状態ではモノドメインが複数集合しただけであり、結晶性は比較的良いものの、A〜Fの領域のそれぞれが一つのモノドメイン領域となっているわけではない。
【0076】
本発明を実現するにはこの横成長領域202の結晶性を改善する工程が必要となる。本明細書ではこの工程を特に単結晶化工程と呼ぶこととする。
【0077】
本発明における単結晶化工程とは、具体的には得られた結晶性珪素膜に対してレーザー光またはそれと同等のエネルギーを持つ強光を照射するものである。
【0078】
まず使用するレーザー光としては紫外領域のエキシマレーザーを使用することが望ましい。具体的には、KrFエキシマレーザー(波長248nm)やXeClエキシマレーザー(波長308nm)等を用いることができる。また、レーザー光ではなく、紫外線ランプを用いた強光を照射しても同様の効果を得ることが可能である。
【0079】
レーザー光を照射された結晶性珪素膜の被照射面は局部的に高温に加熱され、珪素膜は瞬間的な溶融状態となる。しかし、実際には図2(B)に示す様な柱状または針状結晶の粒界部分203に偏析する金属シリサイドが優先的に溶融し、柱状または針状結晶は容易には溶融しない。
【0080】
即ち、図2(B)に示すような構成でなる横成長領域にレーザー光を照射すると、結晶粒界203が瞬間的ではあるが優先的に溶融して再結晶化する。なお、図2(C)において204で示される破線は、図2(B)における結晶粒界203が一時的に解離してその後再結合した接合界面である。
【0081】
その時、結晶粒界203近傍のシリコン格子は再配列してシリコン同士が整合性良く再結合する。従って、図2(B)で示すように柱状または針状結晶が複数集合して形成されていたA〜Fで示される個々の領域内は、図2(C)に示すような実質的に結晶粒界が存在しない。
【0082】
また、さらに針状または柱状結晶の内部に内在していた転位や積層欠陥といった結晶欠陥はほぼ消滅してしまうので元々柱状または針状結晶であった部分の結晶性も著しく改善されたものとなる。
【0083】
この時、A〜Fで示される個々の領域はシリコン格子の再配列により体積膨張が生じる。その結果、図2(A)においてA〜Fの領域がぶつかり合う結晶粒界(即ち、モノドメイン領域の外縁部)では珪素膜の隆起が観測される。この珪素膜の隆起は、上記レーザー照射処理を行う場合に見られる特徴の一つである。
【0084】
このような結晶粒界に見られる珪素膜の隆起が発生するような時、結晶粒内の結晶性は良好なものとなっていることが経験的に判っているが、その理由は現状において定かではない。
【0085】
また、この珪素膜の隆起は、例えば非晶質珪素膜の膜厚が500Åの場合、その高さが500Å程度となることがSEM観察などから判っている。
【0086】
以上の過程を経て形成される結晶性珪素膜は著しく結晶性が改善されており、単結晶に匹敵する結晶性を有したモノドメイン領域となっている。
【0087】
本発明の構成の一つは上記のようなモノドメイン領域のみを利用して薄膜トランジスタに代表される半導体装置の活性層を構成するものである。
【0088】
図7に示すのは、アクティブマトリクス型液晶表示装置を作製するにあたって絶縁表面を有する基体21上にマトリクス状に配置された活性層である。
【0089】
なお、22の破線で示される領域が縦成長領域の存在した場所である。また、23は横成長領域が互いにぶつかり合って形成された結晶粒界が存在した場所である。活性層を形成した後では確認できないため点線で示すことにする。
【0090】
図7に示す様に、薄膜トランジスタの活性層24は縦成長領域および結晶粒界を含まないようにマトリクス状に形成される。
【0091】
図7は局部的に見た図であるが、基体21上に形成される全ての活性層について同様のことが言える。即ち、結晶粒界を含まないモノドメイン領域のみを利用して数百万もの薄膜トランジスタの活性層を構成するのである。
【0092】
〔実施例2〕
本実施例では、実施例1のレーザー光の照射を同等のエネルギーを持つ強光でもって行う場合の例である。この技術としてはRTA(ラピッド・サーマル・アニール)が公知である。
【0093】
RTAとは、被処理体に対して赤外光や紫外光等の強光をランプ等により照射する方法である。この特徴として、昇温速度および降温速度が速く、処理時間が数秒〜数十秒と短いため、実質的に最表面の薄膜のみを加熱できることである。即ち、例えばガラス基板上の薄膜のみを1000℃程度の極めて高温でアニールすることが可能である。
【0094】
また、処理時間が短いことは製造工程においてスループットを大幅に向上させることを意味しており、生産性の面からも非常に有効な手段であると言える。
【0095】
〔実施例3〕
本実施例は、実施例1に示す工程で得られたモノドメイン領域を用いて薄膜トランジスタの活性層を構成する例を示す。なお、本実施例ではトップゲイト型を例にするがボトムゲイト型に適用することも容易である。
【0096】
まず、図4(A)に示す様に、実施例1に示した工程に従ってモノドメイン領域を含む半導体薄膜を形成し、パターニングによってモノドメイン領域のみで構成される活性層403を形成する。なお、401は実施例1で説明したようにガラス基板であり、402は酸化珪素膜である。
【0097】
次に、ゲイト絶縁膜として機能する酸化珪素膜404を1500Åの厚さにプラズマCVD法で成膜する。酸化窒化珪素膜や窒化珪素膜であっても構わない。
【0098】
次にゲイト電極を構成するためのアルミニウム膜405を5000Åの厚さにスパッタ法でもって成膜する。このアルミニウム膜中には、スカンジウムを0.2重量%含有させる。なお、アルミニウム以外にタンタル、モリブデン等の他の金属を用いても良い。こうして図4(A)に示す状態を得る。
【0099】
アルミニウム膜405を成膜したら、その表面に図示しない極薄い陽極酸化膜を形成する。この陽極酸化膜は、3%の酒石酸を含んだエチレングリコール溶液をアンモニア水で中和したものを電解溶液として行う。即ち、この電解溶液中において、アルミニウム膜405を陽極、白金を陰極として陽極酸化を行う。
【0100】
この工程で形成される陽極酸化膜は緻密な膜質を有し、後に形成されるレジストマスクとの密着性を向上させるために機能する。なお、この図示しない陽極酸化膜の膜厚は100Å程度とする。また膜厚は印加電圧で制御できる。
【0101】
次にアルミニウム膜405をパターニングし、ゲイト電極の基となる島状のアルミニウム膜のパターン406を形成する。なおこの際利用したレジストマスク(図示せず)はそのまま残存させておく。(図4(B))
【0102】
図4(B)に示す状態を得たら、再びアルミニウム膜のパターン406を陽極とした陽極酸化を行う。ここでは、電解溶液として3%のシュウ酸水溶液を用いる。この陽極酸化工程においては、図示しないレジストマスクが存在するために陽極酸化がアルミニウムのパターン406の側面のみにおいて進行する。従って、図4(C)の407で示されるように陽極酸化膜が形成される。
【0103】
またこの工程で形成される陽極酸化膜407は、多孔質状を有しており、その成長距離も数μmまで行わせることができる。
【0104】
上記の多孔質状の陽極酸化膜407の膜厚は7000Åとする。またこの陽極酸化膜407の膜厚は陽極酸化時間によって制御することができる。
【0105】
図4(C)に示す多孔質状の陽極酸化膜407を形成したら、図示しないレジストマスクを取り除く。そして、再度の陽極酸化を行うことにより、緻密な陽極酸化膜408を形成する。この陽極酸化工程は、前述の緻密な陽極酸化膜を形成したのと同じ条件で行う。
【0106】
ただし、形成する膜厚を800Åとする。この工程においては、多孔質状の陽極酸化膜407の内部に電解溶液が進入するために図4(C)に示すように陽極酸化膜408が形成される。
【0107】
この陽極酸化膜の膜厚を1500Å以上というように厚くすると、後の不純物イオンの注入工程において、オフセットゲイト領域を形成することができる。
【0108】
この緻密な陽極酸化膜408は、後の工程においてゲイト電極409の表面にヒロックが発生することを抑制するために機能する。
【0109】
緻密な陽極酸化膜408まで形成したら、この状態においてソース/ドレイン領域を形成するための不純物イオンの注入を行う。ここではNチャネル型の薄膜トランジスタを作製するためにPイオンの注入を行う。
【0110】
この工程において、高濃度に不純物が添加されたソース領域410とドレイン領域411が形成される。(図4(C))
【0111】
次に、酢酸とリン酸と硝酸とを混合した混酸を用いて、多孔質状の陽極酸化膜407を選択的に除去した後に再度Pイオンのイオン注入を行なう。このイオン注入は、先のソース/ドレイン領域を形成する際よりも低ドーズ量でもって行なわれる。
【0112】
すると、ソース領域410、ドレイン領域411と比較して不純物濃度の低い、低濃度不純物領域412、413が形成される。そして414の領域が自己整合的にチャネル形成領域として形成される。(図4(D))
【0113】
上記の不純物イオンの注入工程の後、レーザー光または赤外光または紫外光の照射を行うことによって、イオンの注入が行われた領域のアニールを行う。
【0114】
このようにして、ソース領域410、低濃度不純物領域412、チャネル形成領域414、低濃度不純物領域413、ドレイン領域411を形成する。ここで、低濃度不純物領域413が通常LDD(ライトドープドレイン領域)と称される領域である。
【0115】
ここでプラズマ水素化処理を300〜350℃の温度範囲で0.5〜1時間行うと効果的である。この工程により活性層303中には5原子%以下(1×1021atoms/cm3 以下)、1×1015〜1×1021atoms/cm3 以下の水素が添加される。
【0116】
この水素は活性であるため活性層403中の珪素の不対結合手または活性層/ゲイト絶縁膜界面の準位を中和して除去することができる。
【0117】
こうして図4(D)に示す状態が得られたら、次に層間絶縁膜415成膜する。層間絶縁膜415は、酸化珪素膜、または窒化珪素膜、または酸化窒化珪素膜、または樹脂膜、またはそれらの膜の積層膜でもって構成される。窒化珪素膜を用いると、前工程で添加した水素がデバイス外部へ再放出するのを防ぐことが出来るので好ましい。
【0118】
そしてコンタクトホールの形成を行い、ソース電極416とドレイン電極417とを形成する。アクティブマトリクス型液晶表示装置において画素TFTを作製する場合、ゲイト電極409からの取り出し電極は必要ないが、周辺駆動回路に用いる回路TFTの場合、ゲイト電極409からの取り出し電極も同時に形成する必要がある。
【0119】
さらに350℃の水素雰囲気中において加熱処理を行うことにより、素子全体の水素化を行い、図4(E)に示す薄膜トランジスタを完成させる。
【0120】
このようにして形成された薄膜トランジスタは、活性層がモノドメイン領域で構成されているため、高速動作にも対応できる良好な電界効果移動度を示す。また、チャネル領域やドレイン接合部に結晶粒界およびニッケル化合物等の偏析がないため、信頼性に優れた薄膜トランジスタを作製することが出来る。
【0121】
〔実施例4〕
シリコン基板上に酸化珪素膜を成膜してその上に単結晶を形成する構造、いわゆるSOI構造が近年注目されている。SOI構造に関する研究は低消費電力化のブレイクスルーとしてその発達が目覚ましい。
【0122】
本発明によるモノドメイン領域は実質的に単結晶に匹敵する結晶性を有するものであるから、SOI技術に応用することは容易である。本実施例では、SOI基板に残された問題と本発明とを対比させる。
【0123】
SOI技術に伴う問題点を図5にまとめる。図5に示すように珪素膜中の界面準位や固定電荷のような結晶性に関するものや、金属汚染やボロン濃度といった外的なものなどがある。
【0124】
本発明では、結晶性珪素膜に対してレーザー光またはそれと同等のエネルギーを持つ強光を照射することにより、結晶性の改善と結晶同士の再結合(単結晶化)を行う。
【0125】
このレーザーアニールによる効果としては、パイプ密度、界面準位、固定電荷、貫通転移など結晶性に悪影響を与える因子を除去または充分減少できる。
【0126】
さらに、図5中の析出物はシリサイド系物質であればレーザー光を照射した際に容易に溶融して消失してしまう。また、酸化物系物質であればレーザー光の照射による局部的な温度上昇により酸素が再び脱離、拡散して酸化物が消滅することも期待できる。
【0127】
〔実施例5〕
本実施例では、実施例1においてバッファ層となる酸化珪素膜に形成する凹または凸パターンの形状を変えた例を示す。
【0128】
実施例1では正方形の微細な島状パターンを形成したが、本実施例では直方形溝状パターンを形成する。なお、本実施例は凹部となるように形成する例であるが、凸部となるように形成しても同様の効果が得られる。
【0129】
非晶質珪素膜の結晶化工程は実施例1に示す通りであるので、ここでの説明は省略する。ここでは、結晶化した際の結晶粒の形状を図6に示す。
【0130】
図6に示す様に、601で示される縦成長領域を結晶核として横成長領域602が形成される。実施例1と異なるのは、結晶核が点としてではなく、線として捉えられることである。
【0131】
そのため、結晶粒の形状は図6に示す様に概略細長い六角形となる。この横成長領域602はA〜Hの8つの領域に分割される。ただし、縦成長領域601は横幅Xに比べて長さYが十分長いので、実際に石英基板上に形成するとA〜C、F〜Hの領域はD、Eの領域と比べて無視できるほど小さいものとなる。
【0132】
凹または凸パターンをこのような形状とする利点は、D、Eの領域をモノドメイン領域とすると実施例1よりも大きなモノドメイン領域を得られることである。即ち、その領域のみを用いて薄膜トランジスタの活性層を構成すれば、同一の結晶性を有した活性層を一つのモノドメイン領域内において複数形成することが可能である。
【0133】
〔実施例6〕
本実施例は実施例3で示したTFTでもってCMOS構造を形成する例である。図8〜図10に本実施例の作製工程を示す。なお、本発明により形成される結晶性珪素膜の応用範囲は広く、CMOS構造を形成する方法は本実施例に限ったものではない。
【0134】
まず実施例1に示す構成に従って、ガラス基板31上に酸化珪素膜32を成膜し、その上にモノドメイン領域を有した結晶性珪素膜を得る。そしてそれをパターニングすることによりモノドメイン領域のみで構成されたNチャネル型TFTの活性層33とPチャネル型TFTの活性層34を得る。
【0135】
活性層33、34を形成したら、ゲイト絶縁膜として機能する酸化珪素膜35をプラズマCVD法で成膜する。厚さは500〜2000Å、代表的には1000〜1500Åとする。また、ゲイト絶縁膜としては酸化窒化珪素膜、窒化珪素膜等の他の絶縁膜を用いてもよい。
【0136】
こうして図8(A)に示す状態を得る。ここでは説明を簡単にするために一組のNチャネル型の薄膜トランジスタとPチャネル型の薄膜トランジスタとを形成する例を示す。一般的には同一ガラス基板上に数百以上の単位でNチャネル型の薄膜トランジスタとPチャネル型の薄膜トランジスタとが形成される。
【0137】
図8(A)に示す状態を得たら、図8(B)に示すように後にゲイト電極を構成することになるアルミニウム膜36を成膜する。
【0138】
このアルミニウム膜はヒロックやウィスカーの発生を抑制するためにスカンジウムを0.2 wt重量%含有させる。アルミニウム膜の成膜方法はスパッタ法や電子ビーム蒸着法を用いて行う。
【0139】
ヒロックやウィスカーというのは、アルミニウムの異常成長に起因する刺状あるいは針状の突起物のことである。ヒロックやウィスカーの存在は、隣合う配線間や上限間に離間した配線間においてショートやクロスクトークが発生する原因となる。
【0140】
アルミニウム膜以外の材料としてはタンタル等の陽極酸化可能な金属を利用することができる。
【0141】
アルミニウム膜36を成膜したら、電解溶液中においてアルミニウム膜36を陽極とした陽極酸化を行い、薄く緻密な陽極酸化膜37を成膜する。
【0142】
ここでは、3%の酒石酸を含んだエチレングルコール溶液をアンモニアで中和したものを電解溶液として用いる。この陽極酸化方法を用いると緻密な膜質を有した陽極酸化膜を得ることができる。またその膜厚は印加電圧によって制御することができる。
【0143】
ここでは陽極酸化膜37の厚さを100Å程度とする。この陽極酸化膜37は、後に形成されるレジストマスクとの密着性を向上させる役割を有している。このようにして図8(B)に示す状態を得る。
【0144】
次にレジストマスク38と39を形成する。そしてこのレジストマスク38と39を利用してアルミニウム膜36とその表面の陽極酸化膜37をパターニングする。このようにして図8(C)に示す状態を得る。
【0145】
次に3%のシュウ酸水溶液を電解溶液として、この溶液中で残存したアルミニウム膜でなるパターン40と41を陽極とした陽極酸化を行う。
【0146】
この陽極酸化工程においては、陽極酸化が残存したアルミニウム膜40と41の側面において選択的に進行する。これは、アルミニウム膜40と41の上面に緻密な陽極酸化膜とレジストマスク38と39が残存しているからである。
【0147】
またこの陽極酸化においては、多孔質状(ポーラス状)の膜質を有した陽極酸化膜42、43が形成される。またこの多孔質状の陽極酸化膜42、43は数μm程度まで成長させることができる。
【0148】
本実施例では、この陽極酸化の進行距離、即ち膜厚は7000Åとする。この陽極酸化の進行距離によって、後に低濃度不純物領域の長さが決まる。経験的にこの多孔質状の陽極酸化膜の成長距離は6000Å〜8000Åとすることが望ましい。こうして図8(D)に示す状態を得る。
【0149】
この状態においてゲイト電極1と2が画定する。図8(D)に示す状態を得たら、レジストマスク38と39を取り除く。
【0150】
次に再び3%の酒石酸を含んだエチレングルコール溶液をアンモニアで中和したものを電解溶液として用いた陽極酸化を行う。この工程においては、電解溶液が多孔質状の陽極酸化膜42と43の中に侵入する。この結果、図8(E)の44と45で示される緻密な陽極酸化膜が形成される。
【0151】
この緻密な陽極酸化膜44と45の厚さは500〜4000Åとする。この膜厚の制御は電圧印加時間で行なう。なお、先に形成した緻密な陽極酸化膜37の残存部分はこの陽極酸化膜44と45と一体化してしまう。
【0152】
次に、図8(E)に示す状態においてN型を付与する不純物としてP(リン)イオンを全面にドーピングする。
【0153】
このドーピングは、0.2 〜5×1015/cm2 、好ましくは1〜2×1015/cm2 という高いドーズ量で行う。ドーピング方法としてはプラズマドーピング法やイオンドーピング法を用いる。
【0154】
この図8(E)に示す工程の結果、高濃度にPイオンが注入された領域46、47、48、49が形成される。
【0155】
次にアルミ混酸を用いて多孔質状の陽極酸化膜42と43を除去する。この時、陽極酸化膜42、43の直下に位置した活性層領域は、イオン注入されていないため実質的に真性である。
【0156】
次に、右側のPチャネル型の薄膜トランジスタを構成する素子を覆うようにしてレジストマスク50を形成する。こうして図9(A)に示す状態を得る。
【0157】
図9(A)に示す状態を得たら、図9(B)に示すように再びPイオンの注入を行う。このPイオンの注入は、ドーズ量を0.1 〜5×1014/cm2 、好ましくは0.3 〜1×1014/cm2 という低い値とする。
【0158】
即ち、図9(B)で示す工程で行われるPイオンの注入はそのドーズ量を図8(E)に示す工程において行われたドーズ量に比較して低いものとする。
【0159】
この工程の結果、52と54の領域がライトドープされた低濃度不純物領域となる。また、51と55の領域は、より高濃度にPイオンが注入された高濃度不純物領域となる。
【0160】
この工程において、51の領域がNチャネル型の薄膜トランジスタのソース領域となる。そして52と54が低濃度不純物領域、55がドレイン領域となる。また、53で示される領域は実質的に真性なチャネル形成領域となる。なお、54で示される領域が一般にLDD(ライトドープドレイン)領域と称される領域である。
【0161】
また、特に図示しないが陽極酸化膜44でイオン注入を遮られた領域がチャネル形成領域53と低濃度不純物領域52、54との間に存在する。この領域はオフセットゲイト領域と呼ばれ、陽極酸化膜44の膜厚分の距離を有する。
【0162】
オフセットゲイト領域はイオン注入されず実質的に真性であるが、ゲイト電圧が印加されないためチャネルを形成せず、電界強度を緩和し、劣化を抑制する抵抗成分として機能する。
【0163】
ただし、その距離(オフセットゲイト幅)が短い場合、実効的なオフセットゲイト領域として機能しない。また、どれだけの距離があれば有効に機能するかの明確な境界はない。
【0164】
次に、レジストマスク50を除去して、図9(C)に示すように左側のNチャネル型の薄膜トランジスタを覆うレジストマスク56を形成する。
【0165】
次に、図9(C)に示す状態においてP型を付与する不純物としてB(ボロン)イオンの注入を行う。ここでは、Bイオンのドーズ量を0.2 〜10×1015/cm2 、好ましくは1〜2×1015/cm2 程度とする。このドーズ量は図12(E)に示す工程におけるドーズ量と同程度とすることができる。
【0166】
この工程により形成される57と61で示される領域は、N型およびP型を付与する不純物を含むが、実質的に取り出し電極とのコンタクトをとる為のパッド(以下、コンタクトパッドと呼ぶ)としての機能しか持たない。即ち、左側のNチャネル型の薄膜トランジスタと異なり、57、61の領域をソース/ドレイン領域と明確に区別する。
【0167】
本発明者らはPチャネル型の薄膜トランジスタに関して、ソース領域を58で示される領域、ドレイン領域を60で示される領域として定義している。
【0168】
これらの領域58、60は実質的に真性であった領域にBイオンのみを注入して形成されている。そのため、他のイオンが混在しないので不純物濃度の制御が容易なものとなり、整合性の良いPI接合を実現できる。また、イオン注入による結晶性の乱れも比較的小さなもので済む。
【0169】
また、陽極酸化膜45を利用してオフセットゲイト領域を形成することもできるが、経験的にはPチャネル型の薄膜トランジスタは殆ど劣化しないため、オフセットゲイト領域を特に設ける必要はない。
【0170】
こうしてPチャネル型の薄膜トランジスタのソース領域58とドレイン領域60が形成される。また59の領域は特に不純物が注入されずにチャネル形成領域となる。そして、前述のように57、61はそれぞれソース領域58、ドレイン領域60から電流を取り出すためのコンタクトパッドとなる。
【0171】
次に、図9(C)に示す工程の終了後、レジストマスク56を取り除き、図9(D)に示す状態を得る。この状態で注入された不純物の活性化と不純物イオンが注入された領域のアニールを行うためにレーザー光の照射を行う。
【0172】
この時、Nチャネル型の薄膜トランジスタのソース/ドレイン領域である51と55の組で示される領域と、Pチャネル型の薄膜トランジスタのソース/ドレイン領域である58と60の組で示される領域との結晶性の違いがそれ程大きくない状態でレーザー光の照射を行うことができる。
【0173】
上記結晶性の違いがそれ程大きくないのは、図9(C)に示す工程においてPチャネル型の薄膜トランジスタのソース/ドレイン領域58、60がイオン注入の際に大きな損傷を受けていないからである。
【0174】
従って、図9(D)に示す状態においてレーザー光の照射を行い、2つの薄膜トランジスタのソース/ドレイン領域のアニールを行う場合、そのアニール効果違いを是正することができる。即ち、得られるNおよびPチャネル型の薄膜トランジスタの特性の違いを是正することができる。
【0175】
図9(D)に示す状態を得たら、図10(A)に示すように層間絶縁膜62を4000Åの厚さに成膜する。層間絶縁膜62は酸化珪素膜、酸化窒化珪素膜、窒化珪素膜のいずれでも良く、多層構造としても良い。これら珪化膜の成膜方法は、プラズマCVD法や熱CVD法を用いればよい。
【0176】
次にコンタクトホールの形成を行い、Nチャネル型の薄膜トランジスタ(NTFT)のソース電極63とドレイン電極64を形成する。同時にPチャネル型の薄膜トランジスタ(PTFT)のソース電極65とドレイン電極66を形成する。(図10(B))
【0177】
ここでNチャネル型の薄膜トランジスタのドレイン電極64とPチャネル型の薄膜トランジスタのドレイン電極66とを接続するようにパターニングを行い、さらに2つのTFTのゲイト電極同士を接続すればCMOS構造を構成することが出来る。
【0178】
例えば、本実施例に示すようなCMOS型の薄膜回路は、アクティブマトリクス型の液晶表示装置やアクティブマトリクス型のEL表示装置に利用することができる。
【0179】
なお、図8(E)、図9(B)、図9(C)に示す不純物イオンの注入工程において、活性層がゲイト絶縁膜を構成する酸化珪素膜35で覆われていることは重要である。
【0180】
このような状態で不純物イオンの注入を行うと、活性層表面の荒れや汚染を抑制することができる。このことは、歩留りや得られる装置の信頼性を高めることに大きな寄与を果たす。
【0181】
〔実施例7〕
本実施例では、実施例1で示す結晶性珪素膜をシリコンウェハー上に形成する例を示す。この場合、シリコンウェハー表面に絶縁層を設ける必要があるが、通常熱酸化膜を利用することが多い。
【0182】
熱処理の温度範囲は700〜1300℃が一般的であり、所望の酸化膜厚によって処理時間は変化する。
【0183】
また、シリコンウェハーの熱酸化は通常O2 、O2-H2 O、H2 O、O2-H2 燃焼などの雰囲気で行なわれる。また、HClやCl2 などのハロゲン元素を添加した雰囲気での酸化も広く実用化されている。
【0184】
シリコンウェハーはICなどの半導体デバイスに欠かせない基体の一つであり、ウェハー上に様々な半導体素子を形成する技術が生み出されている。
【0185】
本実施例によれば、単結晶に匹敵する結晶性を備えた結晶性珪素膜を従来のシリコンウェハーを用いた技術に組み合わせ、結晶性珪素膜の応用範囲をさらに拡大することができる。
【0186】
〔実施例8〕
本実施例は実施例7の一例としてシリコンウェハー上に形成されたICの上に、本発明による結晶性珪素膜を用いたTFTを形成する例を示す。製造プロセスの概要を図11を用いて説明する。
【0187】
図11(A)に示すのは通常のプロセスによりシリコンウェハー上に形成されたMOS−FETである。71で示されるのはシリコン基板、72、73は素子同士を分離するための絶縁膜であり、一般的には熱酸化膜が用いられる。
【0188】
また、74はソース領域、75はドレイン領域であり、シリコン基板71に一導電性を付与する不純物イオンを注入した後、拡散工程を経て形成される。シリコン基板71がP型ならN型を付与する不純物(リン)を、シリコン基板71がN型ならP型を付与する不純物(ボロン)を注入する。
【0189】
また、76で示される領域はチャネル形成領域である。この領域のシリコン表面にはイオン注入後の拡散工程で形成される熱酸化膜の一部が膜厚制御を行なって残され、ゲイト絶縁膜として機能する。77は一導電型を有する多結晶珪素膜でなるゲイト電極である。
【0190】
ゲイト電極77は酸化珪素膜等の絶縁膜78で覆われ、ソース電極79やドレイン電極80と電気的に短絡しない構成となっている。(図11(A))
【0191】
図11(A)の状態が得られたら、層間絶縁膜81を成膜する。この層間絶縁膜としては酸化珪素膜、窒化珪素膜等が用いられる。層間絶縁膜81を成膜したら、コンタクトホールを形成してドレイン電極からの取り出し配線82を形成する。(図11(B))
【0192】
図11(B)の状態を得たら、CMP(ケミカル・メカニカル・ポリッシング)技術などにより研磨を施し、露出表面の平坦化を行なう。この工程により、層間絶縁膜81は平坦化され、取り出し配線82の凸部は無くなる。
【0193】
図11(C)において83は平坦化された層間絶縁膜、84はその平坦面である。また、85は凸部の無くなった取り出し配線であり、それと接続して取り出し配線86が形成される。
【0194】
次に、層間絶縁膜87を成膜する。この層間絶縁膜87の上に本発明を適用することができる。即ち、層間絶縁膜87上にモノドメイン領域を用いて形成した活性層を有する薄膜トランジスタを形成する。
【0195】
まず、実施例1に従ってモノドメイン領域でなる活性層88を形成する。そして、ゲイト絶縁膜89を成膜し、次にゲイト電極90を形成する。そして、一導電型を付与する不純物を活性層に注入する。
【0196】
不純物注入が終了したら後に低濃度不純物領域を形成するためのサイドウォール91を形成する。サイドウォール91の形成方法は次の工程に従う。
【0197】
まず、ゲイト電極90を覆って酸化珪素膜等でなる絶縁膜(図示せず)をゲイト電極90の膜厚以上に形成する。次に、ドライエッチング法による異方性エッチングを行い、成膜した絶縁膜を除去すると、ゲイト電極90の側面のみに絶縁膜が残存する。これがサイドウォール91となる。
【0198】
この状態で再度不純物注入を行う。すると、2度目に不純物を注入された領域はソース領域およびドレイン領域となり、サイドウォールで遮蔽された領域はソース領域およびドレイン領域と比較して低濃度の不純物領域となる。不純物注入後は加熱処理やレーザー光の照射等により不純物の活性化を行う。
【0199】
以上の様にして、活性層を構成したら層間絶縁膜92として酸化珪素膜または窒化珪素膜を成膜し、コンタクトホールを形成してソース電極93およびドレイン電極94を形成する。
【0200】
以上、本実施例で示す様にIC上に本発明を応用することで、図11(D)のような三次元構造でなる集積回路を構成することが可能である。本発明によれば、ICの上方に形成されるTFTは単結晶上に形成したTFTに匹敵する性能を有するため、IC本来の性能を損なわず、従来以上の高密度集積化回路を実現することができる。
〔実施例9〕
本実施例では、本発明を応用して作製したTFTをDRAM(Dynamic Rondom Access Memory)に応用した例について説明する。説明には図12を用いることとする。
【0201】
DRAMは記憶する情報を電荷としてコンデンサに蓄える形式のメモリである。コンデンサへの情報としての電荷の出し入れは、コンデンサに直列に接続されたTFTによって制御される。DRAMの1個のメモリセルを構成するTFTとコンデンサの回路を図12(A)に示す。
【0202】
ワード線1201によってゲイト信号を与えられると、1203で示されるTFTは導通状態となる。この状態でビット線1202側からコンデンサ1204に電荷が充電されて情報を読み込んだり、充電したコンデンサから電荷を取り出して情報を読みだしたりする。
【0203】
DRAMの断面構造を図12(B)に示す。1205で示されるのは、石英基板もしくはシリコン基板でなる基体である。シリコン基板であれば、所謂SOI構造を構成することができる。
【0204】
上記基体1205上には下地膜として酸化珪素膜1206が成膜され、その上には本発明を応用したTFTが作製される。なお、基体1205がシリコン基板であれば、下地膜1206として熱酸化膜を用いることもできる。また、1207は実施例1に従って形成されたモノドメイン領域からなる活性層である。
【0205】
活性層1207はゲイト絶縁膜1208で覆われ、その上にはゲイト電極1209が形成される。そして、その上に層間絶縁膜1210が積層された後、ソース電極1211が形成される。このソース電極1211の形成と同時にビット線1202および1212で示される電極が形成される。また、1213は絶縁膜でなる保護膜である。
【0206】
この電極1212は固定電位を保ち、その下方に存在する活性層のドレイン領域との間にコンデンサ1214を形成する。即ち、このコンデンサに蓄積された電荷をTFTにより書き込んだり、読み出したりすることで記憶素子としての機能を有することになる。
【0207】
DRAMの特徴は1個のメモリを構成する素子数がTFTとコンデンサだけで非常に少ないので、高集積密度の大規模メモリを構成するのに適している。また、価格も低く抑えられるので、現在最も大量に使用されている。
【0208】
例えば、シリコン基板上に本発明を応用したSOI構造を形成した場合、接合面積が小さいためTFTのリーク(漏洩)電流を小さく抑えることが出来る。このことはデータ保持時間に大きく寄与する。
【0209】
また、SOI基板上にDRAMセルを形成した場合の特徴として蓄積容量を小さく設定することができるため、低電圧での動作を可能とすることができる。
【0210】
〔実施例10〕
本実施例では、本発明を応用して作製したTFTをSRAM(Static Rondom Access Memory )に応用した例について説明する。説明には図13を用いることとする。
【0211】
SRAMはフリップフロップ等の双安定回路を記憶素子に用いたメモリであって、双安定回路のON−OFFあるいはOFF−ONの2安定状態に対応して2進情報値(0または1)を記憶するものである。電源の供給がある限り記憶が保持される点で有利である。
【0212】
記憶回路はN−MOSやC−MOSで構成される。図13(A)に示すSRAMの回路は受動負荷素子に高抵抗を用いた回路である。
【0213】
1301で示されるのはワード線であり、1302はビット線である。1303は高抵抗で構成される負荷素子であり、1304で示されるような2組のドライバトランジスタと1305で示されるような2組のアクセストランジスタとでSRAMが構成される。
【0214】
TFTの断面構造を図13(B)に示す。石英基板もしくはシリコン基板でなる基体1306上に下地膜として酸化珪素膜1307を成膜し、その上に本発明を応用したTFTを作製することができる。1308は実施例1に従って形成されたモノドメイン領域からなる活性層である。
【0215】
活性層1308はゲイト絶縁膜1309で覆われ、その上にはゲイト電極1310が形成される。そして、その上に層間絶縁膜1311が積層された後、ソース電極1312が形成される。このソース電極1312の形成と同時にビット線1302およびドレイン電極1313が形成される。
【0216】
その上には再び層間絶縁膜1314が積層され、次に高抵抗負荷としてポリシリコン膜1315が形成される。1316は絶縁膜でなる保護膜である。
【0217】
以上のような構成でなるSRAMの特徴は、高速動作が可能で、信頼性が高くシステムへの組む込みが容易なことなどである。
【0218】
〔実施例11〕
本実施例では、実施例3の半導体装置および実施例6のCMOS構造を用いて同一基体上にアクティブマトリクス領域とこのアクティブマトリクス領域を駆動する周辺駆動回路とを集積化した例を示す。
【0219】
集積化されたアクティブマトリクス型の液晶表示装置を構成する一方の基体は以下ような構成を有している。即ち、アクティブマトリクス領域には、マトリクス状に配置された画素のそれぞれにスイッチング用の薄膜トランジスタが少なくとも一つ配置され、このアクティブマトリクス領域を駆動するための周辺回路がアクティブマトリクス領域の周囲に配置されている。そしてこれらの回路は全て1枚のガラス基板(または、石英基板やシリコン基板でもよい)上に集積化されている。
【0220】
このような構成に本明細書で開示する発明を利用すると、単結晶上に形成したMOS−FETに匹敵する性能を有する薄膜トランジスタでもってアクティブマトリクス領域と周辺回路とを構成することができる。
【0221】
即ち、図4で示す薄膜トランジスタでもってアクティブマトリクス領域の画素TFTを構成し、図8〜図10で示すCMOS構成でもって周辺回路を構成する。
【0222】
アクティブマトリクス領域に配置される薄膜トランジスタは、画素電極に保持された電荷を所定の時間でもって維持する必要から、そのオフ電流値を極力小さくすることが望まれる。
【0223】
本発明による薄膜トランジスタはその活性層がモノドメイン領域で形成されているため、オフ電流が優先的に流れるパス(電流経路)となりうる結晶粒界が実質的に存在しない。従って、オフ電流の小さい薄膜トランジスタを配置することが可能である。
【0224】
一方で周辺駆動回路はCMOS回路が多用される。そしてその特性を高いものとするためには、CMOS回路を構成するNチャネル型の薄膜トランジスタとPチャネル型の薄膜トランジスタとの特性を極力そろえることが必要とされる。
【0225】
このような目的のためには、実施例6(図8〜図10参照)に示したようなCMOS構造が最適なものとなる。
【0226】
このようにしてそれぞれの回路に好ましい特性を有した構成でなる集積化されたアクティブマトリクス型の液晶表示装置を得ることができる。
【0227】
〔実施例12〕
本実施例では実施例3においてゲイト絶縁膜の形成工程を異なるものとした場合の例について説明する。
【0228】
まず、実施例1と同様の工程を経てモノドメイン領域を含む半導体薄膜を形成し、次いでモノドメイン領域のみを選択的に利用して半導体装置の活性層を形成する。
【0229】
次に、活性層を覆う様にして200 〜1500Å(本実施例では800 Å)の厚さの珪素を主成分とする絶縁膜(本実施例では酸化珪素膜)をCVD法またはPVD法に代表される気相法により成膜する。この時、酸化珪素膜の膜厚は最終的な絶縁耐圧を考慮して決定すれば良い。また、酸化珪素膜の代わりに酸化窒化珪素膜や窒化珪素膜を用いることもできる。
【0230】
酸化珪素膜の成膜が終了したら、ハロゲン元素を含む雰囲気における加熱処理を行う。この加熱処理の最大の目的は活性層中に残存するニッケル等の金属残存物をゲッタリング除去することにある。この加熱処理は600 〜1100℃の温度範囲で行うことができるが、十分なゲッタリング効果を得るためには700 ℃を超える温度(好ましくは800 〜1000℃)で行うことが望ましい。
【0231】
なお、基板としてガラス基板を用いている場合には耐熱性を考慮して600 〜650 ℃で行う必要がある。また、基板として石英基板等の耐熱性の高い材料を用いる場合にはその上限温度は1100℃(好ましくは1000℃) 程度まで上げることができる。
【0232】
本実施例では基板として石英基板を用い、上記加熱処理を酸素に対して0.5 〜10%(本実施例では3%)の塩化水素(HCl)を含有した雰囲気において行う。HCl濃度を上記濃度以上とすると結晶性珪素膜の膜表面が荒れてしまう。また、この時、処理温度は950 ℃とし、処理時間は0.5hr とする。
【0233】
なお、ハロゲン元素を含む雰囲気を形成するには、酸素雰囲気中にHCl、HF、HBr、Cl2 、NF3 、F2 、Br2 から選ばれた一種または複数種類のガスを添加すれば良い。
【0234】
この工程の結果、ハロゲン元素による金属元素のゲッタリング作用が働き、活性層中に含まれるニッケルが 1×1017atoms/cm3 以下(好ましくは 1×1016atoms/cm3 以下、さらに好ましくはスピン密度以下)にまでゲッタリング除去される。なお、上記濃度はSIMS(質量二次分析)の測定結果から得られる測定値である。
【0235】
また、活性層と前述の酸化珪素膜との界面においては熱酸化反応が進行し、200 Å程度の熱酸化膜が形成される。また、その時、活性層の最終的な膜厚が200 〜300 Å(代表的には250 Å)となる様に設定しておくとオフ電流を低減する上で効果的である。
【0236】
なお、本実施例では上記ハロゲン元素を含む雰囲気における加熱処理に引き続いて窒素雰囲気中、950 ℃1hr 程度の加熱処理を施すことで熱酸化膜および珪素を主成分とする絶縁膜の膜質を向上させている。
【0237】
ところでニッケルは活性層を構成する結晶性珪素膜の結晶粒界に偏析していると考えられるが、除去されることで結晶粒界には未結合手が多数発生する。この多数の未結合手は950 ℃という加熱処理によって互いに再結合してトラップ準位等の少ない結晶粒界を形成する。
【0238】
また、ハロゲン元素を含む雰囲気における加熱処理を施した結果、活性層とゲイト絶縁膜との界面付近にはハロゲン元素が高濃度に残留する。SIMS測定によれば 1×1019〜 1×1020atoms/cm3 の濃度で存在する。
【0239】
さらに、活性層と前述の酸化珪素膜との界面に形成された熱酸化膜は、前記酸化珪素膜と共にゲイト絶縁膜を構成する。この時、熱酸化膜が形成される際に活性層界面の欠陥準位や格子間シリコン原子等を減少させるため、活性層とゲイト絶縁膜との界面状態は非常に優れたものとなる。
【0240】
以上の様に、本実施例に示す加熱処理を行うことでニッケル等の金属元素を低減することができる。ニッケル等の金属元素を低減することは半導体装置としての信頼性を向上させる上で非常に重要である。また、活性層の結晶状態を改善し、さらに界面状態の良好なゲイト絶縁膜を形成することができる。
【0241】
以上の結果、優れた電気特性と高い信頼性を有する半導体装置を実現することが可能となる。
【0242】
〔実施例13〕
本実施例は活性層とゲイト絶縁膜との界面状態を改善することに注目した場合の例である。特に、基板としてガラス基板を用いる場合において効果を発揮する技術である。
【0243】
まず、実施例1と同様の工程を経てモノドメイン領域を含む半導体薄膜を形成し、次いでモノドメイン領域のみを選択的に利用して半導体装置の活性層を形成する。そして、実施例12と同様に200 〜1500Åの厚さの酸化珪素膜をCVD法またはPVD法により成膜する。
【0244】
この状態で500 〜700 ℃(代表的には640 〜650 ℃) の加熱処理を行う。この温度範囲はガラス基板に歪や反りを生ずることなく熱酸化膜を形成するために設定される温度である。また、この加熱処理は酸素のみの雰囲気でも良いし、ハロゲン元素を含む雰囲気であっても良い。また、雰囲気中に水蒸気を含むウェット雰囲気とすることもできる。
【0245】
本実施例の条件で加熱処理を行う場合、0.5 〜2hr 程度も処理すれば数十Å未満(例えば10〜90Å)の熱酸化膜が形成される。そして、熱酸化膜の成長はこの程度の膜厚にほぼ収束する。
【0246】
本発明者らの知見によると、活性層およびゲイト絶縁膜の極界面付近(界面から活性層側およびゲイト絶縁膜側に向かって10〜30Å程度の領域)に固定電荷や欠陥準位等が集中するため、この領域が活性層とゲイト絶縁膜との界面状態を決定するといって過言ではない。
【0247】
従って、活性層とゲイト絶縁膜との界面状態を良好なものとするには、活性層界面の僅か10〜30Åの領域を熱酸化する(活性層が10〜30Å減じ、新たに20〜60Åの熱酸化膜が形成される) ことで極界面近傍の固定電荷や欠陥準位を消滅させれば良いのである。換言すれば、良好な界面状態を実現するためには僅か数十Å未満の熱酸化膜が形成できれば十分なのである。
【0248】
本発明に対して本実施例の様な熱酸化工程を組み込むことで、ガラス基板等の様な耐熱性の弱い基板上にも優れた特性を有する半導体装置を作製することが可能となる。
【0249】
〔実施例14〕
本実施例ではゲイト電極として結晶性珪素膜(ポリシリコン膜)を利用した例を示す。説明には図15を用いる。
【0250】
図15(A)において、1501はガラス基板、1502は下地膜、1503は実施例1に示す工程で得られたモノドメイン領域でなる活性層、1504はゲイト絶縁膜、1505は一導電性を付与したポリシリコン膜でなるゲイト電極である。
【0251】
次に、この状態で活性層1503に対して一導電性を付与する不純物イオンの注入を行なう。そして、このイオン注入工程により不純物領域1506、1507が形成される。
【0252】
不純物イオンの注入が終了したら、窒化珪素膜1508を 0.5〜1 μmの厚さに成膜する。成膜方法は減圧熱CVD法、プラズマCVD法、スパッタ法のいずれであっても良い。また、窒化珪素膜以外に酸化珪素膜を用いても良い。
【0253】
こうして図15(B)の状態が得られる。図15(B)の状態が得られたら、次に窒化珪素膜1508をエッチバック法によりエッチングして、ゲイト電極1505の側壁にのみ残す。こうして残された窒化珪素膜はサイドウォール1509として機能する。
【0254】
この際、ゲイト絶縁膜1504はゲイト電極1505およびサイドウォール1509がマスクとなった領域以外が除去されて図15(C)に示す様な状態で残存する。
【0255】
次に、図15(C)に示す状態で再び不純物イオンの注入を行なう。この時、ドーズ量は先程のイオン注入のドーズ量よりも高めとしておく。このイオン注入の際、サイドウォール1509の直下の領域1510、1511はイオン注入が行なわれないので、不純物イオンの濃度に変化はない。しかし、露出した領域1512、1513はさらに高濃度の不純物イオンが注入されることになる。
【0256】
以上の様に2度目のイオン注入を経て、ソース領域1512、ドレイン領域1513およびソース/ドレイン領域よりも不純物濃度の低い低濃度不純物領域(LDD領域)1510、1511が形成される。なお、ゲイト電極1505の直下はアンドープな領域であり、チャネル形成領域1514となる。
【0257】
以上の工程を経て図15(C)の状態が得られたら、300 Åの厚さの図示しないチタン膜を成膜し、チタン膜とシリコン膜とを反応させる。そして、チタン膜を除去した後、ランプアニール等による加熱処理を行なうことでソース領域1512、ドレイン領域1513、ゲイト電極1505の露出表面にチタンシリサイド1515〜1517を形成する。(図15(D))
【0258】
なお、上記工程はチタン膜の代わりにタンタル膜、タングステン膜、モリブデン膜等を用いることも可能である。
【0259】
次に、層間絶縁膜1518として酸化珪素膜を5000Åの厚さに成膜し、ソース配線1519、ドレイン配線1520、ゲイト配線1521を形成する。こうして図15(D)に示す構造のTFTが完成する。
【0260】
本実施例で示す構造のTFTは、配線とTFTとの接続がチタンシリサイド1515〜1517を介して行われるため、良好なオーミックコンタクトを実現することができる。
【0261】
〔実施例15〕
本明細書中における半導体装置とは、半導体を利用することで機能する装置全般を指しており、実施例11に示す様な構成でなるアクティブマトリクス型の電気光学装置(液晶表示装置、EL表示装置、EC表示装置等)およびその様な電気光学装置を組み込んだ応用製品をもその範疇に含むものとする。
【0262】
本実施例では、その応用製品について図例を挙げて説明する。本発明を利用した半導体装置としてはTVカメラ、ヘッドマウントディスプレイ、カーナビゲーション、プロジェクション(フロント型とリア型がある)、ビデオカメラ、パーソナルコンピュータ等が挙げられる。簡単な説明を図16を用いて行う。
【0263】
図16(A)はモバイルコンピュータであり、本体2001、カメラ部2002、受像部2003、操作スイッチ2004、表示装置2005で構成される。本発明は表示装置2005や装置内部に組み込まれる集積化回路等に対して適用される。
【0264】
図16(B)はヘッドマウントディスプレイであり、本体2101、表示装置2102、バンド部2103で構成される。表示装置2102は比較的小型のサイズのものが2枚使用される。
【0265】
図16(C)はカーナビゲーションであり、本体2101、表示装置2102、操作スイッチ2103、アンテナ2104で構成される。本発明は表示装置2102や装置内部の集積化回路等に対して適用できる。表示装置2202はモニターとして利用されるが、地図の表示が主な目的なので解像度の許容範囲は比較的広いと言える。
【0266】
図16(D)は携帯電話であり、本体2301、音声出力部2302、音声入力部2303、表示装置2304、操作スイッチ2305、アンテナ2306で構成される。本発明は表示装置2304や装置内部の集積化回路等に対してに適用できる。
【0267】
図16(E)はビデオカメラであり、本体2401、表示装置2402、音声入力部2403、操作スイッチ2404、バッテリー2405、受像部2406で構成される。本発明は表示装置2402や装置内部の集積化回路等に対して適用できる。
【0268】
図16(F)はフロントプロジェクションであり、本体2501、光源2502、反射型表示装置2503、光学系(ビームスプリッターや偏光子等が含まれる)2504、スクリーン2505で構成される。スクリーン2505は会議や学会発表などのプレゼンテーションに利用される大画面スクリーンであるので、表示装置2503は高い解像度が要求される。
【0269】
また、本実施例に示した電気光学装置以外にも、リアプロジェクションやハンディターミナルなどの携帯型情報端末機器に適用することができる。以上の様に、本発明の応用範囲は極めて広く、あらゆる分野の表示媒体に適用することが可能である。
【0270】
【発明の効果】
本発明は意図的に結晶核となるサイトを形成して結晶粒径を制御できる点が大きな特徴である。そして、こうして形成される比較的大きな結晶粒径の結晶粒をレーザー光等の照射により単結晶化する点も大きな特徴である。
【0271】
これら技術の効果として、表面に絶縁膜を有する基体上に実質的に単結晶と見なせるモノドメイン領域を形成することが実現できる。即ち、単結晶に匹敵する結晶性を有する結晶性珪素膜を用いて薄膜トランジスタ等の半導体装置の活性層を構成することが可能となる。
【0272】
従って、公知の単結晶ウエハーを用いた集積回路に匹敵する性能を有した半導体回路を構築することが実現できる。
【図面の簡単な説明】
【図1】 モノドメイン領域を有する半導体薄膜の形成工程を示す図
【図2】 モノドメイン領域の構成を示す図
【図3】 モノドメイン領域を有する半導体薄膜の形成工程を示す図
【図4】 半導体装置の作製工程を示す図
【図5】 SOI技術の問題点を示す図
【図6】 モノドメイン領域の構成を示す図
【図7】 モノドメイン領域に形成された活性層を示す図
【図8】 半導体装置の作製工程を示す図
【図9】 半導体装置の作製工程を示す図
【図10】 半導体装置の作製工程を示す図
【図11】 半導体装置の作製工程を示す図
【図12】 DRAMの構成を示す図
【図13】 SRAMの構成を示す図
【図14】 人工石英ターゲットの成分表を示す図表
【図15】 半導体装置の作製工程を示す図。
【図16】 応用製品の例を説明するための図。
【符号の説明】
101 ガラス基板
102 酸化珪素膜
103 凹または凸パターン
104 非晶質珪素膜
105 ニッケル層
106 凹または凸部
107 縦成長領域
108 横成長領域
109 結晶性珪素膜
201 縦成長領域
202 横成長領域
203 結晶粒界
204 接合界面
Claims (14)
- 半導体薄膜でなる活性層を有する半導体装置の作製方法において、
絶縁表面上に酸化珪素膜を成膜し、
前記酸化珪素膜をパターニングして凹または凸パターンを形成し、
前記酸化珪素膜上に非晶質半導体膜を成膜し、
前記非晶質半導体膜に対して結晶化を助長する金属元素を保持させ、
加熱処理により前記非晶質半導体膜を結晶性半導体膜に結晶化し、
前記結晶性半導体膜にレーザー光または、前記レーザー光と同等のエネルギーを持つ強光を照射して前記結晶性半導体膜をモノドメイン領域に変成させ、
前記モノドメイン領域を用いて前記活性層を形成することを特徴とする半導体装置の作製方法。 - 請求項1において、前記活性層は前記モノドメイン領域のみを用いて形成されることを特徴とする半導体装置の作製方法。
- 半導体薄膜でなる活性層を有する半導体装置の作製方法において、
絶縁表面上に酸化珪素膜を成膜し、
前記酸化珪素膜をパターニングして凹または凸パターンを形成し、
前記酸化珪素膜上に非晶質半導体膜を成膜し、
前記非晶質半導体膜に対して結晶化を助長する金属元素を保持させ、
加熱処理により前記非晶質半導体膜を結晶性半導体膜に結晶化し、
前記結晶性半導体膜にレーザー光または前記レーザー光と同等のエネルギーを持つ強光を照射して前記結晶性半導体膜をモノドメイン領域に変成させ、
前記モノドメイン領域のみを用いて活性層を形成し、
前記活性層を覆って珪素を主成分とする絶縁膜を成膜し、
加熱処理により前記活性層中の前記結晶化を助長する金属元素をゲッタリングすると共に前記活性層と前記絶縁膜との界面に熱酸化膜を形成し、
窒素雰囲気中における加熱処理により前記熱酸化膜および前記絶縁膜の膜質を改善することを特徴とする半導体装置の作製方法。 - 請求項3において、前記熱酸化膜の形成はハロゲン元素を含む雰囲気において行われることを特徴とする半導体装置の作製方法。
- 請求項3において、前記絶縁膜および前記熱酸化膜でなる積層膜はゲイト絶縁膜として機能し、
前記ゲッタリングする際の加熱処理はハロゲン元素を含む雰囲気で行い、前記ゲッタリング終了後、前記活性層と前記ゲイト絶縁膜との界面付近にはハロゲン元素が存在することを特徴とする半導体装置の作製方法。 - 請求項1乃至5のいずれか一において、前記酸化珪素膜の成膜はスパッタ法により行われることを特徴とする半導体装置の作製方法。
- 請求項1乃至6のいずれか一において、前記酸化珪素膜は人工石英ターゲットを用いたスパッタ法により成膜されることを特徴とする半導体装置の作製方法。
- 請求項1乃至7のいずれか一において、前記金属元素としてFe、Co、Ni、Ru、Rh、Pd、Os、Ir、Pt、Cu、Auから選ばれた一種または複数種類のものが用いられることを特徴とする半導体装置の作製方法。
- 請求項1乃至8のいずれか一において、前記モノドメイン領域内には結晶粒界が存在しないことを特徴とする半導体装置の作製方法。
- 請求項1乃至9のいずれか一において、前記半導体装置は薄膜トランジスタであることを特徴とする半導体装置の作製方法。
- 請求項1乃至10のいずれか一において、前記モノドメイン領域の膜厚は15〜45nmであることを特徴とする半導体装置の作製方法。
- 請求項1乃至11のいずれか一において、前記モノドメイン領域の外縁部は前記レーザー光または前記強光の照射により隆起していることを特徴とする半導体装置の作製方法。
- 請求項1乃至12のいずれか一において、前記活性層中には水素が1×1015〜1×1021atoms/cm3の濃度で添加されていることを特徴とする半導体装置の作製方法。
- 請求項1乃至13のいずれか一において、前記非晶質半導体膜の結晶化は前記凹または凸パターンから進むことを特徴とする半導体装置の作製方法。
Applications Claiming Priority (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP6189396 | 1996-02-23 | ||
JP8-61894 | 1996-02-23 | ||
JP6189496 | 1996-02-23 | ||
JP8-61893 | 1996-02-23 |
Related Parent Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP33633996A Division JP3476320B2 (ja) | 1996-02-23 | 1996-12-02 | 半導体薄膜およびその作製方法ならびに半導体装置およびその作製方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH1187243A JPH1187243A (ja) | 1999-03-30 |
JP4067651B2 true JP4067651B2 (ja) | 2008-03-26 |
Family
ID=26402979
Family Applications (3)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP33633996A Expired - Fee Related JP3476320B2 (ja) | 1996-02-23 | 1996-12-02 | 半導体薄膜およびその作製方法ならびに半導体装置およびその作製方法 |
JP20615098A Expired - Fee Related JP4067651B2 (ja) | 1996-02-23 | 1998-07-22 | 半導体装置の作製方法 |
JP2000034509A Expired - Fee Related JP4001702B2 (ja) | 1996-02-23 | 2000-02-14 | 半導体装置の作製方法 |
Family Applications Before (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP33633996A Expired - Fee Related JP3476320B2 (ja) | 1996-02-23 | 1996-12-02 | 半導体薄膜およびその作製方法ならびに半導体装置およびその作製方法 |
Family Applications After (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2000034509A Expired - Fee Related JP4001702B2 (ja) | 1996-02-23 | 2000-02-14 | 半導体装置の作製方法 |
Country Status (5)
Country | Link |
---|---|
US (4) | US5893730A (ja) |
JP (3) | JP3476320B2 (ja) |
KR (2) | KR100279107B1 (ja) |
CN (2) | CN1328797C (ja) |
TW (1) | TW316993B (ja) |
Families Citing this family (129)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3442500B2 (ja) | 1994-08-31 | 2003-09-02 | 株式会社半導体エネルギー研究所 | 半導体回路の作製方法 |
JP3675886B2 (ja) * | 1995-03-17 | 2005-07-27 | 株式会社半導体エネルギー研究所 | 薄膜半導体デバイスの作製方法 |
US7075002B1 (en) * | 1995-03-27 | 2006-07-11 | Semiconductor Energy Laboratory Company, Ltd. | Thin-film photoelectric conversion device and a method of manufacturing the same |
KR100265179B1 (ko) | 1995-03-27 | 2000-09-15 | 야마자끼 순페이 | 반도체장치와 그의 제작방법 |
TW463378B (en) | 1995-06-01 | 2001-11-11 | Semiconductor Energy Lab | Method of manufacturing semiconductor device |
JP4056571B2 (ja) | 1995-08-02 | 2008-03-05 | 株式会社半導体エネルギー研究所 | 半導体装置の作製方法 |
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JP3645378B2 (ja) | 1996-01-19 | 2005-05-11 | 株式会社半導体エネルギー研究所 | 半導体装置の作製方法 |
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US6599788B1 (en) | 1999-08-18 | 2003-07-29 | Semiconductor Energy Laboratory Co., Ltd. | Semiconductor device and method of fabricating the same |
US6410368B1 (en) | 1999-10-26 | 2002-06-25 | Semiconductor Energy Laboratory Co., Ltd. | Method of manufacturing a semiconductor device with TFT |
US6524877B1 (en) | 1999-10-26 | 2003-02-25 | Semiconductor Energy Laboratory Co., Ltd. | Semiconductor device, and method of fabricating the same |
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-
1996
- 1996-12-02 JP JP33633996A patent/JP3476320B2/ja not_active Expired - Fee Related
-
1997
- 1997-02-13 TW TW086101617A patent/TW316993B/zh not_active IP Right Cessation
- 1997-02-19 US US08/802,675 patent/US5893730A/en not_active Expired - Lifetime
- 1997-02-21 KR KR1019970005281A patent/KR100279107B1/ko not_active IP Right Cessation
- 1997-02-23 CN CNB2004100342931A patent/CN1328797C/zh not_active Expired - Fee Related
- 1997-02-23 CN CNB971048282A patent/CN1153256C/zh not_active Expired - Fee Related
-
1998
- 1998-04-23 US US09/065,654 patent/US6133073A/en not_active Expired - Lifetime
- 1998-07-22 JP JP20615098A patent/JP4067651B2/ja not_active Expired - Fee Related
-
1999
- 1999-03-08 KR KR1019990007485A patent/KR100285865B1/ko not_active IP Right Cessation
-
2000
- 2000-02-14 JP JP2000034509A patent/JP4001702B2/ja not_active Expired - Fee Related
- 2000-09-12 US US09/659,992 patent/US6291275B1/en not_active Expired - Fee Related
-
2001
- 2001-07-27 US US09/916,789 patent/US6458637B1/en not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
JP4001702B2 (ja) | 2007-10-31 |
US20020034863A1 (en) | 2002-03-21 |
US5893730A (en) | 1999-04-13 |
KR970063762A (ko) | 1997-09-12 |
US6133073A (en) | 2000-10-17 |
CN1153256C (zh) | 2004-06-09 |
KR100285865B1 (ko) | 2001-03-15 |
JPH1187243A (ja) | 1999-03-30 |
KR100279107B1 (ko) | 2001-02-01 |
JP3476320B2 (ja) | 2003-12-10 |
CN1162189A (zh) | 1997-10-15 |
JPH09289166A (ja) | 1997-11-04 |
CN1532947A (zh) | 2004-09-29 |
US6291275B1 (en) | 2001-09-18 |
CN1328797C (zh) | 2007-07-25 |
JP2000228361A (ja) | 2000-08-15 |
US6458637B1 (en) | 2002-10-01 |
TW316993B (ja) | 1997-10-01 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20070402 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20070814 |
|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20071004 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20071204 |
|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20071207 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20080108 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20080109 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110118 Year of fee payment: 3 |
|
R150 | Certificate of patent or registration of utility model |
Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110118 Year of fee payment: 3 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110118 Year of fee payment: 3 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120118 Year of fee payment: 4 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120118 Year of fee payment: 4 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20130118 Year of fee payment: 5 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20130118 Year of fee payment: 5 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20140118 Year of fee payment: 6 |
|
R250 | Receipt of annual fees |
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|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
LAPS | Cancellation because of no payment of annual fees |