JP2937130B2 - アクティブマトリクス型液晶表示装置 - Google Patents

アクティブマトリクス型液晶表示装置

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    • G09G3/3614—Control of polarity reversal in general

Description

【発明の詳細な説明】
【０００１】
【発明の属する技術分野】本発明は液晶表示装置に関
し、特に信号線側の駆動回路を減少させる一方で表示品
質を向上させたアクティブマトリクス型液晶表示装置に
関する。
【０００２】
【従来の技術】近年、薄膜トランジスタ（以下、ＴＦ
Ｔ）を使用した液晶表示装置は、ノートパソコンのディ
スプレイ等の用途として普及され、その低価格化も進め
られているが、さらなる低価格化が求められている。こ
の低価格化を実現するための１つの対策として部材費の
削減が挙げられるが、中でも部材費の大部分を占める液
晶表示パネルの信号線を駆動する回路として使われるド
ライバＩＣのコストを下げることがキーポイントとな
る。この信号線側のドライバＩＣが、部材費の中で大部
分を占める理由は、動作機能が高度であるために１個あ
たりの価格が高く、しかも１個あたり２４０出力とすれ
ばＳＶＧＡパネルでは１０個必要となるように数を多く
使う点にある。そこで、このドライバＩＣの数を減らす
ことが提案されており、例えば、特開平３−３８６８９
号公報、特開平５−２６５０４５号公報、特開平６−１
４８６８０号公報に提案されたものがある。これらは
皆、液晶表示パネルの隣り合う表示画素で信号線を共用
して、信号線側ドライバＩＣの個数を半分にしようとす
るものである。
【０００３】以下、これらの信号線ドライバＩＣを半減
する技術について説明する。図７は一般的なアクティブ
マトリクス型液晶表示装置のプロック構成図である。画
像を表示する部分が液晶表示パネル１である。この液晶
表示パネル１を駆動するための回路として、その垂直方
向と水平方向の各端部にそれぞれ信号線駆動回路２と走
査線駆動回路３として配置されている。これら駆動回路
２，３を制御する制御信号はタイミング発生回路５にお
いて発生される。基本的には、外部から入力される水平
同期信号と垂直同期信号とドットクロックから各種制御
信号が生成される。また、信号線駆動回路２のデータ入
力とのインタフェース形態によって、並べ替え等のデー
タ処理を行う必要があり、それを行うのがデータ処理回
路４であって、これもタイミング発生回路５によって制
御される。通常、このデータ処理回路４とタイミング発
生回路５は、ゲートレイ等のＡＳＩＣで１つにまとめて
開発される事が多い。
【０００４】前記した液晶表示パネル１の信号線と走査
線とＴＦＴと表示画素の回路接続を図８に示す。表示画
素ｄがマトリクス状に並び、列の数だけ信号線Ｓが垂直
方向に表示画素の脇を走り、行の数だけ走査線Ｇが水平
方向に表示画素の脇を走っている。各々の信号線Ｓと走
査線の各交点にはスイッチング素子である薄膜トランジ
スタＴＦＴが配置され、ＴＦＴのゲートが走査線Ｇに、
ドレインが信号線Ｓに、ソースが表示画素ｄの１つの電
極である表示電極に接続されている。表示画素のもう一
つの電極は、全て共通に共通電極Ｃとして接続されてい
る。
【０００５】そして、この構成の液晶表示パネル構造で
は、図９にその駆動タイミングチャートを示すように、
データはデータ処理回路４に入力されるが、１水平期間
（１Ｈ）単位でデータを見た場合、ほぼ同タイミングで
信号線駆動回路２に入力されると見なされる。信号線駆
動回路２に１水平期間分のデータが順次蓄えられ、完全
に蓄えられると各出力端子に対して一斉に出力される。
よって、タイミング的には図９のようになる。１ライン
目の表示データが出力されるときに、走査線駆動回路３
の出力Ｇ１が、ＴＦＴのＯＮ電圧を出力し、１ライン目
のデータが信号線駆動回路２から出力され終わるとＯＦ
Ｆ電圧に変わる。同時に２ライン目のデータが出力され
始めるので、Ｇ２がＯＮ電圧になる。同様にラインデー
タの出力に同期してＯＮ電圧が走査線Ｓをシフトしてい
く。このとき、共通電極の電位をずっと一定に保持して
いる駆動方式では、ＯＮ電圧は約２０Ｖ、ＯＦＦ電圧は
約−７Ｖである。走査線がＯＮ電圧の時にＴＦＴが導通
し、そのときの各信号線の電位が各表示画素に書き込ま
れる。このように順次、１水平ラインずつデータを表示
画素に書き込んでいき、１垂直期間で１フレームの表示
パターンを形成する。このとき、各表示画素へ書き込む
信号データの極性に注目すると、ライン毎（１回の出力
毎）に反転している。また、信号線駆動回路２の出力
は、隣り合う信号線Ｓ同士で互いに逆の極性が出力され
るように設計されている。すなわちこれがドット反転駆
動で、１回の書き込み（１ラインの書き込み）に対し、
隣り合う出力が逆極性で出力されるため共通電極の電位
が揺れなくなる。また１フレーム書き込まれた画面は図
１０のようになるので、たとえ正極性と負極性の書き込
みで差があったとしても、見た目で平均化され均一にな
り、画質よく見える。
【０００６】このような従来の一般的な液晶表示パネル
に対し、低価格化を図るべく、信号線を共用して半分に
減らした、すなわち信号線側ドライバＩＣの個数を半分
にした液晶表示装置を説明する。この種の液晶表示装置
においても、そのブロック構成は図７の構成と同じであ
る。ただ、液晶表示パネルで信号線を共用しているため
に、信号線駆動回路の出力が半分、回路自体も半分にな
っている。逆に走査線駆動回路は、走査線が２倍になる
ためにその出力も回路自体も２倍になる。しかしなが
ら、価格面を考えた時、走査線側の駆動回路は、信号線
駆動回路と比べ割合簡単な回路であり、ＩＣで実現する
ということで考えると既存のプロセスで実現できる。つ
まり、走査線駆動回路は信号線駆動回路と比べ安く、回
路規模が２倍になったとしても信号線駆動回路が半分に
なったことで低価格化が実現できる。
【０００７】図１１は、前記した公報に記載されている
液晶表示装置の回路構成図である。水平方向の隣り合う
表示画素で一本の信号線を共有しており、それら表示画
素と信号線とがＴＦＴのソース、ドレインを介して接続
される。そして水平方向の表示ライン１本に対して２本
の走査線が割り当てられており、ＴＦＴのゲートは奇数
番目表示画素と偶数番目表示画素で別々の走査線に接続
されている。したがって、図８に示した液晶表示パネル
と比較すると信号線の数は半分に、走査線の数は２倍に
なっている。
【０００８】このような信号線を半減させた液晶表示装
置では、図１２に駆動タイミングチャートを示すよう
に、データは通常駆動の時と同じようにデータ処理回路
に入力され、データ処理回路でデータを奇数番目データ
群Ａと偶数番目データ群Ｂに分けて半分の水平期間（１
／２・Ｈ）でそれぞれを出力する信号線処理回路入力の
タイミングのようになる。なお、このデータ処理回路の
部分は少なくともラインメモリが必要となる。以下、信
号線駆動回路からの動作は図９の通常駆動と同じで、信
号線駆動回路の出力に合わせてＴＦＴのＯＮ電圧が走査
線をＧ1 ，Ｇ2 ，Ｇ3 ，Ｇ4 ・・・と順次シフトしてい
く。すなわち、表示画素には奇数番目データＡ→偶数番
目データＢ、次の表示ラインに移って、奇数番目データ
Ａ→偶数番目データＢというように交互に書き込まれて
いく。１回の書き込み時間は、奇数番目データＡ→偶数
番目データＢというように２回書き込むことになるの
で、通常駆動と比べて半分の書き込み時間となり、信号
線駆動回路の出力は能力的に厳しくなる。
【０００９】ところで、このときの表示画面の極性を考
えると、通常駆動の時と同じで信号線駆動回路は隣り合
う出力で互いに逆の極性が出力され、図１２の極性１の
ように１回の出力毎に各々の出力の極性が反転すると、
図１３のように２列毎に極性が変わるようになる。正極
性書き込みと負極性書き込みとで差があった場合、表示
画面は見た目２列毎の縦筋になって見え、表示品質的に
良くない。この表示品質を改善するために、図１０のよ
うなドット反転画面にするには信号線駆動回路あるいは
走査線駆動回路を変更すればできる。例えば、信号線駆
動回路の出力が全て同極性で出力され、図１２の極性２
のように２回の出力毎に極性を反転させれば、図１０の
ようなドット反転の表示画面になる。
【００１０】しかし全ての信号線が同極性で駆動される
と表示画素への書き込み時、共通電極へ一方向に電流が
流れ、その電圧降下で共通電極の電位が揺れ、表示画面
に悪影響を及ぼし逆に表示品質を下げる。また、信号線
駆動回路の出力が図１２の極性１のように１回の出力毎
に反転であっても、走査線のＯＮ電圧のシフトを１本お
きにさせて２回その操作をすれば図１０のドット反転画
になる。しかし、それは走査線の駆動と対応したデータ
の処理が必要となり、この操作の場合フレームメモリが
必要となってくる。また、同時に走査線駆動回路も単純
なシフトレジスタではなく複雑になるため、結果として
コストアップの要因となる。当然信号線は全て同極性で
駆動されているので前述した影響を受ける。
【００１１】一方、信号線駆動回路に関し、実用上とい
う見地、信号線負荷駆動能力、価格（チップ面積）の各
点から、極性反転が図１２の極性１のように１回出力毎
の反転のみ対応可能か、極性２のように２回以上同極性
出力できるかという事が重要なポイントとなる。すなわ
ち、近年開発される液晶表示装置は１２インチ以上の大
画面で高解像度（ＸＧＡ以上）のものとなってきてい
る。このことは、１水平期間が短くなり、これは信号線
への書き込み時間に関係し、信号線駆動回路の負荷、信
号線の配線容量と抵抗が大きくなることを意味する。例
えば、ＳＶＧＡで１水平期間は約２７μｓ、ＸＧＡで約
２０μｓであるが、今回のような信号線を半分に減らし
た駆動では、さらにその半分の時間で１回の書き込みを
行わなければいけないことになる。このことから信号線
駆動回路すなわち信号線側ドライバＩＣとして要求され
る性能は十分な負荷駆動能力があるという事である。
【００１２】また、このような大画面、高解像度のパネ
ルを高品質で駆動するには現在１０．４インチクラスの
液晶表示装置で多く行われている低耐圧のドライバＩＣ
を用いた共通電極を振るゲート反転駆動では限界があ
り、低耐圧ドライバＩＣを用いて共通電極を振らずに行
うドット反転駆動である必要がある。また、大画面、高
解像に限らないが世の中の動向として低消費電力でなけ
ればならない。これはドライバＩＣとしてはダイナミッ
クレンジが電源電圧まで、めいっぱいとれるものという
ことにつながる。したがって、信号線側ドライバＩＣと
して要求される性能は、隣り合う出力が互いに逆極性で
あること、負荷駆動能力があり、できるだけ電源電圧い
っぱいまでダイナミックレンジがとれることである。こ
の実現を考えると、現在のところ信号線駆動回路の出力
段であるアンプ部が、図１４（ａ），（ｂ）のような隣
り合う２つの出力で片方が立ち上げ専用のアンプ、もう
片方が立ち下げ専用のアンプを受け持ち、１回の出力毎
に切り替えて使用する構成が最良となる。ただし、この
構成では２回以上続けて同極性での出力ができないとい
う制限がある。
【００１３】以上述べてきたことから、現実的に実用上
用いられる信号線側と走査線側の駆動回路は、動作とし
て信号線側が、隣り合う出力は互いに逆極性で出力さ
れ、１回の出力毎に正極性と負極性とで必ず反転するこ
と、走査線側はＴＦＴのＯＮ電圧を順次端からシフトし
て出力していくタイプが一番シンプルな回路で構成で
き、かつデータ処理回路もラインメモリのみで処理でき
るのでコスト的にも一番良いといえる。
【００１４】
【発明が解決しようとする課題】以上のように、水平方
向の隣り合う画素で信号線を共用して信号線駆動回路を
半分にした駆動回路を備える従来の液晶表示パネルで
は、信号線駆動回路として出力が隣り合う同士で互いに
逆極性で１回の出力毎に極性が反転し、走査線駆動回路
は最上位ラインから順次ＴＦＴのＯＮ電圧がシフトして
いく駆動回路とした場合に、ドット反転駆動を行うこと
が実用的に困難であり、良好な表示が得られないという
問題がある。
【００１５】本発明の目的は、信号線駆動回路を低減す
る一方で、信号線駆動回路の出力が隣り合う同士で互い
の逆の極性で出力され、かつ１回の出力毎に極性が必ず
反転し、走査線駆動回路は出力が片方から順次ＴＦＴの
ＯＮ電圧を出力していく駆動回路を前提とし、ドット反
転駆動あるいはそれに近い駆動ができ、良好な画質が得
られる液晶表示パネルを提供することにある。
【００１６】
【課題を解決するための手段】本発明は、マトリクス状
に配置された複数の表示画素のうち、水平方向の奇数番
目の表示画素と偶数番目の表示画素とで１本の信号線を
共用し、かつ１水平表示ラインに対して２本の走査線が
割り当てられ、信号線を共用している奇数番目と偶数番
目の各スイッチング素子は割り当てられた走査線のそれ
ぞれ別の走査線に接続され、さらに奇数番目の表示ライ
ンと偶数番目の表示ラインとでスイッチング素子と走査
線の前記接続状態が互いに逆の接続関係にあり、隣り合
う前記信号線の出力は互いに逆極性で出力され、かつ１
回の出力毎に正極性と負極性とで反転し、前記走査線は
前記スイッチング素子を端から順次シフトしながらオン
する構成であることを特徴とするものである。
【００１７】また、本発明は、マトリクス状に配置され
た複数の表示画素のうち、水平方向の奇数番目の表示画
素と偶数番目の表示画素とで１本の信号線を共用し、か
つ１水平表示ラインに対して２本の走査線が割り当てら
れ、一の信号線では奇数番目の表示画素のスイッチング
素子は奇数番目または偶数番目のいずれか一方の走査線
に接続され、偶数番目の表示画素のスイッチング素子は
いずれか他方の走査線に接続され、かつこれに隣接する
信号線では前記奇数番目と偶数番目の表示画素のスイッ
チング素子と走査線との接続状態が互いに逆の関係にあ
り、さらに奇数番目の表示ラインと偶数番目の表示ライ
ンとでスイッチング素子と走査線の前記接続状態が互い
に逆の接続関係にあり、隣り合う前記信号線の出力は互
いに逆極性で出力され、かつ１回の出力毎に正極性と負
極性とで反転し、前記走査線は前記スイッチング素子を
端から順次シフトしながらオンする構成であることを特
徴とするものである。
【００１８】さらに、本発明は、マトリクス状に配置さ
れた複数の表示画素は、水平方向の表示画素のそれぞれ
に信号線が接続されるとともに、奇数番目の信号線はｔ
本（ｔは２以上の整数）が１つのグループとして短絡さ
れ、偶数番目の信号線はｔ本が他の１つのグループとし
て短絡され、かつ１水平表示ラインに対してｔ本の走査
線が割り当てられ、前記ｔ本の短絡されている信号線に
接続された表示画素の各スイッチング素子はそれぞれ別
のｔ本の走査線に接続され、奇数番目の表示ラインと偶
数番目の表示ラインでは、それぞれのスイッチング素子
と走査線との接続状態が互いに相反する関係にあり、隣
り合う前記信号線の出力は互いに逆極性で出力され、か
つ１回の出力毎に正極性と負極性とで反転し、前記走査
線は前記スイッチング素子を端から順次シフトしながら
オンする構成であることを特徴とするものてある。
【００１９】
【発明の実施の形態】次に、本発明の実施形態例を図面
を参照して説明する。図１は本発明の第１の実施形態の
アクティブマトリクス型液晶表示装置の液晶表示パネル
の構成を示す回路図であり、図７にブロック構成を示し
たアクティブマトリクス型液晶表示装置に適用した例を
示している。すなわち、図７に示したように、液晶表示
パネル１はその水平方向に配置された信号線駆動回路２
と垂直方向に配置された走査線駆動回路３で駆動され
る。信号線駆動回路２は、タイミング発生回路５で生成
された制御信号により駆動され、出力Ｓ1'，Ｓ2'，
Ｓ3'，Ｓ4'，・・・・は、液晶表示装置の信号線Ｓに接
続されており、水平方向画素数の半分である。走査線駆
動回路３も同じくタイミング発生回路３で生成された制
御信号で駆動される。出力Ｇ1'，Ｇ2'，Ｇ3'，Ｇ4'，・
・・・は、液晶表示パネルの走査線Ｇに接続されてお
り、走査線数は垂直方向画素数の２倍である。シフトレ
ジスタの動作と同じく、Ｇ1'，Ｇ2'，Ｇ3'，Ｇ4'，・・
・・と順次、薄膜トランジスタ（ＴＦＴ）のゲートにオ
ン電圧を出力していく。データ系では、データはデータ
処理回路４によって、液晶表示パネルの回路構成に合わ
せた並び換え（データ処理）を行った後、信号線駆動回
路に入力される。このデータ処理回路４はラインメモリ
を搭載している。ここで信号線駆動回路の動作条件とし
て、出力が隣り合う同士で互いに逆の極性の信号が同時
に出力される。また１回出力されるごとに極性が反転さ
れる。
【００２０】図１において、液晶表示バネルはｎ列×ｍ
行の画素電極より構成される（ｎ，ｍはそれぞれ２以上
の整数）。そして水平方向（行方向）の奇数番目画素と
偶数番目画素の相隣接する画素で、垂直方向（列方向）
に伸びる１本の信号線を共用しており、各画素に接続さ
れるスイッチング素子であるＴＦＴのドレインが接続さ
れている。すなわち、信号線の数は水平方向の画素数の
半分（ｎ／２本）になる。その隣あう２つのＴＦＴのゲ
ートは奇数番目のＴＦＴと偶数番目のＴＦＴで、水平方
向の１表示ラインに割り当てられた水平方向に伸びる２
本の走査線のそれぞれ別の走査線に接続されている。し
たがって、走査線の数は垂直方向の画素数の倍（２ｍ
本）になる。なお、この構成については図１１に示した
従来構成と同じである。
【００２１】しかしながら、この第１実施形態では、奇
数行目の表示ラインにおいては、水平方向の奇数番目の
画素のＴＦＴのゲートは奇数行目の走査線に接続され、
水平方向の偶数番目画素のＴＦＴのゲートは偶数行目の
走査線に接続される。一方、偶数行目の表示ラインにお
いては、水平方向の奇数番目の画素のＴＦＴのゲートは
偶数行目の走査線に接続され、水平方向の偶数番目の画
素のＴＦＴのゲートは奇数行目の走査線に接続される。
すなわち、水平方向の任意の表示ラインに注目した場
合、その表示ラインに割り当てられる複数本の走査線に
おいて、水平方向奇数番目のＴＦＴのゲートはある片方
の走査線に接続されており、偶数番目のＴＦＴのゲート
はもう一方の走査線に接続がれている。そして、その表
示ラインに隣接する表示ラインでは、そのＴＦＴのゲー
トと走査線の接続は逆の関係にある。つまり、奇数番目
の表示ラインと偶数番目の表示ラインで、ＴＦＴのゲー
トと走査線の接続関係が逆ということである。
【００２２】この第１の実施形態の動作を図２のタイミ
ングチャートを参照して説明する。まず、シリアルで入
力されてくるデータを従来と同じくデータ処理回路４で
とらえ、データ処理回路に設けられているラインメモリ
に１ライン分記憶し、パネルのＴＦＴと信号線、走査線
の接続に従って、データを１水平期間（１Ｈ）の半分で
前半と後半に振り分ける。すなわち、パネル１行目の表
示ライン（ｍ＝１）で、前半に出力されるデータは、奇
数番目のデータでＤ1 ，Ｄ3 ，Ｄ5 ，・・・となる。こ
れをＡパターンと名付ける。後半に出力されるデータ
は、偶数番目のデータでＤ2 ，Ｄ4 ，Ｄ6 ，・・・とな
る。これをＢパターンと名付ける。２行目の表示ライン
（ｍ＝２）では、逆に前半がＢパターン、後半がＡパタ
ーンとなる。３行目の表示ライン以降は、この１、２行
目の繰り返しで、信号線に出力される。このようにデー
タが信号線に出力されると、走査線は順次Ｇ1 ，Ｇ2 ，
Ｇ3，・・・とＴＦＴのオン電圧をシフトしていけば、
所定の画素に所定のデータが書き込まれることになる。
例えば信号線Ｓ1 に注目すれば、走査線が順次Ｇ1 から
オンしていくと、ｄ11（Ａ），ｄ12（Ｂ），ｄ
22（Ｂ），ｄ21（Ａ），・・・とデータは書き込まれ
る。なお、（Ａ），（Ｂ）はＡパターン、Ｂパターンを
示す。
【００２３】ここで、信号線駆動回路から出力される信
号の極性は、隣あう出力同士が互いに逆極性で、１回の
出力ごとに極性反転することを考慮すれば、１フレーム
書き込み終了後の画面上の極性は図３のように、水平方
向は２画素おき、垂直方向は１画素おきに極性が反転し
ている。これは前述したすべての隣接画素に対し逆極性
の関係になるドット反転駆動とは若干異なるが、２個を
一組とし、その隣接画素間でみれば逆極性の関係にあ
り、正極性と負極性の差によるフリッカーに強いといえ
る。また対向電極の電荷はやはり隣同士でキャンセル
し、電荷の移動がない。これにより、格段に画質は向上
する。なお、次のフレームは全く逆の極性になることは
言うまでもない。
【００２４】図４は本発明の第２の実施形態例の回路図
であり、図１と同一構成部分には同一符号を付与し、そ
の説明を省略する。この第２の実施形態では、極性が完
全なドット反転になる様にＴＦＴのゲートと走査線を接
続した実施形態である。この液晶パネルにおける接続
は、第１の実施形態と同じく、水平方向の隣あう２画素
で１つの信号線を共用し、ＴＦＴのドレインが接続され
ている。そして水平方向の表示ライン１本に対し２本の
走査線が割り当てられる。一番上の表示ラインにおいて
信号線Ｓ１に注目すると左のＴＦＴのゲートは走査線Ｇ
１に接続され、右のＴＦＴのゲートは走査線Ｇ２に接続
されている。信号線Ｓ２に注目するとその逆であり、信
号線Ｓ３では同じである。すなわち、ある任意の表示ラ
インにおいて、奇数番目の信号線に接続されているＴＦ
Ｔのゲートと走査線の関係と、偶数番目の信号線のそれ
とは逆である。なお、奇数番目と偶数番目の表示ライン
におけるＴＦＴのゲートと走査線の接続関係は、第１の
実施形態と同様に逆の関係となっている。
【００２５】この液晶表示パネルの駆動に際しては、第
１の実施形態例の駆動と同じであた、図２のタイミング
チャートに示した通りである。ただし、データ処理回路
４（図７参照）によって振り分けられるデータは、１行
目の前半が、Ｄ1 ，Ｄ4 ，Ｄ5 ，Ｄ8 ，・・・であり、
これがＡパターンとなる。後半が、Ｄ2 ，Ｄ3 ，Ｄ6，
Ｄ7 ，・・・であり、これがＢパターンとなる。これで
第１の実施形態と同じように駆動すれば、所定のデータ
が所定の画素に書き込まれ、得られる表示画面上の極性
は、図１０のように完全なドット反転になる。
【００２６】図６は本発明の第３の実施形態の回路図で
ある。ここでは、前記第１及び第２の実施形態をさらに
改善したものである。すなわち、図５（ａ）に示すよう
に、前記各実施形態では、１つの信号線を２つの画素が
共用しているが、その動作時には２つの画素の一方の画
素電極には信号線が接続されない状態が生じる。この接
続されない状態では画素電極と信号線の間には寄生容量
が存在するため、この寄生容量は２つの画素電極の一方
のみ存在することになる。信号線は１回の出力ごとに極
性が振れるので、寄生容量をとおして画素電極の電位が
振れることになる。これが縦クロストークの原因とな
り、表示品質を劣化させる。
【００２７】これに対し、第３の実施形態では、図６の
ように、水平方向の各画素に対してはそれぞれ１本の信
号線が通っており、各画素のＴＦＴのドレインがそれぞ
れの信号線に接続されている。しかしながら、これらの
信号線は、水平方向の奇数番目同士、偶数番目同士で隣
接する２本の信号線が短絡されている。この実施形態で
は左から１番目と３番目の信号線、２番目と４番目の信
号線、・・・というように１本おきに短絡されている。
また、１水平表示ラインには前記の第１、第２の実施形
態と同様、２つの走査線が割り当てられている。そし
て、短絡されている２本の信号線に接続されているＴＦ
Ｔのゲートは、その割り当てられた２本の走査線に対
し、別々の走査線に接続されている。そして、奇数番目
の表示ラインと偶数番目の表示ラインで、その接続関係
は逆の関係にある。
【００２８】この液晶表示パネルにおいても、第１及び
第３の実施形態と同様に駆動することができる。このと
きのＡパターンは、Ｄ1 ，Ｄ2 ，Ｄ5 ，Ｄ6 ，・・・、
Ｂパターンは、Ｄ3 ，Ｄ4 ，Ｄ7 ，Ｄ8 ，・・・であ
る。画素電極の両脇の信号線は、１つおきに信号線が接
続され、また信号線駆動回路の隣りあう出力は互いに極
性が反転しているので、互いに逆極性で振れていること
になる。この結果、この液晶表示パネルでは、各画素子
における寄生容量は図５（ｂ）のようになり、容量値は
等しく、逆極性で動く信号線の間にある画素電極の電位
は振れなくなる。なお、このパネル構成での、画面上の
極性は図３に示す第１の実施形態と同じになり、ほぼド
ット反転になる。したがって、これらのことから縦クロ
ストークのない、表示品質の高い画像が得られる。
【００２９】なお、以上説明してきた本発明の各実施形
態は、図７のようにラインメモリをデータ処理回路４に
搭載しているとして説明してきたが、データ処理回路自
体が信号線駆動回路の中にあっても同様に適用できる。
【００３０】
【発明の効果】以上説明したように本発明は、信号線を
共用する表示画素のスイッチング素子と走査線との接続
状態を、共用する表示画素間で逆の接続状態とし、かつ
奇数番目の表示ラインと偶数番目の表示ラインとで逆の
接続状態としているので、信号線駆動回路の出力が隣り
合う同士で極性が互いに逆で、１回の出力毎に極性が反
転し、走査線が順次的にシフト動作されるという条件の
もとでも各表示画素をドット反転駆動することができ、
高価な信号線駆動回路を削減でき、低価格で高画質の液
晶表示装置を得ることができる。また、奇数番目の信号
線と偶数番目の信号線とで表示画素のスイッチング素子
と走査線との接続状態が逆となる構成とすることによっ
ても同様の効果が得られる。さらに、奇数番目の信号線
が複数本を１つのグループとして短絡され、偶数番目の
信号線が複数本を１つのグループとして短絡され、かつ
同じ複数本の走査線を割り当てて各表示画素のスイッチ
ング素子を各走査線に接続した構成とすることによって
も、同様の効果を得ることができる。
【図面の簡単な説明】
【図１】本発明の第１の実施形態の液晶表示パネルの回
路図である。
【図２】図１の回路を駆動する際の動作タイミングチャ
ートである。
【図３】第１の実施形態における表示画面の極性を示す
図である。
【図４】本発明の第２の実施形態の液晶表示パネルの回
路図である。
【図５】信号線と画素電極間の寄生容量を説明するため
の図である。
【図６】本発明の第３の実施形態の液晶表示パネルの回
路図である。
【図７】アクティブマトリクス型液晶表示装置のブロッ
ク構成図である。
【図８】従来の液晶表示パネルの回路図である。
【図９】図８の液晶表示パネルを駆動する際の動作タイ
ミングチャートである。
【図１０】図８の液晶表示パネルの表示画面の極性を示
す図である。
【図１１】従来の改善された液晶表示パネルの回路図で
ある。
【図１２】図１１の液晶表示パネルを駆動する際の動作
タイミンクチャートである。
【図１３】図１１の液晶表示パネルの表示画面の極性を
示す図である。
【図１４】信号線駆動回路の出力アンプ部の回路構成を
説明するための図である。
【符号の説明】
１ 液晶表示パネル ２ 信号線駆動回路 ３ 走査線駆動回路 ４ データ処理回路 ５ タイミング発生回路 Ｓ 信号線 Ｇ 走査線 ｄ 表示画素 ＴＦＴ 薄膜トランジスタ（スイッチング素子）
───────────────────────────────────────────────────── フロントページの続き (56)参考文献 特開 平３−38689（ＪＰ，Ａ) 特開 昭58−203486（ＪＰ，Ａ) 特開 平５−265045（ＪＰ，Ａ) 特開 平10−142578（ＪＰ，Ａ) (58)調査した分野(Int.Cl.6，ＤＢ名) G02F 1/133 G02F 1/136 G02F 1/1343 G09G 3/36 G09F 9/30

Claims (5)

    (57)【特許請求の範囲】
  1. 【請求項１】 マトリクス状に配置された複数の表示画
    素と、前記各表示画素に対して表示画面の垂直方向、水
    平方向にそれぞれ延設される複数本の信号線および走査
    線と、前記走査線に供給された信号に基づいて前記表示
    画素を信号線に接続するスイッチング素子とを備える液
    晶表示パネルと、前記信号線及び走査線にそれぞれ所要
    の信号を供給する信号線駆動回路および走査線駆動回路
    を備えるアクティブマトリクス型液晶表示装置におい
    て、水平方向の奇数番目の表示画素と偶数番目の表示画
    素とで１本の信号線を共用し、かつ１水平表示ラインに
    対して２本の走査線が割り当てられ、前記信号線を共用
    している奇数番目と偶数番目の各スイッチング素子は前
    記割り当てられた走査線のそれぞれ別の走査線に接続さ
    れ、さらに奇数番目の表示ラインと偶数番目の表示ライ
    ンとでスイッチング素子と走査線の前記接続状態が互い
    に逆の接続関係にあり、隣り合う前記信号線の出力は互
    いに逆極性で出力され、かつ１回の出力毎に正極性と負
    極性とで反転し、前記走査線は前記スイッチング素子を
    端から順次シフトしながらオンする構成であることを特
    徴とするアクティブマトリクス型液晶表示装置。
  2. 【請求項２】 マトリクス状に配置された複数の表示画
    素と、前記各表示画素に対して表示画面の垂直方向、水
    平方向にそれぞれ延設される複数本の信号線および走査
    線と、前記走査線に供給された信号に基づいて前記表示
    画素を信号線に接続するスイッチング素子とを備える液
    晶表示パネルと、前記信号線及び走査線にそれぞれ所要
    の信号を供給する信号線駆動回路および走査線駆動回路
    を備えるアクティブマトリクス型液晶表示装置におい
    て、水平方向の奇数番目の表示画素と偶数番目の表示画
    素とで１本の信号線を共用し、かつ１水平表示ラインに
    対して２本の走査線が割り当てられ、一の信号線では奇
    数番目の表示画素のスイッチング素子は奇数番目または
    偶数番目のいずれか一方の走査線に接続され、偶数番目
    の表示画素のスイッチング素子はいずれか他方の走査線
    に接続され、かつこれに隣接する信号線では前記奇数番
    目と偶数番目の表示画素のスイッチング素子と走査線と
    の接続状態が互いに逆の関係にあり、さらに奇数番目の
    表示ラインと偶数番目の表示ラインとでスイッチング素
    子と走査線の前記接続状態が互いに逆の接続関係にあ
    り、隣り合う前記信号線の出力は互いに逆極性で出力さ
    れ、かつ １回の出力毎に正極性と負極性とで反転し、前
    記走査線は前記スイッチング素子を端から順次シフトし
    ながらオンする構成であることを特徴とするアクティブ
    マトリクス型液晶表示装置。
  3. 【請求項３】 マトリクス状に配置された複数の表示画
    素と、前記各表示画素に対して表示画面の垂直方向、水
    平方向にそれぞれ延設される複数本の信号線および走査
    線と、前記走査線に供給された信号に基づいて前記表示
    画素を信号線に接続するスイッチング素子とを備える液
    晶表示パネルと、前記信号線及び走査線にそれぞれ所要
    の信号を供給する信号線駆動回路および走査線駆動回路
    を備えるアクティブマトリクス型液晶表示装置におい
    て、水平方向の表示画素のそれぞれに信号線が接続され
    るとともに、奇数番目の信号線はｔ本（ｔは２以上の整
    数）が１つのグループとして短絡され、偶数番目の信号
    線はｔ本が他の１つのグループとして短絡され、かつ１
    水平表示ラインに対してｔ本の走査線が割り当てられ、
    前記ｔ本の短絡されている信号線に接続された表示画素
    の各スイッチング素子はそれぞれ別のｔ本の走査線に接
    続され、奇数番目の表示ラインと偶数番目の表示ライン
    では、それぞれのスイッチング素子と走査線との接続状
    態が互いに相反する関係にあり、隣り合う前記信号線の
    出力は互いに逆極性で出力され、かつ１回の出力毎に正
    極性と負極性とで反転し、前記走査線は前記スイッチン
    グ素子を端から順次シフトしながらオンする構成である
    ことを特徴とするアクティブマトリクス型液晶表示装
    置。
  4. 【請求項４】 前記スイッチング素子として薄膜トラン
    ジスタを備え、この薄膜トランジスタのソース・ドレイ
    ンを表示画素と信号線との間に接続し、ゲートを走査線
    に接続する請求項１ないし３のいずれかに記載のアクテ
    ィブマトリクス型液晶表示装置。
  5. 【請求項５】 前記信号線駆動回路にデータを供給する
    データ処理回路と、前記信号線駆動回路と前記走査線駆
    動回路と前記データ処理回路を制御する信号を生成する
    タイミング発生回路とを含み、前記データ処理回路は、
    １水平期間を２つ以上に分割して前記信号線駆動回路か
    ら信号が出力される時分割駆動のためのラインメモリを
    備える請求項４に記載のアクティブマトリクス型液晶表
    示装置。
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