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  1. 同一基板上に、第1のトランジスタを含む駆動回路部と、第2のトランジスタを含む画素部とを有し、
    前記第1のトランジスタは、第1のゲート電極層と、前記第1のゲート電極層上のゲート絶縁層と、前記ゲート絶縁層上の第1の酸化物半導体層と、前記第1の酸化物半導体層上の第1のソース電極層と、前記第1の酸化物半導体層上の第1のドレイン電極層と、を有し、
    前記第2のトランジスタは、第2のゲート電極層と、前記第2のゲート電極層上の前記ゲート絶縁層と、前記ゲート絶縁層上の第2の酸化物半導体層と、前記第2の酸化物半導体層上の第2のソース電極層と、前記第2の酸化物半導体層上の第2のドレイン電極層と、を有し、
    前記第1及び前記第2の酸化物半導体層、前記第1及び前記第2のソース電極層上、及び前記第1及び前記第2のドレイン電極層上に前記第1の酸化物半導体層の一部及び前記第2の酸化物半導体層の一部と接する酸化物絶縁層を有し、
    第2のソース電極層又は前記第2のドレイン電極層と電気的に接続された画素電極層を有し
    記酸化物絶縁層上に前記第1のゲート電極層及び前記第1の酸化物半導体層と重なる導電層を有し
    記画素電極層及び前記導電層上に液晶層を有し
    前記液晶層上に対向電極層を有し
    前記駆動回路部において前記対向電極層は開口を有することを特徴とする半導体装置。
  2. 請求項1において、
    前記画素部において前記対向電極層は平板状であることを特徴とする半導体装置。
  3. 請求項1又は2において、
    前記駆動回路部において前記対向電極層は、前記導電層と前記液晶層を介して重なることを特徴とする半導体装置。
  4. 請求項1乃至3のいずれか一項において、
    前記対向電極層は固定電位であることを特徴とする半導体装置。
  5. 請求項1乃至4のいずれか一項において、
    第1の酸化物半導体層のチャネル向において、前記開口を有する対向電極層の幅の方が前記導電層の幅より大きいことを特徴とする半導体装置。
  6. 請求項1乃至4のいずれか一項において、
    第1の酸化物半導体層のチャネル向において、前記開口を有する対向電極層の幅の方が前記第1の酸化物半導体層の幅より大きいことを特徴とする半導体装置。
  7. 同一基板上に、第1のトランジスタを含む駆動回路部と、第2のトランジスタを含む画素部とを有し、
    前記第1のトランジスタは、第1のゲート電極層と、前記第1のゲート電極層上のゲート絶縁層と、前記ゲート絶縁層上の第1の酸化物半導体層と、前記第1の酸化物半導体層上の第1のソース電極層と、前記第1の酸化物半導体層上の第1のドレイン電極層と、を有し、
    前記第2のトランジスタは、第2のゲート電極層と、前記第2のゲート電極層上の前記ゲート絶縁層と、前記ゲート絶縁層上の第2の酸化物半導体層と、前記第2の酸化物半導体層上の第2のソース電極層と、前記第2の酸化物半導体層上の第2のドレイン電極層と、を有し、
    前記第1及び前記第2の酸化物半導体層、前記第1及び前記第2のソース電極層上、及び前記第1及び前記第2のドレイン電極層上に前記酸化物半導体層の一部及び前記第2の酸化物半導体層の一部と接する酸化物絶縁層を有し、
    第2のソース電極層又は前記第2のドレイン電極層と電気的に接続された画素電極層を有し
    記酸化物絶縁層上に前記第1のゲート電極層及び前記第1の酸化物半導体層と重なる導電層を有し
    記画素電極層及び前記導電層上に液晶層を有し
    前記画素部において前記液晶層上に第1の対向電極層を有し
    前記駆動回路部において前記液晶層上に前記第1の対向電極層と同電位の第2の対向電極層を有し、
    前記第2の対向電極層は、開口を有することを特徴とする半導体装置。
  8. 請求項7において、
    前記1の対向電極層は平板状であることを特徴とする半導体装置。
  9. 請求項7又は請求項8において、
    前記第2の対向電極層は、前記導電層と前記液晶層を介して重なることを特徴とする半導体装置。
  10. 請求項7乃至9のいずれか一項において、
    前記第1の対向電極層及び前記第2の対向電極層は固定電位であることを特徴とする半導体装置。
  11. 請求項7乃至10のいずれか一項において、
    第1の酸化物半導体層のチャネル向において、前記開口を有する対向電極層の幅の方が前記導電層の幅より大きいことを特徴とする半導体装置。
  12. 請求項7乃至10のいずれか一項において、
    第1の酸化物半導体層のチャネル向において、前記第2の対向電極層の幅の方が前記第1の酸化物半導体層の幅より大きいことを特徴とする半導体装置。
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