CN1034703C - 异质结双极晶体管 - Google Patents
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Abstract
一种异质结双极晶体管技术，包括在一埋层电极层上较大面积的基极电极层上提供一较小面积的电极，在该较小面积电极的一部分上形成一凸出物，以它作为掩膜能够将基极外部区域转变成高电导率区，并且有助于基极接触金属的剥离过程，以使得基极接触金属与较小面积电极之间的距离十分接近。
Description
本发明涉及具有高性能、高微型化和高器件集成度的异质结双极晶体管。
请参照1988年8月31日提交的、系列号为238、830的美国申请，该申请涉及双极晶体管集成电路技术。
在双极晶体管技术领域中，由于高频率性能、高微型化和高器件集成度的不断发展，使得在晶体管的设计中，每改善其中一个参数，都会导致另一个参数变坏。
在异质结双极晶体管中特别是这样。异质结双极晶体管是由化合物半导体材料以叠层中阵列的形式制成的，往往由于制造过程中的工艺技术而限制了所要求的器件结构特征的可行性和可再现性。在这种结构中，需要对材料腐蚀工艺过程的精确性和淀积后材料布局的精确性这两个能力之间的制约进行权衡。因为，若要容忍並适应这些制约，就要影响器件的性能、微型化和再生产性、器件的结构和制造这种器件的材料对于再生产能力来说都是重要的。
在文献中已报导了三种具有高性能的异质结双极晶体管结构和有关的方法。所有这三种结构都是在较大面积的材料层上形成外延发射极的，这些材料层在随后的成形和适当的变换中成为器件的基极和集电极。
在1985年IEEE IEDM Proceedings第328-331页中描述的结构和方法中提及一种AlGaAs/GaAs异质结双极晶体管，其中，外延的N-AlGaAs-N+GaAs发射极形成在大面积p + AlGaAs基区之上，发射极的侧壁被一侧壁绝缘层所覆盖，该绝缘层起到对准基极接触部件的作用。在制造过程中需要特别小心，以使得在反复进行基极金属的剥离时不发生短路。另外，在无自然中断(natural stop)地用腐蚀剂进行的腐蚀操作中也需要特别小心。
在1986年11月的IEEE Electron Device letters，Vol EDL-7 No.11第615-617页中描述的结构和方法中，依靠对准操作，将发射极接触安排在外延发射极电极的内侧。这种结构需要容忍对于对准的精确度的限制，因此，发射极的面积要大些。这样做本身就导致基区有较大的本征电阻。在这些条件下，这种结构的发射极-基极和集电极-基极间的电容也比较大。
在1986年12月的IEEE Electron Device letters，Vol。EDL-7 №12第694-696中描述的结构和方法中，AuGe被用作湿法腐蚀的抗蚀层，并且也被用作发射极接触，该发射极接触的突出部分在基极接触的淀积过程中起到控制基极接触与之相接的作用。这种结构和方法受到四种限制，它们会影响器件的重复生产性和性能。金合金在腐蚀中需要很细心，在湿法腐蚀中，要将GaAs腐蚀掉1000A0、AlGaAs腐蚀掉2000A0，並在p型GaAs层腐蚀到1000A0时停止，这是很难控制的，正如所说的，基极没有保证基区的外部变成较高电导率来减少基极电阻。如果这样一种p+外基区的变化是经离子注入得到的，则将不能进行相继的注入退火，这是因为AuGe合金的存在对温度产生了制约。在采用常规的接触孔腐蚀和绝缘方法时，发射极面积不得不做得足够大，以适应淀积互连线的需要。
随着这种技术的发展，对于器件的性能来说，重要的是要使电学器件的电阻和电容参数尽可能小，并采用那些工艺参数以使得能采用自然停止和避免材料浪费的技术。
本发明的目的是提供一种高性能、高微型化的异质结双极晶体管。
本发明的另一个目的是提供一种高性能、高微型化的异质结双极晶体管的制造方法。
上述目的可以用本发明的异质结双极晶体管来实现，其特征在于包括一化合物半导体单晶本体，所述本体具有一较大面积的基极电极层，该基极电极层与埋层电极层形成p-n结，在所述基极电极层的另一侧有一较小面积的外延电极，该电极与所述基极电极层形成p-n结；所述基极电极层具有一高电导率的外基极部分，该外基极部分围绕着并延伸到所述较小面积电极的p-n结的附近，但又相隔一特定距离，从而确定了內基极电极的面积和基极电极与埋层电极的p-n结面积；与所述基极层的外基极部分相接的金属接触，其距所述较小面积电极有一特定距离；所述本体中的一隔离区，该隔离区至少延伸穿过所述埋层；围绕着较小面积电极的一绝缘层，该绝缘层完金覆盖住所述金属接触，并有一与所述较小面积电极齐平的平表面，以及位于所述平表面上的接触元件，为所述较小电极、金属接触和埋层电极提供各自的电连接。
本发明的另一个目的是通过本发明的异质结双极晶体管的制造工艺来实现的，其中，所述晶体管形成在一利类型的单晶化合物半导体本体上，它在较大面积基极电极层的一侧与埋层电极层形成一p-n结，而在所述基极电极层的另一侧与较小面积的电极形成一p-n结，其特征在于包括下述步骤的组合；提供一多层单晶本体，该本体至少在所述埋层电极层上具有与之成p-n结关系的所述基极层；在所述基极电极层上形成与之成p-n结关系的所述较小面积电极；所述形成步骤包括在较小面积电极与所述基极层垂直隔开的那部分上提供一个凸出物；所述凸出物水平延伸超出所述较小面积电极的p-n结一段距离；将围绕着所述较小面积电极的所述基极层的电导率变换为高电导率，所述凸出物在所述电导率变换中起到掩模的作用，以靠近但又与所述较小面积电极p-n结隔开所述一段距离的位置关系刻划出所述电导率变换后的基极层区域的边缘位置；在所述基极层的变换后的部分和所述较小面积电极上淀积一金属；把所述变换后的那部分所述基极电极和所述较小面积电极上的所述金属部分分隔开来；围绕着所述较小面积电极施加一绝缘层；在所述绝缘层上施加一层共形平面化材料；腐蚀所述平面化材料层与所述绝缘层的组合体直至约缘材料的一个平表面与所述较小面积电极的较高部分水平；以及在所述平表面上为所述较小面积电极、所述基极的变换后的那部分上的所述金属以及与各电极电连接的所述埋层电极中的每一个施加一分立的金属接触。
下面将结合附图描述本发明。
图1至10示出在制造本发明的异质结双极晶体管梯形凸出发射极的过程中形成的中间结构和最终结构。
图1示出最初的衬底及衬底上的各外延层。
图2、3和4分别示出在制造梯形凸出发射极的过程中形成的抗蚀剂、外延层和最终形状。
图5示出由梯形凸出发射极提供的基极离子注入和基极接触对准的控制。
图6说明集电极接触和绝缘区的形成。
图7示出由梯形凸出发射极控制的基极接触金属化区域。
图8示出钝化层和平面化层的应用。
图9示出梯形发射区凸出物顶部在形成平面金属化区域时的作用。
图10示出完成的异质结双极晶体管结构。
图11至19示出在制造本发明的异质结双极晶体管侧壁淀积发射极凸出物的过程中形成的中间结构和最终结构。
图11为层状的初始材料。
图12和13示出在生长发射极结构过程中形成的中间结构。
图14和15示出在制造侧壁淀积凸出发射极结构的过程中形成的中间结构。
图16示出外基区、集电极接触和隔离区的形成情况。
图17示出基区接触和平面化导引物的金属化。
图18示出平面化层和绝缘层。
图19示出完成的异质结双极晶体管。
图20至28示出在制造本发明的异质结双极晶体管顶部淀积凸出发射极的过程中形成的中间结构和最终结构。
图20为层状的初始材料。
图21和22示出形成顶部淀积发射极结构时的中间结构。
图23示出外基区、集电极接触和隔离区。
图24示出外基区接触和平面化导引物的金属化。
图25、26和27示出形成平面结构的中间结构。
图28示出完成的异质结双极结构。
由于目前集成电路技术领域中采用的异质结双极晶体管大多数包括埋层集电极和暴露的发射极，因此描述这种结构。然而，从发展的眼光看，本领域普通技术人员都很清楚：发射极和集电极的作用是可以互换的。
本发明的结构原则是：发射极电极位于基极电极之上，而基极电极本身又位于集电极电极之上，其中，发射极与基极形成一个结，并且具有如下特征：
发射极-基极结的面积就是为形成晶体管器件所设计的面积，
发射极与能凸出在发射极-基极结之上、并与其隔开一段距离的凸出物联成一体，发射极-基极结横向延伸到与基极所在层的外部部分相吻合，该凸出物在侧壁和顶部之间有一凸缘，
基极层的內部部分被限定在发射极-基极结与集电极-基极结的面积之间，基极层的外部部分具有很高的电导率，
一平面绝缘层在由发射极凸出物顶部建起的高台上延伸，
基极接触有两个部分，第一部分位于外基区之上，第二部分位于隔离区之上。
该结构原则具有几种与之相关的制造方法。发射极凸出物首先作为离子注入的掩模，它使得发射结面积之外的基极层部分转换成高电导层。该凸出物还为提供一个实用的“剥离”凸缘而作为可靠的和可重复的隔离点，使得外基极的金属接触能够非常靠近发射极。此后，位于凸出物之上的金属层残留物作为绝缘层平面的导引物，这层平面化的绝缘层形成了支撑由各自的接触连接基极和集电极的总体导线的平面。
参照图1，首先提供一个化合物半导体结构，和本领域标准技术一样，它是由重叠放置在具有缓冲层的衬底上的集电极和基极层组成的。图1所示的结构是采用本技术领域中常规的分子束外延(MBE)或者金属有机化学汽相淀积(MOCVD)技术逐层形成的。
在半绝缘(SI)GaAs衬底1上生长一层厚度为0.5微米量级的GaAs缓冲层，以减少衬底1中缺陷的影响。在缓冲层2之上生长一层厚度为0.5至1微米量级的n+GaAs层3。在层3上生长一层厚度约为0.2微米的n型AlGaAs层4，在层4上生长一层厚度约为0.15微米的p型GaAs层5。
下面，参照图2、3和4说明梯形凸出发射极结构和制造过程。在图2中，按照本发明，在层5的表面6上淀积一层SiO27，在层7上形成开孔8，开孔8中表面6所暴露的部分其尺寸由所设计的器件的电特性决定。层7约为3500厚，开孔8的侧壁9提供了一个约为600的斜面。这个斜度可以由如下方法获得：首先在用于光刻的抗蚀剂上形成一个类似的斜度，然后将显影后的抗蚀剂放在较高温度下回流，再通过对二氧化硅和抗蚀剂具有相同刻蚀速度的CF4反应离子刻蚀，使抗蚀剂上的斜度复制在下层的氧化层7上。开孔的形成参数这样安排，以使得开孔8底部的表面6的暴露面积为器件中发射极所设计的面积。
接下来，可参见图3，在表面6和整个层7之上外延生长一层厚度约为0.1微米的n型AlGaAs层10，然后，在层10之上外延生长一层厚度约为0.4微米的n+GaAs层11，层11与层10形状相似。
下面参照图4，采用例如化学/机械抛光，离子研磨或反应离子刻蚀等技术去除层7之上的那部分层11和层10。尤其在采用离子研磨或反应离子刻蚀技术时，可以首先覆盖一层例如聚酰亚胺这样的平面化材料。在将SiO2层7之上的层11和10去除之后，使用例如稀释的HF酸将层7本身去除掉。这个操作之后，就得到了图4所示的结构。梯形凸出的发射极的发射极-基极结是在层5的表面6的一部分上通过外延形成的，该表面6的一部分在层7去除之前就是开孔8所在的位置。
下面参照图5进行说明，图5示出梯形凸出发射极的特征示意图。在图5中，除了发射极-基极结是设计的面积之外，凸出部分13使得区域14和15能够通过离子注入进行的垂直杂质引入操作而转化成高电导率层，例如p+层，采用例如镁作为杂质。区域16接近发射结12，但与发射结12隔开大约0.2微米。
由图5所示的梯形凸出发射极所获得的其它优点还有：梯形形状带来的尖锐凸缘18为后序的剥离金属化操作提供了一个清晰的分界面；另外，简单地靠可以控制的层7的厚度(在图2所示步骤中形成的)就可得到在后序的平面化操作中所采用的发射极高度。
当垂直杂质引入操作为本技术领域中熟知的离子注入技术时，进行退火操作，对临界尺寸和杂质分布的有害影响最小。
在图6至10中描述了器件的金属化和绝缘层。
在图6所示的结构中，应用常规的光刻技术形成隔离区20和21以及集电极接触22。对区域20和21可以采用硼离子注入形式。当采用离子注入技术时，经常可能将所有的退火(包括对外基区14和15、绝缘区20和21以及集电极接触22的退火)都集中到同一温度过程中进行。
参照图7说明外基区上基极接触和发射极上平面化导引物(guide)的形成情况。应用适当的、本领域熟知的光刻和剥离技术，形成与外基区的接触23和24以及发射极25的金属覆盖层，例如，可采用0.2微米厚的Au/Mn层覆盖在发射极上得到上述金属覆盖层。按照本发明，在将金属淀积到外基极和发射极上时，发射极梯形凸出的形状限制了外基区的接触23和24的横向延伸，使得它们很接近发射极，但又与之隔开。在剥离操作中，凸缘18使基极接触23和24与发射极平面导引物25之间有一个所需要的、清晰的间隙。基极接触23和24可以按需要向远离发射极的方向横向延伸，包括如图所示那样覆盖住隔离区21的一部分。
按照本发明，如图7所示那样完成的结构有这些优点：有利于与阵列接触或者有利于提供总体导线，这种操作通常是大面积的淀积工序。
下面参照图8说明带有内设的平面化导引中止端的绝缘化和平面化情况。在整个结构上形成一层二氧化硅26，然后用涂覆方法将一层平面化材料(例如聚酰亚胺)27覆盖在层26之上，以使其达到总的高度。对绝缘层26的电绝缘特征进行选择，并且要选择绝缘层和平面化材料具有相同的刻蚀速率。
图9所示出的结构为互连线提供了一个平的表面，参照图9，通过本技术领域中常规技术，如化学和/或机械拋光、离子研磨和溅蚀，将层26和层27腐蚀到平面28。在这步工艺中，区域25起到将水平面建立在发射极顶部的导引物作用。
图10中示出完成了的器件，其中，在平面28上采用标准的光刻-腐蚀技术，分别形成集电极和基极接触所用的接触通路29和30，然后通过光刻和金属淀积，分别形成发射极、基极和集电极的总体导线接触31、32和33。这时，由于平面28位于发射极的顶部，所有的接触都位于同一水平面28之上，使总体导线增加了简便性和可靠性，并且由于两部分基极接触结构23和32的位置具有灵活性，可使基极接触32远离发射极31。
以下参照图11至19，其中采用了侧壁淀积的凸出发射极结构。图中使用的标号与前述图中的相同。
在图11中采用初始的单晶化合物半导体，其层1至层5与图1所示的结构相同。在图11中一层厚度约为3500的SiOx35淀积在层5之上。
图12中，通过光刻和采用例如CF4的反应离子刻蚀(RIE)，形成窗口36，其尺寸为所要制造的器件的发射极-基极结的面积。
如图13所示，在层5暴露在窗口36中的那部分外延生长本技术领域中常规的两层发射极结构。这可以由分子束外延来实现，在层5上生长一层厚度为0.1微米的n-AlGaAs外延层37，然后再在层37上生长一层厚度为0.45微米的n-GaAs外延层38。然后腐蚀层35的表面，使n-GaAs(38)暴露出一部分侧壁，其凸出高度39约为0.2微米。
通过化学汽相淀积，在层35表面上淀积一层SixNy，其厚度与高度39的大小近似相等，然后用反应离子刻蚀(RIE)从表面去除SixNy，留下如图14所示的侧壁淀积凸出部分40。
采用稀释的HF的湿法腐蚀或者各向同性的等离子刻蚀去除整个SiOx层35，结果，如图15所示，仅留下由外延层37和38以及侧壁淀积的凸出物40组成的发射极结构。
参照图16，应用成形后的抗蚀剂层形成集电极接触通路22，以供通过其进行n+杂质注入(例如硅)。然后，采用另一光致抗蚀剂图形层作掩膜，注入p+杂质，例如Be或Mg，形成p+外基区14和15，凸出物40确定了与发射极相邻的区域14和15的内侧边界。接着进行热退火过程以激活全部注入离子。然后注入硼，形成隔离区20和21，並退火。
下面参照图17，通过光刻金属蒸发技术，形成一厚度约为0.2微米的AuMn金属层，然后，经过剥离，形成互相隔开的外基极接触23和24以及平面化导引物25。在剥离过程中，层37和38的高度以及凸出物40形成的凸缘确保金属层被清楚地隔开。
下面参照图18，利用化学汽相淀积之类的技术在整个结构之上淀积一层厚度约为0.6微米的绝缘层26，例如SiOx层。然后形成平面化材料层27，例如聚酰亚胺。然后用RIE刻蚀层26和27，直到露出金属平面化导引物25为止。
采用化学/机械抛光，离子研磨或溅蚀技术，将金属层25、SixNy凸出物40、材料层26、27和层38的顶部同时去除，以形成平面。当凸出物40被去除后，层38减薄了。
参照图19，图中示出最终结构，其中刻蚀的结果产生了一平的表面28，利用光刻和RIE技术，分别形成集电极和基极接触孔29和30。然后利用光刻和金属淀积(例如AuGeNi)分别形成发射极、基极和集电极接触31、32和33，並通过剥离技术限定其轮廓。最终的结构具有图10所述结构的全部优点。
在图20至28中，结合顶部淀积的凸出发射极描述本发明。该发射极的层生长在初始晶片的一部分上。为有利于以下的说明，采用了相同的标号、典型的材料以及导电类型。
在图20中，采用MOCVD或MBE方法生长最初的化合物半导体多层晶体，其中，在半绝缘GaAs衬底1上连续生长厚度约为0.5微米的GaAs缓冲层2、厚度约为0.5～1微米的n+-GaAs下集电极层3、厚度约为0.2微米的n-AlGaAs集电极层4、厚度约为0.15微米的p-GaAs基极层5，厚度约为0.1微米的n-AlGaAs第一发射极层41和厚度约为0.4微米的n+-GaAs第二发射极层42。应用化学汽相淀积法淀积一层厚度约为2500的SiOx层43。
参照图21，将层42和43除去，仅留下一个岛，这个岛的面积为所要制造的器件的发射极设计面积。腐蚀是这样进行的：采用光刻法在抗蚀剂上开窗口，然后用CF4RIE腐蚀SiOx层43，用CCl2F2-He RIE刻蚀n+GaAs层。
参照图22，在腐蚀n+GaAs层42时，调节等离子的条件使得对表面44的腐蚀更容易些。这样，在层43上形成下边缘45，结果提供了一个凸出物，凸出的尺寸达0.2微米。
下面参照图23说明外基区、集电极接触孔以及隔离区的形成情况。
应用光刻胶图形层(未示出)作为掩膜进行多能量的离子注入，例如，注入硅，以提供n+集电极接触通路22。
然后应用另一光刻胶图形层(未示出)作为掩膜来进行离子注入，例如，注入Be或Mg，以形成p+外基区46和47。注入深及层41和基极层5，直到集电极层4。用具有凸出物45的层43作为掩膜来限定p+外基区46和47的边缘48和49。
在最终结构中要求设置边缘48和49，以使在后序工艺中形成的外基区的金属接触不会延伸超出边缘48和49。这种延伸是通过与激活注入离子的加热过程分开的或作为该过程一部分的p+杂质扩散而产生的，这一加热过程使边缘48和49横向向发射极移动。移动量级约为0.1微米，或者说达到0.2微米的凸出物的一半。在离子注入过程中使晶片摇动(tilting)，可以产生同样的效果。
在对外基区离子注入进行退火之后，应用另一掩膜进行离子注入，例如注入硼，以形成隔离区20和21，然后再进行退火。
下面参照图24，给外基极46和47提供金属接触，同时也给作为平面导引物的层43提供金属接触。这可以通过应用剥离光刻技术和金属淀积(例如淀积厚度为0.25微米的AuMn)来得到。在剥离操作中，金属层将靠凸出物45的凸缘和层42的高度而被清楚地分开。在最后得到的结构中，外基极接触23和24以及平面导引物50都在原位，而外基区边缘48和49则在上述的加热过程中向着发射极方向移动。
在图25中，形成一层化学汽相淀积的SiOx绝缘层26，其厚度约为5000，然后，再形成一层平面化材料(例如聚酰亚胺)层27。
在图26中，应用RIE技术(例如CF4 RIE)将层27和26以同样的速率刻除，直到平面导引物50露出为止。
平面导引物50提供了一个标示，在此处改变腐蚀技术，使得能去除导引物50和层43，直至发射层42的顶部。这种结构示于图27中，其中，绝缘层26具有一个与发射极层42齐平的表面51，这就为总体互连线提供了一个平坦的表面。
如果有足够的控制能力，就可以对从图25到图27中所有的刻蚀过程采用相同的刻蚀技术。在去除金属平面导引物50和层43时，可以采用化学/机械拋光、溅蚀或者离子研磨技术。
接着，通过光刻和CF4RIE技术，为基极和集电极开出窗孔52和53，然后分别淀积发射极、基极和集电极接触31、32和33，再进行烧结加热过程得到金属合金，以形成图28的结构。
这里所描述的是一个异质结双极晶体管结构，其中所有的电阻和电容特性是可以控制的，并且给出了得到该结构的三种方法。
Claims (11)
1.一种异质结双极晶体管，其特征在于包括：
一化合物半导体单晶本体；
所述本体具有一较大面积的基极电极层，该基极电极层与埋层电极层形成真p-n结，在所述基极电极层的另一侧有一较小面积的外延电极，该电极与所述的基极电极层形成p-n结，
所述基极电极层具有一高电导率的外基极部分，该外基极部分围绕并延伸到所述较小面积电极p-n的附近，但又相隔一特定距离，从而确定了內基极电极的面积和基极电极与埋层电极的p-n结的面积，
与所述基极层的外基极部分相接的金属接触，其距所述较小面积电极有一特定距离，
所述本体中的一隔离区，该隔离区至少延伸穿过所述埋层，
围绕着较小面积电极的一绝缘层，该绝缘层完全覆盖住所述金属接触，并有一与所述较小面积电极齐平的平表面，以及
位于所说平表面上的接触元件，为所述较小电极、金属接触区和埋层电极提供各自的电连接。
2.根据权利要求1的晶体管，其特征在于，所述较小面积的包极为发射极。
3.根据权利要求2的晶体管，其特征在于，所述发射极的形状为梯形。
4.根据权利要求2的晶体管，其特征在于，所述的基极电极层为p-n型AlGaAs，所述埋层为n型AlGaAs，所述发射极由与基极相邻的第一层n型AlGaAs和远离所述基极层的第二层n+-GaAs组成。
5.一种异质结的双极晶体管的制造工艺，该晶体管形成在一种类型的单晶化合物半导体本体上，该本体在较大面积基极电极层的一侧与埋层电极层形成一p-n结，而在所述基极电极层的另一侧与较小面积的电极形成一p-n结，其特征在于包括下述步骤的组合：
提供一多层单晶本体，该本体至少在所述埋层电极层上具有与之成p-n结关系的所述基极层；
在所述基极电极层上形成与之成p-n结关系的所述较小面积电极；
所述形成步骤包括在较小面积电极与所述基极层垂直隔开的那部分上提供一个凸出物；
所述凸出物水平延伸超出所述较小面积电极的p-n结一段距离；
将围绕着所述较小面积电极的所述基极层的电导率变换为高电导率，所述凸出物在所述电导率变换中起到掩模的作用，以靠近但又与所述较小面积电极p-n结隔开所述一段距离的位置关系刻划出所述电导率变换后的基极层区域的边缘位置；
在所述基极层的变换后的部分和所述较小面积电极上淀积一金属；
把所述变换后的那部分所述基极电极和所述较小面积电极上的所述金属部分分隔开来；
围绕着所述较小面积电极施加一绝缘层；
在所述绝缘层上施加一层共形平面化材料；
腐蚀所述平面化材料层与所述绝缘层的组合体直至约缘材料的一个平表面与所述较小面积电极的较高部分水平；以及
在所述平表面上为所述较小面积电极、所述基极的变换后的那部分上的所述金属、以及与各电极电连接的所述埋层电极中的每一个施加一分立的金属接触区。
6.根据权利要求5的制造工艺，其特征在于，所述较小面积电极为所述晶体管的发射极，它的第一、第二外延生长层为半导体材料。
7.根据权利要求6的制造工艺，其特征在于，所述第一、第二发射极层通过掩模上的窗口生长，与所述基极层相接触。
8.根据权利要求7的制造工艺，其特征在于，所述掩模上的窗口有一斜的侧面，在所述掩模不与所述基极层相接触的那一侧具有较大的窗口，从而提供了一梯形形状。
9.根据权利要求7的制造工艺，其特征在于，所述凸出物是通过在所述发射极侧面的最上部淀积材料而提供的。
10.根据权利要求6的制造工艺，其特征在于，所述发射极是通过在所述多层单晶本体上形成第一和第二发射极层、并腐蚀掉所述较小面积之外的所有层而形成的。
11.根据权利要求10的制造工艺，其特征在于，所述凸出物是通过在所述的发射极上淀积一层凸出部分而形成的。
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Legal Events
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| C10 | Entry into substantive examination | ||
| SE01 | Entry into force of request for substantive examination | ||
| C06 | Publication | ||
| PB01 | Publication | ||
| C14 | Grant of patent or utility model | ||
| GR01 | Patent grant | ||
| C15 | Extension of patent right duration from 15 to 20 years for appl. with date before 31.12.1992 and still valid on 11.12.2001 (patent law change 1993) | ||
| OR01 | Other related matters | ||
| C19 | Lapse of patent right due to non-payment of the annual fee | ||
| CF01 | Termination of patent right due to non-payment of annual fee |