TWI410944B - 顯示裝置之移位暫存器 - Google Patents

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TWI410944B TW098119353A TW98119353A TWI410944B TW I410944 B TWI410944 B TW I410944B TW 098119353 A TW098119353 A TW 098119353A TW 98119353 A TW98119353 A TW 98119353A TW I410944 B TWI410944 B TW I410944B
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Description

顯示裝置之移位暫存器
本發明相關於一種移位暫存器，尤指一種液晶顯示器之移位暫存器。
液晶顯示器(liquid crystal display,LCD)具有低輻射、體積小及低耗能等優點，已逐漸取代傳統的陰極射線管顯示器(cathode ray tube display,CRT)，因而被廣泛地應用在筆記型電腦、個人數位助理(personal digital assistant,PDA)、平面電視，或行動電話等資訊產品上。傳統液晶顯示器之方式是利用外部驅動晶片來驅動面板上的畫素以顯示影像，但為了減少元件數目並降低製造成本，近年來逐漸發展成將驅動電路之結構直接製作於顯示面板上，例如應用將閘極驅動電路(gate driver)整合於液晶面板(gate on array,GOA)之技術。
請參考第1圖，第1圖為先前技術中一液晶顯示裝置100之簡化方塊示意圖。第1圖僅顯示了液晶顯示裝置100之部分結構，包含複數條閘極線GL(1)～GL(N)、一移位暫存器(shift register)110、一時脈產生器120和一電源供應器130。時脈產生器120可提供移位暫存器110運作所需之起始脈衝訊號VST和兩時脈訊號CK和XCK，而電源供應器130可提供移位暫存器110運作所需之操作電壓VSS。時脈訊號CK和XCK以預定週期在高低電位之間切換極性，且在同一時間具相反極性。移位暫存器110包含有複數級串接之移位暫存單元SR(1)～SR(N)，每一級移位暫存單元耦接於相對應之閘極線、下一級移位暫存單元之第一輸入端IN1，以及前一級移位暫存單元之第二輸入端IN2。依據時脈訊號CK、XCK和起始脈衝訊號VST，移位暫存器110可分別透過移位暫存單元SR(1)～SR(N)依序輸出閘極驅動訊號GS(1)～GS(N)至相對應之閘極線GL(1)～GL(N)。
請參考第2圖，第2圖為先前技術之液晶顯示裝置100中一第n級移位暫存單元SR(n)之示意圖(n為介於1和N之間的整數)。移位暫存單元SR(n)包含一第一輸入端IN1、一第二輸入端IN2、一輸出端OUT、一節點Q(n)、一輸入電路10、一提升電路(pull-up circuit)20、一下拉電路(pull-down circuit)30，以及一維持電路40。移位暫存單元SR(n)之第一輸入端IN1耦接於前一級移位暫存單元SR(n-1)之輸出端OUT，第二輸入端IN2耦接於下一級移位暫存單元SR(n+1)之輸出端OUT，而輸出端OUT(n)耦接於下一級移位暫存單元SR(n+1)之第一輸入端IN1和閘極線GL(n)。在先前技術之液晶顯示裝置100中，輸入電路10之電晶體開關T1依據前一級閘極驅動訊號GS(n-1)來維持節點Q(n)之電位，提升電路20之電晶體開關T2和T3分別依據節點Q(n)之電位和下一級閘極驅動訊號GS(n+1)來輸出閘極驅動訊號GS(n)，下拉電路30之電晶體開關T4依據下一級閘極驅動訊號GS(n+1)來維持節點Q(n)之電位，而維持電路40之電晶體開關T5依據時脈訊號CK來控制節點Q(n)和輸出端OUT之間的訊號導通路徑。先前技術之液晶顯示裝置100需依據下一級閘極驅動訊號GS(n+1)來維持節點Q(n)之電位，電路佈局複雜，同時亦無法有效地維持輸出端OUT之電位。
請參考第3圖，第3圖為先前技術中一液晶顯示裝置200之簡化方塊示意圖。第2圖僅顯示了液晶顯示裝置200之部分結構，包含複數條閘極線GL(1)～GL(N)、一移位暫存器210、一時脈產生器220和一電源供應器230。時脈產生器220可提供移位暫存器210運作所需之起始脈衝訊號VST和兩時脈訊號CK和XCK，而電源供應器230可提供移位暫存器210運作所需之操作電壓VDD和VSS。時脈訊號CK和XCK以預定週期在高低電位之間切換極性，且在同一時間具相反極性。移位暫存器210包含有複數級串接之移位暫存單元SR(1)～SR(N)，每一級移位暫存單元之輸出端耦接於相對應之閘極線和下一級移位暫存單元。依據時脈訊號CK、XCK和起始脈衝訊號VST，移位暫存器210可分別透過移位暫存單元SR(1)～SR(N)依序輸出閘極驅動訊號GS(1)～GS(N)至相對應之閘極線GL(1)～GL(N)。
請參考第4圖，第4圖為先前技術之液晶顯示裝置200中一第n級移位暫存單元SR(n)之示意圖(n為介於1和N之間的整數)。移位暫存單元SR(n)包含一輸入端IN(n)、一輸出端OUT(n)、一輸入電路10、一提升電路20，以及一下拉電路30。移位暫存單元SR(n)之輸入端IN(n)耦接於前一級移位暫存單元SR(n-1)，而輸出端OUT(n)耦接於下一級移位暫存單元SR(n+1)和閘極線GL(n)。在先前技術之液晶顯示裝置200中，輸入電路10之電晶體開關T1依據前一級閘極驅動訊號GS(n-1)來維持節點Q1(n)之電位，提升電路20之電晶體開關T2和T3分別依據節點Q1(n)和Q2(n)之電位來輸出閘極驅動訊號GS(n)，下拉電路30之電晶體開關T4～T6則用來維持節點Q1(n)和Q2(n)之電位。先前技術之液晶顯示裝置200不需使用下一級閘極驅動訊號GS(n+1)來做為回授訊號，但仍有電路佈局複雜的缺點。
本發明提供一種移位暫存器，其包含複數級串接之移位暫存單元，其中每一級移位暫存單元包含一輸入端、一輸出端、一第一節點、一第二節點、一輸入電路、一提升電路，以及一下拉電路。該級移位暫存單元於輸入端接收一輸入電壓，並於輸出端提供一輸出電壓。輸入電路依據該輸入電壓之電位來控制一第一時脈訊號和該第一節點之間的訊號導通路徑。提升電路依據該第一節點之電位來控制一第二時脈訊號和該輸出端之間的訊號導通路徑以提供該輸出電壓，其中該第一和第二時脈訊號係以一預定週期在一高電位和一低電位之間切換極性，且在同一週期內該第一和第二時脈訊號之極性相反。下拉電路包含一下拉單元和一控制單元。該下拉單元依據該第二節點之電位來維持該第一節點或該輸出端之電位，而該控制單元依據該第一時脈訊號、該第二時脈訊號和該第一節點之電位來維持該第二節點之電位。
本發明另提供一種移位暫存器，其包含複數級串接之移位暫存單元，其中每一級移位暫存單元包含一輸入端、一輸出端、一第一節點、一第二節點、一輸入電路、一提升電路，以及一下拉電路。該級移位暫存單元於輸入端接收一輸入電壓，並於輸出端提供一輸出電壓。輸入電路依據該輸入電壓之電位來控制一第一時脈訊號和該第一節點之間的訊號導通路徑。提升電路依據該第一節點之電位來控制一第二時脈訊號和該輸出端之間的訊號導通路徑以提供該輸出電壓，其中該第一和第二時脈訊號係以一預定週期在一高電位和一低電位之間切換極性，且在同一週期內該第一和第二時脈訊號之極性相反。下拉電路包含一下拉單元和一控制單元。該下拉單元依據該第二節點之電位來維持該第一節點或該輸出端之電位，而該控制單元依據依據一偏壓和該第一節點之電位來維持該第二節點之電位。
請參考第5圖，第5圖為本發明中一液晶顯示裝置300之簡化方塊示意圖。第5圖僅顯示了液晶顯示裝置300之部分結構，包含複數條閘極線GL(1)～GL(N)、一移位暫存器310、一時脈產生器320和一電源供應器330。時脈產生器320可提供移位暫存器310運作所需之起始脈衝訊號VST和兩時脈訊號CK和XCK，而電源供應器330可提供移位暫存器310運作所需之操作電壓VSS。時脈訊號CK和XCK以預定週期在高低電位之間切換極性，且在同一時間具相反極性。移位暫存器310包含有複數級串接之移位暫存單元SR(1)～SR(N)，每一級移位暫存單元之輸出端耦接於相對應之閘極線和下一級移位暫存單元之輸入端。依據時脈訊號CK、XCK和起始脈衝訊號VST，移位暫存器310可分別透過移位暫存單元SR(1)～SR(N)依序輸出閘極驅動訊號GS(1)～GS(N)至相對應之閘極線GL(1)～GL(N)。
請參考第6圖，第6圖為本發明第一實施例之液晶顯示裝置300中一第n級移位暫存單元SR(n)的示意圖(n為介於1和N之間的整數)。移位暫存單元SR(n)包含一輸入端IN(n)、一輸出端OUT(n)、節點Q(n)和P(n)、一輸入電路11、一提升電路21，以及一下拉電路31。移位暫存單元SR(N)之輸入端IN(n)耦接於前一級移位暫存單元SR(n-1)，而移位暫存單元SR(n)之輸出端OUT(n)耦接於下一級移位暫存單元SR(n+1)和閘極線GL(n)。
輸入電路11包含一電晶體開關T1，其閘極耦接於耦接於移位暫存單元SR(n)之輸入端IN(n)以接收閘極驅動訊號GS(n-1)，其汲極耦接於時脈產生器320以接收時脈訊號XCK，而其源極耦接於節點Q(n)，因此能依據閘極驅動訊號GS(n-1)來控制時脈訊號XCK和節點Q(n)之間的訊號導通路徑。提升電路21包含一電晶體開關T2，其閘極耦接於節點Q(n)，汲極耦接於時脈產生器320以接收時脈訊號CK，而源極耦接於之輸出端OUT(n)，因此能依據節點Q(n)之電位來控制時脈訊號CK和輸出端OUT(n)之間的訊號導通路徑。
下拉電路31包含一下拉單元41和一控制單元51，下拉單元41可依據節點P(n)之電位來維持節點Q(n)或輸出端OUT(n)之電位，而控制單元51可依據時脈訊號CK、時脈訊號XCK和節點Q(n)之電位來維持節點P(n)之電位。在本發明第一實施例之下拉電路31中，下拉單元41包含電晶體開關T3和T4：電晶體開關T3之閘極耦接於節點P(n)，汲極耦接於輸出端OUT(n)，而源極耦接於電源供應器330以接收操作電壓VSS，因此能依據節點P(n)之電位來維持輸出端OUT(n)之電位；電晶體開關T4之閘極耦接於節點P(n)，汲極耦接於節點Q(n)，而源極耦接於電源供應器330以接收操作電壓VSS，因此能依據節點P(n)之電位來維持節點Q(n)之電位。另一方面，控制單元51包含電晶體開關T5～T7：電晶體開關T5之閘極和汲極皆耦接於時脈產生器320以接收時脈訊號CK，而源極耦接於節點P(n)，因此能依據時脈訊號CK來維持節點P(n)之電位；電晶體開關T6之閘極和汲極皆耦接於時脈產生器320以接收時脈訊號XCK，而源極耦接於節點P(n)，因此能依據時脈訊號XCK來維持節點P(n)之電位；電晶體開關T7之閘極耦接於節點Q(n)，汲極耦接於節點P(n)，而源極耦接於電源供應器330以接收操作電壓VSS，因此能依據節點Q(n)之電位來維持節點P(n)之電位。
在第n級輸出週期外的其它時間內，移位暫存單元SR(n)係輸出具低電位之閘極驅動訊號GS(n)，因此節點Q(n)需維持在低電位以確保電晶體開關T2為關閉，如此閘極驅動訊號GS(n)之電位才不會被時脈訊號CK所影響。假設時脈訊號CK和XCK之責任週期(duty cycle)皆為1/2，此時由控制單元51中電晶體開關T5和T6來分別控制50%的下拉運作：當時脈訊號CK具高電位時，電晶體開關T5為導通而電晶體開關T6為關閉，節點P(n)會透過導通之電晶體開關T5拉至時脈訊號CK之高電位，進而開啟電晶體開關T3和T4以分別將輸出端OUT(n)和節點Q(n)拉至低電位偏壓VSS；當時脈訊號XCK具高電位時，電晶體開關T6為導通而電晶體開關T5為關閉，節點P(n)會透過導通之電晶體開關T6拉至時脈訊號XCK之高電位，進而開啟電晶體開關T3和T4以分別將輸出端OUT(n)和節點Q(n)拉至低電位偏壓VSS。
在第n級輸出週期內，節點Q(n)需維持在高電位以開啟電晶體開關T2，進而輸出具高電位之閘極驅動訊號GS(n)。在進入移位暫存單元SR(n)之輸出週期前，輸入電路11之電晶體開關T1會被前一級輸出週期之高電位閘極驅動訊號GS(n-1)開啟，進而將節點Q(n)拉至時脈訊號XCK之高電位。此時控制單元51之電晶體開關T7亦會被導通，因此節點P(n)會被拉至低電位偏壓VSS，進而關閉電晶體開關T3和T4以停止下拉運作。
請參考第7圖，第7圖為本發明第二實施例之液晶顯示裝置300中一第n級移位暫存單元SR(n)的示意圖(n為介於1和N之間的整數)。移位暫存單元SR(n)包含一輸入端IN(n)、一輸出端OUT(n)、節點Q(n)和P(n)、一輸入電路12、一提升電路22，以及一下拉電路32。本發明第二實施例之輸入電路12和提升電路22和第一實施例之輸入電路11和提升電路21之結構相同，不同之處在於本發明第二實施例中下拉電路32之結構。本發明第二實施例之下拉電路32包含一下拉單元42和一控制單元52。下拉單元42包含電晶體開關T3和T4，可依據節點P(n)之電位來維持節點Q(n)或輸出端OUT(n)之電位。控制單元52包含電晶體開關T5～T8，電晶體開關T5和T6可依據時脈訊號CK和XCK來維持節點P(n)之電位，而並聯之電晶體開關T7和T8能依據節點Q(n)之電位來維持節點P(n)之電位。並聯之電晶體開關T7和T8驅動能力較強，因此本發明第二實施例之液晶顯示裝置300在維持節點P(n)之電位時能提供更佳的下拉運作。
請參考第8圖，第8圖為本發明中一液晶顯示裝置400之方塊示意圖。第8圖僅顯示了液晶顯示裝置400之部分結構，包含複數條閘極線GL(1)～GL(N)、一移位暫存器410、一時脈產生器420和一電源供應器430。時脈產生器420可提供移位暫存器410運作所需之起始脈衝訊號VST和兩時脈訊號CK和XCK，而電源供應器430可提供移位暫存器410運作所需之操作電壓VDD和VSS。時脈訊號CK和XCK以預定週期在高低電位之間切換極性，且在同一時間具相反極性。移位暫存器410包含有複數級串接之移位暫存單元SR(1)～SR(N)，每一級移位暫存單元之輸出端耦接於相對應之閘極線和下一級移位暫存單元之輸入端。依據時脈訊號CK、XCK和起始脈衝訊號VST，移位暫存器410可分別透過移位暫存單元SR(1)～SR(N)依序輸出閘極驅動訊號GS(1)～GS(N)至相對應之閘極線GL(1)～GL(N)。
請參考第9圖，第9圖為本發明第三實施例之液晶顯示裝置400中一第n級移位暫存單元SR(n)的示意圖(n為介於1和N之間的整數)。移位暫存單元SR(n)包含一輸入端IN(n)、一輸出端OUT(n)、節點Q(n)和P(n)、一輸入電路13、一提升電路23，以及一下拉電路33。移位暫存單元SR(N)之輸入端IN(n)耦接於前一級移位暫存單元SR(n-1)，而移位暫存單元SR(n)之輸出端OUT(n)耦接於下一級移位暫存單元SR(n+1)和閘極線GL(n)。
輸入電路13包含一電晶體開關T1，其閘極耦接於移位暫存單元SR(n)之輸入端IN(n)以接收閘極驅動訊號GS(n-1)，其汲極耦接於時脈產生器420以接收時脈訊號XCK，而其源極耦接於節點Q(n)，因此能依據閘極驅動訊號GS(n-1)來控制時脈訊號XCK和節點Q(n)之間的訊號導通路徑。提升電路23包含一電晶體開關T2，其閘極耦接於節點Q(n)，汲極耦接於時脈產生器420以接收時脈訊號CK，而源極耦接於之輸出端OUT(n)，因此能依據節點Q(n)之電位來控制時脈訊號CK和輸出端OUT(n)之間的訊號導通路徑。
下拉電路33包含一下拉單元43和一控制單元53，下拉單元43可依據節點P(n)之電位來維持節點Q(n)或輸出端OUT(n)之電位，而控制單元53可依據時脈訊號CK、時脈訊號XCK和節點Q(n)之電位來維持節點P(n)之電位。在本發明第三實施例之下拉電路33中，下拉單元43包含電晶體開關T3和T4：電晶體開關T3之閘極耦接於節點P(n)，汲極耦接於輸出端OUT(n)，而源極耦接於電源供應器430以接收操作電壓VSS，因此能依據節點P(n)之電位來維持輸出端OUT(n)之電位；電晶體開關T4之閘極耦接於節點P(n)，汲極耦接於節點Q(n)，而源極耦接於電源供應器430以接收操作電壓VSS，因此能依據節點P(n)之電位來維持節點Q(n)之電位。另一方面，控制單元53包含電晶體開關T5和T6：電晶體開關T5之閘極和汲極皆耦接於電源供應器430以接收操作電壓VDD，而源極耦接於節點P(n)，因此能依據操作電壓VDD來維持節點P(n)之電位；電晶體開關T6之閘極耦接於節點Q(n)，汲極耦接於節點P(n)，而源極耦接於電源供應器430以接收操作電壓VSS，因此能依據節點Q(n)之電位來維持節點P(n)之電位。
在第n級輸出週期外的其它時間內，移位暫存單元SR(n)係輸出具低電位之閘極驅動訊號GS(n)，因此節點Q(n)需維持在低電位以確保電晶體開關T2為關閉，如此閘極驅動訊號GS(n)之電位才不會被時脈訊號CK所影響，此時由控制單元53之電晶體開關T5來控制下拉運作，透過導通之電晶體開關T5將節點P(n)拉至操作電壓VDD之高電位。在第n級輸出週期內，節點Q(n)需維持在高電位以開啟電晶體開關T2，進而輸出具高電位之閘極驅動訊號GS(n)。在進入移位暫存單元SR(n)之輸出週期前，輸入電路13之電晶體開關T1會被前一級輸出週期之高電位閘極驅動訊號GS(n-1)開啟，進而將節點Q(n)拉至時脈訊號XCK之高電位。此時下拉單元43之電晶體開關T6亦會被導通，因此節點P(n)會被拉至低電位偏壓VSS，進而關閉電晶體開關T3和T4以停止下拉運作。
請參考第10圖，第10圖為本發明第四實施例之液晶顯示裝置300中一第n級移位暫存單元SR(n)的示意圖(n為介於1和N之間的整數)。移位暫存單元SR(n)包含一輸入端IN(n)、一輸出端OUT(n)、節點Q(n)和P(n)、一輸入電路14、一提升電路24，以及一下拉電路34。本發明第四實施例之輸入電路14和提升電路24和第三實施例之輸入電路13和提升電路23之結構相同，不同之處在於本發明第四實施例中下拉電路34之結構。本發明第四實施例之下拉電路34包含一下拉單元44和一控制單元54。下拉單元44包含電晶體開關T3和T4，可依據節點P(n)之電位來維持節點Q(n)或輸出端OUT(n)之電位。控制單元54包含電晶體開關T5～T8，電晶體開關T5和T6可依據時脈訊號CK和XCK來維持節點P(n)之電位，而並聯之電晶體開關T7和T8能依據節點Q(n)之電位來維持節點P(n)之電位。並聯之電晶體開關T7和T8驅動能力較強，因此本發明第四實施例之液晶顯示裝置300在維持節點P(n)之電位時能提供更佳的下拉運作。
在前述實施例中，電晶體開關T1～T8可為薄膜電晶體(thin film transistor,TFT)開關，或其它具類似功能之元件。在本發明之液晶顯示裝置中，下拉電路能以較少元件來進行下拉運作，不但能簡化電路佈局，同時亦能有效地維持輸出端OUT之電位。
以上所述僅為本發明之較佳實施例，凡依本發明申請專利範圍所做之均等變化與修飾，皆應屬本發明之涵蓋範圍。
10～14．．．輸入電路
20～24．．．提升電路
30～34．．．下拉電路
41～44．．．下拉單元
51～54．．．控制單元
40．．．維持電路
VST．．．起始脈衝訊號
CK、XCK．．．時脈訊號
Q(n)、P(n)．．．節點
T1～T8．．．電晶體開關
VDD、VSS．．．電壓
OUT、OUT(n)．．．輸出端
100、200、300、400．．．液晶顯示裝置
110、210、310、410．．．移位暫存器
120、220、320、420．．．時脈產生器
130、230、330、430．．．電源供應器
IN1、IN2、IN(n)．．．輸入端
GL(1)～GL(N)、GL(n)．．．閘極線
GS(1)～GS(N)、GS(n)．．．閘極驅動訊號
SR(1)～SR(N)、SR(n-1)、SR(n)、SR(n+1)．．．移位暫存單元
第1圖為先前技術中一液晶顯示裝置之簡化方塊示意圖。
第2圖為第1圖之液晶顯示裝置中一第n級移位暫存單元之示意圖。
第3圖為先前技術中另一液晶顯示裝置之簡化方塊示意圖。
第4圖為第3圖之液晶顯示裝置中一第n級移位暫存單元之示意圖。
第5圖為本發明中一液晶顯示裝置之簡化方塊示意圖。
第6圖為本發明第一實施例中一第n級移位暫存單元之示意圖。
第7圖為本發明第二實施例中一第n級移位暫存單元之示意圖。
第8圖為本發明中另一液晶顯示裝置之簡化方塊示意圖。
第9圖為本發明第三實施例中一第n級移位暫存單元之示意圖。
第10圖為本發明第四實施例中一第n級移位暫存單元之示意圖。
11．．．輸入電路
21．．．提升電路
31．．．下拉電路
41．．．下拉單元
51．．．控制單元
GL(n)．．．閘極線
GS(n)．．．閘極驅動訊號
SR(n-1)、SR(n+1)．．．移位暫存單元
IN(n)．．．輸入端
OUT(n)．．．輸出端
Q(n)、P(n)．．．節點
T1～T7．．．電晶體開關
VSS．．．電壓
CK、XCK．．．時脈訊號

Claims (23)

  1. 一種移位暫存器，其包含複數級串接之移位暫存單元，其中每一級移位暫存單元包含：一輸入端，用來接收一輸入電壓；一輸出端，用來提供一輸出電壓；一第一節點；一第二節點；一輸入電路，用來依據該輸入電壓之電位來控制一第一時脈訊號和該第一節點之間的訊號導通路徑；一提升電路，用來依據該第一節點之電位來控制一第二時脈訊號和該輸出端之間的訊號導通路徑以提供該輸出電壓，其中該第一和第二時脈訊號係以一預定週期在一高電位和一低電位之間切換極性，且在同一週期內該第一和第二時脈訊號之極性相反；及一下拉電路，包含：一下拉單元，其包含一第四開關，用來依據該第二節點之電位來維持該第一節點或該輸出端之電位，該第四開關包含：一第一端，耦接於該第一節點；一第二端，用來接收一偏壓；及一控制端，耦接於該第二節點；及一控制單元，用來依據該第一時脈訊號、該第二時脈 訊號和該第一節點之電位來維持該第二節點之電位。
  2. 如請求項1所述之移位暫存器，其中該輸入電路包含：一第一開關，包含：一第一端，用來接收該第一時脈訊號；一第二端，耦接於該第一節點；及一控制端，耦接於該級移位暫存單元之輸入端。
  3. 如請求項1所述之移位暫存器，其中該提升電路包含：一第二開關，包含：一第一端，用來接收該第二時脈訊號；一第二端，耦接於該輸出端；及一控制端，耦接於該第一節點。
  4. 如請求項1所述之移位暫存器，其中該下拉單元包含：一第三開關，包含：一第一端，耦接於該輸出端；一第二端，用來接收一偏壓；及一控制端，耦接於該第二節點。
  5. 如請求項1所述之移位暫存器，其中該控制單元包含：一第五開關，包含： 一第一端，用來接收該第一時脈訊號；一第二端，耦接於該第二節點；及一控制端，耦接於該第五開關之第一端；一第六開關，包含：一第一端，用來接收該第二時脈訊號；一第二端，耦接於該第二節點；及一控制端，耦接於該第六開關之第一端；及一第七開關，包含：一第一端，耦接於該第二節點；一第二端，用來接收該偏壓；及一控制端，耦接於該第一節點。
  6. 如請求項5所述之移位暫存器，其中該控制單元另包含：一第八開關，包含：一第一端，耦接於該第二節點；一第二端，用來接收該偏壓；及一控制端，耦接於該第七開關之控制端。
  7. 如請求項1所述之移位暫存器，其中該輸入電路包含：一第一開關，包含：一第一端，用來接收該第一時脈訊號；一第二端，耦接於該第一節點；及 一控制端，耦接於該級移位暫存單元之輸入端該提升電路包含：一第二開關，包含：一第一端，用來接收該第二時脈訊號；一第二端，耦接於該輸出端；及一控制端，耦接於該第一節點；該下拉單元另包含：一第三開關，包含：一第一端，耦接於該輸出端；一第二端，用來接收該偏壓；及一控制端，耦接於該第二節點；該控制單元包含：一第五開關，包含：一第一端，用來接收該第一時脈訊號；一第二端，耦接於該第二節點；及一控制端，耦接於該第五開關之第一端；一第六開關，包含：一第一端，用來接收該第二時脈訊號；一第二端，耦接於該第二節點；及一控制端，耦接於該第六開關之第一端；及一第七開關，包含：一第一端，耦接於該第二節點；一第二端，用來接收該偏壓；及 一控制端，耦接於該第一節點。
  8. 如請求項7所述之移位暫存器，其中該控制單元另包含：一第八開關，包含：一第一端，耦接於該第二節點；一第二端，用來接收該偏壓；及一控制端，耦接於該第七開關之控制端。
  9. 如請求項1所述之移位暫存器，其中該級移位暫存器之輸入端係耦接於一前級移位暫存器之輸出端以接收該輸入訊號。
  10. 一種移位暫存器，其包含複數級串接之移位暫存單元，其中每一級移位暫存單元包含：一輸入端，用來接收一輸入電壓；一輸出端，用來提供一輸出電壓；一第一節點；一第二節點；一輸入電路，用來依據該輸入電壓之電位來控制一第一時脈訊號和該第一節點之間的訊號導通路徑；一提升電路，用來依據該第一節點之電位來控制一第二時脈訊號和該輸出端之間的訊號導通路徑以提供該輸出電壓，其中該第一和第二時脈訊號係以一預定 週期在一高電位和一低電位之間切換極性，且在同一週期內該第一和第二時脈訊號之極性相反；及一下拉電路，包含：一下拉單元，用來依據該第二節點之電位來維持該第一節點或該輸出端之電位；及一控制單元，用來依據該第一時脈訊號、該第二時脈訊號和該第一節點之電位來維持該第二節點之電位，該控制單元包含：一第五開關，包含：一第一端，用來接收該第一時脈訊號；一第二端，耦接於該第二節點；及一控制端，耦接於該第五開關之第一端；一第六開關，包含：一第一端，用來接收該第二時脈訊號；一第二端，耦接於該第二節點；及一控制端，耦接於該第六開關之第一端；及一第七開關，包含：一第一端，耦接於該第二節點；一第二端，用來接收一偏壓；及一控制端，耦接於該第一節點。
  11. 如請求項10所述之移位暫存器，其中該控制單元另包含： 一第八開關，包含：一第一端，耦接於該第二節點；一第二端，用來接收該偏壓；及一控制端，耦接於該第七開關之控制端。
  12. 一種移位暫存器，其包含複數級串接之移位暫存單元，其中每一級移位暫存單元包含：一輸入端，用來接收一輸入電壓；一輸出端，用來提供一輸出電壓；一第一節點；一第二節點；一輸入電路，用來依據該輸入電壓之電位來控制一第一時脈訊號和該第一節點之間的訊號導通路徑；一提升電路，用來依據該第一節點之電位來控制一第二時脈訊號和該輸出端之間的訊號導通路徑以提供該輸出電壓，其中該第一和第二時脈訊號係以一預定週期在一高電位和一低電位之間切換極性，且在同一週期內該第一和第二時脈訊號之極性相反；及一下拉電路，包含：一下拉單元，用來依據該第二節點之電位來維持該第一節點或該輸出端之電位，該下拉單元包含：一第四開關，包含：一第一端，耦接於該第一節點； 一第二端，用來接收一第二偏壓；及一控制端，耦接於該第二節點；及一控制單元，用來依據一第一偏壓和該第一節點之電位來維持該第二節點之電位。
  13. 如請求項12所述之移位暫存器，其中該輸入電路包含：一第一開關，包含：一第一端，用來接收該第一時脈訊號；一第二端，耦接於該第一節點；及一控制端，耦接於該級移位暫存單元之輸入端。
  14. 如請求項13所述之移位暫存器，其中該提升電路包含：一第二開關，包含：一第一端，用來接收該第二時脈訊號；一第二端，耦接於該輸出端；及一控制端，耦接於該第一節點。
  15. 如請求項12所述之移位暫存器，其中該下拉單元包含：一第三開關，包含：一第一端，耦接於該輸出端；一第二端，用來接收該第二偏壓；及一控制端，耦接於該第二節點。
  16. 如請求項12所述之移位暫存器，其中該控制單元包含：一第五開關，包含：一第一端，用來接收該第一偏壓；一第二端，耦接於該第二節點；及一控制端，耦接於該第五開關之第一端；及一第六開關，包含：一第一端，耦接於該第二節點；一第二端，用來接收該第二偏壓；及一控制端，耦接於該第一節點。
  17. 如請求項16所述之移位暫存器，其中該控制單元另包含：一第七開關，包含：一第一端，耦接於該第二節點；一第二端，用來接收該第二偏壓；及一控制端，耦接於該第六開關之控制端。
  18. 如請求項12所述之移位暫存器，其中該輸入電路包含：一第一開關，包含：一第一端，用來接收該第一時脈訊號；一第二端，耦接於該第一節點；及一控制端，耦接於該級移位暫存單元之輸入端； 該提升電路包含：一第二開關，包含：一第一端，用來接收該第二時脈訊號；一第二端，耦接於該輸出端；及一控制端，耦接於該第一節點；該下拉單元包含：一第三開關，包含：一第一端，耦接於該輸出端；一第二端，用來接收該第二偏壓；及一控制端，耦接於該第二節點；且該控制單元包含：一第五開關，包含：一第一端，用來接收該第一偏壓；一第二端，耦接於該第二節點；及一控制端，耦接於該第五開關之第一端；及一第六開關，包含：一第一端，耦接於該第二節點；一第二端，用來接收該第二偏壓；及一控制端，耦接於該第一節點。
  19. 如請求項18所述之移位暫存器，其中該控制單元另包含： 一第七開關，包含：一第一端，耦接於該第二節點；一第二端，用來接收該第二偏壓；及一控制端，耦接於該第六開關之控制端。
  20. 如請求項18所述之移位暫存器，其中該第一偏壓之電位高於該第二偏壓之電位。
  21. 如請求項12所述之移位暫存器，其中該移位暫存器之輸入端係耦接於一前級移位暫存器之輸出端以接收該輸入訊號。
  22. 一種移位暫存器，其包含複數級串接之移位暫存單元，其中每一級移位暫存單元包含：一輸入端，用來接收一輸入電壓；一輸出端，用來提供一輸出電壓；一第一節點；一第二節點；一輸入電路，用來依據該輸入電壓之電位來控制一第一時脈訊號和該第一節點之間的訊號導通路徑；一提升電路，用來依據該第一節點之電位來控制一第二時脈訊號和該輸出端之間的訊號導通路徑以提供該輸出電壓，其中該第一和第二時脈訊號係以一預定 週期在一高電位和一低電位之間切換極性，且在同一週期內該第一和第二時脈訊號之極性相反；及一下拉電路，包含：一下拉單元，用來依據該第二節點之電位來維持該第一節點或該輸出端之電位；及一控制單元，用來依據一第一偏壓和該第一節點之電位來維持該第二節點之電位，該控制單元包含：一第五開關，包含：一第一端，用來接收該第一偏壓；一第二端，耦接於該第二節點；及一控制端，耦接於該第五開關之第一端；及一第六開關，包含：一第一端，耦接於該第二節點；一第二端，用來接收一第二偏壓；及一控制端，耦接於該第一節點。
  23. 如請求項22所述之移位暫存器，其中該控制單元另包含：一第七開關，包含：一第一端，耦接於該第二節點；一第二端，用來接收該第二偏壓；及一控制端，耦接於該第六開關之控制端。
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