TW408473B - Method for fabricating semiconductor nanocrystal and semiconductor memory device using the semiconductor nanocrystal - Google Patents

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TW408473B
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Kenta Nakamura
Yasumori Fukushima
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Description

408473 五、發明說明(1) 發明背景 本發明係關於一製造半導體毫微結晶之方法,該結晶係 作為浮閘’用在可電性地消除與可程式化非揮發性之記憶 體及之類,本發明亦關於一利用該半導體毫微結晶之半導 體記憶裝置。 為了減少功率消耗也為了減少電子儀器之尺寸,一般認 為在高度積體化之半導體記憶裝置(EEPR0M)中,低功率消 耗與可電性地消除及程式化是必須的;此具非揮發性之半 導體記憶裝置,在通道區與閘極區間含有一浮閉7此浮閉 充作載子限制區;但是,半導體記憶裝置通常有以下問 題: U )由於熱載子引起之可靠性惡化’限制了電荷植入浮閘 益自其移除之次數,使得寫入與消除之次數受限; (i i)需要相當厚之絕緣薄膜以維持非揮發性,而且杏其存 在時’為了藉由Fowler-Nordheim隧道電流透過厚絕W緣層 植入電子或正電洞’需要大到10V或更多之電壓:钟果, 產生了熱載子’而因為由熱載子所形成之陷拼(trap)、熱 載子在介面之反應與鬆弛(relaxation),而導致絕緣薄膜 發生劣化;以及 ' (i i i)程式化與消除操作’係以一小電流,自充電至流經 浮閘放電來進行’以致於該充電與放電時間相當長(毫秒 之等級)。 在此情形下’發表於日本專利發明公開(Japanese Patent Laid-open Publication) HEI ?、3〇 2 848 中之半導
C:\Prograra FiIes\Patent\55073.ptd 第 6 頁 408473 五、發明說明(2) 體記憶裝置,已解決了( i )至(i i i.)之問題;在此半導體記 憶裝置中,如圖5所示,源極區丨〇 8與汲極區丨丨〇係於半導 體基板120中,以特定間隔形成,而浮閘〗〇4藉由絕緣層 11 2在半導體基板1 2 0上形成,並位在相對於源極與汲極區 1 0 8、11 0間之通道區1 〇 6的區域中;之後,在浮閘1 〇 4上覆 蓋絕緣層11 2,並在其上再形成控制閘極11 〇 ;該浮閘 104,如圖6中所示’係由直徑1ηηι至2〇nm之半導體材料’ 形成之聚體或島122 ;再者,將位在通道區丨〇6與浮閘1〇4 間之絕緣層11 2變薄’直到電子能夠藉由隧道效應直接穿 過它,而浮閘1 04係位於較通道區丨06為.低之能階,因此捕 捉之電子不易自其逃脫。 製作該浮閘之方法係描述於以下兩份文獻: (1)石夕 ^:微晶體之 s己憶體(A silicon nanocrystals based memory) ’ Sandip Tiwari 等人,應用物理通訊(Appl.
Phys· Lett. ),第68 冊、第l〇 號,第 1 3 7 7 頁( 1 9 9 6 年) 圖7示意地示出一半導體記憶裝置之截面圖,該裝置具 有此文獻中所述之浮閘;1, 1 n m至1. 8 n m厚之隧道絕緣薄 膜202係形成於半導體基板201上,源極區2〇6與汲極區207 在該基板中形成,而直徑5 nm間隔5 nm之毫微結晶2 〇 3, 則以C V D (化學氣相沈積)設備形成於隧道絕緣薄膜2 〇 2上; 毫微結晶2 0 3之密度為1 X 1 〇12 c 2 ;再者,在毫微結晶上 有控制閘極絕緣薄膜2 0 4形成,而控制閘極絕緣2 〇 4上則沈 積了 7 nm厚之Si02,藉此形成控制閘極2 0 5。 (2 )快速與長維持間之毫微結晶記憶體(f a s t a n d L ο n g
C:\Prograra Files\Patent\55073.ptd 第7頁 408473 五、發明說明(3) Retention-Time Nano-Crystal Memory),Hussein I Hanafi 等人,IEEE 電子裝置集刊(Trans. Electron Device)第 43 冊,第 1 3 7 9 頁( 1 9 9 6 年) 圖8A至8C示出一製作半導體記憶裝置之方法,該裝置具 有如此文獻.中所述之浮閘;在半導體基板301上形成一5 nm至20 nm之熱氧化物薄膜3 0 2 (如圖8A中所示),然後將高 #雜量之梦Si或鍺Ge離子佈植進入熱氧化物薄膜302,至 過飽和量(圖8 B所示);在此情形中,該離子佈植係以,例 如,5 keV與5 X 1 015 cnf2之條件進行;在此之後,於氮氣 A環境中,進行30分鐘950度C之熱處理,藉此在熱氧化物 薄膜3 0 2中,生長矽Si或鍺Ge之直徑5 nm毫微結晶30 3 ;然 後,在半導體基板3 0 1中以特定之間隔,形成源極區3 〇 5與 汲極區306 ’而閘極電極304則形成於熱氧化物薄膜302之 上’位在一相對於源極區3 0 5與沒極區3 0 6間.區域之區域 (示於圖8C)。 正如以上文獻(1)與(2)所述,起使電位V t h之位移電位 △ V t h ’其係當每一個毫微結晶儲存一個電子之結果,可 以下列方程式表示: AVth = q(nwell/ eox)(tcntl + ( εοχ + esl)tweIi/2)..... (Eq. 1) 其中q是電子電量; nwell是毫微結晶密度; e ox該氧化物薄膜之介電常數; tcnu是控制閘極氧化物薄膜之厚度;
C:\Program Files\Patent\55073.ptd 第 8 頁 408473 五、發明說明(4) *" -~~ 是矽之介電常數; t 是毫微結晶之大小 veil 如方程式^ ),可 所揭不’可以知道裝置特性之變動(△ Vth 變動來減错卩、由·減少毫微結晶密度n與毫微結晶大小%…之 薄膜 /、’而且’因為在毫微結晶與通道間之隧道絕緣 喊遣Μ ΐ二決定性地調節電子之直接隧道至毫微晶體(該 产之變叙2 =隧道絕緣薄膜厚度之函數表示),此薄膜厚 i、其料^ Ϊ程式化特性之變動;因此,該毫微結晶密 =A , γ π晶大小、及毫微結晶與通道間之隧道絕緣薄膜 ς σ以硯為記憶體本質上要控制之主要參數。 社,ί討論文獻(1)與(2)中所提及之毫微結晶密度、毫微 广與及耄微結晶與通道間之隧道絕緣薄膜厚度。 在文獻(1): 1)之半導體記憶裝置,可視作一個使用毫微結晶 之 、’且其中該結晶偶然出現在基尨s i 02薄膜之表面 ^ ^以島狀形式,環繞CVD製程初始狀態產生之隨機晶 f t長,在任一情形中,毫微晶體密度與毫微晶體大小皆 赉法控制;關於毫微結晶與通道間之隧道絕緣薄膜厚度, ==板之前已加熱氧化,所以該薄膜厚度應可以 先則技術控制。 在文獻(2): 在文獻(2)之半導體記憶裝置中,係將矽以 佈植進入熱氧化物薄膜3〇2巾,然:後做熱處理4鍺“離子 結晶生長於熱氧化物薄膜3 02中,·在此情形中,所以毫微 ’ ,離子佈植
C: \Prograni Fi les\Patent\55073. ptd 第9頁 408473 五、發明說明(5) ~ ί辰度以階梯狀分佈,使得在熱氧化物薄膜3 〇 2中之離子濃 度無法均勻;,果,因為熱處理之進行伴隨濃度分佈之變 動,所以在熱氧化物薄膜3 〇 2中之階梯狀毫微結晶密度也 具有一個分佈’其中要控制毫微結晶密度、毫微結晶大 小、及毫微結晶與通道間之隧道絕緣薄膜厚度,被認為是 很困難的;也就是說,欲改善毫微結晶密度、毫微結晶大 小、及毫微結晶與通道間隧道絕緣薄膜厚度之可控性與均 勻性,是很困難的,此係欲解決之事項β 再者,為使離子佈植進入極薄之氧化物薄膜、厚度在5 nm至20 im間,而且避免該離子到達基底之半導體基板, 必須進行盡可能低能量之離子佈植,以2〇 nm之氧化物為 例’其為5 k e V,此外,對更薄之氧化物薄膜而言,需要 降低此能量,在該情形中’以一般離子佈植設備之性能, 要控制如此低能量之離子佈植會變得很困難,因此作為一 個製作方法是不實際的。 因此本發明之一個目的,係提供一個製作半導體毫微結 晶之方法’其可尚度控制地形成半導體毫微結晶,且在密 度與大小上變動較少。 本發明之另一個目的,係提供一半導體記憶裝置,利用 半導體毫微結晶作為半導體纪憶裝置,其能夠輕易地控制 半導體毫微結晶與通道區間之絕緣薄膜厚度,引入較少特 性上之變動’如起使電位與寫入性能,並可快速重新程式 化且具非揮發性。 . 為了達成上述目的’本發明提供一製作半導體毫微結晶
C:\ProgramFiles\Patent\55073.ptd 第 10 頁 403473 五、發明說明(6) 之方法,其包含: 一步驟,其於低於大氣壓力下之低壓中,在半導體基板 上、或在該半導體基板上形成之絕緣薄膜上,沈積非晶系 半導體薄膜;以及 一步驟,在沈積非晶系半導體薄膜之後,於真空或抗氧 化之氣體環境中,以一不低於該非晶系半導體薄膜沈積溫 度之溫度,將該非晶系半導體薄膜作熱處理,藉此一群直 徑1 8 nm更小之圓球形半導體毫微結晶,以彼此相間地, 形成於半導體基板或該絕緣薄膜上。 根據本發明製作半導體毫微結晶之方法,在低於大氣壓 力之低壓下,沈積非晶糸半導體薄膜於半導體基板、或半 導體基板上形成之絕緣薄膜上之後,然後在真空或抗氧化 之氣體中,以一不低於該非晶系半導體薄膜沈積溫度之溫 度,將該非晶系半導體薄膜作熱處理,使得其所有轉變為 晶體顆粒(gra i ns ),藉此形成一群球形半導體毫微結晶; 在此製程中,非晶系半導體薄膜之沈積厚度n t” ,毫微結 晶之半徑” r/ ,與相鄰結晶顆粒之中心距離"sn間之關係 為 s2t = (4 ^ /3)r03..... (Eq. 2) 在相‘鄰半導體毫微結晶間之中心距離s1',等價於半導體 毫微結晶之密度,並由非晶系半導體薄膜之厚度與熱處理 條件來決定;結果,以非晶系半導體之品質與熱處理之條 件為媒介,藉著控制相鄰半導體毫微結晶之中心距離"s" 與沈積厚度” t” ,可以控制半導體毫微結晶之密度與大
C:\Program Files\Pateat\55073.ptd 第11頁 408<173 藉使半 微結晶 毫微結 足夠長 導體毫 變動較 裝置, 晶與通 動,像 式化與 施例中 半導體 施例製 膜之後 任何自 為在結 薄膜, 變,因 結晶之 量變得 個載子 而不受 其密度 ,利用 憶裝置 絕緣薄 位與程 0 非晶系 氣之中 五 '發明說明(7) 小;而且, 型半導體毫 使該半導體 下维持電子 可以形成半 在特性上之 半導體記憶 導體毫微結 入較小之變 快速重新程 在一個實 露該非晶體 結晶。 根據此實 系半導體薄 中,在沒有 微結晶;因 生成氧化物 形狀易於改 形狀》 再者,一實施例 之後,在形成半導 膜沈積溫度以下之 氧化物薄膜。 導體毫微 之最低能 晶如同一 之時間, 微結晶, 小;此外 半導體記 道區間之 是起使電 非揮發性 ,在沈積 薄膜於空 作半導體毫微結 ’不暴露該非晶 然生成氧化物薄 晶時,表面中没 所以半導體亳微 而得到近於圓練 包含一步驟,在 體毫微結晶之前 溫度,自非晶系 直杈小於1 8 nm ’該球 較室溫之能量為高,致 限制區域,可以在室溫 熱擾動之影響;因此, 與大小之可控性佳’且 該半導體毫微結晶作為 育t*夠輕易地控制,在半 膜厚度,而在特性上引 式化性能,而能夠實現 半導體薄膜之後,不暴 ,來形成該半導體毫微 晶之方法,在沈積非晶 系半導體薄祺於空氣 骐之下,形成半導體毫 有阻擋晶體生長之自然 結晶結晶化時,其表面 之外型,其為最穩定之 洗積非晶系半導體薄獏 ,於該非晶系半導體薄 半導體薄膜之表面移去
408473 五、發明說明(8) 根據本實施例製作半導體毫微結晶之方法,在非晶系半 導體薄膜沈積之後,一旦基板暴露到空氣中,在表面自然 生成氧化物薄膜,例如,在低於大氣壓力之壓力下,以Ar 電漿濺射除去,或在矽烷氣或之類的氣體中,在高真空中 去氧化並除去,然後進行熱處理來形成半導體毫微結晶; 因此,該半導體毫微結晶結晶化時,其表面形狀易於改 變,使得該半導體毫微結晶形成近於圓球之形狀,最穩定 之形狀。 再者,一實施例還包括一步驟,在沈積非晶系半導體薄 膜之後,形成半導體毫微結晶之前,以低於一大氣壓於非 晶糸半導體薄膜之表面形成晶核。 根據此實施例製作半導體毫微結晶之方法,在非晶系半 導體薄膜,於半導體基板或形成於半導體基板上絕緣薄膜 之上沈積之後,在非晶系半導體薄膜表面上形成晶核,接 著以熱處理在低於一大氣壓之壓力,於非晶系半導體薄膜 表面,伴隨晶核之晶種生長半導體毫微結晶;因此,對於 該半導體毫微結晶之大小、形狀 '結晶性與之類的可控性 便增加了 ,以至於在這些特性中之變動得以更加減少;在 此情形中,晶核之密度可依晶核形成之條件來決定。 再者,在一實施例中,該半導體毫微結晶係由矽作成; 以及 形成晶核之步驟係在0 . 0 1托爾(T or r )或更低真空中,利 用一包含石夕烧、乙石夕烧(disilane)或丙石夕烧(trisilane) 氣體之任何一種氣體做為原料氣體來進行。
C:\Program Files\Patent\55073.ptd 第13頁 408473 五、發明說明(9) 根據此實施例製作 導體薄膜沈積之後, 或更低之低壓下,以 何一種氣體流作熱處 吸附在非晶系半導體 形成最佳的晶核,便 顆粒形成,該晶核之 烷、乙矽烷或丙矽烷 定,因而具高度可控 實施例 再者,在 以及 半導體毫微結晶之方法,在非晶系半 將基板放置於反應室中,在〇,〇1托爾 包含矽烷、乙矽烷或丙矽烷氣體之任 理\因此,氣體之分子或反應種子便 薄膜表面,藉此對半導體毫微結晶之 可輕易地形成,而不會導致島狀之矽 密度可以由溫度及氣體(其包含石夕 氣體之任何一種)流動之時間來決 性。 、 中,該半導體毫微結晶係由鍺作成; 形成晶核之步驟係在〇. 〇 1托爾(Torr)或更低真空中,利 用一包含四II化錄(germanium tetrafluoride)或四氫化 鍺(monogermane)氣體之一種氣體做為原料氣體來進行。 根據此實施例製作半導體毫微結晶之方法’在非晶系半 導體薄膜沈積之後’將基板放置於反應室中,在〇 〇丨技阔 或更低之低壓下,以包含四氟化鍺或四氫化鍺氣體.之一種 氣體流作熱處理;因此’氣體之分子或反應種子便吸附在 非晶系半導體薄膜表面’藉此對鍺之半導體毫微結晶之妒 成最佳的晶核’便可輕易地形成,而不會導致島狀之錯顆 粒形成;該晶核之密度可以由溫度及氣體(其包含四氧化 錄或四氫化鍺氣體之一種)流動之時間來決定,因而具高 度可控性》 ' ^ 再者,在一實施例中,該丰導體毫微結晶係由矽與錯作
C:\Program Files\Patent\55073. ptd 第14頁 4084^3 五 '發明說明¢10) 成;以及 形成晶核之步驟係在0.01托爾(Torr)或更低真空中 用一包含矽烷、乙矽烷或丙矽烷氣體之任何一種與四氟7 鍺或四氫化鍺之一種做為原料氣體來進行。 、 化 根據此實施例製作半導體毫微結晶之方法,在非晶 導體薄膜沈積之後,將基板放置於反應室中,在〇 ^ =半 或更低之低壓下,以包含矽烷、乙矽烷或丙石夕燒氣體爾 何一種與四氟化鍺或四氫化鍺之一種氣體流作熱處理之任 此,氣體之分子或反應種子便吸附在非晶系半導體’因 面,藉此對以矽與鍺作成之半導體毫微結晶之形成最膜表 晶核’便可輕易地形成’而不會導致島狀之發_鍺顆\佳的 成.;該晶核之密度可以由溫度及氣體(其包含石夕烧、叙形 烧或丙矽烷氣體之任何一種與四氟化鍺或四氫化I己石夕. 種)流動之時間來決定,因而具高度可控性。 之·〜 .再者,一實施例還包含一步驟,在沉積非晶系半 膜於半導體基板上’並形成半導體毫微結晶之後,=體薄 體毫微結晶表面與半導體基板表面&& Λ、 将半導 薄膜。 軋化物 根據此實施例製作半導體毫微結s 。曰日之方法,而這此 體毫微結晶係應用於半導體記憶裝番士 . . +導 晶形成於半導體基板上之後,將半導體毫微結晶表^結 導體基板表面氧m’該氧化物薄膜作為半導:與半 裝置巾,在通道區與半導體毫微結晶間之随道絕緣匕憶 可以良好之可控性形成。 碎%,
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,,,再者,在一實施例中,非a系半導體薄膜之沉積厚度 ” ” ’與相鄰半導體毫微社曰曰曰之中心距離"S”,滿足t《7Γ /6)S 之關係。 ^ ° 30 ^ 声據盘此Λ施例製作半導體毫微,结晶之ί f ’設定沉積厚 又/、+導體毫微結晶中心距離"S’1,使忐滿足沉積厚度 11”與半導體毫微結晶中心距離1t s„間之關係表示式;結 果,半導體毫微結晶可用相鄰半導體毫微結晶之間隔來形 成,而不導致相鄰半導體毫微結晶立相接觸° 再者,在一實施例中,本擄毫微結晶係由矽、鍺或 矽與鍺混合物之任彳 " J <饪何一種作成。 根據此實施例製作半導體毫微結晶之f法,由矽、鍺或 矽與鍺混合物之任何一種作成之爭導體毫微結晶,可輕易 地以現存製作設備與製程控制來形成;而且’可以輕易形 成’在半導體毫微結晶之大小、形狀、結晶性與之類上較 少變動’且具高度可控性之半導體毫微結晶。 、 再者,在一實施例中,該半導體毫微結晶係 在形成非晶系半導體薄膜之步驟中美 , 膜,係使…、乙竭丙石夕貌之任何 體,或者使用矽烷、乙矽烷或丙矽烷 2科虱 抗,化性之氣體的混合氣體作為原4 : 具有 在形成半導體毫微結晶之步驟中,叶轧體’以及 空中,或在10托爾或低於一大氣墨,係在10托爾或更低真 生長該半導體毫微結晶》 之不具氧化性氣體中, 根據此實施例製作半導體毫微社 、、日日之方法,藉由使用矽
C:\ProgramFiles\Patent\55073.pW 第 16 頁 408473 五、發明說明(12) ' --- 烷、乙矽烷或丙矽烷之任何一種氣體’或者使用矽烷、 ,烷或丙矽烷之任何一種氣體,與具抗氧化性氣體氨 氣、氮氣、氬氣或氫氣)之混合氣體,作為原料氣體,$ 應係在低於一大氣壓之真空中進行,使能沉積非晶系半 體薄膜,而接著在10托爾或更低真空中,或在10拕爾或低 於一大氣壓之不具氧化性氣體(如氦氣、氮氣、氬氣與氯 氣)中’以高於沉積溫度之溫度,進行熱處理;因此,'可 以形成在大小與形狀皆很均勻之圓球形半導體毫微結晶。 再者’在一實施例中’該半導體毫微結晶係以鍺作成; 在形成非晶系半導體薄膜之步驟中,沉基非晶鍺薄膜, 係使用四氟化鍺或四氫化鍺之一作為原料氣體,或者使用 四氟化鍺或四氫化鍺之一’與具有抗氧化性之氣體的混合 氣體作為原料氣體;以及 在形成半導體毫微結晶之步驟中,係在10托爾或更低真 空中,或在10托爾或低於一大氣壓之不具氧化性氣體中, 生長該半導體毫微結晶。 根據此實施例製作半導體毫微結晶之方法,藉由使用四 良化鍺或四氫化錯之一,或者使用四敗化錯或四氫化錯之 一種氣體,與具抗氧化性氣體(如氦氣、氮氣、氬氣或氫 氣)之混合氣體,作為原料氣體,反應係在低於一大氣壓 之真空中進行,而接著在10托爾或更低真空中,或在10托 爾或低於一大氣壓之不具氧化性氣體(如氦氣、氮氣 '氢 氣與氫氣)中,以高於沉積溫度之溫度,進行熱處理;因 此,可以形成在大小與形狀皆很均勻之圓球形半導體毫微
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該半導體毫微結晶係以矽與鍺作 五、發明說明(13) 結 再者,在一實施例中 成; 在形成非晶系半導體薄膜 膜,係使用梦烧、乙石夕燒或石 权沉基非晶,錯薄 梦烧或丙…任何一 或者使用价乙 -,與具有抗氧化性之氣體的混土=鍺或四氫化鍺之 及 孔體的混合亂體作為原料氣體;以 在形成半導體毫微結晶之步驟中,係在i 0托爾或更低真 空中’或在10托爾或低於一大氣壓之不具氧化性氣體中, 生長該半導體毫微結晶。 根據此實施例製作半導體毫微結晶之方法,藉由;g夕烧、 乙石夕烧或丙石夕炫之任何一種氣體’與四氣化錯或四氫化錯 之一作為原料氣體,或者使用矽烷、乙矽烷或丙矽烷之任 何一種氣體,與四氟化鍺或四氫化錯之~種氣體,與具抗 氧化性氣體(如氦氣、氮氣、氬氣或氩氣)之混合氣體,作 為原料氣體,反應係在低於一大氣壓之真空中進行,使能 沉積非晶系半導體薄膜,而接著在10托爾或更低真空中, 或在ίο托爾或低於一大氣壓之不具氧化性氣體(如氦氣' 氮氣、氬氣與氳氣)中,以高於沉積溫度之溫度,進行熱 4理;因此,可以形成在大小與形狀皆很均勾之圓球形半 導體毫微結晶。 再者,一實施例提供一使用半導體亳微結晶之半導體記
五、發明說明(14) 憶裝置,其中該 毫微結晶之任何 之電晶體的浮閘 ’根據此實施例 置’該半導體毫 上之電晶體的載 程式化、非揮發 與更小之面積, 附圖簡述 本發明可自以 附圖僅為說明, 圖 1A、1B、1C 圖’該裝置利用 毫微結晶之方法 圖 2A、2B、2C 情形下之製程圖 上; 半導體毫 微結晶 一種方法製作, 係用以上所述製作半導體 其用作在SOI基板上形成 之使用半導體毫微結晶之半導體記憶裝 微結晶係用作浮閘,充當形成於s〇 I基板 子限制區域;因此,可以實現可快速重新 性半導體記憶裝置,其可運用更少的元件 而且其變動也可以更小。 下詳述與所附之圖得到更完全的瞭解,該 因此並非本發明之設限,而其中: 、1D與1E係半導體記憶裝置之製作程序 根據本發明之第一實施例中,製作半導體 7 與2D係在製作半導體毫微結晶方法中,一 ’其中半導體毫微結晶係形成於矽基板 圖3係在製作半導體亳微結晶方法中,一情形下之截面 圖’其中半導體毫微結晶係形成於so I基板上; 圖、4B、4C、4D '4E與4F係半導體記憶裝置之製作程 序圖’該裝置利用根據本發明之第二實施例中,製作半導 體毫微結晶之方法; 圖5係根據先前技術之半導體記憶裝置的截面圖; 圖6係一放大圖’示出該半導體記憶裝置之浮閘;
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有愛微結晶之 半 圖7係根據先前技術,在隧道絕緣薄膜 導體記憶裝置的示意截面圖;以及 物 較 圖8A、8B與8C係製程圖,示出根據先前技術, 薄膜中具有毫微結晶之半導體記憶裝置的製作 佳實施例詳述 在熱氧化 過程。 以及 之實 本文中,根據本發明製作半導體毫微結晶之方法, 利用此毫微結晶之半導體記憶裝置,將以附圖中_ 施例加以詳述。 不 (第一貫施例) 圖1A、1B、1C、1D與1E係半導體記憶裝置之製作 圖,該裝置利用根據本發明之第—實施例中,製 毫微結晶之方法。 + ¥體 首先,如圓U中所示,矽基板1之表面,在以下 下以RTO(快速熱氧化)氧化,使得在矽基板丨表面上= nm厚之隧道絕緣薄膜2。 ❿成2 N20 與 02之混合氣體:n2〇/(n2〇 + 〇2) = 65%
溫度:1 0 5 0度C 接著,利用未示出之爐式熱壁Lp(低壓)CVD(化段斤' 設備,在同一設備中,於隧道絕緣薄膜2上沈積沈 薄膜3之沈積製程(示於圖1 b ),以及圓球形結晶之埶Ba矽 製程(示於囷1C、1D),在维持真空狀態下,以^處理 續地進行: 巧條件連 (沈積非晶矽薄膜之製程)
溫度:5 00度C
C:\Program Files\Patent\55073. ptd 第20頁 408473 五 '發明說明(16) 50 seem 1000 seem 原料氣體:矽烷 稀釋氣體:氦氣 壓力:25 Pa 沈積速率:2埃/分 薄膜厚度:4 nrn. (熱處理製程) 溫度:750度C 環境氣體:氦氣 壓力:0. 0 1托爾 在這些條件下,如圖1 D所示,可以得到毫微結晶4,其 直徑d〇 8 nm、間隔6 nm及中心距離"sn約14 nm。 「沈積非晶矽薄膜製程」之原料氣體,可以用乙矽烷或 丙矽烷取代矽烷;矽烷、乙矽烷與丙矽烷之裂解溫度依此 順戽遞減,使得沈積溫度可以依此順序降低,其中非晶矽 薄膜可以在個別溫度範圍,5 0 0至5 5 0度C、45 0至5 0 0度(:與 40 0至45 0度C中沈積;通常,當變成非常薄至10 nm或更少 時,該薄膜很容易在剛沈積時形成島形;此時為了得到連 續之薄膜,最好在較低之溫度沈積該薄膜。 再者,該稀釋氣體可以用具抗氧化性之氣體,像是氮 氣、氩氣與氬氣取代氦氣;雖然並非一定必須使用稀釋氣 體,但是稀釋氣體使得薄膜厚度均勻性之控制更為容易。 再者,在「熱處理製程」中之溫度,必須高於非晶矽薄 膜之沈積溫度,使得能夠進行結晶化;該溫度最好是6 0 0 度C或更高以利結晶化進行;通常》溫度越高,在熱處理
C:\Program Files\Patent\55073.ptd 第21頁 408473 五、發明說明(Π)_ 初期產生之晶核密度就越高,所以在此第一實施例中該溫 度設定在750度C ;而且,因為托爾或更高之壓力會導致 —些錯誤’如會形成非圓球形之毫微結晶’或者毫微 ' 口 Θ曰 在大小上會有變動,所以不希望如此;通常’為得到所需 之毫微結晶’必須設定一個適於沈積非晶矽薄膜性質之溫 度;再者,藉由在熱處理中使用少量具抗氧化性之氣體, 做為環境氣體,更易於在整個基板表面上,得到更均勻之 毫微結晶,·此外’附有CVD反應室之設備,能使基板藉由 真空之置入閉鎖室輸送,並附有退火燈泡或熱處理爐,而 能在個別之腔室中’進行非晶矽薄膜沈積製程與熱處理製 程s ▲接著’如圖1E所示’以CV])製程沈積大約7 nm厚之Si〇2 薄膜’而形成控制閘極絕緣薄膜5,接著形成多晶矽區2 域,其作為閘極電極6 ;將N型雜質以高濃度摻入此多晶矽
區域,而使得該區域成為低電阻;之後’在矽基板丨中形 成源極與汲極區7、8。 J 在此製作半導體毫微結晶之方法中’藉由控制非晶矽薄 膜3之薄膜性質、受控於熱處理條件.之相鄰毫微結晶中心 距離"s”、以及沈積薄膜厚度”t,,’便可以控制毫微結晶之 密度與大小’·再者’使毫微結晶4之直徑小於18⑽,藉此 球形毫微結晶4之最低能量變得大於室溫之能[ 微結晶4成為載子限制區域,而能夠在室溫下維持住電子 足夠長之時間,而不受熱擾動之影響。 使毫微結晶4之直徑小於丨8 nm之理由解釋如下。
C:\Program Files\Parent\55073. ptd 第22頁 408473 首先,假設球形毫微結晶係具有r〇半徑之球體,則在毫 微結晶中之基態能量E ’可以根據—般量子力學表示如 下: , θΕ ; h2/(8m) χ Π/Γ〇2)……(Eq. 3) (其中h疋普朗克常數而爪係電子之等效質量)。 為使此毫微結晶作為載子限制區域,而不受熱擾動影響, 基態能量Ε就必須大於能量擾動kT ;為達此目的,以下不 等式必須滿足: E > kT ...., (Eq. 4) (其中k是波兹曼常數而τ是溫度)。 藉由上述方程式3與4,為使毫微結晶在室溫下,有效的作 為載子限制區域,毫微結晶之直徑d〇必須滿足 dD= 2r〇 S 2h(8mkT)1/2 ~ 18 nm , · (Eq. 4) 0 再者,假设一耄微結晶係—载子限制區域,由位於毫微 結晶與絕緣薄膜周邊間之邊界的位能障(當毫微結晶是矽 而絕緣薄膜是Si 〇2,該高度是3. 2eV)所環繞,而當一個電 子已儲存在一個毫微結晶中’為能在室溫下得到阻擋另一 個電子進入該毫微結晶之效應(庫侖封鎖(c〇u丨〇m b blockade)),必須使儲存一個電子所增加之靜電能, q / ( 2 C),大於熱擾動能kT,其中該關係可由下列方程式 表示: α2/(2〇 > kT . ..... (Eq> 5) C = 4 ττ ε id0 ..... (Eq. 6) 其中q是一個電子之電荷;
C:\Program l?i les\Patent\55073, ptd 第23頁 403473 五、發明說明(19) · k是波茲曼常數; T是溫度(室溫); C是該毫微結晶之自身電容; e i是周圍絕緣薄膜之介電常數。 將方程式6帶入方程式5可得 q2/2/( π ed0) > kT d0 < q2/8 7Γ e i/kT ..... (Eq. 7) 為了在室溫滿足方程式7,該毫微結晶之直徑應 d0 S 18 nm。 因此,為使在毫微結晶中之能量量子化、而其基態能量大 於室溫下之擾動而得到庫侖封鎮,該毫微結晶之直徑大小 必須小於1 8 nm。 所以,此半導體毫微結晶之製作方法,能夠以良好可控 性形成毫微結晶,且其密度與大小之變動較小;再者,當 這些毫微結晶用於半導體記憶裝置中,一半導體記憶裝 置,其能夠輕易地控制在毫微結晶與通道區間之絕緣薄膜 的厚度1引入特性中較少之變動,像是起使電壓與程式化 性能,而能夠實現快速重新程式化並具非揮發性。 再者,在非晶矽薄膜3沈積之後,毫微結晶4在沒有任何 自然生成氧化物薄膜下形成,而不暴露該薄膜於空氣中, 因為在結晶化下表面,沒有自然生成氧化物薄膜阻擋晶體 生長,毫微結晶4結晶化時,其表面形狀易於變化,因此 得到一近於圓球形之外形,其為最穩定之形狀,如圖丨C所 示。
C:\Program Files\Pateat\55073.ptd 第24頁 408473 五 '發明說明(20) 产尤積非晶石夕薄膜3之後,如果該表面 軋,而在該表面上產生自然生成 -路於空 製程移去在表面上之自然生成氧醛,、則以後續之 地進行結晶化之熱處理,而不使 板暴露j且接著連續 :侧球形之外形,其為最穩定之形狀 因此:到. :室ΐί並設:為,經由一置入閉鎖g,其使::真= 傳运基板,除去該自然生成氧化物薄μ ;而且,上: 2:: = ::以用氫氟酸⑽)之氣體_除:… 再者,藉由設定非晶矽薄膜3之沈積厚度,,t„ f與相 微結晶4之中心距離"s",而使得其關係表示式’ 士〈(: / 6 ) s,得到滿足,可以形成該毫微結晶4使得其互相隔 開’而.不導致相鄰之毫微結晶4互相接觸。 以矽作成之毫微結晶4,其可容易地以現存之製作設備 與製程控制來形成;此外,高度可控制且在大小、形狀、 結晶性及之類較少變動之毫微結晶,可以容易地形成。 再者,矽烧與抗氧化氦氣之混合氣體,其用作原料氣 體,係置入低於一大氣壓之真空中,而能夠沈積非晶;5夕薄 膜3 ;接著’在10托爾或低壓抗氧化氦氣中,以不低於5〇〇 度C(非晶矽薄膜3之沈積溫度)之溫度(例如,750度C)下, 進行熱處理;結果,便可形成在大小與形狀都报均勻之球
408473 五、發明說明(21) 形毫微結晶4。 κ %例中褽作半導體毫微結晶之方法裡,毫 在此第 .....從 · 七佩 結晶4係在隧道絕緣薄膜2形成之後形成;可是,此順序可 以倒置;也就是說以如圖2 a中所示上述製程中,沈積非 晶石夕薄膜之相同過程,在矽基板丨丨上形成非晶矽薄膜丨2, 再以熱處理形成1 〇 nm之毫微結晶丨3,如圖2δ所示;接 著,如圖2C所示,將毫微結晶13之表面氧化約2 nm的厚 度,.而同時矽基板11之表面氧化’而能形成隧道絕緣薄膜 4b,.因此,毫微結晶13a之直徑(其表面已被氧化)大約是 8 nm ;,然後,如圖2D中戶斤示,以CVD製程在毫微結晶⑴表 ,之氧化,薄膜14a與隨道絕緣薄膜Ub上,形成大約7龍 ί 膜’精此形成控制閘極絕緣層1 5 ;之後,形成 二日日石夕區域成為閘極電極16,·在此多晶石夕區域十推入高濃 :雜質’使該區域成為低阻值;在此之後,在石夕基 =二成源極與汲極區1?、18 ;因此,在半導體基板" 導却A m13之後,藉著氣化毫微結晶13之表面與半 果屯成絕緣薄膜1 4a、1 4b,藉此該氧 化物;4勝成為,在通道區( 成)與毫微結晶U之間的隨ϋ源極與汲極區17、18間形 形成。 的陡道緣屠’且可以高度可控,丨生 鍺G: ΐ真i ΐ 一實施例詳述了矽Si之毫微結晶;可是’ 理,带:非::t可M類似地形成,•由沈積製程與熱處 开成作為非晶半導體薄膜,而可以容易地 結晶’其為高度可控制且該毫微結晶之大小、形
C:\Program Files\Patent\55073. ptd
40S473 五 '發明說明(22) ' 狀、結晶性與之類較少變動。 此非晶鍺薄膜係以LPCVD設備,在以下條件之下沈積: 原料氣體:四氟化鍺GeF4 溫度:3 5 0度C 壓力:25 Pa 此外,四氫化鍺GeH4可以作為原料氣體。 再者’矽S i與鍺Ge之毫微結晶也可以類似地形成,藉由 沈積製程與熱處理,形成非晶矽-鍺薄膜作為非晶半導"體 薄膜’而可以容易地形成毫微結晶,其為高度可控制且該 毫微結晶之大小、形狀、結晶性與之類較少變動。 此非晶矽-鍺薄膜係以LPCVD設備,在以下條件之下沈 積: 原料氣體:四氟化鍺GeF4與乙矽烷Si2H6 溫度:3 7 5度C 壓力:25 Pa 此外,四氫化鍺GeH4可以取代四氟化鍺GeF4而矽烷或丙石夕 烷可以取代乙矽烷Si2H6,作為原料氣體。 再者,雖然在第一實施例中使用矽基板,但是也可以使 用如圖3中之SOI (半導體於絕緣體上)基板,像是siMOX(以 植入氧隔離);如圖3所示,在包含半導體基板41之SOI基 板40上’形成隧道絕緣薄膜32,埋入氧化物層42與半導體 層4 3 ’以及球形毫.微結晶3 4,、彼此相間地在随道絕緣薄 膜32上形成;然後’在毫微結晶34與隧道絕緣薄膜32上, 形成控制閘極絕緣薄膜35,而間極電極36在控制閘極絕緣
C:\Program Files\Patent\55073.ptd 第 27 頁 4〇8473 五,發明說明(23) 薄膜35上之一個區域形成,該區域相對於形成於半導體層 43上之源極區37與汲極區38間之區域;藉由使用毫微結晶 34,作為形成於SOI基板4〇上之電晶體之浮閘,充作載子 限制區域,可以實現以較小數量元件及較小面積’達成可 快速重新程式化、非揮發性之半導體記憶裝置,而其在特 性之變動亦較小。 (弟二實施例) 圖4A至4F係根據本發明之第二實施例,示出使用製作半 導體毫微結晶方法,製作半導體記憶裝置之製程;此第二 實施例與第一實施例相似,除了形成晶核之外。 首先’如圖4A所示,在矽基板5 1上,以與第一實施例相 同之製程’形成隧道絕緣薄膜5 2。 再來,如圖4B所示,以與第一實施例相同之製程,沈積 4 nm厚之非晶矽薄膜5 3。 接著,在與第一實施例相同之LPCVD設備中,在非晶石夕 薄膜53之表面上,形成晶核6〇之製程(示於圖4C中),以及 以熱處理做結晶化來形成毫微結晶5 4之製程(示於圖4D、. 4E),係在以下條件之下,不暴露於空氣連續地進行: (前置處理製程) 氫氟酸HF : 1 % 時間:1分鐘 (形成晶核製程) 在進行抽真空至1 X 1(Γ9托爾之後,
溫度:5 9 0度C
C:\Program Files\Patent\55073. ptd 第28頁 4〇^47s 五、發明說明(24) 塵力:1 X 1 (Γ5托爾 seem 乙矽烷氣體:1 〇 時間:1 2分鐘 (結晶化熱處理製程) 溫度:7 7 Q度C 壓力:1 X ίο'9托爾 時間:6 0秒 U這些條件,如圖4Ε所示,具有直徑8㈣ '間隔6㈣以 及中〜距離1 4 nm之$微結晶5 4得以形成;在晶核6 〇形成 期間(在乙矽烷氣體射出期間),不發生晶體生長,而且較 高溫度與乙矽烷較長之射出時間,晶核之密度會較大;再 者’ ί長之結晶化熱處理時間,晶核也會較大;也就是 說,藉由溫度與乙石夕院射出時間、以及熱處理時間之最佳 化,能夠形成所需之毫微結晶。 考慮晶.核形成之可控性,最奸溫度在55〇至62〇度C的範 圍内,再者,可以射出矽烷或丙矽烷氣體取代乙矽烷氣 體,來形成晶核;此外,0,01托爾或更高之壓力,將導致 島形之矽顆粒形成,因此是不適合的。 再者’結晶化熱處理製程溫度只要5 5〇度C或更高,或是 相等或高於晶核形成溫度之溫度。 在此第二實施例中,形成晶核之溫度與锋續熱處理之溫 度,已設定為相同,以免去在形成晶核後改變溫度之工 作;在形成晶核之製裎中,在550度C或更低之溫度將不會 發,生結晶化;此外,毫微結晶之形成或隧道絕緣薄膜之形
C:\Prograra Files\Patent\55073. ptd 408473 五、發明說明(25) 一 ,,可以如第一實施例中在次序上先進行之;可是,當以 ,化形成隧道絕緣薄膜肖,形成毫微結晶,必須計入;微 、4晶在氧化過程期間,表面氧化之量。 接著’如圖4F所*,以CVD製程在毫微 隧道絕緣薄膜52上,报赤堃胺 ^ L , ,,Hrr ^ 先成S1 〇2,專膜,藉此形成控制閘極絕 曰3 3,之,形成多晶矽區域成為閘極電極5 6 ;在此多 入高濃度之N型雜質’使該區域成為低阻 此银作ί ^坪ί _基板51上形成源極與沒極區57、58 ° , 組毫微結晶之方法,具有如第一實施例中之 相同功能與效應;再者,扁相士, ^ , ★灶丹有在形成於係基板51上隧道絕緣薄 膜52之上’沈積非晶矽薄腺 ..a ,,Rn a 7溥膜53之後,在非晶矽薄膜53之表 面形成晶核6 0,而接.荖,A n ^ , ^ ^ . _ 者在非日日矽薄膜53之表面’透過低 於一大軋壓之低壓下之埶# 料紝b w · κι 士 仓,,‘、處理’伴隨晶核60之晶種生長毫 微結晶5 4,因此*奎料社曰c ^ Μ τ @ @ % 54之大小、形狀、結晶性與分 ^ , 便件在廷些特性中之變動得以降 定。 * •可用晶核形成之條件來決 此第二實施例之製作半導體毫 p w功ς - „ u. , Y肢笔®結晶之方法’已以矽$1 笔被結晶之情形詳述;可β ,L π… 从曰L 5 , J疋’如同第一實施例,鍺Ge毫微 結晶也可以類似地形成。 例如,在以與第一實施例鈿π st , 汽例相同製程,鍺Ge之晶核可以下 列製程形成: (前置處理製程) 氫氟酸HF : 1 %
C:\Program Fi les\Par.ent\55073. ptd 第30頁 408473 五、發明說明(26) 時間:1分鐘 (形成晶核製程) 在進行柚真空至1 X 1 0_9托爾之後, 溫度:3 9 Q度C 壓力:1 X 10 5托爾 四氫化錯GeH4 : 10 seem 時間:1 0分鐘 其中,也可使用四氟化鍺GeF4取代四氫化鍺GeH4。 (結晶化熱處理製程) 溫度:7 5 0度C 壓力:1 X 10_9托爾 時間:6 0秒 再者,以矽與鍺作成之毫微結晶也可類似地形成;例 如,在以與第一實施例相同製程沈積非晶矽-鍺薄膜後, 由矽Si與鍺Ge構成之晶核可由以下製程來形成: (前置處理製程) 氫灰酸HF : 1 % 時間:1分鐘 (形成晶椋製程) 在進行抽真空至1 X 1 (Γ3托爾之後, 溫度:3 9 0度C 壓力:1 X 1 (Γ5托爾 四氫化鍺GeH4、乙石夕烧氣體:10 seem 時間:1 2分鐘
C:\Prograin Files\Patent\55073. ptd 第31頁 408473 五、發明說明(27) 其中,可以四氟化鍺Geh取代四氫化鍺Get而矽烷或丙石夕 烷可以取代乙矽烷。 (結晶化熱處理製程) 溫度·· 75 0度C 壓力:1 X 10_9托爾 時間:6 0秒 再者,雖然在第二實施例中使用矽基板,但是也可以使 用如第一實施例中之SOI基板。 應該注意,根據本發明之製作半導體毫微結晶與半導 體記憶裝置的方法,不限於第一與第二實施例之構成,而 也可以應用至其他,使用球形半導體毫微結晶,作為 之儲存節點。 再考,已詳述之第一與第二實施例之製作半導體毫微結 晶方法,其使用非晶矽薄膜、非晶鍺薄膜與非晶矽_鍺薄 膜’作為非晶半導體薄膜;可是,非晶半導體薄膜當然不 限於這些。 根據本發明之製作半導體毫微結晶之方法,在密度、大 小與之類高度可控帝卜且其特性之變動較小之半導體毫微 結晶可以形成;再者,ϋ由使該毫微結晶之直徑小於18 7,該f料導體毫微結晶之最低能量得以大於室溫之能 S ’使仵該党微結晶作為一載子限制區域,可以在室溫維 持住電子足夠長之時間’而不受熱擾動之影響;而且,可 以實現大小在nm量級之球形半導體毫微結晶,其可以應 用到單-電子電晶體或單—電子記憶體"吏用此半導鍾毫
C:\Program Fi les\Parent\55[)73, ptci 第32頁 408473 五、發明說明(28) 微結晶,可以提供一半導體記憶裝置,其不需冷卻至低 溫,而其可以在室溫儲存資訊,並且其在特性上之變動較 小;再者,利用此半導體記憶裝置,可以實現一資訊儲存 單元(記憶體),其使用較少量之元件與較小面積,而且是 一可快速重新程式化、非揮發性半導體記憶體。 因此本發明所述,很明顯地可以許多方式變化該同一方 式;此種變化不被視為偏離本發明之精神與範圍,而所有 修改,其對熟於此技術者而言甚為明顯者,應包含在下述 之申請專利範圍中。
晶 膜 薄 ,- 緣 層膜,絕, * 緣薄晶極極,, 板絕矽結閘電區區 基道晶微制極極極 矽隧非毫控閘源汲

Claims (1)

  1. 871 162 19 408473 六、申請專利範圍 1. 一種半導體毫微結晶之製造方法,其包括: 一在於低於大氣壓之低壓中,在半導體基板上、或在 形成於半導體基板上之絕緣薄膜上,沈積非晶半導體薄膜 之步驟;以及 一在非晶半導體薄膜沈積之後,在真空中或不具氧化 性之氣體環境中,以不低於非晶半導體薄膜沈積溫度之溫 度,對該非晶半導體薄膜進行熱處理,藉此在該半導體基 板上、或在該絕緣薄膜上,形成一群直徑1 8 ΠΠ1或更小之 球形半導體毫微結晶,而使得其彼此相間隔開之步驟。. 2. 如申請專利範圍第1項之半導體毫微結晶之製造方 法,其中 在沈積非晶半導體薄膜:之後在*不暴露該非晶半導體 薄膜於空氣中之下形成該半導體毫微結晶。 3. 如申請專利範圍第1項之半導體毫微結晶之製造方 法,其又包括 一在沈積非晶半導體薄膜之後,形成該半導體毫微結 晶之前,以不高於該非晶半導體沈積溫度之溫度,自該非 晶半導體薄膜之表面除去氧化物薄膜之步驟。 4. 如申請專利範圍第1項之半導體毫微結晶之製造方 法,其還包括 一在沈積非晶半導體薄膜之後,形成該半導體毫微結 晶之前,於低於大氣壓之低壓下,在非晶半導體薄膜之表 面,形成晶核之步驟。 5. 如申請專利範圍第4項之半導體毫微結晶之製造方
    C:\Pr〇gram Files\Patent\55073. ptci 第34頁 408473 六、申請專利範圍 法,其中: 該半導體毫微結晶係以矽作成;以及 形成該晶核之步驟,係在0. 0 1托爾或更低之真空中, 利用包含望_益、乙矽烷或丙矽烷之任何一種之氣體,做為 原料氣體來進行。 6. 如申請專利範圍第4項之半導體毫微結晶之製造方 法,其中: 該半導體毫微結晶係以鍺作成;以及 形成該晶核之步驟,係在0. 01托爾或更低之真空中, 利用四氟化鍺或四氫化鍺之其中一種氣體,做為原料氣體 來進行。_ _ 7. 如申請專利範圍第4項之半導體毫微結晶之製造方 法’其中: 該半導體毫微結晶係以矽與鍺作成;以及 形成該晶核之步驟,係在0. 0 1托爾或更低之真空中, 利用包含矽烷、己矽烷或丙矽烷之任何一種氣體,與四氟 化鍺或四氫化鍺之其中一種氣體,做為原料氣體來進行。 8. 如申請專利範圍第1項之半導體毫微結晶之製造方 法,其還包括 一在該半導體基板上沈積非晶半導體薄膜與形成半導 體毫微結晶之後,氧化該半導體毫微結晶之表面與該半導 體基板之表面,藉而形成一氧化物薄膜之步驟。 9. 如申請專利範圍第1項之半導體毫微結晶之製造方 法,其中:
    C:\Program Fi les\Patent\55073. ptcl 第35頁 408473 々、申請專利範圍 該非晶半導體薄膜之沈積厚度"t ” ,與相鄰半導體毫 微結晶之中心距離” S",滿足一關係t < ( 7Γ /6)s。 1 0.如申請專利範圍第1項之半導體毫微結晶之製造方 法,其中: 該半導體毫微結晶係以矽、鍺或矽與鍺之混合物之任 何一種作成。 11,如申請專利範圍第1 0項之半導體毫微結晶之製造方 法,其中: 該半導體毫微結晶係以矽作成; 在形成非晶半導體薄膜之步驟中,係利用矽烷、乙矽 烷或丙矽烷之任何一種氣體做為原料氣體,或是利用矽 烷、乙矽烷或丙矽烷之任何一種氣體,與不具氧化性氣體 之混合氣體做為原料氣體,來沈積非晶矽薄膜;以及 在形成半導體毫微結晶之步驟中,該半導體毫微結晶 係在10托爾或更低之真空中,或在10托爾或更低之不具氧 化性氣體環境中生長。 1 2.如申請專利範圍第1 0項之半導體毫微結晶之製造方 法,其中: 該半導體宅微結晶係以錯作成, 在形成非晶半導體薄膜之步驟中,係利用四氟化鍺或 四氫化鍺之一種氣體做為原料氣體,或是利用四氟化鍺或 四氫化鍺之一種氣體,與不具氧化性氣體之混合氣體,做 為原料氣體,來沈積非晶鍺薄膜;以及 在形成半導體毫微結晶之步騍中,該半導體毫微結晶
    C:\Program Files\Patent\55073.ptd 第36頁 ^08473 六'申請專利範圍 係在10托爾或更低之真空中,或在10托爾或更低之不具氧 化性氣體環境中生長。 1 3.如申請專利範圍第1 0項之半導體毫微結晶之製造方 法,其中: 該半導體毫微結晶係以矽與鍺作成; 在形成非晶半導體薄膜之步驟中,係利用矽烷、乙矽 烷或丙矽烷之任何一種氣體與四氟化鍺或四氫化鍺之一種 氣體做為原料氣體 > 或是利用矽烷、乙矽烷或丙矽烷之任 何一種氣體,或者四氟化鍺或四氫化鍺之一種氣體,與不 具氧化性氣體之混合氣體做為原料氣體,來沈積非晶矽-鍺薄膜;以及 在形成半導體毫微結晶之步驟中,該半導體毫微結晶 係在10托爾或更低之真空中,或在10托爾或更低之不具氧 化性氣體環境中生長。 1 4. 一種使用半導體毫微結晶之半導體記憶裝置,其中 該半導體毫微結晶係以申請專利範圍第1項至第1 3項之任 何一項所界定之半導體毫微結晶之製造方法製作,該半導 體毫微結晶係用作形成於SO I基板上之電晶體之浮閘。
    C:\Program Files\Patent\55073, ptd 第37頁
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Families Citing this family (135)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
DE69940430D1 (de) * 1998-06-24 2009-04-02 Illumina Inc Dekodierung von matrixartig-angeordneten Sensoren durch Mikropartikel
KR100271211B1 (ko) * 1998-07-15 2000-12-01 윤덕용 나노결정을 이용한 비휘발성 기억소자 형성방법
US6544732B1 (en) * 1999-05-20 2003-04-08 Illumina, Inc. Encoding and decoding of array sensors utilizing nanocrystals
US6548825B1 (en) 1999-06-04 2003-04-15 Matsushita Electric Industrial Co., Ltd. Semiconductor device including barrier layer having dispersed particles
US7041170B2 (en) * 1999-09-20 2006-05-09 Amberwave Systems Corporation Method of producing high quality relaxed silicon germanium layers
US6475882B1 (en) 1999-12-20 2002-11-05 Nitride Semiconductors Co., Ltd. Method for producing GaN-based compound semiconductor and GaN-based compound semiconductor device
US6172905B1 (en) * 2000-02-01 2001-01-09 Motorola, Inc. Method of operating a semiconductor device
US6571028B1 (en) 2000-03-21 2003-05-27 Evident Technologies Optical switch having a saturable absorber
JP3285341B2 (ja) 2000-06-01 2002-05-27 士郎 酒井 窒化ガリウム系化合物半導体の製造方法
US6413819B1 (en) * 2000-06-16 2002-07-02 Motorola, Inc. Memory device and method for using prefabricated isolated storage elements
US6344403B1 (en) * 2000-06-16 2002-02-05 Motorola, Inc. Memory device and method for manufacture
US6297095B1 (en) * 2000-06-16 2001-10-02 Motorola, Inc. Memory device that includes passivated nanoclusters and method for manufacture
WO2002003430A2 (en) * 2000-06-29 2002-01-10 California Institute Of Technology Aerosol process for fabricating discontinuous floating gate microelectronic devices
JP2003158075A (ja) * 2001-08-23 2003-05-30 Sumitomo Mitsubishi Silicon Corp 半導体基板の製造方法及び電界効果型トランジスタの製造方法並びに半導体基板及び電界効果型トランジスタ
US6455372B1 (en) * 2000-08-14 2002-09-24 Micron Technology, Inc. Nucleation for improved flash erase characteristics
KR100347146B1 (ko) * 2000-08-31 2002-08-03 주식회사 하이닉스반도체 단전자점 메모리 소자의 양자점 제조방법 및 단전자메모리 소자 제조방법
JP3466144B2 (ja) 2000-09-22 2003-11-10 士郎 酒井 半導体の表面を荒くする方法
US6646302B2 (en) * 2000-11-21 2003-11-11 Cornell Research Foundation, Inc. Embedded metal nanocrystals
US6697548B2 (en) 2000-12-18 2004-02-24 Evident Technologies Fabry-perot opitcal switch having a saturable absorber
KR100425934B1 (ko) * 2000-12-29 2004-04-03 주식회사 하이닉스반도체 실리콘-게르마늄막 형성 방법
JP2002208541A (ja) * 2001-01-11 2002-07-26 Shiro Sakai 窒化物系半導体装置及びその製造方法
AU2002306436A1 (en) * 2001-02-12 2002-10-15 Asm America, Inc. Improved process for deposition of semiconductor films
JP5016164B2 (ja) * 2001-02-22 2012-09-05 シャープ株式会社 メモリ膜およびその製造方法、並びにメモリ素子、半導体記憶装置、半導体集積回路および携帯電子機器
US7491634B2 (en) * 2006-04-28 2009-02-17 Asm International N.V. Methods for forming roughened surfaces and applications thereof
US7563715B2 (en) 2005-12-05 2009-07-21 Asm International N.V. Method of producing thin films
US9139906B2 (en) * 2001-03-06 2015-09-22 Asm America, Inc. Doping with ALD technology
KR100427640B1 (ko) * 2001-03-15 2004-04-27 한국과학기술연구원 탄소미세구조를 이용한 rlc 회로
JP2002280465A (ja) * 2001-03-19 2002-09-27 Sony Corp 不揮発性半導体記憶装置およびその製造方法
JP3520919B2 (ja) 2001-03-27 2004-04-19 士郎 酒井 窒化物系半導体装置の製造方法
JP3548735B2 (ja) 2001-06-29 2004-07-28 士郎 酒井 窒化ガリウム系化合物半導体の製造方法
US7110640B2 (en) 2001-07-19 2006-09-19 Evident Technologies Reconfigurable optical add/drop filter
JP2003068891A (ja) * 2001-08-24 2003-03-07 Hitachi Ltd 半導体記憶素子、半導体装置及びその制御方法
WO2003021635A2 (en) 2001-09-05 2003-03-13 Rensselaer Polytechnic Institute Passivated nanoparticles, method of fabrication thereof, and devices incorporating nanoparticles
KR100408743B1 (ko) 2001-09-21 2003-12-11 삼성전자주식회사 양자점 형성 방법 및 이를 이용한 게이트 전극 형성 방법
US6656792B2 (en) * 2001-10-19 2003-12-02 Chartered Semiconductor Manufacturing Ltd Nanocrystal flash memory device and manufacturing method therefor
AU2003202872A1 (en) * 2002-01-04 2003-07-24 Nuccon Technologies Inc. Preparation of nano-sized crystals
KR100400717B1 (ko) * 2002-01-16 2003-10-08 한국전자통신연구원 나노 트랜지스터의 제조 방법
US7005685B2 (en) 2002-02-28 2006-02-28 Shiro Sakai Gallium-nitride-based compound semiconductor device
EP2192616B1 (en) * 2002-05-22 2012-12-05 Fujitsu Limited Quantum semiconductor device and method for fabricating the same
US7005697B2 (en) * 2002-06-21 2006-02-28 Micron Technology, Inc. Method of forming a non-volatile electron storage memory and the resulting device
US7186630B2 (en) 2002-08-14 2007-03-06 Asm America, Inc. Deposition of amorphous silicon-containing films
JP4405715B2 (ja) * 2002-08-23 2010-01-27 キヤノンアネルバ株式会社 酸素あるいは窒素で終端されたシリコンナノ結晶構造体の形成方法とこれにより形成された酸素あるいは窒素で終端されたシリコンナノ結晶構造体
US6808986B2 (en) * 2002-08-30 2004-10-26 Freescale Semiconductor, Inc. Method of forming nanocrystals in a memory device
US7462857B2 (en) * 2002-09-19 2008-12-09 Sharp Kabushiki Kaisha Memory device including resistance-changing function body
US6762094B2 (en) * 2002-09-27 2004-07-13 Hewlett-Packard Development Company, L.P. Nanometer-scale semiconductor devices and method of making
FR2846795A1 (fr) * 2002-11-05 2004-05-07 St Microelectronics Sa Procede de memorisation d'une donnee binaire dans une cellule-memoire d'un circuit integre de memoire, circuit integre correspondant et procede de fabrication
US7259984B2 (en) * 2002-11-26 2007-08-21 Cornell Research Foundation, Inc. Multibit metal nanocrystal memories and fabrication
KR100763897B1 (ko) * 2002-12-23 2007-10-05 삼성전자주식회사 나노도트를 가지는 메모리 제조방법
US7083586B2 (en) * 2003-02-03 2006-08-01 Dj Orthopedics, Llc Patellofemoral brace
US20070056465A1 (en) * 2003-03-06 2007-03-15 Rensselaer Polytechnic Institute Rapid generation of nanoparticles from bulk solids at room temperature
JP4541651B2 (ja) * 2003-03-13 2010-09-08 シャープ株式会社 抵抗変化機能体、メモリおよびその製造方法並びに半導体装置および電子機器
US6784103B1 (en) 2003-05-21 2004-08-31 Freescale Semiconductor, Inc. Method of formation of nanocrystals on a semiconductor structure
DE10326805B4 (de) * 2003-06-13 2007-02-15 Infineon Technologies Ag Herstellungsverfahren für nichtflüchtige Speicherzellen
US7045851B2 (en) * 2003-06-20 2006-05-16 International Business Machines Corporation Nonvolatile memory device using semiconductor nanocrystals and method of forming same
KR100573480B1 (ko) * 2003-06-30 2006-04-24 에스티마이크로일렉트로닉스 엔.브이. 반도체 소자의 제조 방법
KR100545898B1 (ko) * 2003-07-02 2006-01-25 동부아남반도체 주식회사 반도체 소자의 양자점 형성방법
JP2007505477A (ja) * 2003-07-23 2007-03-08 エーエスエム アメリカ インコーポレイテッド シリコン−オン−インシュレーター構造及びバルク基板に対するSiGeの堆積
KR100521433B1 (ko) * 2003-08-12 2005-10-13 동부아남반도체 주식회사 실리콘 양자점의 형성 방법 및 이를 이용한 반도체 메모리소자의 제조 방법
US20070034909A1 (en) * 2003-09-22 2007-02-15 James Stasiak Nanometer-scale semiconductor devices and method of making
US6962850B2 (en) * 2003-10-01 2005-11-08 Chartered Semiconductor Manufacturing Ltd. Process to manufacture nonvolatile MOS memory device
CN1864253A (zh) 2003-10-06 2006-11-15 马萨诸塞州技术研究院 非易失性存储装置
JP4072621B2 (ja) * 2003-10-23 2008-04-09 国立大学法人名古屋大学 シリコンナノ結晶の作製方法及びフローティングゲート型メモリキャパシタ構造の作製方法
TWI276206B (en) * 2003-11-25 2007-03-11 Promos Technologies Inc Method for fabricating flash memory device and structure thereof
US20050202615A1 (en) * 2004-03-10 2005-09-15 Nanosys, Inc. Nano-enabled memory devices and anisotropic charge carrying arrays
US7595528B2 (en) 2004-03-10 2009-09-29 Nanosys, Inc. Nano-enabled memory devices and anisotropic charge carrying arrays
EP1723676A4 (en) * 2004-03-10 2009-04-15 Nanosys Inc MEMORY DEVICES WITH NANOCAPACITIES AND ANISOTROPIC LOADED NETWORKS
WO2005087654A1 (ja) 2004-03-12 2005-09-22 Japan Science And Technology Agency 量子ドット操作方法および量子ドット生成操作装置
KR100660159B1 (ko) 2004-11-03 2006-12-21 삼성전자주식회사 고분자 박막 내에 형성된 Ni1-xFex 나노결정체를이용한 플로팅 게이트 및 이를 이용한 플래쉬 기억소자
WO2005093837A1 (en) * 2004-03-29 2005-10-06 Industry-University Cooperation Foundation Hanyang University Flash memory device utilizing nanocrystals embeded in polymer
JP5000510B2 (ja) 2004-06-08 2012-08-15 ナノシス・インク. ナノ構造単層の形成方法および形成デバイスならびにかかる単層を含むデバイス
US8563133B2 (en) 2004-06-08 2013-10-22 Sandisk Corporation Compositions and methods for modulation of nanostructure energy levels
US8088483B1 (en) 2004-06-08 2012-01-03 Nanosys, Inc. Process for group 10 metal nanostructure synthesis and compositions made using same
TW201341440A (zh) * 2004-06-08 2013-10-16 Sandisk Corp 奈米結構之沉積後包封:併入該包封體之組成物、裝置及系統
US7776758B2 (en) 2004-06-08 2010-08-17 Nanosys, Inc. Methods and devices for forming nanostructure monolayers and devices including such monolayers
US7968273B2 (en) 2004-06-08 2011-06-28 Nanosys, Inc. Methods and devices for forming nanostructure monolayers and devices including such monolayers
US7265036B2 (en) * 2004-07-23 2007-09-04 Applied Materials, Inc. Deposition of nano-crystal silicon using a single wafer chamber
US7405002B2 (en) * 2004-08-04 2008-07-29 Agency For Science, Technology And Research Coated water-soluble nanoparticles comprising semiconductor core and silica coating
US7160775B2 (en) * 2004-08-06 2007-01-09 Freescale Semiconductor, Inc. Method of discharging a semiconductor device
KR100615093B1 (ko) * 2004-08-24 2006-08-22 삼성전자주식회사 나노크리스탈을 갖는 비휘발성 메모리 소자의 제조방법
JP4359207B2 (ja) * 2004-08-30 2009-11-04 シャープ株式会社 微粒子含有体の製造方法
US20060046383A1 (en) * 2004-09-02 2006-03-02 Shenlin Chen Method for forming a nanocrystal floating gate for a flash memory device
US20060054963A1 (en) * 2004-09-10 2006-03-16 Qian Rong A Non-volatile and non-uniform trapped-charge memory cell structure and method of fabrication
US7301197B2 (en) * 2004-09-21 2007-11-27 Atmel Corporation Non-volatile nanocrystal memory transistors using low voltage impact ionization
US7534489B2 (en) * 2004-09-24 2009-05-19 Agency For Science, Technology And Research Coated composites of magnetic material and quantum dots
US6980471B1 (en) 2004-12-23 2005-12-27 Sandisk Corporation Substrate electron injection techniques for programming non-volatile charge storage memory cells
US20060166435A1 (en) * 2005-01-21 2006-07-27 Teo Lee W Synthesis of GE nanocrystal memory cell and using a block layer to control oxidation kinetics
US20060189079A1 (en) * 2005-02-24 2006-08-24 Merchant Tushar P Method of forming nanoclusters
KR100699846B1 (ko) * 2005-06-16 2007-03-27 삼성전자주식회사 SiH4 플라즈마 이온주입을 이용한 실리콘 나노 결정체 형성방법 및 이를 포함한 반도체 소자
US7485526B2 (en) * 2005-06-17 2009-02-03 Micron Technology, Inc. Floating-gate structure with dielectric component
US20070020771A1 (en) * 2005-06-24 2007-01-25 Applied Nanoworks, Inc. Nanoparticles and method of making thereof
US7262991B2 (en) 2005-06-30 2007-08-28 Intel Corporation Nanotube- and nanocrystal-based non-volatile memory
US7381658B2 (en) * 2005-07-05 2008-06-03 Hewlett-Packard Development Company, L.P. Encapsulation of nano-dimensional structures by oxidation
KR100683854B1 (ko) * 2005-09-06 2007-02-15 삼성전자주식회사 비휘발성 기억 소자의 형성 방법
US7172940B1 (en) * 2005-09-15 2007-02-06 Ememory Technology Inc. Method of fabricating an embedded non-volatile memory device
KR100737829B1 (ko) * 2005-10-31 2007-07-12 고려대학교 산학협력단 나노 결정 실리콘의 제조 방법
US20070108502A1 (en) * 2005-11-17 2007-05-17 Sharp Laboratories Of America, Inc. Nanocrystal silicon quantum dot memory device
EP1818989A3 (en) * 2006-02-10 2010-12-01 Semiconductor Energy Laboratory Co., Ltd. Nonvolatile semiconductor storage device and manufacturing method thereof
US8759903B1 (en) * 2006-02-28 2014-06-24 Honeywell International Inc. Method of fabricating total dose hard and thermal neutron hard integrated circuits
EP1837917A1 (en) * 2006-03-21 2007-09-26 Semiconductor Energy Laboratory Co., Ltd. Nonvolatile semiconductor memory device
TWI416738B (zh) * 2006-03-21 2013-11-21 Semiconductor Energy Lab 非揮發性半導體記憶體裝置
US7554854B2 (en) * 2006-03-31 2009-06-30 Semiconductor Energy Laboratory Co., Ltd. Method for deleting data from NAND type nonvolatile memory
US8022460B2 (en) * 2006-03-31 2011-09-20 Semiconductor Energy Laboratory Co., Ltd. Nonvolatile semiconductor memory device
US20070262296A1 (en) * 2006-05-11 2007-11-15 Matthias Bauer Photodetectors employing germanium layers
US20080245769A1 (en) * 2006-07-17 2008-10-09 Applied Nanoworks, Inc. Nanoparticles and method of making thereof
US7445984B2 (en) 2006-07-25 2008-11-04 Freescale Semiconductor, Inc. Method for removing nanoclusters from selected regions
US7432158B1 (en) 2006-07-25 2008-10-07 Freescale Semiconductor, Inc. Method for retaining nanocluster size and electrical characteristics during processing
JP4916247B2 (ja) * 2006-08-08 2012-04-11 トヨタ自動車株式会社 炭化珪素半導体装置及びその製造方法
US7927660B2 (en) * 2006-08-21 2011-04-19 Macronix International Co., Ltd. Method of manufacturing nano-crystalline silicon dot layer
US20080121967A1 (en) * 2006-09-08 2008-05-29 Ramachandran Muralidhar Nanocrystal non-volatile memory cell and method therefor
US7517747B2 (en) * 2006-09-08 2009-04-14 Freescale Semiconductor, Inc. Nanocrystal non-volatile memory cell and method therefor
US7773493B2 (en) * 2006-09-29 2010-08-10 Intel Corporation Probe-based storage device
JP2010506408A (ja) * 2006-10-05 2010-02-25 エーエスエム アメリカ インコーポレイテッド 金属シリケート膜のald
US20080128786A1 (en) * 2006-12-04 2008-06-05 Electronics And Telecommunications Research Institute High density semiconductor memory device and method for manufacturing the same
US20080150009A1 (en) * 2006-12-20 2008-06-26 Nanosys, Inc. Electron Blocking Layers for Electronic Devices
US7847341B2 (en) 2006-12-20 2010-12-07 Nanosys, Inc. Electron blocking layers for electronic devices
US8686490B2 (en) 2006-12-20 2014-04-01 Sandisk Corporation Electron blocking layers for electronic devices
US20080150003A1 (en) * 2006-12-20 2008-06-26 Jian Chen Electron blocking layers for electronic devices
US20080150004A1 (en) * 2006-12-20 2008-06-26 Nanosys, Inc. Electron Blocking Layers for Electronic Devices
US20080179762A1 (en) * 2007-01-25 2008-07-31 Au Optronics Corporation Layered structure with laser-induced aggregation silicon nano-dots in a silicon-rich dielectric layer, and applications of the same
US9577137B2 (en) * 2007-01-25 2017-02-21 Au Optronics Corporation Photovoltaic cells with multi-band gap and applications in a low temperature polycrystalline silicon thin film transistor panel
US7932189B2 (en) * 2007-01-26 2011-04-26 Freescale Semiconductor, Inc. Process of forming an electronic device including a layer of discontinuous storage elements
US20080246101A1 (en) * 2007-04-05 2008-10-09 Applied Materials Inc. Method of poly-silicon grain structure formation
US7846793B2 (en) * 2007-10-03 2010-12-07 Applied Materials, Inc. Plasma surface treatment for SI and metal nanocrystal nucleation
JP5044443B2 (ja) * 2008-02-21 2012-10-10 株式会社東芝 半導体装置およびその製造方法
US8545936B2 (en) 2008-03-28 2013-10-01 Asm International N.V. Methods for forming carbon nanotubes
US8643079B2 (en) * 2008-05-05 2014-02-04 Micron Technology, Inc. Nanocrystal formation using atomic layer deposition and resulting apparatus
CN102044569B (zh) * 2009-10-23 2013-09-11 中芯国际集成电路制造(上海)有限公司 电容器及其制造方法
JP2011204720A (ja) * 2010-03-24 2011-10-13 Toshiba Corp 半導体装置の製造方法
US8536039B2 (en) * 2010-03-25 2013-09-17 Taiwan Semiconductor Manufacturing Co., Ltd. Nano-crystal gate structure for non-volatile memory
FR2974941B1 (fr) 2011-05-06 2013-06-14 Commissariat Energie Atomique Procede de realisation de nanocristaux de
FR2974940B1 (fr) * 2011-05-06 2015-11-13 Commissariat Energie Atomique Procede de realisation de nanocristaux de semi-conducteur orientes selon une direction pre-definie
JP5835771B2 (ja) * 2011-10-21 2015-12-24 国立大学法人北海道大学 論理回路
US9929007B2 (en) * 2014-12-26 2018-03-27 Taiwan Semiconductor Manufacturing Co., Ltd. e-Flash Si dot nitrogen passivation for trap reduction
US9892910B2 (en) * 2015-05-15 2018-02-13 International Business Machines Corporation Method and structure for forming a dense array of single crystalline semiconductor nanocrystals
KR102497991B1 (ko) * 2020-11-25 2023-02-10 한국표준과학연구원 반도체 양자점의 생성과 크기 제어 방법 및 시스템

Family Cites Families (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5508543A (en) * 1994-04-29 1996-04-16 International Business Machines Corporation Low voltage memory
US5740104A (en) * 1997-01-29 1998-04-14 Micron Technology, Inc. Multi-state flash memory cell and method for programming single electron differences
US5852306A (en) * 1997-01-29 1998-12-22 Micron Technology, Inc. Flash memory with nanocrystalline silicon film floating gate
US5850064A (en) * 1997-04-11 1998-12-15 Starfire Electronics Development & Marketing, Ltd. Method for photolytic liquid phase synthesis of silicon and germanium nanocrystalline materials

Also Published As

Publication number Publication date
KR19990030294A (ko) 1999-04-26
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JPH11111867A (ja) 1999-04-23
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