KR850003612A - 반도체 기억 장치 - Google Patents
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 실시예를 설명하기 위한 다이나믹 RAM(이하 DRAM 이라고 한다)의 메모리 셀어레이의 주요부분을 표시한 등가 회로도, 제2도a는 본 발명의 제1실시예의 DRAM의 메모리 셀의 주요부의 평면도, 제2도b는 제2도a에서 Ⅱ-Ⅱ선에 따라 절단하였을 때의 단면도, 제3도b는 본 발명의 원리를 설명하기 위한 그래프.
Claims (18)
- 제1도는 전형의 반도체 기판의 하나의 주면에 형성된 스윗칭 소자와, 상기 반도체 기판의 주면위에 형성된 제1절연막과, 일부분이 상기 스윗칭 소자에 전기적으로 접속되고, 또한 상기 제1절연막 윗쪽에 메모리 셀마다 독립적으로 형성된 제1전극, 그리고 상기 제1절연막의 아래쪽의 반도체 기판에다 상기 반도체 기판보다도 더 높은 불순물 농도를 갖는 제1도전형의 제1반도체 영역으로된 제1전극에 의하여 이루어지는 용량소자에 의하여 구성되고, 하나의 메모리 셀의 제1반도체 영역은 동일한 메모리 셀 어레이내의 상기 하나의 메모리 셀에 인접하는 메모리 셀들중에서 최소한 한 개의 메모리 셀의 제1반도체 영역과, 연속되어 있으며, 이 연속된 제1반도체 영역의 일부는 연속된 제2반도체 영역의 중앙을 가로지르게 되지만, 정전 용량으로서의 작용은 하지 않는다. 상기와 같이 구성된 메모리 셀을 가로와 세로방향으로, 배치시켜서 이루어진 메모리 셀 어레이를 갖는 반도체 기억장치.
- 상기 용량 소자는 골을 이용하여 형성되고, 이 좁은 골을 상기 반도체 기판의 하나의 주면으로부터 그 내부 방향으로 상기 반도체 기판의 일부를 제거시키므로서 형성되며, 상기 제1반도체 영역은 상기 반도체 기판의 하나의 주면과, 상기 좁은 골의 표면에 형성되어 있는 것을 특징으로 하는, 특허 청구범위 제1항 기재의 반도체 기억장치.
- 하나의 메모리 셀의 제1반도체 영역은, 동일한 메모리 셀 어레이내의 상기 하나의 메모리 셀에 인접하고, 또한 상기 하나의 메모리 셀과 동일한 비트선에 접속되어 인접하는 워드선에 접속되는 하나의 메모리셀의 제1반도체 영역과 연속되어 있는 것을 특징으로 하는 특허청구 범위 제1항 기재의 반도체 기억장치.
- 상기 반도체 기판의 주면 윗쪽에 형성된 제1절연막과, 일부분이 상기 스윗칭 소자에 전기적으로 접속되고, 또한 상기 제1절연막의 윗쪽에 메모리 셀마다 독립적으로 형성된, 제1전극, 그리고 상기 제1절연막 아래쪽의 반도체 기판에다 상기 반도체 기판보다도 더 높은 불순물 농도를 갖는 제1도전형의 제1반도체영연으로 된 제2전극에 의하여 이루어지는 제1용량 소자와, 상기 제1전극과, 상기 제1전극 윗쪽에다 최소한 형성된 제2절연막과, 최소한 상기 제2절연막위에 형성된 제3전극에 의하여 이루어진 제2용량소자에 의하여, 구성되는 것을 특징으로 하는 특허청구범위 제1항 기재의 반도체 기억장치.
- 상기 제3전극은 동일한 메모리 셀 어레이내의 모드 메모리 셀에 공통인 전극이며, 또한 하나의 메모리 셀 어레이 내에서는 일체로 형성되는 것을 특징으로 하는 특허청구범위 제4항 기재의 반도체 기억장치.
- 상기 제2절연막은 상기 제3전극 아래쪽의 전체면에 형성되어 있는 것을 특징으로 하는 특허청구범위 제5항 기재의 반도체 기억장치.
- 상기 제3전극은 상기 반도체 기억장치의 기준전위에 접속되는 것을 특징으로 하는 특허청구범위 제5항 기재의 반도체 기억장치.
- 상기 용량소자는 좁은 골을 이용하여 형성되고, 이 좁은 골은 상기 반도체 기판의 하나의 주면으로부터 그 내부 방향으로 상기 반도체 기판의 일부를 제거시키므로서 형성되며, 서기 제1반도체 영연은 상기 반도체 기판의 하나의 주면과 상기 좁은 골의 표면에 형성되는 것을 특징으로 하는 특허청구범위 제4항 기재의 반도체 기억장치.
- 하나의 메모리 셀의 제1반도체 영역은, 동일한 메모리 셀 어레이내의 상기 하나의 메모리 셀에 인접하고, 또한 상기 하나의 메모리 셀과 동일한 비트선에 접속되어 인접하는 워드선에 접속되는 하나의 메모리셀의 제1반도체 영역과 연속되어 있는 것을 특징으로 하는 특허청구범위 제4항 기재의 반도체 기억장치.
- 상기 제1반도체 영역은, 동일한 메모리 셀 어레이내의 모든 메모리 셀에 공통인 영역이며, 또한 하나의 메모리 셀 어레이내에서 연속해서 형성되어 있는 것을 특징으로 하는 특허청구범위 제1항 기재의 반도체 기억장치.
- 상기 용량 소자는 좁은 골을 이용하여 형성되고, 이 좁은 골은 상기 반도체 기판의 하나의 주면으로부터 그 내부방향으로 상기 반도체 기판의 일부를 제거시키므로서 형성되며, 상기 제1반도체 영역은 상기 반도체 기판의 하나의 주면과 상기 좁은 골의 표면에 형성되어 있는 것을 특징으로 하는 특허청구 범위 제10항 기재의 반도체 기억장치.
- 상기 반도체 기판의 주면 윗쪽에 형성된 제1절연막과, 일부분이 상기 스윗칭 소자에 전기적으로 접속되고, 또한 상기 제1절연막의 윗쪽에 메모리 셀마다 독립적으로 형성된 제1전극, 그리고 상기 제1절연막 아래쪽의 반도체 기판에다 상기 반도체 기판보다도 더 높은 불순물 농도를 갖는 제1도전형의 제1반도체 영역으로 된 제2전극에 의하여 이루어지는 제1용량 소자와, 상기 제1전극과, 상기 제1전극 윗쪽에다 최소한 형성된 제2절연막과, 최소한 상기 제3절연막 위에 형성된 제2전극에 의하여 이루어진 제2용량 소자에 의하여 구성되는 것을 특징으로 하는 특허청구 범위 제10항 기재의 반도체 기억장치.
- 상기 제3전극은 동일한 메모리 셀 어레이내의 모든 메모리 셀에 공통인 전극이며, 또한 하나의 메모리셀 어레이 내에서는, 일체로 형성되는 것을 특징으로 하는 특허청구 범위 제12항 기재의 반도체 기억장치.
- 상기 제2절연막은 상기 제3전극 아래쪽의 전체면에 형성되어 있는 것을 특징으로 하는 특허청구 범위 제12항 기재의 반도체 기억장치.
- 상기 제3전극은 상기 반도체 기억장치의 기준전위 접속되는 것을 특징으로 하는 특허청구 범위 제13항 기재의 반도체 기억장치.
- 상기 용량 소자는 좁은 골을 이용하여 형성되고, 이 좁은 골은 상기 반도체 기판의 하나의 주면으로부터 그 내부 방향으로 상기 반도체 기판의 일부를 제거시키므로서 형성되며, 상기 제1반도체 영역은, 상기 반도체 기판의 하나의 주면과, 상기 좁은 골의 표면에 형성되어 있는 것을 특징으로 하는 특허청구 범의 제12항 기재의 반도체 기억장치.
- 제1도전형의 반도체 기판의 하나의 주면에 형성된 스윗치 소자와, 상기 반도체 기판의 주면위에 형성된 제1절연막과, 일부분이 상기 스윗칭 소자에 전기적으로 접속되고, 또한 상기 제1절연막 윗쪽에 메모리 셀마다 독립적으로, 형성된 제1전극, 그리고 상기 제1절연막의 아래쪽에 반도체 기판에다 상기 반도체 기판보다도 더 높은 불순물 농도를 갖는 제1도전형의 제2반도체 영역으로 된 제2전극에 의하여 이루어지는 용량 소자에 의하여 구성되고, 상기 용량 소자는 최소한 상기 제2반도체 영역내에 나타내는 공핍층의 공간 전하의 양을, 상기 제1전극에 인가되는 제1과, 제2의 전위에 따라서, 제1과, 제2의 상태로 변화시킬수 있다. 상기와 같이 구성되는 메모리 셀을 가로와 세로 방향으로 배치시켜서 이루어진 메모리 셀을 갖는 반도체 기억장치.
- 상기의 용량 소자는 상기 제1전극에 인가되는 제1과, 제2의 전위에 따라서, 상기 제2반도체 영역내에 나타나는 공핍층의 공간 전하의 양과 또한 상기 제2반도체 영역내의 축적층의 전하의 양을 제1과, 제2의 상태로 변화시키는 것을 특징으로 하는 특허청구 범위 제17항 기재의 반도체 기억장치.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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