JPH06230739A - マルチシンク型液晶ディスプレイ装置 - Google Patents
マルチシンク型液晶ディスプレイ装置Info
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Abstract
液晶表示パネルのドット数と映像表示期間のドット数が
異なる映像信号が入力されたとしても、使用している液
晶表示パネルの画面の中央に常に映像が表示されるよう
にする。 【構成】液晶ディスプレイ装置内の回路構成を従来構成
に加えて、水平・垂直同期信号から入力映像信号の水平
・垂直周波数を求める周波数判定回路と水平・垂直制御
信号の設定が任意に変更可能な水平・垂直タイミング発
生回路を少なくとも備えた構成とする。この新規追加回
路により、入力映像信号の水平・垂直周波数を検知する
ことができるため、その周波数にあった映像信号処理お
よび水平・垂直タイミング信号の発生を制御できるた
め、使用している液晶表示パネルのドット数が異なる映
像信号が入力されても、使用している液晶表示パネルの
常に画面の中央に表示可能となる。
Description
に関し、特にマルチシンク型表示装置のように複数の信
号規格の映像信号を表示できる液晶ディスプレイ装置に
関する。
ィスプレイモニタの代替えとして薄型,低電圧,低消費
電力などの特徴を生かし、パーソナルコンピュータ,ワ
ードプロセッサ,カラーテレビなどに実用化されてい
る。しかし、従来のアナログ入力マルチシンク対応ディ
スプレイモニタとしては、CRTディスプレイモニタを
用いたマルチシンク対応ディスプレイ装置が主流を占め
ている。従来のマルチシンク対応のCRTディスプレイ
モニタは、入力されてくる水平および垂直同期信号から
その信号の水平および垂直周波数を判定し、その時の条
件にあった制御電流により、水平および垂直方向の偏向
を行うことでマルチシンク表示できるように対応してい
る。しかし、上記方法を液晶ディスプレイ装置に対応す
ることは水平および垂直偏向(駆動)方式の相違上不可
能であるため、液晶ディスプレイ装置でマルチシンクに
対応するには独自の回路構成を考える必要がある。
よび走査電極線側の駆動における表示開始位置の制御方
法は、主に図5に示すような方法が取られている。図5
(a)は、信号電極線駆動回路および走査電極線駆動回
路の構成例の一部分である。図5(a),(b),
(c)に示すように映像表示の開始位置は、多段に連な
るシフトレジスタ等で構成されている部分の初段のシフ
トレジスタに入力されるスタートパルスの位置によって
制御される。従来技術では、この表示開始位置を決定す
るスタートパルスは、液晶ディスプレイ装置の使用用途
によって固定的なタイミングで制御されている。したが
って、液晶表示パネルへの表示開始位置は、常に固定的
な位置より開始されている。従って、例えば液晶表示パ
ネルのドット数が1280×1024ドット数のものに
映像表示期間のドット数が1152×900ドット数の
ものを表示させる場合、従来技術では液晶表示パネルの
左側の上方向に片寄って表示されたり、あるいは複数ラ
インに同じ映像信号が入力されてしまうことがあった。
パネルのドット数と映像表示期間のドット数が異なる映
像信号が入力された場合、従来技術では液晶ディスプレ
イ装置における映像信号の処理、いわゆる画像圧縮およ
び入力信号の周波数判定等の処理を行っていないため、
使用している液晶表示パネルに正しく表示することは不
可能であった。
決し、使用している液晶表示パネルのドット数と映像表
示期間のドット数が異なる映像信号が入力された場合で
も、使用している液晶表示パネル内の画面の中央部分に
常に表示できるマルチシンク型の液晶ディスプレイ装置
を提供することである。
号電極がマトリックス状に配列されている液晶表示パネ
ルを用いた液晶ディスプレイ装置において、入力される
アナログR,G,B映像信号を液晶表示パネルへ表示で
きるようなタイミングに信号処理をするデータ処理回路
と、入力される水平および垂直同期信号よりその時の映
像信号の水平および垂直周波数を求め、水平・垂直タイ
ミングおよびクロック発生回路とデータ処理回路を制御
するためのデータを記憶させるメモリ回路を内蔵する周
波数判定回路と、この周波数判定回路から制御データを
もとに液晶表示パネルへの映像信号の表示開始位置など
の各タイミングを任意に設定可能とする水平タイミング
発生回路および垂直タイミング発生回路を内蔵する水平
・垂直タイミングおよびクロック発生回路とを少なくと
も備え、使用している液晶表示パネルのドット数と映像
信号表示期間のドット数が異なる映像信号が入力されて
も、使用している液晶表示パネルの画面の中央部分に映
像信号を表示できるようにすることを特徴とする。
からの制御データをもとに、映像信号の水平および垂直
方向の圧縮率を任意に制御できる画像圧縮回路を備えて
いる。また、周波数判定回路は水平および垂直同期信号
をある一定電圧に変換するための周波数一電圧変換回路
と、一定電圧値をディジタル値に変換するためのA/D
変換回路と、ディジタル値をパラメータとして水平・垂
直タイミングおよびクロック発生回路とデータ処理回路
を制御するメモリ回路を少なくとも備えている。
説明する。図1は本発明の第1の実施例のマルチシンク
型液晶ディスプレイ装置のブロック図である。本実施例
では、入力されるR,G,B映像信号を一旦ディジタル
信号へ変換し、ディジタルによる信号処理を施した後再
度アナログ信号へ変換する構成について示す。図中、1
はA/D変換回路、2は同期分離回路、3は切換スイッ
チ回路、4はデータ処理回路、5は水平・垂直タイミン
グおよびクロック発生回路、6は周波数判定回路、7は
D/A変換回路、8は走査電極線駆動回路、9,11は
信号電極線駆動回路、10は液晶表示パネル、R,G,
Bは信号線入力端子、H,Vは水平および垂直同期信号
入力端子である。第1の実施例では、使用する液晶表示
パネルの縦横のドット数と同じかあるいはそれより少な
いドット数である映像表示期間を持つ映像信号が入力さ
れた場合について示す。
示すようにA/D変換回路1へ供給され、ディジタル信
号に変換される。ディジタル信号へ変換された各R,
G,B映像信号は、それぞれデータ処理回路4内の図2
に示す信号切換回路21,23において、側へ切り換
えられることにより後段の層展開処理回路24へ直接供
給される。層展開処理回路24では、液晶表示パネル1
0の前段にある信号電極線駆動回路9,11が処理でき
るようなタイミングに処理され、再度D/A変換回路7
によりアナログ信号に変換され、アナログインターフェ
イスによって信号電極線駆動回路9,11へ供給され
る。
び垂直同期信号は、水平・垂直タイミングおよびクロッ
ク発生回路5と周波数判定回路6へ供給される。この水
平・垂直タイミングおよびクロック発生回路5と周波数
判定回路6を備えたところが本発明の新規なところであ
る。以下に、この水平・垂直タイミングおよびクロック
発生回路5と周波数判定回路6について示す。
発生回路5は、図4に示すような回路ブロックにより構
成されている。図4中、41は位相比較検出回路、42
はフィルタ回路、43は1/N分周回路、44は水平タ
イミング信号発生回路、45は電圧制御発振回路、46
はクロック制御回路、47は垂直タイミング信号発生回
路、H,Vは水平および垂直同期信号入力端子、Hse
t,Vsetは水平および垂直表示開始位置制御データ
入力端子、ACK,TCK,DCKは各種クロック出力
端子、HS,VSは水平および垂直表示開始位置制御信
号出力端子である。水平・垂直タイミングおよびクロッ
ク発生回路5では、大きく分けて2つのタイミング制御
信号を作成している。
タ処理回路4とD/A変換回路7のサンプリング用クロ
ックを、水平同期信号より作成している所である。これ
らクロック信号の作成方法は、入力電圧Vcのレベルに
対して発振周波数foが変わる電圧制御発振回路45
と、この電圧制御発振回路45の出力の周波数を1/N
(Nは入力映像信号の1水平走査期間のサンプリングク
ロック数)に分周する1/N分周回路43と、この1/
N分周回路43の出力と水平同期信号Hの2つの信号を
位相比較をして1/N分周回路43の出力周波数すなわ
ちクロックの発振周波数foの水平同期信号Hに対する
遅れ・進みを検出する位相比較検出回路41と、この位
相比較検出回路41の遅れ・進み検出動作により充放電
されるコンデンサ(図示せず)とを有し、その充放電の
結果、電圧制御発振回路45の発振周波数foを一定値
に合わせるようにレベルが上下する電圧Vcを出力する
フィルタ回路42とから成っている。このように、電圧
制御発振回路45の発振周波数foを一定値に合わせる
ようにレベルが上下する電圧Vcを入力する電圧制御発
振回路45の発振周波数foは、フィードバック制御に
よって所望の周波数を保持するように制御される。
より供給される水平および垂直表示開始位置制御データ
Hset,Vsetより、水平表示開始位置制御信号H
Sおよび垂直表示開始位置制御信号VS等の各水平およ
び垂直タイミング信号を作成している所である。図4中
に示すように、水平同期信号Hにより制御されている水
平タイミング信号発生回路44と、垂直同期信号Vによ
り制御されている垂直タイミング信号発生回路47とか
ら構成されている。
力される水平同期信号により水平タイミング信号発生回
路44内のカウンタ(図示せず)を制御し、そのカウン
タより出力されるデータを周波数判定回路6より供給さ
れる水平表示開始位置制御データHsetとデコードす
ることにより、ある一定の期間のみアクティブとなる水
平表示開始位置制御信号HSを生成している。
47では、入力される垂直同期信号により垂直タイミン
グ信号発生回路47内のカウンタ(図示せず)を制御
し、そのカウンタより出力されるデータを周波数判定回
路6より供給される垂直表示開始位置制御データVse
tとデコードすることにより、ある一定の期間のみアク
ティブとなる垂直表示開始位置制御信号HSを生成して
いる。
生回路44と垂直タイミング信号発生回路47は、周波
数判定回路6より供給される水平および垂直表示開始位
置制御データHset,Vset設定データにより、出
力される水平表示開始位置制御信号HSおよび垂直表示
開始位置制御信号VSのパルス発生位置を自由に変更す
ることができる。従って、液晶表示パネルへの映像信号
の表示開始位置を任意に制御することが可能となる。
(b)に示ように基準信号となる水平および垂直同期信
号H,Vより入力される映像信号の周波数を検知し、後
段の水平・垂直タイミングおよびクロック発生回路5と
データ処理回路4がその時の入力にあったモードで信号
処理を行うように制御している。図3(a)中、31,
32は周波数−電圧(F−V)変換回路、33,34は
A/D変換回路、35はメモリ回路である。周波数判定
回路6では、まず水平および垂直同期信号H,Vの周波
数を判定するため、各同期信号を周波数−電圧変換(F
−V変換)回路31,32によりある一定電圧に変換す
る。一定電圧値に変換された水平および垂直同期信号
は、A/D変換回路33,34によりさらにnビットの
ディジタル値に変換される。求められたディジタル値
は、後段のメモリ回路35に供給され、その2つのディ
ジタル値をパラメータとして図3(b)の表に示すよう
に、あらかじめ記憶されているデータの中から任意のデ
ータだけ出力されるような構成となっている。出力され
るこの制御データは、水平・垂直タイミングおよびクロ
ック発生回路5とデータ処理回路4へ供給され、上記に
示したように水平・垂直タイミングおよびクロック発生
回路5とデータ処理回路4を制御する。
プレイ装置では、周波数判定回路6によって水平および
垂直同期信号より、入力される映像信号の周波数を求め
ることで、例えば、使用している液晶表示パネルが12
80×1024ドット数のものに、映像表示期間のドッ
ト数が1052×900ドット数の映像信号のものを表
示する場合、周波数判定回路6より求められた制御デー
タにより、水平・垂直タイミングおよびクロック発生回
路5内の水平表示開始位置制御信号HSおよび垂直表示
開始位置制御信号VS出力のパルス発生位置をその入力
される映像信号の周波数にあったモードに設定できるた
め、使用している液晶表示パネルの上部あるいは左側に
片寄って表示されることなく、常に画面の中央部分に表
示可能となる。
信号が重畳され、H,V信号が入力されない場合は、図
1に示すように同期分離回路2により水平および垂直同
期信号を再生し、切換スイッチ回路3を同期分離回路2
側の出力が後段へ供給されるような回路構成とする。
る。この第2の実施例では、使用する液晶表示パネルの
縦横のドット数より多いドット数の映像表示期間を持つ
映像信号が入力された場合について示す。第1の実施例
と同様、入力されるR,G,B映像信号は、図1に示す
ようにA/D変換回路1へ供給され、ディジタル信号に
変換される。ディジタル信号へ変換された各R,G,B
映像信号は、それぞれデータ処理回路4内の図2に示す
信号切換回路21,23において、側へ切り換えられ
後段の画像圧縮回路22へ供給される。この信号切換回
路21,23が側へ切り換えられ、画像圧縮回路22
を上記第1の実施例の構成に追加したところが本発明の
次に新規な所である。
路ブロックにより構成されている。図2中、21,23
は信号切換回路、22は画像圧縮回路、24は層展開処
理回路、Contは切換制御信号入力端子、TCKは制
御クロック入力端子である。また画像圧縮回路22は、
書き込みアドレスカウンタ回路25と、メモリ回路26
と、読み出しアドレスカウンタ回路27で構成されてい
る。
表示パネルのドット数よりも映像表示期間のドット数が
多い映像信号な入力された場合には、第1の実施例にお
いて側に切り換えられていた信号切換回路21,23
が側へ切り換えられ、使用しているパネルのドット数
に合うように画像圧縮回路22により縦1/L,横1/
M(L,Mは実数)に圧縮される。この画像圧縮回路2
2では、フレームメモリを使用し、書き込みアドレスカ
ウンタ回路25によりメモリ回路26の各アドレスに書
き込まれた映像データを、周波数判定回路6より供給さ
れる制御信号により、任意のアドレスの映像データのみ
読み出すように読み出しアドレスカウンタ回路27を制
御している。この処理により、使用している液晶表示パ
ネルのドット数よりも映像表示期間のドット数が多い映
像信号は、使用する表示パネルのドット数と同じサイズ
の映像信号に変換される。以後は、第1の上記実施例と
同様の処理を行う。
ク型液晶ディスプレイ装置は、周波数判定回路6によっ
て水平および垂直同期信号より、入力される映像信号の
周波数を求めることで、例えば、使用している液晶表示
パネルが1052×900ドット数のものに、映像表示
期間のドット数が1280×1024ドット数の映像信
号のものを表示する場合でも、データ処理回路4内の画
像圧縮回路22において、入力される1280×102
4ドット数の映像信号を縦1/L,横1/Mに圧縮し、
使用している液晶表示パネルのドット数1052×90
0内に表示できるようにデータ処理した後、上記同様に
水平および垂直表示位置の制御を行うことにより第1の
実施例と同様に画面の中央部分に表示することが可能と
なる。尚、上記場合でも画像圧縮を必要としない場合あ
るいは故意に画像圧縮しない場合は、信号切換回路2
1,23を側へ切り換えることにより、A/D変換後
のデータを直接層展開処理回路24へ供給することがで
きる。
旦、入力映像信号処理をディジタル信号に変換してデー
タ処理を行う回路構成としたが、ディジタル信号へ変換
せずアナログ信号のままで上記一連の映像信号処理を行
うことも可能である。
している液晶表示パネルのドット数と映像表示期間のド
ット数が異なる映像信号が入力された場合でも、その入
力されてくる信号の水平および垂直同期信号の周波数を
求めることにより、そのときの周波数に応じた映像信号
処理および映像表示開始位置の制御を適時設定可能なた
め、使用している液晶表示パネルの例えば上方向に片寄
って表示されることなく、常に液晶表示パネルの画面の
中央部分に表示することが可能となる。
ック図である。
ック図である。
の詳細を示すブロック図とメモリ回路に記憶されている
データを示す図である。
ック発生回路の詳細を示すブロック図である。
のブロック図およびタイミングチャート図である。
Claims (3)
- 【請求項1】 走査電極と信号電極がマトリックス状に
配列されている液晶表示パネルを用いた液晶ディスプレ
イ装置において、入力されるアナログR,G,B映像信
号を液晶表示パネルへ表示できるようなタイミングに信
号処理をするデータ処理回路と、入力される水平および
垂直同期信号よりその時の映像信号の水平および垂直周
波数を求め、水平・垂直タイミングおよびクロック発生
回路とデータ処理回路を制御するためのデータを記憶さ
せるメモリ回路を内蔵する周波数判定回路と、この周波
数判定回路からの制御データをもとに液晶表示パネルへ
の映像信号の表示開始位置などの各タイミングを任意に
設定可能とする水平タイミング発生回路および垂直タイ
ミング発生回路を内蔵する水平・垂直タイミングおよび
クロック発生回路とを少なくとも備え、使用している液
晶表示パネルのドット数と映像信号表示期間のドット数
が異なる映像信号が入力されても、使用している液晶表
示パネルの画面の中央部分に映像信号を表示できるよう
にすることを特徴とするマルチシンク型液晶ディスプレ
イ装置。 - 【請求項2】 上記データ処理回路は、上記周波数判定
回路からの制御データをもとに、映像信号の水平および
垂直方向に圧縮率を任意に制御可能な画像圧縮回路を少
なくとも備えた請求項1記載のマルチシンク型液晶ディ
スプレイ装置。 - 【請求項3】 上記周波数判定回路は、水平および垂直
同期信号をある一定電圧に変換するための周波数一電圧
変換回路と、前記一定電圧値をディジタル値に変換する
ためのA/D変換回路と、前記ディジタル値をパラメー
タとして水平・垂直タイミングおよびクロック発生回路
とデータ処理回路を制御するメモリ回路とを少なくとも
備えた請求項1記載のマルチシンク型液晶ディスプレイ
装置。
Priority Applications (5)
Application Number | Priority Date | Filing Date | Title |
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JP5014379A JP2531426B2 (ja) | 1993-02-01 | 1993-02-01 | マルチスキャン型液晶ディスプレイ装置 |
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