JP5027381B2 - ゲート積層物にoha膜を備える不揮発性半導体メモリ装置及びその製造方法 - Google Patents
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Description
例えば、現在広く使われているフラッシュ半導体メモリ装置のメモリセルの場合、トランジスターのゲートは電荷が保存される、すなわちデータが保存されるフローティングゲートとこれを制御するコントロールゲートとが順次に積層されたものが一般的である。
図1はこのようなSONOSメモリ素子(以下、従来のSONOS素子という)の基本構成を示す断面図である。
第1シリコン酸化膜12上に窒化膜(Si3N4)14が形成されている。窒化膜14は実質的にデータが保存される物質膜であり、第1シリコン酸化膜12をトンネリングした電荷がトラップされる。このような窒化膜14上に前記電荷が窒化膜14を通過して上側に移動することを遮断するための遮断膜であって第2シリコン酸化膜16が形成されている。第2シリコン酸化膜16上にはゲート電極18が形成されている。
具体的に、駆動電圧が非常に高い。駆動電圧を下げる場合、データの保存及び消去速度が明細書上の予想された速度よりかなり遅くなる。このような電圧特性によって窒化膜14のトラップ密度調節も難しくなる。リテンション時間もまた所望するほど十分に長くない。
このような問題点は窒化膜14と酸化膜12,16の誘電率が低くて全体的に厚くなるためである。
前記報告に関わるさらに詳細な内容は非特許文献2に記載されている。
C.T.Swift外,"An Embedded 90nm SONOS Nonvolatile Memory Utilizing Hot Electron Programming and Uniform Tunnel Erase",Technical Digest of International Electron Device Meeting(IEDM 2002,December),pp.927−930 C.Lee外"Novel Structure of SiO2/SiN/High−k dielectric,Al2O3 for SONOS type flash memory",Extended Abstract of 2002 International Conf. on Solid State Device and Materials,Nagoya,Japan,Sept.2002,pp.162−163
本発明の他の実施例によれば、前記トンネリング膜と前記第1トラップ物質膜間に第1酸化膜がさらに備わっており、前記第1トラップ物質膜と前記第1絶縁膜間に第2酸化膜がさらに備わっている。この時、前記第1及び第2酸化膜はアルミニウム酸化膜であり、前記第1絶縁膜はHfO2膜、ZrO2膜、Ta2O5膜及びTiO2膜からなる群から選択されたいずれか1つである。
前記第2絶縁膜はHfO2膜、ZrO2膜、Ta2O5膜及びTiO2膜からなる群から選択されたいずれか1つである。
図2を参照して、ソース領域Sとドレイン領域Dとが、互いに所定間隔を開けた状態で、半導体基板40上に形成されている。そして、ソース領域Sとドレイン領域Dとの間の領域が、チャンネル領域に相当する。そして、このチャンネル領域の上には、ゲート積層物が設けられている。
このゲート積層物は、トンネリング酸化膜42と、第1トラップ物質層44と、高誘電率を有する第1絶縁膜46と、ゲート電極48とを、順次積層して形成されるものである。トンネリング酸化膜42の一端は、ソース領域と接触しており、他端は、ドレイン領域と接触している。トンネリング酸化膜42は、シリコン酸化膜であり、このトンネリング酸化膜42の厚さは1.5nm〜4nmほどである。
ゲート電極48及びドレイン領域Dにそれぞれ所定の電圧が印加される場合において、トンネリング酸化膜42を通過した電荷、例えば電子は、第1トラップ物質膜44にトラップされる。
第1トラップ物質膜44は、非窒化膜であることが好ましく、所定の不純物がドーピングされた高誘電率を有する絶縁膜を用いることも可能である。
このような絶縁膜として、例えば、HfO2、ZrO2、Ta2O5、TiO2、Al2O3などからなる群の中から選択された高誘電率を有する酸化膜から構成されることが好ましく、これらの中でも、HfO2膜であることが好ましい。
第1トラップ物質膜44がHfO2膜である場合、その厚さは2nm〜15nmほどである。
これらの中でも、Dyであることが好ましく、この場合のドーピング濃度は、1%〜20%ほど、望ましくは10%ほどである。
なお、本実施の形態において、ドーピング濃度は、第1トラップ物質膜44を構成する主物質を基準にしたものであり、例えば、第1トラップ物質膜44がHfO2である場合、第1トラップ物質膜にドーピングされた不純物の濃度が1%〜20%とは、Hfを基準として、1%〜20%の不純物が第1トラップ物質膜にドーピングされたことを意味するものである。
この第1絶縁膜46は、アルミニウム酸化物から構成されることが好ましいが、このアルミニウム酸化物とほぼ同じ誘電率を有する物質であれば適宜選択可能である。
ゲート電極48は、導電性不純物がドーピングされたポリシリコン電極であることが望ましいが、このポリシリコン電極の代わりに、タングステンシリサイド電極のような他の電極を用いることも可能である。
この第2実施例は、第1トラップ物質膜44の上下に、拡散を防止するための障壁層が設けられた不揮発性半導体メモリ素子に関するものである。
以下の説明において、第1実施例の説明において言及した部材と同じ部材については、第1実施例で使用した参照番号をそのまま使用して説明をする。
第1酸化膜50は、アルミニウム酸化膜である。この図3に示す例の場合、トンネリング酸化膜42の厚さは1nm〜4nmほどであり、第1酸化膜50の厚さは0.5nm〜2nmほどであり、トンネリング酸化膜42と第1酸化膜50とが一体となって、1つのトンネリング膜を構成している。
第2酸化膜52は、アルミニウム酸化膜であり、第1絶縁膜46は高誘電率を有する絶縁膜であり、この第1絶縁膜46は、HfO2、ZrO2、Ta2O5、TiO2からなる群から選択されたいずれか1つである。
本実施の形態の場合、第2酸化膜52の厚さは、0.5nm〜2nmほどであり、第1絶縁膜46の厚さは3nm〜20nmほどである。
この第3実施例は、半導体基板40のチャンネル領域上に形成されたゲート積層物に、複数のトラップ物質膜を含む不揮発性半導体メモリ装置に関するものである。
具体的には、図4を参照して、トンネリング酸化膜42の上には、第1トラップ物質膜44と第1絶縁膜46とが設けられており、そして、第1絶縁膜46の上には、第2トラップ物質膜54と、第2絶縁膜56とが順次積層されている。ゲート電極48は第2絶縁膜56上に備わっている。
第2トラップ物質膜54は、第1トラップ物質膜44と同様にして、ランタン系元素がドーピングされた高誘電率を有する絶縁膜であることが望ましいが、ランタン形元素に変えて、他の絶縁膜を用いることも可能である。
同様にして、第2絶縁膜56は、第1絶縁膜46と同じ絶縁膜であることが望ましいが、他の絶縁膜を用いることも可能である。
また、第2トラップ物質膜54と第2絶縁膜56の厚さは、第1トラップ物質膜44と第1絶縁膜46の厚さと同じであっても良いが、異なっていても良い。
この第4実施例は、拡散障壁層がさらに設けられた不揮発性半導体メモリ装置に関するものである。
具体的には、図5を参照して、トンネリング酸化膜42と第1トラップ物質膜44との間には、第1酸化膜50が設けられており、第1トラップ物質膜44と第1絶縁膜46との間には、第2酸化膜52が設けられている。そして、これら第1酸化膜50と第2酸化膜52に加えて、第1絶縁膜46と第2トラップ物質膜54との間には第3酸化膜58が、そして、第2トラップ物質膜54と第2絶縁膜56との間には第4酸化膜60が、さらに設けられている。
第3酸化膜58と第4酸化膜60とは、第1酸化膜50そして第2酸化膜52の場合と同様に拡散障壁層であり、アルミニウム酸化膜であることが望ましいが、他の酸化膜あるいは絶縁膜であっても良い。
図7において、「□」はフラットバンド電圧が2Vである時の漏れ電流密度の変化を示すグラフ(以下、第1グラフ)上の参照記号であり、「■」は前記フラットバンド電圧が1Vである時の漏れ電流密度の変化を示すグラフ(以下、第2グラフ)上の参照記号であり、「O」は有効厚さの変化を示すグラフ(以下、第3グラフ)上の参照記号である。
図8において、「O」は前記第1の場合に関するものを示すグラフ(以下、第4グラフ)上の参照記号であり、「▲」は前記第2の場合に関するものを示すグラフ(以下、第5グラフ)上の参照記号である。
図9及び図10は、それぞれ前者及び後者に関する結果を示すグラフである。
そして、ゲート電極に印加する電圧を7Vとした場合、電圧を8Vとした時よりも、フラットバンド電圧のシフトが相対的に遅いが、データの「1」と「0」とを区分するために必要とされるフラットバンド電圧の大きさが、0.5V程度であることを考えると、ゲート電極に印加する電圧が7Vである場合にも、フラットバンド電圧が初期値で0.5V以上シフトするのに要する時間は非常に短いことが判る。
このような事実は図11を参照することによりさらに明確になるが、これについては後に詳述するものとする。
そして、第12グラフG12は、ゲート電極48に消去電圧(−8V)を印加して第1トラップ物質膜44にトラップされた電荷を全て第1トラップ物質膜44から除去した後、すなわち第1トラップ物質膜44にデータ「0」を保存した後に前記データ「0」に対するリテンション時間の変化によるフラットバンド電圧の変化を示すグラフである。
そして、グラフ(G14)は、従来技術に係る不揮発性メモリ装置において、ONO膜が設けられたゲート積層物に、データ保存のための電圧(10V)を印加した際のプログラミング時間に対するフラットバンド電圧の変化を示すグラフである。
また、グラフ(G15)は、従来技術に係る不揮発性メモリ装置において、ONA(Oxide−Nitride−Aluminium oxide)膜が設けられたゲート積層物に、データ保存のための電圧(10V)を印加した際のプログラミング時間に対するフラットバンド電圧の変化を示すグラフである。
また、グラフ(G16)は、従来技術に係る不揮発性メモリ装置において、ONA膜が設けられたゲート積層物に、データ保存のために電圧(8V)を印加した際のプログラミング時間に対するフラットバンド電圧の変化を示すグラフである。
これは、本発明の実施例に係る不揮発性メモリ装置では、データ保存電圧が、従来の不揮発性メモリ装置におけるデータ保存電圧より低くても、データ保存速度は、従来の装置の場合よりも速いということを意味する。
そして、グラフ(G18、G19)は、それぞれゲート積層物にONO膜が設けられた場合と、ONA膜が設けられた場合において、従来の不揮発性メモリ装置に、消去電圧(−10V)を印加した時際の消去時間に対するフラットバンド電圧の変化を示すグラフである。
また、グラフ(G20)は、ゲート積層物にONA膜が設けられた従来の不揮発性メモリ装置に、消去電圧(−8V)を印加した際の消去時間に対するフラットバンド電圧の変化を示すグラフである。
しかし、前者の場合は、後者の場合よりも消去電圧が低いという点を勘案すれば、前者の場合に関するデータ消去特性が、後者の場合よりも優秀であるということが判る。
そして、参照符号150aと、200aと、250aとは、半導体基板とゲート電極との間に順次設けられた本発明のOHA膜に対するエネルギーバンドを示している。
本発明のトンネリング酸化膜、すなわちシリコン酸化膜のエネルギーバンド150aの傾きが、従来技術における下部シリコン酸化膜のエネルギーバンド150の傾きよりも、大きいことが判る。
このことは、半導体基板において、シリコン酸化膜を通過する電子のトンネリング速度が増加し、これに伴って、プログラミング速度も速くなることを示している。
従って、電子の速度を低下させない範囲内において、本発明に係る前記トンネリング酸化膜の厚さを、従来の下部シリコン酸化膜よりも厚くできる。
このようにすることにより、トラップ物質膜にトラップされた電子が自然漏れする可能性も低くなり、本発明のリテンション特性も従来よりも優秀になる。
これにより、本発明の場合、電子のバックトンネリングが、従来に比べて減少することになり、その結果消去速度が速くなる。
これにより、本発明のトラップ物質膜のトラップ密度は、従来の窒化膜よりも上昇することになり、本発明の場合におけるプログラミング速度及び消去速度は、従来の場合におけるプログラミング速度及び消去速度よりも速くなる。
また、従来の上部シリコン酸化膜に誘起される電場(以下、第3電場)は10.62MV/cmであるのに対し、本発明のアルミニウム酸化膜に誘起される電場(以下、第4電場)はこれより小さい8.25MV/cmであり、前記第4電場が前記第3電場より小さいということが分かる。
このように、前記第2電場が前記第1電場よりはるかに大きいために、図13に図示されたように、本発明のトンネリング酸化膜のエネルギーバンド150aの傾斜が従来の下部シリコン酸化膜のエネルギーバンド150より大きくなり、その結果として従来の下部シリコン酸化膜より、本発明のトンネリング酸化膜で電子のトンネリングがさらに多く、かつ速く起こるようになる。
また、前記第3電場より前記第4電場が小さいために、図13に図示されたように本発明のアルミニウム酸化膜のエネルギーバンド250aの傾斜が、従来の上部シリコン酸化膜のエネルギーバンド250の傾斜より小さくなり、本発明のアルミニウム酸化膜のほうが、従来の上部シリコン酸化膜よりも、バックトンネリングが起こり難くなる。
従って、前記OHA膜に所定の電圧が印加された時、前記トンネリング酸化膜に最も大きい電圧が誘起され、前記アルミニウム酸化膜にその次に大きい電圧が誘起され、前記ハフニウム酸化膜に最も小さい電圧が誘起される。
このような状況のもと、前記トンネリング酸化膜の厚さ(1.8nm)が最も薄いために、前記トンネリング酸化膜に誘起される電場が最も大きくなり、前記アルミニウム酸化膜の厚さ(4.5nm)がその次に薄いために、前記アルミニウム酸化膜に誘起される電場がその次に大きく、最も厚い(6nm)前記ハフニウム酸化膜に誘起される電場が最小になる。
すなわち、各物質膜に誘起される電圧は、下部シリコン酸化膜、窒化膜及び上部シリコン酸化膜の順に大きくなるが、この時、各物質膜の厚さを考慮すれば、上部シリコン膜と下部シリコン酸化膜とに誘起される電場は同じ値になり、前記窒化膜の電場は最小値になる。
ところで、従来のONO膜の場合、本発明のOHA膜と異なり、各物質膜間の誘電率の差が本発明の場合に比べてはるかに小さい。このような関係で、従来のONO膜の下部シリコン酸化膜に誘起される電圧は1.91Vである一方、本発明のトンネリング酸化膜に誘起される電圧は3.81Vであって相互間に2倍ほどの差がつく。
ところで、従来の下部シリコン酸化膜と本発明のトンネリング酸化膜の厚さはいずれも1.8nmであるので、両者に誘起される電場の値は上の表に示されたように共に2倍ほどの差がつくこととなる。
次に、前述のような特性を有する本発明の実施例による不揮発性半導体メモリ装置の動作について図2を参照して簡略に説明する。
ゲート電極48に保存電圧(Vg)を印加しつつドレイン領域Dに所定の電圧(Vd)を印加する。この過程で、第1トラップ物質膜44に電荷、すなわち電子がトラップされ、トラップされた電荷の量によりフラットバンド電圧のシフト量が決まる。
ゲート電極48に読込み電圧(Vg’)を印加しつつドレイン領域Dにも所定の電圧(Vd’)を印加する。この時、ソース領域Sとドレイン領域D間に基準電流、例えば1μA以上の電流が流れる場合、データ「1」を読み込んだとし、前記基準電流より少ない電流が流れる場合、データ「0」を読み込んだとする。
トンネリング酸化膜42はシリコン酸化膜より形成する。この時、前記シリコン酸化膜は2nm〜4nmほどの厚さに形成する。
データが保存される第1トラップ物質膜44は、ランタン系元素が1%〜20%、望ましくは10%程度ドーピングされた、少なくとも窒化膜より誘電率の高い高誘電率を有する物質膜である。
この物質膜は、例えば、HfO2、ZrO2、Ta2O5、TiO2及びAl2O3からなる高誘電率を有する酸化膜の中から選択されたいずれか1つより形成されることが望ましいが、HfO2膜より形成することがさらに一層望ましい。
第1トラップ物質膜44をHfO2膜より形成する場合、その厚さは2nm〜15nmほどに形成することが望ましい。第1トラップ物質膜44は原子層蒸着(ALD:Atomic Layer Deposition)法、スパッタリング法または化学気相蒸着(Chemical Vapor Deposition)法より形成する。
42 トンネリング酸化膜
44 第1トラップ物質膜
46 第1絶縁膜
48 ゲート電極
S ソース領域
D ドレイン領域
Claims (40)
- ソース領域とドレイン領域とが、所定距離を開けて設けられた半導体基板と、
前記半導体基板上の、前記ソース領域と前記ドレイン領域との間に、その一端を前記ソース領域と、その他端を前記ドレイン領域と、それぞれ接触させた状態で設けられたゲート積層物とを備える不揮発性半導体メモリ装置において、
前記ゲート積層物は、
トンネリング膜と、
窒化膜よりも誘電率が高く、Dyがドーピングされた、HfO 2 膜からなる第1トラップ物質膜と、
前記窒化膜よりも高い誘電率を有する第1絶縁膜と、
ゲート電極とが順次に積層されて構成され、
前記ゲート積層物は、前記トンネリング膜、前記第1絶縁膜、前記第1トラップ物質膜の順に高くなる誘電率を有するとともに、前記トンネリング膜、前記第1絶縁膜、前記第1トラップ物質膜の順に厚さが厚く形成されていることを特徴とする不揮発性半導体メモリ装置。 - 前記トンネリング膜と前記第1トラップ物質膜との間に、第1酸化膜がさらに設けられたことを特徴とする請求項1に記載の不揮発性半導体メモリ装置。
- 前記第1トラップ物質膜と前記第1絶縁膜との間に、第2酸化膜がさらに設けられたことを特徴とする請求項1に記載の不揮発性半導体メモリ装置。
- 前記第1酸化膜はアルミニウム酸化膜であることを特徴とする請求項2に記載の不揮発性半導体メモリ装置。
- 前記第1絶縁膜はアルミニウム酸化膜であることを特徴とする請求項1に記載の不揮発性半導体メモリ装置。
- 前記第1絶縁膜は、HfO2膜、ZrO2膜、Ta2O5膜及びTiO2膜からなる群か選択されたいずれか1つであることを特徴とする請求項4に記載の不揮発性半導体メモリ装置。
- 前記Dyのドーピング濃度は、1%〜20%であることを特徴とする請求項1に記載の不揮発性半導体メモリ装置。
- 前記第1絶縁膜と前記ゲート電極との間には、
窒化膜より誘電率が高く、所定の第2不純物がドーピングされた第2トラップ物質膜と、前記窒化膜より誘電率の高い第2絶縁膜とが、順次設けられたことを特徴とする請求項1に記載の不揮発性半導体メモリ装置。 - 前記トンネリング膜と前記第1トラップ物質膜との間には、第1酸化膜がさらに設けられたことを特徴とする請求項8に記載の不揮発性半導体メモリ装置。
- 前記第1トラップ物質膜と前記第1絶縁膜との間には、第2酸化膜がさらに設けられたことを特徴とする請求項8または9に記載の不揮発性半導体メモリ装置。
- 前記第1絶縁膜と前記第2トラップ物質膜との間には、第3酸化膜がさらに設けられたことを特徴とする請求項8または9に記載の不揮発性半導体メモリ装置。
- 前記第1絶縁膜と前記第2トラップ物質膜との間には、第3酸化膜がさらに設けられたことを特徴とする請求項10に記載の不揮発性半導体メモリ装置。
- 前記第2トラップ物質膜と前記第2絶縁膜との間には、第4酸化膜がさらに設けられたことを特徴とする請求項8または9に記載の不揮発性半導体メモリ装置。
- 前記第2トラップ物質膜と前記第2絶縁膜との間には、第4酸化膜がさらに設けられたことを特徴とする請求項10に記載の不揮発性半導体メモリ装置。
- 前記第2トラップ物質膜と前記第2絶縁膜との間には、第4酸化膜がさらに設けられたことを特徴とする請求項11に記載の不揮発性半導体メモリ装置。
- 前記第2トラップ物質膜と前記第2絶縁膜との間には、第4酸化膜がさらに設けられたことを特徴とする請求項12に記載の不揮発性半導体メモリ装置。
- 前記第2トラップ物質膜は、HfO2、ZrO2、Ta2O5、TiO2及びAl2O3からなる群から選択されたいずれか1つであることを特徴とする請求項8に記載の不揮発性半導体メモリ装置。
- 前記第4酸化膜はアルミニウム酸化膜であることを特徴とする請求項13に記載の不揮発性半導体メモリ装置。
- 前記第4酸化膜はアルミニウム酸化膜であることを特徴とする請求項14ないし16のうちいずれか1項に記載の不揮発性半導体メモリ装置。
- 前記第2絶縁膜は、HfO2膜、ZrO2膜、Ta2O5膜及びTiO2膜からなる群から選択されたいずれか1つであることを特徴とする請求項8、及び14ないし16のうちいずれか1項に記載の不揮発性半導体メモリ装置。
- 前記第2絶縁膜は、HfO2膜、ZrO2膜、Ta2O5膜及びTiO2膜からなる群か選択されたいずれか1つであることを特徴とする請求項19に記載の不揮発性半導体メモリ装置。
- 前記第1酸化膜はアルミニウム酸化膜であることを特徴とする請求項9に記載の不揮発性半導体メモリ装置。
- 前記第2酸化膜はアルミニウム酸化膜であることを特徴とする請求項10に記載の不揮発性半導体メモリ装置。
- 前記第1絶縁膜は、HfO2膜、ZrO2膜、Ta2O5膜及びTiO2膜からなる群から選択されたいずれか1つであることを特徴とする請求項10に記載の不揮発性半導体メモリ装置。
- 前記第1絶縁膜は、HfO2膜、ZrO2膜、Ta2O5膜及びTiO2膜からなる群から選択されたいずれか1つであることを特徴とする請求項23に記載の不揮発性半導体メモリ装置。
- 前記第3酸化膜は、アルミニウム酸化膜であることを特徴とする請求項11に記載の不揮発性半導体メモリ装置。
- 前記第3酸化膜は、アルミニウム酸化膜であることを特徴とする請求項12に記載の不揮発性半導体メモリ装置。
- 前記Dyのドーピング濃度は1%〜20%であることを特徴とする請求項8に記載の不揮発性半導体メモリ装置。
- 前記所定の第2不純物はDyを含むランタン系元素であることを特徴とする請求項8に記載の不揮発性半導体メモリ装置。
- 前記ランタン系元素のドーピング濃度は1%〜20%であることを特徴とする請求項29に記載の不揮発性半導体メモリ装置。
- 半導体基板上にトンネリング酸化膜、窒化膜より誘電率が高く、Dyがドーピングされた、HfO 2 膜からなる第1トラップ物質膜、前記窒化膜より誘電率の高い第1絶縁膜及びゲート電極を順次に形成する段階と、
前記ゲート電極上にゲート領域を限定する感光膜パターンを形成する段階と、
前記感光膜パターン周囲の前記ゲート電極、前記第1絶縁膜、前記第1トラップ物質膜及び前記トンネリング酸化膜を順次にエッチングしてゲート積層物を形成する段階と、
前記感光膜パターンを除去する段階と、
前記ゲート積層物周囲の前記半導体基板にソース及びドレイン領域を形成する段階とを含み、
前記ゲート積層物は、前記トンネリング膜、前記第1絶縁膜、前記第1トラップ物質膜の順に高くなる誘電率を有するとともに、前記トンネリング膜、前記第1絶縁膜、前記第1トラップ物質膜の順に厚さが厚く形成されていることを特徴とする不揮発性半導体メモリ装置の製造方法。 - 前記第1トラップ物質膜の上下部のうち少なくともいずれか1ヵ所に酸化膜をさらに形成することを特徴とする請求項31に記載の不揮発性半導体メモリ装置の製造方法。
- 前記第1絶縁膜と前記ゲート電極との間に、所定の第2不純物がドーピングされた第2トラップ物質膜と、第2絶縁膜とを順次にさらに形成することを特徴とする請求項31に記載の不揮発性半導体メモリ装置の製造方法。
- 前記第1トラップ物質膜の上部と下部、前記第2トラップ物質膜の上部と下部のうち少なくともいずれか1ヵ所に酸化膜をさらに形成することを特徴とする請求項33に記載の
不揮発性半導体メモリ装置の製造方法。 - 前記第1絶縁膜はHfO2膜、ZrO2膜、Ta2O5膜及びTiO2膜からなる群から選択されたいずれか1つより形成することを特徴とする請求項31ないし34のうちいずれか1項に記載の不揮発性半導体メモリ装置の製造方法。
- 前記酸化膜はアルミニウム酸化膜より形成することを特徴とする請求項32ないし34のうちいずれか1項に記載の不揮発性半導体メモリ装置の製造方法。
- 前記第2トラップ物質膜はHfO2膜、ZrO2膜、Ta2O5膜、TiO2膜及びAl2O3膜からなる群のうち選択されたいずれか1つより形成することを特徴とする請求項33または34に記載の不揮発性半導体メモリ装置の製造方法。
- 前記第2絶縁膜はHfO2膜、ZrO2膜、Ta2O5膜及びTiO2膜からなる群から選択されたいずれか1つより形成することを特徴とする請求項33に記載の不揮発性半導体メモリ装置の製造方法。
- 前記Dyのドーピング濃度は1%〜20%であることを特徴とする請求項31に記載の不揮発性半導体メモリ装置の製造方法。
- 前記第2不純物はDyを含むランタン系元素であり、そのドーピング濃度は1%〜20%であることを特徴とする請求項33に記載の不揮発性半導体メモリ装置の製造方法。
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